JP2519519Y2 - Data storage device - Google Patents
Data storage deviceInfo
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- JP2519519Y2 JP2519519Y2 JP1987008585U JP858587U JP2519519Y2 JP 2519519 Y2 JP2519519 Y2 JP 2519519Y2 JP 1987008585 U JP1987008585 U JP 1987008585U JP 858587 U JP858587 U JP 858587U JP 2519519 Y2 JP2519519 Y2 JP 2519519Y2
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Description
【考案の詳細な説明】 [考案の技術分野] この考案はデータ記憶装置に関する。TECHNICAL FIELD OF THE INVENTION The present invention relates to a data storage device.
[考案の背景] シーケンサ機能を備える電子楽器として、そのシーケ
ンサメモリに複数の楽音トラックデータを記憶できるも
のが知られている。この種の装置では、シーケンサメモ
リの全空間を固定的に分割し、各分割領域を各トラック
データの記憶領域として割り当てている。BACKGROUND OF THE INVENTION As an electronic musical instrument having a sequencer function, there is known an electronic musical instrument capable of storing a plurality of musical sound track data in its sequencer memory. In this type of device, the entire space of the sequencer memory is fixedly divided, and each divided area is assigned as a storage area for each track data.
したがって、トラックデータの記憶領域は固定長であ
り、分割領域を越える量のトラックデータを記憶させる
ことはできない。また、トラックデータが分割領域の一
部しか使用していない場合でも、空いている空間を他の
トラックデータのために使用することができず、メモリ
の使用効率がよくないという問題がある。Therefore, the track data storage area has a fixed length, and the amount of track data that exceeds the divided area cannot be stored. Further, even if the track data uses only a part of the divided area, the vacant space cannot be used for other track data, and there is a problem that the memory usage efficiency is low.
より一般的には、上述したような電子楽器のシーケン
サに限らず複数のデータファイル(上記の例でいえば、
複数の楽音のトラックデータ)をメモリに記憶させる上
でその使用効率を上げることが課題である。More generally, it is not limited to the sequencer of the electronic musical instrument as described above, but a plurality of data files (in the above example,
The problem is to improve the usage efficiency in storing a plurality of musical sound track data) in the memory.
[考案の目的] したがって、この考案の目的は上述した課題を解決
し、データファイルメモリの全領域をフルに利用できる
データ記憶装置を提供することである。[Object of the Invention] Therefore, an object of the present invention is to solve the above-mentioned problems and to provide a data storage device which can fully utilize the entire area of the data file memory.
[考案の要点] この考案は、上記の目的を達成するため、複数のデー
タファイルのためのメモリの全空間をエンドレス(リン
グ状)に使用し、既に記憶されているデータファイルの
最終アドレスの次アドレスを新たに入力するデータファ
イルの先頭アドレスとして設定し、そのアドレスから新
しいデータファイルのデータを順次書き込むようにした
ことを要点とする。[Summary of the Invention] In order to achieve the above-mentioned object, the present invention uses the entire space of the memory for a plurality of data files endlessly (in a ring shape), and stores the next address of the last address of the already stored data file. The point is that the address is set as the top address of the newly input data file and the data of the new data file is sequentially written from that address.
[実施例] 以下、この考案をシーケンサ付電子楽器に適用した場
合の一実施例について説明する。[Embodiment] An embodiment in which the present invention is applied to an electronic musical instrument with a sequencer will be described below.
第1図は本実施例に係るシーケンサ付電子楽器の全体
構成を示し、マイクロプロセッサ1を中心として全体の
制御が行われる。このマイクロプロセッサ1はデータバ
ス、アドレスバスを介して、ROM2、RAM3、操作子群・表
示装置4、音源5と結合しており、上記ROM2にはマイク
ロプロセッサ1のプログラムが格納され、上記RAM3に
は、各種レジスタSRT1、END1、SRT2、END2、ADR、LIMIT
のほかシーケンサメモリ31が置かれる。音源5はマイク
ロプロセッサ1からの情報に従って楽音信号を発生し、
その信号はサウンドシステム6を通じて外部へ放音され
る。また、タイマ7は上記シーケンサメモリ31への楽音
トラックデータの記録や、再生のための時間情報を与え
るものであり、記録モードでは、操作子群・表示装置4
内の操作子群より、新たなノートオン/オフ、ノートナ
ンバー、コード名、音色名などの楽音情報がマイクロプ
ロセッサ1において検出されるごとに、その情報にタイ
マ7からの時間情報が付けられてシーケンサメモリ31に
書き込まれることにより、トラックデータが記録され
る。逆に、再生モードでは、シーケンサメモリ31上の時
間情報とタイマ7からの時間情報とがマイクロプロセッ
サ1において比較され、一致するごとに楽音情報が音源
5に送られて再生される。FIG. 1 shows the overall configuration of the electronic musical instrument with a sequencer according to the present embodiment, and the overall control is performed centering on the microprocessor 1. This microprocessor 1 is connected to a ROM 2, a RAM 3, an operator group / display device 4, and a sound source 5 via a data bus and an address bus. The ROM 2 stores the program of the microprocessor 1, and the RAM 3 is stored in the RAM 3. Are registers SRT1, END1, SRT2, END2, ADR, LIMIT
Besides, a sequencer memory 31 is placed. The sound source 5 generates a tone signal according to the information from the microprocessor 1,
The signal is emitted to the outside through the sound system 6. Further, the timer 7 gives time information for recording and reproducing the musical sound track data in the sequencer memory 31, and in the recording mode, the operator group / display device 4 is used.
Each time the microprocessor 1 detects musical tone information such as a new note on / off, note number, chord name, tone color name, etc. from the operator group inside, the time information from the timer 7 is added to that information. The track data is recorded by being written in the sequencer memory 31. On the contrary, in the reproduction mode, the time information on the sequencer memory 31 and the time information from the timer 7 are compared in the microprocessor 1, and musical tone information is sent to the sound source 5 for reproduction each time they match.
本実施例においては、シーケンサメモリ31には2つの
楽音トラックデータが記録、再生可能である。このシー
ケンサメモリ31は第2図に示すようにリング構造(エン
ドレス構造)となっている。すなわち、シーケンサメモ
リ31の物理アドレスが、例えば0番地から9999番地だと
すると、9999番地の次アドレスが0番地となるように、
マイクロプロセッサ1からアクセスできるようになって
いる。In the present embodiment, the sequencer memory 31 can record and reproduce two musical sound track data. The sequencer memory 31 has a ring structure (endless structure) as shown in FIG. That is, assuming that the physical address of the sequencer memory 31 is, for example, address 0 to address 9999, the address next to the address 9999 becomes address 0,
It can be accessed from the microprocessor 1.
さらに、本実施例では、マイクロプロセッサ1によ
り、シーケンサメモリ31にエンドレスの性質が与えられ
るとともに、2つの楽音トラックデータがシーケンサメ
モリ31の全空間を占有し得、しかも新たに記憶させる楽
音トラックデータの記憶エリアが既に記憶されている記
憶エリアに応じて変化するようにしている。この機能の
実現のため、マイクロプロセッサ1は上記のレジスタSR
め1、END1、SRT2、END2、ADR、LIMITを使用する。すな
わち、SRT1は第1ラックデータのスタートアドレスを示
すポインタであり、END1は第1トラックデータのエンド
アドレスを示すポインタであり、同様に、SRT2は第2ト
ラックデータのスタートアドレスを示すポインタであ
り、END2は第2トラックデータのエンドアドレスを示す
ポインタであり、ADRは現在の書込(または読出)アド
レスのポインタである。また、LIMITは書込可能な限界
アドレスを示すポインタであり、既に記録されているト
ラックデータの先頭アドレスより手前のアドレス値をも
つ。Further, in the present embodiment, the microprocessor 1 gives the sequencer memory 31 an endless property, and two musical sound track data can occupy the entire space of the sequencer memory 31, and the musical sound track data to be newly stored. The storage area changes according to the storage area already stored. To realize this function, the microprocessor 1 uses the register SR above.
Use 1, END1, SRT2, END2, ADR, LIMIT. That is, SRT1 is a pointer indicating the start address of the first rack data, END1 is a pointer indicating the end address of the first track data, and similarly SRT2 is a pointer indicating the start address of the second track data. END2 is a pointer indicating the end address of the second track data, and ADR is a pointer for the current write (or read) address. Further, LIMIT is a pointer indicating a writable limit address, and has an address value before the start address of the track data that has already been recorded.
以下、本実施例の動作について第2図、第3図を参照
して説明する。The operation of this embodiment will be described below with reference to FIGS.
いま、第2図に示すように、第1トラックデータと第
2トラックデータがシーケンサメモリ31に記録されてい
るとする。ここで、新たに第1トラックデータを記録す
る場合、マイクロプロセッサ1は第3図に示すフローチ
ャートに従って動作する。Now, it is assumed that the first track data and the second track data are recorded in the sequencer memory 31 as shown in FIG. Here, when newly recording the first track data, the microprocessor 1 operates according to the flowchart shown in FIG.
すなわち、ステップ301で、既に記録されている第2
トラックデータの最終アドレスEND2の次のアドレスをこ
れから記録する第1トラックデータのスタートアドレス
SRT1として設定する。このアドレスは第2図では(SRT
1)で示される。次にステップ302で、第2トラックデー
タの先頭アドレスSRT2より1つ手前のアドレスをこれか
ら記録する第1トラックデータの記録可能限界アドレス
LIMITとしてセットする。このアドレスは第2図におい
て(LIMIT)で示されている。後述のするように、これ
は新しく入力する第1トラックデータが既に記録されて
いる他方のトラックデータ(第2トラックデータ)を破
壊することなく、最大の長さで記録できるように作用す
る。すなわち、新しく入力する第1トラックデータは第
2図の(SRT1)から(LIMIT)まで記録可能である。次
のステップ303で第1トラックのスタートアドレスSRT1
が書込ポインタADRにセットされ、以降ステップ304以下
の記録処理が行われる。That is, in step 301, the second recorded already
Start address of the first track data that will record the address next to the last address END2 of the track data
Set as SRT1. This address is (SRT
1). Next, at step 302, the recordable limit address of the first track data at which the address immediately before the start address SRT2 of the second track data is to be recorded is recorded.
Set as LIMIT. This address is indicated by (LIMIT) in FIG. As will be described later, this acts so that the newly input first track data can be recorded at the maximum length without destroying the other track data (second track data) already recorded. That is, the newly input first track data can be recorded from (SRT1) to (LIMIT) in FIG. At the next step 303, start address SRT1 of the first track
Is set to the write pointer ADR, and thereafter the recording process from step 304 onward is performed.
すなわち、マイクロプロセッサ1はタイマ7がカウン
トアップするごとに操作子群・表示装置4内の操作子か
ら楽音変化の入力があるかどうか検査し(ステップ30
4)、あればその入力が示す情報(楽音データ)をタイ
マ7からのタイマ値とともに書込ポインタADRが示すア
ドレスに格納し(305)、書込ポインタADRを進め(30
6)、書込ポインタADRが書込限界アドレスLIMITに達し
ていない限りステップ304に戻って、再び、楽音変化の
判定に移る。ステップ304で楽音変化なしなら、ステッ
プ308に進み、操作子から演奏終了のコマンドが入って
いるかどうか判別し、入ってなければ、再びステップ30
4に戻り以上のループをくり返し実行する。That is, every time the timer 7 counts up, the microprocessor 1 checks whether or not there is an input of a musical tone change from the operators in the operator group / display device 4 (step 30
4) If present, the information (tone data) indicated by the input is stored in the address indicated by the write pointer ADR together with the timer value from the timer 7 (305), and the write pointer ADR is advanced (30
6), unless the write pointer ADR has reached the write limit address LIMIT, the process returns to step 304, and the tone change change determination is performed again. If there is no change in musical tone in step 304, the process proceeds to step 308, it is judged whether or not a command to end the performance is input from the operator, and if not, step 30 is repeated.
Return to 4 and repeat the above loop.
このようにして、第1トラックデータが、第2図に示
すスタートアドレス(SRT1)より順次記録されてゆき、
演奏入力が完了し、操作子より終了のコマンドが入力さ
れると、これがステップ308にて検出され、そのときの
書込アドレスADRが第1トラックデータのエンドアドレ
スとしてポインタEND1に格納され(ステップ309)、記
録処理が完了する。In this way, the first track data is sequentially recorded from the start address (SRT1) shown in FIG.
When the performance input is completed and an end command is input from the operator, this is detected in step 308, and the write address ADR at that time is stored in the pointer END1 as the end address of the first track data (step 309). ), The recording process is completed.
万一、書込アドレスADRが第2図に例示する書込限界
アドレス(LIMIT)に達したときは、第2トラックデー
タの破壊を防止するため、メモリオーバー処理に移行す
る。If the write address ADR reaches the write limit address (LIMIT) illustrated in FIG. 2, the memory over process is performed to prevent the destruction of the second track data.
以上は、新たに第1トラックデータを記録する場合で
あったが、新たに第2トラックデータを記録する場合に
は、既に記録されている第1トラックデータのスタート
アドレスSRT1、エンドアドレスEND1の値を使って、第2
トラックデータのスタートアドレスSRT1、書込限界アド
レスLIMITが決められる。すなわち、ステップ301、30
2、303の代りに、SRT2←END1+1、LIMIT←SRT1−1、A
DR←SRT2が実行される。そしてステップ309ではEND2←A
DRとなる。The above is the case of newly recording the first track data, but in the case of newly recording the second track data, the values of the start address SRT1 and the end address END1 of the already recorded first track data With the second
The start address SRT1 of the track data and the write limit address LIMIT are determined. That is, steps 301, 30
SRT2 ← END1 + 1, LIMIT ← SRT1-1, A instead of 2,303
DR ← SRT2 is executed. And in step 309 END2 ← A
It becomes DR.
なお、本実施例ではシーケンサメモリ31には、2つの
トラックデータを記録するようにしているが、3つ以上
のトラックデータにもこの考案を適用できることは明ら
かである。In this embodiment, two track data are recorded in the sequencer memory 31, but it is obvious that the invention can be applied to three or more track data.
また、楽音のトラックデータ以外の一般のデータファ
イルにも応用可能である。It can also be applied to general data files other than musical sound track data.
[考案の効果] 以上詳述したように、この考案では複数のデータファ
イルのためのメモリをアクセス上はリング構造と成し、
既に記録されているデータファイルのエンドアドレスの
次のアドレスを新しく入力するデータファイルのスター
トアドレスとして新ファイルのデータを順次記憶してい
る。したがって、非常に簡単な構成でありながらメモリ
の全空間をフルに活用でき、メモリ効率が非常によいと
いう利点がある。[Advantage of Device] As described in detail above, in this device, the memory for a plurality of data files has a ring structure for access,
The data of the new file is sequentially stored with the address next to the end address of the already recorded data file as the start address of the newly input data file. Therefore, there is an advantage that the entire space of the memory can be fully utilized and the memory efficiency is very good even though the configuration is very simple.
第1図はこの考案のデータ記憶装置をシーケンサ付電子
楽器に適用した場合の実施例の全体構成図、第2図はシ
ーケンサメモリの構造を示す模式図、第3図は実施例の
動作のフローチャートである。 1……マイクロプロセッサ、2……ROM(プログラムメ
モリ)、31……リング状シーケンサメモリ、SRT1、END
1、SRT2、END2、ADR、LIMIT……シーケンサメモリのポ
インタ用レジスタ。FIG. 1 is an overall configuration diagram of an embodiment in which the data storage device of the present invention is applied to an electronic musical instrument with a sequencer, FIG. 2 is a schematic diagram showing the structure of a sequencer memory, and FIG. 3 is a flowchart of the operation of the embodiment. Is. 1 ... Microprocessor, 2 ... ROM (program memory), 31 ... Ring sequencer memory, SRT1, END
1, SRT2, END2, ADR, LIMIT ... Sequencer memory pointer register.
Claims (1)
の次アドレスを新たに記憶するデータファイルの先頭ア
ドレスとし、メモリの全空間をエンドレスに使用して複
数のデータファイルをメモリに記憶することを特徴とす
るデータ記憶装置。1. A method for storing a plurality of data files in the memory by using the address next to the last address of the data file on the memory as the start address of the data file to be newly stored and using the entire space of the memory endlessly. And data storage device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1987008585U JP2519519Y2 (en) | 1987-01-26 | 1987-01-26 | Data storage device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1987008585U JP2519519Y2 (en) | 1987-01-26 | 1987-01-26 | Data storage device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63118097U JPS63118097U (en) | 1988-07-30 |
JP2519519Y2 true JP2519519Y2 (en) | 1996-12-04 |
Family
ID=30793100
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1987008585U Expired - Lifetime JP2519519Y2 (en) | 1987-01-26 | 1987-01-26 | Data storage device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2519519Y2 (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS56143038A (en) * | 1980-04-09 | 1981-11-07 | Hitachi Ltd | Data processing system |
JPS6272285A (en) * | 1985-09-25 | 1987-04-02 | Sony Corp | Reproducing device |
-
1987
- 1987-01-26 JP JP1987008585U patent/JP2519519Y2/en not_active Expired - Lifetime
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS56143038A (en) * | 1980-04-09 | 1981-11-07 | Hitachi Ltd | Data processing system |
JPS6272285A (en) * | 1985-09-25 | 1987-04-02 | Sony Corp | Reproducing device |
Also Published As
Publication number | Publication date |
---|---|
JPS63118097U (en) | 1988-07-30 |
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