JP2023515513A - サブピクチャレベルに基づいたパーティション計算 - Google Patents
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Abstract
Description
適用される特許法及び/又はパリ条約に従う規則の下で、本願は、2020年2月24日付けで出願された米国特許仮出願第62/980963号の優先権及びその利益を適宜請求するようになされる。法の下での全ての目的のために、上記の出願の全開示は、本願の開示の部分として参照により援用される。
本特許明細書は、イメージ及びビデオのコーディング及び復号化に関係がある。
本明細書は、ビデオコーディング技術に関係がある。具体的に、それは、サブピクチャ、LMCS、及びAMVRのサポートに関する。サブピクチャに関する態様は、1つのサブピクチャに含まれているタイル行及びタイル列の数の導出とともに、各サブピクチャが1つのスライスか含まない場合にスライスに含まれているCTUのラスタスキャンCTUアドレスのリストの導出を含む。LMCSに関する態様は、異なるレベルでのLMCSの有効化のシグナリングに関する。AMVRに関する態様は、sps_affine_amvr_enabled_flagのセマンティクスに関する。アイデアは、個別的に又は様々な組み合わせで、シングルレイヤ及び/又はマルチレイヤビデオコーディング、例えば、開発中のVVC(Versatile Video Coding)をサポートするあらゆるビデオコーディング標準又は非標準ビデオコーデックにも適用されてよい。
ALF Adaptive Loop Filter
AMVR Adaptive Motion Vector difference Resolution
APS Adaptation Parameter Set
AU Access Unit
AUD Access Unit Delimiter
AVC Advanced Video Coding
CLVS Coded Layer Video Sequence
CPB Coded Picture Buffer
CRA Clean Random Access
CTU Coding Tree Unit
CVS Coded Video Sequence
DPB Decoded Picture Buffer
DPS Decoding Parameter Set
EOB End Of Bitstream
EOS End Of Sequence
GDR Gradual Decoding Refresh
HEVC High Efficiency Video Coding
HRD Hypothetical Reference Decoder
IDR Instantaneous Decoding Refresh
JEM Joint Exploration Model
LMCS Luma Mapping with Chroma Scaling
MCTS Motion-Constrained Tile Sets
NAL Network Abstraction Layer
OLS Output Layer Set
PH Picture Header
PPS Picture Parameter Set
PTL Profile, Tier and Level
PU Picture Unit
RBSP Raw Byte Sequence Payload
SEI Supplemental Enhancement Information
SPS Sequence Parameter Set
SVC Scalable Video Coding
VCL Video Coding Layer
VPS Video Parameter Set
VTM VVC Test Model
VUI Video Usability Information
VVC Versatile Video Coding
ビデオコーディング標準規格は、よく知られているITU-T及びISO/IEC標準規格の開発を通じて主に発展してきた。ITU-TはH.261及びH.263を作り出し、ISO/IECはMPEG-1及びMPEG-4 Visualを作り出し、2つの組織は共同でH.262/MPEG-2 Video及びH264/MPEG-4 AVC(Advanced Video Coding)及びH.265/HEVC標準規格を作り出した。H.262以降、ビデオコーディング標準規格は、時間予測に変換コーディングをプラスしたものが利用されるハイブリッド型ビデオコーディング構造に基づいている。HEVCを超える将来のビデオコーディング技術を探求するために、JVET(Joint Video Exploration Team)がVCEG及びMPEGによって共同で設立された。それ以降、多くの新しい方法がJVETによって採用され、JEM(Joint Exploration Model)と名付けられた参照ソフトウェアに置かれてきた。JVET会議は、四半期ごとに1度同時に開催され、新しいコーディング標準規格では、HEVCと比較してビットレートを50%削減することを目標としている。新しいビデオコーディング標準規格は、2018年4月のJVET会議でVVC(Versatile Video Coding)と公式に命名され、VVCテストモデル(VVC Test Model,VTM)の最初のバージョンがその時にリリースされた。VVC標準化に寄与する継続的な取り組みがあるため、毎回のJVET会議で新しいコーディング手法がVVC標準に採用されている。その後、VVCワーキングドラフト及びテストモデルVTMは、毎回の会議の後で更新されている。VVCプロジェクトは現在、2020年7月の会議で技術的完了(FDIS)を目指している。
HEVCは、最大転送ユニット(Maximum Transfer Unit,MTU)サイズマッチング、並列処理、及び削減されたエンド間遅延に適用され得る4つの異なるピクチャパーティション化手法、つまり、レギュラースライス(regular slices)、依存性スライス(dependent slices)、タイル、及び波面並列処理(Wavefront Parallel Processing,WPP)を含む。
VVCでは、ピクチャは、1つ以上のタイル行及び1つ以上のタイル列に分割される。タイルは、ピクチャの長方形領域をカバーするCTUの連続である。タイル内のCTUは、そのタイル内でラスタスキャン順にスキャンされる。
LMCSは、2つの側面、つまり、ルーママッピング(RPによって表される再成形プロセス)及びルーマ依存クロマ残差スケーリング(CRS)を含む。ルーマ信号について、LMCSモードは、元のドメインにある第1ドメインと、再成形モデルに従ってルーマサンプルを特定の値にマッピングする再成形ドメインである第2ドメインを含む2つのドメインに基づき、動作する。更に、クロマ信号については、残差スケーリングが適用され、スケーリング係数はルーマサンプルから導出される。
アフィンAMVR(Adaptive Motion Vector difference Resolution)は、アフィンインターコーディングされたブロックが異なる分解能で、例えば、1/4ルーマサンプル(デフォルトであり、amvr_flagは0にセットされる)、1/16ルーマサンプル、1ルーマサンプルの精度でMV差分を伝送することを可能にするコーディングツールである。
VVCでのサブピクチャ及びLMCSのための既存の設計には、次の課題がある:
1)式D.5でのリストSubpicNumTileRows[](サブピクチャに含まれるタイル行の数を指定する)導出は、式中のCtbToTileRowBd[idx]のインデックス値idxが最大許容値よりも大きくなり得るということで、不正確である。更に、SubpicNumTileRows[]及びSubpicNumTileCols[](サブピクチャに含まれるタイル列の数を指定する)の両方の導出は、不必要に複雑であるCTUベースの演算を使用する。
2)single_slice_per_subpic_flagが1に等しい場合の式29中のアレイCtbAddrInSliceの導出は、各スライスのアレイ内のラスタスキャンCTBアドレスの値がCTUのラスタスキャン順序ではなくCTUの復号化順にある必要があるということで、不正確である。
3)LMCSシグナリングは非効率である。ph_lmcs_enabled_flagが1に等しいとき、ほとんどの場合に、LMCSはピクチャの全スライスに対して有効にされることになる。しかし、現在のVVC設計では、LMCSがピクチャの全スライスに対して有効にされる場合に、ph_lmcs_enabled_flagが1に等しいのみならず、値1を有するslice_lmcs_enabled_flagが各スライスについてシグナリングされる必要がある。
a.ph_lmcs_enabled_flagのセマンティクスは、ph_lmcs_enabled_flagが真である場合にスライスレベルLMCSフラグをシグナリングする動機と矛盾する。現在のVVCでは、ph_lmcs_enabled_flagが真である場合に、それは、全てのスライスがLMCSを有効にすべきであることを意味する。従って、スライスヘッダでLMCS有効化フラグを更にシグナリングする必要はない。
b.更に、ピクチャヘッダによりLMCSが有効にされることが示される場合に、通常は、全てのスライスに対して、LMCSは全て有効にされる。スライスヘッダでのLMCSの制御は、主に、コーナーの場合を処理するためである。従って、PH LMCSフラグが真であり、SH LMCSフラグが常にシグナリングされるならば、一般的なユーザの場合に不要なビットがシグナリングされる可能性がある。
4)SPSアフィンAMVRフラグのセマンティクスは、各アフィンインターコーディングされたCUについて、アフィンAMVRが有効又は無効にされ得るので、正確ではない。
上記の課題、及び述べられているいくつかの他の課題を解決するために、以下で要約される方法が開示される。項目は、概要を説明するための例と見なされるべきであり、狭義に解釈されるべきではない。更に、これらの項目は、個別的に適用されても、又は任意の 方法で組み合わされてもよい。
1.次のアプローチの1つ以上が開示される:
a.ピクチャの各CTU列のタイル列インデックスが導出される。
b.サブピクチャに含まれるタイル列の数の導出は、サブピクチャに含まれる最左及び/又は最右のCTUのタイル列インデックスに基づく。
c.ピクチャの各CTU行のタイル行インデックスが導出される。
d.サブピクチャに含まれるタイル行の数の導出は、サブピクチャに含まれる上側及び/又は下側のCTUのタイル行インデックスに基づく。
e.ピクチャレベルスライスインデックスという用語は、次のように定義される:single_slice_per_subpic_flagが0に等しい場合にスライスがPPSでシグナリングされる順序で、又はsingle_slice_per_subpic_flagが1に等しい場合にスライスに対応するサブピクチャのサブピクチャインデックスが増加する順序で、ピクチャ内のスライスのリストに対するスライスの、rect_slice_flagが1に等しい場合に定義されるインデックス。
f.一例で、サブピクチャの高さは、タイルからパーティション化されるスライスをサブピクチャが含む場合に、タイルに関してカウントされ得ない。
g.一例で、サブピクチャの高さは、タイルの代わりにCTUに関してカウントされてよい。
h.サブピクチャの高さが1タイル行に満たないかどうかが導出される。
i.一例で、サブピクチャの高さが1タイル行に満たないかどうかは、サブピクチャが1つのタイル行からのCTUしか含まない場合、かつ、サブピクチャ内の上側CTUがそのタイル行の上側CTUではないか、又はサブピクチャ内の下側CTUがタイル行の下側CTUではない場合に、真であるよう導出される。
ii.各サブピクチャが1つのスライスしか含まず、サブピクチャの高さが1タイル行に満たないことが示される場合に、ピクチャのピクチャレベルスライスインデックスiを有する各スライスについて、jが0以上かつスライス内のCTUの数から1をマイナスしたもの以下であるとして、CtbAddrInSlice[i][j]の値は、サブピクチャのCTUラスタスキャンでのj番目のCTUのピクチャラスタスキャンCTUアドレスであるよう導出される。
iii.一例で、サブピクチャが1タイル行に満たないかどうかは、サブピクチャ内の上側CTUとサブピクチャ内の下側CTUとの間の距離がCTUに関してタイルの高さよりも短い場合に、真であるよう導出される。
iv.各サブピクチャが1つのスライスしか含まず、サブピクチャの高さが1タイル行以上であることが示される場合に、ピクチャのピクチャレベルスライスインデックスiを有する各スライスについて、jが0以上かつスライス内のCTUの数から1をマイナスしたもの以下であるとして、CtbAddrInSlice[i][j]の値は、CTUの次の順序でのj番目のCTUのピクチャラスタスキャンCTUアドレスであるよう導出される。
1)サブピクチャ内の異なるタイル内のCTUは、タイルインデックスの値がより小さい第1タイル内の第1CTUが、タイルインデックスの値がより大きい第2タイル内の第2CTUより前になるよう、順序付けられる。
2)サブピクチャ内の1つのタイル内のCTUは、そのタイルのCTUラスタスキャンで順序付けられる。
2.LMCS(2つの側面、つまり、ルーママッピング(RPによって表される再成形プロセス)及びルーマ依存クロマ残差スケーリング(CRS)を含む)の2レベル制御が導入され、上位レベル(例えば、ピクチャレベル)及び下位レベル(例えば、スライスレベル)の制御が使用され、下位レベル制御情報が存在するかどうかは、上位レベル制御情報に依存する。更に、次が適用される:
a.第1の例では、下記のサブビュレットの1つ以上が適用される:
i.第1インジケータ(例えば、ph_lmcs_enabled_type)は、非バイナリ値である下位レベルでどのようにLMCSが有効にされるかを指定するよう上位レベルで(例えば、ピクチャヘッダ(PH)で)シグナリングされてよい。
1)一例で、第1インジケータがX(例えば、X=2)に等しい場合に、それは、LMCSがPHに関連した全てのスライスに対して有効にされることを指定し、第1インジケータがY(Y!=X)(例えば、Y=1)に等しい場合に、それは、LMCSがPHに非関連した1つ以上の、しかし全部ではないスライスに対して有効にされることを指定し、第1インジケータがZ(Z!=XかつZ!=Y)(例えば、Z=0)に等しい場合に、それは、LMCSがPHに関連した全てのスライスに対して無効にされることを指定する。
2)一例で、第1インジケータがX(例えば、X=2)に等しい場合に、それは、LMCSがPHに関連した全てのスライスに対して無効にされることを指定し、第1インジケータがY(Y!=X)(例えば、Y=1)に等しい場合に、それは、LMCSがPHに非関連した1つ以上の、しかし全部ではないスライスに対して有効にされることを指定し、第1インジケータがZ(Z!=XかつZ!=Y)(例えば、Z=0)に等しい場合に、それは、LMCSがPHに関連した全てのスライスに対して有効にされることを指定する。
a)代替的に、更に、第1インジケータが存在しない場合に、そのインジケータの値は、デフォルト値、例えばX、に等しいと推測される。
3)代替的に、更に、第1インジケータは、シーケンスレベルでのLMCS有効化フラグ(例えば、sps_lmcs_enabled_flag)の値に応じて、条件付きでシグナリングされてもよい。
4)代替的に、更に、第1インジケータは、u(v)、又はu(2)、又はue(v)でコーディングされてもよい。
5)代替的に、更に、第1インジケータは、トランケーテッド・ユーナリー・コード(truncated unary code)でコーディングされてもよい。
6)代替的に、更に、スライスによって使用されるLMCS APS情報(例えば、ph_lmcs_aps_id)及び/又はCS有効化フラグ(例えば、ph_chroma_residual_scale_flag)が、第1インジケータの値の条件確認の下でシグナリングされてもよい。
ii.下位レベルに対してLMCSを有効/無効にする第2インジケータは(例えば、slice_lmcs_enabled_flag)は、下位レベルで(例えば、スライスヘッダで)シグナリングされてよく、それは、第1インジケータの値を確認することによって、条件付きでシグナリングされてよい。
1)一例で、第2インジケータは、「第1インジケータがYに等しい」との条件確認の下でシグナリングされてよい。
a)代替的に、第2インジケータは、「第1インジケータの値>>1」又は「第1インジケータの値/2」又は「第1インジケータの値&0x01」との条件確認の下でシグナリングされてもよい。
b)代替的に、更に、第2インジケータは、第1インジケータがXに等しい場合に有効にされると推測され、あるいは、第1インジケータがZに等しい場合に無効にされると推測されてもよい。
b.第2の例では、下記のサブビュレットの1つ以上が適用される:
i.1よりも多いインジケータが、非バイナリ値である下位レベルでどのようにLMCSが有効にされるかを指定するよう上位レベルで(例えば、ピクチャヘッダ(PH)で)シグナリングされてよい。
1)一例で、2つのインジケータがPHでシグナリングされてよい。
a)一例で、第1インジケータは、LMCSを有効にするPHに関連した少なくとも1つのスライスが存在するかどうかを指定する。また、第2インジケータは、PHに関連した全てのスライスがLMCSを有効にするかどうかを指定する。
i.代替的に、更に、第2インジケータは、第1インジケータの値に応じて、例えば、LMCSを有効にする少なくとも1つのスライスが存在することが第1インジケータにより特定される場合に、条件付きでシグナリングされてよい。
i.代替的に、更に、第2インジケータが存在しない場合に、全てのスライスがLMCSを有効にすることが推測される。
ii.代替的に、更に、第3インジケータが、第2インジケータの値に応じて、例えば、スライスの全てがLMCSを有効にするわけではないことが第2インジケータにより特定される場合に、SHにおいて条件付きでシグナリングされてよい。
i.代替的に、更に、第3インジケータが存在しない場合に、それは第1及び/又は第2インジケータの値において推測されてよい(例えば、第1インジケータの値に等しいと推測される)。
b)代替的に、第1インジケータは、LMCSを無効にするPHに関連した少なくとも1つのスライスが存在するかどうかを指定する。また、第2インジケータは、PHに関連した全てのスライスがLMCSを無効にするかどうかを指定する。
i.代替的に、更に、第2インジケータは、第1インジケータの値に応じて、例えば、LMCSを無効にする少なくとも1つのスライスが存在することが第1インジケータにより特定される場合に、条件付きでシグナリングされてよい。
i.代替的に、更に、第2インジケータが存在しない場合に、全てのスライスがLMCSを無効にすることが推測される。
ii.代替的に、更に、第3インジケータが、第2インジケータの値に応じて、例えば、スライスの全てがLMCSを無効にするわけではないことが第2インジケータにより特定される場合に、SHにおいて条件付きでシグナリングされてよい。
i.代替的に、更に、第3インジケータが存在しない場合に、それは第1及び/又は第2インジケータの値において推測されてよい(例えば、第1インジケータの値に等しいと推測される)。
2)代替的に、更に、第1インジケータは、シーケンスレベルでのLMCS有効化フラグ(例えば、sps_lmcs_enabled_flag)の値に応じて、条件付きでシグナリングされてもよい。
ii.下位レベルに対してLMCSを有効/無効にする第3インジケータ(例えば、slice_lmcs_enabled_flag)が、下位レベルで(例えば、スライスヘッダで)シグナリングされてもよく、それは、第1インジケータ及び/又は第2インジケータの値を確認することによって、条件付きでシグナリングされてもよい。
1)一例で、第3インジケータは、「全てのスライスがLMCSを有効にするわけではない」又は「全てのスライスがLMCSを無効にするわけではない」との条件確認の下でシグナリングされてよい。
c.更なる他の例では、第1/第2の例における第1及び/又は第2及び/又は第3インジケータは、LMCSではなくRP又はCRSの利用を制御するために使用されてもよい。
i.代替的に、更に、どのようにLMCSが推測されるかは、PH LMCSシグナリングに依存する。
1)一例で、それは、LMCSがピクチャの全スライスに対して使用される場合に有効にされると推測され、LMCSがピクチャの全スライスに対して使用されない場合に無効にされると推測される。
この実施形態で、ピクチャヘッダ内のLMCS関連シンタックス要素のシンタックス及びセマンティクスは、LMCSがピクチャの全スライスに対して使用される場合にSHでLMCSシグナリングが存在しないように、変更されている。
ビデオ処理方法(例えば、図7で表される方法900)であって、
1つ以上のビデオピクチャを含み、各ビデオピクチャが1つ以上のタイルを含むビデオと、該ビデオのコーディングされた表現との間の変換を実行するステップを含み、
前記コーディングされた表現はフォーマット規則に従い、
前記フォーマット規則は、前記コーディングされた表現においてシグナリングされる第1情報と、前記コーディングされた表現から導出される第2情報とを指定し、
少なくとも前記第1情報又は前記第2情報は、前記1つ以上のタイルの行インデックス又は列インデックスに関係がある、
方法。
前記フォーマット規則は、各ビデオピクチャの各コーディングツリーユニット列のタイル列インデックスが導出される、ことを定める、
解決法1に記載の方法。
前記フォーマット規則は、各ビデオピクチャの各コーディングツリーユニット行のタイル行インデックスが導出される、ことを定める、
解決法1に記載の方法。
ビデオ処理の方法であって、
ビデオのビデオ領域のビデオユニットと前記ビデオのコーディングされた表現との間の変換を実行するステップを含み、
前記コーディングされた表現はフォーマット規則に従い、
前記フォーマット規則は、前記ビデオ領域で第1制御情報が、第2制御情報が前記ビデオユニットのレベルで含まれるかどうかを制御する、ことを定め、
前記第1制御情報及び/又は前記第2制御情報は、前記変換のためのルーマ再成形プロセス(RP)又はクロマ残差スケーリング(CRS)又はルーママッピング及びクロマスケーリング(LMCS)に関する情報を含む、
方法。
前記第1制御情報は、前記第2制御情報が前記コーディングされた表現に含まれるかどうかを示すインジケータを含む、
解決法4に記載の方法。
前記第1制御情報の特定の値は、LMCSが前記ビデオ領域内の全てのビデオユニットに対して無効にされることを示す、
解決法4~5に記載の方法。
前記第2制御情報は、前記ビデオユニットでのLMCSの有効化を制御する、
解決法4~6のいずれかに記載の方法。
前記第1制御情報は、複数のインジケータを含む、
解決法4に記載の方法。
前記変換は、前記ビデオを前記コーディングされた表現に符号化することを含む、
解決法1乃至8のうちいずれかに記載の方法。
前記変換は、前記コーディングされた表現を復号して、前記ビデオのピクセル値を生成することを含む、
解決法1乃至8のうちいずれかに記載の方法。
解決法1乃至10のうちの1つ以上に記載の方法を実装するよう構成されたプロセッサを有するビデオ復号化装置。
解決法1乃至10のうちの1つ以上に記載の方法を実装するよう構成されたプロセッサを有するビデオ符号化装置。
コンピュータコードを記憶し、該コードは、プロセッサによって実行される場合に、プロセッサに、解決法1乃至10のうちいずれかに記載の方法を実装させる、
コンピュータプログラム製品。
本明細書で記載される方法、装置、又はシステム。
tileX=0
for(ctbAddrX=0;ctbAddrX<=PicWidthInCtbsY;ctbAddrX++){
if(ctbAddrX==tileColBd[tileX+1])
tileX++
ctbToTileColIdx[ctbAddrX]=tileX
}
通りに導出され、PicWidthInCtbsYは、コーディングされたツリーブロック(CTB)の単位でビデオピクチャの幅を表し、tileColBd[i]は、CTBの単位でi番目のタイル列境界の位置を表す。
for(i=0;i<=sps_num_subpics_minus1;i++){
leftX=sps_subpic_ctu_top_left_x[i]
rightX=leftX+sps_subpic_width_minus1[i]
SubpicWidthInTiles[i]=ctbToTileColIdx[rightX]+1-ctbToTileColIdx[leftX]
}
通りに導出され、sps_num_subpics_minus1は、ビデオピクチャにおけるサブピクチャの数を表し、sps_subpic_ctu_top_left_x[i]は、i番目のサブピクチャの左上CTUの水平位置を表し、sps_subpic_width_minus1[i]に1をプラスしたものは、i番目のサブピクチャの幅を指定し、ctbToTileColIdx[rightX]及びctbToTileColIdx[leftX]は夫々、サブピクチャに含まれている最左CTU及び最右CTUのタイル列インデックスを表す。
tileY=0
for(ctbAddrY=0;ctbAddrY<=PicHeightInCtbsY;ctbAddrY++){
if(ctbAddrY==tileRowBd[tileY+1])
tileY++
ctbToTileRowIdx[ctbAddrY]=tileY
}
通りに導出され、PicHeightInCtbsYは、コーディングされたツリーブロック(CTB)の単位でビデオピクチャの高さを表し、tileRowBd[i]は、CTBの単位でi番目のタイル行境界の位置を表す。
for(i=0;i<=sps_num_subpics_minus1;i++){
topY=sps_subpic_ctu_top_left_y[i]
bottomY=topY+sps_subpic_height_minus1[i]
SubpicHeightInTiles[i]=ctbToTileRowIdx[botY]+1-ctbToTileRowIdx[topY]
}
通りに導出され、sps_num_subpics_minus1は、ビデオピクチャにおけるサブピクチャの数を表し、sps_subpic_ctu_top_left_y[i]は、i番目のサブピクチャの左上CTUの垂直位置を表し、sps_subpic_height_minus1[i]に1をプラスしたものは、i番目のサブピクチャの高さを指定し、ctbToTileRowIdx[botY]及びctbToTileRowIdx[topY]は夫々、サブピクチャに含まれている下部CTU及び上部CTUのタイル行インデックスを表す。
本願は、2020年2月24日付けで出願された米国特許仮出願第62/980963号の優先権及びその利益を請求して2021年2月23日付けで出願された国際特許出願第PCT/US2021/019216号に基づくものである。上記のすべての出願は、その全文を参照により本願に援用される。
Claims (20)
- ビデオ処理方法であって、
1つ以上のビデオピクチャを含むビデオと該ビデオのビットストリームとの間の変換を実行するステップを有し、
各ビデオピクチャは、1つ以上のタイル列を含む1つ以上のタイルを有し、
前記ビットストリームは、フォーマット規則に従い、
前記フォーマット規則は、タイル列インデックスがビデオピクチャのタイルの各コーティングツリーユニット(CTU)列について導出されることを定める、
方法。 - ctbToTileColIdx[ctbAddrX]と表される、ctbAddrX番目のタイル列の前記タイル列インデックスは、次の
tileX=0
for(ctbAddrX=0;ctbAddrX<=PicWidthInCtbsY;ctbAddrX++){
if(ctbAddrX==tileColBd[tileX+1])
tileX++
ctbToTileColIdx[ctbAddrX]=tileX
}
ように導出され、
PicWidthInCtbsYは、コーディングされたツリーブロック(CTB)の単位で前記ビデオピクチャの幅を表し、
tileColBd[i]は、CTBの単位でi番目のタイル列境界の位置を表す、
請求項1に記載の方法。 - 各ビデオピクチャはまた、1つ以上のサブピクチャを有し、
各サブピクチャは、前記ビデオピクチャの長方形サブセットを集合的に形成する1つ以上のスライスを有し、
前記フォーマット規則は更に、含まれているタイル列の単位でのサブピクチャの幅が、当該サブピクチャに含まれている最左CTU及び/又は最右CTUのタイル列インデックスに基づき導出される、ことを定める、
請求項1又は2のいずれかに記載の方法。 - SubpicWidthInTiles[i]と表される、タイル列の単位でのi番目のサブピクチャの幅は、次の
for(i=0;i<=sps_num_subpics_minus1;i++){
leftX=sps_subpic_ctu_top_left_x[i]
rightX=leftX+sps_subpic_width_minus1[i]
SubpicWidthInTiles[i]=ctbToTileColIdx[rightX]+1-ctbToTileColIdx[leftX]
}
のように導出され、
sps_num_subpics_minus1は、前記ビデオピクチャにおけるサブピクチャの数を表し、
sps_subpic_ctu_top_left_x[i]は、前記i番目のサブピクチャの左上CTUの水平位置を表し、
sps_subpic_width_minus1[i]に1をプラスしたものは、前記i番目のサブピクチャの幅を指定し、
ctbToTileColIdx[rightX]及びctbToTileColIdx[leftX]は夫々、前記サブピクチャに含まれている最左CTU及び最右CTUのタイル列インデックスを表す、
請求項3に記載の方法。 - タイルが複数の長方形スライスにパーティション化され、前記タイルの前記長方形スライスのサブセットのみが前記サブピクチャに含まれることに応答して、前記タイルは、前記サブピクチャの幅の値において1つのタイルとしてカウントされる、
請求項3又は4のいずれかに記載の方法。 - ビデオ処理方法であって、
1つ以上のビデオピクチャを含むビデオと該ビデオのビットストリームとの間の変換を実行するステップを有し、
各ビデオピクチャは、1つ以上のタイル行を含む1つ以上のタイルを有し、
前記ビットストリームは、フォーマット規則に従い、
前記フォーマット規則は、タイル行インデックスがビデオピクチャのタイルの各コーティングツリーユニット(CTU)行について導出されることを定める、
方法。 - ctbToTileRowIdx[ctbAddrY]と表される、ctbAddrY番目のタイル行の前記タイル行インデックスは、次の
tileY=0
for(ctbAddrY=0;ctbAddrY<=PicHeightInCtbsY;ctbAddrY++){
if(ctbAddrY==tileRowBd[tileY+1])
tileY++
ctbToTileRowIdx[ctbAddrY]=tileY
}
ように導出され、
PicHeightInCtbsYは、コーディングされたツリーブロック(CTB)の単位で前記ビデオピクチャの高さを表し、
tileRowBd[i]は、CTBの単位でi番目のタイル行境界の位置を表す、
請求項6に記載の方法。 - 各ビデオピクチャはまた、1つ以上のサブピクチャを有し、
各サブピクチャは、前記ビデオピクチャの長方形サブセットを集合的に形成する1つ以上のスライスを有し、
前記フォーマット規則は更に、タイル行の単位でのサブピクチャの高さが、当該サブピクチャに含まれている上部CTU及び/又は下部CTUのタイル行インデックスに基づき導出される、ことを定める、
請求項6又は7のいずれかに記載の方法。 - SubpicHeightInTiles[i]と表される、タイル行の単位でのi番目のサブピクチャの高さは、次の
for(i=0;i<=sps_num_subpics_minus1;i++){
topY=sps_subpic_ctu_top_left_y[i]
bottomY=topY+sps_subpic_height_minus1[i]
SubpicHeightInTiles[i]=ctbToTileRowIdx[botY]+1-ctbToTileRowIdx[topY]
}
のように導出され、
sps_num_subpics_minus1は、前記ビデオピクチャにおけるサブピクチャの数を表し、
sps_subpic_ctu_top_left_y[i]は、前記i番目のサブピクチャの左上CTUの垂直位置を表し、
sps_subpic_height_minus1[i]に1をプラスしたものは、前記i番目のサブピクチャの高さを指定し、
ctbToTileRowIdx[botY]及びctbToTileRowIdx[topY]は夫々、前記サブピクチャに含まれている下部CTU及び上部CTUのタイル行インデックスを表す、
請求項8に記載の方法。 - タイルが複数の長方形スライスにパーティション化され、前記タイルの前記長方形スライスのサブセットのみが前記サブピクチャに含まれることに応答して、前記タイルは、前記サブピクチャの高さの値において1つのタイルとしてカウントされる、
請求項8又は9のいずれかに記載の方法。 - 前記変換を実行するステップは、前記ビデオを前記ビットストリームに符号化することを有する、
請求項1乃至10のうちいずれか一項に記載の方法。 - 前記変換を実行するステップは、前記ビデオを前記ビットストリームに符号化することを有し、
当該方法は、前記ビットストリームを非一時的なコンピュータ可読記録媒体に格納するステップを更に有する、
請求項1乃至10のうちいずれか一項に記載の方法。 - 前記変換を実行するステップは、前記ビットストリームから前記ビデオを復号することを有する、
請求項1乃至10のうちいずれか一項に記載の方法。 - 請求項1乃至13の一項以上に記載の方法を実装するよう構成されるプロセッサを有するビデオ復号化装置。
- 請求項1乃至13の一項以上に記載の方法を実装するよう構成されるプロセッサを有するビデオ符号化装置。
- コンピュータ命令を記憶しているコンピュータプログラム製品であって、
前記命令は、プロセッサによって実行されるときに、前記プロセッサに、請求項1乃至13のうちいずれかに記載の方法を実施させる、
コンピュータプログラム製品。 - 請求項1乃至13のうちいずれか一項に記載の方法に従って生成されたビットストリームを記憶している非一時的なコンピュータ可読記憶媒体。
- プロセッサに請求項1乃至13のうちいずれかに記載の方法を実施させる命令を記憶している非一時的なコンピュータ可読記憶媒体。
- ビットストリーム生成の方法であって、
請求項1乃至13のうちいずれかに記載の方法に従ってビデオのビットストリームを生成するステップと、
前記ビットストリームをコンピュータ可読プログラム媒体に格納するステップと
を有する方法。 - 本明細書で記載されている方法、装置、開示されている方法に従って生成されたビットストリーム、又はシステム。
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