JP2023510976A - マイクロled及びその製造方法 - Google Patents
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- 238000004519 manufacturing process Methods 0.000 title claims description 21
- 239000000463 material Substances 0.000 claims abstract description 122
- 238000000034 method Methods 0.000 claims abstract description 83
- 229910002601 GaN Inorganic materials 0.000 claims description 63
- 229910052738 indium Inorganic materials 0.000 claims description 42
- 239000000758 substrate Substances 0.000 claims description 29
- APFVFJFRJDLVQX-UHFFFAOYSA-N indium atom Chemical compound [In] APFVFJFRJDLVQX-UHFFFAOYSA-N 0.000 claims description 19
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 14
- 239000002800 charge carrier Substances 0.000 claims description 13
- 229910052782 aluminium Inorganic materials 0.000 claims description 12
- 229910004541 SiN Inorganic materials 0.000 claims description 8
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 8
- 230000000903 blocking effect Effects 0.000 claims description 7
- 229910052681 coesite Inorganic materials 0.000 claims description 7
- 229910052906 cristobalite Inorganic materials 0.000 claims description 7
- 238000000623 plasma-assisted chemical vapour deposition Methods 0.000 claims description 7
- 239000000377 silicon dioxide Substances 0.000 claims description 7
- 235000012239 silicon dioxide Nutrition 0.000 claims description 7
- 238000004544 sputter deposition Methods 0.000 claims description 7
- 229910052682 stishovite Inorganic materials 0.000 claims description 7
- 229910052905 tridymite Inorganic materials 0.000 claims description 7
- 238000000231 atomic layer deposition Methods 0.000 claims description 6
- 239000000203 mixture Substances 0.000 claims description 6
- PMHQVHHXPFUNSP-UHFFFAOYSA-M copper(1+);methylsulfanylmethane;bromide Chemical compound Br[Cu].CSC PMHQVHHXPFUNSP-UHFFFAOYSA-M 0.000 claims description 5
- 229910017107 AlOx Inorganic materials 0.000 claims description 3
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 claims description 3
- RNQKDQAVIXDKAG-UHFFFAOYSA-N aluminum gallium Chemical compound [Al].[Ga] RNQKDQAVIXDKAG-UHFFFAOYSA-N 0.000 claims description 3
- 238000001704 evaporation Methods 0.000 claims description 3
- 230000008020 evaporation Effects 0.000 claims description 3
- 238000011065 in-situ storage Methods 0.000 claims description 3
- 239000002096 quantum dot Substances 0.000 claims description 3
- 238000002488 metal-organic chemical vapour deposition Methods 0.000 claims 1
- 238000003491 array Methods 0.000 abstract description 7
- JMASRVWKEDWRBT-UHFFFAOYSA-N Gallium nitride Chemical compound [Ga]#N JMASRVWKEDWRBT-UHFFFAOYSA-N 0.000 description 38
- 238000002161 passivation Methods 0.000 description 22
- 229910004298 SiO 2 Inorganic materials 0.000 description 20
- 239000004065 semiconductor Substances 0.000 description 20
- 239000003989 dielectric material Substances 0.000 description 16
- 238000001312 dry etching Methods 0.000 description 15
- 230000004888 barrier function Effects 0.000 description 11
- 229910052751 metal Inorganic materials 0.000 description 11
- 239000002184 metal Substances 0.000 description 11
- 238000000151 deposition Methods 0.000 description 10
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 10
- 229910002704 AlGaN Inorganic materials 0.000 description 9
- 229910052733 gallium Inorganic materials 0.000 description 9
- 238000005530 etching Methods 0.000 description 7
- 239000010931 gold Substances 0.000 description 7
- 229910018072 Al 2 O 3 Inorganic materials 0.000 description 6
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 6
- 239000010936 titanium Substances 0.000 description 6
- 238000000137 annealing Methods 0.000 description 5
- 238000007796 conventional method Methods 0.000 description 5
- 238000001039 wet etching Methods 0.000 description 5
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 4
- NBIIXXVUZAFLBC-UHFFFAOYSA-N Phosphoric acid Chemical compound OP(O)(O)=O NBIIXXVUZAFLBC-UHFFFAOYSA-N 0.000 description 4
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 4
- NWAIGJYBQQYSPW-UHFFFAOYSA-N azanylidyneindigane Chemical compound [In]#N NWAIGJYBQQYSPW-UHFFFAOYSA-N 0.000 description 4
- 230000005540 biological transmission Effects 0.000 description 4
- 238000000407 epitaxy Methods 0.000 description 4
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 4
- 229910052737 gold Inorganic materials 0.000 description 4
- 229910052697 platinum Inorganic materials 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 229910052719 titanium Inorganic materials 0.000 description 4
- 238000003631 wet chemical etching Methods 0.000 description 4
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 3
- 230000008021 deposition Effects 0.000 description 3
- 239000002019 doping agent Substances 0.000 description 3
- 230000000873 masking effect Effects 0.000 description 3
- 230000003287 optical effect Effects 0.000 description 3
- 238000000059 patterning Methods 0.000 description 3
- 229910052594 sapphire Inorganic materials 0.000 description 3
- 239000010980 sapphire Substances 0.000 description 3
- 239000010703 silicon Substances 0.000 description 3
- 238000002834 transmittance Methods 0.000 description 3
- 229910005191 Ga 2 O 3 Inorganic materials 0.000 description 2
- 239000000370 acceptor Substances 0.000 description 2
- 229910000147 aluminium phosphate Inorganic materials 0.000 description 2
- 238000005229 chemical vapour deposition Methods 0.000 description 2
- 239000003086 colorant Substances 0.000 description 2
- 238000002248 hydride vapour-phase epitaxy Methods 0.000 description 2
- 229910003465 moissanite Inorganic materials 0.000 description 2
- 239000002086 nanomaterial Substances 0.000 description 2
- 229910052759 nickel Inorganic materials 0.000 description 2
- 230000005693 optoelectronics Effects 0.000 description 2
- 229910002059 quaternary alloy Inorganic materials 0.000 description 2
- 229910010271 silicon carbide Inorganic materials 0.000 description 2
- 229910002058 ternary alloy Inorganic materials 0.000 description 2
- AIRCTMFFNKZQPN-UHFFFAOYSA-N AlO Inorganic materials [Al]=O AIRCTMFFNKZQPN-UHFFFAOYSA-N 0.000 description 1
- PIGFYZPCRLYGLF-UHFFFAOYSA-N Aluminum nitride Chemical compound [Al]#N PIGFYZPCRLYGLF-UHFFFAOYSA-N 0.000 description 1
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- 230000002411 adverse Effects 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 229910052787 antimony Inorganic materials 0.000 description 1
- 229910052785 arsenic Inorganic materials 0.000 description 1
- 238000010420 art technique Methods 0.000 description 1
- 229910002056 binary alloy Inorganic materials 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 230000015556 catabolic process Effects 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 238000006731 degradation reaction Methods 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 229910052732 germanium Inorganic materials 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 229910021389 graphene Inorganic materials 0.000 description 1
- 229910021478 group 5 element Inorganic materials 0.000 description 1
- AMGQUBHHOARCQH-UHFFFAOYSA-N indium;oxotin Chemical compound [In].[Sn]=O AMGQUBHHOARCQH-UHFFFAOYSA-N 0.000 description 1
- 230000003993 interaction Effects 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 238000001451 molecular beam epitaxy Methods 0.000 description 1
- -1 n-GaN Chemical compound 0.000 description 1
- 150000004767 nitrides Chemical class 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 229910052763 palladium Inorganic materials 0.000 description 1
- KDLHZDBZIXYQEI-UHFFFAOYSA-N palladium Substances [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 description 1
- 229910052698 phosphorus Inorganic materials 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 239000011148 porous material Substances 0.000 description 1
- 238000002310 reflectometry Methods 0.000 description 1
- 229910052703 rhodium Inorganic materials 0.000 description 1
- 239000010948 rhodium Substances 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 239000004332 silver Substances 0.000 description 1
- 238000000927 vapour-phase epitaxy Methods 0.000 description 1
- YVTHLONGBIQYBO-UHFFFAOYSA-N zinc indium(3+) oxygen(2-) Chemical compound [O--].[Zn++].[In+3] YVTHLONGBIQYBO-UHFFFAOYSA-N 0.000 description 1
- XLOMVQKBTHCTTD-UHFFFAOYSA-N zinc oxide Inorganic materials [Zn]=O XLOMVQKBTHCTTD-UHFFFAOYSA-N 0.000 description 1
- 239000011787 zinc oxide Substances 0.000 description 1
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- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/075—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L33/00
- H01L25/0753—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L33/00 the devices being arranged next to each other
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- H01L27/153—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components having potential barriers, specially adapted for light emission in a repetitive configuration, e.g. LED bars
- H01L27/156—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components having potential barriers, specially adapted for light emission in a repetitive configuration, e.g. LED bars two-dimensional arrays
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- H01L33/005—Processes
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- H01L33/06—Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor bodies with a quantum effect structure or superlattice, e.g. tunnel junction within the light emitting region, e.g. quantum confinement structure or tunnel barrier
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Abstract
Description
本発明は、半導体デバイス及び半導体デバイスの製造方法に関し、特に、マイクロLED及びマイクロLEDを製造する改良された方法に関する。
発光用の標準的な発光ダイオード(LED)は、通常、200μm×200μmよりも大きい。マイクロLEDは、横方向サイズが100μm×100μm未満で高密度の微小規模LEDのアレイである。このため、マイクロLEDは横方向の寸法(長さと幅)が100μm×100μよりも小さく、数十ナノメートル、更にはより小型になったLED構造として定義され得る。
これまで、既知の技術を用いてマイクロLEDを製造する試みが行われてきた。例えば、従来の試みは、通常のLEDエピタキシ及びレーザリフトオフ、静電キャリー、及び転写用のエラストマスタンプを使用して行われている。しかし、この技術をマイクロLEDくらい小さいデバイスに応用することにはいくつかの問題がある。
これらの問題には以下が含まれる。
-3つの主要カラー(RGB)の全てをマイクロLEDの同一チップ上に生成するには、通常のLEDエピタキシでは難しい。
-緑色及び赤色のマイクロLEDでは効率が低い。
-微小規模のLEDメサを画定するには、常に乾式エッチングが必要である。LEDサイズが小さくなると、LED構造の側壁に対するプラズマ損傷がデバイスの発光効率と寿命に影響を及ぼす。
-レーザリフトオフは歩留まりが低く、コストが高い。
-転写においては、以前から存在するひずみ/反りの問題に起因した低い歩留りがある。
-3つの主要カラー(RGB)の全てをマイクロLEDの同一チップ上に生成するには、通常のLEDエピタキシでは難しい。
-緑色及び赤色のマイクロLEDでは効率が低い。
-微小規模のLEDメサを画定するには、常に乾式エッチングが必要である。LEDサイズが小さくなると、LED構造の側壁に対するプラズマ損傷がデバイスの発光効率と寿命に影響を及ぼす。
-レーザリフトオフは歩留まりが低く、コストが高い。
-転写においては、以前から存在するひずみ/反りの問題に起因した低い歩留りがある。
これらの問題のため、従来のLED製造技術は高品質のマイクロLEDの生産においては満足できるものではない。
本出願は、マイクロLEDの改良された製造方法、及びこの方法を用いて作製されたマイクロLEDに関する。本発明は独立請求項において規定され、独立請求項についてはここで言及するものとする。本発明の好適な又は有利な特徴は、従属請求項に記載される。
マイクロLEDは、好ましくはIII-V族半導体材料から形成され、特に好ましくはIII族窒化物半導体材料から形成される。
「III-V」族半導体は、Ga、Al、及びInのようなIII族元素、並びにN、P、As、及びSb)のようなV族元素の二元合金、三元合金、及び四元合金を含み、オプトエレクトロニクスを含む多数の応用分野において重要である。
特に重要なのは、窒化ガリウム(GaN)、窒化インジウム(InN)、窒化アルミニウム(AlN)、及びそれらの三元合金及び四元合金を含む「III族窒化物」材料として知られる半導体材料クラスである。III族窒化物材料は、半導体照明及びパワーエレクトロニクスで商業的成功を収めているだけでなく、量子光源及び光と物質の相互作用において特別な利点を有する。
多様なIII族窒化物材料が商業的な面で興味深いが、窒化ガリウム(GaN)は最も重要な新しい半導体材料の1つと広く認められ、多くの応用分野において特に重要である。
バルクGaNに気孔を導入すると、例えば屈折率のような材料特性に大きな影響を及ぼすことが知られている。したがって、GaNの多孔度(porosity)を変えることでその光学特性を調整できる可能性があり、多孔質GaNはオプトエレクトロニクスの応用分野において大きな関心が持たれている。
本発明はGaNを参照して記述されるが、代替できるIII族窒化物材料にも有利に応用される。
III-V族半導体材料の多孔質化に関する従来の刊行物には、国際特許出願PCT/GB2017/052895号(国際公開第2019/063957号として公開されている)及びPCT/GB2019/050213号(国際公開第2019/145728号として公開されている)が含まれる。
本発明者らは、本発明を用いてマイクロLED及びマイクロLEDのアレイを有利に提供できることを見出した。
(マイクロLEDの製造方法)
本発明の第1の態様によれば、マイクロLEDを製造する方法が提供される。この方法は、
III族窒化物材料の多孔質領域の上にIII族窒化物材料のnドープ接続層を形成するステップと、
nドープ接続層上に電気絶縁マスク層を形成するステップと、
マスクの一部を除去してnドープ接続層の露出領域を露出させるステップと、
nドープ接続層の露出領域上にLED構造を形成するステップと、
を含む。
本発明の第1の態様によれば、マイクロLEDを製造する方法が提供される。この方法は、
III族窒化物材料の多孔質領域の上にIII族窒化物材料のnドープ接続層を形成するステップと、
nドープ接続層上に電気絶縁マスク層を形成するステップと、
マスクの一部を除去してnドープ接続層の露出領域を露出させるステップと、
nドープ接続層の露出領域上にLED構造を形成するステップと、
を含む。
電気絶縁(誘電)マスク層を形成し、次いでマスクの一部を除去してnドープ接続層の露出領域を露出させることにより、その上にマイクロLEDのLED構造を形成できるテンプレート又は「フットプリント」を形成する。露出領域のサイズ及び形状は、マスクから除去される部分のサイズ及び形状を制御することによって制御される。次いで、露出領域上にその後の半導体材料層を堆積してLED構造を形成することができる。露出領域のサイズ及び形状を制御することにより、その後に形成されるLED構造の横方向サイズ(長さと幅)及び形状を制御できる。このサイズ制御は、横方向の寸法が極めて小さいマイクロLED構造を成長させるため特に有利である。
従来技術では、大規模LED構造を成長させ、次いで、溝をエッチングすることにより、その構造を所望の横方向サイズの微小規模プラットフォーム又は「メサ」に切断し、マイクロLEDに分割する。このような従来技術の手法を用いて作製されたマイクロLEDでは、LED構造の側壁に対するエッチング損傷が、マイクロLEDにより形成される極めて小さい画素に重大な影響を与える。これは、マイクロLEDの信頼性と輝度に悪影響を及ぼす可能性がある。
本発明の方法は、マイクロLEDを形成する適正なサイズと形状を有するあらかじめ画定された露出領域に、マイクロLEDのLED構造が形成されるという利点がある。本発明では、露出領域がLED構造のフットプリントを制御するので、LED構造は最初から適正なサイズに有利に形成され得る。このため、本発明のLED構造をエッチングして横方向サイズを小さく分ける必要はない。したがって、これにより得られるマイクロLEDでは、従来技術の方法で生じる乾式エッチング損傷が回避される。
マイクロLEDのアクティブ層に対する乾式エッチング損傷を回避することは、従来技術を用いて調製されたマイクロLEDに比べて著しい利益をもたらすので、本方法を用いて作製されたマイクロLEDは信頼性が高く、かつ輝度が高いという利点がある。
本発明のもう1つの利点は、わずか数ミクロンのサイズの極めて小さいマイクロLED構造であっても、LED構造のnドープ部分との電気的n接触を容易に作製できることである。本発明では、電気絶縁マスク層の追加の部分を除去してnドープ接続層上に第2の露出領域を露出させ、この第2の露出領域上に伝導接触を堆積することにより簡単にn接触を作製することができる。
LED構造を形成するステップは、当技術分野の従来の方法に従ってLED構造を成長させることを含む。すなわち、LED構造は既知の半導体堆積技術を用いて成長させ、従来の様々なLEDエピタキシャル層を持つことができる。ここでは、一例として典型的なLED構造を記載するが、当技術分野では様々なLED構造(層厚、材料、及びドーピングレベルの様々な組み合わせを含む)が知られており、本発明において使用可能であることは当業者に理解されよう。しかし、本発明では、nドープ接続層の1又は複数の露出領域上にのみ、LED構造が形成、成長、又は堆積される。
LED構造を形成するステップは、好ましくは、nドープ接続層の露出領域上に、
nドープ部分と、
pドープ部分と、
nドープ部分とpドープ部分との間に配置された発光領域と、
を形成することを含む。
nドープ部分と、
pドープ部分と、
nドープ部分とpドープ部分との間に配置された発光領域と、
を形成することを含む。
マイクロLEDを製造する方法は、第1のステップとして、III族窒化物材料層を電気化学的に多孔質化して、III族窒化物材料の多孔質領域を形成するステップを含む。これは、ウェーハスケールの多孔質化プロセスを用いて達成されるもので、国際特許出願PCT/GB2017/052895号(国際公開第2019/063957号として公開されている)及びPCT/GB2019/050213号(国際公開第2019/145728号として公開されている)に記載されている。このステップは、III族窒化物材料からなるnドープ接続層を多孔質領域上に形成する前に実行されるべきもので、これにより、その接続層は電気化学的に多孔質化されることはない。。
その方法は好ましくは、III族窒化物材料の非多孔質層を通して、電気化学的多孔質化によりIII族窒化物材料の多孔質領域を形成し、その結果、III族窒化物材料の非多孔質層が非多孔質中間層を形成するステップを含む。非多孔質中間層は、有利には接続層の成長のための平滑表面となることができ、このため、中間層は、多孔質領域とnドープIII族窒化物接続層との間に配置される。
多孔質領域は、基板上のIII族窒化物材料の1つ以上の層又は領域を多孔質化することによって形成される。基板は、シリコン、サファイア、SiC、β-Ga2O3である。基板の結晶方位は、極性、半極性、又は非極性方位である。基板の厚さは、典型的に100μm~1500μmの間で変動する。
多孔質領域は1つの多孔質層とすることができ、このため、その方法は、III族窒化物材料の多孔質層の上にIII族窒化物材料のnドープ接続層を形成するステップを含む。好ましくは多孔質領域は、例えば多孔質III族窒化物材料の連続層から形成された、連続的に多孔質である多孔質層である。
多孔質領域は複数の多孔質層を含むことができ、任意に複数の非多孔質層も含み得る。本発明の好適な実施形態において、多孔質領域は多孔質層と非多孔質層の交互層からなるスタックであり、スタックのトップ面が多孔質領域のトップ部を画定し、スタックの底面が多孔質領域の底部を画定する。III族窒化物材料のnドープ接続層は、III族窒化物材料の多孔質層のスタックを含む多孔質領域の上に形成される。
あるいは、多孔質領域は、1つ以上の多孔質領域を含むIII族窒化物材料層であり、例えば、III族窒化物材料の非多孔質層内の1つ以上の多孔質領域である。
好適な実施形態において、多孔質領域又は多孔質層は、この多孔質層又は多孔質領域を成長させる基板と同等の横方向寸法(幅又は長さ)を有する。従来の基板ウェーハサイズは種々のサイズを有することができ、例えば1cm2、又は直径が2インチ、4インチ、6インチ、8インチ、12インチ、又は16インチである。しかし、1つ以上の層をパターニングすること、及び/又は同一の層内に電荷キャリア濃度の異なる領域を堆積することによって、基板全体までは及ばない小さい多孔質領域を形成することも可能である。したがって、多孔質層又は多孔質領域の横方向寸法は、1画素の約10分の1(例えば0.1μm)から基板自体の横方向寸法まで変動する。
基板上に、nドープIII族窒化物半導体材料の1つの層又は複数の層のスタックを成長させる。III族窒化物層は、元素Al、Ga、Inのうち1つ又はいくつかの組み合わせを含む(三元層、四元層)。III族窒化物スタックの厚さは、好ましくは10~4000nmである。III族窒化物層は、1×1017cm-3~5×1020cm-3のドーピング濃度を有する。
好ましくは、非ドープIII族窒化物材料からなる中間層は、ドープ材料を多孔質化する前にドープ材料の上に堆積される。中間層の厚さは、好ましくは1nm~3000nmであり、好ましくは5nm~2000nmである。
好適な実施形態において、ドープ領域は、高ドーピングゾーン/低ドーピングゾーンが配列した交互層のスタックから成る。スタックは、高/低ドーピングゾーンのペアで構成することができ、好ましくは5~50ペアの層を含む。高ドープ層の各々の厚さは10nm~200nmの間で変動し、低ドープ層の厚さは5~180nmの間で変動する。
当技術分野において既知のように、電気化学的な多孔質化によってIII族窒化物材料のn型ドープ領域から材料が除去され、半導体材料に空の気孔が生成される。
好適な実施形態では、III族窒化物材料のnドープ接続層は、III族窒化物材料の複数の多孔質層のスタックの上に形成される。このため、多孔質領域は、III族窒化物材料の単一の多孔質層というよりは、少なくともいくつかの層が多孔質であるIII族窒化物材料の複数の層のスタックである。
多孔質層のスタックは、好ましくは、多孔質層と非多孔質層の交互層からなるスタックである。好ましくは、スタックは、一方が他方の上に積層された、多孔質層と非多孔質層の5~50のペアを含む。多孔質層は好ましくは10nm~200nmの厚さを有し、非多孔質層は好ましくは5nm~180nmの厚さを有する。
多孔質領域又は多孔質領域内の各多孔質層は、多孔度1%~99%の多孔質である。好ましくは、多孔質領域又はスタック内の各多孔質層は、多孔度10%~90%の多孔質である。
特に好適な実施形態において、多孔質層スタックは多孔質分布ブラッグ反射器(DBR:Distributed Bragg Reflector)を含み、このためその方法は、III族窒化物材料の多孔質DBRの上にIII族窒化物材料のnドープ接続層を形成するステップを含む。多孔質DBRは、多孔質層/非多孔質層の交互層からなるスタックから形成され、隣接する層間の多孔度が異なるので、隣接する層間に屈折率の違いが生じる。
III族窒化物材料の多孔質/非多孔質の交互層からなるスタック層の厚さ、及び多孔質層の多孔度を制御することによって、特定の波長の光を反射するようにDBRの光学特性を制御することができる。
第1の好適な実施形態において、DBRは、LED構造の発光波長の光を反射するように構成される。これは、LED構造からDBRの方向へ放出された光が反射して戻されるので、マイクロLEDから意図する方向へ放射される光の量が増大することを意味する。これにより、マイクロLEDの輝度は有利に高くなる。
第2の好適な実施形態において、DBRは、LED構造の発光波長の光を透過するが別の光波長の透過を遮断するように構成され得る。マイクロLEDは、デバイスの発光方向がDBRを通るように構成できるので、DBRは、LED構造が放射した光がデバイスから射出するために通過しなければならない光学フィルタとして作用する。このためDBRは、有利には、LEDデバイスからの望ましくない波長の透過を防ぐことができる。
DBRは、有利には、所望の波長の光に対して90%より大きい反射又は透過を与えるよう構成され得る。DBRの層構造及び厚さを変動させることによって、DBRの反射率又は透過特性を様々な波長に合わせて調整することができる。例えば、DBRの反射率/透過率は、~450nmの青色光、あるいは緑色光(520~540nm)、又は赤色光(615~640nm)に対して、90%より大きい反射率/透過率を与えるように調整され得る。
III族窒化物材料のnドープ接続層は、この領域の上に、好ましくは非多孔質中間層上への堆積によって成長させる。
III族窒化物材料のnドープ接続層は、好ましくは200nm~2000nmの厚さを有する。III族窒化物材料のnドープ接続層は、好ましくは少なくとも1×1018cm-3のn型電荷キャリア濃度を有する。
マスク層は、好ましくはIII族窒化物材料のnドープ接続層の上に、誘電材料層を堆積することによって形成される。マスク層は、好ましくはIII族窒化物材料のnドープ接続層の表面全体に堆積され、このため、接続層は完全に誘電材料で覆われる。マスク層は、SiO2、SiN、SiON、AlOx、又は他の任意の適切な誘電材料から形成される。
マスク層の厚さは、5nm~1000nm、好ましくは200nm~800nm、特に好ましくは400nm~600nmである。
マスク層の堆積は、プラズマ強化化学気相堆積(PECVD)、スパッタリング、原子層堆積(ALD)、蒸着、又はインサイチュ(in-situ)有機金属化学気相堆積(MOCVD)のような従来の堆積法によって実行され得る。
標準的なリソグラフィ技術は、マスク層の一部の除去に使用することができ、1つ以上の開口を非伝導マスク層に形成し、これがその下のnドープ接続層の領域を露出する。マスク層の一部を除去するステップは、湿式エッチング又は乾式エッチング、例えば誘導結合乾式エッチング(ICP-RIE)を含む。
1又は複数の露出領域の横方向サイズ(マスク層を貫通する開口の長さと幅)及び形状は、露出領域内に成長させるLED構造の横方向サイズ及び形状を制御する。
接続層の1又は複数の露出領域は、任意の所望の形状に形成することができ、マスク層の一部をパターニングしてリソグラフィで除去することによって制御される。例えば露出領域は、円形、方形、矩形、六角形、又は三角形の形状である。
露出領域のサイズはマイクロLEDのサイズでなければならない。例えば、露出領域の幅及び/又は長さ(又は、露出領域が円形である場合は直径)は、0.05μm~100μm、好ましくは0.05μm~30μm、特に好ましくは10μm未満、例えば0.1μm~10μm又は0.5μm~10μmである。好適な実施形態において、露出領域の長さ、幅、又は直径は、50μm未満、又は40μm、又は30μm、又は20μm、又は10μm未満である。特に好ましくは、露出領域は10μm未満の幅又は直径を有するので、露出領域内に成長させたLED構造は10μm未満のサイズのマイクロLED画素を形成する。
いったん、誘電マスク層にnドープ接続層の露出領域が形成されると、nドープ接続層と接触するように露出領域内にLED構造を成長させることができる。
nドープ部分、発光領域、及びpドープ部分を含むLED構造の横方向寸法は、好ましくは露出領域の寸法と同一である。これは、LED構造が露出領域内に成長して露出領域の横方向サイズを受け継ぐからである。これはつまり、LED構造の横方向寸法を小さく分割するためのエッチングステップを必要とすることなく、マイクロLEDを適切なサイズで成長させることが可能であることを意味する。
本発明の利点を獲得するので、様々なLED構造を露出領域内に成長させることができる。そのような全てのLED構造は、通常、nドープ部分、発光領域、及びpドープ部分を含み、任意に、LEDエピタキシにおいて典型的な更なる半導体材料層を含む。本発明で使用するのに適した典型的LED構造について以下で説明する。
好適な実施形態では、LED構造のnドープ部分は、接続層の露出領域上に、nドープ接続層と直接接触するように成長する。
nドープ部分は、III族窒化物材料の第1のnドープ層を含むことができ、好ましくは、0.2μm~3μmの厚さ及び少なくとも1×1019cm-3のn型ドーピング濃度を有する。
nドープ部分は、第1のnドープ層の上にIII族窒化物材料の第2のnドープ層を含む。第2のnドープ層は、インジウムを含有するIII族窒化物層、又は、インジウムを含有するか含有しない薄いIII族窒化物層のスタック、又は、層内もしくはスタック内でインジウムの原子百分率が変動するIII族窒化物バルク層もしくはIII族窒化物層のスタックを含む。例えばnドープ領域は、n-GaN層又はn-InGaN層であるか、又は、n-GaN/n-InGaNの交互層からなるスタック、又は、それぞれの層でインジウム量が異なるn-InGaN/n-InGaNの交互層からなるスタックである。
第2のnドープ層のインジウム原子百分率は0.5~25%の間で変動する。第2のnドープ層の合計厚は2nm~200nmの間で変動する。第2のnドープ層が層のスタックを含む場合、スタック内の個々の層の厚さは好ましくは1~40nmの間で変動する。
III族窒化物材料の第2のnドープ層は、1×1017cm-3~5×1020cm-3のn型ドーピング濃度を有する。
露出領域内にLED構造のn型部分を成長させた後、n型部分の上にLEDの発光領域を成長させる。
発光領域は、1つ以上のIII族窒化物発光層を含み、好ましくはインジウムガリウム窒化物(InGaN)発光層である。1つの発光層又は各発光層は好ましくは、量子井戸、又は、量子ドット、断片的もしくは不連続的な量子井戸のような量子構造を含むナノ構造層を含む。
1つの発光層又は各発光層は、好ましくは原子インジウム含有量が10~40%であるIII族窒化物材料を含む。発光層のインジウム含有量は、所望の発光波長に応じて異なるレベルに選択される。好適な実施形態において、発光層のインジウム含有量は、12~18%、好ましくは13%超、又は20~30%、好ましくは22%超、又は30~40%、好ましくは33%超である。
1つ以上の発光層は、組成InxGa1-xNを有する。ここで、0.10≦x≦0.40、好ましくは0.12≦x≦0.18、又は0.20≦x≦0.30、又は0.30≦x≦0.40である。
好適な実施形態において、発光領域は、1つ以上のInGaN量子井戸、好ましくは1~7の量子井戸を含む。各量子井戸の厚さは1.5~8nmの間で変動する。
量子井戸は、薄い(0.5~3nm)III族窒化物層で覆われていてもよく、又は覆われていなくともよい。
III族窒化物バリア層は、元素Al、Ga、Inのうち1つ又はいくつかの組み合わせを含む(三元層又は四元層)。
発光領域の量子井戸及びバリアは、好ましくは600~800℃の温度範囲内で成長させる。
LED構造は、量子井戸とpドープ部分との間にIII族窒化物材料のキャップ層を含み、好ましくは、キャップ層はドープされておらず、5nm~30nmの厚さを有する。
pドープ部分は発光領域の上方に成長され、pドープIII族窒化物層と、pドープIII族窒化物層と発光領域との間に配置されたpドープアルミニウムガリウム窒化物層を含む。pドープアルミニウムガリウム窒化物層は、キャップ層とp型層との間にある電子ブロック層(EBL:electron blocking layer)で、この電子ブロック層は5~25at%のアルミニウムを含有し、好ましくは厚さ10nm~100nmである。
pドープIII族窒化物層は、好ましくは5×1018cm-3~8×1020cm-3のp型ドーピング濃度を有する。pドープIII族窒化物層はIn及びGaを含有し、厚さは20~200nmであり、好ましくは厚さ50~100nmである。ドーピング濃度はこの層内で変動し、層の最後の10~30nmの部分にドーピングレベルのスパイクを有することができる。Mgアクセプタを活性化するため、構造体はMOCVD反応器内又はアニーリングオーブン内でアニールされる。アニーリング温度は、N2又はN2/O2雰囲気で700~850Cの範囲である。
EBL及びpドープ層は双方ともp型ドープされているので、これらの層をpドープ領域と呼ぶことができる。
nドープ部分、及び、発光領域とpドープ部分を形成した後、その方法は、LED構造及び電気絶縁マスク層の上に1つ以上のパッシベーション層を堆積するステップを含む。パッシベーション層は誘電材料から形成され、マスク層ばかりでなくLED構造の表面及び側壁を覆う。堆積される第1のパッシベーション層は、例えばAl2O3(10~100nmの厚さの層)(原子層堆積によって堆積される)であり、その後、スパッタ又はプラズマ強化化学気相堆積によりSiO2、SiN、又はSiON(50~300nmの厚さの層)を堆積する。Al2O3は50~150Cで堆積し、SiO2、SiN、及びSiONは250~350Cで堆積する。スパッタプロセスは室温で実行できる。
その方法は、パッシベーション層の第1の部分を除去するステップと、pドープ部分との電気接続を形成するステップと、パッシベーション領域の第2の部分及びマスクの第2の部分を除去してnドープ接続層の第2の露出領域を露出させるステップと、nドープ接続層の第2の露出領域に電気接触を形成するステップと、を更に含む。パッシベーション層及び誘電マスク層の部分は、湿式エッチング、乾式エッチング、又はそれら双方の組み合わせによって除去すればよい。湿式エッチング緩衝酸化物エッチングでは、希釈フッ化水素酸、リン酸、又はこれらの混合物を使用することができる。
これらのステップは連続的に実行される。例えばその方法は、パッシベーション層の第1の部分を除去し、pドープ部分との電気接触を形成するステップを含む。好適な実施形態では、透明導電層を用いてLED構造のpドープ層とのp接触を形成することができ、透明導電層の少なくとも一部分を金属接触で覆う。この金属接触は、ニッケル、チタン、白金、及び金の組み合わせとすることができる。透明導電層は20~250nmの厚さとすることができる。
その方法は、マスクの第2の部分を除去するステップを含み、必要に応じてパッシベーション層の第2の部分を除去し、nドープ接続層の第2の露出領域を露出させ、nドープ接続層の第2の露出領域に電気接触を形成するステップを更に含む。電気接触は、nドープ接続層の第2の露出領域上に金属接触を堆積することによって形成される。この金属接触は例えば、チタン、白金、及び金の組み合わせとすることができる。
(好適な実施形態)
好適な実施形態において、マイクロLEDを製造する本方法は以下のステップを含む。
好適な実施形態において、マイクロLEDを製造する本方法は以下のステップを含む。
ステップ1 電荷キャリア密度が異なるGaN層を基板上に交互に堆積し、次いで、多孔質化技術を用いて基板上に分布ブラッグ反射器(DBR)を形成する。多孔質化技術は国際特許出願PCT/GB2017/052895号に記載されているものを適用する。
ステップ2 n-(Al,In)GaN層(例えばn-GaN、n-AlGaN、又はn-InGaN等の高度にドープされたn型(Al,In)GaN)を、多孔質化DBRのトップに成長させる。
ステップ3 例えばSiO2のような誘電材料層をn-GaNのトップ表面に堆積する。
ステップ4 リソグラフィ、ナノインプリント、又は他の適切な技術によって誘電材料をパターニングし、次いで誘電層の一部を湿式化学エッチング又は乾式エッチングプロセスによって除去する。誘電層の一部を除去すると、その下にあるn-GaNの部分が露出する。誘電体が除去されたエリアは、マイクロLEDの形状及びサイズであり、例えば100μm×100μm又はそれ以下である。
ステップ5 量子井戸(QW)アクティブ発光領域(複数の量子井戸を含み得る)を、n-(Al,In)GaNの露出部分に堆積させる。量子井戸は、InGaN、AlGaN、InN、InAlN、AlInGaNとすることができ、量子井戸層を取り囲む量子バリアは、GaN、AlN、AlGaN、AlInGaN、InAlNとすることができる。量子井戸の構造及び機能は、国際特許出願PCT/GB2019/050213号に定義されている。QWの横方向寸法は、n-(Al,In)GaNの露出部分と同じである。これは、QW領域がマイクロLEDに望ましいサイズであることを意味する。
ステップ6 p-(Al,In)GaN層(高度にドープされたp型(Al,In)GaN)を、量子井戸領域のトップに堆積させる。p-GaN層の横方向寸法はQWと同じであり、n-GaNの露出部とも同じである。したがって、p-GaN及びQWは、マイクロLEDとして望ましい横方向寸法を有するスタックを形成する。
ステップ7 例えばSiO2のような誘電材料の第2の層を、誘電体の第1の層のトップに堆積し、誘電体の第2の層が、QW及びp-(Al,In)GaN層のエッジ又は側壁を覆う。この誘電材料の第2の層はパッシベーション層である。
ステップ8 p-(Al,In)GaNの上に電気的p接触を形成し、これをp-(Al,In)GaN層と電気的に接触させる。
ステップ9 湿式化学エッチング又は乾式エッチングプロセスによって誘電層の一部を除去して、n-(Al,In)GaN層の一部を露出させる。
ステップ10 n-(Al,In)GaNの露出部分に電気的n接触を堆積させ、そのn接触はn-(Al,In)GaNと電気的に接触させる。
ステップ11 SiO2の第2の層は既知の技法によって不動態化される。プラズマエッチはチップの個別化と移送のために用いられる。
この方法によれば、マイクロLEDのアクティブQWとp-(Al,In)GaN層は、いかなる乾式エッチング損傷をも受けない。また、n接触を極めて容易に作製することができる。
マイクロLEDのアクティブ層に対する乾式エッチング損傷が回避される結果、従来技術を用いて調製されたマイクロLEDに比べて著しい利点が得られる。従来技術を用いて作製されたマイクロLEDでは、p-GaN及びQW層の側壁に対するエッチング損傷が、マイクロLEDにより形成される小さい画素に重大な効果を及ぼす。これは、マイクロLEDの信頼性と輝度を害するものである。
本方法を用いて製造されたマイクロLEDは、LEDスタックの側壁へのプラズマエッチング損傷を受けないので、信頼性と輝度の点で有利となる。
半導体構造の層は、電気化学エッチングによって多孔質化することできるが、このことは、所望であれば、国際特許出願PCT/GB2017/052895号(国際公開第2019/063957号として公開されている)及びPCT/GB2019/050213号(国際公開第2019/145728号として公開されている)に記載されている。
上述の方法は、p側光放射LEDの構成に関係する。
n側光放射マイクロLEDを製造することは、「フリップチップ」ステップを組み込み、マイクロLEDをシリコンCMOSバックプレーンに接合することにより、同様の方法で行うことができる。
SiO2はマスキング及びパッシベーションに適した誘電体の一例であり、代わりに他の誘電体を用いてもよい。
半導体材料層は、エピタキシャル成長によって堆積することができる。上述した層は、分子線エピタキシ(MBE)、有機金属化学気相堆積(MOCVD)(有機金属気相エピタキシ(MOVPE)としても知られる)、水素化物気相エピタキシ(HVPE)、アモノサーマルプロセス、又は、III族窒化物材料の成長に適した他の従来の方法によって形成される。
(マイクロLEDのアレイの製造)
本発明の第2の態様によれば、マイクロLEDのアレイを製造する方法が提供される。この方法は、
III族窒化物材料の多孔質領域の上にIII族窒化物材料のnドープ接続層を形成するステップと、
nドープIII族窒化物層上に電気絶縁マスク層を形成するステップと、
マスクの一部を除去してnドープ接続層の露出領域のアレイを露出させるステップと、
nドープ接続層の各露出領域上にLED構造を形成するステップと、
を含む。
本発明の第2の態様によれば、マイクロLEDのアレイを製造する方法が提供される。この方法は、
III族窒化物材料の多孔質領域の上にIII族窒化物材料のnドープ接続層を形成するステップと、
nドープIII族窒化物層上に電気絶縁マスク層を形成するステップと、
マスクの一部を除去してnドープ接続層の露出領域のアレイを露出させるステップと、
nドープ接続層の各露出領域上にLED構造を形成するステップと、
を含む。
マイクロLEDのアレイを製造する方法は、好ましくは第1の態様の方法を含み、これは、nドープ接続層に複数の露出領域を形成し、これらの露出領域に複数のLED構造を形成するものである。マスク層の一部を除去して露出領域のアレイを露出させることによって、マイクロLEDアレイのレイアウトは、マイクロLEDにより形成され画素が所望の寸法及び密度となるように設計される。
マイクロLEDのアレイは、有利には、単一の基板上に形成され、接続層の各露出領域上に半導体材料層を同時に堆積する堆積ステップを用いて、複数のLED構造を同時に形成することができる。
この方法を用いると、、LED構造を、個々の画素に望ましい横方向寸法に切断するエッチングステップを必要とすることなく、マイクロLEDのアレイを形成することができる。したがって、アレイ内のマイクロLEDは、LED構造の側壁に対するいかなるエッチング損傷をも回避することができる。
第2の態様の方法は、有利には、本発明の第1の態様に関連する上述のあらゆる特徴を含むものである。
(マイクロLED)
本発明の別の態様は、上述の方法で作製されたマイクロLEDに関するものである。
本発明の別の態様は、上述の方法で作製されたマイクロLEDに関するものである。
本発明の第3の態様によれば、マイクロLEDが提供される。これは、
III族窒化物材料の多孔質領域の上のIII族窒化物材料のnドープ接続層と、
nドープIII族窒化物層上の電気絶縁マスク層と、
LED構造とを含み、
LED構造の少なくとも一部分は電気絶縁マスク層内のギャップを貫通し、nドープ接続層と接触している。
III族窒化物材料の多孔質領域の上のIII族窒化物材料のnドープ接続層と、
nドープIII族窒化物層上の電気絶縁マスク層と、
LED構造とを含み、
LED構造の少なくとも一部分は電気絶縁マスク層内のギャップを貫通し、nドープ接続層と接触している。
マイクロLEDは、好ましくは、本発明の第1の態様に関連して上述した方法を用いて製造されたマイクロLEDである。
多孔質領域は1つの多孔質層とすることができ、このため、その方法は、III族窒化物材料の多孔質層の上にIII族窒化物材料のnドープ接続層を形成するステップを含む。いくつかの実施形態において、多孔質領域は複数の多孔質層を含み、任意に複数の非多孔質層を含む。本発明の好適な実施形態において、多孔質領域は多孔質層と非多孔質層の交互層からなるスタックであり、スタックのトップ面が多孔質領域のトップ部を画定し、スタックの底面が多孔質領域の底部を画定する。III族窒化物材料のnドープ接続層は、III族窒化物材料の多孔質層のスタックを含む多孔質領域の上に形成される。
好適な実施形態では、III族窒化物材料のnドープ接続層は、III族窒化物材料の複数の多孔質層のスタックの上に配置される。このため、多孔質領域は、III族窒化物材料の単一の多孔質層というよりは、むしろ少なくともいくつかの層が多孔質であるIII族窒化物材料の複数の層のスタックである。
多孔質層のスタックは、好ましくは、多孔質層と非多孔質層の交互層からなるスタックである。好ましくは、スタックは、交互に積層された多孔質層と非多孔質層の5~50のペアを含む。多孔質層は好ましくは10nm~200nmの厚さを有し、非多孔質層は好ましくは5nm~180nmの厚さを有する。
好ましくは、多孔質領域又はスタック内の各多孔質層は、10%~90%の多孔度を有する。
マイクロLEDは好ましくは、多孔質領域とnドープIII族窒化物接続層との間において、III族窒化物材料多孔質領域の非多孔質中間層を含む。好ましくは多孔質領域は、III族窒化物材料の非多孔質層を通して、電気化学的多孔質化によって形成される。この方法は、PCT/GB2017/052895号(国際公開第2019/063957号として公開されている)及びPCT/GB2019/050213号(国際公開第2019/145728号として公開されている)の方法を用いて行われる。このため、III族窒化物材料の非多孔質層は、典型的には、多孔質領域のトップに残る非多孔質中間層を形成する。その非多孔質中間層は、有利には、製造過程において接続層を成長させるための平滑表面を提供する。
特に好適な実施形態において、多孔質層スタックは多孔質分布ブラッグ反射器(DBR)を含むので、III族窒化物材料の多孔質DBRの上にIII族窒化物材料のnドープ接続層が配置される。多孔質DBRは、多孔質層/非多孔質層の交互層からなるスタックから形成され、隣接する層間の多孔度が異なるので、隣接する層間に屈折率の違いを生じさせる。
マイクロLEDは、多孔質領域と接続層との間において、非多孔質III族窒化物材料からなる中間層を有する。中間層の厚さは、好ましくは1nm~3000nmであり、好ましくは5nm~2000nmである。
III族窒化物材料のnドープ接続層は、好ましくは200nm~2000nmの厚さを有する。III族窒化物材料のnドープ接続層は、好ましくは少なくとも1×1018cm-3のn型電荷キャリア濃度を有する。
マスク層は、好ましくはIII族窒化物材料のnドープ接続層の全表面を覆って広がっているので、LED構造を除いて、接続層は完全に誘電材料で覆われる。マスク層は、SiO2、SiN、SiON、AlOx、又は他の適切な誘電材料から形成することができる。
マスク層の厚さは、5nm~1000nm、好ましくは200nm~800nmであり、特に好ましくは400nm~600nmである。
LED構造は所望の任意の形状を有する。これは、マスク層の一部をパターニングしてリソグラフィで除去することにより、LED構造のフットプリントを製造中に制御できるからである。例えば、LED構造のフットプリント(平面視)は、円形、方形、矩形、六角形、又は三角形の形状である。
LED構造は、「マイクロLED」に分類される横方向寸法を有する。例えば、LED構造の幅及び/又は長さ(又は、LEDが円形である場合は直径)は、0.05μm~100μm、好ましくは0.05μm~30μm、特に好ましくは10μm未満であり、例えば0.1μm~10μm又は0.5μm~10μmとすることができる。好適な実施形態において、LED構造の長さ、幅、又は直径は、50μm未満、又は40μm、又は30μm、又は20μm、又は10μm未満である。特に好ましくは、LED構造は10μm未満の幅又は直径を有し得るので、LED構造は10μm未満のサイズのマイクロLED画素を形成する。
LED構造は、
nドープ部分と、
pドープ部分と、
nドープ部分とpドープ部分との間に配置された発光領域と、
を備える。
nドープ部分と、
pドープ部分と、
nドープ部分とpドープ部分との間に配置された発光領域と、
を備える。
好ましくは、LED構造の少なくとも一部は電気絶縁誘電マスク層を貫通しているので、LED構造はnドープ接続層と電気的に接触している。
本発明の第1の態様に関して上述したように、LED構造は、異なる厚さ、組成、及び電荷キャリア濃度の層を有する様々な異なる形態をとり得る。
本発明の第1の態様に関して上述したマイクロLEDの特徴は、第3の態様のマイクロLEDに等しく適用される。
マイクロLEDは多孔質DBRを含む。
マイクロLEDは、量子井戸又は量子層であるアクティブ層(例えば、複数の3D量子構造を含む多孔質化量子井戸)を含む。量子井戸は、InGaN、AlGaN、InN、InAlN、AlInGaNであり、量子井戸層を取り囲む量子バリアは、GaN、AlN、AlGaN、AlInGaN、InAlNである。
マイクロLEDは、横方向の寸法(長さと幅)が100μm×100μmよりも小さく、数十ナノメートル、更にはより小型であり得る。この関連でLEDの「高さ」は、意図される発光方向における寸法である。
マイクロLEDは好ましくは、アクティブ層(量子井戸とすることができる)及びp-GaN層を含む。アクティブ層とp-Gan層の側壁は、例えばSiO2のような誘電材料で覆われることが好ましい。
マイクロLEDは好ましくは、誘電材料の第1の層と、第1の層のトップにある誘電材料の第2の「パッシベーション」層とを含む。誘電材料のパッシベーション層は、好ましくは、アクティブ層とp-GaN層の側壁を覆うように広がっている。
(マイクロLEDのアレイ)
本発明の第4の態様によれば、基板上に形成され、本発明の第3の態様による複数のマイクロLEDを含むマイクロLEDのアレイが提供される。
本発明の第4の態様によれば、基板上に形成され、本発明の第3の態様による複数のマイクロLEDを含むマイクロLEDのアレイが提供される。
マイクロLEDのアレイは、III族窒化物材料の多孔質領域の上のIII族窒化物材料のnドープ接続層と、
nドープIII族窒化物層上の電気絶縁マスク層と、
複数のLED構造と、
を含み、各LED構造の少なくとも一部分は電気絶縁マスク層内のギャップを貫通し、nドープ接続層と接触している。
nドープIII族窒化物層上の電気絶縁マスク層と、
複数のLED構造と、
を含み、各LED構造の少なくとも一部分は電気絶縁マスク層内のギャップを貫通し、nドープ接続層と接触している。
マイクロLEDのアレイは、規則正しく連続した又は配列されたマイクロLEDであり、例えば、それぞれが複数のマイクロLEDを含む多数の行と列が規則的に形成されたものである。
マイクロLEDのアレイは、本発明の第2の態様の方法を用いて製造されたマイクロLEDのアレイである。
本発明の第1、第2、第3、又は第4の態様のいずれかに関して上述した特徴は全て、本発明の他の態様にも等しく適用可能である。
これより図面を参照して本発明の特定の実施形態を記載する。
図1は、本発明に従い、マイクロLED又はマイクロLEDのアレイに適した多孔質テンプレートを示す。
図2-図18は、本発明の好適な実施形態に従い、2つのマイクロLEDのアレイを製造するステップを示し、
図19-図25は、本発明の好適な実施形態に従い、マイクロLEDを製造する方法を示す。
図2-図18は、本発明の好適な実施形態に従い、2つのマイクロLEDのアレイを製造するステップを示し、
図19-図25は、本発明の好適な実施形態に従い、マイクロLEDを製造する方法を示す。
図1は、本発明に従い、マイクロLEDに適した多孔質テンプレートを示す。
多孔質テンプレートは、基板上にIII族窒化物材料の多孔質領域を有し、多孔質領域のトップ面上にはIII族窒化物材料の非多孔質層が配置されている。任意に、基板と多孔質領域との間にIII族窒化物材料の更なる層も存在し得る。
上記で詳述したように、多孔質領域は、III族窒化物材料のnドープ領域、次いでIII族窒化物材料の非ドープ層をエピタキシャルに成長させ、多孔質化プロセスを用いてnドープ領域を多孔質化することによって提供される。多孔質化プロセスについては、国際特許出願PCT/GB2017/052895号(国際公開第2019/063957号として公開されている)及びPCT/GB2019/050213号(国際公開第2019/145728号として公開されている)に記載されている。
多孔質領域は、1つ以上のIII族窒化物材料からなる1つ以上の層を含むことができ、ある範囲の厚さを有し得る。好適な実施形態において、多孔質領域は例えばGaN及び/又はInGaNを含む。
好適な実施形態において、本発明に従ったマイクロLEDは、以下の層を含むことができ、以下に記載される段階的なプロセスを用いて製造される。
マイクロLEDのLED構造の以下の説明は、底から上方へ順に記載されるトップエミッションアーキテクチャに関するが、本発明はボトムエミッションアーキテクチャにも適用可能である。
(図2 基板及び多孔質化のためのIII族窒化物層)
エピタキシャル成長の開始表面として適合性のある基板を用いる。基板は、シリコン、サファイア、SiC、β-Ga2O3、GaN、ガラス、又は金属である。基板の結晶方位は、極性、半極性、又は無極性方位である。基板サイズは、1cm2から、直径2インチ、4インチ、6インチ、8インチ、12インチ、16インチ、及びそれ以上まで変動し得る。基板の厚さは1μmより大きく、例えば1μm~15000μmであり得る。好ましくは、基板は半導体ウェーハである。本発明の利点は、フルサイズの半導体ウェーハ上にマイクロLEDのアレイを同時に製造できることである。図示した例は2つのマイクロLEDを共有テンプレート上に形成することを示すが、同じ方法を用いて多数のマイクロLEDのアレイを同一ウェーハ上に製造することも可能である。
エピタキシャル成長の開始表面として適合性のある基板を用いる。基板は、シリコン、サファイア、SiC、β-Ga2O3、GaN、ガラス、又は金属である。基板の結晶方位は、極性、半極性、又は無極性方位である。基板サイズは、1cm2から、直径2インチ、4インチ、6インチ、8インチ、12インチ、16インチ、及びそれ以上まで変動し得る。基板の厚さは1μmより大きく、例えば1μm~15000μmであり得る。好ましくは、基板は半導体ウェーハである。本発明の利点は、フルサイズの半導体ウェーハ上にマイクロLEDのアレイを同時に製造できることである。図示した例は2つのマイクロLEDを共有テンプレート上に形成することを示すが、同じ方法を用いて多数のマイクロLEDのアレイを同一ウェーハ上に製造することも可能である。
基板上に、III族窒化物材料の1つの層又は複数の層のスタックをエピタキシャル成長させる。III族窒化物層は、元素Al、Ga、Inのうち1つ又はいくつかの組み合わせを含む(二元層、三元層、又は四元層)。
III族窒化物スタックの厚さTは、好ましくは、少なくとも10nm、又は少なくとも50nm、又は少なくとも100nm、例えば10~10000nm、好ましくは4000nmである。
III族窒化物層は、1×1017cm-3~5×1020cm-3のn型ドーピング濃度を有するドープ領域を含む。また、III族窒化物層は、ドープ領域の上にIII族窒化物材料の非ドープ層(図示せず)を含んでもよい。
ドープ領域はIII族窒化物層の露出上面で終わり、その場合、この層の表面は電気化学エッチングの間に多孔質化される。
好ましくは、III族窒化物材料のドープ領域は、III族窒化物材料の非ドープ中間層(又は「キャップ層」)で覆われており、そのためドープ領域は半導体構造の表面下にある。ドープ領域の表面下の開始深さ(d)は、例えば1~2000nmである。
図2から図19に示す例では、多孔質化されているIII族窒化物層は、高度ドープ層と非ドープ層の交互層からなるIII族窒化物層のスタックによって形成される。好ましくは、5~50のペアからなるドープ層と非ドープ層の交互層がスタックを形成し、高度ドープ層は約1×1020cm-3の電荷キャリア濃度を有し、非ドープ層は約1×1017cm-3の電荷キャリア濃度を有する。高度ドープ層の厚さは好ましくは10nm~200nmであり、非ドープ層の厚さは好ましくは5~180nmである。
(図3 多孔質層に対する多孔質化)
III族窒化物層スタックは、基板上に堆積された後、ウェーハスケール多孔質化プロセスによって多孔質化される。このプロセスは、国際特許出願PCT/GB2017/052895号(国際公開第2019/063957号として公開されている)及びPCT/GB2019/050213号(国際公開第2019/145728号として公開されている)に記載されている。このプロセス中に、III族窒化物スタックのドープ層は多孔質になり、III族窒化物材料の非ドープ領域は多孔質にならない。多孔質層の多孔度は、電気化学エッチングプロセスによって制御され、好ましくは10%~90%である。
III族窒化物層スタックは、基板上に堆積された後、ウェーハスケール多孔質化プロセスによって多孔質化される。このプロセスは、国際特許出願PCT/GB2017/052895号(国際公開第2019/063957号として公開されている)及びPCT/GB2019/050213号(国際公開第2019/145728号として公開されている)に記載されている。このプロセス中に、III族窒化物スタックのドープ層は多孔質になり、III族窒化物材料の非ドープ領域は多孔質にならない。多孔質層の多孔度は、電気化学エッチングプロセスによって制御され、好ましくは10%~90%である。
したがって、多孔質化ステップの後に、その構造体は多孔質層と非多孔質層の交互層からなるスタックを覆って非多孔質中間層を有する。多孔質層と非多孔質層の交互層からなるスタックは、上述のようにDBRを構成する。スタックの最上層は非多孔質であるので、この層は多孔質化されずに非多孔質中間層としてスタックのトップに維持される。
(図4 接続層)
図3で示されているように、多孔質化の後、ウェーハ上に接続層1を成長させる。接続層はnドープIII族窒化物層(好ましくはGaN)で、厚さが200~2000nmのであり(図3の層1)、n型電荷キャリア濃度は少なくとも1×1018cm-3より高い。
図3で示されているように、多孔質化の後、ウェーハ上に接続層1を成長させる。接続層はnドープIII族窒化物層(好ましくはGaN)で、厚さが200~2000nmのであり(図3の層1)、n型電荷キャリア濃度は少なくとも1×1018cm-3より高い。
接続層1はIII族窒化物材料で形成され、元素Al、Ga、Inのうち1つ又はいくつかの組み合わせを含む(二元層、三元層、又は四元層)。接続層は、例えばSi、Ge、C、O等の適切なn型ドーパント材料でドーピングされている。
(図5 マスク層)
次いで、ウェーハ表面上に電気絶縁マスク層2を接続層1を覆うように堆積する。マスク層2の目的は、次のステップでウェーハの特定領域をマスクとして保護することと、このテンプレートのトップで選択的エリアのエピタキシを可能とすることである。
次いで、ウェーハ表面上に電気絶縁マスク層2を接続層1を覆うように堆積する。マスク層2の目的は、次のステップでウェーハの特定領域をマスクとして保護することと、このテンプレートのトップで選択的エリアのエピタキシを可能とすることである。
このマスク層2は、SiO2、SiN、SiON、AlOx、又は他の適切な層である。この層の厚さは5~1000nmであり、好ましくは約500nmである。
この層を堆積するために用いられる方法として、PECVD、スパッタリング、ALD、蒸着、又はインサイチュMOCVD技術がある。
(図6 接続層の領域の露出)
標準的なリソグラフィ技術を用いて、非伝導性マスク層2に開口を生成する。開口は、湿式エッチング又は乾式エッチング法のいずれかを用いて生成することができる。
標準的なリソグラフィ技術を用いて、非伝導性マスク層2に開口を生成する。開口は、湿式エッチング又は乾式エッチング法のいずれかを用いて生成することができる。
特に好適な例では、誘導結合乾式エッチング(ICP-RIE)を用いて2つのエリアからSiO2を除去し、これによって、接続層1の表面上に、もはやマスク層2で覆われていない2つの露出領域を生成する。
露出領域の形状は、円形、方形、矩形、六角形、三角形等とすることができる。開口の幅又は直径は100μm未満であることが好ましい。そうすれば、露出エリア上に形成されるLED構造がマイクロLEDに分類できる。露出領域の幅は、好ましくは0.05μm~30μmであり、10μm以下が特に好ましい。
これらの露出領域は最終的にマイクロLED画素になる。
(図7及び図8 Nドープ領域)
接続層1の露出領域を形成した後、これらの露出領域にIII族窒化物材料のnドープ層3を堆積する。
接続層1の露出領域を形成した後、これらの露出領域にIII族窒化物材料のnドープ層3を堆積する。
図示されている特定の例では、MOCVDによって400nmの厚さのnドープGaN層(層3)を成長させる。この成長は、nドープ接続層1の表面上の露出領域内でのみ行われる。nドープ層3のドーパントとしてSiが用いられ、ドーピング濃度は少なくとも1×1019cm-3より高い。
nドープ層3の成長後、インジウムを含有するバルクIII族窒化物層4、又は、インジウムを含有するか含有しない薄いIII族窒化物層のスタック、又は、内部でインジウムの原子百分率が変動するバルクIII族窒化物層もしくはIII族窒化物層のスタックを成長させる。インジウム原子百分率は0.5%~25%で変動する。合計の厚さは2nm~200nmmまで変動する。スタックを用いる場合、スタック内の個々の層の厚さは1~40nmで変動する。層4は、1×1017cm-3~5×1020cm-3のnドーピング濃度を有する。
(図9 発光領域)
n型層4の成長後、発光領域5を成長させる。
n型層4の成長後、発光領域5を成長させる。
発光領域5は少なくとも1つの発光層を含む。各発光層は量子井戸(QW)であり、好ましくはInGaN量子井戸(QW)である。好ましくは、発光領域は1~7の量子井戸を含む。隣接する量子井戸は、量子井戸とは異なる組成を有するIII族窒化物材料のバリア層で分離される。
1又は複数の発光層は、本明細書全体を通して「量子井戸」と呼ぶが、種々の形態をとり得る。例えば、発光層はInGaNの連続層であり、又は、連続的な層、断片的な層、断続的な層、ギャップを含む層、または、ナノ構造であり量子井戸は量子ドットとして振る舞う複数の3Dナノ構造を効率的に含有する
量子井戸及びバリアは、600℃~800℃の温度範囲で成長させる。
各量子井戸は好ましくは、10~40%の原子インジウム百分率を有するInGaN層から成る。特定の例では、原子インジウム含有量は12~18%、好ましくは13%超、又は20~30%、好ましくは22%超、又は30~40%、好ましくは33%超である。
各量子井戸層の厚さは1.5~8nmであり、好ましくは1.5nm~6nm又は1.5nm~4nmである。
量子井戸は、薄い(0.5~3nm)III族窒化物QWキャッピング層で覆われていても覆われていなくてもよい。このキャッピング層は、元素Al、Ga、Inのうち1つ又はいくつかの組み合わせを含む(三元層、四元層)。
QWキャッピング層は、(存在する場合)QW成長の直後に追加される層であり、AlN、Al%が0.01%~99.9%のAlGaN、GaN、In%が0.01~30%のInGaNとすることができる。
発光層(量子井戸)を分離するIII族窒化物QWバリアは、元素Al、Ga、Inのうち1つ又はいくつかの組み合わせを含む(三元層、四元層)。
1又は複数のQWキャッピング層及びQWバリアは発光領域5の一部を形成するので、これらの層は図面において個別の参照番号で示されていない。
(図10 キャップ層及びEBL)
量子井戸の成長後、非ドープキャップ層6を成長させる。非ドープキャップ層4は、発光領域キャップ層と呼ぶことができる。というのは、この層は完全な発光領域の成長後に、例えばQW、QWキャップ層、及びQWバリア層のスタックの成長後に形成されるからである。
量子井戸の成長後、非ドープキャップ層6を成長させる。非ドープキャップ層4は、発光領域キャップ層と呼ぶことができる。というのは、この層は完全な発光領域の成長後に、例えばQW、QWキャップ層、及びQWバリア層のスタックの成長後に形成されるからである。
キャップ層(発光領域キャップ層)6は、III族窒化物LEDの成長スキームでは極めて良く知られている標準的な層である。
キャップ層の厚さは5~30nmであり、好ましくは5~25nm又は5~20nmである。
(電子ブロック層(EBL))
キャップ層6の後、アルミニウムを含有する電子ブロックIII族窒化物層7(EBL)を成長させる。EBLの厚さは10~100nmである。Al%は例えば5~25%であるが、より多くAlを含有することも可能である。
キャップ層6の後、アルミニウムを含有する電子ブロックIII族窒化物層7(EBL)を成長させる。EBLの厚さは10~100nmである。Al%は例えば5~25%であるが、より多くAlを含有することも可能である。
EBLには適切なp型ドーピング材料がドーピングされている。ドーピング濃度は5×1018cm-3~8×1020cm-3とすることができる。
(図11 pドープ層)
pドープ層8は、電子ブロック層(EBL)7の上方に成長させる。
pドープ層8は、電子ブロック層(EBL)7の上方に成長させる。
p型領域は好ましくはMgがドープされ、p型層のp型ドーピング濃度は、好ましくは5×1018cm-3~8×1020cm-3である。
pドープIII族窒化物層はIn及びGaを含む。
ドーピング層は、好ましくは20~200nmの厚さであり、特に好ましくは50~100nmの厚さである。ドーピング濃度はp型層内で変動するが、より良好なp接触を可能とするため、p型層のLED表面に近い方の最後の10~30nmの部分にドーピングレベルのスパイクを有し得る。
pドープ層内のMgアクセプタを活性化するため、MOCVD反応器内またはアニーリングオーブンにおいて構造体をアニーリングすることができる。アニーリング温度は、N2又はN2/O2雰囲気で700~850Cの範囲である。
EBL及びpドープ層の双方がp型ドープされているので、これらの層をpドープ領域と呼ぶことができる。
(図12 パッシベーション層)
次のステップは、1つのパッシベーション層9又は複数のパッシベーション層の組み合わせを堆積するものである。開始パッシベーション層はAl2O3(10~100nm)(原子層堆積によって堆積される)であり、その後、スパッタ又はプラズマ強化化学気相堆積によりSiO2、SiN、又はSiON(50~300nm)を堆積させる。
次のステップは、1つのパッシベーション層9又は複数のパッシベーション層の組み合わせを堆積するものである。開始パッシベーション層はAl2O3(10~100nm)(原子層堆積によって堆積される)であり、その後、スパッタ又はプラズマ強化化学気相堆積によりSiO2、SiN、又はSiON(50~300nm)を堆積させる。
Al2O3は50~150Cで堆積し、SiO2、SiN、及びSiONは250~350Cで堆積させる。スパッタプロセスは室温で実施することができる。
特に好適な例では、パッシベーション層9は30nm厚さのAl2O3層及び200nm厚さのSiO2層で構成されている。
(図13 パッシベーション層の開口)
次のステップは、誘電層に開口を生成してp-GaN及びn-GaNを露出させることである。これは、湿式エッチング、乾式エッチング、又はそれら双方の組み合わせによって実行できる。湿式エッチング緩衝酸化物エッチングでは、希釈フッ化水素酸、リン酸、又はこれらの混合物を使用することができる。
次のステップは、誘電層に開口を生成してp-GaN及びn-GaNを露出させることである。これは、湿式エッチング、乾式エッチング、又はそれら双方の組み合わせによって実行できる。湿式エッチング緩衝酸化物エッチングでは、希釈フッ化水素酸、リン酸、又はこれらの混合物を使用することができる。
図面に示されているトポロジーでは、2つの別個のリソグラフィステップを用い、pドープ層及びnドープ層にオーミック接触を形成する。
図13は、パッシベーション層9に開口を生成してp型層8の領域を露出させることを示す。
(図14 透明導電層)
次いで、p型層8の露出領域を透明導電層10で覆う。透明導電層は、Ni/Au、インジウムスズ酸化物、インジウム亜鉛酸化物、グラフェン、Pd、Rh、銀、ZnO等、又はこれらの材料の組み合わせで作製することができる。
次いで、p型層8の露出領域を透明導電層10で覆う。透明導電層は、Ni/Au、インジウムスズ酸化物、インジウム亜鉛酸化物、グラフェン、Pd、Rh、銀、ZnO等、又はこれらの材料の組み合わせで作製することができる。
透明導電層の厚さは典型的に10~250nmである。
透明導電層は当技術分野では周知であり、任意の適切な材料及び厚さを用いればよい。
p接触をオーミックにするため、アニーリングステップが必要となる場合がある。
(図15 第2の露出領域)
次のステップは、nドープ接続層1の第2の露出領域を露出させるために、開口を生成することで、これにより、接続層1に対する電気接触を可能とすることができる。これは、パッシベーション層9及びマスク層2の一部を除去することで行われる。これは、湿式エッチング、乾式エッチング、又は両者の組み合わせにより実行できる。
次のステップは、nドープ接続層1の第2の露出領域を露出させるために、開口を生成することで、これにより、接続層1に対する電気接触を可能とすることができる。これは、パッシベーション層9及びマスク層2の一部を除去することで行われる。これは、湿式エッチング、乾式エッチング、又は両者の組み合わせにより実行できる。
(図16 n接触)
nドープ接続層1の第2の露出領域上に金属n接触11を堆積する。この金属接触は、チタン、白金、及び金の組み合わせとすることができる。
nドープ接続層1の第2の露出領域上に金属n接触11を堆積する。この金属接触は、チタン、白金、及び金の組み合わせとすることができる。
(図17 p接触)
最終ステップでは、ITOの一部分のみを金属p接触点12で覆う。これは、図17で示されているように、p側から光が抽出されるトポロジーで用いられる。
最終ステップでは、ITOの一部分のみを金属p接触点12で覆う。これは、図17で示されているように、p側から光が抽出されるトポロジーで用いられる。
この金属接触は、ニッケル、チタン、白金、及び金の組み合わせとすることができる。
(マイクロLED 具体例)
上述のステップに従って、本発明によるマイクロLEDの特定の好適な例を製造することができる。例示的なマイクロLED構造体の層の詳細は以下の通りである。
上述のステップに従って、本発明によるマイクロLEDの特定の好適な例を製造することができる。例示的なマイクロLED構造体の層の詳細は以下の通りである。
基板:直径4インチの平面サファイア基板で、1μm未満の厚さの非ドープGaNバッファ層を有する。
多孔質スタック:非ドープGaN層(厚さ45nm)とSiドープn+GaN層(厚さ62.5nm)の15ペアの交互層からなるスタックで、1×1019cm-3より大きい電荷キャリア濃度を有し、電気化学的に多孔質化されていて、nドープ層が多孔質で非ドープ層(スタックの最上層を含む)が非多孔質である。
接続層1(非多孔質/多孔質テンプレートのトップに成長させた層):nドープGaN層で、厚さ500nm、Siがドープされて電荷キャリア濃度が5×1018cm-3より大きい。
マスク層2:PECVDによって堆積された、厚さ500nmのSiO2層。
露出領域:誘導結合ドライエッチング(ICP-RIE)を用い、指定エリアからSiO2を除去し、直径10μmの円形露出領域を露出させた。
nドープ層3:厚さ400nmのnドープGaN(Siドーパント)層であり、MOCVDで成長させ、ドーピング濃度が少なくとも1×1019cm-3より高い。
n型層4:原子インジウム含有量が5%未満の層のスタックで、合計スタック厚が120nm、ドーピング濃度の中央値が1×1018cm-3である。
発光領域5:5つのInGaN量子井戸(インジウム含有量は17.5at%)であって、PL発光波長が440~465nmであり、バリア層としてのGaNを有し、キャップ層はない。
キャップ層6:GaNで厚さ20nm。
EBL7:15%Alを含有するAlGaNで、厚さは60nm。
p型ドープ層8:p型GaN層で、厚さ50nm、Mgがドープされてp型電荷キャリア濃度が1×1019cm-3より大きい層、及び、その後のp++GaN層で、厚さ6nm、Mgがドープされてp型電荷キャリア濃度が1×1020cm-3より大きい層。
パッシベーション層9:厚さ30nmのAl2O3層と厚さ200nmのSiO2層。
透明導電層10:厚さ150nmのITO。
nドープ層に対する金属接触11:50nmのTi、100nmのPt、及び500nmのAu。
p型層に対する金属接触12:2nmのNi、50nmのTi、100nmのPt、及び500nmのAu。
図2から図17に図示されているマイクロLEDは、440~465nmの発光波長を有し、デバイスのp側(図示のようにマイクロLEDのトップ)から発光するように設計されている。多孔質/非多孔質層のスタックは、約450nmで90%より高い反射率/透過率を示すDBRを形成するので、DBRはマイクロLEDのもとで射出光の輝度を増大する反射ミラーとして作用する。発光領域における発光波長及びDBRで反射される波長は、他の色のLEDを得るため望ましいように調整される。
(図19 底側トポロジー)
図19は、光が底側(基板側)から抽出される代替的なマイクロLEDトポロジーを示す。
図19は、光が底側(基板側)から抽出される代替的なマイクロLEDトポロジーを示す。
多孔質/非多孔質層のスタックは、例えば440~465nmの波長範囲内で反射率が90%より大きいDBRを形成するために用いることができる。
例示的な実施形態において、QWは520~540nmの発光波長を有するように選択される。また、図2から図17に関連付けて記述した製造ステップは、この実施形態にも使用されるが、n型下層3及び発光領域5は所望の出力波長に合わせて適切に調整される点は異なる。
この底側発光トポロジーは以下の利点を提供する。
-DBRを介してデバイスから純粋な緑色光が伝送され、520nm未満の他の波長はDBR設計により遮断され反射される。
-製造中に画素の側壁に対する損傷がないので、マイクロ画素の性能劣化が生じない。
-DBRを介してデバイスから純粋な緑色光が伝送され、520nm未満の他の波長はDBR設計により遮断され反射される。
-製造中に画素の側壁に対する損傷がないので、マイクロ画素の性能劣化が生じない。
(好適な実施形態)
図19から図25は、本発明の好適な実施形態によるマイクロLEDの製造方法を示す。
図19から図25は、本発明の好適な実施形態によるマイクロLEDの製造方法を示す。
図19 多孔質化技術を用いて基板上にDBRを形成し、多孔質化DBRのトップにはn-GaNの層を堆積する。多孔質化技術は、ケンブリッジエンタープライズの係属中の特許出願PCT/GB2017/052895号に述べられている。
図20 n-GaNのトップ表面上にSiO2層(又は別の誘電材料)を堆積する。
図21 SiO2をリソグラフィによってパターニングし、横方向寸法が50μm×50μmのSIO2部分を湿式化学エッチング又は乾式エッチングプロセスで除去する。
図22 n-GaNの露出部分上に、GaN、AlN、AlGaN、AlInGaN、InAlNの量子バリアで囲まれ、InGaN、AlGaN、InN、InAlN、AlInGaNのうち1つから作製された量子井戸を堆積する。QWの上にp-GaNの層を堆積する。
図23 SiO2の第1の層のトップにSiO2の第2の層を堆積して、SiO2がQW及びp-GaN層のエッジを覆うようにする。p-GaNの上に、p-GaN層と電気的に接触するように電気p接触を形成する。この第2のSiO2層はパッシベーション層である。
図24 SiO2の一部を湿式化学エッチング又は乾式エッチングプロセスで除去して、n-GaN層の一部を露出させる。露出部分に、n-GaNと電気的に接触するように電気n接触を堆積する。
図25 SiO2の第2の層を既知の技術によって不動態化する。チップの個別化と移送のため、プラズマエッチを用いる。
Claims (32)
- マイクロLEDの製造方法であって、
III族窒化物材料の多孔質領域の上にIII族窒化物材料のnドープ接続層を形成するステップと、
前記nドープ接続層上に電気絶縁マスク層を形成するステップと、
前記マスクの一部を除去して前記nドープ接続層の露出領域を露出させるステップと、
前記nドープ接続層の前記露出領域上にLED構造を形成するステップと、
を含む方法。 - 前記LED構造を形成する前記ステップは、前記nドープ接続層の前記露出領域上に、
nドープ部分と、
pドープ部分と、
前記nドープ部分と前記pドープ部分との間に配置された発光領域と、
を形成することを含む、請求項1に記載の方法。 - III族窒化物材料の前記多孔質領域を形成するため、III族窒化物材料の領域を電気化学的に多孔質化する前記第1のステップを含む、請求項1又は2に記載の方法。
- III族窒化物材料の前記多孔質領域を、電気化学的多孔質化によって、III族窒化物材料の非多孔質層を通して形成し、これにより、前記多孔質領域と前記nドープIII族窒化物接続層との間に、III族窒化物材料の前記非多孔質中間層を形成するステップを含む、請求項1、2、又は3に記載の方法。
- 前記非多孔質中間層の厚さは1nm~3000nmであり、好ましくは5nm~2000nmである、請求項4に記載の方法。
- III族窒化物材料の前記nドープ接続層は、III族窒化物材料の複数の多孔質層のスタックの上に形成されている、先行する請求項のいずれか一項に記載の方法。
- 前記多孔質層のスタックは、多孔質分布ブラッグ反射器(DBR)を含み、このため前記方法は、III族窒化物材料の多孔質DBRの上にIII族窒化物材料のnドープ接続層を形成するステップを含む、請求項6に記載の方法。
- 前記多孔質層のスタックは、多孔質層と非多孔質層の交互層からなるスタックであり、好ましくは、前記スタックは多孔質層と非多孔質層の5~50のペアを含む、請求項6又は7に記載の方法。
- 前記多孔質層の厚さは10nm~200nmであり、前記非多孔質層の厚さは5nm~180nmである、請求項8に記載の方法。
- 前記多孔質領域又は各多孔質層は10%~90%多孔度の多孔質である、先行する請求項のいずれか一項に記載の方法。
- III族窒化物材料の前記nドープ接続層の厚さは200nm~2000nmであり、電荷キャリア濃度は1×1018cm-3より大きい、先行する請求項のいずれか一項に記載の方法。
- 前記マスク層は、SiO2、SiN、SiON、AlOxのうち1つから形成される、先行する請求項のいずれか一項に記載の方法。
- 前記マスク層の厚さは、5nm~1000nm、好ましくは200nm~800nm、特に好ましくは400nm~600nmである、先行する請求項のいずれか一項に記載の方法。
- 前記マスク層は、PECVD、スパッタリング、ALD、蒸着、又はインサイチュMOCVDによって堆積される、先行する請求項のいずれか一項に記載の方法。
- 前記マスク層の一部を除去する前記ステップは、湿式エッチング又は乾式エッチング、例えば誘導結合乾式エッチング(ICP-RIE)を含む、先行する請求項のいずれか一項に記載の方法。
- 前記接続層の前記露出領域は、円形、方形、矩形、六角形、又は三角形の形状である、先行する請求項のいずれか一項に記載の方法。
- 前記露出領域の幅は、0.05μm~100μm、好ましくは0.05μm~30μm、特に好ましくは10μm未満、例えば0.1μm~10μm又は0.5μm~10μmである、先行する請求項のいずれか一項に記載の方法。
- 前記nドープ部分、前記発光領域、及び前記pドープ部分を形成した後に、前記マスクの第2の部分を除去して前記nドープ接続層の第2の露出領域を露出させるステップと、
前記nドープ接続層の前記第2の露出領域に電気接触を形成するステップと、
を含む、先行する請求項のいずれか一項に記載の方法。 - マイクロLEDのアレイの製造方法であって、
III族窒化物材料の多孔質領域の上にIII族窒化物材料のnドープ接続層を形成するステップと、
前記nドープIII族窒化物層上に電気絶縁マスク層を形成するステップと、
前記マスクの一部を除去して前記nドープ接続層の露出領域のアレイを露出させるステップと、
前記nドープ接続層の各露出領域上にLED構造を形成するステップと、
を含む、方法。 - マイクロLEDであって、
III族窒化物材料の多孔質領域の上のIII族窒化物材料のnドープ接続層と、
前記nドープIII族窒化物層上の電気絶縁マスク層と、
LED構造と、
を備え、前記LED構造の少なくとも一部分は前記電気絶縁マスク層内のギャップを貫通し、前記nドープ接続層と接触している、マイクロLED。 - 前記LED構造は、
nドープ部分と、
pドープ部分と、
前記nドープ部分と前記pドープ部分との間に配置された発光領域と、
を含む、請求項20に記載のマイクロLED。 - 前記多孔質領域と前記接続層との間に配置されたIII族窒化物材料の非多孔質中間層を含む、請求項20又は21に記載のマイクロLED。
- 前記nドープ部分はnドープIII族窒化物層を含み、好ましくは前記nドープ部分は、n-GaN、又はn-InGaN、又はn-GaN/n-InGaN層の交互層からなるスタック、又は異なるインジウム濃度を含有するn-InGaN/n-InGaN層の交互層からなるスタックを含む、請求項21又は22に記載のマイクロLED。
- 前記発光領域は1つ以上のIII族窒化物発光層を含み、前記発光層又は各発光層は、量子井戸、又は、量子ドット、断片的または不連続的な量子井戸のような量子構造を含むナノ構造層を含む、請求項21から23のいずれか一項に記載のマイクロLED。
- 前記発光層又は各発光層はIII族窒化物材料を含み、その原子インジウム含有量は10~40%又は12~18%、好ましくは13%超、又は20~30%、好ましくは22%超、又は30~40%、好ましくは33%超である、請求項24に記載のマイクロLED。
- 前記1つ以上の発光層は組成InxGa1-xNを有し、0.10≦x≦0.40であり、好ましくは0.20≦x≦0.40又は0.22≦x≦0.40であり、特に好ましくは0.30≦x≦0.40である、請求項24又は25に記載のマイクロLED。
- 前記発光領域は、1つ以上のInGaN量子井戸、好ましくは1~7の量子井戸を含む、請求項21から26のいずれか一項に記載のマイクロLED。
- 前記LEDは、前記量子井戸と前記pドープ部分との間にIII族窒化物材料のキャップ層を含み、好ましくは、前記キャップ層はドープされておらず、5nm~30nmの厚さを有する、請求項21から27のいずれか一項に記載のマイクロLED。
- 前記pドープ部分は、pドープIII族窒化物層と、前記pドープIII族窒化物層と前記発光領域との間に配置されたpドープアルミニウムガリウム窒化物層と、を含む、請求項21から28のいずれか一項に記載のマイクロLED。
- 前記pドープアルミニウム窒化物層は前記キャップ層と前記p型層との間の電子ブロック層(EBL)であり、前記電子ブロック層は5~25at%のアルミニウムを含有し、好ましくは前記電子ブロック層の厚さは10nm~100nmである、請求項29に記載のマイクロLED。
- 基板上に形成された、請求項21から30のいずれか一項に記載されたマイクロLEDを複数備えるマイクロLEDのアレイ。
- マイクロLEDのアレイであって、
III族窒化物材料の多孔質領域の上のIII族窒化物材料のnドープ接続層と、
前記nドープIII族窒化物層上の電気絶縁マスク層と、
前記電気絶縁マスク層内の複数のギャップと、
複数のLED構造と、
を備え、各LED構造の少なくとも一部分は電気絶縁マスク層内のギャップを貫通し、前記nドープ接続層と接触している、マイクロLEDのアレイ。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
GB2000951.0 | 2020-01-22 | ||
GBGB2000951.0A GB202000951D0 (en) | 2020-01-22 | 2020-01-22 | Semiconductor device and method of manufacture |
PCT/GB2021/050147 WO2021148803A1 (en) | 2020-01-22 | 2021-01-22 | Micro-led and manufacturing method thereof |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2023510976A true JP2023510976A (ja) | 2023-03-15 |
Family
ID=69636868
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2022544132A Pending JP2023510976A (ja) | 2020-01-22 | 2021-01-22 | マイクロled及びその製造方法 |
Country Status (7)
Country | Link |
---|---|
US (1) | US20230048093A1 (ja) |
EP (1) | EP4094290A1 (ja) |
JP (1) | JP2023510976A (ja) |
KR (1) | KR20220140748A (ja) |
CN (1) | CN115244690A (ja) |
GB (1) | GB202000951D0 (ja) |
WO (1) | WO2021148803A1 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7367743B2 (ja) * | 2021-10-18 | 2023-10-24 | 信越半導体株式会社 | 接合型半導体ウェーハの製造方法 |
GB2612040A (en) * | 2021-10-19 | 2023-04-26 | Iqe Plc | Porous distributed Bragg reflector apparatuses, systems, and methods |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR102425935B1 (ko) * | 2014-09-30 | 2022-07-27 | 예일 유니버시티 | GaN 수직 마이크로캐비티 표면 방출 레이저(VCSEL)를 위한 방법 |
KR102467783B1 (ko) | 2017-09-27 | 2022-11-16 | 캠브리지 엔터프라이즈 리미티드 | 재료를 다공화하기 위한 방법 및 반도체 구조체 |
US11005004B2 (en) * | 2017-10-20 | 2021-05-11 | Korea Advanced Institute Of Science And Technology | Micro light emitting diode (LED) structure, method for manufacturing the same and display including the same |
GB201801337D0 (en) | 2018-01-26 | 2018-03-14 | Cambridge Entpr Ltd | Method for etching a semiconductor structure |
-
2020
- 2020-01-22 GB GBGB2000951.0A patent/GB202000951D0/en not_active Ceased
-
2021
- 2021-01-22 EP EP21702080.9A patent/EP4094290A1/en active Pending
- 2021-01-22 JP JP2022544132A patent/JP2023510976A/ja active Pending
- 2021-01-22 KR KR1020227028491A patent/KR20220140748A/ko active Search and Examination
- 2021-01-22 WO PCT/GB2021/050147 patent/WO2021148803A1/en unknown
- 2021-01-22 CN CN202180019209.0A patent/CN115244690A/zh active Pending
- 2021-01-22 US US17/759,250 patent/US20230048093A1/en active Pending
Also Published As
Publication number | Publication date |
---|---|
EP4094290A1 (en) | 2022-11-30 |
WO2021148803A1 (en) | 2021-07-29 |
KR20220140748A (ko) | 2022-10-18 |
CN115244690A (zh) | 2022-10-25 |
GB202000951D0 (en) | 2020-03-04 |
US20230048093A1 (en) | 2023-02-16 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
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