JP2022516846A - アフィン線形加重イントラ予測モードのための簡易シグナリング方法 - Google Patents
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Abstract
Description
本願は、米国仮特許出願番号第62/829,439号、「SIMPLIFIED SIGNALING METHOD FOR AFFINE LINEAR WEIGHTED INTRA PREDICTION MODE」、2019年4月4日出願、の優先権の利益を主張する米国特許出願番号第16/822,985号、「SIMPLIFIED SIGNALING METHOD FOR AFFINE LINEAR WEIGHTED INTRA PREDICTION MODE」、2020年3月18日出願の優先権の利益を主張する。前述の出願の全開示は、それらの全体が参照によりここに組み込まれる。
本開示は、概して、ビデオ符号化に関連する実施形態を記載する。
ALWIP (or LWIP): Affine Linear Weighted Intra Prediction
AMVP: Advanced Motion Vector Prediction
ASIC: Application-Specific Integrated Circuit
ATMVP: Alternative/Advanced Temporal Motion Vector Prediction
BMS: Benchmark Set
BV: Block Vector
CANBus: Controller Area Network Bus
CB: Coding Block
CD: Compact Disc
CPR: Current Picture Referencing
CPUs: Central Processing Units
CRT: Cathode Ray Tube
CTBs: Coding Tree Blocks
CTUs: Coding Tree Units
CU: Coding Unit
DM: Derived Mode
DPB: Decoder Picture Buffer
DVD: Digital Video Disc
FPGA: Field Programmable Gate Areas
GOPs: Groups of Pictures
GPUs: Graphics Processing Units
GSM: Global System for Mobile communications
HDR: High Dynamic Range
HEVC: High Efficiency Video Coding
HRD: Hypothetical Reference Decoder
IBC: Intra Block Copy
IC: Integrated Circuit
ISP: Intra Sub-Partition
JEM: Joint Exploration Model
JVET: Joint Video Exploration Team
LAN: Local Area Network
LCD: Liquid-Crystal Display
LTE: Long-Term Evolution
MIP: Matrix-based Intra Prediction
MPM: Most Probable Mode
MV: Motion Vector
OLED: Organic Light-Emitting Diode
PBs: Prediction Blocks
PCI: Peripheral Component Interconnect
PDPC: Position Dependent Prediction Combination
PLD: Programmable Logic Device
PU: Prediction Unit
RAM: Random Access Memory
ROM: Read-Only Memory
SCC: Screen Content Coding
SDR: Standard Dynamic Range
SEI: Supplementary Enhancement Information
SNR: Signal Noise Ratio
SSD: Solid-state Drive
TUs: Transform Units
USB: Universal Serial Bus
VUI: Video Usability Information
VVC: Versatile Video Coding
WAIP: Wide-Angle Intra Prediction
Claims (19)
- デコーダが実行するビデオ復号の方法であって、
符号化ビデオシーケンスの一部である現在ピクチャ内の現在ブロックの予測情報を復号するステップであって、前記予測情報は、前記現在ブロックがマトリクスに基づくイントラ予測(MIP)で符号化されるかどうかを示す、ステップと、
前記予測情報が、前記現在ブロックはMIPで符号化されると示すことに応答して、MIPモードインデックスを決定するステップであって、前記MIPモードインデックスは、複数のMIPモードのうちの1つを示す、ステップと、
前記現在ブロックを再構成するステップであって、前記予測情報が、前記現在ブロックはMIPモードで符号化されることを示すとき、前記複数のMWIPモードのうちの前記1つに従い前記現在ブロックを再構成するステップと、
を含む方法。 - 前記予測情報が、前記現在ブロックはMIPで符号化されないことを示し、複数の近隣ブロックのうちの1つがMIPで符号化されることに応答して、前記現在ブロックのイントラ予測候補モードが平面イントラ予測モードであることを決定するステップ、を更に含み、
前記現在ブロックを再構成するステップは、前記予測情報が、前記現在ブロックはMIPで符号化されないことを示し、前記複数の近隣ブロックのうちの前記1つがMIPで符号化されるとき、前記平面イントラ予測モードに従い、前記現在ブロックを再構成する、請求項1に記載の方法。 - 前記MIPモードインデックスは、トランケートされたバイナリコードワード、固定長コードワード、及びトランケートされた単項コードワード、のうちの1つである、請求項1又は2に記載の方法。
- 前記予測情報が、前記現在ブロックはMIPで符号化されると示すことに応答して、
少なくとも1つの固定モード候補を含むモード候補リストを構成するステップであって、前記少なくとも1つの固定モード候補は、前記複数のMIPモードのうちの所定の部分集合である、ステップ、を更に含む請求項1~3のいずれか一項に記載の方法。 - 前記複数のMIPモードの合計数は、2のべき乗である、請求項1~4のいずれか一項に記載の方法。
- 前記予測情報が、前記現在ブロックはMWIPで符号化されないと示し、複数の近隣ブロックのうちの1つがMIPで符号化されることに応答して、
(i)プリセットイントラ予測モード、及び(ii)前記近隣ブロックのうち別の近隣ブロックのイントラ予測モード、のうちの1つに基づき、モード候補リストを構成するステップであって、前記モード候補リストは、前記平面イントラ予測モードを含む、ステップ、
を更に含む請求項2~5のいずれか一項に記載の方法。 - 前記プリセットイントラ予測モードは、平面イントラ予測モード、DCIイントラ予測モード、水平イントラ予測モード、及び垂直イントラ予測モード、のうちの1つである、請求項6に記載の方法。
- 前記構成するステップは、
前記複数の近隣ブロックのうちの前記1つを利用不可能として設定するステップ、
を更に含む請求項6又は7に記載の方法。 - 前記予測情報が、前記現在ブロックはMIPで符号化されると示し、導出されたモードが前記現在ブロックの関連するクロマブロックのために使用されることに応答して、
前記関連するクロマブロックの予測モードを、プリセットイントラ予測モードになるよう設定するステップ、
を更に含む請求項1~8のいずれか一項に記載の方法。 - デコーダが実行するビデオ復号の方法であって、
符号化ビデオシーケンスの一部である現在ピクチャ内の現在ブロックの予測情報を復号するステップであって、前記予測情報は、前記現在ブロックがマトリクスに基づくイントラ予測(MIP)で符号化されることを示す、ステップと、
前記現在ブロックに隣接する近隣ブロックがMIPで符号化されるかどうかを決定するステップと、
前記近隣ブロックがMIPで符号化されないことに応答して、
(i)プリセットMIPモード、及び(ii)別の近隣ブロックのMIPモード、のうちの1つに基づき、モード候補リストを構成するステップと、
前記モード候補リストに基づき、前記現在ブロックを再構成するステップと、
を含む方法。 - 前記構成するステップは、
前記近隣ブロックがMIPで符号化されないことに応答して、
前記近隣ブロックを利用不可能として設定するステップ、
を更に含む請求項10に記載の方法。 - 前記近隣ブロックは、前記現在ブロックの右上角又は左下角に隣接する、請求項10又は11に記載の方法。
- 前記モード候補リストのサイズは、前記符号化ビデオシーケンスに含まれる前記近隣ブロックの符号化情報に基づく、請求項10~12のいずれか一項に記載の方法。
- 前記予測情報は、前記現在ブロックのクロマブロックが複数のルマブロックに関連付けられることを示し、前記方法は、
前記複数のルマブロックのうちのルマブロックが非MIPイントラ予測モードで符号化されるかどうかを決定するステップと、
前記ルマブロックが前記非MIPイントラ予測モードで符号化されることに応答して、
前記現在ブロックの前記クロマブロックの予測モードが前記ルマブロックの前記非MIPイントラ予測モードであると決定するステップと、
を更に含む請求項10~13のいずれか一項に記載の方法。 - 前記複数のルマブロックの各々がMIPで符号化されることに応答して、
前記現在ブロックの前記クロマブロックの前記予測モードがプリセットイントラ予測モードであると決定するステップ、
を更に含む請求項14に記載の方法。 - 機器であって、プロセッサとメモリとを含み、前記プロセッサが前記メモリに記憶されたプログラムをロードし実行することにより、請求項1~9のいずれか一項に記載の方法を実現する機器。
- 機器であって、プロセッサとメモリとを含み、前記プロセッサが前記メモリに記憶されたプログラムをロードし実行することにより、請求項10~15のいずれか一項に記載の方法を実現する機器。
- コンピュータプログラムであって、機器により実行されると、前記機器に請求項1~9のいずれか一項に記載の方法を実行させる、コンピュータプログラム。
- コンピュータプログラムであって、機器により実行されると、前記機器に請求項10~15のいずれか一項に記載の方法を実行させる、コンピュータプログラム。
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