JP2020530684A - 短い持続時間内のアップリンク制御情報(uci) - Google Patents
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Abstract
Description
本出願は、2017年8月11日に出願された米国出願第62/544,750号の優先権および利益を主張する、2018年8月6日に出願された米国出願第16/056,073号の優先権を主張するものである。前述の出願は、その全体が参照により本明細書に組み込まれている。
図1は、本開示の態様が実行され得る、ニューラジオ(NR)または5Gネットワークなどの、例示的なワイヤレスネットワーク100を示す。たとえば、UE120は、図9で説明する動作900ならびに図15で説明する動作1500を実行し得る。
UEとBSとの間の干渉する送信を示す。
ロングタームエボリューション(LTE)規格など、いくつかのワイヤレス通信規格に準拠するモバイル通信システムでは、いくつかの技法が、データ送信の信頼性を高めるために使用され得る。たとえば、基地局が特定のデータチャネルに対する初期送信動作を実行した後、送信を受信する受信機は、データチャネルの間に受信機がデータチャネルに対する巡回冗長検査(CRC)を実行する、そのデータチャネルを復調することを試みる。その検査の結果として、初期送信が正常に復調される場合、受信機は、正常な復調に肯定応答するために肯定応答(ACK)を基地局に送り得る。しかしながら、初期送信が正常に復調されない場合、受信機は、否定応答(NACK)を基地局に送り得る。ACK/NACKを送信するチャネルは、応答チャネルまたはACKチャネルと呼ばれる。
上述のように、ULSB領域(たとえば、ULSB808)は、1つまたは2つのシンボルであり得、異なる手法が、この持続時間内にUCIを送信するために使用され得る。たとえば、「1シンボル」UCI設計によれば、3ビット以上のUCIが、周波数分割多重化(FDM)を使用して送られ得る。1ビットもしくは2ビットのACK(それは、確認応答または確認応答の欠如を示し得る)および/または1ビットのスケジューリング要求(SR)に対して、ビットシーケンスベースの設計が使用され得る。たとえば、SRは、1つのビットシーケンス、オンオフキーイングを用いて送られてもよく、RB当たり最大12ユーザまでを多重化し得る。1ビットACKに対して、2つのビットシーケンスが使用されてもよく、RB当たり最大6ユーザまでが多重化され得る。2ビットACKに対して、4つのビットシーケンスが使用されてもよく、RB当たり最大3ユーザまでが多重化され得る。
Y=50、SRおよびACKに均等な電力分割、
Y=33.3、SRに1/3とACKに2/3とでビット当たりに同じ電力をもたらす、
Y=0、SRをなくす、または
Y=100、ACKをなくす。
102a マクロセル
102b マクロセル
102c マクロセル
102x ピコセル
102y フェムトセル
102z フェムトセル
110 基地局(BS)
110a BS
110b BS
110c BS、マクロBS
110r 中継局
110x BS
110y BS
110z BS
120 UE、ユーザ機器、ユーザ端末
120r UE
120x UE
120y UE
130 ネットワークコントローラ
200 分散型無線アクセスネットワーク(RAN)、ローカルアーキテクチャ、アーキテクチャ
202 アクセスノードコントローラ(ANC)
204 次世代コアネットワーク(NG-CN)
206 5Gアクセスノード
208 TRP、DU
210 次世代AN(NG-AN)
300 分散型RAN
302 集中型コアネットワークユニット(C-CU)
304 集中型RANユニット(C-RU)
306 DU
412 データソース
420 プロセッサ、送信プロセッサ
430 TX MIMOプロセッサ
432 変調器、BS変調器/復調器
432a〜432t 変調器(MOD)
434 アンテナ
434a〜434t アンテナ
436 MIMO検出器
438 プロセッサ、受信プロセッサ
439 データシンク
440 コントローラ/プロセッサ、プロセッサ
442 メモリ
444 スケジューラ
452 アンテナ
452a〜452r アンテナ
454 復調器
454a〜454r 復調器(DEMOD)
456 MIMO検出器
458 プロセッサ、受信プロセッサ
462 データソース
464 プロセッサ、送信プロセッサ
466 プロセッサ、TX MIMOプロセッサ
480 コントローラ/プロセッサ、プロセッサ
500 図
505-a 第1のオプション
505-b 第2のオプション
510 無線リソース制御(RRC)レイヤ
515 パケットデータコンバージェンスプロトコル(PDCP)レイヤ
520 無線リンク制御(RLC)レイヤ
525 媒体アクセス制御(MAC)レイヤ
530 物理(PHY)レイヤ
600 図
604 DLデータ部分
606 共通UL部分
700 図
702 制御部分
704 ULデータ部分
706 共通UL部分
800 送信時間間隔(TTI)
802 物理ダウンリンク制御チャネル(PDCCH)
804 ギャップ
806 領域、ULロングバースト、ULLB
808 ULショートバースト(ULSB)
8081 ULSBシンボル
8082 ULSBシンボル
820 TTI
900 動作
900A ワイヤレス通信デバイス
909 プロセッサ
911 コンピュータ可読媒体/メモリ
912 トランシーバ
913 アンテナ
914 処理システム
920 識別構成要素
921 バス
922 送信構成要素
1010 半静的SRリソース、半静的リソース
1012 動的SRリソース
1014 ACKリソース
1016 リソース
1030 スロット
1102A RB
1102A1〜1102A4 ビットシーケンス
1102B RB
1102B1〜1102B4 ビットシーケンス
1104 RB、元のSR RB
1104A RB
1104A1 ビットシーケンス
1104A2 ビットシーケンス
1104A3 ビットシーケンス
1104A4 ビットシーケンス
1104B RB
1104B1 ビットシーケンス
1106 RB
11061〜11064 ビットシーケンス
1302 RB
1304 RB
1402A RB
1402B RB
1404A RB
1404B RB
1406 RB
1500 動作
1500A ワイヤレス通信デバイス
1509 プロセッサ
1511 コンピュータ可読媒体/メモリ
1512 トランシーバ
1513 アンテナ
1514 処理システム
1520 識別構成要素
1521 バス
1522 送り側構成要素
1602 共通領域
1602A 共通領域
1602B 共通領域
1604 追加の領域
1606 ホッピング位置
1700A シンボル
1700B シンボル
1702A 領域
1702B 領域
1704B 領域
Claims (60)
- 送信機によるワイヤレス通信のための方法であって、
アップリンク制御情報(UCI)の少なくとも一部分を送信するために、送信時間間隔(TTI)内にアップリンクショートバースト(ULSB)領域内のリソースを識別するステップであって、前記UCIは、1つのスケジューリング要求(SR)ビット、およびダウンリンク送信に肯定応答または否定応答するための1つまたは複数の確認応答(ACK)ビットのうちの少なくとも1つを含む、ステップと、
前記識別されたリソースを使用して前記UCIを送信するステップと
を含む、方法。 - 前記識別するステップが、
前記SRビットおよび前記1つまたは複数のACKビットを送信するために前記ULSB領域内の第1のリソースブロック(RB)を識別するステップ、または
前記1つまたは複数のACKビットなしに前記SRビットを送信するために第2のRBを識別するステップ
を含む、請求項1に記載の方法。 - 前記第1のRBが、前記SRビットの値に基づいて識別される、請求項2に記載の方法。
- 前記SRビットの前記値が、負または正のSRに対応する、請求項3に記載の方法。
- 前記第1のリソースブロック(RB)を前記識別するステップが、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの1つのACKビットおよび第1の値を有する前記SRビットを伝達するために使用するための2つのビットシーケンスの少なくとも1つの第1のセットを識別するステップと、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの前記1つのACKビットおよび第2の値を有する前記SRビットを伝達するために使用するための2つのビットシーケンスの少なくとも1つの第2のセットを識別するステップと
をさらに含む、請求項2に記載の方法。 - 前記第1のリソースブロック(RB)を前記識別するステップが、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの2つのACKビットおよび第1の値を有する前記SRビットを伝達するために使用するための4つのビットシーケンスの少なくとも1つの第1のセットを識別するステップと、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの前記2つのACKビットおよび第2の値を有する前記SRビットを伝達するために使用するための4つのビットシーケンスの少なくとも1つの第2のセットを識別するステップと
をさらに含む、請求項2に記載の方法。 - 前記第2のRBが、送信されるべきACKビットがないときに識別され、前記SRビットの値が正のSRに対するものである、請求項2に記載の方法。
- 前記識別するステップが、
前記SRビットの送信用に半静的に構成された前記ULSB領域内の第1のシンボルを識別するステップと、
前記1つまたは複数のACKビットのうちの少なくとも1つのACKビットの送信用に前記第1のシンボルを使用するステップと
を含む、請求項1に記載の方法。 - 前記SRビットの送信用に第2のシンボルを使用するステップをさらに含み、前記第2のシンボルは、前記ULSB領域、前記TTIのアップリンクロングバースト(ULLB)領域、または後続のTTIのうちの1つに位置する、請求項8に記載の方法。
- 前記識別するステップが、
前記SRビットが第1の値である場合、前記SRビットを送信するために前記ULSB領域内の第1のリソースブロック(RB)を識別するステップ、または
前記SRビットが第2の値である場合、前記SRビットを送信するために前記ULSB領域内の第2のRBを識別するステップ
を含む、請求項1に記載の方法。 - 前記SRビットの前記第1の値が正のSRに対するものであり、前記SRビットの前記第2の値が負のSRに対するものである、請求項10に記載の方法。
- 前記識別するステップが、
前記第1のRBまたは前記第2のRBを使用して前記SRビットを送信するとき、少なくとも2つのACKビットを伝達するために使用するための少なくとも4つのビットシーケンスを識別するステップを含む、請求項10に記載の方法。 - 前記識別するステップが、前記第1の値である前記SRビットに対する前記第1のRBを使用してACKビットなしに前記SRビットを送信するために前記4つのビットシーケンスのうちの少なくとも1つを識別するステップをさらに含む、請求項12に記載の方法。
- 前記識別するステップが、
ACKビットなしに前記SRビットを送信するために1つのRB内で1つのビットシーケンスを識別するステップを含むか、または
前記1つまたは複数のACKビットのうちの少なくとも2つのACKビットとともに前記SRビットを送信するために少なくとも2つのRBを識別するステップと、
前記少なくとも2つのRBのうちの1つを使用して前記SRビットを送信するとき、前記1つまたは複数のACKビットのうちの前記少なくとも2つのACKビットを伝達するために使用するための少なくとも4つのビットシーケンスを識別するステップと
を含む、請求項10に記載の方法。 - 前記SRビットおよび前記1つまたは複数のACKビットが、周波数分割多重化(FDM)を使用して同じシンボル内で送信される、請求項1に記載の方法。
- 前記SRビットおよび前記1つまたは複数のACKビットが、隣接するRB内で送信される、請求項15に記載の方法。
- 前記SRビットと前記1つまたは複数のACKビットとの間で電力を分割するステップをさらに含む、請求項15に記載の方法。
- 前記SRビットおよび前記1つまたは複数のACKビットは、電力ヘッドルーム(PHR)がしきい値より高い場合にのみ、FDMを使用して前記同じシンボル内で送信される、請求項15に記載の方法。
- 前記SRビットおよび前記1つまたは複数のACKビットは、電力ヘッドルーム(PHR)がしきい値より低い場合に、単一ビットにバンドルされた前記1つまたは複数のACKビットを有するACKリソース内の前記同じシンボルで送信される、請求項15に記載の方法。
- 前記識別するステップが、
前記1つまたは複数のACKビットのうちの第1のACKビットに対して使用される前記ULSB領域内の第1のリソースブロック(RB)を、前記第1のACKビットが第1の値である場合、識別するステップ、または
前記第1のACKビットが第2の値である場合、前記第1のACKビットに対して使用される前記ULSB領域内の第2のRBを識別するステップを含む、請求項1に記載の方法。 - 前記識別するステップが、
前記第1のRBまたは前記第2のRBを使用してSRを送信するとき、前記1つまたは複数のACKビットのうちの少なくとも2つのACKビットを伝達するために使用するための少なくとも4つのビットシーケンスを識別するステップを含む、請求項20に記載の方法。 - 前記識別するステップが、
ACKビットなしに前記SRビットを送信するために1つのRBを識別するステップ、または
前記1つまたは複数のACKビットのうちの少なくとも前記第1のACKビットとともに前記SRビットを送信するために少なくとも2つのRBを識別するステップ
を含む、請求項20に記載の方法。 - ユーザ機器(UE)によるワイヤレス通信のための方法であって、
送信時間間隔(TTI)内に共通のアップリンク領域に時間的に隣接した、前記UEによるアップリンク送信に対して動的に利用可能な、拡張されたリソースを識別するステップと、
前記拡張されたリソースを使用してアップリンク送信を送るステップと
を含む、方法。 - 前記拡張されたリソースが、
前記共通のアップリンク領域の前に発生するリソース、または
前記共通のアップリンク領域の後に発生するリソース
のうちの少なくとも1つを含む、請求項23に記載の方法。 - 前記拡張されたリソースの異なる持続時間が、前記UEを含む異なるUEに利用可能である、請求項23に記載の方法。
- 前記共通のアップリンク領域が、符号分割多重化(CDM)グループを使用してUE間で共有され、
前記拡張されたリソースが、符号分割多重化(CDM)グループを使用して前記UE間で共有される、請求項23に記載の方法。 - 前記共通のアップリンク領域の前記CDMグループと前記拡張されたリソースとが時間的に重複しない、請求項26に記載の方法。
- 前記拡張されたリソースが、前記共通のアップリンク領域に基づいて計算されたホッピング位置を使用して識別される、請求項23に記載の方法。
- 実行可能命令を記録した非一時的メモリと、
前記非一時的メモリとデータ通信しているプロセッサと
を備え、前記プロセッサが、前記実行可能命令を実行することによって、
アップリンク制御情報(UCI)の少なくとも一部分を送信するために、送信時間間隔(TTI)内にアップリンクショートバースト(ULSB)領域内のリソースを識別することであって、前記UCIは、1つのスケジューリング要求(SR)ビット、およびダウンリンク送信に肯定応答または否定応答するための1つまたは複数の確認応答(ACK)ビットのうちの少なくとも1つを含む、識別することと、
前記識別されたリソースを使用して前記UCIを送信することと
を行うように構成される、装置。 - 前記リソースを識別するように構成された前記プロセッサが、
前記SRビットおよび前記1つまたは複数のACKビットを送信するために前記ULSB領域内の第1のリソースブロック(RB)を識別すること、または
前記1つまたは複数のACKビットなしに前記SRビットを送信するために第2のRBを識別すること
を行うようにさらに構成される、請求項29に記載の装置。 - 前記第1のRBが、前記SRビットの値に基づいて識別される、請求項30に記載の装置。
- 前記SRビットの前記値が、負または正のSRに対応する、請求項31に記載の装置。
- 前記第1のRBを識別するように構成された前記プロセッサが、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの1つのACKビットおよび第1の値を有する前記SRビットを伝達するために使用するための2つのビットシーケンスの少なくとも1つの第1のセットを識別することと、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの前記1つのACKビットおよび第2の値を有する前記SRビットを伝達するために使用するための2つのビットシーケンスの少なくとも1つの第2のセットを識別することと
を行うようにさらに構成される、請求項30に記載の装置。 - 前記第1のRBを識別するように構成された前記プロセッサが、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの2つのACKビットおよび第1の値を有する前記SRビットを伝達するために使用するための4つのビットシーケンスの少なくとも1つの第1のセットを識別することと、
前記第1のRBを使用して、前記1つまたは複数のACKビットのうちの前記2つのACKビットおよび第2の値を有する前記SRビットを伝達するために使用するための4つのビットシーケンスの少なくとも1つの第2のセットを識別することと
を行うようにさらに構成される、請求項30に記載の装置。 - 前記第2のRBが、送信されるべきACKビットがないときに識別され、前記SRビットの値が正のSRに対するものである、請求項30に記載の装置。
- 前記リソースを識別するように構成された前記プロセッサが、
前記SRビットの送信用に半静的に構成された前記ULSB領域内の第1のシンボルを識別することと、
前記1つまたは複数のACKビットのうちの少なくとも1つのACKビットの送信用に前記第1のシンボルを使用することと
を行うようにさらに構成される、請求項29に記載の装置。 - 前記プロセッサが、
前記SRビットの送信用に第2のシンボルを使用するようにさらに構成され、前記第2のシンボルは、前記ULSB領域、前記TTIのアップリンクロングバースト(ULLB)領域、または後続のTTIのうちの1つの中に配置される、請求項36に記載の装置。 - 前記リソースを識別するように構成された前記プロセッサが、
前記SRビットが第1の値である場合、前記SRビットを送信するために前記ULSB領域内の第1のリソースブロック(RB)を識別すること、または
前記SRビットが第2の値である場合、前記SRビットを送信するために前記ULSB領域内の第2のRBを識別すること
を行うようにさらに構成される、請求項29に記載の装置。 - 前記SRビットの前記第1の値が正のSRに対するものであり、前記SRビットの前記第2の値が負のSRに対するものである、請求項38に記載の装置。
- 前記リソースを識別するように構成された前記プロセッサが、
前記第1のRBまたは前記第2のRBを使用して前記SRビットを送信するとき、少なくとも2つのACKビットを伝達するために使用するための少なくとも4つのビットシーケンスを識別するようにさらに構成される、請求項38に記載の装置。 - 前記リソースを識別するように構成された前記プロセッサが、
前記第1の値である前記SRビットに対する前記第1のRBを使用して、ACKビットなしに前記SRビットを送信するために前記4つのビットシーケンスのうちの少なくとも1つを識別するようにさらに構成される、請求項40に記載の装置。 - 前記リソースを識別するように構成された前記プロセッサが、
ACKビットなしに前記SRビットを送信するために1つのRB内で1つのビットシーケンスを識別することを行うようにさらに構成されるか、または
前記1つまたは複数のACKビットのうちの少なくとも2つのACKビットとともに前記SRビットを送信するために少なくとも2つのRBを識別することと、
前記少なくとも2つのRBのうちの1つを使用して前記SRビットを送信するとき、前記1つまたは複数のACKビットのうちの前記少なくとも2つのACKビットを伝達するために使用するための少なくとも4つのビットシーケンスを識別することと
を行うようにさらに構成される、請求項38に記載の装置。 - 前記SRビットおよび前記1つまたは複数のACKビットが、周波数分割多重化(FDM)を使用して同じシンボル内で送信される、請求項29に記載の装置。
- 前記SRビットおよび前記1つまたは複数のACKビットが、隣接するRB内で送信される、請求項43に記載の装置。
- 前記プロセッサが、
前記SRビットと前記1つまたは複数のACKビットとの間で電力を分割するようにさらに構成される、請求項43に記載の装置。 - 前記SRビットおよび前記1つまたは複数のACKビットは、電力ヘッドルーム(PHR)がしきい値より高い場合にのみ、FDMを使用して前記同じシンボル内で送信される、請求項43に記載の装置。
- 前記SRビットおよび前記1つまたは複数のACKビットは、電力ヘッドルーム(PHR)がしきい値より低い場合に、単一ビットにバンドルされた前記1つまたは複数のACKビットを有するACKリソース内の前記同じシンボルで送信される、請求項43に記載の装置。
- 前記リソースを識別するように構成された前記プロセッサが、
前記1つまたは複数のACKビットのうちの第1のACKビットに対して使用される前記ULSB領域内の第1のリソースブロック(RB)を、前記第1のACKビットが第1の値である場合、識別すること、または
前記第1のACKビットが第2の値である場合、前記第1のACKビットに対して使用される前記ULSB領域内の第2のRBを識別すること
を行うようにさらに構成される、請求項29に記載の装置。 - 前記リソースを識別するように構成された前記プロセッサが、
前記第1のRBまたは前記第2のRBを使用してSRを送信するとき、前記1つまたは複数のACKビットのうちの少なくとも2つのACKビットを伝達するために使用するための少なくとも4つのビットシーケンスを識別するようにさらに構成される、請求項48に記載の装置。 - 前記リソースを識別するように構成された前記プロセッサが、
ACKビットなしに前記SRビットを送信するために1つのRBを識別すること、または
前記1つまたは複数のACKビットのうちの少なくとも前記第1のACKビットとともに前記SRビットを送信するために少なくとも2つのRBを識別すること
を行うようにさらに構成される、請求項48に記載の装置。 - 装置であって、
実行可能命令を記録した非一時的メモリと、
前記非一時的メモリとデータ通信しているプロセッサと
を備え、前記プロセッサが、前記実行可能命令を実行することによって、
送信時間間隔(TTI)内に共通のアップリンク領域に時間的に隣接した、前記装置によるアップリンク送信に対して動的に利用可能な、拡張されたリソースを識別することと、
前記拡張されたリソースを使用してアップリンク送信を送ることと
を行うように構成される、装置。 - 前記拡張されたリソースが、
前記共通のアップリンク領域の前に発生するリソース、または
前記共通のアップリンク領域の後に発生するリソース
のうちの少なくとも1つを含む、請求項51に記載の装置。 - 前記拡張されたリソースの異なる持続時間が、異なる装置に利用可能である、請求項51に記載の装置。
- 前記共通のアップリンク領域が、符号分割多重化(CDM)グループを使用してUE間で共有され、
前記拡張されたリソースが、符号分割多重化(CDM)グループを使用して前記UE間で共有される、請求項51に記載の装置。 - 前記共通のアップリンク領域の前記CDMグループと前記拡張されたリソースとが時間的に重複しない、請求項54に記載の装置。
- 前記拡張されたリソースが、前記共通のアップリンク領域に基づいて計算されたホッピング位置を使用して識別される、請求項51に記載の装置。
- アップリンク制御情報(UCI)の少なくとも一部分を送信するために、送信時間間隔(TTI)内にアップリンクショートバースト(ULSB)領域内のリソースを識別するための手段であって、前記UCIは、1つのスケジューリング要求(SR)ビット、およびダウンリンク送信に肯定応答または否定応答するための1つまたは複数の確認応答(ACK)ビットのうちの少なくとも1つを含む、手段と、
前記識別されたリソースを使用して前記UCIを送信するための手段と
を含む、装置。 - 方法を実行するための命令を記憶した非一時的コンピュータ可読記録媒体であって、前記方法は、
アップリンク制御情報(UCI)の少なくとも一部分を送信するために、送信時間間隔(TTI)内にアップリンクショートバースト(ULSB)領域内のリソースを識別するステップであって、前記UCIは、1つのスケジューリング要求(SR)ビット、およびダウンリンク送信に肯定応答または否定応答するための1つまたは複数の確認応答(ACK)ビットのうちの少なくとも1つを含む、ステップと、
前記識別されたリソースを使用して前記UCIを送信するステップと
を含む、非一時的コンピュータ可読記録媒体。 - 装置であって、
送信時間間隔(TTI)内に共通のアップリンク領域に時間的に隣接した、前記装置によるアップリンク送信に対して動的に利用可能な、拡張されたリソースを識別するための手段と、
前記拡張されたリソースを使用してアップリンク送信を送るための手段と
を含む、装置。 - 方法を実行するための命令を記憶した非一時的コンピュータ可読記録媒体であって、前記方法は、
送信時間間隔(TTI)内に共通のアップリンク領域に時間的に隣接した、UEによるアップリンク送信に対して動的に利用可能な、拡張されたリソースを識別するステップと、
前記拡張されたリソースを使用してアップリンク送信を送るステップと
を含む、非一時的コンピュータ可読記録媒体。
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