JP2020184059A - 回路装置、電子機器及び移動体 - Google Patents
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Abstract
Description
図1は、本実施形態の回路装置100の第1構成例である。図2は、第1構成例における回路装置100の動作を説明する図である。
図5は、回路装置100の第2構成例である。図6は、第2構成例における回路装置100の動作を説明する図である。
第3構成例では、回路装置100は、表示画像の歪み補正に加えて回転補正を行う。まず、図7を用いて、ヘッドアップディスプレイの取り付け公差と回転補正との関係を説明する。なお図7ではヘッドアップディスプレイが自動車のダッシュボードに設置される場合を例に説明するが、ヘッドアップディスプレイの設置場所はこれに限定されない。また図7ではヘッドアップディスプレイの表示部DSPを平面で示しているが、実際には曲面ディスプレイである。
図10は、回路装置100の第4構成例である。図11は、第4構成例における回路装置100の動作を説明する図である。
図12は、回路装置100の第5構成例である。第5構成例では、回路装置100は画像IMG2を逆マッピング処理することで画像IMG3を生成し、画像IMG1と画像IMG3とを比較することで画像IMG2のエラーを検出する。
図18は、本実施形態の回路装置を含む電子機器の構成例である。電子機器300は、処理装置310、回路装置320、記憶装置350、操作装置360、通信装置370、ヘッドアップディスプレイ400を含む。回路装置320は第1〜第5構成例の回路装置100に対応する。ヘッドアップディスプレイ400は、表示ドライバー330、表示パネル340を含む。処理装置310は、例えばMCU等である。図18の構成例では回路装置320は表示コントローラーに対応する。但し、本実施形態の回路装置100は、表示コントローラーだけでなく、ヘッドアップディスプレイ用の表示画像を生成する回路装置であれば適用可能である。
Claims (16)
- 入力座標から出力座標への座標変換を行う座標変換回路と、
入力される第1画像に対して、前記出力座標に基づくマッピング処理を行うことで、曲面ディスプレイに画像を表示するための表示パネルに表示される第2画像を生成するマッピング処理回路と、
を含み、
前記座標変換回路は、
前記座標変換を表す2次以上の多項式を用いた演算処理を行うことで、前記座標変換を行うことを特徴とする回路装置。 - 請求項1に記載の回路装置において、
前記座標変換回路は、
前記多項式の係数情報と前記入力座標とが入力され、前記係数情報に基づく前記演算処理により前記入力座標から前記出力座標を求めることを特徴とする回路装置。 - 請求項2に記載の回路装置において、
前記座標変換回路は、
第i項演算回路が、前記係数情報に基づいて前記多項式の第1〜第n項の第i項を演算する第1〜第n項演算回路(nは2以上の整数、iは1以上n以下の整数)と、
前記第1〜第n項演算回路が出力する前記第1〜第n項を加算し、前記出力座標を出力する加算回路と、
を有することを特徴とする回路装置。 - 請求項2に記載の回路装置において、
前記座標変換回路は、
前記入力座標を(x,y)としたとき、x2、y2、及びxyを求める第1演算回路と、
前記第1演算回路の演算結果と前記係数情報とに基づいて前記出力座標を求める第2演算回路と、
を含むことを特徴とする回路装置。 - 請求項4に記載の回路装置において、
前記多項式は、第1〜第6項として、a1×x2、a2×y2、a3×xy、a4×x、a5×y、及びa6を含み、
前記係数情報は、前記第1〜第6係数として、a1、a2、a3、a4、a5、及びa6の情報を含み、
前記第2演算回路は、
前記a1と前記x2を乗算する第1項演算回路と、
前記a2と前記y2を乗算する第2項演算回路と、
前記a3と前記xyを乗算する第3項演算回路と、
前記a4と前記xを乗算する第4項演算回路と、
前記a5と前記yを乗算する第5項演算回路と、
前記第1〜第5演算回路が出力する前記第1〜第5項、及び前記第6項であるa6を加算し、前記出力座標を出力する加算回路と、
を含むことを特徴とする回路装置。 - 請求項1乃至5のいずれか一項に記載の回路装置において、
画素クロックに基づく画素単位の座標である第1カウント座標を出力する第1座標カウンターを含み、
前記座標変換回路は、
前記第1カウント座標を前記入力座標として前記座標変換を行うことを特徴とする回路装置。 - 請求項6に記載の回路装置において、
前記入力座標は、前記第1画像及び前記第2画像の一方の画像上の座標に対応した座標であり、
前記出力座標は、前記第1画像及び前記第2画像の他方の画像上の座標に対応した座標であることを特徴とする回路装置。 - 請求項6に記載の回路装置において、
前記マッピング処理回路は、
前記画素クロックに基づく画素単位の座標である第2カウント座標を出力する第2座標カウンターと、
前記第1画像を記憶する画像メモリーと、
前記画像メモリーのアクセス制御を行うメモリー制御回路と、
を含み、
前記メモリー制御回路は、
前記第2カウント座標に基づいて前記第1画像を前記画像メモリーに書き込み、前記出力座標に基づいて前記画像メモリーから読み出した画素値を、前記第2画像の前記第1カウント座標における画素値として出力することで、前記マッピング処理を行う、又は、
前記第1画像の前記第1カウント座標における画素値を前記出力座標における画素値として前記画像メモリーに書き込み、前記第2カウント座標に基づいて前記画像メモリーから読み出した画素値を、前記第2画像の前記第2カウント座標における画素値として出力することで、前記マッピング処理を行うことを特徴とする回路装置。 - 請求項1乃至5のいずれか一項に記載の回路装置において、
座標の回転変換を行い、回転後座標を出力する回転変換回路を含み、
前記座標変換回路は、
前記回転後座標を前記入力座標として前記座標変換を行うことを特徴とする回路装置。 - 請求項9に記載の回路装置において、
画素クロックに基づく画素単位の座標である第1カウント座標を出力する第1座標カウンターを含み、
前記回転変換回路は、
前記第1カウント座標に対して前記回転変換を行うことで、前記回転後座標を求めることを特徴とする回路装置。 - 請求項10に記載の回路装置において、
前記第1カウント座標は、前記第1画像及び前記第2画像の一方の画像上の座標を指定する座標であり、
前記出力座標は、前記第1画像及び前記第2画像の他方の画像上の座標を指定する座標であることを特徴とする回路装置。 - 請求項10に記載の回路装置において、
前記マッピング処理回路は、
前記画素クロックに基づく画素単位の座標である第2カウント座標を出力する第2座標カウンターと、
前記第1画像を記憶する画像メモリーと、
前記画像メモリーのアクセス制御を行うメモリー制御回路と、
を含み、
前記メモリー制御回路は、
前記第2カウント座標に基づいて前記第1画像を前記画像メモリーに書き込み、前記出力座標に基づいて前記画像メモリーから読み出した画素値を、前記第2画像の前記第1カウント座標における画素値として出力することで、前記マッピング処理を行う、又は、
前記第1画像の前記第1カウント座標における画素値を前記出力座標における画素値として前記画像メモリーに書き込み、前記第2カウント座標に基づいて前記画像メモリーから読み出した画素値を、前記第2画像の前記第2カウント座標における画素値として出力することで、前記マッピング処理を行うことを特徴とする回路装置。 - 請求項1乃至12のいずれか一項に記載の回路装置において、
前記多項式は、a1×x2+a2×y2+a3×xy+a4×x+a5×y+a6であることを特徴とする回路装置。 - 請求項1乃至13のいずれか一項に記載の回路装置において、
前記マッピング処理の逆マッピング処理である第2マッピング処理を前記第2画像に対して行うことで、第3画像を生成する第2マッピング処理回路と、
前記第1画像と前記第3画像との比較を行い、前記比較の結果を、前記第2画像のエラー検出を行うための情報として出力する比較回路と、
を含むことを特徴とする回路装置。 - 請求項1乃至14のいずれか一項に記載の回路装置を含むことを特徴とする電子機器。
- 請求項1乃至14のいずれか一項に記載の回路装置を含むことを特徴とする移動体。
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