JP2020155470A - Method for manufacturing nitride semiconductor device - Google Patents

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Abstract

To provide a technique for forming a p-type region in a nitride semiconductor.SOLUTION: A method for manufacturing a nitride semiconductor device includes: a step of forming, on a part of a nitride semiconductor substrate, an n-type region containing an n-type impurity at a first concentration; an impurity introduction step of introducing a p-type impurity from an exposed surface of the nitride semiconductor substrate into a specific region other than the n-type region, the specific region containing an n-type impurity with a concentration lower than the first concentration and the specific region being in contact with the n-type region; and a diffusion step of selectively thermally diffusing the p-type impurity into the specific region without diffusing an n-type impurity in the n-type region. In the diffusion step, diffusion of the p-type impurity at an interface between the n-type region and the specific region is stopped so that the p-type impurity is not diffused to the inside of the n-type region.SELECTED DRAWING: Figure 2

Description

本明細書に開示する技術は、窒化物半導体装置の製造方法に関する。 The techniques disclosed herein relate to methods of manufacturing nitride semiconductor devices.

特許文献1には、窒化物半導体装置のp型領域を形成する技術が開示されている。 Patent Document 1 discloses a technique for forming a p-type region of a nitride semiconductor device.

特開平5−183189号公報Japanese Unexamined Patent Publication No. 5-183189

熱拡散によってp型領域を形成する場合には、p型不純物の拡散プロファイルの制御性がイオン注入法に比して低いため、p型領域の深さや幅を高精度に位置決めすることが困難である。 When a p-type region is formed by thermal diffusion, the controllability of the diffusion profile of p-type impurities is lower than that of the ion implantation method, so it is difficult to accurately position the depth and width of the p-type region. is there.

本明細書に開示する窒化物半導体装置の製造方法の一実施形態は、窒化物半導体基板の一部にn型不純物を第1濃度で含んだn型領域を形成する工程を備える。窒化物半導体基板の露出面からn型領域以外の特定領域にp型不純物を導入する不純物導入工程を備える。特定領域に含まれるn型不純物の濃度は第1濃度よりも低い。特定領域はn型領域に接している。n型領域中のn型不純物を拡散させずにp型不純物を選択的に特定領域内に熱拡散させる拡散工程を備える。拡散工程では、n型領域と特定領域との境界面でp型不純物の拡散を停止させることでp型不純物をn型領域の内部へ拡散させない。 One embodiment of the method for manufacturing a nitride semiconductor device disclosed in the present specification includes a step of forming an n-type region containing an n-type impurity at a first concentration in a part of a nitride semiconductor substrate. It is provided with an impurity introduction step of introducing p-type impurities into a specific region other than the n-type region from the exposed surface of the nitride semiconductor substrate. The concentration of n-type impurities contained in the specific region is lower than the first concentration. The specific region is in contact with the n-type region. A diffusion step is provided in which p-type impurities are selectively thermally diffused into a specific region without diffusing the n-type impurities in the n-type region. In the diffusion step, the diffusion of p-type impurities is stopped at the interface between the n-type region and the specific region, so that the p-type impurities are not diffused into the n-type region.

n型領域と特定領域との境界面でp型不純物の拡散を停止させることで、p型不純物をn型領域の内部へ拡散させないことができる。また、n型領域中のn型不純物を拡散させないことで、n型領域と特定領域との境界面の形状を維持することができる。すなわち、n型領域を、p型不純物の拡散をストップする領域として機能させることができる。p型領域の深さや幅を高精度に位置決めすることが可能となる。 By stopping the diffusion of p-type impurities at the interface between the n-type region and the specific region, it is possible to prevent the p-type impurities from diffusing into the n-type region. Further, by not diffusing the n-type impurities in the n-type region, the shape of the interface between the n-type region and the specific region can be maintained. That is, the n-type region can function as a region for stopping the diffusion of p-type impurities. It is possible to position the depth and width of the p-shaped region with high accuracy.

拡散工程では、p型不純物の拡散プロファイルと水素の拡散プロファイルとの少なくとも一部が同一形状となってもよい。効果の詳細は実施例で説明する。 In the diffusion step, at least a part of the diffusion profile of the p-type impurity and the diffusion profile of hydrogen may have the same shape. Details of the effect will be described in Examples.

p型不純物の拡散プロファイルと水素の拡散プロファイルとが同一形状となる領域において、p型不純物の濃度と水素の濃度が同一となってもよい。効果の詳細は実施例で説明する。 In a region where the diffusion profile of the p-type impurity and the diffusion profile of hydrogen have the same shape, the concentration of the p-type impurity and the concentration of hydrogen may be the same. Details of the effect will be described in Examples.

拡散工程は、チャンバ内に水素を存在させた状態で行われてもよい。効果の詳細は実施例で説明する。 The diffusion step may be carried out in the presence of hydrogen in the chamber. Details of the effect will be described in Examples.

拡散工程は、窒化物半導体基板の飽和蒸気圧近傍の高圧下で行われてもよい。効果の詳細は実施例で説明する。 The diffusion step may be performed under a high pressure near the saturated vapor pressure of the nitride semiconductor substrate. Details of the effect will be described in Examples.

p型不純物を導入する工程はイオン注入によって行われてもよい。 The step of introducing the p-type impurity may be performed by ion implantation.

p型不純物を導入する工程は固相拡散によって行われてもよい。 The step of introducing the p-type impurity may be carried out by solid phase diffusion.

p型不純物の熱拡散前の状態を示すSIMS分析結果およびGaN基板の断面概略図である。It is the SIMS analysis result which shows the state before thermal diffusion of a p-type impurity, and is the sectional schematic view of a GaN substrate. p型不純物の熱拡散後の状態を示すSIMS分析結果およびGaN基板の断面概略図である。It is the SIMS analysis result which shows the state after thermal diffusion of a p-type impurity, and is the sectional schematic view of a GaN substrate. 窒化物半導体装置の製造方法のフローチャートである。It is a flowchart of the manufacturing method of a nitride semiconductor apparatus. 窒化物半導体装置の製造工程を示す図である。It is a figure which shows the manufacturing process of a nitride semiconductor apparatus. 窒化物半導体装置の製造工程を示す図である。It is a figure which shows the manufacturing process of a nitride semiconductor apparatus. 窒化物半導体装置の製造工程を示す図である。It is a figure which shows the manufacturing process of a nitride semiconductor apparatus. 窒化物半導体装置の製造工程を示す図である。It is a figure which shows the manufacturing process of a nitride semiconductor apparatus.

(n型領域によるp型不純物の拡散停止機能)
本発明者らは、窒化物半導体において、p型不純物の拡散をストップする領域としてn型領域を機能させることができることを見出した。ここで「n型領域」とは、「n型領域」と比してn型不純物濃度が高い領域のことである。以下に説明する。本実施例では、窒化物半導体として窒化ガリウム(GaN)、II族元素のp型不純物としてマグネシウム(Mg)、n型不純物としてシリコン(Si)を用いている。
(Diffusion stop function of p-type impurities by n + type region)
The present inventors have found that in a nitride semiconductor, the n + type region can function as a region for stopping the diffusion of p-type impurities. Here, the "n + type region" is a region in which the concentration of n-type impurities is higher than that of the "n - type region". This will be described below. In this embodiment, gallium nitride (GaN) is used as the nitride semiconductor, magnesium (Mg) is used as the p-type impurity of the group II element, and silicon (Si) is used as the n-type impurity.

図1はp型不純物の熱拡散前の状態を示し、図2はp型不純物の熱拡散後の状態を示している。図1(A)は、二次イオン質量分析(SIMS)法を用いた、各元素の深さ方向の濃度プロファイルである。図1(A)の縦軸はMg、水素(H)、Siの各元素の濃度である。横軸は、n型GaN層103の表面103aからの深さである。図1(B)は、図1(A)対応する構造を図解したものである。図1(B)に示すように、GaN基板100は、n型基板101、n型GaN層102、n型GaN層103を備えている。n型GaN層102のSi濃度は、8×1018(cm−3)以上である。n型GaN層103のSi濃度は、3×1016(cm−3)程度である。n型GaN層103のSi濃度は、n型GaN層102のSi濃度よりも二桁以上低い。n型GaN層102のSi濃度の決め方については、後述する。n型GaN層102およびn型GaN層103は、n型基板101上にエピタキシャル成長した層である。n型GaN層103とn型GaN層102との界面IF1の、表面103aからの深さD1は、約1900nmである。n型GaN層102とn型基板101との界面IF2の、表面103aからの深さD2は、約2200nmである。 FIG. 1 shows a state before thermal diffusion of p-type impurities, and FIG. 2 shows a state after thermal diffusion of p-type impurities. FIG. 1 (A) is a concentration profile in the depth direction of each element using the secondary ion mass spectrometry (SIMS) method. The vertical axis of FIG. 1 (A) is the concentration of each element of Mg, hydrogen (H), and Si. The horizontal axis is the depth of the n - type GaN layer 103 from the surface 103a. FIG. 1 (B) illustrates the structure corresponding to FIG. 1 (A). As shown in FIG. 1B, the GaN substrate 100 includes an n-type substrate 101, an n + -type GaN layer 102, and an n - type GaN layer 103. The Si concentration of the n + type GaN layer 102 is 8 × 10 18 (cm -3 ) or more. The Si concentration of the n - type GaN layer 103 is about 3 × 10 16 (cm -3 ). The Si concentration of the n type GaN layer 103 is two orders of magnitude or more lower than the Si concentration of the n + type GaN layer 102. The method of determining the Si concentration of the n + type GaN layer 102 will be described later. The n + type GaN layer 102 and the n type GaN layer 103 are layers epitaxially grown on the n-type substrate 101. n - -type GaN layer 103 and the n + -type GaN layer 102 of the interface IF1 and the depth D1 from the surface 103a is about 1900 nm. The depth D2 of the interface IF2 between the n + type GaN layer 102 and the n-type substrate 101 from the surface 103a is about 2200 nm.

図1(B)に示すように、n型GaN層103の表面103aには、Mgがイオン注入されている。図1(B)では、注入されたMgをバツ印で示している。注入エネルギーは、注入深さが300nmとなるように設定した。また注入量は、1×1019(cm−3)とした。その結果、Mg濃度プロファイルP11は、表面103aから300nm程度の領域R11にピークが存在し、その濃度は1×1019(cm−3)である。なお図1(B)では、Si濃度プロファイルP12は、n型GaN層103しか取得していない。従って、n型GaN層102中のSi濃度は、図1(B)には表れていない。 As shown in FIG. 1 (B), Mg is ion-implanted on the surface 103a of the n - type GaN layer 103. In FIG. 1B, the injected Mg is indicated by a cross. The injection energy was set so that the injection depth was 300 nm. The injection volume was 1 × 10 19 (cm -3 ). As a result, the Mg concentration profile P11 has a peak in the region R11 from the surface 103a to about 300 nm, and the concentration is 1 × 10 19 (cm -3 ). In FIG. 1B, only the n - type GaN layer 103 is acquired as the Si concentration profile P12. Therefore, the Si concentration in the n + type GaN layer 102 does not appear in FIG. 1 (B).

図2は、図1のGaN基板100のアニール後の状態を示している。図2の内容は、図1と同様であるため、説明を省略する。本実施例では、GaNの飽和蒸気圧近傍の高圧下で、不活性雰囲気中(例:N雰囲気中)でGaN基板100をアニールした。具体的には、1480℃、1000MPa、15分間の条件でアニールした。GaNの飽和蒸気圧近傍の高圧下でアニールすることにより、表面103aから窒素が抜けてしまうことを抑制することができる。n型GaN層103の結晶性を良好に保つことが可能となる。 FIG. 2 shows the state of the GaN substrate 100 of FIG. 1 after annealing. Since the content of FIG. 2 is the same as that of FIG. 1, the description thereof will be omitted. In this embodiment, under high pressure GaN saturated vapor圧近near, in an inert atmosphere: annealing the GaN substrate 100 in (Example N 2 atmosphere). Specifically, it was annealed under the conditions of 1480 ° C., 1000 MPa, and 15 minutes. By annealing under a high pressure near the saturated vapor pressure of GaN, it is possible to suppress the escape of nitrogen from the surface 103a. It is possible to maintain good crystallinity of the n - type GaN layer 103.

図2(A)のMg濃度プロファイルP21に示すように、Mgが深さ方向(図2の右方向)へ拡散していることが分かる。また、界面IF1を境界として、Mg濃度が1/10以下に減少していることが分かる。すなわち、Mgの深さ方向への拡散が、n型GaN層102によって停止している。また図2(A)の領域R12に示すように、n型GaN層103内の界面IF1近傍領域において、Mg濃度が一定値になっていることが分かる。これは、n型GaN層102側へ拡散できなかったMgが界面IF1近傍に溜まった結果、領域R12でのMg濃度が上昇したためと考えられる。 As shown in the Mg concentration profile P21 of FIG. 2 (A), it can be seen that Mg is diffused in the depth direction (right direction of FIG. 2). Further, it can be seen that the Mg concentration is reduced to 1/10 or less with the interface IF1 as a boundary. That is, the diffusion of Mg in the depth direction is stopped by the n + type GaN layer 102. In addition, as shown in region R12 of Fig. 2 (A), n - the interface IF1 region near -type GaN layer 103, it can be seen that Mg concentration is set to a constant value. It is considered that this is because the Mg concentration in the region R12 increased as a result of the Mg that could not be diffused to the n + type GaN layer 102 side accumulated in the vicinity of the interface IF1.

図2(A)のSi濃度プロファイルP22は、界面IF1およびIF2において、Mg濃度プロファイルP21に比して急峻なプロファイルを有している。すなわち、アニールによって、n型GaN層102中のSiは拡散していないことが分かる。これは、SiはMgに比して拡散しにくい特性を有するためである。 The Si concentration profile P22 of FIG. 2A has a steeper profile than the Mg concentration profile P21 at the interfaces IF1 and IF2. That is, it can be seen that Si in the n + type GaN layer 102 is not diffused by annealing. This is because Si has a property of being less likely to diffuse than Mg.

以上より、n型GaN層102によって、Mgの拡散を停止できることが分かる。またn型GaN層102中のSiを拡散させないことで、n型GaN層102のプロファイルがアニールによって大きく崩れないことが分かる。よってn型GaN層102は、Mgの拡散を狙いの位置で停止させるための拡散停止層に適した特性を有していることが分かる。 From the above, it can be seen that the diffusion of Mg can be stopped by the n + type GaN layer 102. Also by not to diffuse Si in the n + -type GaN layer 102, it can be seen that the profile of the n + -type GaN layer 102 is not collapse significantly by annealing. Therefore, it can be seen that the n + type GaN layer 102 has characteristics suitable for a diffusion stop layer for stopping the diffusion of Mg at a target position.

また図2(A)において、Mg濃度プロファイルP21とH濃度プロファイルP23とが、深さ600nmから界面IF1までの領域R13において同一形状となっている。換言すると、領域R13において、Mg濃度とH濃度が同一となっている。すなわち、水素とMgが1:1で結合してn型GaN層103中を拡散していることが分かる。Mgと結合する水素は、アニール雰囲気中から供給することができる。本実施例では、アニール用チャンバ内に微量に存在している水から、雰囲気中に水素を供給している。 Further, in FIG. 2A, the Mg concentration profile P21 and the H concentration profile P23 have the same shape in the region R13 from the depth of 600 nm to the interface IF1. In other words, the Mg concentration and the H concentration are the same in the region R13. That is, hydrogen and Mg 1: bonded to n 1 - it can be seen that by diffusing type GaN layer 103 medium. Hydrogen bonded to Mg can be supplied from the annealing atmosphere. In this embodiment, hydrogen is supplied to the atmosphere from a small amount of water present in the annealing chamber.

p型GaN中に水素が非常に高濃度に含まれると、Mgの活性化が阻害されてしまうことが知られている。例えば、有機金属気相成長法(MOVPE法)において、シクロペンタジエニルマグネシウム(Cp2Mg)を用いて成長させたp型GaNには、水素が非常に高濃度に含まれるため、Mgの活性化のために脱水素が必要となる。本明細書に記載されている技術では、上述したように、p型GaN中のMg濃度とH濃度を同程度にすることができる。MOVPE法で成長させたp型GaNに比して、水素濃度を十分に低くすることができる。よって、脱水素を行うことなく、Mgを活性化することが可能となる。 It is known that when hydrogen is contained in p-type GaN at a very high concentration, activation of Mg is inhibited. For example, in the metalorganic vapor phase growth method (MOVPE method), p-type GaN grown using cyclopentadienyl magnesium (Cp2Mg) contains hydrogen at a very high concentration, so that Mg activation Therefore, dehydrogenation is required. In the technique described herein, as described above, the Mg concentration and the H concentration in the p-type GaN can be made comparable. The hydrogen concentration can be sufficiently lowered as compared with the p-type GaN grown by the MOVPE method. Therefore, it is possible to activate Mg without dehydrogenation.

(拡散停止メカニズム)
型領域でp型不純物の拡散を停止できるメカニズムについて、発明者らは以下のモデルを考案した。MOVPE法などによる、MgドープGaN結晶の成長中には、水素と結合しているMgは拡散しやすくなることが知られている。また、水素はp型GaN中は拡散するが、n型GaN中には拡散バリアが存在し、拡散しにくいことが知られている。これは、pn接合端においてフェルミレベルが価電子帯側から伝導帯側に移動するにしたがって水素の形成エネルギーが増大するためである。そのため、n型GaN中では水素が形成されにくく、これが拡散バリアとなる。この原理については、例えば、Lyonsらによる論文(Physical Review Letters 108, “Shallow versus Deep Nature of Mg Acceptors in Nitride Semiconductors”, 156403, 2012)に記載がある。
(Diffusion stop mechanism)
The inventors have devised the following model for a mechanism capable of stopping the diffusion of p-type impurities in the n + type region. It is known that Mg bonded to hydrogen tends to diffuse during the growth of Mg-doped GaN crystals by the MOVPE method or the like. Further, it is known that hydrogen diffuses in p-type GaN, but a diffusion barrier exists in n-type GaN and it is difficult to diffuse. This is because the hydrogen formation energy increases as the Fermi level moves from the valence band side to the conduction band side at the pn junction end. Therefore, hydrogen is unlikely to be formed in n-type GaN, which serves as a diffusion barrier. This principle is described, for example, in a paper by Lyons et al. (Physical Review Letters 108, “Shallow versus Deep Nature of Mg Acceptors in Nitride Semiconductors”, 156403, 2012).

GaNがn型として機能するかp型として機能するかは、GaN中のn型不純物(例:Si)とp型不純物(例:Mg)との濃度の大小関係によって定まる。図1の熱拡散前の状態では、Mg濃度がn型GaN層103のSi濃度(3×1016(cm−3))より高濃度であるp型機能領域Rpは、表面103aから深さ約1000nmまでの領域に存在している。p型機能領域Rp内のn型GaN層103は、p型GaNとして機能する。一方、n型機能領域Rn内のn型GaN層103は、n型GaNとして機能する。Mgは、水素と結合してp型機能領域Rp内を拡散する。 Whether GaN functions as n-type or p-type is determined by the magnitude relationship between the concentrations of n-type impurities (eg Si) and p-type impurities (eg Mg) in GaN. In the state before thermal diffusion in FIG. 1, the p-type functional region Rp having a Mg concentration higher than the Si concentration (3 × 10 16 (cm -3 )) of the n - type GaN layer 103 is deep from the surface 103a. It exists in the region up to about 1000 nm. The n - type GaN layer 103 in the p-type functional region Rp functions as p-type GaN. Meanwhile, n in the n-type functional region Rn - -type GaN layer 103 functions as an n-type GaN. Mg combines with hydrogen and diffuses within the p-type functional region Rp.

p型機能領域Rp内でのMgの拡散が進むにつれて、p型機能領域Rpとn型機能領域Rnとの界面IFaにおけるMg濃度が、n型GaN層103のSi濃度(3×1016(cm−3))を超えるようになる。すると、Mgの拡散が進むにつれて、界面IFaは深さ方向(図1右方向)へ移動していく。p型機能領域Rpが深さ方向へさらに拡大していくため、Mgは水素と結合して深さ方向へさらに拡散していくことが可能となる。Mgが水素と結合して拡散していることは、図2(A)の領域R13において、Mg濃度プロファイルP21とH濃度プロファイルP23とが同一形状であることからも分かる。 As the diffusion of Mg in the p-type functional region Rp progresses, the Mg concentration at the interface IFa between the p-type functional region Rp and the n-type functional region Rn becomes the Si concentration of the n - type GaN layer 103 (3 × 10 16 (3 × 10 16 ). It will exceed cm -3 )). Then, as the diffusion of Mg progresses, the interface IFa moves in the depth direction (right direction in FIG. 1). Since the p-type functional region Rp further expands in the depth direction, Mg can be combined with hydrogen and further diffused in the depth direction. It can be seen from the fact that the Mg concentration profile P21 and the H concentration profile P23 have the same shape in the region R13 of FIG. 2 (A) that Mg is bonded to hydrogen and diffused.

Mgは、界面IF1(図2)まで拡散する。界面IF1におけるMg濃度に比して、n型GaN層102のSi濃度(8×1018(cm−3))は十分に高い。よって界面IF1におけるMg濃度は、n型GaN層102のSi濃度を超えることができない。その結果、n型GaN層102はn型が維持されるため、水素はn型GaN層102中を拡散しない。よってMgもn型GaN層102中を拡散しない。n型GaN層102は、Mgの拡散停止層として機能する。 Mg diffuses to interface IF1 (FIG. 2). The Si concentration (8 × 10 18 (cm -3 )) of the n + type GaN layer 102 is sufficiently higher than the Mg concentration at the interface IF1. Therefore, the Mg concentration at the interface IF1 cannot exceed the Si concentration of the n + type GaN layer 102. As a result, the n + -type GaN layer 102 is the n-type is maintained, the hydrogen does not diffuse the n + -type GaN layer 102 medium. Therefore, Mg also does not diffuse in the n + type GaN layer 102. The n + type GaN layer 102 functions as a diffusion stop layer for Mg.

以上より、n型GaN層がMgの拡散停止層として機能する条件は、アニール完了後のn型GaN層の界面におけるMg濃度よりも、n型GaN層のSi濃度が高いことである。具体的には、Mgの注入量、Mgを拡散させる層のSi濃度、Mgの拡散距離などに基づいて、アニール完了後におけるn型GaN層の界面でのMg濃度を概算すればよい。そして、Mg濃度の概算値よりもn型GaN層のSi濃度が高くなるように、半導体基板を設計すればよい。 From the above, the conditions n + -type GaN layer functions as a diffusion stop layer Mg, rather than the Mg concentration at the interface of annealing after completion of the n + -type GaN layer, is the high Si concentration of the n + -type GaN layer .. Specifically, the Mg concentration at the interface of the n + type GaN layer after the annealing is completed may be roughly estimated based on the amount of Mg injected, the Si concentration of the layer in which Mg is diffused, the diffusion distance of Mg, and the like. Then, the semiconductor substrate may be designed so that the Si concentration of the n + type GaN layer is higher than the approximate value of the Mg concentration.

なお図2(A)において、界面IF1よりも深い領域R14に水素が1×1016〜1017(cm−3)程度存在しているため、水素が界面IF1を超えてn型GaN層102側にも拡散しているようにも見える。しかし領域R14の水素濃度は、図1(A)に示すように拡散前の水素濃度と同等であるため、実際には水素は界面IF1を超えてn型GaN層102側には拡散していない。 In FIG. 2A, since hydrogen exists in the region R14 deeper than the interface IF1 by about 1 × 10 16 to 10 17 (cm -3 ), the hydrogen exceeds the interface IF1 and is n + type GaN layer 102. It also seems to be diffused to the side. However, since the hydrogen concentration in the region R14 is equivalent to the hydrogen concentration before diffusion as shown in FIG. 1 (A), the hydrogen actually diffuses beyond the interface IF1 to the n + type GaN layer 102 side. Absent.

(窒化物半導体装置の製造方法)
本明細書に記載されている技術を用いた窒化物半導体装置の製造方法の一例について、説明する。本実施例では、ゲート電極の下方で一対のボディ領域の間に挟まれたn型のJFET領域(Junction FET領域)を備えた、縦型MOSFETの製造方法を説明する。図3のフローチャートのステップS1において、基板形成工程が行われる。この工程は、窒化物半導体基板10の一部にn型領域を形成する工程の一例である。具体的には図4に示すように、支持基板9上にn型GaN層11およびn型GaN層12を積層する。n型GaN層11およびn型GaN層12は、エピタキシャル成長(例:HVPE法)により形成することができる。
(Manufacturing method of nitride semiconductor device)
An example of a method for manufacturing a nitride semiconductor device using the technique described in the present specification will be described. In this embodiment, a method of manufacturing a vertical MOSFET having an n-type JFET region (Junction FET region) sandwiched between a pair of body regions below the gate electrode will be described. In step S1 of the flowchart of FIG. 3, a substrate forming step is performed. This step is an example of a step of forming an n + type region on a part of the nitride semiconductor substrate 10. Specifically, as shown in FIG. 4, the n + type GaN layer 11 and the n type GaN layer 12 are laminated on the support substrate 9. The n + type GaN layer 11 and the n type GaN layer 12 can be formed by epitaxial growth (eg, HVPE method).

ステップS2において、p型不純物であるMgを導入する工程が行われる。図5に示すように、n型のJFET領域となる領域を覆うマスク20を介して、窒化物半導体基板10の表面から、Mgをイオン注入する。これにより、n型のJFET領域以外の領域にMgを導入することができる。なお図5では、注入されたMgをバツ印で示している。なお、このイオン注入の目的は、Mgを窒化物半導体基板10の表面近傍に導入することであり、n型GaN層12の全体をp型化させることではない。よって浅いイオン注入でよいため、注入により発生する欠陥は許容できる程度に少なくすることができる。 In step S2, a step of introducing Mg, which is a p-type impurity, is performed. As shown in FIG. 5, Mg is ion-implanted from the surface of the nitride semiconductor substrate 10 through a mask 20 that covers a region to be an n-type JFET region. As a result, Mg can be introduced into a region other than the n-type JFET region. In FIG. 5, the injected Mg is indicated by a cross. The purpose of this ion implantation is to introduce Mg into the vicinity of the surface of the nitride semiconductor substrate 10, not to make the entire n - type GaN layer 12 p-type. Therefore, since shallow ion implantation is sufficient, defects generated by implantation can be reduced to an acceptable level.

Mgのイオン注入では、水素や窒素を同時に注入してもよい。窒素を共注入することにより、イオン注入時に発生してしまう窒素空孔を減少させることができる。また水素を共注入することにより、Mgと結合する水素を供給することが可能になる。 In the ion implantation of Mg, hydrogen and nitrogen may be implanted at the same time. By co-implanting nitrogen, it is possible to reduce the nitrogen vacancies that occur during ion implantation. Further, by co-injecting hydrogen, it becomes possible to supply hydrogen that binds to Mg.

ステップS3において、拡散工程が行われる。具体的には、GaNの飽和蒸気圧近傍の高圧下で、N雰囲気中でアニールする。アニール条件の一例としては、1400℃、400〜1000MPa、15分間、が挙げられる。拡散工程では、アニール用チャンバ内に微量に存在している水から、アニール雰囲気中へ水素を供給している。これにより、Mgが水素と結合し、n型GaN層12中を拡散する。Mgの拡散は、n型GaN層11で停止する。このとき、深さ方向へ異方性を有してMgを拡散させることができる。従って、図6に示すように、n型のJFET領域12bと、p型ボディ領域12aを形成することができる。 In step S3, the diffusion step is performed. Specifically, under high pressure of GaN saturated vapor圧近near, annealing in an N 2 atmosphere. Examples of annealing conditions include 1400 ° C., 400 to 1000 MPa, and 15 minutes. In the diffusion step, hydrogen is supplied into the annealing atmosphere from a small amount of water present in the annealing chamber. Thus, Mg is bonded to hydrogen, n - diffusion type GaN layer 12 inside. The diffusion of Mg is stopped at the n + type GaN layer 11. At this time, Mg can be diffused with anisotropy in the depth direction. Therefore, as shown in FIG. 6, an n-type JFET region 12b and a p-type body region 12a can be formed.

深さ方向へ異方性を有してMgが拡散する理由を説明する。Mgの拡散自体は、等方的に行われる。しかし、n型GaN層12の厚さT1(1μm程度)は、p型ボディ領域12aの幅W1(数十μm)に比して、十分に小さい。このようなアスペクト比を考慮すると、横方向(図6左右方向)の拡散は無視できるため、実質的に深さ方向に異方性を有してMgを拡散させることができる。 The reason why Mg diffuses with anisotropy in the depth direction will be described. The diffusion of Mg itself is isotropic. However, the thickness T1 (about 1 μm) of the n - type GaN layer 12 is sufficiently smaller than the width W1 (several tens of μm) of the p-type body region 12a. Considering such an aspect ratio, diffusion in the lateral direction (horizontal direction in FIG. 6) can be ignored, so Mg can be diffused with anisotropy in the depth direction.

ステップS4において、脱水素アニールを行う。なお、本実施例では、脱水素アニールは省略できる。理由を説明する。従来技術においてp型GaN層をMOVPE法で作成する際には、p型不純物であるMgを添加するためにCp2Mgを用いる。すると、p型GaN層には水素が非常に高濃度に含まれるため、Mgを活性化するための脱水素が必要となる。しかし本明細書に記載されている技術では、n型GaNを熱拡散によってp型GaNにすることができる。よって、p型GaNを配置する部分を、n型GaNで作成することができる。n型GaNは、MOVPE法に比して水素含有量が少なくなるような成長法(例:ハイドライド気相成長法(HVPE法))で作成することができる。よって、本明細書に記載されている技術で作成したp型GaNは、脱水素工程を不要にすることができる。 In step S4, dehydrogenation annealing is performed. In this embodiment, dehydrogenation annealing can be omitted. Explain the reason. When the p-type GaN layer is prepared by the MOVPE method in the prior art, Cp2Mg is used to add Mg which is a p-type impurity. Then, since the p-type GaN layer contains hydrogen at a very high concentration, dehydrogenation is required to activate Mg. However, in the technique described herein, n - type GaN can be converted to p-type GaN by thermal diffusion. Therefore, the portion where the p-type GaN is arranged can be created with the n - type GaN. The n - type GaN can be produced by a growth method (eg, hydride vapor phase growth method (HVPE method)) in which the hydrogen content is lower than that of the MOVPE method. Therefore, the p-type GaN produced by the technique described in the present specification can eliminate the dehydrogenation step.

ステップS5において、ソース領域の形成工程が行われる。具体的には、周知のフォトリソグラフィー技術およびドライエッチング加工を用いて、ソース領域13および14に対応する開口部を備えたマスクを加工する。マスクを介して、p型ボディ領域12aにシリコンをイオン注入する。そして活性化アニールを実行する。活性化アニールでは、GaNの飽和蒸気圧近傍の高圧を用いなくてもよい。 In step S5, the step of forming the source region is performed. Specifically, a well-known photolithography technique and dry etching processing are used to process a mask having openings corresponding to source regions 13 and 14. Silicon is ion-implanted into the p-type body region 12a via a mask. Then, activation annealing is performed. In activation annealing, it is not necessary to use a high pressure near the saturated vapor pressure of GaN.

ステップS6において、電極形成工程が行われる。具体的には、図7に示すように、ゲート絶縁膜15を介してゲート電極16を形成する。また、ソース電極17および18を形成する。支持基板9の裏面に不図示のドレイン電極を形成する。これにより、n型のJFET領域12bを備えた、縦型MOSFET1が完成する。 In step S6, the electrode forming step is performed. Specifically, as shown in FIG. 7, the gate electrode 16 is formed via the gate insulating film 15. It also forms the source electrodes 17 and 18. A drain electrode (not shown) is formed on the back surface of the support substrate 9. As a result, the vertical MOSFET 1 provided with the n-type JFET region 12b is completed.

以上、本発明の具体例を詳細に説明したが、これらは例示に過ぎず、特許請求の範囲を限定するものではない。特許請求の範囲に記載の技術には、以上に例示した具体例を様々に変形、変更したものが含まれる。本明細書または図面に説明した技術要素は、単独であるいは各種の組合せによって技術的有用性を発揮するものであり、出願時請求項記載の組合せに限定されるものではない。また、本明細書または図面に例示した技術は複数目的を同時に達成し得るものであり、そのうちの一つの目的を達成すること自体で技術的有用性を持つものである。 Although specific examples of the present invention have been described in detail above, these are merely examples and do not limit the scope of claims. The techniques described in the claims include various modifications and modifications of the specific examples illustrated above. The technical elements described in the present specification or drawings exhibit technical usefulness alone or in various combinations, and are not limited to the combinations described in the claims at the time of filing. In addition, the techniques illustrated in the present specification or drawings can achieve a plurality of purposes at the same time, and achieving one of the purposes itself has technical usefulness.

(変形例)
ステップS3(図6)において、深さ方向へ異方性を有してMgを拡散させる技術は、各種のデバイス構造に適用可能である。例えば、n型のドリフト層を有する半導体装置の終端領域において、p型のガードリング構造を作成する領域にMgをイオン注入して拡散させればよい。これにより、簡易にガードリングを形成できる。
(Modification example)
In step S3 (FIG. 6), the technique of diffusing Mg with anisotropy in the depth direction can be applied to various device structures. For example, in the terminal region of a semiconductor device having an n-type drift layer, Mg may be ion-implanted into a region where a p-type guard ring structure is formed and diffused. As a result, the guard ring can be easily formed.

ステップS3において、p型不純物であるMgを導入する工程は、イオン注入に限られず、例えば固相拡散の技術を用いてもよい。具体的には、窒化物半導体基板10の表面のn型領域以外の領域に、p型不純物を含んだ膜を成膜してからアニールしてもよい。このような膜の一例としては、スパッタ等で成膜されたMg、Be、窒化マグネシウム(Mg)、窒化ベリリウム(Be)、などが挙げられる。また、炉内に配置したルツボ内にp型不純物(例:Mg、Be)を含んだ粒を入れた状態で、アニールを行ってもよい。 In step S3, the step of introducing Mg, which is a p-type impurity, is not limited to ion implantation, and for example, a solid phase diffusion technique may be used. Specifically, a film containing p-type impurities may be formed in a region other than the n-type region on the surface of the nitride semiconductor substrate 10 and then annealed. Examples of such a film include Mg, Be, magnesium nitride (Mg 3 N 2 ), beryllium nitride (Be 3 N 2 ), and the like formed by sputtering or the like. Further, annealing may be performed in a state where grains containing p-type impurities (eg, Mg, Be) are put in a crucible arranged in a furnace.

本実施形態では、n型GaN層にMgを拡散させる場合を説明したが、この形態に限られない。真性半導体であるi型GaN層にMgを拡散させてもよい。 In the present embodiment, n - a case has been described for diffusing Mg in -type GaN layer is not limited to this embodiment. Mg may be diffused in the i-type GaN layer which is an intrinsic semiconductor.

ステップS4で行われるアニールは、高圧下に限られない。任意の圧力下でアニールを行っても、本明細書の技術の効果を得ることができる。 The annealing performed in step S4 is not limited to high pressure. Even if annealing is performed under an arbitrary pressure, the effects of the techniques described herein can be obtained.

アニール雰囲気中に水素を供給する形態は様々であってよい。例えば、アニール用チャンバ内に水素を含んだガスを供給しながらアニールしてもよい。 There may be various forms of supplying hydrogen in the annealing atmosphere. For example, annealing may be performed while supplying a gas containing hydrogen into the annealing chamber.

ステップS2のn型領域形成工程と、ステップS3のp型不純物を導入する工程との順序は逆でもよい。これらの工程間に他の工程が複数存在していてもよい。 The order of the n + type region forming step in step S2 and the step of introducing the p-type impurity in step S3 may be reversed. A plurality of other steps may exist between these steps.

窒化物半導体はGaNに限定されるものではなく、例えば窒化アルミニウムガリウム(AlGaN)、AlN(窒化アルミニウム)、InN(窒化インジウム)、または、その混晶等であってもよい。 The nitride semiconductor is not limited to GaN, and may be, for example, gallium nitride (AlGaN), AlN (aluminum nitride), InN (indium nitride), or a mixed crystal thereof.

上記の実施例では、p型領域を形成するためのII族元素の一例としてマグネシウム(Mg)を用いていたが、この構成に限定されるものではない。II族元素は、例えばベリリウム(Be)、カルシウム(Ca)等であってもよい。 In the above embodiment, magnesium (Mg) is used as an example of the group II element for forming the p-type region, but the present invention is not limited to this configuration. The group II element may be, for example, beryllium (Be), calcium (Ca), or the like.

上記の実施例では、n型領域を形成するための元素の一例としてシリコン(Si)を用いていたが、この構成に限定されず、ゲルマニウム(Ge)などを用いてもよい。 In the above embodiment, silicon (Si) is used as an example of the element for forming the n-type region, but the present invention is not limited to this configuration, and germanium (Ge) or the like may be used.

型GaN層102、n型GaN層11、ソース領域13および14は、n型領域の一例である。 The n + type GaN layer 102, the n + type GaN layer 11, and the source regions 13 and 14 are examples of the n type region.

1:横型MOSFET 9:支持基板 10:窒化物半導体基板 11:n型GaN層 12:i型GaN層 13、14:ソース領域 101:n型基板 102:n型GaN層 103:i型GaN層 P11、P21:Mg濃度プロファイル P12、P22:Si濃度プロファイル P13、P23:H濃度プロファイル 1: Horizontal MOSFET 9: Support substrate 10: Nitride semiconductor substrate 11: n + type GaN layer 12: i-type GaN layer 13, 14: Source region 101: n-type substrate 102: n + type GaN layer 103: i-type GaN Layers P11, P21: Mg concentration profile P12, P22: Si concentration profile P13, P23: H concentration profile

Claims (8)

窒化物半導体基板の一部にn型不純物を第1濃度で含んだn型領域を形成する工程と、
前記窒化物半導体基板の露出面から前記n型領域以外の特定領域にp型不純物を導入する不純物導入工程であって、
前記特定領域に含まれるn型不純物の濃度は前記第1濃度よりも低く、前記特定領域は前記n型領域に接している、前記不純物導入工程と、
前記n型領域中のn型不純物を拡散させずに前記p型不純物を選択的に前記特定領域内に熱拡散させる拡散工程と、
を備え、
前記拡散工程では、前記n型領域と前記特定領域との境界面で前記p型不純物の拡散を停止させることで前記p型不純物を前記n型領域の内部へ拡散させない、窒化物半導体装置の製造方法。
A step of forming an n-type region containing an n-type impurity at a first concentration in a part of a nitride semiconductor substrate, and
This is an impurity introducing step of introducing a p-type impurity into a specific region other than the n-type region from the exposed surface of the nitride semiconductor substrate.
The impurity introduction step, wherein the concentration of the n-type impurity contained in the specific region is lower than the first concentration, and the specific region is in contact with the n-type region.
A diffusion step in which the p-type impurities are selectively thermally diffused into the specific region without diffusing the n-type impurities in the n-type region.
With
In the diffusion step, a nitride semiconductor device is manufactured which does not diffuse the p-type impurities into the n-type region by stopping the diffusion of the p-type impurities at the interface between the n-type region and the specific region. Method.
前記拡散工程では、前記p型不純物の拡散プロファイルと水素の拡散プロファイルとの少なくとも一部が同一形状となる、請求項1に記載の窒化物半導体装置の製造方法。 The method for manufacturing a nitride semiconductor device according to claim 1, wherein in the diffusion step, at least a part of the diffusion profile of the p-type impurity and the diffusion profile of hydrogen have the same shape. 前記p型不純物の拡散プロファイルと前記水素の拡散プロファイルとが同一形状となる領域において、前記p型不純物の濃度と前記水素の濃度が同一となる、請求項2に記載の窒化物半導体装置の製造方法。 The production of the nitride semiconductor device according to claim 2, wherein the concentration of the p-type impurity and the concentration of the hydrogen are the same in a region where the diffusion profile of the p-type impurity and the diffusion profile of hydrogen have the same shape. Method. 前記拡散工程は、チャンバ内に水素を存在させた状態で行われる、請求項1〜3の何れか1項に記載の窒化物半導体装置の製造方法。 The method for manufacturing a nitride semiconductor device according to any one of claims 1 to 3, wherein the diffusion step is performed in a state where hydrogen is present in the chamber. 前記拡散工程は、前記窒化物半導体基板の飽和蒸気圧近傍の高圧下で行われる、請求項1〜4の何れか1項に記載の窒化物半導体装置の製造方法。 The method for manufacturing a nitride semiconductor device according to any one of claims 1 to 4, wherein the diffusion step is performed under a high pressure near the saturated vapor pressure of the nitride semiconductor substrate. 前記p型不純物を導入する工程はイオン注入によって行われる、請求項1〜5の何れか1項に記載の窒化物半導体装置の製造方法。 The method for manufacturing a nitride semiconductor device according to any one of claims 1 to 5, wherein the step of introducing the p-type impurity is performed by ion implantation. 前記p型不純物を導入する工程は固相拡散によって行われる、請求項1〜5の何れか1項に記載の窒化物半導体装置の製造方法。 The method for manufacturing a nitride semiconductor device according to any one of claims 1 to 5, wherein the step of introducing the p-type impurity is performed by solid-phase diffusion. 前記窒化物半導体基板はGaNであり、
前記p型不純物はII族元素である、請求項1〜7の何れか1項に記載の窒化物半導体装置の製造方法。
The nitride semiconductor substrate is GaN and is
The method for manufacturing a nitride semiconductor device according to any one of claims 1 to 7, wherein the p-type impurity is a group II element.
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Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003197642A (en) * 2001-12-25 2003-07-11 Mitsubishi Electric Corp Semiconductor device and its manufacturing method
JP2004356257A (en) * 2003-05-28 2004-12-16 Toyota Central Res & Dev Lab Inc Manufacturing method for p-type iii nitride semiconductor
JP2006100310A (en) * 2004-09-28 2006-04-13 Nissan Motor Co Ltd Method of manufacturing semiconductor device
JP2012094688A (en) * 2010-10-27 2012-05-17 Sumitomo Electric Ind Ltd Semiconductor device and method of manufacturing the same
JP2012156207A (en) * 2011-01-24 2012-08-16 Mitsubishi Electric Corp Semiconductor device and method of manufacturing the same
JP2017208427A (en) * 2016-05-18 2017-11-24 富士電機株式会社 Method of manufacturing semiconductor device

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003197642A (en) * 2001-12-25 2003-07-11 Mitsubishi Electric Corp Semiconductor device and its manufacturing method
JP2004356257A (en) * 2003-05-28 2004-12-16 Toyota Central Res & Dev Lab Inc Manufacturing method for p-type iii nitride semiconductor
JP2006100310A (en) * 2004-09-28 2006-04-13 Nissan Motor Co Ltd Method of manufacturing semiconductor device
JP2012094688A (en) * 2010-10-27 2012-05-17 Sumitomo Electric Ind Ltd Semiconductor device and method of manufacturing the same
JP2012156207A (en) * 2011-01-24 2012-08-16 Mitsubishi Electric Corp Semiconductor device and method of manufacturing the same
JP2017208427A (en) * 2016-05-18 2017-11-24 富士電機株式会社 Method of manufacturing semiconductor device

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