JP2020047656A - 半導体ユニット、半導体モジュール及び半導体装置 - Google Patents
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Abstract
Description
<半導体ユニット>
本発明の第1実施形態に係る半導体ユニット1は、図1及び図3に示すように、導電ピンからなる電極端子(7a,7b,7c,7d)、樹脂9、絶縁回路基板10及び配線基板20を備える。樹脂9の上面には、矩形の凹部17a、17b、17c、17dが設けられる。凹部17a、17b、17c、17dには、それぞれ第1端子(ドレイン電極ピン)7a、第2端子(ソース電極ピン)7b、制御電極端子(制御電極ピン)7c、及び補助電極端子(補助電極ピン)7dが配置される。絶縁回路基板10及び配線基板20は、樹脂(封止樹脂)9の内部に内蔵される。樹脂9は、図1に示した平面パターンにおいて矩形状を有する。第1端子7a及び第2端子7bは、樹脂9の長手方向の一方の端部(図1において右側の端部)において、樹脂9の短手方向で互いに対向するように配置される。制御電極端子7c及び補助電極端子7dは、樹脂9の長手方向の他方の端部(図1において左側の端部)において、樹脂9の短手方向で互いに対向するように配置される。第1端子7aと補助電極端子7dとが樹脂9の長手方向で互いに対向し、第2端子7bと制御電極端子7cとが樹脂9の長手方向で互いに対向する。
第1実施形態に係る半導体モジュール2は、図5に示すように、第1実施形態に係る第1半導体ユニット1a及び第2半導体ユニット1bを備える2素子入り半導体モジュールである。例えば、半導体モジュール2は、第1半導体ユニット1aを上アーム、第2半導体ユニット1bを下アームとする半波整流回路として使用可能である。半導体モジュール2において、第2半導体ユニット1bは第1半導体ユニット1aを180度回転させて、互いの樹脂9の短辺を対向配置した構成である。図5に示すように、第1半導体ユニット1aの第1端子7aが第2半導体ユニット1bの第4接続端子7bと対向し、第1半導体ユニット1aの第2端子7bが第2半導体ユニット1bの第3接続端子7aと対向するように配置される。
第1実施形態に係る半導体装置は、図8に示すように、第1実施形態に係る半導体モジュール2を複数個、例えば2個備える。第1実施形態に係る半導体装置では、半導体モジュール2を、互いの長辺が対面するように並列に配置して大電流化することができる。図9は、第1実施形態に係る半導体装置の等価回路である。図8の一方の半導体モジュール2の正極外部端子31A、負極外部端子32A及び出力外部端子33Aのそれぞれが、図9のP1端子、N1端子及びU1端子に対応する。図8の他方の半導体モジュール2の正極外部端子31A、負極外部端子32A及び出力外部端子33Aのそれぞれが、図9のP2端子、N2端子及びU2端子に対応する。図9のG1端子及びS1a端子は、それぞれ図8の両方の半導体モジュール2に設けられた第1半導体ユニット1aのゲート電極G及び補助ソース電極Saに電気的に接続される。図9のG2端子及びS2a端子は、それぞれ図8の両方の半導体モジュール2に設けられた第2半導体ユニット1bのゲート電極G及び補助ソース電極Saに電気的に接続される。図8の下側の半導体モジュール2では、ゲート外部端子及び補助外部端子を設置するため、出力連結部33aが第2半導体ユニット1bの上面から側壁に折り曲げられて配置される。
<半導体ユニット>
本発明の第2実施形態に係る半導体ユニット1Aは、図11に示すように、端子ピン(7a1,7a2,7a3,7b,7c,7d)、樹脂9、絶縁回路基板10及び配線基板20を備える。樹脂9の上面には、凹部17a1、凹部17a2、凹部17a3、17b、17c、17dが設けられる。凹部17a1、17a2、17a3には、それぞれ第1端子7a1、第1端子7a2及び第3端子7a3が配置される。第1端子7a1及び第1端子7a2は、樹脂9の長手方向の一方の端部(図1において右側の端部)において、第2端子7bを挟むように設けられる。第3端子7a3は、樹脂9の長手方向の他方の端部(図1において左側の端部)において、制御電極端子7c及び補助電極端子7dの間に挟まれるように設けられる。第2実施形態に係る半導体ユニット1Aは、第2端子7bが第1端子7a1、7a2に挟まれ、第3端子7a3が制御電極端子7c及び補助電極端子7dの間に挟まれるように設けられる点が第1実施形態と異なる。他の構成は、第1実施形態に係る半導体ユニット1と同様であるので、重複した説明を省略する。
第2実施形態に係る半導体モジュール2Aは、図13に示すように、第2実施形態に係る第1半導体ユニット1Aa及び第2半導体ユニット1Abを備える2素子入り半導体モジュールである。例えば、半導体モジュール2Aは、第1半導体ユニット1Aaを上アーム、第2半導体ユニット1Abを下アームとする半波整流回路として使用可能である。半導体モジュール2Aにおいて、第2半導体ユニット1Abは第1半導体ユニット1Aaを180度回転させて、互いの樹脂9の短辺を対向配置した構成である。第1半導体ユニット1Aaの第1端子7a1が第2半導体ユニット1Abの第1端子7a2と対向し、第1半導体ユニット1Aaの第1端子7a1が第2半導体ユニット1Abの第1端子7a2と対向する。また、第1半導体ユニット1Aaの第2端子7bが第2半導体ユニット1Abの第2端子7bと対向するように配置される。第2実施形態に係る半導体モジュール2Aは、第1半導体ユニット1Aa及び第2半導体ユニット1Abを用いる点が第1実施形態の半導体モジュール2と異なる。他の構成は、第1実施形態に係る半導体モジュール2と同様であるので、重複した説明を省略する。
第2実施形態に係る半導体装置は、図15に示すように、第2実施形態に係る半導体モジュール2Aを複数個、例えば2個備える。第2実施形態に係る半導体装置では、半導体モジュール2Aを、互いの長辺が対面するように並列に配置して大電流化することができる。第2実施形態に係る半導体装置は、半導体モジュール2Aを用いる点が第1実施形態の半導体装置と異なる。他の構成は、第1実施形態に係る半導体装置と同様であるので、重複した説明を省略する。
本発明の第1及び第2実施形態に係る半導体装置について、寄生インダクタンスを評価した。実施例1として、図8に示した第1実施形態に係る半導体装置を用いた。実施例2として、図15に示した第2実施形態に係る半導体装置を用いた。また、比較例として、図16及び図17に示す従来構造の半導体装置を用いた。
上記のように、本発明は第1及び第2実施形態によって記載したが、この開示の一部をなす論述及び図面は本発明を限定するものであると理解すべきではない。第1及び第2実施形態では、ダイオードチップ4a〜4hを挟んでトランジスタチップ3a〜3eの配列及びトランジスタチップ3f〜3jの配列を短手方向の両端部に配列している。しかし、トランジスタチップを挟んで、ダイオードチップを両端に配置してもよい。例えば、図19に示すように、絶縁回路基板10の導体層12aの上に、短手方向の中央部にトランジスタチップ3a〜3eとトランジスタチップ3f〜3jをそれぞれ長手方向に配列する。ダイオードチップ4a〜4dは、トランジスタチップ3a〜3eと短手方向の一方の端部との間に配列する。ダイオードチップ4e〜4hは、トランジスタチップ3f〜3jと短手方向の他方の端部との間に配列する。第1端子7a4は、導体層12aの一方の端部でトランジスタチップ3a、3fに面するように、短手方法の中央部に配置する。導体層12aの他方の端部でトランジスタチップ3e、3jに面するように第3端子7a3を配置する。また、長手方向の一方の端部において、導体層12aを挟んで短手方向の両端部に導体層12b1、12b2を配置する。導体層12b1に第2端子7b1及び導電ポスト6bを配置し、導体層12b2に第2端子7b2及び導電ポスト6bを配置する。このように、トランジスタチップ3a〜3eの配列及びトランジスタチップ3f〜3jの配列を挟んで、ダイオードチップ4a〜4hを両端に配置しても、電流経路の往路と復路とを平行に近接して配置することができ、インダクタンスの低減が可能となる。
1a、1Aa 第1半導体ユニット
1b、1Ab 第2半導体ユニット
2、2A、2Z 半導体モジュール
3a、3b、3c、3d、3e、3f、3g、3h、3i、3j 半導体チップ(トランジスタチップ)
4a、4b、4c、4d、4e、4f、4g、4h 半導体チップ(ダイオードチップ)
5a 導電ポスト(第1導電ポスト)
5b 導電ポスト(制御電極ポスト)
5c 導電ポスト(陽極ポスト)
6b、6c 導電ポスト
6b1、6b2 導電ポスト(第2導電ポスト)
(7a,7b,7c,7d) 電極端子
7a、7a1、7a2 第1端子(ドレイン電極ピン)
7a3 第3端子
7b 第2端子(ソース電極ピン)
7c 制御電極端子(制御電極ピン)
7d 補助電極端子(補助電極ピン)
8 抵抗素子
9 樹脂(封止樹脂)
10 絶縁回路基板
11 絶縁板
12a、12b、12c、12d、13 導体層
17a、17a1、17a2、17a3、17b、17c、17d 凹部
20 配線基板
21 樹脂板
22a、22b 配線層
31 正極連結部
31A 正極外部端子
32 負極連結部
32A 負極外部端子
33、33a 出力連結部
33b 中間連結部
33A 出力外部端子
34 制御外部端子
35 補助外部端子
36 支持板
37 外装ケース
38a、38b ガイド
38c リブ
Claims (8)
- 一方の面に第1主電極および他方の面に第2主電極をそれぞれ有し、平行な複数の列に配置された複数のトランジスタチップと、
前記トランジスタチップの前記第1主電極と電気的に接続され、前記トランジスタチップの列の延伸方向に沿って一方の辺の両隅部を突出させた第1導体層と、
前記第1導体層の前記両隅部の間に配置された第2導体層と、
前記複数のトランジスタチップの前記第2主電極側に配置され、前記複数のトランジスタチップの前記第2主電極及び前記第2導体層に電気的に接続された配線層を有する配線基板と、
を備えることを特徴とする半導体ユニット。 - 前記第2導体層の両端領域は、前記複数のトランジスタチップのそれぞれの列の延長線上にあり、前記両端領域で前記配線層と導電接続していることを特徴とする請求項1に記載の半導体ユニット。
- 前記トランジスタチップの列の間に列状に配置され、前記トランジスタチップと電気的に逆並列に接続された複数のダイオードチップを備えることを特徴とする請求項1又は2に記載の半導体ユニット。
- 前記第1導体層は、前記両隅部とは反対側の他方の辺の中央部を突出させたことを特徴とする請求項1から3のいずれか1項に記載の半導体ユニット。
- 前記第1導体層の前記両隅部に接続された第1端子と、
前記第2導体層に接続された第2端子と、
前記第1導体層の前記中央部に接続された第3端子と、
前記複数のトランジスタチップの前記第2主電極と前記配線層を接続する第1導電ポストと、
前記第2導体層の前記両端領域と前記配線層を接続する第2導電ポストと、を有し、
前記第1端子の一部、前記第2端子の一部及び前記第3端子の一部を除いて、前記トランジスタチップ、前記第1導体層、第2導体層及び前記配線基板を樹脂で封止した請求項4に記載の半導体ユニット。 - 一方の面に第1主電極および他方の面に第2主電極をそれぞれ有し、平行な複数の列に配置された複数の第1トランジスタチップと、前記第1トランジスタチップの前記第1主電極と電気的に接続され、前記第1トランジスタチップの列の延伸方向に沿って一方の辺の両隅部を突出させた第1導体層と、前記第1導体層の前記両隅部の間に配置された第2導体層と、前記複数の第1トランジスタチップの前記第2主電極側に配置され、前記複数の第1トランジスタチップの前記第2主電極及び前記第2導体層に電気的に接続された第1配線層を有する第1配線基板とを備えた第1半導体ユニットと、
一方の面に第3主電極および他方の面に第4主電極をそれぞれ有し、平行な複数の列に配置された複数の第2トランジスタチップと、前記第2トランジスタチップの前記第3主電極と電気的に接続され、前記第2トランジスタチップの列の延伸方向に沿って一方の辺の両隅部を突出させた第3導体層と、前記第3導体層の前記両隅部の間に配置された第4導体層と、前記複数の第2トランジスタチップの前記第4主電極側に配置され、前記複数の第2トランジスタチップの前記第4主電極及び前記第4導体層に電気的に接続された第2配線層を有する第2配線基板とを備えた第2半導体ユニットと、
前記第1半導体ユニットの前記第1主電極に正極連結部を介して電気的に接続された正極外部端子と、
前記第2半導体ユニットの前記第4主電極に負極連結部を介して電気的に接続された負極外部端子と、
前記第2半導体ユニットの前記第3主電極と電気的に接続された出力外部端子と、
前記第1半導体ユニットの前記第2主電極及び前記第2半導体ユニットの前記第3主電極に電気的に接続された中間連結部と、を備え、
前記第1半導体ユニットの前記第1導体層の前記両隅部と前記第2半導体ユニットの前記第3導体層の前記両隅部とを対向して配置し、
前記正極連結部の主面と前記負極連結部の主面が互いに離間して対面するように配置され、かつ前記正極連結部及び前記負極連結部の両方の前記主面が前記第1半導体ユニットの上面と平行に配置されることを特徴とする半導体モジュール。 - 前記第3導体層は、前記両隅部とは反対側の他方の辺の中央部を突出させており、
前記出力外部端子は、前記第2半導体ユニットの前記第3導体層の前記中央部と電気的に接続されていることを特徴とする請求項6に記載の半導体モジュール。 - 請求項6又は7に記載の複数の前記半導体モジュールが、該半導体モジュールの前記各正極外部端子、前記各負極外部端子、前記各出力外部端子をそれぞれ露出されるように外装ケースに内蔵されたことを特徴とする半導体装置。
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