JP2017175691A - 電源切換回路及び電子機器 - Google Patents
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Abstract
Description
図1は、本発明の一実施形態に係る電子機器の構成例を示す図である。図1に示すように、この電子機器は、本発明の一実施形態に係る電源切換回路10と、ロジック回路50と、レギュレーター60と、計時回路70と、アナログ回路80と、I/O回路(入出力回路)90とを含んでも良い。以下においては、電源切換回路10〜I/O回路90が半導体集積回路装置(IC)100に内蔵されている場合について説明する。さらに、電子機器は、AC/DCコンバーター110と、レギュレーター(REG)120と、分圧回路130と、バッテリー140と、キャパシターC1とを含んでも良い。
電源切換回路10は、メインの電源電位としてノードN1に供給される第1の電源電位V1と、サブの電源電位としてノードN4に供給される第2の電源電位V2との内の一方を選択して、選択された電源電位をノードN3から出力する。電源切換回路10は、PチャネルMOSトランジスターQP1〜QP4と、制御信号生成部20とを含み、比較部30と、レベルシフター(L/S)40とをさらに含んでも良い。
次に、図1に示す電源切換回路10の動作例について、図1及び図3を参照しながら説明する。図3は、図1に示す電源切換回路の動作例を示す波形図である。この例においては、比較部30が、シュミットトリガー回路で構成されており、ヒステリシス特性を有している。
再び図1を参照すると、電源切換回路10の出力電源電位V3は、レギュレーター60、計時回路70、アナログ回路80、及び、I/O回路90等の周辺回路に供給される。レギュレーター60は、オペアンプ61と、抵抗R61及びR62とを含んでいる。抵抗R61及びR62は、オペアンプ61の出力電圧を分圧して、分圧された電圧をオペアンプ61の反転入力端子に帰還することにより、オペアンプ61のゲインを設定する。オペアンプ61は、設定されたゲインで参照電位VREF2を増幅することにより、ロジック電源電位V5(例えば、1.8V)を生成してロジック回路50に供給する。
例えば、図1に示す電子機器が運搬される際にAC電源電圧が供給されなくなると、AC/DCコンバーター110及びレギュレーター120が動作を停止して、第1の電源電位V1が基準電位VSSまで低下する。それにより、比較電圧VCMPも基準電位VSSまで低下するので、比較部30によって生成される電源選択信号SELがローレベルになって、電源切換回路10が、バッテリー140から供給される第2の電源電位V2を選択する。
また、図1に示す電子機器が一旦設置されてしまうと、バッテリー140を必要としない場合もある。そのような場合に、比較部30は、比較動作を停止して電源選択信号SELのレベルを固定しても良い。
Claims (6)
- 第1の電源電位が供給される第1のノードと第2のノードとの間に接続されたソース及びドレイン、及び、前記第1のノードに接続されたバックゲートを有する第1のPチャネルMOSトランジスターと、
前記第2のノードと第3のノードとの間に接続されたソース及びドレイン、及び、前記第3のノードに接続されたバックゲートを有する第2のPチャネルMOSトランジスターと、
第2の電源電位が供給される第4のノードと第5のノードとの間に接続されたソース及びドレイン、及び、前記第4のノードに接続されたバックゲートを有する第3のPチャネルMOSトランジスターと、
前記第5のノードと前記第3のノードとの間に接続されたソース及びドレイン、及び、前記第3のノードに接続されたバックゲートを有する第4のPチャネルMOSトランジスターと、
前記第1〜第4のPチャネルMOSトランジスターのゲートに基準電位以上でバックゲートの電位以下の電位を有する第1〜第4の制御信号をそれぞれ印加することにより、前記第1及び第2のPチャネルMOSトランジスターの組と前記第3及び第4のPチャネルMOSトランジスターの組との内の一方を導通状態にすると共に他方を非導通状態にする制御信号生成部と、
を備える電源切換回路。 - 前記第1の電源電位と前記基準電位との間の電圧を分圧して得られる比較電圧を参照電圧と比較することにより、電源選択信号を生成する比較部をさらに備え、
前記制御信号生成部が、前記電源選択信号に従って前記第1〜第4の制御信号を生成する、請求項1記載の電源切換回路。 - 前記制御信号生成部が、
前記第1のノードに接続されたアノードと第6のノードに接続されたカソードとを有する第1のダイオードと、
前記第4のノードに接続されたアノードと前記第6のノードに接続されたカソードとを有する第2のダイオードと、
を含み、前記第6のノードの電位が、前記比較部に電源電位として供給される、請求項2記載の電源切換回路。 - 前記制御信号生成部が、
ローアクティブの電源選択信号のハイレベルを前記第6のノードの電位から前記第1の電源電位にシフトすることによって前記第1の制御信号を生成する第1のレベルシフターと、
前記ローアクティブの電源選択信号のハイレベルを前記第6のノードの電位から前記第3のノードの電位にシフトすることによって前記第2の制御信号を生成する第2のレベルシフターと、
ハイアクティブの電源選択信号のハイレベルを前記第6のノードの電位から前記第2の電源電位にシフトすることによって前記第3の制御信号を生成する第3のレベルシフターと、
前記ハイアクティブの電源選択信号のハイレベルを前記第6のノードの電位から前記第3のノードの電位にシフトすることによって前記第4の制御信号を生成する第4のレベルシフターと、
をさらに含む、請求項3記載の電源切換回路。 - 前記比較部が、設定に従って比較動作を停止させて前記電源選択信号のレベルを固定するスイッチ回路を含む、請求項2〜4のいずれか1項記載の電源切換回路。
- 請求項2〜4のいずれか1項記載の電源切換回路と、
前記比較電圧が前記参照電圧よりも低いときに生成される電源選択信号に従って動作を停止するロジック回路と、
を備える電子機器。
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