JP2016149517A - Wiring board and method for manufacturing the same - Google Patents

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Abstract

PROBLEM TO BE SOLVED: To provide a wiring board which secures a strength and improves insulation reliability.SOLUTION: A wiring board includes: an insulating layer in which a second insulating film is laminated on one surface of a first insulating film and the other surface of the first insulating film is exposed to the outside; a first wiring layer having a pad and a wiring pattern that are embedded in the first insulating film and of which a predetermined surface is exposed from the other surface of the first insulating film; and a second wiring layer containing a wiring pattern formed in an opposite surface to a surface in contact with one surface of the first insulating film in the second insulating film, and a via wiring which penetrates the insulating layer and connects the wiring pattern and the first wiring layer. The first insulating film is formed of only a resin. The second insulating film has such a structure that a reinforcement member is impregnated with the resin.SELECTED DRAWING: Figure 1

Description

本発明は、配線基板及びその製造方法に関する。   The present invention relates to a wiring board and a manufacturing method thereof.

従来、配線層と絶縁層とが交互に積層され、配線層同士が絶縁層を貫通するビアホールを介して接続された所謂ビルドアップ配線基板が知られている。このような配線基板において、絶縁層が補強部材を有していない場合には、配線基板としての強度が弱くなるおそれがある。そのため、最外の絶縁層として、補強部材に絶縁性樹脂を含浸させた所謂プリプレグを用い、配線基板としての強度を確保している(例えば、特許文献1参照)。   Conventionally, a so-called build-up wiring board in which wiring layers and insulating layers are alternately stacked and the wiring layers are connected via via holes penetrating the insulating layer is known. In such a wiring board, when the insulating layer does not have a reinforcing member, the strength as the wiring board may be weakened. Therefore, a so-called prepreg in which a reinforcing member is impregnated with an insulating resin is used as the outermost insulating layer to ensure the strength as a wiring board (for example, see Patent Document 1).

特許第4108643号Japanese Patent No. 4108643

しかしながら、絶縁層としてプリプレグを用いると、最外の絶縁層を薄くした場合に、ガラスクロス等の補強部材が最外の絶縁層に埋め込まれた配線層と接触し、絶縁信頼性を低下させる問題があった。   However, when prepreg is used as the insulating layer, when the outermost insulating layer is thinned, a reinforcing member such as a glass cloth comes into contact with the wiring layer embedded in the outermost insulating layer, which lowers the insulation reliability. was there.

又、プリプレグは溶融粘度が高く樹脂の埋め込み性が十分ではないため、最外の絶縁層に埋め込まれた配線層が微細な場合には、配線層間に樹脂が十分に埋め込まれずにボイド等が発生し、絶縁信頼性を低下させる問題があった。   Also, since the prepreg has a high melt viscosity and the resin embedding property is not sufficient, if the wiring layer embedded in the outermost insulating layer is fine, the resin is not sufficiently embedded between the wiring layers and voids are generated. However, there was a problem of lowering the insulation reliability.

本発明は、上記の点に鑑みてなされたものであり、強度を確保すると共に絶縁信頼性を向上させた配線基板を提供することを課題とする。   This invention is made | formed in view of said point, and makes it a subject to provide the wiring board which improved the insulation reliability while ensuring intensity | strength.

本配線基板は、第1絶縁膜の一方の面に第2絶縁膜が積層され、前記第1絶縁膜の他方の面が外部に露出する絶縁層と、前記第1絶縁膜に埋め込まれ、所定面が前記第1絶縁膜の他方の面から露出するパッド及び配線パターンを有する第1配線層と、前記第2絶縁膜の前記第1絶縁膜の一方の面と接する面の反対面に形成された配線パターン、及び前記絶縁層を貫通し前記配線パターンと前記第1配線層とを接続するビア配線、を含む第2配線層と、を有し、前記第1絶縁膜は樹脂のみから構成され、前記第2絶縁膜は補強部材に樹脂を含浸させた構成とされていることを要件とする。   The wiring substrate includes a second insulating film laminated on one surface of the first insulating film, an insulating layer in which the other surface of the first insulating film is exposed to the outside, and embedded in the first insulating film. A first wiring layer having a pad and a wiring pattern exposed from the other surface of the first insulating film; and a surface of the second insulating film opposite to the surface in contact with one surface of the first insulating film. And a second wiring layer including a via wiring that penetrates the insulating layer and connects the wiring pattern and the first wiring layer, and the first insulating film is made of resin alone. The second insulating film is required to have a structure in which a reinforcing member is impregnated with resin.

開示の技術によれば、強度を確保すると共に絶縁信頼性を向上させた配線基板を提供できる。   According to the disclosed technology, it is possible to provide a wiring board that secures strength and improves insulation reliability.

第1の実施の形態に係る配線基板を例示する図(その1)である。1 is a diagram (part 1) illustrating a wiring board according to a first embodiment; 第1の実施の形態に係る配線基板の製造工程を例示する図(その1)である。FIG. 3 is a diagram (part 1) illustrating a manufacturing process of the wiring board according to the first embodiment; 第1の実施の形態に係る配線基板の製造工程を例示する図(その2)である。FIG. 6 is a diagram (part 2) illustrating the manufacturing process of the wiring board according to the first embodiment; 第1の実施の形態に係る配線基板を例示する図(その2)である。FIG. 3 is a diagram (part 2) illustrating the wiring board according to the first embodiment; 第1の実施の形態の変形例1に係る配線基板を例示する断面図である。It is sectional drawing which illustrates the wiring board which concerns on the modification 1 of 1st Embodiment. 第1の実施の形態の変形例1に係る配線基板の製造工程を例示する図である。It is a figure which illustrates the manufacturing process of the wiring board which concerns on the modification 1 of 1st Embodiment. 第1の実施の形態の変形例2に係る配線基板を例示する断面図(その1)である。9 is a cross-sectional view (part 1) illustrating a wiring board according to a second modification of the first embodiment; FIG. 第1の実施の形態の変形例2に係る配線基板の製造工程を例示する図(その1)である。It is FIG. (The 1) which illustrates the manufacturing process of the wiring board which concerns on the modification 2 of 1st Embodiment. 第1の実施の形態の変形例2に係る配線基板の製造工程を例示する図(その2)である。FIG. 11 is a diagram (No. 2) illustrating the manufacturing process of the wiring board according to the second modification of the first embodiment; 第1の実施の形態の変形例2に係る配線基板を例示する断面図(その2)である。FIG. 12 is a cross-sectional view (part 2) illustrating a wiring board according to a second modification of the first embodiment; 第2の実施の形態に係る配線基板を例示する断面図である。It is sectional drawing which illustrates the wiring board which concerns on 2nd Embodiment. 第2の実施の形態に係る配線基板の製造工程を例示する図である。It is a figure which illustrates the manufacturing process of the wiring board which concerns on 2nd Embodiment. 応用例1に係る半導体パッケージを例示する断面図である。12 is a cross-sectional view illustrating a semiconductor package according to Application Example 1. FIG. 応用例2に係る半導体パッケージを例示する断面図である。12 is a cross-sectional view illustrating a semiconductor package according to Application Example 2. FIG. 第3の実施の形態に係る配線基板を例示する断面図である。It is sectional drawing which illustrates the wiring board which concerns on 3rd Embodiment. 第3の実施の形態に係る配線基板の製造工程を例示する図(その1)である。It is FIG. (The 1) which illustrates the manufacturing process of the wiring board which concerns on 3rd Embodiment. 第3の実施の形態に係る配線基板の製造工程を例示する図(その2)である。It is FIG. (The 2) which illustrates the manufacturing process of the wiring board which concerns on 3rd Embodiment. 応用例3に係る半導体パッケージを例示する断面図である。12 is a cross-sectional view illustrating a semiconductor package according to Application Example 3. FIG.

以下、図面を参照して発明を実施するための形態について説明する。なお、各図面において、同一構成部分には同一符号を付し、重複した説明を省略する場合がある。   Hereinafter, embodiments for carrying out the invention will be described with reference to the drawings. In addition, in each drawing, the same code | symbol is attached | subjected to the same component and the overlapping description may be abbreviate | omitted.

〈第1の実施の形態〉
[第1の実施の形態に係る配線基板の構造]
まず、第1の実施の形態に係る配線基板の構造について説明する。図1は、第1の実施の形態に係る配線基板を例示する図であり、図1(a)は断面図、図1(b)は部分底面図である。
<First Embodiment>
[Structure of Wiring Board According to First Embodiment]
First, the structure of the wiring board according to the first embodiment will be described. 1A and 1B are diagrams illustrating a wiring board according to a first embodiment. FIG. 1A is a cross-sectional view, and FIG. 1B is a partial bottom view.

図1を参照するに、第1の実施の形態に係る配線基板1は、配線層10と、絶縁層20と、配線層40と、ソルダーレジスト層50及び60とを有するコアレスのビルドアップ配線基板である。   Referring to FIG. 1, a wiring board 1 according to a first embodiment includes a coreless build-up wiring board having a wiring layer 10, an insulating layer 20, a wiring layer 40, and solder resist layers 50 and 60. It is.

なお、本実施の形態では、便宜上、配線基板1のソルダーレジスト層50側を上側又は一方の側、ソルダーレジスト層60側を下側又は他方の側とする。又、各部位のソルダーレジスト層50側の面を一方の面又は上面、ソルダーレジスト層60側の面を他方の面又は下面とする。但し、配線基板1は天地逆の状態で用いることができ、又は任意の角度で配置することができる。又、平面視とは対象物をソルダーレジスト層50の一方の面の法線方向から視ることを指し、平面形状とは対象物をソルダーレジスト層50の一方の面の法線方向から視た形状を指すものとする。   In the present embodiment, for the sake of convenience, the solder resist layer 50 side of the wiring board 1 is referred to as the upper side or one side, and the solder resist layer 60 side is referred to as the lower side or the other side. Further, the surface on the solder resist layer 50 side of each part is defined as one surface or upper surface, and the surface on the solder resist layer 60 side is defined as the other surface or lower surface. However, the wiring board 1 can be used upside down, or can be arranged at an arbitrary angle. Further, the plan view refers to viewing the object from the normal direction of one surface of the solder resist layer 50, and the planar shape refers to the object viewed from the normal direction of one surface of the solder resist layer 50. It shall refer to the shape.

配線基板1において、第1配線層である配線層10は、半導体チップとの接続端子となる複数のパッド10aと、パッド10aと接続された配線パターン10bとを含んでいる。なお、主として、ソルダーレジスト層60の開口部60xから露出している部分がパッド10aであり、ソルダーレジスト層60に被覆されている部分が配線パターン10bである。しかし、配線パターン10bの一部がソルダーレジスト層60の開口部60xから露出してもよい。配線層10の材料としては、例えば、銅(Cu)等を用いることができる。配線層10の厚さは、例えば、1〜35μm程度とすることができる。   In the wiring substrate 1, the wiring layer 10 as the first wiring layer includes a plurality of pads 10a serving as connection terminals to the semiconductor chip and a wiring pattern 10b connected to the pads 10a. Note that the portion exposed from the opening 60x of the solder resist layer 60 is mainly the pad 10a, and the portion covered with the solder resist layer 60 is the wiring pattern 10b. However, a part of the wiring pattern 10 b may be exposed from the opening 60 x of the solder resist layer 60. As a material of the wiring layer 10, for example, copper (Cu) or the like can be used. The thickness of the wiring layer 10 can be set to, for example, about 1 to 35 μm.

絶縁層20は、第1絶縁膜21と、第1絶縁膜21の上面(一方の面)に積層された第2絶縁膜22とを備えている。第1絶縁膜21は最外の絶縁層であり、第1絶縁膜21の下面(他方の面)の一部は配線基板1の外部に露出している。本実施の形態では、第1絶縁膜21の下面が半導体チップを搭載するチップ搭載面である。第1絶縁膜21は、絶縁性樹脂のみから構成されている。なお、本願において『絶縁性樹脂のみから構成されている』とは、補強部材を含有していないことを意味し、フィラー等の添加物の含有を妨げるものではない。   The insulating layer 20 includes a first insulating film 21 and a second insulating film 22 stacked on the upper surface (one surface) of the first insulating film 21. The first insulating film 21 is the outermost insulating layer, and a part of the lower surface (the other surface) of the first insulating film 21 is exposed to the outside of the wiring substrate 1. In the present embodiment, the lower surface of the first insulating film 21 is a chip mounting surface on which a semiconductor chip is mounted. The first insulating film 21 is composed only of an insulating resin. In the present application, “consisting only of an insulating resin” means that it does not contain a reinforcing member, and does not hinder the inclusion of additives such as fillers.

第1絶縁膜21は、配線層10を被覆している。より詳しくは、第1絶縁膜21は、配線層10の側面及び上面を被覆している。言い換えれば、配線層10は第1絶縁膜21に埋め込まれ、下面が第1絶縁膜21の下面から露出している。第1絶縁膜21の下面と配線層10の下面とは、例えば、面一とすることができる。   The first insulating film 21 covers the wiring layer 10. More specifically, the first insulating film 21 covers the side surface and the upper surface of the wiring layer 10. In other words, the wiring layer 10 is embedded in the first insulating film 21, and the lower surface is exposed from the lower surface of the first insulating film 21. For example, the lower surface of the first insulating film 21 and the lower surface of the wiring layer 10 can be flush with each other.

第1絶縁膜21に用いる絶縁性樹脂としては、例えば、エポキシ系樹脂、イミド系樹脂、フェノール系樹脂、シアネート系樹脂等を挙げることができる。第1絶縁膜21に用いる絶縁性樹脂は、例えば、熱硬化性樹脂とすることができる。第1絶縁膜21の厚さは、例えば、1〜100μm程度とすることができる。第1絶縁膜21は、シリカ(SiO)等のフィラーを含有しても構わない。 Examples of the insulating resin used for the first insulating film 21 include an epoxy resin, an imide resin, a phenol resin, and a cyanate resin. The insulating resin used for the first insulating film 21 can be, for example, a thermosetting resin. The thickness of the first insulating film 21 can be set to about 1 to 100 μm, for example. The first insulating film 21 may contain a filler such as silica (SiO 2 ).

第2絶縁膜22は、補強部材30に絶縁性樹脂を含浸させた構成とされている。なお、本願において『補強部材に絶縁性樹脂を含浸させた構成とされている』とは、絶縁膜が少なくとも補強部材及び絶縁性樹脂を有していることを意味し、フィラー等の添加物の含有を妨げるものではない。   The second insulating film 22 is configured by impregnating the reinforcing member 30 with an insulating resin. In the present application, “the reinforcing member is configured to be impregnated with an insulating resin” means that the insulating film has at least the reinforcing member and the insulating resin. It does not prevent inclusion.

補強部材30としては、例えば、ガラス繊維、炭素繊維、アラミド繊維等の織布や不織布等を用いることができる。第2絶縁膜22に用いる絶縁性樹脂としては、例えば、エポキシ系樹脂、イミド系樹脂、フェノール系樹脂、シアネート系樹脂等を挙げることができる。第2絶縁膜22に用いる絶縁性樹脂は、例えば、熱硬化性樹脂とすることができる。第2絶縁膜22の厚さは、例えば、15〜200μm程度とすることができる。第2絶縁膜22は、シリカ(SiO)等のフィラーを含有しても構わない。 As the reinforcing member 30, for example, woven or non-woven fabric such as glass fiber, carbon fiber, and aramid fiber can be used. Examples of the insulating resin used for the second insulating film 22 include an epoxy resin, an imide resin, a phenol resin, and a cyanate resin. The insulating resin used for the second insulating film 22 can be, for example, a thermosetting resin. The thickness of the second insulating film 22 can be, for example, about 15 to 200 μm. The second insulating film 22 may contain a filler such as silica (SiO 2 ).

なお、第1絶縁膜21と第2絶縁膜22に用いる絶縁性樹脂の種類や厚さは独立に決定することができる。つまり、第1絶縁膜21と第2絶縁膜22には、同一の絶縁性樹脂を用いてもよいし、異なる絶縁性樹脂を用いてもよい。又、第1絶縁膜21と第2絶縁膜22とは、同一の厚さであってもよいし、異なる厚さであってもよい。又、第1絶縁膜21と第2絶縁膜22の何れか一方がフィラーを含有してもよいし、双方がフィラーを含有してもよい。又、双方がフィラーを含有する場合、フィラーの種類や含有量は同一としてもよいし、異なっていてもよい。なお、第1絶縁膜21と第2絶縁膜22の何れについても、絶縁性樹脂の種類や厚さ、フィラーの種類や含有量等を調整し、CTE(熱膨張係数)を15ppm/℃以下にすることにより、配線基板1の反りを抑制可能となる。   The type and thickness of the insulating resin used for the first insulating film 21 and the second insulating film 22 can be determined independently. That is, the same insulating resin may be used for the first insulating film 21 and the second insulating film 22, or different insulating resins may be used. Further, the first insulating film 21 and the second insulating film 22 may have the same thickness or different thicknesses. Further, either one of the first insulating film 21 and the second insulating film 22 may contain a filler, or both may contain a filler. Moreover, when both contain a filler, the kind and content of a filler may be the same, and may differ. For both the first insulating film 21 and the second insulating film 22, the type and thickness of the insulating resin, the type and content of the filler, etc. are adjusted so that the CTE (thermal expansion coefficient) is 15 ppm / ° C. or less. By doing so, the warp of the wiring board 1 can be suppressed.

第2配線層である配線層40は、絶縁層20上に形成されている。配線層40は、絶縁層20(第2絶縁膜22及び第1絶縁膜21)を貫通し配線層10の上面を露出するビアホール20x内に充填されたビア配線、及び第2絶縁膜22の上面に形成された配線パターンを含んで構成されている。ビアホール20xは、ソルダーレジスト層50側に開口されている開口部の径が配線層10の上面によって形成された開口部の底面の径よりも大きい逆円錐台状の凹部となっている。   The wiring layer 40 that is the second wiring layer is formed on the insulating layer 20. The wiring layer 40 includes a via wiring filled in the via hole 20 x that penetrates the insulating layer 20 (the second insulating film 22 and the first insulating film 21) and exposes the upper surface of the wiring layer 10, and the upper surface of the second insulating film 22. It is comprised including the wiring pattern formed in this. The via hole 20x is an inverted frustoconical concave portion in which the diameter of the opening opened on the solder resist layer 50 side is larger than the diameter of the bottom surface of the opening formed by the upper surface of the wiring layer 10.

配線層40は、ビアホール20xの底部に露出した配線層10と電気的に接続されている。配線層40の材料としては、例えば、銅(Cu)等を用いることができる。配線層40を構成する配線パターンの厚さは、例えば1〜35μm程度とすることができる。   The wiring layer 40 is electrically connected to the wiring layer 10 exposed at the bottom of the via hole 20x. As a material of the wiring layer 40, for example, copper (Cu) or the like can be used. The thickness of the wiring pattern constituting the wiring layer 40 can be, for example, about 1 to 35 μm.

ソルダーレジスト層50は、第2絶縁膜22の上面に、配線層40を被覆するように形成されている。ソルダーレジスト層50は開口部50xを有し、開口部50xの底部には配線層40の一部が露出している。開口部50xの底部に露出する配線層40は、他の配線基板や半導体パッケージ、半導体チップ等と電気的に接続されるパッドとして機能する。ソルダーレジスト層50の材料としては、例えば、感光性のエポキシ系絶縁性樹脂やアクリル系絶縁性樹脂等を用いることができる。ソルダーレジスト層50の厚さは、例えば5〜40μm程度とすることができる。   The solder resist layer 50 is formed on the upper surface of the second insulating film 22 so as to cover the wiring layer 40. The solder resist layer 50 has an opening 50x, and a part of the wiring layer 40 is exposed at the bottom of the opening 50x. The wiring layer 40 exposed at the bottom of the opening 50x functions as a pad that is electrically connected to another wiring board, a semiconductor package, a semiconductor chip, or the like. As a material of the solder resist layer 50, for example, a photosensitive epoxy insulating resin or an acrylic insulating resin can be used. The thickness of the solder resist layer 50 can be set to, for example, about 5 to 40 μm.

必要に応じ、開口部50xから露出する配線層40の上面に金属層を形成してもよい。金属層の例としては、Au層や、Ni/Au層(Ni層とAu層をこの順番で積層した金属層)、Ni/Pd/Au層(Ni層とPd層とAu層をこの順番で積層した金属層)等を挙げることができる。又、金属層の形成に代えて、OSP(Organic Solderability Preservative)処理等の酸化防止処理を施してもよい。なお、OSP処理により形成される表面処理層は、アゾール化合物やイミダゾール化合物等からなる有機被膜である。   If necessary, a metal layer may be formed on the upper surface of the wiring layer 40 exposed from the opening 50x. Examples of metal layers include an Au layer, a Ni / Au layer (a metal layer in which an Ni layer and an Au layer are stacked in this order), and a Ni / Pd / Au layer (a Ni layer, a Pd layer, and an Au layer in this order). And a laminated metal layer). Further, instead of forming the metal layer, an antioxidant treatment such as an OSP (Organic Solderability Preservative) treatment may be performed. The surface treatment layer formed by the OSP treatment is an organic film made of an azole compound or an imidazole compound.

ソルダーレジスト層60は、第1絶縁膜21の下面に、配線層10を被覆するように形成されている。ソルダーレジスト層60は開口部60xを有し、開口部60xの底部には配線層10のパッド10aが主に露出している。ソルダーレジスト層60の材料としては、例えば、感光性のエポキシ系絶縁性樹脂やアクリル系絶縁性樹脂等を用いることができる。ソルダーレジスト層60の厚さは、例えば5〜40μm程度とすることができる。必要に応じ、開口部60xから露出する配線層10の下面に前述の金属層を形成したり、酸化防止処理を施したりしてもよい。   The solder resist layer 60 is formed on the lower surface of the first insulating film 21 so as to cover the wiring layer 10. The solder resist layer 60 has an opening 60x, and the pad 10a of the wiring layer 10 is mainly exposed at the bottom of the opening 60x. As a material of the solder resist layer 60, for example, a photosensitive epoxy insulating resin or an acrylic insulating resin can be used. The thickness of the solder resist layer 60 can be set to, for example, about 5 to 40 μm. If necessary, the above-described metal layer may be formed on the lower surface of the wiring layer 10 exposed from the opening 60x, or an oxidation treatment may be performed.

なお、配線層10のパッド10aは、数μm〜10数μm程度の間隔で隣接するため、ソルダーレジスト層60に、各パッド10aの下面を個別に露出する複数の開口部を設けることは困難である。そこで、本実施の形態では、ソルダーレジスト層60に、配線層10の全パッド10aの下面を一括で露出する1つの開口部60xを設けている。もちろん、パッド10aが狭ピッチでなければ、ソルダーレジスト層60に、各パッド10aの下面を個別に露出する複数の開口部を設けてもよい。   Since the pads 10a of the wiring layer 10 are adjacent to each other with an interval of several μm to several tens of μm, it is difficult to provide a plurality of openings in the solder resist layer 60 that individually expose the lower surfaces of the pads 10a. is there. Therefore, in the present embodiment, the solder resist layer 60 is provided with one opening 60x that collectively exposes the lower surfaces of all the pads 10a of the wiring layer 10. Of course, if the pads 10a are not narrow in pitch, the solder resist layer 60 may be provided with a plurality of openings that individually expose the lower surfaces of the pads 10a.

[第1の実施の形態に係る配線基板の製造方法]
次に、第1の実施の形態に係る配線基板の製造方法について説明する。図2及び図3は、第1の実施の形態に係る配線基板の製造工程を例示する図である。本実施の形態では、支持体上に複数の配線基板となる部分を作製し支持体を除去後個片化して各配線基板とする工程の例を示すが、支持体上に1個ずつ配線基板を作製し支持体を除去する工程としてもよい。
[Method for Manufacturing Wiring Board According to First Embodiment]
Next, a method for manufacturing a wiring board according to the first embodiment will be described. 2 and 3 are diagrams illustrating the manufacturing process of the wiring board according to the first embodiment. In this embodiment, an example of a process in which a part to be a plurality of wiring boards is formed on a support, and the support is removed and separated into individual wiring boards is shown. However, one wiring board is provided on each support. It is good also as a process of producing and removing a support body.

まず、図2(a)に示す工程では、上面が平坦面である支持体300を準備し、支持体300の上面に配線層10を形成する。支持体300としては、金属板や金属箔等を用いることができるが、本実施の形態では、支持体300として銅箔を用いる例を示す。支持体300の厚さは、例えば18〜100μm程度とすることができる。   First, in the process illustrated in FIG. 2A, a support body 300 having a flat upper surface is prepared, and the wiring layer 10 is formed on the upper surface of the support body 300. As the support 300, a metal plate, a metal foil, or the like can be used. In this embodiment, an example in which a copper foil is used as the support 300 is shown. The thickness of the support 300 can be, for example, about 18 to 100 μm.

配線層10を形成するには、まず、支持体300の上面に、配線層10を形成する部分に開口部を備えたレジスト層(例えば、ドライフィルムレジスト等)を形成する。そして、支持体300をめっき給電層に利用する電解めっき法等により、レジスト層の開口部内に露出する支持体300の上面に配線層10を形成する。その後、レジスト層を除去する。配線層10の材料や厚さは、前述の通りである。   In order to form the wiring layer 10, first, a resist layer (for example, a dry film resist) having an opening in a portion where the wiring layer 10 is formed is formed on the upper surface of the support 300. Then, the wiring layer 10 is formed on the upper surface of the support 300 exposed in the opening of the resist layer by an electrolytic plating method using the support 300 as a plating power feeding layer. Thereafter, the resist layer is removed. The material and thickness of the wiring layer 10 are as described above.

次に、図2(b)に示す工程では、例えば、支持体300の上面に配線層10の上面及び側面を被覆するように熱硬化性のエポキシ系絶縁性樹脂等をラミネートし、Bステージ状態(半硬化状態)の第1絶縁膜21を形成する。第1絶縁膜21は、絶縁性樹脂のみから構成されている。この工程では、第1絶縁膜21の硬化は行わない。   Next, in the step shown in FIG. 2B, for example, a thermosetting epoxy insulating resin or the like is laminated on the upper surface of the support 300 so as to cover the upper surface and side surfaces of the wiring layer 10, and the B stage state. The (semi-cured state) first insulating film 21 is formed. The first insulating film 21 is composed only of an insulating resin. In this step, the first insulating film 21 is not cured.

なお、配線層10を形成する工程で、ドライフィルムレジスト等のレジスト層に代えて、感光性の永久絶縁膜を使用してもよい。この場合には、永久絶縁膜の開口部に配線層10を形成後、永久絶縁膜を除去することなく、そのまま第1絶縁膜21として使用することができる。   In the step of forming the wiring layer 10, a photosensitive permanent insulating film may be used instead of a resist layer such as a dry film resist. In this case, after forming the wiring layer 10 in the opening of the permanent insulating film, it can be used as it is as the first insulating film 21 without removing the permanent insulating film.

次に、図2(c)に示す工程では、例えば、第1絶縁膜21の上面に熱硬化性のエポキシ系絶縁性樹脂等をラミネートし、Bステージ状態(半硬化状態)の第2絶縁膜22を積層する。第2絶縁膜22は補強部材30に絶縁性樹脂を含浸させた構造の所謂プリプレグである。補強部材30の材料は、前述の通りである。第1絶縁膜21の上面に第2絶縁膜22を積層後、第1絶縁膜21及び第2絶縁膜22を所定温度に加熱して硬化させ、絶縁層20を作製する。必要に応じて、加圧しながら加熱してもよい。   Next, in the step shown in FIG. 2C, for example, a thermosetting epoxy insulating resin or the like is laminated on the upper surface of the first insulating film 21, and the second insulating film in the B stage state (semi-cured state). 22 is laminated. The second insulating film 22 is a so-called prepreg having a structure in which the reinforcing member 30 is impregnated with an insulating resin. The material of the reinforcing member 30 is as described above. After the second insulating film 22 is laminated on the upper surface of the first insulating film 21, the first insulating film 21 and the second insulating film 22 are cured by heating to a predetermined temperature, and the insulating layer 20 is manufactured. If necessary, heating may be performed while applying pressure.

ここで、樹脂のみからなる第1絶縁膜21の溶融粘度に比較し、補強部材30を含む第2絶縁膜22の溶融粘度は高くなる。本実施の形態では、配線層10は比較的溶融粘度の低い第1絶縁膜21に被覆されているため、配線層10の配線密度が高い場合や、配線層10の残銅率が高い場合であっても、配線層10同士の隙間に、溶融した絶縁性樹脂が入り込む。そのため、配線層10を比較的溶融粘度の高い補強部材入りの絶縁膜で被覆した場合のように、絶縁性樹脂の埋め込みが不十分でボイドが発生する問題が生じ難い。なお、残銅率とは、絶縁層表面に占める配線層の面積の割合である。   Here, the melt viscosity of the second insulating film 22 including the reinforcing member 30 is higher than the melt viscosity of the first insulating film 21 made of resin alone. In the present embodiment, since the wiring layer 10 is covered with the first insulating film 21 having a relatively low melt viscosity, the wiring layer 10 has a high wiring density or the wiring layer 10 has a high residual copper ratio. Even if it exists, the melted insulating resin enters the gap between the wiring layers 10. Therefore, unlike the case where the wiring layer 10 is covered with an insulating film containing a reinforcing member having a relatively high melt viscosity, the problem that voids are generated due to insufficient embedding of the insulating resin is unlikely to occur. The remaining copper ratio is the ratio of the area of the wiring layer to the surface of the insulating layer.

又、一般に、配線層が補強部材と接触すると、補強部材に沿ってマイグレーションが発生する場合がある。例えば、補強部材としてガラスクロスを用いた場合、ガラスクロスの繊維に沿ってマイグレーションが発生し、隣接する配線パターン同士が短絡するおそれがある。配線基板1では、配線層10が補強部材と接触するおそれがないため、マイグレーションの発生を抑制可能となり、配線基板1の絶縁信頼性を向上できる。   In general, when the wiring layer comes into contact with the reinforcing member, migration may occur along the reinforcing member. For example, when glass cloth is used as the reinforcing member, migration may occur along the fibers of the glass cloth, and adjacent wiring patterns may be short-circuited. In the wiring board 1, since there is no possibility that the wiring layer 10 contacts the reinforcing member, the occurrence of migration can be suppressed, and the insulation reliability of the wiring board 1 can be improved.

特に、配線基板1では、最外の配線層10はパッド10aのみから構成されているのではなく、パッド10aと配線パターン10bとを含んでいる。そのため、残銅率が場所により大きく異なる場合があるが、そのような場合でも比較的溶融粘度の低い第1絶縁膜21により配線層10同士の隙間を十分に埋め込むことが可能となる。   In particular, in the wiring board 1, the outermost wiring layer 10 is not composed of only the pad 10a but includes the pad 10a and the wiring pattern 10b. Therefore, although the remaining copper ratio may vary greatly depending on the location, even in such a case, the gap between the wiring layers 10 can be sufficiently filled with the first insulating film 21 having a relatively low melt viscosity.

次に、図2(d)に示す工程では、絶縁層20に、絶縁層20(第2絶縁膜22及び第1絶縁膜21)を貫通し配線層10の上面を露出させるビアホール20xを形成する。ビアホール20xは、例えばCOレーザ等を用いたレーザ加工法により形成できる。レーザ加工法により形成したビアホール20xは、ソルダーレジスト層50が形成される側に開口されている開口部の径が配線層10の上面によって形成された開口部の底面の径よりも大きい逆円錐台状の凹部となる。ビアホール20xをレーザ加工法により形成した場合には、デスミア処理を行い、ビアホール20xの底部に露出する配線層10の上面に付着した絶縁層20の樹脂残渣を除去することが好ましい。 Next, in the step shown in FIG. 2D, a via hole 20x is formed in the insulating layer 20 so as to penetrate the insulating layer 20 (the second insulating film 22 and the first insulating film 21) and expose the upper surface of the wiring layer 10. . The via hole 20x can be formed by a laser processing method using, for example, a CO 2 laser. The via hole 20x formed by the laser processing method is an inverted truncated cone in which the diameter of the opening opened on the side where the solder resist layer 50 is formed is larger than the diameter of the bottom of the opening formed by the upper surface of the wiring layer 10. It becomes a concave part. When the via hole 20x is formed by a laser processing method, it is preferable to perform a desmear process to remove the resin residue of the insulating layer 20 attached to the upper surface of the wiring layer 10 exposed at the bottom of the via hole 20x.

なお、第1絶縁膜21と第2絶縁膜22に異なる樹脂を用いていたり、夫々のフィラー含有量を変えていたりする場合がある。この場合には、第2絶縁膜22にレーザを照射する段階と、第2絶縁膜22が貫通して第1絶縁膜21にレーザを照射する段階で、レーザの照射条件等を変更しても構わない。第1絶縁膜21と第2絶縁膜22との境界部において、ビアホール20xの内壁面に段差等を生じさせないためである。或いは、デスミア処理の条件を調整することで、ビアホール20xの内壁面の形状を制御することも可能である。   In some cases, different resins may be used for the first insulating film 21 and the second insulating film 22, or the respective filler contents may be changed. In this case, even if the laser irradiation conditions are changed between the stage of irradiating the second insulating film 22 with laser and the stage of penetrating the second insulating film 22 and irradiating the first insulating film 21 with laser. I do not care. This is because a step or the like is not generated on the inner wall surface of the via hole 20x at the boundary between the first insulating film 21 and the second insulating film 22. Alternatively, the shape of the inner wall surface of the via hole 20x can be controlled by adjusting the desmear processing conditions.

次に、図3(a)に示す工程では、絶縁層20上に配線層40を形成する。配線層40は、ビアホール20x内に充填されたビア配線、及び絶縁層20の上面に形成された配線パターンを含んで構成される。配線層40は、ビアホール20xの底部に露出した配線層10と電気的に接続される。配線層40の材料としては、例えば銅(Cu)等を用いることができる。配線層40は、セミアディティブ法やサブトラクティブ法等の各種の配線層形成方法を用いて形成できる。   Next, in the step shown in FIG. 3A, the wiring layer 40 is formed on the insulating layer 20. The wiring layer 40 includes a via wiring filled in the via hole 20 x and a wiring pattern formed on the upper surface of the insulating layer 20. The wiring layer 40 is electrically connected to the wiring layer 10 exposed at the bottom of the via hole 20x. As a material of the wiring layer 40, for example, copper (Cu) or the like can be used. The wiring layer 40 can be formed using various wiring layer forming methods such as a semi-additive method and a subtractive method.

次に、図3(b)に示す工程では、絶縁層20上に配線層40を被覆するソルダーレジスト層50を形成する。ソルダーレジスト層50は、例えば、液状又はペースト状の感光性のエポキシ系絶縁性樹脂やアクリル系絶縁性樹脂等を、配線層40を被覆するように絶縁層20上にスクリーン印刷法、ロールコート法、又は、スピンコート法等で塗布することにより形成できる。或いは、例えば、フィルム状の感光性のエポキシ系絶縁性樹脂やアクリル系絶縁性樹脂等を、配線層40を被覆するように絶縁層20上にラミネートすることにより形成してもよい。   Next, in the step shown in FIG. 3B, a solder resist layer 50 that covers the wiring layer 40 is formed on the insulating layer 20. The solder resist layer 50 is, for example, a liquid or paste-like photosensitive epoxy insulating resin, acrylic insulating resin, or the like on the insulating layer 20 so as to cover the wiring layer 40 by a screen printing method or a roll coating method. Or it can form by apply | coating by the spin coat method etc. Alternatively, for example, a film-like photosensitive epoxy insulating resin, acrylic insulating resin, or the like may be laminated on the insulating layer 20 so as to cover the wiring layer 40.

そして、塗布又はラミネートした絶縁性樹脂を露光及び現像することで開口部50xを形成する(フォトリソグラフィ法)。これにより、開口部50xを有するソルダーレジスト層50が形成される。なお、予め開口部50xを形成したフィルム状の絶縁性樹脂を、配線層40を被覆するように絶縁層20上にラミネートしても構わない。なお、ソルダーレジスト層50の材料として、非感光性の絶縁性樹脂を用いてもよい。この場合には、絶縁層20上にソルダーレジスト層50を形成して硬化させた後、例えばCOレーザ等を用いたレーザ加工法や、アルミナ砥粒等の研磨剤を用いたブラスト処理により開口部50xを形成できる。又は、スクリーン印刷により、開口部50xを有するソルダーレジスト層50を形成してもよい。 And the opening part 50x is formed by exposing and developing the apply | coated or laminated insulating resin (photolithography method). Thereby, the solder resist layer 50 having the opening 50x is formed. Note that a film-like insulating resin in which the opening 50x is formed in advance may be laminated on the insulating layer 20 so as to cover the wiring layer 40. Note that a non-photosensitive insulating resin may be used as the material of the solder resist layer 50. In this case, after the solder resist layer 50 is formed on the insulating layer 20 and cured, the openings are formed by, for example, a laser processing method using a CO 2 laser or the like, or a blasting process using an abrasive such as alumina abrasive grains. The part 50x can be formed. Or you may form the soldering resist layer 50 which has the opening part 50x by screen printing.

これにより、配線層40の一部が開口部50x内に露出する。開口部50x内に露出する配線層40は、他の配線基板や半導体パッケージ、半導体チップ等と電気的に接続されるパッドとして機能する。必要に応じ、開口部50xの底部に露出する配線層40の上面に、例えば無電解めっき法等により金属層を形成してもよい。金属層の例としては、前述の通りである。又、開口部50xの底部に露出する配線層40の上面に、OSP処理等の酸化防止処理を施してもよい。なお、ソルダーレジスト層50を形成する工程は、支持体300の除去後であってもよい。この場合、ソルダーレジスト層50とソルダーレジスト層60を同時に形成するとよい。   Thereby, a part of the wiring layer 40 is exposed in the opening 50x. The wiring layer 40 exposed in the opening 50x functions as a pad that is electrically connected to another wiring board, a semiconductor package, a semiconductor chip, or the like. If necessary, a metal layer may be formed on the upper surface of the wiring layer 40 exposed at the bottom of the opening 50x by, for example, an electroless plating method. Examples of the metal layer are as described above. Further, the upper surface of the wiring layer 40 exposed at the bottom of the opening 50x may be subjected to an oxidation treatment such as OSP treatment. Note that the step of forming the solder resist layer 50 may be after the support 300 is removed. In this case, the solder resist layer 50 and the solder resist layer 60 are preferably formed simultaneously.

次に、図3(c)に示す工程では、図3(b)に示す支持体300を除去した後、絶縁層20の下面に、配線層10のパッド10aを主に露出する開口部60xを備えたソルダーレジスト層60を形成する。銅箔である支持体300は、例えば、塩化第二鉄水溶液や塩化第二銅水溶液、過硫酸アンモニウム水溶液等を用いたウェットエッチングにより除去できる。ソルダーレジスト層60は、ソルダーレジスト層50と同様の方法で形成できる。必要に応じ、開口部60xから露出する配線層10の下面に金属層を形成したり、酸化防止処理を施したりしてもよい。なお、前述のように、配線層10のパッド10aは数μm〜10数μm程度の間隔で隣接するため、本実施の形態では、一例として、ソルダーレジスト層60に、配線層10の全パッド10aの下面を一括で露出する1つの開口部60xを設けている。   Next, in the step shown in FIG. 3C, after removing the support 300 shown in FIG. 3B, an opening 60 x that mainly exposes the pad 10 a of the wiring layer 10 is formed on the lower surface of the insulating layer 20. The provided solder resist layer 60 is formed. The support 300, which is a copper foil, can be removed by wet etching using, for example, a ferric chloride aqueous solution, a cupric chloride aqueous solution, an ammonium persulfate aqueous solution, or the like. The solder resist layer 60 can be formed by the same method as the solder resist layer 50. If necessary, a metal layer may be formed on the lower surface of the wiring layer 10 exposed from the opening 60x, or an antioxidant treatment may be performed. As described above, since the pads 10a of the wiring layer 10 are adjacent to each other with an interval of about several μm to several tens of μm, in this embodiment, as an example, all the pads 10a of the wiring layer 10 are disposed on the solder resist layer 60. One opening 60x that exposes the lower surfaces of the two at a time is provided.

図3(c)に示す工程の後、図3(c)に示す構造体をスライサー等により切断位置Cで切断して個片化することにより、複数の配線基板1(図1参照)が完成する。必要に応じ、ソルダーレジスト層50の開口部50x内に露出する配線層40上や、ソルダーレジスト層60の開口部60x内に露出する配線層10上に、はんだボール等の外部接続端子を設けたり、チップキャパシタ等の電子部品を搭載したりしてもよい。又、切断前の構造体に外部接続端子を設けたり電子部品を搭載したりし、その後、構造体を切断して個片化する工程としてもよい。   After the step shown in FIG. 3C, the structure shown in FIG. 3C is cut into pieces by cutting at a cutting position C with a slicer or the like to complete a plurality of wiring boards 1 (see FIG. 1). To do. If necessary, external connection terminals such as solder balls may be provided on the wiring layer 40 exposed in the opening 50x of the solder resist layer 50 or on the wiring layer 10 exposed in the opening 60x of the solder resist layer 60. An electronic component such as a chip capacitor may be mounted. Alternatively, an external connection terminal or an electronic component may be provided on the structure before cutting, and then the structure may be cut into pieces.

このように、第1の実施の形態に係る配線基板1では、最外の配線層10が、樹脂のみからなり比較的溶融粘度の低い第1絶縁膜21に埋め込まれている。そのため、配線層10の配線密度が高い場合や、配線層10の残銅率が高い場合であっても、絶縁性樹脂の埋め込みが不十分でボイドが発生する問題が生じ難く、又、配線層10が補強部材と接触するおそれもない。その結果、配線基板1の絶縁信頼性を向上できる。   Thus, in the wiring substrate 1 according to the first embodiment, the outermost wiring layer 10 is made of only resin and is embedded in the first insulating film 21 having a relatively low melt viscosity. Therefore, even when the wiring density of the wiring layer 10 is high or the remaining copper ratio of the wiring layer 10 is high, the problem that the insulating resin is not sufficiently embedded and voids occur is difficult to occur. There is no possibility that 10 contacts with the reinforcing member. As a result, the insulation reliability of the wiring board 1 can be improved.

又、絶縁層20は、樹脂のみからなる第1絶縁膜21と補強部材を備えた第2絶縁膜22との2層構造であるため、絶縁層20全体の強度は従来のプリプレグと同程度であり、配線基板1としての強度を確保できる。   Further, since the insulating layer 20 has a two-layer structure of the first insulating film 21 made only of resin and the second insulating film 22 provided with the reinforcing member, the strength of the entire insulating layer 20 is about the same as that of a conventional prepreg. In addition, the strength as the wiring board 1 can be secured.

又、従来のように、補強部材を備えた絶縁膜を用いて配線層を埋め込むと、補強部材を備えた絶縁膜では埋め込みに使用できる樹脂の量が少ないため、絶縁膜の上面に凹凸が生じやすく、絶縁膜の上面に配線層を形成することが困難となる。これに対し、本実施の形態では、補強部材を備えた第2絶縁膜22は第1絶縁膜21上に形成され、第2絶縁膜22の樹脂は配線層10の埋め込みには使用されないため、第2絶縁膜22の上面は平坦面となる。従って、第2絶縁膜22の上面に容易に配線層40を形成できる。   In addition, when the wiring layer is embedded using an insulating film provided with a reinforcing member as in the conventional case, the insulating film provided with the reinforcing member has a small amount of resin that can be used for embedding, so that the top surface of the insulating film is uneven. It is easy to form a wiring layer on the upper surface of the insulating film. In contrast, in the present embodiment, the second insulating film 22 provided with the reinforcing member is formed on the first insulating film 21, and the resin of the second insulating film 22 is not used for embedding the wiring layer 10. The upper surface of the second insulating film 22 is a flat surface. Accordingly, the wiring layer 40 can be easily formed on the upper surface of the second insulating film 22.

又、第1絶縁膜21と第2絶縁膜22の特性は任意に設定できるため、設計自由度を向上できる。例えば、第1絶縁膜21として配線層10との密着性に優れた樹脂を選択したり、絶縁性の高い樹脂(耐マイグレーション性が高い樹脂)を選択したり、溶融粘度の特に低い樹脂を選択したりすることが可能となる。これらは、何れも配線基板1の絶縁信頼性の向上に寄与できる。或いは、フィラー含有量等により、第1絶縁膜21と第2絶縁膜22のCTEを個別に調整できるため、配線基板1全体での反りを低減することが容易となる。   Moreover, since the characteristics of the first insulating film 21 and the second insulating film 22 can be set arbitrarily, the degree of freedom in design can be improved. For example, a resin having excellent adhesion to the wiring layer 10 is selected as the first insulating film 21, a resin having a high insulating property (a resin having a high migration resistance), or a resin having a particularly low melt viscosity is selected. It becomes possible to do. Any of these can contribute to the improvement of the insulation reliability of the wiring board 1. Alternatively, since the CTE of the first insulating film 21 and the second insulating film 22 can be individually adjusted depending on the filler content and the like, it is easy to reduce the warpage of the entire wiring board 1.

又、本実施の形態では、配線層10の側面だけではなく、配線層10の上面も樹脂のみからなる第1絶縁膜21で被覆されている。そのため、配線層10と第2絶縁膜22内の補強部材30との距離を十分に確保できるため、特に吸湿したときの絶縁信頼性を向上することができる。   In the present embodiment, not only the side surface of the wiring layer 10 but also the upper surface of the wiring layer 10 is covered with the first insulating film 21 made of resin alone. Therefore, a sufficient distance between the wiring layer 10 and the reinforcing member 30 in the second insulating film 22 can be secured, so that the insulation reliability can be improved particularly when moisture is absorbed.

なお、支持体300と配線層10とが同じ金属(例えば、銅等)からなる場合、図3(c)の工程で支持体300を除去した際に、配線層10の下面がエッチングされ、配線層10の下面が第1絶縁膜21の下面よりも窪んだ状態になる場合がある。この場合、図4に示す配線基板1Aの構造となる。配線基板1Aも配線基板1と同等の性能である。   When the support 300 and the wiring layer 10 are made of the same metal (for example, copper), the lower surface of the wiring layer 10 is etched when the support 300 is removed in the process of FIG. In some cases, the lower surface of the layer 10 is depressed more than the lower surface of the first insulating film 21. In this case, the structure of the wiring board 1A shown in FIG. 4 is obtained. The wiring board 1A also has the same performance as the wiring board 1.

又、配線基板1の製造工程を以下のように変形してもよい。例えば、図2(c)の工程において、第1絶縁膜21の上面に、銅箔付きのプリプレグを積層し、第2絶縁膜22を形成してもよい。この場合、プリプレグの片面全面に銅箔が積層されており、銅箔を上面として、第1絶縁膜21の上面にプリプレグを積層する。又は、第1絶縁膜21の上面に、プリプレグと共に銅箔を積層して、第2絶縁膜22を形成してもよい。   Further, the manufacturing process of the wiring board 1 may be modified as follows. For example, in the step of FIG. 2C, a prepreg with a copper foil may be laminated on the upper surface of the first insulating film 21 to form the second insulating film 22. In this case, a copper foil is laminated on the entire surface of one side of the prepreg, and the prepreg is laminated on the upper surface of the first insulating film 21 with the copper foil as the upper surface. Alternatively, the second insulating film 22 may be formed by laminating a copper foil together with the prepreg on the upper surface of the first insulating film 21.

この結果、図2(c)において、第1絶縁膜21、第2絶縁膜22、銅箔がこの順に積層された状態となる。その後、図2(d)の工程において、銅箔ごとレーザ加工を施し、絶縁層20にビアホール20xを形成する。次いで、図3(a)の工程において、セミアディティブ法やサブトラクティブ法により、配線層40を形成する。この際、銅箔は配線層40の一部として残る。   As a result, in FIG. 2C, the first insulating film 21, the second insulating film 22, and the copper foil are laminated in this order. Thereafter, in the step of FIG. 2D, the entire copper foil is subjected to laser processing to form a via hole 20 x in the insulating layer 20. Next, in the step of FIG. 3A, the wiring layer 40 is formed by a semi-additive method or a subtractive method. At this time, the copper foil remains as a part of the wiring layer 40.

又、配線基板1の製造工程を以下のように変形してもよい。例えば、図2(c)の工程において、第1絶縁膜21の上面に、プリプレグと共にプライマー層付き銅箔を積層し、第2絶縁膜22を形成してもよい。   Further, the manufacturing process of the wiring board 1 may be modified as follows. For example, in the step of FIG. 2C, the second insulating film 22 may be formed by laminating a copper foil with a primer layer together with the prepreg on the upper surface of the first insulating film 21.

この結果、図2(c)において、第1絶縁膜21、第2絶縁膜22、プライマー層、銅箔がこの順に積層された状態となる。その後、銅箔を除去する。次いで、図2(d)の工程において、プライマー層ごとレーザ加工を施し、絶縁層20にビアホール20xを形成する。次いで、図3(a)の工程において、セミアディティブ法やサブトラクティブ法により、配線層40を形成する。この際、プライマー層は絶縁層20の一部として残る。なお、プライマー層の材料等は、後述の第3絶縁膜23と同様とすることができる。   As a result, in FIG. 2C, the first insulating film 21, the second insulating film 22, the primer layer, and the copper foil are laminated in this order. Thereafter, the copper foil is removed. Next, in the process of FIG. 2D, the primer layer is laser processed together to form a via hole 20 x in the insulating layer 20. Next, in the step of FIG. 3A, the wiring layer 40 is formed by a semi-additive method or a subtractive method. At this time, the primer layer remains as a part of the insulating layer 20. The material of the primer layer can be the same as that of the third insulating film 23 described later.

〈第1の実施の形態の変形例1〉
第1の実施の形態の変形例1では、配線層10の上面が第1絶縁膜21から露出する例を示す。なお、第1の実施の形態の変形例1において、既に説明した実施の形態と同一構成部についての説明は省略する場合がある。
<Variation 1 of the first embodiment>
The first modification of the first embodiment shows an example in which the upper surface of the wiring layer 10 is exposed from the first insulating film 21. In the first modification of the first embodiment, the description of the same components as those of the already described embodiments may be omitted.

図5は、第1の実施の形態の変形例1に係る配線基板を例示する断面図である。図5を参照するに、第1の実施の形態の変形例1に係る配線基板2は、配線層10の上面が第1絶縁膜21から露出している点が配線基板1(図1参照)と相違する。   FIG. 5 is a cross-sectional view illustrating a wiring board according to Modification 1 of the first embodiment. Referring to FIG. 5, the wiring board 2 according to the first modification of the first embodiment is that the upper surface of the wiring layer 10 is exposed from the first insulating film 21 (see FIG. 1). Is different.

つまり、配線基板2では、第1絶縁膜21は、配線層10の側面のみを被覆している。第1絶縁膜21の下面と配線層10の下面とは、例えば、面一とすることができる。又、第1絶縁膜21の上面と配線層10の上面とは、例えば、面一とすることができる。言い換えれば、第1絶縁膜21の厚さは、配線層10の厚さと同一とすることができる。又、配線層10の上面は第2絶縁膜22により被覆されており、配線層40を構成するビア配線は、第2絶縁膜22のみを貫通するビアホール20xを介して、配線層10の上面に接続されている。   That is, in the wiring substrate 2, the first insulating film 21 covers only the side surface of the wiring layer 10. For example, the lower surface of the first insulating film 21 and the lower surface of the wiring layer 10 can be flush with each other. Further, the upper surface of the first insulating film 21 and the upper surface of the wiring layer 10 can be flush with each other, for example. In other words, the thickness of the first insulating film 21 can be the same as the thickness of the wiring layer 10. Further, the upper surface of the wiring layer 10 is covered with the second insulating film 22, and the via wiring constituting the wiring layer 40 is formed on the upper surface of the wiring layer 10 through the via hole 20 x penetrating only the second insulating film 22. It is connected.

配線基板2を作製するには、まず、第1の実施の形態の図2(a)及び図2(b)に示す工程を実行し、支持体300の上面に配線層10及び第1絶縁膜21を形成する。或いは、以下のようにして、配線層10及び第1絶縁膜21を形成してもよい。まず、支持体300の上面に、例えばエポキシ系の感光性の絶縁性樹脂を設け、感光性の絶縁性樹脂を露光及び現像によりパターニングして配線層10を形成する部分に支持体300の上面を露出する開口部を形成する。これにより、開口部を有する第1絶縁膜21が作製される。そして、支持体300をめっき給電層に利用する電解めっき法等により、第1絶縁膜21の開口部内に露出する支持体300の上面に電解めっきを析出させ、配線層10を形成する。   In order to manufacture the wiring substrate 2, first, the steps shown in FIGS. 2A and 2B of the first embodiment are performed, and the wiring layer 10 and the first insulating film are formed on the upper surface of the support 300. 21 is formed. Alternatively, the wiring layer 10 and the first insulating film 21 may be formed as follows. First, for example, an epoxy-based photosensitive insulating resin is provided on the upper surface of the support 300, and the upper surface of the support 300 is formed on a portion where the wiring layer 10 is formed by patterning the photosensitive insulating resin by exposure and development. An exposed opening is formed. Thereby, the 1st insulating film 21 which has an opening part is produced. Then, electrolytic plating is deposited on the upper surface of the support 300 exposed in the opening of the first insulating film 21 by an electrolytic plating method using the support 300 as a plating power feeding layer, and the wiring layer 10 is formed.

その後、図6(a)に示す工程では、半硬化状態の第1絶縁膜21を平坦面を有する板等により支持体300側に押圧し、第1絶縁膜21の上面と配線層10の上面とを面一とする。或いは、配線層10よりも上側の部分の第1絶縁膜21を研磨して、第1絶縁膜21の上面と配線層10の上面とを面一としてもよい。   Thereafter, in the step shown in FIG. 6A, the semi-cured first insulating film 21 is pressed to the support 300 side with a flat plate or the like, and the upper surface of the first insulating film 21 and the upper surface of the wiring layer 10 are pressed. To be flush with each other. Alternatively, the portion of the first insulating film 21 above the wiring layer 10 may be polished so that the upper surface of the first insulating film 21 and the upper surface of the wiring layer 10 are flush with each other.

次に、図6(b)に示す工程では、図2(c)に示す工程と同様にして、第1絶縁膜21の上面にBステージ状態(半硬化状態)の第2絶縁膜22を積層する。そして、第1絶縁膜21の上面に第2絶縁膜22を積層後、第1絶縁膜21及び第2絶縁膜22を所定温度に加熱して硬化させる。必要に応じて、加圧しながら加熱してもよい。この工程では、図2(c)に示す工程とは異なり、配線層10の上面は、第2絶縁膜22により被覆される。   Next, in the step shown in FIG. 6B, the second insulating film 22 in a B-stage state (semi-cured state) is laminated on the upper surface of the first insulating film 21 in the same manner as the step shown in FIG. To do. And after laminating the 2nd insulating film 22 on the upper surface of the 1st insulating film 21, the 1st insulating film 21 and the 2nd insulating film 22 are heated and hardened to predetermined temperature. If necessary, heating may be performed while applying pressure. In this step, unlike the step shown in FIG. 2C, the upper surface of the wiring layer 10 is covered with the second insulating film 22.

次に、図6(c)に示す工程では、図2(d)に示す工程と同様にして、配線層10の上面を露出させるビアホール20xを形成する。但し、本実施の形態では、配線層10の上面は第2絶縁膜22により被覆されているため、第2絶縁膜22のみを貫通するビアホール20xを形成する。つまり、第1絶縁膜21には、ビアホール20xは形成されない。そのため、第1絶縁膜21と第2絶縁膜22の両方にビアホール20xを形成する場合のように、レーザの照射条件の変更やデスミア処理の条件の調整等を考慮する必要がなく、簡易な製造工程とすることができる。   Next, in the step shown in FIG. 6C, a via hole 20x that exposes the upper surface of the wiring layer 10 is formed in the same manner as the step shown in FIG. However, in the present embodiment, since the upper surface of the wiring layer 10 is covered with the second insulating film 22, the via hole 20 x penetrating only the second insulating film 22 is formed. That is, the via hole 20 x is not formed in the first insulating film 21. Therefore, unlike the case where the via hole 20x is formed in both the first insulating film 21 and the second insulating film 22, it is not necessary to consider the change of the laser irradiation condition, the adjustment of the desmear process condition, etc. It can be a process.

その後、第1の実施の形態の図3(a)〜図3(c)に示す工程を実行し、更に、作製された構造体をスライサー等により個片化することにより、複数の配線基板2(図5参照)が完成する。必要に応じ、ソルダーレジスト層50の開口部50x内に露出する配線層40上や、ソルダーレジスト層60の開口部60x内に露出する配線層10上に、はんだボール等の外部接続端子を設けたり、チップキャパシタ等の電子部品を搭載したりしてもよい。又、切断前の構造体に外部接続端子を設けたり電子部品を搭載したりし、その後、構造体を切断して個片化する工程としてもよい。   Thereafter, the steps shown in FIG. 3A to FIG. 3C of the first embodiment are executed, and the manufactured structure is separated into pieces by a slicer or the like, whereby a plurality of wiring boards 2 are obtained. (See FIG. 5) is completed. If necessary, external connection terminals such as solder balls may be provided on the wiring layer 40 exposed in the opening 50x of the solder resist layer 50 or on the wiring layer 10 exposed in the opening 60x of the solder resist layer 60. An electronic component such as a chip capacitor may be mounted. Alternatively, an external connection terminal or an electronic component may be provided on the structure before cutting, and then the structure may be cut into pieces.

〈第1の実施の形態の変形例2〉
第1の実施の形態の変形例2では、配線層10の上面が第1絶縁膜21から突出する例を示す。なお、第1の実施の形態の変形例2において、既に説明した実施の形態と同一構成部についての説明は省略する場合がある。
<Modification 2 of the first embodiment>
Modification 2 of the first embodiment shows an example in which the upper surface of the wiring layer 10 protrudes from the first insulating film 21. In the second modification of the first embodiment, the description of the same components as those of the already described embodiment may be omitted.

図7は、第1の実施の形態の変形例2に係る配線基板を例示する断面図である。図7を参照するに、第1の実施の形態の変形例2に係る配線基板3は、配線層10の上面が第1絶縁膜21の上面から第2絶縁膜22内に突出している点が配線基板1(図1参照)と相違する。   FIG. 7 is a cross-sectional view illustrating a wiring board according to Modification 2 of the first embodiment. Referring to FIG. 7, in the wiring board 3 according to the second modification of the first embodiment, the upper surface of the wiring layer 10 protrudes from the upper surface of the first insulating film 21 into the second insulating film 22. It is different from the wiring board 1 (see FIG. 1).

つまり、配線基板3では、第1絶縁膜21は、配線層10の側面の下側のみを被覆している。第1絶縁膜21の下面と配線層10の下面とは、例えば、面一とすることができる。又、配線層10の側面の上側と、配線層10の上面は、第2絶縁膜22により被覆されている。   That is, in the wiring substrate 3, the first insulating film 21 covers only the lower side of the side surface of the wiring layer 10. For example, the lower surface of the first insulating film 21 and the lower surface of the wiring layer 10 can be flush with each other. Further, the upper side surface of the wiring layer 10 and the upper surface of the wiring layer 10 are covered with the second insulating film 22.

配線基板3を作製するには、まず、図8に示す工程を実行する。図8に示す工程では、第1絶縁膜21と第2絶縁膜22を予め積層したBステージ状態(半硬化状態)の絶縁層20を準備しておく。又、図8に示す工程と並行して、第1の実施の形態の図2(a)に示す工程を実行して、支持体300の上面に配線層10を形成しておく。   In order to manufacture the wiring board 3, first, the process shown in FIG. 8 is performed. In the step shown in FIG. 8, a B-stage (semi-cured) insulating layer 20 in which a first insulating film 21 and a second insulating film 22 are laminated in advance is prepared. In parallel with the step shown in FIG. 8, the step shown in FIG. 2A of the first embodiment is executed to form the wiring layer 10 on the upper surface of the support 300.

そして、第1絶縁膜21を支持体300側に向けて、支持体300の上面に配線層10を被覆するように絶縁層20を貼り付け(ラミネートし)、第1絶縁膜21及び第2絶縁膜22を所定温度に加熱して硬化させる。必要に応じて、加圧しながら加熱してもよい。第1絶縁膜21の厚さを予め配線層10よりも薄くしておくことにより、図8の下側に示すように、配線層10の上面が第1絶縁膜21から突出した構造とすることができる。但し、配線層10の突出量は、配線層10の上面が補強部材30と接することがない程度の量に設定する必要がある。   Then, with the first insulating film 21 facing the support 300 side, the insulating layer 20 is pasted (laminated) so as to cover the wiring layer 10 on the upper surface of the support 300, and the first insulating film 21 and the second insulating film 21 The film 22 is cured by heating to a predetermined temperature. If necessary, heating may be performed while applying pressure. By making the thickness of the first insulating film 21 thinner than the wiring layer 10 in advance, the upper surface of the wiring layer 10 protrudes from the first insulating film 21 as shown in the lower side of FIG. Can do. However, the protruding amount of the wiring layer 10 needs to be set to an amount that prevents the upper surface of the wiring layer 10 from coming into contact with the reinforcing member 30.

なお、図8に示す工法では、第1絶縁膜21の厚さを適宜調整することにより、図1の構造や図5の構造の配線基板を作製することもできる。又、第1絶縁膜21の厚さによっては、図1の構造、図5の構造、及び図7の構造が1つの配線基板内に混在する場合もあり得るが、そのような構造でも問題となる点はない。   In the method shown in FIG. 8, the wiring substrate having the structure shown in FIG. 1 or the structure shown in FIG. 5 can be manufactured by appropriately adjusting the thickness of the first insulating film 21. Further, depending on the thickness of the first insulating film 21, the structure of FIG. 1, the structure of FIG. 5, and the structure of FIG. 7 may be mixed in one wiring board. There is no point.

又、図8の絶縁層20に代えて、図9(a)に示す3層構造の絶縁層20Aを用いてもよい。絶縁層20Aは、絶縁層20の第2絶縁膜22上に更に第3絶縁膜23を積層した構造である。第3絶縁膜23は、補強部材を有していない絶縁膜であり、プライマー層とも称される。   Further, an insulating layer 20A having a three-layer structure shown in FIG. 9A may be used instead of the insulating layer 20 shown in FIG. The insulating layer 20 </ b> A has a structure in which a third insulating film 23 is further stacked on the second insulating film 22 of the insulating layer 20. The third insulating film 23 is an insulating film having no reinforcing member, and is also referred to as a primer layer.

第2絶縁膜22のような補強部材30を有する絶縁膜では、補強部材30の存在により、第2絶縁膜22の上面に無電解めっきが析出し難い場合がある。この場合、セミアディティブ法等の無電解めっきを用いる配線層形成方法を採用できない。そこで、図9(a)では、第2絶縁膜22の上面に第3絶縁膜23を積層して、無電解めっきの析出を可能としている。これにより、例えばセミアディティブ法による配線層形成が可能となる。   In the insulating film having the reinforcing member 30 such as the second insulating film 22, electroless plating may not be easily deposited on the upper surface of the second insulating film 22 due to the presence of the reinforcing member 30. In this case, a wiring layer forming method using electroless plating such as a semi-additive method cannot be adopted. Therefore, in FIG. 9A, the third insulating film 23 is laminated on the upper surface of the second insulating film 22 so that the electroless plating can be deposited. Thereby, for example, a wiring layer can be formed by a semi-additive method.

第3絶縁膜23の材料としては、例えば、第2絶縁膜22と同じ材料系の絶縁性樹脂を、無電解めっきが析出し易いように組成調整したものを用いることができる。第3絶縁膜23の厚さは、例えば、1〜10μm程度とすることができる。   As the material of the third insulating film 23, for example, an insulating resin of the same material system as that of the second insulating film 22 whose composition is adjusted so that electroless plating can be easily deposited can be used. The thickness of the third insulating film 23 can be set to about 1 to 10 μm, for example.

図9(a)に示すように、第1絶縁膜21を支持体300側に向けて、支持体300の上面に配線層10を被覆するように絶縁層20Aを貼り付け(ラミネートし)、第1絶縁膜21、第2絶縁膜22及び第3絶縁膜23を所定温度に加熱して硬化させる。必要に応じて、加圧しながら加熱してもよい。第1絶縁膜21の厚さを予め配線層10よりも薄くしておくことにより、図9(a)の下側に示すように、配線層10の上面が第1絶縁膜21から突出した構造とすることができる。   As shown in FIG. 9A, the insulating layer 20A is attached (laminated) so as to cover the wiring layer 10 on the upper surface of the support 300 with the first insulating film 21 facing the support 300 side. The first insulating film 21, the second insulating film 22, and the third insulating film 23 are cured by heating to a predetermined temperature. If necessary, heating may be performed while applying pressure. A structure in which the upper surface of the wiring layer 10 protrudes from the first insulating film 21 as shown in the lower side of FIG. 9A by making the thickness of the first insulating film 21 thinner than the wiring layer 10 in advance. It can be.

その後、第1の実施の形態の図2(d)及び図3(a)と同様の工程を実行することにより、図9(b)に示すように、配線層40を形成できる。配線層40をセミアディティブ法で形成する場合には、まず、無電解めっき法により、ビアホール20xの底部に露出した配線層10の上面、及びビアホール20xの内壁面を含む絶縁層20A上に銅(Cu)等からなるシード層を形成する。更に、シード層上に配線層40に対応する開口部を備えたレジスト層を形成する。   Thereafter, by performing the same steps as those in FIGS. 2D and 3A of the first embodiment, the wiring layer 40 can be formed as shown in FIG. 9B. When the wiring layer 40 is formed by a semi-additive method, first, copper (on the insulating layer 20A including the upper surface of the wiring layer 10 exposed at the bottom of the via hole 20x and the inner wall surface of the via hole 20x is formed by electroless plating. A seed layer made of Cu) or the like is formed. Further, a resist layer having an opening corresponding to the wiring layer 40 is formed on the seed layer.

そして、シード層を給電層に利用した電解めっき法により、レジスト層の開口部に銅(Cu)等からなる配線層を形成する。続いて、レジスト層を除去した後に、配線層をマスクにして、配線層に覆われていない部分のシード層をエッチングにより除去する。これにより、絶縁層20A上にビアホール20x内に充填されたビア配線、及び絶縁層20A上(第3絶縁膜23上)に形成された配線パターンを含む配線層40が形成される。   Then, a wiring layer made of copper (Cu) or the like is formed in the opening of the resist layer by an electrolytic plating method using the seed layer as a power feeding layer. Subsequently, after removing the resist layer, the seed layer not covered with the wiring layer is removed by etching using the wiring layer as a mask. Thereby, the wiring layer 40 including the via wiring filled in the via hole 20x on the insulating layer 20A and the wiring pattern formed on the insulating layer 20A (on the third insulating film 23) is formed.

図9(b)の工程の後、第1の実施の形態の図3(b)及び図3(c)に示す工程を実行し、更に、作製された構造体をスライサー等により個片化することにより、図10に示す配線基板3Aが複数個完成する。必要に応じ、ソルダーレジスト層50の開口部50x内に露出する配線層40上や、ソルダーレジスト層60の開口部60x内に露出する配線層10上に、はんだボール等の外部接続端子を設けたり、チップキャパシタ等の電子部品を搭載したりしてもよい。又、切断前の構造体に外部接続端子を設けたり電子部品を搭載したりし、その後、構造体を切断して個片化する工程としてもよい。   After the step of FIG. 9B, the steps shown in FIG. 3B and FIG. 3C of the first embodiment are executed, and the manufactured structure is separated into pieces by a slicer or the like. Thereby, a plurality of wiring boards 3A shown in FIG. 10 are completed. If necessary, external connection terminals such as solder balls may be provided on the wiring layer 40 exposed in the opening 50x of the solder resist layer 50 or on the wiring layer 10 exposed in the opening 60x of the solder resist layer 60. An electronic component such as a chip capacitor may be mounted. Alternatively, an external connection terminal or an electronic component may be provided on the structure before cutting, and then the structure may be cut into pieces.

なお、他の実施の形態においても、第2絶縁膜22上に第3絶縁膜23を積層することにより、セミアディティブ法を用いた配線層形成を行ってもよい。つまり、図1に示す配線基板1、図4に示す配線基板1A、図5に示す配線基板2、後述の図11に示す配線基板4において、絶縁層20に代えて絶縁層20Aを用いてもよい。   In other embodiments, the wiring layer may be formed using the semi-additive method by laminating the third insulating film 23 on the second insulating film 22. That is, in the wiring board 1 shown in FIG. 1, the wiring board 1 </ b> A shown in FIG. 4, the wiring board 2 shown in FIG. 5, and the wiring board 4 shown in FIG. 11 described later, the insulating layer 20 </ b> A may be used instead of the insulating layer 20. Good.

〈第2の実施の形態〉
第2の実施の形態では、3層構造の配線基板の例を示す。なお、第2の実施の形態において、既に説明した実施の形態と同一構成部についての説明は省略する場合がある。
<Second Embodiment>
In the second embodiment, an example of a wiring board having a three-layer structure is shown. In the second embodiment, description of the same components as those of the already described embodiments may be omitted.

図11は、第2の実施の形態に係る配線基板を例示する断面図である。図11を参照するに、第2の実施の形態に係る配線基板4は、配線層40とソルダーレジスト層50との間に、絶縁層70及び配線層80が挿入されている点が配線基板1(図1参照)と相違する。   FIG. 11 is a cross-sectional view illustrating a wiring board according to the second embodiment. Referring to FIG. 11, the wiring board 4 according to the second embodiment is that the insulating layer 70 and the wiring layer 80 are inserted between the wiring layer 40 and the solder resist layer 50. (See FIG. 1).

絶縁層70は、絶縁層20の上面に、配線層40を被覆するように形成されている。絶縁層70の材料としては、例えば、エポキシ系絶縁性樹脂等を用いることができる。絶縁層70は、シリカ(SiO)等のフィラーを含有しても構わない。絶縁層70の厚さは、例えば15〜35μm程度とすることができる。 The insulating layer 70 is formed on the upper surface of the insulating layer 20 so as to cover the wiring layer 40. As a material of the insulating layer 70, for example, an epoxy-based insulating resin or the like can be used. The insulating layer 70 may contain a filler such as silica (SiO 2 ). The thickness of the insulating layer 70 can be about 15 to 35 μm, for example.

なお、絶縁層70として、第1絶縁膜21及び第2絶縁膜22を含む積層体を用いてもよい。この場合は、第1絶縁膜21及び第2絶縁膜22を含む積層体である絶縁層20上に、第1絶縁膜21及び第2絶縁膜22を含む積層体である絶縁層70が積層された構造となる。或いは、絶縁層70は、補強部材を有してもよい。この場合、絶縁層70を構成する絶縁性樹脂や補強部材の材質として、第2絶縁膜22及び補強部材30と同様のものを使用できる。   Note that a stacked body including the first insulating film 21 and the second insulating film 22 may be used as the insulating layer 70. In this case, an insulating layer 70 that is a stacked body including the first insulating film 21 and the second insulating film 22 is stacked on the insulating layer 20 that is a stacked body including the first insulating film 21 and the second insulating film 22. Structure. Alternatively, the insulating layer 70 may have a reinforcing member. In this case, the same material as the second insulating film 22 and the reinforcing member 30 can be used as the insulating resin and the reinforcing member constituting the insulating layer 70.

第3配線層である配線層80は、絶縁層70上に形成されている。配線層80は、絶縁層70を貫通し配線層40の上面を露出するビアホール70x内に充填されたビア配線、及び絶縁層70の上面に形成された配線パターンを含んで構成されている。ビアホール70xは、ソルダーレジスト層50側に開口されている開口部の径が配線層40の上面によって形成された開口部の底面の径よりも大きい逆円錐台状の凹部となっている。   A wiring layer 80 as a third wiring layer is formed on the insulating layer 70. The wiring layer 80 includes a via wiring filled in the via hole 70 x that penetrates the insulating layer 70 and exposes the upper surface of the wiring layer 40, and a wiring pattern formed on the upper surface of the insulating layer 70. The via hole 70 x is an inverted frustoconical concave portion in which the diameter of the opening opened to the solder resist layer 50 side is larger than the diameter of the bottom surface of the opening formed by the upper surface of the wiring layer 40.

配線層80は、ビアホール70xの底部に露出した配線層40と電気的に接続されている。配線層80の材料としては、例えば、銅(Cu)等を用いることができる。配線層80を構成する配線パターンの厚さは、例えば1〜35μm程度とすることができる。   The wiring layer 80 is electrically connected to the wiring layer 40 exposed at the bottom of the via hole 70x. As a material of the wiring layer 80, for example, copper (Cu) or the like can be used. The thickness of the wiring pattern constituting the wiring layer 80 can be, for example, about 1 to 35 μm.

ソルダーレジスト層50は、絶縁層70の上面に、配線層80を被覆するように形成されている。ソルダーレジスト層50は開口部50xを有し、開口部50xの底部には配線層80の一部が露出している。開口部50xの底部に露出する配線層80は、他の配線基板や半導体パッケージ、半導体チップ等と電気的に接続されるパッドとして機能する。ソルダーレジスト層50の材料や厚さは、前述の通りである。   The solder resist layer 50 is formed on the upper surface of the insulating layer 70 so as to cover the wiring layer 80. The solder resist layer 50 has an opening 50x, and a part of the wiring layer 80 is exposed at the bottom of the opening 50x. The wiring layer 80 exposed at the bottom of the opening 50x functions as a pad that is electrically connected to another wiring board, a semiconductor package, a semiconductor chip, or the like. The material and thickness of the solder resist layer 50 are as described above.

配線基板4を作製するには、まず、第1の実施の形態の図2(a)〜図3(a)に示す工程を実行する。その後、図12(a)に示す工程では、絶縁層20上に配線層40を被覆するように、例えば熱硬化性を有するフィルム状のエポキシ系絶縁性樹脂等をラミネートする。或いは、絶縁層20上に配線層40を被覆するように、例えば熱硬化性を有する液状又はペースト状のエポキシ系絶縁性樹脂等をスクリーン印刷、スピンコート法等により塗布する。そして、ラミネート又は塗布した絶縁性樹脂を押圧しつつ、硬化温度以上に加熱して硬化させ、絶縁層70を作製する。必要に応じて、加圧しながら加熱してもよい。   In order to manufacture the wiring board 4, first, the steps shown in FIGS. 2A to 3A of the first embodiment are performed. Thereafter, in the step shown in FIG. 12A, for example, a thermosetting film-like epoxy insulating resin is laminated so as to cover the wiring layer 40 on the insulating layer 20. Alternatively, for example, a thermosetting liquid or pasty epoxy insulating resin or the like is applied by screen printing, spin coating, or the like so as to cover the wiring layer 40 on the insulating layer 20. Then, while pressing the laminated or coated insulating resin, the insulating layer 70 is manufactured by heating to a curing temperature or higher and curing. If necessary, heating may be performed while applying pressure.

次に、図12(b)に示す工程では、第1の実施の形態の図2(d)に示す工程と同様にして、絶縁層70に、絶縁層70を貫通し配線層40の上面を露出させるビアホール70xを形成する。ビアホール70xをレーザ加工法により形成した場合には、デスミア処理を行い、ビアホール70xの底部に露出する配線層40の上面に付着した絶縁層20の樹脂残渣を除去することが好ましい。   Next, in the step shown in FIG. 12B, in the same manner as the step shown in FIG. 2D of the first embodiment, the insulating layer 70 is penetrated through the insulating layer 70 and the upper surface of the wiring layer 40 is formed. A via hole 70x to be exposed is formed. When the via hole 70x is formed by a laser processing method, it is preferable to remove the resin residue of the insulating layer 20 attached to the upper surface of the wiring layer 40 exposed at the bottom of the via hole 70x by performing a desmear process.

次に、図12(c)に示す工程では、第1の実施の形態の図3(a)に示す工程と同様にして、絶縁層70上に配線層80を形成する。その後、第1の実施の形態の図3(b)及び図3(c)に示す工程を実行し、更に、作製された構造体をスライサー等により個片化することにより、複数の配線基板4(図11参照)が完成する。必要に応じ、ソルダーレジスト層50の開口部50x内に露出する配線層80上や、ソルダーレジスト層60の開口部60x内に露出する配線層10上に、はんだボール等の外部接続端子を設けたり、チップキャパシタ等の電子部品を搭載したりしてもよい。又、切断前の構造体に外部接続端子を設けたり電子部品を搭載したりし、その後、構造体を切断して個片化する工程としてもよい。   Next, in the step shown in FIG. 12C, the wiring layer 80 is formed on the insulating layer 70 in the same manner as the step shown in FIG. 3A of the first embodiment. Thereafter, the steps shown in FIG. 3B and FIG. 3C of the first embodiment are executed, and the manufactured structure is separated into pieces by a slicer or the like, whereby a plurality of wiring boards 4 are obtained. (See FIG. 11) is completed. If necessary, external connection terminals such as solder balls may be provided on the wiring layer 80 exposed in the opening 50x of the solder resist layer 50 or on the wiring layer 10 exposed in the opening 60x of the solder resist layer 60. An electronic component such as a chip capacitor may be mounted. Alternatively, an external connection terminal or an electronic component may be provided on the structure before cutting, and then the structure may be cut into pieces.

このように、配線層40上に絶縁層70及び配線層80を積層することで、3層構造の配線基板4を実現できる。配線層40上に絶縁層及び配線層を必要数交互に積層し、4層構造以上の配線基板とすることも可能である。この際、配線層40上に積層する1つ又は2つ以上の絶縁層として、第1絶縁膜21及び第2絶縁膜22を含む積層体を用いることにより、絶縁信頼性を更に高めることができる点で好適である。   Thus, by laminating the insulating layer 70 and the wiring layer 80 on the wiring layer 40, the wiring substrate 4 having a three-layer structure can be realized. A necessary number of insulating layers and wiring layers may be alternately stacked on the wiring layer 40 to form a wiring board having a four-layer structure or more. At this time, the insulation reliability can be further improved by using a laminated body including the first insulating film 21 and the second insulating film 22 as one or two or more insulating layers stacked on the wiring layer 40. This is preferable in terms of points.

〈配線基板の応用例1〉
配線基板の応用例1では、第1の実施の形態及び第2の実施の形態に係る配線基板に半導体チップが搭載(フリップチップ実装)された半導体パッケージの例を示す。なお、配線基板の応用例1において、既に説明した実施の形態と同一構成部についての説明は省略する場合がある。
<Application example 1 of wiring board>
Application example 1 of a wiring board shows an example of a semiconductor package in which a semiconductor chip is mounted (flip chip mounting) on the wiring boards according to the first and second embodiments. In Application Example 1 of the wiring board, the description of the same components as those in the above-described embodiment may be omitted.

図13(a)及び図13(b)は、応用例1に係る半導体パッケージを例示する断面図である。図13(a)を参照するに、半導体パッケージ5は、図1に示す配線基板1と、半導体チップ100と、バンプ110と、アンダーフィル樹脂120と、バンプ130とを有する。半導体パッケージ5において、配線基板1の第1絶縁膜21側が半導体チップ100が搭載されるチップ搭載面となり、配線基板1のソルダーレジスト層50側が外部接続端子が形成される外部接続端子面となる。   13A and 13B are cross-sectional views illustrating a semiconductor package according to Application Example 1. FIG. Referring to FIG. 13A, the semiconductor package 5 includes the wiring substrate 1 shown in FIG. 1, the semiconductor chip 100, the bump 110, the underfill resin 120, and the bump 130. In the semiconductor package 5, the first insulating film 21 side of the wiring substrate 1 is a chip mounting surface on which the semiconductor chip 100 is mounted, and the solder resist layer 50 side of the wiring substrate 1 is an external connection terminal surface on which external connection terminals are formed.

半導体チップ100は、例えば、シリコン等からなる薄板化された半導体基板(図示せず)上に半導体集積回路(図示せず)等が形成されたものである。半導体基板(図示せず)には、半導体集積回路(図示せず)と電気的に接続された電極パッド(図示せず)が形成されている。   The semiconductor chip 100 is obtained by forming a semiconductor integrated circuit (not shown) or the like on a thinned semiconductor substrate (not shown) made of, for example, silicon. An electrode pad (not shown) electrically connected to a semiconductor integrated circuit (not shown) is formed on a semiconductor substrate (not shown).

バンプ110は、半導体チップ100の電極パッド(図示せず)と、配線基板1のソルダーレジスト層60の開口部60xから露出する配線層10とを電気的に接続している。アンダーフィル樹脂120は、半導体チップ100と配線基板1(第1絶縁膜21)との間に充填されている。バンプ130は、ソルダーレジスト層50の開口部50xの底部に露出する配線層40の上面に形成された外部接続端子である。バンプ130は、例えば、他の配線基板(マザーボード等)や他の半導体パッケージ等と電気的に接続される。バンプ110及び130は、例えば、はんだバンプである。はんだバンプの材料としては、例えばPbを含む合金、SnとCuの合金、SnとAgの合金、SnとAgとCuの合金等を用いることができる。   The bump 110 electrically connects an electrode pad (not shown) of the semiconductor chip 100 and the wiring layer 10 exposed from the opening 60x of the solder resist layer 60 of the wiring board 1. The underfill resin 120 is filled between the semiconductor chip 100 and the wiring substrate 1 (first insulating film 21). The bump 130 is an external connection terminal formed on the upper surface of the wiring layer 40 exposed at the bottom of the opening 50 x of the solder resist layer 50. The bump 130 is electrically connected to, for example, another wiring board (motherboard or the like), another semiconductor package, or the like. The bumps 110 and 130 are, for example, solder bumps. As a material for the solder bump, for example, an alloy containing Pb, an alloy of Sn and Cu, an alloy of Sn and Ag, an alloy of Sn, Ag, and Cu can be used.

このように、第1の実施の形態に係る配線基板1に半導体チップを搭載することにより、半導体パッケージ5を実現できる。又、図13(b)に示す半導体パッケージ6のように、第2の実施の形態に係る配線基板4に半導体チップを搭載することにより、半導体パッケージ6を実現してもよい。もちろん、配線基板1や4に代えて、配線基板1A、2、3、又は3Aを用いることも可能である。   Thus, the semiconductor package 5 can be realized by mounting the semiconductor chip on the wiring board 1 according to the first embodiment. Further, as in the semiconductor package 6 shown in FIG. 13B, the semiconductor package 6 may be realized by mounting a semiconductor chip on the wiring board 4 according to the second embodiment. Of course, instead of the wiring boards 1 and 4, the wiring boards 1A, 2, 3, or 3A can be used.

なお、第1絶縁膜21として、アンダーフィル樹脂120との相性の良い樹脂を選定することで、アンダーフィル樹脂120の充填性を高めることができる。   In addition, the filling property of the underfill resin 120 can be improved by selecting a resin having a good compatibility with the underfill resin 120 as the first insulating film 21.

なお、図13の例では、配線層10側に半導体チップ100を搭載し、配線層40又は80にバンプ130を設ける例を示したが、配線層40又は80側に半導体チップ100を搭載し、配線層10にバンプ130を設けてもよい。   In the example of FIG. 13, the semiconductor chip 100 is mounted on the wiring layer 10 side and the bump 130 is provided on the wiring layer 40 or 80. However, the semiconductor chip 100 is mounted on the wiring layer 40 or 80 side. Bumps 130 may be provided on the wiring layer 10.

〈配線基板の応用例2〉
配線基板の応用例2では、半導体パッケージ上に更に他の半導体パッケージが搭載された所謂POP(Package on package)構造の半導体パッケージの例を示す。なお、配線基板の応用例2において、既に説明した実施の形態と同一構成部についての説明は省略する場合がある。
<Application example 2 of wiring board>
Application example 2 of the wiring board shows an example of a so-called POP (Package on package) semiconductor package in which another semiconductor package is further mounted on the semiconductor package. In application example 2 of the wiring board, description of the same components as those of the above-described embodiment may be omitted.

図14は、応用例2に係る半導体パッケージを例示する断面図である。図14を参照するに、半導体パッケージ7は、配線基板4を含む第1の半導体パッケージ上に、配線基板1を含む第2の半導体パッケージが搭載された構造である。   FIG. 14 is a cross-sectional view illustrating a semiconductor package according to Application Example 2. Referring to FIG. 14, the semiconductor package 7 has a structure in which a second semiconductor package including the wiring substrate 1 is mounted on a first semiconductor package including the wiring substrate 4.

第1の半導体パッケージにおいて、配線基板4の絶縁層20側に、バンプ220を介して半導体チップ210が実装され、ソルダーレジスト層50の開口部50xから露出する配線層80にはバンプ130が形成されている。又、第2の半導体パッケージにおいて、配線基板1の絶縁層20側に、バンプ260を介して半導体チップ250が実装され、バンプ280を介してチップコンデンサ270が実装されている。   In the first semiconductor package, the semiconductor chip 210 is mounted on the insulating layer 20 side of the wiring substrate 4 via the bumps 220, and the bumps 130 are formed on the wiring layer 80 exposed from the openings 50 x of the solder resist layer 50. ing. In the second semiconductor package, the semiconductor chip 250 is mounted via the bump 260 and the chip capacitor 270 is mounted via the bump 280 on the insulating layer 20 side of the wiring board 1.

第1の半導体パッケージと第2の半導体パッケージとは、銅コアボール231の周囲をはんだ232で覆った構造のはんだボール230を介して接続されている。より詳しくは、第1の半導体パッケージを構成する配線基板4の配線層10と、第2の半導体パッケージを構成する配線基板1の配線層40とが、はんだボール230を介して接続されている。   The first semiconductor package and the second semiconductor package are connected via a solder ball 230 having a structure in which the periphery of the copper core ball 231 is covered with solder 232. More specifically, the wiring layer 10 of the wiring board 4 constituting the first semiconductor package and the wiring layer 40 of the wiring board 1 constituting the second semiconductor package are connected via the solder balls 230.

はんだボール230は、第1の半導体パッケージと第2の半導体パッケージとを接続(接合)する接合材として機能すると共に、両パッケージ間の距離(離間距離)を規定値に保持するスペーサとしても機能する。つまり、はんだ232が接合材として機能し、銅コアボール231がスペーサとして機能する。なお、はんだボール230の高さは、半導体チップ210の厚さとバンプ220の厚さとを合算した高さよりも高く設定されている。   The solder ball 230 functions as a bonding material for connecting (bonding) the first semiconductor package and the second semiconductor package, and also functions as a spacer for maintaining the distance (separation distance) between the two packages at a specified value. . That is, the solder 232 functions as a bonding material, and the copper core ball 231 functions as a spacer. The height of the solder ball 230 is set to be higher than the total height of the thickness of the semiconductor chip 210 and the thickness of the bump 220.

配線基板1と配線基板4との間の空間には、封止樹脂240が充填されている。封止樹脂240の充填によって、配線基板1が配線基板4に対して固定されると共に、配線基板4に実装された半導体チップ210が封止される。すなわち、封止樹脂240は、第1の半導体パッケージと第2の半導体パッケージとを接着する接着剤として機能すると共に、半導体チップ210を保護する保護層として機能する。又、封止樹脂240を設けることにより、半導体パッケージ7全体の機械的強度を高めることができる。   A space between the wiring board 1 and the wiring board 4 is filled with a sealing resin 240. By filling the sealing resin 240, the wiring substrate 1 is fixed to the wiring substrate 4 and the semiconductor chip 210 mounted on the wiring substrate 4 is sealed. That is, the sealing resin 240 functions as an adhesive that bonds the first semiconductor package and the second semiconductor package, and also functions as a protective layer that protects the semiconductor chip 210. Further, the provision of the sealing resin 240 can increase the mechanical strength of the entire semiconductor package 7.

このように、第1の実施の形態に係る配線基板1や第2の実施の形態に係る配線基板4を用いて、能動部品(半導体チップ210等)や受動部品(チップコンデンサ270)を搭載したPOP構造の半導体パッケージ7を実現できる。もちろん、配線基板1や4に代えて、配線基板1A、2、3、又は3Aを用いることも可能である。   As described above, the active component (semiconductor chip 210 and the like) and the passive component (chip capacitor 270) are mounted using the wiring substrate 1 according to the first embodiment and the wiring substrate 4 according to the second embodiment. A semiconductor package 7 having a POP structure can be realized. Of course, instead of the wiring boards 1 and 4, the wiring boards 1A, 2, 3, or 3A can be used.

〈第3の実施の形態〉
第3の実施の形態では、微細配線を有する配線基板の例を示す。なお、第3の実施の形態において、既に説明した実施の形態と同一構成部についての説明は省略する場合がある。
<Third Embodiment>
In the third embodiment, an example of a wiring board having fine wiring is shown. Note that in the third embodiment, description of the same components as those of the already described embodiments may be omitted.

[第3の実施の形態に係る配線基板の構造]
まず、第3の実施の形態に係る配線基板の構造について説明する。図15は、第3の実施の形態に係る配線基板を例示する断面図である。図15を参照するに、第3の実施の形態に係る配線基板8は、配線基板1(図1参照)の絶縁層20上に絶縁層410、配線層420、絶縁層430、配線層440、絶縁層450、配線層460を順次積層した構造である。なお、図15では、配線層10、絶縁層20等が図1とは上下を反転した状態で描かれている。
[Structure of Wiring Board According to Third Embodiment]
First, the structure of the wiring board according to the third embodiment will be described. FIG. 15 is a cross-sectional view illustrating a wiring board according to the third embodiment. Referring to FIG. 15, the wiring board 8 according to the third embodiment includes an insulating layer 410, a wiring layer 420, an insulating layer 430, a wiring layer 440 on the insulating layer 20 of the wiring board 1 (see FIG. 1). The insulating layer 450 and the wiring layer 460 are sequentially stacked. In FIG. 15, the wiring layer 10, the insulating layer 20, and the like are drawn upside down with respect to FIG. 1.

絶縁層410、430、及び450の厚さは、絶縁層20の厚さよりも薄く形成されている。又、配線層420及び440を構成する配線パターンの厚さは、配線層10及び40を構成する配線パターンの厚さよりも薄く形成されている。配線層420及び440を構成する配線パターンは、配線層10及び40を構成する配線パターンよりも高密度(微細配線)である。なお、絶縁層450上に、配線層460を構成するパッドを露出するソルダーレジスト層を設けてもよい。   The insulating layers 410, 430, and 450 are formed thinner than the insulating layer 20. Further, the thickness of the wiring pattern constituting the wiring layers 420 and 440 is formed to be thinner than the thickness of the wiring pattern constituting the wiring layers 10 and 40. The wiring patterns constituting the wiring layers 420 and 440 have a higher density (fine wiring) than the wiring patterns constituting the wiring layers 10 and 40. Note that a solder resist layer that exposes the pads constituting the wiring layer 460 may be provided on the insulating layer 450.

配線基板8において、配線層10の他方の面と絶縁層20の他方の面(第1絶縁膜21の他方の面)は研磨されて平坦面とされている。絶縁層410は、配線層10の他方の面と絶縁層20の他方の面が形成する平坦面に形成されている。絶縁層410の材料としては、例えば、エポキシ系樹脂やフェノール系樹脂等を主成分とする感光性の絶縁性樹脂(熱硬化性)を用いることができる。絶縁層410は、シリカ(SiO)等のフィラーを含有しても構わない。絶縁層410の厚さは、例えば、3〜30μm程度とすることができる。 In the wiring substrate 8, the other surface of the wiring layer 10 and the other surface of the insulating layer 20 (the other surface of the first insulating film 21) are polished to a flat surface. The insulating layer 410 is formed on a flat surface formed by the other surface of the wiring layer 10 and the other surface of the insulating layer 20. As a material of the insulating layer 410, for example, a photosensitive insulating resin (thermosetting) whose main component is an epoxy resin or a phenol resin can be used. The insulating layer 410 may contain a filler such as silica (SiO 2 ). The thickness of the insulating layer 410 can be, for example, about 3 to 30 μm.

配線層420は、絶縁層410の他方の側に形成されている。配線層420は、ビアホール410x内に充填されたビア配線、及び絶縁層410の他方の面に形成された配線パターンを含んで構成されている。ビアホール410xは、絶縁層430側に開口されている開口部の径が配線層10の他方の面によって形成された開口部の底面の径よりも大きい逆円錐台状の凹部となっている。配線層420は、ビアホール410xを介して、配線層10と電気的に接続されている。配線層420の材料としては、例えば、銅(Cu)等を用いることができる。配線層420を構成する配線パターンの厚さは、例えば、1〜3μm程度とすることができる。   The wiring layer 420 is formed on the other side of the insulating layer 410. The wiring layer 420 includes a via wiring filled in the via hole 410 x and a wiring pattern formed on the other surface of the insulating layer 410. The via hole 410x is an inverted frustoconical concave portion in which the diameter of the opening opened on the insulating layer 430 side is larger than the diameter of the bottom surface of the opening formed by the other surface of the wiring layer 10. The wiring layer 420 is electrically connected to the wiring layer 10 through the via hole 410x. As a material of the wiring layer 420, for example, copper (Cu) or the like can be used. The thickness of the wiring pattern constituting the wiring layer 420 can be, for example, about 1 to 3 μm.

絶縁層430は、絶縁層410の他方の面に、配線層420を被覆するように形成されている。絶縁層430の材料や厚さは、例えば、絶縁層410と同様とすることができる。   The insulating layer 430 is formed on the other surface of the insulating layer 410 so as to cover the wiring layer 420. The material and thickness of the insulating layer 430 can be the same as that of the insulating layer 410, for example.

配線層440は、絶縁層430の他方の側に形成されている。配線層440は、ビアホール430x内に充填されたビア配線、及び絶縁層430の他方の面に形成された配線パターンを含んで構成されている。ビアホール430xは、絶縁層450側に開口されている開口部の径が配線層420の他方の面によって形成された開口部の底面の径よりも大きい逆円錐台状の凹部となっている。配線層440は、ビアホール430xを介して、配線層420と電気的に接続されている。配線層440の材料や配線層440を構成する配線パターンの厚さは、例えば、配線層420と同様とすることができる。   The wiring layer 440 is formed on the other side of the insulating layer 430. The wiring layer 440 includes a via wiring filled in the via hole 430x and a wiring pattern formed on the other surface of the insulating layer 430. The via hole 430x is an inverted frustoconical concave portion in which the diameter of the opening opened on the insulating layer 450 side is larger than the diameter of the bottom surface of the opening formed by the other surface of the wiring layer 420. The wiring layer 440 is electrically connected to the wiring layer 420 through the via hole 430x. The material of the wiring layer 440 and the thickness of the wiring pattern constituting the wiring layer 440 can be the same as that of the wiring layer 420, for example.

絶縁層450は、絶縁層430の他方の面に、配線層440を被覆するように形成されている。絶縁層450の材料や厚さは、例えば、絶縁層410と同様とすることができる。   The insulating layer 450 is formed on the other surface of the insulating layer 430 so as to cover the wiring layer 440. The material and thickness of the insulating layer 450 can be the same as those of the insulating layer 410, for example.

配線層460は、絶縁層450の他方の側に形成されている。配線層460は、ビアホール450x内に充填されたビア配線、及び絶縁層450の他方の面から突出するパッド(ポスト)を含んで構成されている。ビアホール450xは、配線基板8の外側に開口されている開口部の径が配線層440の他方の面によって形成された開口部の底面の径よりも大きい逆円錐台状の凹部となっている。配線層460は、ビアホール450xを介して、配線層440と電気的に接続されている。   The wiring layer 460 is formed on the other side of the insulating layer 450. The wiring layer 460 includes a via wiring filled in the via hole 450x and a pad (post) protruding from the other surface of the insulating layer 450. The via hole 450x is an inverted frustoconical concave portion in which the diameter of the opening opened outside the wiring substrate 8 is larger than the diameter of the bottom surface of the opening formed by the other surface of the wiring layer 440. The wiring layer 460 is electrically connected to the wiring layer 440 through the via hole 450x.

配線層460の材料は、例えば、配線層420と同様とすることができる。配線層460の厚さ(絶縁層450の他方の面から突出するパッド部分も含む)は、例えば、10μm程度とすることができる。配線層460を構成するパッドの平面形状は、例えば、直径が20〜30μm程度の円形とすることができる。配線層460を構成するパッドのピッチは、例えば、40〜50μm程度とすることができる。配線層460を構成するパッドは、半導体チップ等と電気的に接続されるパッドとして機能する。なお、配線層460を構成するパッドの表面(上面のみ、又は上面及び側面)に前述の金属層を形成したり、酸化防止処理を施したりしてもよい。   The material of the wiring layer 460 can be the same as that of the wiring layer 420, for example. The thickness of the wiring layer 460 (including the pad portion protruding from the other surface of the insulating layer 450) can be, for example, about 10 μm. The planar shape of the pads constituting the wiring layer 460 can be a circle having a diameter of about 20 to 30 μm, for example. The pitch of the pads constituting the wiring layer 460 can be about 40 to 50 μm, for example. The pads constituting the wiring layer 460 function as pads that are electrically connected to a semiconductor chip or the like. Note that the metal layer described above may be formed on the surface (only the upper surface, or the upper surface and side surfaces) of the pads constituting the wiring layer 460, or may be subjected to an antioxidant treatment.

[第3の実施の形態に係る配線基板の製造方法]
次に、第3の実施の形態に係る配線基板の製造方法について説明する。図16及び図17は、第3の実施の形態に係る配線基板の製造工程を例示する図である。本実施の形態では、支持体上に複数の配線基板となる部分を作製し支持体を除去後個片化して各配線基板とする工程の例を示すが、支持体上に1個ずつ配線基板を作製し支持体を除去する工程としてもよい。
[Method for Manufacturing Wiring Board According to Third Embodiment]
Next, a method for manufacturing a wiring board according to the third embodiment will be described. 16 and 17 are diagrams illustrating a manufacturing process of the wiring board according to the third embodiment. In this embodiment, an example of a process in which a part to be a plurality of wiring boards is formed on a support, and the support is removed and separated into individual wiring boards is shown. However, one wiring board is provided on each support. It is good also as a process of producing and removing a support body.

まず、図16(a)に示す工程では、図2(a)〜図3(b)と同様の工程を実行し、支持体300上に配線層10、絶縁層20、配線層40、及びソルダーレジスト層50を形成する。   First, in the step shown in FIG. 16A, the same steps as in FIGS. 2A to 3B are executed, and the wiring layer 10, the insulating layer 20, the wiring layer 40, and the solder are formed on the support 300. A resist layer 50 is formed.

次に、図16(b)に示す工程では、図3(c)に示す工程と同様にして、図16(a)に示す支持体300を除去する。ここで、支持体300と配線層10とが同じ金属(例えば、銅等)からなる場合、配線層10の他方の面がエッチングされ、配線層10の他方の面が第1絶縁膜21の他方の面よりも窪んだ状態になる。   Next, in the step shown in FIG. 16B, the support 300 shown in FIG. 16A is removed in the same manner as the step shown in FIG. Here, when the support body 300 and the wiring layer 10 are made of the same metal (for example, copper or the like), the other surface of the wiring layer 10 is etched, and the other surface of the wiring layer 10 is the other side of the first insulating film 21. It will be in a state where it is depressed from the surface.

次に、図16(c)に示す工程では、図16(b)に示す構造体の絶縁層20の他方の面(第1絶縁膜21の他方の面)をCMP法(chemical mechanical polishing法)等を用いて研磨する。この際、配線層10の他方の面の一部を同時に研磨してもよい。これにより、配線層10の他方の面と絶縁層20の他方の面とは平坦面(面一)となる。なお、絶縁層20の第1絶縁膜21は絶縁性樹脂のみから構成されており、ガラスクロス等の補強部材を含有していないため、ガラスクロス等の補強部材が表面から突出するおそれがなく平坦化することが容易である。   Next, in the step shown in FIG. 16C, the other surface of the insulating layer 20 (the other surface of the first insulating film 21) of the structure shown in FIG. 16B is CMP (chemical mechanical polishing method). Etc. are polished. At this time, a part of the other surface of the wiring layer 10 may be simultaneously polished. Thereby, the other surface of the wiring layer 10 and the other surface of the insulating layer 20 become a flat surface (the same surface). The first insulating film 21 of the insulating layer 20 is made of only an insulating resin and does not contain a reinforcing member such as a glass cloth, so that the reinforcing member such as a glass cloth does not protrude from the surface and is flat. It is easy to make.

次に、図17(a)に示す工程では、配線層10の他方の面と絶縁層20の他方の面が形成する平坦面に絶縁層410を形成する。そして、絶縁層410に、絶縁層410を貫通し配線層10の他方の面を露出するビアホール410xを形成する。絶縁層410の材料としては、例えば、エポキシ系樹脂やフェノール系樹脂等を主成分とする感光性の絶縁性樹脂(熱硬化性)を用いることができる。   Next, in the step shown in FIG. 17A, the insulating layer 410 is formed on a flat surface formed by the other surface of the wiring layer 10 and the other surface of the insulating layer 20. Then, a via hole 410 x that penetrates the insulating layer 410 and exposes the other surface of the wiring layer 10 is formed in the insulating layer 410. As a material of the insulating layer 410, for example, a photosensitive insulating resin (thermosetting) whose main component is an epoxy resin or a phenol resin can be used.

具体的には、例えば、配線層10の他方の面と絶縁層20の他方の面が形成する平坦面に、液状又はペースト状の絶縁性樹脂をスピンコート法等により塗布し、加熱して硬化させ、絶縁層410を形成する。そして、絶縁層410を露光及び現像し、ビアホール410xを形成する(フォトリソグラフィ法)。このように、絶縁層410の材料として感光性の絶縁性樹脂を用いることにより、フォトリソグラフィ法によりビアホール410xを形成できるため、微細配線の形成に好適である。なお、図17(a)〜図17(c)は、図16(a)〜図16(c)に対して上下が反転して描かれている。   Specifically, for example, a liquid or paste-like insulating resin is applied to the flat surface formed by the other surface of the wiring layer 10 and the other surface of the insulating layer 20 by spin coating or the like, and cured by heating. The insulating layer 410 is formed. Then, the insulating layer 410 is exposed and developed to form a via hole 410x (photolithography method). Thus, by using a photosensitive insulating resin as the material of the insulating layer 410, the via hole 410x can be formed by a photolithography method, which is suitable for forming fine wiring. 17A to 17C are drawn upside down with respect to FIGS. 16A to 16C.

次に、図17(b)に示す工程では、絶縁層410の他方の側に、例えば、セミアディティブ法等により配線層420を形成する。次に、図17(c)に示す工程では、図17(a)及び図17(b)に示す工程を繰り返し、絶縁層410の他方の側に絶縁層430、配線層440、絶縁層450、及び配線層460を順次積層する。   Next, in the step shown in FIG. 17B, the wiring layer 420 is formed on the other side of the insulating layer 410 by, for example, a semi-additive method. Next, in the process shown in FIG. 17C, the process shown in FIGS. 17A and 17B is repeated, and the insulating layer 430, the wiring layer 440, the insulating layer 450, In addition, the wiring layer 460 is sequentially stacked.

図17(c)の工程の後、図17(c)に示す構造体をスライサー等により個片化することにより、図15に示す配線基板8が複数個完成する。必要に応じ、配線層460を構成するパッドの表面(上面のみ、又は上面及び側面)に前述の金属層を形成したり、酸化防止処理を施したりしてもよい。又、絶縁層450の他方の面に、配線層460を構成するパッドを露出するソルダーレジスト層を設けてもよい。   After the step of FIG. 17C, the structure shown in FIG. 17C is separated into pieces by a slicer or the like, thereby completing a plurality of wiring boards 8 shown in FIG. If necessary, the above-described metal layer may be formed on the surface (only the upper surface, or the upper surface and side surfaces) of the pad constituting the wiring layer 460, or an oxidation treatment may be performed. Further, a solder resist layer that exposes a pad constituting the wiring layer 460 may be provided on the other surface of the insulating layer 450.

このように、第3の実施の形態に係る配線基板8では、配線層10の他方の面と絶縁層20の他方の面(第1絶縁膜21の他方の面)は研磨されて平坦面とされている。そのため、その上に形成される絶縁層410、430、及び450の他方の面も平坦面となる。その結果、絶縁層410、430、及び450の各平坦面に微細な配線層420、440、及び460を容易に形成することができる。   As described above, in the wiring substrate 8 according to the third embodiment, the other surface of the wiring layer 10 and the other surface of the insulating layer 20 (the other surface of the first insulating film 21) are polished to be a flat surface. Has been. Therefore, the other surfaces of the insulating layers 410, 430, and 450 formed thereon are also flat surfaces. As a result, fine wiring layers 420, 440, and 460 can be easily formed on the flat surfaces of the insulating layers 410, 430, and 450, respectively.

〈配線基板の応用例3〉
配線基板の応用例3では、第3の実施の形態に係る配線基板に半導体チップが搭載(フリップチップ実装)された半導体パッケージの例を示す。なお、配線基板の応用例3において、既に説明した実施の形態と同一構成部についての説明は省略する場合がある。
<Application example 3 of wiring board>
Application example 3 of the wiring board shows an example of a semiconductor package in which a semiconductor chip is mounted (flip chip mounting) on the wiring board according to the third embodiment. In the application example 3 of the wiring board, the description of the same components as those of the embodiment described above may be omitted.

図18は、応用例3に係る半導体パッケージを例示する断面図である。図18を参照するに、半導体パッケージ9は、図15に示す配線基板8と、半導体チップ100と、はんだバンプ140と、アンダーフィル樹脂120と、バンプ130とを有する。半導体パッケージ9において、配線基板8の絶縁層450側が半導体チップ100が搭載されるチップ搭載面となり、配線基板8のソルダーレジスト層50側が外部接続端子が形成される外部接続端子面となる。   FIG. 18 is a cross-sectional view illustrating a semiconductor package according to Application Example 3. Referring to FIG. 18, the semiconductor package 9 includes the wiring substrate 8 shown in FIG. 15, a semiconductor chip 100, a solder bump 140, an underfill resin 120, and a bump 130. In the semiconductor package 9, the insulating layer 450 side of the wiring substrate 8 is a chip mounting surface on which the semiconductor chip 100 is mounted, and the solder resist layer 50 side of the wiring substrate 8 is an external connection terminal surface on which external connection terminals are formed.

はんだバンプ140は、半導体チップ100の電極パッド(図示せず)と、配線基板8の配線層460を構成するパッドとを電気的に接続している。なお、半導体チップ100は銅ピラーを有していてもよい。はんだバンプ140の材料としては、例えばPbを含む合金、SnとCuの合金、SnとAgの合金、SnとAgとCuの合金等を用いることができる。   The solder bump 140 electrically connects an electrode pad (not shown) of the semiconductor chip 100 and a pad constituting the wiring layer 460 of the wiring board 8. The semiconductor chip 100 may have a copper pillar. As a material of the solder bump 140, for example, an alloy containing Pb, an alloy of Sn and Cu, an alloy of Sn and Ag, an alloy of Sn, Ag, and Cu can be used.

アンダーフィル樹脂120は、半導体チップ100と配線基板8(絶縁層450)との間に充填されている。バンプ130は、ソルダーレジスト層50の開口部50xの底部に露出する配線層40の表面に形成された外部接続端子である。   The underfill resin 120 is filled between the semiconductor chip 100 and the wiring substrate 8 (insulating layer 450). The bumps 130 are external connection terminals formed on the surface of the wiring layer 40 exposed at the bottom of the opening 50x of the solder resist layer 50.

このように、第3の実施の形態に係る配線基板8に半導体チップ100を搭載することにより、半導体パッケージ9を実現できる。   Thus, the semiconductor package 9 can be realized by mounting the semiconductor chip 100 on the wiring board 8 according to the third embodiment.

以上、好ましい実施の形態等について詳説したが、上述した実施の形態等に制限されることはなく、特許請求の範囲に記載された範囲を逸脱することなく、上述した実施の形態等に種々の変形及び置換を加えることができる。   The preferred embodiments and the like have been described in detail above, but the present invention is not limited to the above-described embodiments and the like, and various modifications can be made to the above-described embodiments and the like without departing from the scope described in the claims. Variations and substitutions can be added.

例えば、上記の実施の形態等では、第1絶縁膜21の下面と配線層10の下面(露出面)とが面一である例や、配線層10の下面が第1絶縁膜21の下面よりも窪んだ位置にある例を示した。しかし、配線層10の下面は第1絶縁膜21の下面よりも突出した位置にあってもよい。   For example, in the above-described embodiment, the lower surface of the first insulating film 21 and the lower surface (exposed surface) of the wiring layer 10 are flush with each other, or the lower surface of the wiring layer 10 is lower than the lower surface of the first insulating film 21. An example is shown in the recessed position. However, the lower surface of the wiring layer 10 may be in a position protruding from the lower surface of the first insulating film 21.

又、支持体300として、銅以外に、ニッケル、クロム、鉄等、銅からなる配線層10とは異なるエッチング液で除去可能な金属箔や金属板を用いてもよい。この場合、配線層10の下面が第1絶縁膜21の下面と面一となる。   In addition to copper, a metal foil or a metal plate that can be removed with an etching solution different from the wiring layer 10 made of copper, such as nickel, chromium, or iron, may be used as the support 300. In this case, the lower surface of the wiring layer 10 is flush with the lower surface of the first insulating film 21.

又、配線層10と同じ金属からなる支持体300の上面に、配線層10と異なる金属からなるエッチングバリア層を設けてもよい。例えば、配線層10及び支持体300が共に銅である場合、支持体300の上面全面に、電解めっき法等により、ニッケル、クロム、鉄等からなるエッチングバリア層を形成する。その後、エッチングバリア層上に配線層10、絶縁層20等を順次積層する。そして、支持体300をエッチングで除去し、次いで、エッチングバリア層を(配線層10をエッチングしないエッチング液を用いて)エッチングで除去し、配線基板が完成する。この場合も、配線層10の下面が第1絶縁膜21の下面と面一となる。   In addition, an etching barrier layer made of a metal different from the wiring layer 10 may be provided on the upper surface of the support 300 made of the same metal as the wiring layer 10. For example, when the wiring layer 10 and the support 300 are both copper, an etching barrier layer made of nickel, chromium, iron, or the like is formed on the entire upper surface of the support 300 by electrolytic plating or the like. Thereafter, the wiring layer 10, the insulating layer 20, and the like are sequentially stacked on the etching barrier layer. Then, the support 300 is removed by etching, and then the etching barrier layer is removed by etching (using an etching solution that does not etch the wiring layer 10), thereby completing the wiring board. Also in this case, the lower surface of the wiring layer 10 is flush with the lower surface of the first insulating film 21.

1、2、3、4、8 配線基板
5、6、7、9 半導体パッケージ
10、40、80、420、440、460 配線層
10a パッド
10b 配線パターン
20、20A、70、410、430、450 絶縁層
20x、70x、410x、430x、450x ビアホール
21 第1絶縁膜
22 第2絶縁膜
23 第3絶縁膜
30 補強部材
50、60 ソルダーレジスト層
50x、60x 開口部
100、210、250 半導体チップ
110、130、220、260、280 バンプ
120 アンダーフィル樹脂
140 はんだバンプ
230 はんだボール
231 銅コアボール
232 はんだ
240 封止樹脂
270 チップコンデンサ
300 支持体
1, 2, 3, 4, 8 Wiring substrate 5, 6, 7, 9 Semiconductor package 10, 40, 80, 420, 440, 460 Wiring layer 10a Pad 10b Wiring pattern 20, 20A, 70, 410, 430, 450 Insulation Layer 20x, 70x, 410x, 430x, 450x Via hole 21 First insulating film 22 Second insulating film 23 Third insulating film 30 Reinforcing member 50, 60 Solder resist layer 50x, 60x Openings 100, 210, 250 Semiconductor chips 110, 130 , 220, 260, 280 Bump 120 Underfill resin 140 Solder bump 230 Solder ball 231 Copper core ball 232 Solder 240 Sealing resin 270 Chip capacitor 300 Support body

Claims (10)

第1絶縁膜の一方の面に第2絶縁膜が積層され、前記第1絶縁膜の他方の面が外部に露出する絶縁層と、
前記第1絶縁膜に埋め込まれ、所定面が前記第1絶縁膜の他方の面から露出するパッド及び配線パターンを有する第1配線層と、
前記第2絶縁膜の前記第1絶縁膜の一方の面と接する面の反対面に形成された配線パターン、及び前記絶縁層を貫通し前記配線パターンと前記第1配線層とを接続するビア配線、を含む第2配線層と、を有し、
前記第1絶縁膜は樹脂のみから構成され、
前記第2絶縁膜は補強部材に樹脂を含浸させた構成とされている配線基板。
A second insulating film is stacked on one surface of the first insulating film, and the other surface of the first insulating film is exposed to the outside;
A first wiring layer having a pad and a wiring pattern embedded in the first insulating film and having a predetermined surface exposed from the other surface of the first insulating film;
A wiring pattern formed on a surface of the second insulating film opposite to a surface in contact with one surface of the first insulating film, and a via wiring that penetrates the insulating layer and connects the wiring pattern and the first wiring layer; And a second wiring layer including
The first insulating film is made of resin only,
The second insulating film is a wiring board in which a reinforcing member is impregnated with a resin.
前記第1絶縁膜は、前記第1配線層の側面と、前記所定面の反対面を被覆し、
前記ビア配線は、前記第2絶縁膜及び前記第1絶縁膜を貫通し、前記所定面の反対面に接続されている請求項1記載の配線基板。
The first insulating film covers a side surface of the first wiring layer and a surface opposite to the predetermined surface,
The wiring board according to claim 1, wherein the via wiring penetrates the second insulating film and the first insulating film and is connected to a surface opposite to the predetermined surface.
前記第1絶縁膜は、前記第1配線層の側面のみを被覆し、
前記ビア配線は、前記第2絶縁膜のみを貫通し、前記所定面の反対面に接続されている請求項1記載の配線基板。
The first insulating film covers only the side surface of the first wiring layer;
The wiring board according to claim 1, wherein the via wiring penetrates only the second insulating film and is connected to a surface opposite to the predetermined surface.
前記所定面の反対面は、前記第1絶縁膜の一方の面から前記第2絶縁膜内に突出している請求項3記載の配線基板。   The wiring board according to claim 3, wherein a surface opposite to the predetermined surface protrudes into the second insulating film from one surface of the first insulating film. 前記第1絶縁膜の他方の面に、複数の前記パッドの所定面を一括で露出する開口部を備えたソルダーレジスト層が積層されている請求項1乃至4の何れか一項記載の配線基板。   5. The wiring board according to claim 1, wherein a solder resist layer having an opening that exposes a predetermined surface of the plurality of pads is laminated on the other surface of the first insulating film. . 前記第1絶縁膜の他方の面は、半導体チップを搭載するチップ搭載面である請求項1乃至5の何れか一項記載の配線基板。   The wiring board according to claim 1, wherein the other surface of the first insulating film is a chip mounting surface on which a semiconductor chip is mounted. 前記第2配線層の配線パターンを被覆するように、前記第2絶縁膜に積層された他の絶縁層と、
前記他の絶縁層に積層され、前記第2配線層の配線パターンと接続される第3配線層と、を有する請求項1乃至6の何れか一項記載の配線基板。
Another insulating layer laminated on the second insulating film so as to cover the wiring pattern of the second wiring layer;
The wiring board according to claim 1, further comprising: a third wiring layer stacked on the other insulating layer and connected to the wiring pattern of the second wiring layer.
支持体の上面に第1配線層を形成する工程と、
前記支持体の上面に、前記第1配線層を被覆するように、樹脂のみから構成された半硬化状態の第1絶縁膜を形成する工程と、
前記第1絶縁膜上に、補強部材に樹脂を含浸させた構成とされた半硬化状態の第2絶縁膜を積層する工程と、
前記第1絶縁膜及び前記第2絶縁膜を硬化させ、前記第1絶縁膜上に前記第2絶縁膜が積層された絶縁層を作製する工程と、
前記絶縁層を貫通して前記第1配線層の上面を露出するビアホールを形成する工程と、
前記第2絶縁膜上に形成された配線パターン、及び前記ビアホール内に形成され、前記配線パターンと前記第1配線層とを接続するビア配線、を含む第2配線層を形成する工程と、を有する配線基板の製造方法。
Forming a first wiring layer on the upper surface of the support;
Forming a semi-cured first insulating film made of resin alone on the upper surface of the support so as to cover the first wiring layer;
Laminating a semi-cured second insulating film having a structure in which a reinforcing member is impregnated with resin on the first insulating film;
Curing the first insulating film and the second insulating film, and producing an insulating layer in which the second insulating film is laminated on the first insulating film;
Forming a via hole penetrating the insulating layer and exposing an upper surface of the first wiring layer;
Forming a second wiring layer including a wiring pattern formed on the second insulating film and a via wiring that is formed in the via hole and connects the wiring pattern and the first wiring layer. A method for manufacturing a wiring board.
支持体の上面に第1配線層を形成する工程と、
樹脂のみから構成された半硬化状態の第1絶縁膜、及び前記第1絶縁膜上に積層された、補強部材に樹脂を含浸させた構成とされた半硬化状態の第2絶縁膜、を有する絶縁層を準備する工程と、
前記第1絶縁膜を前記支持体側に向けて、前記支持体の上面に前記第1配線層を被覆するように前記絶縁層を貼り付け、前記絶縁層を硬化させる工程と、
前記絶縁層を貫通して前記第1配線層の上面を露出するビアホールを形成する工程と、
前記第2絶縁膜上に形成された配線パターン、及び前記ビアホール内に形成され、前記配線パターンと前記第1配線層とを接続するビア配線、を含む第2配線層を形成する工程と、を有する配線基板の製造方法。
Forming a first wiring layer on the upper surface of the support;
A semi-cured first insulating film made of resin only, and a semi-cured second insulating film laminated on the first insulating film and impregnated with a resin in a reinforcing member. Preparing an insulating layer; and
Attaching the insulating layer so as to cover the first wiring layer on the upper surface of the support with the first insulating film facing the support, and curing the insulating layer;
Forming a via hole penetrating the insulating layer and exposing an upper surface of the first wiring layer;
Forming a second wiring layer including a wiring pattern formed on the second insulating film and a via wiring that is formed in the via hole and connects the wiring pattern and the first wiring layer. A method for manufacturing a wiring board.
前記支持体を除去する工程を有する請求項8又は9記載の配線基板の製造方法。   The method for manufacturing a wiring board according to claim 8, further comprising a step of removing the support.
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