JP2015520425A - 計算機システム及びその制御方法 - Google Patents
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Abstract
Description
次に本発明にストレージシステムの実施形態を図面に基づいて説明する。ストレージシステムは、デュアルコントローラ構成を備える。図1は、第1の実施形態に係るストレージシステムを有する計算機システムのハードウェアブロック図である。計算機システム1は、ホスト計算機2、管理端末3、ストレージシステム4、ネットワーク5,6を備える。ネットワーク5は、ホスト計算機2とストレージシステ4とを接続するためのものであり、特に、SANである。ネットワーク6は、ストレージシステム4と管理端末3とを接続する、特に、LANである。ホスト計算機2は、例えば、大型汎用コンピュータ、サーバ、クライアント端末である。ホスト計算機2はSAN5を介さずにストレージシステム4に接続されてもよい。また、管理端末3は、LAN6を介さずにストレージシステムに接続されてもよい。
第1の実施形態では、既述の優先処理を割込処理によって実現したが、第2の実施形態では、プロセッサにマルチコアのタイプのものを採用し、一部のコアを優先処理専用として設定し、当該コアがホストI/O処理を行わないようにすることによって優先処理が達成されるようにした。図16は第2の実施形態のMPUメモリ102aの構成である。第1の実施形態と異なるのは、ローカルメモリ11aに、複数のコアプロセッサのうちの専用コアプロセッサを判定するためのテーブル113aが追加されている点と、通信エリア14aにコア毎割込用通信エリア143a、および、コア毎通常通信エリア144aが追加されている点である。他系コントローラ100bのMPUメモリ102bも同様である。
第3の実施形態は、第2の実施形態の変形として、Simultaneous Multi−Threading(SMT)を用いることを特徴とする。SMTを用いることによって一つの物理コアをスレッドという仮想的な複数のコアとして扱うことができる。このスレッドを仮想コアと呼ぶ。本実施形態によれば、既述の専用コア判定テーブル113において、エントリが仮想コア数分用意されることになる。コアフィールドには仮想コアの識別番号が記録される。この仮想コアのうち1以上を専用コアとして設定できる点は第2の実施形態と同じである。
次に、既述の第2実施形態の変形例としての第4の実施形態について説明する。この実施形態は、コントローラの依頼送信プログラム207aが他系コントローラ100bに依頼した処理が完了したと判定するための要件を定め、この要件を達成するための依頼方式を選択することを特徴とする。この特徴点のために、第2の実施形態に係るMPUメモリのローカルメモリ11(図16)に、当該要件を決定するためのテーブルとこの要件を達成するための依頼方式を選択するためのテーブルが追加されている。前者の例が依頼方式要件テーブルと称するものであり、後者の例が依頼方式利用可否テーブルと称するものである。
第4の実施形態の変形例としての第5実施形態について説明する。第5実施形態は、ユーザがI/O処理に対する性能要件を定め、これに応じて通信の期待応答時間を補正する例を示す。I/O処理に対する性能要件として、レスポンス時間(ホストがI/Oコマンドを発行してからストレージシステムから応答が返されるまでの所要時間)である場合を示す。
Claims (14)
- ホスト計算機と記憶領域との間のデータ転送を制御するストレージシステムであって、
第1のコントローラと、
第2のコントローラと、
前記第1のコントローラの第1のプロセッサと、
前記第2のコントローラの第2のプロセッサと、
前記第1のプロセッサと前記第2のプロセッサとを接続するバスと、
を備え、
前記第1のプロセッサは前記第2のプロセッサに当該第2のプロセッサによって処理されるべき依頼情報を送信し、
前記第2のプロセッサは前記依頼情報を処理してその応答を前記第1のプロセッサに返し、
前記第1のプロセッサは、前記依頼情報を前記第1のプロセッサによって優先処理されるべきものであるか否かを判定して前記第2のプロセッサに送信し、
前記第2のプロセッサは、前記依頼情報を優先処理されるものと、優先処理がされないものとを区別して取得する、ストレージシステム。 - 前記第1のプロセッサは、
前記依頼情報を優先処理されるべきものと判定すると、当該依頼情報を前記第2のコントローラの第1の領域に提供し、
前記依頼情報を優先処理優先されなくてもよいものと判定すると、当該依頼情報を前記第2のコントローラの第2の領域に提供し、
前記第2のプロセッサは、前記第1の領域を前記第2の領域よりも優先して処理する、
請求項1記載のストレージシステム。 - 前記第1の領域は、前記ホスト計算機からのI/O処理に対して割込み処理がされる情報が記録される第1の記録部であり、前記第2の領域は、前記ホスト計算機からのI/O処理に対して非割込み処理がされる情報が記録される第2の記録部であり、前記第2のプロセッサは、前記第1のプロセッサから、前記第1の記録部に前記優先処理される依頼情報が送信されたことを受信すると、当該依頼情報を前記ホスト計算機からのI/O処理に対して優先処理する、請求項1記載のストレージシステム。
- 前記優先処理される依頼情報は、前記第1のコントローラと前記第2のコントローラによって共有される共有情報であって、前記第2のコントローラのメモリに記録されている共有情報に対するアクセスのための情報である、請求項1記載のストレージシステム。
- 前記優先処理されない依頼情報は、前記第2のコントローラのハードウェアリソースに対する、データ転送のための起動を求める情報である、請求項1記載のストレージシステム。
- 前記第1のプロセッサは、前記ホスト計算機からI/Oを受領した際、前記第2のコントローラの前記共有情報が更新されたか否かを判定し、更新されたことを判定すると、第2のプロセッサに前記第2のコントローラの前記共有情報をリードする依頼情報を送信する、請求項4記載のストレージシステム。
- 前記第1のプロセッサは前記第1の領域に前記依頼情報を記録して、当該依頼情報を前記第2のプロセッサに処理させる際、前記第1の領域に所定数以上の依頼情報を記録すると割込み要求を前記第2のプロセッサに送信し、当該第2のプロセッサは当該割込み要求を契機として、前記第1の領域に記録されている所定数以上の依頼情報を纏めて処理する、請求項3記載のストレージシステム。
- 前記第2のプロセッサは複数のコアから構成されており、
前記第1の領域は前記複数のコアの内の一つ又は複数の専用コアであり、
前記第2の領域は前記複数のコアの内の前記専用コア以外の通常コアであり、
前記専用コアは、前記ホスト計算機からのI/O処理よりも前記依頼情報の処理を優先させ、
前記通常コアは、前記ホスト計算からのI/O処理とともに前記依頼情報の処理を行い、
前記第1のプロセッサは、前記優先処理されるべき依頼情報を、前記通常コアより前記専用コアを優先して、当該専用コアに送信する、請求項2記載のストレージシステム。 - 前記第2のプロセッサは前記複数のコアの負荷状態に応じて、前記複数のコアのうちの前記専用コアと前記通常コアの割合を変更する、請求項8記載のストレージシステム。
- 前記第1のプロセッサは、前記専用コアの負荷が高い場合には、前記通常コアに前記ホスト計算機からのI/O処理よりも前記依頼情報の処理を優先させる、請求項8記載のストレージシステム。
- 前記第2のプロセッサには複数の仮想コアが設定可能であり、前記第1のプロセッサからの要求によって、前記複数の仮想コアの一つ又は複数が前記通常コアから前記専用コアに変更される、請求項8記載のストレージシステム。
- 前記第1のプロセッサは、前記依頼情報が送信される、前記第2のコントローラのアクセス先ハードウェアとアクセスの種別に応じて、前記第2のプロセッサに要求する応答時間を決定し、この応答時間を満足するように前記依頼情報の前記第2のプロセッサに対する送信形態を選択する、請求項1記載のストレージシステム。
- 前記第1のプロセッサは、前記第2のプロセッサに要求する応答時間を補正することができる、請求項12記載のストレージシステム。
- 第1のコントローラの第1のプロセッサと第2のコントローラの第2のプロセッサとがバスによって接続されたストレージシステムが、ホスト計算機と記憶領域との間のデータ転送を制御する制御方法であって、
前記第1のプロセッサは前記第2のプロセッサに当該第2のプロセッサによって処理されるべき依頼情報を送信し、
前記第2のプロセッサは前記依頼情報を処理してその応答を前記第1のプロセッサに返し、
前記第1のプロセッサは、前記依頼情報を前記第1のプロセッサによって優先処理されるべきものであるか否かを判定して前記第2のプロセッサに送信し、
前記第2のプロセッサは、前記依頼情報を優先処理されるものと、優先処理がされないものとを区別して取得する、ストレージシステムの制御方法。
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