JP2015128258A - AD conversion circuit and AD conversion method - Google Patents
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Abstract
Description
本発明は、AD変換回路及びAD変換方法に関する。 The present invention relates to an AD conversion circuit and an AD conversion method.
従来、高速AD変換を実現するために、異なる電圧レベルの複数の参照電圧のスロープを用い高速化を検討されたものがある。例えば、特許文献1には、異なるスロープを持つ低解像度のADCにより得られたサンプリング値を合算することで雑音を抑制し、正確な変換値を得る技術が開示されている。
Conventionally, in order to realize high-speed AD conversion, there has been a study of speeding up using a plurality of reference voltage slopes of different voltage levels. For example,
しかしながら、異なる電圧レベルの複数のスロープを用いた場合、複数の参照電圧の傾きのバラツキやオフセット誤差によるAD変換のエラーが大きな問題となっている。 However, when a plurality of slopes having different voltage levels are used, the AD conversion error due to the variation in the inclination of the plurality of reference voltages or the offset error is a serious problem.
そこで、本発明は、上記問題に鑑みてなされたものであり、本発明の目的とするところは、複数の参照電圧の傾きのバラツキやオフセット誤差による変換エラーを確実に抑止することが可能な、新規かつ改良されたAD変換回路及びAD変換方法を提供することにある。 Therefore, the present invention has been made in view of the above problems, and the object of the present invention is to reliably suppress conversion errors due to variations in the gradients of reference voltages and offset errors. It is an object to provide a new and improved AD conversion circuit and AD conversion method.
上記課題を解決するために、本発明のある観点によれば、画素出力値の参照電圧が第1のカウンタのカウント値のアップカウントに応じて増加するアップスロープと、画素出力値の参照電圧が第2のカウンタのカウント値のダウンカウントに応じて減少するダウンスロープと、の間にクロスポイントが形成されるように前記アップスロープ及び前記ダウンスロープを生成するスロープ生成部と、画素回路から出力された画素出力値と前記アップスロープ又は前記ダウンスロープの参照電圧とが一致した時点での前記第1又は第2のカウンタのカウント値を取得するAD変換部と、を備えるAD変換回路が提供される。この構成によれば、画素出力値の参照電圧が第1のカウンタのカウント値のアップカウントに応じて増加するアップスロープと、画素出力値の参照電圧が第2のカウンタのカウント値のダウンカウントに応じて減少するダウンスロープと、の間にクロスポイントが形成される。クロスポイントにおいて第1のカウンタのカウント値と第2のカウンタのカウンタ値を一致させることで、アップスロープとダウンスロープとの間のオフセット誤差を考慮して高精度なAD変換を実現することが可能となる。 In order to solve the above problem, according to an aspect of the present invention, an up slope in which a reference voltage of a pixel output value increases according to an up count of a count value of a first counter, and a reference voltage of a pixel output value A slope generator that generates the up slope and the down slope so as to form a cross point between the down slope that decreases according to the down count of the count value of the second counter, and is output from the pixel circuit. An AD conversion circuit is provided that includes an AD conversion unit that acquires a count value of the first or second counter at the time when the pixel output value matches the reference voltage of the up slope or the down slope. . According to this configuration, the reference voltage of the pixel output value increases in accordance with the up-count of the count value of the first counter, and the reference voltage of the pixel output value becomes the down-count of the count value of the second counter. A cross point is formed between the down slope and the corresponding slope. By matching the count value of the first counter with the counter value of the second counter at the cross point, it is possible to realize highly accurate AD conversion in consideration of the offset error between the up slope and the down slope. It becomes.
前記アップスロープと前記ダウンスロープのクロスポイントにおける前記第1のカウンタ及び前記第2のカウンタの一方のカウント値に基づいて他方のカウント値を補正する補正部を更に備える。この構成によれば、クロスポイントにおける第1のカウンタ及び第2のカウンタの一方のカウント値に基づいて他方のカウント値が補正されるため、クロスポイントにおける第1のカウンタのカウント値と第2のカウンタのカウンタ値を一致させることができ、アップスロープとダウンスロープとの間のオフセット誤差を考慮して高精度なAD変換を実現することが可能となる。 A correction unit is further provided for correcting the other count value based on one count value of the first counter and the second counter at the cross point of the up slope and the down slope. According to this configuration, since the other count value is corrected based on one count value of the first counter and the second counter at the cross point, the count value of the first counter at the cross point and the second counter value are corrected. The counter values of the counters can be matched, and high-precision AD conversion can be realized in consideration of the offset error between the up slope and the down slope.
また、前記スロープ生成部は、前記アップスロープの始点と前記ダウンスロープの始点とを一致させて前記アップスロープ及び前記ダウンスロープを生成する。この構成によれば、アップスロープの始点とダウンスロープの始点とが一致した状態でアップスロープ及びダウンスロープが生成されるためアップスロープとダウンスロープとの間にオフセット誤差が生じることを確実に抑止できる。 Further, the slope generation unit generates the up slope and the down slope by matching a start point of the up slope and a start point of the down slope. According to this configuration, since the up slope and the down slope are generated in a state where the start point of the up slope and the start point of the down slope coincide with each other, it is possible to reliably suppress occurrence of an offset error between the up slope and the down slope. .
上記課題を解決するために、本発明のある観点によれば、画素回路から出力された画素出力値の参照電圧が第1のカウンタのカウント値のアップカウントに応じて増加するアップスロープと、画素出力値の参照電圧が第2のカウンタのカウント値のダウンカウントに応じて減少するダウンスロープと、の間にクロスポイントが形成されるように前記アップスロープ及び前記ダウンスロープを生成するステップと、画素出力値と前記アップスロープ又は前記ダウンスロープの参照電圧とが一致した時点での前記第1又は第2のカウンタのカウント値を取得するステップと、を備えるAD変換方法が提供される。この構成によれば、画素出力値の参照電圧が第1のカウンタのカウント値のアップカウントに応じて増加するアップスロープと、画素出力値の参照電圧が第2のカウンタのカウント値のダウンカウントに応じて減少するダウンスロープと、の間にクロスポイントが形成される。クロスポイントにおいて第1のカウンタのカウント値と第2のカウンタのカウンタ値を一致させることで、アップスロープとダウンスロープとの間のオフセット誤差を考慮して高精度なAD変換を実現することが可能となる。 In order to solve the above problem, according to an aspect of the present invention, an up slope in which a reference voltage of a pixel output value output from a pixel circuit increases in accordance with an up count of a count value of a first counter, Generating the up-slope and the down-slope so that a cross-point is formed between a down-slope in which a reference voltage of the output value decreases in accordance with a down-count of the count value of the second counter; Obtaining a count value of the first or second counter at a time point when an output value and a reference voltage of the up slope or the down slope coincide with each other. According to this configuration, the reference voltage of the pixel output value increases in accordance with the up-count of the count value of the first counter, and the reference voltage of the pixel output value becomes the down-count of the count value of the second counter. A cross point is formed between the down slope and the corresponding slope. By matching the count value of the first counter with the counter value of the second counter at the cross point, it is possible to realize highly accurate AD conversion in consideration of the offset error between the up slope and the down slope. It becomes.
前記アップスロープと前記ダウンスロープのクロスポイントにおける前記第1のカウンタ及び前記第2のカウンタの一方のカウント値に基づいて他方のカウント値を補正するステップを更に備える。この構成によれば、クロスポイントにおける第1のカウンタ及び第2のカウンタの一方のカウント値に基づいて他方のカウント値が補正されるため、クロスポイントにおける第1のカウンタのカウント値と第2のカウンタのカウンタ値を一致させることができ、アップスロープとダウンスロープとの間のオフセット誤差を考慮して高精度なAD変換を実現することが可能となる。 The method further includes a step of correcting the other count value based on one count value of the first counter and the second counter at the cross point of the up slope and the down slope. According to this configuration, since the other count value is corrected based on one count value of the first counter and the second counter at the cross point, the count value of the first counter at the cross point and the second counter value are corrected. The counter values of the counters can be matched, and high-precision AD conversion can be realized in consideration of the offset error between the up slope and the down slope.
前記スロープを生成するステップにおいて、前記アップスロープの始点と前記ダウンスロープの始点とを一致させて前記アップスロープ及び前記ダウンスロープを生成する。この構成によれば、アップスロープの始点とダウンスロープの始点とが一致した状態でアップスロープ及びダウンスロープが生成されるためアップスロープとダウンスロープとの間にオフセット誤差が生じることを確実に抑止できる。 In the step of generating the slope, the up slope and the down slope are generated by matching a start point of the up slope and a start point of the down slope. According to this configuration, since the up slope and the down slope are generated in a state where the start point of the up slope and the start point of the down slope coincide with each other, it is possible to reliably suppress occurrence of an offset error between the up slope and the down slope. .
本発明によれば、複数の参照電圧の傾きのバラツキやオフセット誤差による変換エラーを確実に抑止することが可能となる。 According to the present invention, it is possible to reliably suppress conversion errors due to variations in the gradients of a plurality of reference voltages and offset errors.
以下に添付図面を参照しながら、本発明の好適な実施の形態について詳細に説明する。なお、本明細書及び図面において、実質的に同一の機能構成を有する構成要素については、同一の符号を付することにより重複説明を省略する。 Exemplary embodiments of the present invention will be described below in detail with reference to the accompanying drawings. In addition, in this specification and drawing, about the component which has the substantially same function structure, duplication description is abbreviate | omitted by attaching | subjecting the same code | symbol.
最初に、本実施形態に係るAD変換回路を説明する前提として、複数のスロープを用いたAD変換の手法について説明する。図1は、複数のスロープを用いたAD変化の手法を示す模式図である。 First, as a premise for explaining the AD conversion circuit according to the present embodiment, an AD conversion method using a plurality of slopes will be described. FIG. 1 is a schematic diagram illustrating a method of AD change using a plurality of slopes.
図1(a)及び図1(b)において、上段の図は、縦軸の画素値(アナログ値)に対して設定された4つのスロープ500,502,504,506を示している。また、下段の図は、4つのスロープ500,502,504,506に対してそれぞれ設定された4つのカウンタ600,602,604,606の値を示している。例えば、スロープ502に対応する画素値v(アナログ値)をAD変換する際には、始点P2から終点P3に向かってスロープ502の参照電圧Vref2(アナログ値)を変化させながら参照電圧Vref2と画素値vを比較していく。同時に、スロープ502に対応するカウンタ602をカウントアップしていく。そして、スロープ502の参照電圧Vref2と画素値vが一致した時点でラッチ信号を出力し、この時点でのカウンタ602のカウント値“22”を画素値vのAD変換値とする。
In FIG. 1A and FIG. 1B, the upper diagram shows four
図1(a)に示す構成によれば、複数のスロープ500,502,504,506を設けることにより、スロープが1つである場合と比較して1/4の時間で参照電圧との比較を行うことができ、AD変換の高速化を図ることができる。
According to the configuration shown in FIG. 1A, by providing a plurality of
図1(a)は、複数のスロープが同じ傾きで構成され、オフセット誤差も生じていない場合を示している。つまり、図1(a)に示す各スロープ500,502,504,506の傾きは全て同一である。また、スロープ500の終点P1とスロープ502の始点P2の電圧値は同一である。また、スロープ502の終点P3とスロープ504の始点P4の電圧値は同一であり、スロープ504の終点P5とスロープ506の始点P6の電圧値は同一である。従って、スロープ500,502,504,506にオフセット誤差は生じていない。
FIG. 1A shows a case where a plurality of slopes are configured with the same inclination and no offset error occurs. That is, the slopes of the
図1(a)に示すような理想的なスロープが構成されていれば、複数の参照電圧の傾きのバラツキやオフセット誤差による変換エラーは発生せず、理想的な高速AD変換が可能である。 If an ideal slope as shown in FIG. 1A is configured, an ideal high-speed AD conversion is possible without causing a conversion error due to a variation in the inclination of a plurality of reference voltages or an offset error.
しかしながら、図1(a)に示すような理想的なスロープが現実に構成されることは稀であり、図1(b)に示すように各スロープ500,502,504,506の傾きにバラツキが生じることが多い。また、図1(b)に示すように、各スロープ500,502,504,506のオフセットにもバラツキが生じることが多い。
However, it is rare that an ideal slope as shown in FIG. 1 (a) is actually constructed, and the slopes of the
図1(b)に示す例では、各スロープ500,502,504,506のオフセットにバラツキが生じた結果、スロープ500の終点P1とスロープ502の始点P2の電圧値は一致していない。また、スロープ502の終点P3とスロープ504の始点P4の電圧値は一致しておらず、スロープ504の終点P5とスロープ506の始点P6の電圧値も一致していない。
In the example shown in FIG. 1B, as a result of variations in the offsets of the
従って、図1(b)に示すスロープ500,502,504,506では、傾き、及びオフセットにバラツキが生じている結果、変換エラーが発生することになる。例えば、スロープ502を例に挙げると、図1(b)のスロープ502は図1(a)のスロープ502よりも傾きが緩く、上側(高電圧側)にシフトしている。従って、図1(a)と同様に画素値vをAD変換すると、本来は値“22”が出力されるにも関わらず、値“24”が出力されてしまい、変換エラーが生じてしまう。
Therefore, in the
本実施形態では、各スロープの傾き、オフセット等のバラツキによる変換誤差を補正し、高速AD変換の変換精度を大幅に向上させる。図2は、本実施形態によるスロープ100,102,104,106を示す特性図である。一例として、本実施形態では、参照電圧の奇数番(Vref1,Vref3)をアップ(Up)カウントし、偶数番(Vref2,Vref4)をダウン(Down)カウントするスロープを生成する。すなわち、奇数番の参照電圧Vref1,Vref3は、スロープ100,104を用いてアップカウントし、偶数番の参照電圧Vref2,Vref4は、スロープ102,106を用いてダウンカウントする。図2の下段の図は、4つのスロープ100,102,104,106に対してそれぞれ設定された4つのカウンタ200,202,204,206の値を示している。
In this embodiment, a conversion error due to variations in slope, offset, etc. of each slope is corrected, and the conversion accuracy of high-speed AD conversion is greatly improved. FIG. 2 is a characteristic diagram showing the
このように構成することで、スロープ100,104はカウントに伴って参照電圧Vref1,Vref3が増加するスロープとなり、スロープ102,106はカウントに伴って参照電圧Vref2,Vref4が低下するスロープとなる。これにより、スロープ100とスロープ102に交点(クロスポイント)P11が設けられ、スロープ102とスロープ104に交点(クロスポイント)P12が設けられ、スロープ104とスロープ106に交点(クロスポイント)P13が設けられる。
With this configuration, the
そして、各スロープのバラツキを補正するためにカウント値をオフセットして補正するようにする。図2(a)において、各スロープ100,102,104,106が交わるクロスポイントP11,P12,P13でのカウンタ値は同じ値であるべきである。図2(a)に示すように、理想的なクロスポイントとは異なる位置で各スロープが交差した場合は、誤差が生じていると判断し、クロスポイントでのカウンタ値の誤差を検出してカウンタ値そのものを図2(b)に示すように補正する。
Then, in order to correct the variation of each slope, the count value is offset and corrected. In FIG. 2A, the counter values at the cross points P11, P12, P13 where the
より詳細には、交点P11でのスロープ100によるAD変換値とスロープ102によるAD変換値は同一となることから、カウンタ202の値を交点P11でのカウンタ200の値に基づいて補正する。同様に、交点P12でのスロープ102によるAD変換値とスロープ104によるAD変換値は同一となることから、カウンタ204の値を交点P12でのカウンタ202の値に基づいて補正する。同様に、交点P13でのスロープ104によるAD変換値とスロープ106によるAD変換値は同一となることから、カウンタ206の値を交点P13でのカウンタ204の値に基づいて補正する。
More specifically, since the AD conversion value by the
具体的には、図2(a)において、交点P11におけるカウンタ200のカウント値は“14”である。一方、交点P11におけるカウンタ202のカウント値は“18”である。従って、交点P11におけるカウンタ200のカウント値は、カウンタ202のカウント値よりも“4”だけ少ない。このため、カウンタ202のAD変換値は、変換後の値から“4”が減算される。これにより、クロスポイントP11におけるカウンタ200とカウンタ202の変換値が一致し、クロスポイントP11におけるカウンタ値が“14”となる。
Specifically, in FIG. 2A, the count value of the
次に、図2(a)において、クロスポイントP12におけるカウンタ202のカウント値は“36”である一方、クロスポイントP12におけるカウンタ204のカウント値は“28”である。従って、交点P12におけるカウンタ202のカウント値は、カウンタ204のカウント値よりも“8”だけ大きい。上述のカウンタ202の補正値“−4”を考慮すると、交点P12におけるカウンタ202のカウント値は、カウンタ204のカウント値よりも“4”だけ大きい。このため、カウンタ204のAD変換値は、変換後の値から“4”が加算される。これにより、図2(b)に示すように、クロスポイントP12におけるカウンタ202とカウンタ204の変換値が一致し、クロスポイントP12におけるカウンタ値が“32”となる。
Next, in FIG. 2A, the count value of the
次に、図2(a)において、クロスポイントP13におけるカウンタ204のカウント値は“49”である一方、クロスポイントP13におけるカウンタ206のカウント値は“47”である。従って、交点P13におけるカウンタ204のカウント値は、カウンタ206のカウント値よりも“2”だけ少ない。上述のカウンタ204の補正値“+4”を考慮すると、交点P13におけるカウンタ204のカウント値は、カウンタ206のカウント値よりも“6”だけ大きい。このため、カウンタ206のAD変換値は、変換後の値から“6”が加算される。これにより、図2(b)に示すように、クロスポイントP13におけるカウンタ204とカウンタ206の変換値が一致し、クロスポイントP13におけるカウンタ値が“53”となる。
Next, in FIG. 2A, the count value of the
これにより、クロスポイントP11,P12,P13を介してスロープ100,102,104,106が接続され、各スロープ100,102,104,106の参照電圧Vref1,Vref2,Vref3,Vref4とカウンタ200,202,204,206によるAD変換エラーを確実に抑止することが可能となる。
Thus, the
図3は、フレーム単位での読み出しシーケンスを示す模式図である。図3に示すように、1フレーム毎の読み出しの処理(Pixel Readout)において、実際に画素出力を読み出してAD変換が行われる。この読み出しの処理の前に、スロープの補正を行うキャリブレーション(Calibration)を実施する。図2に示す例では、このキャリブレーションは、上述したクロスポイントP11,P12,P13の数だけ行われる。また、フレーム毎にキャリブレーションが必要になるため、クロスポイントを減らすことで、キャリブレーションの回数を減らし、フレームレートを改善することが可能である。 FIG. 3 is a schematic diagram showing a reading sequence in units of frames. As shown in FIG. 3, in the reading process (Pixel Readout) for each frame, the pixel output is actually read and AD conversion is performed. Before this reading process, calibration (Calibration) for correcting the slope is performed. In the example shown in FIG. 2, this calibration is performed for the number of cross points P11, P12, and P13 described above. Further, since calibration is required for each frame, it is possible to reduce the number of calibrations and improve the frame rate by reducing cross points.
図4は、クロスポイントを減らすためのAD変換回路300を示す模式図である。図4に示すAD変換回路300は、画素回路302、第1判定を行う第1判定部(CMP1)304、2つのスロープ(Dual Slope)を出力するスロープ生成部(Slope Gen)306、スロープの参照電圧と画素出力値を比較する比較部(CMP2)308、比較部(CMP2)308からのラッチ信号を受け取り、デジタル信号を出力する変換カウンタ(Conversion Counter)310、デジタル出力値を補正する補正部(Correction)312から構成されている。
FIG. 4 is a schematic diagram showing an
図5は、図4のAD変換回路300による補正例を示す模式図である。図2と比較すると、スロープ400とスロープ402のスタートポイントP21が共通している。また、スロープ404とスロープ406のスタートポイントP21が共通している。クロスポイントはP22の1つのみである。参照電圧Vref1およびVref2は電圧値V2(スタートポイントP21)からスタートし、参照電圧Vref3およびVref4は電圧値V2(スタートポイントP21)からスタートしている。従って、オフセットを共通化しているためカウントのスタート値にズレが生じることはない。
FIG. 5 is a schematic diagram showing an example of correction by the
スロープ生成部306は、スタートポイントP21を始点として2つのスロープ400,402を生成し、スタートポイントP22を始点として2つのスロープ404,404を生成する。従って、クロスポイントP21,P22については、カウンタ値の補正は不要である。
The
画素読み出しの際、第1判定部304は、画素回路302から出力された画素出力値に基づいて、画素出力値が参照電圧Vref1,Vref2,Vref3,Vref4のいずれに相当するかを判定する。その判定結果を受け、スロープ生成部206は、ダウンスロープを使うか、アップスロープを使うか、またオフセットを加えるかどうかを識別する。比較部308は、画素回路302からの画素出力値とダウンスロープまたはアップスロープの参照電圧を比較していく。同時に、変換カウンタ310は、カウンタ320,322,324,326によるカウントを開始する。この際、変換カウンタ310は、画素出力値に基づいて、カウンタ320,322,324,326のいずれかを選択する。スロープ400を使う場合はカウンタ320が選択され、スロープ402を使う場合はカウンタ322が選択され、スロープ404を使う場合はカウンタ324が選択され、スロープ406を使う場合はカウンタ326が選択される。
During pixel reading, the
比較部308による比較の結果、画素出力値と参照電圧が一致して比較部308の出力がハイ(High)になると、ラッチ信号を変換カウンタ310に出力する。変換カウンタ310は、ラッチ信号が入力された時のカウンタの出力値(デジタル値)が取得される。カウンタの出力値は、補正部312へ出力される。補正部312は、予め取得しておいた補正値を用いてカウンタの出力値を補正する。
As a result of comparison by the
画素出力値をAD変換する前に、補正部312で使用される補正値が求められる。この場合、トランジスタCP2をオフにして画素出力値の比較部(CMP2)308への入力をオフにした状態で、スロープ204,404の参照電圧Vref2,Vref4が比較部(CMP2)308へ入力される。比較部208では、参照電圧Vref2,Vref4を比較し、参照電圧Vref2,Vref4が一致したときにラッチ信号を変換カウンタ310に出力する。このときのカウンタ322,324のカウント値からカウンタ322,324のオフセットが求められる。補正部312は求めたオフセットを補正値として保持しておく。
Before AD conversion of the pixel output value, a correction value used by the
図5の例では、図5(a)に示すように、クロスポイントP21におけるカウンタ322の値は“34”であり、カウンタ324の値は“30”である。このため、図5(b)に示すように、補正部312は、カウンタ324の値に“4”を加算する補正が行われる。これに伴い、カウンタ326の値にも“4”を加算する補正が行われる。これにより、AD変換エラーの発生を抑止することができる。
In the example of FIG. 5, as shown in FIG. 5A, the value of the
なお、図4に示すAD変換回路300は、図5に示したスロープ400とスロープ402のスタートポイントP21が共通し、スロープ404とスロープ406のスタートポイントP21が共通している場合の他、図2に示したクロスポイントが3つ存在する場合にも適用することができる。
The
図2に示したスロープに適用する場合、スロープ生成部206は、4つのスロープ100,102,104,106を生成し、画素出力値をAD変換する前に補正部312で使用される補正値を予め求めておく。この場合、トランジスタCP2をオフにして画素出力値の比較部(CMP2)308への入力をオフにした状態で、スロープ100,102の参照電圧Vref1,Vref2が比較部(CMP2)308へ入力される。比較部208では、参照電圧Vref1,Vref2を比較し、参照電圧Vref1,Vref2が一致したときにラッチ信号を変換カウンタ310に出力する。このときのカウンタ200,202のカウント値からクロスポイントP11におけるカウンタ200,202のオフセットが求められる。補正部312は求めたオフセットを補正値として保持しておく。同様にして、クロスポイントP12におけるカウンタ202,204のオフセット、クロスポイントP13におけるカウンタ204,204のオフセットが求められる。
When applied to the slope shown in FIG. 2, the
画素読み出しの際、第1判定部304は、画素回路302から出力された画素出力値に基づいて、画素出力値が参照電圧Vref1,Vref2,Vref3,Vref4のいずれに相当するかを判定する。その判定結果を受け、スロープ生成部206は、ダウンスロープを使うか、アップスロープを使うか、またオフセットを加えるかどうかを識別する。比較部308は、画素回路302からの画素出力値とダウンスロープまたはアップスロープの参照電圧を比較していく。同時に、変換カウンタ310は、カウンタ200,202,204,206によるカウントを開始する。この際、変換カウンタ310は、画素出力値に基づいて、カウンタ200,202,204,206のいずれかを選択する。スロープ100を使う場合はカウンタ200が選択され、スロープ102を使う場合はカウンタ202が選択され、スロープ104を使う場合はカウンタ204が選択され、スロープ106を使う場合はカウンタ206が選択される。
During pixel reading, the
比較部308による比較の結果、画素出力値と参照電圧が一致して比較部308の出力がハイ(High)になると、ラッチ信号を変換カウンタ310に出力する。変換カウンタ310は、ラッチ信号が入力された時のカウンタの出力値(デジタル値)が取得される。カウンタの出力値は、補正部312へ出力される。補正部312は、予め取得しておいた補正値を用いてカウンタの出力値を補正する。
As a result of comparison by the
以上説明したように本実施形態によれば、参照電圧がカウント値のアップカウントに応じて増加するアップスロープと、参照電圧がカウント値のダウンカウントに応じて減少するダウンスロープと、を生成し、アップスロープとダウンスロープのクロスポイントでカウント値を一致させるようにした。これにより、アップスロープとダウンスロープの間にオフセットが生じてしまうことを抑止することができ、AD変換の際のエラーの発生を確実に抑止することが可能となる。 As described above, according to the present embodiment, an up slope in which the reference voltage increases in accordance with the up count of the count value and a down slope in which the reference voltage decreases in accordance with the down count of the count value are generated, The count value is made to match at the cross point of up slope and down slope. Thereby, it is possible to prevent an offset from occurring between the up slope and the down slope, and it is possible to reliably suppress the occurrence of an error during AD conversion.
以上、添付図面を参照しながら本発明の好適な実施形態について詳細に説明したが、本発明はかかる例に限定されない。本発明の属する技術の分野における通常の知識を有する者であれば、特許請求の範囲に記載された技術的思想の範疇内において、各種の変更例または修正例に想到し得ることは明らかであり、これらについても、当然に本発明の技術的範囲に属するものと了解される。 The preferred embodiments of the present invention have been described in detail above with reference to the accompanying drawings, but the present invention is not limited to such examples. It is obvious that a person having ordinary knowledge in the technical field to which the present invention pertains can come up with various changes or modifications within the scope of the technical idea described in the claims. Of course, it is understood that these also belong to the technical scope of the present invention.
300 AD変換回路
306 スロープ生成部
310 変換カウンタ
300
Claims (6)
画素回路から出力された画素出力値と前記アップスロープ又は前記ダウンスロープの参照電圧とが一致した時点での前記第1又は第2のカウンタのカウント値を取得するAD変換部と、
を備えることを特徴とする、AD変換回路。 An up slope in which the reference voltage of the pixel output value increases in accordance with the up count of the count value of the first counter, and a down slope in which the reference voltage of the pixel output value decreases in accordance with the down count of the count value of the second counter. And a slope generator that generates the up slope and the down slope so that a cross point is formed between the slope and the slope.
An AD converter that obtains a count value of the first or second counter at a time point when a pixel output value output from a pixel circuit matches a reference voltage of the up slope or the down slope;
An AD conversion circuit comprising:
画素出力値と前記アップスロープ又は前記ダウンスロープの参照電圧とが一致した時点での前記第1又は第2のカウンタのカウント値を取得するステップと、
を備えることを特徴とする、AD変換方法。 An up slope in which the reference voltage of the pixel output value output from the pixel circuit increases in accordance with the up-count of the count value of the first counter, and the reference voltage of the pixel output value in the down-count of the count value of the second counter Generating the upslope and the downslope such that a cross point is formed between the downslope and the correspondingly decreasing downslope;
Obtaining a count value of the first or second counter at a time point when a pixel output value and a reference voltage of the up slope or the down slope coincide with each other;
An AD conversion method comprising:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013273427A JP2015128258A (en) | 2013-12-27 | 2013-12-27 | AD conversion circuit and AD conversion method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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Publications (1)
Publication Number | Publication Date |
---|---|
JP2015128258A true JP2015128258A (en) | 2015-07-09 |
Family
ID=53838055
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2013273427A Pending JP2015128258A (en) | 2013-12-27 | 2013-12-27 | AD conversion circuit and AD conversion method |
Country Status (1)
Country | Link |
---|---|
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Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6670904B1 (en) * | 2002-08-22 | 2003-12-30 | Micron Technology, Inc. | Double-ramp ADC for CMOS sensors |
WO2008044433A1 (en) * | 2006-10-06 | 2008-04-17 | Sony Corporation | Solid state imaging device, solid state imaging device drive method, and imaging device |
-
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- 2013-12-27 JP JP2013273427A patent/JP2015128258A/en active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6670904B1 (en) * | 2002-08-22 | 2003-12-30 | Micron Technology, Inc. | Double-ramp ADC for CMOS sensors |
WO2008044433A1 (en) * | 2006-10-06 | 2008-04-17 | Sony Corporation | Solid state imaging device, solid state imaging device drive method, and imaging device |
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Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
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|
A977 | Report on retrieval |
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|
A131 | Notification of reasons for refusal |
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|
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