JP2013222950A - パワー半導体モジュール - Google Patents

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Abstract

【課題】スイッチング素子で発生するスイッチングノイズを低減し、同時にパワー半導体チップと絶縁基板の間の熱抵抗を低減することができるパワー半導体モジュールを提供する。
【解決手段】スイッチング素子であるパワー半導体チップ６に隣接して、プリント基板１１と絶縁基板４の間にコンデンサ１７を設置することで、スイッチング素子で発生するスイッチングノイズを低減でき、さらにパワー半導体チップ６と絶縁基板４の間の熱抵抗Ｒｊｃを低減することができる。
【選択図】 図１

Description

この発明は、パワー半導体モジュールに関し、特にスイッチング素子から発生するスイッチングノイズおよびチップ−ケース間の熱抵抗の双方を低減できるパワー半導体モジュールに関する。
図７は、従来のパワー半導体モジュール２０１の構成図であり、同図（ａ）は要部平面図、同図（ｂ）は同図（ａ）のＡ−Ａ線で切断した要部断面図である。
このパワー半導体モジュール２０１は、パワー半導体チップ２０５の主電極が複数のポスト電極２１１により電気的に接続されるタイプのパワー半導体モジュールで、特許文献１に記載されている。
図７のパワー半導体モジュール２０１は、絶縁基板２０２と、絶縁基板２０２に対向させたインプラントプリント基板２０３（以下、プリント基板）とがアンダーフィル材，樹脂材２０４などにより封止され、一体的になった構造をなし、絶縁基板２０２上に、複数のパワー半導体チップ２０５が実装されている。
さらに、このパワー半導体モジュール２０１は、図示しない樹脂ケースによりパッケージングされ、例えば、汎用ＩＧＢＴ（絶縁ゲート型バイポーラトランジスタ）モジュールとして機能する。絶縁基板２０２は、絶縁板２０６と、絶縁板２０６の下面にＤＣＢ（Ｄｉｒｅｃｔ ｃｏｐｐｅｒ Ｂｏｎｄｉｎｇ）法で形成された金属箔２０７と、絶縁板２０６の上面に同じくＤＣＢ法で形成された複数の金属箔２０８を備えている。
さらに金属箔２０８の上には、錫（Ｓｎ）−銀（Ａｇ）系の鉛フリーの半田層２０９を介してパワー半導体チップ２０５が接合されている。またプリント基板２０３には、複数のスルホール２１０が設けられており、このスルホール２１０内に図示しない薄厚の筒状めっき層が設けられ、円筒状のポスト電極２１１が筒状めっきを介し注入（インプラント）されている。
またパワー半導体チップ２０５は、半田層２１２を介し各々のポスト電極２１１に接合されている。またプリント基板２０３は多層構造をなし、例えば、樹脂層２１３を中心部に配置し、その上面と下面に金属箔２１４が選択的にパターン形成されている。
図８は、パワー半導体モジュールを用いた電力変換装置の回路構成図である。この電力変換装置は特許文献２に記載されている。
この電力変換装置は、回路構成としてノイズフィルタ部２１５と主回路部２１６、制御回路部２１７の３つの回路部に大別される。ノイズフィルタ部２１５は、３相交流電源２１８と入力端子Ｒ，Ｓ，Ｔを介して３本の電力ラインにそれぞれ直列に接続されたリアクトル２１９と接地コンデンサ２２０と相間コンデンサ２２１とからなる。
このノイズフィルタ部２１５は、インバータ等の電力変換器を構成するパワー半導体チップのスイッチング動作に伴って発生するスイッチングノイズを濾波する機能をもつ。主回路部２１６は、ノイズフィルタ部２１５に接続された整流回路２２４と、整流回路２２４の一対の出力端子に接続された平滑コンデンサ２２５と、この平滑コンデンサ２２５に接続されたインバータ回路２２３とからなる。
インバータ回路２２３（パワー半導体モジュールで構成される）は、例えば、ＩＧＢＴ（絶縁ゲートバイポーラトランジスタ）からなるスイッチング素子とフリーホイーリングダイオードで構成されるパワー半導体素子２２６を有し、各素子はオン，オフ制御される。なお、電気機器、ここではインバータ回路２２３の負荷として、三相誘導電動機（モータ）２２７が接続されている。制御回路部２１７は、ＤＣ−ＤＣコンバータ２２８，各種の信号処理や制御を行うＣＰＵ，ＲＯＭ，ＲＡＭ，等を含む制御回路２２９からなる。ＤＣ−ＤＣコンバータ２２８は、整流回路２２４の出力端子と接続され、３相交流電源２１８が入力される。このＤＣ−ＤＣコンバータ２２８により所定の値に変換された電力は、制御回路２２９に供給される。制御回路２２９は、インバータ回路２２３のスイッチング素子（パワー半導体素子２２６）のゲート端子に接続されている。この制御回路２２９からの制御信号に基づいて、スイッチング素子がオン，オフ制御され、これによりパルス変調（ＰＷＭ）された出力電圧が出力端子Ｕ，Ｖ，Ｗから出力され、三相誘導電動機２２７
が回転する。
また、特許文献３では、２つの半導体素子を並列接続した上アームのみについて、配線の長短によりインダクタンスが異なることで電流アンバランスが生じるので、配線長の長くなる方のスナバコンデンサ（Ｃｓ２）の容量よりも、短くなる方のスナバコンデンサの容量を大きくすることにより、配線の長短により電流アンバランスが生じる場合でも、各半導体素子のターンオフ損失のアンバランスを抑制し損失を低減できるようにすることが記載されている。
特開２００９−６４８５２号公報 特開２００２−２０４５８０号公報 特開２０１１−１４７２１２号公報
しかし、従来のパワー半導体モジュール２０１では、次の課題があった。１つ目はスイッチングノイズの課題である。パワー半導体モジュール２０１を構成するＩＧＢＴなどのスイッチング素子のスイッチング動作は、キャリア周波数を数ｋＨｚから十数ｋＨｚ程度としたパルス幅変調（ＰＷＭ）された駆動信号に基づいて行われる。
このスイッチング動作により数十ｋＨｚ以上の周波数成分のスイッチングノイズがスイッチング素子（ＩＧＢＴなど）から発生し、外部機器に悪影響を与える。この悪影響を抑えるために、図８に示すように電力変換装置内にノイズフィルタ２１５が設置されている。しかし、これらのノイズフィルタ２１５はパワー半導体モジュール２０１を構成するスイッチング素子（ＩＧＢＴなど）から離れてパワー半導体モジュール２０１のパッケージ外に設置されるため、スイッチングノイズを十分に抑えることが困難である。
２つ目は熱的課題である。パワー半導体モジュール２０１は低コスト化のため、年々パワー半導体チップ２０５の小型化・薄型化が進み、それにより高電流密度化によるパワー半導体チップ２０５の温度の上昇が課題となってきている。
またパワー半導体チップ２０５の小型化に伴い、パワー半導体モジュール２０１のパッケージサイズも小型化が進んできており、パワー半導体チップ２０５から冷却体までの熱抵抗Ｒｊｃが増大する。また隣接するパワー半導体チップ２０５同士の熱干渉，等の影響によるパワー半導体チップ２０５の温度上昇が課題としてある。
また、前記特許文献３には、配線の長短により電流アンバランスが生じる場合でも、各半導体素子のターンオフ損失のアンバランスを抑制し損失を低減できることは記載されているが、スイッチング素子から発生するスイッチングノイズを抑制する方策については記載されていない。
この発明の目的は、前記の課題を解決して、スイッチング素子で発生するスイッチングノイズを低減し、同時にパワー半導体チップと絶縁基板の間の熱抵抗を低減することができるパワー半導体モジュールを提供することにある。
前記の目的を達成するために、特許請求の範囲の請求項１に記載の発明によれば、上基板とパワー半導体チップがその上面に搭載された下基板とがあって、前記パワー半導体チップと前記上基板とは導体で接続され、前記パワー半導体チップに対応するパワー半導体に回路的に並列接続されるコンデンサが前記上基板と前記下基板を繋いでいる構成とする。
また、特許請求の範囲の請求項２記載の発明によれば、請求項１に記載の発明において、前記コンデンサは並列接続された複数のコンデンサからなるものとする。
また、特許請求の範囲の請求項３記載の発明によれば、請求項１乃至２に記載の発明において、前記パワー半導体チップと前記コンデンサの間の距離が、０．３ｍｍ以上、１０ｍｍ以下とする。
また、特許請求の範囲の請求項４に記載の発明によれば、請求項1乃至３に記載の発明において、前記パワー半導体チップの上面から前記導体、前記上基板及び前記コンデンサを経由して前記下基板の下面に至る経路の熱抵抗が０．３℃／Ｗ以下とする。
また、特許請求の範囲の請求項５に記載の発明によれば、請求項１、３または４のいずれか一項に記載の発明において、前記コンデンサの容量を１０ｐＦから１μＦとする。
また、特許請求の範囲の請求項６に記載の発明によれば、請求項２、３又は４のいずれか一項に記載の発明において、前記複数のコンデンサの合成容量を１０ｐＦから１μＦでとする。
また、特許請求の範囲の請求項７に記載の発明によれば、請求項１乃至６に記載の発明において、前記上基板が、プリント基板であり、前記下基板が導電パターン付絶縁基板であり、前記導体がポスト電極であり、前記導電パターン付絶縁基板の導電パターンに外部導出端子が接続し、前記導電パターン付絶縁基板の裏面側導電膜と前記外部導出端子の先端部を露出させ全体を樹脂で封止するようにする。
また、特許請求の範囲の請求項８に記載の発明によれば、請求項１乃至７に記載の発明において、前記コンデンサをセラミックコンデンサチップとする。
この発明によれば、スイッチング素子に隣接して、プリント基板と絶縁基板の間にコンデンサを設置することで、スイッチング素子で発生するスイッチングノイズを低減でき、さらにパワー半導体チップと絶縁基板の間の熱抵抗を低減することができる。その結果、小型・低ノイズ・低熱抵抗かつ低コストのパワー半導体モジュールを提供することができる。
この発明の第１実施例のパワー半導体モジュール１００の構成図であり、（ａ）は要部平面図、（ｂ）は（ａ）の矢印Ｋの方向から見た要部側面図である。 セラミックコンデンサ１８の代表的な内部構成図である。 このパワー半導体モジュール１００の要部回路構成図である。 放熱を説明する図である。 パワー半導体チップ６と絶縁基板４裏面の銅板３の間の熱抵抗Ｒｊｃを示した図である。 この発明の第２実施例のパワー半導体モジュール２００の要部平面図である。 従来のパワー半導体モジュール２０１の構成図であり、（ａ）は要部平面図、（ｂ）は（ａ）のＡ−Ａ線で切断した要部断面図である。 パワー半導体モジュールを用いた電力変換装置の回路構成図である。
実施の形態を以下の実施例で説明する。
＜実施例１＞
図１は、この発明の第１実施例のパワー半導体モジュール１００の構成図であり、同図（ａ）は要部平面図、同図（ｂ）は同図（ａ）の矢印Ｋの方向から見た要部側面図である。同図（ａ）は樹脂１６内の各部の配置図である。このパワー半導体モジュール１００は半導体チップ６の主電極と絶縁性の基材１０（プリント基板）の間が複数のポスト電極８により電気的に接続されているタイプである。パワー半導体モジュール１００は先行技術として記載したもののように、パワー半導体を用いて電力制御などの用途のために電流のスイッチングなどを行うものである。
このパワー半導体モジュール１００は、セラミック基板などの絶縁層１と銅板２，３からなる絶縁基板４の上面に、はんだ５によりパワー半導体チップ６が接合され、その組合せが２組で構成された２ｉｎ１モジュールである。パワー半導体チップ６はＩＧＢＴチップ６ａとＦＷＤチップ６ｂが含まれる。さらにパワー半導体チップ６の上面に、はんだ７によりポスト電極８を有し、銅配線９と絶縁性の基材１０からなるプリント基板１１が取付けられ、このプリント基板１１によりパワー半導体チップ６が電気的に接続される。コレクタ側接続端子１２はパワー半導体チップ６裏面に電流を供給する端子であり、エミッタ側接続端子１３はパワー半導体チップ６表面からの電流を外部に流す端子である。また、出力端子１４はコレクタ側配線とエミッタ側配線の中間にある出力電流を流す端子であり、ゲート用接続端子１５とエミッタ信号用端子１５ａはパワー半導体チップ６のＯＮ／ＯＦＦを制御する端子である。全体は樹脂１６で封止されている。
図７に示す従来のパワー半導体モジュールと異なるのは、パワー半導体チップ６の近傍で前記の樹脂１６の内部にコンデンサ１７を設置した点である。このコンデンサの一端は前記ポスト電極付プリント基板１１の銅配線９上に接続され、もう一端は前記絶縁基板４の銅板２上に接続される。パワー半導体チップ６とコンデンサ１７は回路上、並列に配置されている。コンデンサ１７の端子は銅配線９と銅板２にはんだなどの接合材で固着される。また、コンデンサ１７とパワー半導体チップ６との距離Ｌは０．３ｍｍ〜１０ｍｍの範囲とする。０．３ｍｍ未満にするとパワー半導体チップ６とコンデンサ１７の隙間が狭すぎて樹脂１６が隙間に注型されず絶縁不良を引き起こす惧れがある。また、１０ｍｍ超にすると絶縁基板４の面積が大きくなり過ぎて、パワー半導体モジュール１００の外形が大きくなりコストアップになる。距離Ｌは０．３ｍｍ〜５ｍｍの範囲にあるとパワー半導体モジュールを特に小型に構成できるメリットがある。
このように、コンデンサ１７をパワー半導体チップ６に近接して配置することで、スイッチングノイズを１０％から３０％程度低減させることができた。スイッチングノイズを評価した条件は、例えば、ＩＧＢＴのスイッチング周波数＝５ｋＨｚ、コレクタ電圧＝３００Ｖ，コレクタ電流＝１００Ａ、コンデンサ１７の容量＝１ｎＦ、距離Ｌ＝０．３ｍｍで、ＩＧＢＴで発生するスイッチングノイズを評価した。このとき用いたコンデンサ１７は図３で示すセラミックコンデンサ１８である。
また、このコンデンサ１７を設置することで、パワー半導体チップ６の表面から絶縁基板４の裏面までの熱抵抗Ｒｊｃを低減することができる。
つぎに、前記のコンデンサ１７として使用したセラミックコンデンサ１８の内部構成を説明する。
図２は、セラミックコンデンサ１８の代表的な内部構成図である。セラミックコンデンサ１８は、誘電体１９に酸化チタンやアルミナ，チタン酸バリウムを用い、内部電極２０と外部電極２１より構成される。静電容量としては０．５ｐＦ〜０．１μＦが一般的であるが、物理的に並列接続して大容量化（例：６８０μＦ）しているものもある。誘電体１９の熱伝導率を調整することで、セラミックコンデンサ１８自体の熱伝導を良くすることが可能である。
スイッチングノイズを１０％以上低減するために必要となるコンデンサ１７の容量（静電容量）は１０ｐＦ〜１μＦである。前記の容量が１０ｐＦ未満ではスイッチングノイズの低減効果が小さくなりすぎ、１μＦ超では、コンデンサ１７の寸法が大きくなりすぎてパワー半導体モジュール１００の外形寸法が大きくなりコストも増大する。このコンデンサ１７の容量は、１０ｐＦ〜３００ｐF程度であると実用的なノイズ低減効果が得られかつ十分小さなコンデンサ寸法とすることができる。コンデンサ１７の容量が３００ｐＦ〜１ｎＦの範囲ではさらにノイズ低減効果が得られかつコンデンサ寸法も小さなものとすることができる。また、コンデンサ１７としては、前記したセラミックコンデンサ１８が小さな寸法で大きな容量が得られるので好ましい。
図３は、このパワー半導体モジュール１００の要部回路構成図である。ここでは、１個のスイッチング素子６ａ（例えば、ＩＧＢＴ（絶縁ゲート型バイポーラトランジスタ）など）であるパワー半導体チップ６と、１個のＦＷＤ６ｂ（フリーホイーリングダイオード）であるパワー半導体チップ６が接続し、さらにコンデンサ１７が並列接続されている。コンデンサ１７は各アームごとに備えられアーム間の個別スナバ回路を形成し、スイッチングノイズを濾波する機能をもつ。
つぎに、パワー半導体モジュール１００におけるパワー半導体チップ６の上部からコンデンサ１７を介して絶縁基板４への放熱について説明する。つぎに説明する図４は、図１に示すパワー半導体モジュール１００の上アーム（または下アーム）分だけの図である。
図４は、放熱を説明する図である。パワー半導体チップ６から生じた熱は絶縁基板４を経由し、矢印２５の様に、絶縁基板４の下側の銅板３と接触する図示していないヒートシンクに放熱される。コンデンサ１７をパワー半導体チップ６に並列に設置することで、矢印２５に並列する矢印２６のような熱の流れが生じてコンデンサ下部１７ａより絶縁基板４に放熱される。ここで、熱抵抗Ｒｊｃを、パワー半導体チップ上表面からはんだ５を経由して絶縁基板４の裏面である銅板３の下面に至る経路と、パワー半導体チップ上表面からはんだ７、ポスト電極８、プリント基板１１及びコンデンサ１７を経由して絶縁基板４の裏面である銅板３の下面に至る経路との二つの経路を合わせた経路についての熱抵抗とする。また、熱抵抗Ｒｊｂを、パワー半導体チップ上表面からはんだ７、ポスト電極８、プリント基板１１及びコンデンサ１７を経由して絶縁基板４の裏面である銅板３の下面に至る経路についての熱抵抗とする。熱抵抗Ｒｊｃは、パワー半導体チップ上表面からはんだ５を経由して絶縁基板４の裏面である銅板３の下面に至る経路だけの熱抵抗に比べてパワー半導体チップ上表面からはんだ７、ポスト電極８、プリント基板１１及びコンデンサ１７を経由して絶縁基板４の裏面である銅板３の下面に至る経路がある分小さくなる。
図５は、パワー半導体チップ６と絶縁基板４裏面である銅板３の間の熱抵抗Ｒｊｃを示した図である。具体的には、熱抵抗Ｒｊｃはチップ表面温度と絶縁基板４の裏面温度の温度の差をチップ発熱量で割った値である。
図５において、（１）は従来構造でコンデンサ１７がない場合、（２）は本発明でコンデンサ１７が有りの場合、（３）はコンデンサ１７有りで、プリント基板１１の銅配線９の厚さを厚くした場合である。また、使用したセラミックコンデンサ１８の諸元は、例えば、電極面積が１．２５ｍｍ×１．６ｍｍ、高さが１ｍｍで容量１０ｐF及び電極面積が１．２５ｍｍ×１．６ｍｍ、高さが１ｍｍで容量２．２ｎFの二例である。
従来のパワー半導体モジュール２０１であるコンデンサが無い（１）の場合は０．２２４℃／Ｗである。本発明のパワー半導体モジュール１００であるコンデンサ１７が有る（２）の場合の熱抵抗Ｒｊｃは０．２０６℃／Ｗである。なお、矢印２６の放熱経路における熱抵抗Ｒｊｂ（伝熱特性）は０．２２８℃／Ｗである。ここでコンデンサ１７は上述したセラミックコンデンサ１８の二例について同様の熱抵抗Ｒｊｃ及びＲｊｂを得ている。
また、（２）の場合より、さらに熱抵抗Ｒｊｃを低減するために、プリント基板１１の両面にある銅配線９の厚さについて、０．２ｍｍであったものを３ｍｍ程度と厚くした（３）の場合は、熱抵抗Ｒｊｃは０．２００℃／Ｗとなり、従来に比べて８％程度低減した。このときの熱抵抗Ｒｊｂは０．２２１℃／Ｗである。つまり、銅配線９を厚くすることで、熱抵抗Ｒｊｂを３％程度低減することができる。
検討の結果、この熱抵抗Ｒｊｂが約０．３℃／Ｗ以下になると熱抵抗Ｒｊｃの低減効果が大きいことから、熱抵抗Ｒｊｂは０．３℃／Ｗ以下とすることが望ましい。
また、（３）の場合より銅配線９を厚くすることで、熱抵抗Ｒｊｂが低減し、熱抵抗Ｒｊｃをさらに低減させることができる。以上述べた実施例１によればチップ６表面側から絶縁基板にいたる熱抵抗Ｒｊｃを低減することができる。
＜実施例２＞
図６は、この発明の第２実施例のパワー半導体モジュール２００の要部平面図である。図１のパワー半導体モジュール１００との違いは、複数のコンデンサ１７がパワー半導体チップ６の周りに配置されている点である。このように、複数個配置することでコンデンサ１７の容量は大きくなり、スイッチングノイズを一層低減することができる。さらに、コンデンサ１７の占有面積を広げることができるので、熱抵抗Ｒｊｃをさらに低下させることができる。
具体的には、例えば、電極面積が０．５ｍｍ×０．５ｍｍ、高さが１ｍｍ、容量５０ｐＦのセラミックコンデンサ１８を６個、パワー半導体チップ６の周りに配置することで、セラミックコンデンサ１個の場合に比べて、スイッチングノイズを１０％程度低減できて、同時に熱抵抗Ｒｊｃを実施例１の場合と同程度である０．１９５℃／Ｗ程度まで低減することができる。
１ 絶縁層
２、３ 銅板
４ 絶縁基板
５ はんだ
６ パワー半導体チップ
６ａ ＩＧＢＴチップ
６ｂ ＦＷＤチップ
７ はんだ
８ ポスト電極
９ 銅配線
１０ 基材（絶縁性）
１１ プリント基板
１２ コレクタ側接続端子
１３ エミッタ側接続端子
１４ 出力端子
１５ ゲート用接続端子
１５ａ エミッタ信号用端子
１６ 樹脂
１７ コンデンサ
１７ａ コンデンサ下部
１８ セラミックコンデンサ
１９ 誘電体
２０ 内部電極
２１ 外部電極

Claims (8)

  1. 上基板とパワー半導体チップがその上面に搭載された下基板とがあって、前記パワー半導体チップと前記上基板とは導体で接続され、前記パワー半導体チップに対応するパワー半導体に回路的に並列接続されるコンデンサが前記上基板と前記下基板を繋いでいることを特徴とするパワー半導体モジュール。
  2. 前記コンデンサは並列接続された複数のコンデンサからなることを特徴とする請求項１に記載のパワー半導体モジュール。
  3. 前記パワー半導体チップと前記コンデンサの間の距離が、０．３ｍｍ以上、１０ｍｍ以下であることを特徴とする請求項１乃至２に記載のパワー半導体モジュール。
  4. 前記パワー半導体チップの上面から前記導体、前記上基板及び前記コンデンサを経由して前記下基板の下面に至る経路の熱抵抗が０．３℃／Ｗ以下であることを特徴とする請求項１乃至３に記載のパワー半導体モジュール。
  5. 前記コンデンサの容量が１０ｐＦから１μＦであることを特徴とする請求項１、３又は４のいずれか一項に記載のパワー半導体モジュール。
  6. 前記複数のコンデンサの合成容量が１０ｐＦから１μＦであることを特徴とする請求項２、３又は４のいずれか一項に記載のパワー半導体モジュール。
  7. 前記上基板が、プリント基板であり、前記下基板が導電パターン付絶縁基板であり、前記導体がポスト電極であり、前記導電パターン付絶縁基板の導電パターンに外部導出端子が接続し、前記導電パターン付絶縁基板の裏面側導電膜と前記外部導出端子の先端部を露出させ全体を樹脂で封止することを特徴とする請求項１乃至６に記載のパワー半導体モジュール。
  8. 前記コンデンサがセラミックコンデンサチップであることを特徴とする請求項１乃至７に記載のパワー半導体モジュール。
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