JP2013118555A - Control circuit and phase modulator - Google Patents
Control circuit and phase modulator Download PDFInfo
- Publication number
- JP2013118555A JP2013118555A JP2011265635A JP2011265635A JP2013118555A JP 2013118555 A JP2013118555 A JP 2013118555A JP 2011265635 A JP2011265635 A JP 2011265635A JP 2011265635 A JP2011265635 A JP 2011265635A JP 2013118555 A JP2013118555 A JP 2013118555A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- differential amplifier
- phase
- voltage
- control
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Landscapes
- Networks Using Active Elements (AREA)
- Amplifiers (AREA)
Abstract
Description
本発明は、信号振幅を調整する四象限乗算器等の手段に対して制御信号を出力する制御回路、および四象限乗算器と制御回路とを用いて、入力信号の位相を任意に変調して出力する位相変調器に関するものである。 The present invention uses a control circuit that outputs a control signal to a means such as a four-quadrant multiplier for adjusting a signal amplitude, and a four-quadrant multiplier and a control circuit to arbitrarily modulate the phase of the input signal. The present invention relates to an output phase modulator.
無線通信の分野ではフェーズアレイアンテナや周波数シンセサイザ等において、光通信の分野では光トランシーバのRZ変換やクロック再生回路等において、さらに計測器の分野では任意信号発生回路等において、信号の位相を任意に変更する機能、すなわち移相器が必要とされている。移相器においては、信号の広帯域動作、位相制御の線形性、制御電圧の単一化、低電力化などの特性が求められている。 In the field of wireless communication, phase phase antennas and frequency synthesizers, in the field of optical communication, RZ conversion of optical transceivers, clock recovery circuits, etc., and in the field of measuring instruments, arbitrary signal generators, etc. A function to change, i.e. a phase shifter, is needed. A phase shifter is required to have characteristics such as wideband operation of a signal, linearity of phase control, unification of control voltage, and low power.
図14に従来の位相変調器の構成を示す(特許文献1、非特許文献1参照)。この位相変調器は、90°分配器1と、2つの四象限乗算器2I,2Qと、合成器3と、制御回路4とから構成される。図15(A)、図15(B)、図15(C)は図14の位相変調器の各部の信号を平面上にコンスタレーション表示した図である。図15(A)は入力信号VINを表す。
FIG. 14 shows a configuration of a conventional phase modulator (see
90°分配器1は、入力信号VINを入力し、同相信号VINIと、これに対して位相が90°ずれた直交信号VINQとを出力する。すなわち、入力信号VIN(=sin(ωt))は、90度分配器1において同相信号VINI(=sin(ωt))と直交信号VINQ(=cos(ωt))に分配される。同相成分(I)を横軸、直交成分(Q)を縦軸とするコンスタレーション表示では、図15(B)に示すように、同相信号VINIは同相成分(I)のみで表すことができ、直交信号VINQは直交成分(Q)のみで表すことができる。この2つの信号VINI,VINQを仮に合成した場合には、図15(B)の20(角度45°、振幅21/2)に相当する信号を得ることができる。
The 90 °
一方、制御回路4は、出力させたい位相に対応した制御電圧VCを入力とし、四象限乗算器2I,2Qのための制御信号CI,CQを発生する。具体的には、制御電圧VCは、制御回路4において制御信号CI(=cos(VC))と制御信号CQ(=sin(VC))に変換される。四象限乗算器2I,2Qは、それぞれ制御信号CI,CQの符号とレベルに応じて出力の符号と利得とを変化させ、結果として同相信号VINI、直交信号VINQの振幅を変化させて出力する。すなわち、四象限乗算器2Iは同相信号VINIと制御信号CIとを乗算し、四象限乗算器2Qは直交信号VINQと制御信号CQとを乗算する。
On the other hand, the control circuit 4 receives the control voltage VC corresponding to the phase to be output, and generates control signals CI and CQ for the four-
四象限乗算器2I,2Qから出力される同相信号VXIと直交信号VXQは合成器3でベクトル合成され、出力信号VOUTとして外部へ出力される。位相変調器の出力信号VOUTは以下のように表わされる。
VOUT=cos(VC)・sin(ωt)+sin(VC)・cos(ωt)
・・・(1)
The in-phase signal VXI and quadrature signal VXQ output from the four-
VOUT = cos (VC) · sin (ωt) + sin (VC) · cos (ωt)
... (1)
式(1)は加法定理により次式で表わされる。
VOUT=sin(ωt+VC) ・・・(2)
結果として、出力信号VOUTの位相は制御電圧VCに比例し、出力振幅は制御電圧VCに依らず一定となる。
Equation (1) is expressed by the following equation according to the addition theorem.
VOUT = sin (ωt + VC) (2)
As a result, the phase of the output signal VOUT is proportional to the control voltage VC, and the output amplitude is constant regardless of the control voltage VC.
例えば同相信号側の利得を1、直交信号側の利得を0と設定した場合、コンスタレーション表示では、出力信号VOUTとして図15(C)の21(角度0°、振幅1)の信号を得ることができる。同様に、同相信号側の利得をcos(22.5°)≒0.92、直交信号側の利得をsin(22.5°)≒0.38と設定した場合には、出力信号VOUTとして図15(C)の22(角度22.5°、振幅(0.922+0.382)1/2=1)の信号を得ることができ、同相信号側の利得をcos(45°)≒0.71、直交信号側の利得をsin(45°)≒0.71と設定した場合には、出力信号VOUTとして図15(C)の23(角度45°、振幅(0.712+0.712)1/2=1)の信号を得ることができる。
For example, when the gain on the in-phase signal side is set to 1 and the gain on the quadrature signal side is set to 0, a signal of 21 (
図16に従来の位相変調器の制御回路の構成例を示す。制御回路4は、抵抗ラダーにより複数の参照電圧Vn(n:1〜10)を発生する電圧発生器400Ib,400Qbと、制御電圧VCおよび2つの参照電圧を入力とし制御電圧VCが2つの参照電圧の範囲内にあるか範囲外にあるかを検出する差動増幅器対401I,401Q,402I,402Qと、PVT補償回路600とから構成されており、アナログ演算により擬似的な正弦波関数である制御信号CI(=cos(VC))と制御信号CQ(=sin(VC))とを発生させる。なお、図16では、制御信号CI,CQが差動信号である場合について記載しており、補信号にはバーを付記して区別している。
FIG. 16 shows a configuration example of a control circuit of a conventional phase modulator. The control circuit 4 receives voltage generators 400Ib and 400Qb that generate a plurality of reference voltages Vn (n: 1 to 10) using a resistance ladder, the control voltage VC and two reference voltages, and the control voltage VC includes two reference voltages. Is a
同相信号側の電圧発生器400Ibは、抵抗4011〜4015からなる抵抗ラダーによって構成され、直交信号側の電圧発生器400Qbは、抵抗4016〜4020からなる抵抗ラダーによって構成されている。同相信号側の抵抗ラダーと直交信号側の抵抗ラダーに参照電圧VRT,VRBを共通に与える。電源電圧VCCと電圧VRTとの間にレベルシフトダイオード4022,4023および抵抗4024を設け、電源電圧VEEと電圧VRBとの間に定電流源4021を設けることにより、参照電圧VRT,VRBを電圧発生器400Qbの内部で生成している。
The voltage generator 400Ib on the in-phase signal side is configured by a resistor
レベルシフトダイオード4022,4023の1個あたりの電圧降下をVLS、定電流源4021の電流値をI、抵抗ラダー内の抵抗4011〜4020の合成抵抗値をRTL、抵抗4024の抵抗値をRRとし、差動増幅器440I〜444I,440Q〜444Qの入力への電流の流れこみを無視すると、電圧VRTはVRT=VCC−2×VLS−RR×Iと表すことができ、電圧VRBはVRB=VCC−2×VLS−(RR+RTL)×Iと表すことができる。
The voltage drop per
2つの抵抗ラダー内で使用される抵抗値は2種類である。抵抗4011,4020の抵抗値をRとすると、抵抗4012〜4019の抵抗値は2Rとなる。つまり、例えばV10とV9との間や、V2とV1との間のように隣接する参照電圧間に設けられる抵抗については抵抗値をRとし、V10とV8との間や、V9とV7との間のように1つおきの参照電圧間に設けられる抵抗については抵抗値を2Rとする。これにより、同相信号側の電圧発生器400Iが発生する参照電圧V1,V3,V5,V7,V9と直交信号側の電圧発生器400Qが発生する参照電圧V2,V4,V6,V8,V10とが交互に等間隔の電圧レベルになるようにする(V10−V9=V9−V8=V8−V7=・・・=V2−V1=一定)。
There are two types of resistance values used in the two resistance ladders. When the resistance values of the
PVT補償回路600は、トランジスタ6000、レベルシフトダイオード6001,抵抗6002,6003、および定電流源6004から構成される。PVT補償回路600は、制御電圧VCのレベルをシフトするエミッタフォロアであり、以下の回路定数を電圧発生器400Qbと一致させる。まず、PVT補償回路600のエミッタフォロア(トランジスタ6000)とレベルシフトダイオード6001の合計の段数を、電圧発生器400Qbのレベルシフトダイオード4022,4023の段数と一致させる。また、PVT補償回路600の抵抗6002の抵抗値を、電圧発生器400Qbの電圧レベル微調整用の抵抗4024の抵抗値RRと一致させる。さらに、PVT補償回路600の定電流源6004の定電流値を、電圧発生器400Qbの定電流源4021の定電流値Iと一致させる。PVT補償回路600の抵抗6003の抵抗値RTDLは、任意に選ぶことができる。
The
トランジスタ6000のベース−エミッタ間電圧がレベルシフトダイオード4022,4023,6001の1個あたりの電圧降下VLSと同一と仮定すると、差動増幅器440I〜444I,440Q〜444Qに送られるレベルシフト後の制御電圧VCLSは、VCLS=VC−2×VLS−RR×Iとなる。以上により、VRT−VCLS=VCC−VC、VCLS−VRB=RTL×I−(VCC−VC)となり、電圧VRTとVCLS間の電圧差および電圧VCLSとVRB間の電圧差は、(VCC−VC)の関数で表すことができる。
Assuming that the base-emitter voltage of the
差動増幅器対401I,401Q,402I,402Qは、制御電圧VCLSおよび2つの参照電圧Vm,Vnを入力とし、制御電圧VCLSが2つの参照電圧Vm,Vnの範囲内にあるか範囲外にあるかを検出する。差動増幅器対401I,401Q,402I,402Qに求められる機能は、制御電圧VCLSが2つの参照電圧の範囲内にあるか範囲外にあるか単純に2状態を検出することではなく、入力される制御電圧VCLSから制御信号CI=cos(VCLS)、CQ=sin(VCLS)への変換をアナログ演算することである。
The
差動増幅器対401Iは、差動増幅器440I,441Iによって構成され、差動増幅器対402Iは、差動増幅器442I,443Iによって構成されている。同様に、差動増幅器対401Qは、差動増幅器440Q,441Qによって構成され、差動増幅器対402Qは、差動増幅器442Q,443Qによって構成されている。同相信号側の差動増幅器440I〜444Iは第1の差動増幅器グループを構成し、直交信号側の差動増幅器440Q〜444Qは第2の差動増幅器グループを構成している。参照電圧の数N(Nは2以上の整数)は、位相変調器の必要な総移相量を得るために任意の整数から選択することが可能であり、図16の例ではN=10の場合を記載している。第1の差動増幅器グループに含まれる差動増幅器の個数と第2の差動増幅器グループに含まれる差動増幅器の個数との総和は、Nである。
The differential amplifier pair 401I is configured by differential amplifiers 440I and 441I, and the differential amplifier pair 402I is configured by differential amplifiers 442I and 443I. Similarly, the
第1の差動増幅器グループが制御信号CI(=cos(VCLS))を発生し、第2の差動増幅器グループが制御信号CQ(=sin(VCLS))を発生する。差動増幅器対401I,401Q,402I,402Qはそれぞれ360度相当の擬似的な正弦波または余弦波を発生するので、差動増幅器1個当たり180度相当の擬似的な正弦波または余弦波の発生を担うことになる。第1の差動増幅器グループ、第2の差動増幅器グループはそれぞれ900度相当の擬似的な正弦波、余弦波を発生するが、正弦波と余弦波とで90度ずれているので、擬似的な正弦波(制御信号CQ)と余弦波(制御信号CI)を同時に発生できる移相範囲は810度となる。 The first differential amplifier group generates a control signal CI (= cos (VCLS)), and the second differential amplifier group generates a control signal CQ (= sin (VCLS)). Each of the differential amplifier pairs 401I, 401Q, 402I, and 402Q generates a pseudo sine wave or cosine wave corresponding to 360 degrees, so that a pseudo sine wave or cosine wave corresponding to 180 degrees per differential amplifier is generated. Will be responsible. The first differential amplifier group and the second differential amplifier group generate pseudo sine waves and cosine waves corresponding to 900 degrees, respectively, but the sine waves and cosine waves are shifted by 90 degrees. A phase shift range in which a simple sine wave (control signal CQ) and a cosine wave (control signal CI) can be generated simultaneously is 810 degrees.
図17は差動増幅器の回路構成とその動作を示す図であり、図17(A)は差動増幅器の回路図、図17(B)は図17(A)の差動増幅器の記号を示す図、図17(C)は図17(A)の差動増幅器の入出力特性(VC−CI特性)を示す図である。差動増幅器は、図17(A)に示すように、トランジスタ500,501,508,509と、電流源502,510と、レベルシフト用抵抗503と、負荷抵抗504,505,511,512と、エミッタ抵抗506,507,513,514とから構成される。制御信号CIは、トランジスタ508のコレクタと負荷抵抗511との接続点から出力され、制御信号バーCIは、トランジスタ509のコレクタと負荷抵抗512との接続点から出力される。この差動増幅器を記号で表すと、図17(B)のようになる。
FIG. 17 is a diagram showing the circuit configuration and operation of the differential amplifier. FIG. 17A is a circuit diagram of the differential amplifier, and FIG. 17B is a symbol of the differential amplifier in FIG. FIG. 17C is a diagram showing input / output characteristics (VC-CI characteristics) of the differential amplifier of FIG. As shown in FIG. 17A, the differential amplifier includes
図17(C)において、150は差動増幅器を1段使用した場合の入出力特性、151は図17(A)の差動増幅器の入出力特性を示している。図17(A)の構成では、複数の差動増幅器を縦続接続することにより、急峻な入出力特性(VC−CI特性)が得られるので、制御電圧VCの電圧範囲(すなわち、参照電圧の電圧範囲=VRT−VRB=V10−V1)を小さくすることが可能となり、設計の自由度を増やすことができる。
従来の位相変調器は、信号の広帯域動作、位相制御の高い線形性、単一の制御電圧による制御、低電力動作などにおいて優れた特性を得ることができる。
In FIG. 17C,
A conventional phase modulator can obtain excellent characteristics in wideband operation of a signal, high linearity of phase control, control by a single control voltage, low power operation, and the like.
従来の位相変調器は、制御電圧の周波数が低い(例えばMHz程度以下)ことを前提に設計されており、無線通信、光通信、計測器において高周波帯域にて位相制御を行う用途には対応できないという問題点があった。例えば、無線通信にてフェーズアレイアンテナや周波数シンセサイザを高速に切り替える場合や、計測器にて高速で位相が変化する任意信号を発生させたい場合などには、制御電圧の帯域が不足することにより、十分に高速な位相変調動作をさせることができない。 The conventional phase modulator is designed on the assumption that the frequency of the control voltage is low (for example, about MHz or less), and cannot be used for phase control in a high frequency band in wireless communication, optical communication, and measuring instruments. There was a problem. For example, when switching the phase array antenna or frequency synthesizer at high speed by wireless communication, or when you want to generate an arbitrary signal whose phase changes at high speed with a measuring instrument, the bandwidth of the control voltage is insufficient, A sufficiently high-speed phase modulation operation cannot be performed.
本発明は、上記課題を解決するためになされたもので、GHzオーダーの高周波にて位相制御を行う用途に対応可能な制御回路を実現することにより、従来構成では難しかった高周波帯域の位相制御が可能な移相器、すなわち位相変調器を提供することを目的とする。特に、単一の制御電圧により高周波の位相変調が可能な位相変調器を提供することを目的とする。 The present invention has been made to solve the above problems, and by realizing a control circuit that can be used for phase control at a high frequency in the order of GHz, phase control in a high frequency band, which has been difficult with the conventional configuration, can be achieved. An object is to provide a possible phase shifter, ie a phase modulator. In particular, an object is to provide a phase modulator capable of high-frequency phase modulation with a single control voltage.
本発明は、信号振幅を調整する手段に対して制御信号を出力する制御回路であって、複数の参照電圧を発生する電圧発生器と、外部から入力される制御電圧と前記参照電圧との差信号を制御信号として出力する差動増幅器群とを備え、振幅調整の対象となる信号として同相信号とこの同相信号に対して位相が90°ずれた直交信号とが存在する場合に、前記差動増幅器群として、前記制御電圧と前記参照電圧とを入力とし同相信号側の第1制御信号を出力する第1の差動増幅器グループと、前記制御電圧と前記参照電圧とを入力とし直交信号側の第2の制御信号を出力する第2の差動増幅器グループとを備え、前記電圧発生器は、前記複数の参照電圧を前記第1の差動増幅器グループと前記第2の差動増幅器グループに交互に1つずつ入力し、前記第1の差動増幅器グループと前記第2の差動増幅器グループとは、それぞれ少なくとも1つずつの差動増幅器を備え、各差動増幅器は、前記制御電圧と前記参照電圧とを入力とする第1の単位差動増幅器と、この第1の単位差動増幅器の出力信号を入力とするエミッタフォロアと、このエミッタフォロアの出力信号を入力とする第2の単位差動増幅器とから構成され、前記制御電圧が前記参照電圧の近傍にあるときに、前記制御電圧を正弦波または余弦波に類似する前記制御信号へ変換するアナログ演算を行うことを特徴とするものである。 The present invention provides a control circuit for outputting a control signal to a means for adjusting a signal amplitude, a voltage generator for generating a plurality of reference voltages, and a difference between the control voltage input from the outside and the reference voltage A differential amplifier group that outputs a signal as a control signal, and when there is an in-phase signal and a quadrature signal whose phase is shifted by 90 ° with respect to the in-phase signal as a signal to be subjected to amplitude adjustment, As a differential amplifier group, a first differential amplifier group that inputs the control voltage and the reference voltage and outputs a first control signal on the in-phase signal side, and inputs the control voltage and the reference voltage to be orthogonal A second differential amplifier group for outputting a second control signal on the signal side, wherein the voltage generator uses the first differential amplifier group and the second differential amplifier as the plurality of reference voltages. Enter one by one alternately into the group Each of the first differential amplifier group and the second differential amplifier group includes at least one differential amplifier, and each differential amplifier receives the control voltage and the reference voltage as inputs. A first unit differential amplifier; an emitter follower that receives the output signal of the first unit differential amplifier; and a second unit differential amplifier that receives the output signal of the emitter follower. When the control voltage is in the vicinity of the reference voltage, an analog operation for converting the control voltage into the control signal similar to a sine wave or a cosine wave is performed.
また、本発明の制御回路の1構成例において、前記電圧発生器は、N(Nは2以上の整数)個の前記参照電圧を生成し、前記第1の差動増幅器グループに含まれる差動増幅器の個数と前記第2の差動増幅器グループに含まれる差動増幅器の個数との総和は、Nであることを特徴とするものである。
また、本発明の制御回路の1構成例において、前記第1の差動増幅器グループに含まれる隣接する2つの差動増幅器の出力は逆相で接続され、前記第2の差動増幅器グループに含まれる隣接する2つの差動増幅器の出力は逆相で接続されることを特徴とするものである。
また、本発明の制御回路の1構成例において、前記参照電圧Vmと1つおきの前記参照電圧Vnとは、前記第1の差動増幅器グループに含まれる隣接する2つの差動増幅器または前記第2の差動増幅器グループに含まれる隣接する2つの差動増幅器に入力されることを特徴とするものである。
Further, in one configuration example of the control circuit of the present invention, the voltage generator generates N (N is an integer of 2 or more) reference voltages, and includes a differential included in the first differential amplifier group. The sum of the number of amplifiers and the number of differential amplifiers included in the second differential amplifier group is N.
Further, in one configuration example of the control circuit of the present invention, outputs of two adjacent differential amplifiers included in the first differential amplifier group are connected in opposite phases and included in the second differential amplifier group. The outputs of two adjacent differential amplifiers are connected in opposite phases.
Further, in one configuration example of the control circuit of the present invention, the reference voltage Vm and every other reference voltage Vn may include two adjacent differential amplifiers included in the first differential amplifier group or the first differential amplifier. It is input to two adjacent differential amplifiers included in two differential amplifier groups.
また、本発明の位相変調器は、入力信号から同相信号とこの同相信号に対して位相が90°ずれた直交信号とを生成する90°分配器と、同相信号側の第1の制御信号に応じて前記同相信号の振幅を変化させて出力する第1の四象限乗算器と、直交信号側の第2の制御信号に応じて前記直交信号の振幅を変化させて出力する第2の四象限乗算器と、前記第1、第2の四象限乗算器から出力される同相信号と直交信号とを合成して出力する合成器と、制御回路とを備えることを特徴とするものである。
また、本発明の位相変調器の1構成例において、前記90°分配器は、多段のポリフェーズフィルタで構成されることを特徴とするものである。
The phase modulator of the present invention includes a 90 ° distributor that generates an in-phase signal from an input signal and a quadrature signal that is 90 ° out of phase with the in-phase signal, and a first on the in-phase signal side. A first four-quadrant multiplier that outputs the in-phase signal by changing the amplitude according to the control signal; and a first quadrant multiplier that outputs the output by changing the amplitude of the quadrature signal according to the second control signal on the quadrature signal side. 2 quadrant multipliers, a combiner that combines and outputs the in-phase signal and the quadrature signal output from the first and second four-quadrant multipliers, and a control circuit. Is.
Further, in one configuration example of the phase modulator of the present invention, the 90 ° distributor is composed of a multi-stage polyphase filter.
従来の位相変調器では、制御回路を構成する差動増幅器に十分な駆動力がないため、GHzオーダーの高周波にて位相制御を行う用途には対応できなかった。これに対して、本発明では、第1、第2の単位差動増幅器の間にエミッタフォロアを挿入して駆動力を高めた差動増幅器を用いて制御回路を構成するので、制御電圧の帯域不足を解消することができ、GHzオーダーの高周波にて位相制御を行う用途に対応可能な制御回路を実現することができる。したがって、本発明の制御回路を位相変調器に適用すれば、単一の制御電圧により高周波の位相変調が可能な位相変調器を実現することができる。 In the conventional phase modulator, since the differential amplifier constituting the control circuit does not have sufficient driving force, it cannot be used for applications in which phase control is performed at a high frequency on the order of GHz. On the other hand, in the present invention, the control circuit is configured using a differential amplifier in which an emitter follower is inserted between the first and second unit differential amplifiers to increase the driving force. A short circuit can be eliminated, and a control circuit that can be used for phase control at a high frequency in the order of GHz can be realized. Therefore, when the control circuit of the present invention is applied to a phase modulator, a phase modulator capable of high-frequency phase modulation with a single control voltage can be realized.
また、本発明では、縦続接続による位相変調器であっても、後段の位相変調器の広帯域動作を担保することができるので、位相変調器の変調度を高くすることができる。 Further, in the present invention, even if the phase modulator is connected in cascade, the wideband operation of the subsequent phase modulator can be ensured, so that the modulation degree of the phase modulator can be increased.
[第1の実施の形態]
以下、本発明の実施の形態について図面を参照して詳細に説明する。図1(A)、図1(B)は本発明の第1の実施の形態に係る位相変調器における差動増幅器対の構成要素となる差動増幅器の回路構成を示す図である。本実施の形態においても位相変調器の構成は図14に示したとおりであり、制御回路4の構成は図16に示したとおりであるので、図14、図16の符号を用いて説明する。図1(A)は差動増幅器440I,442I,444Iの構成を示しており、図1(B)は差動増幅器441I,443Iの構成を示している。
[First Embodiment]
Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. 1A and 1B are diagrams showing a circuit configuration of a differential amplifier that is a component of a differential amplifier pair in the phase modulator according to the first embodiment of the present invention. Also in the present embodiment, the configuration of the phase modulator is as shown in FIG. 14, and the configuration of the control circuit 4 is as shown in FIG. 16, and will be described using the reference numerals in FIGS. FIG. 1A shows the configuration of differential amplifiers 440I, 442I, and 444I, and FIG. 1B shows the configuration of differential amplifiers 441I and 443I.
図1(A)の差動増幅器は、ベースに制御電圧VCLSが入力されるトランジスタ100と、ベースに参照電圧Vmが入力されるトランジスタ101と、一端に電源電圧VEEが与えられる定電流源102と、一端に電源電圧VCCが与えられ、他端がトランジスタ100のコレクタに接続される負荷抵抗103と、一端に電源電圧VCCが与えられ、他端がトランジスタ101のコレクタに接続される負荷抵抗104と、一端がトランジスタ100のエミッタに接続され、他端が定電流源102の他端に接続されるエミッタ抵抗105と、一端がトランジスタ101のエミッタに接続され、他端が定電流源102の他端に接続されるエミッタ抵抗106と、ベースがトランジスタ101のコレクタと負荷抵抗104との接続点に接続され、コレクタに電源電圧VCCが与えられるトランジスタ107と、ベースがトランジスタ100のコレクタと負荷抵抗103との接続点に接続され、コレクタに電源電圧VCCが与えられるトランジスタ108と、ベースおよびコレクタがトランジスタ107のエミッタに接続されたトランジスタ109と、ベースおよびコレクタがトランジスタ108のエミッタに接続されたトランジスタ110と、一端に電源電圧VEEが与えられ、他端がトランジスタ109のエミッタに接続された定電流源111と、一端に電源電圧VEEが与えられ、他端がトランジスタ110のエミッタに接続された定電流源112と、ベースがトランジスタ108のエミッタとトランジスタ110のベースおよびコレクタとの接続点に接続されたトランジスタ113と、ベースがトランジスタ107のエミッタとトランジスタ109のベースおよびコレクタとの接続点に接続されたトランジスタ114と、一端に電源電圧VEEが与えられる定電流源115と、一端に電源電圧VCCが与えられ、他端がトランジスタ113のコレクタに接続される負荷抵抗116と、一端に電源電圧VCCが与えられ、他端がトランジスタ114のコレクタに接続される負荷抵抗117と、一端がトランジスタ113のエミッタに接続され、他端が定電流源115の他端に接続されるエミッタ抵抗118と、一端がトランジスタ114のエミッタに接続され、他端が定電流源115の他端に接続されるエミッタ抵抗119とから構成される。制御信号CIは、トランジスタ113のコレクタと負荷抵抗116との接続点から出力され、制御信号バーCIは、トランジスタ114のコレクタと負荷抵抗117との接続点から出力される。
1A includes a
トランジスタ100,101と定電流源102と負荷抵抗103,104とエミッタ抵抗105,106とは、制御電圧VCLSと参照電圧Vmとを入力とするエミッタ結合形式の第1の単位差動増幅器を構成している。トランジスタ107,108,109,110と定電流源111,112とは、第1の単位差動増幅器から出力される差動出力信号を入力とするエミッタフォロアを構成している。トランジスタ113,114と定電流源115と負荷抵抗116,117とエミッタ抵抗118,119とは、エミッタフォロアから出力される差動出力信号を入力とするエミッタ結合形式の第2の単位差動増幅器を構成している。本実施の形態では、駆動力が大きく高速性に優れるエミッタフォロアを第1、第2の単位差動増幅器の間に挿入することにより、図17(A)に示した従来の差動増幅器と比較して高周波帯域の信号を扱うことが可能となる。
The
図1(B)の差動増幅器は、図1(A)と同様の構成であり、トランジスタ200,201,207,208,209,210,213,214と、定電流源202,211,212,215と、負荷抵抗203,204,216,217と、エミッタ抵抗205,206,218,219とから構成される。トランジスタ200,201と定電流源202と負荷抵抗203,204とエミッタ抵抗205,206とは、制御電圧VCLSと参照電圧Vn(VnはVmに対して1つおきの関係にある参照電圧)とを入力とするエミッタ結合形式の第1の単位差動増幅器を構成している。トランジスタ207,208,209,210と定電流源211,212とは、第1の単位差動増幅器から出力される差動出力信号を入力とするエミッタフォロアを構成している。トランジスタ213,214と定電流源215と負荷抵抗216,217とエミッタ抵抗218,219とは、エミッタフォロアから出力される差動出力信号を入力とするエミッタ結合形式の第2の単位差動増幅器を構成している。図1(A)との違いは、参照電圧Vmの代わりに参照電圧Vnが入力されることと、出力が逆相になっていることである。つまり、制御信号CIは、トランジスタ214のコレクタと負荷抵抗217との接続点から出力され、制御信号バーCIは、トランジスタ213のコレクタと負荷抵抗216との接続点から出力される。
The differential amplifier in FIG. 1B has the same configuration as that in FIG. 1A, and includes
図2(A)、図2(B)は差動増幅器対401Iの回路構成とその動作を示す図であり、図2(A)は差動増幅器対401Iの記号を示す図、図2(B)は図2(A)の差動増幅器対401Iの入出力特性(VC−CI特性)を示す図である。差動増幅器対401Iを構成する一方の差動増幅器440Iの構成は図1(A)に示したとおりであり、他方の差動増幅器441Iの構成は図1(B)に示したとおりである。上記のとおり、2つの差動増幅器440I,441Iの出力は逆相で接続される。 2A and 2B are diagrams showing a circuit configuration and an operation of the differential amplifier pair 401I. FIG. 2A is a diagram showing a symbol of the differential amplifier pair 401I, and FIG. ) Is a diagram showing input / output characteristics (VC-CI characteristics) of the differential amplifier pair 401I of FIG. The configuration of one differential amplifier 440I constituting the differential amplifier pair 401I is as shown in FIG. 1A, and the configuration of the other differential amplifier 441I is as shown in FIG. 1B. As described above, the outputs of the two differential amplifiers 440I and 441I are connected in reverse phase.
制御電圧VCLSが参照電圧Vm,Vnよりも十分に大きい領域では2つの差動増幅器440I,441Iが両方ともオンとなり、制御信号CIは電圧VHの近傍に収束する。制御電圧VCLSが参照電圧Vm,Vnよりも十分に小さい領域では2つの差動増幅器440I,441Iが両方ともオフとなり、制御信号CIは電圧VHの近傍に収束する。制御電圧VCLSが参照電圧VmとVnの中間電圧となったときには、制御信号CIは最小電圧VLとなる。制御電圧VCLSが参照電圧Vmに近い領域では差動増幅器440Iがオフとなり差動増幅器441Iがオンとなるので、制御信号CIはVHとVLの中間的なレベルとなる。制御電圧VCLSが参照電圧Vnに近い領域では差動増幅器440Iがオンとなり差動増幅器441Iがオフとなるので、制御信号CIはVHとVLの中間的なレベルとなる。2つの差動増幅器440I,441Iは同一に製造されるので、差動増幅器対401Iの入出力特性は下に凸(または上に凸)の左右対称の形状となる。本実施の形態では、制御電圧VCLSを参照電圧Vmの近傍の値または参照電圧Vnの近傍の値にして、VHとVLの中間的なレベルを利用する。 In a region where the control voltage VCLS is sufficiently larger than the reference voltages Vm and Vn, the two differential amplifiers 440I and 441I are both turned on, and the control signal CI converges in the vicinity of the voltage VH. In a region where the control voltage VCLS is sufficiently smaller than the reference voltages Vm and Vn, the two differential amplifiers 440I and 441I are both turned off, and the control signal CI converges in the vicinity of the voltage VH. When the control voltage VCLS becomes an intermediate voltage between the reference voltages Vm and Vn, the control signal CI becomes the minimum voltage VL. In the region where the control voltage VCLS is close to the reference voltage Vm, the differential amplifier 440I is turned off and the differential amplifier 441I is turned on, so that the control signal CI is at an intermediate level between VH and VL. In a region where the control voltage VCLS is close to the reference voltage Vn, the differential amplifier 440I is turned on and the differential amplifier 441I is turned off, so that the control signal CI is at an intermediate level between VH and VL. Since the two differential amplifiers 440I and 441I are manufactured in the same manner, the input / output characteristics of the differential amplifier pair 401I have a left-right symmetrical shape that protrudes downward (or protrudes upward). In the present embodiment, the control voltage VCLS is set to a value near the reference voltage Vm or a value near the reference voltage Vn, and an intermediate level between VH and VL is used.
図3(A)、図3(B)、図3(C)は差動増幅器対401Iの動作の参照電圧間隔依存性を示す図であり、図3(A)は参照電圧VmとVnとの差が定数VT(VT=kT/q=26mVであり、kはボルツマン定数、Tは絶対温度、qは電子の電荷)と比較して十分に大きい場合(|Vm−Vn|>>8VT)の差動増幅器対401Iの入出力特性を示す図、図3(B)は参照電圧VmとVnとの差が定数VTの8倍程度である場合(|Vm−Vn|≒8VT)の差動増幅器対401Iの入出力特性を示す図、図3(C)は参照電圧VmとVnとの差が定数VTと比較して十分に小さい場合(|Vm−Vn|<<8VT)の差動増幅器対401Iの入出力特性を示す図である。 3A, FIG. 3B, and FIG. 3C are diagrams showing the dependency of the differential amplifier pair 401I on the reference voltage interval, and FIG. 3A shows the relationship between the reference voltages Vm and Vn. When the difference is sufficiently larger than the constant VT (VT = kT / q = 26 mV, k is the Boltzmann constant, T is the absolute temperature, and q is the charge of the electron) (| Vm−Vn | >> 8VT) FIG. 3B shows the input / output characteristics of the differential amplifier pair 401I. FIG. 3B shows the differential amplifier when the difference between the reference voltages Vm and Vn is about eight times the constant VT (| Vm−Vn | ≈8VT). FIG. 3C shows the input / output characteristics of the pair 401I. FIG. 3C shows a differential amplifier pair when the difference between the reference voltages Vm and Vn is sufficiently smaller than the constant VT (| Vm−Vn | << 8VT). It is a figure which shows the input / output characteristic of 401I.
制御電圧VCLSが参照電圧VmとVnの中間電圧となったときに制御信号CIは最小となるが、参照電圧VmとVnの電圧差と定数VTとの大小関係によりその振る舞いは変化する。参照電圧VmとVnとの差が定数VTと比較して十分に大きい場合には、制御信号CIは、図3(A)に示すように広い制御電圧VCLSの範囲で最小電圧VLに張り付く。反対に、参照電圧VmとVnとの差が定数VTと比較して十分に小さい場合には、図3(C)に示すように制御電圧VCLSが参照電圧VmとVnの中間電圧となったときに制御信号CIは最小となるが、制御信号CIの電圧値はVLまで下がらない。 When the control voltage VCLS becomes an intermediate voltage between the reference voltages Vm and Vn, the control signal CI is minimized, but the behavior changes depending on the magnitude relationship between the voltage difference between the reference voltages Vm and Vn and the constant VT. When the difference between the reference voltages Vm and Vn is sufficiently larger than the constant VT, the control signal CI sticks to the minimum voltage VL within a wide control voltage VCLS range as shown in FIG. On the other hand, when the difference between the reference voltages Vm and Vn is sufficiently smaller than the constant VT, the control voltage VCLS becomes an intermediate voltage between the reference voltages Vm and Vn as shown in FIG. However, the control signal CI is minimized, but the voltage value of the control signal CI does not drop to VL.
参照電圧VmとVnとの電圧差と、定数VTとの関係を適切に(例えば、参照電圧VmとVnとの電圧差を定数VTの8倍程度)に選択すると、図3(B)に示すように制御電圧VCLSが参照電圧VmとVnの中間電圧となったときに、制御信号CIは最小電圧VL近傍まで下がり、かつ余弦波形または正弦波形に似た極小値を持つことになる。 When the relationship between the voltage difference between the reference voltages Vm and Vn and the constant VT is appropriately selected (for example, the voltage difference between the reference voltages Vm and Vn is about eight times the constant VT), the relationship shown in FIG. As described above, when the control voltage VCLS becomes an intermediate voltage between the reference voltages Vm and Vn, the control signal CI decreases to the vicinity of the minimum voltage VL and has a minimum value similar to a cosine waveform or a sine waveform.
このように、参照電圧VmとVnとの電圧差と、定数VTとの関係を適切に選択すると、制御電圧VCLSに対する制御信号CIの変化の特性をcos(VCLS)またはsin(VCLS)に類似させることができる。さらに、制御電圧VCLSの変化に対して制御信号CIが大きく変化しており、雑音の影響を受けにくいことから、制御信号CIは制御信号として適している。参照電圧VmとVnとの電圧差が定数VTの2倍未満または定数VTの12倍よりも大きいときには、制御信号CIは余弦波形、正弦波形から外れた波形になる。このように、制御信号CIを余弦波形、正弦波形に類似した波形にするには、参照電圧VmとVnの電圧差を定数VTの2倍以上12倍以下程度に設定すると有効である。 As described above, when the relationship between the voltage difference between the reference voltages Vm and Vn and the constant VT is appropriately selected, the change characteristic of the control signal CI with respect to the control voltage VCLS is made similar to cos (VCLS) or sin (VCLS). be able to. Furthermore, the control signal CI is suitable as a control signal because the control signal CI changes greatly with respect to the change of the control voltage VCLS and is not easily affected by noise. When the voltage difference between the reference voltages Vm and Vn is less than twice the constant VT or greater than 12 times the constant VT, the control signal CI has a waveform deviating from the cosine waveform and sine waveform. Thus, in order to make the control signal CI have a waveform similar to a cosine waveform or a sine waveform, it is effective to set the voltage difference between the reference voltages Vm and Vn to be not less than 2 times and not more than 12 times the constant VT.
なお、図1〜図3では、制御信号CIを演算する構成について説明しているが、制御信号CQを演算する構成も同様である。すなわち、差動増幅器440Q,442Q,444Qの場合には図1(A)の構成においてCI,バーCIをCQ,バーCQとすればよく、差動増幅器441Q,443Qの場合には図1(B)に示した構成においてCI,バーCIをCQ,バーCQとすればよい。
1 to 3, the configuration for calculating the control signal CI has been described, but the configuration for calculating the control signal CQ is also the same. That is, in the case of the
図4は制御回路4の入出力特性を示す図である。まず、参照電圧Vmとして電圧V9が入力され、参照電圧Vnとして電圧V7が入力される差動増幅器対401Iに注目して動作を説明する。制御電圧VCLSが電圧V6よりも大きく、電圧V10よりも小さい領域では、制御信号CIは図3(B)と同様な特性となっている。すなわち、電圧V6を位相の基準(0°)と考えると、制御信号CIのレベルは擬似的に、VCLS=V6においてcos(0°)、VCLS=Vn=V7においてcos(90°)、VCLS=V8においてcos(180°)、VCLS=Vm=V9においてcos(270°)と理解することができる。図3(B)によれば、cos(0°)の電圧値はVH、cos(180°)の電圧値はVL、cos(90°)、cos(270°)の電圧値はVHとVLの中間の値である。本実施の形態では、図4に示すようにVHを「1」、VLを「−1」、VHとVLの中間の値を「0」としている。 FIG. 4 is a diagram showing the input / output characteristics of the control circuit 4. First, the operation will be described focusing on the differential amplifier pair 401I to which the voltage V9 is input as the reference voltage Vm and the voltage V7 is input as the reference voltage Vn. In a region where the control voltage VCLS is larger than the voltage V6 and smaller than the voltage V10, the control signal CI has the same characteristics as in FIG. That is, when the voltage V6 is considered as a phase reference (0 °), the level of the control signal CI is artificially cos (0 °) at VCLS = V6, cos (90 °) at VCLS = Vn = V7, and VCLS = It can be understood that cos (180 °) at V8 and cos (270 °) at VCLS = Vm = V9. According to FIG. 3B, the voltage value of cos (0 °) is VH, the voltage value of cos (180 °) is VL, and the voltage values of cos (90 °) and cos (270 °) are VH and VL. Intermediate value. In this embodiment, as shown in FIG. 4, VH is “1”, VL is “−1”, and an intermediate value between VH and VL is “0”.
さらに、参照電圧Vmとして電圧V5が入力され、参照電圧Vnとして電圧V3が入力される差動増幅器対402Iに注目して動作を説明する。制御電圧VCLSが電圧V2よりも大きく、電圧V6よりも小さい領域では、制御信号CIは図3(B)と同様な特性となっている。すなわち、電圧V2を位相の基準(0°)と考えると、制御信号CIのレベルは擬似的に、VCLS=V2においてcos(0°)、VCLS=Vn=V3においてcos(90°)、VCLS=V4においてcos(180°)、VCLS=Vm=V5においてcos(270°)と理解することができる。 Further, the operation will be described by paying attention to the differential amplifier pair 402I to which the voltage V5 is input as the reference voltage Vm and the voltage V3 is input as the reference voltage Vn. In the region where the control voltage VCLS is larger than the voltage V2 and smaller than the voltage V6, the control signal CI has the same characteristics as in FIG. That is, when the voltage V2 is considered as a phase reference (0 °), the level of the control signal CI is pseudo, cos (0 °) when VCLS = V2, cos (90 °) when VCLS = Vn = V3, and VCLS = It can be understood that cos (180 °) at V4 and cos (270 °) at VCLS = Vm = V5.
以上説明した2つの差動増幅器対401I,402Iにより、制御電圧VCLSが電圧V2からV10の領域で720°分に相当する疑似的な余弦波形が得られることが分かる。さらに、電圧V1が入力される差動増幅器444Iが設けられることにより、制御信号CIは電圧V1においてcos(270°)に相当する値となる。2つの差動増幅器対401I,402Iと差動増幅器444Iとを合わせると、制御電圧VCLSが電圧V1からV10の領域で810°分に相当する疑似的な余弦波形が得られることになる。 It can be seen that the two differential amplifier pairs 401I and 402I described above provide a pseudo cosine waveform corresponding to 720 ° in the region where the control voltage VCLS is from the voltage V2 to V10. Further, by providing the differential amplifier 444I to which the voltage V1 is input, the control signal CI has a value corresponding to cos (270 °) at the voltage V1. When the two differential amplifier pairs 401I, 402I and the differential amplifier 444I are combined, a pseudo cosine waveform corresponding to 810 ° in the region where the control voltage VCLS is from the voltage V1 to V10 is obtained.
次に、参照電圧Vmとして電圧V10が入力され、参照電圧Vnとして電圧V8が入力される差動増幅器対401Qに注目して動作を説明する。制御電圧VCLSが電圧V7よりも大きい領域では、制御信号CQは図3(B)の制御信号CIと同様な特性となっている。90°基準をずらして考えて、V6を位相の基準(0°)と考えると、制御信号CQのレベルは擬似的に、VCLS=V6においてsin(0°)、VCLS=V7においてsin(90°)、VCLS=Vn=V8においてsin(180°)、VCLS=V9においてsin(270°)と理解することができる。
Next, the operation will be described by paying attention to the
さらに、参照電圧Vmとして電圧V6が入力され、参照電圧Vnとして電圧V4が入力される差動増幅器対402Qに注目して動作を説明する。制御電圧VCLSが電圧V3よりも大きく、電圧V7よりも小さい領域では、制御信号CQは図3(B)の制御信号CIと同様な特性となっている。90°基準をずらして考えて、V2を位相の基準(0°)と考えると、制御信号CQのレベルは擬似的に、VCLS=V2においてsin(0°)、VCLS=V3においてsin(90°)、VCLS=Vn=V4においてsin(180°)、VCLS=V5においてsin(270°)と理解することができる。
Further, the operation will be described by paying attention to the
以上説明した2つの差動増幅器対401Q,402Qにより、制御電圧VCLSが電圧V2からV10の領域で720°分に相当する疑似的な正弦波形が得られることが分かる。さらに、電圧V2が入力される差動増幅器444Qが設けられることにより、制御信号CQはVCLS=V2においてsin(0°)、VCLS=V1においてsin(270°)に相当する値となる。2つの差動増幅器対401Q,402Qと差動増幅器444Qとを合わせると、制御電圧VCLSが電圧V1からV10の領域で810°分に相当する疑似的な正弦波形が得られることになる。 It can be seen that the two differential amplifier pairs 401Q and 402Q described above provide a pseudo sine waveform corresponding to 720 ° in the region where the control voltage VCLS is from the voltage V2 to V10. Further, by providing the differential amplifier 444Q to which the voltage V2 is input, the control signal CQ becomes a value corresponding to sin (0 °) when VCLS = V2 and sin (270 °) when VCLS = V1. When the two differential amplifier pairs 401Q and 402Q and the differential amplifier 444Q are combined, a pseudo sine waveform corresponding to 810 ° in the region where the control voltage VCLS is from the voltage V1 to V10 is obtained.
このように、制御回路4は、制御電圧VCLSから、制御信号CI=cos(VCLS)、CQ=sin(VCLS)への変換をリアルタイムで行うアナログ演算回路となっている。同相信号側の制御信号CIと直交信号側の制御信号CQを同時に得ることができるのは、制御回路4内の電圧発生器400Ib,400Qbが発生する複数の参照電圧を、同相信号側の演算を行う差動増幅器対と直交信号側の演算を行う差動増幅器対に交互に入力するからである。例えば図16の例では、電圧V9,V7,V5,V3,V1を同相信号側の演算に使用し、電圧V10,V8,V6,V4,V2を直交信号側の演算に使用している。 As described above, the control circuit 4 is an analog arithmetic circuit that performs conversion from the control voltage VCLS to the control signals CI = cos (VCLS) and CQ = sin (VCLS) in real time. The control signal CI on the in-phase signal side and the control signal CQ on the quadrature signal side can be obtained at the same time by using a plurality of reference voltages generated by the voltage generators 400Ib and 400Qb in the control circuit 4 on the in-phase signal side. This is because they are alternately input to the differential amplifier pair that performs the operation and the differential amplifier pair that performs the operation on the orthogonal signal side. For example, in the example of FIG. 16, the voltages V9, V7, V5, V3, and V1 are used for the calculation on the in-phase signal side, and the voltages V10, V8, V6, V4, and V2 are used for the calculation on the quadrature signal side.
図5は本実施の形態の位相変調器の移相特性を示す図である。横軸は制御電圧VCLS、縦軸はVCLS=V1を基準にした場合の出力信号VOUTの移相量である。50は制御回路4が理想的な余弦波、正弦波を発生すると仮定した場合の位相変調器の移相特性を示し、51は実際の移相特性を示している。制御回路4が理想的な余弦波、正弦波を発生する場合、VCLS=V1で0度の移相量となり、VCLS=V10で810度の移相量となる直線的な移相特性となる。しかしながら、現実の制御回路4は、理想的な余弦波、正弦波を発生するものではなく、余弦波、正弦波の特性に近い特性(擬似正弦波、擬似余弦波)を発生するので、移相特性は理想的な直線にはならない。
FIG. 5 is a diagram showing the phase shift characteristics of the phase modulator according to the present embodiment. The horizontal axis represents the control voltage VCLS, and the vertical axis represents the phase shift amount of the output signal VOUT when VCLS = V1 is used as a reference.
現実の移相特性の形状は、擬似余弦波の理想的な余弦波に対する振幅歪み、擬似正弦波の理想的な正弦波に対する振幅歪みや、90°分配器1の分配誤差(振幅ばらつき、位相ばらつき)等によって影響を受ける。
まず、90°分配器1の分配誤差よりも擬似余弦波および擬似正弦波の振幅歪みの方が位相変調器の移相特性に大きな影響を与える場合を考える。振幅歪みは180度周期で理想からのずれとして現れるが、擬似余弦波にて180度毎に現れ、擬似正弦波にて180度毎に現れる。擬似余弦波と擬似正弦波には90度相当の差があるので、結果として出力には90度周期の位相誤差として現れる。図5の51で示した移相特性は、このような振幅歪みが支配的な場合の移相特性の例を表わしている。
The shape of the actual phase shift characteristic is the amplitude distortion of the pseudo cosine wave with respect to the ideal cosine wave, the amplitude distortion of the pseudo sine wave with respect to the ideal sine wave, and the distribution error (amplitude variation and phase variation of the 90 °
First, let us consider a case where the amplitude distortion of the pseudo cosine wave and the pseudo sine wave has a greater influence on the phase shift characteristics of the phase modulator than the distribution error of the 90 °
次に、擬似余弦波および擬似正弦波の振幅歪みよりも90°分配器1の分配誤差の方が位相変調器の移相特性に大きな影響を与える場合を考える。90°分配器1の分配誤差は180度周期であるので、結果として出力には180度周期の位相誤差として現れる。
図6は擬似余弦波および擬似正弦波の振幅歪みよりも90°分配器1の分配誤差の方が移相特性に大きな影響を与える場合の位相変調器の移相特性を示す図である。60は理想的な移相特性を示し、61は実際の移相特性を示している。
Next, consider the case where the distribution error of the 90 °
FIG. 6 is a diagram showing the phase shift characteristic of the phase modulator when the distribution error of the 90 °
以上のように、本実施の形態では、第1、第2の単位差動増幅器の間にエミッタフォロアを挿入して駆動力を高めた差動増幅器を用いて制御回路4を構成するので、制御電圧VCの帯域不足を解消することができ、GHzオーダーの高周波にて位相制御を行う用途に対応可能な制御回路4を実現することができる。したがって、本実施の形態の制御回路4を図14に示した位相変調器に適用すれば、単一の制御電圧VCにより高周波の位相変調が可能な位相変調器を実現することができる。
このように、本実施の形態の位相変調器では、単一の制御信号により高周波の位相変調が可能であるが、制御回路4の出力に振幅歪みが存在する場合や、90°分配器1に分配誤差が存在する場合には、移相特性の線形性が悪化する。
As described above, in the present embodiment, the control circuit 4 is configured using the differential amplifier in which the emitter follower is inserted between the first and second unit differential amplifiers to increase the driving force. The bandwidth shortage of the voltage VC can be solved, and the control circuit 4 that can be used for phase control at a high frequency of the GHz order can be realized. Therefore, if the control circuit 4 of the present embodiment is applied to the phase modulator shown in FIG. 14, a phase modulator capable of high-frequency phase modulation with a single control voltage VC can be realized.
As described above, in the phase modulator according to the present embodiment, high-frequency phase modulation is possible with a single control signal. However, when amplitude distortion exists in the output of the control circuit 4 or the 90 °
[第2の実施の形態]
次に、本発明の第2の実施の形態について説明する。図7は本発明の第2の実施の形態に係る位相変調器の構成を示すブロック図である。本実施の形態の位相変調器は、90°分配器1−1,1−2と、四象限乗算器2I−1,2Q−1,2I−2,2Q−2と、合成器3−1,3−2と、制御回路4−1,4−2と、相殺回路5とから構成される。本実施の形態は、90°分配器1−1と四象限乗算器2I−1,2Q−1と合成器3−1と制御回路4−1とからなる第1の位相変調器と、90°分配器1−2と四象限乗算器2I−2,2Q−2と合成器3−2と制御回路4−2とからなる第2の位相変調器とを縦続接続した構成になっている。
[Second Embodiment]
Next, a second embodiment of the present invention will be described. FIG. 7 is a block diagram showing the configuration of the phase modulator according to the second embodiment of the present invention. The phase modulator according to the present embodiment includes 90 ° distributors 1-1 and 1-2, four-quadrant multipliers 2I-1, 2Q-1, 2I-2, and 2Q-2, and combiners 3-1, 3-2, control circuits 4-1 and 4-2, and
90°分配器1−1,1−2は第1の実施の形態の90°分配器1と同一であり、四象限乗算器2I−1,2Q−1,2I−2,2Q−2は第1の実施の形態の四象限乗算器2I,2Qと同一であり、合成器3−1,3−2は第1の実施の形態の合成器3と同一であり、制御回路4−1,4−2は第1の実施の形態の制御回路4と同一である。したがって、これら構成要素の説明は省略する。
The 90 ° distributors 1-1 and 1-2 are the same as the 90 °
すでに述べたように、第1の実施の形態では、位相変調器の移相特性の誤差は90度または180度の周期で現れる。そこで、第1の実施の形態で説明した位相変調器を2つ用意し、これらの位相変調器を縦続接続し、移相特性の誤差の周期を相殺する2つの制御電圧VC1,VC2を発生する相殺回路5を設ける。相殺回路5は、単一の制御電圧VCから制御電圧VC1,VC2を生成して制御回路4−1,4−2に入力する。このとき、相殺回路5は、予め定められた動作特性により制御電圧VC1,VC2の電圧レベルを調整したり、予め定められた動作特性により制御電圧VC1,VC2間のタイミングを調整したりすることで、位相変調器の2つの移相特性の誤差を相殺する。
As described above, in the first embodiment, the phase shift characteristic error of the phase modulator appears in a period of 90 degrees or 180 degrees. Therefore, two phase modulators described in the first embodiment are prepared, and these phase modulators are cascaded to generate two control voltages VC1 and VC2 that cancel out the period of the phase shift characteristic error. A
つまり、90°分配器1−1と四象限乗算器2I−1,2Q−1と合成器3−1と制御回路4−1とからなる第1の位相変調器の移相特性と、90°分配器1−2と四象限乗算器2I−2,2Q−2と合成器3−2と制御回路4−2とからなる第2の位相変調器の移相特性との間には、45度または90度に相当するずれが存在するので、制御電圧VC1,VC2の電圧レベルを調整したり、制御電圧VC1,VC2間のタイミングを調整したりすることで、これら2つの移相特性の誤差を相殺することができる。制御電圧VC1,VC2の調整は、電圧レベルのみを調整してもよいし、タイミングのみを調整してもよいし、これら2つの調整を同時に実施してもよい。 That is, the phase shift characteristic of the first phase modulator including the 90 ° distributor 1-1, the four-quadrant multipliers 2I-1, 2Q-1, the combiner 3-1, and the control circuit 4-1, and the 90 ° 45 degrees between the phase shift characteristics of the second phase modulator composed of the divider 1-2, the four-quadrant multipliers 2I-2 and 2Q-2, the combiner 3-2, and the control circuit 4-2. Alternatively, since there is a deviation corresponding to 90 degrees, adjusting the voltage levels of the control voltages VC1 and VC2 or adjusting the timing between the control voltages VC1 and VC2 can reduce the error between these two phase shift characteristics. Can be offset. The adjustment of the control voltages VC1 and VC2 may be performed by adjusting only the voltage level, adjusting only the timing, or performing these two adjustments simultaneously.
以上の構成により、本実施の形態では、単一の制御電圧VCにより高周波の位相変調が可能であり、かつ、制御回路4−1,4−2の出力に振幅歪みが存在する場合や、90°分配器1−1,1−2に分配誤差が存在する場合でも、移相特性の線形性の悪化を抑圧することができる。 With the above configuration, in the present embodiment, high-frequency phase modulation is possible with a single control voltage VC, and amplitude distortion exists in the outputs of the control circuits 4-1 and 4-2. Even when there is a distribution error in the distributors 1-1 and 1-2, the deterioration of the linearity of the phase shift characteristic can be suppressed.
[第3の実施の形態]
次に、本発明の第3の実施の形態について説明する。図8は本発明の第3の実施の形態に係る位相変調器の構成を示すブロック図であり、図7と同一の構成には同一の符号を付してある。本実施の形態の位相変調器は、90°分配器1−1,1−2と、四象限乗算器2I−1,2Q−1,2I−2,2Q−2と、合成器3−1,3−2と、制御回路4−1,4−2と、レベルシフト回路6とから構成される。
[Third Embodiment]
Next, a third embodiment of the present invention will be described. FIG. 8 is a block diagram showing the configuration of the phase modulator according to the third embodiment of the present invention. The same components as those in FIG. 7 are denoted by the same reference numerals. The phase modulator according to the present embodiment includes 90 ° distributors 1-1 and 1-2, four-quadrant multipliers 2I-1, 2Q-1, 2I-2, and 2Q-2, and combiners 3-1, 3-2, control circuits 4-1 and 4-2, and a
本実施の形態は、第2の実施の形態の相殺回路5の具体例としてレベルシフト回路6を用いるものである。制御回路4−1には、制御電圧VCが制御電圧VC1としてそのまま入力される。レベルシフト回路6は、入力される制御電圧VCの高周波特性は維持しながら、制御電圧VCの直流成分のみ電圧レベルをシフトさせて制御電圧VC2として出力する機能を有する。
In this embodiment, a
例えば、図5で説明したように制御回路4が発生する擬似余弦波および擬似正弦波に振幅歪みが存在する場合、第1の実施の形態の位相変調器の移相特性は90度周期の位相誤差を持つ。この位相誤差は、制御電圧VCではV(n+1)−Vnの電圧レベル、すなわち参照電圧の間隔に相当する。そこで、90°分配器1−1,1−2の分配誤差よりも制御回路4−1,4−2が発生する擬似余弦波および擬似正弦波の振幅歪みの方が位相変調器の移相特性に大きな影響を与える場合、レベルシフト回路6は、制御電圧VC1とVC2の電圧レベル差が(V(n+1)−Vn)の1/2に相当する値になるように制御電圧VC2の電圧レベルをシフトさせればよい。
For example, when amplitude distortion exists in the pseudo cosine wave and pseudo sine wave generated by the control circuit 4 as described with reference to FIG. 5, the phase shift characteristic of the phase modulator of the first embodiment is a phase with a period of 90 degrees. Has an error. This phase error corresponds to a voltage level of V (n + 1) −Vn in the control voltage VC, that is, a reference voltage interval. Therefore, the amplitude distortion of the pseudo cosine wave and pseudo sine wave generated by the control circuits 4-1 and 4-2 is more in phase shift characteristics of the phase modulator than the distribution error of the 90 ° distributors 1-1 and 1-2.
図9は本実施の形態の位相変調器の移相特性を示す図である。90°分配器1−1と四象限乗算器2I−1,2Q−1と合成器3−1と制御回路4−1とからなる第1の位相変調器の移相特性は図9の90で表わされる90度周期の位相誤差を持ち、90°分配器1−2と四象限乗算器2I−2,2Q−2と合成器3−2と制御回路4−2とからなる第2の位相変調器の移相特性は図9の91で表わされる90度周期の位相誤差を持つ。本実施の形態では、レベルシフト回路6を設け、制御電圧VC1とVC2の電圧レベル差を(V(n+1)−Vn)の1/2に相当する値にすることにより、2つの移相特性が45度に相当するずれを持つことになるので、2つの移相特性を相殺することができ、位相変調器のトータルの移相特性として図9の92で示す直線の移相特性を実現することができる。
FIG. 9 is a diagram illustrating the phase shift characteristics of the phase modulator according to the present embodiment. The phase shift characteristic of the first phase modulator composed of the 90 ° distributor 1-1, the four-quadrant multipliers 2I-1, 2Q-1, the combiner 3-1, and the control circuit 4-1, is 90 in FIG. A second phase modulation having a phase error of 90 ° period and comprising a 90 ° distributor 1-2, four-quadrant multipliers 2I-2 and 2Q-2, a combiner 3-2, and a control circuit 4-2. The phase shift characteristic of the detector has a phase error of 90 ° period represented by 91 in FIG. In this embodiment, the
また、図6で説明したように90°分配器1に分配誤差が存在する場合、第1の実施の形態の位相変調器の移相特性は180度周期の位相誤差を持つ。この位相誤差は、制御電圧VCではV(n+2)−Vnの電圧レベル、すなわち参照電圧の間隔の2倍の電圧レベルに相当する。そこで、制御回路4−1,4−2が発生する擬似余弦波および擬似正弦波の振幅歪みよりも90°分配器1−1,1−2の分配誤差の方が位相変調器の移相特性に大きな影響を与える場合、レベルシフト回路6は、制御電圧VC1とVC2の電圧レベル差が(V(n+2)−Vn)の1/2に相当する値になるように制御電圧VC2の電圧レベルをシフトさせればよい。
In addition, as described with reference to FIG. 6, when there is a distribution error in the 90 °
図10は本実施の形態の位相変調器の別の移相特性を示す図である。90°分配器1−1と四象限乗算器2I−1,2Q−1と合成器3−1と制御回路4−1とからなる第1の位相変調器の移相特性は図10の120で表わされる180度周期の位相誤差を持ち、90°分配器1−2と四象限乗算器2I−2,2Q−2と合成器3−2と制御回路4−2とからなる第2の位相変調器の移相特性は図10の121で表わされる180度周期の位相誤差を持つ。本実施の形態では、レベルシフト回路6を設け、制御電圧VC1とVC2の電圧レベル差を(V(n+2)−Vn)の1/2に相当する値にすることにより、2つの移相特性が90度に相当するずれを持つことになるので、2つの移相特性を相殺することができ、位相変調器のトータルの移相特性として図10の122で示す直線の移相特性を実現することができる。
FIG. 10 is a diagram showing another phase shift characteristic of the phase modulator according to the present embodiment. The phase shift characteristic of the first phase modulator composed of the 90 ° distributor 1-1, the four-quadrant multipliers 2I-1, 2Q-1, the combiner 3-1, and the control circuit 4-1, is 120 in FIG. A second phase modulation having a phase error of 180 degrees and represented by a 90 ° distributor 1-2, four-quadrant multipliers 2I-2 and 2Q-2, a combiner 3-2 and a control circuit 4-2. The phase shift characteristic of the detector has a phase error of a 180 degree period represented by 121 in FIG. In the present embodiment, the
以上の構成により、本実施の形態では、単一の制御電圧VCにより高周波の位相変調が可能であり、かつ、制御回路4−1,4−2の出力に振幅歪みが存在する場合や、90°分配器1−1,1−2に分配誤差が存在する場合でも、移相特性の線形性の悪化を抑圧することができる。 With the above configuration, in the present embodiment, high-frequency phase modulation is possible with a single control voltage VC, and amplitude distortion exists in the outputs of the control circuits 4-1 and 4-2. Even when there is a distribution error in the distributors 1-1 and 1-2, the deterioration of the linearity of the phase shift characteristic can be suppressed.
[第4の実施の形態]
次に、本発明の第4の実施の形態について説明する。図11は本発明の第4の実施の形態に係る位相変調器の構成を示すブロック図であり、図7、図8と同一の構成には同一の符号を付してある。本実施の形態の位相変調器は、90°分配器1−1,1−2と、四象限乗算器2I−1,2Q−1,2I−2,2Q−2と、合成器3−1,3−2と、制御回路4−1,4−2と、遅延回路7とから構成される。
[Fourth Embodiment]
Next, a fourth embodiment of the present invention will be described. FIG. 11 is a block diagram showing the configuration of the phase modulator according to the fourth embodiment of the present invention. The same components as those in FIGS. 7 and 8 are given the same reference numerals. The phase modulator according to the present embodiment includes 90 ° distributors 1-1 and 1-2, four-quadrant multipliers 2I-1, 2Q-1, 2I-2, and 2Q-2, and combiners 3-1, 3-2, control circuits 4-1 and 4-2, and a
本実施の形態は、第2の実施の形態の相殺回路5の具体例として遅延回路7を用いるものである。制御回路4−1には、制御電圧VCが制御電圧VC1としてそのまま入力される。遅延回路7は、入力される制御電圧VCの高周波特性は維持しながら、制御電圧VCのタイミングをずらして制御電圧VC2として出力する機能を有する。
In this embodiment, a
例えば、図5で説明したように制御回路4が発生する擬似余弦波および擬似正弦波に振幅歪みが存在する場合、第1の実施の形態の位相変調器の移相特性は90度周期の位相誤差を持つ。この位相誤差は、制御電圧VCのタイミングを、入力信号VINで90度の位相に相当するタイミングずらした場合に相当する。そこで、90°分配器1−1,1−2の分配誤差よりも制御回路4−1,4−2が発生する擬似余弦波および擬似正弦波の振幅歪みの方が位相変調器の移相特性に大きな影響を与える場合、遅延回路7は、制御電圧VC1とVC2のタイミング差が、入力信号VINで45度の位相に相当する値になるように制御電圧VC2のタイミングをずらせばよい。この場合の位相変調器の動作は図9で説明することができる。
For example, when amplitude distortion exists in the pseudo cosine wave and pseudo sine wave generated by the control circuit 4 as described with reference to FIG. 5, the phase shift characteristic of the phase modulator of the first embodiment is a phase with a period of 90 degrees. Has an error. This phase error corresponds to a case where the timing of the control voltage VC is shifted by a timing corresponding to a phase of 90 degrees with the input signal VIN. Therefore, the amplitude distortion of the pseudo cosine wave and pseudo sine wave generated by the control circuits 4-1 and 4-2 is more in phase shift characteristics of the phase modulator than the distribution error of the 90 ° distributors 1-1 and 1-2. When the
90°分配器1−1と四象限乗算器2I−1,2Q−1と合成器3−1と制御回路4−1とからなる第1の位相変調器の移相特性は図9の90で表わされる90度周期の位相誤差を持ち、90°分配器1−2と四象限乗算器2I−2,2Q−2と合成器3−2と制御回路4−2とからなる第2の位相変調器の移相特性は図9の91で表わされる90度周期の位相誤差を持つ。本実施の形態では、遅延回路7を設け、制御電圧VC1とVC2のタイミング差を、入力信号VINで45度の位相に相当する値にすることにより、2つの移相特性が45度に相当するずれを持つことになるので、位相変調器のトータルの移相特性として図9の92で示す直線の移相特性を実現することができる。
The phase shift characteristic of the first phase modulator composed of the 90 ° distributor 1-1, the four-quadrant multipliers 2I-1, 2Q-1, the combiner 3-1, and the control circuit 4-1, is 90 in FIG. A second phase modulation having a phase error of 90 ° period and comprising a 90 ° distributor 1-2, four-quadrant multipliers 2I-2 and 2Q-2, a combiner 3-2, and a control circuit 4-2. The phase shift characteristic of the detector has a phase error of 90 ° period represented by 91 in FIG. In this embodiment, the
また、図6で説明したように90°分配器1に分配誤差が存在する場合、第1の実施の形態の位相変調器の移相特性は180度周期の位相誤差を持つ。この位相誤差は、制御電圧VCのタイミングを、入力信号VINで180度の位相に相当するタイミングずらした場合に相当する。そこで、制御回路4−1,4−2が発生する擬似余弦波および擬似正弦波の振幅歪みよりも90°分配器1−1,1−2の分配誤差の方が位相変調器の移相特性に大きな影響を与える場合、遅延回路7は、制御電圧VC1とVC2のタイミング差が、入力信号VINで90度の位相に相当する値になるように制御電圧VC2のタイミングをずらせばよい。この場合の位相変調器の動作は図10で説明することができる。
In addition, as described with reference to FIG. 6, when there is a distribution error in the 90 °
90°分配器1−1と四象限乗算器2I−1,2Q−1と合成器3−1と制御回路4−1とからなる第1の位相変調器の移相特性は図10の120で表わされる180度周期の位相誤差を持ち、90°分配器1−2と四象限乗算器2I−2,2Q−2と合成器3−2と制御回路4−2とからなる第2の位相変調器の移相特性は図10の121で表わされる180度周期の位相誤差を持つ。本実施の形態では、遅延回路7を設け、制御電圧VC1とVC2のタイミング差を、入力信号VINで90度の位相に相当する値にすることにより、2つの移相特性が90度に相当するずれを持つことになるので、位相変調器のトータルの移相特性として図10の122で示す直線の移相特性を実現することができる。
The phase shift characteristic of the first phase modulator composed of the 90 ° distributor 1-1, the four-quadrant multipliers 2I-1, 2Q-1, the combiner 3-1, and the control circuit 4-1, is 120 in FIG. A second phase modulation having a phase error of 180 degrees and represented by a 90 ° distributor 1-2, four-quadrant multipliers 2I-2 and 2Q-2, a combiner 3-2 and a control circuit 4-2. The phase shift characteristic of the detector has a phase error of a 180 degree period represented by 121 in FIG. In the present embodiment, the
以上の構成により、本実施の形態では、単一の制御電圧VCにより高周波の位相変調が可能であり、かつ、制御回路4−1,4−2の出力に振幅歪みが存在する場合や、90°分配器1−1,1−2に分配誤差が存在する場合でも、移相特性の線形性の悪化を抑圧することができる。 With the above configuration, in the present embodiment, high-frequency phase modulation is possible with a single control voltage VC, and amplitude distortion exists in the outputs of the control circuits 4-1 and 4-2. Even when there is a distribution error in the distributors 1-1 and 1-2, the deterioration of the linearity of the phase shift characteristic can be suppressed.
[第5の実施の形態]
次に、本発明の第5の実施の形態について説明する。図12(A)、図12(B)は本発明の第5の実施の形態に係る位相変調器の90°分配器の構成を示す回路図である。図12(A)は第1〜第4の実施の形態の90°分配器1,1−1,1−2を1段のポリフェーズフィルタで実現する場合の回路図であり、図12(B)は90°分配器1,1−1,1−2を2段のポリフェーズフィルタで実現する場合の回路図である。
[Fifth Embodiment]
Next, a fifth embodiment of the present invention will be described. 12A and 12B are circuit diagrams showing the configuration of the 90 ° distributor of the phase modulator according to the fifth embodiment of the present invention. FIG. 12A is a circuit diagram in the case where the 90 °
図12(A)に示すポリフェーズフィルタは、一端が入力信号VINの入力端子に接続され、他端が同相信号VINIの出力端子に接続された抵抗300と、一端が入力信号VINの入力端子に接続され、他端が直交信号VINQの出力端子に接続された抵抗301と、一端が入力信号バーVINの入力端子に接続され、他端が同相信号バーVINIの出力端子に接続された抵抗302と、一端が入力信号バーVINの入力端子に接続され、他端が直交信号バーVINQの出力端子に接続された抵抗303と、一端が入力信号VINの入力端子に接続され、他端が直交信号VINQの出力端子に接続された容量304と、一端が入力信号VINの入力端子に接続され、他端が同相信号バーVINIの出力端子に接続された容量305と、一端が入力信号バーVINの入力端子に接続され、他端が直交信号バーVINQの出力端子に接続された容量306と、一端が入力信号バーVINの入力端子に接続され、他端が同相信号VINIの出力端子に接続された容量307とから構成される。
In the polyphase filter shown in FIG. 12A, one end is connected to the input terminal of the input signal VIN, the other end is connected to the output terminal of the in-phase signal VINI, and one end is the input terminal of the input signal VIN. Connected to the output terminal of the quadrature signal VINQ, one end connected to the input terminal of the input signal bar VIN, and the other end connected to the output terminal of the in-phase signal bar VINI. 302, one end connected to the input terminal of the input signal bar VIN, the other end connected to the output terminal of the quadrature signal bar VINQ, one end connected to the input terminal of the input signal VIN, and the other end orthogonal A
図12(B)に示すポリフェーズフィルタは、一端が入力信号VINの入力端子に接続された抵抗308,309と、一端が入力信号バーVINの入力端子に接続された抵抗310,311と、一端が抵抗308の他端に接続され、他端が同相信号VINIの出力端子に接続された抵抗312と、一端が抵抗309の他端に接続され、他端が直交信号VINQの出力端子に接続された抵抗313と、一端が抵抗310の他端に接続され、他端が同相信号バーVINIの出力端子に接続された抵抗314と、一端が抵抗311の他端に接続され、他端が直交信号バーVINQの出力端子に接続された抵抗315と、一端が入力信号VINの入力端子に接続され、他端が抵抗309,313の接続点に接続された容量316と、一端が入力信号VINの入力端子に接続され、他端が抵抗310,314の接続点に接続された容量317と、一端が入力信号バーVINの入力端子に接続され、他端が抵抗311,315の接続点に接続された容量318と、一端が入力信号バーVINの入力端子に接続され、他端が抵抗308,312の接続点に接続された容量319と、一端が抵抗308,312の接続点に接続され、他端が直交信号VINQの出力端子に接続された容量320と、一端が抵抗309,313の接続点に接続され、他端が同相信号バーVINIの出力端子に接続された容量321と、一端が抵抗310,314の接続点に接続され、他端が直交信号バーVINQの出力端子に接続された容量322と、一端が抵抗311,315の接続点に接続され、他端が同相信号VINIの出力端子に接続された容量323とから構成される。
The polyphase filter shown in FIG. 12B has
図12(A)、図12(B)に示したポリフェーズフィルタを第1の実施の形態の90°分配器1に適用してもよいが、第2〜第4の実施の形態の90°分配器1−1,1−2に適用すると、より効果的である。第2〜第4の実施の形態では、位相変調器を縦続接続するので、後段の第2の位相変調器には前段の第1の位相変調器によって位相変調された信号が入力される。したがって、第2の位相変調器の各構成要素は広帯域での動作が担保されている必要がある。
The polyphase filter shown in FIGS. 12A and 12B may be applied to the 90 °
90°分配器1,1−1,1−2は、利用する回路構成により広帯域性に大きく差が生じる。ポリフェーズフィルタは広帯域性に優れた90度分配を実現することができるが、前段の第1の位相変調器の変調度が大きい場合には、1段のポリフェーズフィルタでは必要な帯域をカバーできないケースが生じる。
そこで、図12(A)に示した1段のポリフェーズフィルタでは必要な帯域をカバーできない場合には、図12(B)に示すように90°分配器1−1,1−2として多段のポリフェーズフィルタを使用すればよい。
The 90 °
Therefore, when the necessary band cannot be covered with the single-stage polyphase filter shown in FIG. 12A, as shown in FIG. A polyphase filter may be used.
図13は1段、2段、3段、4段のポリフェーズフィルタの帯域特性を示す図である。横軸は周波数、縦軸は位相である。図13の130は1段のポリフェーズフィルタの帯域特性を示し、131は2段のポリフェーズフィルタの帯域特性を示し、132は3段のポリフェーズフィルタの帯域特性を示し、133は4段のポリフェーズフィルタの帯域特性を示している。図13によれば、ポリフェーズフィルタの段数を増やすことにより、90度分配の広帯域性が良好になることが分かる。 FIG. 13 is a diagram illustrating the band characteristics of the first, second, third, and fourth stage polyphase filters. The horizontal axis is frequency and the vertical axis is phase. In FIG. 13, 130 indicates the band characteristic of the one-stage polyphase filter, 131 indicates the band characteristic of the two-stage polyphase filter, 132 indicates the band characteristic of the three-stage polyphase filter, and 133 indicates the band characteristic of the four-stage polyphase filter. The band characteristic of a polyphase filter is shown. According to FIG. 13, it can be seen that the wideband property of 90-degree distribution is improved by increasing the number of stages of the polyphase filter.
以上の構成により、本実施の形態では、縦続接続による位相変調器であっても、後段の位相変調器の広帯域動作を担保することができるので、位相変調器の変調度を高くすることができる。 With the above configuration, in the present embodiment, even in the case of a phase modulator using cascade connection, the wideband operation of the subsequent phase modulator can be secured, so that the degree of modulation of the phase modulator can be increased. .
本発明は、特に、位相変調を高周波(RF)帯域で行う無線通信、光通信、計測器の分野に適している。 The present invention is particularly suitable for the fields of wireless communication, optical communication, and measuring instruments that perform phase modulation in a radio frequency (RF) band.
1,1−1,1−2…90°分配器、2I,2Q,2I−1,2Q−1,2I−2,2Q−2…四象限乗算器、3,3−1,3−2…合成器、4,4−1,4−2…制御回路、5…相殺回路、6…レベルシフト回路、7…遅延回路、100,101,107〜110,113,114,200,201,207〜210,213,214,6000…トランジスタ、102,111,112,115,202,211,212,215,4021,6004…定電流源、103〜106,116〜119,203〜206,216〜219,300,300,308〜315,4011〜4020,4024,6002,6003…抵抗、304,307,316〜323…容量、400Ib,400Qb…電圧発生器、401I,401Q,402I,402Q…差動増幅器対、440I〜444I,440Q〜444Q…差動増幅器、600…PVT補償回路、4021,6004…定電流源、4022,4023,6001…レベルシフトダイオード。
1, 1-1, 1-2... 90 ° distributor, 2I, 2Q, 2I-1, 2Q-1, 2I-2, 2Q-2, four quadrant multiplier, 3, 3-1, 3-2,. Synthesizer, 4, 4-1, 4-2 ... control circuit, 5 ... cancellation circuit, 6 ... level shift circuit, 7 ... delay circuit, 100, 101, 107 to 110, 113, 114, 200, 201, 207 to 210, 213, 214, 6000 ... transistors, 102, 111, 112, 115, 202, 211, 212, 215, 4021, 6004 ... constant current sources, 103-106, 116-119, 203-206, 216-219, 300, 300, 308 to 315, 4011 to 4020, 4024, 6002, 6003... Resistor, 304, 307, 316 to 323 ... capacity, 400Ib, 400Qb ... voltage generator, 401I,
Claims (6)
複数の参照電圧を発生する電圧発生器と、
外部から入力される制御電圧と前記参照電圧との差信号を制御信号として出力する差動増幅器群とを備え、
振幅調整の対象となる信号として同相信号とこの同相信号に対して位相が90°ずれた直交信号とが存在する場合に、前記差動増幅器群として、前記制御電圧と前記参照電圧とを入力とし同相信号側の第1制御信号を出力する第1の差動増幅器グループと、前記制御電圧と前記参照電圧とを入力とし直交信号側の第2の制御信号を出力する第2の差動増幅器グループとを備え、
前記電圧発生器は、前記複数の参照電圧を前記第1の差動増幅器グループと前記第2の差動増幅器グループに交互に1つずつ入力し、
前記第1の差動増幅器グループと前記第2の差動増幅器グループとは、それぞれ少なくとも1つずつの差動増幅器を備え、
各差動増幅器は、前記制御電圧と前記参照電圧とを入力とする第1の単位差動増幅器と、この第1の単位差動増幅器の出力信号を入力とするエミッタフォロアと、このエミッタフォロアの出力信号を入力とする第2の単位差動増幅器とから構成され、前記制御電圧が前記参照電圧の近傍にあるときに、前記制御電圧を正弦波または余弦波に類似する前記制御信号へ変換するアナログ演算を行うことを特徴とする制御回路。 A control circuit for outputting a control signal to a means for adjusting a signal amplitude,
A voltage generator for generating a plurality of reference voltages;
A differential amplifier group that outputs, as a control signal, a difference signal between a control voltage input from the outside and the reference voltage;
When there is an in-phase signal and a quadrature signal whose phase is shifted by 90 ° with respect to the in-phase signal as a signal to be subjected to amplitude adjustment, the control voltage and the reference voltage are set as the differential amplifier group. A first differential amplifier group that outputs a first control signal on the in-phase signal side as an input, and a second difference that outputs the second control signal on the quadrature signal side as an input using the control voltage and the reference voltage A dynamic amplifier group,
The voltage generator inputs the plurality of reference voltages alternately one by one to the first differential amplifier group and the second differential amplifier group,
Each of the first differential amplifier group and the second differential amplifier group includes at least one differential amplifier,
Each differential amplifier includes a first unit differential amplifier that receives the control voltage and the reference voltage, an emitter follower that receives an output signal of the first unit differential amplifier, A second unit differential amplifier that receives an output signal, and converts the control voltage into the control signal similar to a sine wave or cosine wave when the control voltage is in the vicinity of the reference voltage. A control circuit characterized by performing an analog operation.
前記電圧発生器は、N(Nは2以上の整数)個の前記参照電圧を生成し、
前記第1の差動増幅器グループに含まれる差動増幅器の個数と前記第2の差動増幅器グループに含まれる差動増幅器の個数との総和は、Nであることを特徴とする制御回路。 The control circuit according to claim 1,
The voltage generator generates N (N is an integer of 2 or more) pieces of the reference voltages,
The control circuit according to claim 1, wherein the sum of the number of differential amplifiers included in the first differential amplifier group and the number of differential amplifiers included in the second differential amplifier group is N.
前記第1の差動増幅器グループに含まれる隣接する2つの差動増幅器の出力は逆相で接続され、
前記第2の差動増幅器グループに含まれる隣接する2つの差動増幅器の出力は逆相で接続されることを特徴とする制御回路。 The control circuit according to claim 1 or 2,
The outputs of two adjacent differential amplifiers included in the first differential amplifier group are connected in reverse phase,
The control circuit, wherein outputs of two adjacent differential amplifiers included in the second differential amplifier group are connected in opposite phases.
前記参照電圧Vmと1つおきの前記参照電圧Vnとは、前記第1の差動増幅器グループに含まれる隣接する2つの差動増幅器または前記第2の差動増幅器グループに含まれる隣接する2つの差動増幅器に入力されることを特徴とする制御回路。 The control circuit according to any one of claims 1 to 3,
The reference voltage Vm and every other reference voltage Vn are two adjacent differential amplifiers included in the first differential amplifier group or two adjacent differential amplifiers included in the second differential amplifier group. A control circuit which is inputted to a differential amplifier.
同相信号側の第1の制御信号に応じて前記同相信号の振幅を変化させて出力する第1の四象限乗算器と、
直交信号側の第2の制御信号に応じて前記直交信号の振幅を変化させて出力する第2の四象限乗算器と、
前記第1、第2の四象限乗算器から出力される同相信号と直交信号とを合成して出力する合成器と、
請求項1乃至4のいずれか1項に記載の制御回路とを備えることを特徴とする位相変調器。 A 90 ° distributor that generates an in-phase signal from the input signal and a quadrature signal that is 90 ° out of phase with the in-phase signal;
A first four-quadrant multiplier that changes and outputs the amplitude of the in-phase signal in accordance with a first control signal on the in-phase signal side;
A second four-quadrant multiplier for changing and outputting the amplitude of the orthogonal signal in accordance with a second control signal on the orthogonal signal side;
A combiner that combines and outputs the in-phase signal and the quadrature signal output from the first and second four-quadrant multipliers;
A phase modulator comprising: the control circuit according to claim 1.
前記90°分配器は、多段のポリフェーズフィルタで構成されることを特徴とする位相変調器。 The phase modulator according to claim 5.
The 90 ° distributor is composed of a multi-stage polyphase filter.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011265635A JP2013118555A (en) | 2011-12-05 | 2011-12-05 | Control circuit and phase modulator |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011265635A JP2013118555A (en) | 2011-12-05 | 2011-12-05 | Control circuit and phase modulator |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2013118555A true JP2013118555A (en) | 2013-06-13 |
Family
ID=48712814
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2011265635A Pending JP2013118555A (en) | 2011-12-05 | 2011-12-05 | Control circuit and phase modulator |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2013118555A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2024013883A1 (en) * | 2022-07-13 | 2024-01-18 | 日本電信電話株式会社 | Phase adjustment circuit |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0447704A (en) * | 1990-06-14 | 1992-02-17 | Nec Corp | Emitter follower circuit |
WO2002017485A1 (en) * | 2000-08-21 | 2002-02-28 | Mitsubishi Denki Kabushiki Kaisha | π/2 PHASE SHIFTER |
JP2003008399A (en) * | 2001-04-20 | 2003-01-10 | Nec Microsystems Ltd | Phase shifter |
JP2003229738A (en) * | 2002-01-31 | 2003-08-15 | Mitsubishi Electric Corp | Analog phase shifter |
JP2008010991A (en) * | 2006-06-27 | 2008-01-17 | Nippon Telegr & Teleph Corp <Ntt> | Amplifier for receiving light and light receiver using the same |
WO2010021280A1 (en) * | 2008-08-18 | 2010-02-25 | 日本電信電話株式会社 | Vector synthesis type phase shifter, optical transceiver, and control circuit |
JP2010232767A (en) * | 2009-03-26 | 2010-10-14 | Nippon Telegr & Teleph Corp <Ntt> | Differential driving circuit |
-
2011
- 2011-12-05 JP JP2011265635A patent/JP2013118555A/en active Pending
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0447704A (en) * | 1990-06-14 | 1992-02-17 | Nec Corp | Emitter follower circuit |
WO2002017485A1 (en) * | 2000-08-21 | 2002-02-28 | Mitsubishi Denki Kabushiki Kaisha | π/2 PHASE SHIFTER |
JP2003008399A (en) * | 2001-04-20 | 2003-01-10 | Nec Microsystems Ltd | Phase shifter |
JP2003229738A (en) * | 2002-01-31 | 2003-08-15 | Mitsubishi Electric Corp | Analog phase shifter |
JP2008010991A (en) * | 2006-06-27 | 2008-01-17 | Nippon Telegr & Teleph Corp <Ntt> | Amplifier for receiving light and light receiver using the same |
WO2010021280A1 (en) * | 2008-08-18 | 2010-02-25 | 日本電信電話株式会社 | Vector synthesis type phase shifter, optical transceiver, and control circuit |
JP2010232767A (en) * | 2009-03-26 | 2010-10-14 | Nippon Telegr & Teleph Corp <Ntt> | Differential driving circuit |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2024013883A1 (en) * | 2022-07-13 | 2024-01-18 | 日本電信電話株式会社 | Phase adjustment circuit |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US8687968B2 (en) | Vector sum phase shifter, optical transceiver, and control circuit | |
WO2010067644A1 (en) | Voltage generator, control circuit, vector synthesis type phase shifter and optical transceiver | |
JP5859444B2 (en) | Digital affine transformation modulation power amplifier for wireless communication | |
US8660508B2 (en) | Calibration of passive harmonic-rejection mixer | |
US7450913B2 (en) | Circuit arrangement for a wideband mixer with predistortion and high linearity | |
EP2201677A2 (en) | Gilbert cell mixer with linear transconductor stage | |
JP2008236135A (en) | Frequency converter | |
EP2999116A1 (en) | Direct digital radio frequency modulator | |
US20060252396A1 (en) | Phase generator using polyphase architecture | |
JP2013118555A (en) | Control circuit and phase modulator | |
JP2012049882A (en) | Iq signal generating circuit | |
JP2013118554A (en) | Phase modulator | |
US20070075805A1 (en) | Phase shift circuit and phase correcting method | |
JP6445286B2 (en) | Phase detector, phase adjustment circuit, receiver and transmitter | |
JP5144474B2 (en) | Adder and power combiner, quadrature modulator, quadrature demodulator, power amplifier, transmitter, and wireless communication device using the same | |
US6665353B1 (en) | Quadrant switching method for phase shifter | |
JP5971102B2 (en) | Clock phase adjusting circuit and receiving circuit | |
US10476717B1 (en) | Digital-controlled vector signal modulator | |
US11128258B2 (en) | Mixer circuitry | |
WO2024018888A1 (en) | Signal generation circuit | |
Shi et al. | A novel design using translinear circuit for linear LINC transmitters | |
EP3687064A1 (en) | Digital-controlled vector signal modulator | |
JP2020120302A (en) | Digitally controlled vector signal modulator | |
JP2019016978A (en) | Phase modulator | |
JP2019087786A (en) | Impulse generation circuit and radio communication device |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20140124 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20141017 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20141111 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20150317 |