JP2012195873A - 信号処理回路と画像読取装置および画像形成装置 - Google Patents
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Abstract
【課題】 高速駆動を行った際にも真の出力信号を得られるようにする。
【解決手段】 差動増幅回路9が、サンプルホールド回路5によって検出された信号成分とサンプルホールド回路7によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する場合、サンプルホールド回路7での信号検出速度を、フィルタ回路10がサンプルホールド回路5での信号検出速度よりも遅くすることにより、複数のノイズ要因が合成された合成ノイズが重畳された出力信号自身から、高速化に伴った画素レベルの暴れをフィルタリングにより除去し、画像に現れるスジ状ノイズの原因となる比較的周期の遅いノイズのみを検出する。
【選択図】 図2
【解決手段】 差動増幅回路9が、サンプルホールド回路5によって検出された信号成分とサンプルホールド回路7によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する場合、サンプルホールド回路7での信号検出速度を、フィルタ回路10がサンプルホールド回路5での信号検出速度よりも遅くすることにより、複数のノイズ要因が合成された合成ノイズが重畳された出力信号自身から、高速化に伴った画素レベルの暴れをフィルタリングにより除去し、画像に現れるスジ状ノイズの原因となる比較的周期の遅いノイズのみを検出する。
【選択図】 図2
Description
この発明は、信号処理回路、それを備えたスキャナ等の画像読取装置(デジタル複写機やデジタル複合機,ファクシミリ装置等の画像形成装置に搭載された画像読取部あるいは単体の画像読取装置)、およびその画像読取装置を搭載した画像形成装置に関する。
例えば、スキャナは、原稿の画像面(以下単に「原稿」ともいう)からの反射光を取得し、それをセンサ制御基板内に配置されているCCD(Charge Coupled Device)イメージセンサ(以下単に「CCD」と略称する)で光電変換して電気信号(画像信号)に変えることで原稿の画像を読み取るようにしている。
このようなスキャナにおいて、近年、画像信号に重畳するノイズを補正する回路の提案が盛んに行われており、代表的なものとして、SSCG(スペクトラム拡散クロックジェネレータ)補正回路等がある。
このようなスキャナにおいて、近年、画像信号に重畳するノイズを補正する回路の提案が盛んに行われており、代表的なものとして、SSCG(スペクトラム拡散クロックジェネレータ)補正回路等がある。
SSCG起因によるノイズは、駆動クロックの拡散を行うことで出力信号の基準レベルとなるオフセットレベルが変動し、画像にはスジとして現れてしまうことが問題である。
提案されている対策回路(補正回路)としては、SSCG変調の掛かった信号を取り出し、その信号の変動分を増幅させ、同信号の重畳している出力信号との差分を取ることで、出力信号に重畳するSSCG起因のノイズの補正を行うものが既に知られている。
提案されている対策回路(補正回路)としては、SSCG変調の掛かった信号を取り出し、その信号の変動分を増幅させ、同信号の重畳している出力信号との差分を取ることで、出力信号に重畳するSSCG起因のノイズの補正を行うものが既に知られている。
また、ノイズ検出のために、CDS(相関2重サンプリング)回路を備え、光に反応しない非信号領域の信号をサンプリングすることで変動ノイズを検出し、その検出したノイズと信号出力との差分を取ることによってノイズを低減した信号出力(画像信号)を得るという提案も既に知られている。例えば、特許文献1には、SSCGの変動による影響でオフセット変動が生じる問題があり、それを解決する目的で、CDS回路を用いて信号領域と非信号領域の各信号を各々サンプルホールド(以下「S/H」ともいう)し、それら信号の差分を求める差動増幅器によりオフセット変動低減を行う提案が開示されている。
ここで、光に反応しない非信号領域の信号とは、CCDからの1画素毎の出力信号のうち、光入射に反応しない期間(非信号領域)内の信号のことである。また、光に反応する信号領域の信号とは、CCDからの1画素毎の出力信号のうち、光入射に反応する期間(信号領域)内の信号のことである。
しかしながら、上述したような従来の補正回路では、1つのノイズ要因に対する対策でしかなかった。
すなわち、ノイズ要因となる複数の信号によるノイズ対策を実施する場合には、複数の対策回路を構成する必要があり、回路規模が膨大になってしまうという問題があった。
また、CDS回路を使用し、単純にセンサ出力の光に反応する信号領域および光に反応しない非信号領域の各信号をS/Hしてオフセット変動を起こすノイズ検出を行うやり方では、高速駆動を行った場合、画素レベルでの暴れが顕著であるため、非信号領域は全く安定した領域がなく、S/Hして得られたレベルが本来検出したいノイズなのか画素毎の暴れなのか分からず、またその信号を使用して補正すると、逆にノイズを増やしてしまうという逆効果の問題があった。
すなわち、ノイズ要因となる複数の信号によるノイズ対策を実施する場合には、複数の対策回路を構成する必要があり、回路規模が膨大になってしまうという問題があった。
また、CDS回路を使用し、単純にセンサ出力の光に反応する信号領域および光に反応しない非信号領域の各信号をS/Hしてオフセット変動を起こすノイズ検出を行うやり方では、高速駆動を行った場合、画素レベルでの暴れが顕著であるため、非信号領域は全く安定した領域がなく、S/Hして得られたレベルが本来検出したいノイズなのか画素毎の暴れなのか分からず、またその信号を使用して補正すると、逆にノイズを増やしてしまうという逆効果の問題があった。
この発明は、上記の点に鑑みてなされたものであり、高速駆動を行った際にも安定して出力信号に重畳したノイズを検出し、その検出したノイズで補正を行うことにより真の出力信号を得られるようにして、高画質の画像を提供できるようにすることを目的とする。
この発明は、上記の目的を達成するため、以下の(1)〜(10)に示す信号処理回路、画像読取装置、および画像形成装置を提供する。
(1)信号出力手段からの出力信号に対して信号成分を検出する信号検出手段と、上記信号成分の基準となる基準成分を検出する基準検出手段と、上記信号検出手段によって検出された信号成分と上記基準検出手段によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する差分出力手段とを有する信号処理回路であって、上記基準検出手段での信号検出速度を上記信号検出手段での信号検出速度よりも遅くする速度遅延手段を設けたものである。
(1)信号出力手段からの出力信号に対して信号成分を検出する信号検出手段と、上記信号成分の基準となる基準成分を検出する基準検出手段と、上記信号検出手段によって検出された信号成分と上記基準検出手段によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する差分出力手段とを有する信号処理回路であって、上記基準検出手段での信号検出速度を上記信号検出手段での信号検出速度よりも遅くする速度遅延手段を設けたものである。
(2)(1)の信号処理回路において、上記信号出力手段を、光電変換を行うイメージセンサとし、上記信号成分を、上記イメージセンサからの出力信号のうちの光に反応する信号成分とし、上記基準成分を、上記イメージセンサからの出力信号のうちの光に反応しない信号成分とし、上記信号検出手段および上記基準検出手段を、いずれもサンプルホールド回路とし、上記差分出力手段を、差動増幅回路とし、上記速度遅延手段を、フィルタとしたものである。
(3)(1)の信号処理回路において、上記基準検出手段に上記速度遅延手段を備えたものである。
(4)(3)の信号処理回路において、上記信号出力手段を、光電変換を行うイメージセンサとし、上記信号成分を、上記イメージセンサからの出力信号のうちの光に反応する信号成分とし、上記基準成分を、上記イメージセンサからの出力信号のうちの光に反応しない信号成分とし、上記信号検出手段を、サンプルホールド回路とし、上記速度遅延手段をフィルタとし、上記基準検出手段を、サンプルホールド回路と上記フィルタとによって構成し、上記差分出力手段を、差動増幅回路としたものである。
(4)(3)の信号処理回路において、上記信号出力手段を、光電変換を行うイメージセンサとし、上記信号成分を、上記イメージセンサからの出力信号のうちの光に反応する信号成分とし、上記基準成分を、上記イメージセンサからの出力信号のうちの光に反応しない信号成分とし、上記信号検出手段を、サンプルホールド回路とし、上記速度遅延手段をフィルタとし、上記基準検出手段を、サンプルホールド回路と上記フィルタとによって構成し、上記差分出力手段を、差動増幅回路としたものである。
(5)(1)〜(4)のいずれかの信号処理回路において、上記基準検出手段が、上記信号出力手段からの出力信号のうち、リセットノイズを含む光に反応しない信号部分から上記基準成分の検出を行うものである。
(6)(1)〜(5)のいずれかの信号処理回路において、上記信号出力手段の後段に、その信号出力手段(イメージセンサ)からの出力信号を受ける信号バッファ手段を設けたものである。
(7)(1)〜(5)のいずれかの信号処理回路において、上記信号検出手段および上記基準信号検出手段を、同一の半導体チップ上に形成したものである。
(8)(6)の信号処理回路において、上記信号検出手段、上記基準検出手段、および上記信号バッファ手段を、同一の半導体チップ上に形成したものである。
(9)(1)〜(8)のいずれかの信号処理回路を備えた画像読取装置である。
(10)(9)の画像読取装置を備え、その画像読取装置によって読み取られた画像データに基づいて画像形成処理を行う画像形成装置である。
(6)(1)〜(5)のいずれかの信号処理回路において、上記信号出力手段の後段に、その信号出力手段(イメージセンサ)からの出力信号を受ける信号バッファ手段を設けたものである。
(7)(1)〜(5)のいずれかの信号処理回路において、上記信号検出手段および上記基準信号検出手段を、同一の半導体チップ上に形成したものである。
(8)(6)の信号処理回路において、上記信号検出手段、上記基準検出手段、および上記信号バッファ手段を、同一の半導体チップ上に形成したものである。
(9)(1)〜(8)のいずれかの信号処理回路を備えた画像読取装置である。
(10)(9)の画像読取装置を備え、その画像読取装置によって読み取られた画像データに基づいて画像形成処理を行う画像形成装置である。
この発明の信号処理回路によれば、差分出力手段が、信号検出手段によって検出された信号成分と基準検出手段によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する場合、基準検出手段での信号検出速度を信号検出手段での信号検出速度よりも遅くすることにより、高速駆動(高速動作)させた場合においても真の有効信号成分を得ることができる。
以下、この発明を実施するための形態を図面に基づいて具体的に説明する。
以下の実施形態は、CCD等のイメージセンサからの出力信号に重畳しているノイズ成分のうち、比較的周期が遅く画像にスジとして影響を与える変動ノイズ分のみを、出力信号自身から検出するノイズ検出部を備えたことを特徴とする。
以下の実施形態は、CCD等のイメージセンサからの出力信号に重畳しているノイズ成分のうち、比較的周期が遅く画像にスジとして影響を与える変動ノイズ分のみを、出力信号自身から検出するノイズ検出部を備えたことを特徴とする。
すなわち、ノイズ源となる信号1つ1つからノイズ検出を行うのではなく、既に出力信号に重畳した複数のノイズ要因が合成された後の合成ノイズを検出するノイズ検出部を備えている。
ノイズ検出部は、合成ノイズが重畳された出力信号を取り出し、非画像領域をサンプリングした後に得られた信号に重畳している高周波ノイズを除去するフィルタリングによって比較的周期の遅いノイズのみを検出できることが特徴になっている。
ノイズ検出部は、合成ノイズが重畳された出力信号を取り出し、非画像領域をサンプリングした後に得られた信号に重畳している高周波ノイズを除去するフィルタリングによって比較的周期の遅いノイズのみを検出できることが特徴になっている。
そこで、その特徴について詳細に説明するが、その説明に入る前に、理解の便宜のため、従来のスキャナに搭載されているCDS回路を使用したノイズ補正撮像装置と、その問題点について、図9〜図11を参照して説明する。
図9は、従来のCDS回路を使用したノイズ補正撮像装置の構成例を示す回路図である。
図9は、従来のCDS回路を使用したノイズ補正撮像装置の構成例を示す回路図である。
図9に示すノイズ補正撮像装置を備えたスキャナは、原稿からの反射光を取得し、それをノイズ補正撮像装置内に配置されているCCD1で光電変換して電気信号(アナログ画像信号)に変えることで原稿の画像を読み取る。
ノイズ補正撮像装置は、CDS回路を用いて出力信号のノイズ補正を行うノイズ補正回路を構成するものであり、CCD1と、タイミングジェネレータ(以下「TG」と略称する)2と、アナログ遅延器3(DL1),アナログ遅延器4(DL2)と、サンプルホールド回路5(S/H_sig1),サンプルホールド回路6(S/H_sig2)と、サンプルホールド回路7(S/H_no)を有するノイズ抽出部8と、差動増幅回路(差動出力回路)9とを備えている。
ノイズ補正撮像装置は、CDS回路を用いて出力信号のノイズ補正を行うノイズ補正回路を構成するものであり、CCD1と、タイミングジェネレータ(以下「TG」と略称する)2と、アナログ遅延器3(DL1),アナログ遅延器4(DL2)と、サンプルホールド回路5(S/H_sig1),サンプルホールド回路6(S/H_sig2)と、サンプルホールド回路7(S/H_no)を有するノイズ抽出部8と、差動増幅回路(差動出力回路)9とを備えている。
CCD1は、TG2からの駆動信号(駆動クロック)に応じて駆動し、原稿からの反射光を光電変換してアナログ画像信号(Vsig)を出力する。
TG2は、CCD1の駆動に必要な駆動信号やタイミング信号(トリガ信号)を発生し、CCD1やアナログ遅延器3,4へ供給する。
アナログ遅延器3は、TG2からのタイミング信号を遅延させ、サンプルホールド信号SH1として出力する。
アナログ遅延器4は、TG2からのタイミング信号を遅延させ、サンプルホールド信号SH2として出力する。なお、アナログ遅延器3,4によるタイミング信号の遅延時間は異なる。
TG2は、CCD1の駆動に必要な駆動信号やタイミング信号(トリガ信号)を発生し、CCD1やアナログ遅延器3,4へ供給する。
アナログ遅延器3は、TG2からのタイミング信号を遅延させ、サンプルホールド信号SH1として出力する。
アナログ遅延器4は、TG2からのタイミング信号を遅延させ、サンプルホールド信号SH2として出力する。なお、アナログ遅延器3,4によるタイミング信号の遅延時間は異なる。
サンプルホールド回路5は、CCD1からのアナログ画像信号(以下単に「画像信号」又は「出力信号」ともいう)Vsigを、光に反応する信号成分つまり信号領域の信号を取得できるように、アナログ遅延器3からのサンプルホールド信号SH1の立ち上がりタイミングでS/H(サンプルホールド)し、信号領域の信号V_s/h_sig1として出力する。
サンプルホールド回路6は、サンプルホールド回路5からの出力信号V_s/h_sig1を、リセットノイズを含む光に反応しない信号成分つまり非信号領域(従来技術ではフィードスルーレベル)の信号を基準レベルの信号(基準成分)として取得できるように、アナログ遅延器4からのサンプルホールド信号SH2の立ち上がりタイミングでS/Hし、基準レベル(非信号領域)の信号V_s/h_sig2として出力する。
サンプルホールド回路6は、サンプルホールド回路5からの出力信号V_s/h_sig1を、リセットノイズを含む光に反応しない信号成分つまり非信号領域(従来技術ではフィードスルーレベル)の信号を基準レベルの信号(基準成分)として取得できるように、アナログ遅延器4からのサンプルホールド信号SH2の立ち上がりタイミングでS/Hし、基準レベル(非信号領域)の信号V_s/h_sig2として出力する。
ノイズ抽出部8は、サンプルホールド回路7を用いてノイズの抽出を行うものである。 サンプルホールド回路7は、CCD1からの出力信号Vsigを、光に反応しない非信号領域の信号を取得できるように、サンプルホールド回路6と同タイミングであるアナログ遅延器4からのサンプルホールド信号SH2の立ち上がりタイミングでS/Hし、非信号領域の信号V_s/h_noとして出力する。
サンプルホールド回路6からの出力信号V_s/h_sig2およびサンプルホールド回路7からの出力信号V_s/h_noは、後段の差動増幅回路9に入力される。
差動増幅回路9は、サンプルホールド回路6からの出力信号V_s/h_sig2とサンプルホールド回路7からの出力信号V_s/h_noとの差分を出力することで、出力信号Vsigに重畳するノイズを除去した出力信号(Vsig_out)を得る。
サンプルホールド回路6からの出力信号V_s/h_sig2およびサンプルホールド回路7からの出力信号V_s/h_noは、後段の差動増幅回路9に入力される。
差動増幅回路9は、サンプルホールド回路6からの出力信号V_s/h_sig2とサンプルホールド回路7からの出力信号V_s/h_noとの差分を出力することで、出力信号Vsigに重畳するノイズを除去した出力信号(Vsig_out)を得る。
なお、TG2には、SSCG(スペクトラム拡散クロックジェネレータ)が接続され、更にそのSSCGを介して図示しない水晶発振器が接続されている。
水晶発振器の出力信号は周波数固定で一定周期の基準クロック信号であり、SSCGを介して出力されるクロック信号は、基準クロック信号の周波数を所定の周期で偏移させた変調クロック信号である。この変調クロック信号は、TG2のクロック信号として使用される。
TG2は、同期回路によって構成されており、上記変調クロック信号を分周(又は逓倍)した信号に対して同期をとりながら、CCD1の各種駆動信号やサンプルホールド信号の元になるトリガ信号を生成して出力する。
水晶発振器の出力信号は周波数固定で一定周期の基準クロック信号であり、SSCGを介して出力されるクロック信号は、基準クロック信号の周波数を所定の周期で偏移させた変調クロック信号である。この変調クロック信号は、TG2のクロック信号として使用される。
TG2は、同期回路によって構成されており、上記変調クロック信号を分周(又は逓倍)した信号に対して同期をとりながら、CCD1の各種駆動信号やサンプルホールド信号の元になるトリガ信号を生成して出力する。
図10は、図9に示したノイズ補正撮像装置の通常動作時の出力信号の一例を示す波形図である。
図10に示す信号波形は、画素単位の出力信号Vsigに対して各サンプルホールド回路5,6,7でS/Hを行った様子を示している。
ここで、図示しないSSCGや電源のスイッチング周波数の影響を受けてオフセットレベルが変化している。
図10に示す信号波形は、画素単位の出力信号Vsigに対して各サンプルホールド回路5,6,7でS/Hを行った様子を示している。
ここで、図示しないSSCGや電源のスイッチング周波数の影響を受けてオフセットレベルが変化している。
1ライン周期の長いレンジで見ると、上記周期に同期して緩やかな変動をしている。
CCD1からの出力信号Vsigを信号領域の信号の取得タイミングでS/Hしたサンプルホールド回路5からの出力信号(信号領域の信号)V_s/h_sig1、およびその出力信号V_s/h_sig1を非信号領域の信号の取得タイミングでS/Hしたサンプルホールド回路6からの出力信号(非信号領域の信号)V_s/h_sig2は、オフセット変動を起こしており、同様に基準信号となる出力信号Vsigを非信号領域の信号の取得タイミングでS/Hしたサンプルホールド回路7からの出力信号V_s/h_noもオフセット変動していることから、出力信号V_s/h_sig2と出力信号V_s/h_noとの差分をとることによって、オフセット変動が取り除かれた真の出力信号Vsig_outを得ることができる。
よって、図9に示した信号処理回路は、出力信号Vsigが理想的な波形であれば、単純に信号成分(光に反応する信号領域の信号)と基準信号成分(光に反応しない非信号領域の信号)との差分を取ることでノイズ補正を行い、Vsig_outのような真の出力信号が得られるものである。
CCD1からの出力信号Vsigを信号領域の信号の取得タイミングでS/Hしたサンプルホールド回路5からの出力信号(信号領域の信号)V_s/h_sig1、およびその出力信号V_s/h_sig1を非信号領域の信号の取得タイミングでS/Hしたサンプルホールド回路6からの出力信号(非信号領域の信号)V_s/h_sig2は、オフセット変動を起こしており、同様に基準信号となる出力信号Vsigを非信号領域の信号の取得タイミングでS/Hしたサンプルホールド回路7からの出力信号V_s/h_noもオフセット変動していることから、出力信号V_s/h_sig2と出力信号V_s/h_noとの差分をとることによって、オフセット変動が取り除かれた真の出力信号Vsig_outを得ることができる。
よって、図9に示した信号処理回路は、出力信号Vsigが理想的な波形であれば、単純に信号成分(光に反応する信号領域の信号)と基準信号成分(光に反応しない非信号領域の信号)との差分を取ることでノイズ補正を行い、Vsig_outのような真の出力信号が得られるものである。
図9,図10を用いて従来技術によるノイズ補正の動作について説明したが、次に図11を用いて従来技術の問題点について具体的に説明する。
確かに、出力信号Vsigの波形が図10に示したような理想的な形状であれば、従来技術でもノイズを補正し、真の出力信号を得ることはできる。
しかし、近年、機器の高速化に伴い、駆動周波数が高くなり、短くなる1画素期間中に確保しなければならない各種駆動クロック間のタイミング制約が厳しい上に、デバイスの遅延時間は固定であるため、高速化を実現する上で各種タイミング規定を満足することが困難になってくる。それに伴い、早い周波数で駆動させると、出力信号は、画素毎の暴れやオーバーシュート(OS)、アンダーシュート(US)、うねりの重畳された信号となってしまう。
確かに、出力信号Vsigの波形が図10に示したような理想的な形状であれば、従来技術でもノイズを補正し、真の出力信号を得ることはできる。
しかし、近年、機器の高速化に伴い、駆動周波数が高くなり、短くなる1画素期間中に確保しなければならない各種駆動クロック間のタイミング制約が厳しい上に、デバイスの遅延時間は固定であるため、高速化を実現する上で各種タイミング規定を満足することが困難になってくる。それに伴い、早い周波数で駆動させると、出力信号は、画素毎の暴れやオーバーシュート(OS)、アンダーシュート(US)、うねりの重畳された信号となってしまう。
図11は、図9に示したノイズ補正撮像装置の高速駆動時の出力信号の一例を示す波形図である。
この図11は、出力信号Vsigの理想的な波形(破線で図示)に実波形のイメージ波形(太い実線で図示)を重ね合わせたものを示している。
出力信号Vsigには、高周波ノイズが重畳し、かつオフセットレベルが変動し、実際には図示している以上に波形の形状は崩れる。
この図11は、出力信号Vsigの理想的な波形(破線で図示)に実波形のイメージ波形(太い実線で図示)を重ね合わせたものを示している。
出力信号Vsigには、高周波ノイズが重畳し、かつオフセットレベルが変動し、実際には図示している以上に波形の形状は崩れる。
そのため、サンプルホールド信号SH2の立ち上がりタイミングに従って単純に光に反応しない非信号領域の信号をS/Hしただけでは、画素毎の暴れ/OS/US/うねりを含んでS/Hしているため、忠実に波形の基準レベルを検出することは困難である。
したがって、V_s/h_sig2とV_s/h_noとで差分を取った場合には、Vsig_outに画素の暴れが残ってしまい、真の出力信号は得られない。
したがって、V_s/h_sig2とV_s/h_noとで差分を取った場合には、Vsig_outに画素の暴れが残ってしまい、真の出力信号は得られない。
そこで、上述した問題を解消するため、この発明の実施形態を以下に示す。
図1は、この発明による信号処理回路の基本構成例を示すブロック図である。
この信号処理回路は、図1に示すように、信号出力部21、信号検出部22、基準検出部23、および差分出力部24を備えている。
信号出力部21は、各種信号を生成して出力する信号出力手段である。
信号検出部22は、信号出力部21からの出力信号の信号成分を検出する信号検出手段である。
図1は、この発明による信号処理回路の基本構成例を示すブロック図である。
この信号処理回路は、図1に示すように、信号出力部21、信号検出部22、基準検出部23、および差分出力部24を備えている。
信号出力部21は、各種信号を生成して出力する信号出力手段である。
信号検出部22は、信号出力部21からの出力信号の信号成分を検出する信号検出手段である。
基準検出部23は、上記信号成分の基準となる基準成分を検出する基準検出手段である。
差分出力部24は、信号検出部22によって検出された信号成分と基準検出部23によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する差分出力手段である。この差分出力部24は、基準検出部23での信号検出速度を信号検出部22での信号検出速度よりも遅くする速度遅延手段としての機能を有する。なお、速度遅延手段としての機能を果す回路(速度遅延回路)を単独で備えてもよい。
差分出力部24は、信号検出部22によって検出された信号成分と基準検出部23によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する差分出力手段である。この差分出力部24は、基準検出部23での信号検出速度を信号検出部22での信号検出速度よりも遅くする速度遅延手段としての機能を有する。なお、速度遅延手段としての機能を果す回路(速度遅延回路)を単独で備えてもよい。
図2は、この発明による信号処理回路の具体的構成例を示す回路図であり、図9と対応する部分には同一符号を付して、それらの説明を省略する。
この信号処理回路は、実際の回路を組み込んだノイズ補正回路であり、CCD1と、TG2と、サンプルホールド回路5(S/H_sig)と、サンプルホールド回路7(S/H_no)と、差動増幅回路9と、フィルタ回路10とを備えている。
この信号処理回路は、実際の回路を組み込んだノイズ補正回路であり、CCD1と、TG2と、サンプルホールド回路5(S/H_sig)と、サンプルホールド回路7(S/H_no)と、差動増幅回路9と、フィルタ回路10とを備えている。
CCD1は、図1の信号出力部21に相当するものであり、TG2からの駆動信号に応じて駆動し、原稿からの反射光を光電変換してアナログ画像信号(Vsig)を出力する。
TG2は、CCD1の駆動に必要な駆動信号をCCD1へ供給したり、サンプルホールド回路5が光に反応する有効な入力信号部分(信号領域)の信号をS/Hできるように、タイミング信号T_s/h_sigを発生し、サンプルホールド回路5へ供給したり、サンプルホールド回路7が光に反応しない非信号領域の信号をS/Hできるように、タイミング信号T_s/h_noを発生し、サンプルホールド回路7へ供給する。
TG2は、CCD1の駆動に必要な駆動信号をCCD1へ供給したり、サンプルホールド回路5が光に反応する有効な入力信号部分(信号領域)の信号をS/Hできるように、タイミング信号T_s/h_sigを発生し、サンプルホールド回路5へ供給したり、サンプルホールド回路7が光に反応しない非信号領域の信号をS/Hできるように、タイミング信号T_s/h_noを発生し、サンプルホールド回路7へ供給する。
サンプルホールド回路5(S/H_sig)は、図1の信号検出部22に相当するものであり、CCD1からの出力信号(画像信号)Vsigを、光に反応する信号領域の信号を取得できるように、タイミング信号T_s/h_sigの立ち上がりタイミングでS/Hし、信号領域の信号V_s/h_sigとして出力する。
サンプルホールド回路7(S/H_no)は、フィルタ回路10と共に、図1の基準検出部23としての機能を果すものであり、CCD1からの出力信号Vsigを、光に反応しない非信号領域の信号を基準レベルの信号として取得できるように、タイミング信号T_s/h_noの立ち上がりタイミングでS/Hし、基準レベル(非信号領域)の信号V_s/h_noとして出力する。
サンプルホールド回路7(S/H_no)は、フィルタ回路10と共に、図1の基準検出部23としての機能を果すものであり、CCD1からの出力信号Vsigを、光に反応しない非信号領域の信号を基準レベルの信号として取得できるように、タイミング信号T_s/h_noの立ち上がりタイミングでS/Hし、基準レベル(非信号領域)の信号V_s/h_noとして出力する。
フィルタ回路10は、サンプルホールド回路7からの基準レベルの信号V_s/h_noに対してフィルタリングを行って応答を遅らせ、V_s/h_filとして出力する。
差動増幅回路9は、図1の差分出力部24に相当するものであり、サンプルホールド回路5からの出力信号V_s/h_sigとフィルタ回路10からの出力信号V_s/h_filとの差分を出力することで、出力信号Vsigに重畳する非信号成分を取り除いた真の出力信号Vsig_outを得ることができる。
差動増幅回路9は、図1の差分出力部24に相当するものであり、サンプルホールド回路5からの出力信号V_s/h_sigとフィルタ回路10からの出力信号V_s/h_filとの差分を出力することで、出力信号Vsigに重畳する非信号成分を取り除いた真の出力信号Vsig_outを得ることができる。
サンプルホールド回路7の後段にフィルタ回路10を備え、出力信号V_s/h_sigに対してフィルタ回路10を利用し、応答を遅らせている理由は、高速駆動をさせた際に増加する画素オーダーの高周波ノイズ成分を除去し、オフセット変動の要因となる比較的周期の遅い緩やかな信号を取り出すためである。
なお、フィルタ回路10の追加以外の他の手段で同様の効果を実現する手段としては、サンプルホールド回路7の基本的な構成が、S/Hを行うタイミングでオン(ON)にするスイッチと、基準レベルの信号を保持するために電荷蓄積を行うコンデンサによる構成であるとすれば、スイッチON抵抗を大きくする、またはコンデンサの容量を大きくすることで入力信号に対してS/Hの応答時間を遅く、すなわち高周波ノイズによる変動の影響を受けないようにする(ノイズ除去)方法もある。
また、単純にフィルタ回路10で高周波ノイズを除去することが目的であれば、サンプルホールド回路7の前後どちらでフィルタ回路を設定しても構わない。
しかし、この実施形態の特徴は、信号自身から、それに重畳しているオフセット変動を起こすノイズのみを検出するところにあり、検出する信号レベルは基準となるレベルでなければならない。
フィルタ回路10→サンプルホールド回路7の順に構成してしまうと、出力信号Vsigはリセットノイズおよび信号の出力レベルを含めた出力信号に対してフィルタリングしてしまうため、出力信号をなまらせてしまう。
しかし、この実施形態の特徴は、信号自身から、それに重畳しているオフセット変動を起こすノイズのみを検出するところにあり、検出する信号レベルは基準となるレベルでなければならない。
フィルタ回路10→サンプルホールド回路7の順に構成してしまうと、出力信号Vsigはリセットノイズおよび信号の出力レベルを含めた出力信号に対してフィルタリングしてしまうため、出力信号をなまらせてしまう。
後段でS/Hする波形の形状を変化させてしまっており、本来検出したいレベルとは異なったレベルを検出してしまうことになるため、差動増幅回路9で差分出力すると、逆にノイズを重畳させてしまうことになる。
従って、ノイズの検出を行うためのサンプルホールド回路7とフィルタ回路10の順番は重要である。
従って、ノイズの検出を行うためのサンプルホールド回路7とフィルタ回路10の順番は重要である。
図3は、図2に示した信号処理回路(ノイズ補正回路)の高速駆動時の暗時状態(CCD1に光入射がない状態)における出力信号の一例を示す波形図である。
高速駆動により、従来技術で基準レベルの検出にS/Hを行っている非信号領域のペデスタル部に平坦部はなく、単純にS/Hを行っても基準レベルは得られない。
この実施形態では、CCD1からの出力信号(Vsig)を、光に反応する信号領域(信号レベル)の信号を取得できるタイミングでS/Hし、信号領域の信号V_s/h_sigとして出力する。
高速駆動により、従来技術で基準レベルの検出にS/Hを行っている非信号領域のペデスタル部に平坦部はなく、単純にS/Hを行っても基準レベルは得られない。
この実施形態では、CCD1からの出力信号(Vsig)を、光に反応する信号領域(信号レベル)の信号を取得できるタイミングでS/Hし、信号領域の信号V_s/h_sigとして出力する。
また、CCD1からの出力信号(Vsig)を、光に反応しない非信号領域の信号を基準レベル(画素レベルの暴れを含む変動レベル)の信号として取得できるタイミングでS/Hし、非信号領域の信号V_s/h_noとして出力するが、後段のフィルタ回路10により高周波成分(高周波ノイズ)を除去するため、周波数の遅い変動(周期の遅いノイズ)のみ検出し、V_s/h_filとして出力することができる。なお、高周波成分とは、例えばMHzオーダー以上のものに相当する。また、周波数の遅い変動とは、例えばKHzオーダーのものに相当する。
従って、V_s/h_sigとV_s/h_filとで差分を取ることにより、画素暴れを含む高周波成分を除去した(ノイズ補正した)真の光に反応する信号レベルの信号(Vsig_out)を得ることができる。
従って、V_s/h_sigとV_s/h_filとで差分を取ることにより、画素暴れを含む高周波成分を除去した(ノイズ補正した)真の光に反応する信号レベルの信号(Vsig_out)を得ることができる。
図4は、図2に示した信号処理回路の高速駆動時でかつCCD1に光入射があった場合における出力信号の一例を示す波形図である。
CCD1に光入射があった場合においても、出力信号Vsigのオフセット変動と同じオフセット変動を基準レベルとして検出し、その基準レベル検出後、画素暴れをフィルタリングでノイズ除去するため、V_s/h_sigとV_s/h_filとで差分を取ることによって真の信号出力を得ることができる。よって、光入射分のみを真の信号出力として得ることができる。
CCD1に光入射があった場合においても、出力信号Vsigのオフセット変動と同じオフセット変動を基準レベルとして検出し、その基準レベル検出後、画素暴れをフィルタリングでノイズ除去するため、V_s/h_sigとV_s/h_filとで差分を取ることによって真の信号出力を得ることができる。よって、光入射分のみを真の信号出力として得ることができる。
なお、オフセット変動分のみを検出できれば良いため、非信号領域の信号をS/Hするタイミングとしては、従来技術のペデスタル期間を非信号領域として使用し、ノイズ検出に使用するのではなく(高速化に伴って非常に期間が短く、波形の暴れやうねりが激しいため)、期間の長いリセットノイズ含んだ非信号期間全体を使用してノイズ検出を行う方がより効果的である。
このように、差動増幅回路9(差分出力部24)が、サンプルホールド回路5(信号検出部22)によって検出された信号成分とサンプルホールド回路7(基準検出部23)によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する場合、サンプルホールド回路7での信号検出速度を、フィルタ回路10がサンプルホールド回路5での信号検出速度よりも遅くすることにより、信号処理回路を高速駆動させた場合においても真の有効信号成分を得ることができる。
すなわち、高速駆動を行った場合でも、ノイズ検出部としての機能を果すサンプルホールド回路7およびフィルタ回路10によって複数のノイズ要因が合成された合成ノイズが重畳された出力信号自身から、高速化に伴った画素レベルの暴れをフィルタリングにより除去し、画像に現れるスジ状ノイズの原因となる比較的周期の遅いノイズのみを検出し、その検出したノイズと元の合成ノイズが重畳された出力信号との差分を取ることで、ノイズ補正された出力信号を得ることができる。よって、高画質の画像を提供することが可能になる。
また、サンプルホールド回路7が、CCD1(信号出力部21)からの出力信号のうち、リセットノイズを含む光に反応しない信号部分から基準成分の検出を行うことにより、リセットノイズを含む分だけ基準成分検出の期間を広く取れるため、精度良く信号検出を行うことができる。
図5は、この発明による信号処理回路の他の具体的構成例を示す回路図であり、図2と対応する部分には同一符号を付して、それらの説明を省略する。
この信号処理回路では、CCD1の後段に信号バッファ手段であるバッファ11を備えることにより、CCD1からサンプルホールド回路5,7までの信号伝搬中に外来ノイズが重畳するのを極力避けることができる。
この信号処理回路では、CCD1の後段に信号バッファ手段であるバッファ11を備えることにより、CCD1からサンプルホールド回路5,7までの信号伝搬中に外来ノイズが重畳するのを極力避けることができる。
実際に基板上に回路を構成するとなると、基板サイズやデバイスの端子配置の制約があり、信号出力〜信号入力間において全ての信号を等距離で配線することは難しい。それにより、信号這い回しが長くなってしまうものも出てくる。伝搬距離が長くなると外来ノイズを受ける可能性も高くなるため、バッファ11を備えることでインピーダンスを下げ、ノイズ耐性を強化することができる。
なお、バッファ11は差動増幅回路9(図1の差分出力部24)の前段に配置しても構わない。
なお、バッファ11は差動増幅回路9(図1の差分出力部24)の前段に配置しても構わない。
図6は、図2に示した信号処理回路(ノイズ補正回路)の一部を同一の半導体チップ上に形成して集積化した一例を示す回路図である。
図2に示した信号処理回路(ノイズ補正回路)のサンプルホールド回路5(S/H_sig)、サンプルホールド回路7(S/H_no)、差動増幅回路9、フィルタ回路10は、例えば図6に示すように、同一の半導体チップ50上に形成して集積化することにより、省スペース・低コストを実現することができる。
なお、図5のバッファ11を半導体チップ50に含め、形成しても良い。
図2に示した信号処理回路(ノイズ補正回路)のサンプルホールド回路5(S/H_sig)、サンプルホールド回路7(S/H_no)、差動増幅回路9、フィルタ回路10は、例えば図6に示すように、同一の半導体チップ50上に形成して集積化することにより、省スペース・低コストを実現することができる。
なお、図5のバッファ11を半導体チップ50に含め、形成しても良い。
以上、この発明をCCDによって原稿の画像を読み取るスキャナに搭載可能な信号処理回路に適用した実施形態について説明したが、この発明はこれに限らず、他のイメージセンサによって原稿の画像を読み取るスキャナに搭載可能な信号処理回路には勿論、それらのイメージセンサによって原稿の画像を読み取る他の画像読取装置に搭載可能な信号処理回路、その信号処理回路を搭載した画像読取装置、その画像読取装置を搭載したデジタル複写機,ファクシミリ装置,プリンタ等の各種画像形成装置にもそれぞれ適用可能である。画像形成装置本体は、画像読取装置からの画像データを可視画像として印刷媒体に印刷することができる
図7は、図2に示した信号処理回路を含む制御基板を搭載したスキャナのハード構成例を示す概略図であり、図2,図5と同じ部分(CCD1)には同一符号を付している。
このスキャナ100は、フラットベッド方式のものであり、本体上面に、原稿が載置される原稿ガラスであるコンタクトガラス101が設置されている。
コンタクトガラス101の下方には、第1キャリッジ106と第2キャリッジ107が2対1の速度で矢印A方向(副走査方向)に移動するように配置されている。
このスキャナ100は、フラットベッド方式のものであり、本体上面に、原稿が載置される原稿ガラスであるコンタクトガラス101が設置されている。
コンタクトガラス101の下方には、第1キャリッジ106と第2キャリッジ107が2対1の速度で矢印A方向(副走査方向)に移動するように配置されている。
第1キャリッジ106には光源としてのハロゲンランプ102と第1ミラー103が搭載され、第2キャリッジ107には第2ミラー104及び第3ミラー105が搭載されている。
ハロゲンランプ102によって照射された原稿からの反射光は、第1ミラー103、第2ミラー104、および第3ミラー105によって反射されて結像レンズ108に入射し、その結像レンズ108で集光され、CCD(リニアイメージセンサ)1の結像面に結像し、CCD1で光電変換されたアナログ電気信号が図2に示した信号処理回路(図5に示した信号処理回路でもよい)を含む制御基板109でデジタル画像データ(原稿の画像データ)に変換され、後段に送られる。
ハロゲンランプ102によって照射された原稿からの反射光は、第1ミラー103、第2ミラー104、および第3ミラー105によって反射されて結像レンズ108に入射し、その結像レンズ108で集光され、CCD(リニアイメージセンサ)1の結像面に結像し、CCD1で光電変換されたアナログ電気信号が図2に示した信号処理回路(図5に示した信号処理回路でもよい)を含む制御基板109でデジタル画像データ(原稿の画像データ)に変換され、後段に送られる。
一方、原稿の画像データの主走査方向(副走査方向と直交する方向)の分布を均一にするためには、シェーディング補正を行うが、そのための基準白板111の読み取りデータを取得する必要がある。
シェーディング補正を行うためには、原稿の画像読み取り前に、ハロゲンランプ102による照明により、基準白板111の表面が読み取られ、その読み取り結果(読み取りデータ)に基づいて原稿の画像読み取り時のシェーディング補正が行われる。
シェーディング補正を行うためには、原稿の画像読み取り前に、ハロゲンランプ102による照明により、基準白板111の表面が読み取られ、その読み取り結果(読み取りデータ)に基づいて原稿の画像読み取り時のシェーディング補正が行われる。
ここで、第1,第2キャリッジ106,107が2対1の速度で副走査方向に移動するのは、原稿面からCCD1の結像面までの光路長を一定に保持するためであり、CCD1は制御基板109上に搭載されている。
また、コンタクトガラス101の上面を覆うように圧板110が開閉可能に設けられ、コンタクトガラス101上に原稿が載置されたとき、外部からの光がCCD1に入射しないようにしている。なお、圧板110に代えてADF(自動原稿給送装置)あるいはARDFなどを設け、原稿を自動的に給送できるように構成することも可能である。
また、コンタクトガラス101の上面を覆うように圧板110が開閉可能に設けられ、コンタクトガラス101上に原稿が載置されたとき、外部からの光がCCD1に入射しないようにしている。なお、圧板110に代えてADF(自動原稿給送装置)あるいはARDFなどを設け、原稿を自動的に給送できるように構成することも可能である。
図8は、図2に示した信号処理回路を含む制御基板を搭載したスキャナを備えた画像形成装置の構成例を示す概略図であり、図2,図7等と同じ部分には同一符号を付している。
画像形成装置200は、スキャナ100とプリンタ120とを備えている。
スキャナ100は、CCD1、TG2、サンプルホールド回路5,7、差動増幅回路9、フィルタ回路10、A/D変換器112、およびLVDS(Low Voltage Differential Signaling)113を含む制御基板を備え、差動増幅回路9からの出力信号がA/D変換器112によってデジタル画像データに変換されて、LVDS113に送られる。
画像形成装置200は、スキャナ100とプリンタ120とを備えている。
スキャナ100は、CCD1、TG2、サンプルホールド回路5,7、差動増幅回路9、フィルタ回路10、A/D変換器112、およびLVDS(Low Voltage Differential Signaling)113を含む制御基板を備え、差動増幅回路9からの出力信号がA/D変換器112によってデジタル画像データに変換されて、LVDS113に送られる。
一方、プリンタ120は、プリンタエンジン121と、このプリンタエンジン121を制御する制御部122とを備え、両者はI/F123により通信可能に接続されている。
制御部122は、CPU124、画像処理回路125、およびLVDS126を備えている。
CPU124は、TG2と相互に通信可能に接続し、LVDS126を介して入力されるデジタル画像データに基づいてプリンタエンジン121を制御し、記録紙等の媒体に画像を形成させる。プリンタエンジン121の画像形成プロセスは種々あり、いずれの形式のプリンタエンジンでも使用できるので、プリンタエンジンに関する説明は省略する。
制御部122は、CPU124、画像処理回路125、およびLVDS126を備えている。
CPU124は、TG2と相互に通信可能に接続し、LVDS126を介して入力されるデジタル画像データに基づいてプリンタエンジン121を制御し、記録紙等の媒体に画像を形成させる。プリンタエンジン121の画像形成プロセスは種々あり、いずれの形式のプリンタエンジンでも使用できるので、プリンタエンジンに関する説明は省略する。
なお、図7に示したスキャナあるいは図8に示した画像形成装置に搭載された制御基板内の信号処理回路を図5に示したものにしても勿論良い。
この発明では、高速駆動させた場合においても、信号処理回路から真の有効信号成分を得ることができるため、この発明をスキャナや複写機等の画像形成装置に適用することにより、安定動作かつ高信頼性のシステムを実現でき、高品質の画像を得ることができる。
なお、この発明は上述した実施形態に限定されるものではなく、特許請求の範囲に記載された技術思想に含まれる技術的事項の全てが対象となることは言うまでもない。
この発明では、高速駆動させた場合においても、信号処理回路から真の有効信号成分を得ることができるため、この発明をスキャナや複写機等の画像形成装置に適用することにより、安定動作かつ高信頼性のシステムを実現でき、高品質の画像を得ることができる。
なお、この発明は上述した実施形態に限定されるものではなく、特許請求の範囲に記載された技術思想に含まれる技術的事項の全てが対象となることは言うまでもない。
以上の説明から明らかなように、この発明によれば、高速駆動させた場合においても真の有効信号成分を得ることができる。したがって、高速駆動させた場合においても真の有効信号成分を得ることが可能な信号処理回路、画像読取装置、および画像形成装置を提供することができる。
1:CCD 2:TG(タイミングジェネレータ)
5,7:サンプルホールド回路 9:差動増幅回路 10:フィルタ回路
11:バッファ 21:信号出力部 22:信号検出部 23:基準検出部
24:差分出力部 50:半導体チップ 100:スキャナ 109:制御基板
200:画像形成装置
5,7:サンプルホールド回路 9:差動増幅回路 10:フィルタ回路
11:バッファ 21:信号出力部 22:信号検出部 23:基準検出部
24:差分出力部 50:半導体チップ 100:スキャナ 109:制御基板
200:画像形成装置
Claims (10)
- 信号出力手段からの出力信号に対して信号成分を検出する信号検出手段と、
前記信号成分の基準となる基準成分を検出する基準検出手段と、
前記信号検出手段によって検出された信号成分と前記基準検出手段によって検出された基準成分との差分を取り、真に有効な信号として後段へ出力する差分出力手段とを有する信号処理回路であって、
前記基準検出手段での信号検出速度を前記信号検出手段での信号検出速度よりも遅くする速度遅延手段を設けたことを特徴とする信号処理回路。 - 前記信号出力手段は、光電変換を行うイメージセンサであり、
前記信号成分は、前記イメージセンサからの出力信号のうちの光に反応する信号成分であり、
前記基準成分は、前記イメージセンサからの出力信号のうちの光に反応しない信号成分であり、
前記信号検出手段および前記基準検出手段は、いずれもサンプルホールド回路であり、
前記差分出力手段は、差動増幅回路であり、
前記速度遅延手段は、フィルタであることを特徴とする請求項1に記載の信号処理回路。 - 前記基準検出手段が前記速度遅延手段を備えていることを特徴とする請求項1に記載の信号処理回路。
- 前記信号出力手段は、光電変換を行うイメージセンサであり、
前記信号成分は、前記イメージセンサからの出力信号のうちの光に反応する信号成分であり、
前記基準成分は、前記イメージセンサからの出力信号のうちの光に反応しない信号成分であり、
前記信号検出手段は、サンプルホールド回路であり、
前記速度遅延手段はフィルタであり、
前記基準検出手段は、サンプルホールド回路と前記フィルタとからなり、
前記差分出力手段は、差動増幅回路であることを特徴とする請求項3に記載の信号処理回路。 - 前記基準検出手段は、前記信号出力手段からの出力信号のうち、リセットノイズを含む光に反応しない信号部分から前記基準成分の検出を行うことを特徴とする請求項1乃至4のいずれか一項に記載の信号処理回路。
- 請求項1乃至5のいずれか一項に記載の信号処理回路において、
前記信号出力手段の後段に、該信号出力手段からの出力信号を受ける信号バッファ手段を設けたことを特徴とする信号処理回路。 - 前記信号検出手段および前記基準検出手段は、同一の半導体チップ上に形成されていることを特徴とする請求項1乃至5のいずれか一項に記載の信号処理回路。
- 前記信号検出手段、前記基準検出手段、および前記信号バッファ手段は、同一の半導体チップ上に形成されていることを特徴とする請求項6に記載の信号処理回路。
- 請求項1乃至8のいずれか一項に記載の信号処理回路を備えていることを特徴とする画像読取装置。
- 請求項9に記載の画像読取装置を備え、該画像読取装置によって読み取られた画像データに基づいて画像形成処理を行うことを特徴とする画像形成装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2011059806A JP2012195873A (ja) | 2011-03-17 | 2011-03-17 | 信号処理回路と画像読取装置および画像形成装置 |
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