JP2012159966A - 情報処理装置 - Google Patents
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Abstract
【解決手段】CPU11,21は高速起動プログラム14、高速起動プログラム24、通常起動プログラム15、通常起動プログラム25の順番で書き換えをし、いずれかのプログラムの書き換えが失敗した段階で、以降の書き換えを中止する。CPU11,21のうち、一方のCPUが高速起動プログラム、他方のCPUが通常起動プログラムを用いて起動する場合に初期通信にタイムアウトを発生させて、一方のCPUが通常起動プログラムに切り換えて起動して、初期通信を成功するようにしている。
【選択図】図5
Description
11 CPU(第1のCPUの一例)
12 EEPROM(第1の不揮発性記憶装置の一例)
13 RAM(第1のRAMの一例)
14 高速起動プログラム(第1の高速起動プログラムの一例)
15 通常起動プログラム(第1の通常起動プログラムの一例)
21 CPU(第2のCPUの一例)
22 EEPROM(第2の不揮発性記憶装置の一例)
23 RAM(第2のRAMの一例)
24 高速起動プログラム(第2の高速起動プログラムの一例)
25 通常起動プログラム(第2の通常起動プログラムの一例)
Claims (3)
- 第1のCPUと、
第1のRAMと、
前記第1のCPUを起動するために前記第1のRAMに書き込まれて実行される第1の通常起動プログラム及び、前記第1のCPUを起動するために前記第1のRAMに書き込まれて実行され、前記第1の通常起動プログラムに比べて前記第1のRAMへの書き込み時間が短い第1の高速起動プログラムが格納可能な第1の不揮発性記憶装置と、
前記第1のCPUと同期をとるために前記第1のCPUと互いに初期通信をする第2のCPUと、
第2のRAMと、
前記第2のCPUを起動するために前記第2のRAMに書き込まれて実行される第2の通常起動プログラム及び、前記第2のCPUを起動するために前記第2のRAMに書き込まれて実行され、前記第2の通常起動プログラムに比べて前記第2のRAMへの書き込み時間が短い第2の高速起動プログラムが格納可能な第2の不揮発性記憶装置と、を備え、
前記第1及び第2のCPUが、前記第1の不揮発性記憶装置に格納されている前記第1の通常起動プログラム及び前記第1の高速起動プログラム並びに前記第2の不揮発性記憶装置に格納されている前記第2の通常起動プログラム及び前記第2の高速起動プログラムをそれぞれ書き換える場合、前記第1及び第2の不揮発性記憶装置において、最初に書き換えるプログラムと次に書き換えるプログラムとは前記初期通信が成功可能なプログラムどうしであり、前記第1の通常起動プログラム、前記第1の高速起動プログラム、前記第2の通常起動プログラム及び前記第2の高速起動プログラムのいずれかの書き換えが失敗した段階で、以降の書き換えを中止し、
前記第1及び第2のCPUを起動するために、前記第1のCPUが前記第1のRAMに前記第1の高速起動プログラムを書き込み、かつ前記第2のCPUが前記第2のRAMに前記第2の通常起動プログラムを書き込む場合、前記第2のCPUが前記第1のCPUと前記初期通信を開始する前に、前記第1のCPUが前記第2のCPUとの前記初期通信でタイムアウトが発生するように、前記第1の高速起動プログラムには前記初期通信の時間が設定されており、
前記第1及び第2のCPUを起動するために、前記第1のCPUが前記第1のRAMに前記第1の通常起動プログラムを書き込み、かつ前記第2のCPUが前記第2のRAMに前記第2の高速起動プログラムを書き込む場合、前記第1のCPUが前記第2のCPUと前記初期通信を開始する前に、前記第2のCPUが前記第1のCPUとの前記初期通信でタイムアウトが発生するように、前記第2の高速起動プログラムには前記初期通信の時間が設定されており、
前記第1のRAMに前記第1の高速起動プログラムが書き込まれ、かつ前記第2のRAMに前記第2の通常起動プログラムが書き込まれることによって、前記第1のCPUが前記第2のCPUとの前記初期通信でタイムアウトが発生した場合、前記第1のCPUは前記第2の通常起動プログラムと前記初期通信が成功可能な前記第1の通常起動プログラムを前記第1のRAMに書き込んで前記第2のCPUと前記初期通信をし、
前記第1のRAMに前記第1の通常起動プログラムが書き込まれ、かつ前記第2のRAMに前記第2の高速起動プログラムが書き込まれることによって、前記第2のCPUが前記第1のCPUとの前記初期通信でタイムアウトが発生した場合、前記第2のCPUは前記第1の通常起動プログラムと前記初期通信が成功可能な前記第2の通常起動プログラムを前記第2のRAMに書き込んで前記第1のCPUと前記初期通信をする情報処理装置。 - 前記第1及び第2のCPUは、前記第1の高速起動プログラム及び前記第2の高速起動プログラムのうち一方を先に他方を次に書き換えた後、前記第1の通常起動プログラム及び前記第2の通常起動プログラムのうち一方を先に他方を次に書き換える制御をする請求項1に記載の情報処理装置。
- 前記第1のCPUが、書き換え後の前記第1の高速起動プログラムを前記第2の不揮発性記憶装置に転送することにより前記第2の高速起動プログラムの書き換えが実行され、
前記第1のCPUが、書き換え後の前記第1の通常起動プログラムを前記第2の不揮発性記憶装置に転送することにより前記第2の通常起動プログラムの書き換えが実行される請求項1又は2に記載の情報処理装置。
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JP2011018520A JP5383722B2 (ja) | 2011-01-31 | 2011-01-31 | 情報処理装置 |
Applications Claiming Priority (1)
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JP2011018520A JP5383722B2 (ja) | 2011-01-31 | 2011-01-31 | 情報処理装置 |
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JP2012159966A true JP2012159966A (ja) | 2012-08-23 |
JP5383722B2 JP5383722B2 (ja) | 2014-01-08 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2011018520A Expired - Fee Related JP5383722B2 (ja) | 2011-01-31 | 2011-01-31 | 情報処理装置 |
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2015055917A (ja) * | 2013-09-10 | 2015-03-23 | 日本電気株式会社 | ファームウェア実行装置、ファームウェア実行方法、コンピュータ・プログラム、および、コンピュータ装置 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
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JPH05189392A (ja) * | 1992-01-09 | 1993-07-30 | Hitachi Ltd | 多重化計算機システムおよび多重化計算機システムのプログラム入替方法 |
JP2002049509A (ja) * | 2000-08-01 | 2002-02-15 | Hitachi Ltd | データ処理システム |
JP2003316582A (ja) * | 2002-04-24 | 2003-11-07 | Nec System Technologies Ltd | 2重化biosの制御方法と装置 |
JP2004199277A (ja) * | 2002-12-17 | 2004-07-15 | Fujitsu Ltd | Biosの冗長管理方法、データ処理装置及びストレージシステム |
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2011
- 2011-01-31 JP JP2011018520A patent/JP5383722B2/ja not_active Expired - Fee Related
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JP5383722B2 (ja) | 2014-01-08 |
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