JP2012129691A - Amplifier circuit, charge or discharge control circuit having the same, and method of controlling the same - Google Patents
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Abstract
Description
本発明は、制御開始のタイムラグを低減したアンプ回路とそれを備える充電または放電制御回路とその制御方法とに関する。 The present invention relates to an amplifier circuit in which a control start time lag is reduced, a charge or discharge control circuit including the amplifier circuit, and a control method therefor.
負帰還増幅回路のシンク・ソース能力や、上限制限電圧/下限制限電圧の値によって、消費電流が大きく増加することがなく、低消費電流タイプで、オペアンプの動作が安定な信号増幅回路を提供することを目的とし、クランプ動作を上限電圧制限回路や下限電圧制限回路および負帰還増幅回路を構成するMOSFET(M16、M17)のオン抵抗を制御することにより、クランプ動作を行う場合に電流の増加がないため、信号増幅回路の消費電流を小さくできる信号増幅回路が、例えば下記特許文献1に開示されている。 Providing a signal amplifier circuit with low current consumption type and stable op amp operation without significant increase in current consumption due to sink / source capability of negative feedback amplifier circuit and upper limit voltage / lower limit voltage For this purpose, the clamp operation is controlled by controlling the on-resistance of the MOSFETs (M16, M17) constituting the upper limit voltage limit circuit, the lower limit voltage limit circuit, and the negative feedback amplifier circuit. Therefore, for example, Patent Document 1 below discloses a signal amplifier circuit that can reduce the current consumption of the signal amplifier circuit.
従来のアンプ回路においては、誤差アンプの出力電流が立ち上がり開始しても、位相補償コンデンサに電流が供給される相当分、負荷への制御開始が遅延することとなっていた。 In the conventional amplifier circuit, even when the output current of the error amplifier starts to rise, the start of control to the load is delayed by an amount corresponding to the current supplied to the phase compensation capacitor.
本発明は、上述の問題点に鑑み為されたものであって、制御開始のタイムラグを低減したアンプ回路とそれを備える充電または放電制御回路とその制御方法とを提供することを目的とする。 The present invention has been made in view of the above-described problems, and it is an object of the present invention to provide an amplifier circuit in which a control start time lag is reduced, a charge or discharge control circuit including the amplifier circuit, and a control method therefor.
本発明のアンプ回路は、誤差アンプと、誤差アンプの出力にベースが接続されたトランジスタと、トランジスタのコレクタとエミッタとの間に接続された負荷と、誤差アンプの出力と誤差アンプのマイナス側入力との間に接続された位相補償コンデンサと、を備えるアンプ回路において、位相補償コンデンサと直列に接続されたフォトモススイッチを備え、フォトモススイッチは、トランジスタのベース電流の有無に対応してオン・オフが制御されることを特徴とする。 The amplifier circuit of the present invention includes an error amplifier, a transistor having a base connected to the output of the error amplifier, a load connected between the collector and emitter of the transistor, an output of the error amplifier, and a negative input of the error amplifier. An amplifier circuit having a phase compensation capacitor connected between and a phase compensation capacitor, and a photoMOS switch connected in series with the phase compensation capacitor. OFF is controlled.
また、本発明のアンプ回路は、好ましくは位相補償コンデンサと並列に接続されたクランプダイオードを備えることを特徴とする。 The amplifier circuit according to the present invention preferably includes a clamp diode connected in parallel with the phase compensation capacitor.
また、本発明のアンプ回路は、さらに好ましくは誤差アンプが、プラス側入力に基準電圧の正側が接続されることを特徴とする。 The amplifier circuit of the present invention is more preferably characterized in that the error amplifier is connected to the positive side of the reference voltage to the positive side input.
また、本発明のアンプ回路は、さらに好ましくは負荷がバッテリであることを特徴とする。 In the amplifier circuit of the present invention, more preferably, the load is a battery.
また、本発明のアンプ回路は、さらに好ましくはトランジスタのエミッタと負荷との間に負荷電流検出抵抗を備え、負荷電流検出抵抗のエミッタ側と誤差アンプのマイナス側入力とが接続されることを特徴とする。 The amplifier circuit of the present invention is more preferably provided with a load current detection resistor between the emitter of the transistor and the load, and the emitter side of the load current detection resistor is connected to the negative side input of the error amplifier. And
また、本発明の充電または放電制御装置は、上述に記載のアンプ回路を備えることを特徴とする。 Moreover, the charge or discharge control device of the present invention is characterized by including the amplifier circuit described above.
また、本発明の充電または放電制御装置により負荷に電流を供給する制御方法においては、誤差アンプの出力電流が立ち上がり開始する工程と、負荷の電流が流れ始めると同時にフォトモススイッチがオンとなって、位相補償コンデンサが誤差アンプと電気的に並列に接続される工程と、を有することを特徴とする。 In the control method for supplying current to the load by the charge or discharge control device of the present invention, the step of starting the output current of the error amplifier starts, and the photo moss switch is turned on at the same time as the load current starts to flow. And a step of electrically connecting the phase compensation capacitor in parallel with the error amplifier.
本発明により、制御開始のタイムラグを低減したアンプ回路とそれを備える充電または放電制御回路とその制御方法とを提供できる。 According to the present invention, it is possible to provide an amplifier circuit in which a control start time lag is reduced, a charge or discharge control circuit including the amplifier circuit, and a control method therefor.
実施形態で説明する充電または放電制御装置は、誤差アンプを備えるアナログ制御回路で構成され、負荷に対して電流が印加されて負荷制御ループが確立されると同時に、位相補償コンデンサを誤差アンプに負帰還で接続して位相補償を遂行し、安定な動作をする。 The charge or discharge control device described in the embodiment is composed of an analog control circuit including an error amplifier. When a current is applied to a load and a load control loop is established, a phase compensation capacitor is charged to the error amplifier. Connect with feedback to perform phase compensation and operate stably.
すなわち、負荷に対する電流制御ループが確立されるまでの間は、位相補償コンデンサは誤差アンプから電気的に切り離されている。このため、負荷制御の立ち上げ段階で、電流が位相補償コンデンサに供給されることがなく、迅速に負荷への電流制御ループを確立して負荷制御を開始することができる。 That is, until the current control loop for the load is established, the phase compensation capacitor is electrically disconnected from the error amplifier. Therefore, current is not supplied to the phase compensation capacitor at the start-up stage of the load control, and the load control can be started by quickly establishing a current control loop to the load.
図1は、実施形態にかかる負荷への定電流動作をするアンプ回路100の構成概要を説明する図である。図1に示すように、アンプ回路100は、誤差アンプ110と、誤差アンプ110のプラス側入力に接続される基準電圧源150と、誤差アンプ110の出力とマイナス側入力との間に負帰還接続される位相補償コンデンサ130と、位相補償コンデンサ130と並列に接続されるクランプダイオード120とを備える。
FIG. 1 is a diagram illustrating a configuration outline of an
また、アンプ回路100は、誤差アンプ110の出力にべースが接続されたトランジスタ170と、トランジスタ170のコレクタとエミッタとの間に接続された負荷であるバッテリ140と、トランジスタ170のエミッタとバッテリ140との間に接続された負荷電流検出抵抗160とを備える。
The
負荷電流検出抵抗160のエミッタ側は誤差アンプ110のマイナス側に接続され、負荷電流検出抵抗160の他端は基準電圧源150のマイナス側に接続される。また、アンプ回路100は、誤差アンプ110の出力電流すなわちトランジスタ170のベース電流の有無に対応してオン・オフ動作をするフォトモススイッチ180を備える。フォトモススイッチ180がオン動作とされた場合には位相補償コンデンサ130が誤差アンプ110の出力側と電気的に接続され、フォトモススイッチ180がオフ動作とされた場合には位相補償コンデンサ130が誤差アンプ110の出力側と電気的に切断される。
The emitter side of the load
また、アンプ回路100は、バッテリ140に定電流を供給する電源装置として構成することができ、またバッテリ140に定電流を供給して放電させる放電装置または充電させる充電装置として構成することができる。また、アンプ回路100が上記構成を備えることにより、誤差アンプ110の出力電流が流れ始めるタイミングすなわちトランジスタ170のベース電流が流れ始めるタイミングで、位相補償コンデンサ130が電気的に接続され機能する。
In addition, the
このため、実質的にバッテリ140に電流が流れ始めると同時に、位相補償コンデンサ130が動作開始する。すなわち、アンプ回路100は、バッテリ140への電流供給制御を開始するまでは位相補償コンデンサ130を電気的に切り離して迅速な制御開始をするとともに、バッテリ140への電流供給制御が開始されると同時に位相補償コンデンサ130の位相補償機能を発揮して、安定した電流供給制御動作を遂行する。
Therefore, the
図2は、フォトモススイッチ180がない場合の制御立ち上がり時間T12と、フォトモススイッチ180がある場合の制御立ち上がり時間T14とを比較説明する概念図である。
Figure 2 is a control rise time T 12 in the absence of photo-
図2において、実線で示す210がフォトモススイッチ180がない場合の制御立ち上がりの時間−電圧関係を示し、破線で示す220がフォトモススイッチ180がある場合の制御立ち上がりの時間−電圧関係を示している。
In FIG. 2, a
図2から理解できるように、フォトモススイッチ180がない場合には、基準電圧源150から電圧V1が誤差アンプ110に時刻t1で印加された後、誤差アンプ110の出力電流が立ち上がる初期においてトランジスタ170のベース電流とならずに位相補償コンデンサ130にいわば吸い取られる状態となるので、実線210のように、制御立ち上がり時間が比較的長く時間T12を要することとなる。
As can be seen from Figure 2, when there is no
一方、フォトモススイッチ180がある場合には、基準電圧源150から電圧V1が誤差アンプ110に印加された後、誤差アンプ110の出力電流が立ち上がる初期において位相補償コンデンサ130にいわば吸い取られる状態とはならないので、誤差アンプ110の出力電流がトランジスタ170のベース電流となって破線220のように、制御立ち上がり時間が比較的短い時間T14となり、バッテリ140に対して迅速な制御開始が可能となる。
On the other hand, when the
また、図3は、アンプ回路100において誤差アンプ110の出力(電圧VR)の立ち上がりとバッテリ140に供給される負荷電流(負荷電流検出抵抗160の両端電圧)の立ち上がりとの間の好ましいタイミングを説明する図である。
FIG. 3 shows a preferable timing between the rise of the output of the error amplifier 110 (voltage V R ) and the rise of the load current (the voltage across the load current detection resistor 160) supplied to the
図3(a)がフォトモススイッチ180がない場合のアンプ出力立ち上がり開始後負荷電流が流れ始めるまでの期間Taを説明する図であり、図3(b)がフォトモススイッチ180がある場合のアンプ出力立ち上がり開始後負荷電流が流れ始めるまでの期間Tbを説明する図である。
FIG. 3A is a diagram for explaining a period Ta after the start of rising of the amplifier output when the
図3(a)に示すように、フォトモススイッチ180がない場合には、ダイオードドロップ電圧VE(大凡0.7ボルト程度)の2倍に相当する電圧値(2VE)にまでアンプ出力が到達した時点で、負荷電流が立ち上がりを開始する。
As shown in FIG. 3A, in the absence of the
一方、図3(b)に示すように、フォトモススイッチ180がある場合には、フォトモスダイオードのドロップ電圧VF(大凡1.1ボルト)とトランジスタ170のベース−エミッタ間電圧VBE(大凡0.7ボルト)との和に相当する電圧値(VF+VBE)にまでアンプ出力が到達した時点で、負荷電流が立ち上がりを開始する。
On the other hand, as shown in FIG. 3B, when there is a
ここで、(VF+VBE)は(2VE)よりも一般に大きい電圧となるが、図2及び図3で説明するように、アンプ出力の立ち上がり自体の傾きが大きく、迅速な立ち上がりとなる。このため、アンプ出力の立ち上がり開始から負荷電流が立ち上がり開始するまでに要する期間は、Ta>Tbとなって、フォトモススイッチ180を備えるアンプ回路100は、負荷電流の制御を迅速に開始可能となる。
Here, (V F + V BE ) is generally a larger voltage than (2V E ), but as described with reference to FIGS. 2 and 3, the slope of the rise of the amplifier output itself is large and the rise is quick. For this reason, the period required from the start of the rise of the amplifier output to the start of the rise of the load current is Ta> Tb, and the
また、図4は、アンプ回路100の制御開始時の立ち上がり動作について順次説明するフロー図である。
FIG. 4 is a flowchart for sequentially explaining the rising operation at the start of control of the
(ステップS410)
アンプ回路100は、基準電圧源150から基準電圧V1を誤差アンプ110のプラス側入力に抵抗を介して供給する。基準電圧源150から基準電圧V1を誤差アンプ110のプラス側入力に抵抗を介して供給開始すればステップS420へと進み、基準電圧源150から基準電圧V1を誤差アンプ110のプラス側入力に抵抗を介して供給しなければステップS410で待機する。
(Step S410)
(ステップS420)
誤差アンプ110の出力が、フォトモスのダイオードドロップ電圧VFを超えたか否かを判断する。誤差アンプ110の出力がフォトモスのダイオードドロップ電圧VFを超えた場合にはステップS430へと進み、誤差アンプ110の出力がフォトモスのダイオードドロップ電圧VFを超えていない場合にはステップS410へと戻る。
(Step S420)
The output of the
(ステップS430)
アンプ回路100において、フォトモススイッチ180がオンとなる。フォトモススイッチ180がオンとなることで、位相補償コンデンサ130が誤差アンプ110と負帰還として電気的に接続される。換言すれば、このステップS430まではフォトモススイッチ180がオフであって、位相補償コンデンサ130は誤差アンプ110の出力側と電気的に接続されていないので、位相補償コンデンサ130の出力は迅速に立ち上がる。
(Step S430)
In the
(ステップS440)
誤差アンプ110の出力が、フォトモスのダイオードドロップ電圧(VF)とトランジスタ170のベース−エミッタ間電圧(VBE)との和(VF+VBE)を超えたか否かを判断する。
(Step S440)
It is determined whether or not the output of the
誤差アンプ110の出力が、フォトモスのダイオードドロップ電圧(VF)とトランジスタ170のベース−エミッタ間電圧(VBE)との和(VF+VBE)を超えた場合には、ステップS450へと進む。また、誤差アンプ110の出力が、フォトモスのダイオードドロップ電圧(VF)とトランジスタ170のベース−エミッタ間電圧(VBE)との和(VF+VBE)を超えていない場合には、ステップS440で待機する。
When the output of the
(ステップS450)
トランジスタ170のベース電流に対応してコレクタ−エミッタ間に接続されたバッテリ140に負荷電流が供給される。当該負荷電流は、負荷電流検出抵抗160により検出される。また、検出された負荷電流値は、誤差アンプ110のマイナス側入力へとフィードバックされて、一定電流がバッテリ140に流れるように定電流アナログ制御される。
(Step S450)
A load current is supplied to the
ここで、アンプ回路100において、ステップS420とステップS440とは図4に示すように厳密には異なるタイミングであるため、その後のステップS430とステップS450とは厳密には各々異なるタイミングで動作されることとなる。しかし、図2において説明したように、アンプ回路100は基準電圧源150から基準電圧V1が印加された後、位相補償コンデンサ130が電気的に接続されていないため、トランジスタ170に迅速に出力を伝達し、負荷電流を流すことが可能である。このため、ステップS420とステップS440とのタイミングのずれは微小であって、その後のステップS430とステップS450とは連続した極めて短期間、換言すれば実質的に同一タイミングとみなせる程度のタイミングにおいて遂行される。
Here, in the
さらに好ましくは、アンプ出力がVFを超えて後(VF+VBE)を超える迄の短い期間と、フォトモススイッチ180の発光ダイオードが発光し始めてから現実にスイッチがオンされて電気的に導通開始されるまでのタイムラグと、が同一となるように構成することが好ましい。
More preferably, a short period from when the amplifier output exceeds V F to after (V F + V BE ), and after the light emitting diode of the
上述したアンプ回路100は、バッテリ140に対して定電流制御する構成として説明したが、負荷はバッテリ140に限られず任意の負荷(例えばコンデンサ)を接続してもよく、また定電圧制御または下限電圧制御または上限電圧制御としてもよい。いずれの場合においても、誤差アンプの出力に設けられたフォトモススイッチのオン動作により、位相補償コンデンサが誤差アンプに接続される構成とすることで、迅速な制御立ち上がり動作を実現することができる。
The
図5は、実施形態のアンプ回路100と比較するために、トランジスタ370のベース−エミッタ間の電圧を補償する追加的電圧源380を付加したアンプ回路300の構成概要を説明する図である。
FIG. 5 is a diagram illustrating a configuration outline of an
図5に示すように、アンプ回路300は、誤差アンプ310と、誤差アンプ310のプラス側入力に接続される基準電圧源350と、誤差アンプ310の出力とマイナス側入力との間に負帰還接続される位相補償コンデンサ330と、位相補償コンデンサ330と並列に接続されるクランプダイオード320とを備える。
As shown in FIG. 5, the
また、アンプ回路300は、誤差アンプ310の出力にべースが接続されたトランジスタ370と、トランジスタ370のコレクタとエミッタとの間に接続された負荷であるバッテリ340と、トランジスタ370のエミッタとバッテリ340との間に接続された負荷電流検出抵抗360とを備える。
The
負荷電流検出抵抗360のエミッタ側は誤差アンプ310のマイナス側に接続され、負荷電流検出抵抗360の他端は基準電圧源350のマイナス側に接続される。また、アンプ回路300は、誤差アンプ310の出力側とトランジスタ370のベースとの間に接続された追加的電圧源380を備える。
The emitter side of the load
追加的電圧源380は、トランジスタ370のベース−エミッタ間の電圧(例えば約0.7ボルト)に相当する電圧を発生し、当該トランジスタ370の立ち上がり応答を迅速にするために設けられる。
The
アンプ回路300においては、トランジスタ370を動作させるためのVBE相当の電圧が、追加的電圧源380により予め与えられているので、VBE相当分を昇圧するためのアンプ出力昇圧時間が不要となり、高速な制御開始が可能となる。しかし追加的電圧源380による高速化にも拘わらず、上述したアンプ回路100のほうがさらに高速な制御開始を実現できるものである。
In the
また、アンプ回路300は、バッテリ340に定電流を供給する電源装置として構成することができ、またバッテリ340に定電流を供給して放電させる放電装置または充電させる充電装置として構成することができる。
In addition, the
また、図6は、クランプダイオード420を用いたダイオードクランプによって負側に出力が振れないようにしたアンプ回路400の構成概要を説明する比較例の図である。図6に示すように、アンプ回路400は、誤差アンプ410と、誤差アンプ410のプラス側入力に抵抗を介して接続される基準電圧源450と、誤差アンプ410の出力とマイナス側入力との間に負帰還接続される位相補償コンデンサ430と、位相補償コンデンサ430と並列に接続されるクランプダイオード420とを備える。
FIG. 6 is a diagram of a comparative example for explaining the outline of the configuration of the
また、アンプ回路400は、誤差アンプ410の出力にべースが接続されたトランジスタ470と、トランジスタ470のコレクタとエミッタとの間に接続された負荷であるバッテリ440と、トランジスタ470のエミッタとバッテリ440との間に接続された負荷電流検出抵抗460とを備える。
The
負荷電流検出抵抗460のエミッタ側は誤差アンプ410のマイナス側に接続され、負荷電流検出抵抗460の他端は基準電圧源450のマイナス側に接続される。アンプ回路400においては、トランジスタ470を動作させるためのVBE相当の電圧を昇圧するためのアンプ出力昇圧時間が必要であり、負荷の制御開始までに比較的長い時間を要する。このため、アンプ回路100,300に比べて、基準電圧V1の印加後制御開始までの応答時間は遅い。
The emitter side of the load
また、アンプ回路400は、バッテリ440に定電流を供給する電源装置として構成することができ、またバッテリ440に定電流を供給して放電させる放電装置または充電させる充電装置として構成することができる。
In addition, the
図7は、アンプ回路400におけるクランプダイオード420がある場合と無い場合とにおける制御立ち上がり動作について説明する概念図である。図7において、実線で示す710がクランプダイオード420がある場合の制御立ち上がりの時間−電圧関係を示し、破線で示す720がクランプダイオード420がない場合の制御立ち上がりの時間−電圧関係を示している。
FIG. 7 is a conceptual diagram for explaining the control rising operation with and without the
図7から理解できるように、クランプダイオード420がある場合には、基準電圧源450から電圧V1が誤差アンプ410に時刻t1で印加された後、クランプされた比較的高い電圧V710から誤差アンプ410の出力が立ち上がるので、実線710のように、制御立ち上がり時間が比較的短く時間T12(t2−t1)を要することとなる。
As can be seen from FIG. 7, in the presence of the
一方、クランプダイオード420がない場合には、基準電圧源150から時刻t1において電圧V1が誤差アンプ410に印加された後、誤差アンプ410の出力が比較的低い電圧V720から立ち上がるので、破線720のように、制御立ち上がり時間が比較的長くかかり時間T13(t3−t1)となり、タイムロスを生じるのでバッテリ440に対して迅速な制御開始ができないこととなる。すなわち、アンプ回路100においては、好ましくはクランプダイオード120を備えるとともに、フォトモススイッチ180によりオン・オフされる位相補償コンデンサ130を備えることにより、迅速でありながら安定した確実な制御が可能となるものである。
On the other hand, when there is no clamping
本実施形態においては、特にアナログ制御回路の誤差アンプに関するものであって、その位相補償コンデンサを電気的に切断する手段としてフォトカプラまたはフォトモススイッチ等のフォトダイオードを用いた光学スイッチを用いることを提案する。 This embodiment particularly relates to an error amplifier of an analog control circuit, and uses an optical switch using a photodiode such as a photocoupler or a photomoss switch as means for electrically disconnecting the phase compensation capacitor. suggest.
これにより、発光ダイオードに電流が流れるとともに負荷制御ループが形成される制御回路とすることで、誤差アンプが無制御状態の場合には、位相補償コンデンサを電気的に切断して制御開始の立ち上がり時間を低減させる。また、負荷制御ループが確立されると同時に位相補償コンデンサを電気的に接続して位相補償動作を遂行させて安定な動作を確保する。 As a result, a control circuit in which a current flows through the light emitting diode and a load control loop is formed. When the error amplifier is in an uncontrolled state, the phase compensation capacitor is electrically disconnected and the control start rise time Reduce. Further, at the same time when the load control loop is established, the phase compensation capacitor is electrically connected to perform the phase compensation operation to ensure a stable operation.
また、アナログ制御回路で正負いずれかのみの制御回路では、例えば正方向のみを可能な限り早く制御させ、制御目標値に対して無駄時間が少なく迅速に到達するように、ダイオードクランプする。ダイオードクランプすることにより、不要な電圧の振れが抑制され安定する。 In addition, in the control circuit of only one of positive and negative in the analog control circuit, for example, only the positive direction is controlled as fast as possible, and diode clamping is performed so that the control target value can be quickly reached with less dead time. By diode clamping, unnecessary voltage fluctuation is suppressed and stabilized.
また、上述したようにトランジスタ駆動回路とした場合には、トランジスタのベースとエミッタが導通する電圧(VBE)を越えなければ、トランジスタを活性化させることができない。 In the case of the transistor drive circuit as described above, the transistor cannot be activated unless the voltage (V BE ) at which the base and the emitter of the transistor are conducted is exceeded.
0ボルトからトランジスタが活性化するVBEとなるまでの間は、制御回路が負荷を制御することができないので、この間はいわば無駄な立ち上がり時間を要していると考えられ、制御遅延を生じていることとなる。 Since the control circuit cannot control the load from 0 volt to V BE when the transistor is activated, it can be considered that a wasteful rise time is required during this period, causing a control delay. Will be.
これに対し、上述したように例えば制御アンプの出力に予めVBEと同電圧を与えて微妙な電圧調整をして高速化する対応も考えられる。しかし、この方法では、経年変化や温度ドリフト等が生じることが知られており、少しの電圧のブレにより制御できずに発信する等の問題点が指摘されている。 On the other hand, as described above, for example, it is possible to apply the same voltage as V BE to the output of the control amplifier in advance to finely adjust the voltage to increase the speed. However, this method is known to cause aging, temperature drift, and the like, and has been pointed out as a problem such as transmission without being controlled due to slight voltage fluctuations.
本実施形態で説明したアンプ回路100では、誤差アンプ110の出力とトランジスタ170のベースとの間にフォトモススイッチ180を介在させ、ベース電流が流れることに起因してトランジスタ170の制御が開始されると同時に自動的にフォトモススイッチ180がオンして位相補償コンデンサ130が接続される。
In the
また、制御アンプが制御を開始するまでの間は、位相補償コンデンサが制御アンプから切り離された状態であるので、制御アンプが迅速に立ち上がり動作をすることができる。さらに、制御アンプが負荷やトランジスタを制御している状態においては、位相補償コンデンサが接続されているので、確実に動作可能なアナログ制御回路を実現できる。 Further, since the phase compensation capacitor is disconnected from the control amplifier until the control amplifier starts control, the control amplifier can quickly start up. Further, in a state where the control amplifier controls the load and the transistor, the phase compensation capacitor is connected, so that an analog control circuit that can operate reliably can be realized.
本発明は、負荷に電力を供給するアナログ制御回路や電源装置等一般に幅広く適用できる。 The present invention is widely applicable to analog control circuits and power supply devices that supply power to a load.
100・・アンプ回路、110・・誤差アンプ、120・・クランプダイオード、130・・位相補償コンデンサ、140・・バッテリ、150・・基準電圧源、160・・負荷電流検出抵抗、170・・トランジスタ、180・・フォトモススイッチ。
100 ...
Claims (7)
前記位相補償コンデンサと直列に接続されたフォトモススイッチを備え、
前記フォトモススイッチは、前記トランジスタのベース電流の有無に対応してオン・オフが制御される
ことを特徴とするアンプ回路。 An error amplifier, a transistor having a base connected to the output of the error amplifier, a load connected between the collector and emitter of the transistor, and a connection between the output of the error amplifier and the negative input of the error amplifier In an amplifier circuit comprising:
A photo moss switch connected in series with the phase compensation capacitor;
The amplifier circuit, wherein the photo-MOS switch is controlled to be turned on / off in accordance with the presence or absence of a base current of the transistor.
前記位相補償コンデンサと並列に接続されたクランプダイオードを備える
ことを特徴とするアンプ回路。 The amplifier circuit according to claim 1,
An amplifier circuit comprising: a clamp diode connected in parallel with the phase compensation capacitor.
前記誤差アンプは、プラス側入力に基準電圧の正側が接続される
ことを特徴とするアンプ回路。 The amplifier circuit according to claim 1 or 2,
In the error amplifier, the positive side of a reference voltage is connected to a positive side input.
前記負荷はバッテリである
ことを特徴とするアンプ回路。 The amplifier circuit according to any one of claims 1 to 3,
The amplifier circuit characterized in that the load is a battery.
前記トランジスタのエミッタと前記負荷との間に負荷電流検出抵抗を備え、
前記負荷電流検出抵抗の前記エミッタ側と前記誤差アンプのマイナス側入力とが接続される
ことを特徴とするアンプ回路。 The amplifier circuit according to any one of claims 1 to 4,
A load current detection resistor is provided between the emitter of the transistor and the load,
An amplifier circuit, wherein the emitter side of the load current detection resistor and a negative side input of the error amplifier are connected.
ことを特徴とする充電または放電制御装置。 A charging or discharging control device comprising the amplifier circuit according to any one of claims 1 to 6.
前記誤差アンプの出力電流が立ち上がり開始する工程と、
前記負荷の電流が流れ始めると同時に前記フォトモススイッチがオンとなって、前記位相補償コンデンサが前記誤差アンプと電気的に並列に接続される工程と、を有する
ことを特徴とする制御方法。 In the control method which supplies an electric current to load with the charge or discharge control device according to claim 6,
A step of starting rising of the output current of the error amplifier;
And a step of turning on the photo-moss switch at the same time when the current of the load starts to flow, and connecting the phase compensation capacitor in parallel with the error amplifier.
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Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62237805A (en) * | 1986-04-09 | 1987-10-17 | Mitsubishi Electric Corp | Voltage amplifier circuit |
JPH04147305A (en) * | 1990-10-09 | 1992-05-20 | Mitsubishi Denki Eng Kk | Constant current driving circuit |
JPH05327873A (en) * | 1992-05-18 | 1993-12-10 | Fujitsu Ltd | Ringer transmission circuit |
JPH06164263A (en) * | 1992-11-17 | 1994-06-10 | Fuji Film Micro Device Kk | Operational amplifier |
JP2005010062A (en) * | 2003-06-20 | 2005-01-13 | Keisoku Giken Co Ltd | Electronic load apparatus |
JP2006280077A (en) * | 2005-03-29 | 2006-10-12 | Fujitsu Access Ltd | Power supply |
JP2009159508A (en) * | 2007-12-27 | 2009-07-16 | Nec Electronics Corp | Operational amplifier and integrating circuit |
JP2010119091A (en) * | 2008-10-16 | 2010-05-27 | Fuji Electric Systems Co Ltd | Signal amplification circuit |
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Patent Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62237805A (en) * | 1986-04-09 | 1987-10-17 | Mitsubishi Electric Corp | Voltage amplifier circuit |
JPH04147305A (en) * | 1990-10-09 | 1992-05-20 | Mitsubishi Denki Eng Kk | Constant current driving circuit |
JPH05327873A (en) * | 1992-05-18 | 1993-12-10 | Fujitsu Ltd | Ringer transmission circuit |
JPH06164263A (en) * | 1992-11-17 | 1994-06-10 | Fuji Film Micro Device Kk | Operational amplifier |
JP2005010062A (en) * | 2003-06-20 | 2005-01-13 | Keisoku Giken Co Ltd | Electronic load apparatus |
JP2006280077A (en) * | 2005-03-29 | 2006-10-12 | Fujitsu Access Ltd | Power supply |
JP2009159508A (en) * | 2007-12-27 | 2009-07-16 | Nec Electronics Corp | Operational amplifier and integrating circuit |
JP2010119091A (en) * | 2008-10-16 | 2010-05-27 | Fuji Electric Systems Co Ltd | Signal amplification circuit |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN108227806A (en) * | 2017-12-29 | 2018-06-29 | 三英精控(天津)仪器设备有限公司 | A kind of novel VI transformation output circuit |
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