JP2011176200A - Estimation device, estimation method and computer program - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To make physical phenomena common which are different from one semiconductor wafer to another, and to accurately estimate the polishing rates of various semiconductor wafers by using few statistical models. <P>SOLUTION: An estimation device estimates a polishing rate, based on a statistical model that uses two or more physical quantities as elements of a formula, with the two or more physical quantities showing the characteristics of a polishing instrument for polishing a semiconductor wafer. Regarding each of the two or more physical quantities, it has a correction value calculation section for calculating correction values, corresponding to the wiring length of a semiconductor wafer circuit pattern and the area ratio of the circuit pattern occupying the semiconductor wafer and an estimation section for estimating the polishing rate, by using the correction values and the statistical model that treats two or more physical quantities as explanatory variables. <P>COPYRIGHT: (C)2011,JPO&INPIT

Description

本発明は、統計モデルを用いることによって半導体研磨装置における研磨レートを推定するための技術に関する。   The present invention relates to a technique for estimating a polishing rate in a semiconductor polishing apparatus by using a statistical model.

半導体研磨装置の分野において、半導体ウェハの研磨前後の膜厚を随時計測せずに、半導体ウェハの研磨装置の各種物理現象を表すセンサデータに基づいて研磨レートを推定する方法がある。このような方法の一例として、特許文献1に開示されている技術がある。この技術では、半導体ウェハの研磨装置の各種センサから得られる物理量を説明変数とし、テストウェハの研磨量を目的変数として、回帰分析により研磨レートが推定される。この方法では、説明変数として、研磨テーブルを回転させるモータのトルク値、研磨テーブル上の表面温度、研磨テーブルに半導体ウェハを押し当てる圧力値などの物理現象の平均値などが、説明変数として用いられる。   In the field of semiconductor polishing apparatuses, there is a method of estimating a polishing rate based on sensor data representing various physical phenomena of a semiconductor wafer polishing apparatus without measuring the film thickness before and after polishing of a semiconductor wafer as needed. As an example of such a method, there is a technique disclosed in Patent Document 1. In this technique, a polishing rate is estimated by regression analysis using physical quantities obtained from various sensors of a semiconductor wafer polishing apparatus as explanatory variables and polishing amounts of test wafers as objective variables. In this method, as an explanatory variable, a torque value of a motor for rotating the polishing table, a surface temperature on the polishing table, an average value of physical phenomena such as a pressure value for pressing a semiconductor wafer against the polishing table, and the like are used as explanatory variables. .

ところが、半導体ウェハの表面は、製品により回路パターンが異なる。そのため、同じ研磨レートにより研磨が行われても、各種物理現象に差が出てしまう。例えば、テーブル上の研磨パッドを用いた研磨によって生じるテーブル温度などに変化が生じてしまう。また、研磨テーブルを回転させるモータのトルクや、半導体ウェハを保持して回転させる研磨ヘッド回転モータのトルクなどにも差が生じてしまう。   However, the circuit pattern of the surface of the semiconductor wafer differs depending on the product. For this reason, even if polishing is performed at the same polishing rate, there are differences in various physical phenomena. For example, a change occurs in the table temperature caused by polishing using a polishing pad on the table. In addition, there is a difference in the torque of the motor that rotates the polishing table and the torque of the polishing head rotation motor that holds and rotates the semiconductor wafer.

また、現在では半導体ウェハ上の回路構成は多層配線が採用されている。そのため、同一製品であっても、配線層によって回路パターンが異なっている。このような理由によっても、上記と同様に、研磨レートが同じであるにもかかわらず研磨の際に生じる物理現象に差が生じてしまう。   At present, multilayer wiring is employed for the circuit configuration on the semiconductor wafer. Therefore, even in the same product, the circuit pattern varies depending on the wiring layer. For this reason as well, as described above, there is a difference in the physical phenomenon that occurs during polishing even though the polishing rate is the same.

このような回路パターンの違いよって生じる物理現象の差を共通化する方法として、例えば特許文献2に開示されているような技術が提案されている。この技術では、回路パターンデータの配線周囲長により研磨レートが変化する特性を利用して、研磨時間が調整される。具体的には、回路パターンの違いによる研磨時の研磨テーブル温度や研磨テーブル回転モータのトルクの違いが、配線周囲長に依存するということが利用されている。   For example, a technique disclosed in Patent Document 2 has been proposed as a method for sharing the difference in physical phenomenon caused by the difference in circuit pattern. In this technique, the polishing time is adjusted by utilizing the characteristic that the polishing rate varies depending on the wiring peripheral length of the circuit pattern data. Specifically, it is utilized that the difference in polishing table temperature during polishing and the torque of the polishing table rotation motor due to the difference in circuit pattern depends on the wiring peripheral length.

特開2005−342841号公報JP 2005-328441 A 特開2009−33105号公報JP 2009-33105 A

しかしながら、特許文献2に開示された技術では、配線周囲長が短い場合に精度が低下してしまうという問題があった。図8は、特許文献2に開示された技術の問題点の概略を表す図である。図8の横軸は、ある配線周囲長を基準として規格化した配線周囲長を表す。図8の縦軸は、ある研磨テーブル回転モータのトルク電流値を基準として規格化した値を表す。図8に示すように、配線周囲長が閾値Thよりも長い領域では、研磨時の研磨テーブル回転モータのトルク変化と配線周囲長との間には傾きαの比例関係がある。これに対し、配線周囲長が閾値Thよりも短い領域、つまり回路パターンが粗いウェハの研磨では、研磨時の研磨テーブル回転モータのトルク変化と配線周囲長との間の傾きはα未満の値となる。   However, the technique disclosed in Patent Document 2 has a problem in that accuracy decreases when the wiring perimeter is short. FIG. 8 is a diagram showing an outline of the problems of the technique disclosed in Patent Document 2. The horizontal axis of FIG. 8 represents the wiring circumference normalized with a certain wiring circumference as a reference. The vertical axis in FIG. 8 represents a value normalized based on the torque current value of a certain polishing table rotation motor. As shown in FIG. 8, in the region where the wiring peripheral length is longer than the threshold value Th, there is a proportional relationship of the inclination α between the torque change of the polishing table rotation motor during polishing and the wiring peripheral length. On the other hand, in the polishing of a region where the wiring perimeter is shorter than the threshold Th, that is, a wafer having a rough circuit pattern, the slope between the torque change of the polishing table rotation motor and the wiring perimeter during polishing is less than α Become.

また、研磨時のテーブル温度についても、研磨面とウェハとの摩擦により発生する温度変化が大きく影響するため、同様なことが言える。このように、配線周囲長データだけでは、様々な回路パターンに対する研磨レートを推定する統計モデルを精度良く構築することができないという問題があった。   The same applies to the table temperature at the time of polishing because the temperature change caused by the friction between the polishing surface and the wafer is greatly affected. As described above, there is a problem that a statistical model for estimating the polishing rate for various circuit patterns cannot be constructed with high accuracy only by the wiring peripheral length data.

上記事情に鑑み、本発明は、半導体ウェハ毎に異なる物理現象を共通化して、少ない統計モデルで多品種の半導体ウェハの研磨レートを精度良く推定することを可能とする技術の提供を目的としている。   In view of the above circumstances, an object of the present invention is to provide a technique that makes it possible to accurately estimate the polishing rate of various types of semiconductor wafers with a small number of statistical models by sharing different physical phenomena for each semiconductor wafer. .

本発明の一態様は、半導体ウェハを研磨する研磨機構の特性を表す複数の物理量を式の要素とする統計モデルに基づいて研磨レートを推定する推定装置であって、前記複数の物理量のそれぞれについて、前記半導体ウェハの回路パターンの配線長と、前記半導体ウェハに占める前記回路パターンの面積比と、に対応する補正値を算出する補正値算出部と、前記補正値と、前記複数の物理量を説明変数とする統計モデルと、を用いて研磨レートを推定する推定部と、を備える。   One aspect of the present invention is an estimation apparatus that estimates a polishing rate based on a statistical model having a plurality of physical quantities representing the characteristics of a polishing mechanism for polishing a semiconductor wafer as an element of an expression, and each of the plurality of physical quantities The correction value calculation unit that calculates the correction value corresponding to the wiring length of the circuit pattern of the semiconductor wafer and the area ratio of the circuit pattern in the semiconductor wafer, the correction value, and the plurality of physical quantities are explained A statistical model as a variable, and an estimation unit that estimates a polishing rate using the statistical model.

本発明の一態様は、推定方法であって、半導体ウェハを研磨する研磨機構の特性を表す複数の物理量を式の要素とする統計モデルに基づいて研磨レートを推定する推定装置が、前記複数の物理量のそれぞれについて、前記半導体ウェハの回路パターンの配線長と、前記半導体ウェハに占める前記回路パターンの面積比と、に対応する補正値を算出する補正値算出ステップと、前記推定装置が、前記補正値と、前記複数の物理量を説明変数とする統計モデルと、を用いて研磨レートを推定する推定ステップと、を備える。   One aspect of the present invention is an estimation method, wherein an estimation apparatus that estimates a polishing rate based on a statistical model having a plurality of physical quantities representing the characteristics of a polishing mechanism for polishing a semiconductor wafer as elements of an expression is For each physical quantity, a correction value calculating step for calculating a correction value corresponding to the wiring length of the circuit pattern of the semiconductor wafer and the area ratio of the circuit pattern occupying the semiconductor wafer, and the estimation device includes the correction An estimation step of estimating a polishing rate using a value and a statistical model having the plurality of physical quantities as explanatory variables.

本発明の一態様は、コンピュータに対し、半導体ウェハを研磨する研磨機構の特性を表す複数の物理量を式の要素とする統計モデルに基づいて研磨レートを推定させるためのコンピュータプログラムであって、前記複数の物理量のそれぞれについて、前記半導体ウェハの回路パターンの配線長と、前記半導体ウェハに占める前記回路パターンの面積比と、に対応する補正値を算出する補正値算出ステップと、前記補正値と、前記複数の物理量を説明変数とする統計モデルと、を用いて研磨レートを推定する推定ステップと、を前記コンピュータに対し実行させるためのコンピュータプログラムである。   One aspect of the present invention is a computer program for causing a computer to estimate a polishing rate based on a statistical model having a plurality of physical quantities representing the characteristics of a polishing mechanism for polishing a semiconductor wafer as elements of an expression. For each of a plurality of physical quantities, a correction value calculating step for calculating a correction value corresponding to the wiring length of the circuit pattern of the semiconductor wafer and the area ratio of the circuit pattern in the semiconductor wafer, the correction value, A computer program for causing the computer to execute an estimation step of estimating a polishing rate using a statistical model having the plurality of physical quantities as explanatory variables.

本発明により、半導体ウェハ毎に異なる物理現象を共通化して、少ない統計モデルで多品種の半導体ウェハの研磨レートを精度良く推定することが可能となる。   The present invention makes it possible to share different physical phenomena for each semiconductor wafer and accurately estimate the polishing rate of various types of semiconductor wafers with a small statistical model.

半導体研磨システムの構成を表すブロック図である。It is a block diagram showing the structure of a semiconductor polishing system. 演算部の機能構成を表すブロック図である。It is a block diagram showing the function structure of a calculating part. データベース記憶部に書き込まれるセンサデータの具体例を表す図である。It is a figure showing the specific example of the sensor data written in a database memory | storage part. 補正値算出処理に用いられる配線周囲長及び表面積比の概略を表す図である。It is a figure showing the outline of wiring circumference length and surface area ratio used for a correction value calculation process. 補正値算出処理において用いられる補正値算出式を取得するための処理の流れを表すフローチャートである。It is a flowchart showing the flow of the process for acquiring the correction value calculation formula used in a correction value calculation process. 補正値の算出方法を表す概念図である。It is a conceptual diagram showing the calculation method of a correction value. 任意の回路パターンに対する補正値を算出するために用いられる補正式を取得するために用いられる測定データテーブルを表す図である。It is a figure showing the measurement data table used in order to acquire the correction formula used in order to calculate the correction value with respect to arbitrary circuit patterns. 特許文献2に開示された技術の問題点の概略を表す図である。It is a figure showing the outline of the problem of the technique disclosed by patent document 2. FIG.

図1は、半導体研磨システム100の構成を表すブロック図である。半導体研磨システム100は、研磨テーブル1、テーブルモータ2、研磨ヘッド3、ヘッドモータ4、ドレッサーヘッド5、ドレッサーモータ6、ラスリー供給器7、温度計8、データ収集部10、データベース記憶部11、演算部12を備える。なお、研磨テーブル1、テーブルモータ2、研磨ヘッド3、ヘッドモータ4、ドレッサーヘッド5、ドレッサーモータ6、ラスリー供給器7、温度計8は、半導体研磨システム100のうち、半導体研磨装置を構成する部分である。また、データ収集部10、データベース記憶部11、演算部12は、半導体研磨システム100のうち、推定装置を構成する部分である。   FIG. 1 is a block diagram showing the configuration of the semiconductor polishing system 100. The semiconductor polishing system 100 includes a polishing table 1, a table motor 2, a polishing head 3, a head motor 4, a dresser head 5, a dresser motor 6, a lassley feeder 7, a thermometer 8, a data collection unit 10, a database storage unit 11, and an operation. The unit 12 is provided. The polishing table 1, the table motor 2, the polishing head 3, the head motor 4, the dresser head 5, the dresser motor 6, the lassley feeder 7, and the thermometer 8 are parts of the semiconductor polishing system 100 that constitute the semiconductor polishing apparatus. It is. In addition, the data collection unit 10, the database storage unit 11, and the calculation unit 12 are parts that constitute an estimation device in the semiconductor polishing system 100.

研磨テーブル1は、半導体ウェハを研磨する研磨パッドを上面に搭載するテーブルである。テーブルモータ2は、研磨テーブル1を回転させるモータである。研磨ヘッド3は、搬送機能と研磨機能とを備える。搬送機能とは、半導体ウェハを、研磨面を研磨テーブル1側に向けて保持し、搬送する機能である。研磨機能とは、研磨テーブル1上の研磨パッドに対し半導体ウェハの研磨面を加圧しながら押し当てて研磨を行う機能である。ヘッドモータ4は、研磨ヘッド3を回転させるモータである。ドレッサーヘッド5は、研磨後の研磨テーブル1上の研磨パッドのドレッシングを行う。ドレッサーモータ6は、ドレッサーヘッド5を回転させるモータである。ラスリー供給器7は、研磨テーブル1上に、研磨液であるスラリーを供給する。温度計8は、研磨テーブル1上の温度の時間変化を測定する。温度計8が測定する温度の時間変化は、半導体ウェハの研磨により化学的に発生する熱と、半導体ウェハ及び研磨テーブル1の摩擦によって機械的に発生する熱と、によって発生する変化である。   The polishing table 1 is a table on which a polishing pad for polishing a semiconductor wafer is mounted on the upper surface. The table motor 2 is a motor that rotates the polishing table 1. The polishing head 3 has a conveyance function and a polishing function. The transfer function is a function of holding the semiconductor wafer while holding the polishing surface toward the polishing table 1 side. The polishing function is a function of performing polishing by pressing the polishing surface of the semiconductor wafer against the polishing pad on the polishing table 1 while applying pressure. The head motor 4 is a motor that rotates the polishing head 3. The dresser head 5 performs dressing of the polishing pad on the polishing table 1 after polishing. The dresser motor 6 is a motor that rotates the dresser head 5. The rasley feeder 7 supplies a slurry, which is a polishing liquid, onto the polishing table 1. The thermometer 8 measures the time change of the temperature on the polishing table 1. The time change of the temperature measured by the thermometer 8 is a change generated by heat generated chemically by polishing the semiconductor wafer and heat generated mechanically by friction between the semiconductor wafer and the polishing table 1.

データ収集部10は、半導体研磨システム100において生じる所定の物理現象により生じる値の時間変化を測定する。例えば、データ収集部10は、テーブルモータ2、ヘッドモータ4、ドレッサーモータ6、それぞれの回転トルクデータを、モータ毎に収集する。回転トルクデータとは、各モータにおける回転トルクの時間変化を表すデータである。また、データ収集部10は、温度計8によって測定される温度の時間変化を表すデータ(以下、「温度変化データ」という。)を収集する。そして、データ収集部10は、所定の物理現象により生じる値の時間変化を表すデータ(以下、「センサデータ」という。)をデータベース記憶部11に書き込む。センサデータの具体例として、上述した回転トルクデータや温度変化データがある。また、回転トルクデータは、モータ毎に得られるデータであり、モータ毎に異なるセンサデータである。   The data collection unit 10 measures a time change of a value caused by a predetermined physical phenomenon that occurs in the semiconductor polishing system 100. For example, the data collection unit 10 collects the rotational torque data of the table motor 2, the head motor 4, and the dresser motor 6 for each motor. Rotational torque data is data representing a temporal change in rotational torque in each motor. In addition, the data collection unit 10 collects data representing a temporal change in temperature measured by the thermometer 8 (hereinafter referred to as “temperature change data”). Then, the data collection unit 10 writes data (hereinafter referred to as “sensor data”) representing a time change of a value caused by a predetermined physical phenomenon in the database storage unit 11. Specific examples of sensor data include the above-described rotational torque data and temperature change data. The rotational torque data is data obtained for each motor, and is sensor data that differs for each motor.

データベース記憶部11は、磁気ハードディスク装置や半導体記憶装置などの記憶装置を用いて構成される。データベース記憶部11は、データ収集部10によって収集された各センサデータをデータベースとして記憶する。例えば、データベース記憶部11は、各時刻と、その時刻における各測定値とを対応付けて、時系列に沿って記憶する。   The database storage unit 11 is configured using a storage device such as a magnetic hard disk device or a semiconductor storage device. The database storage unit 11 stores each sensor data collected by the data collection unit 10 as a database. For example, the database storage unit 11 stores each time and each measurement value at that time in association with each other in time series.

演算部12は、データベース記憶部11に記憶されている各センサデータに基づいて、研磨レートを推定する。図2は、演算部12の機能構成を表すブロック図である。演算部12は、バスで接続されたCPU(Central Processing Unit)やメモリや補助記憶装置などを備える。演算部12は、推定プログラムを実行することによって、研磨データ取得部120、変換部121、目的変数管理部122、統計モデル作成部123、製品情報取得部124、予測部125を備える装置として機能する。なお、演算部12の各機能の全て又は一部は、ASIC(Application Specific Integrated Circuit)やPLD(Programmable Logic Device)やFPGA(Field Programmable Gate Array)等のハードウェアを用いて実現されても良い。   The calculation unit 12 estimates the polishing rate based on each sensor data stored in the database storage unit 11. FIG. 2 is a block diagram illustrating a functional configuration of the calculation unit 12. The calculation unit 12 includes a CPU (Central Processing Unit), a memory, an auxiliary storage device, and the like connected by a bus. The calculation unit 12 functions as an apparatus including a polishing data acquisition unit 120, a conversion unit 121, an objective variable management unit 122, a statistical model creation unit 123, a product information acquisition unit 124, and a prediction unit 125 by executing an estimation program. . Note that all or part of the functions of the arithmetic unit 12 may be realized using hardware such as an application specific integrated circuit (ASIC), a programmable logic device (PLD), or a field programmable gate array (FPGA).

研磨データ取得部120は、データベース記憶部11から各センサデータを取得する。例えば、研磨データ取得部120は、研磨中の一定時間周期で、各センサデータを取得する。変換部121は、研磨データ取得部120によって取得されたセンサデータ毎に代表値処理を行い、センサデータ毎に代表値を算出する。目的変数管理部122は、統計モデルの作成時に目的変数となる研磨レート(出来映えデータ)を保存する。研磨レートは、例えば予めテスト用の半導体ウェハを用いて試験的に研磨を行い、研磨前後のウェハ膜厚値を計測することによって、テスト用の半導体ウェハ毎に得られる。そして、研磨レートは、予め目的変数管理部122に設定される。   The polishing data acquisition unit 120 acquires each sensor data from the database storage unit 11. For example, the polishing data acquisition unit 120 acquires each sensor data at a constant time period during polishing. The conversion unit 121 performs representative value processing for each sensor data acquired by the polishing data acquisition unit 120 and calculates a representative value for each sensor data. The objective variable management unit 122 stores a polishing rate (performance data) that becomes an objective variable when a statistical model is created. The polishing rate is obtained for each semiconductor wafer for testing by, for example, conducting a trial polishing using a semiconductor wafer for testing in advance and measuring the wafer film thickness value before and after the polishing. The polishing rate is set in advance in the objective variable management unit 122.

統計モデル作成部123は、重回帰分析により研磨レートの統計モデルを作成する。このとき、統計モデル作成部123は、目的変数管理部122に保存されている研磨レートを目的変数とする。また、統計モデル作成部123は、各研磨レートが算出された際にデータ収集部10によって収集された各センサデータの代表値を説明変数とする。   The statistical model creation unit 123 creates a statistical model of the polishing rate by multiple regression analysis. At this time, the statistical model creation unit 123 uses the polishing rate stored in the objective variable management unit 122 as an objective variable. Further, the statistical model creation unit 123 uses the representative value of each sensor data collected by the data collection unit 10 when each polishing rate is calculated as an explanatory variable.

製品情報取得部124は、研磨レートの推定対象となる半導体ウェハに関する回路パターン情報(製品情報)を取得する。半導体ウェハに関する回路パターンの情報は、半導体研磨システム100の使用者や管理者などによって製品情報取得部124に対し予め与えられる。予測部125は、統計モデル作成部123によって作成された統計モデルと、変換部121によって算出される各センサデータの代表値と、製品情報取得部124によって取得される回路パターン情報と、に基づいて研磨レートの推定値を算出する。   The product information acquisition unit 124 acquires circuit pattern information (product information) related to a semiconductor wafer whose polishing rate is to be estimated. Circuit pattern information regarding the semiconductor wafer is given in advance to the product information acquisition unit 124 by a user or administrator of the semiconductor polishing system 100. The prediction unit 125 is based on the statistical model created by the statistical model creation unit 123, the representative value of each sensor data calculated by the conversion unit 121, and the circuit pattern information acquired by the product information acquisition unit 124. An estimated value of the polishing rate is calculated.

図3は、データベース記憶部11に書き込まれるセンサデータの具体例を表す図である。図3は温度変化データを表す。図3において、縦軸は測定された温度を表し、横軸は時間を表す。図3に示すように、温度変化データは、時間に対するテーブル温度(研磨テーブル1上の温度)の変化を表す二次元のデータとなる。各モータの回転トルクデータも同様に、時間に対する回転トルクの変化を表す二次元データとなる。また、その他のセンサデータも同様に、時間に対する各物理現象により生じる値の変化を表す二次元データとなる。   FIG. 3 is a diagram illustrating a specific example of sensor data written in the database storage unit 11. FIG. 3 shows temperature change data. In FIG. 3, the vertical axis represents the measured temperature, and the horizontal axis represents time. As shown in FIG. 3, the temperature change data is two-dimensional data representing a change in table temperature (temperature on the polishing table 1) with respect to time. Similarly, the rotational torque data of each motor is two-dimensional data representing a change in rotational torque with respect to time. Similarly, the other sensor data is also two-dimensional data representing a change in value caused by each physical phenomenon with respect to time.

次に、半導体研磨システム100の動作について説明する。半導体研磨システム100の動作は、前処理として統計モデルを作成する動作と、実処理として統計モデルを用いて研磨レートの推定値を算出する動作とに分けられる。まず、前処理と実処理とに共通する、データ収集部10の処理と、研磨データ取得部120の処理と、変換部121の処理とについて説明する。   Next, the operation of the semiconductor polishing system 100 will be described. The operation of the semiconductor polishing system 100 can be divided into an operation of creating a statistical model as preprocessing and an operation of calculating an estimated value of the polishing rate using the statistical model as actual processing. First, the processing of the data collection unit 10, the processing of the polishing data acquisition unit 120, and the processing of the conversion unit 121, which are common to the preprocessing and the actual processing, will be described.

データ収集部10は、半導体研磨システム100の半導体研磨装置上で生じる各種の物理現象を測定し、一定のサンプリング周期で測定結果をサンプリング(収集)する。そして、データ収集部10が、収集したセンサデータをデータベース記憶部11に書き込む。上述したように、収集されるセンサデータの具体例としては、研磨テーブル1上でウェハが研磨されている時のテーブルモータ2の回転トルクデータや、研磨テーブル1上でウェハが研磨されている時のヘッドモータ4の回転トルクデータや、研磨テーブル1上でウェハが研磨されている時の研磨テーブル1上の温度変化データや、ウェハの研磨後に行われるドレッサーヘッド5による研磨テーブル1のドレッシング時のドレッサーモータ6の回転トルクデータなどがある。   The data collection unit 10 measures various physical phenomena that occur on the semiconductor polishing apparatus of the semiconductor polishing system 100 and samples (collects) measurement results at a constant sampling period. Then, the data collection unit 10 writes the collected sensor data in the database storage unit 11. As described above, specific examples of collected sensor data include rotational torque data of the table motor 2 when the wafer is being polished on the polishing table 1 and when the wafer is being polished on the polishing table 1. Rotational torque data of the head motor 4, temperature change data on the polishing table 1 when the wafer is being polished on the polishing table 1, and dressing of the polishing table 1 by the dresser head 5 performed after polishing of the wafer. There are rotational torque data of the dresser motor 6 and the like.

研磨データ取得部120は、データベース記憶部11内に保存されている各センサデータを読み出す。変換部121は、読み出された各センサデータのそれぞれについて代表値処理を行う。代表値処理とは、予め設定された統計処理に基づいて、時系列のセンサデータから代表値を算出する処理である。予め設定された統計処理とは、例えば平均値を算出する処理や、一定時間を挟んだ二つの時刻における測定値の差分を算出する処理などである。変換部121には、設計者や使用者によって選択された統計処理が適宜設定される。変換部121は、代表値処理を、研磨処理がなされた半導体ウェハ毎に、且つ、各研磨処理で得られたセンサデータ毎に、行う。そのため、変換部121は、研磨処理がなされた半導体ウェハの数と、収集されるセンサデータの数とを乗じた数の代表値を算出する。   The polishing data acquisition unit 120 reads each sensor data stored in the database storage unit 11. The conversion unit 121 performs representative value processing for each of the read sensor data. The representative value process is a process of calculating a representative value from time-series sensor data based on a preset statistical process. The preset statistical process includes, for example, a process of calculating an average value, a process of calculating a difference between measured values at two times with a fixed time. Statistical processing selected by the designer or user is appropriately set in the conversion unit 121. The conversion unit 121 performs representative value processing for each semiconductor wafer that has been subjected to polishing processing, and for each sensor data obtained by each polishing processing. Therefore, the conversion unit 121 calculates a representative value of the number obtained by multiplying the number of semiconductor wafers subjected to the polishing process and the number of sensor data to be collected.

次に、前処理について説明する。前処理では、半導体研磨装置において、テスト用の半導体ウェハを用いて試験的に研磨が行われる。このとき、テスト用の半導体ウェハとしては、後述する基準ウェハが用いられる。各研磨において、データ収集部10が各センサデータを収集しデータベース記憶部11に書き込む。演算部12の変換部121は、研磨毎に、センサデータ毎の代表値を算出する。また、テスト用の半導体ウェハの研磨前後のウェハ膜厚値をそれぞれ計測することによって、研磨毎に研磨レートが得られる。得られた研磨レートは、目的変数管理部122に設定される。そして、統計モデル作成部123は、目的変数管理部122に設定される各研磨レートを目的変数とし、研磨毎及びに算出された各センサデータの代表値を説明変数とし、重回帰分析を行うことによって研磨レートの統計モデルを作成する。以上が前処理である。   Next, preprocessing will be described. In the pretreatment, polishing is performed on a trial basis using a test semiconductor wafer in a semiconductor polishing apparatus. At this time, a reference wafer described later is used as a test semiconductor wafer. In each polishing, the data collection unit 10 collects each sensor data and writes it in the database storage unit 11. The conversion unit 121 of the calculation unit 12 calculates a representative value for each sensor data for each polishing. Further, by measuring the wafer film thickness values before and after polishing of the test semiconductor wafer, the polishing rate can be obtained for each polishing. The obtained polishing rate is set in the objective variable management unit 122. Then, the statistical model creation unit 123 performs multiple regression analysis using each polishing rate set in the objective variable management unit 122 as an objective variable and representative values of each sensor data calculated for each polishing as explanatory variables. To create a statistical model of the polishing rate. The above is the preprocessing.

次に、実処理について説明する。実処理では、半導体研磨装置において、研磨レートを推定する対象となる半導体ウェハ(以下、「対象ウェハ」という。)を用いた研磨が行われる。この研磨において、データ収集部10が各センサデータを収集しデータベース記憶部11に書き込む。演算部12の変換部121は、センサデータ毎の代表値を算出する。   Next, actual processing will be described. In actual processing, polishing using a semiconductor wafer (hereinafter referred to as “target wafer”) whose polishing rate is to be estimated is performed in a semiconductor polishing apparatus. In this polishing, the data collection unit 10 collects each sensor data and writes it in the database storage unit 11. The conversion unit 121 of the calculation unit 12 calculates a representative value for each sensor data.

製品情報取得部124は、対象ウェハの回路パターン情報を取得する。次に、予測部125は、対象ウェハが研磨された際に収集された各センサデータの代表値を、説明変数として変換部121から取得する。次に、予測部125は、統計モデル作成部123によって予め作成された統計モデルに対し、補正処理を行う。具体的には、予測部125は、製品情報取得部124によって取得された対象ウェハの回路パターンから、配線周囲長及び表面積比を取得する。予測部125は、配線周囲長及び表面積比に基づいて補正値を算出する。そして、予測部125は、算出された補正値と、統計モデルと、変換部121から取得された説明変数とに基づいて、対象ウェハの研磨レートの推定値を算出する。   The product information acquisition unit 124 acquires circuit pattern information of the target wafer. Next, the prediction unit 125 acquires the representative value of each sensor data collected when the target wafer is polished from the conversion unit 121 as an explanatory variable. Next, the prediction unit 125 performs a correction process on the statistical model created in advance by the statistical model creation unit 123. Specifically, the prediction unit 125 acquires the wiring peripheral length and the surface area ratio from the circuit pattern of the target wafer acquired by the product information acquisition unit 124. The prediction unit 125 calculates a correction value based on the wiring peripheral length and the surface area ratio. Then, the prediction unit 125 calculates an estimated value of the polishing rate of the target wafer based on the calculated correction value, the statistical model, and the explanatory variable acquired from the conversion unit 121.

次に、予測部125の処理についてさらに詳細に説明する。予測部125の処理は、大きく分けて、補正値算出処理と、推定値算出処理とに分けられる。まず、補正値算出処理について説明する。補正値算出処理において、予測部125は、予め設定されている補正値算出式と、対象ウェハの配線周囲長及び表面積比と、に基づいて補正値を算出する。
図4は、補正値算出処理に用いられる配線周囲長及び表面積比の概略を表す図である。図4において、L1は半導体ウェハ上の回路パターンを表す。配線周囲長は、半導体ウェハ上の回路パターンL1の配線の一方の境界線L1aの全長と、他方の境界線L1bの全長との合計値である。また表面積比は、回路パターンL1の表面積S1と、半導体ウェハ上の回路パターンL1以外の部分の表面積S2との比(S1/S2)である。なお、半導体ウェハの高さ方向に表面の露出がある場合には、表面積比として高さ方向の露出表面がさらに考慮されても良い。
Next, the process of the prediction unit 125 will be described in more detail. The process of the prediction unit 125 is roughly divided into a correction value calculation process and an estimated value calculation process. First, the correction value calculation process will be described. In the correction value calculation process, the prediction unit 125 calculates a correction value based on a preset correction value calculation formula, the wiring peripheral length and the surface area ratio of the target wafer.
FIG. 4 is a diagram showing an outline of the wiring peripheral length and the surface area ratio used for the correction value calculation processing. In FIG. 4, L1 represents a circuit pattern on the semiconductor wafer. The wiring peripheral length is a total value of the total length of one boundary line L1a of the wiring of the circuit pattern L1 on the semiconductor wafer and the total length of the other boundary line L1b. The surface area ratio is a ratio (S1 / S2) between the surface area S1 of the circuit pattern L1 and the surface area S2 of the portion other than the circuit pattern L1 on the semiconductor wafer. If there is surface exposure in the height direction of the semiconductor wafer, the exposed surface in the height direction may be further considered as the surface area ratio.

図5は、補正値算出処理において用いられる補正値算出式を取得するための処理の流れを表すフローチャートである。補正値算出式は、前処理において取得され、予め予測部125に設定される。まず、回路パターンがそれぞれ異なるN個の半導体ウェハが準備される。この中から、一つの基準ウェハが選択される。以下の説明では、半導体ウェハW1が基準ウェハとして設定された場合について説明する。N個の半導体ウェハに対し、連続して研磨処理を行う(ステップS101)。このとき、データ収集部10は、各研磨におけるセンサデータを収集しデータベース記憶部11に記録する。半導体ウェハW1〜WNに対して連続して研磨処理を行った場合であっても、それぞれの半導体ウェハの研磨レートは厳密には異なる。しかしながら、研磨パッドなどの研磨に用いる消耗部材は、数枚〜数十枚の半導体ウェハの研磨処理では大きく劣化しない。そのため、半導体ウェハW1〜WNの研磨時の研磨レートは等しいものと近似できる。なお、基準ウェハW1には、想定される回路パターンの配線周囲長で最長のものが選ばれることが望ましい。   FIG. 5 is a flowchart showing a flow of processing for obtaining a correction value calculation formula used in the correction value calculation processing. The correction value calculation formula is acquired in the preprocessing and is set in the prediction unit 125 in advance. First, N semiconductor wafers having different circuit patterns are prepared. One reference wafer is selected from these. In the following description, a case where the semiconductor wafer W1 is set as a reference wafer will be described. Polishing processing is continuously performed on N semiconductor wafers (step S101). At this time, the data collection unit 10 collects sensor data in each polishing and records it in the database storage unit 11. Even when the semiconductor wafers W1 to WN are continuously polished, the polishing rates of the respective semiconductor wafers are strictly different. However, a consumable member used for polishing such as a polishing pad does not deteriorate greatly when polishing several to several tens of semiconductor wafers. Therefore, the polishing rate at the time of polishing the semiconductor wafers W1 to WN can be approximated to be equal. The reference wafer W1 is preferably selected to have the longest wiring perimeter of the assumed circuit pattern.

次に、変換部121が、ステップS101において研磨した半導体ウェハW1〜WN毎に、センサデータの代表値(説明変数)を求める(ステップS102)。本実施例では、テーブルモータ2の回転トルク、ヘッドモータ4の回転トルク、研磨テーブル1上の温度、ドレッサーモータ6の回転トルク、のそれぞれを説明変数とする。すなわち、変換部121は、各半導体ウェハの研磨毎に、各センサデータ(3つの回転トルクデータと1つの温度変化データ)について、それぞれの代表値を求める。   Next, the conversion unit 121 obtains a representative value (explanatory variable) of sensor data for each of the semiconductor wafers W1 to WN polished in step S101 (step S102). In this embodiment, the rotational torque of the table motor 2, the rotational torque of the head motor 4, the temperature on the polishing table 1, and the rotational torque of the dresser motor 6 are used as explanatory variables. That is, the converter 121 obtains a representative value for each sensor data (three rotational torque data and one temperature change data) for each polishing of each semiconductor wafer.

次に、1つの説明変数と、回路パターンの配線周囲長と、に対応する補正値Yを算出するための補正式を取得する(ステップS103)。ステップS102及びステップS103の処理を、統計モデルの作成に用いられる全ての種類の説明変数に対して行う。これらの処理によって、説明変数毎に、説明変数に対応した補正値を取得するための補正式を取得する(ステップS104)。   Next, a correction formula for calculating the correction value Y corresponding to one explanatory variable and the wiring peripheral length of the circuit pattern is acquired (step S103). The processing in step S102 and step S103 is performed on all types of explanatory variables used for creating the statistical model. Through these processes, a correction formula for acquiring a correction value corresponding to the explanatory variable is acquired for each explanatory variable (step S104).

図6は、補正値の算出方法を表す概念図である。次に、図6を用いて、各説明変数の代表値と回路パターンに対する補正式の決定方法について説明する。図6において、縦軸は、変換部121によって算出される各センサデータの代表値、すなわち説明変数を表す。また、横軸は、各半導体ウェハW1〜WNの番号を表す。Z1〜ZNは、それぞれ半導体ウェハW1〜WNを研磨した際に得られる代表値を表す。等しい研磨レートであると近似される環境で研磨された半導体ウェハW1〜WNであるが、回路パターンの違いに応じて、基準ウェハW1の代表値Z1と、他の半導体ウェハW2〜WNの代表値Z2〜ZNには差が出てしまう。そこで、本実施形態の演算部12では、同一の統計モデルを用いて、半導体ウェハW1〜WNの全てにおいて同じ推定値を得る為に、補正値を用いる。すなわち、半導体ウェハW2〜WNの代表値Z2〜ZNを、基準ウェハW1の代表値Z1と等しくなるように、以下の式1によってそれぞれの半導体ウェハの補正値Rn(n:ウェハ番号(1〜N))が予め算出される。各補正値Rnを、各代表値Znに乗じることによって、半導体ウェハW2〜WNの研磨によって得られた代表値Z2〜ZNを、Z1に一致させる。   FIG. 6 is a conceptual diagram illustrating a correction value calculation method. Next, a method for determining a correction formula for the representative value of each explanatory variable and the circuit pattern will be described with reference to FIG. In FIG. 6, the vertical axis represents a representative value of each sensor data calculated by the conversion unit 121, that is, an explanatory variable. The horizontal axis represents the numbers of the semiconductor wafers W1 to WN. Z1 to ZN represent representative values obtained when the semiconductor wafers W1 to WN are polished, respectively. Although the semiconductor wafers W1 to WN are polished in an environment that is approximated to have an equal polishing rate, the representative value Z1 of the reference wafer W1 and the representative values of the other semiconductor wafers W2 to WN are determined depending on the circuit pattern. A difference appears in Z2 to ZN. Therefore, the calculation unit 12 of the present embodiment uses the correction value in order to obtain the same estimated value in all of the semiconductor wafers W1 to WN using the same statistical model. That is, the correction values Rn (n: wafer number (1 to N) of the respective semiconductor wafers are expressed by the following formula 1 so that the representative values Z2 to ZN of the semiconductor wafers W2 to WN are equal to the representative values Z1 of the reference wafer W1. )) Is calculated in advance. By multiplying each representative value Zn by each correction value Rn, representative values Z2 to ZN obtained by polishing the semiconductor wafers W2 to WN are made to coincide with Z1.

補正値Rn=Z1/Zn ・・・・式1       Correction value Rn = Z1 / Zn (1)

図7は、任意の回路パターンに対する補正値を算出するために用いられる補正式を取得するために用いられる測定データテーブルを表す図である。次に、図7を用いて、任意の回路パターンに対する補正値を求めるための補正式の算出方法について説明する。図7に表される測定データテーブルは、各ウェハ番号に対応する回路パターンに対し、配線周囲長と、表面積比と、式1によって算出される補正値の関係とを対応付けたテーブルである。配線周囲長(L)及び表面積比(SR)の2つの値から補正値を求めるための重回帰式を求める。本実施例では、式2に示す1次式による重回帰式を適用する。   FIG. 7 is a diagram illustrating a measurement data table used to obtain a correction formula used to calculate a correction value for an arbitrary circuit pattern. Next, a calculation method of a correction formula for obtaining a correction value for an arbitrary circuit pattern will be described with reference to FIG. The measurement data table shown in FIG. 7 is a table in which the circuit pattern corresponding to each wafer number is associated with the relationship between the wiring perimeter, the surface area ratio, and the correction value calculated by Equation 1. A multiple regression equation for obtaining a correction value from two values of the wiring perimeter (L) and the surface area ratio (SR) is obtained. In this embodiment, a multiple regression equation based on a linear equation shown in Equation 2 is applied.

補正値=A1×L+A2×SR+B ・・・・式2       Correction value = A1 × L + A2 × SR + B (2)

式2において、Lは、回路パターンの配線周囲長を表す。SRは、回路パターンの表面積比を表す。A1は、配線周囲長に対する重回帰係数を表す。A2は、表面積比に対する重回帰係数を表す。Bは、切片を表す。したがって、式2の重回帰式のA1及びA2を予め求めておく事によって、補正値Rnの実測値が算出されたウェハWn以外の任意の回路パターンにおいても、回路パターンの配線周囲長及び表面積比に応じた補正値を算出することが可能となる。   In Expression 2, L represents the wiring perimeter of the circuit pattern. SR represents the surface area ratio of the circuit pattern. A1 represents a multiple regression coefficient with respect to the wiring perimeter. A2 represents a multiple regression coefficient with respect to the surface area ratio. B represents an intercept. Therefore, by obtaining A1 and A2 of the multiple regression equation of Equation 2 in advance, even in any circuit pattern other than the wafer Wn where the actual measurement value of the correction value Rn is calculated, the wiring peripheral length and the surface area ratio of the circuit pattern It is possible to calculate a correction value according to the above.

上記算出方法を、説明変数に用いるM個(M:物理現象の数)の物理現象のそれぞれにおいて行い、各説明変数の補正値Ym(mは1〜Mの値をとる)を算出するための重回帰式を算出する。上記のように、3つのモータそれぞれの回転トルクと温度とを説明変数として用いる場合には、Mは4となる。M個の式3が予め予測部125に設定される。補正値算出処理において、予測部125は、対象ウェハの配線周囲長(L)及び表面積比(SR)と、M個の式3を用いることによって、M個の補正値Y1〜YMを算出する。   The above calculation method is performed for each of M (M: number of physical phenomena) physical phenomena used as explanatory variables, and a correction value Ym (m takes a value from 1 to M) of each explanatory variable is calculated. A multiple regression equation is calculated. As described above, M is 4 when the rotational torque and temperature of each of the three motors are used as explanatory variables. M Equations 3 are set in the prediction unit 125 in advance. In the correction value calculation process, the prediction unit 125 calculates M correction values Y1 to YM by using the wiring peripheral length (L) and the surface area ratio (SR) of the target wafer and M equations 3.

Ym=A1m×L+A2m×SR+B ・・・・式3       Ym = A1m × L + A2m × SR + B (3)

式3において、Lは、回路パターンの配線周囲長を表す。SRは、回路パターンの表面積比を表す。A1mは、mによって表される物理現象に対応する、配線周囲長に対する重回帰係数を表す。A2mは、mによって表される物理現象に対応する、表面積比に対する重回帰係数を表す。Bは、切片を表す。式3を用いる事によって、任意の回路パターンにおける各説明変数に対する補正値Ymを算出することができる。   In Equation 3, L represents the wiring perimeter of the circuit pattern. SR represents the surface area ratio of the circuit pattern. A1m represents a multiple regression coefficient with respect to the wiring perimeter corresponding to the physical phenomenon represented by m. A2m represents the multiple regression coefficient for the surface area ratio corresponding to the physical phenomenon represented by m. B represents an intercept. By using Equation 3, the correction value Ym for each explanatory variable in an arbitrary circuit pattern can be calculated.

次に、推定値算出処理について説明する。式4は、一般的な重回帰分析のモデルである。式4に相当する式が、統計モデル作成部123によって予め作成されている。   Next, the estimated value calculation process will be described. Equation 4 is a general model of multiple regression analysis. A formula corresponding to Formula 4 is created in advance by the statistical model creation unit 123.

推定値=a1×E1+a2×E2+・・・+aM*EM ・・式4   Estimated value = a1 × E1 + a2 × E2 +... + AM * EM Equation 4

式4において、a1〜aMは、基準ウェハ1により作成された統計モデルの各説明変数に対する回帰係数である。EMは、推定対象となる半導体ウェハの各説明変数の代表値である。本発明の実施例では、式4に基づいて得られる式5を用いて多品種の半導体ウェハの研磨レートの推定を行い、推定値を算出する。   In Equation 4, a1 to aM are regression coefficients for each explanatory variable of the statistical model created by the reference wafer 1. EM is a representative value of each explanatory variable of the semiconductor wafer to be estimated. In the embodiment of the present invention, the polishing rate of various types of semiconductor wafers is estimated using Equation 5 obtained based on Equation 4, and the estimated value is calculated.

推定値=a1×E1×Y1+a2×E2×Y2+・・・aM×EM×YM ・・式5   Estimated value = a1 × E1 × Y1 + a2 × E2 × Y2 +... AM × EM × YM

以上のように、予測部125は、式5と、M個のセンサデータ毎の式3と、を予め記憶している。予測部125は、製品情報取得部124によって、対象ウェハの配線周囲長及び表面積比が得られると、M個の式3を用いて、センサデータ毎の補正値Ymを算出する。そして、変換部121からM個のセンタデータの代表値が得られると、各センサデータの代表値Emと、回帰係数amと、補正値Ymとを、式5に代入することによって推定値を算出する。   As described above, the prediction unit 125 stores Expression 5 and Expression 3 for each of M pieces of sensor data in advance. When the product information acquisition unit 124 obtains the wiring peripheral length and the surface area ratio of the target wafer, the prediction unit 125 calculates the correction value Ym for each sensor data using M Equations 3. When the representative values of the M pieces of center data are obtained from the conversion unit 121, the estimated value is calculated by substituting the representative value Em, the regression coefficient am, and the correction value Ym of each sensor data into Equation 5. To do.

このように構成された半導体研磨システム100では、対象ウェハの回路パターン情報である配線周囲長及び表面積比を用いて、説明変数毎に補正値Ymを算出する。そして、この補正値を用いて研磨レートの推定値を算出する。この処理により、半導体ウェハ毎に異なる物理現象を共通化して、1つの統計モデルで多品種の半導体ウェハの研磨レートを推定できる。   In the semiconductor polishing system 100 configured as described above, the correction value Ym is calculated for each explanatory variable using the wiring peripheral length and the surface area ratio which are circuit pattern information of the target wafer. Then, an estimated value of the polishing rate is calculated using this correction value. By this processing, different physical phenomena can be made common for each semiconductor wafer, and the polishing rate of various types of semiconductor wafers can be estimated with one statistical model.

なお、補正値の式2に入力する回路パターンデータは、研磨部材の特性や説明変数の特性により、それぞれのデータ毎に個別に、指数関数、対数関数、n次関数などの物理現象に則した近似式を用いて入力しても良い。
また、式4の様な重回帰モデルに適用する場合だけでなく、その他の統計モデルに適用する際にも、各物理現象を表す説明変数に対して補正を行うことにより、重回帰モデル以外の統計モデルにも適用が可能である。
以上、この発明の実施形態について図面を参照して詳述してきたが、具体的な構成はこの実施形態に限られるものではなく、この発明の要旨を逸脱しない範囲の設計等も含まれる。
Note that the circuit pattern data input to the correction value formula 2 is based on physical phenomena such as exponential functions, logarithmic functions, and n-th order functions individually for each data depending on the characteristics of the polishing member and the characteristics of the explanatory variables. You may input using an approximate expression.
Moreover, not only when applying to multiple regression models like Formula 4, but also when applying to other statistical models, by correcting the explanatory variables representing each physical phenomenon, It can also be applied to statistical models.
The embodiment of the present invention has been described in detail with reference to the drawings. However, the specific configuration is not limited to this embodiment, and includes designs and the like that do not depart from the gist of the present invention.

1…研磨テーブル, 2…テーブルモータ, 3…研磨ヘッド, 4…ヘッドモータ, 5…ドレッサーヘッド, 6…ドレッサーモータ, 7…ラスリー供給器, 8…温度計, 10…データ収集部(物理量取得部), 120…研磨データ取得部, 121…変換部, 122…目的変数管理部, 123…統計モデル作成部, 124…製品情報取得部, 125…予測部(補正値算出部、推定部) DESCRIPTION OF SYMBOLS 1 ... Polishing table, 2 ... Table motor, 3 ... Polishing head, 4 ... Head motor, 5 ... Dresser head, 6 ... Dresser motor, 7 ... Lasley feeder, 8 ... Thermometer, 10 ... Data collection part (physical quantity acquisition part) , 120 ... Polishing data acquisition unit, 121 ... Conversion unit, 122 ... Objective variable management unit, 123 ... Statistical model creation unit, 124 ... Product information acquisition unit, 125 ... Prediction unit (correction value calculation unit, estimation unit)

Claims (4)

半導体ウェハを研磨する研磨機構の特性を表す複数の物理量を式の要素とする統計モデルに基づいて研磨レートを推定する推定装置であって、
前記複数の物理量のそれぞれについて、前記半導体ウェハの回路パターンの配線長と、前記半導体ウェハに占める前記回路パターンの面積比と、に対応する補正値を算出する補正値算出部と、
前記補正値と、前記複数の物理量を説明変数とする統計モデルと、を用いて研磨レートを推定する推定部と、
を備える推定装置。
An estimation apparatus for estimating a polishing rate based on a statistical model having a plurality of physical quantities representing the characteristics of a polishing mechanism for polishing a semiconductor wafer as an element of an expression,
For each of the plurality of physical quantities, a correction value calculation unit that calculates a correction value corresponding to the wiring length of the circuit pattern of the semiconductor wafer and the area ratio of the circuit pattern occupying the semiconductor wafer;
An estimation unit that estimates a polishing rate using the correction value and a statistical model having the plurality of physical quantities as explanatory variables;
An estimation apparatus comprising:
前記研磨レートの推定対象となる半導体ウェハに対して実際に研磨が行われた際の前記複数の物理量を取得する物理量取得部をさらに備え、
前記補正値算出部は、前記推定部が用いる統計モデルを生成する際に実測値を得るために研磨された基準ウェハについて求められた物理量と、前記推定対象となる半導体ウェハの研磨によって求められた物理量との相違のうち、回路パターンの配線周囲長及び表面積比の違いによって生じる相違を解消するための値を補正値として算出する、
ことを特徴とする請求項1に記載の推定装置。
A physical quantity acquisition unit that acquires the plurality of physical quantities when polishing is actually performed on the semiconductor wafer to be estimated for the polishing rate;
The correction value calculation unit is obtained by polishing a reference wafer polished to obtain an actual measurement value when generating a statistical model used by the estimation unit and polishing the semiconductor wafer to be estimated Of the differences from the physical quantity, calculate a correction value as a value for eliminating the difference caused by the difference in the circuit pattern wiring circumference and the surface area ratio.
The estimation apparatus according to claim 1, wherein:
半導体ウェハを研磨する研磨機構の特性を表す複数の物理量を式の要素とする統計モデルに基づいて研磨レートを推定する推定装置が、前記複数の物理量のそれぞれについて、前記半導体ウェハの回路パターンの配線長と、前記半導体ウェハに占める前記回路パターンの面積比と、に対応する補正値を算出する補正値算出ステップと、
前記推定装置が、前記補正値と、前記複数の物理量を説明変数とする統計モデルと、を用いて研磨レートを推定する推定ステップと、
を備える推定方法。
An estimation device for estimating a polishing rate based on a statistical model having a plurality of physical quantities representing the characteristics of a polishing mechanism for polishing a semiconductor wafer as an element of an expression, and wiring a circuit pattern of the semiconductor wafer for each of the plurality of physical quantities A correction value calculating step for calculating a correction value corresponding to the length and the area ratio of the circuit pattern in the semiconductor wafer;
An estimation step in which the estimation device estimates a polishing rate using the correction value and a statistical model having the plurality of physical quantities as explanatory variables;
An estimation method comprising:
コンピュータに対し、半導体ウェハを研磨する研磨機構の特性を表す複数の物理量を式の要素とする統計モデルに基づいて研磨レートを推定させるためのコンピュータプログラムであって、
前記複数の物理量のそれぞれについて、前記半導体ウェハの回路パターンの配線長と、前記半導体ウェハに占める前記回路パターンの面積比と、に対応する補正値を算出する補正値算出ステップと、
前記補正値と、前記複数の物理量を説明変数とする統計モデルと、を用いて研磨レートを推定する推定ステップと、
を前記コンピュータに対し実行させるためのコンピュータプログラム。
A computer program for causing a computer to estimate a polishing rate based on a statistical model having a plurality of physical quantities representing the characteristics of a polishing mechanism for polishing a semiconductor wafer as an element of an expression,
A correction value calculating step for calculating a correction value corresponding to the wiring length of the circuit pattern of the semiconductor wafer and the area ratio of the circuit pattern in the semiconductor wafer for each of the plurality of physical quantities;
An estimation step for estimating a polishing rate using the correction value and a statistical model having the plurality of physical quantities as explanatory variables;
A computer program for causing the computer to execute.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN110520807A (en) * 2017-03-29 2019-11-29 三菱重工业株式会社 Information processing unit, information processing method and program

Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08288245A (en) * 1995-04-12 1996-11-01 Sony Corp Polishing apparatus and method
JP2000117623A (en) * 1998-10-16 2000-04-25 Tokyo Seimitsu Co Ltd Wafer grinding device
JP2003042721A (en) * 2001-07-27 2003-02-13 Hitachi Ltd Method and apparatus for measurement of film thickness of thin film as well as method of manufacturing device by using the same
JP2003163194A (en) * 2001-11-28 2003-06-06 Semiconductor Energy Lab Co Ltd Polishing method and method for manufacturing semiconductor device
JP2003224098A (en) * 2002-01-30 2003-08-08 Semiconductor Leading Edge Technologies Inc Design method of wiring, program and recording medium which records the program
JP2008258510A (en) * 2007-04-07 2008-10-23 Tokyo Seimitsu Co Ltd Polish requirement management device for cmp device and method of managing polish requirement
JP2009033105A (en) * 2007-06-25 2009-02-12 Panasonic Corp Method of manufacturing semiconductor device
JP2009170632A (en) * 2008-01-16 2009-07-30 Fujitsu Microelectronics Ltd Manufacturing method of semiconductor device, and semiconductor device manufacturing system
JP2010040918A (en) * 2008-08-07 2010-02-18 Sony Corp Method for estimating film thickness, layout design method, mask pattern designing method for exposing mask, and method for manufacturing semiconductor integrated circuit

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08288245A (en) * 1995-04-12 1996-11-01 Sony Corp Polishing apparatus and method
JP2000117623A (en) * 1998-10-16 2000-04-25 Tokyo Seimitsu Co Ltd Wafer grinding device
JP2003042721A (en) * 2001-07-27 2003-02-13 Hitachi Ltd Method and apparatus for measurement of film thickness of thin film as well as method of manufacturing device by using the same
JP2003163194A (en) * 2001-11-28 2003-06-06 Semiconductor Energy Lab Co Ltd Polishing method and method for manufacturing semiconductor device
JP2003224098A (en) * 2002-01-30 2003-08-08 Semiconductor Leading Edge Technologies Inc Design method of wiring, program and recording medium which records the program
JP2008258510A (en) * 2007-04-07 2008-10-23 Tokyo Seimitsu Co Ltd Polish requirement management device for cmp device and method of managing polish requirement
JP2009033105A (en) * 2007-06-25 2009-02-12 Panasonic Corp Method of manufacturing semiconductor device
JP2009170632A (en) * 2008-01-16 2009-07-30 Fujitsu Microelectronics Ltd Manufacturing method of semiconductor device, and semiconductor device manufacturing system
JP2010040918A (en) * 2008-08-07 2010-02-18 Sony Corp Method for estimating film thickness, layout design method, mask pattern designing method for exposing mask, and method for manufacturing semiconductor integrated circuit

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN110520807A (en) * 2017-03-29 2019-11-29 三菱重工业株式会社 Information processing unit, information processing method and program
CN110520807B (en) * 2017-03-29 2022-06-17 三菱重工业株式会社 Information processing apparatus, information processing method, and storage medium

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