JP2011044524A - Laminate, method of manufacturing the same, thin film transistor having laminate, and printed wiring board having laminate - Google Patents
Laminate, method of manufacturing the same, thin film transistor having laminate, and printed wiring board having laminate Download PDFInfo
- Publication number
- JP2011044524A JP2011044524A JP2009190716A JP2009190716A JP2011044524A JP 2011044524 A JP2011044524 A JP 2011044524A JP 2009190716 A JP2009190716 A JP 2009190716A JP 2009190716 A JP2009190716 A JP 2009190716A JP 2011044524 A JP2011044524 A JP 2011044524A
- Authority
- JP
- Japan
- Prior art keywords
- layer
- organic layer
- organic
- plating
- laminate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Abstract
Description
本発明は、積層体、その製造方法、積層体を備える薄膜トランジスタ、および積層体を備えるプリント配線基板に関する。 The present invention relates to a laminate, a manufacturing method thereof, a thin film transistor including the laminate, and a printed wiring board including the laminate.
液晶ディスプレイに代表されるフラットパネルディスプレイの金属配線の形成手法として、一般的には真空成膜法等の気相法が用いられる。しかしながら、これらの手法ではレジストなどの材料コストや真空成膜装置などの設備コストが大きい。特に、近年はパネルの大型化が進み、従来の真空成膜法で金属配線を形成しようとすると、広い面積にわたって膜厚や膜質が均一な金属膜を成膜することが困難であるうえ、大がかりな真空成膜装置が必要であるという問題点があった。 As a method for forming a metal wiring of a flat panel display typified by a liquid crystal display, a vapor phase method such as a vacuum film forming method is generally used. However, in these methods, the cost of materials such as a resist and the equipment cost of a vacuum film forming apparatus are large. In particular, in recent years, the panel has been increased in size, and it has been difficult to form a metal film having a uniform film thickness and film quality over a wide area when a metal wiring is formed by a conventional vacuum film forming method. There is a problem that a simple vacuum film forming apparatus is necessary.
この問題を解決するために、無電解めっき用塗布液を基板上に塗布して無電解めっき用塗布液の塗布膜を基板上に形成する工程と、所定のパターンを有するマスクを介して塗布膜を露光し、現像する工程と、基板を無電解めっき浴に含浸して無電解めっきを施す工程を備えた金属配線パターンの形成方法が提案されている(例えば、特許文献1)。この方法では、無電解めっき法を用いて金属配線パターン(本願におけるめっき層)を形成することにより、大がかりが装置を用いることなく低コストで、広い面積にわたって膜厚や膜質が均一な金属配線パターンを形成することができる。 In order to solve this problem, an electroless plating coating solution is applied on a substrate to form a coating film of the electroless plating coating solution on the substrate, and the coating film is passed through a mask having a predetermined pattern. A method for forming a metal wiring pattern has been proposed which includes a step of exposing and developing the substrate and a step of impregnating the substrate in an electroless plating bath and performing electroless plating (for example, Patent Document 1). In this method, a metal wiring pattern (plating layer in the present application) is formed by using an electroless plating method, so that a large-scale metal wiring pattern having a uniform film thickness and film quality over a wide area at low cost without using an apparatus. Can be formed.
しかしながら、特許文献1に記載の金属配線パターンの形成方法では、表面が平滑な基板上に金属配線パターンを形成した場合、基板と金属配線パターンとの密着性が弱いという問題点があった。
However, in the method for forming a metal wiring pattern described in
本発明は上述の課題を解決するためになされたものであり、基板とめっき層との密着性に優れた積層体、その製造方法、積層体を備える薄膜トランジスタ、および積層体を備えるプリント配線基板を提供することを目的とする。 The present invention has been made to solve the above-described problems, and includes a laminate having excellent adhesion between a substrate and a plating layer, a manufacturing method thereof, a thin film transistor provided with the laminate, and a printed wiring board provided with the laminate. The purpose is to provide.
上記目的を達成するために、請求項1に係る発明の積層体は、基板と、前記基板上面に形成され、ポリシラザンを前駆体とするアモルファスシリカ層と、前記アモルファスシリカ層上面に形成され、前記アモルファスシリカ層の上面と化学的に結合可能な有機分子を前駆体とする有機層と、前記有機層の上面に形成され、無電解めっきにより析出されためっき層とを備えている。
In order to achieve the above object, a laminate of the invention according to
また、請求項2に係る発明の積層体は、請求項1に記載の発明の構成に加え、前記有機層は、前記有機分子の自己組織化により形成される自己組織化単分子膜であることを特徴とする。
Further, in the laminate of the invention according to
また、請求項3に係る発明の積層体は、請求項1または2に記載の発明の構成に加え、前記有機分子は、無電解めっきに用いる触媒と化学的もしくは電気的に結合可能な部位を有する。
Further, in the laminate of the invention according to
また、請求項4に係る発明の積層体では、請求項1から3のいずれかに記載の発明の構成に加え、前記有機分子は、アミノ基、ピリジル基、チオール基、またはメチル基を備えることを特徴とする。
In the laminate of the invention according to
また、請求項5に係る発明の積層体は、請求項1から4のいずれかに記載の発明の構成に加え、前記有機分子は、有機シラン分子、カルボン酸、ホスホン酸、リン酸エステルのいずれかであることを特徴とする。
In addition to the constitution of the invention according to any one of
また、請求項6に係る発明の積層体は、請求項1から5のいずれかに記載の発明の構成に加え、前記めっき層は、銅、ニッケル、金、銀、白金のいずれかを少なくとも含むことを特徴とする。
Moreover, in addition to the structure of the invention according to any one of
また、請求項7に係る発明の積層体は、請求項1から5のいずれかに記載の発明の構成に加え、前記めっき層は、亜鉛、チタン、インジウム、スズのいずれかを少なくとも含み、かつ半導体特性を示す金属酸化物からなることを特徴とする。
Moreover, in addition to the structure of the invention according to any one of
また、請求項8に係る発明の積層体は、請求項1から7のいずれかに記載の発明の構成に加え、前記有機層はパターン形成され、前記めっき層は、前記有機層上面に前記有機層と同一パターンで形成されていることを特徴とする。
In addition to the configuration of the invention according to any one of
また、請求項9に係る発明の積層体の製造方法は、基板上面に、ポリシラザンを前駆体として、アモルファスシリカ層を形成するシリカ層形成工程と、前記アモルファスシリカ層上面に、前記アモルファスシリカ層の上面と化学的に結合可能な有機分子を前駆体として、有機層を形成する有機層形成工程と、前記有機層上面に、無電解めっきによりめっき層を形成するめっき層形成工程とを備えている。 The method for producing a laminate of the invention according to claim 9 includes a silica layer forming step of forming an amorphous silica layer using polysilazane as a precursor on the upper surface of the substrate, and an amorphous silica layer on the upper surface of the amorphous silica layer. An organic layer forming step of forming an organic layer using an organic molecule that can be chemically bonded to the upper surface as a precursor, and a plating layer forming step of forming a plating layer on the upper surface of the organic layer by electroless plating are provided. .
また、請求項10に係る発明の積層体の製造方法は、請求項9に記載の発明の構成に加えて、前記有機層形成工程では、前記有機層がパターン状に形成されることを特徴とする。 Moreover, the manufacturing method of the laminated body of the invention according to claim 10 is characterized in that, in addition to the configuration of the invention according to claim 9, in the organic layer forming step, the organic layer is formed in a pattern. To do.
また、請求項11に係る発明の積層体の製造方法は、請求項9または10に記載の発明の構成に加えて、前記有機層形成工程では、前記有機層が前記有機分子の自己組織化により形成されることを特徴とする。 In addition to the configuration of the invention according to claim 9 or 10, the method for manufacturing a laminate of the invention according to claim 11 is characterized in that, in the organic layer forming step, the organic layer is formed by self-organization of the organic molecules. It is formed.
また、請求項12に係る発明の薄膜トランジスタは、請求項8に記載の積層体を備えている。 According to a twelfth aspect of the present invention, a thin film transistor includes the laminate according to the eighth aspect.
また、請求項13に係る発明のプリント配線基板は、請求項8に記載の積層体を備えている。 According to a thirteenth aspect of the present invention, a printed wiring board includes the laminate according to the eighth aspect.
請求項1に係る発明の積層体では、基板に対して密着性のよいアモルファスシリカ層を、ポリシラザンを前駆体として形成することができる。また、ポリシラザンを前駆体として形成されたアモルファスシリカ層には、上面に無数の微細な凹凸が形成されるため、アモルファスシリカ層の上面に形成される有機層は、アモルファスシリカ層の上面の無数の微細な凹凸に入り込んだ状態で、アモルファスシリカ層と結合することができる。よって、アンカー効果により、アモルファスシリカ層および有機層を介して基板上に形成されるめっき層の基板に対する密着性を向上させることができる。
In the laminate of the invention according to
また、請求項2に係る発明の積層体では、請求項1に記載の発明の効果に加え、有機層は、前記有機分子の自己組織化により形成される自己組織化単分子膜であるため、有機層を均一かつ薄くすることができる。よって、有機層上面においても、アモルファスシリカ層の上面に形成された無数の微細な凹凸を反映して、同様の凹凸を形成することができる。よって、有機層と、有機層上面に形成されるめっき層との間にアンカー効果が発現し、有機層とめっき層との結合を強固なものとすることができる。よって、基板上にアモルファスシリカ層と有機層とを介して形成されるめっき層の基板に対する密着性を向上させることができる。
In the laminate of the invention according to
また、請求項3に係る発明の積層体では、請求項1または2に記載の発明の効果に加えて、前記有機分子は、無電解めっきに用いる触媒と化学的もしくは電気的に結合可能な部位を有するので、触媒は有機層上面の凹凸によるアンカー効果に加え、有機層との化学的もしくは電気的な結合によって、有機層と触媒との結合を一層強固なものにすることができる。よって、基板上にアモルファスシリカ層と有機層とを介して形成されるめっき層の基板に対する密着性を向上させることができる。更に、有機層をパターニングすることで、触媒が付与される領域を選択することができるため、任意のめっきパターンを形成することが可能となる。
Moreover, in the laminated body of the invention according to
また、請求項4に係る発明の積層体では、請求項1から3のいずれかに記載の発明の効果に加えて、前記有機分子は、アミノ基、ピリジル基、チオール基、またはメチル基を備えている。チオール基は、めっき層を構成する金属と配位結合、もしくは共有結合する。アミノ基、ピリジル基、メチル基は、めっき層形成工程において、無電解めっき触媒と電気的に結合、もしくは錯体を形成するなど化学的に結合し、めっき層の形成を促進する。よって、有機層とめっき層の結合を強固なものにすることができるため、基板上にアモルファスシリカ層と有機層とを介して形成されるめっき層の基板に対する密着性を向上させることができる。
In the laminate of the invention according to
また、請求項5に係る発明の積層体では、請求項1から4のいずれかに記載の発明の効果に加えて、前記有機分子は、有機シラン分子、カルボン酸、ホスホン酸、リン酸エステルのいずれかであるため、有機シラン分子、カルボン酸、ホスホン酸、リン酸エステルが備える加水分解基が、アモルファスシリカ層の上面と結合することができる。よって、有機層とアモルファスシリカ層の結合を強固なものにすることができるため、基板上にアモルファスシリカ層と有機層とを介して形成されるめっき層の基板に対する密着性を向上させることができる。
In addition, in the laminate of the invention according to
また、請求項6に係る発明の積層体では、請求項1から5のいずれかに記載の発明の効果に加えて、銅、ニッケル、金、銀、白金のいずれかを少なくとも含むめっき層を、基板上にアモルファスシリカ層と有機層とを介して形成することができる。めっき層は銅、ニッケル、金、銀、白金のいずれか一つからなる単層構造、または銅、ニッケル、金、銀、白金のいずれかを少なくとも含む積層構造であってもよい。これにより、導電性や耐腐食性に優れる金属膜が形成できるため、各種電子デバイスの配線や電極として利用することに適している。
Moreover, in the laminated body of the invention according to claim 6, in addition to the effect of the invention according to any one of
また、請求項7に係る発明の積層体では、請求項1から5のいずれかに記載の発明の効果に加えて、亜鉛、チタン、インジウム、スズのいずれかを少なくとも含み、かつ半導体特性を示す金属酸化物からなるめっき層を、基板上にアモルファスシリカ層と有機層とを介して形成することができる。これにより、めっき層を各種半導体デバイスの半導体層として適用することができる。
In addition to the effect of the invention according to any one of
また、請求項8に係る発明の積層体では、請求項1から7のいずれかに記載の発明の効果に加え、パターン状に形成された有機層の上面に有機層と同一パターンのめっき層が形成されているので、予めパターン状に形成した有機層の上面にのみにめっき層を形成することができる。よって、基板の上面を覆うようにめっき層を形成した後に、めっき層のパターニングを行う場合に比べて、めっき層を形成する材料やパターニングに必要なレジスト材料などの無駄がない。
In the laminated body of the invention according to claim 8, in addition to the effect of the invention according to any one of
また、請求項9に係る発明の積層体の製造方法では、シリカ層形成工程において、基板上面にポリシラザンを前駆体としてアモルファスシリカ層を形成する。ポリシラザン前駆体としてアモルファスシリカ層を形成するので、基板に対して密着性のよいアモルファス構造のシリカからなるアモルファスシリカ層を形成することができる。また、有機層形成工程において、アモルファスシリカ層上面に、アモルファスシリカ層の上面と化学的に結合可能な有機分子を前駆体として、有機層を形成する。アモルファスシリカ層の上面には、無数の微細な凹凸が形成されているので、有機層は、アモルファスシリカ層の上面の無数の微細な凹凸に入り込んだ状態で、アモルファスシリカ層と結合することができる。よって、アンカー効果により、アモルファスシリカ層および有機層を介して基板上に形成されるめっき層の基板に対する密着性を向上させることができる。 Moreover, in the manufacturing method of the laminated body of the invention concerning Claim 9, in a silica layer formation process, an amorphous silica layer is formed on a substrate upper surface using polysilazane as a precursor. Since the amorphous silica layer is formed as the polysilazane precursor, an amorphous silica layer made of silica having an amorphous structure having good adhesion to the substrate can be formed. Further, in the organic layer forming step, an organic layer is formed on the upper surface of the amorphous silica layer using an organic molecule that can be chemically bonded to the upper surface of the amorphous silica layer as a precursor. An infinite number of fine irregularities are formed on the upper surface of the amorphous silica layer, so that the organic layer can be combined with the amorphous silica layer while entering the innumerable fine irregularities on the upper surface of the amorphous silica layer. . Therefore, the adhesion of the plating layer formed on the substrate via the amorphous silica layer and the organic layer can be improved by the anchor effect.
請求項10に係る発明の積層体の製造方法では、請求項9に記載の発明の効果に加え、有機層形成工程では、有機層がパターン状に形成されるため、めっき層形成工程においては、通常の無電解めっきプロセスにより、めっき層をパターン状に形成された有機層の上面にのみ選択的に形成することができる。よって、基板上面を覆うようにめっき層を形成した後、めっき層のパターニングを行う場合に比べて、めっき層を形成する材料やパターニングに必要なレジスト材料などの無駄がない。また、基板上面を覆うようにめっき層を形成した後、めっき層のパターニングを行う場合に比べて少ない工程でパターン状のめっき層を形成することができる。 In the manufacturing method of the laminated body of the invention according to claim 10, in addition to the effect of the invention of claim 9, in the organic layer forming step, the organic layer is formed in a pattern, so in the plating layer forming step, The plating layer can be selectively formed only on the upper surface of the organic layer formed in a pattern by a normal electroless plating process. Therefore, compared to the case where the plating layer is patterned after forming the plating layer so as to cover the upper surface of the substrate, there is no waste of the material for forming the plating layer, the resist material necessary for the patterning, and the like. Moreover, after forming a plating layer so that the upper surface of a board | substrate may be covered, a pattern-shaped plating layer can be formed in a process fewer compared with the case where patterning of a plating layer is performed.
請求項11に係る発明の積層体の製造方法では、請求項9または10に記載の発明の効果に加え、有機層形成工程では、有機層が有機分子の自己組織化により形成されるため、有機層の厚さを均一かつ薄くすることができる。よって、有機層の上面に、アモルファスシリカ層の上面を反映した微細な凹凸を形成することができる。よって、有機層と、有機層上面に形成されるめっき層との間にアンカー効果が発現し、有機層とめっき層との結合を強固なものとすることができる。また、選択する有機分子に応じて、有機層の上面の化学的性質を制御することができる。 In the manufacturing method of the laminated body of the invention according to claim 11, in addition to the effect of the invention of claim 9 or 10, in the organic layer forming step, the organic layer is formed by self-organization of organic molecules. The thickness of the layer can be made uniform and thin. Therefore, fine unevenness reflecting the upper surface of the amorphous silica layer can be formed on the upper surface of the organic layer. Therefore, an anchor effect appears between the organic layer and the plating layer formed on the upper surface of the organic layer, and the bond between the organic layer and the plating layer can be strengthened. Further, the chemical properties of the upper surface of the organic layer can be controlled according to the organic molecule to be selected.
また、請求項12に記載の薄膜トランジスタは、請求項8に記載の積層体を備えている。よって、基板に対して密着性の良いめっき層を備える薄膜トランジスタを提供することができる。たとえば、積層体のめっき層を薄膜トランジスタの電極として適用すれば、剥離しにくい電極を備える薄膜トランジスタを提供できる。積層体のめっき層を薄膜トランジスタの半導体層として適用すれば、剥離しにくい半導体層を備える薄膜トランジスタを提供できる。 A thin film transistor according to a twelfth aspect includes the laminate according to the eighth aspect. Thus, a thin film transistor including a plating layer with good adhesion to a substrate can be provided. For example, when a plating layer of a laminate is applied as an electrode of a thin film transistor, a thin film transistor including an electrode that is difficult to peel can be provided. When the plated layer of the stacked body is applied as a semiconductor layer of a thin film transistor, a thin film transistor including a semiconductor layer that is difficult to peel can be provided.
請求項13に記載のプリント配線基板は、請求項8に記載の積層体を備えている。よって、基板に対して密着性の良いめっき層を備えるプリント配線基板を提供することができる。 A printed wiring board according to a thirteenth aspect includes the laminate according to the eighth aspect. Therefore, a printed wiring board provided with a plating layer with good adhesion to the board can be provided.
以下、本発明の一実施形態である積層体1について、図1から図12を参照して説明する。本実施形態の積層体1は、基板2の上面に、ポリシラザンを前駆体とするシリカ層3及び自己組織化形成膜からなる有機層4を介して、めっき層5が形成される点に特徴を有する。
Hereinafter, the
はじめに、積層体1の断面構造について、図1を参照して説明する。以下の説明では、図1の下側(基板2側)を積層体1の下側、図1の上側を積層体1の上側として説明する。積層体1は、板状の基板2を有し、基板2の上面には、ポリシラザンを前駆体とするシリカ層3が形成されている。シリカ層3の上面には、シリカ層3を覆うように有機層4が形成されている。有機層4の上面には、有機層4を覆うように、めっき層5が形成されている。
First, the cross-sectional structure of the
次に、積層体1を構成する各層の材質について説明する。基板2について説明する。基板2は、表面が平坦である板状部材である。基板2の材質としては、絶縁性の材質が用いられ、具体的には、ガラス基板やシリコン基板のほか、プラスチック基板が用いられる。基板2に可撓性を付与したい場合には、特に、基板2の材質としてプラスチックが採用される。プラスチックの材質としては、例えば、ポリエーテルスルホン(PES)、ポリエチレンテレフタレート(PET)、ポリイミド(PI)、ポリエチレンナフタレート(PEN)、ポリエーテルイミド(PEI)、ポリスチレン(PS)、ポリ塩化ビニル(PVC)、ポリエチレン(PE)、ポリプロピレン(PP)等が挙げられる。基板2の耐水性やガスバリア性を向上させる場合には、基板2の表面にSiO2やSiNxなどからなるバリア膜が形成される。
Next, the material of each layer which comprises the
シリカ層3について説明する。シリカ層3は、高純度のシリカガラス(SiO2)から形成されている。シリカ層3の構造は、周期的には配列した結晶構造を持たない非晶質(アモルファス)構造である。シリカ層3の上面には、無数の微細な凹凸が形成されている。このシリカ層3は、後述するようにパーヒドロポリシラザンを前駆体として形成される。
The
有機層4について説明する。有機層4は、自己組織化単分子膜である。本発明において「自己組織化単分子膜」とは、膜形成面(本実施形態においては、シリカ層3の上面)の構成原子と結合可能な官能基が直鎖分子に結合されている化合物を、気体または液体の状態で膜形成面と共存させることにより、前記官能基が膜形成面に吸着して膜形成面の構成原子と結合し、直鎖分子を外側に向けて形成された緻密な単分子膜であると定義される。なお、有機層4を構成する自己組織化単分子膜は、ほぼ完全な単分子膜となっていることが好ましいが、実質上、3分子膜、5分子膜のように、単分子でない部分を含んでいても良い。
The
有機層4の前駆体としては、後述する無電解めっき中の金属または、無電解めっき触媒と、化学的または電気的に結合可能な部位を有するとともに、シリカ層3の上面の構成原子と結合可能な官能基を有する有機化合物が用いられる。具体的には、有機化合物として、アミノ基、ピリジル基、チオール基、メチル基のいずれかを備える有機シラン分子、カルボン酸、ホスホン酸、リン酸エステルが適用可能である。有機シラン分子、カルボン酸、ホスホン酸、リン酸エステルが備える加水分解基が、シリカ層3の上面と結合する。チオール基が、後述するめっき層5を構成する金属原子と配位結合、もしくは共有結合する。アミノ基、ピリジル基、メチル基が、後述する無電解めっき触媒と電気的に結合、もしくは錯体を形成するなど化学的に結合し、めっき層5の形成を促進する。
The precursor of the
めっき層5について説明する。めっき層5は、無電解めっき法により形成され、銅、ニッケル、金、銀、白金のいずれかを少なくとも含む金属層、もしくは亜鉛、チタン、インジウム、スズのいずれかを少なくとも含み、かつ半導体特性を示す金属酸化物層である。
The
<第一実施例>
以下、上述の実施形態の第一実施例である積層体1について、図1から図5を参照して説明する。本実施例の積層体1は、有機層4がアミノ基を有するシランカップリング剤により形成されている点、めっき層5がNiにより形成されている点に特徴を有する。
<First Example>
Hereinafter, the
はじめに、積層体1の構造および材質について、図1を参照して説明する。積層体1は、無アルカリガラスからなる基板2を備える。基板2の上面に、アモルファス構造のシリカ層3が形成されている。シリカ層3の上面には、自己組織化単分子膜である有機層4が形成されている。本実施例の有機層4はアミノ基を有するシランカップリング剤により形成されている。具体的には、シランカップリング剤として、3−アミノプロピルトリメトキシシランが用いられる。有機層4の上面には、Niからなるめっき層5が形成されている。めっき層5の厚さは、一例として約150nmである。
First, the structure and material of the
次に、上記構造の積層体1の製造工程について、図2から図5を参照して説明する。積層体1の製造工程は、図2に示すように、シリカ層3を形成するシリカ層形成工程(S1)と、有機層4を形成する有機層形成工程(S2)と、めっき層5を形成するめっき層形成工程(S3)とを備えている。めっき層工程(S3)は、触媒付与工程(S4)と、めっき層形成工程(S5)とを備えている。以下、各工程について詳細に説明する。
Next, the manufacturing process of the
はじめに、シリカ層形成工程(S1)について説明する。シリカ層形成工程(S1)では、図3に示すように、基板2の上面を覆うようにシリカ層3を形成する。シリカ層形成工程(S1)では、パーヒドロポリシラザンを含有するシリカ層形成用溶液を、基板2の上面に塗布した後、熱処理を行う。本実施例では、シリカ層形成用溶液として、クリアントジャパン社製のアクアミカ(登録商標)を用いた。シリカ層形成用溶液を基板2の上面に塗布する塗布法としては、スピンコート法を採用した。熱処理は、基板2をホットプレートの上面に乗せて、70℃で10分間、120℃で10分間、150℃で60分間加熱することにより行った。シリカ層3の厚さは一例として50nmである。こうして、図3に示すように、基板2の上面にシリカ層3が形成された構造体71が形成される。
First, the silica layer forming step (S1) will be described. In the silica layer forming step (S1), the
ここで、パーヒドロポリシラザンについて説明する。パーヒドロポリシラザン(Perhydro−polysilazane)は、−(SiH2NH)−を基本ユニットとするポリシラザンの一種で、側鎖すべてが水素である。パーヒドロポリシラザンは、有機溶剤に可溶な無機ポリマーであるので、有機溶剤と混合させることで液体材料として取り扱うことが可能となる。パーヒドロポリシラザンは、大気中または水蒸気含有雰囲気で焼成されることにより、水や酸素と反応し、SiO2膜へ転化する性質を有している。特に、水分との反応を促進させるアミン系触媒を少量添加することによって、低温焼成でも、結晶性の高いSiO2膜へ転化させることができる。パーヒドロポリシラザンと触媒とを有機溶媒に添加した溶液を用いることにより、塗布法でのSiO2膜の形成が可能となる。また、パーヒドロポリシラザンから形成されるSiO2膜は、周期的に配列した結晶構造を持たない非晶質(アモルファス)構造である。シリカ層3をパーヒドロポリシラザンを用いて形成することにより、シリカ層3の上面に、無数の微細な凹凸を形成することができる。
Here, perhydropolysilazane will be described. Perhydropolysilazane (Perhydro-polysilazane) is a kind of polysilazane having — (
次に、有機層形成工程(S2)について説明する。有機層形成工程(S2)では、図4に示すように、構造体71におけるシリカ層3の上面に自己組織化単分子膜からなる有機層4を形成する。有機層形成工程(S2)では、まず、前処理として、構造体71(図3参照)におけるシリカ層3上面に紫外線を照射するUV処理を行う。そして、構造体71を、エタノールを溶剤とした1mmol/lの3−アミノプロピルトリメトキシシラン溶液に30分含浸させたあと、120度で焼成する。こうして、図4に示すように、基板2の上面にシリカ層3が積層され、シリカ層3の上面に有機層4が積層された構造体72が形成される。構造体72の、有機層4においては、アミノ基を上側に向けて自己組織化単分子膜が形成されている。
Next, the organic layer forming step (S2) will be described. In the organic layer forming step (S2), as shown in FIG. 4, the
めっき層形成工程(S3)について説明する。図2に示すように、めっき層工程(S3)は、触媒付与工程(S4)と、めっき層形成工程(S5)とを備えている。 The plating layer forming step (S3) will be described. As shown in FIG. 2, the plating layer step (S3) includes a catalyst application step (S4) and a plating layer formation step (S5).
触媒付与工程(S4)について説明する。触媒付与工程(S4)では、有機層4のアミノ基とPd−Snコロイドとが電気的に結合することで、構造体72の有機層4の上面に、無電解めっき触媒としてのパラジウムが付着する。具体的には、まず、構造体72(図4参照)を、Pd−Snコロイド液(上村工業社製、PED−104およびAT−105)に室温で3分間浸漬させる。次に、構造体72を純水で洗浄する。その後、アクセレータ液(上村工業社製、AL−106)に2分間含浸させる。最後に構造体72を純水で洗浄する。これにより、有機層4の表面に無電解めっき触媒としてのパラジウムが付着する。
A catalyst provision process (S4) is demonstrated. In the catalyst application step (S4), the amino group of the
次に、めっき工程(S5)について説明する。めっき工程(S5)では、パラジウムが付着された有機層4の上面にめっき層5を形成する。具体的には、温度80℃の無電解ニッケルめっき浴(上村工業社製NPR−4M、NPR−4D、NPR−4A)に、無電解めっき触媒としてのパラジウムが付着した構造体72を7分間浸漬させた後、純水で洗浄した。これにより、厚さ1μmのめっき層5が、有機層4を覆うように形成される。こうして、積層体1が形成される。
Next, the plating step (S5) will be described. In the plating step (S5), the
このようにして形成された積層体1のめっき層5の密着性について試験を行った。以下、密着性試験の方法、および結果について、図5を参照して説明する。
A test was performed on the adhesion of the
密着性試験は、JIS H−8504の引きはがし試験方法に従って行った。この試験方法では、形成しためっき層の表面に刃物で2mm間隔程度の碁盤目を入れる。次いで、粘着性のあるテープを気泡ができないように碁盤目上に貼り付け、これを引き剥がす。そして、テープの付着面にNiめっきが付着している場合には、めっき層5の基板2に対する密着性が不良であると判断し、テープの付着面にNiめっきが付着していない場合には、めっき層5の基板2に対する密着性が良好であると判断する。
The adhesion test was carried out according to a test method for peeling JIS H-8504. In this test method, a grid of about 2 mm intervals is made with a blade on the surface of the formed plating layer. Next, an adhesive tape is stuck on the grid so as not to generate air bubbles, and then peeled off. And when Ni plating has adhered to the adhesion surface of a tape, it judges that the adhesiveness with respect to the board |
この密着性試験の結果、めっき層からテープを引き剥がした後のテープの付着面には、Niめっきは付着していなかった。また、図5に示す写真のように、積層体1では、テープを引き剥がした後にも碁盤目が残っており、めっき層の剥離が見られなかった。従って、密着性は良好と判断できる。
As a result of this adhesion test, the Ni plating did not adhere to the adhesion surface of the tape after the tape was peeled off from the plating layer. Further, as shown in the photograph shown in FIG. 5, in the
積層体1では、基板2の上面に、ポリシラザンを前駆体としてシリカ層3を形成している。ポリシラザンをシリカ層3の前駆体として用いることにより、基板2と密着性の良いシリカ層3を基板2の上面に形成することができる。また、シリカ層3は上面に無数の微細な凹凸が形成されている。有機層4は、シリカ層3の上面の無数の微細な凹凸に入り込んだ状態で、シリカ層3と化学的に結合しているため、シリカ層3と有機層4との結合は強固である。
In the
また、自己形成単分子膜から形成されている有機層4の厚さは均一かつ薄いので、有機層4の上面にも、シリカ層3の上面に形成されている微細な凹凸を反映した凹凸が形成される。そのため、有機層4とめっき層5との間に、アンカー効果が発現する。基板2とシリカ層3、シリカ層3と有機層4、有機層4とめっき層5の密着性を向上させることができるので、基板2に対するめっき層5の密着性を向上させることができたものと考えられる。
Moreover, since the thickness of the
次に、比較のために、シリカ層3を備えない積層体1Bについて製造し、めっき層5Bを製造する過程でめっき層5Bの状態を目視した結果について、図6および図7を参照して説明する。まず、積層体1Bの断面構造について説明する。図6に示すように、積層体1Bは、基板2Bの上面に有機層4Bが形成され、有機層4Bの上面にめっき層5Bが形成されている。すなわち、積層体1Bの構造は、シリカ層3を備えないこと以外は、積層体1(図1参照)と同様である。また、積層体1Bの製造工程は、シリカ層形成工程(S1)(図2参照)を備えないこと以外は積層体1の製造工程に対して、同一である。
Next, for comparison, the result of visual observation of the state of the
次に、積層体1Bを製造する過程でめっき層5Bの状態を目視した結果について、説明する。図7に示すように、比較例の積層体1Bでは、めっき工程(S5)において、めっき層5Bの一部が膜厚が100nmにも満たない程度で基板2と密着しないで浮いてしまう、所謂「フクレ」が生じてしまった。これは、シリカ層3を備えない積層体1Bにおいては、基板2Bと有機層4Bとの間や有機層4Bとめっき層5Bとの間に、積層体1のようなアンカー効果が発現せず、めっき層5Bの基板2Bに対する密着性が不良であったためと考えられる。更にめっき浴に浸漬すると、めっき層5Bは膜厚が150nmにも満たない程度でめっき液中で完全に剥離した。一方、上述したように、シリカ層3を備えている場合には、厚さ1μmまで膜厚を増加しても、めっき層5が剥離することなく形成されること確認している。これにより、シリカ層3を形成することにより、フクレの発生及びめっき液中での剥離を抑制でき、めっき層5の密着性を向上させることができることが示唆された。
Next, the result of visually observing the state of the
<第二実施例>
次に、上述の実施形態の第二実施例である積層体11について、図8から図11を参照して説明する。積層体11の構造は、有機層14がパターニング形成されている点、めっき層15が有機層14の上面に有機層14と同一パターンで形成されている点で第一実施例の積層体1とは異なる。また、積層体11の製造工程は、シリカ層3の上面にパターン状の有機層14が形成される有機層パターン形成工程(S22)を備える点で、第一実施例の積層体1とは異なる。以下、第一実施例と異なる点についてのみ重点的に説明を行い、第一実施例と同一の箇所については、説明を省略または簡略化する。
<Second Example>
Next, the laminated body 11 which is the 2nd Example of the above-mentioned embodiment is demonstrated with reference to FIGS. The structure of the laminated body 11 is the same as that of the
はじめに、第二実施例の積層体11の構造および材質について、図8を参照して説明する。積層体11は、無アルカリガラスからなる基板2の上面に、アモルファス構造のシリカ層3が形成され、シリカ層3の上面にパターニングされた有機層14が形成される。そして、パターニング形成された有機層14の上面には、Niからなるめっき層15が、有機層14と同一パターンで形成されている。第二実施例における有機層14は、第一実施例と同様に、アミノ基を有するシランカップリング剤を前駆体として形成されている。具体的には、シランカップリング剤として、3−アミノプロピルトリメトキシシランが用いられる。
First, the structure and material of the laminate 11 of the second embodiment will be described with reference to FIG. In the laminate 11, the
次に、第二実施例の積層体11の製造工程について、図9から図11を参照して説明する。積層体11の製造工程は、図9に示すように、シリカ層3を形成するシリカ層形成工程(S21)と、有機層14をパターン形成する有機層パターン形成工程(S22)と、めっき層15を形成するめっき層形成工程(S23)とを備えている。
Next, the manufacturing process of the laminated body 11 of a 2nd Example is demonstrated with reference to FIGS. As shown in FIG. 9, the manufacturing process of the laminate 11 includes a silica layer forming process (S 21) for forming the
シリカ層形成工程(S21)は、第一実施形態におけるシリカ層形成工程(S1)と同様であるため、説明を省略する。シリカ層形成工程(S21)によって、第一実施例と同様に、基板2の上面にシリカ層3が形成された構造体71(図3参照)が形成される。
Since the silica layer forming step (S21) is the same as the silica layer forming step (S1) in the first embodiment, the description thereof is omitted. By the silica layer forming step (S21), a structure 71 (see FIG. 3) in which the
有機層パターン形成工程(S22)について、図10を参照して説明する。有機層パターン形成工程(S22)では、まず、前処理として、構造体71(図3参照)におけるシリカ層3の上面に紫外線を照射するUV処理を行う。そして、図10に示すように、マイクロコンタクトプリント法により、パターン化された有機層14を、シリカ層3の上面に形成する。具体的には、パターン状に凸部が形成されたスタンプ20の凸面75に、エタノールを溶剤とした5mmol/lの、3−アミノプロピルトリメトキシシラン溶液を塗布する。そして、N2を用いてエタノールを揮発させたあと、凸面75をシリカ層3の上面に密着させる。その後、120度で焼成する。こうして、図11に示すように、パターン化された有機層14がシリカ層3の上面に形成された構造体73が形成される。
An organic layer pattern formation process (S22) is demonstrated with reference to FIG. In the organic layer pattern forming step (S22), first, as a pretreatment, a UV treatment for irradiating the upper surface of the
めっき層形成工程(S23)について説明する。図9に示すように、めっき層工程(S23)は、触媒付与工程(S24)と、めっき工程(S25)とを備えている。触媒付与工程(S24)では、構造体73の有機層14の上面に、無電解めっき触媒としてのパラジウムを付着させる。具体的には、まず、構造体73(図4参照)を、Pd−Snコロイド液(上村工業社製、PED−104およびAT−105)に室温で3分間浸漬させる。次に、構造体73を純水で洗浄する。その後、アクセレータ液(上村工業社製、AL−106)に2分間含浸させる。最後に構造体73を純水で洗浄する。こうして、構造体73における有機層14の上面に、無電解めっき触媒としてのパラジウムを付着させる。 The plating layer forming step (S23) will be described. As shown in FIG. 9, the plating layer step (S23) includes a catalyst application step (S24) and a plating step (S25). In the catalyst application step (S24), palladium as an electroless plating catalyst is attached to the upper surface of the organic layer 14 of the structure 73. Specifically, first, the structure 73 (see FIG. 4) is immersed in a Pd—Sn colloidal liquid (manufactured by Uemura Kogyo Co., Ltd., PED-104 and AT-105) for 3 minutes at room temperature. Next, the structure 73 is washed with pure water. Thereafter, it is impregnated with an accelerator solution (AL-106 manufactured by Uemura Kogyo Co., Ltd.) for 2 minutes. Finally, the structure 73 is washed with pure water. Thus, palladium as an electroless plating catalyst is attached to the upper surface of the organic layer 14 in the structure 73.
次に、めっき工程(S25)について説明する。めっき工程(S25)では、パラジウムが付着された有機層14の上面にめっき層15を形成する。具体的には、温度80℃の無電解ニッケルめっき浴(上村工業社製NPR−4M、NPR−4D、NPR−4A)に、無電解めっき触媒としてのパラジウムが付着した構造体73を1分間浸漬させた後、純水で洗浄した。 Next, the plating step (S25) will be described. In the plating step (S25), the plating layer 15 is formed on the upper surface of the organic layer 14 to which palladium is attached. Specifically, the structure 73 with palladium attached as an electroless plating catalyst is immersed in an electroless nickel plating bath (NPR-4M, NPR-4D, NPR-4A manufactured by Uemura Kogyo Co., Ltd.) at a temperature of 80 ° C. for 1 minute. And then washed with pure water.
構造体73では、パターン形成された有機層14の表面にアミノ基が存在する。触媒付与工程(S24)では、このアミノ基とPd−Snコロイドとが電気的に結合するので、パターン形成された有機層14の表面のみにパラジウムが付着する。そして、めっき工程(S25)では、このパラジウム付着部分にめっき浴中の金属が付着し、めっき層15が形成される。これにより、パターン形成された、厚さ150nmのめっき層15が形成される。こうして、第二実施例の積層体11(図8参照)が形成される。 In the structure 73, an amino group exists on the surface of the patterned organic layer. In the catalyst application step (S24), this amino group and the Pd—Sn colloid are electrically bonded, so that palladium adheres only to the surface of the patterned organic layer. In the plating step (S25), the metal in the plating bath adheres to the palladium adhering portion, and the plating layer 15 is formed. As a result, a plated layer 15 having a thickness of 150 nm is formed. In this way, the laminated body 11 (refer FIG. 8) of a 2nd Example is formed.
第二実施例の積層体11についても、第一実施例の積層体1と同様に、めっき層15の基板2に対する密着性を向上させることができる。また、パターン化された有機層14は、マイクロコンタクトプリント法により形成されるので、簡単にパターン状の有機層14を形成することができる。しかも、予めパターン状に形成された有機層14の上面にめっき層15を形成するので、構造体73を覆うように金属薄膜を形成した後にパターニングを行い、めっき層15を形成する場合に比べて、金属材料やパターニングに必要なレジスト材料などの無駄がない。
Also about the laminated body 11 of 2nd Example, the adhesiveness with respect to the board |
<第三実施例>
次に、上述の実施形態の第三実施例である積層体21について、図8、図11、および図12を参照して説明する。図8に示すように、積層体21の構造は、第二実施例の積層体11の構造と同一である。積層体21の材質は、有機層24がチオール基を有するシランカップリング剤により形成されている点、めっき層25がCuにより形成されている点で、第二実施例の積層体11とは異なる。また、図12に示すように、積層体21の製造工程は、有機層パターン形成工程(S32)が、自己組織化単分子膜形成工程(S33)とパターニング工程(S34)とを備える点で、第二実施例とは異なる。以下、第二実施例と異なる点についてのみ重点的に説明を行い、第二実施例と同一の箇所については、説明を省略または簡略化する。
<Third embodiment>
Next, the
積層体21の断面構造については、第二実施例の積層体11(図8参照)と同様であるため、説明を省略する。
Since the cross-sectional structure of the
積層体21を構成する各層の材質について説明する。基板2およびシリカ層3の材質は、第二実施例の積層体11と同様であるため、説明を省略する。有機層24は、チオール基を有するシランカップリング剤により形成されている。具体的には、シランカップリング剤として、3−メルカプトプロピルトリメトキシシランが用いられる。めっき層25は、Cuからなる。
The material of each layer which comprises the
次に、上記構造の積層体21の製造工程について、図12を参照して説明する。積層体21の製造工程は、図12に示すように、シリカ層3を形成するシリカ層形成工程(S31)と、有機層24をパターン状に形成する有機層パターン形成工程(S32)と、めっき層25を形成するめっき層形成工程(S35)とを備えている。有機層パターン形成工程(S32)は、自己組織化単分子膜形成工程(S33)と、パターニング工程(S34)とを備えている。以下、各工程について詳細に説明する。
Next, the manufacturing process of the
シリカ層形成工程(S31)は、第一実施例、第二実施例のシリカ層形成工程(S1、S21)と同様であるため、説明を省略する。シリカ層形成工程(S31)により、第一実施例、第二実施例と同様に、基板2の上面にシリカ層3が形成された構造体71(図3参照)が形成される。
Since the silica layer forming step (S31) is the same as the silica layer forming step (S1, S21) of the first and second examples, the description thereof is omitted. By the silica layer forming step (S31), a structure 71 (see FIG. 3) in which the
次に、有機層パターン形成工程(S32)について説明する。有機層パターン形成工程(S32)は、図12に示すように、構造体71におけるシリカ層3の上面に自己組織化単分子膜を形成する自己組織化単分子膜形成工程(S33)と、形成された自己組織化単分子膜をパターニングするパターニング工程(S34)とを備える。
Next, an organic layer pattern formation process (S32) is demonstrated. The organic layer pattern forming step (S32) includes a self-assembled monolayer forming step (S33) for forming a self-assembled monolayer on the upper surface of the
自己組織化単分子膜形成工程(S33)について説明する。自己組織化単分子膜形成工程(S33)では、まず、前処理として、構造体71におけるシリカ層3の上面に紫外線を照射するUV処理を行う。そして、構造体71を、エタノールを溶剤とした1mmol/lの3−メルカプトプロピルトリメトキシシラン溶液に30分含浸させたあと、120度で焼成する。こうして、シリカ層3を覆うように、自己組織化単分子膜からなる有機層24を形成する。有機層24においては、チオール基を上側に向けて、自己組織化単分子膜が形成されている。
The self-assembled monomolecular film forming step (S33) will be described. In the self-assembled monomolecular film forming step (S33), first, as a pretreatment, a UV treatment for irradiating the upper surface of the
パターニング工程(S34)について説明する。パターニング工程(S34)では、自己組織化単分子膜形成工程(S33)で形成された有機層24をパターニングする。本実施例では、真空条件下において、石英ガラスをベースとしたフォトマスクを介して、形成された有機層24に、波長λ=172nmの紫外線を照射することにより、有機層24のパターニングを行った。こうして、基板2、シリカ層3、およびパターニングされた有機層24が積層された構造体74が形成される。
The patterning step (S34) will be described. In the patterning step (S34), the
めっき層形成工程(S35)について説明する。めっき層形成工程(S35)では、構造体74を、温度50℃、pH7.0の無電解銅めっき浴に3分間浸漬することにより、有機層24の上面にめっき層25を形成する。無電解銅めっき浴の組成は以下のとおりである。
・CuCl2・2H2O : 0.05mol/l、
・EDTA・2Na : 0.05mol/l、
・H3BO4 : 0.1mol/l、
・CuCl2/2H2O : 0.1mol/l
構造体74においては、有機層24の表面にチオール基が存在する。チオール基が、無電解銅めっき浴の銅イオンと結合することにより、有機層24の上面にCuからなるめっき層25を形成することができる。以上のS31からS35の工程を経て、積層体21が形成される。
The plating layer forming step (S35) will be described. In the plating layer forming step (S35), the structure 74 is immersed in an electroless copper plating bath having a temperature of 50 ° C. and a pH of 7.0 for 3 minutes, thereby forming the
CuCl2 · 2H2O: 0.05 mol / l,
EDTA · 2Na: 0.05 mol / l,
H3BO4: 0.1 mol / l,
CuCl2 / 2H2O: 0.1 mol / l
In the structure 74, a thiol group exists on the surface of the
第三実施例の積層体21によれば、有機層24がチオール基を備える自己組織化単分子膜から形成されている。チオール基は、金属と共有結合または配位結合するので、めっき形成工程において有機層24上面のチオール基とめっき液中の銅が結合する。有機層24上面に結合した銅自体が触媒効果を有するため、触媒付与工程を用いることなく有機層24の上面にめっき層25を形成させることができる。よって、製造工程を簡略化することができる。
According to the
次に、上述した積層体11と同様の積層構造を備えた、本発明の一実施形態である薄膜トランジスタ100について、図13を参照して説明する。以下の説明では、図13の下側(基板102側)を薄膜トランジスタ100の下側、図13の上側を薄膜トランジスタ100の上側として説明する。薄膜トランジスタ100は、ゲート電極110が、ソース電極105やドレイン電極106より上側に位置する、所謂「トップゲート型」の薄膜トランジスタである。
Next, a
薄膜トランジスタ100の断面構造について説明する。薄膜トランジスタ100は、板状の基板102を有し、基板102の上面には、シリカ層103が設けられている。シリカ層103の上面には、パターニングされた有機層104が設けられ、有機層104の上面には、ソース電極105およびドレイン電極106が設けられている。ソース電極105とドレイン電極106との間には、ソース電極105とドレイン電極106とを埋めるように、半導体層107が設けられている。
A cross-sectional structure of the
ソース電極105、ドレイン電極106、半導体層107、シリカ層103の上面には、絶縁層111が設けられている。絶縁層111の上面には、シリカ層108が設けられている。シリカ層108の上面には、パターニングされた自己組織化形成膜からなる有機層109が設けられ、有機層109の上面には、ゲート電極110が設けられている。
An insulating
基板102、シリカ層103、有機層104、ソース電極105・ドレイン電極106の積層構造は、上述の積層体11と同一の積層構造である。すなわち、基板102、シリカ層103、有機層104、ソース電極105、ドレイン電極106の材質として採用可能な材質は、上述した積層体11の基板2、シリカ層3、有機層4、めっき層5と同様である。また、シリカ層103、有機層104、ソース電極105、ドレイン電極106の形成方法は、上述した積層体11のシリカ層3、有機層4、めっき層5と同様である。
The stacked structure of the
また、絶縁層111、シリカ層108、有機層109、ゲート電極110の積層構造は、上述の積層体11と同一の積層構造である。すなわち、シリカ層108、有機層109、ゲート電極110の材質として採用可能な材質は、上述した積層体11のシリカ層3、有機層4、めっき層5と同様である。また、シリカ層108、有機層109、ゲート電極110の材質として採用可能な材質は、上述した積層体11のシリカ層3、有機層4、めっき層5と同様である。
The stacked structure of the insulating
なお、絶縁層111の材質としては、絶縁物質が採用され、絶縁層111の形成方法としては、周知の各種方法が適用可能である。本実施形態では、絶縁層111の材質として、有機絶縁物質であるポリビニルフェノールが採用され、形成方法としてスピンコート法が採用される。
Note that an insulating material is employed as the material of the insulating
また、半導体層107の材質としては、本実施形態ではInGaZnO4が採用される。半導体層107の形成方法は、スパッタリング法によりInGaZnO4膜の成膜を行った後、フォトリソグラフィ法によりパターニングを行う方法を採用した。
As a material of the
薄膜トランジスタ100では、基板102、シリカ層103、有機層104、ソース電極105・ドレイン電極106の積層構造は、上述の積層体11と同一の積層構造であるため、ソース電極105、ドレイン電極106の基板102に対する密着性を向上させることができる。絶縁層111、シリカ層108、有機層109、ゲート電極110の積層構造は、上述の積層体11と同一の積層構造であるため、ゲート電極110の絶縁層111に対する密着性を向上させることができる。
In the
次に、上述した積層体11と同様の方法で形成した、本発明の一実施形態であるプリント配線基板200について、図14および図15を参照して説明する。
Next, a printed
プリント配線基板200の断面構造について説明する。図14に示すように、プリント配線基板200は、樹脂からなる基板202の上面に、シリカ層203が形成され、シリカ層203の上面にパターン形成された有機層204が形成されている。基板202とシリカ層203と有機層204とによって、基板210が構成される。そして、基板210の上面には、有機層204と同一パターンの金属配線205が形成される。
A cross-sectional structure of the printed
プリント配線基板200のシリカ層203、有機層204、金属配線205の積層構造は、上述の積層体11と同一の積層構造である。すなわち、シリカ層203、有機層204、金属配線205の材質として採用可能な材質は、上述した積層体11のシリカ層3、有機層14、めっき層15、と同様である。また、シリカ層203、有機層204、金属配線205の形成方法は、積層体11のシリカ層3、有機層14、めっき層15の形成方法と同様である。
The laminated structure of the
このように形成されたプリント配線基板200を目視すると、図13に示すように、配線のフクレおよび剥がれがみられなかった。プリント配線基板200では、金属配線205を積層体11のめっき層15と同様の方法で形成するので、金属配線205の基板202に対する密着性を向上させることができる。よって、金属配線205が断線しにくく、信頼性の高いプリント配線基板200を提供することができる。
When the printed
また真空成膜装置を用いた方法は、基板の全面に金属膜を成膜した後、その不要部分をエッチングにより除去することで、配線パターンを形成するため、除去された部分の金属が無駄になってしまう。一方、本発明においては、あらかじめ、パターン形成された有機層204の上面に金属配線205を形成するので、金属材料やパターニングに必要なレジスト材料などの無駄がない。
In the method using the vacuum film forming apparatus, a metal film is formed on the entire surface of the substrate, and then unnecessary portions are removed by etching to form a wiring pattern. Therefore, the removed portion of the metal is wasted. turn into. On the other hand, in the present invention, since the
なお、本発明の積層体1、11、21、薄膜トランジスタ100、およびプリント配線基板200は、上記実施形態に限定されるものではなく、本発明の要旨を逸脱しない範囲内において種々変更を加え得ることは勿論である。
The
たとえば、上述の実施例では、シリカ層の前駆体として、パーヒドロポリシラザンを用いたが、ポリシラザンであればよく、パーヒドロポリシラザンに限定されない。 For example, in the above-described embodiment, perhydropolysilazane is used as the precursor of the silica layer, but polysilazane may be used and is not limited to perhydropolysilazane.
また、上述の実施例では、形成されためっき層5、15、25は、金属単体からなるが、めっき層5、15、25を置換めっきした金属積層体または、金属酸化物より形成しても良い。例えば、めっき層5、15、25を、亜鉛、チタン、インジウム、スズのいずれかを少なくとも含み、かつ半導体特性を示す金属酸化物とした場合、めっき層を各種半導体デバイスの半導体層として適用することができる。有機層4、14、24の上面に金属酸化物からなるめっき層を形成するプロセスには、周知の無電解めっきプロセスが適用される。
Moreover, in the above-mentioned Example, although the formed
また、積層体11、21では、パターニングされた有機層14、24の上面にめっき層を形成したが、パターニングされた有機層14、24の上面にめっき層15、25を形成するものに限定しない。たとえば、シリカ層3の上面を覆うように有機層を形成し、さらに、その上面にめっき層を形成し、そのあと、エッチングなどによって、めっき層のパターンを形成しても良い。この場合であっても、パターン形成された密着性のよいめっき層を得ることができる。
Moreover, in the
また、上述した薄膜トランジスタ100は、トップゲート型の薄膜トランジスタであったが、ボトムゲート型の薄膜トランジスタに適用しても良い。また、薄膜トランジスタ100では、ソース電極105、ドレイン電極106、ゲート電極110のすべてが無電解めっきにより形成されていたが、いずれかを無電解めっき以外の方法で形成してもよい。また、薄膜トランジスタ100の上面にさらに層間絶縁層を形成し、層間絶縁層の上面に積層体11、21のめっき層15、25と同様の方法で、画素電極を形成しても良い。すなわち、薄膜トランジスタ100の上面に周知の方法で層間絶縁層を形成し、層間絶縁層の上面にポリシラザンを前駆体としてシリカ層を形成し、シリカ層の上面に自己組織化単分子膜からなる有機層を形成し、有機層の上面に無電解めっきにより画素電極を形成しても良い。
Although the above-described
1、11、21 積層体
2 基板
3 シリカ層
4、14、24 有機層
5、15、25 めっき層
100 薄膜トランジスタ
200 プリント配線基板
1, 11, 21
Claims (13)
前記基板上面に形成され、ポリシラザンを前駆体とするアモルファスシリカ層と、
前記アモルファスシリカ層上面に形成され、前記アモルファスシリカ層の上面と化学的に結合可能な有機分子を前駆体とする有機層と、
前記有機層の上面に形成され、無電解めっきにより析出されためっき層と
を備えたことを特徴とする積層体。 A substrate, an amorphous silica layer formed on the upper surface of the substrate and having polysilazane as a precursor;
An organic layer formed on an upper surface of the amorphous silica layer and having an organic molecule as a precursor which can be chemically bonded to the upper surface of the amorphous silica layer;
A laminate comprising: a plating layer formed on an upper surface of the organic layer and deposited by electroless plating.
前記めっき層は、前記有機層上面に前記有機層と同一パターンで形成されていることを特徴とする請求項1から7のいずれかに記載の積層体。 The organic layer is patterned,
The laminate according to any one of claims 1 to 7, wherein the plating layer is formed on the upper surface of the organic layer in the same pattern as the organic layer.
前記アモルファスシリカ層上面に、前記アモルファスシリカ層の上面と化学的に結合可能な有機分子を前駆体として、有機層を形成する有機層形成工程と、
前記有機層上面に、無電解めっきによりめっき層を形成するめっき層形成工程と
を備えたことを特徴とする積層体の製造方法。 A silica layer forming step of forming an amorphous silica layer on the substrate upper surface using polysilazane as a precursor,
An organic layer forming step of forming an organic layer on the amorphous silica layer upper surface using an organic molecule that can be chemically bonded to the upper surface of the amorphous silica layer as a precursor;
The manufacturing method of the laminated body characterized by including the plating layer formation process which forms a plating layer on the organic layer upper surface by electroless plating.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009190716A JP2011044524A (en) | 2009-08-20 | 2009-08-20 | Laminate, method of manufacturing the same, thin film transistor having laminate, and printed wiring board having laminate |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009190716A JP2011044524A (en) | 2009-08-20 | 2009-08-20 | Laminate, method of manufacturing the same, thin film transistor having laminate, and printed wiring board having laminate |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2011044524A true JP2011044524A (en) | 2011-03-03 |
Family
ID=43831742
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2009190716A Pending JP2011044524A (en) | 2009-08-20 | 2009-08-20 | Laminate, method of manufacturing the same, thin film transistor having laminate, and printed wiring board having laminate |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2011044524A (en) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2013176247A1 (en) * | 2012-05-25 | 2013-11-28 | 株式会社ニコン | Method for manufacturing transistor and transistor |
WO2014051061A1 (en) * | 2012-09-28 | 2014-04-03 | 田中貴金属工業株式会社 | Substrate processing method for supporting a catalyst particle for plating process |
KR20190037152A (en) * | 2017-09-28 | 2019-04-05 | 도쿄엘렉트론가부시키가이샤 | Substrate processing apparatus and substrate processing method |
-
2009
- 2009-08-20 JP JP2009190716A patent/JP2011044524A/en active Pending
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2013176247A1 (en) * | 2012-05-25 | 2013-11-28 | 株式会社ニコン | Method for manufacturing transistor and transistor |
WO2014051061A1 (en) * | 2012-09-28 | 2014-04-03 | 田中貴金属工業株式会社 | Substrate processing method for supporting a catalyst particle for plating process |
CN104685098A (en) * | 2012-09-28 | 2015-06-03 | 田中贵金属工业株式会社 | Substrate processing method for supporting a catalyst particle for plating process |
KR20150060888A (en) * | 2012-09-28 | 2015-06-03 | 다나카 기킨조쿠 고교 가부시키가이샤 | Substrate processing method for supporting a catalyst particle for plating process |
KR101641031B1 (en) | 2012-09-28 | 2016-07-19 | 다나카 기킨조쿠 고교 가부시키가이샤 | Method for treating substrate that supports catalyst particles for plating processing |
US9565776B2 (en) | 2012-09-28 | 2017-02-07 | Tanaka Kikinzoku Kogyo K.K. | Method for treating substrate that support catalyst particles for plating processing |
KR20190037152A (en) * | 2017-09-28 | 2019-04-05 | 도쿄엘렉트론가부시키가이샤 | Substrate processing apparatus and substrate processing method |
KR102260913B1 (en) | 2017-09-28 | 2021-06-04 | 도쿄엘렉트론가부시키가이샤 | Substrate processing apparatus and substrate processing method |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
CN103299448B (en) | Use the manufacture method of flexible electronic device, flexible electronic device and the flexible base board of roll shape mother substrate | |
TWI445183B (en) | Schottky diode and method for making the same | |
JP2010506400A5 (en) | ||
JP2008536295A5 (en) | ||
KR101262464B1 (en) | Method of manufacturing flexible electronic device using a laser beam | |
KR20100115298A (en) | Method for isolating flexible substrate from support substrate | |
CN107039600A (en) | Display device and its manufacture method | |
JP2005244205A5 (en) | ||
TWI755023B (en) | Electrode, method for manufacturing electrode and device thereof | |
JP6394691B2 (en) | Wiring pattern manufacturing method and transistor manufacturing method | |
TWI755022B (en) | Touch panel, method for manufacturing touch panel and device thereof | |
JP2011044524A (en) | Laminate, method of manufacturing the same, thin film transistor having laminate, and printed wiring board having laminate | |
CN105813838A (en) | Stacked body, and gas barrier film | |
JP2009158691A (en) | Organic device and manufacturing method thereof | |
KR101431595B1 (en) | Method for tranferring metal oxide/nitride/sulfide thin film and transfer sheet used therefor | |
US8871601B2 (en) | Diffusion barriers | |
KR100862149B1 (en) | Method for forming metal wiring on flexible substrate by electroless plating | |
JP2012174805A (en) | Organic transistor, display device, and method of manufacturing organic transistor | |
KR101920145B1 (en) | Flexible substrate for flexible electronic device, method of fabricating flexible electronic device using the same, and flexible electronic device fabriacated by the method | |
KR20120031000A (en) | Alkylsilane laminate, method for producing the same, and thin-film transistor | |
KR101940974B1 (en) | Process of fabricating flexible electronic device and flexible electronic device fabriacated by the same | |
JP2007103479A (en) | Forming method of inorganic thin film pattern on polyimide resin substrate | |
WO2013176247A1 (en) | Method for manufacturing transistor and transistor | |
KR101804819B1 (en) | Method for Manufacturing Flexible Information Display Device Comprising Tranfer Process of Detaching Assist Layer | |
KR20160150412A (en) | Surface modified graphene transparent electrode and preparing method of the same |