JP2010251345A - Bump forming method - Google Patents
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Abstract
Description
本発明は、回路基板上で電子部品の接続に用いるバンプの形成方法に関する。 The present invention relates to a method of forming bumps used for connecting electronic components on a circuit board.
従来から、回路基板上に電子部品を接続する際、部品の端子に形成されたバンプとパッドを、接触や結合することで導通を得ている。この種のバンプは、フォトリソグラフィ等によりメッキレジストを導電体上に形成し、レジストの開口部に電気メッキでバンプを形成している。 Conventionally, when an electronic component is connected on a circuit board, conduction is obtained by contacting or coupling bumps and pads formed on the terminal of the component. In this type of bump, a plating resist is formed on a conductor by photolithography or the like, and the bump is formed by electroplating in the opening of the resist.
下記特許文献1は、はんだバンプの製造方法に関し、信頼性を向上した製造方法を実用化するための技術が開示している。このはんだバンプの製造方法は、基板上に共通電極を形成し、この基板上にパッドを形成し、この基板上にレジストを被膜した後、パッド位置のレジストを窓開けし、この基板をはんだめっき液に浸漬し、共通電極を陰極として所定の厚さにはんだめっきを行い、レジストを除去し、基板をはんだの融点以上にまで加熱して溶融し、基板上の共通電極を除去してはんだバンプを製造する。
従来、この種のはんだバンプの製造技術は、以下に説明する課題があった。フォトリソグラフィ法でレジストを形成し、めっきでバンプを形成するため、多くの工程を必要としていた。また、フォトリソグラフィでの位置合わせは位置精度に限界があった。さらに、多くの工程を必要とすることから、設備費、人件費及び材料費が高かった。バンプを全てめっきで作製するため、バンプの高さが高くなるほど作製時間がかかっていた。 Conventionally, this type of solder bump manufacturing technique has the following problems. Since a resist is formed by photolithography and bumps are formed by plating, many processes are required. In addition, there is a limit to the positional accuracy in alignment by photolithography. Furthermore, since many processes are required, the equipment cost, personnel cost and material cost were high. Since all the bumps are produced by plating, it takes a longer production time as the bump height increases.
本発明は、工程数が少なく位置精度が高いバンプ形成方法を提供することを目的とする。 An object of this invention is to provide the bump formation method with few steps and high position accuracy.
本発明の第1の態様は、絶縁層上に第1導電層が形成された基板の第1導電層の一部を除去し、絶縁層に至る円筒状のバンプ穴を開孔する工程と、バンプ穴に導電性ボールの少なくとも一部を挿入する工程と、導電性ボール及び第1導電層上に第2導電層を形成する工程とを含むバンプ形成方法を要旨とする。 The first aspect of the present invention includes a step of removing a part of the first conductive layer of the substrate having the first conductive layer formed on the insulating layer and opening a cylindrical bump hole reaching the insulating layer; The gist is a bump forming method including a step of inserting at least a part of a conductive ball into a bump hole and a step of forming a second conductive layer on the conductive ball and the first conductive layer.
本発明によれば、工程数が少なく位置精度が高いバンプ形成方法が提供される。 According to the present invention, a bump forming method with a small number of steps and high positional accuracy is provided.
以下に、実施形態を挙げて本発明の説明を行うが、本発明は以下の実施形態に限定されるものではない。尚、図中同一の機能又は類似の機能を有するものについては、同一又は類似の符号を付して説明を省略する。 Hereinafter, the present invention will be described with reference to embodiments, but the present invention is not limited to the following embodiments. In addition, about what has the same function or a similar function in a figure, the same or similar code | symbol is attached | subjected and description is abbreviate | omitted.
[基板]
図1は、本発明の実施形態に係るバンプ形成方法を用いて製造された基板10の断面図を示す。基板10は、絶縁層1と、絶縁層1上に形成され、一部に絶縁層1に至る円筒状で、膜厚と同程度の内径のバンプ穴3が形成された第1導電層2と、バンプ穴3の開孔部から絶縁層1側に向かい半円に満たない全体の一部がバンプ穴3に挿入された導電性ボール9と、導電性ボール9及び第1導電層2の表面に設けられた第2導電層6とを有する。
導電性ボール9は、樹脂からなる絶縁性ボール4の表面に、導電被膜5が形成されている。その他にも、導電性ボール9は、金属単体もしくは合金からなる導電体で形成することができる。導電性ボール9の直径は、バンプ穴3の内径よりも大きいことが好ましい。
[substrate]
FIG. 1 shows a cross-sectional view of a
The
[バンプ形成方法]
(イ)図2に示すような、絶縁層1上に第1導電層2が形成された基板10aを用意する。そして、開孔部が設けられたマスクを基板10a上に配置する。その後、例えばサブトラクティブ法、セミアディティブ法又はアディティブ法等を用いて、マスクの開孔部を介して、基板10aの第1導電層2の一部を除去し、絶縁層1に至る円筒状のバンプ穴3を開孔する。その後、マスクを取り除いて、図3のような基板10bを得る。
(ロ)バンプ穴3に導電性ボール9の一部を挿入する。
(ハ)導電性ボール9及び第1導電層2上に第2導電層6を形成する。電解めっき、無電解めっき、スパッタ、蒸着により第2導電層6を形成することが好ましい。
[Bump formation method]
(A) As shown in FIG. 2, a
(B) A part of the
(C) The second
本発明の実施形態に係るバンプ形成方法によれば、導電性ボール9を使用することで、従来よりも少ない工程数でバンプを形成することができる。また、回路形成時のフォトリソグラフィでバンプ穴3が形成されるため、位置精度が極めて高くなる。さらに、工程の簡略化やめっき厚が薄くても良いことから、コスト削減や時間短縮が図られる。例えば、従来のバンプ形成方法では、フォトリソグラフィ法とめっきでバンプを形成していたため、基材の寸法変化によっては位置の誤差が±100μm以上と位置精度が極めて低かった。ところが、本発明の実施形態に係るバンプ形成方法によれば、回路形成時のフォトリソグラフィでバンプ穴を形成するため、位置の誤差がほぼ0となり位置精度が高くなる。また、バンプレジスト形成が不要であることやめっき時間の短縮の時間により、コストや時間は従来技術の1/10以下となる。
According to the bump forming method according to the embodiment of the present invention, by using the
図5は、本発明の実施例に係るバンプ形成方法を用いて製造された導電性ボール9Aを備える基板10Aの断面図を示す。基板10Aは、絶縁層1Aと、絶縁層1A上に形成され、一部に絶縁層1Aに至る円筒状で、膜厚と同程度の内径のバンプ穴3a〜3dが形成された第1導電層2Aと、バンプ穴3a〜3dの開孔部から絶縁層1A側に向かい半円に満たない一部がバンプ穴3に挿入された導電性ボール9Aと、導電性ボール9A及び第1導電層2Aの表面に設けられた第2導電層6Aとを有する。導電性ボール9Aは、絶縁性ボール4Aの表面に、金メッキからなる導電被膜5Aが形成されている。絶縁性ボール4Aとしては、特に制限されないが、例えばアクリル樹脂等を用いることができる。以下に、サブトラクティブ法による基板10Aの作製方法について説明する。
FIG. 5 shows a cross-sectional view of a
(イ)まず、図6に示すような、厚さ25μmのポリイミドフィルムからなる絶縁層1A上に、厚さ12μmの銅箔からなる第1導電層2Aが張り合された、銅張積層板(CCL)10Aaを用意した。
(A) First, as shown in FIG. 6, a copper-clad laminate in which a first
(ロ)図7に示すように、厚さ20μmのドライフィルムレジスト(DF)8をロールラミネートで熱と圧力を加えて、第1導電層2A上に張り合わせた。 (B) As shown in FIG. 7, a dry film resist (DF) 8 having a thickness of 20 μm was laminated on the first conductive layer 2 </ b> A by applying heat and pressure by roll lamination.
(ハ)図8に示すように、回路パターンが形成される部分に対応するDF8a、8b、8c、8d、8eを除いて、フォトリソグラフィ法によりDF8の一部を取り除き、開孔部7a、7b、7c、7dを離間して形成した。
(C) As shown in FIG. 8, except for the
(ニ)図8の開口部7a〜7dを介して塩化鉄で第1導電層2Aを除去した。そして図9に示すようにバンプ穴3a、3b、3c、3dを開孔した。なお、バンプ穴3a〜3dは直径80μmで20穴とした。
(D) The first
(ホ)図9のDF8a〜8eを苛性ソーダで除去した。そして、図10に示すような、第1導電層(回路パターン)2Aa、2Ab,2Ac,2Ad,2Aeとバンプ穴3a〜3dを備える基板10Abを形成した。
(E) DF8a to 8e in FIG. 9 were removed with caustic soda. Then, a substrate 10Ab including first conductive layers (circuit patterns) 2Aa, 2Ab, 2Ac, 2Ad, 2Ae and bump
(ヘ)次に、図11に示すような、直径100μmの複数の導電性ボール9Aが入ったケース11を用意した。基板10Abを導電性ボール9Aの表面に対して入射角約15°でケース11内に挿入した。
(F) Next, as shown in FIG. 11, a
(ト)図12に示すように、基板10Abをケース11内で数回前後に揺動させて導電性ボール9Aをバンプ穴3a、3b、3c、3dの中に充填した。
(G) As shown in FIG. 12, the substrate 10Ab was swung back and forth several times in the
(チ)図13に示すように、基板10Abをケース11から取り出した。そして、基板10Abを、前後に揺動させることで余分な導電性ボール9Aを除去した。
(H) As shown in FIG. 13, the
(リ)顕微鏡で全てのバンプ穴3a〜3dに導電性ボール9Aが入っていることを確認した。そして図14に示すように、一端に基板10Abに対して平行な平らな金属板が取り付けられた棒13a〜13dで導電性ボール9Aをバンプ穴3a〜3dに押し込んだ。
(I) It was confirmed with a microscope that the
(ヌ)最後に、導電性ボール9Aと第1導電層2Aの表面に、電界銅めっきを施し第2導電層6Aを形成した。以上により、図5に示す基板10Aが得られた。
(N) Finally, electrolytic copper plating was applied to the surfaces of the
上記のように、本発明は実施形態や実施例によって記載したが、この開示の一部をなす論述及び図面はこの発明を限定するものであると理解すべきではない。この開示から当業者には様々な代替実施の形態、実施例及び運用技術が明らかとなろう。例えば、実施例の欄では、回路形成や導電性ボールを入れる穴を作成する例として、サブトラクティブ法を適用したが、本発明はサブトラクティブ法にのみ限定するものではなく、セミアディティブ法、アディティブ法を用いてバンプ穴を形成してよい。セミアディティブ法は、絶縁基板上に予め導電層を形成し、めっきレジストを形成したのちに、例えば無電解銅めっきでパターンを形成する。アディティブ法は、めっき等の技術を応用して、回路パターンを析出して構成する。また、導電性のポリマを基板上に塗布して回路を形成する。このように、本発明はここでは記載していない様々な実施の形態等を含むことは勿論である。したがって、本発明の技術的範囲は上記の説明から妥当な特許請求の範囲に係る発明特定事項によってのみ定められるものである。 As described above, the present invention has been described by way of embodiments and examples. However, it should not be understood that the description and drawings constituting a part of this disclosure limit the present invention. From this disclosure, various alternative embodiments, examples and operational techniques will be apparent to those skilled in the art. For example, in the column of the embodiment, the subtractive method is applied as an example of forming a hole for inserting a circuit formation or a conductive ball. However, the present invention is not limited to the subtractive method, but the semi-additive method, the additive Bump holes may be formed using a method. In the semi-additive method, after a conductive layer is formed on an insulating substrate in advance and a plating resist is formed, a pattern is formed by, for example, electroless copper plating. In the additive method, a circuit pattern is deposited by applying a technique such as plating. A circuit is formed by applying a conductive polymer onto the substrate. As described above, the present invention naturally includes various embodiments not described herein. Therefore, the technical scope of the present invention is defined only by the invention specifying matters according to the scope of claims reasonable from the above description.
1、1A…絶縁層
2、2A…第1導電層
3…バンプ穴
4、4A…樹脂ボール
6、6A…第2導電層
9、9A…導電性ボール
DESCRIPTION OF
Claims (5)
前記バンプ穴に導電性ボールの少なくとも一部を挿入する工程と、
前記導電性ボール及び前記第1導電層上に第2導電層を形成する工程と
を含むことを特徴とするバンプ形成方法。 Removing a part of the first conductive layer of the substrate on which the first conductive layer is formed on the insulating layer, and opening a cylindrical bump hole reaching the insulating layer;
Inserting at least a part of a conductive ball into the bump hole;
Forming a second conductive layer on the conductive ball and the first conductive layer.
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JP2009095771A JP2010251345A (en) | 2009-04-10 | 2009-04-10 | Bump forming method |
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