JP2008256568A - Pulse compression radar device and method of phase modulation of the pulse compression radar device - Google Patents

Pulse compression radar device and method of phase modulation of the pulse compression radar device Download PDF

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Abstract

<P>PROBLEM TO BE SOLVED: To make a code difficult to be decoded by signal monitoring by an outsider to prevent leakage of radar information for compressing the signal or synthesis of radar jamming or the like. <P>SOLUTION: A code signal generation circuit 4 applies a plurality of initial values to a shift register function of M-sequence code generation logic, generates two or more kinds of different M-sequence codes with the same code length, and synthesizes them to output modulation signals (I and Q) by a pseudo random code in a multiple notation system (compound M-sequence code). A phase modulation circuit 6 uses the modulation signals to modulate a transmitted signal from a gate circuit 5 in multiple phases for outputting. In a receiver side, a phase detection circuit 8 outputs phase detection signals (I and Q) of a reflective signal, and pulse compression takes place by a matched filter 9 constituting a correlation filter matching the compound M-sequence code of a sender side. A number of kinds of unique codes can be used when compared with kinds of random codes conventionally obtained only by depending on a single initial value. <P>COPYRIGHT: (C)2009,JPO&INPIT

Description

本発明はパルス圧縮レーダ装置に関し、特にパルス圧縮に擬似ランダム符号を用いたパルス圧縮レーダ装置及びパルス圧縮レーダ装置の位相変調方法に関する。   The present invention relates to a pulse compression radar apparatus, and more particularly to a pulse compression radar apparatus using a pseudo-random code for pulse compression and a phase modulation method for the pulse compression radar apparatus.

パルス圧縮レーダ装置におけるバイナリーコードを使用したパルス圧縮では圧縮比(コードのビット長)が13以下ではバーカーコード、それ以上では主にM系列符号発生アルゴリズムにより擬似的なランダム2進数を発生させ、それらの2進符号に基づいて送信パルスの2相位相変調を行うものが一般的である。M系列符号発生ロジックではシフトレジスタが使用され、必要とされるコードのビット長によりレジスタの段数(n)が求められる。   In pulse compression using a binary code in a pulse compression radar system, a Barker code is generated when the compression ratio (bit length of the code) is 13 or less, and pseudo random binary numbers are generated mainly by an M-sequence code generation algorithm. In general, the transmission pulse is subjected to two-phase modulation based on the binary code. In the M-sequence code generation logic, a shift register is used, and the number of register stages (n) is obtained according to the required bit length of the code.

図8はシフトレジスタによるM系列符号発生回路を示す図である。同図(a)に示すように4段(4ビット)のシフトレジスタによる構成例であり、シフトレジスタと、該シフトレジスタの最終段の出力bとその前段の出力aを入力し、出力cを入力段に帰還するMod2Adder(モジュロ2加算器)とを備える。Mod2Adderは、同図(b)に示す真理値表に示す入出力関係を有する。Mod2Adderの入力a、bに対する出力cは2値のモジュロ2加算であることからEX−OR(排他的論理和)回路の真理値表と同等である。シフトレジスタの各ビットに相当するレジスタ内部に示す「1」、「0」の数字はコードを発生させる前の初期値を示しており、この回路構成で各段のコードをシフトすることにより15ビットの固有の擬似ランダムバイナリコードが得られる。   FIG. 8 is a diagram showing an M-sequence code generation circuit using a shift register. As shown in FIG. 4A, the shift register is an example of a configuration having four stages (four bits). The shift register, the output b of the last stage of the shift register, and the output a of the preceding stage are input, and the output c is input. A Mod2Adder (modulo-2 adder) that feeds back to the input stage. Mod2Adder has the input / output relationship shown in the truth table shown in FIG. Since the output c for the inputs a and b of Mod2Adder is a binary modulo-2 addition, it is equivalent to the truth table of an EX-OR (exclusive OR) circuit. The numbers “1” and “0” shown in the register corresponding to each bit of the shift register indicate initial values before the code is generated, and 15 bits are obtained by shifting the code of each stage with this circuit configuration. A unique pseudo-random binary code is obtained.

図9は図8に示すM系列符号発生回路で発生されるバイナリーコードによる2相位相変調波形を示す図である。M系列符号発生回路が初期値=1[1000](左端がLSB)の場合に生成される15ビット長のM系列コードは「000100110101111」であり、このコードで送信信号を2相位相変調した変調波形(3ビット目以降)を示している。この構成のM系列符号発生回路では初期値は1[1000]〜15[1111]の範囲で任意の数が設定可能であり、それぞれの初期値で固有のコードを発生することが可能であるが、15を超える種類のコードは存在しない。   FIG. 9 is a diagram showing a two-phase phase modulation waveform by a binary code generated by the M-sequence code generation circuit shown in FIG. The 15-bit M-sequence code generated when the M-sequence code generation circuit has an initial value = 1 [1000] (the left end is LSB) is “000100110101111”, and this code modulates the transmission signal by two-phase phase modulation. A waveform (from the third bit) is shown. In the M-sequence code generation circuit having this configuration, the initial value can be set to any number in the range of 1 [1000] to 15 [1111], and a unique code can be generated with each initial value. , There are no more than 15 types of codes.

以上のように、従来のパルス圧縮レーダ装置で送信信号に擬似ランダムな位相変調を行う符号系列はバイナリーコードであり、長いビット長のバイナリーコードとしてはM系列符号発生アルゴリズムにより擬似的なランダム2進数が利用されている。また、M系列符号発生ロジックではシフトレジスタが使用され、コードのビット長Nとレジスタの段数nとの関係はN=(2−1)であり、生成されるコードはシフトレジスタの初期値で決まる固有のコードであるが、n段のレジスタからは(2−1)種以上の固有コードは生成できない。 As described above, a code sequence for performing pseudo-random phase modulation on a transmission signal in a conventional pulse compression radar apparatus is a binary code. Is being used. In the M-sequence code generation logic, a shift register is used, the relationship between the bit length N of the code and the number of register stages n is N = (2 n −1), and the generated code is the initial value of the shift register. Although it is a specific code that is determined, it is not possible to generate more than (2 n −1) types of unique code from the n-stage registers.

したがって、M系列符号発生ロジックでは使用できるバイナリーコードのコードの種類に限界があるため、バイナリーコードで2相位相変調を行うパルス圧縮レーダ装置を構成した場合、部外者による信号の傍受により容易にコードが解読され、信号を圧縮するレーダ情報あるいはレーダの妨害電波等の合成が可能となるという問題がある。   Therefore, there is a limit to the types of binary code codes that can be used in the M-sequence code generation logic. Therefore, when a pulse compression radar apparatus that performs two-phase phase modulation with binary codes is configured, it is easy to intercept signals by outsiders. There is a problem that it is possible to synthesize the radar information for compressing the signal or the interference wave of the radar by decoding the code.

本発明の目的は、以上の課題を解決するものであり、より多くのコードの種類の固有コードを利用可能なパルス圧縮レーダ装置を提供することにある。   An object of the present invention is to solve the above-described problems, and to provide a pulse compression radar apparatus that can use more specific codes of different types of codes.

本発明の目的は、部外者による信号傍受によりコードの解読を困難にし、信号を圧縮するレーダ情報の漏洩あるいはレーダの妨害電波等の合成を防止することを可能とするパルス圧縮レーダ装置を提供することにある。   An object of the present invention is to provide a pulse compression radar device that makes it difficult to decode a code due to signal interception by an outsider and prevents the leakage of radar information for compressing the signal or the synthesis of radar jamming waves and the like. There is to do.

本発明のパルス圧縮レーダ装置は、送信信号を擬似ランダム符号により位相変調するパルス圧縮レーダ装置であって、同一の生成多項式等による同一コード長で互いに異なるm(m≧2)種類のM系列符号を生成し、異なるM系列符号の各ビットを組み合わせ多進の擬似ランダム符号を生成するコード信号発生手段(例えば図2の41、42)と、生成した多進の擬似ランダム符号に基づいて送信信号を多相に位相変調する位相変調手段(例えば図1の6、図3)と、を備え、前記コード信号発生手段は、異なるm種類のM系列符号を生成するm個のM系列符号発生回路(例えば図2の41)と、前記異なるm種類のM系列符号の各ビットを組み合わせ多進の擬似ランダム符号を生成する多進符号発生手段(例えば図2の42)と、を備え、前記m個のM系列符号発生回路は異なる初期値を設定することにより前記m種類のM系列符号を生成することを特徴とする。更に、前記送信信号による反射信号を受信し、多相の位相変調の位相検波出力を入力する前記多進の擬似ランダム符号にマッチングのとれた相関フィルターを備えることを特徴とする。特に、前記M系列符号は2種類のM系列符号であり、前記位相変調手段は4進の擬似ランダム符号を送信信号の位相を0位相として0、π/4、π/2、3π/4の4相の位相変調とすることを特徴とする。   The pulse compression radar apparatus of the present invention is a pulse compression radar apparatus that modulates the phase of a transmission signal with a pseudo-random code, and has different m (m ≧ 2) types of M-sequence codes with the same code length by the same generator polynomial or the like. Code signal generating means (for example, 41 and 42 in FIG. 2) for combining each bit of different M-sequence codes to generate a multi-random pseudo-random code, and a transmission signal based on the generated multi-random pseudo-random code Phase modulation means (for example, 6 in FIG. 1 and FIG. 3), and the code signal generation means generates m M-sequence code generation circuits for generating m different M-sequence codes. (For example, 41 in FIG. 2), and multi-code generation means (for example, 42 in FIG. 2) for generating a multi-random pseudo-random code by combining each bit of the different m kinds of M-sequence codes, Serial m-number of M-sequence code generation circuit and generates the m kinds of M-sequence code by setting different initial values. Further, the present invention is characterized in that a correlation filter matched with the multi-quadrature pseudo-random code that receives a reflection signal from the transmission signal and inputs a phase detection output of multi-phase modulation is provided. In particular, the M-sequence code is two types of M-sequence codes, and the phase modulation means uses a quaternary pseudo-random code of 0, π / 4, π / 2, 3π / 4 with the phase of the transmission signal as 0 phase. It is characterized by four-phase phase modulation.

本発明のパルス圧縮レーダ装置の位相変調方法は、送信信号を擬似ランダム符号により位相変調するパルス圧縮レーダ装置の位相変調方法であって、同一コード長で互いに異なるm(m≧2)種類のM系列符号を生成し、異なるM系列符号の各ビットの組み合わせにより多進の擬似ランダム符号を生成し、該多進の擬似ランダム符号により前記送信信号を多相に位相変調することを特徴とし、前記異なるm種類のM系列符号は、異なる初期値を設定したm個のM系列符号発生回路により生成することを特徴とする。また、前記送信信号による反射信号に対し、多相に位相変調の位相検波出力を入力する前記多進の擬似ランダム符号にマッチングのとれた相関フィルターによりパルス圧縮を行うことを特徴とする。特に、前記M系列符号は2種類のM系列符号であり、前記位相変調は4進の擬似ランダム符号を送信信号の位相を0位相として0、π/4、π/2、3π/4の4相の位相変調とすることを特徴とする。   The phase modulation method of the pulse compression radar apparatus of the present invention is a phase modulation method of a pulse compression radar apparatus that modulates the phase of a transmission signal with a pseudo-random code, and is different in m (m ≧ 2) types with the same code length. Generating a sequence code, generating a multi-pseudo pseudo-random code by combining each bit of a different M-sequence code, and phase-modulating the transmission signal in multiple phases by the multi-pseudo pseudo-random code, Different m types of M-sequence codes are generated by m M-sequence code generation circuits having different initial values. The reflected signal of the transmission signal may be subjected to pulse compression by a correlation filter matched with the multi-quadrature pseudo-random code that inputs a phase detection output of phase modulation in multiple phases. In particular, the M-sequence code is two types of M-sequence codes, and the phase modulation is a quaternary pseudo-random code with the phase of the transmission signal as 0 phase, 0, π / 4, π / 2, 3π / 4, 4 It is characterized by phase modulation of the phase.

具体的には、本発明はM系列符号の発生により成出されるバイナリーコードにより位相変調を行うパルス圧縮レーダ装置に係り、(1)同一コード長で2種類以上の異なるM系列符号を生成し、これらを合成して多進の擬似ランダム符号(複合M系列符号)を得る。(2)この符号を用いて送信信号を2値を超える位相角で位相変調する。(3)受信側においては、送信側の複合M系列符号にマッチングのとれた相関フィルターを使用することでパルス圧縮を実現する。   Specifically, the present invention relates to a pulse compression radar apparatus that performs phase modulation using a binary code generated by generation of an M-sequence code, and (1) generates two or more different M-sequence codes with the same code length, These are combined to obtain a multi-ary pseudo-random code (composite M-sequence code). (2) Using this code, the transmission signal is phase-modulated with a phase angle exceeding two values. (3) On the reception side, pulse compression is realized by using a correlation filter matched to the composite M-sequence code on the transmission side.

従来から一般的に使用されているバイナリーコードによるパルス圧縮レーダ装置の送信パルスの位相変調は、単一の初期値だけに依存して得られるランダムコードを使用し、そのコード内のセグメントの符号が「1」の場合、送信信号の搬送波に与える位相シフト量を0度(同相)、「0」の場合、搬送波に与える位相シフト量を180度(逆相)とする2値の位相変調となる。   The phase modulation of the transmission pulse of a pulse compression radar apparatus using a binary code that has been generally used in the past uses a random code obtained depending on only a single initial value, and the code of the segment in the code is In the case of “1”, the phase shift amount given to the carrier wave of the transmission signal is 0 degree (in phase), and in the case of “0”, the binary phase modulation is made such that the phase shift amount given to the carrier wave is 180 degrees (reverse phase). .

本発明ではM系列符号発生ロジックのシフトレジスタ機能に複数個の初期値を与えることで、複数個の固有コードを生成する。さらに、これらの固有コードから固有の多ビットの擬似ランダムコードを合成し、このコードで多値位相変調を行うことで、パルス拡散及びパルス圧縮を行う。多ビットの擬似ランダムコードは前述の複数個の初期値の組み合わせの数だけの種類が存在するため、従来の単一の初期値だけに依存して得られるランダムコードの種類に比べ、多量の種類の固有コードの使用が可能となる。   In the present invention, a plurality of unique codes are generated by giving a plurality of initial values to the shift register function of the M-sequence code generation logic. Furthermore, a unique multi-bit pseudo-random code is synthesized from these unique codes, and multi-level phase modulation is performed with this code, thereby performing pulse spreading and pulse compression. Since there are as many types of multi-bit pseudo-random codes as the number of combinations of the above-mentioned multiple initial values, there are a large number of types compared to the types of random codes obtained by relying on only a single initial value. The unique code can be used.

本発明によれば、同一コード長で互いに異なる2種類以上のM系列符号を例えば複数の初期値の設定により生成し、その各ビットの組み合わせにより多進の擬似ランダム符号を生成してパルス圧縮レーダ装置の送信信号に多相位相変調を行うものであるから、単一のバイナリーコードの使用に較べて膨大なコードの種類の固有コードをパルス拡散及び圧縮に利用可能である。   According to the present invention, two or more different M-sequence codes having the same code length are generated by setting a plurality of initial values, for example, and a multi-adic pseudo-random code is generated by a combination of each bit to generate a pulse compression radar. Since multiphase phase modulation is performed on the transmission signal of the apparatus, a large number of unique codes can be used for pulse spreading and compression compared to the use of a single binary code.

また、多進の擬似ランダム符号の利用により、パルス圧縮に使用するマッチドフィルタのパラメータが複雑になりパルス圧縮レーダ装置の秘匿性が向上し、信号を圧縮するレーダ情報の漏洩あるいはレーダの妨害電波等の合成を防止できる。   In addition, the use of multi-quadrature pseudo-random codes complicates the parameters of the matched filter used for pulse compression, improving the confidentiality of the pulse compression radar device, leaking radar information that compresses the signal, or interfering radio waves from the radar, etc. Can be prevented.

例えば従来の変調方式では15対1のパルス圧縮を行うシステムに例をとると、15種類のコードしか存在せず、コードを知らない部外者は15種類のコードでパルス圧縮動作を試してみれば正しいコードが判明するが、本発明による変調を行った場合は、15×14で210種類のコードで試みることが必要となり、解析が極めて困難になる。また、本発明では圧縮比においても128倍あるいは256倍となり、その差は極めて大きくなり効果が顕著である。   For example, in the case of a conventional modulation system that performs 15-to-1 pulse compression, there are only 15 types of code, and outsiders who do not know the code can try pulse compression with 15 types of code. If the modulation according to the present invention is performed, it is necessary to try with 15 kinds of codes of 15 × 14, and the analysis becomes extremely difficult. In the present invention, the compression ratio is also 128 times or 256 times, and the difference becomes extremely large, and the effect is remarkable.

(発明の実施の形態)
本発明の一実施の形態として2種類の固有のバイナリーコード使用した複合M系列符号によるパルス圧縮レーダ装置及びパルス圧縮レーダ装置の位相変調方法について説明する。
(Embodiment of the Invention)
As an embodiment of the present invention, a pulse compression radar apparatus using a composite M-sequence code using two kinds of unique binary codes and a phase modulation method of the pulse compression radar apparatus will be described.

(実施の形態の構成)
図1は本実施の形態のパルス圧縮レーダ装置の構成を示す図である。パルス圧縮レーダ装置のアナログ的な構成を示すブロック図であり、レーダパルスの送信側としてキャリア発生回路1、シンクロナイザー2、ゲート信号発生回路3、ゲート回路5、2つのM系列符号に基づき変調信号を発生するコード信号発生回路4及び位相変調回路6、受信側として位相検波回路8、マッチドフィルタ9及び信号検出及び信号処理回路10と、コード信号発生回路4で生成する2つのM系列符号でなるバイナリーコードの初期値と該バイナリーコードに対応するマッチドフィルタ9のパラメータに関する設定を行うパラメータ設定回路11と、無線周波のレーダパルスを送受する高周波回路7と、から構成される。各部の構成、機能の概要は次のとおりである。
(Configuration of the embodiment)
FIG. 1 is a diagram showing a configuration of a pulse compression radar apparatus according to the present embodiment. FIG. 2 is a block diagram showing an analog configuration of a pulse compression radar apparatus, and a modulated signal based on a carrier generation circuit 1, a synchronizer 2, a gate signal generation circuit 3, a gate circuit 5, and two M-sequence codes on the radar pulse transmission side. Code signal generation circuit 4 and phase modulation circuit 6 for generating signal, phase detection circuit 8 on the receiving side, matched filter 9 and signal detection and signal processing circuit 10, and two M-sequence codes generated by code signal generation circuit 4 It comprises a parameter setting circuit 11 for setting the initial value of the binary code and the parameters of the matched filter 9 corresponding to the binary code, and a high frequency circuit 7 for transmitting and receiving a radio frequency radar pulse. The outline of the configuration and function of each part is as follows.

送信側のキャリア発生回路1は送信パルスのキャリア信号を生成して出力し、シンクロナイザー2は前記キャリア信号を分周してタイミング信号を生成しゲート信号発生回路3及びコード信号発生回路4の発生タイミングを制御する。ゲート信号発生回路3は送信パルス幅のゲート信号を出力し、ゲート回路5はゲート信号発生回路3からのゲート信号によりキャリア発生回路1から出力されるキャリア信号をゲートして送信パルスを出力し、位相変調回路6に出力する。コード信号発生回路5は、後述する2系統のM系列発生ロジックにより発生したM系列符号から4進符号を生成し、該4進符号に基づきI,Q信号を生成して位相変調回路6の変調信号として出力する。位相変調回路6は、前記I,Q信号によりゲート回路5の出力を4相の位相変調を行い、4相位相変調波でなる送信パルスを出力し、高周波回路7のアップコンバータ、増幅器及び方向性結合器等を介してレーダアンテナに送出する。   A carrier generation circuit 1 on the transmission side generates and outputs a carrier signal of a transmission pulse, and a synchronizer 2 generates a timing signal by dividing the carrier signal to generate a gate signal generation circuit 3 and a code signal generation circuit 4 Control timing. The gate signal generation circuit 3 outputs a gate signal having a transmission pulse width, the gate circuit 5 outputs a transmission pulse by gating the carrier signal output from the carrier generation circuit 1 by the gate signal from the gate signal generation circuit 3, Output to the phase modulation circuit 6. The code signal generation circuit 5 generates a quaternary code from an M-sequence code generated by two M-sequence generation logics described later, generates I and Q signals based on the quaternary code, and modulates the phase modulation circuit 6 Output as a signal. The phase modulation circuit 6 performs four-phase phase modulation on the output of the gate circuit 5 based on the I and Q signals, and outputs a transmission pulse composed of a four-phase phase modulation wave. The signal is sent to the radar antenna via a coupler or the like.

受信側の位相検波回路8は、レーダアンテナから受信した送信パルスの反射信号(反射パルス)を方向性結合器、増幅器及びダウンコンバータ等を介して入力し、前記キャリア信号による同期検波等により位相検波してI,Q信号を出力し、マッチドフィルタ9に出力する。マッチドフィルタ9はI,Q信号の圧縮データを出力し、信号検出及び信号処理回路10は前記圧縮データのピークを検出して目標等の検出、表示等のための信号処理を行う。なお、高周波回路6は送信パルス及び反射パルスをローカル発振回路の出力で周波数変換するミキサ、無線周波信号を増幅する増幅器及びサーキュレータ等で構成される。   The phase detection circuit 8 on the receiving side inputs a reflection signal (reflection pulse) of the transmission pulse received from the radar antenna via a directional coupler, an amplifier, a down converter, etc., and performs phase detection by synchronous detection using the carrier signal. Then, I and Q signals are output and output to the matched filter 9. The matched filter 9 outputs compressed data of I and Q signals, and the signal detection and signal processing circuit 10 detects the peak of the compressed data and performs signal processing for detection and display of a target and the like. The high frequency circuit 6 includes a mixer that converts the frequency of the transmission pulse and the reflected pulse with the output of the local oscillation circuit, an amplifier that amplifies a radio frequency signal, a circulator, and the like.

次に、本実施の形態のパルス圧縮レーダ装置の主要機能であるコード信号発生回路5、位相変調回路6及びマッチドフィルタ9の構成をそれぞれ説明する。   Next, the configurations of the code signal generation circuit 5, the phase modulation circuit 6, and the matched filter 9, which are the main functions of the pulse compression radar apparatus according to the present embodiment, will be described.

図2は本実施の形態のコード信号発生回路4の構成例を示す図である。コード信号発生回路4はM系列符号発生回路41、4進符号発生回路42及びI,Q信号発生回路43により構成される。   FIG. 2 is a diagram illustrating a configuration example of the code signal generation circuit 4 according to the present embodiment. The code signal generation circuit 4 includes an M-sequence code generation circuit 41, a quaternary code generation circuit 42, and an I and Q signal generation circuit 43.

M系列符号発生回路41はM系列発生ロジックとして4段(4ビット)のシフトレジスタA、Bを使用した2系統の回路構成でなり、本実施の形態では各シフトレジスタA、Bは、従属接続した4段の記憶段(D型フリップフロップ機能)と、各シフトレジスタA、Bの最終段の出力bとその前段等の出力aを入力し、出力cを入力段に帰還するEX−OR(排他的論理和)回路等で構成可能なMod2Adder(モジュロ2加算器)とで構成される。   The M-sequence code generation circuit 41 has a two-system circuit configuration using four-stage (4-bit) shift registers A and B as the M-sequence generation logic. In this embodiment, each shift register A and B is connected in a dependent manner. EX-OR (D-type flip-flop function), the output b of the last stage of each shift register A, B and the output a of the preceding stage, etc., and the output c fed back to the input stage It is composed of Mod2Adder (modulo-2 adder) that can be composed of an exclusive OR circuit.

M系列符号発生回路41の各シフトレジスタA、Bの各段に相当するレジスタの表示「1」、「0」の数字はコードを発生させる前の初期値(シフトレジスタAは初期値:8「0001」、シフトレジスタBは初期値:12「0011」)を示している。それぞれ同一のM系列符号発生ロジックでそれぞれシフトレジスタの各段の信号をクロック信号によりシフトすることにより15ビットの固有の擬似ランダムバイナリコードが得られる。   The numbers “1” and “0” in the registers corresponding to the respective stages of the shift registers A and B of the M-sequence code generation circuit 41 are initial values before the code is generated (the shift register A has an initial value of 8 “ 0001 ", shift register B has an initial value of 12" 0011 "). A 15-bit unique pseudo-random binary code can be obtained by shifting the signal of each stage of the shift register by the clock signal with the same M-sequence code generation logic.

4進符号発生回路42はM系列符号発生回路41のシフトレジスタA、Bの各最終段の出力をセグメントとして、4進の擬似ランダムコードを生成する。つまり、シフトレジスタA、Bに2種類の初期値を与えることにより2種類のコードを生成でき、1セグメント当たり2ビット(4進)の擬似ランダムコードを生成して出力する。   The quaternary code generation circuit 42 generates a quaternary pseudo-random code using the outputs of the final stages of the shift registers A and B of the M-sequence code generation circuit 41 as segments. That is, two types of codes can be generated by giving two types of initial values to the shift registers A and B, and a 2-bit (quaternary) pseudo-random code is generated and output per segment.

I,Q信号発生回路43は4進符号化回路42の出力の2ビットのそれぞれを本実施の形態の位相平面のI軸及びQ軸上、つまり0度、90度、180度、270度の何れかに対応させるように4相位相変調するための変調信号(変調波形)に変換する。   The I and Q signal generation circuit 43 converts each of the 2 bits of the output of the quaternary encoding circuit 42 on the I axis and Q axis of the phase plane of this embodiment, that is, 0 degree, 90 degrees, 180 degrees, and 270 degrees. The signal is converted into a modulation signal (modulation waveform) for four-phase phase modulation so as to correspond to either one.

図3は本実施の形態の位相変調回路の構成を示す図である。2つの乗算回路61、62と各乗算回路の出力を合成するI,Q合成回路63とから構成される。各乗算回路61、62は、それぞれゲート回路5から出力されるキャリア信号として直交関係の送信I信号(sin)と送信Q信号(cos)を入力するとともに、コード信号発生回路4から前記送信I信号(sin)と送信Q信号(cos)に対し極性を反転するためのバイポーラ信号であるI,Q信号を入力しそれぞれを乗算する。I,Q合成回路63は乗算出力を合成することにより4相位相変調波が出力される。   FIG. 3 is a diagram showing the configuration of the phase modulation circuit of the present embodiment. The circuit includes two multiplication circuits 61 and 62 and an I and Q synthesis circuit 63 that synthesizes the outputs of the multiplication circuits. Each of the multiplying circuits 61 and 62 receives a transmission I signal (sin) and a transmission Q signal (cos) of orthogonal relation as carrier signals output from the gate circuit 5, and also transmits the transmission I signal from the code signal generation circuit 4. (Sin) and the transmission Q signal (cos) are input with I and Q signals, which are bipolar signals for inverting the polarity, and multiplied. The I and Q combining circuit 63 outputs a four-phase modulated wave by combining the multiplication outputs.

図4は本実施の形態のマッチドフィルタ9の構成例を示す図である。マッチドフィルタ9は位相検波回路8からのI,Q信号をそれぞれ入力する2つのシフトレジスタであって、各段が複数ビットで構成されたレジスタが使用された15ビット長シフトレジスタ91、92と、該15ビット長シフトレジスタ91、92のそれぞれ各段の出力を入力とする位相機能回路93a、93b、93c、…93oと、各位相機能回路93a、93b、93c、…93oからの出力を入力し、I信号に関する圧縮を行い圧縮Iデータを出力する加算回路(I)94と、Q信号に関する圧縮を行い圧縮Qデータを出力する加算回路(Q)95とで構成される。   FIG. 4 is a diagram illustrating a configuration example of the matched filter 9 according to the present embodiment. The matched filter 9 is two shift registers that respectively receive the I and Q signals from the phase detection circuit 8, and 15-bit length shift registers 91 and 92 each using a register having a plurality of bits, The phase function circuits 93a, 93b, 93c,... 93o that receive the outputs of the respective stages of the 15-bit length shift registers 91, 92 and the outputs from the phase function circuits 93a, 93b, 93c,. The adder circuit (I) 94 compresses the I signal and outputs compressed I data, and the adder circuit (Q) 95 compresses the Q signal and outputs compressed Q data.

(実施の形態の動作)
本実施の形態のパルス圧縮レーダ装置の動作及びその位相変調方法について以下詳細に説明する。本パルス圧縮レーダ装置ではその運用にあたり、コード信号発生回路4とマッチドフィルタ9に対しパラメータ設定部11からパラメータの設定が行われる。つまり、コード信号発生回路4に対しては生成する2系統のM系列符号を決定する各シフトレジスタA、Bの初期値の入力設定が行われ、マッチドフィルタ9に対しては当該M系列符号により生成される多進の擬似ランダム符号にマッチングのとれた相関フィルターを構成する設定が行われる。
(Operation of the embodiment)
The operation of the pulse compression radar apparatus of the present embodiment and the phase modulation method thereof will be described in detail below. In the operation of this pulse compression radar apparatus, parameters are set from the parameter setting unit 11 to the code signal generation circuit 4 and the matched filter 9. That is, the code signal generation circuit 4 is set to input initial values of the shift registers A and B that determine the two M-sequence codes to be generated, and the matched filter 9 is subjected to the M-sequence code. Settings are made to configure a correlation filter matched to the generated multi-ary pseudo-random code.

パラメータの設定後にパルス圧縮レーダ装置が起動されると、送信側の動作としては、シンクロナイザー2は所定周期でレーダパルスを送信するための同期信号をゲート信号発生回路3及びコード信号発生回路4に出力し、前記同期信号の入力毎にゲート信号発生回路3は前記M系列符号のビット長に相当する時間幅のゲート信号を出力し、コード信号発生回路4はM系列符号の生成を行いI,Q信号を変調信号として出力する。これによりゲート回路4から前記時間幅のキャリア信号が出力され、前記キャリア信号は位相変調回路6でコード信号発生回路5からの変調信号で位相変調され、高周波回路7でアップコンバートされてレーダアンテナから送信される。   When the pulse compression radar apparatus is activated after setting the parameters, the synchronizer 2 sends a synchronization signal for transmitting radar pulses at a predetermined cycle to the gate signal generation circuit 3 and the code signal generation circuit 4 as an operation on the transmission side. For each input of the synchronization signal, the gate signal generation circuit 3 outputs a gate signal having a time width corresponding to the bit length of the M-sequence code, and the code signal generation circuit 4 generates an M-sequence code to generate I, The Q signal is output as a modulation signal. As a result, the carrier signal having the time width is output from the gate circuit 4, and the carrier signal is phase-modulated by the phase modulation circuit 6 using the modulation signal from the code signal generation circuit 5, up-converted by the high-frequency circuit 7, and output from the radar antenna. Sent.

また、受信側の動作としては、レーダアンテナからの送信信号に基づく反射信号等が受信されると高周波回路7でダウンコンバートされて位相検波回路8でキャリア信号により同期検波され、I,Q信号としてマッチドフィルタ9に出力される。マッチドフィルタ9はM系列符号により生成される多進の擬似ランダム符号にマッチングのとれた相関フィルターを構成するように設定されているから、位相変調された送信パルスによる反射信号が受信されるとI,Q信号のパルス圧縮データが生成され、反射対象の物標の位置検出、表示等の処理を行う信号検出及び信号処理回路10に出力される。   As the operation on the receiving side, when a reflected signal or the like based on the transmission signal from the radar antenna is received, it is down-converted by the high-frequency circuit 7 and synchronously detected by the carrier signal by the phase detection circuit 8 to obtain I and Q signals. It is output to the matched filter 9. Since the matched filter 9 is set so as to constitute a correlation filter matched with the multi-quadrature pseudo-random code generated by the M-sequence code, when a reflected signal from the phase-modulated transmission pulse is received, I , Q signal pulse compression data is generated and output to the signal detection and signal processing circuit 10 which performs processing such as position detection and display of the target to be reflected.

そこで、本実施の形態の主要構成であるコード信号発生回路4及びマッチドフィルタ6の動作について説明する。まず、コード信号発生回路4での4進符号の発生、変換等と、位相変調回路6の位相変調形式及び位相変調波形について具体例により説明する。   Therefore, operations of the code signal generation circuit 4 and the matched filter 6 which are main components of the present embodiment will be described. First, the generation and conversion of the quaternary code in the code signal generation circuit 4 and the phase modulation format and phase modulation waveform of the phase modulation circuit 6 will be described with specific examples.

図5はコード信号発生回路4での4進コードの作成と変調位相との関係を示す図である。図2に示すM系列符号発生回路41の各シフトレジスタに、初期値として「8」と「12」を与えた場合に発生するそれぞれのM系列符号は、図5(a)に示すようなコード−1、コード−2となる。4進符号発生回路42では両コード−1、2の同じセグメントから各2ビットの4進コード11、01、00、00、01、…11を合成する。   FIG. 5 is a diagram showing the relationship between the creation of a quaternary code in the code signal generation circuit 4 and the modulation phase. Each M-sequence code generated when “8” and “12” are given as initial values to each shift register of the M-sequence code generation circuit 41 shown in FIG. 2 is a code as shown in FIG. -1 and code-2. The quaternary code generation circuit 42 synthesizes 2-bit quaternary codes 11, 01, 00, 00, 01,... 11 from the same segment of both codes-1 and -2.

4進コードの2ビットの全ての組み合わせは、「10」、「11」、「00」、「01」であり、本実施の形態では図5(b)に示すように、前記組み合わせをそれぞれ90度、0度、180度、270度に対応付けた位相変調形式を採用する。4進コードと変調位相との関係を複素平面に表わした様子は図5(c)に示すとおりである。なお、この位相変調形式は受信側の位相検波にレーダ装置の送信時のキャリア信号が利用可能であり良好な検波特性を実現可能である。   All combinations of 2 bits of the quaternary code are “10”, “11”, “00”, “01”, and in this embodiment, as shown in FIG. A phase modulation format associated with degrees, 0 degrees, 180 degrees, and 270 degrees is employed. A state in which the relationship between the quaternary code and the modulation phase is expressed in a complex plane is as shown in FIG. In this phase modulation format, a carrier signal at the time of transmission of the radar apparatus can be used for phase detection on the receiving side, and good detection characteristics can be realized.

本実施の形態では、かかる位相変調を可能とするためI,Q信号発生回路43において、4進コードと一対一に対応する位相変調の変調信号として、4進コードを0度と180度の変調を行うI信号の変調信号(波形)及び90度と270度の変調を行うQ信号の変調信号(波形)に変換する。   In this embodiment, in order to enable such phase modulation, the I and Q signal generation circuit 43 modulates the quaternary code at 0 degrees and 180 degrees as a modulation signal of phase modulation corresponding to the quaternary code on a one-to-one basis. The signal is converted into a modulation signal (waveform) of the I signal to be modulated and a modulation signal (waveform) of the Q signal to be modulated at 90 degrees and 270 degrees.

図6は2つのコード−1、2とI、Q信号の信号波形を示す図である。4進コードの変換後の信号波形(I,Q信号)は0レベルを含むバイポーラ信号である。図3に示す位相変調回路の乗算回路61、62は、それぞれI信号の「1」又は「−1」の場合にそれぞれsin信号と同相又は逆相の信号を出力し0度又は180度の位相変調を行い、Q信号の「1」又は「−1」の場合に同様にcos信号を0度又は180度の位相変調を行う。また、I,Q信号のそれぞれの0レベルでは乗算出力は0であるから、I,Q合成回路63の出力は図5(c)に示す4相位相変調出力となる。   FIG. 6 is a diagram showing signal waveforms of two codes-1, 2 and I and Q signals. The signal waveform (I, Q signal) after conversion of the quaternary code is a bipolar signal including 0 level. The multiplication circuits 61 and 62 of the phase modulation circuit shown in FIG. 3 respectively output a signal in phase with or out of phase with the sin signal when the I signal is “1” or “−1”, and the phase is 0 degree or 180 degrees. When the Q signal is “1” or “−1”, the cos signal is similarly phase-modulated by 0 degree or 180 degrees. Since the multiplication output is 0 at the 0 level of each of the I and Q signals, the output of the I and Q synthesis circuit 63 is a four-phase phase modulation output shown in FIG.

次に、図4に示す本実施の形態のマッチドフィルタ9の動作について説明する。マッチドフィルタ9は、位相検波回路8から出力されるI信号を15ビット長シフトレジスタ91に入力し、同Q信号を15ビット長シフトレジスタ92に入力する。ここでI,Q信号はバイポーラ信号に基づく多レベルの信号であるから5ビット長シフトレジスタ91、92の各段のレジスタも複数ビットでなり、2つの15ビット長シフトレジスタ91、92のそれぞれの各段の出力は位相機能回路A93a、B93b、C93c…O93oで、I,Q信号別に位相制御され、その出力はI,Q信号別に加算回路(I)94及び加算回路(Q)95で加算され、それぞれ圧縮Iデータ、圧縮Qデータが合成される。ここで各位相機能回路A93a、B93b、C93c、…O93oには、前述のパラメータの設定により位相量に関する4種類の組み合わせが与えられ、それぞれのシフトレジスタ91、92の各段に図6に示すI,Q信号の入力時に加算回路(I)94、(Q)95から最大の相関値の出力が得られるように構成されることにより、マッチドフィルタ9は前記多進の擬似ランダム符号にマッチングのとれた相関フィルターを構成する。   Next, the operation of the matched filter 9 of this embodiment shown in FIG. 4 will be described. The matched filter 9 inputs the I signal output from the phase detection circuit 8 to the 15-bit length shift register 91 and inputs the Q signal to the 15-bit length shift register 92. Here, since the I and Q signals are multi-level signals based on bipolar signals, the registers of each stage of the 5-bit length shift registers 91 and 92 are also composed of a plurality of bits, and each of the two 15-bit length shift registers 91 and 92 is provided. The output of each stage is phase-controlled by the phase function circuits A93a, B93b, C93c... O93o for each of the I and Q signals, and the output is added by the adder circuit (I) 94 and the adder circuit (Q) 95 for each I and Q signal. , Compressed I data and compressed Q data are combined. Here, each of the phase function circuits A93a, B93b, C93c,... O93o is given four types of combinations relating to the phase amount by setting the above-described parameters, and each stage of the shift registers 91 and 92 has an I shown in FIG. , Q signals are input so that the output of the maximum correlation value can be obtained from the adder circuits (I) 94, (Q) 95, so that the matched filter 9 can match the multi-random pseudo-random code. Configure a correlation filter.

図7は4進の擬似ランダム符号と該符号に対応するマッチドフィルタ9の出力を示す図である。コード−1、2による4進の擬似ランダム符号に基づいて変調された信号に対する位相検波出力のパルス圧縮後の時間波形を示している。同図に示すように送信信号を変調するコードと対をなす受信側のマッチドフィルタにより受信信号はパルス圧縮される。   FIG. 7 is a diagram showing a quaternary pseudo-random code and the output of the matched filter 9 corresponding to the code. The time waveform after the pulse compression of the phase detection output with respect to the signal modulated based on the quaternary pseudorandom code by code -1,2 is shown. As shown in the figure, the received signal is pulse-compressed by a matched filter on the receiving side that is paired with a code for modulating the transmitted signal.

(他の実施の形態)
以上の実施の形態においては、パルス拡散及び圧縮に4進の擬似ランダム符号を使用し、キャリア信号の位相(基準位相)に対し位相変調形式を0度、90度、180度、270度の4相位相変調とした構成例を示したが、この位相変調形式はキャリア信号の位相に対し45度、135度、225度、315度の位相変調とすることが可能である。この場合、キャリア信号の位相(0度)とその直交位相(90度)をI,Q軸とする位相変調となり、コード信号発生回路4では4進符号発生回路42に出力をそのままI,Q信号(「11」45度、「01」135度、「00」225度、「10」315度)として出力するように構成することが可能である。また、この場合のマッチドフィルタ9は、パラメータの設定により4相の位相変調の位相検波出力を入力する前記4進の擬似ランダム符号にマッチングのとれた相関フィルターを構成するだけでパルス圧縮が可能であることは明らかである。
(Other embodiments)
In the above embodiments, a quaternary pseudo-random code is used for pulse spreading and compression, and the phase modulation format is 0 degrees, 90 degrees, 180 degrees, or 270 degrees 4 with respect to the phase of the carrier signal (reference phase). Although a configuration example in which phase phase modulation is used is shown, this phase modulation format can be 45 °, 135 °, 225 °, and 315 ° phase modulation with respect to the phase of the carrier signal. In this case, phase modulation is performed with the carrier signal phase (0 degree) and its quadrature phase (90 degrees) as the I and Q axes, and the code signal generation circuit 4 outputs the output to the quaternary code generation circuit 42 as it is. (“11” 45 degrees, “01” 135 degrees, “00” 225 degrees, “10” 315 degrees) can be output. Further, in this case, the matched filter 9 can perform pulse compression only by configuring a correlation filter matched with the quaternary pseudo-random code that receives the phase detection output of the four-phase phase modulation by setting parameters. It is clear that there is.

また、前記実施の形態の多進の擬似ランダム符号は、異なるm種類(m≧2)のM系列符号とすることが可能であり、この場合、コード信号発生回路4では異なるm種類のM系列符号の各ビットの組み合わせにより2進の擬似ランダム符号が生成されるように構成され、位相変調回路6では前記2進の擬似ランダム符号により前記送信信号を2相に位相変調するように構成される。 Further, the multi-pseudo pseudo-random code of the above embodiment can be different m types (m ≧ 2) of M-sequence codes. In this case, the code signal generation circuit 4 uses different m types of M-sequences. pseudorandom code of 2 m ary by a combination of each bit of the code is configured to be generated, so as to phase modulate the transmission signal by the pseudo-random code of the phase modulation circuit in 6 the 2 m proceed to 2 m phase Composed.

以上の実施の形態の構成及び動作に関してアナログ的に説明したが、送信する変調出力の生成及び受信信号の処理は現実にはデジタル処理により行い得ることは明らかである。つまり、図1に示す主な回路ブロック1〜6、8〜11はデジタル処理により実現可能である。例えばキャリア発生はメモリに格納した波形データ(sin、cosデータ)の読み出しにより発生可能であり、ゲート回路5と位相変調回路6等ではI(sin)/Q(cos)の2系列のデータ演算で処理され、位相変調回路6ではI(sin)データを送信(種)I信号としQ(cos)データを送信(種)Q信号として、コード信号発生回路4からの変調信号(I,Q信号)との乗算により変調データを出力し、I,Q合成回路63での合成データ出力に対するD/A変換回路を設けて送信(種)信号としてアナログ変調出力に変換して出力する。また、M系列発生回路のシフトレジスタは遅延機能が実現可能なメモリを使用して実現することが可能であり、本実施の形態は位相検波回路8、マッチドフィルタ8及び信号検出及び処理装置9を含めてDSP(Digital Signal Processor)により実現することが可能である。   Although the configuration and operation of the above embodiment have been described in an analog manner, it is obvious that the generation of the modulation output to be transmitted and the processing of the received signal can actually be performed by digital processing. That is, the main circuit blocks 1 to 6 and 8 to 11 shown in FIG. 1 can be realized by digital processing. For example, carrier generation can be generated by reading waveform data (sin, cos data) stored in a memory, and the gate circuit 5 and the phase modulation circuit 6 perform two series of data operations of I (sin) / Q (cos). In the phase modulation circuit 6, the modulation signal (I, Q signal) from the code signal generation circuit 4 is transmitted using I (sin) data as a transmission (seed) I signal and Q (cos) data as a transmission (seed) Q signal. The D / A conversion circuit for the combined data output from the I and Q combining circuit 63 is provided and converted into an analog modulation output as a transmission (seed) signal and output. Further, the shift register of the M-sequence generation circuit can be realized by using a memory capable of realizing a delay function, and this embodiment includes the phase detection circuit 8, the matched filter 8, and the signal detection and processing device 9. In addition, it can be realized by a DSP (Digital Signal Processor).

本発明は、レーダ分野、ソーナー分野、距離測定分野、通信分野のパルス圧縮レーダ装置等に適用可能である。   The present invention can be applied to a pulse compression radar apparatus or the like in the radar field, the sonar field, the distance measurement field, and the communication field.

本実施の形態のパルス圧縮レーダ装置の構成を示す図である。It is a figure which shows the structure of the pulse compression radar apparatus of this Embodiment. 本実施の形態のコード信号発生回路4の構成例を示す図である。It is a figure which shows the structural example of the code signal generation circuit 4 of this Embodiment. 本実施の形態の位相変調回路の構成を示す図である。It is a figure which shows the structure of the phase modulation circuit of this Embodiment. 本実施の形態のマッチドフィルタ9の構成例を示す図である。It is a figure which shows the structural example of the matched filter 9 of this Embodiment. コード信号発生回路4での4進コードの作成と変調位相との関係を示す図である。FIG. 6 is a diagram illustrating a relationship between the generation of a quaternary code and a modulation phase in the code signal generation circuit 4; 2つのコード−1、2とI、Q信号の信号波形を示す図である。It is a figure which shows the signal waveform of two code | symbol-1 and 2 and I and Q signal. 4進の擬似ランダムと該符号に対応するマッチドフィルタ9の出力を示す図である。It is a figure which shows the output of the matched filter 9 corresponding to a quaternary pseudorandom and this code | symbol. シフトレジスタによるM系列符号発生回路を示す図である。It is a figure which shows the M series code generation circuit by a shift register. M系列符号発生回路で発生されるバイナリーコードによる2相位相変調波形を示す図である。It is a figure which shows the two-phase phase modulation waveform by the binary code generate | occur | produced by the M series code generation circuit.

符号の説明Explanation of symbols

1 キャリア発生回路
2 シンクロナイザー
3 ゲート信号発生回路
4 コード信号発生回路
5 ゲート回路
6 4相位相変調回路
7 高周波回路
8 位相検波回路
9 マッチドフィルタ
10 信号検出及び信号処理回路
11 パラメータ設定回路
41 M系列符号発生回路
42 4進符号発生回路
43 IQ信号発生回路
61、62 乗算回路
63 I,Q合成回路
91、92 シフトレジスタ
93a、93b、93c、93o 位相機能回路
94、95 加算回路
DESCRIPTION OF SYMBOLS 1 Carrier generation circuit 2 Synchronizer 3 Gate signal generation circuit 4 Code signal generation circuit 5 Gate circuit 6 Four phase phase modulation circuit 7 High frequency circuit 8 Phase detection circuit 9 Matched filter 10 Signal detection and signal processing circuit 11 Parameter setting circuit 41 M series Code generation circuit 42 Quaternary code generation circuit 43 IQ signal generation circuit 61, 62 Multiplication circuit 63 I, Q synthesis circuit 91, 92 Shift registers 93a, 93b, 93c, 93o Phase function circuits 94, 95 Addition circuit

Claims (9)

送信信号を擬似ランダム符号により位相変調するパルス圧縮レーダ装置であって、同一コード長で互いに異なる2種類以上のM系列符号を生成し、異なるM系列符号の各ビットを組み合わせ多進の擬似ランダム符号を生成するコード信号発生手段と、生成した多進の擬似ランダム符号に基づいて送信信号を多相に位相変調する位相変調手段と、を備えることを特徴とするパルス圧縮レーダ装置。 A pulse compression radar apparatus for phase-modulating a transmission signal with a pseudo-random code, generating two or more different M-sequence codes with the same code length, and combining each bit of different M-sequence codes into a multi-ary pseudo-random code A pulse compression radar apparatus comprising: a code signal generating means for generating a transmission signal; and a phase modulation means for phase-modulating a transmission signal in multiple phases based on the generated multi-ary pseudo-random code. 前記コード信号発生手段は、異なる2種類以上のM系列符号を生成する2個以上のM系列符号発生回路と、前記異なる2種類以上のM系列符号の各ビットを組み合わせ多進の擬似ランダム符号を生成する多進符号発生手段と、を備えることを特徴とする請求項1記載のパルス圧縮レーダ装置。 The code signal generation means combines two or more M-sequence code generation circuits for generating two or more different types of M-sequence codes with each bit of the two or more different types of M-sequence codes to generate a multi-random pseudo-random code. The pulse compression radar apparatus according to claim 1, further comprising a multi-code generation means for generating. 前記2個以上のM系列符号発生回路は異なる初期値を設定することにより前記2種類以上のM系列符号を生成することを特徴とする請求項2記載のパルス圧縮レーダ装置。 3. The pulse compression radar apparatus according to claim 2, wherein the two or more M-sequence code generation circuits generate the two or more types of M-sequence codes by setting different initial values. 前記送信信号による反射信号を受信し、多相の位相変調の位相検波出力を入力する前記多進の擬似ランダム符号にマッチングのとれた相関フィルターを備えることを特徴とする請求項1、2又は3記載のパルス圧縮レーダ装置。 4. A correlation filter that receives a reflection signal from the transmission signal and matches a multi-phase pseudo-random code that receives a phase detection output of multi-phase modulation. The pulse compression radar apparatus described. 前記M系列符号は2種類のM系列符号であり、前記位相変調手段は4進の擬似ランダム符号を送信信号の位相を0位相として0、π/4、π/2、3π/4の4相の位相変調とすることを特徴とする請求項1ないし4の何れかの請求項記載のパルス圧縮レーダ装置。 The M-sequence code is two types of M-sequence codes, and the phase modulation means uses a quaternary pseudo-random code as a four-phase phase of 0, π / 4, π / 2, and 3π / 4 with the phase of the transmission signal as 0 phase. The pulse compression radar apparatus according to any one of claims 1 to 4, wherein the phase modulation is performed as follows. 送信信号を擬似ランダム符号により位相変調するパルス圧縮レーダ装置の位相変調方法であって、同一コード長で互いに異なる2種類以上のM系列符号を生成し、異なるM系列符号の各ビットの組み合わせにより多進の擬似ランダム符号を生成し、該多進の擬似ランダム符号により前記送信信号を多相に位相変調することを特徴とするパルス圧縮レーダ装置の位相変調方法。 A phase modulation method for a pulse compression radar apparatus that phase-modulates a transmission signal with a pseudo-random code, wherein two or more different M-sequence codes having the same code length are generated, and multiple combinations of bits of different M-sequence codes are used. A phase modulation method for a pulse compression radar apparatus, comprising: generating a pseudo-random code of a hex, and phase-modulating the transmission signal into a polyphase using the quasi-random pseudo-random code. 前記異なる2種類以上のM系列符号は、異なる初期値を設定した2個以上のM系列符号発生回路により生成することを特徴とする請求項6記載のパルス圧縮レーダ装置の位相変調方法。 The phase modulation method for a pulse compression radar apparatus according to claim 6, wherein the two or more different types of M-sequence codes are generated by two or more M-sequence code generation circuits having different initial values. 前記送信信号による反射信号に対し、多相の位相変調の位相検波出力を入力する前記多進の擬似ランダム符号にマッチングのとれた相関フィルターによりパルス圧縮を行うことを特徴とする請求項6又は7記載のパルス圧縮レーダ装置の位相変調方法。 8. The pulse compression is performed on the reflected signal by the transmission signal by a correlation filter matched with the multi-phase pseudo-random code that inputs a phase detection output of multi-phase modulation. A phase modulation method for the pulse compression radar apparatus according to the description. 前記M系列符号は2種類のM系列符号であり、前記位相変調は4進の擬似ランダム符号を送信信号の位相を0位相として0、π/4、π/2、3π/4の4相の位相変調とすることを特徴とする請求項6ないし8の何れかの請求項記載のパルス圧縮レーダ装置の位相変調方法。 The M-sequence code is two types of M-sequence codes, and the phase modulation is a quaternary pseudo-random code with four phases of 0, π / 4, π / 2, and 3π / 4, where the phase of the transmission signal is 0 phase. 9. The phase modulation method for a pulse compression radar apparatus according to claim 6, wherein phase modulation is used.
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