JP2008102631A - 半導体集積回路システムの設計方法、半導体集積回路実装基板の設計方法、パッケージの設計方法、半導体集積回路の設計方法、半導体集積回路システムの設計装置、半導体集積回路システム、半導体集積回路実装基板、パッケージ、および半導体集積回路 - Google Patents
半導体集積回路システムの設計方法、半導体集積回路実装基板の設計方法、パッケージの設計方法、半導体集積回路の設計方法、半導体集積回路システムの設計装置、半導体集積回路システム、半導体集積回路実装基板、パッケージ、および半導体集積回路 Download PDFInfo
- Publication number
- JP2008102631A JP2008102631A JP2006283098A JP2006283098A JP2008102631A JP 2008102631 A JP2008102631 A JP 2008102631A JP 2006283098 A JP2006283098 A JP 2006283098A JP 2006283098 A JP2006283098 A JP 2006283098A JP 2008102631 A JP2008102631 A JP 2008102631A
- Authority
- JP
- Japan
- Prior art keywords
- integrated circuit
- semiconductor integrated
- designing
- package substrate
- heat conduction
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/153—Connection portion
- H01L2924/1531—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
- H01L2924/15311—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
Landscapes
- Design And Manufacture Of Integrated Circuits (AREA)
- Logic Circuits (AREA)
Abstract
【課題】半導体集積回路の大規模化、高集積化に際しても、作業性よく、半導体集積回路の設計を行い、熱特性に優れた半導体集積回路システムを設計する方法を提供する。
【解決手段】システム仕様情報に基づき、当該システムを収納する筐体および、前記筐体内に収納され、当該システムを構成する実装基板と、前記実装基板上に実装されるパッケージ基板を含むパッケージの設計を行う第1の工程と、前記設計を行う工程で得られた設計結果に基づき、前記筐体内における前記実装基板および前記パッケージの熱解析を行う工程と、前記熱解析を行う工程の解析結果に基づき、半導体集積回路システムの設計を行う第2の工程とを含む。望ましくは、この第2の工程では、半導体集積回路の素子配置を決定するように、前記パッケージに搭載する半導体集積回路の設計を行う。
【選択図】図1
【解決手段】システム仕様情報に基づき、当該システムを収納する筐体および、前記筐体内に収納され、当該システムを構成する実装基板と、前記実装基板上に実装されるパッケージ基板を含むパッケージの設計を行う第1の工程と、前記設計を行う工程で得られた設計結果に基づき、前記筐体内における前記実装基板および前記パッケージの熱解析を行う工程と、前記熱解析を行う工程の解析結果に基づき、半導体集積回路システムの設計を行う第2の工程とを含む。望ましくは、この第2の工程では、半導体集積回路の素子配置を決定するように、前記パッケージに搭載する半導体集積回路の設計を行う。
【選択図】図1
Description
本発明は、半導体集積回路システムの設計方法、半導体集積回路実装基板の設計方法、パッケージの設計方法、半導体集積回路の設計方法、半導体集積回路システムの設計装置、半導体集積回路システム、半導体集積回路実装基板、パッケージ、および半導体集積回路に係り、特に熱特性に優れた半導体集積回路システムを設計する方法に関する。
半導体集積回路(LSI)は、微細化、高集積化が進む一方であり、微細化が進むにつれて、素子配置により、ある場所は温度が高く、ある場所は温度が低く、というように半導体集積回路を構成するチップ内部に温度の差が生じるという現象が顕著となり、チップの消費電力や、動作周波数、信頼性に与える問題が顕在化してきている。このようなチップ上の発熱は、リーク電流や動作周波数、エレクトロマイグレーションなどに影響を及ぼす可能性がある。
一方、このような半導体集積回路は、コンピュータはもちろんのこと、携帯電話等の通信機器、一般家庭製品や玩具、自動車まで利用範囲が拡大しており、これらの製品から生じる不要輻射がテレビ・ラジオ等の受信装置の電波障害や他システムの誤動作の原因として問題になっている。これらの問題に対して、フィルタリングやシールディングといった製品全体としての対策も施されているが、これらの問題に、上記熱的な影響が加わり問題が深刻となっている。このような状況の中で、熱的な影響は、半導体集積回路のみならずこれを実装するパッケージおよびこれを搭載する実装基板を含む、半導体集積回路システムに大きく左右されるため、上記ノイズ抑制を含む熱対策が避けることのできない問題となってきている。
一方、このような半導体集積回路は、コンピュータはもちろんのこと、携帯電話等の通信機器、一般家庭製品や玩具、自動車まで利用範囲が拡大しており、これらの製品から生じる不要輻射がテレビ・ラジオ等の受信装置の電波障害や他システムの誤動作の原因として問題になっている。これらの問題に対して、フィルタリングやシールディングといった製品全体としての対策も施されているが、これらの問題に、上記熱的な影響が加わり問題が深刻となっている。このような状況の中で、熱的な影響は、半導体集積回路のみならずこれを実装するパッケージおよびこれを搭載する実装基板を含む、半導体集積回路システムに大きく左右されるため、上記ノイズ抑制を含む熱対策が避けることのできない問題となってきている。
このような状況下、各製品において半導体集積回路システムはキーデバイスとして位置付けられており、製品の競争力確保のために、半導体集積回路システムの大規模化・高速化が要求されている。製品サイクルが短くなる中で、これらの要求に答えるためには半導体集積回路システム設計の自動化が必須であり、種々の研究がなされている。
回路装置の直流特性を解析することにより、回路装置が発生する発熱量を算出する方法も提案されている(特許文献1)。
上記特許文献1の装置は、直流特性の解析結果に基づいて回路装置が発生する発熱量を算出し、この発熱量に基づいて解析条件を再設定するもので、発熱量を考慮しているため、精度の向上を図ることが可能となる。
しかしながら、個々の回路素子の発熱量を解析し、解析条件を再設定する点が示されているのみであるのに対し、近年、半導体集積回路の大規模化、高集積化は高まる一方であり、半導体集積回路の大規模化、高集積化に伴い、半導体集積回路の回路設計の複雑化のみならず、動作特性に与える熱的影響は深刻であり、半導体集積回路だけでなく、パッケージ基板や、実装基板ひいては筐体についても熱特性を無視することはできなくなってきている。
しかしながら、個々の回路素子の発熱量を解析し、解析条件を再設定する点が示されているのみであるのに対し、近年、半導体集積回路の大規模化、高集積化は高まる一方であり、半導体集積回路の大規模化、高集積化に伴い、半導体集積回路の回路設計の複雑化のみならず、動作特性に与える熱的影響は深刻であり、半導体集積回路だけでなく、パッケージ基板や、実装基板ひいては筐体についても熱特性を無視することはできなくなってきている。
また、信号配線の複雑な引き回しが発生するため、不要輻射(EMI)解析、熱解析は複雑となり、設計の最適化に際し、完全な自動化は困難であり、マニュアルでの修正が必要となり、開発時間の増大を招くという問題もあった。
本発明は前記実情に鑑みてなされたもので、半導体集積回路の大規模化、高集積化に際しても、作業性よく、半導体集積回路、パッケージ、実装基板の設計を行い、熱特性に優れ、信頼性の高い半導体集積回路システムを提供することを目的とする。
そこで本発明では、半導体集積回路の発熱を考慮し、パッケージ、実装基板、これを収納する筐体をも含む半導体集積回路システム全体として、半導体集積回路のレイアウト設計を行うようにしたことを特徴とする。
すなわち、本発明の半導体集積回路システムの設計方法は、システム仕様情報に基づき、当該システムを収納する筐体および、前記筐体内に収納され、当該システムを構成する実装基板と、前記実装基板上に実装されるパッケージ基板を含むパッケージの設計を行う第1の工程と、前記設計を行う工程で得られた設計結果に基づき、前記筐体内における前記実装基板および前記半導体集積回路装置の熱解析を行う工程と、前記熱解析を行う工程の解析結果に基づき、半導体集積回路システムの設計を行う第2の工程とを含む。望ましくは、この第2の工程では、半導体集積回路の素子配置を決定するように、前記パッケージに搭載する半導体集積回路の設計を行う。
この方法によれば、半導体集積回路システムの設計に際し、熱解析を行った後、この解析結果に基づき、半導体集積回路の素子配置、あるいは、パッケージ基板への実装構造、実装基板上での配置などを決定しているため、熱特性に優れた半導体集積回路システムの実現をはかることができる。
例えば消費電力マップに従い、熱伝導の方向と大きさを示す熱伝導ベクトルを作成し、この熱伝導ベクトルを指標にして、半導体集積回路装置、パッケージ、実装基板、さらには筐体を含む半導体集積回路システムとしての熱解析を実現し、半導体集積回路装置、パッケージ、実装基板、さらには筐体を含む半導体集積回路システムの信頼性の向上を図る。すなわち半導体集積回路の素子配置を、半導体集積回路の内部条件のみならず、筐体を含む実装基板およびパッケージ基板の熱解析情報に基づいて最適化することで、実装基板、パッケージ基板、半導体集積回路全体の最適化を実施することが可能となる。
また、自動化対応が可能となる。
すなわち、本発明の半導体集積回路システムの設計方法では、システム仕様情報に基づき、当該システムを収納する筐体および、前記筐体内に収納され、当該システムを構成する実装基板と、前記実装基板上に実装されるパッケージ基板を含む半導体集積回路(LSI)装置の設計を行う第1の工程と、前記設計を行う工程で得られた設計結果に基づき、前記筐体内における前記実装基板および/または前記半導体集積回路装置の熱解析を行う工程と、前記熱解析を行う工程の解析結果に基づき半導体集積回路システムを設計する第2の工程とを含む。
また、本発明では、上記半導体集積回路システムの設計方法において、前記第2の工程は、前記半導体集積回路装置に搭載する半導体集積回路の素子配置を決定し、前記半導体集積回路の設計を行う工程を含む。
また、本発明では、上記半導体集積回路システムの設計方法において、システム仕様情報に基づき、当該システムを収納する筐体および、前記筐体内に収納され、当該システムを構成する実装基板の設計を行う工程と、前記実装基板の設計を行う工程で得られた設計結果に基づき、前記筐体内における前記実装基板の熱解析を行う工程と、前記熱解析を行う工程の解析結果に基づき、前記実装基板上に実装されるパッケージ基板を含む半導体集積回路装置の設計を行う工程とを含む。
また、本発明では、上記半導体集積回路システムの設計方法において、前記実装基板の設計工程は、前記筐体内の熱解析を行う工程と、前記熱解析を行う工程の解析結果に基づき、前記筐体内に収納される実装基板を設計する工程を含む。
また、本発明では、上記半導体集積回路システムの設計方法において、前記半導体集積回路装置は、外部接続端子が格子状に配置されたグリッドアレイ端子構造を持つものを含む。
また、本発明では、上記半導体集積回路システムの設計方法において、前記熱解析を行う工程は、前記実装基板の表面温度をシミュレートする工程と、前記表面温度に基づいて等熱線を描画する工程と、前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む。
また、本発明では、上記半導体集積回路システムの設計方法において、前記実装基板の表面温度をシミュレートする工程は、前記実装基板に搭載する各半導体集積回路装置の消費電力に基づいて表面温度をシミュレートする工程とを含む。
また、本発明では、上記半導体集積回路システムの設計方法において、前記第1の工程は、システム仕様情報に基づき、当該システムを構成する実装基板の設計を行う工程と、前記実装基板の設計を行う工程で得られた設計結果に基づき、前記実装基板上に実装されるパッケージ基板を含むパッケージの設計を行う工程と、前記パッケージの設計を行う工程で得られた設計結果に基づき、半導体集積回路のI/O端子位置を決定するように、前記パッケージに搭載する半導体集積回路の設計を行う工程を含む。
また、本発明は、パッケージ基板上に半導体集積回路を搭載して、筐体内に収納される半導体集積回路実装基板上で所望のシステムを構成する半導体集積回路の設計方法であって、前記半導体集積回路および、前記半導体集積回路実装基板の前記筐体内における熱解析を行う工程と、熱解析結果に基づき、前記半導体集積回路を設計する工程とを含む。
また、本発明では、上記半導体集積回路の設計方法において、前記熱解析を行う工程は、前記半導体集積回路の消費電力に基づいて表面温度をシミュレートする工程と、前記表面温度に基づいて等熱線を描画する工程と、前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路を設計する工程は、素子配置に基づく熱伝導による温度変化を設計条件に組み入れる工程を含む。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路を設計する工程は、当該半導体集積回路の発熱量に応じて前記半導体集積回路の表面高さを調整する工程を含む。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路を設計する工程は、前記システム仕様にもとづく素子配置から消費電力マップを作成する工程と、前記消費電力マップに基づき熱伝導ベクトルを作成する工程とを含む。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路を設計する工程は、筐体内に収納される半導体集積回路実装基板の放熱状況に応じて、前記半導体集積回路の位置および向きを決定するものを含む。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路を設計する工程は、前記熱伝導ベクトルにあわせて、放熱し易い方向に発熱量の大きい回路素子の配置を変更する工程であるものを含む。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路を設計する工程は、前記熱伝導ベクトルの向かう方向を避けて、熱耐性の小さい素子を配置する工程を含む。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路は、複数の半導体集積回路を積層する際に、その上層または下層に隣接して配置される半導体集積回路の熱伝導ベクトルを考慮して、熱伝導ベクトルの総和が0に近づくように設計される。
また、本発明では、上記半導体集積回路の設計方法において、前記半導体集積回路は、複数のパッケージを積層する際に、その上層または下層に隣接して配置されるパッケージの熱伝導ベクトルを考慮して、半導体集積回路装置としての熱伝導ベクトルの総和が0に近づくように設計されるものを含む。
また、本発明は、半導体集積回路を搭載して、半導体集積回路実装基板上で所望のシステムを構成するパッケージ基板の設計方法であって、前記半導体集積回路および、前記半導体集積回路実装基板の熱解析を行う工程と、熱解析結果とに基づき、前記パッケージ基板を設計する工程とを含む。
また、本発明では、上記パッケージ基板の設計方法において、前記熱解析を行う工程は、前記半導体集積回路の消費電力とパッケージ基板上の配線パターンに基づいて表面温度をシミュレートする工程と、前記表面温度に基づいて前記パッケージ基板上で等熱線を描画する工程と、前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む。
また、本発明では、上記パッケージ基板の設計方法において、パッケージ基板の構造に基づく熱伝導による温度変化を設計条件に組み入れる工程を含む。
また、本発明では、上記パッケージ基板の設計方法において、前記パッケージ基板を設計する工程は、当該半導体集積回路の発熱量に応じて前記パッケージ全体としての表面高さを調整する工程を含む。
また、本発明では、上記パッケージ基板の設計方法において、前記パッケージ基板を設計する工程は、前記システム仕様にもとづくパッケージ基板の構造から消費電力マップを作成する工程と、前記消費電力マップに基づき熱伝導ベクトルを作成する工程とを含む。
また、本発明では、上記パッケージ基板の設計方法において、前記パッケージ基板を設計する工程は、筐体内に収納される半導体集積回路実装基板の放熱状況に応じて、前記パッケージ基板の位置および向きを決定するものを含む。
また、本発明では、上記パッケージ基板の設計方法において、前記パッケージ基板を設計する工程は、前記熱伝導ベクトルにあわせて、放熱し易い方向に発熱量の大きいパッケージの配置を変更する工程である。
また、本発明では、上記パッケージ基板の設計方法において、前記パッケージ基板を設計する工程は、前記熱伝導ベクトルの向かう方向を避けて、熱耐性の小さい素子を配置する工程を含む。
また、本発明では、上記パッケージ基板の設計方法において、少なくとも1層の電源・接地プレーンを含み、前記電源プレーンが、前記半導体集積回路の熱伝導ベクトルに従って形状を変更するように、前記パッケージ基板を構成する工程を含む。
また、本発明では、上記パッケージ基板の設計方法において、前記パッケージ基板は、複数のパッケージを積層する際に、その上層または下層に隣接して配置されるパッケージの熱伝導ベクトルを考慮して、半導体集積回路装置としての熱伝導ベクトルの総和が0に近づくように設計される。
また、本発明では、上記パッケージ基板の設計方法において、前記パッケージ基板を構成する工程は、熱伝導ベクトルの大きい領域に熱遮断手段を配する工程を含む。
また、本発明は、半導体集積回路を搭載したパッケージ基板を実装し、所望のシステムを構成する半導体集積回路実装基板の設計方法であって、搭載すべきパッケージの熱解析を行なう工程と、前記解析結果に基づき、熱的に安定な状態を維持できるように、前記パッケージを構成するパッケージ基板に搭載された半導体集積回路を接続するための配線パターンを備えた半導体集積回路実装基板を設計する工程を含む。
また、本発明は、半導体集積回路実装基板の設計方法において、前記熱解析を行う工程は、前記半導体集積回路の消費電力に基づいて前記パッケージ基板の表面温度をシミュレートする工程と、前記表面温度に基づいて等熱線を描画する工程と、前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む。
また、本発明は、半導体集積回路実装基板の設計方法において、前記半導体集積回路実装基板の設計方法は、発熱量の大きいパッケージが隣接配置されるのを避けるように、設計を行うようにしたものを含む。
また、本発明は、半導体集積回路実装基板の設計方法において、前記半導体集積回路実装基板の設計方法は、発熱量の大きいパッケージを集中して配置し、当該位置に強制冷却手段を配するようにしたものを含む。
また、本発明は、上記のパッケージ基板の設計方法で得られるパッケージ基板であって、パッケージ基板が熱遮断手段を有することを特徴とする。
また、本発明では、パッケージ基板において、前記熱遮断手段は、電源プレーンまたは接地プレーンに設けられたスリットに充填された絶縁体で構成してもよい。
また、本発明では、パッケージ基板において、前記熱遮断手段は、パッケージ基板に設けられた貫通スリットで構成してもよい。
また、本発明では、パッケージ基板において、前記熱遮断手段は、配線パターンを避けてパッケージ基板に設けられた複数の貫通ビアで構成してもよい。
また、本発明の半導体集積回路システムは、上記半導体集積回路システムの設計方法に基づいて製造される。
また、本発明の半導体集積回路は、上記半導体集積回路の設計方法に基づいて製造される。
また、本発明の半導体集積回路実装基板は、上記半導体集積回路実装基板の設計方法に基づいて製造される。
また、本発明は、上記半導体集積回路実装基板が熱遮断手段を有するものを含む。
また、本発明では、上記半導体集積回路実装基板において、前記熱遮断手段を、電源プレーンまたは接地プレーンに設けられたスリットに充填された絶縁体で構成してもよい。
また、本発明では、上記半導体集積回路実装基板において、前記熱遮断手段は、半導体集積回路実装基板に設けられた貫通スリットで構成されていてもよい。
また、本発明では、上記半導体集積回路実装基板において、前記熱遮断手段は、配線パターンを避けて半導体集積回路実装基板に設けられた複数の貫通ビアで構成されていてもよい。
また、本発明の半導体集積回路システムの設計装置は、半導体集積回路の消費電力とパッケージ基板上の配線パターンに基づいて表面温度をシミュレートする温度シミュレーション手段と、前記表面温度に基づいて前記パッケージ基板上で等熱線を描画する等熱線描画手段と、前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する熱伝導ベクトル算出手段とを含み、半導体集積回路システムの熱解析を行うことを特徴とする。
また、本発明の物体の熱解析方法は、物体の表面温度をシミュレートする工程と、前記表面温度に基づいて等熱線を描画する工程と、前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む。
この熱解析方法は、半導体集積回路、パッケージ基板、実装基板に限定されること無く、拡散炉、真空チャンバーの温度プロファイルの解析など、種々の物体の熱解析に適用可能である。
この熱解析方法は、半導体集積回路、パッケージ基板、実装基板に限定されること無く、拡散炉、真空チャンバーの温度プロファイルの解析など、種々の物体の熱解析に適用可能である。
上記構成によれば、半導体集積回路実装基板、パッケージ(パッケージ基板)を含む半導体集積回路の、熱特性を考慮し、筐体、半導体集積回路実装基板、パッケージ(パッケージ基板)に応じた半導体集積回路を設計するようにしているため、設計の高速化を図ることができると共に、熱特性に優れた半導体集積回路システムを提供することが可能となる。
以下本発明の実施の形態について図面を参照しつつ詳細に説明する。
実施の形態の説明に先立ち、本実施の形態で用いられる用語について説明する。
図10に一例を示すように、半導体集積回路2は、パッケージ基板1上にボンディングワイヤあるいはバンプを介して接続されている。そして、パッケージ基板1上に半導体集積回路2を接続し、さらに、半導体集積回路2を封止樹脂3でモールドし、半田ボール4などの外部出力端子を導出したものを半導体集積回路装置と呼ぶ。そしてパッケージ基板1と封止樹脂などのキャップ材料と、外部出力端子とをあわせてパッケージと呼ぶ。さらに、筐体内に実装基板が設置され、その実装基板上に半導体集積回路装置が設置されている全体を半導体集積回路システムと呼ぶ。
(実施の形態1)
本発明の実施の形態の説明に先立ち、まず本発明の概念について説明する。
本発明は、図1にその概念図を示すように、システム仕様情報S1001に基づき、当該システムを収納する筐体および、実装基板と、この実装基板上に実装される半導体集積回路装置のパッケージ基板の設計を行う第1の工程S1002と、前記設計を行う工程で得られた設計結果に基づき、前記筐体内における前記実装基板および前記半導体集積回路装置の熱解析を行う工程S1003と、前記熱解析を行う工程の解析結果に基づき、半導体集積回路の素子配置を決定するように、前記パッケージに搭載する半導体集積回路の設計を行う第2の工程S1004とを含むことを特徴としている。
実施の形態の説明に先立ち、本実施の形態で用いられる用語について説明する。
図10に一例を示すように、半導体集積回路2は、パッケージ基板1上にボンディングワイヤあるいはバンプを介して接続されている。そして、パッケージ基板1上に半導体集積回路2を接続し、さらに、半導体集積回路2を封止樹脂3でモールドし、半田ボール4などの外部出力端子を導出したものを半導体集積回路装置と呼ぶ。そしてパッケージ基板1と封止樹脂などのキャップ材料と、外部出力端子とをあわせてパッケージと呼ぶ。さらに、筐体内に実装基板が設置され、その実装基板上に半導体集積回路装置が設置されている全体を半導体集積回路システムと呼ぶ。
(実施の形態1)
本発明の実施の形態の説明に先立ち、まず本発明の概念について説明する。
本発明は、図1にその概念図を示すように、システム仕様情報S1001に基づき、当該システムを収納する筐体および、実装基板と、この実装基板上に実装される半導体集積回路装置のパッケージ基板の設計を行う第1の工程S1002と、前記設計を行う工程で得られた設計結果に基づき、前記筐体内における前記実装基板および前記半導体集積回路装置の熱解析を行う工程S1003と、前記熱解析を行う工程の解析結果に基づき、半導体集積回路の素子配置を決定するように、前記パッケージに搭載する半導体集積回路の設計を行う第2の工程S1004とを含むことを特徴としている。
図2にこの方法の詳細な工程を示すフローチャートを用いて説明する。
まず実装基板/筐体の熱解析ステップS2001では、半導体集積回路装置の消費電力と実装基板/筐体のレイアウト、筐体内のエアーフローから、実装基板の熱解析を行う。この時、半導体集積回路装置毎の消費電力は、通常半導体集積回路のRTLベースの消費電力見積もりを行うか、あるいは半導体集積回路の仮レイアウト実施後、ゲートレベルでの消費電力見積もりを行うかのいずれかの方法を用いて計算する。これらの計算には、通常パッケージ基板上の配線容量などをふくめ、半導体集積回路にパッケージを含めた半導体集積回路としての消費電力の算出を行う。また市販のメモリなど半導体集積回路装置の場合は仕様に基づいた消費電力値とする方法でも良い。
まず実装基板/筐体の熱解析ステップS2001では、半導体集積回路装置の消費電力と実装基板/筐体のレイアウト、筐体内のエアーフローから、実装基板の熱解析を行う。この時、半導体集積回路装置毎の消費電力は、通常半導体集積回路のRTLベースの消費電力見積もりを行うか、あるいは半導体集積回路の仮レイアウト実施後、ゲートレベルでの消費電力見積もりを行うかのいずれかの方法を用いて計算する。これらの計算には、通常パッケージ基板上の配線容量などをふくめ、半導体集積回路にパッケージを含めた半導体集積回路としての消費電力の算出を行う。また市販のメモリなど半導体集積回路装置の場合は仕様に基づいた消費電力値とする方法でも良い。
次に、熱解析ステップS2001の実行結果を使って、半導体集積回路装置温度条件抽出ステップS2002において、半導体集積回路装置毎の動作温度を抽出する。温度解析条件として筐体が使用される上下限温度全範囲の熱解析を行う。この結果、図3(c)に示すように、半導体集積回路装置の仕様の温度条件(旧温度条件)を、実使用時の温度条件(新温度条件)に変更する。
次に、温度条件判定ステップS2003において、前記新旧温度条件を比較し、その温度差によるタイミングずれを、半導体集積回路側で吸収するか否かを判定する。半導体集積回路側で吸収する場合は、YES方向に進み、それ以外はNO方向に進む。この温度条件判定ステップS2003における判定基準は、新旧温度条件差が設計マージン以下であるか否かを判定するという方法や、図3(a)および(b)に示すように、温度条件を変えたライブラリを準備する場合を想定し、ライブラリを準備する際に想定した温度範囲内であるか否かで判断する。想定した温度範囲内とは、図3(a)および(b)に示すように複数の温度条件でのライブラリを事前に作っておく際に、温度条件をどこまで変化させてライブラリを作っておくかという点に依存する。
もし、この温度条件の許容範囲を広くとっておけば、ライブラリ作成工数が増大するという問題があるが、半導体集積回路側で吸収できる場合が多くなる。一方、温度条件の許容範囲が狭い場合は、この温度条件判定ステップS2003はNOとなり易く、この場合は半導体集積回路装置/実装基板/筐体の再設計により想定した温度条件になるようにする。(半導体集積回路装置/実装基板/筐体設計変更ステップS2006)
この半導体集積回路装置/実装基板/筐体設計変更ステップS2006の後、再度実装基板/筐体熱解析ステップS2001に戻る。
この半導体集積回路装置/実装基板/筐体設計変更ステップS2006の後、再度実装基板/筐体熱解析ステップS2001に戻る。
次に温度依存遅延ライブラリ生成ステップS2004において、半導体集積回路装置が動作する温度範囲(上下限)に応じた遅延ライブラリを生成する。この遅延ライブラリの生成に際しては既に前記新温度条件でキャラクタライズされた遅延ライブラリがある場合はそのライブラリを選択し(図3(a)参照)、一方、温度がとびとびでキャラクタライズされており、新温度条件に一致するライブラリがない場合は、温度条件が最も近い2つの遅延ライブラリから補間により計算する(図3(b)参照)。
最後に半導体集積回路タイミング設計ステップS2005では、温度依存遅延ライブラリ生成ステップS2004で生成された遅延ライブラリを用いてタイミング検証を行い、タイミング仕様を満たすかどうか判定する。もし満たさない場合は、半導体集積回路あるいはパッケージの設計を見直す。
以上のステップを実施することで、筐体が実際使用される温度条件に応じた適切な半導体集積回路のタイミング設計が可能となる。
この新旧温度条件でのタイミング設計において、セットアップとホールドの設計の困難さが変わることについて説明する。まず、温度が上がったときのセットアップについて説明する。
図4に示すように、各時間を定義する。
pd1:クロックソースからデータ送りFFまでの遅延時間
pd2:送りFFにクロックが入ってから受けFFにデータが伝播する時間
pd3:クロックソースからデータ受けFFまでの遅延時間
tc1:受けFFのセットアップ時間
cy:サイクルタイム
正常動作させるためには、以下の関係式が成り立つことが必要である。
cy+pd1+pd2+tc1 < pd3 (式1)
温度が高くなった場合、(式1)において、cy以外の値が大きくなる。それぞれの遅延時間について、温度条件が変わった時の遅延時間を’(シングルコーテーション)付きで表現すると、cy+pd1’+pd2’+tc1’とpd3’の大小関係が問題になる。
図4に示すように、各時間を定義する。
pd1:クロックソースからデータ送りFFまでの遅延時間
pd2:送りFFにクロックが入ってから受けFFにデータが伝播する時間
pd3:クロックソースからデータ受けFFまでの遅延時間
tc1:受けFFのセットアップ時間
cy:サイクルタイム
正常動作させるためには、以下の関係式が成り立つことが必要である。
cy+pd1+pd2+tc1 < pd3 (式1)
温度が高くなった場合、(式1)において、cy以外の値が大きくなる。それぞれの遅延時間について、温度条件が変わった時の遅延時間を’(シングルコーテーション)付きで表現すると、cy+pd1’+pd2’+tc1’とpd3’の大小関係が問題になる。
しかし、一般的にクロックスキュー(=pd3-pd1)は可能な限り0となるようにするので、pd3’-pd1’もほぼ0に近い。(温度は一様に上昇するのではないが、pd1,pd3は近傍に存在しているため、同じ温度、割合で増加すると考えられる)。
このため、(式1)について考えると、pd1の増加分はpd3の増加分で相殺され、(pd2’-pd2)+(tc1’-tc1)分だけ左辺が大きくなる。これは、(式1)が成り立ちにくくなる方向への変移に相当するため、セットアップが厳しくなる。
このため、(式1)について考えると、pd1の増加分はpd3の増加分で相殺され、(pd2’-pd2)+(tc1’-tc1)分だけ左辺が大きくなる。これは、(式1)が成り立ちにくくなる方向への変移に相当するため、セットアップが厳しくなる。
次に温度が上がったときのホールドについて説明する。
図5に示すように、以下のように各時間を定義する。
pd21:クロック分岐からデータ送りFFまでの遅延時間
pd22:送りFFにクロックが入ってから受けFFにデータが伝播する時間
pd23:クロック分岐からデータ受けFFまでの遅延時間
tc21:受けFFのホールド時間
正常動作させるためには、以下の関係式が成り立つことが必要である。
pd21+pd22 > pd23+tc21 (式2)
ここで、温度が高くなった場合、(式2)において、すべての遅延時間の値が大きくなる。温度条件が変わった時のそれぞれの遅延時間を’(シングルコーテーション)付きで表現すと、pd21’+pd22’と pd3’+tc21’の大小関係が問題になる。クロックスキュー(=pd23-pd21)は可能な限り0にするので、pd23’-pd21’もほぼ0に近い(温度は一様に上昇するのではないが、pd21,pd23は近傍に存在しているため、同じ温度、割合で増加すると考えられる)。このため、 (pd22’-pd22)と(tc21’-tc21)のいずれが大きいかによりホールドが厳しくなるかどうかが決まる。
図5に示すように、以下のように各時間を定義する。
pd21:クロック分岐からデータ送りFFまでの遅延時間
pd22:送りFFにクロックが入ってから受けFFにデータが伝播する時間
pd23:クロック分岐からデータ受けFFまでの遅延時間
tc21:受けFFのホールド時間
正常動作させるためには、以下の関係式が成り立つことが必要である。
pd21+pd22 > pd23+tc21 (式2)
ここで、温度が高くなった場合、(式2)において、すべての遅延時間の値が大きくなる。温度条件が変わった時のそれぞれの遅延時間を’(シングルコーテーション)付きで表現すと、pd21’+pd22’と pd3’+tc21’の大小関係が問題になる。クロックスキュー(=pd23-pd21)は可能な限り0にするので、pd23’-pd21’もほぼ0に近い(温度は一様に上昇するのではないが、pd21,pd23は近傍に存在しているため、同じ温度、割合で増加すると考えられる)。このため、 (pd22’-pd22)と(tc21’-tc21)のいずれが大きいかによりホールドが厳しくなるかどうかが決まる。
しかし、一般的に、tc21よりpd22のほうが絶対値が大きい場合が多い。よって、(式2)の左辺が大きくなる傾向がある。その結果、(式2)を満たしやすい方向に動くので、ホールドは楽になる。
以上のように、本発明の半導体集積回路システムの設計方法によれば、熱解析により、許容範囲となるように半導体集積回路を設計するかあるいは、実装基板、パッケージ、筐体の設計変更を行うようにしているため、信頼性の高い半導体集積回路システムの設計を実現することが可能となる。
なお、ここで実装基板の設計に際しては、筐体内の熱解析を行い、この解析結果に基づき、筐体内に収納される実装基板を設計するようにしてもよい。
なお、ここで実装基板の設計に際しては、筐体内の熱解析を行い、この解析結果に基づき、筐体内に収納される実装基板を設計するようにしてもよい。
特に、本発明では、半導体集積回路装置が、外部接続端子が格子状に配置されたグリッドアレイ端子構造を持つ場合に、特に熱伝導性がよく、相互に影響も大きいため、上記熱解析を用いた設計方法が有効である。
なお、この熱解析を行う方法については、後述するが、例えば実装基板の表面温度をシミュレートし、この表面温度に基づいて等熱線を描画し、等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出し、この熱伝導ベクトルを指標にして設計を行うようにすれば、効率よく高精度の設計を行うことが可能となる。
なお、この熱解析を行う方法については、後述するが、例えば実装基板の表面温度をシミュレートし、この表面温度に基づいて等熱線を描画し、等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出し、この熱伝導ベクトルを指標にして設計を行うようにすれば、効率よく高精度の設計を行うことが可能となる。
また、この実装基板の表面温度をシミュレートするに際しては、実装基板に搭載する各半導体集積回路装置の消費電力に基づいて表面温度をシミュレートするのがより簡単である。
さらにまた、熱解析に先立ち、一旦、仮のシステム設計を行う必要がある。このシステム設計において、まずシステム仕様情報に基づき、当該システムを構成する実装基板の設計を行い、前記実装基板の設計を行う工程で得られた設計結果に基づき、前記実装基板上に実装される半導体集積回路装置のパッケージ基板の設計を行い、前記パッケージ基板の設計を行う工程で得られた設計結果に基づき、半導体集積回路のI/O端子位置を決定するように、前記半導体集積回路装置に搭載する半導体集積回路の設計を行うことにより、仮設計を実現するようにしてもよい。
さらにまた、熱解析に先立ち、一旦、仮のシステム設計を行う必要がある。このシステム設計において、まずシステム仕様情報に基づき、当該システムを構成する実装基板の設計を行い、前記実装基板の設計を行う工程で得られた設計結果に基づき、前記実装基板上に実装される半導体集積回路装置のパッケージ基板の設計を行い、前記パッケージ基板の設計を行う工程で得られた設計結果に基づき、半導体集積回路のI/O端子位置を決定するように、前記半導体集積回路装置に搭載する半導体集積回路の設計を行うことにより、仮設計を実現するようにしてもよい。
図6にこの仮のシステム設計を行うための設計方法を示すフローチャートの説明図、図7に半導体集積回路システムの設計装置を示す。本実施の形態では、まず実装基板上の半導体集積回路装置に収容される半導体集積回路と、メモリ等の他の電子部品とを含めたシステム仕様を検討し(システム・仕様検討:ステップS6001)、実装基板上の部品配置情報から実装基板の設計を行う(実装基板の設計:ステップS6002)。そして実装基板上の部品配置情報からパッケージを構成するパッケージ基板上の外部接続端子としてのボールの位置、及びパッケージ内の信号配線を考慮して、パッケージの設計を行う(パッケージの設計:ステップS6003)。そして、パッケージ内の信号配線が最適になるように半導体集積回路のI/O端子配置を決定し、半導体集積回路のI/O端子配置を決定する(半導体集積回路の設計:ステップS6004)。
すなわち、半導体集積回路の素子配置を、半導体集積回路の内部条件だけではなく、実装基板およびパッケージ(含むパッケージ基板)の情報に基づいて最適化する。つまり、実装基板、パッケージ、半導体集積回路からなる半導体集積回路システム全体の仮設計を行った後に、熱解析結果に基づいて再度半導体集積回路の設計を変更し最適化を図るものである。
また、実装基板上の当該半導体集積回路装置はじめ部品および配線パターンの最適配置、パッケージを構成するパッケージ基板内の信号配線も考慮され、交差構成あるいは配線長の増大などの問題を防止し、システム全体としての不要輻射および熱に対して最適化されており、品質向上が可能となる。さらにまた、信号配線の複雑な引き回しが発生しないため、工数の削減をはかることが可能となると共に自動化対応が可能となる。
次に、本実施の形態について詳細に説明する。ここではシステム/仕様検討すなわち部品配置結果を、入力データとして実施する。ここで用いられる半導体集積回路システムの設計装置は、CPUとメモリなどとで構成され、図7にブロック図を示すように、実装基板設計部150と、この設計結果に基づいてパッケージ基板含むパッケージを設計するパッケージ設計部250と、さらにこのパッケージ基板の設計結果に基づいて半導体集積回路を設計する半導体集積回路設計部350と、熱解析部450とを具備している。
ここで実装基板設計部150は、システム仕様を入力データとして実装基板を設計するものである。
また、この実装基板設計部150は、入力データとして、半導体集積回路の設計情報を含まないシステム仕様情報を用いるように構成されてもよい。これにより、半導体集積回路の設計情報を考慮せず、実装基板優先の設計が可能となる。
また、実装基板設計部150は、前記パッケージ基板の外縁から所定の距離を隔てた位置に、仮想的な配線引き出しポイントを決定し、前記配線パターンが前記配線引き出しポイントを通るように設計する設計部を備えている。
また、この実装基板設計部150は、設計対象デバイスとしての半導体集積回路のI/O端子と、前記I/O端子に接続される前記パッケージ基板の内部接続端子(ボンドフィンガーのボンディングポイント)と、前記パッケージ基板の前記実装基板に接続するための外部接続端子と、前記配線引き出しポイントとを結ぶ線が交差領域をもたないように前記配線引き出しポイントを設計する交差制御部とを含むようにするのが望ましい。
ここで、パッケージとしてはボールグリッドアレイを用い、表層配線と、電源プレーンと接地プレーンと外部接続端子を構成するボールが形成された最下層配線との4層の導体層を備えた多層配線構造のパッケージ基板を含んでいる。そして、半導体集積回路を搭載する表層に位置する導体層が,電源リングを含み、前記電源リングを介して、前記パッケージ基板内の配線が交差領域を持たないように電源プレーンに接続するように構成される。
次に、パッケージ設計部250は、実装基板の設計結果、システムの仕様、消費電力などを考慮し、適用するパッケージ種別の検討、パッケージ基板の設計をするものである。このパッケージ設計装置250の入力データは、実装基板設計部150の設計結果を含むようにするのが望ましい。
次に、半導体集積回路設計部350は、実装基板の設計結果、パッケージの設計結果に、半導体集積回路の内部条件を考慮して、I/O端子をはじめ回路設計を行うものである。
次に、熱解析部450は、表面温度シミュレート部451と、表面温度に基づいて等熱線を描画する等熱線描画部452と、等熱線に基づき熱伝導速度と大きさとを示す熱伝導ベクトルを算出する熱伝導ベクトル作成部453とを具備している。この熱解析部450を用いた熱解析方法については後述する。
図8は図6に示したステップのうち、実装基板の設計ステップS6002に先立ち行われるシステム/仕様検討ステップS6001を詳細に示すフローチャートである。
まず、システム/仕様から、半導体集積回路装置など実装基板上に配置する部品の消費電力を算出する(ステップS8011)。その際、半導体集積回路装置を構成するパッケージに関しては、パッケージ基板をどのように設計するか、どのようなパッケージを使うかを検討する必要があるため、以下の検討を実施する。
まず、システム/仕様から、半導体集積回路装置など実装基板上に配置する部品の消費電力を算出する(ステップS8011)。その際、半導体集積回路装置を構成するパッケージに関しては、パッケージ基板をどのように設計するか、どのようなパッケージを使うかを検討する必要があるため、以下の検討を実施する。
消費電力より電源ボール数の見積りを実施する(ステップS8012)。これはパッケージの外部接続端子を構成するボール1個当り供給できる電力値をもとに計算によって求める。この電力値は、電源、グラウンド(接地)それぞれについて算出する。
また、システム仕様にもとづき、システムの端子表と信号の接続(ネットリスト)をもとに、信号および電源の種類(グループ分け)、個数の検討を実施する(ステップS8013)。
また、システム仕様にもとづき、システムの端子表と信号の接続(ネットリスト)をもとに、信号および電源の種類(グループ分け)、個数の検討を実施する(ステップS8013)。
ステップS8013において、信号および電源のグループ分けと、そのグループに属する電源の数を明確にすることにより、必要な端子数の見積もりを行う(ステップS8014)。
このようにして、この実装基板に配置する部品の消費電力に基づいて計算した電源ボール数と、システムのネットリスト及び端子表とに基づいて、ボール数を算出する。
上記2種の検討結果から、必要なボール数と、このボール数にあわせたパッケージを決定する(ステップS8015)。例えばボールを格子状に配列したボールグリッドアレイを構成する外部接続端子をもつ3層構造のパッケージ基板を用いたパッケージを使用すると決定を下す。
上記2種の検討結果から、必要なボール数と、このボール数にあわせたパッケージを決定する(ステップS8015)。例えばボールを格子状に配列したボールグリッドアレイを構成する外部接続端子をもつ3層構造のパッケージ基板を用いたパッケージを使用すると決定を下す。
そしてパッケージが決定すると、そのパッケージから各配線のファンアウト(引き出し)が実施可能かどうかの検討を実施する(ステップS8016)。
ここでなされる検討の内容は、パッケージのフットプリント(パッケージの形状、ピン配置、ピン数)に対して、実装基板の配線ルール(配線の幅、間隔、ビアの大きさ、間隔)や、この実装基板を多層基板で構成する場合には、基板層構成(何枚構成にするか)について選択し、必要な配線の引き出しが可能かどうか確認を実施する。
そして必要な配線の引き出しが不可能であると判断された場合は、パッケージの検討まで戻って再検討(ステップS8017)を実施する。
可能な場合は実装基板の詳細設計をスタートする(ステップS8018)。(次のフェーズに移行する)。
可能な場合は実装基板の詳細設計をスタートする(ステップS8018)。(次のフェーズに移行する)。
この方法によれば、半導体集積回路システムの設計に際し、まず、実装基板を設計するに際し、実装基板からパッケージ設計、半導体集積回路設計と、下流側から上流側に向かって設計を行うようにしている。さらに、実装基板の設計に際し、システム仕様情報に基づき得られた部品配置結果などの情報を入力データとして、パッケージの端子配列の概略のポジションを決定するようにしているため、パッケージや半導体集積回路の制約を受けにくく、実装基板が理想とする半導体集積回路のI/O端子の配置あるいはパッケージ基板の配線パターンのレイアウトを決定することができる。これにより実装基板の配線ルールや基板層構成の検討を短いTATで実施可能である。そしてこの状態で、熱解析を行い、半導体集積回路の設計を行うようにしているため、微細化、高集積化に際しても、熱に起因する動作周波数の変動や、リーク電流、配線に生じる電圧変動を抑制し、信頼性の高い半導体集積回路システムを提供することが可能となる。また、図3で説明した温度依存遅延ライブラリを生成するようにしているため、設計の自動化も可能である。
上記作用効果に加え、本発明によれば、配線の交差、配線長の増大などを抑制し、半導体集積回路システムの大規模化、高速化、多ビット化に際しても、信号配線の複雑な引き
回しを低減することができる。従って、配線の自動化が容易となる。
回しを低減することができる。従って、配線の自動化が容易となる。
なお熱解析に際し、半導体集積回路装置の消費電力としては仮の値を用い、その条件で実装基板、筐体の最適設計を行う。その後、半導体集積回路、パッケージの実設計における消費電力解析結果と、その仮の値の差が、許容範囲内であれば、全体として熱に最適な設計になっていると判断できる。しかし、許容範囲をはずれている場合、半導体集積回路、パッケージの設計を見直し、仮の値との差が許容範囲内に収まるように再設計を行う。
もし、半導体集積回路側で大きく許容範囲を外れており、半導体集積回路側だけでは吸収できない場合には、最初の半導体集積回路、パッケージの消費電力の見積もりから再度やり直す。
もし、半導体集積回路側で大きく許容範囲を外れており、半導体集積回路側だけでは吸収できない場合には、最初の半導体集積回路、パッケージの消費電力の見積もりから再度やり直す。
ここで、パッケージ種別としては、リードフレームを用いたものや、フィルムキャリアを用いたものなど種々のパッケージが提案されているが、ここではパッケージ基板として多層構造基板を用い、外部接続端子としてボールを用いたボールグリッドアレイ構造のパッケージを用いる。
このパッケージ1としては、例えば、表層配線を備えた表層1―5a、電源プレーン1―1bを構成する電源層、接地プレーン1―1aを構成する接地層、ボールを形成するためのボールパッドを構成する最下層配線を備えた最下層1―5bとからなる4層構造のパッケージ基板1で構成される(図56参照)。パッケージ基板の接地層および電源層を構成する金属層は、銅箔をパターニングして形成される。これら4層の表層、電源層、接地層、最下層は、絶縁層を介して積層され、インナービアを介して、各端子と接続される。最下層には半田ボール4が形成されて外部接続端子を構成し、実装基板の配線パターン上に面実装される。
(実施の形態2)
次に本発明の実施の形態2として、半導体集積回路の設計方法について説明する。
前記実施の形態1では、半導体集積回路の設計に際しては、熱解析によって保障する温度条件を変更し、温度依存遅延ライブラリを生成するステップ(図2:ステップS2004)を用いるようにした。これに代えて、本実施の形態2では、図9にその設計方法のフローチャートを示すと共に、図10(a)および(b)に示すように、半導体集積回路の発熱量に応じて前記半導体集積回路の表面高さhを調整するようにしたことを特徴とする。図10(a)に示した通例の半導体集積回路の基板厚さh0に対して、図10(b)に示すように基板厚さh1を厚くすることにより、実装基板側に逃げる熱量はほぼ一定のまま、空気中に逃げる熱量を増やし、温度上昇を抑制するものである。
次に本発明の実施の形態2として、半導体集積回路の設計方法について説明する。
前記実施の形態1では、半導体集積回路の設計に際しては、熱解析によって保障する温度条件を変更し、温度依存遅延ライブラリを生成するステップ(図2:ステップS2004)を用いるようにした。これに代えて、本実施の形態2では、図9にその設計方法のフローチャートを示すと共に、図10(a)および(b)に示すように、半導体集積回路の発熱量に応じて前記半導体集積回路の表面高さhを調整するようにしたことを特徴とする。図10(a)に示した通例の半導体集積回路の基板厚さh0に対して、図10(b)に示すように基板厚さh1を厚くすることにより、実装基板側に逃げる熱量はほぼ一定のまま、空気中に逃げる熱量を増やし、温度上昇を抑制するものである。
この半導体集積回路の設計方法では、まず、半導体集積回路/パッケージ基板表面積計算ステップS9001において、半導体集積回路全面の面積総和に対する、パッケージ基板に接する半導体集積回路底面の面積の割合を計算する。この時の半導体集積回路のレイヤー構成は配線層導電性の材質、膜厚、パターン分布、層間絶縁膜の組成および膜厚などによって異なるが、基本のレイヤー構成、高さとする。
次に、実装基板熱伝導許容値計算ステップS9002において、実装基板の材料、面積、筐体のエアーフローから放熱可能な熱量または消費電力量を計算する。
最後に、半導体集積回路高さ決定ステップS9003において、前記割合、半導体集積回路消費電力、放熱可能な熱量または消費電力量から、以下の(式3)で放熱可能か否かを判断する。
(式3) 放熱可能量な熱量または消費電力量 − 半導体集積回路消費電力×前記割合
(式3)において、計算結果が正となる場合は放熱可能と判断でき、この基本のレイヤー構成、高さで設計を行う。反対に、計算結果が負の場合は、(式4)及び(式5)を用いて、放熱可能な半導体集積回路の基板厚さを計算する。
(式4) 放熱可能な熱量または消費電力量/半導体集積回路消費電力
(式4)での計算結果をαとする。
半導体集積回路の横幅x,奥行きy,高さzとした場合、以下の式で放熱可能な半導体集積回路の基板厚さを計算できる。
(式5) z = ((x*y)/2α-x*y)/(x+y)
(式4)では、底面の面積から放熱可能な熱量または消費電力量から、放熱可能な半導体集積回路全面の面積総和を計算している。次に(式5)において、その面積総和となる半導体集積回路の基板厚さを計算している。この計算において、半導体集積回路の横幅xと奥行きyは変わらないものとする。
以上の方法で計算された半導体集積回路の基板厚さでのレイヤー構成を用いて半導体集積回路を設計する。
(式3)において、計算結果が正となる場合は放熱可能と判断でき、この基本のレイヤー構成、高さで設計を行う。反対に、計算結果が負の場合は、(式4)及び(式5)を用いて、放熱可能な半導体集積回路の基板厚さを計算する。
(式4) 放熱可能な熱量または消費電力量/半導体集積回路消費電力
(式4)での計算結果をαとする。
半導体集積回路の横幅x,奥行きy,高さzとした場合、以下の式で放熱可能な半導体集積回路の基板厚さを計算できる。
(式5) z = ((x*y)/2α-x*y)/(x+y)
(式4)では、底面の面積から放熱可能な熱量または消費電力量から、放熱可能な半導体集積回路全面の面積総和を計算している。次に(式5)において、その面積総和となる半導体集積回路の基板厚さを計算している。この計算において、半導体集積回路の横幅xと奥行きyは変わらないものとする。
以上の方法で計算された半導体集積回路の基板厚さでのレイヤー構成を用いて半導体集積回路を設計する。
この構成は、パッケージの厚さは規定されていて変更できないという前提での手法であるため。そのため、実装基板側からの見た目に変化は無い。しかし、内部の半導体集積回路の高さh1が高くなっており、放熱性が高められ、温度上昇を避けることができるため、図2の温度条件判定ステップS2003で、温度条件を満たした構成とすることができる。
なお、本実施の形態では、フィルムキャリアやリードフレームなどを含むパッケージ基板1と、このパッケージ基板1に搭載される半導体集積回路2と、これらを覆う封止樹脂3と、PCSとの接続に用いられる半田ボール4などの外部接続端子とで構成される半導体集積回路装置としては、まったく変わらない状態で、半導体集積回路を構成する半導体基板の厚さのみを調整することによって放熱性を調整し、温度条件を満たすようにすることができたが、パッケージの高さあるいは、表面積を調整したり、半田ボールの組成あるいは大きさ、数、配置などを調整することによっても放熱性を調整することも可能である。
(実施の形態3)
前記実施の形態2では、パッケージ内に搭載する半導体集積回路の設計方法について説明した。次に本発明の実施の形態3として、半導体集積回路の熱解析方法について説明する。ここでパッケージとは、パッケージ基板と封止樹脂とを含めたものをいう。
前記実施の形態2では、パッケージ内に搭載する半導体集積回路の設計方法について説明した。次に本発明の実施の形態3として、半導体集積回路の熱解析方法について説明する。ここでパッケージとは、パッケージ基板と封止樹脂とを含めたものをいう。
本実施の形態では、半導体集積回路の消費電力に基づいて表面温度をシミュレートし、表面温度に基づいて等熱線を描画し、この等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出するようにしている。ここでも図7に示した設計装置の熱解析部450を用いて熱解析を行う。
図11は、本発明の実施の形態の熱解析方法を示すフローチャート図、図12はその概要説明図である。
まず、発熱量をシミュレートするためのシミュレート部451を用いて行われる半導体集積回路領域別消費電力計算ステップS1101では、半導体集積回路の消費電力を計算する。ここでは、図12(a)に示すように半導体集積回路の半導体集積回路表面を格子状に分割して、それぞれの格子別に消費電力の大小で表現する。図12(a)では、半導体集積回路の右下の黒い部分が消費電力の大きい部分で白くなるほど消費電力が少ないことを意味している。以降これを消費電力マップと呼ぶ。
まず、発熱量をシミュレートするためのシミュレート部451を用いて行われる半導体集積回路領域別消費電力計算ステップS1101では、半導体集積回路の消費電力を計算する。ここでは、図12(a)に示すように半導体集積回路の半導体集積回路表面を格子状に分割して、それぞれの格子別に消費電力の大小で表現する。図12(a)では、半導体集積回路の右下の黒い部分が消費電力の大きい部分で白くなるほど消費電力が少ないことを意味している。以降これを消費電力マップと呼ぶ。
次に、等熱線生成部452(図7参照)で実施される等熱線生成ステップS1102において、この消費電力マップに従って同じ消費電力部分を囲むことにより、図12(b)に示すように半導体集積回路を等熱線で表現する。
次に熱伝導ベクトル生成部453(図7参照)で実施される熱伝導ベクトル生成ステップS1103では、水平、垂直、及び水平に対し45度の角度に熱伝導ベクトルを生成し、矢印で表す。この時、矢印の長さは熱伝導率の高さを表し、熱伝導率は中心と等熱線との距離に反比例する。この熱伝導ベクトルの生成方法については詳細を後で説明する。
次に、半導体集積回路熱伝導モデル生成ステップS1104では、熱伝導ベクトル生成ステップS1103で計算した熱伝導ベクトルを水平/垂直軸に投射した4つのベクトルに分解して表現する。水平に対し45度の熱伝導ベクトルがあることから、水平/垂直軸にはプラス/マイナス方向に複数の熱伝導ベクトルが投射されることになる。この場合、熱伝導ベクトル長さを合算して大きさ(矢印の長さ)を表現する。この手順において、4つの熱伝導ベクトル(水平/垂直軸のプラス/マイナス方向)に表現しなおす理由について説明する。この半導体集積回路(実装する際は、パッケージを含んだ半導体集積回路装置となる)を実装基板上に実装する場合、熱が伝導する向きが問題であり、中心がどこにあるかは大きな問題にはならない。これは実装基板の面積に比べて半導体集積回路の面積が非常に小さいためである。
従って、実装基板の熱解析においては、熱の逃げる方向を示す4つの熱伝導ベクトルで表現する。ここで、熱伝導ベクトル長さについて詳細に説明する。
熱伝導ベクトルの長さ(図中の矢印の長さ)は、中心から直近等熱線への距離に反比例し、等熱線間隔が近いと長くなり、遠いと短くなる。
また、距離の計算は、水平、垂直、水平に対し45度の線と等熱線がクロスするポイントとベクトル中心点(消費電力最大)との距離を計算することによって行う。
なお、等熱線が10℃間隔で引かれていて、中心からの距離が1mmの場合の長さを1mmと既定しておく。もし、距離が0.5mmならベクトル長さは2mm、(=基準ベクトル長さ*基準距離/距離=1mm*1mm/0.5mm)になる。もし、距離が2mmならベクトル長さは0.5mmとなる。
熱伝導ベクトルの長さ(図中の矢印の長さ)は、中心から直近等熱線への距離に反比例し、等熱線間隔が近いと長くなり、遠いと短くなる。
また、距離の計算は、水平、垂直、水平に対し45度の線と等熱線がクロスするポイントとベクトル中心点(消費電力最大)との距離を計算することによって行う。
なお、等熱線が10℃間隔で引かれていて、中心からの距離が1mmの場合の長さを1mmと既定しておく。もし、距離が0.5mmならベクトル長さは2mm、(=基準ベクトル長さ*基準距離/距離=1mm*1mm/0.5mm)になる。もし、距離が2mmならベクトル長さは0.5mmとなる。
次に、図13(a)および(b)を用いて、熱伝導ベクトルの合成方法を説明する。水平に対し45度の熱伝導ベクトル4本(図13の太い黒線)を水平、垂直方法に分解(水平/垂直軸に投射)して、その分解された熱伝導ベクトル(図13の太い白抜き線)を、元々の水平及び垂直方向の熱伝導ベクトル(図13の細い黒線)に足し合わせる。この結果得られた水平、垂直4方向のベクトルが、その半導体集積回路の持つ熱伝導ベクトルとなる。ここでは、45度の熱伝導ベクトル1本について説明したが、4本すべてについて同様の計算を行う。
次に複数の等熱線を考慮する熱伝導ベクトルの算出方法について説明する。
図14(a)に示す熱伝導ベクトルの長さ(図中太黒線の長さ)の計算方法は、図13に示した方法と同様である。
しかし、図14(a)の例では、等熱線が2本になっているので、同一方向にベクトルが2本になる。「外側の等熱線Oe」は、「内側の等熱線Ie」より外側にあるので、中心からの距離が遠くなり、「外側の等熱線Oe」に関する熱伝導ベクトル(の長さは短くなる。これは「外側の等熱線Oe」による熱伝導ベクトルOv(図14の太い白抜き線)は、「内側の等熱線Ie」による熱伝導ベクトルIv(図14の太い黒線)よりも長さが短いというのと同じ意味である。
このことは、「外側の等熱線Oe」よりも「内側の等熱線Ie」のほうが熱伝導ベクトルを決定する要因となりやすいということを表している。
ここで、ベクトル長さは、2つのベクトルの和Iv+Ovで表現する。
そして前述したのと同様のベクトル合成により、45度のベクトルを水平/垂直方向に合成する。
図14(a)に示す熱伝導ベクトルの長さ(図中太黒線の長さ)の計算方法は、図13に示した方法と同様である。
しかし、図14(a)の例では、等熱線が2本になっているので、同一方向にベクトルが2本になる。「外側の等熱線Oe」は、「内側の等熱線Ie」より外側にあるので、中心からの距離が遠くなり、「外側の等熱線Oe」に関する熱伝導ベクトル(の長さは短くなる。これは「外側の等熱線Oe」による熱伝導ベクトルOv(図14の太い白抜き線)は、「内側の等熱線Ie」による熱伝導ベクトルIv(図14の太い黒線)よりも長さが短いというのと同じ意味である。
このことは、「外側の等熱線Oe」よりも「内側の等熱線Ie」のほうが熱伝導ベクトルを決定する要因となりやすいということを表している。
ここで、ベクトル長さは、2つのベクトルの和Iv+Ovで表現する。
そして前述したのと同様のベクトル合成により、45度のベクトルを水平/垂直方向に合成する。
以上は、水平、垂直、水平に対し45度の熱伝導ベクトルを算出する方法について説明した。しかし、水平、垂直、水平に対し45度でない方向に向かう熱伝導ベクトルで表現する方法も考えられる、以下この方法について説明する。
まず、図15(a)に示すように、領域分割をおこなう。この場合、等熱線を水平、垂直、45度の線(図15(a)の黒点線)で8つの領域に分けている。そしてそれぞれの領域について、重心×を求める。
まず、図15(a)に示すように、領域分割をおこなう。この場合、等熱線を水平、垂直、45度の線(図15(a)の黒点線)で8つの領域に分けている。そしてそれぞれの領域について、重心×を求める。
この後、図15(b)に示すように、中心からそれぞれの重心に向かうベクトルを計算する。この時のベクトル長さは、図12で説明したのと同様に距離に反比例させる。
そして図13で説明したのと同様に、水平/垂直軸にベクトル分割し、足し合わせる。
そして図13で説明したのと同様に、水平/垂直軸にベクトル分割し、足し合わせる。
この方法は、前記図12乃至14で説明した45度ベクトルと考えは同じであるが、熱伝導の方向をより正確に表現することができる。
理由は、45度ベクトルの場合、ベクトルの方向が水平、垂直、水平に対し45度の8方向に固定であるために、この8方向以外の形が変わっても、同じベクトルとなる。しかし、この方法は、領域毎の重心方向に向かうベクトルであるため、より等熱線の形に応じたベクトルを作成可能である。
理由は、45度ベクトルの場合、ベクトルの方向が水平、垂直、水平に対し45度の8方向に固定であるために、この8方向以外の形が変わっても、同じベクトルとなる。しかし、この方法は、領域毎の重心方向に向かうベクトルであるため、より等熱線の形に応じたベクトルを作成可能である。
さらに詳細に説明する。
図16(a)および(b)とも、等熱線と水平、垂直、水平に対し45度の線との交点が同じなので、熱伝導ベクトルは同じになる。しかし、図16(b)のほうは図16(a)よりも、左方向に等熱線が伸びているため、左方向の熱伝導は小さくなりベクトルが小さくなるはずである。逆に、右方向は等熱線の間隔が狭くなっているのでベクトルが大きくなるはずである。
このように、ベクトルの方向を8方向に固定する方法では、等熱線の形を正確に表現できない場合がある。しかし、図16(b)ほど歪んだ等熱線は出ないのが一般的であるため、計算量から考えて、45度ベクトルを使うのはリーズナブルである。
45度ベクトルを用いることによって、重心を求める必要もなく、その重心を求めるための領域分割、領域境界の認識もしなくてよいため、コンピュータによる計算量は格段に少なくなる。このため計算コストの低減を図ることが可能となる。
図16(a)および(b)とも、等熱線と水平、垂直、水平に対し45度の線との交点が同じなので、熱伝導ベクトルは同じになる。しかし、図16(b)のほうは図16(a)よりも、左方向に等熱線が伸びているため、左方向の熱伝導は小さくなりベクトルが小さくなるはずである。逆に、右方向は等熱線の間隔が狭くなっているのでベクトルが大きくなるはずである。
このように、ベクトルの方向を8方向に固定する方法では、等熱線の形を正確に表現できない場合がある。しかし、図16(b)ほど歪んだ等熱線は出ないのが一般的であるため、計算量から考えて、45度ベクトルを使うのはリーズナブルである。
45度ベクトルを用いることによって、重心を求める必要もなく、その重心を求めるための領域分割、領域境界の認識もしなくてよいため、コンピュータによる計算量は格段に少なくなる。このため計算コストの低減を図ることが可能となる。
次に、熱伝導ベクトルの時間変化を考慮する方法について説明する。
半導体集積回路の消費電力は時間経過によって変わる可能性がある。これは、時間経過により、処理内容が変化し、今まではCPUが頻繁に動いていたのに、今度は、メモリ部分がよく動くという場合に発生する。図17(a)は時刻0の時の等熱線、図17(b)は時刻tの時の等熱線を示す。Vtは時刻tのときの熱伝導ベクトルである。
この場合、等熱線が変わるので、熱伝導ベクトルが変わる可能性がある。この場合、時刻0と時刻tのベクトルの内積を取り、ベクトルの方向を表現する。ベクトルの大きさは、その内積で表現されたベクトルの半分とする。
ここで、半分とする理由は、時刻0と時刻t両方の成分が含まれている(つまり2倍になっている)からである。
以降、図13(a)および(b)に示したように、ベクトル分割をして、水平、垂直方向のベクトルで表現する。
半導体集積回路の消費電力は時間経過によって変わる可能性がある。これは、時間経過により、処理内容が変化し、今まではCPUが頻繁に動いていたのに、今度は、メモリ部分がよく動くという場合に発生する。図17(a)は時刻0の時の等熱線、図17(b)は時刻tの時の等熱線を示す。Vtは時刻tのときの熱伝導ベクトルである。
この場合、等熱線が変わるので、熱伝導ベクトルが変わる可能性がある。この場合、時刻0と時刻tのベクトルの内積を取り、ベクトルの方向を表現する。ベクトルの大きさは、その内積で表現されたベクトルの半分とする。
ここで、半分とする理由は、時刻0と時刻t両方の成分が含まれている(つまり2倍になっている)からである。
以降、図13(a)および(b)に示したように、ベクトル分割をして、水平、垂直方向のベクトルで表現する。
以上説明してきたように、熱伝導ベクトルという概念の導入により、実装基板設計において、半導体集積回路は熱の伝導する向きに強弱のある一つの発熱体と考えられ、その向きに応じた設計が可能となる。つまり、熱の逃げやすい方向には部品をあまりおかない、熱耐性の弱い部品は配置しない、もしくは、熱耐性の強い部品を配置するなどの方法をとることができる。この結果、実装基板を含む筐体全体として熱に強い製品となる。
また、本実施の形態では、半導体集積回路の熱伝導ベクトルについて説明した。しかし、半導体集積回路だけでなく、パッケージを含む半導体集積回路装置として考えることもできる。基本は、半導体集積回路の左右上下共にピン数が同じで、電源及び接地プレーンがパッケージで一様であれば、半導体集積回路の熱伝導ベクトルがそのままパッケージを含む半導体集積回路装置の熱伝導ベクトルとなるはずである。
半導体集積回路と半導体集積回路装置で熱伝導ベクトルを変えたい場合には、電源プレーンや接地プレーンなどのプレーンの形状を変えて対応することができる。
半導体集積回路と半導体集積回路装置で熱伝導ベクトルを変えたい場合には、電源プレーンや接地プレーンなどのプレーンの形状を変えて対応することができる。
(実施の形態4)
次に本発明の実施の形態4として、筐体内のエアーフロー(空気の流れ)を考慮した半導体集積回路装置の配置方法を含む実装基板の設計方法について説明する。図18は、この設計方法を示すフローチャート図、図19、図20及び図21が本設計方法の説明図である。
ここでは、パッケージを設計するに際し、筐体内に収納される実装基板の放熱状況に応じて、前記半導体集積回路装置の位置および向きを決定するという方法をとる。パッケージはパッケージ基板と封止樹脂などのキャップ部材で構成されるが、熱的状態はパッケージ基板のほぼパッケージと同様であるため、パッケージ基板の熱解析をパッケージとしての熱解析とみなしても良い場合が多い。
次に本発明の実施の形態4として、筐体内のエアーフロー(空気の流れ)を考慮した半導体集積回路装置の配置方法を含む実装基板の設計方法について説明する。図18は、この設計方法を示すフローチャート図、図19、図20及び図21が本設計方法の説明図である。
ここでは、パッケージを設計するに際し、筐体内に収納される実装基板の放熱状況に応じて、前記半導体集積回路装置の位置および向きを決定するという方法をとる。パッケージはパッケージ基板と封止樹脂などのキャップ部材で構成されるが、熱的状態はパッケージ基板のほぼパッケージと同様であるため、パッケージ基板の熱解析をパッケージとしての熱解析とみなしても良い場合が多い。
図18に示すように、実装基板・筐体風路解析ステップS1801では、実装基板及び筐体のエアーフローを計算し、どちらの向きに空気の流れがあるかを計算する。(図19あるいは図21)
次に半導体集積回路装置熱伝導方向決定ステップS1802では、前記実施の形態3で説明した熱伝導ベクトル手法等を用いて、その半導体集積回路装置において、熱がどちらの方向に逃げやすいかを計算する。
次に半導体集積回路装置熱伝導方向決定ステップS1802では、前記実施の形態3で説明した熱伝導ベクトル手法等を用いて、その半導体集積回路装置において、熱がどちらの方向に逃げやすいかを計算する。
半導体集積回路装置配置位置・向き決定ステップS1803では、計算されたエアーフローと熱伝導ベクトルが長い向きが並行するように半導体集積回路装置配置向きを決定する。(図21)
この方法は、エアーフローと並行の向きに熱が逃げやすく、放熱効率が向上することに着目している。もし、図20(b)の向きにおいた場合、熱が逃げやすい方向と空気流れが垂直の関係にあり、放熱効率が悪く熱のこもりが発生する。
この方法は、エアーフローと並行の向きに熱が逃げやすく、放熱効率が向上することに着目している。もし、図20(b)の向きにおいた場合、熱が逃げやすい方向と空気流れが垂直の関係にあり、放熱効率が悪く熱のこもりが発生する。
図20の熱伝導ベクトルをもつ半導体集積回路装置に対し、図19および図21のいずれの配置方法を選ぶかは、設計方針及び実装基板の配置状況により決定する。前記半導体集積回路装置のまわりにエアーフローを邪魔するものが存在すれば、それを考慮する。
例えば、図19の半導体集積回路装置の右下に大きな障害物がある場合、エアーフロー上、図19よりも図21の方向を選択する。逆に、左上に障害物がある場合は図19の方向を選択する。
例えば、図19の半導体集積回路装置の右下に大きな障害物がある場合、エアーフロー上、図19よりも図21の方向を選択する。逆に、左上に障害物がある場合は図19の方向を選択する。
以上、図19あるいは図21のいずれを選択するかは、放熱の原因となる箇所(半導体集積回路装置)を直接放熱するか、放熱により熱がたまった箇所を冷却するかの違いであって、どちらの方法もそれぞれ適用可能であり、必要に応じて選択するようにすればよい。
(実施の形態5)
次に本発明の実施の形態5として、熱解析を考慮した半導体集積回路の設計方法について説明する。この設計フローチャートを図22に、図23にその説明図を示す。
この方法では、パッケージ基板上に半導体集積回路を搭載して、筐体内に収納される実装基板上で所望のシステムを構成する半導体集積回路の設計方法であって、前記半導体集積回路の熱解析結果に基づき、前記半導体集積回路を設計するもので、消費電力マップに応じてフロアプランを変更するようにしたことを特徴とするものである。
次に本発明の実施の形態5として、熱解析を考慮した半導体集積回路の設計方法について説明する。この設計フローチャートを図22に、図23にその説明図を示す。
この方法では、パッケージ基板上に半導体集積回路を搭載して、筐体内に収納される実装基板上で所望のシステムを構成する半導体集積回路の設計方法であって、前記半導体集積回路の熱解析結果に基づき、前記半導体集積回路を設計するもので、消費電力マップに応じてフロアプランを変更するようにしたことを特徴とするものである。
まず、機能ブロック別消費電力見積もりステップS2201では、機能ブロック別に消費電力を算出する。算出方法は前記実施の形態1で説明したのと同様に、RTLあるいはゲートレベルでの消費電力見積もりとする。
次に消費電力マップ計算ステップS2202は、機能ブロック別消費電力とそれぞれの機能ブロック配置位置関係から半導体集積回路の熱伝導ベクトルを計算する。
次に消費電力マップ計算ステップS2202は、機能ブロック別消費電力とそれぞれの機能ブロック配置位置関係から半導体集積回路の熱伝導ベクトルを計算する。
図23(a)に示すような機能ブロックフロアプランにおいて、消費電力大ブロックBPが右側に配置されているとして、消費電力マップは図23(b)に示すように構成される。
次にフロアプラン変更ステップS2203において、半導体集積回路の熱伝導ベクトルに従い、熱の伝導を抑制したい方向に熱伝導ベクトルが向いている場合は、消費電力大ブロックの配置位置を変更することで、消費電力ピーク位置の変更あるいは熱伝導方向の変更を行う。この結果、実装基板/筐体のフロアプランから熱の伝導させたい方向にあわせて半導体集積回路のフロアプランを実現することができる。
最後に消費電力マップ確認ステップS2204において、図24(a)および(b)に示すように、再度消費電力マップを作成しなおし、消費電力マップを再確認して、熱の伝導させたい方向と一致しているかを確認する。
この方法により、半導体集積回路側で熱伝導方向をコントロールできることとなり、最適な放熱が可能になる。このように、熱伝導方向のコントロールは、半導体集積回路側でおこなうこともできるし、前記実施の形態3のように、実装基板側でも実施できることとなり、自由度が広がることになり、より最適な放熱効果を得ることができる。
(実施の形態6)
次に本発明の実施の形態6として、熱解析を考慮した半導体集積回路の設計方法について説明する。前記実施の形態5では消費電力マップに応じてフロアプランを変更するようにしたが、本実施の形態では弱熱耐性ブロックBWを検出し、この弱熱耐性ブロックを移動するという方法に特徴がある。この設計フローチャートを図25に、図26および図27にその説明図を示す。
次に本発明の実施の形態6として、熱解析を考慮した半導体集積回路の設計方法について説明する。前記実施の形態5では消費電力マップに応じてフロアプランを変更するようにしたが、本実施の形態では弱熱耐性ブロックBWを検出し、この弱熱耐性ブロックを移動するという方法に特徴がある。この設計フローチャートを図25に、図26および図27にその説明図を示す。
まず、機能ブロック別消費電力見積もりステップS2501では、機能ブロック毎に消費電力を算出する。算出方法は前記実施の形態1で説明した方法と同様に、RTLあるいはゲートレベルでの消費電力見積もりを行う。
次に消費電力マップ計算ステップS2502では、機能ブロック別消費電力とそれぞれの機能ブロック配置から消費電力マップを作成する。その結果、図26(a)および(b)に機能ブロックフロアプランおよびその消費電力マップを示すように、弱熱耐性ブロックがもっとも高熱となる部分PHに隣接している場合で説明する。
この場合、弱熱耐性ブロックBWが等熱線の間隔が狭い箇所に配置されているために、熱変動が大きい。よって、特性のばらつきも大きくなるという問題がある。
そこで、次に弱熱耐性ブロックフロアプラン変更ステップS2503において、消費電力マップに従い、図27に示すように弱熱耐性ブロックBWを熱変動の少ない位置に変更する。この時、最も消費電力の大きい機能ブロックは動かさないことが重要である。このような方法をとることにより、消費電力マップを大きく変えることなく、信頼性の向上をはかることができる。
最後に消費電力マップ確認ステップS2504において、再度消費電力マップを作成しなおし、弱熱耐性ブロックが等熱線の間隔が広い箇所に移動しているかどうかを確認する。
本手法により、弱熱耐性ブロックは熱変動の少ない部分に配置され、特性変化が少なくなり、半導体集積回路の性能保障がやりやすくなるという利点がある。
(実施の形態7)
次に本発明の実施の形態7について説明する。前記実施の形態6では、半導体集積回路の熱伝導ベクトルを用いた熱解析について説明したが、本実施の形態では、半導体集積回路を搭載するパッケージ基板の熱解析について説明する。図28にこの方法を示すフローチャート、図29から図33にその説明図を示す。パッケージ基板を前述したように3層あるいは4層の配線層を持つ基板で構成する場合、電源プレーンあるいは接地プレーンをもつが、このパターン構成を調整することによって、熱伝導ベクトルを補正することができる。本実施の形態では、電源プレーンのパターン制御による熱伝導ベクトルの補正について説明する。
次に本発明の実施の形態7について説明する。前記実施の形態6では、半導体集積回路の熱伝導ベクトルを用いた熱解析について説明したが、本実施の形態では、半導体集積回路を搭載するパッケージ基板の熱解析について説明する。図28にこの方法を示すフローチャート、図29から図33にその説明図を示す。パッケージ基板を前述したように3層あるいは4層の配線層を持つ基板で構成する場合、電源プレーンあるいは接地プレーンをもつが、このパターン構成を調整することによって、熱伝導ベクトルを補正することができる。本実施の形態では、電源プレーンのパターン制御による熱伝導ベクトルの補正について説明する。
まず、半導体集積回路熱伝導ベクトル算出ステップS2701では、半導体集積回路の熱伝導のしやすさを表す熱伝導ベクトルを計算する。計算方法は、上記実施の形態3で説明した方法を用いる。もしくは、既に、熱伝導方向がわかっている場合は、その情報を用いる。
次にパッケージ基板プレーン計算ステップS2702では、半導体集積回路と半導体集積回路装置で熱伝導の方向を変更したいかどうかを考慮して、電源、接地プレーン設計を行う。着目するポイントとしては、半導体集積回路装置10の熱伝導ベクトルは、半導体集積回路とパッケージ基板1の電源および接地プレーン1−1a/bにより決まることである。(図56参照)
次にパッケージ基板プレーン計算ステップS2702では、半導体集積回路と半導体集積回路装置で熱伝導の方向を変更したいかどうかを考慮して、電源、接地プレーン設計を行う。着目するポイントとしては、半導体集積回路装置10の熱伝導ベクトルは、半導体集積回路とパッケージ基板1の電源および接地プレーン1−1a/bにより決まることである。(図56参照)
図29(a)に示すように、右方向に強い熱伝導ベクトルをもつ半導体集積回路を、図29(b)に示すように、一様な電源プレーン(ビアも含めて一様)を持つパッケージ基板上に搭載する場合、半導体集積回路の熱伝導ベクトルをそのまま引き継ぐことになる。
従って、半導体集積回路と同じ方向に熱伝導するままで良い場合は、プレーン、ビアの穴がパッケージ基板内の電源、設置プレーンで一様になるようにパッケージ基板を設計する。
一方、熱伝導方向を右方向ではなく、上下方向に変えたい場合には、右方向のプレーンを小さくする(図30(a))、あるいは伝導させたくない方向の形状を変更する(図30(b))か、右方向にビアの穴を多くあける(図32)ことで対応する。
すなわち、図31(a)に示すように右方向に強い熱伝導ベクトルをもつ半導体集積回路の場合、図30(a)に示すように、電源プレーンの右側部分をなくすことにより、図31(b)に示すように、右側への熱伝導が減少し、その分、上下方向への熱伝導が増大する。
また図30(b)に示すように、電源プレーンの右側部分のパターンを変更し面積を小さくすることにより、図30(a)に示した場合と同様、図31(b)に示すように、右側への熱伝導が減少し、その分、上下方向への熱伝導が増大する。
さらにまた図32に示すように、電源プレーンの右側部分のビアの分布密度を大きくすることにより、図30(a)に示した場合と同様、図31(b)に示すように、右側への熱伝導が減少し、その分、上下方向への熱伝導が増大する。
この方法は、半導体集積回路の熱伝導方向が決まっている、あるいはフロアプラン上、方向を変えられない場合に、パッケージ基板で熱伝導方向を変えたい場合に有効である。
あるいは、半導体集積回路だけでは、熱伝導方向を変えきれないため、半導体集積回路/パッケージ基板で協力して熱伝導方向をコントロールする場合に有効である。
(実施の形態8)
次に本発明の実施の形態8について説明する。本実施の形態では、複数の半導体集積回路装置を積層する場合の半導体集積回路装置の設計方法について説明する。図33にこの設計方法を示すフローチャートを示すように、本実施の形態では、その上層または下層に隣接して配置される半導体集積回路装置の熱伝導ベクトルを考慮して、熱伝導ベクトルの総和が0に近づくように設計するようにしたことを特徴とする。
次に本発明の実施の形態8について説明する。本実施の形態では、複数の半導体集積回路装置を積層する場合の半導体集積回路装置の設計方法について説明する。図33にこの設計方法を示すフローチャートを示すように、本実施の形態では、その上層または下層に隣接して配置される半導体集積回路装置の熱伝導ベクトルを考慮して、熱伝導ベクトルの総和が0に近づくように設計するようにしたことを特徴とする。
図34に示すように、半導体集積回路装置10d上に半導体集積回路装置10eを縦積みして実装するものにおいて、縦積みする向きを決定する方法である。
まず、半導体集積回路装置熱伝導ベクトル計算ステップS3301では、半導体集積回路装置毎に熱伝導ベクトルを計算する。その結果、半導体集積回路装置10dおよび半導体集積回路装置10eの消費電力マップおよび熱伝導ベクトルは図35および図36に示すものであったとする。
まず、半導体集積回路装置熱伝導ベクトル計算ステップS3301では、半導体集積回路装置毎に熱伝導ベクトルを計算する。その結果、半導体集積回路装置10dおよび半導体集積回路装置10eの消費電力マップおよび熱伝導ベクトルは図35および図36に示すものであったとする。
複数半導体集積回路装置合成熱伝導ベクトル計算ステップS3302では、上下に積まれる半導体集積回路装置の熱伝導ベクトルの総和が小さくなるように積む。
最後に合成熱伝導ベクトル判定ステップS3303において、ベクトルの総和が設定値以下になっているかどうかを判定する。
最後に合成熱伝導ベクトル判定ステップS3303において、ベクトルの総和が設定値以下になっているかどうかを判定する。
具体的には、図35および図36に示したような消費電力マップおよび熱伝導ベクトルの半導体集積回路装置を縦積みする場合、このまま積むと、右側に熱がかたよりすぎて、放熱効率が悪い。
この点について詳細に説明する。図35及び図36の消費電力マップの断面図が、それぞれ図37、38であるとする。縦軸は消費電力が高いことを意味している。図35と図36の消費電力マップのまま縦積みすると、図40に示すように、半導体集積回路装置10d及び半導体集積回路装置10eの消費電力の高い箇所が一致してしまい、一部箇所に異常に高温な箇所ができてしまうことから、放熱効率が悪いといえる。
逆に、図39のように、半導体集積回路装置10dあるいは半導体集積回路装置10eのいずれかを反対向きに積みことにより、消費電力が一様で、熱伝導ベクトルが互いに打ち消しあい、熱が一様に広がり、放熱効率の良い積み方となる。ここで反対向きに積層する場合、外部出力端子を含めてパッケージ基板内の配線を調整するとともに、必要に応じて電源プレーンや接地プレーンの設計変更を行うことにより、熱的および電気(信号)的調整を行う。
この点について詳細に説明する。図35及び図36の消費電力マップの断面図が、それぞれ図37、38であるとする。縦軸は消費電力が高いことを意味している。図35と図36の消費電力マップのまま縦積みすると、図40に示すように、半導体集積回路装置10d及び半導体集積回路装置10eの消費電力の高い箇所が一致してしまい、一部箇所に異常に高温な箇所ができてしまうことから、放熱効率が悪いといえる。
逆に、図39のように、半導体集積回路装置10dあるいは半導体集積回路装置10eのいずれかを反対向きに積みことにより、消費電力が一様で、熱伝導ベクトルが互いに打ち消しあい、熱が一様に広がり、放熱効率の良い積み方となる。ここで反対向きに積層する場合、外部出力端子を含めてパッケージ基板内の配線を調整するとともに、必要に応じて電源プレーンや接地プレーンの設計変更を行うことにより、熱的および電気(信号)的調整を行う。
しかしながら、半導体集積回路装置同士の信号の組合せの問題で、半導体集積回路装置10dあるいは半導体集積回路装置10eのいずれかを反対向きにできない場合がある。そこの場合、半導体集積回路装置10d,半導体集積回路装置10eのいずれかのフロアプランの変更等により消費電力マップ及び熱伝導ベクトルを可能な限り図39に近づけることで、熱の一様化を実現する。このフロアプランの変更においては、本発明の実施の形態5や実施の形態6を用いて熱伝導ベクトルの向きを変更する手法が有効である。
あるいは実施の形態12で後述するように、パッケージ基板にスリットなどの熱遮断手段を配したり、電源プレーンや接地プレーンを調整したりすることにより、半導体集積回路装置としての熱伝導ベクトルの向きを変更するなどの方法も有効である。
あるいは実施の形態12で後述するように、パッケージ基板にスリットなどの熱遮断手段を配したり、電源プレーンや接地プレーンを調整したりすることにより、半導体集積回路装置としての熱伝導ベクトルの向きを変更するなどの方法も有効である。
この方法によれば、半導体集積回路装置の縦積み時でも、熱のこもりがなく、放熱効果の高い積み方が可能である。
(実施の形態9)
次に本発明の実施の形態9について説明する。前記実施の形態8では、半導体集積回路装置の縦積みについて説明したが、本実施の形態では、図42に示すように複数の半導体集積回路つまりベアチップを積層する場合の半導体集積回路の設計方法について説明する。半導体集積回路の場合も半導体集積回路装置の場合と同様、その上層または下層に隣接して配置される半導体集積回路の熱伝導ベクトルを考慮して、熱伝導ベクトルの総和が0に近づくように設計するようにしたことを特徴とする。
次に本発明の実施の形態9について説明する。前記実施の形態8では、半導体集積回路装置の縦積みについて説明したが、本実施の形態では、図42に示すように複数の半導体集積回路つまりベアチップを積層する場合の半導体集積回路の設計方法について説明する。半導体集積回路の場合も半導体集積回路装置の場合と同様、その上層または下層に隣接して配置される半導体集積回路の熱伝導ベクトルを考慮して、熱伝導ベクトルの総和が0に近づくように設計するようにしたことを特徴とする。
図42(a)に示すように、半導体集積回路2a上に半導体集積回路2bを縦積みして実装するものにおいて、縦積みする向きを決定する方法である。
この方法については前記実施の形態8で示した図33のフローチャートと同様であり、半導体集積回路装置を半導体集積回路に読み替えればよい。
図41にこのフローチャートを示す。半導体集積回路熱伝導ベクトル計算ステップS3901では、半導体集積回路毎に熱伝導ベクトルを計算する。その結果、半導体集積回路2aおよび半導体集積回路2bの消費電力マップおよび熱伝導ベクトルは図43および図44に示すものであったとする。
この方法については前記実施の形態8で示した図33のフローチャートと同様であり、半導体集積回路装置を半導体集積回路に読み替えればよい。
図41にこのフローチャートを示す。半導体集積回路熱伝導ベクトル計算ステップS3901では、半導体集積回路毎に熱伝導ベクトルを計算する。その結果、半導体集積回路2aおよび半導体集積回路2bの消費電力マップおよび熱伝導ベクトルは図43および図44に示すものであったとする。
複数半導体集積回路合成熱伝導ベクトル計算ステップS3902では、上下に積まれる半導体集積回路の熱伝導ベクトルの総和が小さくなるように積む。
最後に合成熱伝導ベクトル判定ステップS3903において、ベクトルの総和が設定値以下になっているかどうかを判定する。
最後に合成熱伝導ベクトル判定ステップS3903において、ベクトルの総和が設定値以下になっているかどうかを判定する。
具体的には、図43および図44に示したような消費電力マップおよび熱伝導ベクトルの半導体集積回路を縦積みする場合、このまま積むと、右側に熱がかたよりすぎて、放熱効率が悪い。より詳細に説明する。図43及び図44の消費電力マップの断面図が図45及び図46である。縦軸は消費電力が高いことを意味している。図43と図44の消費電力マップのまま縦積みすると、図47に示すように、半導体集積回路1及び半導体集積回路2の消費電力の高い箇所が一致してしまい、一部箇所に異常に高温な箇所ができてしまうことから、放熱効率が悪いといえる。
逆に、図48のように、半導体集積回路1あるいは半導体集積回路2のいずれかを反対向きに積みことにより、消費電力が一様で、熱伝導ベクトルが互いに打ち消しあい、熱が一様に広がり、放熱効率の良い積み方となる。
逆に、図48のように、半導体集積回路1あるいは半導体集積回路2のいずれかを反対向きに積みことにより、消費電力が一様で、熱伝導ベクトルが互いに打ち消しあい、熱が一様に広がり、放熱効率の良い積み方となる。
このようにして消費電力マップ及び熱伝導ベクトルを改善し、熱の一様化を実現する。しかしながら、信号の組合せの問題で、図47の組合せになってしまう場合も出てくるが、その場合、半導体集積回路2a,半導体集積回路2bのいずれかのフロアプランの変更等により、熱の一様化を実現する。このフロアプランの変更においては、本発明の実施の形態5や実施の形態6を用いて熱伝導ベクトルの向きを変更する手法が有効である。
この方法によれば、熱のこもりがなく、放熱効果の高い積層構造を提供することが可能である。なお図42(b)に示すように、バンプを介して半導体集積回路が接続されている場合、若干熱伝導ベクトルは異なるが、おおむね同様である。
(実施の形態10)
次に本発明の実施の形態10について説明する。
本実施の形態では、実装基板上での熱解析結果を考慮した実装形態(半導体集積回路装置などの部品配置)について説明する。実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとが配置される場合を考える。まず図49および図50に示すように、実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとが配置されるように仮配置を行う。図49は図50のA−A断面図である。
次に本発明の実施の形態10について説明する。
本実施の形態では、実装基板上での熱解析結果を考慮した実装形態(半導体集積回路装置などの部品配置)について説明する。実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとが配置される場合を考える。まず図49および図50に示すように、実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとが配置されるように仮配置を行う。図49は図50のA−A断面図である。
まず、消費電力から消費電力マップおよび熱伝導ベクトルを作成する。その結果、図示は省略するが、発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bのところで熱が集中し極大点が形成される。
このとき、図51に示すように、筐体400にファン500を形成し、熱が集中する極大点に向けて空気の流れRが形成されるように強制冷却する。すなわち強制冷却ポイントPに対してより直角に空気流れRが形成されるようにファン位置を変更する。ここで200は実装基板100を実装するマザーボードである。
このようにすることで、効率的な放熱効果が得られ、誤動作が低減し、信頼性の高い半導体集積回路システムを得る事が可能となる。
(実施の形態11)
次に本発明の実施の形態11について説明する。
前記実施の形態10では、発熱量の大きい半導体集積回路装置を集中して配置し、ここに強制冷却手段を配置するようにしたが、本実施の形態では、実装基板上で発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとを、図52および図53に示すように離間して配置し、熱伝導ベクトルを均一化したことを特徴とするものである。
実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとが配置される場合を考える。まず図52および図53に示すように、実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとを離間して配置されるように配置を行う。図52は図53のA−A断面図である。
次に本発明の実施の形態11について説明する。
前記実施の形態10では、発熱量の大きい半導体集積回路装置を集中して配置し、ここに強制冷却手段を配置するようにしたが、本実施の形態では、実装基板上で発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとを、図52および図53に示すように離間して配置し、熱伝導ベクトルを均一化したことを特徴とするものである。
実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとが配置される場合を考える。まず図52および図53に示すように、実装基板100上に発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとを離間して配置されるように配置を行う。図52は図53のA−A断面図である。
まず、消費電力から消費電力マップおよび熱伝導ベクトルを作成する。その熱解析結果に基づいて、図52および図53に示すように、発熱量の大きい半導体集積回路装置(QFP−X)10aと、発熱量の大きい半導体集積回路装置(BGA−X)10bとを離間して配置し、熱の均一化をはかるものである。
本実施の形態においても、効率的な放熱効果で誤動作が低減し、信頼性の高い半導体集積回路システムを得る事が可能となる。
(実施の形態12)
次に本発明の実施の形態12について説明する。
この方法では、熱伝導ベクトルを考慮してパッケージ基板の設計を行うものである。
図54にこのパッケージ基板の設計方法のフローチャートを示す。
本実施の形態では、まず、実装基板/筐体熱解析ステップS4801において、実装基板/筐体の熱解析を行う。
次に本発明の実施の形態12について説明する。
この方法では、熱伝導ベクトルを考慮してパッケージ基板の設計を行うものである。
図54にこのパッケージ基板の設計方法のフローチャートを示す。
本実施の形態では、まず、実装基板/筐体熱解析ステップS4801において、実装基板/筐体の熱解析を行う。
次に半導体集積回路装置熱設計方針決定ステップS4802で、実装基板/筐体の状況にあわせて、半導体集積回路装置の熱設計方針を決定する。例えば図55に示すように、実装基板100上で、設計対象の半導体集積回路装置20aの両隣に熱に弱い(=温度変化させたくない)半導体集積回路装置20b,20cがある場合に、パッケージ基板1を含むパッケージをどのような方針で設計するかを決定する。
第1の方法としては図56(a)に示すように、通常、実装基板側への放熱のためにサーマルビア6を介してサーマルボール4が設けられているのに対し、本実施の形態の半導体集積回路装置のパッケージ基板1には図56(b)に示すように、サーマルビア6を形成しないようにし、実装基板側への半導体集積回路装置20aからの放熱を抑制する。これにより、両隣の熱に弱い半導体集積回路装置20b,20cへの熱放射を抑制するようにしたことを特徴とするものである。
この方法によれば、熱特性に優れ長寿命の半導体集積回路システムを提供することが可能となる。
この方法によれば、熱特性に優れ長寿命の半導体集積回路システムを提供することが可能となる。
第2の方法としては図57(a)、(b)に示すように、両隣の熱に弱い半導体集積回路装置20b,20cへ向いていた半導体集積回路装置20aの熱伝導ベクトルを、90度変換し、熱伝導方向を上下方向にするものである。この例の場合は、サーマルボールはつけて、制御した方向に熱が伝導するようにする。
第3の方法として、図58(a)に示すように、通常、実装基板側への放熱のためにサーマルビア6を介してサーマルボール4Tが設けられているのに対し、本実施の形態の半導体集積回路装置のパッケージ基板1には図58(b)に示すように、サーマルビア6の位置を変更し、放熱したい側にのみサーマルビア6およびサーマルボール4Tを形成し、熱伝導ベクトルの方向を変更することにより、両隣の熱に弱い半導体集積回路装置20b,20cへの熱放射を抑制するようにしたことを特徴とするものである。図59(b)はサーマルボールの配置を示す平面図である。この水平方向の断面が図58(b)に相当する。図59(a)は図58(a)平面図である。
この方法によれば、熱特性に優れ長寿命の半導体集積回路システムを提供することが可能となる。
なお、サーマルボールの配置については、熱伝導方向を考慮して適宜変更しパッケージ基板設計をすればよく、必ずしも図59(b)に示す配置に限定されるものではなく、図59(c)および(d)など適宜変更可能である。
以上の第1から第3の方法等を含め定められた設計方針に従い、パッケージ基板設計ステップS4803でパッケージ基板の設計を行う。
この方法によれば、熱特性に優れ長寿命の半導体集積回路システムを提供することが可能となる。
なお、サーマルボールの配置については、熱伝導方向を考慮して適宜変更しパッケージ基板設計をすればよく、必ずしも図59(b)に示す配置に限定されるものではなく、図59(c)および(d)など適宜変更可能である。
以上の第1から第3の方法等を含め定められた設計方針に従い、パッケージ基板設計ステップS4803でパッケージ基板の設計を行う。
(実施の形態13)
次に本発明の実施の形態13について説明する。
この方法では、熱解析結果(熱伝導ベクトル)を考慮して実装基板の設計を行うものである。
図60にこの実装基板の設計方法のフローチャートを示す。
本実施の形態では、まず、実装基板/筐体熱解析ステップS5401において、実装基板/筐体のエアーフロー及び各半導体集積回路装置の消費電力から実装基板/筐体の熱解析を行う。
次に本発明の実施の形態13について説明する。
この方法では、熱解析結果(熱伝導ベクトル)を考慮して実装基板の設計を行うものである。
図60にこの実装基板の設計方法のフローチャートを示す。
本実施の形態では、まず、実装基板/筐体熱解析ステップS5401において、実装基板/筐体のエアーフロー及び各半導体集積回路装置の消費電力から実装基板/筐体の熱解析を行う。
次に、電源プレーン解析ステップS5402において、実装基板の電源、接地プレーンの形状およびその電源プレーンに繋がる半導体集積回路装置と、複数の半導体集積回路装置が搭載されている場合にはそれぞれの位置関係を抽出する。
この抽出の結果、同じ電源、接地プレーンを共用している消費電力大半導体集積回路装置が、隣接配置されているとする(図61(a))。この隣接配置された消費電力大半導体集積回路装置間は、電源プレーンを共有しているために、双方の半導体集積回路装置からの熱伝導により熱がこもりやすい。
次にスリット挿入ステップS5403において、上記条件で抽出された半導体集積回路間の電源、接地プレーン101a、101bにスリットSを入れる(図61(b)参照)。
以上の方法により、図61(a)に示したように、半導体集積回路装置30a,30bが隣接している実装基板100上で、図61(b)に示すように、スリットを入れることにより、相互の半導体集積回路装置方向に向いていた放熱方向を、他の方向に向かせるようにすることが可能となり、これら半導体集積回路装置間に熱が集中するのを防ぐことができる。
以上の方法により、図61(a)に示したように、半導体集積回路装置30a,30bが隣接している実装基板100上で、図61(b)に示すように、スリットを入れることにより、相互の半導体集積回路装置方向に向いていた放熱方向を、他の方向に向かせるようにすることが可能となり、これら半導体集積回路装置間に熱が集中するのを防ぐことができる。
なお、前記実施の形態では、電源、接地プレーンの解析に際し、熱伝導ベクトルを作成し、熱解析を行うようにしたが、この方法は、半導体集積回路を含む半導体集積回路システム全体、あるいは個々の設計方法のみならず、物体の熱解析全般に適用可能である。
(実施の形態14)
次に本発明の実施の形態14について説明する。
この方法でも、前記実施の形態13と同様、熱解析結果(熱伝導ベクトル)を考慮して実装基板の設計を行うものであるが、ここではスリットではなく、熱的に絶縁性の材料を形成するなど、熱的遮断手段を設けたことを特徴とする。
次に本発明の実施の形態14について説明する。
この方法でも、前記実施の形態13と同様、熱解析結果(熱伝導ベクトル)を考慮して実装基板の設計を行うものであるが、ここではスリットではなく、熱的に絶縁性の材料を形成するなど、熱的遮断手段を設けたことを特徴とする。
図62にこの実装基板の筐体への装着状態を示す。マザーボード200に装着された実装基板100上で、発熱量の大きい半導体集積回路装置が近接している場合を考える。
図63(a)および(b)に平面図および断面図を示すように実装基板100上に3つの半導体集積回路装置が配線パターン103を介して近接配置される場合を考える。図63(b)は図63(a)のA−A断面図である。
図63(a)および(b)に平面図および断面図を示すように実装基板100上に3つの半導体集積回路装置が配線パターン103を介して近接配置される場合を考える。図63(b)は図63(a)のA−A断面図である。
本実施の形態でも、図60に示したフローチャートと同様に図64に示すフローチャートを用いて熱解析を行い、この結果に基づいて実装基板の設計を行う。実装基板/筐体熱解析ステップS5801において、実装基板/筐体のエアーフロー及び各半導体集積回路装置の消費電力から実装基板/筐体の熱解析を行う。
次に、隣接半導体集積回路装置相関作成ステップS5802において、実装基板上に搭載される半導体集積回路装置の熱的相関を抽出する。
ここでは、電源プレーンおよび接地プレーンを共用している半導体集積回路装置で、かつ、消費電力大半導体集積回路装置が、隣接する場合を考える。
次に方法選択ステップS5803において隣接する半導体集積回路装置毎に熱、信号品質、熱および信号品質のいずれに重点を置くべきかを判断する。例えば方法選択ステップS5803において、信号品質に重点を置くと判断された場合には、表層配線はそのままにして、電気的には遮断することなく、上記条件で抽出された半導体集積回路装置間の接地プレーン101bにスリットSを入れ、図65(a)および(b)に平面図および断面図を示すようにこのスリットに絶縁体104を充填する。図65(b)は図65(a)のA−A断面図である。
以上の方法により、図61(a)に示したように、半導体集積回路装置30a,30bが隣接していた実装基板100上で、図61(b)に示すように、スリットを入れることにより、相互の半導体集積回路装置方向に向いていた放熱方向を、熱伝導を断ち切ることにより、他の方向に向かすことが可能となり、これら半導体集積回路装置間に熱が集中するのを防ぐことができる。
なお、方法選択ステップS5803において、信号品質および熱の両方に重点を置くと判断された場合には、スリットに絶縁体を充填する方法に代えて、図66(a)乃至(c)に示すように貫通ビアを形成しこれに絶縁体を充填するようにしてもよい。図66(b)(c)は図66(a)のA−A断面およびB−B断面図である。
また、方法選択ステップS5803において、熱に重点を置くと判断された場合には、スリットに絶縁体を充填する方法に代えて、図67(a)および(b)に示すように全層に貫通するようにスリットSを形成してもよい。図67(b)は図67(a)のA−A断面図である。この場合配線パターン103は迂回配線を構成する必要がある。
なおスリットの形状としては前記実施の形態に示した形状に限定されることなく、例えば図68に示すように適宜変更可能である。
なおスリットの形状としては前記実施の形態に示した形状に限定されることなく、例えば図68に示すように適宜変更可能である。
なおここで、パッケージについては、パッケージ基板と、樹脂封止、金属キャップ、セラミックキャップなどのキャップ材料と合わせたものとして説明した。
本発明によれば、半導体集積回路実装基板の情報から、熱解析を考慮し、パッケージの設計、半導体集積回路の設計を行うことにより、高精度でかつ高速設計が可能となることから、携帯電話等の通信機器、一般家庭用品や玩具、自動車まで、種々の製品に適用可能である。
1 パッケージ基板
2,2a、2b 半導体集積回路
3 封止樹脂
4 半田ボール
10a、10b 半導体集積回路装置
100 実装基板
101 電源・設置プレーン
103 配線パターン
400 筐体
2,2a、2b 半導体集積回路
3 封止樹脂
4 半田ボール
10a、10b 半導体集積回路装置
100 実装基板
101 電源・設置プレーン
103 配線パターン
400 筐体
Claims (46)
- システム仕様情報に基づき、
当該システムを収納する筐体および、前記筐体内に収納され、当該システムを構成する実装基板と、前記実装基板上に実装されるパッケージ基板を含む半導体集積回路(LSI)装置の設計を行う第1の工程と、
前記設計を行う工程で得られた設計結果に基づき、
前記筐体内における前記実装基板および/または前記半導体集積回路装置の熱解析を行う工程と、
前記熱解析を行う工程の解析結果に基づき
半導体集積回路システムを設計する第2の工程とを含む半導体集積回路システムの設計方法。 - 請求項1に記載の半導体集積回路システムの設計方法であって、
前記第2の工程は、
前記半導体集積回路装置に搭載する半導体集積回路の素子配置を決定し、前記半導体集積回路の設計を行う工程を含む半導体集積回路システムの設計方法。 - 請求項1または2に記載の半導体集積回路システムの設計方法であって、
システム仕様情報に基づき、
当該システムを収納する筐体および、前記筐体内に収納され、当該システムを構成する実装基板の設計を行う工程と、
前記実装基板の設計を行う工程で得られた設計結果に基づき、
前記筐体内における前記実装基板の熱解析を行う工程と、
前記熱解析を行う工程の解析結果に基づき、
前記実装基板上に実装されるパッケージ基板を含む半導体集積回路装置の設計を行う工程と、を含む半導体集積回路システムの設計方法。 - 請求項1乃至3のいずれかに記載の半導体集積回路システムの設計方法であって、
前記実装基板の設計工程は、
前記筐体内の熱解析を行う工程と、
前記熱解析を行う工程の解析結果に基づき、
前記筐体内に収納される実装基板を設計する工程を含む半導体集積回路システムの設計方法。 - 請求項1乃至4のいずれかに記載の半導体集積回路システムの設計方法であって、
前記半導体集積回路装置は、外部接続端子が格子状に配置されたグリッドアレイ端子構造を持つ半導体集積回路システムの設計方法。 - 請求項1に記載の半導体集積回路システムの設計方法であって、
前記熱解析を行う工程は、前記実装基板の表面温度をシミュレートする工程と、
前記表面温度に基づいて等熱線を描画する工程と、
前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む半導体集積回路システムの設計方法。 - 請求項6に記載の半導体集積回路システムの設計方法であって、
前記実装基板の表面温度をシミュレートする工程は、
前記実装基板に搭載する各半導体集積回路装置の消費電力に基づいて表面温度をシミュレートする工程とを含む半導体集積回路システムの設計方法。 - 請求項1に記載の半導体集積回路システムの設計方法であって、
前記第1の工程は、システム仕様情報に基づき、
当該システムを構成する実装基板の設計を行う工程と、
前記実装基板の設計を行う工程で得られた設計結果に基づき、
前記実装基板上に実装されるパッケージ基板を含むパッケージの設計を行う工程と、
前記パッケージの設計を行う工程で得られた設計結果に基づき、
半導体集積回路のI/O端子位置を決定するように、前記パッケージに搭載する半導体集積回路の設計を行う工程を含む半導体集積回路システムの設計方法。 - パッケージ基板上に半導体集積回路を搭載して、筐体内に収納される半導体集積回路実装基板上で所望のシステムを構成する半導体集積回路の設計方法であって、
前記半導体集積回路および、前記半導体集積回路実装基板の前記筐体内における熱解析を行う工程と、
熱解析結果に基づき、前記半導体集積回路を設計する工程とを含む半導体集積回路の設計方法。 - 請求項9に記載の半導体集積回路の設計方法であって、
前記熱解析を行う工程は、前記半導体集積回路の消費電力に基づいて表面温度をシミュレートする工程と、
前記表面温度に基づいて等熱線を描画する工程と、
前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む半導体集積回路の設計方法。 - 請求項9または10に記載の半導体集積回路の設計方法であって、
前記半導体集積回路を設計する工程は、素子配置に基づく熱伝導による温度変化を設計条件に組み入れる工程を含む半導体集積回路の設計方法。 - 請求項9または10に記載の半導体集積回路の設計方法であって、
前記半導体集積回路を設計する工程は、当該半導体集積回路の発熱量に応じて前記半導体集積回路の表面高さを調整する工程を含む半導体集積回路の設計方法。 - 請求項9または10に記載の半導体集積回路の設計方法であって、
前記半導体集積回路を設計する工程は、前記システム仕様にもとづく素子配置から消費電力マップを作成する工程と、
前記消費電力マップに基づき熱伝導ベクトルを作成する工程とを含む半導体集積回路の設計方法。 - 請求項9または10に記載の半導体集積回路の設計方法であって、
前記半導体集積回路を設計する工程は、筐体内に収納される半導体集積回路実装基板の放熱状況に応じて、前記半導体集積回路の位置および向きを決定する半導体集積回路の設計方法。 - 請求項13または14に記載の半導体集積回路の設計方法であって、
前記半導体集積回路を設計する工程は、前記熱伝導ベクトルにあわせて、放熱し易い方向に発熱量の大きい回路素子の配置を変更する工程である半導体集積回路の設計方法。 - 請求項13または14に記載の半導体集積回路の設計方法であって、
前記半導体集積回路を設計する工程は、前記熱伝導ベクトルの向かう方向を避けて、熱耐性の小さい素子を配置する工程を含む半導体集積回路の設計方法。 - 請求項9に記載の半導体集積回路の設計方法であって、
前記半導体集積回路は、複数の半導体集積回路を積層する際に、その上層または下層に隣接して配置される半導体集積回路の熱伝導ベクトルを考慮して、熱伝導ベクトルの総和が0に近づくように設計される半導体集積回路の設計方法。 - 請求項9に記載の半導体集積回路の設計方法であって、
前記半導体集積回路は、複数のパッケージを積層する際に、その上層または下層に隣接して配置されるパッケージの熱伝導ベクトルを考慮して、半導体集積回路装置としての熱伝導ベクトルの総和が0に近づくように設計される半導体集積回路の設計方法。 - 半導体集積回路を搭載して、半導体集積回路実装基板上で所望のシステムを構成するパッケージ基板の設計方法であって、
前記半導体集積回路および、前記半導体集積回路実装基板の熱解析を行う工程と、
熱解析結果とに基づき、前記パッケージ基板を設計する工程とを含む半導体集積回路の設計方法。 - 請求項19に記載のパッケージ基板の設計方法であって、
前記熱解析を行う工程は、前記半導体集積回路の消費電力とパッケージ基板上の配線パターンに基づいて表面温度をシミュレートする工程と、
前記表面温度に基づいて前記パッケージ基板上で等熱線を描画する工程と、
前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含むパッケージ基板の設計方法。 - 請求項19または20記載のパッケージ基板の設計方法であって、
パッケージ基板の構造に基づく熱伝導による温度変化を設計条件に組み入れる工程を含むパッケージ基板の設計方法。 - 請求項19または20に記載のパッケージ基板の設計方法であって、
前記パッケージ基板を設計する工程は、当該半導体集積回路の発熱量に応じて前記パッケージ全体としての表面高さを調整する工程を含むパッケージ基板の設計方法。 - 請求項19または20に記載のパッケージ基板の設計方法であって、
前記パッケージ基板を設計する工程は、前記システム仕様にもとづくパッケージ基板の構造から消費電力マップを作成する工程と、
前記消費電力マップに基づき熱伝導ベクトルを作成する工程とを含むパッケージ基板の設計方法。 - 請求項19または20に記載のパッケージ基板の設計方法であって、
前記パッケージ基板を設計する工程は、筐体内に収納される半導体集積回路実装基板の放熱状況に応じて、前記パッケージ基板の位置および向きを決定するパッケージ基板の設計方法。 - 請求項23または24に記載のパッケージ基板の設計方法であって、
前記パッケージ基板を設計する工程は、前記熱伝導ベクトルにあわせて、放熱し易い方向に発熱量の大きいパッケージの配置を変更する工程であるパッケージ基板の設計方法。 - 請求項23または24に記載のパッケージ基板の設計方法であって、
前記パッケージ基板を設計する工程は、前記熱伝導ベクトルの向かう方向を避けて、熱耐性の小さい素子を配置する工程を含むパッケージ基板の設計方法。 - 請求項19乃至26のいずれかに記載のパッケージ基板の設計方法であって、
少なくとも1層の電源・接地プレーンを含み、
前記電源プレーンが、前記半導体集積回路の熱伝導ベクトルに従って形状を変更するように、前記パッケージ基板を構成する工程を含むパッケージ基板の設計方法。 - 請求項19に記載のパッケージ基板の設計方法であって、
前記パッケージ基板は、複数のパッケージを積層する際に、その上層または下層に隣接して配置されるパッケージの熱伝導ベクトルを考慮して、半導体集積回路装置としての熱伝導ベクトルの総和が0に近づくように設計されるパッケージ基板の設計方法。 - 請求項27に記載のパッケージ基板の設計方法であって、
前記パッケージ基板を構成する工程は、熱伝導ベクトルの大きい領域に熱遮断手段を配する工程を含むパッケージ基板の設計方法。 - 半導体集積回路を搭載したパッケージ基板を実装し、所望のシステムを構成する半導体集積回路実装基板の設計方法であって、
搭載すべきパッケージの熱解析を行なう工程と、
前記解析結果に基づき、熱的に安定な状態を維持できるように、前記パッケージを構成するパッケージ基板に搭載された半導体集積回路を接続するための配線パターンを備えた半導体集積回路実装基板を設計する工程を含む半導体集積回路実装基板の設計方法。 - 請求項30に記載の半導体集積回路実装基板の設計方法であって、
前記熱解析を行う工程は、前記半導体集積回路の消費電力に基づいて前記パッケージ基板の表面温度をシミュレートする工程と、
前記表面温度に基づいて等熱線を描画する工程と、
前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む半導体集積回路実装基板の設計方法。 - 請求項30または31に記載の半導体集積回路実装基板の設計方法であって、
前記半導体集積回路実装基板の設計方法は、発熱量の大きいパッケージが隣接配置されるのを避けるように、設計を行うようにした半導体集積回路実装基板の設計方法。 - 請求項30または31に記載の半導体集積回路実装基板の設計方法であって、
前記半導体集積回路実装基板の設計方法は、発熱量の大きいパッケージを集中して配置し、当該位置に強制冷却手段を配するようにした半導体集積回路実装基板の設計方法。 - 請求項19乃至29に記載のパッケージ基板の設計方法で得られるパッケージ基板であって、
パッケージ基板が熱遮断手段を有するパッケージ基板。 - 請求項34記載のパッケージ基板であって、
前記熱遮断手段は、電源プレーンまたは接地プレーンに設けられたスリットに充填された絶縁体であるパッケージ基板。 - 請求項34記載のパッケージ基板であって、
前記熱遮断手段は、パッケージ基板に設けられた貫通スリットであるパッケージ基板。 - 請求項34記載のパッケージ基板であって、
前記熱遮断手段は、配線パターンを避けてパッケージ基板に設けられた複数の貫通ビアであるパッケージ基板。 - 請求項1乃至8記載の半導体集積回路システムの設計方法に基づいて製造された半導体集積回路システム。
- 請求項9乃至18記載の半導体集積回路の設計方法に基づいて製造された半導体集積回路。
- 請求項30乃至33載の半導体集積回路実装基板の設計方法に基づいて製造された半導体集積回路実装基板。
- 請求項40に記載の半導体集積回路実装基板であって、
半導体集積回路実装基板が熱遮断手段を有する半導体集積回路実装基板。 - 請求項41記載の半導体集積回路実装基板であって、
前記熱遮断手段は、電源プレーンまたは接地プレーンに設けられたスリットに充填された絶縁体である半導体集積回路実装基板。 - 請求項41記載の半導体集積回路実装基板であって、
前記熱遮断手段は、半導体集積回路実装基板に設けられた貫通スリットである半導体集積回路実装基板。 - 請求項41記載の半導体集積回路実装基板であって、
前記熱遮断手段は、配線パターンを避けて半導体集積回路実装基板に設けられた複数の貫通ビアである半導体集積回路実装基板。 - 半導体集積回路の消費電力とパッケージ基板上の配線パターンに基づいて表面温度をシミュレートする温度シミュレーション手段と、
前記表面温度に基づいて前記パッケージ基板上で等熱線を描画する等熱線描画手段と、
前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する熱伝導ベクトル算出手段とを含み、
半導体集積回路システムの熱解析を行う半導体集積回路システムの設計装置。 - 物体の表面温度をシミュレートする工程と、
前記表面温度に基づいて等熱線を描画する工程と、
前記等熱線に基づき、熱伝導速度と大きさとを示す熱伝導ベクトルを算出する工程とを含む物体の熱解析方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006283098A JP2008102631A (ja) | 2006-10-17 | 2006-10-17 | 半導体集積回路システムの設計方法、半導体集積回路実装基板の設計方法、パッケージの設計方法、半導体集積回路の設計方法、半導体集積回路システムの設計装置、半導体集積回路システム、半導体集積回路実装基板、パッケージ、および半導体集積回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006283098A JP2008102631A (ja) | 2006-10-17 | 2006-10-17 | 半導体集積回路システムの設計方法、半導体集積回路実装基板の設計方法、パッケージの設計方法、半導体集積回路の設計方法、半導体集積回路システムの設計装置、半導体集積回路システム、半導体集積回路実装基板、パッケージ、および半導体集積回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2008102631A true JP2008102631A (ja) | 2008-05-01 |
Family
ID=39436932
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006283098A Withdrawn JP2008102631A (ja) | 2006-10-17 | 2006-10-17 | 半導体集積回路システムの設計方法、半導体集積回路実装基板の設計方法、パッケージの設計方法、半導体集積回路の設計方法、半導体集積回路システムの設計装置、半導体集積回路システム、半導体集積回路実装基板、パッケージ、および半導体集積回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2008102631A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101134440B1 (ko) | 2011-04-14 | 2012-04-09 | 한국과학기술원 | 집적 회로의 온도 예측 방법 및 이를 이용한 집적 회로의 플로어플래닝 방법 |
JP2017010248A (ja) * | 2015-06-22 | 2017-01-12 | 株式会社デンソー | 電子機器の熱解析方法、及び熱解析装置 |
CN113155313A (zh) * | 2021-03-16 | 2021-07-23 | 中国电子科技集团公司第二十九研究所 | 一种扇出型封装温度分布原位模拟结构及方法 |
WO2023080222A1 (ja) * | 2021-11-08 | 2023-05-11 | 株式会社レゾナック | プログラム、提案装置及び提案方法 |
CN116544153A (zh) * | 2023-07-06 | 2023-08-04 | 成都汉芯国科集成技术有限公司 | 一种具有散热互联功能的3d封装***及其封装方法 |
-
2006
- 2006-10-17 JP JP2006283098A patent/JP2008102631A/ja not_active Withdrawn
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101134440B1 (ko) | 2011-04-14 | 2012-04-09 | 한국과학기술원 | 집적 회로의 온도 예측 방법 및 이를 이용한 집적 회로의 플로어플래닝 방법 |
JP2017010248A (ja) * | 2015-06-22 | 2017-01-12 | 株式会社デンソー | 電子機器の熱解析方法、及び熱解析装置 |
CN113155313A (zh) * | 2021-03-16 | 2021-07-23 | 中国电子科技集团公司第二十九研究所 | 一种扇出型封装温度分布原位模拟结构及方法 |
CN113155313B (zh) * | 2021-03-16 | 2023-04-07 | 中国电子科技集团公司第二十九研究所 | 一种扇出型封装温度分布原位模拟结构及方法 |
WO2023080222A1 (ja) * | 2021-11-08 | 2023-05-11 | 株式会社レゾナック | プログラム、提案装置及び提案方法 |
JP7302762B1 (ja) * | 2021-11-08 | 2023-07-04 | 株式会社レゾナック | プログラム、提案装置及び提案方法 |
CN116544153A (zh) * | 2023-07-06 | 2023-08-04 | 成都汉芯国科集成技术有限公司 | 一种具有散热互联功能的3d封装***及其封装方法 |
CN116544153B (zh) * | 2023-07-06 | 2023-09-01 | 成都汉芯国科集成技术有限公司 | 一种具有散热互联功能的3d封装***及其封装方法 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US11004780B2 (en) | Hard macro having blockage sites, integrated circuit including same and method of routing through a hard macro | |
US6304450B1 (en) | Inter-circuit encapsulated packaging | |
TWI773401B (zh) | 版圖設計的方法和積體電路、運算晶片和計算設備 | |
Cong et al. | Thermal-driven multilevel routing for 3-D ICs | |
KR20150121244A (ko) | 무선 주파수 멀티-칩 집적 회로 패키지들을 위한 전자기 간섭 인클로저 | |
Shang et al. | Thermal-reliable 3D clock-tree synthesis considering nonlinear electrical-thermal-coupled TSV model | |
US20160259877A1 (en) | Method and Apparatus of a Three Dimensional Integrated Circuit | |
US20200151382A1 (en) | Method for making a semiconductor device | |
JP2008102631A (ja) | 半導体集積回路システムの設計方法、半導体集積回路実装基板の設計方法、パッケージの設計方法、半導体集積回路の設計方法、半導体集積回路システムの設計装置、半導体集積回路システム、半導体集積回路実装基板、パッケージ、および半導体集積回路 | |
CN107924994A (zh) | 用于存储器器件的金属化工艺 | |
Ni et al. | Temperature-aware floorplanning for fixed-outline 3D ICs | |
Heinig et al. | Thermal analysis and optimization of 2.5 D and 3D integrated systems with wide I/O memory | |
Chao et al. | Thermal placement for high-performance multichip modules | |
JP2004259967A (ja) | 半導体集積回路及び半導体集積回路の設計方法 | |
Monier-Vinard et al. | Delphi style compact modeling by means of genetic algorithms of system in Package devices using composite sub-compact thermal models dedicated to model order reduction | |
Fischbach et al. | From 3D circuit technologies and data structures to interconnect prediction | |
Lee et al. | Hierarchical placement for power hybrid circuits under reliability and wireability constraints | |
Wang et al. | Effectiveness of thermal redistribution layer in cooling of 3D ICs | |
CN108733869B (zh) | 一种大规模三维集成电路分区方法和装置 | |
Nakayama et al. | Thermal characterization of high-density interconnects: A methodolgy tested on a model coupon | |
Cho et al. | Thermal Aware 3-D Floorplanning on Multi-stacked Board of Smart Phone | |
Iwata et al. | An efficient thermal design method based on boundary condition modeling | |
Wong et al. | Multi-objective module placement for 3-D system-on-package | |
US10141297B1 (en) | Integrated device comprising device level cells with variable sizes for heat dissipation around hotspots | |
Mehdipour et al. | A thermal-aware mapping algorithm for reducing peak temperature of an accelerator deployed in a 3D stack |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20091013 |
|
A761 | Written withdrawal of application |
Free format text: JAPANESE INTERMEDIATE CODE: A761 Effective date: 20110722 |