JP2007233730A - Three-dimensional graphic drawing device - Google Patents

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晃 鳥居
Yoshiyuki Kato
義幸 加藤
Hiroshi Onishi
宏 大西
Ryohei Ishida
良平 石田
Masaki Hamada
雅樹 濱田
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a three-dimensional graphic drawing device for operating with low power consumption by controlling a clock signal. <P>SOLUTION: A clock control means detects the termination of the processing of one polygon or one pixel in each processing means in a geometry processing means and a rendering processing means by a busy signal from each processing means in the geometry processing means and the rendering processing means, and supplies a clock signal to each processing means in the geometry processing means and the rendering processing means for successive operation, thus eliminating simultaneous operation by the duplicate input of clock signals by a plurality of processing means. <P>COPYRIGHT: (C)2007,JPO&INPIT

Description

この発明は、動作時の消費電力を抑制する三次元グラフィック描画装置に関するものである。   The present invention relates to a three-dimensional graphic drawing apparatus that suppresses power consumption during operation.

三次元グラフィック描画処理は大きくジオメトリ処理とレンダリング処理に大別することができる。ジオメトリ処理とレンダリング処理の各処理をパイプライン処理により高速化を図る技術が公知になっている。(例えば、非特許文献1)。   Three-dimensional graphic drawing processing can be roughly divided into geometry processing and rendering processing. A technique for speeding up each processing of the geometry processing and the rendering processing by pipeline processing is known. (For example, Non-Patent Document 1).

また、三次元グラフィック描画装置の消費電力を低減させるための方法として、描画処理が非実行状態の時にクロック信号の供給を停止することにより消費電力の低減を図る方法がある(例えば、特許文献1)。
また、三次元グラフィック描画装置の消費電力を低減させるための別の方法として、ジオメトリ処理部とレンダリング処理部へ交互にクロック信号を供給して交互に動作させることにより消費電力の低減を図る方法がある(例えば、特許文献2)。
Further, as a method for reducing the power consumption of the three-dimensional graphic drawing apparatus, there is a method for reducing the power consumption by stopping the supply of the clock signal when the drawing process is not executed (for example, Patent Document 1). ).
As another method for reducing the power consumption of the three-dimensional graphic drawing apparatus, there is a method of reducing power consumption by alternately supplying clock signals to the geometry processing unit and the rendering processing unit and operating them. There is (for example, Patent Document 2).

特開2000-285227号公報JP 2000-285227 A 特開2003-271986号公報JP 2003-271986 Tomas Moller, Eric Haines共著「Real-Time Rendering」A K Peters, Ltd., 1999年,P7〜21`` Real-Time Rendering '' by Tomas Moller and Eric Haines, A K Peters, Ltd., 1999, P7-21

三次元グラフィック描画装置を携帯機器に搭載する場合には低消費電力であることが要求される。
従来の特許文献1による消費電力低減の方法は、三次元グラフィック描画装置が動作していない間は消費電力を低減することができるが、三次元グラフィック描画装置が動作しているときには、当該装置を構成する全ての処理部にクロック信号が供給されるため、動作中の消費電力を低減することはできないという課題があった。
When the three-dimensional graphic drawing apparatus is mounted on a portable device, low power consumption is required.
The conventional method for reducing power consumption according to Patent Document 1 can reduce power consumption while the 3D graphic drawing apparatus is not operating. However, when the 3D graphic drawing apparatus is operating, Since a clock signal is supplied to all the processing units that constitute, there is a problem that power consumption during operation cannot be reduced.

特許文献2による消費電力低減の方法は、ジオメトリ処理部とレンダリング処理部を交互に動作させるため動作中消費電力を低減することができるが、キャッシュについては考慮されていなかった。例えば回路規模を削減するために内蔵メモリを使用せずに、レンダリング処理部内にテクスチャキャッシュやピクセルキャッシュを有する構成であった場合、キャッシュにミスヒットして外部メモリからデータを読み出す時にはデータの読出しが完了するまでの間は処理を行えないために待ち時間が発生し、無駄な電力を消費するという課題があった。   The method of reducing power consumption according to Patent Document 2 can reduce power consumption during operation because the geometry processing unit and the rendering processing unit are operated alternately, but cache is not considered. For example, when the rendering processing unit has a texture cache or pixel cache without using the built-in memory to reduce the circuit scale, the data is read when the cache is missed and data is read from the external memory. Since processing cannot be performed until completion, a waiting time occurs, and there is a problem that wasteful power is consumed.

この発明は上記のような課題を解決するためになされたものであり、クロック信号を制御することにより低消費電力で効率良く動作する三次元グラフィック描画装置を得ることを目的とする。   The present invention has been made to solve the above-described problems, and an object thereof is to obtain a three-dimensional graphic drawing apparatus that operates efficiently with low power consumption by controlling a clock signal.

この発明に係る三次元グラフィック描画装置は、
三次元データを入力してジオメトリ処理を行い頂点データを求めるジオメトリ処理手段と、異なる処理を行う複数の処理手段により構成され、前記ジオメトリ処理手段から出力された頂点データにレンダリング処理を行い画素データを生成するレンダリング処理手段と、前記ジオメトリ処理手段及び前記レンダリング処理手段内の各処理手段の動作をクロック信号によって制御するクロック制御手段を備え、
前記クロック制御手段は、前記ジオメトリ処理手段及び前記レンダリング処理手段内の各処理手段からのビジー信号により前記ジオメトリ処理手段及び前記レンダリング処理手段内の各処理手段における1ポリゴンまたは1ピクセルの処理の終了を検知し、前記ジオメトリ処理手段と前記レンダリング処理手段内の各処理手段とを1つずつ順次動作させるように各クロック信号を供給する構成にされる。
The three-dimensional graphic drawing apparatus according to the present invention is
Consists of a geometry processing means for inputting vertex data by performing 3D data processing to obtain vertex data, and a plurality of processing means for performing different processing. The vertex data output from the geometry processing means is subjected to rendering processing and pixel data A rendering processing means for generating, and a clock control means for controlling the operation of each processing means in the geometry processing means and the rendering processing means by a clock signal,
The clock control means finishes processing of one polygon or one pixel in each processing means in the geometry processing means and the rendering processing means by a busy signal from each processing means in the geometry processing means and the rendering processing means. Each clock signal is supplied so as to detect and sequentially operate the geometry processing means and each processing means in the rendering processing means one by one.

この発明によれば、クロック制御手段がジオメトリ処理手段及びレンダリング処理手段内の各処理手段からのビジー信号によりジオメトリ処理手段及びレンダリング処理手段内の各処理手段における1ポリゴンまたは1ピクセルの処理の終了を検知し、ジオメトリ処理手段及びレンダリング処理手段内の各処理手段をひとつずつ順次動作させることにより、複数の処理手段に同時にクロック信号が入力されることがなく、三次元グラフィック描画装置の処理動作中の消費電力が低減できるという効果がある。   According to this invention, the clock control means terminates the processing of one polygon or one pixel in each processing means in the geometry processing means and the rendering processing means by a busy signal from each processing means in the geometry processing means and the rendering processing means. By detecting and sequentially operating each processing means in the geometry processing means and the rendering processing means one by one, a clock signal is not simultaneously input to the plurality of processing means, and the processing operation of the three-dimensional graphic drawing apparatus is in progress. There is an effect that power consumption can be reduced.

実施の形態1.
図1は、この発明の実施の形態1による三次元グラフィック描画装置の構成を示すブロック図である。
図において、1は三次元グラフィック描画装置、2は三次元グラフィック描画装置1が外部のホストCPU(ホストコンピュータ)13とデータ送受信を行うときに使用するホストインタフェースである。
3はキャッシュと外部バスインタフェース9を介して外部メモリ12から三次元データを読み出して、当該三次元データが示す三次元シーンを構成するポリゴンの各頂点に幾何学処理を施し、二次元の画面に描画するための頂点データを求めるジオメトリ処理部(ジオメトリ処理手段)である。
4はジオメトリ処理部3から出力された頂点データを入力し、この頂点データから画素データを生成するレンダリング処理部(レンダリング処理手段)であり、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7、ピクセル処理部8から構成される。
Embodiment 1 FIG.
FIG. 1 is a block diagram showing a configuration of a three-dimensional graphic drawing apparatus according to Embodiment 1 of the present invention.
In the figure, reference numeral 1 denotes a three-dimensional graphic drawing apparatus, and 2 denotes a host interface used when the three-dimensional graphic drawing apparatus 1 performs data transmission / reception with an external host CPU (host computer) 13.
3 reads out the three-dimensional data from the external memory 12 via the cache and the external bus interface 9, performs geometric processing on each vertex of the polygon constituting the three-dimensional scene indicated by the three-dimensional data, and displays the two-dimensional screen. This is a geometry processing unit (geometry processing means) for obtaining vertex data for drawing.
A rendering processing unit (rendering processing unit) 4 receives the vertex data output from the geometry processing unit 3 and generates pixel data from the vertex data. The setup processing unit 5, the rasterization processing unit 6, and the texture processing unit 7 The pixel processing unit 8 is configured.

セットアップ処理部(セットアップ処理手段)5はジオメトリ処理部3から頂点データを入力し、この頂点データからラスタライズ処理に必要な増分値等のパラメータを求める。
ラスタライズ処理部(ラスタライズ処理手段)6はセットアップ処理部5で求められたパラメータに従って所定の補間を行い、ポリゴンを構成する画素データを順次生成する。
テクスチャ処理部(テクスチャ処理手段)7はラスタライズ処理部6によって生成された各画素データに対応させてテクスチャイメージの画素データを貼り付けるテクスチャマッピング処理等をおこなう。テクスチャイメージはキャッシュと外部バスインタフェース9を介して外部メモリ12から読み込みを行う。
A setup processing unit (setup processing means) 5 receives vertex data from the geometry processing unit 3 and obtains parameters such as an increment value necessary for rasterization processing from the vertex data.
A rasterization processing unit (rasterization processing means) 6 performs predetermined interpolation according to the parameters obtained by the setup processing unit 5 and sequentially generates pixel data constituting the polygon.
The texture processing unit (texture processing means) 7 performs a texture mapping process for pasting pixel data of a texture image in correspondence with each pixel data generated by the rasterization processing unit 6. The texture image is read from the external memory 12 via the cache and the external bus interface 9.

ピクセル処理部(ピクセル処理手段)8はテクスチャ処理部7から出力される画素データについて、奥行きを表すZ値を大小比較するデプステストやアルファ値を比較するアルファテスト等を行って当該画素データをフレームバッファへ書き込むか否かを判定するピクセルテスト処理と、既にフレームバッファに書き込まれているカラー値とピクセルテスト処理でフレームバッファに書き込む判定を行った画素データのカラー値とをブレンディングするピクセルブレンディング処理とを行って、フレームバッファへ書き込む画素データを生成する。
なお、フレームバッファは外部メモリ上12に存在し、ピクセル処理部8はキャッシュと外部バスインタフェース9を介してフレームバッファの読み書きを行う。
A pixel processing unit (pixel processing means) 8 performs a depth test for comparing the Z value representing the depth, an alpha test for comparing the alpha value, and the like on the pixel data output from the texture processing unit 7 to frame the pixel data. A pixel test process for determining whether or not to write to the buffer, and a pixel blending process for blending the color value already written to the frame buffer and the color value of the pixel data determined to be written to the frame buffer by the pixel test process; To generate pixel data to be written to the frame buffer.
Note that the frame buffer exists in the external memory 12, and the pixel processing unit 8 reads and writes the frame buffer via the cache and the external bus interface 9.

外部バスインタフェース9はジオメトリ処理部3、テクスチャ処理部7、ピクセル処理部8が夫々に設けられたキャッシュから外部メモリ12へアクセスする際に使用する。
10はジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7、ピクセル処理部8へ入力する各クロック信号を制御するクロック制御部(クロック制御手段)である。
11は三次元グラフィック描画装置1、外部メモリ12、CPU13等を接続するための外部バスである。
The external bus interface 9 is used when the geometry processing unit 3, the texture processing unit 7, and the pixel processing unit 8 access the external memory 12 from caches provided respectively.
A clock control unit (clock control unit) 10 controls each clock signal input to the geometry processing unit 3, the setup processing unit 5, the rasterization processing unit 6, the texture processing unit 7, and the pixel processing unit 8.
Reference numeral 11 denotes an external bus for connecting the three-dimensional graphic drawing apparatus 1, the external memory 12, the CPU 13, and the like.

また、CLK1はジオメトリ処理部3へ入力されるクロック信号、CLK2はセットアップ処理部5へ入力されるクロック信号、CLK3はラスタライズ処理部6へ入力されるクロック信号、CLK5はテクスチャ処理部7へ入力されるクロック信号、CLK6はピクセル処理部8へ入力されるクロック信号で、それぞれクロック制御部10から出力される。   CLK1 is a clock signal input to the geometry processing unit 3, CLK2 is a clock signal input to the setup processing unit 5, CLK3 is a clock signal input to the rasterization processing unit 6, and CLK5 is input to the texture processing unit 7. The clock signal CLK6 is a clock signal input to the pixel processing unit 8 and is output from the clock control unit 10, respectively.

また、BSY0はジオメトリ処理部3が1シーン分のポリゴンの処理を行っている最中であることを示すビジー信号で、ジオメトリ処理部3からクロック制御部10へ出力される。
BSY1はジオメトリ処理部3が1ポリゴンの処理を行っている最中であることを示すビジー信号で、ジオメトリ処理部3からクロック制御部10へ出力される。
BSY2はセットアップ処理部5が1ポリゴンの処理を行っている最中であることを示すビジー信号で、セットアップ処理部5からクロック制御部10へ出力される。
BSY3はラスタライズ処理部6が1ポリゴンの処理を行っている最中であることを示すビジー信号で、ラスタライズ処理部6からクロック制御部10へ出力される。
BSY4はラスタライズ処理部6が1ピクセルの処理を行っている最中であることを示すビジー信号で、ラスタライズ処理部6からクロック制御部10へ出力される。
BSY0 is a busy signal indicating that the geometry processing unit 3 is in the process of processing a polygon for one scene, and is output from the geometry processing unit 3 to the clock control unit 10.
BSY 1 is a busy signal indicating that the geometry processing unit 3 is currently processing one polygon, and is output from the geometry processing unit 3 to the clock control unit 10.
BSY2 is a busy signal indicating that the setup processing unit 5 is in the process of processing one polygon, and is output from the setup processing unit 5 to the clock control unit 10.
BSY3 is a busy signal indicating that the rasterizing processor 6 is in the process of processing one polygon, and is output from the rasterizing processor 6 to the clock controller 10.
BSY4 is a busy signal indicating that the rasterization processing unit 6 is in the process of processing one pixel, and is output from the rasterization processing unit 6 to the clock control unit 10.

BSY5はテクスチャ処理部7が1ピクセルの処理を行っている最中であることを示すビジー信号で、テクスチャ処理部7からクロック制御部10へ出力される。
BSY6はピクセル処理部8が1ピクセルの処理を行っている最中であることを示すビジー信号で、ピクセル処理部8からクロック制御部10へ出力される。
BSY5 is a busy signal indicating that the texture processing unit 7 is processing one pixel, and is output from the texture processing unit 7 to the clock control unit 10.
BSY 6 is a busy signal indicating that the pixel processing unit 8 is in the process of processing one pixel, and is output from the pixel processing unit 8 to the clock control unit 10.

また、MISS5はテクスチャ処理部7においてキャッシュのミスヒットが発生して外部メモリ12のデータを読み出している最中であることを示す信号で、外部バスインタフェース9からクロック制御部10へ出力される。
MISS6はピクセル処理部8においてキャッシュのミスヒットが発生して外部メモリ12のデータを読み出している最中であることを示す信号で、バスインタフェース9からクロック制御部10へ出力される。
MISS 5 is a signal indicating that a cache miss occurs in the texture processing unit 7 and the data in the external memory 12 is being read, and is output from the external bus interface 9 to the clock control unit 10.
MISS 6 is a signal indicating that a cache miss occurs in the pixel processing unit 8 and data is being read from the external memory 12, and is output from the bus interface 9 to the clock control unit 10.

次に動作について説明する。図2、図3および図4は、実施の形態1による三次元グラフィック描画装置の動作を示す説明図である。図1に示したクロック信号CLK1,CLK2,CLK4,CLK5,CLK6,ビジー信号BSY0,BSY1,BSY2,BSY3,BSY4、BSY5,BSY6,ミスヒット信号MISS5,MISS6のタイミングチャートを用いて、各部分の機能および動作を説明する。   Next, the operation will be described. 2, 3 and 4 are explanatory diagrams showing the operation of the three-dimensional graphic drawing apparatus according to the first embodiment. The function of each part is described using the timing chart of the clock signals CLK1, CLK2, CLK4, CLK5, CLK6, busy signals BSY0, BSY1, BSY2, BSY3, BSY4, BSY5, BSY6, and the miss hit signals MISS5, MISS6 shown in FIG. The operation will be described.

三次元グラフィック描画装置1の初期状態は、クロック制御部10がジオメトリ処理部3にクロック信号CLK1を供給し、セットアップ処理部5へのクロック信号CLK2とラスタライズ処理部6へのクロック信号CLK4とテクスチャ処理部7へのクロック信号CLK5とピクセル処理部8へのクロック信号CLK6の供給を停止している状態である。
また、ジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7、ピクセル処理部8から夫々出力されるビジー信号BSY0,BSY1,BSY2,BSY3,BSY4,BSY5,BSY6は全て“0”で、これらの処理部、また三次元グラフィック描画装置1が動作していないことを示している。
In the initial state of the three-dimensional graphic drawing apparatus 1, the clock control unit 10 supplies the clock signal CLK1 to the geometry processing unit 3, the clock signal CLK2 to the setup processing unit 5, the clock signal CLK4 to the rasterization processing unit 6, and texture processing. In this state, the supply of the clock signal CLK5 to the unit 7 and the clock signal CLK6 to the pixel processing unit 8 are stopped.
The busy signals BSY0, BSY1, BSY2, BSY3, BSY4, BSY5, and BSY6 output from the geometry processing unit 3, the setup processing unit 5, the rasterization processing unit 6, the texture processing unit 7, and the pixel processing unit 8 are all “0”. "Indicates that these processing units and the three-dimensional graphic drawing apparatus 1 are not operating.

三次元グラフィック描画処理を開始する際には、CPU13等によって外部メモリ12に三次元データが設定され、クロック制御部10からクロック信号CLK1の供給を開始させてジオメトリ処理部3を起動させる(図2のタイミングT20)。
起動したジオメトリ処理部3は、“1”を示すビジー信号BSY0,BSY1をクロック制御部10に出力する。また、外部バスインタフェース9を介して外部メモリ12から1ポリゴン分のデータを読み出して、当該データの1ポリゴンのジオメトリ処理を行い、その処理結果の頂点データをセットアップ処理部5へ出力し、“0”を示すビジー信号BSY1をクロック制御部10へ出力する。
When starting the three-dimensional graphic drawing process, three-dimensional data is set in the external memory 12 by the CPU 13 or the like, and the supply of the clock signal CLK1 from the clock control unit 10 is started to start the geometry processing unit 3 (FIG. 2). Timing T20).
The activated geometry processing unit 3 outputs busy signals BSY0 and BSY1 indicating “1” to the clock control unit 10. Also, data for one polygon is read from the external memory 12 via the external bus interface 9, geometry processing for one polygon of the data is performed, and vertex data as a result of the processing is output to the setup processing unit 5. The busy signal BSY1 indicating "" is output to the clock controller 10.

クロック制御部10は、ジオメトリ処理部3から出力されたビジー信号BSY1が“1”から“0”へ変化すると、ジオメトリ処理部3において1ポリゴンのデータ処理が終了したことを検知してジオメトリ処理部3へのクロック信号CLK1の供給を停止し、セットアップ処理部5へクロック信号CLK2の供給を開始してセットアップ処理部5を起動させる。ジオメトリ処理部3は、クロック信号CLK1の供給が停止されるとビジー信号BSY0を“1”に保持した状態のまま処理動作を停止する(図2のタイミングT21)。   When the busy signal BSY1 output from the geometry processing unit 3 changes from “1” to “0”, the clock control unit 10 detects that the data processing of one polygon has been completed in the geometry processing unit 3, and the geometry processing unit The supply of the clock signal CLK1 to 3 is stopped, the supply of the clock signal CLK2 to the setup processing unit 5 is started, and the setup processing unit 5 is activated. When the supply of the clock signal CLK1 is stopped, the geometry processing unit 3 stops the processing operation while keeping the busy signal BSY0 at “1” (timing T21 in FIG. 2).

起動したセットアップ処理部5は、“1”を示すビジー信号BSY2を出力してジオメトリ処理部3から出力されたポリゴンの頂点データのセットアップ処理を行い、処理結果のデータをラスタライズ処理部6へ出力してビジー信号BSY2を“0”にする。
クロック制御部10は、セットアップ処理部5から出力されたビジー信号BSY2が“1”から“0”へ変化すると、セットアップ処理部5の動作終了を検知し、セットアップ処理部5へのクロック信号CLK2の供給を停止し、ラスタライズ処理部6へクロック信号CLK4を供給してラスタライズ処理部を起動させる(図2のタイミングT22)。
The activated setup processing unit 5 outputs a busy signal BSY2 indicating “1”, performs setup processing of the vertex data of the polygon output from the geometry processing unit 3, and outputs processing result data to the rasterization processing unit 6. The busy signal BSY2 is set to “0”.
When the busy signal BSY2 output from the setup processing unit 5 changes from “1” to “0”, the clock control unit 10 detects the end of the operation of the setup processing unit 5 and the clock signal CLK2 to the setup processing unit 5 is detected. The supply is stopped, the clock signal CLK4 is supplied to the rasterization processing unit 6, and the rasterization processing unit is activated (timing T22 in FIG. 2).

起動したラスタライズ処理部6は、“1”を示すビジー信号BSY3,BSY4をクロック制御部10へ出力し、セットアップ処理部5から出力されたポリゴンのデータに基づいてラスタライズ処理を開始する。ラスタライズ処理によりポリゴンを構成する1ピクセルの処理が終了すると、ラスタライズ処理部6はその処理結果のピクセルデータをテクスチャ処理部7へ出力し、“0”を示すビジー信号BSY4をクロック制御部10へ出力する。   The activated rasterization processing unit 6 outputs busy signals BSY3 and BSY4 indicating “1” to the clock control unit 10, and starts rasterization processing based on the polygon data output from the setup processing unit 5. When the processing of one pixel constituting the polygon is completed by the rasterizing process, the rasterizing processing unit 6 outputs the pixel data of the processing result to the texture processing unit 7 and outputs the busy signal BSY4 indicating “0” to the clock control unit 10. To do.

クロック制御部10は、ラスタライズ処理部6から出力されたビジー信号BSY4が“1”から“0”へ変化すると、ラスタライズ処理部6において1ピクセルのデータ処理が終了したことを検知してラスタライズ処理部6へのクロック信号CLK4の供給を停止し、テクスチャ処理部7へクロック信号CLK5の供給を開始してテクスチャ処理部7を起動させる。ラスタライズ処理部6は、クロック信号CLK4の供給が停止されるとビジー信号BSY3を“1”に保持した状態のまま処理動作を停止する(図2に示すタイミングT23)。   When the busy signal BSY4 output from the rasterization processing unit 6 changes from “1” to “0”, the clock control unit 10 detects that the data processing of one pixel has been completed in the rasterization processing unit 6, and the rasterization processing unit The supply of the clock signal CLK4 to 6 is stopped, the supply of the clock signal CLK5 to the texture processing unit 7 is started, and the texture processing unit 7 is activated. When the supply of the clock signal CLK4 is stopped, the rasterization processing unit 6 stops the processing operation while keeping the busy signal BSY3 at “1” (timing T23 shown in FIG. 2).

起動したテクスチャ処理部7は、“1”を示すビジー信号BSY5をクロック制御部10へ出力し、ラスタライズ処理部6から出力されたピクセルデータに基づいてテクスチャ処理を行う。参照するテクスチャデータがキャッシュ内に存在する場合には、そのテクスチャデータを使用してテクスチャ処理を行い、処理結果のピクセルデータをピクセル処理部8へ出力し、“0”を示すビジー信号BSY5をクロック制御部10へ出力する。
参照するテクスチャデータがキャッシュ内に存在しない場合、すなわちキャッシュでミスヒットが発生した場合の処理については後述する。
The activated texture processing unit 7 outputs a busy signal BSY5 indicating “1” to the clock control unit 10, and performs texture processing based on the pixel data output from the rasterization processing unit 6. If the texture data to be referred to exists in the cache, the texture processing is performed using the texture data, the pixel data of the processing result is output to the pixel processing unit 8, and the busy signal BSY5 indicating “0” is clocked. Output to the control unit 10.
Processing when the texture data to be referenced does not exist in the cache, that is, when a miss occurs in the cache will be described later.

クロック制御部10は、テクスチャ処理部7から出力されたビジー信号BSY5が“1”から“0”へ変化すると、テクスチャ処理部7において1ピクセルのデータ処理が終了したことを検知してテクスチャ処理部7へのクロック信号CLK5の供給を停止し、ピクセル処理部8へクロック信号CLK6の供給を開始してピクセル処理部8を起動させる(図2のタイミングT24)。   When the busy signal BSY5 output from the texture processing unit 7 changes from “1” to “0”, the clock control unit 10 detects that the data processing for one pixel has been completed in the texture processing unit 7, and the texture processing unit 7 is stopped, the supply of the clock signal CLK6 to the pixel processing unit 8 is started, and the pixel processing unit 8 is activated (timing T24 in FIG. 2).

起動したピクセル処理部8は、“1”を示すビジー信号BSY6をクロック制御部10へ出力し、テクスチャ処理部7から出力されたピクセルデータに基づいてピクセル処理を行う。ピクセル処理においては、ピクセルの前後関係を比較するためのデプステストやカラー値のブレンディング処理等のために、既にフレームバッファに描画されているピクセルデータが必要となる。参照するピクセルデータがキャッシュ内に存在する場合には、そのピクセルデータを使用してピクセル処理を行い、処理結果のピクセルデータを外部バスインタフェース9を介して外部メモリ12内にあるフレームバッファへ送って描画を行い、“0”を示すビジー信号BSY6をクロック制御部10へ出力する。
参照するピクセルデータがキャッシュ内に存在しない場合、すなわちキャッシュでミスヒットが発生した場合の処理については後述する。
以上の一連の処理により1ピクセルの処理が完了する。
The activated pixel processing unit 8 outputs a busy signal BSY6 indicating “1” to the clock control unit 10, and performs pixel processing based on the pixel data output from the texture processing unit 7. In pixel processing, pixel data already drawn in a frame buffer is required for a depth test for comparing the context of pixels, a blending process of color values, and the like. If the pixel data to be referenced exists in the cache, the pixel processing is performed using the pixel data, and the pixel data obtained as a result of processing is sent to the frame buffer in the external memory 12 via the external bus interface 9. Drawing is performed, and a busy signal BSY 6 indicating “0” is output to the clock control unit 10.
Processing when the pixel data to be referenced does not exist in the cache, that is, when a miss occurs in the cache will be described later.
One pixel processing is completed by the above series of processing.

クロック制御部10は、ピクセル処理部8から出力されたビジー信号BSY6が“1”から“0”へ変化すると、ピクセル処理部8において1ピクセルのデータ処理が終了したことを検知してテクスチャ処理部8へのクロック信号CLK5の供給を停止する。
そして、ラスタライズ処理部6から出力されているビジー信号BSY3が“1”であれば、ラスタライズ処理部6においてまだ処理すべきピクセルが残っていることを示しているので、ラスタライズ処理部6へのクロック信号CLK4を供給し、ラスタライズ処理部6の動作を再開させる(図2のタイミングT25)。
When the busy signal BSY6 output from the pixel processing unit 8 changes from “1” to “0”, the clock control unit 10 detects that the data processing for one pixel has been completed in the pixel processing unit 8, and the texture processing unit The supply of the clock signal CLK5 to 8 is stopped.
If the busy signal BSY3 output from the rasterization processing unit 6 is “1”, this indicates that there are still pixels to be processed in the rasterization processing unit 6, and therefore the clock to the rasterization processing unit 6 The signal CLK4 is supplied, and the operation of the rasterization processing unit 6 is restarted (timing T25 in FIG. 2).

以降、ラスタライズ処理部6、テクスチャ処理部7、ピクセル処理部8において順次1ピクセルずつ処理を行う。ラスタライズ処理部6はポリゴンを構成する全てのピクセルの処理が終了したら“0”を示すビジー信号BSY3をクロック制御部へ出力する(図2のタイミングT26)。   Thereafter, the rasterization processing unit 6, the texture processing unit 7, and the pixel processing unit 8 sequentially process one pixel at a time. The rasterization processing unit 6 outputs a busy signal BSY3 indicating “0” to the clock control unit when processing of all the pixels constituting the polygon is completed (timing T26 in FIG. 2).

クロック制御部10は、ピクセル処理部8の動作が終了したときに、ラスタライズ処理部6から出力されているビジー信号BSY3が“0”、かつジオメトリ処理部3から出力されているビジー信号BSY0が“1”であれば、ジオメトリ処理部3においてまだ処理すべきポリゴンがあることを示しているので、ジオメトリ処理部3へクロック信号CLK1を供給し、ジオメトリ処理部3の動作を再開させる(図2のタイミングT27)。   When the operation of the pixel processing unit 8 ends, the clock control unit 10 determines that the busy signal BSY3 output from the rasterization processing unit 6 is “0” and the busy signal BSY0 output from the geometry processing unit 3 is “ If it is 1 ″, this means that there is still a polygon to be processed in the geometry processing unit 3, and therefore the clock signal CLK1 is supplied to the geometry processing unit 3 to restart the operation of the geometry processing unit 3 (FIG. 2). Timing T27).

以降、ジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7、ピクセル処理部8において順次1ポリゴンまたは1ピクセルずつ処理を行う。ジオメトリ処理部3は1シーンを構成する全てのポリゴンの処理が終了したら“0”を示すビジー信号BSY3をクロック制御部へ出力する(図2のタイミングT28)。
各処理部から出力されるすべてのビジー信号のORをとったものが“0” (図2のタイミングT29)になれば、1シーンの描画処理が終了したことを意味し、この後、適宜、外部メモリ12内のフレームバッファに格納されている画素データが図示しない表示装置に読み出されて、三次元データに基づく画像表示が行われる。
Thereafter, the polygon processing unit 3, the setup processing unit 5, the rasterization processing unit 6, the texture processing unit 7, and the pixel processing unit 8 sequentially process one polygon or one pixel at a time. The geometry processing unit 3 outputs a busy signal BSY3 indicating “0” to the clock control unit when processing of all the polygons constituting one scene is completed (timing T28 in FIG. 2).
If the result of ORing all the busy signals output from each processing unit is “0” (timing T29 in FIG. 2), it means that the drawing process of one scene has been completed. Pixel data stored in the frame buffer in the external memory 12 is read out to a display device (not shown), and image display based on the three-dimensional data is performed.

次にキャッシュのミスヒットが起こった場合の動作について説明する。
テクスチャ処理部7において参照するテクスチャデータがテクスチャ処理部7のキャッシュ内に存在しない場合には外部メモリ12から読み出す必要があるため、外部バスインタフェース9に対して必要なテクスチャデータの読出しを要求する。
外部バスインタフェース9はテクスチャ処理部7からデータ読出しの要求があると外部バス11を介して外部メモリ12からテクスチャデータの読出しを開始すると共に、テクスチャ処理部7がキャッシュでミスヒットしてデータの読出しを行っている最中であることを示すミスヒット信号MISS5を“1”としてクロック制御部10へ出力する。
Next, the operation when a cache miss occurs will be described.
When the texture data to be referred to in the texture processing unit 7 does not exist in the cache of the texture processing unit 7, it is necessary to read from the external memory 12.
When the external bus interface 9 receives a data read request from the texture processing unit 7, the external bus interface 9 starts reading the texture data from the external memory 12 via the external bus 11, and the texture processing unit 7 reads the data due to a cache miss. Is output to the clock control unit 10 as “1”.

クロック制御部10は、ミスヒット信号MISS5が“0”から“1”へ変化すると、テクスチャ処理部7でキャッシュのミスヒットが発生しデータ待ちのため処理が一時停止していることを検知し、テクスチャ処理部7へのクロック信号CLK5の供給を停止する。そして、次に動作できる処理部を探し、その処理部へクロック信号を供給する。
この時に、ラスタライズ処理部6からのビジー信号BSY3が“1”であれば、ラスタライズ処理部6にまだ処理すべきピクセルが残っていることを示しているので、クロック制御部10はラスタライズ処理部6へクロック信号CLK4を供給し、次のピクセルの処理を開始させる(図3のタイミングT30、T34)。
When the miss hit signal MISS5 changes from “0” to “1”, the clock control unit 10 detects that a cache miss occurs in the texture processing unit 7 and the processing is temporarily stopped due to data waiting. The supply of the clock signal CLK5 to the texture processing unit 7 is stopped. Then, the processor that can operate next is searched for and a clock signal is supplied to the processor.
At this time, if the busy signal BSY3 from the rasterization processing unit 6 is “1”, this means that there are still pixels to be processed in the rasterization processing unit 6, and therefore the clock control unit 10 uses the rasterization processing unit 6. Is supplied with the clock signal CLK4 to start processing the next pixel (timing T30, T34 in FIG. 3).

ラスタライズ処理部6は、外部バスインタフェース9がデータの読出しを行っている間に次のピクセルのラスタライズ処理を行う。ここで、例えば図3のタイミングT35のように外部バスインタフェース9のテクスチャデータの読出しが終わらないうちにラスタライズ処理部6において次のピクセルのラスタライズ処理が終了した場合は、テクスチャ処理部7が次のデータを受け取れないのでラスタライズ処理部6はデータを出力することができず、テクスチャ処理部7の動作の終了を待つこととなる。   The rasterization processing unit 6 performs rasterization processing for the next pixel while the external bus interface 9 is reading data. Here, for example, when the rasterization processing of the next pixel is completed in the rasterization processing unit 6 before the reading of the texture data of the external bus interface 9 is completed as shown at timing T35 in FIG. 3, the texture processing unit 7 Since the data cannot be received, the rasterization processing unit 6 cannot output the data and waits for the operation of the texture processing unit 7 to end.

外部バスインタフェース9は、テクスチャ処理部7からの要求によるテクスチャデータの読出しが終了すると、読み出したデータをテクスチャ処理部7へ出力すると共にミスヒット信号MISS5を“0”としてクロック制御部へ出力する。
クロック制御部10は、ミスヒット信号MISS5が“1”から“0”へ変化すると、テクスチャ処理部7が必要とするテクスチャデータの読出しが終了したことを検知し、テクスチャ処理部7へのクロック信号CLK5を供給し、動作を再開させる。また、同時にそれまでクロックを供給していたラスタライズ処理部6へのクロック信号CLK4の供給を停止し、動作を停止させる(図3のタイミング31、36)。
When the external bus interface 9 finishes reading the texture data in response to the request from the texture processing unit 7, the external bus interface 9 outputs the read data to the texture processing unit 7 and outputs the mishit signal MISS 5 to “0” to the clock control unit.
When the mis-hit signal MISS5 changes from “1” to “0”, the clock control unit 10 detects that the texture data required by the texture processing unit 7 has been read, and the clock signal to the texture processing unit 7 Supply CLK5 and resume operation. At the same time, the supply of the clock signal CLK4 to the rasterization processing unit 6 that has been supplying the clock is stopped and the operation is stopped (timing 31 and 36 in FIG. 3).

動作を再開したテクスチャ処理部7は、外部バスインタフェース9より読み出したテクスチャデータを使用してテクスチャ処理を行い、処理結果のピクセルデータをピクセル処理部8へ出力し、“0”を示すビジー信号BSY5をクロック制御部10へ出力する(図3のタイミング32、37)。すると、クロック制御部10がテクスチャ処理部7へのクロック信号CLK5の供給を停止し、ピクセル処理部8へのクロック信号CLK6を供給してピクセル処理部を起動させる。この処理は、前述したテクスチャ処理部7においてキャッシュのミスヒットが起こらなかった場合と同様である。   The texture processing unit 7 that has resumed the operation performs texture processing using the texture data read from the external bus interface 9, outputs the pixel data of the processing result to the pixel processing unit 8, and a busy signal BSY 5 indicating “0”. Is output to the clock controller 10 (timing 32, 37 in FIG. 3). Then, the clock control unit 10 stops supplying the clock signal CLK5 to the texture processing unit 7, supplies the clock signal CLK6 to the pixel processing unit 8, and starts the pixel processing unit. This process is the same as the case where no cache miss hit has occurred in the texture processing unit 7 described above.

その後、ピクセル処理部8の処理が終了すると、ビジー信号BSY3が“1”であり、ラスタライズ処理部6が処理の途中であることを表しているので、クロック制御部10はラスタライズ処理部6へのクロック信号CLK4を供給する(図3のタイミングT33,T38)。
ラスタライズ処理部6は次のピクセルの処理が途中で停止していた場合には残りの処理を行う。次のピクセルの処理が既に終了している場合にはすぐに処理結果をテクスチャ処理部へ出力する(図3のタイミングT38)。
そして、再びテクスチャ処理部7が起動され、入力されたピクセルに対してテクスチャ処理を行う。
Thereafter, when the processing of the pixel processing unit 8 is completed, the busy signal BSY3 is “1”, indicating that the rasterization processing unit 6 is in the process of processing. The clock signal CLK4 is supplied (timing T33, T38 in FIG. 3).
The rasterization processing unit 6 performs the remaining processing when processing of the next pixel is stopped halfway. If the processing for the next pixel has already been completed, the processing result is immediately output to the texture processing unit (timing T38 in FIG. 3).
Then, the texture processing unit 7 is activated again, and texture processing is performed on the input pixels.

クロック制御部10は、ミスヒット信号MISS5が“0”から“1”へ変化したときに、ビジー信号BSY3が“0”で、BSY0が“1”であれば、ジオメトリ処理部3が次に動作できると判断し、ジオメトリ処理部3へのクロック信号CLK1を供給し、次のポリゴンのジオメトリ処理を開始させる(図4のタイミングT40,T42)。
ジオメトリ処理部3は、外部バスインタフェース9がテクスチャデータの読出しを行っている間に次のポリゴンのジオメトリ処理を行う。ここで、例えば図4のタイミングT43のように外部バスインタフェース9のテクスチャデータの読出しが終わらないうちにジオメトリ処理部3において次のポリゴンのジオメトリ処理が終了した場合には、セットアップ処理部5を起動し、次のポリゴンのセットアップ処理を開始させる。
When the miss control signal MISS5 changes from “0” to “1” and the busy signal BSY3 is “0” and BSY0 is “1”, the clock control unit 10 operates the geometry processing unit 3 next. When it is determined that it is possible, the clock signal CLK1 is supplied to the geometry processing unit 3 to start geometry processing for the next polygon (timing T40, T42 in FIG. 4).
The geometry processing unit 3 performs geometry processing for the next polygon while the external bus interface 9 is reading texture data. Here, when the geometry processing of the next polygon is completed in the geometry processing unit 3 before the reading of the texture data of the external bus interface 9 is completed, for example, at timing T43 in FIG. 4, the setup processing unit 5 is activated. Then, the setup process for the next polygon is started.

そして、クロック制御部10は、ミスヒット信号MISS5が“1”から“0”へ変化すると、テクスチャ処理部7へのクロック信号CLK5を供給し動作を再開させ、また、同時にそれまでクロックを供給していた処理部へのクロックの供給を停止する(図4のタイミング41,44)。
その後、キャッシュのミスヒットが起こらなかった場合と同様に処理を行い、ピクセル処理部8の処理が終了すると、クロック制御部10は次の処理部へクロック信号を供給する。ビジー信号BSY2が“1”であれば、セットアップ処理部5が処理の途中であることを表しているのでセットアップ処理部5へのクロック信号CLK2を供給し、ビジー信号BSY2が“0”かつBSY0が“1”であれば、ジオメトリ処理部3へのクロック信号CLK1を供給し、次のポリゴンの処理を開始させる(図4のタイミングT41,T45)。
When the mishit signal MISS5 changes from “1” to “0”, the clock control unit 10 supplies the clock signal CLK5 to the texture processing unit 7 to restart the operation, and at the same time supplies the clock until then. The supply of the clock to the processing unit that has been stopped is stopped (timing 41, 44 in FIG. 4).
Thereafter, processing is performed in the same way as when no cache miss hit occurs, and when the processing of the pixel processing unit 8 is completed, the clock control unit 10 supplies a clock signal to the next processing unit. If the busy signal BSY2 is "1", it means that the setup processing unit 5 is in the middle of processing, so the clock signal CLK2 is supplied to the setup processing unit 5, the busy signal BSY2 is "0" and BSY0 is If “1”, the clock signal CLK1 is supplied to the geometry processing unit 3 to start the processing of the next polygon (timing T41, T45 in FIG. 4).

以上のようにテクスチャ処理部7においてキャッシュのミスヒットが発生すると、クロック制御部10は、ジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6の中から次に動作できる処理部を探し、外部バスインタフェース9がテクスチャデータの読出しを行っている間に次の処理を行わせるように各クロック信号の制御を行う。   As described above, when a cache miss occurs in the texture processing unit 7, the clock control unit 10 searches the geometry processing unit 3, the setup processing unit 5, and the rasterization processing unit 6 for a processing unit that can operate next. Each clock signal is controlled so that the following processing is performed while the bus interface 9 reads texture data.

同様に、ピクセルキャッシュ8においてキャッシュのミスヒットが発生すると、クロック制御部10は、ジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7の中から次に動作できる処理部を判断し、外部バスインタフェース9がピクセルデータの読出しを行っている間に次の処理を行わせるように各クロック信号の制御を行う。
ピクセル処理部8は参照するピクセルデータがキャッシュ内に存在しない場合には外部バスインタフェース9に対して必要なピクセルデータの読出しを要求する。
Similarly, when a cache miss occurs in the pixel cache 8, the clock control unit 10 selects a processing unit that can operate next from the geometry processing unit 3, the setup processing unit 5, the rasterization processing unit 6, and the texture processing unit 7. Judgment is made, and each clock signal is controlled so that the following processing is performed while the external bus interface 9 reads pixel data.
The pixel processing unit 8 requests the external bus interface 9 to read out necessary pixel data when the pixel data to be referenced does not exist in the cache.

外部バスインタフェース9はピクセル処理部8からピクセルデータ読出しの要求があると外部バス11を介して外部メモリ12からピクセルデータの読出しを開始すると共に、ピクセル処理部8がキャッシュでミスヒットしてピクセルデータの読出しを行っている最中であることを示すミスヒット信号MISS6を“1”としてクロック制御部10へ出力する。
クロック制御部10は、ミスヒット信号MISS6が“0”から“1”へ変化すると、ピクセル処理部8でキャッシュのミスヒットが発生しピクセルデータ待ちのため処理が一時停止していることを検知し、ピクセル処理部8へのクロック信号CLK5の供給を停止する。そして、次に動作できる処理部を判断し、その処理部へクロック信号を供給する。
The external bus interface 9 starts reading pixel data from the external memory 12 via the external bus 11 when there is a request for reading pixel data from the pixel processing unit 8, and the pixel processing unit 8 misses the pixel data in the cache. Is output to the clock control unit 10 as “1”.
When the miss hit signal MISS6 changes from “0” to “1”, the clock control unit 10 detects that a cache miss occurs in the pixel processing unit 8 and the processing is paused because of waiting for pixel data. The supply of the clock signal CLK5 to the pixel processing unit 8 is stopped. Then, the processor that can operate next is determined, and a clock signal is supplied to the processor.

外部バスインタフェース9は、ピクセル処理部8からの要求によるピクセルデータの読出しが終了すると、読み出したピクセルデータをピクセル処理部8へ出力すると共にミスヒット信号MISS6を“0”としてクロック制御部10へ出力する。
クロック制御部10は、ミスヒット信号MISS6が“1”から“0”へ変化すると、ピクセル処理部8が必要とするピクセルデータの読出しが終了したことを検知し、ピクセル処理部8へのクロック信号CLK6を供給し、動作を再開させる。また、同時にそれまでクロックを供給していた他の処理部へのクロックの供給を停止し、動作を停止させる。
When the reading of the pixel data in response to the request from the pixel processing unit 8 is completed, the external bus interface 9 outputs the read pixel data to the pixel processing unit 8 and outputs the mishit signal MISS6 to “0” to the clock control unit 10. To do.
When the mis-hit signal MISS6 changes from “1” to “0”, the clock control unit 10 detects that reading of the pixel data required by the pixel processing unit 8 has been completed, and the clock signal to the pixel processing unit 8 is detected. CLK6 is supplied to resume the operation. At the same time, the clock supply to the other processing units that have been supplying the clock is stopped, and the operation is stopped.

動作を再開したピクセル処理部8は、外部バスインタフェース9より読み出したピクセルデータを使用してピクセル処理を行い、処理結果のピクセルデータを外部バスインタフェース9を介して外部メモリ12内にあるフレームバッファへ送信して描画を行い、“0”を示すビジー信号BSY6をクロック制御部10へ出力する。
クロック制御部10は、ピクセル処理部8から出力されたビジー信号BSY6が“1”から“0”へ変化すると、ピクセル処理部8の動作終了を検知し、ピクセル処理部8へのクロック信号CLK6の供給を停止し、次に動作させる処理部に対してクロック信号を供給する。
The pixel processing unit 8 that has resumed operation performs pixel processing using the pixel data read from the external bus interface 9, and sends the pixel data as a result of processing to a frame buffer in the external memory 12 via the external bus interface 9. Transmission is performed and drawing is performed, and a busy signal BSY 6 indicating “0” is output to the clock control unit 10.
When the busy signal BSY6 output from the pixel processing unit 8 changes from “1” to “0”, the clock control unit 10 detects the end of the operation of the pixel processing unit 8 and outputs the clock signal CLK6 to the pixel processing unit 8. The supply is stopped and a clock signal is supplied to the processing unit to be operated next.

クロック制御部10は、ピクセル処理部8でキャッシュがミスヒットした場合およびピクセル処理部8の動作が終了したときには、各処理部から出力されるビジー信号により、次に動作させる処理部を決定する。
・ ビジー信号BSY5が“1”であればテクスチャ処理部7へのクロック信号CLK 5を供給し、テクスチャ処理部7を動作させる。
・ ビジー信号BSY5が“0”かつBSY3“1”であればラスタライズ処理部6へ のクロック信号CLK3を供給し、ラスタライズ処理部6を動作させる。
・ ビジー信号BSY5,BSY3が“0”かつBSY2が“1”であればセットアッ プ処理部5へのクロック信号CLK2を供給し、セットアップ処理部5を動作させる。
・ ビジー信号BSY5,BSY3,BSY2が“0”かつBSY0が“1”であれば ジオメトリ処理部3へのクロック信号CLK1を供給し、ジオメトリ処理部3を動作 させる。
前記説明のジオメトリ処理、セットアップ処理、ラスタライズ処理、テクスチャ処理及びピクセル処理を順次繰り返して処理を続け、各処理部から出力されるすべてのビジー信号のORをとったものが“0”であれば1シーンの描画処理が終了する。
When a cache miss occurs in the pixel processing unit 8 or when the operation of the pixel processing unit 8 ends, the clock control unit 10 determines a processing unit to be operated next by a busy signal output from each processing unit.
If the busy signal BSY5 is “1”, the clock signal CLK5 is supplied to the texture processing unit 7 and the texture processing unit 7 is operated.
If the busy signal BSY5 is “0” and BSY3 “1”, the clock signal CLK3 is supplied to the rasterization processing unit 6 and the rasterization processing unit 6 is operated.
When the busy signals BSY5 and BSY3 are “0” and BSY2 is “1”, the clock signal CLK2 is supplied to the setup processing unit 5 to operate the setup processing unit 5.
If the busy signals BSY5, BSY3, BSY2 are “0” and BSY0 is “1”, the clock signal CLK1 is supplied to the geometry processing unit 3 and the geometry processing unit 3 is operated.
The above-described geometry processing, setup processing, rasterization processing, texture processing, and pixel processing are sequentially repeated to continue the processing. If the result of ORing all the busy signals output from each processing unit is “0”, 1 The scene drawing process ends.

以上のように、この実施の形態1によれば、ジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7及びピクセル処理部8をひとつずつ順次動作させることにより、複数の処理部に同時にクロック信号が入力されることがなく、三次元グラフィック描画装置1の処理動作中の消費電力が低減できるという効果がある。さらに、テクスチャ処理部7、ピクセル処理部8においてキャッシュのミスヒットが発生した場合に、外部メモリ12のデータを読み出している間に別の動作できる処理部を動作させることにより、三次元グラフィック描画装置1を効率よく動作させることができ、無駄な消費電力を削減することができるという効果がある。   As described above, according to the first embodiment, a plurality of processes are performed by sequentially operating the geometry processing unit 3, the setup processing unit 5, the rasterization processing unit 6, the texture processing unit 7, and the pixel processing unit 8 one by one. There is an effect that the clock signal is not simultaneously input to the unit, and the power consumption during the processing operation of the three-dimensional graphic drawing apparatus 1 can be reduced. Further, when a cache miss occurs in the texture processing unit 7 and the pixel processing unit 8, a three-dimensional graphic rendering apparatus is operated by operating another processing unit that can operate while reading data from the external memory 12. 1 can be operated efficiently, and wasteful power consumption can be reduced.

実施の形態2.
図5は、この発明の実施の形態2による三次元グラフィック描画装置の構成を示すブロック図である。図1に示した三次元グラフィック描画装置1と同一あるいは相当する部分に同じ符号を付し、その説明を省略する。
図において、14はジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7及びピクセル処理部8が共通して使用する演算部であり、乗算器や加減算器等の演算器により構成される。
ジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7及びピクセル処理部8の各処理部は、処理を行う際に演算部14に対して乗算や加減算などの演算の種類および演算の対象となるデータを出力する。演算部14は各処理ブロックに対し、演算結果を出力する。
また、SELはクロック制御部10が演算部14に対してどの処理部がからのデータを処理すべきかを指示する信号である。
Embodiment 2. FIG.
FIG. 5 is a block diagram showing a configuration of a three-dimensional graphic drawing apparatus according to Embodiment 2 of the present invention. The same or corresponding parts as those in the three-dimensional graphic drawing apparatus 1 shown in FIG.
In the figure, reference numeral 14 denotes an arithmetic unit commonly used by the geometry processing unit 3, the setup processing unit 5, the rasterization processing unit 6, the texture processing unit 7 and the pixel processing unit 8, and is calculated by an arithmetic unit such as a multiplier or an adder / subtractor. Composed.
The processing units of the geometry processing unit 3, the setup processing unit 5, the rasterization processing unit 6, the texture processing unit 7, and the pixel processing unit 8 perform the types of operations such as multiplication and addition / subtraction with respect to the operation unit 14 when performing processing. Outputs data to be operated on. The calculation unit 14 outputs a calculation result to each processing block.
SEL is a signal for instructing which processing unit should process data from the clock control unit 10 to the calculation unit 14.

次に動作について説明する。図6は、実施の形態2による三次元グラフィック描画装置の動作を示すタイミングチャートである。図6に示すように、クロック制御部10は演算部14に対してどの処理部からのデータを処理すべきかを指示する信号SELを出力する。図6では“1”はジオメトリ処理部3、“2”はセットアップ処理部5、“4”はラスタライズ処理部6、“5”はテクスチャ処理部7、“6”はピクセル処理部8からのデータをそれぞれ処理すべきであることを示している。演算部14はこのSEL信号により各処理部からのデータを選択し、演算を行い演算結果を各処理部へ出力する。
前記以外の動作は実施の形態1と同様であるので、その説明を省略する。
Next, the operation will be described. FIG. 6 is a timing chart showing the operation of the 3D graphic drawing apparatus according to the second embodiment. As shown in FIG. 6, the clock control unit 10 outputs a signal SEL that instructs the processing unit 14 from which processing unit data should be processed. In FIG. 6, "1" is the geometry processing unit 3, "2" is the setup processing unit 5, "4" is the rasterization processing unit 6, "5" is the texture processing unit 7, and "6" is the data from the pixel processing unit 8. Each should be processed. The calculation unit 14 selects data from each processing unit based on this SEL signal, performs calculation, and outputs the calculation result to each processing unit.
Since operations other than those described above are the same as those in the first embodiment, description thereof is omitted.

以上のように、この実施の形態2によれば、ジオメトリ処理部3、セットアップ処理部5、ラスタライズ処理部6、テクスチャ処理部7及びピクセル処理部8をひとつずつ順次動作させることにより、複数の処理部に同時にクロック信号が入力されることがなく、三次元グラフィック描画装置1の処理動作中の消費電力が低減できるという効果がある。また、テクスチャ処理部7、ピクセル処理部8においてキャッシュのミスヒットが発生した場合に、外部メモリ12のデータを読み出している間に別の動作できる処理部を動作させることにより、三次元グラフィック描画装置1を効率よく動作させることができ、無駄な消費電力を削減することができるという効果がある。さらに、各処理部が共通して使用する共有化の演算器を設けることにより、同時に複数の処理部が演算処理を実行するという誤動作を防止でき、なおかつ回路規模を削減することができるという効果がある。   As described above, according to the second embodiment, a plurality of processes are performed by sequentially operating the geometry processing unit 3, the setup processing unit 5, the rasterization processing unit 6, the texture processing unit 7, and the pixel processing unit 8 one by one. There is an effect that the clock signal is not simultaneously input to the unit, and the power consumption during the processing operation of the three-dimensional graphic drawing apparatus 1 can be reduced. In addition, when a cache miss occurs in the texture processing unit 7 and the pixel processing unit 8, a three-dimensional graphic rendering apparatus is operated by operating another processing unit that can operate while reading data in the external memory 12. 1 can be operated efficiently, and wasteful power consumption can be reduced. Furthermore, by providing a shared arithmetic unit that is used in common by each processing unit, it is possible to prevent malfunctions in which a plurality of processing units execute arithmetic processing at the same time, and to reduce the circuit scale. is there.

この発明による三次元グラフィック描画装置は、描画装置における複数の処理ブロックを夫々のクロック信号を制御することにより順番に動作させることで、低消費電力化が図れ、低消費電力化が要求される携帯電話機等の携帯機器用の3Dグラフィクスコアに適用されると特に効果がある。   The three-dimensional graphic drawing apparatus according to the present invention operates a plurality of processing blocks in the drawing apparatus in order by controlling their respective clock signals, thereby reducing power consumption and requiring portable power consumption to be reduced. It is particularly effective when applied to 3D graphics scores for portable devices such as telephones.

この発明の実施の形態1による三次元グラフィック描画装置の構成を示すブロック図である。It is a block diagram which shows the structure of the three-dimensional graphic drawing apparatus by Embodiment 1 of this invention. 実施の形態1による三次元グラフィック描画装置の描画処理動作の説明図である。6 is an explanatory diagram of a drawing processing operation of the three-dimensional graphic drawing apparatus according to Embodiment 1. FIG. テクスチャ処理部におけるキャッシュのミスヒットが起こった場合のラスタライズ処理部等の動作説明図である。FIG. 10 is an operation explanatory diagram of a rasterization processing unit and the like when a cache miss occurs in the texture processing unit. テクスチャ処理部におけるキャッシュのミスヒットが起こった場合のジオメトリ処理部等の動作説明図である。It is operation | movement explanatory drawing of a geometry process part etc. when the cache miss hits in a texture process part. この発明の実施の形態2による三次元グラフィック描画装置の構成を示すブロック図である。It is a block diagram which shows the structure of the three-dimensional graphic drawing apparatus by Embodiment 2 of this invention. 実施の形態2による三次元グラフィック描画装置の動作説明図である。FIG. 10 is an operation explanatory diagram of the three-dimensional graphic drawing apparatus according to the second embodiment.

符号の説明Explanation of symbols

1;三次元グラフィック描画装置、2;ホストインタフェース、3;ジオメトリ処理部(ジオメトリ処理手段)、4;レンダリング処理部(レンダリング処理手段)、5;セットアップ処理部(セットアップ処理手段)、6;ラスタライズ処理部(ラスタライズ処理手段)、7;テクスチャ処理部(テクスチャ処理手段)、8;ピクセル処理部(ピクセル処理手段)、9;外部バスインタフェース、10;クロック制御部(クロック制御手段)、11;外部バス、12;外部メモリ、13;CPU、14;演算部。 DESCRIPTION OF SYMBOLS 1; 3D graphic drawing apparatus, 2; Host interface, 3; Geometry processing part (geometry processing means), 4; Rendering processing part (rendering processing means), 5; Setup processing part (setup processing means), 6; Part (rasterization processing means), 7; texture processing part (texture processing means), 8; pixel processing part (pixel processing means), 9; external bus interface, 10; clock control part (clock control means), 11; external bus , 12; external memory, 13; CPU, 14; arithmetic unit.

Claims (4)

三次元データを入力してジオメトリ処理を行い頂点データを求めるジオメトリ処理手段と、異なる処理を行う複数の処理手段により構成され、前記ジオメトリ処理手段から出力された頂点データにレンダリング処理を行い画素データを生成するレンダリング処理手段と、前記ジオメトリ処理手段及び前記レンダリング処理手段内の各処理手段の動作をクロック信号によって制御するクロック制御手段を備える三次元グラフィック描画装置であって、
前記クロック制御手段は、前記ジオメトリ処理手段及び前記レンダリング処理手段内の各処理手段からのビジー信号により前記ジオメトリ処理手段及び前記レンダリング処理手段内の各処理手段における1ポリゴンまたは1ピクセルの処理の終了を検知し、前記ジオメトリ処理手段と前記レンダリング処理手段内の各処理手段とを1つずつ順次動作させるように各クロック信号を供給することを特徴とする三次元グラフィック描画装置。
Consists of a geometry processing means for inputting vertex data by performing 3D data processing to obtain vertex data, and a plurality of processing means for performing different processing. Rendering processing is performed on the vertex data output from the geometry processing means to obtain pixel data. A three-dimensional graphic drawing apparatus comprising: a rendering processing means to be generated; and a clock control means for controlling the operation of each processing means in the geometry processing means and the rendering processing means by a clock signal,
The clock control means finishes processing of one polygon or one pixel in each processing means in the geometry processing means and the rendering processing means by a busy signal from each processing means in the geometry processing means and the rendering processing means. 3. A three-dimensional graphic drawing apparatus that detects and supplies each clock signal so as to sequentially operate the geometry processing means and the processing means in the rendering processing means one by one.
前記レンダリング処理手段は、ジオメトリ処理手段から出力された一つのポリゴン分の頂点データにセットアップ処理を行うセットアップ処理手段と、前記セットアップ処理手段から出力されたデータにラスタライズ処理を行いピクセルを生成するラスタライズ処理手段と、前記ラスタライズ処理手段から出力されたピクセルに対しテクスチャの貼り付け処理を行うテクスチャ処理手段と、前記テクスチャ処理手段から出力されたピクセルを既に描画されているピクセルとの前後関係の比較やブレンドの処理を行いフレームバッファへ書き込みを行うピクセル処理手段とを備え、
前記クロック制御手段は、前記各処理手段からのビジー信号により前記各処理手段における1ポリゴンまたは1ピクセルの処理の終了を検知し、前記ジオメトリ処理手段と前記セットアップ処理手段と前記ラスタライズ処理手段と前記テクスチャ処理手段と前記ピクセル処理手段とを順次動作させるように各クロック信号を供給することを特徴とする請求項1記載の三次元グラフィック描画装置。
The rendering processing means includes setup processing means for performing setup processing on vertex data for one polygon output from the geometry processing means, and rasterization processing for generating pixels by performing rasterization processing on the data output from the setup processing means. Comparison and blending between the image processing unit, the texture processing unit that applies the texture to the pixel output from the rasterization processing unit, and the pixel output from the texture processing unit. Pixel processing means for performing the above processing and writing to the frame buffer,
The clock control means detects the end of processing of one polygon or one pixel in each processing means by a busy signal from each processing means, and the geometry processing means, the setup processing means, the rasterization processing means, and the texture 2. The three-dimensional graphic drawing apparatus according to claim 1, wherein each clock signal is supplied so as to sequentially operate the processing means and the pixel processing means.
前記テクスチャ処理手段および前記ピクセル処理手段はそれぞれキャッシュを備え、
前記クロック制御手段は、前記テクスチャ処理手段または前記ピクセル処理手段においてキャッシュのミスヒットが発生すると、該処理手段へのクロック信号の供給を停止し、前記テクスチャ処理手段または前記ピクセル処理手段が外部メモリからデータの読出しが終了するまでの間、次に動作可能な処理手段へクロック信号を供給して動作させ、外部メモリからのデータの読出しが終了したらクロック信号の供給を停止していた処理手段へ再びクロック信号を供給して動作を再開させる事を特徴とする請求項2記載の三次元グラフィック描画装置。
Each of the texture processing means and the pixel processing means includes a cache,
When a cache miss occurs in the texture processing unit or the pixel processing unit, the clock control unit stops supply of a clock signal to the processing unit, and the texture processing unit or the pixel processing unit is disconnected from an external memory. Until the data reading is finished, the clock signal is supplied to the next operable processing means to operate, and when the data reading from the external memory is finished, the clock signal supply is stopped again. 3. The three-dimensional graphic drawing apparatus according to claim 2, wherein the operation is resumed by supplying a clock signal.
前記ジオメトリ処理手段と前記レンダリング処理手段内の各処理手段が共有して使用する演算手段を備え、
前記クロック制御手段は、前記演算手段に対して前記ジオメトリ処理手段と前記レンダリング処理手段内の各処理手段の何れの処理手段からのデータを演算するかを指示することを特徴とする請求項1から3何れかに記載の三次元グラフィック描画装置。
Computation means used in common by each processing means in the geometry processing means and the rendering processing means,
The clock control means instructs the arithmetic means to calculate data from which of the processing means in the geometry processing means and the rendering processing means. 3. The three-dimensional graphic drawing apparatus according to any one of 3 above.
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009295162A (en) * 2008-06-04 2009-12-17 Arm Ltd Graphics processing system
JP2012177986A (en) * 2011-02-25 2012-09-13 Nec System Technologies Ltd Image plotting device, image plotting method and program
US10163238B2 (en) 2014-11-21 2018-12-25 Arm Limited Processing graphics primitives in a tile-based graphics processing system

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6125274A (en) * 1984-07-13 1986-02-04 Nec Corp Vector arithmetic processor
JPH05216762A (en) * 1992-02-04 1993-08-27 Fujitsu Ltd Cache control system
JPH05324141A (en) * 1992-05-22 1993-12-07 Sharp Corp Power controller for computer system
JP2003271986A (en) * 2002-03-14 2003-09-26 Mitsubishi Electric Corp Three-dimensional graphic drawing device
JP2004062280A (en) * 2002-07-25 2004-02-26 Hitachi Ltd Semiconductor integrated circuit

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6125274A (en) * 1984-07-13 1986-02-04 Nec Corp Vector arithmetic processor
JPH05216762A (en) * 1992-02-04 1993-08-27 Fujitsu Ltd Cache control system
JPH05324141A (en) * 1992-05-22 1993-12-07 Sharp Corp Power controller for computer system
JP2003271986A (en) * 2002-03-14 2003-09-26 Mitsubishi Electric Corp Three-dimensional graphic drawing device
JP2004062280A (en) * 2002-07-25 2004-02-26 Hitachi Ltd Semiconductor integrated circuit

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009295162A (en) * 2008-06-04 2009-12-17 Arm Ltd Graphics processing system
US8698828B2 (en) 2008-06-04 2014-04-15 Arm Limited Graphics processing systems
JP2012177986A (en) * 2011-02-25 2012-09-13 Nec System Technologies Ltd Image plotting device, image plotting method and program
US10163238B2 (en) 2014-11-21 2018-12-25 Arm Limited Processing graphics primitives in a tile-based graphics processing system

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