JP2006222470A - Semiconductor device and manufacturing method thereof - Google Patents
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Abstract
Description
本発明は、半導体装置およびその製造技術に関し、特に、複数の半導体チップを実装基板上に積層した半導体装置に適用して有効な技術に関する。 The present invention relates to a semiconductor device and a manufacturing technique thereof, and more particularly, to a technique effective when applied to a semiconductor device in which a plurality of semiconductor chips are stacked on a mounting substrate.
半導体装置の多機能化、高集積化および小型化を図ることを目的として、実装基板上に複数の半導体チップを三次元的に実装した積層パッケージが種々提案されている。 A variety of stacked packages in which a plurality of semiconductor chips are three-dimensionally mounted on a mounting substrate have been proposed for the purpose of achieving multi-functionality, high integration, and miniaturization of semiconductor devices.
また、メモリ製品等においては、同一の半導体チップを複数積層し、高集積化を図っているものもある。 Some memory products and the like have a plurality of identical semiconductor chips stacked to achieve high integration.
例えば、特開2003−78106号公報(特許文献1参照)の図1や特開平6−244360号公報(特許文献2参照)の図1には、同一サイズの半導体IC素子を積層したチップ積層型パッケージ素子およびその製造方法についての記載がある。
本発明者らは、一つのパッケージ内に複数個の半導体チップ(素子、ペレット)を積層したBGA(ball grid array)やCSP(chip size package)を開発している。 The present inventors have developed BGA (ball grid array) and CSP (chip size package) in which a plurality of semiconductor chips (elements, pellets) are stacked in one package.
実装基板上に半導体チップを搭載するためには接着材が用いられるが、半導体チップを複数積層する際に、接着不良が見られた。 An adhesive material is used to mount the semiconductor chip on the mounting substrate, but adhesion failure was observed when a plurality of semiconductor chips were stacked.
これは、実装基板上に半導体チップを搭載する際に、ペースト状の樹脂(接着材)を用いた場合、樹脂を硬化させるために熱処理が施される。この際、硬化温度から室温に戻る際に、実装基板(例えば、ガラス・エポキシ)と半導体チップ(例えばシリコン)が収縮し、これらの熱膨張係数(α)差に起因して、実装基板と半導体チップに反りが生じる。このように反った半導体チップ上にさらに半導体チップを積層しようとしても接着性を確保することが困難であり、また、半導体チップの剥がれや傾きの要因となることが判明した。なお、この問題点については、図14および図15を参照しながら追って詳細に説明する。 This is because when a semiconductor chip is mounted on a mounting substrate, when a paste-like resin (adhesive) is used, heat treatment is performed to cure the resin. At this time, when returning from the curing temperature to room temperature, the mounting substrate (for example, glass epoxy) and the semiconductor chip (for example, silicon) contract, and the mounting substrate and the semiconductor are caused by the difference in their thermal expansion coefficients (α). Warping occurs on the tip. It has been found that it is difficult to secure adhesiveness even if a semiconductor chip is further laminated on the warped semiconductor chip, and it causes peeling or tilting of the semiconductor chip. This problem will be described in detail later with reference to FIG. 14 and FIG.
そこで、本発明者らは、複数個の半導体チップを積層する際の接着材に着眼し、半導体装置の組立工程や積層する半導体チップの大きさなどを考慮しつつ、半導体チップの接着性を向上させる技術について検討した。 Accordingly, the present inventors have focused on adhesives when laminating a plurality of semiconductor chips, and improved the adhesion of the semiconductor chips while taking into account the assembly process of the semiconductor device and the size of the semiconductor chips to be laminated. We examined the technology to be used.
なお、本願発明者は、本願発明を完成した後に、先行技術調査を行い、上記特許文献1及び2を抽出した。上記特許文献1には、接着材として複数の材料が列挙されているが、個々の接着材の特性や半導体装置の組立段階毎の接着材の使い分けについては何ら記載されていない。
In addition, after completing this invention, this inventor conducted prior art investigation and extracted the said
また、本発明者らは、半導体チップの形状を工夫することにより、さらに小型化が図れ、また、工程の簡略化が図れる半導体装置の構造および製造方法について検討した。 Further, the present inventors have studied a structure and a manufacturing method of a semiconductor device that can be further miniaturized by devising the shape of the semiconductor chip and can simplify the process.
本発明の目的は、複数のチップを有する半導体装置の信頼性を向上することにある。 An object of the present invention is to improve the reliability of a semiconductor device having a plurality of chips.
本発明の他の目的は、複数の半導体チップを有する半導体装置の小型化もしくは高密度実装化を図ることにある。 Another object of the present invention is to achieve miniaturization or high-density mounting of a semiconductor device having a plurality of semiconductor chips.
本発明の前記ならびにその他の目的と新規な特徴は、本明細書の記述および添付図面から明らかになるであろう。 The above and other objects and novel features of the present invention will be apparent from the description of this specification and the accompanying drawings.
本願において開示される発明のうち、代表的なものの概要を簡単に説明すれば、次のとおりである。 Of the inventions disclosed in the present application, the outline of typical ones will be briefly described as follows.
すなわち、本発明の半導体装置の製造方法は、(a)実装基板上に第1接着材を介して第1半導体チップを搭載する工程と、(b)前記(a)工程の後、熱処理によって前記第1接着材を硬化させることにより前記実装基板上に前記第1半導体チップを固定する工程と、(c)前記(b)工程の後、前記第1半導体チップの上方に第2半導体チップを搭載する工程であって、前記実装基板および前記第1半導体チップに熱を加えることによって前記第1半導体チップの表面が前記熱を加える前より平坦となった状態で、前記第2半導体チップを第2接着材を介して接着する工程と、を有するものである。 That is, the method for manufacturing a semiconductor device of the present invention includes (a) a step of mounting a first semiconductor chip on a mounting substrate via a first adhesive, and (b) after the step (a), by heat treatment. A step of fixing the first semiconductor chip on the mounting substrate by curing the first adhesive material; and (c) mounting the second semiconductor chip above the first semiconductor chip after the step (b). And applying the heat to the mounting substrate and the first semiconductor chip so that the surface of the first semiconductor chip is flattened before the heat is applied. Adhering via an adhesive.
本発明の半導体装置は、実装基板上に少なくとも第1および第2の半導体チップが積層された半導体装置であって、(a)前記実装基板の直上に搭載された第1半導体チップは、主として熱硬化性を有する樹脂を介して固定され、(b)前記第1半導体チップの上方に搭載された第2半導体チップは、熱可塑性を有する樹脂を介して固定されているものである。 The semiconductor device of the present invention is a semiconductor device in which at least first and second semiconductor chips are stacked on a mounting substrate. (A) The first semiconductor chip mounted directly on the mounting substrate is mainly heated. The second semiconductor chip fixed via a curable resin and (b) mounted above the first semiconductor chip is fixed via a thermoplastic resin.
本発明の半導体装置の製造方法は、(a)実装基板上に主として熱硬化性を有する樹脂を介して、裏面の外周部に切り欠き部を有し、前記裏面の中央部が凸部である半導体チップを搭載する工程と、(b)前記(a)工程の後、熱処理によって前記樹脂を硬化させることにより前記実装基板上に前記半導体チップを固定する工程と、を有するものである。 In the method for manufacturing a semiconductor device of the present invention, (a) a mounting substrate has a notch in the outer peripheral portion of the back surface mainly through a thermosetting resin, and the central portion of the back surface is a convex portion. A step of mounting a semiconductor chip; and (b) a step of fixing the semiconductor chip on the mounting substrate by curing the resin by heat treatment after the step (a).
本発明の半導体装置は、(a)実装基板と、(b)前記実装基板上に搭載された半導体チップであって、裏面の外周部に切り欠き部を有し、前記裏面の中央部が凸部である半導体チップと、(c)前記実装基板と前記半導体チップとの間に形成された主として熱硬化性を有する樹脂と、を有するものである。 A semiconductor device according to the present invention includes (a) a mounting substrate, and (b) a semiconductor chip mounted on the mounting substrate, having a notch in the outer peripheral portion of the back surface, and the central portion of the back surface being convex. And (c) a resin having a mainly thermosetting property formed between the mounting substrate and the semiconductor chip.
本願において開示される発明のうち、代表的なものによって得られる効果を簡単に説明すれば以下のとおりである。 Among the inventions disclosed in the present application, effects obtained by typical ones will be briefly described as follows.
すなわち、複数のチップを有する半導体装置の信頼性を向上することができる。また、歩留まりを向上することができる。 That is, the reliability of a semiconductor device having a plurality of chips can be improved. In addition, the yield can be improved.
また、複数の半導体チップを有する半導体装置の小型化もしくは高密度実装化を図ることができる。 In addition, a semiconductor device having a plurality of semiconductor chips can be downsized or mounted with high density.
以下、本発明の実施の形態を図面に基づいて詳細に説明する。なお、実施の形態を説明するための全図において、同一の部材には同一の符号を付し、その繰り返しの説明は省略する。また、各実施の形態は相互に関連するものであり、各実施の形態において同一もしくは類似の部材には同一もしくは関連する符号を付し、その繰り返しの説明は省略する。また、各実施の形態において同一もしくは類似の構成を有する場合には、同一もしくは類似の効果を奏するものとし、その繰り返しの説明は省略する。 Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. Note that in all the drawings for describing the embodiments, the same members are denoted by the same reference numerals, and the repeated description thereof is omitted. Also, the embodiments are mutually related, and in each embodiment, the same or similar members are denoted by the same or related reference numerals, and the repeated description thereof is omitted. Further, when each embodiment has the same or similar configuration, the same or similar effect is obtained, and repeated description thereof is omitted.
(実施の形態1)
図1〜図13は、本実施の形態の半導体装置の製造工程を示す要部断面図である。
(Embodiment 1)
1 to 13 are main-portion cross-sectional views showing the manufacturing process of the semiconductor device of the present embodiment.
まず、本実施の形態の半導体装置の構成について説明する。なお、後述する本実施の形態の半導体装置の製造工程の説明において構造がより明確となるため、ここでは主要な構成についてのみ説明する。 First, the structure of the semiconductor device of this embodiment will be described. Note that since the structure becomes clearer in the description of the manufacturing process of the semiconductor device of the present embodiment described later, only the main configuration will be described here.
最終工程図である図13に示すように、本実施の形態の半導体装置は、実装基板(配線基板、パッケージ基板)1の主面上に、2個のほぼ同じ形状の半導体チップ3A、3Bが搭載されている。また、これらの間には、スペーサチップ5が配置され、半導体チップ3Aの外周部上に空間を確保し、ワイヤ11Aと半導体チップ3Bのショート(短絡)を防止している。例えば半導体チップ3A、3Bの厚さは50〜200μm程度で、スペーサチップ5の厚さは50〜200μm程度である。また、半導体チップ3Aの端部とスペーサチップ5の端部との距離D1は、200〜500μm程度である。
As shown in FIG. 13 which is a final process diagram, the semiconductor device of the present embodiment includes two
実装基板1は、例えば、ガラス繊維を含んだエポキシ樹脂(ガラス・エポキシ樹脂)のような汎用樹脂を主体として構成された多層配線基板である。即ち、表面や裏面に配線を印刷法などで形成した、いわゆるプリント基板(図示せず)を複数積層した構造で、この複数枚のプリント基板の各配線は、ビアによって適宜接続されている。また、実装基板1の表面には、複数のパッド(ボンディングパッド)P1が形成されている。このパッドは、実装基板の例えば外周部に配置される(図48等参照)。
The
ワイヤは、金等の導電性材料よりなり、半導体チップは、シリコン等の半導体よりなる。また、スペーサチップもシリコン等の半導体よりなる。前記スペーサチップを半導体チップと同じ材料にすることで、極力熱膨張係数の差異を低減し、応力を低減することができる。前記スペーサチップには、他の材料も適用できる。例えば、多結晶シリコンチップや、下側の半導体チップの表面に予め印刷により形成したポリイミド樹脂層をスペーサとして用いてもよい。この場合、前記シリコンのスペーサチップを用いる場合と比較して材料、製造コストを低減できる。 The wire is made of a conductive material such as gold, and the semiconductor chip is made of a semiconductor such as silicon. The spacer chip is also made of a semiconductor such as silicon. By making the spacer chip the same material as the semiconductor chip, the difference in thermal expansion coefficient can be reduced as much as possible, and the stress can be reduced. Other materials can also be applied to the spacer chip. For example, a polyimide resin layer previously formed by printing on the surface of a polycrystalline silicon chip or a lower semiconductor chip may be used as the spacer. In this case, material and manufacturing costs can be reduced as compared with the case where the silicon spacer chip is used.
半導体チップ3A、3B中には、図示しない複数の半導体素子や配線が形成され、その表面は保護膜で覆われている。また、保護膜の開口部からはそれぞれ複数のパッドPA、PBが露出している。このパッドは、最上層配線の露出部であり、各半導体チップの例えば外周部に配置される(図47等参照)。
A plurality of semiconductor elements and wirings (not shown) are formed in the
ワイヤ11Aは、半導体チップ3Aの表面のパッド(ボンディングパッド)PAと実装基板1の表面のパッドP1とを接続し、ワイヤ11Bは、半導体チップ3Bの表面のパッド(ボンディングパッド)PBと実装基板1の表面のパッドP1とを接続する。実装基板1の表面には、複数のパッドP1が形成され、ワイヤ11Aと11Bは異なるパッドP1に接続される(図48等参照)。なお、一部同じ位置のパッドP1に接続される場合もある。また、ワイヤ11Aのループ高さ(半導体チップ3Aの表面からワイヤ11Aの最高位置までの距離)は、100〜300μm程度であり、ワイヤ11Bのループ高さ(半導体チップ3Bの表面からワイヤ11Bの最高位置までの距離)は、300〜1000μm程度である。
The
ここで、実装基板1と半導体チップ3Aとは、接着材7を介して固定されている。この接着材7は、例えば主として熱硬化性を有する樹脂である。一方、スペーサチップ5と半導体チップ3Bとは、接着材9Bを介して固定されている。この接着材9Bは、例えば熱可塑性を有する樹脂である。また、半導体チップ3Aとスペーサチップ5とは、接着材9Aを介して固定されている。この接着材9Aは、例えば熱可塑性を有する樹脂である。
Here, the mounting
このように、本実施の形態によれば、実装基板1上に搭載される半導体チップ3Aの接着材と、この半導体チップ3Aの上方に位置する半導体チップ3Bの接着材とを異なるものとしたのでこれらの接着性を良くすることができる。
As described above, according to the present embodiment, the adhesive for the
具体的には、接着材7として、例えば主として熱硬化性を有する樹脂を用い、接着材9A、9Bとして、例えば熱可塑性を有する樹脂を用いる。また、接着材7の厚さは5〜50μm程度であり、接着材9A、9Bの厚さは5〜50μm程度である。
Specifically, for example, a resin having a thermosetting property is mainly used as the
なお、これらの接着材7、9A、9Bの特性や具体的な組成例については、製造工程の説明部においてさらに詳細に説明する。
Note that the characteristics and specific composition examples of these
これら半導体チップ3A、3Bおよびワイヤ11A、11Bの周囲は、モールド樹脂(レジン)13によって覆われている。また、実装基板1の裏面には、半田等よりなるバンプ電極15が例えばエリア配置されている。このバンプ電極15は、図示しない実装基板1中の複数の配線層やビア(接続部)を介してパッドP1と電気的に接続されている。
The periphery of the
次いで、本実施の形態の半導体装置の製造方法(組立工程)を図1〜図13を参照しながら説明する。 Next, a manufacturing method (assembly process) of the semiconductor device according to the present embodiment will be described with reference to FIGS.
図1に示すように、常温(室温)で、実装基板1上の半導体チップ搭載領域に接着材7を塗布する。この接着材7は、ペースト状の樹脂であり、主として熱硬化性を有する樹脂よりなる。具体的には、エポキシ系の樹脂がある。この樹脂の特徴は、溶剤と混合することによりペースト状となり、加熱の際、溶剤が揮発するとともに樹脂の反応により硬化が起こる。この硬化によって実装基板1上に半導体チップが固定される。また、熱硬化性樹脂は、一度硬化した後は熱を加えても溶融しない。
As shown in FIG. 1, an adhesive 7 is applied to the semiconductor chip mounting region on the mounting
このように、本実施の形態によれば、実装基板1上に主として熱硬化性を有する樹脂を用いたので、コストの低減を図ることができる。即ち、後述する熱可塑性を有するフィルム状の樹脂と比較し、主として熱硬化性を有する樹脂は汎用的で安価なものが多い。また、ペースト状の樹脂を用いることで、配線の厚さや、前記配線を覆う絶縁膜の厚さの影響で比較的凹凸が多い実装基板1の表面を埋めるように樹脂を供給でき、実装基板1とその上部の半導体チップ3Aの接着性を向上させることができる。
As described above, according to the present embodiment, since the thermosetting resin is mainly used on the mounting
次いで、図2に示すように、常温で接着材7上に半導体チップ3Aを搭載し、さらに、図3に示すように、実装基板1を熱処理することにより接着材7を硬化させる。熱処理は、実装基板1を例えば100〜200℃の雰囲気中に晒すことにより行う。その結果、実装基板1上に半導体チップ3Aが固定される。実装基板1上の半導体チップ搭載領域の外周には、パッドP1が露出している。また、半導体チップ3Aの表面からはパッドPAが露出している。
Next, as shown in FIG. 2, the
ここで、実装基板1を放置し、常温まで自然冷却する。この際、実装基板1および半導体チップ3Aがそれぞれ収縮するが、個々にα値が異なるため、その収縮度合いが異なる。このα値とは、熱膨張係数であり、シリコン(Si)では、3.5×10−6/℃、ガラス・エポキシ基板では、12×10−6/℃〜16×10−6/℃程度である。その結果、図4に示すように、実装基板1等が凸型に反った形状となる。
Here, the mounting
次いで、実装基板1上のパッドP1と半導体チップ3AのパッドPAとをワイヤ11Aで接続(第1ワイヤボンディング)する。この際、図5に示すように、実装基板1を加熱ステージ17上に搭載し、約150〜200℃程度で加熱しながらワイヤボンディングを行う。従って、ワイヤボンディングの最中は、加熱により実装基板1や半導体チップ3Aがそれぞれ平坦となる。このワイヤボンディングは、例えば超音波振動と熱圧着とを併用したワイヤボンダを使用して行う。
Next, the pads P1 on the mounting
次いで、実装基板1を放置し、常温まで自然冷却すると、図6に示すように、再び、実装基板1等が凸型に反った形状となる。
Next, when the mounting
次いで、図7に示すように、半導体チップ3A上に接着材9Aを貼り付け、その上部にスペーサチップ5を熱圧着する。即ち、実装基板1を加熱ステージ上に搭載し、約100〜250℃程度で加熱しつつ、スペーサチップ5を接着材9A(半導体チップ3A)上に押圧する。
Next, as shown in FIG. 7, an adhesive 9 </ b> A is attached on the semiconductor chip 3 </ b> A, and the
この場合、熱で実装基板1や半導体チップ3Aがそれぞれほぼ平坦となる。言い換えれば、熱を加える前(例えば図6に示す状態)より実装基板1や半導体チップ3Aの平坦性が向上する。その結果、半導体チップ3Aとスペーサチップ5の接着性が向上する。また、一定の接着力、接着面積、樹脂厚さを確保することができる。
In this case, the mounting
なお、スペーサチップ5の裏面(下面)に接着材9Aを貼り付け。半導体チップ3A上に熱圧着してもよい。
Note that an adhesive 9 </ b> A is attached to the back surface (lower surface) of the
ここで、接着材9Aは、熱可塑性を有する樹脂である。即ち、加熱中は硬化せず、接着材自身が溶融し、粘着性を有する。その後、自然冷却すると樹脂が硬化し、半導体チップ3A上にスペーサチップ5が固定される。但し、接着材9Aは、熱可塑性樹脂のみで構成されるとは限らない。例えば、熱可塑性樹脂よりなるメインフィルム部の表面に熱硬化性樹脂を塗布したフイルムを用い、半導体チップ3A上にフィルムを貼り付ける際には、上記熱硬化性樹脂の性質を利用して接着し、半導体チップ3A上にスペーサチップ5を固定する際には、熱可塑性樹脂の性質を利用して接着することもできる。また、熱可塑性樹脂と熱硬化性樹脂の混合樹脂を用いても同様の処理を行うことができる。
Here, the adhesive 9A is a resin having thermoplasticity. That is, it is not cured during heating, and the adhesive itself melts and has tackiness. Thereafter, when naturally cooled, the resin is cured, and the
従って、ここで言う「熱可塑性を有する樹脂」とは、熱を加えた時にある程度の接着性を有しつつ、その後硬化する樹脂を言う。従って、反応性の小さい熱硬化性樹脂や完全にキュア(重合)させていない熱硬化性樹脂であっても、ダイボンディングの加熱の期間に接着性を確保しつつ、その後硬化により所望の位置に上層の半導体チップを固定できるものであればよい。 Accordingly, the term “resin having thermoplasticity” as used herein refers to a resin that has a certain degree of adhesiveness when heated and is subsequently cured. Therefore, even a thermosetting resin with low reactivity or a thermosetting resin that has not been completely cured (polymerized) can secure adhesion during the heating period of die bonding, and then be cured to a desired position. Any device capable of fixing the upper semiconductor chip may be used.
また、接着材9Aには、溶媒(溶剤)の含有量が少なく、フィルム状(ペースト状でない)に加工できるという特性を有する。これに対し、接着材7は、樹脂に溶媒を加えることによりペースト状とすることができ、熱硬化の際に溶剤が揮発する。 Further, the adhesive 9A has a characteristic that the content of the solvent (solvent) is small and it can be processed into a film shape (not a paste shape). On the other hand, the adhesive 7 can be made into a paste by adding a solvent to the resin, and the solvent volatilizes during thermosetting.
接着材9Aの具体的組成は、例えばエポキシ樹脂と熱可塑性樹脂の混合物やポリイミド樹脂とエポキシ樹脂との混合物等がある。また、接着材9A中には、無機物質フィラー等を含有させてもよい。 Specific compositions of the adhesive 9A include, for example, a mixture of an epoxy resin and a thermoplastic resin, a mixture of a polyimide resin and an epoxy resin, and the like. Further, the adhesive 9A may contain an inorganic filler or the like.
このように本実施の形態によれば、スペーサチップ5を熱圧着する、即ち、加熱しながら接着したので、スペーサチップ5の接着性を向上させることができる。
Thus, according to the present embodiment, since the
例えば、図14に示すように、実装基板1等が凸型に反った状態で、半導体チップ3A上のスペーサチップ搭載領域に、ペースト状の樹脂であり、主として熱硬化性を有する樹脂よりなる接着材7Bを塗布しても、半導体チップ3Aの表面が反っているため、接着材7Bを安定的に供給できない。さらに、図15に示すように、その接着材7B上にスペーサチップ5を搭載しても、実装基板1や半導体チップ3Aに対して平行に搭載することができない。従って、熱処理することにより接着材7Bを硬化させても、スペーサチップ5の接着性が悪く、所望の接着力、接着面積、樹脂厚さを確保することが困難となる。また、半導体チップの剥がれや半導体チップ中のクラックの発生の原因となる。また、スペーサチップ5が傾いた状態で搭載され、その上部に他の半導体チップを積層すると、この半導体チップも傾いた状態で搭載され、その後のワイヤボンディングを制御性良く行うことができない。
For example, as shown in FIG. 14, with the mounting
このように、一度熱負荷が加わった実装基板の上方にさらにチップ(半導体チップやスペーサチップ)を積層しようとする場合、接着材7Bを用いたのでは接着性良く積層することができない。 As described above, when an additional chip (semiconductor chip or spacer chip) is to be stacked above the mounting substrate to which a thermal load has been applied once, the adhesive 7B cannot be used to stack with good adhesion.
これに対し、本実施の形態では、前述したように、スペーサチップ5を熱圧着したので、その接着性を向上させることができる。
On the other hand, in the present embodiment, as described above, since the
なお、図14および図15は、本実施の形態の効果を示すための半導体装置の製造方法を示す要部断面図である。 14 and 15 are cross-sectional views of relevant parts showing a method of manufacturing a semiconductor device to show the effect of the present embodiment.
このように、半導体チップ3A上に接着材9Aを貼り付け、その上部にスペーサチップ5を熱圧着した後、常温まで自然冷却すると、再び、実装基板1等が凸型に反った形状となる(図示せず)。
As described above, after the
次いで、図8に示すように、スペーサチップ5上に接着材9Bを貼り付け、その上部に半導体チップ3Bを熱圧着する。即ち、実装基板1を加熱ステージ17上に搭載し、約100〜250℃程度で加熱しつつ、半導体チップ3Bを接着材9B(スペーサチップ5)上に押圧する。この接着材9Bも接着材9Aと同様に、熱可塑性を有する樹脂である。また、フィルム状の樹脂である。なお、この場合も、半導体チップ3Bの裏面に接着材9Bを貼り付け、スペーサチップ5上に熱圧着してもよい。
Next, as shown in FIG. 8, an adhesive 9B is attached on the
このように半導体チップ3Bの接着(固定)の際も、加熱しながら接着したので、スペーサチップ5の接着の場合と同様にその接着性を向上させることができる。
As described above, since the
次いで、常温まで自然冷却すると、図9に示すように、実装基板1等が凸型に反った形状となる。なお、半導体チップ3Bの外周部からはパッドPBが露出している。
Next, when naturally cooled to room temperature, as shown in FIG. 9, the mounting
次いで、図10に示すように、実装基板1上のパッドP1と半導体チップ3BのパッドPBとをワイヤ11Bで接続(第2ワイヤボンディング)する。この際、図示するように、実装基板1を加熱ステージ17上に搭載し、約150〜200℃程度で加熱しながらワイヤボンディングを行う。従って、ワイヤボンディングの最中は、加熱により実装基板1や半導体チップ3A、3B等がそれぞれ平坦となる。このワイヤボンディングは、例えば超音波振動と熱圧着とを併用したワイヤボンダを使用して行う。
Next, as shown in FIG. 10, the pads P1 on the mounting
次いで、図11に示すように、実装基板1や半導体チップ3A、3B等を図示しない金型で挟持し、実装基板1側を150〜200℃の加熱ステージ17上に搭載し、金型のキャビティ内に溶融樹脂(モールド樹脂)を注入し、半導体チップ3A、3Bやワイヤ11A、11B等の周囲をモールド樹脂13によって封止する。なお、この後、常温まで自然冷却しても、実装基板1等が凸型に反らないよう、モールド樹脂13と実装基板1のα差を調整し、半導体装置の反りが少なくなるよう工夫されている。
Next, as shown in FIG. 11, the mounting
次いで、図12に示すように、実装基板1側を上面とし、半田等よりなるバンプ電極15を形成する。このバンプ電極15は、例えば低融点のPb−Sn共晶合金からなる半田ボールを実装基板1の上面(半導体チップ搭載側の逆側)に供給した後、この半田ボールをリフローさせることによって形成する。例えば、実装基板1等を、240〜260℃の雰囲気に晒すことによりリフローを行う。
Next, as shown in FIG. 12, a
その後、バンプ電極15の形成面を下側とし(図13)、本実施の形態の半導体装置が略完成する。
Thereafter, the
このように、本実施の形態によれば、実装基板の直上にはペースト状の熱硬化性を有する樹脂を用いてその上部の半導体チップの接着(固定)を行い、上記樹脂の硬化のための熱処理の後に積層されるチップ(半導体チップやスペーサチップ)の接着の際には、フィルム状の熱可塑性を有する樹脂を用いることとしたので、個々のチップの接着性を向上させることができる。また、半導体装置の信頼性を向上することができる。また、半導体装置の歩留まりを向上することができる。 As described above, according to the present embodiment, the upper semiconductor chip is bonded (fixed) using a paste-like thermosetting resin directly on the mounting substrate, and the resin is cured. When bonding chips (semiconductor chips and spacer chips) laminated after heat treatment, a film-like thermoplastic resin is used, so that the adhesiveness of individual chips can be improved. In addition, the reliability of the semiconductor device can be improved. In addition, the yield of the semiconductor device can be improved.
また、ペースト状の熱硬化性を有する樹脂の硬化のための熱処理を行うタイミングは、第1ワイヤボンディングの前である。これは、ワイヤボンディングの前には、ワイヤボンディングの対象となる半導体チップが固定されていなければならないからである。 Moreover, the timing which performs the heat processing for hardening of resin which has a paste-like thermosetting property is before 1st wire bonding. This is because the semiconductor chip to be wire bonded must be fixed before wire bonding.
特に、本実施の形態のように、2個のほぼ同じ形状の半導体チップ3A、3Bを積層する場合には、それぞれのパッドPA、PBが平面的に重なってしまうため、これらを1回のワイヤボンディングで接続することはできない。従って、途中で樹脂の硬化のための熱処理を行わなければならず、本実施の形態を適用して効果的である。なお、半導体チップ3A、3Bは、必ずしも同じ大きさである必要はなく、積層する複数の半導体チップのいずれか2つの半導体チップのパッドがその上部の半導体チップと平面的に重なってしまう半導体装置に適用して効果的である。このように、パッドが平面的に重なるような積層構造とすることにより半導体装置の小型化もしくは高密度実装化を図ることができる。
In particular, as in the present embodiment, when two
また、本実施の形態においては、2つの半導体チップ3A、3Bを積層したが、さらに、スペーサチップを介して半導体チップを積層してもよく、その場合のスペーサチップや半導体チップの接着にはフィルム状の熱可塑性を有する樹脂を用いる。
In the present embodiment, the two
(実施の形態2)
図16〜図27は、本実施の形態の半導体装置の製造工程を示す要部断面図である。以下、これらの図を参照しながら本実施の形態を説明する。なお、実施の形態1と同一の部材には同一もしくは関連する符号を付し、その繰り返しの説明は省略する。また、実施の形態1と同様の工程(処理)についても繰り返しの説明を省略する。
(Embodiment 2)
16 to 27 are main-portion cross-sectional views showing the manufacturing process of the semiconductor device of the present embodiment. Hereinafter, the present embodiment will be described with reference to these drawings. Note that the same or related reference numerals are given to the same members as those in the first embodiment, and repeated description thereof will be omitted. Further, repeated description of the same steps (processes) as those in
まず、本実施の形態の半導体装置の構成について説明する。なお、後述する本実施の形態の半導体装置の製造工程の説明において構造がより明確となるため、ここでは主要な構成についてのみ説明する。 First, the structure of the semiconductor device of this embodiment will be described. Note that since the structure becomes clearer in the description of the manufacturing process of the semiconductor device of the present embodiment described later, only the main configuration will be described here.
最終工程図である図27に示すように、本実施の形態の半導体装置は、実装基板1の主面上に、2個の半導体チップ3A、3Bが搭載されている。また、これらの間には、スペーサチップ5が配置されている。
As shown in FIG. 27, which is a final process diagram, in the semiconductor device of the present embodiment, two
ここで、実施の形態1と異なる構成は、半導体チップ3Aとスペーサチップ5とが、接着材7Bを介して固定されていることである。この接着材7Bおよび7Aは、例えば主として熱硬化性を有する樹脂である。また、この接着材7Aおよび7Bの厚さは、5〜50μm程度である。なお、スペーサチップ5と半導体チップ3Bとは、接着材9を介して固定されている。この接着材9は、例えば熱可塑性を有する樹脂である。
Here, the configuration different from the first embodiment is that the
このように、本実施の形態によれば、実装基板1上に搭載される半導体チップ3Aの接着材と、この半導体チップ3Aの上方に位置する半導体チップ3Bの接着材とを異なるものとしたのでこれらの接着性を良くすることができる。
As described above, according to the present embodiment, the adhesive for the
次いで、本実施の形態の半導体装置の製造方法(組立工程)を図16〜図27を参照しながら説明する。 Next, a manufacturing method (assembly process) of the semiconductor device according to the present embodiment will be described with reference to FIGS.
図16に示すように、実装基板1上の半導体チップ搭載領域に接着材7Aを塗布する。この接着材7Aは、ペースト状の樹脂であり、主として熱硬化性を有する樹脂よりなる。次いで、接着材7A上に半導体チップ3Aを搭載し、さらに、図17に示すように、半導体チップ3Aのスペーサチップ搭載領域に接着材7Bを塗布する。この接着材7A、7Bの特性や具体的な組成例は、実施の形態1の接着材7と同様である。
As shown in FIG. 16, an adhesive 7 </ b> A is applied to the semiconductor chip mounting region on the mounting
次いで、図18に示すように、実装基板1に例えば100〜200℃の熱処理を施すことにより接着材7A、7Bを硬化させる。その結果、実装基板1上に半導体チップ3Aが固定され、半導体チップ3A上にスペーサチップ5が固定される。実装基板1上の半導体チップ搭載領域の外周には、パッドP1が露出し、また、半導体チップ3Aのスペーサチップ搭載領域の外周には、パッドPAが露出している。
Next, as illustrated in FIG. 18, the
ここで、実装基板1を放置し、常温まで自然冷却する。この際、実装基板1、半導体チップ3Aやスペーサチップ5がそれぞれ収縮するが、個々にα値が異なるため、その収縮度合いが異なる。その結果、図19に示すように、実装基板1等が凸型に反った形状となる。
Here, the mounting
次いで、図20に示すように、実装基板1上のパッドP1と半導体チップ3AのパッドPAとをワイヤ11Aで接続(第1ワイヤボンディング)する。この第1ワイヤボンディングは、実施の形態1の第1ワイヤボンディングと同様に行う。
Next, as shown in FIG. 20, the pads P1 on the mounting
次いで、実装基板1を放置し、常温まで自然冷却すると、図21に示すように、再び、実装基板1等が凸型に反った形状となる。
Next, when the mounting
次いで、図22に示すように、スペーサチップ5上に接着材9を貼り付け、その上部に半導体チップ3Bを実施の形態1と同様に熱圧着する。即ち、実装基板1を加熱ステージ上に搭載し、約100〜250℃程度で加熱しつつ、半導体チップ3Bを接着材9(スペーサチップ5)上に押圧する。
Next, as shown in FIG. 22, an adhesive 9 is pasted on the
ここで、接着材9は、熱可塑性を有する樹脂である。また、フィルム状の樹脂である。この接着材9の特性や具体的な組成例は、実施の形態1の接着材9A、9Bと同様である。
Here, the
次いで、常温まで自然冷却すると、図23に示すように、実装基板1等が凸型に反った形状となる。なお、半導体チップ3Bの外周部からはパッドPBが露出している。
Next, when naturally cooled to room temperature, as shown in FIG. 23, the mounting
次いで、図24に示すように、実装基板1上のパッドP1と半導体チップ3BのパッドPBとをワイヤ11Bで接続(第2ワイヤボンディング)する。この第2ワイヤボンディングは、実施の形態1の第2ワイヤボンディングと同様に行う。
Next, as shown in FIG. 24, the pads P1 on the mounting
次いで、図25に示すように、実施の形態1と同様に、半導体チップ3A、3Bやワイヤ11A、11B等の周囲をモールド樹脂13によって封止した後、図26に示すように、実施の形態1と同様にバンプ電極15を形成する。その後、バンプ電極15の形成面を下側とし(図27)、本実施の形態の半導体装置が略完成する。
Next, as shown in FIG. 25, after the periphery of the
このように、本実施の形態によれば、実施の形態1と同様に、実装基板の直上にはペースト状の熱硬化性を有する樹脂を用いてその上部の半導体チップの接着(固定)を行い、上記樹脂の硬化のための熱処理の後に積層される半導体チップの接着の際には、フィルム状の熱可塑性を有する樹脂を用いることとしたので、個々のチップの接着性を向上させることができる。また、半導体装置の信頼性や歩留まりを向上することができる。 Thus, according to the present embodiment, as in the first embodiment, the upper semiconductor chip is bonded (fixed) using a paste-like thermosetting resin immediately above the mounting substrate. Since the resin having a film-like thermoplasticity is used for bonding the semiconductor chips laminated after the heat treatment for curing the resin, the adhesiveness of each chip can be improved. . In addition, the reliability and yield of the semiconductor device can be improved.
即ち、本実施の形態においては、スペーサチップを固定した後に第1ワイヤボンディングを行ったので、スペーサチップの固定にもペースト状の熱硬化性を有する樹脂を用いることができる。従って、接着材のコストを低減できる。また、スペーサチップとその下層の半導体チップの固定のための熱処理を同時に行うことができ、工程の簡略化を図ることができる。 That is, in this embodiment, since the first wire bonding is performed after the spacer chip is fixed, a paste-like thermosetting resin can be used for fixing the spacer chip. Therefore, the cost of the adhesive can be reduced. In addition, the heat treatment for fixing the spacer chip and the underlying semiconductor chip can be performed at the same time, and the process can be simplified.
但し、スペーサチップの端部と、その下層の半導体チップのパッドとの距離が小さい場合には、スペーサチップを固定した後においてはワイヤボンディングをし難いので、このような場合には、実施の形態1のように、第1ワイヤボンディングを行った後、スペーサチップを固定する方が望ましい。 However, when the distance between the edge of the spacer chip and the pad of the semiconductor chip below it is small, it is difficult to perform wire bonding after fixing the spacer chip. As shown in FIG. 1, it is preferable to fix the spacer chip after the first wire bonding.
(実施の形態3)
実施の形態1および2においては、スペーサチップを用いたが、本実施の形態においては積層する半導体チップの形状を工夫することでスペーサチップを省略する。
(Embodiment 3)
In the first and second embodiments, the spacer chip is used, but in this embodiment, the spacer chip is omitted by devising the shape of the semiconductor chip to be stacked.
図28〜図32は、本実施の形態の半導体装置の製造工程を示す要部断面図である。以下、これらの図を参照しながら本実施の形態を説明する。なお、実施の形態1と同一の部材には同一もしくは関連する符号を付し、その繰り返しの説明は省略する。また、実施の形態1と同様の工程(処理)についても繰り返しの説明を省略する。
28 to 32 are main-portion cross-sectional views showing the manufacturing process of the semiconductor device of the present embodiment. Hereinafter, the present embodiment will be described with reference to these drawings. Note that the same or related reference numerals are given to the same members as those in the first embodiment, and repeated description thereof will be omitted. Further, repeated description of the same steps (processes) as those in
まず、本実施の形態の半導体装置の構成について説明する。なお、後述する本実施の形態の半導体装置の製造工程の説明において構造がより明確となるため、ここでは主要な構成についてのみ説明する。 First, the structure of the semiconductor device of this embodiment will be described. Note that since the structure becomes clearer in the description of the manufacturing process of the semiconductor device of the present embodiment described later, only the main configuration will be described here.
最終工程図である図32に示すように、本実施の形態の半導体装置は、実装基板1の主面上に、2個の半導体チップ3A、23Bが搭載されている。このうち、半導体チップ23Bは、逆凸形状となっている。言い換えれば、半導体チップ23Bの下面(裏面、接着面、素子形成面と逆側の面)の中央部に凸部を有する。また、半導体チップ23Bの下面の外周部に切り欠き部を有する。この切り欠き部によって、半導体チップ3Aの外周部上に空間が確保され、ワイヤ11Aと半導体チップ23Bのショート(短絡)を防止している。この半導体チップ23Bの切り欠き部の横方向の長さD2は200〜500μm程度で、縦方向の長さD3は100〜300μm程度である。
As shown in FIG. 32, which is a final process diagram, in the semiconductor device of the present embodiment, two
ここで、実装基板1と半導体チップ3Aとは、接着材7を介して固定されており、半導体チップ3Aと半導体チップ23Bとは、接着材9を介して固定されている。接着材7は、例えば主として熱硬化性を有する樹脂である。また、接着材9は、例えば熱可塑性を有する樹脂である。
Here, the mounting
このように、本実施の形態によれば、実装基板1上に搭載される半導体チップ3Aの接着材と、この半導体チップ3A上の半導体チップ23Bの接着材とを異なるものとしたのでこれらの接着性を良くすることができる。
As described above, according to the present embodiment, the adhesive for the
また、逆凸形状の半導体チップ23Bを用いることにより、追って詳細に説明するように半導体装置の薄型化が図れ、また、製造工程の簡略化を図ることができる。また、スペーサチップを省略することができ、コストの低減を図ることができる。
Further, by using the reverse
次いで、本実施の形態の半導体装置の製造方法(組立工程)を図28〜図32を参照しながら説明する。 Next, a manufacturing method (assembly process) of the semiconductor device according to the present embodiment will be described with reference to FIGS.
まず、実施の形態1において図1〜図4を参照しながら説明したように、実装基板1上の半導体チップ搭載領域に接着材7を介して半導体チップ3Aを固定する。即ち、実装基板1上に接着材7を塗布し、半導体チップ3Aを搭載した後、熱処理を施し、接着材7を硬化させる。この接着材7は、ペースト状の樹脂であり、主として熱硬化性を有する樹脂よりなる。また、接着材7の特性や具体的な組成例は、実施の形態1で説明した通りである。
First, as described in the first embodiment with reference to FIGS. 1 to 4, the semiconductor chip 3 </ b> A is fixed to the semiconductor chip mounting region on the mounting
さらに、実施の形態1と同様に、実装基板1上のパッドP1と半導体チップ3AのパッドPAとをワイヤ11Aで接続(第1ワイヤボンディング)する(図5参照)。次いで、実装基板1を放置し、常温まで自然冷却すると、実施の形態1で説明したように、実装基板1等が凸型に反った形状となる(図6参照)。
Further, as in the first embodiment, the pad P1 on the mounting
次いで、図28に示すように、半導体チップ3A上に接着材9を貼り付け、その上部に半導体チップ23Bを熱圧着する。この半導体チップ23Bは、前述した通り逆凸形状である。半導体チップ23Bの下面の凸部が半導体チップ3A上に接着される。なお、逆凸形状の半導体チップの形成方法については後述する。
Next, as shown in FIG. 28, the
即ち、実施の形態1の半導体チップ3Bと同様に、実装基板1を加熱ステージ上に搭載し、約100〜250℃程度で加熱しつつ、半導体チップ23Bを接着材9(半導体チップ3A)上に押圧する。
That is, like the
ここで、接着材9は、熱可塑性を有する樹脂である。また、フィルム状の樹脂である。この接着材9の特性や具体的な組成例は、実施の形態1の接着材9A、9Bと同様である。
Here, the
次いで、常温まで自然冷却すると、実装基板1等が凸型に反った形状となる。なお、半導体チップ23Bの外周部からはパッドPBが露出している。
Next, when the substrate is naturally cooled to room temperature, the mounting
次いで、図29に示すように、実装基板1上のパッドP1と半導体チップ23BのパッドPBとをワイヤ11Bで接続(第2ワイヤボンディング)する。この第2ワイヤボンディングは、実施の形態1の第2ワイヤボンディングと同様に行う。
Next, as shown in FIG. 29, the pads P1 on the mounting
次いで、図30に示すように、実施の形態1と同様に、半導体チップ3A、23Bやワイヤ11A、11B等の周囲をモールド樹脂13によって封止した後、図31に示すように、実施の形態1と同様にバンプ電極15を形成する。その後、バンプ電極15の形成面を下側とし(図32)、本実施の形態の半導体装置が略完成する。
Next, as shown in FIG. 30, after the periphery of the
このように、本実施の形態によれば、実施の形態1と同様に、実装基板の直上にはペースト状の熱硬化性を有する樹脂を用いてその上部の半導体チップの接着(固定)を行い、上記樹脂の硬化のための熱処理の後に積層される半導体チップの接着の際には、フィルム状の熱可塑性を有する樹脂を用いることとしたので、個々のチップの接着性を向上させることができる。また、半導体装置の信頼性や歩留まりを向上することができる。 Thus, according to the present embodiment, as in the first embodiment, the upper semiconductor chip is bonded (fixed) using a paste-like thermosetting resin immediately above the mounting substrate. Since the resin having a film-like thermoplasticity is used for bonding the semiconductor chips laminated after the heat treatment for curing the resin, the adhesiveness of each chip can be improved. . In addition, the reliability and yield of the semiconductor device can be improved.
また、本実施の形態によれば、逆凸形状の半導体チップを用いたので、実施の形態1もしくは2で説明したスペーサチップを省略することができる。従って、スペーサチップの接着工程を省略でき、製造工程の簡略化を図ることができる。 In addition, according to the present embodiment, since the inverted convex semiconductor chip is used, the spacer chip described in the first or second embodiment can be omitted. Therefore, the spacer chip bonding step can be omitted, and the manufacturing process can be simplified.
また、スペーサチップの厚さに関わらず凸部の高さ(図32のD3)を調整することが可能であり、半導体装置の薄型化(小型化)を図ることができる。即ち、ワイヤ11Aのループ高さを考慮した必要最小限の凸部の高さとすることで、半導体装置の薄型化(小型化)を図ることができる。
Further, the height of the convex portion (D3 in FIG. 32) can be adjusted regardless of the thickness of the spacer chip, and the semiconductor device can be thinned (downsized). In other words, the semiconductor device can be thinned (downsized) by setting the height of the protrusions to the minimum necessary considering the loop height of the
次いで、逆凸形状の半導体チップを形成する方法について図33〜図39を参照しながら説明する。 Next, a method for forming an inverted convex semiconductor chip will be described with reference to FIGS.
まず、図33に示すように、半導体ウエハWを準備する。この半導体ウエハWは例えば略円形であり、矩形状のチップ領域CAが多数配置されている。各チップ領域はスクライブ領域SAによって区画され、通常、このスクライブ領域SAに沿ってダイシングすることにより複数の半導体チップ(ペレット)が形成される。なお、図33等においては約2個分の半導体チップに対応する領域しか表示していない。半導体ウエハWの主表面には図示しない半導体素子が形成され、その表面からはパッドPBが露出している。 First, as shown in FIG. 33, a semiconductor wafer W is prepared. The semiconductor wafer W is, for example, substantially circular, and a large number of rectangular chip areas CA are arranged. Each chip region is partitioned by a scribe region SA, and a plurality of semiconductor chips (pellets) are usually formed by dicing along the scribe region SA. In FIG. 33 and the like, only regions corresponding to about two semiconductor chips are displayed. Semiconductor elements (not shown) are formed on the main surface of the semiconductor wafer W, and pads PB are exposed from the surface.
図34に示すように、パッドPB形成面にバックグラインド(BG)テープ31およびダイシングテープ33を順次貼り付け、テープ接着面を下側とし、裏面研磨(バックグラインド、BG)する。次いで、図35に示すように、スクライブ領域SAを含む幅W1の領域を幅広のダイシングソー35で半導体ウエハの途中まで(例えば100〜300μm程度)ダイシングする(第1ダイシング)。
As shown in FIG. 34, a back grind (BG)
次いで、図36に示すように、幅W1の領域のほぼ中心部に位置するスクライブ領域SA(幅W2)を幅狭のダイシングソー37で半導体ウエハの表面までダイシングする(第2ダイシング)。幅W2は幅W1より小さい。 Next, as shown in FIG. 36, the scribe region SA (width W2) located substantially at the center of the region of width W1 is diced to the surface of the semiconductor wafer with a narrow dicing saw 37 (second dicing). The width W2 is smaller than the width W1.
次いで、図37に示すように、チップ領域CAをテープ接着面側から針等で押し上げるとともに、その上面を吸引コレット等を用いてピックアップ(pick up)する。その結果、図38に示すように、その裏面(図38においては上面)の中央部に凸部を有し、その外周部に切り欠きを有する半導体チップ23Bが形成される。なお、半導体装置内に積層される場合には図39に示すようにその凸部側が下側となるよう接着される。
Next, as shown in FIG. 37, the chip area CA is pushed up from the tape bonding surface side with a needle or the like, and its upper surface is picked up using a suction collet or the like. As a result, as shown in FIG. 38, a
次いで、逆凸形状の半導体チップを形成する他の方法について図40〜図42を参照しながら説明する。 Next, another method for forming an inverted convex semiconductor chip will be described with reference to FIGS.
図35に示す第1ダイシングが終わった後の半導体ウエハWのパッドPB形成面(表面)のバックグラインド(BG)テープ31およびダイシングテープ33を剥離し、図40に示すように半導体ウエハWの裏面にダイシングテープ33bを貼り付ける。
35, the back grind (BG)
次いで、図41に示すように、幅W1の領域のほぼ中心部に位置するスクライブ領域SA(幅W2)を幅狭のダイシングソー37でパッドPB形成面(表面)からダイシングする(第2ダイシング)。幅W2は幅W1より小さい。 Next, as shown in FIG. 41, the scribe region SA (width W2) located substantially at the center of the region of width W1 is diced from the pad PB formation surface (front surface) with a narrow dicing saw 37 (second dicing). . The width W2 is smaller than the width W1.
次いで、チップ領域CAをダイシングテープ33bの接着面側から針等で押し上げるとともに、その上面を吸引コレット等を用いてピックアップ(pick up)する。このような方法でも、図38を参照しながら説明した、裏面(図38においては上面)の中央部に凸部を有し、その外周部に切り欠きを有する半導体チップ23Bが形成される(図42)。
Next, the chip area CA is pushed up with a needle or the like from the bonding surface side of the dicing
なお、本実施の形態においては、切り欠き部がほぼ矩形状の半導体チップを例に説明したが、図43に示すように、切り欠き部をテーパー形状としてもよいし、また、図45に示すように、切り欠き部をアール形状としてもよい。このような形状の半導体チップは、例えば、幅広のダイシングソーの先端の形状を切り欠き部の形状に対応させることで形成することができる。なお、これらの形状の半導体チップの形成工程も、第2ダイシングをパッドPB形成面(表面)から行ってもよいし、また、裏面から行ってもよい(図41および図36参照)。なお、図43および図45は、他の逆凸形状の半導体チップを形成する方法を説明するため要部断面図である。 In this embodiment, a semiconductor chip having a substantially rectangular cutout has been described as an example. However, as shown in FIG. 43, the cutout may have a tapered shape, or as shown in FIG. As described above, the notch may have a round shape. Such a semiconductor chip can be formed, for example, by making the shape of the tip of a wide dicing saw correspond to the shape of the notch. In the process of forming the semiconductor chips having these shapes, the second dicing may be performed from the pad PB formation surface (front surface) or from the back surface (see FIGS. 41 and 36). FIG. 43 and FIG. 45 are principal part cross-sectional views for explaining another method of forming an inverted convex semiconductor chip.
また、図44は、切り欠き部をテーパー形状とした半導体チップを本実施の形態で説明した半導体チップ23Bとして用いた場合の要部断面図であり、図46は、切り欠き部をアール形状とした半導体チップを本実施の形態で説明した半導体チップ23Bとして用いた場合の要部断面図である。搭載する半導体チップの形状を除いては、その構成および製造工程は同様であるためその詳細な説明を省略する。なお、これらの図においては、モールド樹脂13およびバンプ電極15の表示を省略してある。
FIG. 44 is a cross-sectional view of a main part when a semiconductor chip having a notch part having a tapered shape is used as the
(実施の形態4)
実施の形態1等においては、2個のほぼ同じ形状の半導体チップ3A、3Bを積層したが、以下に示すように、チップの形状に関わらず、下層の半導体チップのパッドの一部と重なるよう上層の半導体チップが配置される場合にも有効である。
(Embodiment 4)
In the first embodiment, etc., two
図47および図48は、本実施の形態の半導体装置を示す要部平面図で、図49は、本実施の形態の半導体装置を示す要部断面図ある。図49は、例えば図48のA−A断面部に対応する。 47 and 48 are main part plan views showing the semiconductor device of the present embodiment, and FIG. 49 is a main part sectional view showing the semiconductor device of the present embodiment. FIG. 49 corresponds to, for example, the AA cross section of FIG.
図47に示す半導体チップ3A、23Bを、図48および図49に示すように積層する。半導体チップ3Aは23Bより僅かに大きく、また、半導体チップ23Bは実施の形態3で詳細に説明した逆凸形状である。このような構造の半導体装置においても半導体チップ3AのパッドPAと半導体チップ23Bとが重なっているため、上層の半導体チップ23Bの積層前に、ワイヤ11Aのボンディングを行う必要がある。即ち、積層前に、下層の半導体チップ3Aを樹脂によって固定するための熱処理を行う必要がある。
The semiconductor chips 3A and 23B shown in FIG. 47 are stacked as shown in FIGS. The
従って、実施の形態3等で説明したように、実装基板1の直上にはペースト状の熱硬化性を有する樹脂(接着材7)を用いてその上部の半導体チップ3Aの接着(固定)を行い、上記樹脂の硬化のための熱処理の後に積層される半導体チップ23Bの接着の際には、フィルム状の熱可塑性を有する樹脂(接着材9)を用いることにより、個々のチップの接着性を向上させることができる。また、半導体装置の信頼性や歩留まりを向上することができる。
Therefore, as described in the third embodiment, the
なお、図49等に示す半導体装置の構成および製造方法は、実施の形態3の場合と同様であるため対応部位には同じ符号を付しその詳細な説明を省略する。また、本図においてはモールド樹脂13およびバンプ電極15の表示を省略してある。
49 and the like, the configuration and manufacturing method of the semiconductor device shown in FIG. 49 and the like are the same as those in the third embodiment, so the corresponding parts are denoted by the same reference numerals and detailed description thereof is omitted. Further, in this drawing, the display of the
図50および図51は、本実施の形態の他の半導体装置を示す要部平面図で、図52は、本実施の形態の他の半導体装置を示す要部断面図ある。図52は、例えば図51のB−B断面部に対応する。 50 and 51 are main part plan views showing another semiconductor device of this embodiment, and FIG. 52 is a main part sectional view showing another semiconductor device of this embodiment. FIG. 52 corresponds to, for example, the BB cross section of FIG.
図50に示す半導体チップ3A、23Bを、図51および図52に示すように積層する。半導体チップ3Aおよび23Bはそれぞれの長手方向が交差する方向に配置され、半導体チップ3AのパッドPAの一部と半導体チップ23Bとが重なるよう配置されている。また、半導体チップ23Bは実施の形態3で詳細に説明した逆凸形状である。
The semiconductor chips 3A and 23B shown in FIG. 50 are stacked as shown in FIGS. The semiconductor chips 3A and 23B are arranged in a direction in which their longitudinal directions intersect, and a part of the pad PA of the
このような構造の半導体装置においても上層の半導体チップ23Bの積層前に、ワイヤ11Aのボンディングを行う必要がある。即ち、積層前に、下層の半導体チップ3Aを樹脂によって固定するための熱処理を行う必要がある。
Even in the semiconductor device having such a structure, it is necessary to bond the
従って、実施の形態3等で説明したように、実装基板1の直上にはペースト状の熱硬化性を有する樹脂(接着材7)を用いてその上部の半導体チップ3Aの接着(固定)を行い、上記樹脂の硬化のための熱処理の後に積層される半導体チップ23Bの接着の際には、フィルム状の熱可塑性を有する樹脂(接着材9)を用いる。なお、図52等に示す半導体装置の構成および製造方法は、実施の形態3の場合と同様であるため対応部位には同じ符号を付しその詳細な説明を省略する。また、本図においてはモールド樹脂13およびバンプ電極15の表示を省略してある。
Therefore, as described in the third embodiment, the
但し、半導体チップ23Bの裏面の接着面積が小さい場合には、下層の半導体チップ3Aの反りの影響が小さくなるため、例えば接着面積の長手方向の長さが5mm以下の場合には、半導体チップ23Bの接着にペースト状の熱硬化性を有する樹脂(接着材7)を用いてもよい。逆に、接着面積の長手方向の長さが5mmを超える場合には、半導体チップ23Bの接着にはフィルム状の熱可塑性を有する樹脂(接着材9)を用いることが望ましい。
However, when the bonding area of the back surface of the
なお、本実施の形態においては、上層の半導体チップを逆凸形状としたが、実施の形態1や2に示すスペーサチップを用いてもよい。 In the present embodiment, the upper semiconductor chip is formed in a reverse convex shape, but the spacer chip shown in the first or second embodiment may be used.
(実施の形態5)
実施の形態3においては、2個の半導体チップ3A、23Bを積層したが、さらに、多くの半導体チップを積層してもよい。
(Embodiment 5)
In the third embodiment, the two
図53は、本実施の形態の半導体装置を示す要部断面図である。なお、本図においてはモールド樹脂13およびバンプ電極15の表示を省略してある。図示するように、半導体チップ23Bの上層には、半導体チップ23Cが、さらにその上層には半導体チップ23Dが積層されている。また、各半導体チップ表面のパッド(PA、PB、PC、PD)は、実装基板1の表面のパッドP1とそれぞれワイヤ(11A、11B、11C、11D)を介して接続されている。また、各半導体チップのパッド(PA、PB、PC、PD)は、それぞれ上層の半導体チップと平面的に重なって配置されているため、順次ワイヤボンディングを行う必要がある。従って、半導体チップ3Aは、ペースト状の熱硬化性を有する樹脂(接着材7)を用いて接着され、他の半導体チップ(23B、23C、23D)は、フィルム状の熱可塑性を有する樹脂(接着材9A、9B、9C)を用いて接着される。
FIG. 53 is a fragmentary cross-sectional view showing the semiconductor device of the present embodiment. In the drawing, the display of the
なお、本実施の形態の半導体装置の半導体チップ23Bより下層の構成および製造方法は、実施の形態3と同様であるため対応部位には同じ符号を付しその詳細な説明を省略する。
Note that the configuration and manufacturing method below the
また、半導体チップ23B、23C、23Dは、実施の形態3の半導体チップ23Bと同様に下層の半導体チップ上にフィルム状の熱可塑性を有する樹脂を用いて固定されるため、その詳細な説明を省略する。
Further, since the semiconductor chips 23B, 23C, and 23D are fixed on the lower semiconductor chip using a resin having a film-like thermoplastic property in the same manner as the
なお、本実施の形態においては、上層の半導体チップを逆凸形状としたが、実施の形態1や2に示すスペーサチップを用いてもよい。 In the present embodiment, the upper semiconductor chip is formed in a reverse convex shape, but the spacer chip shown in the first or second embodiment may be used.
(実施の形態6)
実施の形態5においては、半導体チップ23B、23C、23Dを逆凸形状としたが、最下層の半導体チップ3Aも逆凸形状としてもよい。
(Embodiment 6)
In the fifth embodiment, the semiconductor chips 23B, 23C, and 23D have a reverse convex shape, but the
図54は、本実施の形態の半導体装置を示す要部断面図である。その構成および製造方法は、最下層の半導体チップ23Aの形状が逆凸形状であることを除いては実施の形態5の場合と同じであるためその詳細な説明を省略する。なお、本図においてはモールド樹脂13およびバンプ電極15の表示を省略してある。
FIG. 54 is a main-portion cross-sectional view showing the semiconductor device of the present embodiment. Since the configuration and the manufacturing method are the same as those in the fifth embodiment except that the shape of the
特に、本実施の形態においては、実装基板1の直上の半導体チップ23Aを逆凸形状としたので、以下に説明する効果を奏する。なお、この効果は単層の半導体チップを搭載した場合も同様であるため図55および図56を参照しながら説明する。図55は、本実施の形態の他の半導体装置を示す要部断面図であり、図56は、本実施の形態の効果を説明するための半導体装置を示す要部断面図である。
In particular, in the present embodiment, since the
図55に示すように、半導体チップ23Aを逆凸形状とした場合、実装基板1と半導体チップ23Aの裏面の対向面積が小さくなる。例えば、図56に示すように、PS1の大きさの半導体チップ33Aを搭載した場合、実装基板1と半導体チップ33Aの裏面の対向面積が大きくなり、応力により実装基板1中にクラックが生じやすくなる。特に、半導体チップ33Aの端部近傍では応力が集中しやすく、クラック39が生じやすい。また、クラックが発生しなくても、実装基板1中の複数の配線層が応力により断線しやすくなる。
As shown in FIG. 55, when the
これに対して、半導体チップ23Aを逆凸形状とすると対向面積が小さくなり、応力を緩和できる。言い換えれば、見かけ上PS2(<PS1)の大きさの半導体チップが搭載されている場合と同様の応力となる。従って、実装基板1中のクラックの発生を防止できる。また、応力の緩和により半導体チップ23Aの平坦性が向上し、その後の製造工程が容易となる。特に、半導体チップを積層する場合には、上層の半導体チップの接着性を向上することができる。また、半導体装置の完成後における温度サイクル試験(Tサイクル試験)時に熱負荷が加わっても応力を緩和することができる。従って、Tサイクル特性を向上させることができる。
On the other hand, when the
また、切り欠き部にペースト状の熱硬化性を有する樹脂(接着材7)が充填されるため、半導体チップ23Aの端部からの樹脂のはみ出し量を低減でき、パッドP1上まで樹脂が流れ込むことを防止できる。
In addition, since the notched portion is filled with paste-like thermosetting resin (adhesive 7), the amount of the resin protruding from the end of the
(実施の形態7)
実施の形態6の図54においては、常に上層の半導体チップが下層の半導体チップのパッドと平面的に重なっているが、本実施の形態で示すように、下層の半導体チップより小さい半導体チップを積層してもよい。
(Embodiment 7)
In FIG. 54 of the sixth embodiment, the upper semiconductor chip always overlaps the pad of the lower semiconductor chip in a planar manner. However, as shown in this embodiment, a semiconductor chip smaller than the lower semiconductor chip is stacked. May be.
図57は、本実施の形態の半導体装置を示す要部断面図である。その構成および製造方法は、半導体チップ33B、33Cの形状を除いては実施の形態6の場合と同様であるためその詳細な説明を省略する。なお、本図においてはモールド樹脂13およびバンプ電極15の表示を省略してある。
FIG. 57 is a fragmentary cross-sectional view showing the semiconductor device of the present embodiment. Since the configuration and the manufacturing method are the same as those in the sixth embodiment except for the shapes of the
この場合、半導体チップ23Aの上部には、半導体チップ33Bが固定されているが、半導体チップ33Bは23Aより一回り小さく、半導体チップ33B搭載後もパッドPAは露出している。
In this case, the
同様に半導体チップ33Bの上部にも一回り小さい半導体チップ33Cが固定され、半導体チップ33C搭載後もパッドPBは露出している。
Similarly, a slightly
従って、この場合、半導体チップ23A、33Bおよび33Cを順次ペースト状の熱硬化性を有する樹脂(接着材7A、7B、7C)を介して接着し、熱処理により3つの半導体チップを同時に固定した後、ワイヤ11A、11B、11Cのボンディングを行うことができる。このようにチップの接着工程をはさまずに、連続してボンディングを行った場合には、ボンディング回数は1回と考える。
Therefore, in this case, after the
従って、少なくとも半導体チップ23Dの固定をフィルム状の熱可塑性を有する樹脂(接着材9)を用いて接着すればよい。
Therefore, at least the
もちろん、半導体チップ33Bおよび33Cの固定にフィルム状の熱可塑性を有する樹脂(接着材9)を用いてもよい。
Of course, a resin (adhesive 9) having a film-like thermoplasticity may be used for fixing the
また、図57においては、実施の形態6で説明したように半導体チップ23Aが逆凸形状となっている。
In FIG. 57, as described in the sixth embodiment, the
以上、本発明者によってなされた発明を実施の形態に基づき具体的に説明したが、本発
明は上記実施の形態に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可
能であることは言うまでもない。
As mentioned above, the invention made by the present inventor has been specifically described based on the embodiment. However, the present invention is not limited to the above embodiment, and various modifications can be made without departing from the scope of the invention. Needless to say.
特に、矛盾しない限り各実施の形態の構成を適宜組み合わせることが可能である。また、前記実施の形態によれば、実装基板上に半導体チップを積層する場合について説明したが、この他、リードフレーム上に半導体チップを搭載する場合など、半導体チップとα値の異なる部材上に半導体チップを積層する場合に広く適用可能である。また、前記実施の形態においては、実装基板等が凸型に反る場合について説明したが、これに限られるものではない。 In particular, the configurations of the embodiments can be appropriately combined as long as no contradiction arises. In addition, according to the embodiment, the case where the semiconductor chip is stacked on the mounting substrate has been described. However, in addition to the case where the semiconductor chip is mounted on the lead frame, the semiconductor chip is formed on a member having a different α value. The present invention is widely applicable when stacking semiconductor chips. In the above-described embodiment, the case where the mounting substrate warps in a convex shape has been described, but the present invention is not limited to this.
本発明は、半導体装置の製造業に適用できる。 The present invention can be applied to the semiconductor device manufacturing industry.
1 実装基板
3A 半導体チップ
3B 半導体チップ
5 スペーサチップ
7、7A、7B、7C 接着材
9、9A、9B、9C 接着材
11A 、11B、11C、11D ワイヤ
13 モールド樹脂
15 バンプ電極
17 加熱ステージ
23A 半導体チップ
23B 半導体チップ
23C 半導体チップ
23D 半導体チップ
31 バックグラインドテープ
33 ダイシングテープ
33A 半導体チップ
33B 半導体チップ
33C 半導体チップ
33b ダイシングテープ
35 ダイシングソー
37 ダイシングソー
39 クラック
CA チップ領域
D1 半導体チップの端部とスペーサチップの端部との距離
D2 半導体チップの切り欠き部の横方向の長さ
D3 半導体チップの切り欠き部の縦方向の長さ
P1 パッド
PA、PB、PC、PD パッド
PS1、PS2 半導体チップの大きさ
SA スクライブ領域
W 半導体ウエハ
W1、W2 幅
DESCRIPTION OF
Claims (11)
(a)前記実装基板の直上に搭載された第1半導体チップは、主として熱硬化性を有する樹脂を介して固定され、
(b)前記第1半導体チップの上方に搭載された第2半導体チップは、熱可塑性を有する樹脂を介して固定されていることを特徴とする半導体装置。 A semiconductor device in which at least first and second semiconductor chips are stacked on a mounting substrate,
(A) The first semiconductor chip mounted immediately above the mounting substrate is mainly fixed through a thermosetting resin,
(B) The semiconductor device, wherein the second semiconductor chip mounted above the first semiconductor chip is fixed via a thermoplastic resin.
前記スペーサチップは、前記第1半導体チップ上に主として熱硬化性を有する樹脂もしくは熱可塑性を有する樹脂を介して固定され、
前記第2半導体チップは、前記スペーサチップ上に搭載されていることを特徴とする請求項1記載の半導体装置。 A spacer chip is mounted between the first semiconductor chip and the second semiconductor chip,
The spacer chip is fixed on the first semiconductor chip mainly through a thermosetting resin or a thermoplastic resin,
The semiconductor device according to claim 1, wherein the second semiconductor chip is mounted on the spacer chip.
前記凸部が前記樹脂を介して接着されることを特徴とする請求項1記載の半導体装置。 The second semiconductor chip has a notch in the outer periphery of the back surface, and the center of the back surface is a convex portion,
The semiconductor device according to claim 1, wherein the convex portion is bonded through the resin.
(b)前記(a)工程の後、熱処理によって前記樹脂を硬化させることにより前記実装基板上に前記半導体チップを固定する工程と、
を有することを特徴とする半導体装置の製造方法。 (A) a step of mounting a semiconductor chip having a notch in the outer peripheral portion of the back surface, and a central portion of the back surface being a convex portion, mainly through a thermosetting resin on the mounting substrate;
(B) after the step (a), fixing the semiconductor chip on the mounting substrate by curing the resin by heat treatment;
A method for manufacturing a semiconductor device, comprising:
(b)前記実装基板上に搭載された半導体チップであって、裏面の外周部に切り欠き部を有し、前記裏面の中央部が凸部である半導体チップと、
(c)前記実装基板と前記半導体チップとの間に形成された主として熱硬化性を有する樹脂と、
を有することを特徴とする半導体装置。 (A) a mounting substrate;
(B) a semiconductor chip mounted on the mounting substrate, the semiconductor chip having a notch in the outer peripheral portion of the back surface, and the central portion of the back surface being a convex portion;
(C) a mainly thermosetting resin formed between the mounting substrate and the semiconductor chip;
A semiconductor device comprising:
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