JP2006066530A - Electronic device - Google Patents
Electronic device Download PDFInfo
- Publication number
- JP2006066530A JP2006066530A JP2004245668A JP2004245668A JP2006066530A JP 2006066530 A JP2006066530 A JP 2006066530A JP 2004245668 A JP2004245668 A JP 2004245668A JP 2004245668 A JP2004245668 A JP 2004245668A JP 2006066530 A JP2006066530 A JP 2006066530A
- Authority
- JP
- Japan
- Prior art keywords
- circuit board
- circuit
- electronic device
- substrate
- circuit element
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/82—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected by forming build-up interconnects at chip-level, e.g. for high density interconnects [HDI]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
- H01L2224/23—Structure, shape, material or disposition of the high density interconnect connectors after the connecting process
- H01L2224/24—Structure, shape, material or disposition of the high density interconnect connectors after the connecting process of an individual high density interconnect connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
- H01L2224/23—Structure, shape, material or disposition of the high density interconnect connectors after the connecting process
- H01L2224/24—Structure, shape, material or disposition of the high density interconnect connectors after the connecting process of an individual high density interconnect connector
- H01L2224/2405—Shape
- H01L2224/24051—Conformal with the semiconductor or solid-state device
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
- H01L2224/23—Structure, shape, material or disposition of the high density interconnect connectors after the connecting process
- H01L2224/24—Structure, shape, material or disposition of the high density interconnect connectors after the connecting process of an individual high density interconnect connector
- H01L2224/241—Disposition
- H01L2224/24151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/24221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/24225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/24227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the HDI interconnect not connecting to the same level of the item at which the semiconductor or solid-state body is mounted, e.g. the semiconductor or solid-state body being mounted in a cavity or on a protrusion of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1306—Field-effect transistor [FET]
- H01L2924/13091—Metal-Oxide-Semiconductor Field-Effect Transistor [MOSFET]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/30—Technical effects
- H01L2924/301—Electrical effects
- H01L2924/30105—Capacitance
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
- Combinations Of Printed Boards (AREA)
Abstract
Description
本発明は、電子装置に関するものである。 The present invention relates to an electronic device.
従来、回路基板10に回路素子20が実装された電子装置として図5に示すものがあった。図5は、従来技術における電子装置の模式的な断面図である。
Conventionally, there has been an electronic device shown in FIG. 5 as an electronic device in which a
従来における電子装置は、図5に示すように回路基板10の上に回路素子20が搭載され、回路基板10に設けられた基板側電極11と回路素子20に設けられた素子側電極21とがスクリーン印刷された導電性ペースト(印刷材料)30にて電気的に接続されるものである。
As shown in FIG. 5, the conventional electronic device includes a
しかしながら、従来における電子装置では、回路基板10の表面と回路素子20の表面との間に、回路素子20の厚さ分の段差が形成される。この段差が形成された状態で回路基板10と回路素子20とに渡って導電性ペースト30をスクリーン印刷すると、段差の付け根付近には導電性ペースト30が印刷されにくく隙間Iが生じることがある。この隙間I付近の導電性ペースト30は、回路基板10や回路素子20などに接触しておらず強度が弱いため断線する可能性があった。
However, in the conventional electronic device, a step corresponding to the thickness of the
また、回路基板10と回路素子20とに渡って窒化シリコンなどからなる印刷材料がスクリーン印刷されることによって保護膜が形成されるような場合も、回路基板10の表面と回路素子20の表面との間に形成された段差によって保護膜が損傷する可能性があった。
Also, when a protective film is formed by screen printing a printing material made of silicon nitride or the like across the
本発明は、上記問題点に鑑みなされたものであり、被実装基材と電子部材間とに渡ってスクリーン印刷される印刷材料の損傷を抑制することができる電子装置を提供することを目的とする。 The present invention has been made in view of the above problems, and an object of the present invention is to provide an electronic device that can suppress damage to a printing material that is screen-printed across a substrate to be mounted and an electronic member. To do.
上記目的を達成するために請求項1に記載の電子装置は、被実装基材に電子部材を実装し、被実装基材の表面と電子部材の表面とに渡って印刷材料がスクリーン印刷にて設けられる電子装置において、被実装基材は、電子部材を実装する位置に電子部材の外形に応じた段差からなる実装部を有することを特徴とするものである。 In order to achieve the above object, an electronic device according to claim 1, an electronic member is mounted on a substrate to be mounted, and a printing material is screen-printed across the surface of the substrate to be mounted and the surface of the electronic member. In the electronic device provided, the substrate to be mounted has a mounting portion having a step corresponding to the outer shape of the electronic member at a position where the electronic member is mounted.
このように、被実装基板に電子部材の外形に応じた実装部(段差)を設けることによって、この実装部の深さ分だけ被実装基板の表面と電子部材の表面との段差が低減されることになる。したがって、実装基材の表面と電子部材の表面とに渡って印刷材料をスクリーン印刷しても被実装基板の表面と電子部材の表面との段差の付け根には隙間が生じにくく、印刷材料の損傷を抑制することができる。 Thus, by providing the mounting substrate with a mounting portion (step) corresponding to the outer shape of the electronic member, the step between the surface of the mounting substrate and the surface of the electronic member is reduced by the depth of the mounting portion. It will be. Therefore, even if the printing material is screen-printed across the surface of the mounting substrate and the surface of the electronic member, a gap is hardly formed at the base of the step between the surface of the mounting substrate and the surface of the electronic member, and the printing material is damaged. Can be suppressed.
また、請求項2に示すように、実装部は、電子部材が挿入された状態で被実装基材の表面と電子部材の表面とが略同一平面となる深さとすることによって、より一層隙間が生じにくくし損傷を抑制することができる。 Further, as shown in claim 2, the mounting portion has a further gap by setting the depth so that the surface of the substrate to be mounted and the surface of the electronic member are substantially flush with the electronic member inserted. It is difficult to occur and damage can be suppressed.
また、被実装基材に複数の電子部材が実装されるような場合であっても、請求項3に示すように、被実装基材が複数の実装部を有することによって、被実装基材における電子部材との段差による凸凹が減少され印刷材料を一括でスクリーン印刷することができる。 Further, even when a plurality of electronic members are mounted on the substrate to be mounted, as shown in claim 3, the substrate to be mounted has a plurality of mounting portions, so that The unevenness due to the step with the electronic member is reduced, and the printing material can be screen-printed collectively.
また、請求項4に示すように被実装基材としては回路基板もしくは筐体、電子部材としては回路素子、回路基板、センサ素子、コネクタ部材の端子、半導体基板の少なくとも一つとすることができる。 According to a fourth aspect of the present invention, the substrate to be mounted can be a circuit board or housing, and the electronic member can be at least one of a circuit element, a circuit board, a sensor element, a connector member terminal, and a semiconductor substrate.
また、請求項5に記載の電子装置では、被実装基材は、電子部材として一対の湿度検出電極を形成するための湿度センサ用半導体基板、及び湿度センサの検出信号を処理する処理回路が実装されるものであり、印刷材料は、被実装基材を介して湿度センサ用半導体基板と処理回路とに渡って設けられることを特徴とするものである。 In the electronic device according to claim 5, the substrate to be mounted is mounted with a humidity sensor semiconductor substrate for forming a pair of humidity detection electrodes as electronic members, and a processing circuit for processing the detection signal of the humidity sensor. The printing material is provided across the humidity sensor semiconductor substrate and the processing circuit via the substrate to be mounted.
このように、被実装基材を介して電子部材である湿度センサ用半導体基板と処理回路とに渡って印刷材料が設けられることによって、湿度検出電極及び湿度検出電極と処理回路との配線を構成する印刷材料を一括でスクリーン印刷することができる。さらに、電子部材に保護膜をスクリーン印刷する場合でも、被実装基材における電子部材(湿度センサ用半導体基板、処理回路)の実装面の凸凹が減少されるので、保護膜に関しても一括でスクリーン印刷することができる。また、実装面の凸凹が減少されることによって保護膜の損傷が抑制されるので保護機能の低下を抑制することができる。 In this manner, the humidity detection electrode and the wiring between the humidity detection electrode and the processing circuit are configured by providing the printing material over the semiconductor substrate for the humidity sensor, which is an electronic member, and the processing circuit via the mounted substrate. It is possible to screen-print the printing materials to be batched. Furthermore, even when screen-printing a protective film on the electronic member, the unevenness of the mounting surface of the electronic member (humidity sensor semiconductor substrate, processing circuit) on the substrate to be mounted is reduced, so that the protective film is also screen-printed collectively. can do. Moreover, since the damage of a protective film is suppressed by reducing the unevenness | corrugation of a mounting surface, the fall of a protective function can be suppressed.
また、請求項6に記載の電子装置のように、印刷材料は、導電性部材からなることを特徴とすることによって、導電性部材を被実装基材の表面と電子部材の表面との段差によって生じる断線を抑制することができる。 Further, as in the electronic device according to claim 6, the printing material is made of a conductive member, and the conductive member is formed by a step between the surface of the substrate to be mounted and the surface of the electronic member. The disconnection which arises can be suppressed.
(第1の実施の形態)
以下、本発明の第1の実施の形態を図に基づいて説明する。図1は、本発明の第1の実施の形態における電子装置の模式的な断面図であり、(a)は回路基板の断面図であり、(b)は回路基板に回路素子を実装した際の断面図であり、(c)は導電性ペーストを印刷する際の断面図であり、(d)は回路基板と回路素子をスクリーン印刷にて電気的に接続した際の断面図である。図2は、本発明の第1の実施の形態における複数の回路素子を備える電子装置の模式的な断面図である。
(First embodiment)
Hereinafter, a first embodiment of the present invention will be described with reference to the drawings. FIG. 1 is a schematic cross-sectional view of an electronic device according to a first embodiment of the present invention, (a) is a cross-sectional view of a circuit board, and (b) is when a circuit element is mounted on the circuit board. (C) is a cross-sectional view when the conductive paste is printed, and (d) is a cross-sectional view when the circuit board and the circuit element are electrically connected by screen printing. FIG. 2 is a schematic cross-sectional view of an electronic device including a plurality of circuit elements according to the first embodiment of the present invention.
本実施の形態における電子装置は、導電性ペースト(導電性部材)30によって電気的に接続された回路基板10と回路素子20とを含むものである。なお、回路基板10は、本発明の被実装基材に相当するものであり、回路素子20は、本発明の電子部材に相当するものであり、導電性ペースト(導電性部材)30は、本発明の導電性部材に相当するものである。
The electronic device in the present embodiment includes a
回路基板10は、図1(a)に示すように基板側電極11、回路素子20を実装する段差である実装部12などを備える。この実装部12は、回路基板10の表面と回路素子20の表面との段差を低減させるためのものであり、回路素子20の外形に応じた形状であり、回路基板10と回路素子20との間に略隙間がないように回路素子20を挿入できる程度の大きさを有する。また、実装部12の深さは、回路素子20の厚さと略同じとすることによって、回路素子20を実装部12に実装した際に、回路基板10の表面と回路素子20の表面とが略同一平面上に位置することとなり好適である。
As shown in FIG. 1A, the
なお、回路基板10に関しては、熱可塑性樹脂からなる樹脂フィルムと導体パターンとを交互に積層し、加熱しつつ加圧することによって形成される多層基板でもよい。この場合、実装部12は、回路基板10を形成する樹脂フィルムのうち、回路素子20の厚みに相当する程度の枚数の樹脂フィルムに回路素子20に応じた形状の開口を施す。そして、多層基板の表面となる方に開口部を備える樹脂フィルムを積層し、この樹脂フィルムの開口位置を揃えて、多層基板を構成するほかの樹脂フィルムと一緒に加熱しつつ加圧することによって形成する。回路素子20は、MOSFETやトランジスタなどの回路構成要素が形成されるものであり素子側電極21などを備える。
The
ここで、本実施の形態における電子装置の製造方法に関して説明する。まず、回路基板10の実装部12に回路素子20を接着するための接着剤(図示せず)を塗布する。次に、図1(b)に示すように実装部12に回路素子20を挿入することによって回路基板10と回路素子20とを接着固定する。このように回路基板10の実装部12に回路素子20が実装された状態においてスクリーン印刷工程を行う。
Here, a method for manufacturing the electronic device in the present embodiment will be described. First, an adhesive (not shown) for bonding the
スクリーン印刷工程には、電子装置に施す導電性ペースト30のパターン(以下、配線パターンとも称する)に応じた開口部81を備えたスキージ板80、スキージ板80に充填されている印刷材料である導電性ペースト30を開口部81から押し出すためのスキージ82などを用いる。
In the screen printing process, a
スクリーン印刷工程においては、まず、図1(c)に示すようにスキージ板80を開口部81が回路基板10の配線パターンと対応するように位置合わせした状態で回路基板10の表面に密接させる。次に、導電性ペースト30をスキージ板80に押し付けるようにしてスキージ82を移動させる。図1(c)に示す例では、紙面右から左へ移動させる。
In the screen printing process, first, as shown in FIG. 1C, the
このスキージ82の移動に伴って導電性ペースト30が開口部81から押し出されることによって、図1(d)に示すように回路基板10と回路素子20とに渡って導電性ペースト30が印刷される。そして、印刷された導電性ペースト30によって基板側電極11と素子側電極21とが接続され、回路基板10と回路素子20とが電気的に接続される。
As the
このように、回路基板10に設けた実装部12に回路素子20を挿入することによって回路基板10の表面と回路素子20の表面との段差が低減される。従って、実装部12に回路素子20を挿入した状態で、回路基板10と回路素子20とに渡って導電性ペースト30を印刷する際に、回路基板10の表面と回路素子20の表面との段差の付け根付近に隙間が生じにくく、導電性ペースト30の断線を抑制することができる。
As described above, the step between the surface of the
また、図2に示すように回路基板10に複数の実装部12を設けるようにしてもよい。回路基板10に複数の回路素子20を実装するような場合であっても、複数の実装部12を設けることによって、回路基板10における回路素子20との段差による凸凹が減少され導電性ペースト30を一括でスクリーン印刷することができる。
Further, as shown in FIG. 2, a plurality of mounting
また、回路素子20に保護膜をスクリーン印刷する場合でも、実装部12を設けることによって回路基板10における回路素子20との段差による凸凹が減少されるので保護膜を一括でスクリーン印刷することができる。さらに、回路基板10における回路素子20との段差による実装面の凸凹が減少されるので、保護膜の損傷による保護機能の低下を抑制することができる。
Further, even when the protective film is screen-printed on the
なお、本実施の形態においては、基板側電極11及び素子側電極21上に導電性ペースト30を印刷する例を用いて説明したが、本発明はこれに限定されるものではない。基板側電極11及び素子側電極21を導電性ペースト30のスクリーン印刷によって形成するようにしてもよい。こうすることによって、基板側電極11及び素子側電極21を設ける必要がなくなる。
In the present embodiment, the example in which the
なお、本実施の形態においては、電子部材として回路素子20を用いる例にて説明したが、本発明はこれに限定されるものではなく、回路基板、センサ素子、半導体基板などの電子部材でもよい。
In the present embodiment, the
(第2の実施の形態)
次に、本発明の第2の実施の形態を図3に基づいて説明する。図3は、本発明の第2の実施の形態における電子装置の模式的な平面図である。
(Second Embodiment)
Next, a second embodiment of the present invention will be described with reference to FIG. FIG. 3 is a schematic plan view of an electronic device according to the second embodiment of the present invention.
第2の実施の形態における電子装置は、第1の実施の形態によるものと共通するところが多いので、以下、共通部分についての詳しい説明は省略し、異なる部分を重点的に説明する。第2の実施の形態において、第1の実施の形態と異なる点は、電子部材として湿度センサ40用の半導体基板と処理回路50(回路素子)とを用いた点である。
Since the electronic device according to the second embodiment is often in common with that according to the first embodiment, a detailed description of the common parts will be omitted, and different parts will be described mainly. The second embodiment is different from the first embodiment in that a semiconductor substrate for the
本実施の形態における電子装置は、回路基板10の実装部12に湿度センサ40用の半導体基板と処理回路50とが実装され、この湿度センサ40と処理回路50とが接続部42(導電性ペースト30)で電気的に接続されている。
In the electronic device according to the present embodiment, the semiconductor substrate for the
湿度センサ40は、容量式湿度センサであり、湿度に応じて一対の湿度検出電極41間の静電容量が変化するものである。この湿度センサ40は、シリコンなどの半導体基板の上面に絶縁膜として酸化シリコン膜が形成されている。そして、湿度センサ40は、この酸化シリコン膜上の略同一平面に一対の湿度検出電極41が離間して対向配置される。
The
湿度検出電極41の形状は特に限定されるものではないが、本実施の形態においては、図3に示すように、一対の櫛歯形状の電極が対向する状態で配置されている。このように櫛歯形状を用いることにより、湿度検出電極41の配置面積を小さくしつつ、櫛歯部が互いに対向する面積を大きくすることができる。これにより、周囲の湿度変化に伴って変化する湿度検出電極41間の静電容量の変化量が大きくなり、容量式湿度センサの感度が向上する。
The shape of the
そして、水分によって湿度検出電極41が腐食するのを抑制するために、湿度検出電極を覆うように保護膜としての窒化シリコン膜が形成されている。さらに、窒化シリコン膜40の上には、吸湿性の高分子材料からなる感湿膜が形成されている。
And in order to suppress that the
処理回路50は、湿度センサ40からの検出信号(静電容量値)を信号処理したり、検出信号を補正したりする回路であり、CMOSトランジスタや電極などが形成されている。そして、処理回路50の表面にも保護膜が形成されている。
The
ここで、本実施の形態における電子装置の製造方法に関して説明する。まず、回路基板10の実装部12に接着剤を塗布する。次に、実装部12に湿度センサ40用の半導体基板と処理回路50とを挿入して回路基板10と湿度センサ40用の半導体基板、処理回路50とを接着固定する。
Here, a method for manufacturing the electronic device in the present embodiment will be described. First, an adhesive is applied to the mounting
このように回路基板10の実装部12に湿度センサ40用の半導体基板と処理回路50とが実装された状態においてスクリーン印刷工程を行う。本実施の形態におけるスクリーン印刷は、湿度検出電極41と接続部42とを構成する導電性ペースト30を一括でスクリーン印刷する。
In this manner, the screen printing process is performed in a state where the semiconductor substrate for the
上述の実施の形態のように、スキージ板80を湿度センサ40用の半導体基板及び処理回路50が実装部12に挿入された回路基板10に位置合わせした状態で密接させる。そして、導電性ペースト30をスキージ板80に押し付けるようにしてスキージ82を移動させることによって湿度センサ40用の半導体基板と処理回路50とに渡って導電性ペースト30が印刷される。このようにして、湿度検出電極41及び接続部42が形成されることによって湿度センサ40と処理回路50とが電気的に接続される。
As in the above-described embodiment, the
さらに本実施の形態においては、導電性ペースト30が印刷された回路基板10、湿度センサ40用の半導体基板及び処理回路50の表面に窒化シリコン膜からなる保護膜がスクリーン印刷される。そして、湿度センサ40の表面のみに吸湿性の高分子材料からなる感湿膜がスクリーン印刷される。
Furthermore, in the present embodiment, a protective film made of a silicon nitride film is screen-printed on the surface of the
このように、回路基板10に設けた実装部12に湿度センサ40用の半導体基板及び処理回路50を挿入することによって回路基板10の表面と湿度センサ40用の半導体基板及び処理回路50の表面との段差が低減される。従って、湿度検出電極41と接続部42とを構成する導電性ペースト30を一括でスクリーン印刷することができる。
In this way, by inserting the semiconductor substrate and
なお、本実施の形態においては、センサ素子である湿度センサ40と回路素子である処理回路50をそれぞれ単数設ける例を用いて説明したが、本発明はこれに限定されるものではない。複数の湿度センサ40及び複数の処理回路50を用いるようにしてもよいし、複数の湿度センサ40及び単数の処理回路50を用いるようにしてもよいし、単数の湿度センサ40及び複数の処理回路50を用いるようにしてもよい。
Although the present embodiment has been described using an example in which a
また、本実施の形態においては、電子部材として回路素子である処理回路50を用いる例にて説明したが、本発明はこれに限定されるものではなく、処理回路50が実装された回路基板でもよい。
In the present embodiment, the
(第3の実施の形態)
次に、本発明の第3の実施の形態を図4に基づいて説明する。図4は、本発明の第3の実施の形態における電子装置の模式的な斜視図である。
(Third embodiment)
Next, a third embodiment of the present invention will be described with reference to FIG. FIG. 4 is a schematic perspective view of an electronic device according to the third embodiment of the present invention.
第3の実施の形態における電子装置は、上述の実施の形態によるものと共通するところが多いので、以下、共通部分についての詳しい説明は省略し、異なる部分を重点的に説明する。第3の実施の形態において、第1の実施の形態と異なる点は、被実装基材としてコネクタ70を実装する筐体60、電子部材としてコネクタ70の端子71及び回路基板10を用いた点である。
Since the electronic device according to the third embodiment is often in common with that according to the above-described embodiment, a detailed description of the common parts will be omitted, and different parts will be mainly described below. The third embodiment is different from the first embodiment in that a
筐体60は、図4(a)に示すように実装部61、端子実装部62などを備える。実装部61は、上述の実施の形態における実装部12と同じものであるので説明は省略する。端子実装部62は、筐体60の表面とコネクタ70の端子71の表面との段差を低減させるためのものであり、端子71の外形に応じた形状であり、筐体60と端子71との間に略隙間がないように端子71を挿入できる程度の大きさを有する。また、端子実装部62の深さは、端子71の厚さと略同じとすることによって、端子71を筐体60に実装した際に、筐体60の表面と端子71の表面とが略同一平面となり好適である。
The
ここで、本実施の形態における電子装置の製造方法に関して説明する。まず、筐体60の実装部61及び端子実装部62に接着剤を塗布する。次に、実装部61に回路基板10を挿入して筐体60と回路基板10とを接着固定すると共に、端子実装部62に端子71を挿入して筐体60と端子71(コネクタ70)とを接着固定する。
Here, a method for manufacturing the electronic device in the present embodiment will be described. First, an adhesive is applied to the mounting
このように筐体60の実装部61及び端子実装部62に回路基板10及び端子71が実装された状態においてスクリーン印刷工程を行う。上述の実施の形態のように、スキージ板80を回路基板10及び端子71が実装部に挿入された筐体60に位置合わせした状態で密接させる。そして、導電性ペースト30をスキージ板80に押し付けるようにしてスキージ82を移動させることによって回路基板10と端子71とに渡って導電性ペースト30が印刷される。
Thus, the screen printing process is performed in a state where the
このように、筐体60に設けた端子実装部62に端子71を挿入することによって筐体60の表面と端子71の表面との段差が低減される。従って、実装部61に回路基板10を挿入した状態及び端子実装部62に端子71を挿入した状態で、回路基板10と端子71とに渡って導電性ペースト30を印刷する際に、筐体61の表面と回路基板10の表面及び端子71の表面との段差の付け根付近に隙間が生じにくく、導電性ペースト30の断線を抑制することができる。
As described above, by inserting the terminal 71 into the
なお、本実施の形態においては、電子部材として回路基板50を用いる例にて説明したが、本発明はこれに限定されるものではなく、電子部材としては回路素子、センサ素子、半導体基板などであってもよい。
In the present embodiment, the
10 回路基板、11 基板側電極、12 実装部、20 回路素子、21 素子側電極、30 導電性ペースト(導電性部材)、40 湿度センサ、41 湿度検出電極、42 接続部、50 処理回路、60 筐体、61 実装部、62 端子実装部、70 コネクタ、71 端子、80 スキージ板、81 開口部、82 スキージ
DESCRIPTION OF
Claims (6)
前記被実装基材は、前記電子部材を実装する位置に当該電子部材の外形に応じた段差からなる実装部を有することを特徴とする電子装置。 In an electronic device in which an electronic member is mounted on a substrate to be mounted, and a printing material is provided by screen printing across the surface of the substrate to be mounted and the surface of the electronic member,
The electronic device according to claim 1, wherein the mounting substrate has a mounting portion having a step corresponding to the outer shape of the electronic member at a position where the electronic member is mounted.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004245668A JP2006066530A (en) | 2004-08-25 | 2004-08-25 | Electronic device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004245668A JP2006066530A (en) | 2004-08-25 | 2004-08-25 | Electronic device |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2006066530A true JP2006066530A (en) | 2006-03-09 |
Family
ID=36112752
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004245668A Pending JP2006066530A (en) | 2004-08-25 | 2004-08-25 | Electronic device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2006066530A (en) |
-
2004
- 2004-08-25 JP JP2004245668A patent/JP2006066530A/en active Pending
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR200458765Y1 (en) | Resistive touch panel | |
RU2506627C2 (en) | Touch panel and method for production thereof | |
US7340952B2 (en) | Capacitive humidity sensor | |
JP2000002882A (en) | Liquid crystal display device and its manufacture | |
JP2006309161A5 (en) | ||
TW472205B (en) | Coordinate data input device and method of fabricating the same | |
US11733109B2 (en) | Force sensor and manufacturing method thereof | |
US20050280018A1 (en) | Light-emitting diode | |
US20030231275A1 (en) | Liquid crystal display device | |
EP1536672A4 (en) | Circuit board device and method for board-to-board connection | |
WO2001036987A1 (en) | Probe device, method of manufacture thereof, method of testing substrate using probe device | |
KR20200087716A (en) | Sensor unit and method of interconnecting a substrate and a carrier | |
JP2006066530A (en) | Electronic device | |
KR100510439B1 (en) | Chip on glass package structure of lcd driving chip using dummy projecting pad and packaging method therefor | |
US9766140B2 (en) | Surface mount force sensing module | |
JP4136947B2 (en) | Stress sensor | |
JP2004259750A (en) | Wiring board, connecting wiring board and its inspecting method, electronic device and its manufacturing method, electronic module, and electronic equipment | |
CN216283945U (en) | Photosensitive module and terminal equipment | |
KR101224665B1 (en) | Camera module | |
TWI486598B (en) | Electrical connection assembly and testing method thereof | |
KR101393991B1 (en) | Flexible Printed Cirucit Board and Method of forming The Same | |
JP2012032221A (en) | Wiring board inspection apparatus | |
JP3480293B2 (en) | Electronic component mounting apparatus, mounting method thereof, and liquid crystal panel manufacturing method | |
US20040201387A1 (en) | Circuitry for measuring mechanical stress impressed on a printed circuit board | |
JPH05326202A (en) | Chip component |