JP2005303590A - ローカルタイマ装置 - Google Patents
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Abstract
【解決手段】1/40カウンタ100は、高速クロックを分周してTSFタイマ102に供給し、TSFタイマ102からタイミング同期がとられたTSFタイマ値108が出力される。高速クロックの供給の際に低速クロックに同期して1/40カウンタ100の計数値がレジスタ110に保持され、TSFタイマ値108がレジスタ142に保持される。高速クロックが停止すると低速クロックに同期して、高速クロックと低速クロックとの比に応じて算出した2つの値が所定確率にてレジスタ110の保持値に加算器120にて加算され、加算器120の桁上がりごとに、高速クロックと低速クロックとの比に応じて算出した値が加算器150にてレジスタ142のTSFタイマ値に加算される。高速クロックが再稼働した際、最初のクロックタイミングでレジスタ110の保持値が1/40カウンタ100に設定され、レジスタ142の保持値がTSFタイマ102に設定される。
【選択図】図1
Description
102 TSFタイマ
104 クロックセレクト回路
110,142 レジスタ
120,150 加算器
130 7/10確率回路
116,132,156 セレクタ
206 ベースバンド処理回路
208 40 MHzクロック生成回路
210 32 kHzクロック生成回路
212 タイマ回路
Claims (6)
- 無線LANを形成するアクセスポイントの基準タイマと同期して計数するステーション側のローカルタイマ装置において、該装置は、
該ステーションの動作基準となる高速クロックを入力する第1の入力手段と、
前記高速クロックを計数し、所定周期の基準カウント信号を出力する分周カウンタ手段と、
前記基準カウント信号に基づいて前記基準タイマと同期をとってタイミング同期タイマ値を計数するタイミング同期タイマ手段と、
前記高速クロックよりも低速周波数の低速クロックを入力する第2の入力手段と、
前記高速クロックを基準として該ステーションが動作しているとき、前記低速クロックに同期して前記第1のカウンタの計数値を保持する第1のバッファ手段と、
前記高速クロックを基準として該ステーションが動作しているとき、前記低速クロックに同期して前記タイミング同期タイマ値を保持する第2のバッファ手段と、
前記高速クロックが停止したとき、前記第1のバッファ手段の保持値に、前記低速クロックに同期して、前記高速クロックと前記低速クロックとの比に応じて算出した第1の補正値と第2の補正値とのいずれかを所定確率にて加算する第1の加算手段と、
第1の加算手段の桁上がりごとに、前記高速クロックと前記低速クロックとの比に応じて算出した一定値を前記第2のバッファ手段の前記タイミング同期タイマ値に加算する第2の加算手段とを含み、
前記第1のバッファ手段は、前記低速クロックに同期して、前記高速クロックが再稼働した際の最初の高速クロックタイミングで前記計数値を前記分周カウンタ手段に設定し、
前記第2のバッファ手段は、前記低速クロックに同期して、前記高速クロックが再稼働した際の最初の高速クロックタイミングで前記計数値を前記タイミング同期タイマ手段に設定して、タイミング同期タイマ値を整合することを特徴するローカルタイマ装置。 - 請求項1に記載の装置において、第1のバッファ手段は、前記高速クロックが停止する前に、前記低速クロックに同期して前記計数値を格納し、
第2のバッファ手段は、前記高速クロックが停止する前に、前記低速クロックに同期して前記タイミング同期タイマ値を格納することを特徴とするローカルタイマ装置。 - 請求項2に記載の装置において、第2のバッファ手段は、常時前記低速クロックに同期して、前記タイミング同期タイマ値を格納することを特徴とするローカルタイマ装置。
- 請求項1に記載の装置において、前記高速クロックの発振周波数が40 [MHz]であり、前記低速クロックの発振周波数が32.768 [kHz]であることを特徴とするローカルタイマ装置。
- 請求項4に記載の装置において、前記第1の加算手段は、前記第1の補正値として値"21"を7/10の確率で前記第1のバッファ手段に保持されている計数値に加算し、前記第2の補正値として値"20"を3/10の確率で前記計数値に加算し、
前記第2の加算手段は、前記一定値として値"30"を前記第2のバッファ手段に保持されているタイミング同期タイマ値に加算することを特徴とするローカルタイマ装置。 - 請求項1に記載の装置において、前記タイミング同期タイマ値は、IEEE 803.11規格におけるTSF (Timing Synchronization Function)タイマの値であることを特徴とするローカルタイマ装置。
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