JP2005070488A - Ac type plasma display device and its driving method - Google Patents
Ac type plasma display device and its driving method Download PDFInfo
- Publication number
- JP2005070488A JP2005070488A JP2003300874A JP2003300874A JP2005070488A JP 2005070488 A JP2005070488 A JP 2005070488A JP 2003300874 A JP2003300874 A JP 2003300874A JP 2003300874 A JP2003300874 A JP 2003300874A JP 2005070488 A JP2005070488 A JP 2005070488A
- Authority
- JP
- Japan
- Prior art keywords
- sustain
- scan
- block
- plasma display
- electrode
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
Abstract
Description
本発明は、電極結線(マトリクス)構造によるAC駆動型プラズマディスプレイの駆動方法に関する。 The present invention relates to a driving method of an AC driving type plasma display having an electrode connection (matrix) structure.
大画面化・薄型化が可能なプラズマディスプレイパネル(以下、PDPと称する)は、ガス放電に伴う発光及び紫外線による蛍光体の励起発光を利用した表示パネルであり、1セル当り3本の電極が設けられた3電極放電構造を持つ形が主に用いられる。 A plasma display panel (hereinafter referred to as PDP) that can be made large and thin is a display panel that utilizes light emission associated with gas discharge and excitation light emission of a phosphor by ultraviolet rays, and has three electrodes per cell. A form having a provided three-electrode discharge structure is mainly used.
図5に、放電セルにおける3電極放電構造の模式断面図を示す。放電セル100では、前面ガラス基板101上に、対になるスキャン電極11とサステイン電極12が平行して形成され、スキャン電極11及びサステイン電極12は透明誘電体層102及び保護層103で覆われている。前面ガラス基板101に対向配置される背面ガラス基板104上にはアドレス電極13がスキャン電極11及びサステイン電極12に対し直交して形成され、その上には透明誘電体層105が設けられている。さらに透明誘電体層105の上には蛍光体106が塗布されている。
FIG. 5 shows a schematic cross-sectional view of a three-electrode discharge structure in the discharge cell. In the
この放電セル100においてスキャン電極11とアドレス電極13の間に放電開始電圧Vfよりも高いパルス電圧(書き込みパルス)を印加すると放電が発生する。その時、正電圧を印加しているアドレス電極13上の蛍光体106の壁面には負電荷が蓄積され、負電圧を印加しているスキャン電極11側の保護層103付近の壁面には正電荷が蓄積される。また、同時に正電圧を印加しているサステイン電極12側の保護層103付近の壁面には、アドレス電極13と同じく負電荷が蓄積する。
When a pulse voltage (writing pulse) higher than the discharge start voltage Vf is applied between the
この保護層103、蛍光体106の壁面に蓄積された電荷を壁電荷といい、この壁電荷によって誘起された電圧を壁電圧Vwという。書き込みパルスを印加することで放電を発生させ壁電荷を生成させることをアドレス放電といい、ある単位ライン分のアドレス放電する期間を書き込み期間という。
The charges accumulated on the wall surfaces of the
スキャン電極11側に正電荷、サステイン電極12及びアドレス電極13側に負電荷を蓄積させた状態で、スキャン電極11とサステイン電極12間にパルス状の高電圧Viを印加すると、壁電圧Vwと印加電圧Viとの和(=セル電圧Vc)が放電開始電圧Vfを超えた場合、放電が発生する。一旦、放電が開始されると、常に前放電時の電極とは正負逆極性の壁電荷が再蓄積されるので、スキャン電極11及びサステイン電極12に交互に反転する周期的パルス電圧が印加し続ける間放電は維持される。この放電を維持放電といい、維持放電している期間を維持期間と呼ぶ。
When a pulsed high voltage Vi is applied between the
印加電圧Viは放電開始電圧Vfよりも低く設定し、壁電圧(壁電荷)が無い場合は、セル電圧Vc=Vw+Vi=Vi<Vfとなり、維持放電が発生しないようにする。このように、アドレス放電によって発生する壁電圧Vwの有無により、次に続く維持放電の有無を決定されることで選択的放電が実現できる。 The applied voltage Vi is set lower than the discharge start voltage Vf, and when there is no wall voltage (wall charge), the cell voltage Vc = Vw + Vi = Vi <Vf, so that no sustain discharge occurs. As described above, the selective discharge can be realized by determining the presence or absence of the subsequent sustain discharge based on the presence or absence of the wall voltage Vw generated by the address discharge.
図6は、従来のプラズマディスプレイ装置の概略構成を示すブロック図である。PDP1は複数のスキャン電極11、複数のサステイン電極12及び複数のアドレス電極13を有する。複数のアドレス電極13は画面垂直方向に配列され、複数のスキャン電極11及び複数のサステイン電極12は画面水平方向に対になって配列されている。複数のサステイン電極12はすべて同電位になるよう共通化されている。スキャン電極11、サステイン電極12及びアドレス電極13の各交点に放電セル100が形成され、表示画面上の画素として機能する。
FIG. 6 is a block diagram showing a schematic configuration of a conventional plasma display device. The
スキャン回路111は複数のスキャン電極11を順に駆動し、サステイン回路112は複数のサステイン電極12を共通に駆動する。アドレス回路113は映像データに応じて複数のアドレス電極13を1ライン分同時に駆動する。
The
図7にAC型プラズマディスプレイ装置を駆動する際の駆動方法である、アドレス・発光分離(Address Display−period Separated)駆動方式を示す。以下、ADS駆動方式と略する。TV信号は、一般に1秒間に60枚の画像を重ね合わせて映像を表示している。約16.6msecに1回の割合で画像を形成することになる。その16.6msecに相当する時間を1TVフィールドとする。 FIG. 7 shows an Address Display-Period Separated driving method, which is a driving method for driving an AC type plasma display device. Hereinafter, it is abbreviated as ADS driving method. The TV signal generally displays video by superimposing 60 images per second. An image is formed at a rate of about once every 16.6 msec. The time corresponding to 16.6 msec is defined as 1 TV field.
図7に示すように、その1TVフィールドは、複数のサブフィールドSF1、SF2〜SFNに分割されており、各サブフィールドは書き込み期間Tadrと維持期間Tsus1、Tsus2〜TsusNから構成される。書き込み期間Tadrでは、表示させるライン数分に相当する個数のスキャンパルスを順にスキャンする。 As shown in FIG. 7, the 1TV field is divided into a plurality of subfields SF1, SF2 to SFN, and each subfield includes a writing period Tadr and sustain periods Tsus1, Tsus2 to TsusN. In the writing period Tadr, the scan pulses corresponding to the number of lines to be displayed are sequentially scanned.
図8はADS駆動方式におけるスキャン電極11、サステイン電極12及びアドレス電極13の動作波形の一例を示す。図8に示すように、アドレス電極13は、書き込み期間Tadrにおいて、各ラインに表示するデータを各ラインのスキャンパルス幅Tsc内でHレベルもしくはLレベルを設定する。H/Lレベルに対応するアドレス電圧は、それぞれ約60/0Vである。アドレス電極13によりHレベルの電圧を印加された各ライン上の各画素空間には、壁電荷が蓄積されている。Lレベルの場合には壁電荷は蓄積されていない。壁電荷が蓄積されている画素は、各維持期間Tsusi(N=1〜N)では放電が開始、維持されることとなる。
FIG. 8 shows an example of operation waveforms of the
各サブフィールドの維持期間Tsus1、Tsus2〜TsusNは、それぞれの重み付け比率が2の累乗(1(=20):2(=21):4(=22):〜:2(N-1))になるよう設定されている。各サブフィールドの発光時間を選択的に組み合わせることで、1〜2N段階の多階調表示をしている。例えば、N=8の場合、1TVフィールドは8個のサブフィールドで構成され、28=256階調表示が可能となる。 The sustain periods Tsus1, Tsus2 to TsusN of the subfields are powers of 2 (1 (= 2 0 ): 2 (= 2 1 ): 4 (= 2 2 ): ˜: 2 (N−1) ) ) Is set. By selectively combining the light emission times of the subfields, a multi-gradation display of 1 to 2 N stages is performed. For example, when N = 8, one TV field is composed of eight subfields, and 2 8 = 256 gradation display is possible.
しかしADS駆動方式では、一定期間の書き込み期間Tadrを各サブフィールドにて確保する必要があり、少なくとも(サブフィールド数×Tadr)期間は非発光となる。階調数を多くするためにサブフィールドが増やす程またHDなどの高解像度表示にする程、非発光期間は多くなり、1TVフィールドに対する発光時間は減り輝度を確保できないという課題がある。例えば、NTSC信号で画面上下2分割する駆動する場合、走査パルスTsc=8μsec程度に設定され、書き込み期間Tadr=8×480/2=1.92(msec)となる。6bitで多階調表示する際には、全書き込み期間は1.92×6=11.52(msec)となり、1TVフィールド16.6(msec)に対する発光時間の比率は(16.6−11.52)/16.6=30.6%と低い。 However, in the ADS driving method, it is necessary to secure a writing period Tadr of a certain period in each subfield, and at least (the number of subfields × Tadr) period does not emit light. As the number of sub-fields is increased in order to increase the number of gradations and the high resolution display such as HD is performed, the non-light emission period increases, and there is a problem that the light emission time for one TV field decreases and the luminance cannot be secured. For example, in the case of driving to divide the screen up and down by the NTSC signal, the scanning pulse Tsc is set to about 8 μsec, and the writing period Tadr = 8 × 480/2 = 1.92 (msec). When 6-bit multi-gradation display is performed, the total writing period is 1.92 × 6 = 11.52 (msec), and the ratio of the emission time to 1TV field 16.6 (msec) is (16.6-11. 52) /16.6=30.6%.
そこで、図6に示すようなプラズマディスプレイ装置において高輝度を確保するための手段の一つとして、特許文献1のような維持ブロック駆動方式が提案されている。これは、全ラインをスキャン・維持する維持ブロック毎に分割し、維持ブロック毎にアドレスおよび維持発光させるタイミングをシフトさせる方式である。以下、維持ブロック分割したADS駆動方式の一例について図9を用いて説明する。
Therefore, as one of means for ensuring high brightness in the plasma display device as shown in FIG. 6, a sustain block driving method as in
図9に示すプラズマディスプレイ装置におけるPDP1は、複数のスキャン電極11、サステイン電極12及びアドレス電極13を含み、アドレス電極13が画面の垂直方向に配列され、スキャン電極11及びサステイン電極12は画面の水平方向に配列されている。スキャン電極11、サステイン電極12及びアドレス電極13の各交点に放電セル100が形成され、各放電セル100が表示画面上の画素を構成する。そして、維持ブロック駆動をするために、例えば、全Mラインを4つの維持ブロック毎のスキャン回路、サステイン回路に分ける。
The
図10は、図9のPDP1におけるスキャン電極11、サステイン電極12及びアドレス電極13に対して駆動電圧を印加するタイミングの一例を示すものである。
FIG. 10 shows an example of the timing at which the drive voltage is applied to the
まず、第1サブフィールドSF1では、第1〜第4の維持ブロックに対して初期化Initが行われた後、第1維持ブロックの書き込み期間Tadrが開始され、維持期間Tsusへと続く。次に、第1維持ブロックの維持期間Tsusの約半分が終了した時点で第2維持ブロックの維持期間Tsusが開始されるように、第1維持ブロックの維持期間Tsusの開始から所定時間経過後に第2維持ブロックの書き込み期間Tadrが開始され、第2維持ブロックの書き込み期間Tadrが終了した後、第2維持ブロックの維持期間Tsusが開始される。以降第2維持ブロックと同様に第3及び第4維持ブロックの書き込み期間Tadr及び維持期間Tsusが開始される。第2サブフィールドSF2以降も同様に、維持ブロック毎にタイミングがシフトされた形で初期化Init、書き込み期間Tadr、維持期間Tsusが逐次実行される。 First, in the first subfield SF1, after the initialization Init is performed on the first to fourth sustain blocks, the first sustain block write period Tadr is started and continues to the sustain period Tsus. Next, after the lapse of a predetermined time from the start of the sustain period Tsus of the first sustain block, the sustain period Tsus of the second sustain block is started when about half of the sustain period Tsus of the first sustain block ends. After the second sustain block write period Tadr is started and the second sustain block write period Tadr ends, the second sustain block sustain period Tsus starts. Thereafter, similarly to the second sustain block, the write period Tadr and the sustain period Tsus of the third and fourth sustain blocks are started. Similarly, after the second subfield SF2, the initialization Init, the write period Tadr, and the sustain period Tsus are sequentially executed in a form in which the timing is shifted for each sustain block.
ここで、上述の維持ブロック駆動においては、維持ブロック毎の書き込み期間Tadrは、全ラインの書き込みに要する時間を、分割する維持ブロック数で割った値となり、例えば図10の例では、書き込み期間Tadrは全ライン分の時間の1/4となる。そして、維持ブロック毎におけるADS動作でアドレス時間を短縮し、維持期間を前倒しにしてサブフィールド数を多くし、あるいは維持期間を延長することで高輝度化を図ることが可能となる。
上述した構成においては、一般的に、スキャンドライバの内部構成と出力されるスキャンパルスとの関係は以下のとおりとなる。図11は、64段の出力をもつスキャンドライバを例として示したものであり、スキャンドライバーは大きく分けて、ロジック部と出力部から構成される。 In the configuration described above, generally, the relationship between the internal configuration of the scan driver and the output scan pulse is as follows. FIG. 11 shows an example of a scan driver having 64 outputs, and the scan driver is roughly divided into a logic part and an output part.
ロジック部は、64bitシフトレジスタとラッチ回路から構成される。電源Vddは通常3.3〜5V位の電圧を用いる。64bitシフトレジスタは、シフト入力パルスDIをスキャンクロックSCLK単位で1クロックずつ位相シフトさせ、P0〜P63の64個のシフトパルスを逐一出力し、ラッチ回路は、64bitシフトレジスタから出力された64個のシフトパルスをLE(ラッチイネーブル)信号で一度にラッチする機能を有するが、スキャン動作に用いる場合はラッチせずに、仕様によってHレベルまたはLレベルに固定し、64bitシフトレジスタからの出力をスルーする。このドライバをアドレスドライバとして用いる場合は、スキャンするライン単位時間毎に一度にデータを出力するために上記ラッチ機能を用いる。また、64番目まで位相をシフトされたパルスは、例えば、次のスキャンドライバに渡すためのシフト出力パルスDOとして出力される。スキャンドライバをカスケード接続する場合には、このシフト出力パルスDOは、次段スキャンドライバのシフト入力パルスDIとなる。 The logic part is composed of a 64-bit shift register and a latch circuit. The power supply Vdd usually uses a voltage of about 3.3 to 5V. The 64-bit shift register shifts the phase of the shift input pulse DI one clock at a time in units of the scan clock SCLK and outputs 64 shift pulses P0 to P63 one by one. The latch circuit outputs the 64 shift pulses output from the 64-bit shift register. The shift pulse is latched at a time by an LE (latch enable) signal, but when used for a scan operation, it is not latched, but is fixed at the H level or the L level according to the specification, and the output from the 64-bit shift register is passed through. . When this driver is used as an address driver, the above-mentioned latch function is used to output data at a time every scanning line unit time. Further, the pulse whose phase is shifted up to the 64th is output as, for example, a shift output pulse DO for passing to the next scan driver. When the scan drivers are cascade-connected, the shift output pulse DO becomes the shift input pulse DI of the next-stage scan driver.
次に、振幅Vddの64個のシフトパルスは出力部へ渡される。出力部は、セレクタ回路とアンプ回路から構成され、64個のシフトパルスは、OE(アウトプットイネーブル)信号で出力選択され、そしてアンプ回路で振幅Vh=約100〜130Vのスキャンパルスに増幅される。また、出力保護のため、出力段がVhとVssレベルの両方にダイオードを介して接続されている。 Next, 64 shift pulses of amplitude Vdd are passed to the output unit. The output unit is composed of a selector circuit and an amplifier circuit. The 64 shift pulses are output-selected by an OE (output enable) signal, and amplified by the amplifier circuit to a scan pulse having an amplitude Vh = about 100 to 130V. . For output protection, the output stage is connected to both the Vh and Vss levels via a diode.
ここで、VssはGNDレベルではなく、スキャン回路の出力電圧レベルに設定される。ここで述べる出力電圧レベルとは、回路的にスキャンドライバに入力する以前の電圧値を指す。スキャンドライバの耐圧は約130Vが上限であるが、実際にスキャン電極に印加する出力電圧は振幅200V以上の電圧であるため、動作基準レベルであるVssをGNDレベルに設定すると、そのまま出力電圧レベルを入力すると耐圧を超えてしまいドライバを破壊することになる。Vssに出力電圧レベルを設定すれば、そのVss電圧レベルに対しスキャンドライバが動作することになる。スキャンドライバに印加されるのはスキャンドライバ動作電圧Vhのみになり、耐圧を超えることなくスキャンドライバを動作させ、スキャンパルスをスキャン電極に印加することができる。 Here, Vss is set not at the GND level but at the output voltage level of the scan circuit. The output voltage level described here refers to a voltage value before being input to the scan driver in a circuit form. The upper limit of the breakdown voltage of the scan driver is about 130V, but the output voltage actually applied to the scan electrode is a voltage having an amplitude of 200V or more. Therefore, if the operation reference level Vss is set to the GND level, the output voltage level is set as it is. If it is input, the breakdown voltage will be exceeded and the driver will be destroyed. If the output voltage level is set to Vss, the scan driver operates with respect to the Vss voltage level. Only the scan driver operating voltage Vh is applied to the scan driver, and the scan driver can be operated without exceeding the breakdown voltage, and the scan pulse can be applied to the scan electrode.
このスキャンクロックを必要とするのは書き込み期間のみで、それ以外の期間は停止させている。スキャンパルスがスキャンドライバ内部のシフトレジスタ内をシフトし終えた後もシフトクロックを動作させると、無駄な電力を消費し、かつ電磁波の不要輻射ノイズも多くなってしまうためである。すなわち、従来のADS駆動方式においては、各サブフィールド内の書き込み期間は、全ラインが同じタイミングで始まり同じタイミングで終了する。書き込み特性の均一化を図るために画面上下で書き込み期間を多少変化させているが、ほぼ同じ時間位置で、ラインをスキャンしデータを書き込んでいる。このとき、各サブフィールドの書き込み期間内に、スキャンクロック周波数をもって全スキャンドライバが一斉に動作することになり、スキャンドライバを駆動するだけの電流が流れる。不要輻射は、一般に輻射源を流れる電流値の2乗に比例し大きくなり、この場合スキャンクロックの周波数帯付近における電磁波の不要輻射のピークが、スキャンドライバ1個を駆動する場合に比べ大きくなる。また、スキャンし終えたスキャンドライバがシフトするスキャンパルスのないまま書き込み期間内でスキャンクロック周波数をもって動作することになり、余分の電力を消費する。書き込み期間に一斉にスキャンドライバがスキャンクロックにて動作することで、例えばクロック動作開始時に流れるピーク電流が増大し、電源の一時的負荷が大きくなってしまう。 This scan clock is required only during the writing period, and is stopped during other periods. This is because if the shift clock is operated even after the scan pulse has been shifted in the shift register inside the scan driver, useless power is consumed and unnecessary radiation noise of electromagnetic waves increases. That is, in the conventional ADS driving method, the writing period in each subfield starts at the same timing and ends at the same timing. In order to make the writing characteristics uniform, the writing period is slightly changed at the top and bottom of the screen, but the line is scanned and data is written at substantially the same time position. At this time, all the scan drivers operate simultaneously with the scan clock frequency within the writing period of each subfield, and a current sufficient to drive the scan drivers flows. Unnecessary radiation generally increases in proportion to the square of the current value flowing through the radiation source, and in this case, the peak of unnecessary radiation of electromagnetic waves near the frequency band of the scan clock becomes larger than when one scan driver is driven. In addition, the scan driver that has finished scanning operates at the scan clock frequency within the writing period without a scan pulse to shift, and consumes extra power. When the scan driver simultaneously operates with the scan clock during the writing period, for example, the peak current flowing at the start of the clock operation increases, and the temporary load of the power supply increases.
本発明は上記課題に鑑みてなされたものであり、電磁波の不要輻射を低減することで消費電力を削減し、また、不要輻射のピークを抑えることで不要な電磁波の不要輻射を防止するための部品点数を削減し、低コスト化することができるAC型プラズマディスプレイ装置およびその駆動方法を実現することを目的とする。 The present invention has been made in view of the above problems, and reduces power consumption by reducing unnecessary radiation of electromagnetic waves, and prevents unnecessary radiation of unnecessary electromagnetic waves by suppressing the peak of unnecessary radiation. It is an object of the present invention to realize an AC type plasma display apparatus and a driving method thereof that can reduce the number of parts and reduce the cost.
上記目的を実現するために本発明のAC型プラズマディスプレイ装置は、放電空間を挟んで対向配置された前面基板及び背面基板と、前記前面基板の内面に設けられたスキャン電極とサステイン電極で構成されるM個の行電極対と、前記行電極対を覆う誘電体を含む保護層と、前記背面基板の内面に設けられ前記行電極対に交差して配列されたL個のアドレス電極と、前記列電極を覆う誘電体層と、前記誘電体層を覆う蛍光体層と、前記背面基板に形成された隔壁間に塗布されている蛍光体と前記放電空間に充填された紫外光発生用の放電気体によって形成された三原色の放電発光セル群とを具備し、複数の前記サステイン電極を共通接続した結線群を1単位とする複数の維持ブロックと、複数の前記スキャン電極に放電電圧を印加するための多段出力を持つ複数のスキャンドライバを有するM×Lマトリクス構造のAC型プラズマディスプレイ装置において、前記維持ブロックの各々に対し、前記スキャンドライバから前記維持ブロックの各々へ出力されるスキャン動作パルスを独立に動作及び停止させる制御回路を有することを特徴とするものである。 In order to achieve the above object, an AC type plasma display apparatus according to the present invention includes a front substrate and a rear substrate that are disposed to face each other with a discharge space therebetween, and a scan electrode and a sustain electrode provided on the inner surface of the front substrate. M row electrode pairs, a protective layer including a dielectric covering the row electrode pairs, L address electrodes provided on the inner surface of the back substrate and arranged to intersect the row electrode pairs, A dielectric layer covering the column electrode, a phosphor layer covering the dielectric layer, a phosphor applied between the barrier ribs formed on the back substrate, and a discharge for generating ultraviolet light filled in the discharge space A discharge light emitting cell group of three primary colors formed by gas, for applying a discharge voltage to a plurality of sustain blocks each having a connection group in which a plurality of the sustain electrodes are connected in common and a plurality of the scan electrodes; In an AC plasma display device having an M × L matrix structure having a plurality of scan drivers having multi-stage outputs, scan operation pulses output from the scan driver to the sustain blocks are independently applied to the sustain blocks. It has a control circuit for operating and stopping.
また、上記目的を実現するために本発明のAC型プラズマディスプレイ装置の駆動方法は、本発明のAC型プラズマディスプレイ装置の駆動方法であって、映像信号の各フィールドを複数個に分割したサブフィールド駆動を用い、各サブフィールドでは、(1)放電セルを初期化する初期期間、(2)各維持ブロック内の複数の前記スキャン電極にはそれぞれ位相のシフトしたスキャンパルスを含むスキャン電圧波形を順に印加し、前記アドレス電極には前記スキャンパルスの印加されるタイミングで映像信号に対応した書き込みパルスを印加する書き込み期間、(3)交互に反転した周期的電圧パルスを前記スキャン電極及び前記サステイン電極に印加する維持期間、の順に設定し、前記スキャン電極、前記サステイン電極及び前記アドレス電極へ印加する駆動電圧パルスのタイミングを、前記維持ブロックごとに一定の時間間隔をおいて順にシフトさせ、前記維持ブロックの各々の所定期間にスキャン動作パルスを動作及び停止させることを特徴とするものである。 In order to achieve the above object, a driving method for an AC plasma display apparatus according to the present invention is a driving method for an AC plasma display apparatus according to the present invention, in which each field of a video signal is divided into a plurality of subfields. In each subfield, (1) an initial period for initializing a discharge cell, and (2) a scan voltage waveform including a scan pulse whose phase is shifted to each of the plurality of scan electrodes in each sustain block. A write period in which a write pulse corresponding to a video signal is applied to the address electrode at the timing when the scan pulse is applied; (3) periodic voltage pulses that are alternately inverted are applied to the scan electrode and the sustain electrode. The sustain period to be applied is set in order of the scan electrode, the sustain electrode, and the address. The timing of the drive voltage pulse applied to the electrodes is sequentially shifted at a certain time interval for each sustain block, and the scan operation pulse is activated and stopped during each predetermined period of the sustain block. It is.
本発明のAC型プラズマディスプレイ装置及び駆動方法によれば、複数のサステイン電極を共通接続した結線群を1単位とする複数の維持ブロックと、各維持ブロック別のスキャン電極に放電電圧を印加するスキャンドライバを有するマトリクス構造のAC型プラズマディスプレイ装置において、維持ブロック毎にスキャンクロックを動作または停止させることで、電磁波の不要輻射を低減し、かつ消費電力を削減することができる。また、各維持ブロックのスキャンクロックの周波数を可変させることで不要輻射のピークを抑えることができ、もって、不要な電磁波の不要輻射を防止する種々の対策のための部品点数が削減でき、より低コスト化することができる。 According to the AC type plasma display apparatus and the driving method of the present invention, a plurality of sustain blocks each including a connection group in which a plurality of sustain electrodes are connected in common and a scan voltage for applying a discharge voltage to the scan electrodes of each sustain block In an AC plasma display device having a matrix structure having a driver, unnecessary radiation of electromagnetic waves can be reduced and power consumption can be reduced by operating or stopping the scan clock for each sustain block. In addition, by changing the frequency of the scan clock of each maintenance block, the peak of unnecessary radiation can be suppressed, and the number of parts for various measures to prevent unnecessary radiation of unnecessary electromagnetic waves can be reduced. Cost can be increased.
また、現在技術革新が著しいプラズマディスプレイ装置をはじめとする映像表示装置に関して、不要輻射及び消費電力を低減する本発明を用いれば、地球環境にも優しいこととなる。 In addition, with respect to video display devices such as plasma display devices that are currently undergoing significant technological innovation, the present invention that reduces unnecessary radiation and power consumption is friendly to the global environment.
すなわち、本発明の請求項1に記載の発明は、放電空間を挟んで対向配置された前面基板及び背面基板と、前記前面基板の内面に設けられたスキャン電極とサステイン電極で構成されるM個の行電極対と、前記行電極対を覆う誘電体を含む保護層と、前記背面基板の内面に設けられ前記行電極対に交差して配列されたL個のアドレス電極と、前記列電極を覆う誘電体層と、前記誘電体層を覆う蛍光体層と、前記背面基板に形成された隔壁間に塗布されている蛍光体と前記放電空間に充填された紫外光発生用の放電気体によって形成された三原色の放電発光セル群とを具備し、複数の前記サステイン電極を共通接続した結線群を1単位とする複数の維持ブロックと、複数の前記スキャン電極に放電電圧を印加するための多段出力を持つ複数のスキャンドライバを有するM×Lマトリクス構造のAC型プラズマディスプレイ装置において、前記維持ブロックの各々に対し、前記スキャンドライバから前記維持ブロックの各々へ出力されるスキャン動作パルスを独立に動作及び停止させる制御回路を有することを特徴とするAC型プラズマディスプレイ装置である。
That is, the invention described in
また、請求項2に記載の発明は、請求項1記載の発明において、前記維持ブロックの個数が2の累乗であることを特徴とするものである。 According to a second aspect of the present invention, in the first aspect of the present invention, the number of the maintenance blocks is a power of two.
また、請求項3に記載の発明は、請求項1記載の発明において、前記スキャン動作パルスは、前記スキャンドライバを動作させるクロック及びシフトされるスキャンパルスであることを特徴とするものである。
The invention according to
また、請求項4に記載の発明は、請求項1記載の発明において、前記スキャンクロックの周波数は、前記維持ブロックの各々において可変させることを特徴とするものである。 According to a fourth aspect of the present invention, in the first aspect of the present invention, the frequency of the scan clock is varied in each of the sustain blocks.
また、請求項5に記載の発明は、請求項1記載の発明において、前記スキャン動作パルスを独立に動作及び停止させる単位は、少なくとも1つ以上の前記維持ブロックであることを特徴とするものである。 According to a fifth aspect of the present invention, in the first aspect of the invention, the unit for independently operating and stopping the scan operation pulse is at least one of the sustain blocks. is there.
また、請求項6に記載の発明は、請求項1記載の発明において、前記維持ブロックに含まれる個々の前記サステイン電極が互いに隣り合わないように、別の前記維持ブロックに含まれるサステイン電極と交互に配列したことを特徴とするものである。 According to a sixth aspect of the present invention, in the first aspect of the invention, the sustain electrodes included in another sustain block are alternately arranged so that the individual sustain electrodes included in the sustain block are not adjacent to each other. It is characterized by being arranged in.
請求項7に記載の発明は、請求項1から6のいずれかに記載のAC型プラズマディスプレイ装置の駆動方法であって、映像信号の各フィールドを複数個に分割したサブフィールド駆動を用い、各サブフィールドでは、(1)放電セルを初期化する初期期間、(2)各維持ブロック内の複数の前記スキャン電極にはそれぞれ位相のシフトしたスキャンパルスを含むスキャン電圧波形を順に印加し、前記アドレス電極には前記スキャンパルスの印加されるタイミングで映像信号に対応した書き込みパルスを印加する書き込み期間、(3)交互に反転した周期的電圧パルスを前記スキャン電極及び前記サステイン電極に印加する維持期間、の順に設定し、前記スキャン電極、前記サステイン電極及び前記アドレス電極へ印加する駆動電圧パルスのタイミングを、前記維持ブロックごとに一定の時間間隔をおいて順にシフトさせ、前記維持ブロックの各々の所定期間にスキャン動作パルスを動作及び停止させることを特徴とするAC型プラズマディスプレイ駆動方法である。
The invention according to
また、請求項8に記載の発明は、請求項7記載の発明において、前記維持ブロック毎に、前記スキャンクロックの周波数を変化させることを特徴とするものである。
The invention according to
また、請求項9に記載の発明は、請求項8記載の発明において、前記維持ブロックの各々をスキャンする順に、前記スキャンクロックの周波数を低くすることを特徴とするものである。 According to a ninth aspect of the present invention, in the eighth aspect of the invention, the frequency of the scan clock is lowered in the order of scanning each of the sustain blocks.
また、請求項10に記載の発明は、請求項7記載の発明において、前記維持ブロックの各々において、前記スキャンクロックの周波数をサブフィールド順に、かつ、スキャンする前記維持ブロックの順に変化させ、前記サブフィールド順に変化させるスキャンクロックの周波数が、前記維持ブロックをスキャンする順に変化させるスキャンクロックの周波数と一致しないことを特徴とするものである。
Further, in the invention described in
以下、本発明の一実施の形態によるAC型プラズマディスプレイ装置について図面を用いて説明する。図1は、本発明の一実施の形態によるAC型プラズマディスプレイ装置の概略構成を示すブロック図である。 Hereinafter, an AC plasma display apparatus according to an embodiment of the present invention will be described with reference to the drawings. FIG. 1 is a block diagram showing a schematic configuration of an AC type plasma display apparatus according to an embodiment of the present invention.
本発明の一実施の形態によるAC型プラズマディスプレイ装置は、スキャン電極11とサステイン電極12からなる行電極対14(以下、ラインと称する)と、横画素分のアドレス電極13を含むマトリクス構造をもつ。アドレス電極13は画面の垂直方向に配列され、スキャン電極11及びサステイン電極12は画面の水平方向に配列されている。スキャン電極11、サステイン電極12及びアドレス電極13の各交点に放電セル100が形成され、各放電セル100が表示画面上の単位画素を構成する。スキャン回路1Fは、主に、スキャンドライバ1F−1〜1F−6のスキャンドライバ群と、スキャン動作パルスとしてのスキャンクロック1Aやスタートパルス1Bをスキャンブロック制御信号1Cによって時間方向に分配するブロック別切換回路1Dから構成されている。サステイン回路1Gは複数のサステイン電極12の単位本数分を維持ブロック1H−1、1H−2、1H−3毎に共通化し駆動する。アドレス回路(図示せず)は、複数のアドレス電極13を駆動するドライバ回路であり、スキャン電極11に印加されるスキャンパルスのタイミングに同期して、サブフィールド方向に変換された映像データを書き込みパルスとして1ライン毎に横画素分を同時に出力する。
An AC plasma display apparatus according to an embodiment of the present invention has a matrix structure including a row electrode pair 14 (hereinafter referred to as a line) composed of a
図1では、スキャンドライバ1F−1と1F−2、1F−3と1F−4、1F−5と1F−6がそれぞれカスケード接続されており、各維持ブロック1H−1、1H−2、1H−3をスキャンするドライバ回路として機能する。また、各維持ブロック1H−1、1H−2、1H−3が保有するサステイン電極12は、それぞれサステイン回路1G内のサステインドライバ1G−1、1G−2、1G−3に接続されており、サステインドライバ内でそれぞれ共通に結線されている。即ち、サステインドライバの数だけ維持ブロック駆動単位が形成されていることになる。サステインドライバ1G−1を含む駆動単位が第1維持ブロック1H−1、サステインドライバ1G−2を含む駆動単位が第2維持ブロック1H−2、サステインドライバ1G−3を含む駆動単位が第3維持ブロック1H−3となる。アドレス回路は、サブフィールド単位に変換されたシリアルデータをパラレルデータに変換し、そのパラレルデータに基づいて複数のアドレス電極13を駆動する。
In FIG. 1, scan
スキャン回路1Fは、ブロック別切換回路1Dから出力されるスキャンクロック1A及びスタートパルス1Bに応じて、第1維持ブロック1H−1、第2維持ブロック1H−2、第3維持ブロック1H−3のスキャン電極11を順にスキャンする。サステインドライバ1G−1、1G−2、1G−3は、それぞれ第1維持ブロック1H−1、第2維持ブロック1H−2、第3維持ブロック1H−3のサステイン電極12をそれぞれ一括に駆動する。
The
ブロック別切換回路1Dは、スキャンクロック1Aを受け取り、スキャンブロック制御信号1Cに基づいて、各維持ブロック1H−1、1H−2、1H−3をスキャンするためのスキャンクロック1E−1、1E−2、1E−3を出力する。同時に、ブロック別切換回路1Dは、受け取ったスタートパルス1Bをスキャンブロック制御信号1Cに基づいて各維持ブロック1H−1、1H−2、1H−3をスキャンするためのスタートパルス1E−4、1E−5、1E−6を出力する。図1では、スタートパルス1Bをブロック別切換回路1Dから受け取る形にしているが、各維持ブロックの書き込み期間が時間方向に連続して行われる場合は、スキャンし終えた維持ブロックが最後の出力段から出力されるスキャンパルスをスタートパルス1Bとして次段の維持ブロックへ出力した後、前段の維持ブロックのスキャンクロック1E−1、1E−2または1E−3を停止する構成でもよい。
The block switching circuit 1D receives the
各維持ブロック1H−1、1H−2、1H−3へ供給されているスキャンクロック1E−1、1E−2、1E−3は個々に周波数を変化させることも可能である。スキャンクロック1Aとスキャンブロック制御信号1Cとを時間方向で同期させて、該当するスキャンする維持ブロックの選択期間に、所定の周波数をもつスキャンクロック1Aを入力し、スキャンブロック制御信号1Cによりブロック別切換回路1Dを該当する維持ブロックへ切り替えればよい。各維持ブロック1H−1、1H−2、1H−3へ最初から異なる周波数のスキャンクロック1E−1、1E−2、1E−3を入力し続けてもよいが、比較的周波数の高いスキャンクロック(500k〜1MHz程度)を常時入力するのは、ノイズ、消費電力、回路規模等を考慮すると望ましくない。
The scan clocks 1E-1, 1E-2, 1E-3 supplied to the sustain
図1に示すAC型プラズマディスプレイ装置は、従来のスキャン動作パルス出力1系統を、維持ブロック1H−1、1H−2、1H−3毎に各1系統ずつブロック別切換回路1Dでスイッチ分割するような構成となっている。図1では、1つの維持ブロックに対するスキャンドライバの割り当ては2個としている。スキャンするタイミングを決定するスキャンクロック1A及びスキャン動作を開始させるスタートパルス1Bをブロック別切換回路1Dへ入力し、スキャンブロック制御信号1Cによって各維持ブロック1H−1、1H−2、1H−3への割り当て及びタイミングを決定し、個々に出力する。従来の構成では維持ブロックは勿論1系統で、時間方向においてスキャンしないときのスキャンドライバ1G−1、1G−2または1G−3へもスキャンクロック1Aは入力されていることになる。本発明の構成によれば、例えば、スキャンクロック1Aをスキャンしている維持ブロック1H−1、1H−2、1H−3のいずれかのみに供給し、それ以外の維持ブロックへは供給しないことで、スキャンクロック1Aの周波数でピークをもつ電磁波の不要輻射を低減することができる。また、スキャンしている各維持ブロックに対応するスキャンクロック周波数の値を変え、スキャンクロック1Aでの不要輻射のピークを周波数方向に分散させることで、全体的な不要輻射を低減する。
In the AC type plasma display device shown in FIG. 1, one conventional scan operation pulse output system is switch-divided by a block-specific switching circuit 1D for each
同時に、時間方向においてスキャンしないスキャンドライバ1F−1と1F−2、1F−3と1F−4、1F−5と1F−6において、スキャンクロック1E−1、1E−2または1E−3を入力しないことで、スキャンドライバ1G−1、1G−2または1G−3内部のシフトレジスタのロジック動作電力を削減することも可能である。また、書き込み期間内にスキャンドライバ1F−1と1F−2、1F−3と1F−4、1F−5と1F−6に流れるピーク電流を抑制することで、電源の負荷を軽減できる。
At the same time, scan clocks 1E-1, 1E-2, or 1E-3 are not input to scan
以上より、ブロック別切換回路1Dは、維持ブロック1H−1、1H−2、1H−3の各々に対し、スキャンドライバ1F−1と1F−2、1F−3と1F−4、1F−5と1F−6から維持ブロック1H−1、1H−2、1H−3の各々へ出力されるスキャン動作パルスを独立に動作及び停止させる制御回路として機能するものである。
From the above, the block-by-block switching circuit 1D has the
本説明では維持ブロックは3つに設定したが、維持ブロックの個数はこの例に特に限定されず、2分割、6分割、8分割等の他の分割数であってもよい。また、維持ブロックの個数は2の累乗個であると制御回路の簡素化が図れる。仮に維持ブロックの個数が6個だとすると、維持ブロック制御する信号は3bit(3本)必要であり、維持ブロックの個数が8個の場合と制御信号の規模は変わらない。また制御回路内のレジスタ規模を例にとってみても同様のことがいえる。維持ブロックの個数が4個もしくは6個の選択肢がある場合は、制御の簡素化の観点からみれば4個を選択する方が望ましい。また、維持ブロックを構成するスキャンドライバの個数は、2の累乗個に限らない。書き込み特性の均一化を図るため、各々の維持ブロック毎にスキャンドライバ数を可変させてもよい。 In this description, the number of maintenance blocks is set to three. However, the number of maintenance blocks is not particularly limited to this example, and may be other division numbers such as two divisions, six divisions, and eight divisions. Further, if the number of sustain blocks is a power of 2, the control circuit can be simplified. If the number of sustain blocks is six, 3 bits (three) of signals to control the sustain blocks are necessary, and the scale of the control signal is the same as when the number of sustain blocks is eight. The same can be said for the register scale in the control circuit. When there are 4 or 6 options for the number of maintenance blocks, it is preferable to select 4 from the viewpoint of simplification of control. Further, the number of scan drivers constituting the maintenance block is not limited to a power of 2. In order to make the writing characteristics uniform, the number of scan drivers may be varied for each sustain block.
さらに、各維持ブロックの維持期間が互いに重複しないように維持ブロック毎に維持期間をずらしてスキャン電極11およびサステイン電極12を維持放電させることで、同時に維持放電を行うスキャン電極11およびサステイン電極12の数は1/維持ブロック数=1/3になり、不要な電磁波の不要輻射のピークを低減すると共に、維持期間のピーク電流を1/3に低減することで消費電力を削減することができる。
Further, the sustain period is shifted for each sustain block so that the sustain periods of the sustain blocks do not overlap with each other, so that the
次に、本発明の一実施の形態によるAC型プラズマディスプレイ駆動方法の一例を図2に示す。図2は、図1に示す本発明の一実施の形態によるAC型プラズマディスプレイ装置における、スキャン電極11、サステイン電極12及びアドレス電極13の駆動方法の一例を示すタイミングチャートである。
Next, an example of an AC type plasma display driving method according to an embodiment of the present invention is shown in FIG. FIG. 2 is a timing chart showing an example of a method for driving the
図2に示すように、各フィールドは複数のサブフィールドに分割される。各サブフィールドでは、壁電荷を調整するセットアップ動作を行う初期化期間21、アドレス放電を行う書き込み期間22及び維持放電を行う維持期間23により構成される。各サブフィールドは維持期間23の長さが異なり、各サブフィールドの点灯期間を変えることにより、例えば256階調の階調表示が行われる。
As shown in FIG. 2, each field is divided into a plurality of subfields. Each subfield includes an
初期化期間21では、微弱な初期化放電が起こり、放電セル100の各壁面には微弱な壁電圧が蓄積される。書き込み期間22では、映像信号に応じてオンまたはオフする書き込みパルスがアドレス回路により各アドレス電極13に印加され、この書き込みパルスと同期して、図1に示すスキャンドライバ1F−1〜1F−6によりスキャン電極11にスキャンパルスが順に印加される。このとき、表示すべき放電セル100に対応するアドレス電極13とスキャン電極11との間の電圧は、書き込みパルス電圧とスキャンパルス電圧とを加算した電圧に、初期化期間21にスキャン電極11とアドレス電極13のそれぞれに蓄積された壁電圧がさらに加算されたものとなる。従って、アドレス電極13とスキャン電極11との間にアドレス放電が起こり、各電極には選択的に壁電圧が蓄積される。
In the initializing
次に、維持期間23において、スキャンドライバ1F−1〜1F−6により維持パルスがスキャン電極11に印加される。このとき、アドレス放電を起こした放電セル100におけるスキャン電極11とサステイン電極12との間の電圧は、維持パルス電圧に、書き込み期間22において蓄積されたスキャン電極11とサステイン電極12間の壁電圧が加算されたものとなる。このため、アドレス放電を起こした放電セル100では、スキャン電極11とサステイン電極12との間に維持放電が起こり、この維持放電を起こした放電セル100では、前放電前とは正負逆極性の壁電圧が蓄積される。この後、スキャン電極11とサステイン電極12には交互に反転した維持パルスが周期的に印加されている間、維持放電が行われる。第2サブフィールドSF2以降も同様に選択的にアドレス放電が行われ維持放電する。
Next, in the sustain
サステインドライバ1G−1、1G−2、1G−3をそれぞれ含むサステイン回路1G及びアドレス回路により、維持ブロック1H−1、1H−2、1H−3毎に放電タイミングが以下のように制御される。
The discharge timing is controlled as follows for each of the sustain
まず、第1サブフィールドSF1では、維持ブロック1H−1、1H−2、1H−3各々に対して初期化期間21が開始される。その後、第1維持ブロック1H−1の書き込み期間22が開始され、その後、維持期間23が開始される。第1維持ブロック1H−1から一定時間間隔をおいて、第2維持ブロック1H−2の初期化期間21が開始される。第3維持ブロック1H−3の場合も同様に、それぞれ一定時間間隔をおいて初期化期間21が開始される。次に、第1維持ブロック1H−1の維持期間23の半分以上が終了した時点で第2維持ブロック1H−2の維持期間23が開始されるように、第1維持ブロック1H−1の維持期間23の開始から所定時間経過後に第2維持ブロック1H−2の書き込み期間22が開始され、第2維持ブロック1H−2の書き込み期間22が終了した後、第2維持ブロック1H−2の維持期間23が開始される。以降、第2維持ブロック1H−2と同様に第3維持ブロック1H−3の初期化期間21、書き込み期間22及び維持期間23が順に開始される。
First, in the first subfield SF1, the
第2サブフィールドSF2では、第2維持ブロック1H−2の第1サブフィールドSF1の維持期間23が終了した後、第1維持ブロック1H−1の初期化期間21が開始される。その後、第1維持ブロック1H−1の書き込み期間22が開始され、第1維持ブロック1H−1の書き込み22期間が終了した後、第1維持ブロック1H−1の維持期間23が開始される。第1維持ブロック1H−1の書き込み期間22が終了した時点で第2維持ブロック1H−2の初期化期間21が開始される。第2維持ブロック1H−2の初期化期間21の終了後、第2維持ブロック1H−2の書き込み期間22が開始され、第2維持ブロック1H−2の書き込み期間22が終了した後、第2維持ブロック1H−2の維持期間24が開始される。以降第2維持ブロックと同様に第3維持ブロックの初期化期間22、書き込み期間22及び維持期間23が開始される。
In the second subfield SF2, the
次に、ある維持ブロックの維持期間中に他の維持ブロックがアドレス放電を行う場合において、アドレス電極13、スキャン電極11及びサステイン電極12の駆動電圧の印加するタイミングについて述べる。例えば、第1サブフィールドSF1では、第1維持ブロック1H−1の維持期間23に第2維持ブロック1H−2の書き込み期間22が設定されており、第1維持ブロック1H−1の維持期間23では、スキャン電極11及びサステイン電極12にはそれぞれ維持パルスが印加されている。一方、第1維持ブロック1H−1の維持期間23中のスキャン電極11が0Vで、サステイン電極12に維持パルスが印加されている期間に、個々のスキャン電極11に印加されるスキャンパルスに対応して、第2維持ブロック1H−2のアドレス電極13には書き込みパルスが印加される。これにより、各維持ブロック1H−1、1H−2、1H−3に対してアドレス電極13が共通に使用されるような現構成でも、印加するスキャンパルス、書き込みパルス及び維持パルスを印加するタイミングを工夫することで、各電極に印加される駆動パルスの維持ブロック間干渉を無くし、維持放電及びアドレス放電を平行して安定に行うことができる。第2サブフィールド以降も同様な駆動パルスの加え方の工夫により時間を有効に活用することができる。
Next, the timing at which the drive voltages of the
サステイン電極12をすべて一括に駆動する従来のADS駆動方法に対し、本発明に示す維持ブロック分割型の駆動方法を用いると、各維持ブロックにおいて、書き込み期間が短縮されることで、例えばサブフィールド数を多くして階調数を増やし動画擬似輪郭を低減し、また各サブフィールドにおける維持期間を延長して輝度向上を図ることもできる。
When the sustain block division type driving method shown in the present invention is used for the conventional ADS driving method for driving all the sustain
本発明のAC型プラズマディスプレイ駆動方法を用いると、スキャンクロック1E−1、1E−2、1E−3を個々に独立に印加あるいは停止することによる、電磁波の不要輻射の低減について図3を用いて説明する。 Using the AC type plasma display driving method of the present invention, FIG. 3 is used to reduce unnecessary radiation of electromagnetic waves by individually applying or stopping the scan clocks 1E-1, 1E-2, 1E-3 individually. explain.
図3は、従来のADS駆動と、サステイン電極をブロック分割駆動した場合の不要輻射のピークの変化を比較して示したものである。図3(a)は、同時に駆動するサステインドライバを減らした場合、つまり維持ブロック分割駆動をした場合の不要輻射のピークの変化を表し、図3(b)は、各維持ブロックのスキャンクロック1E−1、1E−2、1E−3の周波数を変化させた場合の不要輻射のピークの変化を示す。
FIG. 3 shows a comparison of the change in the peak of unnecessary radiation when the conventional ADS drive and the sustain electrode are divided into blocks. FIG. 3A shows a change in the peak of unnecessary radiation when the number of sustain drivers that are driven simultaneously is reduced, that is, when sustain block division driving is performed, and FIG. 3B shows a
図3(a)では、従来のADS駆動における輻射のピーク31Aに対し、維持ブロック分割駆動のピーク31Bは小さい値となる。同時に駆動するスキャンドライバの少ない維持ブロック分割駆動のほうが、電源から見れば流す電流量はスキャンドライバの個数分だけ少なくなる。そのため、流れる電流量の2乗に比例する不要輻射は低減される。一方、図3(b)は、従来のADS駆動における不要輻射のピーク31Aに対し、各維持ブロック1H−1、1H−2、1H−3毎に、それぞれのスキャンクロック1E−1、1E−2、1E−3の周波数を変化させた場合を示す。各維持ブロックのスキャンクロック1E−1、1E−2、1E−3の周波数を変えることで、周波数軸上の不要輻射のピークは分散し、それぞれスキャンクロック1E−1、1E−2、1E−3の周波数帯で、ピーク31C−1、31C−2、31C−3を持つ。このように、周波数帯を分散させることでも不要輻射は低減される。
In FIG. 3A, the peak 31B of the sustain block division driving is smaller than the
次に、本発明の他の実施の形態によるAC型プラズマディスプレイ駆動方法について述べる。サブフィールド方向に維持発光が進行すると、放電セル100内の空間電荷が徐々に蓄積されていくことで、データパルス印加時に発生するアドレス放電の起こり易さ、すなわち書き込み特性は良化する。すると、スキャンパルスの時間幅は小さくてもアドレス放電が発生することになる。また、維持ブロック1H−1、1H−2、1H−3が画面方向にスキャンする順番が遅くなるほど、まだ書き込まれていない放電セル100において、初期化期間21において発生した空間電荷が徐々に減り、前述のアドレス放電が発生し難くなる。すなわち、スキャンする順番が遅い維持ブロックほど、スキャンパルスの時間幅が大きくないとアドレス放電できなくなり、書き込み特性が悪化する。そこで、現在のAC型プラズマディスプレイ装置では、維持ブロック1H−1、1H−2、1H−3におけるスキャンクロック1E−1、1E−2、1E−3の周波数をサブフィールド方向へ徐々に高くし、同時に、スキャンする維持ブロック1H−1、1H−2、1H−3の順に小さくさせることで、書き込み特性の均一化が図れる。
Next, an AC type plasma display driving method according to another embodiment of the present invention will be described. As the sustain light emission proceeds in the subfield direction, space charges in the
しかし、サブフィールド方向へはスキャンクロックの周波数を徐々に高くし、スキャン方向へはスキャンクロックの周波数を徐々に低くすると、同じ周波数で動作するスキャンクロックが時間方向もしくは画面方向に混在する可能性が生じる。もし同周波数が混在した場合、前に述べたように、不要輻射のピークが大きくなる。そこで、サブフィールド方向へ変化させるスキャンクロックの周波数と、スキャン方向へ変化させるスキャンクロック周波数を一致させることなく駆動することで、不要輻射のピークの増大を抑制することができる。図4は、サブフィールド方向及びスキャン方向へのスキャンクロック周波数の割り当て構成の概略を示したものである。維持ブロック1H−1のサブフィールドSF1では周波数aのスキャンクロックをもち、サブフィールドSF2以降へは徐々に異なる周波数bからeを割り当てていく。同時に、画面方向すなわち維持ブロックのスキャン方向へも同様に、異なる周波数b'からc'を割り当てていく。そこで、a〜eもしくはa〜c'の周波数のうち、一致する組み合わせが生じるような維持ブロック分割駆動をした場合、その周波数でピークをもつ不要輻射が増大する。そのため、前述のa〜eもしくはa〜c'の周波数のうち、一致する組み合わせのない駆動を行えば、不要輻射の増大を抑制することが可能である。
However, if the scan clock frequency is gradually increased in the subfield direction and the scan clock frequency is gradually decreased in the scan direction, scan clocks operating at the same frequency may be mixed in the time direction or screen direction. Arise. If the same frequency is mixed, the peak of unnecessary radiation increases as described above. Therefore, by driving the scan clock frequency changed in the subfield direction and the scan clock frequency changed in the scan direction without matching, it is possible to suppress an increase in the peak of unnecessary radiation. FIG. 4 shows an outline of a configuration for assigning scan clock frequencies in the subfield direction and the scan direction. The subfield SF1 of the
なお、ここで述べる"一致しない周波数"とは、互いに干渉することのないスキャンクロックの周波数であり、完全には一致しておらず、「ほぼ」一致しているという場合も含む。周波数の値は若干異なっていても、非常に値の近い周波数をもつスキャンクロックは、互いに干渉し、新たな不要輻射ノイズの発生を引き起こす可能性があるためである。 Note that the “frequency that does not match” described here is the frequency of the scan clocks that do not interfere with each other, and includes the case where the frequencies do not match completely and “match” substantially. This is because even though the frequency values are slightly different, scan clocks having very close frequencies may interfere with each other and cause generation of new unnecessary radiation noise.
なお上述した本発明の実施の形態における説明は、それらのサブフィールドに対し限定されるものではなく、第3サブフィールド以降にも同様に適用することができる。また、本発明の実施の形態に示す種々の駆動方法を組み合わせて用いてもよい。また、その他、例示はしないが、実施の形態に示す本発明はその主旨を逸脱しない範囲で種々変更を加え得るものとする。 The description in the embodiment of the present invention described above is not limited to those subfields, and can be similarly applied to the third and subsequent subfields. Further, various driving methods shown in the embodiments of the present invention may be used in combination. In addition, although not illustrated, the present invention shown in the embodiments can be variously modified without departing from the gist thereof.
また、以上述べた本発明の実施の形態については、プラズマディスプレイのみならず、画像表示を行う際に電流を多く必要とするマトリックス構造をもつ表示装置に対しても適用できるものである。 Further, the embodiment of the present invention described above can be applied not only to a plasma display but also to a display device having a matrix structure that requires a large amount of current when performing image display.
以上のように本発明によれば、複数のサステイン電極を共通接続した結線群を1単位とする複数の維持ブロックと、各維持ブロック別のスキャン電極に放電電圧を印加するスキャンドライバを有するマトリクス構造のAC型プラズマディスプレイ装置において、維持ブロック毎にスキャンクロックを動作または停止させることで、電磁波の不要輻射を低減し、かつ消費電力を削減させることができる。また、各維持ブロックのスキャンクロックの周波数を可変させることで不要輻射のピークを抑えることができ、もって、不要な電磁波の不要輻射を防止する種々の対策のための部品点数が削減でき、より低コスト化させることができる。 As described above, according to the present invention, a matrix structure having a plurality of sustain blocks each having a connection group in which a plurality of sustain electrodes are commonly connected, and a scan driver that applies a discharge voltage to the scan electrodes of each sustain block. In the AC type plasma display device, unnecessary radiation of electromagnetic waves can be reduced and power consumption can be reduced by operating or stopping the scan clock for each maintenance block. In addition, by changing the frequency of the scan clock of each maintenance block, the peak of unnecessary radiation can be suppressed, and the number of parts for various measures to prevent unnecessary radiation of unnecessary electromagnetic waves can be reduced. Cost can be increased.
また、現在技術革新が著しいプラズマディスプレイ装置をはじめとする映像表示装置に関して、不要輻射及び消費電力を低減する本発明を用いれば、地球環境にも優しい映像表示装置を提供できる。 In addition, with respect to video display devices such as plasma display devices that are currently undergoing significant technological innovation, if the present invention that reduces unnecessary radiation and power consumption is used, a video display device that is friendly to the global environment can be provided.
1 PDP
11 スキャン電極
12 サステイン電極
13 アドレス電極
14 行電極対
21 初期化期間
22 書き込み期間
23 維持期間
100 放電セル
101 前面ガラス基板
102 透明誘電体層
103 保護層
104 背面ガラス基板
105 透明誘電体層
106 蛍光体
111 スキャン回路
112 サステイン回路
113 アドレス回路
1A スキャンクロック
1B スタートパルス
1C スキャンブロック制御信号
1D ブロック別切換回路(制御回路)
1E−1〜1E−3 スキャンクロック
1E−4〜1E−6 スタートパルス
1F スキャン回路
1F−1〜1F−6 スキャンドライバ
1G サステイン回路
1G−1〜1G−3 サステインドライバ
1H−1〜1H−3 維持ブロック
31A 従来のADS駆動時の不要輻射のピーク
31B 維持ブロック分割駆動時の不要輻射のピーク
31C−1〜31C−3 維持ブロック分割駆動時の不要輻射のピーク
1 PDP
DESCRIPTION OF
1E-1 to 1E-3
Claims (10)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003300874A JP2005070488A (en) | 2003-08-26 | 2003-08-26 | Ac type plasma display device and its driving method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003300874A JP2005070488A (en) | 2003-08-26 | 2003-08-26 | Ac type plasma display device and its driving method |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2005070488A true JP2005070488A (en) | 2005-03-17 |
Family
ID=34405656
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003300874A Pending JP2005070488A (en) | 2003-08-26 | 2003-08-26 | Ac type plasma display device and its driving method |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2005070488A (en) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006023751A (en) * | 2004-07-09 | 2006-01-26 | Thomson Licensing | Method and device for driving display device by line-wise dynamic addressing |
JP2009115936A (en) * | 2007-11-05 | 2009-05-28 | Sharp Corp | Drive control method, drive controller, and display device |
US7602354B2 (en) | 2004-08-03 | 2009-10-13 | Samsung Sdi Co., Ltd. | Plasma display panel (PDP) and driving method thereof |
-
2003
- 2003-08-26 JP JP2003300874A patent/JP2005070488A/en active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006023751A (en) * | 2004-07-09 | 2006-01-26 | Thomson Licensing | Method and device for driving display device by line-wise dynamic addressing |
US8780092B2 (en) | 2004-07-09 | 2014-07-15 | Thomson Licensing | Method and device for driving a display device with line-wise dynamic addressing |
US7602354B2 (en) | 2004-08-03 | 2009-10-13 | Samsung Sdi Co., Ltd. | Plasma display panel (PDP) and driving method thereof |
JP2009115936A (en) * | 2007-11-05 | 2009-05-28 | Sharp Corp | Drive control method, drive controller, and display device |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100290830B1 (en) | Plasma display panel driving method and device | |
JP4322101B2 (en) | Plasma display device | |
JP4647220B2 (en) | Driving method of plasma display device | |
KR100503603B1 (en) | Method of driving plasma display panel | |
US7649509B2 (en) | Plasma display device and driving method thereof | |
KR100342280B1 (en) | Display and its driving method | |
JP4264044B2 (en) | Panel driving method and display panel | |
JPH10319900A (en) | Driving method of plasma display device | |
JP5131241B2 (en) | Driving method of plasma display panel | |
JP3028087B2 (en) | Driving method of plasma display panel | |
JP2000206926A (en) | Plasma display panel drive device | |
JP2005070488A (en) | Ac type plasma display device and its driving method | |
JP2002351397A (en) | Driving device for plasma display device | |
JP2002189443A (en) | Driving method of plasma display panel | |
JP2008033035A (en) | Plasma display device | |
JPH07210113A (en) | Method for driving plasma display panel | |
JP2001166734A (en) | Plasma display panel driving method | |
KR20010073680A (en) | Method for Driving Plasma Display Panel | |
US20090289926A1 (en) | Plasma display device | |
JP2007241255A (en) | Method of driving plasma display panel | |
KR100482349B1 (en) | Method And Apparatus Of Driving Plasma Display Panel | |
KR100349917B1 (en) | Method for driving a plasma display panel | |
KR20010058768A (en) | Method for driving plasma display panel | |
JP5107958B2 (en) | Plasma display device | |
KR100296009B1 (en) | Driving Method of Plasma Display Panel |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Effective date: 20060602 Free format text: JAPANESE INTERMEDIATE CODE: A621 |
|
RD01 | Notification of change of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7421 Effective date: 20060712 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20090203 |
|
A131 | Notification of reasons for refusal |
Effective date: 20090217 Free format text: JAPANESE INTERMEDIATE CODE: A131 |
|
A521 | Written amendment |
Effective date: 20090420 Free format text: JAPANESE INTERMEDIATE CODE: A523 |
|
RD01 | Notification of change of attorney |
Effective date: 20091119 Free format text: JAPANESE INTERMEDIATE CODE: A7421 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20100302 |