JP2002305881A - Inverter - Google Patents
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Abstract
Description
【０００１】[0001]
【発明の属する技術分野】本発明は、インバータ電源に
係り、特に複数の負荷を持つ用途に使用されるインバー
タ回路に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an inverter power supply, and more particularly, to an inverter circuit used for an application having a plurality of loads.
【０００２】[0002]
【従来の技術】図２は、従来のインバータ回路の一例を
示す図である。図２を参照して、従来のインバータ回路
の構成と動作を説明する。図２において、５１は直流電
圧源、５２は入力コネクタ、５３は制御回路、５４ａは
第１のスイッチング素子、５４ｂは第２のスイッチング
素子、５５は共振用コンデンサ、５６は昇圧用トラン
ス、５７は電流検出回路、５８ａは第１のバラストコン
デンサ、５８ｂは第２のバラストコンデンサ、５９は出
力コネクタ、６０ａは第１の負荷、６０ｂは第２の負
荷、そして６３は抵抗である。2. Description of the Related Art FIG. 2 is a diagram showing an example of a conventional inverter circuit. The configuration and operation of the conventional inverter circuit will be described with reference to FIG. 2, 51 is a DC voltage source, 52 is an input connector, 53 is a control circuit, 54a is a first switching element, 54b is a second switching element, 55 is a resonance capacitor, 56 is a step-up transformer, and 57 is a step-up transformer. A current detection circuit, 58a is a first ballast capacitor, 58b is a second ballast capacitor, 59 is an output connector, 60a is a first load, 60b is a second load, and 63 is a resistor.
【０００３】このインバータ回路の動作は、次のとおり
である。入力コネクタ５２に電圧が印加されると抵抗６
３を通してスイッチング素子５４ａがオンし、スイッチ
ング素子５４ｂはオフ状態で、発振周期の１/２だけ継
続する。次の１/２周期はスイッチング素子５４ａがオ
フし、スイッチング素子５４ｂがオンする。その後はス
イッチング素子５４ａと５４ｂが交互にオン/オフを繰
り返す。The operation of this inverter circuit is as follows. When a voltage is applied to the input connector 52, the resistance 6
3, the switching element 54a is turned on, and the switching element 54b is in the off state, and continues for の of the oscillation cycle. In the next half cycle, the switching element 54a turns off and the switching element 54b turns on. Thereafter, the switching elements 54a and 54b alternately turn on / off.
【０００４】次いで、昇圧トランス５６の入力には共振
用コンデンサ５５、バラストコンデンサ５８ａ，５８ｂ
と昇圧トランス５６のインダクタンスの共振による正弦
波が加わり、昇圧トランス５６の出力には正弦波が出力
される。Next, a resonance capacitor 55 and ballast capacitors 58a and 58b are input to the input of a step-up transformer 56.
And a sine wave due to the resonance of the inductance of the step-up transformer 56 is added, and a sine wave is output to the output of the step-up transformer 56.
【０００５】バラストコンデンサ５８ａ，５８ｂを通し
て負荷（冷陰極管など）に電流が流れ、この負荷電流を
電流検出回路５７で検出し、一定値になるように昇圧ト
ランス５６の入力電圧を制御回路５３で制御する。A current flows through a load (such as a cold-cathode tube) through ballast capacitors 58a and 58b. Control.
【０００６】[0006]
【発明が解決しようとする課題】ところで、出力コネク
タの半挿入時には出力コネクタの挿入側、被挿入側の電
極間で放電が発生し、発熱により、出力コネクタが焼損
し、又、負荷の劣化、破損によって負荷が開放状態にな
ると昇圧トランスの出力巻線以降の回路には通常の２倍
以上の交流電圧が常時発生し昇圧トランスが破損するこ
ともある。By the way, when the output connector is half-inserted, a discharge occurs between the electrodes on the insertion side and the insertion side of the output connector, and the output connector is burned out due to heat generation. When the load is opened due to damage, an AC voltage twice or more than usual is always generated in a circuit after the output winding of the step-up transformer, and the step-up transformer may be damaged.
【０００７】そこで、本発明は、負荷状態が変動したと
きに起こる過大電圧から昇圧トランスを保護し、安定に
動作する、信頼性の高いインバータ回路を提供すること
を課題とする。SUMMARY OF THE INVENTION It is an object of the present invention to provide a highly reliable inverter circuit which protects a step-up transformer from an excessive voltage that occurs when a load condition fluctuates and operates stably.
【０００８】[0008]
【課題を解決するための手段】出力コネクタの半挿入時
や未挿入時、あるいは負荷が開放状態になった場合や劣
化した場合には出力電流が低下、又は流れなくなるの
で、出力電流が設定値未満になった場合にタイマ回路が
動作し、その出力信号に基づいて制御回路を動作停止さ
せ、インバータ回路の出力を停止させる。When the output connector is half-inserted or not inserted, or when the load is opened or deteriorated, the output current decreases or stops flowing. When the value becomes less than the predetermined value, the timer circuit operates, and based on the output signal, stops the operation of the control circuit and stops the output of the inverter circuit.
【０００９】又、出力電流検出回路とタイマ回路は各出
力ごとに設け、タイマ回路は設定時間内に出力電流が設
定値以上になった場合に、インバータ出力を持続させる
ように動作する。Also, an output current detection circuit and a timer circuit are provided for each output, and the timer circuit operates to maintain the inverter output when the output current exceeds a set value within a set time.
【００１０】即ち、本発明のインバータ回路は、各負荷
ごとに出力電流検出回路とタイマ回路を設け、出力電流
が設定値未満になったときに、タイマ回路が動作し、前
記出力電流検出回路とタイマ回路の出力信号を基づき制
御回路を駆動し、インバータ出力を停止させる回路構成
とする。That is, the inverter circuit of the present invention is provided with an output current detection circuit and a timer circuit for each load, and when the output current becomes smaller than a set value, the timer circuit operates and the output current detection circuit and the timer circuit operate. The control circuit is driven based on the output signal of the timer circuit to stop the inverter output.
【００１１】又、前記タイマ回路は、設定時間内に出力
電流が設定値以上になった場合には、インバータ出力を
持続させるように制御回路を駆動するように動作させる
とよい。The timer circuit may be operated to drive the control circuit so that the output of the inverter is maintained when the output current exceeds a set value within a set time.
【００１２】[0012]
【発明の実施の形態】図面に基づいて、本発明の実施の
形態を説明する。Embodiments of the present invention will be described with reference to the drawings.
【００１３】図１は、本発明の実施の一形態であるイン
バータ回路を示す図である。図１において、１１は直流
電圧源、１２は入力コネクタ、１３は制御回路、１４ａ
は第１のスイッチング素子、１４ｂは第２のスイッチン
グ素子、１５は共振用コンデンサ、１６は昇圧用トラン
ス、１７ａは第１の負荷に対する出力電流検出回路、１
７ｂは第２の負荷に対する出力電流検出回路、１７ｃは
電流検出回路、１８ａは第１のバラストコンデンサ、１
８ｂは第２のバラストコンデンサ、１９は出力コネク
タ、２０ａは第１の負荷、２０ｂは第２の負荷、２１ａ
は第１のタイマ回路、２１ｂは第２のタイマ回路、２２
はタイマ回路出力信号のＯＲ回路、そして２３は抵抗で
ある。なお、第１及び第２の負荷２０ａ，２０ｂには、
冷陰極管が用いられている。FIG. 1 is a diagram showing an inverter circuit according to an embodiment of the present invention. In FIG. 1, 11 is a DC voltage source, 12 is an input connector, 13 is a control circuit, 14a
Is a first switching element, 14b is a second switching element, 15 is a resonance capacitor, 16 is a step-up transformer, 17a is an output current detection circuit for the first load, 1
7b is an output current detection circuit for the second load, 17c is a current detection circuit, 18a is a first ballast capacitor,
8b is a second ballast capacitor, 19 is an output connector, 20a is a first load, 20b is a second load, 21a
Is a first timer circuit, 21b is a second timer circuit, 22
Is an OR circuit of the timer circuit output signal, and 23 is a resistor. Note that the first and second loads 20a and 20b include:
Cold cathode tubes are used.
【００１４】この回路における動作は、以下のようであ
る。第１の負荷２０ａに対する第１の出力電流検出回路
１７ａと第２の負荷２０ｂに対する第２の出力電流検出
回路１７ｂによって、出力コネクタ１９の半挿入時や未
挿入時、あるいは負荷が開放の状態あるいは劣化した場
合における出力電流の低下、又は流れなくなることを検
出する。The operation of this circuit is as follows. By the first output current detection circuit 17a for the first load 20a and the second output current detection circuit 17b for the second load 20b, when the output connector 19 is half-inserted or not inserted, or when the load is open or It detects that the output current has decreased or has stopped flowing when the battery has deteriorated.
【００１５】次に、電流検出回路１７ｃは第１の出力電
流検出回路１７ａ及び第２の出力電流検出回路１７ｂの
出力信号に基づいて、制御回路１３に信号を出力する。Next, the current detection circuit 17c outputs a signal to the control circuit 13 based on the output signals of the first output current detection circuit 17a and the second output current detection circuit 17b.
【００１６】一方、第１のタイマ回路２１ａと第２のタ
イマ回路２１ｂは、それぞれ第１の出力電流検出回路１
７ａ及び第２の出力電流検出回路１７ｂの出力信号を受
けて、出力電流が設定値未満になったとき、その時間を
計測して、タイマ出力信号のＯＲ回路２２に信号を出力
する。次いで、タイマ出力信号のＯＲ回路２２はＯＲ信
号を制御回路１３に出力する。On the other hand, the first timer circuit 21a and the second timer circuit 21b are connected to the first output current detection circuit 1 respectively.
In response to the output signals of the output current detection circuit 7a and the second output current detection circuit 17b, when the output current becomes less than the set value, the time is measured and a signal is output to the OR circuit 22 of the timer output signal. Next, the timer output signal OR circuit 22 outputs an OR signal to the control circuit 13.
【００１７】更に、制御回路１３は、電流検出回路１７
ｃとタイマ出力信号のＯＲ回路２２の出力によって、ス
イッチングの制御を行う。Further, the control circuit 13 includes a current detection circuit 17
Switching is controlled based on the output of the OR circuit 22 of c and the timer output signal.
【００１８】このとき、第１又は第２の負荷に対する出
力電流が設定値未満になり、その時間が設定値以上にな
ったとき、出力電流を停止させるように、制御回路１３
を動作させる。At this time, the control circuit 13 stops the output current when the output current to the first or second load falls below the set value and the time exceeds the set value.
To work.
【００１９】又、設定時間内に出力電流が設定値以上に
なった場合には、インバータ出力を持続させるように制
御回路１３を動作させる。When the output current exceeds the set value within the set time, the control circuit 13 is operated so as to keep the inverter output.
【００２０】即ち、この実施の形態においては、各負荷
ごとに出力電流検出回路とタイマ回路を設け、それらの
出力信号を基にして、負荷の状態が変化したときに生じ
る過大電圧から昇圧トランスを保護するように回路が構
成されている。That is, in this embodiment, an output current detection circuit and a timer circuit are provided for each load, and based on the output signals thereof, the step-up transformer is switched from an excessive voltage generated when the state of the load changes. The circuit is configured to protect.
【００２１】[0021]
【発明の効果】本発明のインバータ回路においては、負
荷状態が変動したとき、タイマ回路などの出力信号を基
にして出力動作を停止することが出来る。その結果、昇
圧用トランスや出力コネクタが保護される。According to the inverter circuit of the present invention, when the load condition changes, the output operation can be stopped based on the output signal of the timer circuit or the like. As a result, the step-up transformer and the output connector are protected.
【００２２】即ち、本発明によれば、負荷の接続状態
や、負荷の変化に対して、信頼性の高いインバータ回路
を提供することができる。That is, according to the present invention, it is possible to provide an inverter circuit having high reliability with respect to a connection state of a load and a change in load.
【図１】本発明の実施の一形態であるインバータ回路を
示す図。FIG. 1 is a diagram showing an inverter circuit according to an embodiment of the present invention.
【図２】従来のインバータ回路の一例を示す図。FIG. 2 is a diagram illustrating an example of a conventional inverter circuit.
１１ 直流電圧源 １２ 入力コネクタ １３ 制御回路 １４ａ 第１のスイッチング素子 １４ｂ 第２のスイッチング素子 １５ 共振用コンデンサ １６ 昇圧用トランス １７ａ 第１の出力電流検出回路 １７ｂ 第２の出力電流検出回路 １７ｃ 電流検出回路 １８ａ 第１のバラストコンデンサ １８ｂ 第２のバラストコンデンサ １９ 出力コネクタ ２０ａ 第１の負荷 ２０ｂ 第２の負荷 ２１ａ 第１のタイマ回路 ２１ｂ 第２のタイマ回路 ２２ タイマ出力信号のＯＲ回路 ２３ 抵抗 Reference Signs List 11 DC voltage source 12 Input connector 13 Control circuit 14a First switching element 14b Second switching element 15 Resonant capacitor 16 Boosting transformer 17a First output current detection circuit 17b Second output current detection circuit 17c Current detection circuit 18a First ballast capacitor 18b Second ballast capacitor 19 Output connector 20a First load 20b Second load 21a First timer circuit 21b Second timer circuit 22 OR circuit of timer output signal 23 Resistance
フロントページの続き Ｆターム(参考） 5G053 AA07 BA01 CA02 EA03 EA05 EB01 5H007 AA00 AA06 BB03 CA01 CB01 CB06 CB25 CC32 DA06 DB02 DC02 FA01 FA04 FA14 FA19Continued on the front page F term (reference) 5G053 AA07 BA01 CA02 EA03 EA05 EB01 5H007 AA00 AA06 BB03 CA01 CB01 CB06 CB25 CC32 DA06 DB02 DC02 FA01 FA04 FA14 FA19
Claims (2)
回路を設け、出力電流が設定値未満になったときに、タ
イマ回路が動作し、前記出力電流検出回路と前記タイマ
回路の出力信号に基づいて制御回路を駆動し、インバー
タ出力を停止させる回路構成であることを特徴とするイ
ンバータ回路。An output current detection circuit and a timer circuit are provided for each load, and when the output current falls below a set value, the timer circuit operates, and an output signal of the output current detection circuit and an output signal of the timer circuit are output. An inverter circuit having a circuit configuration for driving a control circuit based on the output signal and stopping output of the inverter.
が設定値以上になった場合には、インバータ出力を持続
させるように制御回路を駆動することを特徴とする請求
項１記載のインバータ回路。2. The inverter circuit according to claim 1, wherein the timer circuit drives the control circuit so as to maintain the inverter output when the output current becomes equal to or more than a set value within a set time. .
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001103006A JP2002305881A (en) | 2001-04-02 | 2001-04-02 | Inverter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
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| JP2001103006A JP2002305881A (en) | 2001-04-02 | 2001-04-02 | Inverter |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2002305881A true JP2002305881A (en) | 2002-10-18 |
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ID=18956129
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2001103006A Pending JP2002305881A (en) | 2001-04-02 | 2001-04-02 | Inverter |
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| JP (1) | JP2002305881A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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2001
- 2001-04-02 JP JP2001103006A patent/JP2002305881A/en active Pending
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