JP2002259924A - Data carrier system - Google Patents
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- Near-Field Transmission Systems (AREA)
Abstract
Description
【０００１】[0001]
【発明の属する技術分野】本発明は、データキャリアシ
ステム（個別対象物認識システム）に係わり、特に当該
データキャリアシステムの構成要素の１つである応答器
（以下ＩＤタグ）の外乱ノイズ対策に関するものであ
る。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a data carrier system (individual object recognition system), and more particularly to a countermeasure against disturbance noise of a transponder (hereinafter, an ID tag) which is one of components of the data carrier system. It is.
【０００２】[0002]
【従来の技術】データキャリアシステムは、質問器（リ
ーダ／ライタ、以下Ｒ／Ｗ）が、マイクロ波を用いて、
このＲ／Ｗから離れた位置にあるＩＤタグの中に記憶さ
れた個別データを読み出し、またＩＤタグにデータを書
き込むシステムである。このようなデータキャリアシス
テムは、ＦＡ（Factory Automation）、物流、鉄道切符
およびスーパーマーケットの価格読み取り、あるいは鉄
道保安装置等に広く利用されている。2. Description of the Related Art In a data carrier system, an interrogator (reader / writer, hereinafter referred to as R / W) uses microwaves,
This system reads out individual data stored in an ID tag at a position distant from the R / W and writes data to the ID tag. Such a data carrier system is widely used for factory automation (FA), logistics, reading prices of railway tickets and supermarkets, and railway security devices.
【０００３】ここで、一般的なデータキャリアシステム
の概要を説明する。図３は、データキャリアシステムの
構成を示したブロック図である。この図において、符号
１はＩＤタグであり、認識される対象物に搭載され、変
復調回路２、アンテナ３およびＭＰＵ回路４、メモリ
５、内蔵電池６で構成されており、Ｒ／Ｗ７より送信さ
れる自身の個別情報データがメモリ５に記憶されてい
る。Here, an outline of a general data carrier system will be described. FIG. 3 is a block diagram showing a configuration of the data carrier system. In this figure, reference numeral 1 denotes an ID tag, which is mounted on an object to be recognized, and includes a modulation / demodulation circuit 2, an antenna 3, an MPU circuit 4, a memory 5, and a built-in battery 6, which are transmitted from the R / W 7. Its own individual information data is stored in the memory 5.
【０００４】Ｒ／Ｗ７は、送受信回路８、アンテナ９、
変復調回路１０およびＭＰＵ回路１１で構成されてお
り、ホストコンピュータ１２に通信回線Ｄ３を介して接
続され、ホストコンピュータ１２より命令を受け、ＩＤ
タグ１内のメモリ５のデータの読出しおよび書込みを行
うものである。ホストコンピュータ１２は、Ｒ／Ｗ７を
制御し、複数のＩＤタグの個別情報データの収集と管理
を行うものである。The R / W 7 includes a transmitting / receiving circuit 8, an antenna 9,
It comprises a modulation / demodulation circuit 10 and an MPU circuit 11, is connected to a host computer 12 via a communication line D3, receives a command from the host computer 12, and
It reads and writes data in the memory 5 in the tag 1. The host computer 12 controls the R / W 7 and collects and manages individual information data of a plurality of ID tags.
【０００５】上記ＩＤタグ１において、変復調回路２は
ＭＰＵ回路４から送信された信号を変調し、信号波とし
てアンテナ３により送信し、アンテナ３で受信された信
号波を復調し、ＭＰＵ回路４に受信信号を送信するもの
である。ＭＰＵ回路４は、変復調回路２からの受信信号
および変復調回路２への送信信号の送受信データの管理
を行うものである。In the ID tag 1, the modulation / demodulation circuit 2 modulates the signal transmitted from the MPU circuit 4, transmits the modulated signal as a signal wave by the antenna 3, demodulates the signal wave received by the antenna 3, It transmits a received signal. The MPU circuit 4 manages the transmission / reception data of the reception signal from the modulation / demodulation circuit 2 and the transmission signal to the modulation / demodulation circuit 2.
【０００６】Ｒ／Ｗ７において、送受信回路８はＩＤタ
グ１との通信における送信波および受信波をアンテナ９
により送受信するものである。変復調回路１０は、送受
信回路８へ送信する信号の変調を行い、送受信回路８よ
り受信する信号の復調を行うものである。ＭＰＵ回路１
１は、送受信するデータの管理およびホストコンピュー
タ１２との通信制御を行うものである。In the R / W 7, the transmission / reception circuit 8 transmits and receives a transmission wave and a reception wave in communication with the ID tag 1 to the antenna 9.
Is transmitted and received by The modulation / demodulation circuit 10 modulates a signal transmitted to the transmission / reception circuit 8 and demodulates a signal received from the transmission / reception circuit 8. MPU circuit 1
1 manages data to be transmitted and received and controls communication with the host computer 12.
【０００７】次に、ＩＤタグ１とＲ／Ｗ７の動作を説明
する。まず、ホストコンピュータ１２が個別データの書
込み又は読出し命令を、たとえばＲＳ−２３２Ｃの規格
で制御される通信回線Ｄを介し、Ｒ／Ｗ７へ送信する。
次に、ホストコンピュータ１２からの信号を受信する
と、Ｒ／Ｗ７は、命令データをＡＳＫ（Amplitude Shif
t Keying）変調した送信波ＲＤ１０を介して認識対象物
であるＩＤタグ１へ送信する。Next, the operation of the ID tag 1 and the R / W 7 will be described. First, the host computer 12 transmits an instruction to write or read individual data to the R / W 7 via the communication line D controlled by, for example, the RS-232C standard.
Next, upon receiving a signal from the host computer 12, the R / W 7 converts the instruction data to ASK (Amplitude Shift).
t Keying) The signal is transmitted to the ID tag 1, which is the object to be recognized, via the modulated transmission wave RD10.
【０００８】そして、Ｒ／Ｗ７からの命令データを変復
調回路２が受信すると、ＩＤタグ１のＭＰＵ回路４は、
回路が動作していないスリープモードから起動し、受信
されて変復調回路２で復調された命令データの解読を行
う。次に、解読された読出しまたは書込みの命令に従
い、ＭＰＵ回路４はメモリ５に記憶されるデータの読出
しまたは書込みを行う。When the modulation / demodulation circuit 2 receives the command data from the R / W 7, the MPU circuit 4 of the ID tag 1
It starts up from the sleep mode in which the circuit is not operating, and decodes the instruction data received and demodulated by the modulation / demodulation circuit 2. Next, the MPU circuit 4 reads or writes data stored in the memory 5 in accordance with the decoded read or write command.
【０００９】次に、ＭＰＵ回路４は、データ処理終了後
に終了信号を変復調回路２へ送信し、変復調回路２は、
終了信号をＦＳＫ（Frequency Shift Keying）変調およ
びＢＰＳＫ（Binary Phase Shift Keying）変調を行
い、Ｒ／Ｗ７へアンテナ３により送信波ＴＤ１０として
送信する。ここで、ＩＤタグ１とＲ／Ｗ７との間での個
別情報データの読出しおよび書込みを実行するデータ通
信の媒体は、たとえば２．４５ＧＨｚ帯のマイクロ波が
用いられる。Next, the MPU circuit 4 sends an end signal to the modem circuit 2 after the data processing is completed, and the modem circuit 2
The end signal is subjected to FSK (Frequency Shift Keying) modulation and BPSK (Binary Phase Shift Keying) modulation, and transmitted to the R / W 7 by the antenna 3 as the transmission wave TD10. Here, as a medium of data communication for reading and writing the individual information data between the ID tag 1 and the R / W 7, for example, a microwave in the 2.45 GHz band is used.
【００１０】さらに、ＩＤタグ１内の標準的な機能とし
て、ウェイクアップ回路があり、アンテナ３からのＲ／
Ｗ７よりの受信信号が発生したときに、スリープ状態の
ＭＰＵ回路４が給電されてウェイクアップし、割り込み
処理が終了するとＭＰＵ回路４からの指令でスリープ状
態に戻る機能を具備している。[0010] Further, as a standard function in the ID tag 1, there is a wake-up circuit.
When the reception signal from W7 is generated, the MPU circuit 4 in the sleep state is supplied with power and wakes up, and has a function of returning to the sleep state by a command from the MPU circuit 4 when the interrupt processing is completed.
【００１１】[0011]
【発明が解決しようとする課題】しかし、上記ＩＤタグ
１においては、Ｒ／Ｗ７よりの正常な受信信号でウェイ
クアップせずに、外部からのノイズ電波を受けてウェイ
クアップ回路が誤作動する問題がある。However, the ID tag 1 does not wake up with a normal reception signal from the R / W 7, but receives a noise radio wave from the outside and the wake-up circuit malfunctions. There is.
【００１２】本発明は、このような課題に鑑みてなされ
たものであり、Ｒ／Ｗよりの正常な呼び出し信号で確実
にウェイクアップし、外部雑音ではウェイクアップしな
いデータキャリアシステムの提供を目的とするものであ
る。The present invention has been made in view of the above problems, and has as its object to provide a data carrier system that wakes up reliably with a normal calling signal from the R / W and does not wake up with external noise. Is what you do.
【００１３】[0013]
【課題を解決するための手段】この問題点を解決するた
めの、本発明請求項１記載構成の特徴は、応答器手段
と、質問器手段とよりなり、この質問器手段が前記応答
器手段に近接したときに前記質問器手段との間で通信を
実行するデータキャリアシステムにおいて、前記質問器
より前記応答器を呼び出す信号の先頭に識別信号を付加
した点にある。To solve this problem, a feature of the configuration according to the first aspect of the present invention comprises a transponder means and an interrogator means, and the interrogator means comprises the transponder means. In the data carrier system for executing communication with the interrogator means when the interrogator approaches, the identification signal is added to the head of the signal for calling the transponder from the interrogator.
【００１４】請求項２記載構成の特徴は、前記応答器
は、前記識別信号を認識したときにウェイクアップする
するノイズ対策回路を具備する点にある。A feature of the configuration according to claim 2 is that the transponder includes a noise countermeasure circuit that wakes up when the identification signal is recognized.
【００１５】請求項３記載構成の特徴は、前記識別信号
は、所定の周期を有するパルス列信号であり、前記ノイ
ズ対策回路は、前記所定の周期内に前記識別信号の２回
目の立ち上がりを検出したときに正常な呼び出しと判断
する点にある。According to a third feature of the present invention, the identification signal is a pulse train signal having a predetermined cycle, and the noise countermeasure circuit detects a second rising of the identification signal within the predetermined cycle. The point is that sometimes it is judged as a normal call.
【００１６】[0016]
【発明の実施の形態】以下、図面を参照して、本発明に
係わるデータキャリアシステムの一実施形態について説
明する。図１は、本実施形態の機能構成を示すブロック
図である。図３の構成要素と同一機能の要素には同一符
号を付してある。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Hereinafter, an embodiment of a data carrier system according to the present invention will be described with reference to the drawings. FIG. 1 is a block diagram illustrating a functional configuration of the present embodiment. Elements having the same functions as those in FIG. 3 are denoted by the same reference numerals.
【００１７】まず、正常な動作状態を説明する。この図
において、符号１３はダイオード等の受動素子からなる
検波回路であり、アンテナ３の受信信号を検波してＲ／
Ｗ７よりの受信信号ｄを発生する。この受信信号ｄはウ
ェイクアップレベル検出回路１４に入力される。First, a normal operation state will be described. In this figure, reference numeral 13 denotes a detection circuit composed of a passive element such as a diode.
A reception signal d from W7 is generated. This reception signal d is input to the wake-up level detection circuit 14.
【００１８】ＩＤタグ１がスリープの状態では、メモリ
５、ウェイクアップレベル検出回路１４、ノイズ対策回
路１５、信号ホールド回路１６のみが電池６から電源電
圧ＶＣＣ１が給電され、アクティブ状態とされている。When the ID tag 1 is in the sleep state, only the memory 5, the wake-up level detection circuit 14, the noise countermeasure circuit 15, and the signal hold circuit 16 are supplied with the power supply voltage VCC1 from the battery 6 and are in an active state.
【００１９】受信信号ｄが所定レベル以上であれば、ウ
ェイクアップレベル検出回路１４が作動し、その正常出
力ｗ１によりノイズ対策回路１５が作動する。さらに、
ノイズ対策回路１５の正常出力ｗ２により信号ホールド
回路１６が作動し、その正常ホールド出力ｗ２によりＶ
ＣＣ２制御回路１７が起動し、ＭＰＵ回路４を含む他の
回路に電源電圧ＶＣＣ２が給電され、ＩＤタグ１はウェ
イクアップ状態となる。If the received signal d is equal to or higher than the predetermined level, the wake-up level detection circuit 14 operates, and the noise countermeasure circuit 15 operates by its normal output w1. further,
The signal hold circuit 16 is operated by the normal output w2 of the noise countermeasure circuit 15, and V is set by the normal hold output w2.
The CC2 control circuit 17 is activated, the power supply voltage VCC2 is supplied to other circuits including the MPU circuit 4, and the ID tag 1 enters a wake-up state.
【００２０】ウェイクアップ状態において、検波回路１
３の受信信号ｄに基づく割り込み処理がＭＰＵで実行さ
れる。この割り込み処理が終了すると、ＭＰＵ回路４よ
り終了信号ｗ４がＶＣＣ２制御回路１７に与えられ、電
源電圧ＶＣＣ２の供給はオフとなり、ＩＤタグ１はスリ
ープの状態に戻る。In the wake-up state, the detection circuit 1
The MPU executes an interrupt process based on the third received signal d. When this interrupt processing is completed, the end signal w4 is supplied from the MPU circuit 4 to the VCC2 control circuit 17, the supply of the power supply voltage VCC2 is turned off, and the ID tag 1 returns to the sleep state.
【００２１】１８は通信制御回路であり、Ｒ／Ｗ７より
の受信信号ｄに基づく割り込み処理の期間中、復調回路
２ａにより復調された受信信号ｄをＭＰＵ回路４に渡
し、ＭＰＵ回路４から渡されるデータを変調回路２ｂを
介してアンテナ３に供給し、Ｒ／Ｗ７との間の電波通信
を制御する。Reference numeral 18 denotes a communication control circuit, which passes the received signal d demodulated by the demodulation circuit 2a to the MPU circuit 4 during the interruption process based on the received signal d from the R / W 7, and is passed from the MPU circuit 4. The data is supplied to the antenna 3 via the modulation circuit 2b, and the radio communication with the R / W 7 is controlled.
【００２２】次に、本発明の特徴部であるノイズ対策回
路１５並びに信号ホールド回路１６について説明する。
ノイズ対策回路１５は、ウェイクアップレベル検出回路
１４からのパルス信号ｗ１をカウントするカウンタ回路
１９と、自身の一方のカウント出力ＱＡを入力するフィ
ードバッククリア回路２０よりなる。他方のカウント出
力ＱＢが信号ホールド回路１６の入力ｗ２として供給さ
れる。Next, the noise countermeasure circuit 15 and the signal hold circuit 16, which are characteristic parts of the present invention, will be described.
The noise countermeasure circuit 15 includes a counter circuit 19 for counting the pulse signal w1 from the wake-up level detection circuit 14 and a feedback clear circuit 20 for receiving one of its own count outputs QA. The other count output QB is supplied as an input w2 of the signal hold circuit 16.
【００２３】フィードバッククリア回路２０の構成は、
カウント出力ＱＡの立ち上がりに対して一次遅れ特性を
付与する抵抗２１及びコンデンサ２２よりなる充電回路
と、この充電回路の電圧が所定のスレッシュホールド値
に達すると反転し、リセット端子ＣＬＲを介してカウン
タ回路１９を初期状態に戻すインバータ２３よりなる。The configuration of the feedback clear circuit 20 is as follows.
A charging circuit comprising a resistor 21 and a capacitor 22 for giving a first-order lag characteristic to the rising edge of the count output QA, and when the voltage of this charging circuit reaches a predetermined threshold value, the charging circuit is inverted and the counter circuit is reset via a reset terminal CLR. 19 comprises an inverter 23 for restoring the initial state.
【００２４】カウンタ回路１９は、正常動作の場合、Ｒ
／Ｗ７よりの受信信号ｄの先頭に付加されている所定周
期のパルス列よりなる識別信号の立ち上がりでカウント
出力ＱＡのレベルを“０”（以下オフ）より“１”（以
下オン）とする。更にカウンタ回路１９は、識別信号の
２発目のパルスの立ち上がりでカウント出力ＱＢをオフ
よりオンとする。When the counter circuit 19 operates normally, R
The level of the count output QA is changed from "0" (hereinafter "off") to "1" (hereinafter "on") at the rising edge of the identification signal composed of a pulse train of a predetermined period added to the head of the reception signal "d" from / W7. Further, the counter circuit 19 turns on the count output QB from off at the rise of the second pulse of the identification signal.
【００２５】カウント出力ＱＢのオンへのレベル変化で
作動開始するフィードバッククリア回路２０よりの出力
がリセット端子ＣＬＲに与えられると、カウント出力Ｑ
Ａ、ＱＢのレベルは、オフの初期状態に戻る。カウント
出力ＱＢのオンへのレベル変化は、信号ホールド回路１
６で保持され、ＶＣＣ２制御回路１７を起動してＩＤタ
グ１がウェイクアップする。When the output from the feedback clear circuit 20 which starts operation when the level of the count output QB changes to ON is given to the reset terminal CLR, the count output Q
The levels of A and QB return to the initial state of off. The level change of the count output QB to ON is determined by the signal hold circuit 1
6 and activates the VCC2 control circuit 17 to wake up the ID tag 1.
【００２６】識別信号の２発目のパルスの立ち上がりが
カウンタ回路１９の入力されない場合は、カウント出力
ＱＢはオフレベルのままであり、信号ホールド回路１６
を介したＶＣＣ２制御回路１７は起動せず、ＩＤタグ１
はスリープを保持する。When the rising edge of the second pulse of the identification signal is not input to the counter circuit 19, the count output QB remains off and the signal hold circuit 16
Does not activate the VCC2 control circuit 17 via the
Keeps sleep.
【００２７】さらに、図２に示す各部の波形図に基づい
て、正常動作の場合、外部ノイズを受けた場合について
の動作を時間軸を共通にして比較説明する。（Ａ）は正
常動作の場合の波形図、（Ｂ）は検波回路１３のカット
オフ周波数よりも早いノイズを受けた場合の波形図、
（Ｃ）はフィードバッククリア回路２０の動作時間より
も遅いノイズを受けた場合の波形図である。Further, based on the waveform diagrams of the respective sections shown in FIG. 2, the operation in the case of normal operation and the case of receiving external noise will be compared and described with a common time axis. (A) is a waveform diagram in the case of normal operation, (B) is a waveform diagram in the case of receiving noise earlier than the cutoff frequency of the detection circuit 13,
(C) is a waveform diagram when a noise that is slower than the operation time of the feedback clear circuit 20 is received.
【００２８】（Ａ）の場合は、前記の正常動作の説明で
明らかなように、識別信号Ｐの２発目のパルスの立ち上
がりでカウント出力ＱＢはオフよりオンとなり、ウェイ
クアップによりＭＰＵの処理が正常に実行される。カウ
ント出力ＱＡがオンとなり、カウント出力ＱＡ、ＱＢが
オフになるまでの時間τは、フィードバッククリア回路
２０の抵抗２１、コンデンサ２２による時定数で最適値
に決定できる。In the case of (A), as is clear from the description of the normal operation, the count output QB is turned on from the off at the rising of the second pulse of the identification signal P, and the processing of the MPU is performed by wakeup. Executes normally. The time τ from when the count output QA turns on to when the count outputs QA and QB turn off can be determined to be an optimum value by a time constant of the resistor 21 and the capacitor 22 of the feedback clear circuit 20.
【００２９】（Ｂ）は早いノイズを受けた場合の波形図
である。一般にウェイクアップレベル検出回路１４は、
ノイズカットのため所定のカットオフ周波数（数１００
Ｈｚ程度）を有するローパスフィルタ特性を持たせてい
る。一般に、早い外部ノイズはこのカットオフ周波数よ
りはるかに周波数（数メガＨｚ）であるため、検波回路
自身がこの早いノイズに応答できない。従ってノイズに
よるカウント出力ＱＢのオンへの反転は発生せず、カウ
ント出力ＱＢはオフを保持するするので、ＩＤタグ１は
スリープを保持する。FIG. 3B is a waveform diagram when a fast noise is received. Generally, the wake-up level detection circuit 14
Predetermined cut-off frequency (100
(About Hz). In general, the fast external noise has a frequency (several megahertz) much higher than the cutoff frequency, and thus the detection circuit itself cannot respond to the fast noise. Therefore, the count output QB is not turned on due to noise, and the count output QB is kept off, so that the ID tag 1 keeps sleep.
【００３０】（Ｃ）は遅いノイズを受けた場合の波形図
である。フィードバッククリア回路２０の動作時間τを
予測される遅いノイズの周期よりも早く設定しておけ
ば、ノイズの２発目のパルス発生時刻よりもτの経過が
早いので、カウント出力ＱＢがオフのままカウント出力
ＱＡもオフとなり、初期状態に戻るのでＩＤタグ１はス
リープを保持する。FIG. 3C is a waveform diagram when a slow noise is received. If the operation time τ of the feedback clear circuit 20 is set earlier than the predicted period of the slow noise, the lapse of τ is earlier than the time at which the second pulse of noise is generated, so that the count output QB remains off. Since the count output QA is also turned off and returns to the initial state, the ID tag 1 holds the sleep state.
【００３１】本実施形態によれば、Ｒ／Ｗ７よりのデー
タ先頭に付加した所定周期のパルス列よりなる識別信号
と、ＩＤタグ１側に設けたノイズ対策回路により、早い
周波数の電波ノイズにも遅い周波数の電波ノイズに対し
ても誤ったウェイクアップを発生しない、信頼性の高い
ＩＤタグシステムを実現することができる。According to the present embodiment, the identification signal consisting of a pulse train of a predetermined period added to the head of the data from the R / W 7 and the noise countermeasure circuit provided on the ID tag 1 side are slow against radio wave noise of a high frequency. A highly reliable ID tag system that does not cause erroneous wake-up even with radio wave noise of a frequency can be realized.
【００３２】[0032]
【発明の効果】以上説明したように、本発明によれば、
質問器手段よりの正常な呼び出し信号で確実にウェイク
アップし、外部ノイズではウェイクアップしないデータ
キャリアシステムを実現することができる。As described above, according to the present invention,
It is possible to realize a data carrier system that wakes up reliably with a normal calling signal from the interrogator means and does not wake up with external noise.
【図１】 本発明の一実施形態の機能構成を示すブロッ
ク図である。FIG. 1 is a block diagram showing a functional configuration of an embodiment of the present invention.
【図２】 本発明のの一実施形態の動作を説明するため
の各部の波形図である。FIG. 2 is a waveform chart of each part for explaining the operation of one embodiment of the present invention.
【図３】 従来のデータキャリアシステムの一構成例を
示すブロック図である。FIG. 3 is a block diagram illustrating a configuration example of a conventional data carrier system.
１……ＩＤタグ（応答器手段） ２ａ…復調回路 ２ｂ…変調回路 ３……アンテナ ４……ＭＰＵ回路 ５……メモリ ６……電池 １３…検波回路 １４…ウェイクアップレベル検出回路 １５…ノイズ対策回路 １６…信号ホールド回路 １７…ＶＣＣ２制御回路 １８…通信制御回路 １９…カウンタ回路 ２０…フィードバッククリア回路 DESCRIPTION OF SYMBOLS 1 ... ID tag (response means) 2a ... Demodulation circuit 2b ... Modulation circuit 3 ... Antenna 4 ... MPU circuit 5 ... Memory 6 ... Battery 13 ... Detection circuit 14 ... Wakeup level detection circuit 15 ... Noise countermeasures Circuit 16 ... Signal hold circuit 17 ... VCC2 control circuit 18 ... Communication control circuit 19 ... Counter circuit 20 ... Feedback clear circuit
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Claims (3)
の質問器手段が前記応答器手段に近接したときに前記質
問器手段との間で通信を実行するデータキャリアシステ
ムにおいて、 前記質問器より前記応答器を呼び出す信号の先頭に識別
信号を付加したことを特徴とするデータキャリアシステ
ム。1. A data carrier system comprising: transponder means and interrogator means, wherein said interrogator means communicates with said interrogator means when said interrogator means is close to said transponder means. A data carrier system, wherein an identification signal is added to the head of a signal for calling the transponder.
ときにウェイクアップするノイズ対策回路を具備する請
求項１記載のデータキャリアシステム。2. The data carrier system according to claim 1, wherein the transponder includes a noise countermeasure circuit that wakes up when the identification signal is recognized.
ルス列信号であり、前記ノイズ対策回路は、前記所定の
周期内に前記識別信号の２回目の立ち上がりを検出した
ときに正常な呼び出しと判断することを特徴とする請求
項１あるいは２記載のデータキャリアシステム。3. The identification signal is a pulse train signal having a predetermined period, and the noise countermeasure circuit determines a normal call when detecting a second rising of the identification signal within the predetermined period. The data carrier system according to claim 1, wherein
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001059889A JP2002259924A (en) | 2001-03-05 | 2001-03-05 | Data carrier system |
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2001
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