JP2002247001A - 擬似ランダムパターン送信装置 - Google Patents
擬似ランダムパターン送信装置Info
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Abstract
(57)【要約】
【課題】 ハードウエアによる擬似ランダム発生回路を
使用せず、ソフトウエア処理により擬似ランダムパター
ンをPPPフレームまたはIPパケットのペイロード部
に挿入して送信できる擬似ランダムパターン送信装置を
提供する。 【解決手段】 ソフトウエア処理手段1と、擬似ランダ
ムパターンを記憶する記憶手段2と、デジタル信号の連
続したフレームのペイロード部に、前記擬似ランダムパ
ターンを順次挿入して構成した複数のパケットを記憶す
る送信メモリ3と、指定された前記デジタル信号の送信
レートに応じて計算された挿入アイドルバイトを計算す
るアイドル送出処理部4と、デジタル回線7に対して、
前記送信メモリからの複数のパケットの送信と、前記ア
イドル送出部からのアイドルバイトとの送信を交互に実
行する送信制御手段6と、を有することを特徴とする擬
似ランダムパターン送信装置。
使用せず、ソフトウエア処理により擬似ランダムパター
ンをPPPフレームまたはIPパケットのペイロード部
に挿入して送信できる擬似ランダムパターン送信装置を
提供する。 【解決手段】 ソフトウエア処理手段1と、擬似ランダ
ムパターンを記憶する記憶手段2と、デジタル信号の連
続したフレームのペイロード部に、前記擬似ランダムパ
ターンを順次挿入して構成した複数のパケットを記憶す
る送信メモリ3と、指定された前記デジタル信号の送信
レートに応じて計算された挿入アイドルバイトを計算す
るアイドル送出処理部4と、デジタル回線7に対して、
前記送信メモリからの複数のパケットの送信と、前記ア
イドル送出部からのアイドルバイトとの送信を交互に実
行する送信制御手段6と、を有することを特徴とする擬
似ランダムパターン送信装置。
Description
【0001】
【発明の属する技術分野】本発明は、インターネット通
信で使用されるIPネットワーク及びIPネットワーク
のバックボーンとなるSONET/SDH網におけるP
PPoverSONET/SDH(略称POS)のPPPフ
レームおよびIPパケットのペイロード部に擬似ランダ
ムパターンを挿入し、ペイロード部の疑似ランダムパタ
ーンをPNパターンの発生規則に従って連続させて複数
のPPPフレームまたはIPパケットを、任意の回線使
用率で発生させる装置に関するものである。
信で使用されるIPネットワーク及びIPネットワーク
のバックボーンとなるSONET/SDH網におけるP
PPoverSONET/SDH(略称POS)のPPPフ
レームおよびIPパケットのペイロード部に擬似ランダ
ムパターンを挿入し、ペイロード部の疑似ランダムパタ
ーンをPNパターンの発生規則に従って連続させて複数
のPPPフレームまたはIPパケットを、任意の回線使
用率で発生させる装置に関するものである。
【0002】
【従来の技術】従来の擬似ランダムパターン発生装置で
は、ソフトウエアによって疑似ランダムパターンをメモ
リ等に一次的に記憶し、パケット作成部においてそのメ
モリ等の内容をペイロード部に反映して、フラグ及びF
CSを付与した後、パケット化を行い、回線に送出して
いた。
は、ソフトウエアによって疑似ランダムパターンをメモ
リ等に一次的に記憶し、パケット作成部においてそのメ
モリ等の内容をペイロード部に反映して、フラグ及びF
CSを付与した後、パケット化を行い、回線に送出して
いた。
【0003】この際、メモリ上に記憶するパターンは1
パケット分の長さであり、送信の度にソフトウエアによ
ってメモリに記憶させていた。このため、低速のインタ
フェースでは送信トラヒックを確保することができる
が、POS等の高速インタフェースでは、送信トラヒッ
クを確保することが難しいという問題があった。
パケット分の長さであり、送信の度にソフトウエアによ
ってメモリに記憶させていた。このため、低速のインタ
フェースでは送信トラヒックを確保することができる
が、POS等の高速インタフェースでは、送信トラヒッ
クを確保することが難しいという問題があった。
【0004】
【発明が解決しようとする課題】しかし、ソフトウエア
によるメモリの書込みの問題をなくすために、送信を行
う以前に擬似ランダムパターンのPNパターンが周回す
る分を、予めメモリに記憶させておき、パケット処理部
がある一定の長さのパターンを順にパケット化して送出
する方式も考えられる。このような方式では、高速イン
タフェースの送信トラヒックを確保することができる
が、パケット処理部がメモリ内容を順に参照する必要が
あるため、アドレス管理を行わなければならず、ハード
ウエア規模が膨大になり、コストの高いものになるとい
う問題があった。
によるメモリの書込みの問題をなくすために、送信を行
う以前に擬似ランダムパターンのPNパターンが周回す
る分を、予めメモリに記憶させておき、パケット処理部
がある一定の長さのパターンを順にパケット化して送出
する方式も考えられる。このような方式では、高速イン
タフェースの送信トラヒックを確保することができる
が、パケット処理部がメモリ内容を順に参照する必要が
あるため、アドレス管理を行わなければならず、ハード
ウエア規模が膨大になり、コストの高いものになるとい
う問題があった。
【0005】本発明の目的は、ハードウエアによる擬似
ランダム発生回路を使用せず、ソフトウエア処理により
擬似ランダムパターンをPPPフレームまたはIPパケ
ットのペイロード部に挿入して送信できる擬似ランダム
パターン送信装置を提供することである。
ランダム発生回路を使用せず、ソフトウエア処理により
擬似ランダムパターンをPPPフレームまたはIPパケ
ットのペイロード部に挿入して送信できる擬似ランダム
パターン送信装置を提供することである。
【0006】
【課題を解決するための手段】上記課題を解決するため
に、ソフトウエア処理手段(CPUによるソフトウエア
処理部)1と、擬似ランダムパターンを記憶する擬似ラ
ンダムパターン記憶手段(一次メモリ)2と、デジタル
信号の連続したフレームのペイロード部に、前記擬似ラ
ンダムパターンを順次挿入して構成した複数のパケット
を記憶する送信メモリ3と、指定された前記デジタル信
号の送信レートに応じて計算された挿入アイドルバイト
を計算するアイドル送出処理部4と、デジタル回線7に
対して、前記送信メモリからの複数のパケットの送信
と、前記アイドル送出部からのアイドルバイトとの送信
を交互に実行する送信制御手段(SDH送信部)6と
で、擬似ランダムパターン送信装置を構成する。この構
成で、ハードウエアによる擬似ランダム発生回路を使用
せず、ソフトウエア処理により擬似ランダムパターンを
PPPフレームまたはIPパケットのペイロード部に挿
入して送信できる。(請求項1)
に、ソフトウエア処理手段(CPUによるソフトウエア
処理部)1と、擬似ランダムパターンを記憶する擬似ラ
ンダムパターン記憶手段(一次メモリ)2と、デジタル
信号の連続したフレームのペイロード部に、前記擬似ラ
ンダムパターンを順次挿入して構成した複数のパケット
を記憶する送信メモリ3と、指定された前記デジタル信
号の送信レートに応じて計算された挿入アイドルバイト
を計算するアイドル送出処理部4と、デジタル回線7に
対して、前記送信メモリからの複数のパケットの送信
と、前記アイドル送出部からのアイドルバイトとの送信
を交互に実行する送信制御手段(SDH送信部)6と
で、擬似ランダムパターン送信装置を構成する。この構
成で、ハードウエアによる擬似ランダム発生回路を使用
せず、ソフトウエア処理により擬似ランダムパターンを
PPPフレームまたはIPパケットのペイロード部に挿
入して送信できる。(請求項1)
【0007】また、前記デジタル信号を、IPパケット
とすることによって、IPパケットのペイロード部に擬
似ランダムパターンを挿入してデジタル回線に送信する
ことができる。(請求項2) また、前記デジタル信号を、PPPフレームとすること
によって、PPPフレームのペイロード部に擬似ランダ
ムパターンを挿入してデジタル回線に送信することがで
きる。(請求項3) また、前記デジタル信号を、PPPフレームとした際
に、PPPフレームに含まれるIPパケット全体をペイ
ロード部として扱い、該IPパケット部に擬似ランダム
パターンを挿入してデジタル回線に送信することもでき
る。(請求項4)
とすることによって、IPパケットのペイロード部に擬
似ランダムパターンを挿入してデジタル回線に送信する
ことができる。(請求項2) また、前記デジタル信号を、PPPフレームとすること
によって、PPPフレームのペイロード部に擬似ランダ
ムパターンを挿入してデジタル回線に送信することがで
きる。(請求項3) また、前記デジタル信号を、PPPフレームとした際
に、PPPフレームに含まれるIPパケット全体をペイ
ロード部として扱い、該IPパケット部に擬似ランダム
パターンを挿入してデジタル回線に送信することもでき
る。(請求項4)
【0008】また、前記デジタル回線は、SDH回線
(SONET/SDH網におけるPPPoverSONET
/SDH(略称POS)のPPPフレームおよびIPパ
ケット)とすることもできる。(請求項5)
(SONET/SDH網におけるPPPoverSONET
/SDH(略称POS)のPPPフレームおよびIPパ
ケット)とすることもできる。(請求項5)
【0009】また、前記擬似ランダムパターン中に予め
エラーの設定が可能な構成とすることにより、予め設定
されたエラーをペイロード部に挿入した信号を送信する
ことによって、受信側で、当該エラーの検出の有無を検
査することもできる。(請求項6)
エラーの設定が可能な構成とすることにより、予め設定
されたエラーをペイロード部に挿入した信号を送信する
ことによって、受信側で、当該エラーの検出の有無を検
査することもできる。(請求項6)
【0010】また、前記擬似ランダムパターン記憶手段
に記憶される、擬似ランダムパターンが、2n −1ビッ
トで構成されるデータであって、任意に変更可能な構成
とすることによって、 nとして例えば9,15,23
等のものを用いることができる。(請求項7)
に記憶される、擬似ランダムパターンが、2n −1ビッ
トで構成されるデータであって、任意に変更可能な構成
とすることによって、 nとして例えば9,15,23
等のものを用いることができる。(請求項7)
【0011】
【発明の実施の形態】本発明の基礎になるインターネッ
ト通信で使用される、SONET/SDH網におけるP
PPoverSONET/SDH(略称POS)のPPPフ
レームについて図1を使用して説明する。図1におい
て、SONET/SDHフレームは、3バイトからな
る、SOH(Section Overhead),LOH(Line Ove
rhead),1バイトのPOH(Path Overhead)及び8
6バイトのPayload部で構成され、該Payload部は、IP
パケットを含む複数のPPPフレームからなっている。
ト通信で使用される、SONET/SDH網におけるP
PPoverSONET/SDH(略称POS)のPPPフ
レームについて図1を使用して説明する。図1におい
て、SONET/SDHフレームは、3バイトからな
る、SOH(Section Overhead),LOH(Line Ove
rhead),1バイトのPOH(Path Overhead)及び8
6バイトのPayload部で構成され、該Payload部は、IP
パケットを含む複数のPPPフレームからなっている。
【0012】また、前記PPPフレームは、図2(a)に
示す如き、フラグ(7E),アドレス(FF),コントロール(0
3),プロトコル(0021)PPPペイロード,FCS(CRC-32/1
6)及びフラグ(7E)により構成され、最大で1508バ
イトである。そして、PPPフレームにおけるペイロー
ド部は0〜1500バイトである。
示す如き、フラグ(7E),アドレス(FF),コントロール(0
3),プロトコル(0021)PPPペイロード,FCS(CRC-32/1
6)及びフラグ(7E)により構成され、最大で1508バ
イトである。そして、PPPフレームにおけるペイロー
ド部は0〜1500バイトである。
【0013】また、IPパケットは、図2(b)に示す如
き、バージョン番号(Ver),ヘッダ長(32ビット単
位)(HLEN),サービス種類(Type of Service),
全体長(バイト単位)(Total Length),パケット識
別子(Indetification),フラグメント制御用(Frag
s),フラグメントオフセット(Fragment Offset),
送信元アドレス(Source Address),送信先アドレス
(Destination Address),オプション(Option)及び
ペイロード部(Payload)からなっている。
き、バージョン番号(Ver),ヘッダ長(32ビット単
位)(HLEN),サービス種類(Type of Service),
全体長(バイト単位)(Total Length),パケット識
別子(Indetification),フラグメント制御用(Frag
s),フラグメントオフセット(Fragment Offset),
送信元アドレス(Source Address),送信先アドレス
(Destination Address),オプション(Option)及び
ペイロード部(Payload)からなっている。
【0014】また、本発明は、図3に記載の構成を有し
ている。図3における、1はCPUによるソフトウエア
処理部、2は一次メモリ、3は送信メモリ、4はアイド
ル送信処理部、5はメモリ送出処理部、6はSDH送信
部、7はSDH回線である。また、CPUによるソフト
ウエア処理部1は、ヒューマンインタフェース(HM
I)からの擬似ランダムパターンの指示に応じて擬似ラ
ンダムパターンの作成処理部1−1で実行して、前記一
次メモリ2に記憶する。
ている。図3における、1はCPUによるソフトウエア
処理部、2は一次メモリ、3は送信メモリ、4はアイド
ル送信処理部、5はメモリ送出処理部、6はSDH送信
部、7はSDH回線である。また、CPUによるソフト
ウエア処理部1は、ヒューマンインタフェース(HM
I)からの擬似ランダムパターンの指示に応じて擬似ラ
ンダムパターンの作成処理部1−1で実行して、前記一
次メモリ2に記憶する。
【0015】また、CPUによるソフトウエア処理部1
は、ヒューマンインタフェース(HMI)からのIPペ
イロード長の指定、IPヘッダの作成、アイドルバイト
長の指定に応じてIPパケットの作成処理部1−2で実
行して、前記送信メモリ3に記憶する。また、CPUに
よるソフトウエア処理部1は、ヒューマンインタフェー
ス(HMI)からの送信レートの指定に応じて、挿入ア
イドルバイト数計算部1−3で挿入アイドルバイト数を
計算して、前記アイドル送出処理部4に出力する。
は、ヒューマンインタフェース(HMI)からのIPペ
イロード長の指定、IPヘッダの作成、アイドルバイト
長の指定に応じてIPパケットの作成処理部1−2で実
行して、前記送信メモリ3に記憶する。また、CPUに
よるソフトウエア処理部1は、ヒューマンインタフェー
ス(HMI)からの送信レートの指定に応じて、挿入ア
イドルバイト数計算部1−3で挿入アイドルバイト数を
計算して、前記アイドル送出処理部4に出力する。
【0016】また、前記一次メモリに記憶された疑似ラ
ンダムパターンは、前記送信メモリ5に送られて、PP
Pフレーム及びIPパケットのペイロード部に擬似ラン
ダムパターンを挿入して作成した複数のパケットが記憶
される。
ンダムパターンは、前記送信メモリ5に送られて、PP
Pフレーム及びIPパケットのペイロード部に擬似ラン
ダムパターンを挿入して作成した複数のパケットが記憶
される。
【0017】前記送信メモリ3に記憶された、ペイロー
ド部に擬似ランダムパターンが挿入されたPPPフレー
ム及びIPパケットは、メモリ送出処理部5を介して、
前記アイドル送出処理部4の出力と共に、SDH送信部
6からSDH回線に送信される。
ド部に擬似ランダムパターンが挿入されたPPPフレー
ム及びIPパケットは、メモリ送出処理部5を介して、
前記アイドル送出処理部4の出力と共に、SDH送信部
6からSDH回線に送信される。
【0018】この発明のパケットの送出では、擬似ラン
ダムパターンを作成するソフトウエア処理により、一次
メモリ2にPNパターンを完結させたデータを作成す
る。このデータは、メモリから繰り返し送出することに
よって、PNパターンの連続性が確保される。
ダムパターンを作成するソフトウエア処理により、一次
メモリ2にPNパターンを完結させたデータを作成す
る。このデータは、メモリから繰り返し送出することに
よって、PNパターンの連続性が確保される。
【0019】この発明では、32周分の疑似ランダムパ
ターンを用いられる。その理由は以下の条件から得られ
る。 ・擬似ランダムパターンは2n−1ビットで構成され
る。(nは勧告で決まっており、例えば,9,15,2
3等がある。) ・PPPoverSDHでは、オクテット同期のデータ構成
となるため、8周分のビットを要する。 ・IPパケットは4バイトバウンダリ構成をとるため、
4周分のビット数を要する。
ターンを用いられる。その理由は以下の条件から得られ
る。 ・擬似ランダムパターンは2n−1ビットで構成され
る。(nは勧告で決まっており、例えば,9,15,2
3等がある。) ・PPPoverSDHでは、オクテット同期のデータ構成
となるため、8周分のビットを要する。 ・IPパケットは4バイトバウンダリ構成をとるため、
4周分のビット数を要する。
【0020】次に本発明におけるパケットの作成の手順
を説明する。先ず、CPUによるソフトウエア処理部1
に対して、ヒューマンインタフェース(HMI)から擬
似ランダムパターンの作成の指示に応じて、該ヒューマ
ンインタフェース(HMI)から、 ・フレームまたはパケットのヘッダ部のテンプレートが
指示される。 ・フレームまたはパケットのペイロード長が指示され
る。 ・フレームまたはパケット間のアイドルデータバイト数
(フラグ共有を含む)が指示される。
を説明する。先ず、CPUによるソフトウエア処理部1
に対して、ヒューマンインタフェース(HMI)から擬
似ランダムパターンの作成の指示に応じて、該ヒューマ
ンインタフェース(HMI)から、 ・フレームまたはパケットのヘッダ部のテンプレートが
指示される。 ・フレームまたはパケットのペイロード長が指示され
る。 ・フレームまたはパケット間のアイドルデータバイト数
(フラグ共有を含む)が指示される。
【0021】前記ヒューマンインタフェース(HMI)
からの指示に応じて、前記一次メモリ2に記憶された擬
似ランダムパターンを所定の長さづつペイロードとし
て、IPパケットヘッダ及びFCS計算を行ってパケッ
トとして送信メモリ3に記憶する処理を繰り返して実行
される。その結果、送信メモリ3に記憶されるデータ
は、図4に記載の如く作成される。
からの指示に応じて、前記一次メモリ2に記憶された擬
似ランダムパターンを所定の長さづつペイロードとし
て、IPパケットヘッダ及びFCS計算を行ってパケッ
トとして送信メモリ3に記憶する処理を繰り返して実行
される。その結果、送信メモリ3に記憶されるデータ
は、図4に記載の如く作成される。
【0022】図4は、本発明で作成された送信メモリ3
に記憶されるデータであって、基本的には、IPヘッダ
部、擬似ランダムパターンが挿入されたIPペイロー
ド部 及びアイドル部の繰り返しからなっている。
に記憶されるデータであって、基本的には、IPヘッダ
部、擬似ランダムパターンが挿入されたIPペイロー
ド部 及びアイドル部の繰り返しからなっている。
【0023】次に、IPペイロード部に対する、擬似ラ
ンダムパターンの挿入の手順を説明する。図4における
は、ヒューマンインタフェース(HMI)から指示さ
れたフレームまたはパケットのヘッダ部のテンプレイト
である。
ンダムパターンの挿入の手順を説明する。図4における
は、ヒューマンインタフェース(HMI)から指示さ
れたフレームまたはパケットのヘッダ部のテンプレイト
である。
【0024】図4における−1は、ヒューマンインタ
フェース(HMI)から指示されたペイロード長の擬似
ランダムパターンである。(この擬似ランダムパターン
は、一次メモリ2から指示されたペイロード長ずつ順次
読み出される。)
フェース(HMI)から指示されたペイロード長の擬似
ランダムパターンである。(この擬似ランダムパターン
は、一次メモリ2から指示されたペイロード長ずつ順次
読み出される。)
【0025】図4におけるは、ヒューマンインタフェ
ース(HMI)から指示されたフレームまたはパケット
間のアイドルデータバイト数(フラグ共有を含む)分の
アイドルビットである。
ース(HMI)から指示されたフレームまたはパケット
間のアイドルデータバイト数(フラグ共有を含む)分の
アイドルビットである。
【0026】図4のの次のは最初のと同じで、ヒ
ューマンインタフェース(HMI)から指示されたフレ
ームまたはパケットのヘッダ部のテンプレイトである。
また、図4の−2は、−1と同じで、ヒューマンイ
ンタフェース(HMI)から指示されたペイロード長の
擬似ランダムパターンで、この擬似ランダムパターン
は、一次メモリ2から指示された−1に続いて読み出
された部分である。
ューマンインタフェース(HMI)から指示されたフレ
ームまたはパケットのヘッダ部のテンプレイトである。
また、図4の−2は、−1と同じで、ヒューマンイ
ンタフェース(HMI)から指示されたペイロード長の
擬似ランダムパターンで、この擬似ランダムパターン
は、一次メモリ2から指示された−1に続いて読み出
された部分である。
【0027】この処理を繰り返して、図4における−
最後は、ヒューマンインタフェース(HMI)から指示
されたペイロード長の擬似ランダムパターンの割り切れ
なかった場合の余りの部分である。したがって、上記
−1,−2・・・・−最後の関係は、−1+−
2+・・・・・+−最後=32周分の擬似ランダムパ
ターン(bit)になる。
最後は、ヒューマンインタフェース(HMI)から指示
されたペイロード長の擬似ランダムパターンの割り切れ
なかった場合の余りの部分である。したがって、上記
−1,−2・・・・−最後の関係は、−1+−
2+・・・・・+−最後=32周分の擬似ランダムパ
ターン(bit)になる。
【0028】次に、前記送信メモリ3に記憶された、図
4に示す如きデータをSDH回線に送信するSDH送信
部6の手順を、図5を用いて説明する。先ず、ヒューマ
ンインタフェース(HMI)から、フレームまたはパケ
ット全体の送出割合(SONET/SDHペイロードの
全ビットを100%とした場合のフレームまたはパケッ
ト全体が占める割合)が指示される。
4に示す如きデータをSDH回線に送信するSDH送信
部6の手順を、図5を用いて説明する。先ず、ヒューマ
ンインタフェース(HMI)から、フレームまたはパケ
ット全体の送出割合(SONET/SDHペイロードの
全ビットを100%とした場合のフレームまたはパケッ
ト全体が占める割合)が指示される。
【0029】次に、図4で示す如き、送信メモリ3に記
憶されているフレームまたはパケット間のアイドルデー
タバイト数(フラグ共有を含む)の総数と、ヒューマン
インタフェース(HMI)より指示された、フレームま
たはパケット全体の送出割合により、送信メモリ間に何
バイトのアイドルデータバイト数を送出すればよいか
を、前記挿入アイドルバイト数計算部1−3で計算し
て、前記アイドル送出処理部4を介してSDH送信部6
に出力する。
憶されているフレームまたはパケット間のアイドルデー
タバイト数(フラグ共有を含む)の総数と、ヒューマン
インタフェース(HMI)より指示された、フレームま
たはパケット全体の送出割合により、送信メモリ間に何
バイトのアイドルデータバイト数を送出すればよいか
を、前記挿入アイドルバイト数計算部1−3で計算し
て、前記アイドル送出処理部4を介してSDH送信部6
に出力する。
【0030】SDH送信部6では、前記送信メモリ3か
らの読み出したデータを送信する度に、前記アイドル送
出処理部1−3で計算したアイドルバイトを、続けてS
DH回線に送信する。この処理が繰り返されることによ
り、ヒューマンインタフェース(HMI)で指定した送
信レートで擬似ランダムパターンをペイロードに含むパ
ケットがSDH回線に送出される。
らの読み出したデータを送信する度に、前記アイドル送
出処理部1−3で計算したアイドルバイトを、続けてS
DH回線に送信する。この処理が繰り返されることによ
り、ヒューマンインタフェース(HMI)で指定した送
信レートで擬似ランダムパターンをペイロードに含むパ
ケットがSDH回線に送出される。
【0031】なお、上記説明では、IPパケットにおけ
るペイロード部分に擬似ランダムパターンを挿入するも
のとして説明を行ったが、PPPフレームを構成するI
Pパケット全体をペイロードとして扱って、その部分に
擬似ランダムパターンを挿入することも可能である。
るペイロード部分に擬似ランダムパターンを挿入するも
のとして説明を行ったが、PPPフレームを構成するI
Pパケット全体をペイロードとして扱って、その部分に
擬似ランダムパターンを挿入することも可能である。
【0032】また、擬似ランダムパターンの送信に際し
て、予め所定のエラーを擬似ランダムパターン中に設定
しておくことによって、受信側で設定されたエラーが検
出できるか否かの測定を行うことも可能である。
て、予め所定のエラーを擬似ランダムパターン中に設定
しておくことによって、受信側で設定されたエラーが検
出できるか否かの測定を行うことも可能である。
【0033】
【発明の効果】請求項1に記載の発明では、ソフトウエ
ア処理手段(CPUによるソフトウエア処理部)1と、
擬似ランダムパターンを記憶する擬似ランダムパターン
記憶手段(一次メモリ)2と、デジタル信号の連続した
フレームのペイロード部に、前記擬似ランダムパターン
を順次挿入して構成した複数のパケットを記憶する送信
メモリ3と、指定された前記デジタル信号の送信レート
に応じて計算された挿入アイドルバイトを計算するアイ
ドル送出処理部4と、デジタル回線7に対して、前記送
信メモリからの複数のパケットの送信と、前記アイドル
送出部からのアイドルバイトとの送信を交互に実行する
送信制御手段(SDH送信部)6とで、擬似ランダムパ
ターン送信装置を構成することにより、ハードウエアに
よる擬似ランダム発生回路を使用せず、ソフトウエア処
理により擬似ランダムパターンをPPPフレームまたは
IPパケットのペイロード部に挿入して送信できる。
ア処理手段(CPUによるソフトウエア処理部)1と、
擬似ランダムパターンを記憶する擬似ランダムパターン
記憶手段(一次メモリ)2と、デジタル信号の連続した
フレームのペイロード部に、前記擬似ランダムパターン
を順次挿入して構成した複数のパケットを記憶する送信
メモリ3と、指定された前記デジタル信号の送信レート
に応じて計算された挿入アイドルバイトを計算するアイ
ドル送出処理部4と、デジタル回線7に対して、前記送
信メモリからの複数のパケットの送信と、前記アイドル
送出部からのアイドルバイトとの送信を交互に実行する
送信制御手段(SDH送信部)6とで、擬似ランダムパ
ターン送信装置を構成することにより、ハードウエアに
よる擬似ランダム発生回路を使用せず、ソフトウエア処
理により擬似ランダムパターンをPPPフレームまたは
IPパケットのペイロード部に挿入して送信できる。
【0034】また、請求項2に記載の発明では、前記デ
ジタル信号を、IPパケットとすることによって、IP
パケットのペイロード部に擬似ランダムパターンを挿入
してデジタル回線に送信することができる。また、請求
項3に貴紙娃の発明では、前記デジタル信号を、PPP
フレームとすることによって、PPPフレームのペイロ
ード部に擬似ランダムパターンを挿入してデジタル回線
に送信することができる。また、請求項4に記載の発明
では、前記デジタル信号を、PPPフレームとした際
に、PPPフレームに含まれるIPパケット全体をペイ
ロード部として扱い、該IPパケット部に擬似ランダム
パターンを挿入してデジタル回線に送信することもでき
る。
ジタル信号を、IPパケットとすることによって、IP
パケットのペイロード部に擬似ランダムパターンを挿入
してデジタル回線に送信することができる。また、請求
項3に貴紙娃の発明では、前記デジタル信号を、PPP
フレームとすることによって、PPPフレームのペイロ
ード部に擬似ランダムパターンを挿入してデジタル回線
に送信することができる。また、請求項4に記載の発明
では、前記デジタル信号を、PPPフレームとした際
に、PPPフレームに含まれるIPパケット全体をペイ
ロード部として扱い、該IPパケット部に擬似ランダム
パターンを挿入してデジタル回線に送信することもでき
る。
【0035】また、請求項5に記載の発明では、前記デ
ジタル回線は、SDH回線(SONET/SDH網にお
けるPPPoverSONET/SDH(略称POS)のP
PPフレームおよびIPパケット)とすることもでき
る。
ジタル回線は、SDH回線(SONET/SDH網にお
けるPPPoverSONET/SDH(略称POS)のP
PPフレームおよびIPパケット)とすることもでき
る。
【0036】また、請求項6に記載の発明では、前記擬
似ランダムパターン中に予めエラーの設定が可能な構成
とすることにより、予め設定されたエラーをペイロード
部に挿入した信号を送信することによって、受信側で、
当該エラーの検出の有無を検査することもできる。
似ランダムパターン中に予めエラーの設定が可能な構成
とすることにより、予め設定されたエラーをペイロード
部に挿入した信号を送信することによって、受信側で、
当該エラーの検出の有無を検査することもできる。
【0037】また、請求項7に記載の発明では、前記擬
似ランダムパターン記憶手段に記憶される、擬似ランダ
ムパターンが、2n −1ビットで構成されるデータであ
って、任意に変更可能な構成とすることによって、 n
として例えば9,15,23等のものを用いることがで
き、擬似ランダムパターンの加工をハードウエアの追加
なしにできる。
似ランダムパターン記憶手段に記憶される、擬似ランダ
ムパターンが、2n −1ビットで構成されるデータであ
って、任意に変更可能な構成とすることによって、 n
として例えば9,15,23等のものを用いることがで
き、擬似ランダムパターンの加工をハードウエアの追加
なしにできる。
【図1】SONET/SDHフレームの構成とPPPフ
レームの関係を示す図である。
レームの関係を示す図である。
【図2】PPPフレームとIPパケットの構成を示す図
である。
である。
【図3】本発明の構成を示す図である。
【図4】送信メモリに記憶されるデータパターンを示す
図である。
図である。
【図5】SDH送信部からSDH回線に送出されるデー
タのタイミングを示す図である。
タのタイミングを示す図である。
Claims (7)
- 【請求項1】 ソフトウエア処理手段と、 擬似ランダムパターンを記憶する擬似ランダムパターン
記憶手段と、 デジタル信号の連続したフレームのペイロード部に、前
記擬似ランダムパターンを順次挿入して構成した複数の
パケットを記憶する送信メモリと、 指定された前記デジタル信号の送信レートに応じて計算
された挿入アイドルバイトを計算するアイドル送出処理
部と、 デジタル回線に対して、前記送信メモリからの複数のパ
ケットの送信と、前記アイドル送出部からのアイドルバ
イトとの送信を交互に実行する送信制御手段と、 を有することを特徴とする擬似ランダムパターン送信装
置。 - 【請求項2】 前記デジタル信号は、IPパケットであ
ることを特徴とする請求項1に記載の擬似ランダムパタ
ーン送信装置。 - 【請求項3】 前記デジタル信号は、PPPフレームで
あることを特徴とする請求項1に記載の擬似ランダムパ
ターン送信装置。 - 【請求項4】 前記PPPフレームを構成するIPパケ
ット全体をペイロード部として扱うことを特徴とする請
求項3に記載の擬似ランダムパターン送信装置。 - 【請求項5】 前記デジタル回線は、SDH回線である
ことを特徴とする請求項1〜4のいずれか1項に記載の
擬似ランダムパターン送信装置。 - 【請求項6】 前記擬似ランダムパターン中に予めエラ
ーの設定が可能であることを特徴とする請求項1〜5の
いずれか1項に記載の擬似ランダムパターン送信装置。 - 【請求項7】 前記擬似ランダムパターン記憶手段に記
憶される、擬似ランダムパターンが、2n −1ビットで
構成されるデータであって、任意に変更可能であること
を特徴とする請求項1〜6のいずれか1項に記載の擬似
ランダムパターン送信装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001044660A JP2002247001A (ja) | 2001-02-21 | 2001-02-21 | 擬似ランダムパターン送信装置 |
US10/081,057 US20020131450A1 (en) | 2001-02-21 | 2002-02-21 | Pseudo-random pattern transmission apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001044660A JP2002247001A (ja) | 2001-02-21 | 2001-02-21 | 擬似ランダムパターン送信装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2002247001A true JP2002247001A (ja) | 2002-08-30 |
Family
ID=18906613
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2001044660A Pending JP2002247001A (ja) | 2001-02-21 | 2001-02-21 | 擬似ランダムパターン送信装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US20020131450A1 (ja) |
JP (1) | JP2002247001A (ja) |
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---|---|---|---|---|
US7874015B2 (en) * | 2006-05-12 | 2011-01-18 | At&T Intellectual Property I, L.P. | Methods, systems, and computer program products for controlling distribution of digital content in a file sharing system using license-based verification, encoded tagging, and time-limited fragment validity |
CN102291406B (zh) * | 2011-08-12 | 2017-02-15 | 中兴通讯股份有限公司 | 鲁棒性头压缩处理方法及鲁棒性头压缩处理器 |
US9628396B2 (en) * | 2013-07-11 | 2017-04-18 | Mediatek Inc. | Network device and method for outputting data to bus with data bus width at each cycle by generating end of packet and start of packet at different cycles |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2892180B2 (ja) * | 1991-04-30 | 1999-05-17 | 富士通株式会社 | Atmクロスコネクト装置の監視方式 |
CA2097350C (en) * | 1992-08-17 | 1998-12-22 | Shahrukh S. Merchant | Asynchronous transfer mode (atm) transmission test cell generator |
EP0662778B1 (en) * | 1994-01-11 | 2005-10-12 | NTT DoCoMo, Inc. | Mobile radio communications system |
US6215798B1 (en) * | 1996-11-01 | 2001-04-10 | Telefonaktiebolaget Lm Ericsson (Publ) | Multi-frame synchronization for parallel channel transmissions |
US6069876A (en) * | 1997-02-13 | 2000-05-30 | Nortel Networks Corporation | Performance monitoring of an ATM Network |
US6233253B1 (en) * | 1997-05-23 | 2001-05-15 | Thomson Licensing S.A. | System for digital data format conversion and bit stream generation |
US6904110B2 (en) * | 1997-07-31 | 2005-06-07 | Francois Trans | Channel equalization system and method |
US6707842B2 (en) * | 1997-10-22 | 2004-03-16 | Via Telecom Co., Ltd. | Accelerated base station searching by buffering samples |
JP3536909B2 (ja) * | 1999-12-24 | 2004-06-14 | 日本電気株式会社 | 交換装置とスクランブル方法 |
US20020031141A1 (en) * | 2000-05-25 | 2002-03-14 | Mcwilliams Patrick | Method of detecting back pressure in a communication system using an utopia-LVDS bridge |
US6879581B1 (en) * | 2000-08-22 | 2005-04-12 | Qualcomm Incorporated | Method and apparatus for providing real-time packetized voice and data services over a wireless communication network |
-
2001
- 2001-02-21 JP JP2001044660A patent/JP2002247001A/ja active Pending
-
2002
- 2002-02-21 US US10/081,057 patent/US20020131450A1/en not_active Abandoned
Also Published As
Publication number | Publication date |
---|---|
US20020131450A1 (en) | 2002-09-19 |
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