EP0252911B1 - Programmable circuit for the control of a liquid crystal indicator - Google Patents
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- EP0252911B1 EP0252911B1 EP86901788A EP86901788A EP0252911B1 EP 0252911 B1 EP0252911 B1 EP 0252911B1 EP 86901788 A EP86901788 A EP 86901788A EP 86901788 A EP86901788 A EP 86901788A EP 0252911 B1 EP0252911 B1 EP 0252911B1
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- crystal display
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
Definitions
- the invention relates to a control circuit of the type specified in the preamble of claim 1.
- Circuits of this type are known which make it possible to control those organized in a matrix-like manner Liquid crystal (LCD) display module required to derive information-containing signals from a processor system, the clock and timing signals for the LCD display being generated in the control circuit itself.
- the characters to be reproduced are usually generated with the aid of memories available in the control circuit itself, which are able to display complete characters on the LCD display on a corresponding command.
- control devices for changing the image content require more or less complex operations, which have in common that the processor's access to the memory area assigned to the LCD display is only indirect after a corresponding one Request can be made via the control circuit, waiting cycles and similar delays must be accepted.
- the content of the liquid crystal display can only be initiated indirectly via a memory, which in turn contains the components necessary for generating complete drawing elements composed of point groups.
- the invention specified in claim 1 is based on the task of largely simplifying a control device of the type mentioned at the outset, changes in the screen content should be made as independently as possible of the functional cycles of the control circuit without taking special time conditions into account.
- the invention is based on the knowledge that time-optimal processing of signals present in an image memory is possible if the memory area assigned to the image can be achieved essentially independently of the internal control sequence of the circuit and largely unaffected by the times required to supply the screen with data from memory are required.
- the access times for the control of the LCD display module can regularly be kept so short that the data access from the computer system is not or hardly affected in time.
- the control circuit is thus “quasi-transparent” for the connected computer, so that the contents of the screen (memory) can be changed at any time without regard to the cyclical internal processes of the control device can.
- the memory for holding the screen contents appears to the processor system as part of the memory areas which it can directly access. It is controlled via memory-oriented addressing in accordance with the usual addressing of RAM or ROM memory modules.
- the access to the "reserved" memory areas for the LCD display is carried out in a regular sequence with short-term shutdown of access by the computer, with appropriate buffering between the computer and screen memory can be achieved that this or no, or at most a slight time delay for the processor system occurs.
- timing of the switching determined by the internal timing of the control circuit takes place in such a way that the times for which the internal lines of the control circuit are connected to the BUS structure for the transmission of data to the liquid crystal display are of the order of magnitude of the times for the transmission of individual ones
- data words are in the data exchange with the computer, and are preferably smaller, access to the memory areas assigned to the LCD modules is not, or at most occasionally, hindered, so that the computer is not restricted in its access.
- Data words are preferably read out from the memory for driving the LCD module one after the other, the time of the subsequent parallel-serial conversion in particular giving the computer access time again.
- the computer and control circuit operate asynchronously in their timing control relative to one another.
- a control circuit 1 is provided between a first complete bus structure 2, consisting of data bus 2a, address bus 2b and control bus 2c.
- This bus structure forms the system bus, which enables data operations between the control circuit according to the invention and a computer 3 and a main memory 4 assigned to the computer.
- the system bus 2 forms a known bus structure, as is used in the conventional microprocessors.
- the control device 1 is connected to a further bus structure 5, which likewise consists of a data bus 5a, an address bus 5b and a control bus 5c.
- a further bus structure 5 which likewise consists of a data bus 5a, an address bus 5b and a control bus 5c.
- Several - in the present example two - memory areas 6, 7 are connected to this second bus structure, each of which contains the complete image content of graphic information to be displayed on an LCD module.
- the LCD module 8 is controlled by the control circuit 1 via a driver stage 9, the data stored in the memories 6 or 7 existing data can be converted by the control circuit into serially transmitted information which is adapted to the respective LCD module.
- polarity reversals and possibly further control pulses are necessary which are necessary for the operation of such a display module.
- the data is transmitted over two or more lines (display data), the number of these data lines depending on how many fields the display area is divided into.
- an interface circuit 11 is distinguished in terms of block circuitry, which maintains the data communication with the bus structure 2 and thus forms the communication interface with the external computer system.
- the block diagram of the internal circuit shown in FIG. 2 further shows how the control lines (control bus in FIG. 1) are composed in detail.
- the following signal names were used:
- a time control 12 is synchronized by an externally connectable crystal 13.
- An additional test device 14 can be controlled externally and transmits an acknowledgment output "test" signal after the function test of the module has been properly completed.
- the connections to the external control bus are made by means of a module 14 which effects the data transmission to the second bus structure 5 according to FIG. 1.
- a control module 15 generates the serial data signals for controlling the data lines of the LCD module.
- the further control pulses for the LCD display come from the LCD driver controller 16, which generates the signals that are supplied to the external driver circuits.
- control pulses which are generated by means of the driver control 16 can be influenced via internal registers, the different control sequences corresponding to the various commercially produced LCD modules being represented by different data words.
- a central element for linking the two bus structures 2 and 5 is a multiplexer 21, to which the external bus structure 2 (data, address and control bus 2a, 2b and 2c) are fed via a data buffer 22.
- the connection to the outer bus structures for the individual bus lines is influenced as a function of the current operating state of the control circuit 1 by means of the switch connections shown as internal blocks.
- the connection of the bus lines to the memory areas 6 and 7 assigned to the image has priority over the access of the computer via lines 2.
- the bus lines 5a to 5c are therefore normally reserved for the internal access of the control circuit 1 in order to use the data in the Store 6 and 7 data found to build up the image information.
- the pulse sequences required to build up the image display are generated in a fixed time pattern, one of the memories 6 or 7 being accessed for the image content. Because the two memory areas of the control unit are available with priority, difficulties due to possible collisions with the computer access are avoided.
- the LCD display shows the memory content, the type of display being triggered by an external command from the computer via the bus structure 2 and the corresponding commands being stored in a register 23. The storage of commands in the Register 23 can occur at any time regardless of the state of the image generation, provided that only the type of image representation is affected. (Those commands which change the type of control of the LCD display 8 and which practically ensure the adaptation to another LCD module can be disregarded here.)
- Both memories 6 and 7 can then be accessed twice in succession with respect to the same picture content elements, whereby logical links between these picture contents can be generated in an arithmetic unit 24, so that a pixel is displayed in black if one of the corresponding pixels in both memories is black should be controlled (OR-linked display) or only if both are darkly controlled (AND-) or it can also be achieved that the screen content is only blanked if one of the corresponding memory locations contains the information "black" contains (EXCLUSIVE OR or EXOR representation).
- the memories 6 and 7 are addressed in such a way that successive memory addresses identify memory locations which also follow one another in the image display. Corresponding memory addresses in the memories 6 and 7 identify corresponding image areas.
- the data words recorded in the memories 6 and 7 describe - according to their bit length - the state of a corresponding sequence of pixels in the LCD display 8. Changes which affect the register 23, which occur during the image construction, are not disturbing to the human observer , as long as the image information in the following is is retained - this "image change" is felt as a natural change.
- the structure of the control circuit 1 is extremely simple.
- the need for information to be recorded for the image structure in memories 6 and 7 increases.
- the relevant data can be stored and changed without loss of time by the circuit according to the invention, there would be no simplification through the use of character generators within the control part 1.
- the direct access to the memories 6 and 7, as will be described below, increases the universality of the use of the control circuit considerably.
- the internal Control part 22 and the timer contained therein generates a pulse which sets the data transmission in the multiplexer 21 so that the internal bus lines are connected to the external bus 5.
- the memory content is transferred to the parallel-serial converter 15 and, after the clock signal has been delayed by a delay element 26 for a short time, the Reading of this data word from the parallel-serial converter is effected via a data line to the driver circuit 9. While the parallel-serial converter 15 is still busy reading the data word, the multiplexer 21 is again switched in the direction of data traffic between the bus structures 2 and 5 via a further delay circuit 27.
- the delay lines 26 and 27 have only symbolic meaning in the block diagram shown.
- the relevant signal delays can also be generated in other ways, for example by counters, natural line delays in signal transmission etc.
- the computer 6 connected to the bus structure 2 has almost unlimited access to the memories 6 and 7.
- the memory areas 6 and 7 for the connected computer circuit are now directly accessible and the Control circuit 1 is "quasi-transparent".
- the data available in memories 6 or 7 can be changed or deleted during access to control the LCD.
- a complete image change is carried out continuously. While the computer accesses one of the memory areas 6 or 7, a change in the information of a complete image display is carried out, a fixed image with the necessary “refresh” cycles can be reproduced from the other memory area without being influenced by the image change.
- completely generated image contents are stored in the correct sequence with respect to the addressing in the main memory 4 (FIG. 1), which can be transferred to a memory 6 or 7 assigned to the LCD at short notice if required.
- main memory 4 All information elements used for character formation are present in main memory 4 and can be addressed as a unit by macro commands and transferred to the corresponding memory areas of memories 6 and 7. There is a high degree of flexibility, since fixed character grids etc. are not required.
- the LCD display can be used in an independent graphics-capable company, whereby complex characters such as letters and numbers etc. can be read in at short notice by means of appropriate data transfers.
- the excess memory locations can also be saved by the computer can be used as a quasi-direct access memory area.
- the memory areas 6 and 7 can also be addressed in DMA mode by external modules, since corresponding control lines ("ready") are available.
- the data buffer 22 ensures that the data for access via the bus structure 2 are still available for a short time even when the multiplexer 21 is already in its operating state for the transmission of data in the internal control part 25.
- data can be read into the buffer area when the multiplexer is busy with the transfer of data from the memories 6 or 7 to the LCD display 8.
- the addressed data are still transferred to the buffer, for example in read mode, by means of a corresponding clock cycle before the multiplexer again allocates the bus 5 to the control circuit internally.
- the write mode the data transmitted by the computer are recorded and only read into the memories 6 or 7 via the multiplexer when the bus 5 is available to the computer again.
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Abstract
Description
Die Erfindung betrifft eine Steuerschaltung der im Oberbegriff des Anspruchs 1 angegebenen Art.The invention relates to a control circuit of the type specified in the preamble of
Es sind Schaltungen dieser Art bekannt, welche es ermöglichen, die zur Steuerung eines matrixartig organisierten Flüssigkristall-(LCD-)Anzeigemoduls erforderlichen, Informationen enthaltenden Signale von einem Prozessorsystem herzuleiten, wobei die Takt- und Zeitsteuersignale für die LCD-Anzeige in der Steuerschaltung selbst generiert werden. Dabei werden meist die wiederzugebenden Zeichen unter Zuhilfenahme von in der Steuerschaltung selbst vorhandenen Speichern generiert, welche in der Lage sind, auf einen entsprechenden Befehl hin vollständige Zeichen in der LCD-Anzeige zur Darstellung zu bringen.Circuits of this type are known which make it possible to control those organized in a matrix-like manner Liquid crystal (LCD) display module required to derive information-containing signals from a processor system, the clock and timing signals for the LCD display being generated in the control circuit itself. The characters to be reproduced are usually generated with the aid of memories available in the control circuit itself, which are able to display complete characters on the LCD display on a corresponding command.
Bei üblichen Flüssigkeitskristallanzeigen hoher Auflösung sind - entsprechend der matrixartigen Ansteuerung - Signalfolgen zu erstellen, welche zum einen in sequentieller Folge Bildzeilen entsprechende Signalmuster aussenden, zum anderen aber auch dafür sorgen, daß ein Neueinschreiben der Zeichen, beispielsweise unter Benutzung des bekannten "Zweidrittel-Verfahrens", in regelmäßiger Wiederholung erfolgt und außerdem in Abständen Umpolungen vorgenommen werden, um Elektrolyseerscheinungen bei den Flüssigkristallanordnungen zu vermeiden. Darüber hinaus sind gegebenenfalls Schaltmittel vorzusehen, um mehrere der Anzeigeflächen nebeneinander zu versorgen, da die maximal ansteuerbare Fläche durch die einzuhaltenden Wiederholungsintervalle begrenzt ist. Die so erzeugten Signale gelangen über Treiberstufen zu dem LCD-Modul.In the case of conventional liquid crystal displays of high resolution, signal sequences are to be created, corresponding to the matrix-like control, which on the one hand emit corresponding signal patterns in sequential image lines, but on the other hand also ensure that the characters are rewritten, for example using the known "two-thirds method" , is carried out in a regular repetition and polarity reversals are also carried out at intervals in order to avoid electrolysis phenomena in the liquid crystal arrangements. In addition, switching means may have to be provided in order to supply several of the display areas next to one another, since the maximum controllable area is limited by the repetition intervals to be observed. The signals generated in this way reach the LCD module via driver stages.
Nachteilig ist, daß die bekannten Steuereinrichtungen zur Änderung des Bildinhalts mehr oder weniger aufwendige Operationen erfordern, denen gemeinsam ist, daß der Zugriff des Prozessors auf den der LCD-Anzeige zugeordneten Speicherbereich nur mittelbar nach einer entsprechenden Anforderung über die Steuerschaltung erfolgen kann, wobei Wartezyklen und ähnliche Verzögerungen in Kauf genommen werden müssen. Bei anderen Ausführungen kann der Inhalt der Flüssigkeitskristallanzeige nur mittelbar über einen Speicher, der seinerseits die zur Erzeugung vollständiger aus Punktgruppen zusammengesetzte Zeichenelemente notwendigen Bauelemente enthält, veranlaßt werden.It is disadvantageous that the known control devices for changing the image content require more or less complex operations, which have in common that the processor's access to the memory area assigned to the LCD display is only indirect after a corresponding one Request can be made via the control circuit, waiting cycles and similar delays must be accepted. In other embodiments, the content of the liquid crystal display can only be initiated indirectly via a memory, which in turn contains the components necessary for generating complete drawing elements composed of point groups.
Demgegenüber liegt der im Anspruch 1 angegebenen Erfindung die Aufgabe zugrunde, eine Steuereinrichtung der eingangs genannten Gattung weitgehend zu vereinfachen, wobei Veränderungen des Bildschirminhalts möglichst unabhängig von den Funktionszyklen der Steuerschaltung ohne Beachtung besonderer Zeitbedingungen erfolgen sollen.In contrast, the invention specified in
Der Erfindung liegt die Erkenntnis zugrunde, daß eine zeitoptimale Verarbeitung von in einem Bildspeicher vorhandenen Signalen dann möglich ist, wenn der dem Bild zugeordnete Speicherbereich im wesentlichen unabhängig von der internen Steuersequenz der Schaltung und weitgehend unbeeinflußt von den Zeiten erzielbar ist, welche zur Versorgung des Bildschirms mit Daten aus dem Speicher erforderlich sind. Die Zugriffszeiten für die Ansteuerung des LCD-Anzeigemoduls können dabei regelmäßig so kurz gehalten werden, daß der Datenzugriff aus dem Rechnersystem zeitlich nicht oder kaum beeinträchtigt wird.The invention is based on the knowledge that time-optimal processing of signals present in an image memory is possible if the memory area assigned to the image can be achieved essentially independently of the internal control sequence of the circuit and largely unaffected by the times required to supply the screen with data from memory are required. The access times for the control of the LCD display module can regularly be kept so short that the data access from the computer system is not or hardly affected in time.
Die Steuerschaltung ist damit für den angeschlossenen Rechner "quasi-transparent", so daß eine Veränderung des Bildschirm(speicher)inhalts jederzeit ohne Rücksicht auf die zyklischen internen Abläufe der Steuereinrichtung erfolgen kann. Die Speicher zum Festhalten der Bildschirminhalte erscheinen dem Prozessorsystem als Teil der für ihn direkt erreichbaren Speicherbereiche. Die Ansteuerung erfolgt über eine speicherorientierte Adressierung entsprechend der üblichen Adressierung von RAM- oder ROM-Speicherbausteinen. Der Zugriff auf die für die LCD-Darstellung "reservierten" Speicherbereiche wird dabei in regelmäßiger Folge unter kurzfristiger Abschaltung des Zugriffs durch den Rechner vorgenommen, wobei mittels entsprechender Pufferung zwischen Rechner und Bildschirmspeicher erreicht werden kann, daß hierdurch keine oder höchstens eine geringfügige zeitliche Verzögerung für das Prozessorsystem auftritt.The control circuit is thus “quasi-transparent” for the connected computer, so that the contents of the screen (memory) can be changed at any time without regard to the cyclical internal processes of the control device can. The memory for holding the screen contents appears to the processor system as part of the memory areas which it can directly access. It is controlled via memory-oriented addressing in accordance with the usual addressing of RAM or ROM memory modules. The access to the "reserved" memory areas for the LCD display is carried out in a regular sequence with short-term shutdown of access by the computer, with appropriate buffering between the computer and screen memory can be achieved that this or no, or at most a slight time delay for the processor system occurs.
Dabei ist von besonderer Bedeutung, daß Änderungen von Bildinhalten bei geringfügigen Informationsveränderungen ohne subjektive Störung des Betrachters durch direkten Eingriff in die laufende Bilddarstellung vorgenommen werden können.It is of particular importance that changes in image content can be made with minor changes in information without subjective interference to the viewer by directly interfering with the current image display.
Bei komplexen Umstellungen der Bilddarstellungen kann zwischen zwei oder mehr verschiedenen gleichberechtigten Speicherbereichen umgeschaltet werden, welche jeweils den gesamten Bildinhalt umfassen. In diesem Fall erfolgt der Bildwechsel durch Umschalten der Steuerschaltung "schlagartig", während bei gewollter sukzessiver Änderung des Bildinhaltes durch den Prozessor die Steuerzeiten der Veränderungen einzelner Bildabschnitte so gewählt werden können, daß sich Bildelemente vor den Augen des Betrachters nacheinander "aufbauen". Durch den Abruf von zwei mittels mathematisch/logischer Verknüpfungen verbundener Bildinhalte lassen sich jederzeit weitere Bilddarstellungen erzeugen, welche durch Kombination oder sonstige logische Zuordnung der Bildelemente der einander überlagerten Bildinhalte der beiden Speicherbereiche entstehen. Diese Steuerung wird - ebenfalls speicherorientiert - durch vom Rechner her adressierbare und bevorzugt innerhalb der Steuerschaltung vorgesehene Register vorgenommen, deren Inhalt von der Steuerschaltung gelesen und ausgewertet wird.In the case of complex changes in the image representations, it is possible to switch between two or more different storage areas with equal rights, each of which comprises the entire image content. In this case, the picture change takes place "suddenly" by switching the control circuit, while if the processor wishes to successively change the picture content, the control times of the changes in individual picture sections can be selected so that picture elements "build up" in front of the viewer. By calling up two connected by means of mathematical / logical connections Image contents can be generated at any time further image representations, which result from a combination or other logical assignment of the image elements of the superimposed image contents of the two memory areas. This control is carried out - likewise memory-oriented - by means of registers which are addressable by the computer and preferably provided within the control circuit, the contents of which are read and evaluated by the control circuit.
Wenn die vom internen Zeittakt der Steuerschaltung bestimmte zeitliche Steuerung der Durchschaltung in der Weise erfolgt, daß die Zeiten, für die die internen Leitungen der Steuerschaltung mit der BUS-Struktur zur Übertragung von Daten zur Flüssigkristallanzeige verbunden sind, in der Größenordnung der Zeiten zur Übertragung einzelner Datenworte beim Datenaustausch mit dem Rechner liegen, und vorzugsweise kleiner sind, wird der Zugriff auf die den LCD-Modulen zugeordneten Speicherbereiche nicht oder höhcstens gelegentlich behindert, so daß der Rechner in seinem Zugriff nicht eingeschränkt ist. Bevorzugt erfolgt das Auslesen von Datenworten aus dem Speicher zum Ansteuern des LCD-Moduls also einzeln nacheinander, wobei insbesondere die Zeit der nachfolgenden Parallel-Seriell-Wandlung dem Rechner erneut Zugriffszeit gibt. Rechner und Steuerschaltung arbeiten dabei in ihrer Zeitsteuerung relativ zueinander asynchron.If the timing of the switching determined by the internal timing of the control circuit takes place in such a way that the times for which the internal lines of the control circuit are connected to the BUS structure for the transmission of data to the liquid crystal display are of the order of magnitude of the times for the transmission of individual ones If data words are in the data exchange with the computer, and are preferably smaller, access to the memory areas assigned to the LCD modules is not, or at most occasionally, hindered, so that the computer is not restricted in its access. Data words are preferably read out from the memory for driving the LCD module one after the other, the time of the subsequent parallel-serial conversion in particular giving the computer access time again. The computer and control circuit operate asynchronously in their timing control relative to one another.
Vorteilhafte Weiterbildungen der Erfindung sind in den Unteransprüchen gekennzeichnet bzw. werden nachstehend zusammen mit der Beschreibung der bevorzugten Ausführung der Erfindung anhand der Figuren näher dargestellt. Es zeigen:
Figur 1 ein Blockdiagramm der erfindungsgemäßen Steuereinrichtung innerhalb eines Prozessorssystems, das eine LCD-Anzeigeeinheit steuert,Figur 2 ein Blockschaltbild zur Erläuterung der internen Signalverarbeitung für ein Ausführungsbeispiel der Erfindung undFigur 3 Details der Innenschaltung des Ausführungsbeispiels gemäßFigur 2.
- FIG. 1 shows a block diagram of the control device according to the invention within a processor system that controls an LCD display unit,
- Figure 2 is a block diagram for explaining the internal signal processing for an embodiment of the invention and
- FIG. 3 details of the internal circuitry of the exemplary embodiment according to FIG. 2.
Bei der in Figur 1 dargestellten Blockschaltung ist eine Steuerschaltung 1 zwischen einer ersten vollständigen Bus-Struktur 2, bestehend aus Datenbus 2a, Adressenbus 2b und Steuerbus 2c, vorgesehen. Diese Bus-Struktur bildet den Systembus, welcher die Datenoperationen zwischen der erfindungsgemäßen Steuerschaltung und einem Rechner 3 sowie einem dem Rechner zugeordneten Hauptspeicher 4 ermöglicht. Der Systembus 2 bildet eine bekannte Bus-Struktur, wie sie bei den gebräuchlichen Mikroprozessoren verwendet wird.In the block circuit shown in FIG. 1, a
Die Steuereinrichtung 1 ist mit einer weiteren Bus-Stuktur 5 verbunden, welche ebenfalls aus einem Datenbus 5a, einem Adress-Bus 5b und einem Steuerbus 5c besteht. An diese zweite Bus-Struktur sind mehrere - im vorliegenden Beispiel zwei - Speicherbereiche 6, 7 angeschlossen, welche jeweils den vollständigen Bildinhalt einer auf einem LCD-Modul wiederzugebenden Graphikinformation enthalten. Der LCD-Modul 8 wird von der Steuerschaltung 1 über eine Treiberstufe 9 gesteuert, wobei die in den Speichern 6 bzw. 7 vorhandenen Daten durch die Steuerschaltung in seriell zu übertragende Informationen umgesetzt werden, welche dem jeweiligen LCD-Modul angepaßt sind. Neben der zeilenweisen Übertragung des Bildinhalts in zur Wiederauffrischung des Bilds erforderlichen Zyklen sind Polaritätsumkehrungen und gegebenenfalls weitere Steuerimpulse erforderlich, welche zum Betrieb eines derartigen Anzeige-Moduls notwendig sind. Die Daten werden über zwei oder mehr Leitungen (Display Data) übertragen, wobei sich die Zahl dieser Datenleitungen danach richtet, in wie viele Felder die Darstellungsfläche unterteilt ist.The
Bei der in Figur 2 dargestellten Innenschaltung des Steuerteils 1 wird blockschaltungsmäßig eine Interfaceschaltung 11 unterschieden, welche die Datenkommunikation zur Bus-Struktur 2 aufrechterhält und somit die Kommunikationsschnittstelle zum externen Rechnersystem bildet.In the internal circuitry of the
Das in Figur 2 wiedergegebene Blockschaltbild der Innenschaltung zeigt des weiteren, wie sich die Steuerleitungen (Steuerbus in Figur 1) im einzelnen zusammensetzen. Dabei wurden die folgenden Signalbezeichnungen verwendet:
Entsprechend sind aus der vorstehenden Tabelle auch die Bezeichnungen und Funktionen der Verbindungen zum LCD-Modul 8 zu entnehmen. Eine Zeitsteuerung 12 wird synchronisiert von einem extern anschließbaren Quarz 13. Eine zusätzliche Testvorrichtung 14 läßt sich extern ansteuern und übermittelt nach ordnungsgemäß abgeschlossenem Funktionstest des Bausteins ein Quittungsausgangs-"Test"-Signal. Die Verbindungen zum externen Steuerbus erfolgen mittels einer Baugruppe 14, welche die Datenübertragung zur zweiten Bus-Struktur 5 gemäß Figur 1 bewirkt.Correspondingly, the names and functions of the connections to the
Ein Ansteuerbaustein 15 erzeugt die seriellen Datensignale zur Ansteuerung der Datenleitungen des LCD-Moduls. Die weiteren Steuerungsimpulse für die LCD-Anzeige stammen von der LCD-Treiber-Steuerung 16, welche die Signale erzeugt, die den externen Treiberschaltungen zugeführt werden.A
Die Steuerimpulse, welche mittels der Treiber-Steuerung 16 erzeugt werden, lassen sich über interne Register beeinflussen, wobei die verschiedenen kommerziell gefertigten LCD-Modulen entsprechenden Steuersequenzen durch unterschiedliche Datenworte repräsentiert werden.The control pulses which are generated by means of the
In der Darstellung gemäß Figur 3 sind diejenigen Bauelemente schematisch dargestellt, welche beim Betrieb der erfindungsgemäßen Steuerschaltung funktionell wirksam werden. Die externen Baugruppen entsprechen in ihrer Bezeichnungsweise der in den Figuren 2 bzw. 3 verwendeten Form.In the illustration according to FIG. 3, those components are shown schematically which become functionally effective when the control circuit according to the invention is operated. The designation of the external modules corresponds to the form used in FIGS. 2 and 3.
Zentrales Element für die Verknüpfung der beiden Bus-Strukturen 2 und 5 ist ein Multiplexer 21, dem die externe BUS-Struktur 2 (Daten-, Adress- und Steuerbus 2a, 2b und 2c) über einen Datenpuffer 22 zugeleitet werden. Mittels der als interne Blöcke dargestellten Weichenverbindungen wird die Verbindung zu den äußeren Bus-Strukturen für die einzelnen Busleitungen in Abhängigkeit vom aktuellen Betriebszustand der Steuerschaltung 1 beeinflußt. Dabei hat die Verbindung der Busleitungen mit den der Bilddarstellung zugeordneten Speicherbereichen 6 und 7 grundsätzlich Priorität vor dem Zugriff des Rechners über die Leitungen 2. Die Busleitungen 5a bis 5c sind daher im Normalfall für den internen Zugriff der Steuerschaltung 1 reserviert, um aus den in den Speichern 6 und 7 vorgefundenen Daten die Bildinformation aufzubauen.A central element for linking the two
Gesteuert durch den bevorzugt quarzstabilen Zeitgeber 12, 13 werden die zum Aufbau der Bilddarstellung notwendigen Impulsfolgen in einem festen Zeitraster erzeugt, wobei für den Bildinhalt jeweils auf einen der Speicher 6 oder 7 zugegriffen wird. Dadurch, daß die beiden Speicherbereiche der Steuereinheit bevorrechtigt zur Verfügung stehen, sind Schwierigkeiten durch eventuelle Kollisionen mit dem Rechnerzugriff vermieden. Die LCD-Anzeige gibt jeweils den Speicherinhalt wieder, wobei die Art der Darstellung durch einen externen Befehl vom Rechner über die Bus-Struktur 2 veranlaßt wird und die entsprechenden Befehle in einem Register 23 abgelegt werden. Die Ablage von Befehlen im Register 23 kann unabhängig vom Zustand der Bilderzeugung jederzeit erfolgen, sofern lediglich die Art der Bilddarstellung betroffen ist. (Diejenigen Befehle, welche die Art der Ansteuerung des LCD-Displays 8 verändern und praktisch die Anpassung an eine andere LCD-Baugruppe sicherstellen, können hier außer Betracht gelassen werden.)Controlled by the preferably quartz-
Dabei kann nach Belieben auch auf beide Speicher 6 und 7 bezüglich derselben Bildinhaltselemente nacheinander zweifach zugegriffen werden, wobei in einer Arithmetikeinheit 24 logische Verknüpfungen zwischen diesen Bildinhalten erzeugt werden können, so daß eine Schwarzdarstellung eines Bildpunktes erfolgt, wenn einer der entsprechenden Bildpunkte in beiden Speichern schwarz gesteuert werden soll (ODER- verknüpfte Darstellung) oder aber nur dann, wenn beide dunkel gesteuert werden (UND-) bzw. es kann auch erreicht werden, daß der Bildschirminhalt nur dann dunkel getastet wird, wenn einer der entsprechenden Speicherplätze die Information "schwarz" enthält (EXCLUSIV- ODER bzw. EXOR-Darstellung). Die Adressierung der Speicher 6 und 7 erfolgt dabei derart, daß aufeinanderfolgende Speicheradressen Speicherplätze kennzeichnen, die auch in der Bilddarstellung aufeinanderfolgen. Entsprechende Speicheradressen in den Speichern 6 und 7 kennzeichnen übereinstimmende Bildbereiche. Die in den Speichern 6 und 7 festgehaltenen Datenworte beschreiben - entsprechend ihrer Bit-Länge - den Zustand einer entsprechenden Folge von Bildpunkten im LCD-Display 8. Veränderungen die das Register 23 betreffen, welche während des Bildaufbaus erfolgen, fallen dem menschlichen Betrachter nicht störend auf, da - sofern die Bildinformation im folgenden generell erhalten bleibt - dieser "Bildwechsel" als natürliche Veränderung empfunden wird.Both
Dadurch, daß die Bildinformation direkt aus den Speichern 6 und 7 gewonnen wird - und zwar ohne Zwischenschaltung von Zeichengeneratoren - ist der Aufbau der Steuerschaltung 1 äußerst einfach. Zwar erhöht sich der für den Bildaufbau in den Speichern 6 und 7 festzuhaltende Informationsbedarf. Da die betreffenden Daten durch die erfindungsgemäße Schaltung jedoch ohne Zeitverlust eingespeichert und geändert werden können, ergäbe sich durch die Verwendung von Zeichengeneratoren innerhalb des Steuerteils 1 keine Vereinfachung. Durch den unmittelbar wirkenden Direktzugriff auf die Speicher 6 und 7, wie er weiter unten beschrieben wird, erhöht sich die Universalität der Verwendung der Steuerschaltung dagegen wesentlich.Because the image information is obtained directly from the
Bei der Verwendung der aus den Speichern 6 und 7 mittels der Bus-Struktur 5 ausgelesenen Daten und Übertragung derselben - gegebenenfalls nach einer arithmetischen Operation in der Baugruppe 24 in einem Parallel-Seriell-Wandler 15 - wird im Takte des Zeitgebers 12 jeweils ein Datenwort als bitweise Impulsfolge an eine entsprechende Datenleitung zur Treiberschaltung 9 übertragen. In Figur 3 ist aus Vereinfachungsgründen lediglich eine Datenleitung wiedergegeben. Für die gleichzeitige Ansteuerung mehrerer getrennter Bildbereiche wäre entsprechend der Parallel-Seriell-Wandler 15 mehrfach vorzusehen.When using the data read from the
Im Rahmen des vom Zeitgeber erzeugten Zeitzyklus wird jeweils für jedes zu übertragende Datenwort vom internen Steuerteil 22 und dem darin enthaltenen Zeitgeber ein Impuls erzeugt, welcher die Datenübertragung im Multiplexer 21 so setzt, daß die internen Bus-Leitungen mit dem externen Bus 5 verbunden sind. Durch die gleichzeitige Adressierung des jeweiligen Speicherbereiches 6 oder 7 (in Abhängigkeit von einem im Register 23 enthaltenen Datenwort) wird der Speicherinhalt in den Parallel-Seriell-Wandler 15 übertragen und, nachdem das Taktsignal durch ein Verzögerungsglied 26 um einen kleinen Zeitraum verzögert wurde, das Auslesen dieses Datenwortes aus dem Parallel-Seriell-Wandler über eine Datenleitung zur Treiberschaltung 9 hin be-wirkt. Während der Parallel-Seriell-Wandler 15 noch mit dem Auslesen des Datenwortes beschäftigt ist, wird über eine weitere Verzögerungsschaltung 27 der Multiplexer 21 wieder in Richtung Datenverkehr zwischen den Bus-Strukturen 2 und 5 geschaltet.As part of the time cycle generated by the timer, the
Die Verzögerungsleitungen 26 und 27 haben in dem dargestellten Blockschaltbild lediglich symbolische Bedeutung. Die betreffenden Signalverzögerungen können auch auf andere Weise, beispielsweise durch Zähler, natürliche Leitungsverzögerungen bei der Signalübertragung etc., erzeugt werden.The
Dadurch, daß die Zugriffszeiten bei der Parallel-Seriell-Wandlung für die Übermittlung eines Datenworts zur LCD-Einheit relativ kurz sind, steht dem an der Bus-Struktur 2 angeschlossenen Rechner der Zugriff zu den Speichern 6 und 7 nahezu uneingeschränkt zur Verfügung.Because the access times for the parallel-serial conversion for the transmission of a data word to the LCD unit are relatively short, the
Damit sind nun die Speicherbereiche 6 und 7 für die angeschlossene Rechnerschaltung direkt erreichbar und die Steuerschaltung 1 ist "quasi-transparent". Während des Zugriffs für die Ansteuerung des LCDs können die in den Speichern 6 oder 7 vorhandenen Daten verändert oder gelöscht werden. Um eine konstante Bilddarstellung zu erhalten, wird ein vollständiger Bildwechsel zusammenhängend ausgeführt. Während durch Zugriff des Rechners auf einen der Speicherbereiche 6 bzw. 7 ein Wechsel der Information einer vollständigen Bilddarstellung vollzogen wird, kann aus dem anderen Speicherbereich ein feststehendes Bild mit den notwendigen "Refresh"-Zyklen ohne Beeinflussung durch den Bildwechsel wiedergegeben werden. Bei einer bevorzugten Anwendung der Erfindung werden fertig erzeugte Bildinhalte in korrekter Folge bezüglich der Adressierung im Hauptspeicher 4 (Figur 1) abgelegt, welche nach Bedarf kurzfristig in einen dem LCD-zugeordneten Speicher 6 oder 7 übertragen werden können. Sämtliche zur Zeichenbildung dienenden Informationselemente sind im Hauptspeicher 4 vorhanden und können durch Makro-Befehle als Einheit adressiert und in die entsprechenden Speicherbereiche der Speicher 6 und 7 übertragen werden. Dabei ist eine hohe Flexibilität gegeben, da feste Zeichenraster etc. nicht erforderlich sind. Die LCD-Anzeige kann in einem unabhängigen graphik-fähigen Betrieb benutzt werden, wobei komplexe Zeichen wie Buchstaben und Ziffern etc. durch entsprechende Datenübertragungen kurzfristig eingelesen werden können.The
Falls die Speicherbereiche 6 oder 7 nicht exakt dem Speicherbedarf des LCD-Elementes entsprechen und - wie im Normalfall - dessen Kapazität geringfügig übertreffen, können die überzähligen Speicherplätze vom Rechner ebenfalls als Speicherbereich im Quasi-Direktzugriff benutzt werden. Die Speicherbereiche 6 und 7 lassen sich auch in DMA-Betrieb von externen Baugruppen adressieren, da entsprechende Steuerleitungen ("Ready") vorhanden sind.If the
Der Datenpuffer 22 sorgt dafür, daß die Daten zum Zugriff über die Bus-Struktur 2 kurzfristig auch dann noch zur Verfügung stehen, wenn der Multiplexer 21 bereits seinen Betriebszustand für die Übertragung von Daten im internen Steuerteil 25 einnimmt. Entsprechend können in den Pufferbereich Daten eingelesen werden, wenn der Multiplexer mit der Übertragung von Daten aus den Speichern 6 bzw. 7 zum LCD-Display 8 beschäftigt ist. Bei einer praktischen Ausführung werden beispielsweise im Lesebetrieb durch einen entsprechenden Taktzyklus die adressierten Daten noch in den Puffer übertragen, bevor der Multiplexer den Bus 5 wieder der Steuerschaltung intern zuteilt. Im Schreibbetrieb werden die vom Rechner übertragenen Daten festgehalten und erst dann über den Multiplexer in die Speicher 6 oder 7 eingelesen, wenn der Bus 5 dem Rechner wieder zur Verfügung steht.The
Dieser sogennante "Handshake"-Betrieb erfolgt dabei entsprechend dem in der Prozessortechnik üblichen Vereinbarungen mit den zugehörigen Steuerleitungen. Durch die Verwendung eines Daten- und Adressenpuffers in der dargestellten Konfiguration ergibt sich die Möglichkeit, durch eine Heraufsetzung der Geschwindigkeit der internen Verarbeitung des Zugriffs des LCD-Displays zu den Speichern gegenüber der Geschwindigkeit des externen Rechners die Datenverarbeitung mit dem Rechner ungefähr um die Hälfte langsamer zu gestalten als es der internen Taktfrequenz der Datenaufbereitung entspricht. Bei einer derartigen Zeitsteuerung unter Verwendung des Puffers tritt für den Rechner die interne Bedienung des LCD-Moduls in keiner Weise mehr zeitverzögernd in Erscheinung.This so-called "handshake" operation takes place in accordance with the agreements with the associated control lines that are common in processor technology. By using a data and address buffer in the configuration shown there is the possibility, by increasing the speed of the internal processing of the access of the LCD display to the memory compared to the speed of the external computer, the data processing with the computer approximately by To make half slower than the internal clock frequency of data processing. With such a time control using the buffer, the internal operation of the LCD module no longer appears to the computer in a time-delaying manner.
Durch Vorsehen einer "Ready"-Leitung innerhalb des Steuerbus 2c wird einer externen Einheit die Bereitschaft signalisiert, Daten anzunehmen oder abzugeben. Dieser Zustand wird immer dann angezeigt, wenn das Pufferregister 22 - je nach Richtung der Übertragung - Daten bereithält oder annehmen kann. Eine derartige Steuerleitung läßt die Steuereinheit 1 mit den nachgeschalteten Speicherbereichen 6 und 7 als direkt adressierbaren Speicher erscheinen. Das "Ready"-Signal wird abgegeben, wenn zwischenzeitlich das Pufferregister zu der ebenfalls im Pufferregister enthaltenen Adresse im Speicher 6 bzw. 7 entladen wurde oder wenn von diesen Speichern her ein Lesezyklus ausgeführt wurde, so daß eine Steuerung von DMA-fähigen Baugruppen in günstiger Weise möglich ist.By providing a "ready" line within the
Claims (12)
- A programmable circuit for controlling a liquid crystal display (LCD-controller), possibly with interposed driver stages, for two separate BUS structures, of which one is used for data exchange with a computer, whereas the other is used for data exchange with at least one addressable store which is assigned to the liquid crystal display (LCD), characterised in that the two BUS structures are designed as complete, parallel BUS structures comprising address-, data- and control lines, which, in the case of a predetermined switching state of the control circuit and possibly in response to a corresponding additional signal from the computer, are interconnected in such manner that data exchange can take place between the store assigned to the liquid crystal display and the computer.
- A control circuit as claimed in Claim 1, characterised in that the predetermined switching state of the control circuit consists in that the BUS structure which serves for connection to the storage zone assigned to the liquid crystal display is not switched through to internal control lines of the control circuit for the transmission of data to the liquid crystal display, wherein the time control of the establishment of this connection is governed by the internal clock of the control circuit.
- A control circuit as claimed in any preceding claims, characterised in that the connection between the BUS structure via which the data exchange with the store assigned to the liquid crystal display takes place, and the BUS structure which is used for data exchange with the computer is established by enabling at least one buffer store.
- A control circuit as claimed in Claim 2 or 3, characterised in that the time control of the switch-through, which is governed by the internal clock of the control circuit, takes place in such manner that the times during which the internal lines of the control circuit are connected to the BUS-structure for the transmission of data to the liquid crystal display are in the order of magnitude of the times required for the transmission of individual data words during the data exchange with the computer, and in particular are shorter than such times.
- A control circuit as claimed in any preceding claim, characterized in that the parallel-series conversion of a data word intended for transmission to the liquid crystal display takes place during a time interval in which the BUS structure which serves for connection to the storage zone assigned to the liquid crystal display is not switched through to the internal lines of the control circuit for the transmission of data to the liquid crystal display.
- A control circuit as claimed in any preceding claim, characterised in that a multiplexer is provided by which the BUS structure which is used for data exchange with at least one addressable store assigned to the liquid crystal display (LCD) is switched through, in dependence upon the internal clock of the control circuit, alternately on the one hand to the BUS structure assigned to the computer and on the other hand to the internal control lines for the transmission of data to the liquid crystal display.
- A control circuit as claimed in any preceding claim, characterised in that the programming of operating states of the control circuit takes place via the internal registers of the latter, which can be reached by the BUS structure connected to the computer.
- A control circuit as claimed in any preceding claim, characterised in that control lines (ready) are provided which permit direct access by components with DMA capability to the BUS-structure which serves for data exchange with the liquid crystal display.
- A control circuit as claimed in any preceding claim, characterised in that access can be obtained under identical addresses to different storage zones assigned to the liquid crystal display, wherein the selection takes place via additional control lines (CS1 and CS2).
- A control circuit as claimed in any preceding claim, characterised in that different storage zones assigned to the liquid crystal display can be logic linked by means of data words which can be stored in a register, wherein, when the corresponding data word identifying this state is input, the individual image points are reproduced in accordance with the result of the logic linking of the store content of mutually corresponding image points.
- A control circuit as claimed in any preceding claim, characterised in that different storage zones assigned to the liquid crystal display can be separately selected and reproduced on the liquid crystal display by means of data words which can be stored in a register.
- A control circuit as claimed in any preceding claim, characterised in that a plurality of simultaneously driven data lines are provided for the supply of partial images, each of which transmits different image contents.
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