DE102010006996A1 - Method for manufacturing semiconductor component e.g. high voltage component, involves filling insulating material in narrow trench aperture, and forming electrical conductive guard material in spread trench aperture - Google Patents
Method for manufacturing semiconductor component e.g. high voltage component, involves filling insulating material in narrow trench aperture, and forming electrical conductive guard material in spread trench aperture Download PDFInfo
- Publication number
- DE102010006996A1 DE102010006996A1 DE201010006996 DE102010006996A DE102010006996A1 DE 102010006996 A1 DE102010006996 A1 DE 102010006996A1 DE 201010006996 DE201010006996 DE 201010006996 DE 102010006996 A DE102010006996 A DE 102010006996A DE 102010006996 A1 DE102010006996 A1 DE 102010006996A1
- Authority
- DE
- Germany
- Prior art keywords
- trench
- substrate
- semiconductor
- insulating
- conductor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/762—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
- H01L21/76224—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using trench refilling with dielectric materials
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/74—Making of localized buried regions, e.g. buried collector layers, internal connections substrate contacts
- H01L21/743—Making of internal connections, substrate contacts
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Element Separation (AREA)
Abstract
Description
Die vorliegende Erfindung betrifft die Herstellung eines Halbleiterbauelements mit mindestens einem Isolationsgraben und mindestens einem Leitergraben, der ein elektrisch leitfähiges Material enthält.The present invention relates to the production of a semiconductor device having at least one isolation trench and at least one conductor trench, which contains an electrically conductive material.
Bei der Herstellung von Halbleiterbauelementen ist es oftmals erforderlich, Bereiche des Halbleitersubstrats elektrisch voneinander zu isolieren. Dazu dienen Isolationsgräben, die mit einem elektrisch isolierenden Material gefüllt sind, insbesondere so genannte STIs (shallow trench isolations). Gräben im Halbleitermaterial können statt dessen mit einem elektrisch leitfähigen Material gefüllt werden. Damit erhält man vertikal im Substrat angeordnete Leiter, die zum Beispiel im Substrat vergrabene Kontaktbereiche elektrisch leitend mit oberseitigen Anschlüssen verbinden. Verfahren zur Herstellung elektrisch leitender und elektrisch isolierender Gräben sind in
Aufgabe der vorliegenden Erfindung ist es, anzugeben, wie auf vorteilhafte Weise Halbleiterbauelemente mit Isolationsgräben und vertikalen Leitern im Halbleitermaterial versehen werden können.The object of the present invention is to indicate how advantageously semiconductor devices with isolation trenches and vertical conductors in the semiconductor material can be provided.
Diese Aufgabe wird mit dem Verfahren mit den Merkmalen des Anspruchs 1 bzw. mit dem Halbleiterbauelement mit den Merkmalen des Anspruchs 9 gelöst. Ausgestaltungen ergeben sich aus den jeweiligen abhängigen Ansprüchen.This object is achieved by the method having the features of
Bei dem Verfahren zur Herstellung eines Halbleiterbauelementes werden eine breite und eine schmale Grabenöffnung an einer Oberseite eines Substrates aus Halbleitermaterial hergestellt. Ein elektrisch isolierendes Isolationsmaterial wird aufgebracht oder aus einem oberflächigen Schichtanteil des Halbleitermaterials erzeugt, so dass das Isolationsmaterial die schmale Grabenöffnung füllt. Das Isolationsmaterial wird von der Oberseite und aus der breiten Grabenöffnung entfernt, während die schmale Grabenöffnung mit dem Isolationsmaterial gefüllt bleibt. In die breite Grabenöffnung wird ein elektrisch leitfähiges Leitermaterial eingebracht.In the method of fabricating a semiconductor device, a wide and a narrow trench opening are formed on an upper surface of a substrate of semiconductor material. An electrically insulating insulating material is applied or generated from a surface layer portion of the semiconductor material, so that the insulating material fills the narrow trench opening. The insulation material is removed from the top and from the wide trench opening, while the narrow trench opening remains filled with the insulation material. In the wide trench opening an electrically conductive conductor material is introduced.
Bei einem Ausführungsbeispiel des Verfahrens ist das Isolationsmaterial ein Oxid des Halbleitermaterials.In one embodiment of the method, the insulating material is an oxide of the semiconductor material.
Bei einem weiteren Ausführungsbeispiel des Verfahrens ist das Isolationsmaterial Polysilizium.In a further embodiment of the method, the insulating material is polysilicon.
Bei einem weiteren Ausführungsbeispiel des Verfahrens wird vor dem Einbringen des Leitermaterials eine Isolationsschicht gebildet, die dafür vorgesehen ist, das Leitermaterial von dem Halbleitermaterial des Substrates elektrisch zu isolieren.In a further embodiment of the method, an insulating layer is formed before the introduction of the conductor material, which is intended to electrically isolate the conductor material from the semiconductor material of the substrate.
Bei einem weiteren Ausführungsbeispiel des Verfahrens wird die Isolationsschicht durch eine thermische Oxidation des Halbleitermaterials erzeugt.In a further embodiment of the method, the insulation layer is produced by a thermal oxidation of the semiconductor material.
Bei einem weiteren Ausführungsbeispiel des Verfahrens wird die Isolationsschicht vor dem Einbringen des Leitermaterials zu Seitenwandspacern rückgeätzt.In a further exemplary embodiment of the method, the insulation layer is etched back to side wall spacers before the introduction of the conductor material.
Bei einem weiteren Ausführungsbeispiel des Verfahrens ist das Leitermaterial dotiertes Polysilizium.In a further embodiment of the method, the conductor material is doped polysilicon.
Bei einem weiteren Ausführungsbeispiel des Verfahrens bildet das Leitermaterial einen Kontakt mit dem Halbleitermaterial des Substrates.In a further embodiment of the method, the conductor material forms a contact with the semiconductor material of the substrate.
Das Halbleiterbauelement besitzt ein Substrat aus Halbleitermaterial, einen Isolationsgraben, der ein elektrisch isolierendes Isolationsmaterial enthält, und einen Leitergraben, der ein elektrisch leitfähiges Leitermaterial enthält. Der Leitergraben ist mit einer breiteren Grabenöffnung in dem Substrat gebildet als der Isolationsgraben.The semiconductor device has a substrate of semiconductor material, an isolation trench containing an electrically insulating insulating material, and a conductor trench containing an electrically conductive conductor material. The ladder trench is formed with a wider trench opening in the substrate than the isolation trench.
Bei einem Ausführungsbeispiel des Halbleiterbauelements ist der Leitergraben von dem Halbleitermaterial des Substrates durch eine Isolationsschicht getrennt.In one embodiment of the semiconductor device, the conductor trench is separated from the semiconductor material of the substrate by an insulating layer.
Es folgt eine genauere Beschreibung von Beispielen des Verfahrens und des Halbleiterbauelements anhand der beigefügten Figuren.The following is a more detailed description of examples of the method and the semiconductor device with reference to the attached figures.
Die
Die
Die
Die
Die
Die
Die
Die
Die
Die
Die
Die Isolationsgräben
Die Leitergräben
Der in der
Wesentlich für die Erfindung ist, dass ein Leitergraben
Die
Die
Die
Die
Die schmale Grabenöffnung
Die
Die
Die
In dem Ausführungsbeispiel der
Die
Die
Das beschriebene Herstellungsverfahren erlaubt eine einfache und kostengünstige Herstellung von Bauelementen mit Isolationsgräben und Leitergräben, die nach dem Ätzen sämtlicher Grabenöffnungen in einem gegenüber herkömmlichen Verfahren vereinfachten Prozessablauf hergestellt werden können. Das Verfahren hat insbesondere den Vorteil, dass nach dem Füllen der Isolationsgräben kein weiterer Maskenschritt erforderlich ist, um die Grabenöffnungen der Leitergräben herzustellen.The described manufacturing method allows a simple and cost-effective production of components with isolation trenches and conductor trenches, which can be produced after the etching of all trench openings in a simplified process compared to conventional methods. The method has the particular advantage that after filling the isolation trenches no further mask step is required to produce the trench openings of the conductor trenches.
Das Verfahren lässt sich insbesondere vorteilhaft anwenden zur Herstellung von Hochvolt-Bauelementen oder Grabenkondensatoren.The method can be used particularly advantageously for the production of high-voltage components or trench capacitors.
BezugszeichenlisteLIST OF REFERENCE NUMBERS
- 11
- Substratsubstratum
- 22
- Isolationsgrabenisolation trench
- 33
- LeitergrabenLeiterngraben
- 44
- Isolationsschichtinsulation layer
- 55
- dotierter Bereichdoped area
- 66
- erste Maskefirst mask
- 77
- breite Grabenöffnungwide trench opening
- 88th
- zweite Maskesecond mask
- 99
- schmale Grabenöffnungnarrow trench opening
- 1010
- Oberseitetop
- 1111
- Isolationsmaterialinsulation material
- 1212
- restliche Grabenöffnungremaining trench opening
- 1313
- restliches Isolationsmaterialremaining insulation material
- 1414
- Isolationsschichtinsulation layer
- 1515
- verbleibende Grabenöffnungremaining trench opening
- 1616
- Leitermaterialconductors
- 1717
- Seitenwandspacersidewall
- 1818
- Grabenbodengrave soil
- 1919
- Leitermaterialconductors
- 2020
- KontaktContact
- 2121
- Isolationsgrabenisolation trench
- 2222
- Isolationsgrabenisolation trench
- 2323
- Isolationsgrabenisolation trench
- 3030
- Leiterbahnconductor path
- 3131
- LeitergrabenLeiterngraben
- 3232
- LeitergrabenLeiterngraben
- 3333
- LeitergrabenLeiterngraben
ZITATE ENTHALTEN IN DER BESCHREIBUNG QUOTES INCLUDE IN THE DESCRIPTION
Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.This list of the documents listed by the applicant has been generated automatically and is included solely for the better information of the reader. The list is not part of the German patent or utility model application. The DPMA assumes no liability for any errors or omissions.
Zitierte PatentliteraturCited patent literature
- US 4924284 A [0002] US 4924284 A [0002]
- DE 102006029682 A1 [0002] DE 102006029682 A1 [0002]
- WO 2007/144053 A2 [0002] WO 2007/144053 A2 [0002]
- US 2009/0160050 A1 [0002] US 2009/0160050 A1 [0002]
Claims (10)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE102010006996.5A DE102010006996B4 (en) | 2010-02-05 | 2010-02-05 | Method for producing a semiconductor component |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE102010006996.5A DE102010006996B4 (en) | 2010-02-05 | 2010-02-05 | Method for producing a semiconductor component |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102010006996A1 true DE102010006996A1 (en) | 2011-08-11 |
DE102010006996B4 DE102010006996B4 (en) | 2017-08-24 |
Family
ID=44316478
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102010006996.5A Expired - Fee Related DE102010006996B4 (en) | 2010-02-05 | 2010-02-05 | Method for producing a semiconductor component |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE102010006996B4 (en) |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3715232A1 (en) * | 1987-05-07 | 1988-11-17 | Siemens Ag | Method of substrate connection in the fabrication of bipolar transistor circuits separated by isolation trenches |
US4924284A (en) | 1985-10-31 | 1990-05-08 | International Business Machines Corporation | Method of trench filling |
DE102005010944A1 (en) * | 2005-03-10 | 2006-09-14 | X-Fab Semiconductor Foundries Ag | Method for producing a carrier disk contact in trench-insulated integrated SOI circuits with high-voltage components |
DE102006029682A1 (en) | 2005-06-29 | 2007-01-11 | Infineon Technologies Ag | Production of a semiconductor structure with deep trench isolation and buried layer contact etches a trench and a shallower and narrower hole in a single crystal semiconductor layer |
WO2007144053A2 (en) | 2006-06-12 | 2007-12-21 | Austriamicrosystems Ag | Semiconductor device with a trench isolation and method of manufacturing trenches in a semiconductor body |
WO2008058829A1 (en) * | 2006-11-17 | 2008-05-22 | Austriamicrosystems Ag | Method for producing a semiconductor component with two trenches |
US20090160050A1 (en) | 2005-08-26 | 2009-06-25 | Honda Motor Co., Ltd. | Semiconductor device manufacturing method, semiconductor device and wafer |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102007032003B4 (en) * | 2007-07-09 | 2016-03-03 | Zweibrüder Optoelectronics Gmbh & Co. Kg | Combination of battery cartridge and flashlight housing |
-
2010
- 2010-02-05 DE DE102010006996.5A patent/DE102010006996B4/en not_active Expired - Fee Related
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4924284A (en) | 1985-10-31 | 1990-05-08 | International Business Machines Corporation | Method of trench filling |
DE3715232A1 (en) * | 1987-05-07 | 1988-11-17 | Siemens Ag | Method of substrate connection in the fabrication of bipolar transistor circuits separated by isolation trenches |
DE102005010944A1 (en) * | 2005-03-10 | 2006-09-14 | X-Fab Semiconductor Foundries Ag | Method for producing a carrier disk contact in trench-insulated integrated SOI circuits with high-voltage components |
DE102006029682A1 (en) | 2005-06-29 | 2007-01-11 | Infineon Technologies Ag | Production of a semiconductor structure with deep trench isolation and buried layer contact etches a trench and a shallower and narrower hole in a single crystal semiconductor layer |
US20090160050A1 (en) | 2005-08-26 | 2009-06-25 | Honda Motor Co., Ltd. | Semiconductor device manufacturing method, semiconductor device and wafer |
WO2007144053A2 (en) | 2006-06-12 | 2007-12-21 | Austriamicrosystems Ag | Semiconductor device with a trench isolation and method of manufacturing trenches in a semiconductor body |
WO2008058829A1 (en) * | 2006-11-17 | 2008-05-22 | Austriamicrosystems Ag | Method for producing a semiconductor component with two trenches |
Also Published As
Publication number | Publication date |
---|---|
DE102010006996B4 (en) | 2017-08-24 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP0001100B1 (en) | Method for forming recessed dielectric isolation regions in silicon by means of charged and accelerated particles | |
DE102006019950B4 (en) | Semiconductor device with dielectric separation | |
DE102013218238B4 (en) | METHOD FOR PRODUCING A CONTROLLABLE SEMICONDUCTOR COMPONENT | |
DE10141916A1 (en) | MOS semiconductor device and method of manufacturing the same | |
DE102020101247B4 (en) | DEEP DITCH INSULATION STRUCTURE AND METHOD FOR MANUFACTURING IT | |
DE2502235A1 (en) | CHARGE COUPLING SEMICONDUCTOR ARRANGEMENT | |
DE102005010944A1 (en) | Method for producing a carrier disk contact in trench-insulated integrated SOI circuits with high-voltage components | |
DE102008051245A1 (en) | High-voltage transistor with high current carrying capacity and method of manufacture | |
DE10345346A1 (en) | A method of manufacturing a semiconductor device having active regions separated by isolation structures | |
DE10219107A1 (en) | SOI transistor element with an improved back contact and a method for producing the same | |
DE19837395A1 (en) | Method for producing a semiconductor insulation layer and a semiconductor component containing this semiconductor insulation layer | |
DE19501557A1 (en) | Semiconductor device and method for its production | |
DE112016000050B4 (en) | Method for manufacturing a split gate power device | |
DE2420239A1 (en) | METHOD FOR MANUFACTURING DOUBLE DIFFUSED LATERAL TRANSISTORS | |
DE102016202110B4 (en) | Semiconductor structure with backgate regions and method for its production | |
DE102007018098B4 (en) | Method for producing a semiconductor body with a trench and semiconductor body with a trench | |
DE102020116563A1 (en) | SEMICONDUCTOR DEVICE AND METHOD OF MANUFACTURING THE SAME | |
DE102021201635A1 (en) | Vertical DMOS semiconductor device and manufacturing method thereof | |
DE19853432A1 (en) | Semiconductor device and method of manufacturing the same | |
DE10261404B4 (en) | Method for producing a semiconductor component | |
DE3842749A1 (en) | METHOD FOR PRODUCING AN INTEGRATED CIRCUIT | |
DE10242145B4 (en) | Semiconductor device with local interconnect layer and manufacturing method | |
DE10147120B4 (en) | Trench capacitor and method of making the same | |
DE102010006996B4 (en) | Method for producing a semiconductor component | |
DE102010034116B3 (en) | Method for producing an insulation layer between two electrodes |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R020 | Patent grant now final | ||
R119 | Application deemed withdrawn, or ip right lapsed, due to non-payment of renewal fee |