CN218446655U - 一种总线通讯接口电路 - Google Patents

Abstract

一种总线通讯接口电路，该电路设置于通过总线交互数据的每一个外部设备中，包括连接在总线的上通讯接口A1和A2，以及与通讯接口A1相接的第一控制模块和与通讯接口A2相接的第二控制模块；第一和第二控制模块分别包括上拉辅助单元、NFET、控制单元和接收器；NFET的漏极接地，NFET的源极接通讯接口A1或A2；其中，控制单元输出第一脉冲控制信号gate_n至NFET的栅极，控制单元输出第二脉冲控制信号至上拉辅助单元，接收器的输入端连接在通讯接口A1或A2，上拉辅助单元的输出端接通讯接口A1或A2，接收器输出信号Rev，信号Rev为控制单元的输入接收级。因此，本实用新型能提高通讯成功率、数据传输准确率和总线的通讯速率。

Description

一种总线通讯接口电路

技术领域

本实用新型属于总线通讯技术领域，涉及一种总线通讯接口电路及增强总线通讯效果的通信方法。

背景技术

总线是***各种设备部件之间传送信息的公共通信干线，它是由导线组成的传输线束。异步时钟总线含数据总线和时钟总线，分别用来传输数据和时钟信号。

请参阅图1，图1所示为现有技术中总线与***设备的连接关系示意图。如图1所示，总线的两个通讯接口A1和A2需通过上拉电阻R1和电阻R2 接电源VCC，并通过两个通讯接口A1和A2连接总线的外部设备U1、外部设备U2和外部设备U3。例如，I2C(Inter－Integrated Circuit)总线是用于连接微控制器及其***设备的总线；SDA(串行数据线)和SCL(串行时钟线)都是双向I/O线，接口驱动为开漏输出，需通过上拉电阻接电源VCC。

外部设备U1、外部设备U2和外部设备U3有时候作为主机(主器件)，有时候作为从机(从器件)，主器件用于启动总线传送数据，并产生时钟以传送数据信息给其它的器件，此时任何被寻址的器件均被认为是从器件。在总线上主和从、发和收的关系不是恒定的，而取决于此时数据传送方向。如果主机要发送数据给从器件，则主机首先寻址从器件，然后主动发送数据至从器件，最后由主机终止数据传送。在这种情况下，主机中的控制器负责产生定时时钟和终止数据传送。

请参阅图2，图2所示为现有外部设备(例如图1中的U1、U2和U3) 中通讯接口示意图。如图2所示，这些外部设备U1、外部设备U2和外部设备U3通过通讯接口A1和通讯接口A2连接总线，总线的通讯接口A1和通讯接口A2需通过上拉电阻R1和R2接电源VCC。

每个外部设备通常包含NFET、控制单元和接收器。其中，NFET的漏极接地，NFET的源极接通讯接口A，控制单元输出第一脉冲控制信号至 NFET的栅极，接收器的输入端连接在通讯接口A1或通讯接口A2，信号 Rev为接收器的输出信号，所述信号Rev为控制单元的输入接收级。

请参阅图3，图3所示为现有通讯接口电路的信号波形示意。如图3所示，当关闭端口NFET后，波形A有总线上的上拉电阻来实现高电平信号，而电阻和总线上的寄生电容，就会产生RC延时，所以波形A上升沿缓慢。然而，波形A信号上升沿缓慢，对于波形A上的接收级Rev就会接收到有单边延时的信号，当延时过大时有可能造成通讯错误。

也就是说，由于每个器件的总线接口都有一定的等效电容，当总线上扩展的设备达到一定数量时，总电容过大，RC延时过大，因而总线A上升沿缓慢导致接收信号延迟，就会造成了通讯错误。通讯速率越快，越容易造成通讯错误。

实用新型内容

为解决的上述技术问题，本实用新型提出一种总线通讯接口电路及增强总线通讯效果的通信方法，其技术方案如下：

一种总线通讯接口电路，设置于通过总线交互数据的每一个外部设备中其包括：

连接在所述总线的通讯接口A1和通讯接口A2，所述通讯接口A1和通讯接口A2分别通过上拉电阻R1和上拉电阻R2接电源VCC；

与所述通讯接口A1相接的第一控制模块和与通讯接口A2相接的第二控制模块，所述第一控制模块和第二控制模块分别包括上拉辅助单元、NFET、控制单元和接收器；所述NFET的漏极接地，所述NFET的源极接通讯接口 A1或通讯接口A2；其中，所述控制单元输出第一脉冲控制信号gate_n至所述NFET的栅极，所述控制单元输出第二脉冲控制信号至所述上拉辅助单元，所述接收器的输入端连接在通讯接口A1或通讯接口A2，所述上拉辅助单元的输出端接所述通讯接口A1或通讯接口A2，所述接收器输出信号Rev，所述信号Rev为所述控制单元的输入接收级；

当所述第一脉冲控制信号gate_n从高电平变成低电平时，第二脉冲控制信号gate_p同时输出一个时间t的控制信号；此时，所述第一脉冲控制信号gate_n变低，关断所述的NFET，所述上拉电阻R1拉高通讯端口A1的电平或所述上拉电阻R2拉高通讯端口A2的电平；所述第二脉冲控制信号 gate_p通过控制所述上拉辅助单元在t时间内输出高电平，增加所述通讯接口A1或所述通讯接口A2从低电平到高电平的上升沿速度。

进一步地，所述上拉辅助单元为PFET，所述PFET的栅极接第二脉冲控制信号gate_p，所述PFET的源极接电源VCC，所述PFET的漏极接通讯接口A1或通讯接口A2。

进一步地，所述的t时间为短暂脉冲信号，小于所述第一脉冲控制信号 gate_n所持续低电平时间。

进一步地，所述N个外部设备之一为主机，其余N-1个外部设备中的一个或多个为从机。

从上述技术方案可以得出，在本实用新型总线通讯接口电路及增强总线通讯效果的通信方法的实施例中，具有如下有益效果：

①、提高通讯成功率；

②、实现更多的总线上的设备数量，确保每个设备总线接口等效电容不变情况下，数据传输的准确率高；

③、提高了总线的通讯速率。

附图说明

图1所示为现有技术中总线与***设备的连接关系示意图

图2所示为现有通讯接口的具体电路示意图

图3所示为现有技术中的通讯接口电路的信号波形示意

图4所示为本实用新型通讯接口电路一较佳实施例的示意图

图5所示为本实用新型通讯接口电路的信号波形示意

具体实施方式

下面结合附图4-5，对本实用新型的具体实施方式作进一步的详细说明。

请结合图1参阅图4，图4所示为本实用新型总线通讯接口电路一较佳实施例的示意图。如图1所示，在本实用新型的实施例中，总线上可以连接有多个外部设备(例如，外部设备U1、外部设备U2和外部设备U3)本实用新型的总线通讯接口电路可以设置于通过总线交互数据的每一个外部设备中。

该总线通讯接口电路包括连接在所述总线上的通讯接口A1和通讯接口 A2，以及与所述通讯接口A1相接的第一控制模块和与通讯接口A2相接的第二控制模块。所述通讯接口A1和通讯接口A2通过上拉电阻R1和上拉电阻R2接电源VCC。较佳地，上拉电阻R1和上拉电阻R2的阻值可以相同。

通常的情况下，所述多个外部设备之一为主机，其余的外部设备中的一个或多个为从机，所述主机用于发送数据，所述从机用于接收数据，或者，所述从机用于接收数据，并将所述数据处理后再发送给主机。

其中，每一个所述外部设备包括与所述通讯接口A1相接的第一控制模块和与通讯接口A2相接的第二控制模块，图4中所示的可以是第一控制模块或者是第二控制模块。

所述第一控制模块和第二控制模块分别包括上拉辅助单元、NFET、控制单元和接收器；所述NFET的漏极接地，所述NFET的源极接通讯接口 A1或通讯接口A2。

在本实用新型的较佳实施例中，所述控制单元输出第一脉冲控制信号 gate_n至所述NFET的栅极，所述控制单元输出第二脉冲控制信号至所述上拉辅助单元，所述接收器的输入端连接在通讯接口A1或通讯接口A2，所述上拉辅助单元的输出端接所述通讯接口A1或通讯接口A2，所述接收器输出信号Rev，所述信号Rev为所述控制单元的输入接收级。

较佳地，所述上拉辅助单元可以为PFET，所述PFET的栅极接第二脉冲控制信号gate_p，所述PFET的源极接电源VCC，所述PFET的漏极接通讯接口A1或通讯接口A2。

需要说明的是，本实用新型的通讯接口电路，与传统通讯接口电路相似的是，总线信号主要由NFET和总线上的上拉电阻R1或R2实现电平值的高低；与传统通讯接口电路不相同的是，本实用新型通过增加一个上拉辅助单元(例如，增加一个PFET)，PFET只是辅助上拉电阻R1或R2快速实现高电平，从而到达增加上升沿速度的目的。

具体工作原理过程请参阅图5，图5所示为本实用新型通讯接口电路的信号波形示意图。如图5所示，当所述第一脉冲控制信号gate_n从高电平变成低电平时，第二脉冲控制信号gate_p同时从高电平变成低电平，所述第二脉冲控制信号gate_p的低电平持续一个时间t后变成高电平；此时，所述第一脉冲控制信号gate_n变低，关断所述的NFET，所述上拉电阻R1拉高通讯端口A1的电平或所述上拉电阻R2拉高通讯端口A2的电平；所述第二脉冲控制信号gate_p通过控制所述上拉辅助单元在t时间内输出高电平，增加所述通讯接口A1或所述通讯接口A2从低电平到高电平的上升沿速度。

与图3中所示的图形相比，图5所示的通讯接口A信号从低电平到高电平的上升沿几乎是垂直的。也就是说，本实用新型的总线通讯接口电路可以有效地解决现有接口电路实现总线A上升沿缓慢导致接收信号延迟，而造成的通信错误。

其中，所述时间t小于第一脉冲控制信号gate_n所持续的低电平时间。由于在很短的一段时间t驱动结束后，PFET就处于关闭状态，不影响总线通讯协议的执行。进一步地，所述的t时间为短暂脉冲信号，小于所述第一脉冲控制信号gate_n所持续低电平时间。

接下来，描述一下本实用新型提出的一种增强总线通讯效果的通信方法，该方法可以应用于一台主机同一台从机间的通信，也可以用于一台主机同多台从机间的通信，为简化起见，就以一台主机同一台从机间的通信为例进行说明，其它情况类似，不再赘述。

再请参阅图4，用于发送数据的主机和用于接收数据的从机分别包括上述的总线通讯接口电路。该增强总线通讯效果的通信方法，用于通过总线交互数据的外部设备间的通讯，所述主机和从机的数据通讯包括：

步骤S1：所述主机中的第一控制模块和第二控制模块分别根据协议产生第一脉冲控制信号gate_n和第二脉冲控制信号gate_p，去控制所述通讯接口A1和通讯接口A2发送数据；其中，当所述第一脉冲控制信号gate_n从高电平变成低电平时，第二脉冲控制信号gate_p同时从高电平变成低电平，所述第二脉冲控制信号gate_p的低电平持续一个时间t后变成高电平；此时，所述第一脉冲控制信号gate_n变低，关断所述的NFET，所述上拉电阻R1 拉高通讯端口A1的电平或所述上拉电阻R2拉高通讯端口A2的电平；所述第二脉冲控制信号gate_p通过控制所述上拉辅助单元在t时间内输出高电平，增加所述通讯接口A1或所述通讯接口A2从低电平到高电平的上升沿速度；其中，所述时间t小于第一脉冲控制信号gate_n所持续的低电平时间。

也就是说，每次第一脉冲控制信号gate_n控制关闭NFET后，第二脉冲控制信号gate_p控制打开PFET，让总线A信号迅速上升后，第二脉冲控制信号gate_p马上再关闭PFET。即打开PFET的时间t很小，只是瞬间辅助总线上拉电阻，增加A信号上升沿的速度，不影响总线通讯协议。

步骤S2：所述从机的第一控制模块和第二控制模块分别接收所述主机的第一控制模块和第二控制模块控制所述通讯接口A1和通讯接口A2发送的数据，并通过所述第一控制模块和第二控制模块的所述接收器分别接收，所述接收器输出信号Rev至各自相应的控制单元。

综上所述，本实用新型的总线通讯接口电路及增强总线通讯效果的通信方法，可以提高通讯成功率，增加了总线上的接口电路可以实现更多的总线上的设备数量，且提高了总线的通讯速率。

以上所述的仅为本实用新型的优选实施例，所述实施例并非用以限制本实用新型的专利保护范围，因此凡是运用本实用新型的说明书及附图内容所作的等同结构变化，同理均应包含在本实用新型的保护范围内。

Claims (3)

1.一种总线通讯接口电路，设置于通过总线交互数据的每一个外部设备中，其特征在于，包括：

连接在所述总线上的通讯接口A1和通讯接口A2，所述通讯接口A1和通讯接口A2分别通过上拉电阻R1和上拉电阻R2接电源VCC；

与所述通讯接口A1相接的第一控制模块和与通讯接口A2相接的第二控制模块，所述第一控制模块和第二控制模块分别包括上拉辅助单元、NFET、控制单元和接收器；所述NFET的漏极接地，所述NFET的源极接通讯接口A1或通讯接口A2；其中，所述控制单元输出第一脉冲控制信号gate_n至所述NFET的栅极，所述控制单元输出第二脉冲控制信号至所述上拉辅助单元，所述接收器的输入端连接在通讯接口A1或通讯接口A2，所述上拉辅助单元的输出端接所述通讯接口A1或通讯接口A2，所述接收器输出信号Rev，所述信号Rev为所述控制单元的输入。

2.根据权利要求1所述的总线通讯接口电路，其特征在于，所述上拉辅助单元为PFET，所述PFET的栅极接第二脉冲控制信号gate_p，所述PFET的源极接电源VCC，所述PFET的漏极接通讯接口A1或通讯接口A2。

3.根据权利要求2所述的总线通讯接口电路，其特征在于，所述的t时间为短暂脉冲信号，小于所述第一脉冲控制信号gate_n所持续低电平时间。

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