CN203399117U - 可时钟同步的光纤网络监控卡 - Google Patents
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Abstract
本实用新型公开了可时钟同步的光纤网络监控卡,包括中央处理器、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片、时钟电路和现场可编程门阵列FPGA,所述的时钟电路、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接;所述的第一参考时钟芯片和第二参考时钟芯片均连接时钟电路;所述的接口测试适配器上连接两个测试端口。本实用新型通过上述原理,设置专门的可实现同步的时钟电路,使FC网络监控卡具有主/从时钟工作模式。
Description
技术领域
本实用新型涉及光纤网络监控卡领域,具体涉及可时钟同步的光纤网络监控卡。
背景技术
FC网络监控卡用于接收光纤线路中的FC帧,并根据配置方案的定义过滤FC帧,并通过PCIE接口采用DMA方式传输计算机***内存中。其中FC网络监控卡的运行需要用到FC监控卡驱动软件和监控动态链接库软件。FC监控卡驱动软件位于Windows操作***的驱动层,通过操作***为上层应用软件提供识别、读、写和控制板卡的接口。监控动态链接库软件用于实现用户定义的监控配置、管理和控制方面的功能。FC网络监控卡捕获的数据通过PCIE接口传输到***内存中,并由***内存写入磁盘阵列中。所有数据移动的过程均由软件控制。其中的FC网络监控卡要求具有主/从时钟工作模式,作为主时钟,具有复位和周期定时的功能;作为从时钟,具有接收主时钟信号和进行同步的功能。但是现有的FC网络监控卡还无法达到这样的要求。
实用新型内容
本实用新型克服了现有技术的不足,提供可时钟同步的光纤网络监控卡,设置专门的可实现同步的时钟电路,使FC网络监控卡具有主/从时钟工作模式。
为解决上述的技术问题,本实用新型采用以下技术方案:可时钟同步的光纤网络监控卡,包括中央处理器、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片、时钟电路和现场可编程门阵列FPGA,所述的时钟电路、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接;所述的第一参考时钟芯片和第二参考时钟芯片均连接时钟电路;所述的接口测试适配器上连接两个测试端口。
所述的时钟电路包括寄存器F1、寄存器F2、寄存器F3、寄存器F4、寄存器F5、与门A1和与门A2,其中的寄存器F1的正输出端Q1、寄存器F2的触发端D2、寄存器F2的正输出端Q2、寄存器F3的触发端D3、寄存器F3的正输出端Q3和与门A2的输入端依次连接,并且与门A2的输入端还与寄存器F3的触发端D3连接;其中的寄存器F2、寄存器F3和寄存器F5的时钟端均与第二参考时钟芯片连接,寄存器F1、寄存器F4和与门A1的输入端均连接第一参考时钟芯片;其中的寄存器F4的触发端D4连接中央处理器,寄存器F4的正输出端Q4连接寄存器F5的触发端D5;其中的与门A1的输出端连接寄存器F1的复位端CLR,与门A1的输入端和与门A2的输出端均连接触发器F5的使能端CE。
所述的现场可编程门阵列FPGA还同时连接光收发模块、数据缓冲存储器FLASH、静态随机存储器SRAM和PCI-EXPRESS X4接口。
所述的光收发模块的型号为FTRJ-8519-1-2.5。
所述的中央处理器的型号为ARMCORTEX M3。
与现有技术相比,本实用新型的有益效果是:
1、 本实用新型设置专门的时钟电路,电路上设置有独立的主/从时钟同步接口,主设备通过同步控制线连接从设备,实现各监控卡同步。
2、 其中的光模块的作用就是光电转换,发送端把电信号转换成光信号,通过光纤传送后,接收端再把光信号转换成电信号。
附图说明
图1为本实用新型的原理图。
具体实施方式
下面结合附图对本实用新型作进一步阐述,本实用新型的实施例不限于此。
实施例:
如图1所示,本实用新型包括可时钟同步的光纤网络监控卡,包括中央处理器、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片、时钟电路和现场可编程门阵列FPGA,现场可编程门阵列FPGA还同时连接光收发模块、数据缓冲存储器FLASH、静态随机存储器SRAM和PCI-EXPRESS X4接口。本实施例的时钟电路、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接;所述的第一参考时钟芯片和第二参考时钟芯片均连接时钟电路;所述的接口测试适配器上连接两个测试端口。光收发模块的型号为FTRJ-8519-1-2.5;中央处理器的型号为ARMCORTEX M3,第一参考时钟芯片的型号为MAX DS4106,第二参考时钟芯片的型号为MAX DS4212,FPGA的型号为XC5VLX110T。
本实施例的时钟电路包括寄存器F1、寄存器F2、寄存器F3、寄存器F4、寄存器F5、与门A1和与门A2,其中的寄存器F1的正输出端Q1、寄存器F2的触发端D2、寄存器F2的正输出端Q2、寄存器F3的触发端D3、寄存器F3的正输出端Q3和与门A2的输入端依次连接,并且与门A2的输入端还与寄存器F3的触发端D3连接;其中的寄存器F2、寄存器F3和寄存器F5的时钟端均与第二参考时钟芯片连接,寄存器F1、寄存器F4和与门A1的输入端均连接第一参考时钟芯片;其中的寄存器F4的触发端D4连接中央处理器,寄存器F4的正输出端Q4连接寄存器F5的触发端D5;其中的与门A1的输出端连接寄存器F1的复位端CLR,与门A1的输入端和与门A2的输出端均连接触发器F5的使能端CE。
通过时钟电路,电路上设置有独立的主/从时钟同步接口,主设备通过同步控制线连接从设备,实现各监控卡同步,使FC网络监控卡具有主/从时钟工作模式。
如上所述便可实现该实用新型。
Claims (5)
1.可时钟同步的光纤网络监控卡,其特征在于:包括中央处理器、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片、时钟电路和现场可编程门阵列FPGA,所述的时钟电路、接口测试适配器、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接;所述的第一参考时钟芯片和第二参考时钟芯片均连接时钟电路;所述的接口测试适配器上连接两个测试端口。
2.根据权利要求1所述的可时钟同步的光纤网络监控卡,其特征在于:所述的时钟电路包括寄存器F1、寄存器F2、寄存器F3、寄存器F4、寄存器F5、与门A1和与门A2,其中的寄存器F1的正输出端Q1、寄存器F2的触发端D2、寄存器F2的正输出端Q2、寄存器F3的触发端D3、寄存器F3的正输出端Q3和与门A2的输入端依次连接,并且与门A2的输入端还与寄存器F3的触发端D3连接;其中的寄存器F2、寄存器F3和寄存器F5的时钟端均与第二参考时钟芯片连接,寄存器F1、寄存器F4和与门A1的输入端均连接第一参考时钟芯片;其中的寄存器F4的触发端D4连接中央处理器,寄存器F4的正输出端Q4连接寄存器F5的触发端D5;其中的与门A1的输出端连接寄存器F1的复位端CLR,与门A1的输入端和与门A2的输出端均连接触发器F5的使能端CE。
3.根据权利要求1所述的可时钟同步的光纤网络监控卡,其特征在于:所述的现场可编程门阵列FPGA还同时连接光收发模块、数据缓冲存储器FLASH、静态随机存储器SRAM和PCI-EXPRESS X4接口。
4.根据权利要求3所述的可时钟同步的光纤网络监控卡,其特征在于:所述的光收发模块的型号为FTRJ-8519-1-2.5。
5.根据权利要求1所述的可时钟同步的光纤网络监控卡,其特征在于:所述的中央处理器的型号为ARMCORTEX M3。
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CN201320511202.3U CN203399117U (zh) | 2013-08-21 | 2013-08-21 | 可时钟同步的光纤网络监控卡 |
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Application Number | Priority Date | Filing Date | Title |
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CN201320511202.3U CN203399117U (zh) | 2013-08-21 | 2013-08-21 | 可时钟同步的光纤网络监控卡 |
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CN203399117U true CN203399117U (zh) | 2014-01-15 |
Family
ID=49910613
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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CN201320511202.3U Expired - Lifetime CN203399117U (zh) | 2013-08-21 | 2013-08-21 | 可时钟同步的光纤网络监控卡 |
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CN (1) | CN203399117U (zh) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN103414511A (zh) * | 2013-08-21 | 2013-11-27 | 成都成电光信科技有限责任公司 | 时钟同步形网络监控卡 |
-
2013
- 2013-08-21 CN CN201320511202.3U patent/CN203399117U/zh not_active Expired - Lifetime
Cited By (1)
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CN103414511A (zh) * | 2013-08-21 | 2013-11-27 | 成都成电光信科技有限责任公司 | 时钟同步形网络监控卡 |
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