CN1697011A - 控制驱动器及显示装置 - Google Patents

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Abstract

一种驱动装置，具有：显示用存储器；存储器控制电路，进行控制：接收由图像描绘装置提供的输入图像数据，从显示用存储器读出输入图像数据的前一帧图像数据，并且将输入图像数据作为写入到显示用存储器的图像数据而写入到上述显示用存储器；图像数据控制电路，判断来自存储器控制电路的输入图像数据和从显示用存储器读出的前一帧读出图像数据是否一致；根据图像数据控制电路提供的输入图像数据和读出图像数据，输出变换后的图像数据的LUT；传送数据控制电路，当输入图像数据和读出图像数据一致时输出输入图像数据，当不一致时输出变换后的图像数据；锁存一个水平线的像素的图像数据的锁存电路；移位寄存器，生成并输出锁存信号，以使从传送数据控制电路输出、并通过开关被传送的图像数据由对应的锁存电路锁存，其中开关通过激活状态的传送启动信号被接通；数据线驱动电路，接收锁存电路的输出并驱动对应的数据线。

Description

控制驱动器及显示装置
技术领域
本发明涉及到一种显示装置，特别涉及到一种设置在上位装置和显示单元之间、进行显示单元的数据线的驱动控制的装置(称作“控制驱动器”)及显示装置。
背景技术
图15是现有的控制驱动器的典型结构的一个示例图(例如参照下述非专利文献1)。参照图15，该控制驱动器100(显示控制驱动装置)配置在构成上位装置的CPU(中央运算处理装置)等的图像描绘装置20和显示单元30之间，从图像描绘装置20接收应显示的图像数据，并控制到显示单元30的显示，该装置具有：至少存储一个帧的图像数据的显示用存储器121(也称作“帧存储器”)；锁存电路122；数据线驱动电路123；存储器控制电路124；时序控制电路125；以及灰度级电压发生电路126。并且图15所示的控制驱动器可构成例如半导体装置(IC)等。
在控制驱动器100中，存储器控制电路124输入从图像描绘装置20提供的图像数据(每1画素(像素)k比特)，并向显示用存储器写入1帧(水平方向为H像素，垂直方向为V像素，每1像素为k比特)的图像数据。
并且，时序控制电路125向存储器控制电路124输出时序控制信号，向锁存电路122提供锁存信号，向栅极线驱动电路31提供栅极启动脉冲信号，向数据线驱动电路123提供选通信号STB。
并且，锁存电路122响应于来自时序控制电路125的锁存信号，将从显示用存储器121读出并输出的1个线(H像素×k比特)的数据进行锁存，提供到数据线驱动电路123。
数据线驱动电路123接收来自灰度级电压发生电路126的灰度级电压输出(模拟电压)，接收来自锁存电路122的数字数据信号(k比特)，通过和该数据信号对应的灰度级电压信号驱动显示单元30的数据线。数据线驱动电路123由来自时序控制电路125的选通信号STB被激活。并且，由栅极线驱动电路31选择而被激活的栅极线所连接的像素开关(未图示)接通，来自该像素开关所连接的数据线的灰度级电压信号被施加到像素的显示元件(液晶元件时为像素电极)，由此，进行1个水平线的像素显示，之后同样地，从显示用存储器121依次输出的线的像素的图像数据被锁存电路122锁存，灰度级电压信号从数据线驱动电路123输出到显示单元30，依次进行由栅极线驱动电路31所选择的一个水平线的显示，并进行构成一个帧的V个线的显示。栅极线驱动电路31接收栅极启动脉冲信号，推动一个选择线，激活对应的栅极线。栅极线驱动电路31例如由移位寄存器构成，上述移位寄存器将栅极启动脉冲信号作为移位时钟接收，依次移位激活的栅极线。
并且，在图15所示的控制驱动器100中，锁存电路122具有将相当于一个线的H像素的图像数据(每1像素的图像数据为k比特)分别锁存的H个并列配置的锁存电路(各锁存电路将k比特的并行数据由输入的锁存信号同时锁存)。同样地，数据线驱动电路123具有分别接收来自H个锁存电路的输出、并驱动H个数据线的H个并列配置的数据线驱动电路。并且在图15中，为了便于简单说明，像素的图像数据只用亮度信号的灰度等级表示。当一个像素的数据具有RGB数据时，每1像素的图像数据例如为3×k比特。
图16是图15所示的显示装置的时序动作的一个示例。在图16中，CLK是提供到控制驱动100的时钟信号，地址是显示用存储器121的访问地址，k比特的输入图像数据[k-1:0]是从图像描绘装置20向控制驱动器100提供的k比特宽度的图像数据。并且，输入图像数据[k-1:0]的[k-1:0]表示从第0比特开始到k-1比特为止的比特宽度k的并行比特数据。显示用存储器控制信号是从存储器控制电路124输出到显示用存储器121的信号，锁存信号是从时序控制电路125输出到锁存电路122的信号。并且，选通信号STB是从时序控制电路125提供到数据线驱动电路123的信号。
如图16所示，在存储器控制电路124的控制下，写入图像数据对应于时钟信号CLK的每一周期所输出的显示用存储器写(WRITE)信号(脉冲信号)，按照每个时钟周期依次写入到显示用存储器121对应的地址中。即，作为一个水平线的像素的输入图像数据，显示用存储器121列方向的地址y对应于0、行方向的地址x对应于0-n为止的n+1个(＝H个)地址，依次输入n+1个像素的输入图像数据，存储器控制电路124按照每一时钟周期输出显示用存储器写信号(脉冲信号)，响应于显示用存储器写信号，写入图像数据以一个像素单位依次写入到显示用存储器121。在图16所示的例子中，写入图像数据D0、D1、D2、D3、...、Dn-1、Dn响应于每一时钟周期被激活的显示用存储器写信号，依次写入到显示用存储器121。存储在显示用存储器121内的图像数据从显示用存储器121例如以每1线(每H个像素)被读出，响应于由时序控制电路125输出的锁存信号，并列输出的一个水平线的像素的图像数据由锁存电路122的H个锁存电路锁存，和图像数据对应的灰度级电压从响应选通信号STB而被激活的数据线驱动电路123输出到显示单元30的数据线。
并且，上述现有的存储器内置控制驱动器中内置1个帧的显示用存储器121，当显示画面不切换时，停止从图像描绘装置(CPU)20传送图像数据，使存储在显示用存储器121中的图像数据输出到显示单元30。并且，内置有显示用存储器121，即使切换显示画面时，通过从图像描绘装置(CPU)20只传送变更了像素的图像数据，以达到减少电力消耗的目的。
但近些年来，在移动终端搭载视频、TV功能等，并通过高功能化显示动画图像的情况越来越多了。一帧大约为60Hz(16.7msec)左右。液晶材料的响应速度在白色显示和黑色显示二值显示下，例如为20至30msec左右，进行中间显示时，有时也会超过100msec。
图17是液晶面板的响应示例的模式示意图。如图17所示，相对于施加电压的变化，亮度的响应迟缓。例如，直到达到需要的亮度，其响应需要数帧的时间。
作为改善液晶响应速度的方法，一直以来存在利用过驱动方法的驱动(称作过驱动“オ一バ一ドライブ”)的技术。过驱动方法如图18所示，在图像发生变化的情况下，当上升时，向液晶面板施加比通常电压高的电压，当下降时，向液晶面板施加比通常电压低的电压，以此来提高灰度级变化时的响应速度。由于转移方向的不同而包括过驱动、减速驱动(ァンダ一ドライブ)，因此有时用响应时间补偿(RTC：Response Time Compensation)一词来替代过驱动、减速驱动(例如下述非专利文献2)。
图19是进行过驱动的结构的一个示例图(例如参照下述专利文献1)。如图19所示，该液晶面板装置是具有段电极驱动电路204的装置，并具有：按照1个帧存储显示用数字图像的图像存储器201；存储数字图像数据和从图像存储器201延迟一帧读出的图像数据的二个输入相对应的图像数据表的ROM(只读存储器)202(也称作“查找表”)，当图像数据变化时，根据其变化方向的程度，读出提前存储在ROM 202中的最佳图像数据，并驱动液晶面板，对其透光率的上升、下降在必要的充分的范围内加速。并且，同步控制电路203提供向图像存储器201的写入、读出、以及向段电极驱动电路204、公共电极驱动电路205的时序信号。
并且，在使用帧存储器和查找表进行过驱动的液晶面板驱动装置中，其构成是：输入数据的一部分和来自帧存储器的前一帧数据的一部分作为地址附加到查找表中，根据查找表的输出数据和输入数据的地址的非使用部分，生成过驱动的数据，此外减少查找表的存储量，同时减少过驱动数据的不均匀的构成也被公知(例如参照下述专利文献2)。
专利文献1：特开平4-365094号公报(图1)
专利文献2：特开平2004-78129号公报(图1)
非专利文献1：μPD161622デ一タ·シ一トS15469JJV0DS「RAM内蔵386出力TFT-LCD用ソ-スドライバ」、第2页、ULR<http：//www.necel.com/nesdis/images/S15649JJ2V0DS00.pdf”>
非专利文献2：Richard I.McCartney，48.3：A Liquid Crystal DisplayResponse Time Compensation Feature Integrated into and LCD PanelTiming Controller”，SID 03 DIGEST
但是将图19所示的构成适用于移动终端的显示装置的控制驱动器(也称作“控制驱动器IC”)时，需要配置和显示用存储器不同的、用于存储前一帧的图像数据的图像存储器。因此，电路规模增大，消耗电力增加，并且配线也会增加。
关于这一点以图15所示的控制驱动器100为例进行说明。如图15所示，在该控制驱动器100中，其构成是从显示用存储器121读出的图像数据传送到锁存电路122。在这种构成下，为了实现过驱动，对输入图像数据进行过驱动处理，需要将过驱动后的图像数据写入到显示用存储器121。
如上所述，过驱动处理，根据输入图像数据和前一帧的图像数据由查找表确定。因此为了使图15的构成和过驱动相对应，需要另外的用于保存输入图像前一帧的图像数据的帧存储器。
并且，为了对应过驱动，需要准备存储2个帧的图像数据的存储器，这样会导致电路规模的增大、消耗电力的增加。因此，对于要求低耗电量、小型化的移动通信终端等而言，其很难应用。
因此，本发明正是鉴于以上各问题而出现的，其目的在于提供一种在抑制电路规模增加、降低耗电量的同时，可进行过驱动等响应时间补偿的驱动器及显示装置。
发明内容
本发明所公开的发明为了实现上述目的，简言之具有下述构成。
本发明的一个方面的控制驱动器(控制驱动装置)具有：显示用存储器，至少存储一个帧的图像数据；存储器控制电路，进行以下控制：接收由图像描绘装置提供的输入图像数据，从上述显示用存储器读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；变换电路，输入上述输入图像数据和上述前一帧的读出图像数据，输出根据上述输入图像数据和上述前一帧的读出图像数据所确定的变换后图像数据；比较电路，比较上述输入图像数据和上述前一帧的读出图像数据；传送数据控制电路，根据上述输入图像数据和上述前一帧的读出图像数据的比较结果，判断输出上述变换电路的上述变换后图像数据或者上述输入图像数据中的哪一个，并输出上述变换后图像数据或者上述输入图像中的一方的图像数据；多个锁存电路，将从上述传送数据控制电路输出的图像数据直接、或者通过预定的电路间接接收，并响应于输入的锁存信号进行锁存；以及多个驱动电路，将从上述多个锁存电路分别输出的图像数据作为输入而接收，分别输出和上述图像数据对应的输出信号。
本发明的另一方面的控制驱动器是：具有至少存储一个帧的图像数据的显示用存储器，并设置在图像描绘装置和显示单元之间，其具有：存储器控制电路，进行以下控制：接收由上述图像描绘装置提供的输入图像数据，从上述显示用存储器中读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；图像数据控制电路，输入上述输入图像数据和从上述显示用存储器读出的上述前一帧的读出图像数据，判断上述输入图像数据和上述读出图像数据是否一致；变换电路，根据上述输入图像数据和上述前一帧的读出图像数据，输出变换后图像数据；传送数据控制电路，根据上述图像数据控制电路的判断结果，当上述输入图像数据和上述前一帧的读出图像数据一致时，输出上述输入图像数据，当不一致时，输出上述变换后图像数据；多个锁存电路，通过开关与上述传送数据控制电路的输出端连接；移位电路，对上述多个锁存电路分别生成锁存信号并提供；以及多个数据线驱动电路，接收来自上述多个锁存电路的输出，分别驱动对应的数据线。
本发明的另一方面的控制驱动器是：具有至少存储一个帧的图像数据的显示用存储器，并设置在图像描绘装置和显示单元之间，其具有：存储器控制电路，进行以下控制：接收由上述图像描绘装置提供的输入图像数据，从上述显示用存储器中读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；图像数据控制电路，输入上述输入图像数据和从上述显示用存储器读出的上述前一帧的读出图像数据，判断上述输入图像数据和上述读出图像数据是否一致；变换电路，根据上述输入图像数据和上述前一帧的读出图像数据，输出变换后图像数据；传送数据控制电路，根据上述图像数据控制电路的判断结果，当上述输入图像数据和上述前一帧的读出图像数据一致时，输出上述输入图像数据，当不一致时，输出上述变换后图像数据；数据移位电路，将从上述传送数据控制电路输出的图像数据依次移位，最多保存一个线的多个像素的图像数据；多个锁存电路，通过开关与上述数据移位电路的输出端连接，当上述开关为接通时，分别接收来自上述数据移位电路的多个像素的图像数据，并响应于共同的锁存信号进行锁存；以及多个数据线驱动电路，接收来自上述多个锁存电路的输出，分别驱动对应的数据线。
进一步，本发明的另一方面下的控制驱动器是：具有至少存储一个帧的图像数据的显示用存储器，并设置在图像描绘装置和显示单元之间，其具有：存储器控制电路，进行以下控制：接收由上述图像描绘装置提供的输入图像数据，从上述显示用存储器中读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；图像数据控制电路，输入上述输入图像数据和从上述显示用存储器读出的上述前一帧的读出图像数据，判断上述输入图像数据和上述读出图像数据是否一致；变换电路，根据上述输入图像数据和上述前一帧的读出图像数据，输出变换后图像数据；传送数据控制电路，根据上述图像数据控制电路的判断结果，当上述输入图像数据和上述前一帧的读出图像数据一致时，输出上述输入图像数据，当不一致时，输出上述变换后图像数据；存储器电路，将从上述传送数据控制电路输出的图像数据存储到对应的地址中，最多存储一个线的多个像素的数据；多个锁存电路，通过开关与上述存储器电路的输出端连接，当上述开关为接通时，分别接收来自上述存储器电路的多个像素的图像数据，并响应于共同的锁存信号进行锁存；以及数据线驱动电路，接收来自上述多个锁存电路的输出，分别驱动对应的数据线。
进一步，本发明的另一方面所涉及的装置是：包括控制电路、锁存电路和数据线驱动电路，上述控制电路，当处于响应时间补偿模式时，将输入数据和来自上述帧存储器的前一帧的数据输入到上述查找表，根据上述输入数据和上述前一帧的数据的比较结果，当需要对上述输入数据进行响应时间的补偿时，输出来自上述查找表的数据，来自上述控制电路的输出数据被对应的上述锁存电路锁存，接收从上述锁存电路输出的数据的上述数据线驱动电路输出和上述数据对应的信号，当不处于上述响应时间补偿模式时，上述控制电路的输出从上述锁存电路切断，从上述帧存储器输出的数据被对应的上述锁存电路锁存，接收从上述锁存电路输出的数据的上述数据线驱动电路输出和上述数据对应的信号，通过具有一个帧存储器可进行响应时间的补偿。
根据本发明，比较输入图像数据和前一帧的读出图像数据并进行过驱动的控制驱动器中，不需要追加帧存储器，并且可以实现电路小型化，可以避免配线的增加，以及实现耗电的降低。
附图说明
图1是本发明第一实施例的整体构成的示意图。
图2是用于说明本发明第一实施例的动作的示例的时序图。
图3是本发明第一实施例中的LUT的***电路构成的示意图。
图4是本发明第一实施例中的移位寄存器的构成的示意图。
图5是本发明第二实施例的整体构成示意图。
图6是用于说明本发明第二实施例的动作的示例的时序图。
图7是本发明第二实施例中的LUT的***电路构成的示意图。
图8是本发明第二实施例中的数据移位电路的构成的示意图。
图9是本发明第三实施例的整体构成的示意图。
图1O是用于说明本发明第三实施例的动作的示例的时序图。
图11是本发明第三实施例中的LUT的***电路构成的示意图。
图12是本发明第三实施例中的线存储器的构成的示意图。
图13是本发明第四实施例中的LUT的***电路构成的示意图。
图14是本发明第五实施例中的LUT的***电路构成的示意图。
图15是现有的控制驱动器的典型构成的示意图。
图16是用于说明图15的控制驱动器的动作的示例的时序图。
图17是用于说明现有的液晶响应速度的图。
图18是用于说明过驱动方式的液晶面板驱动装置的响应速度的图。
图19是现有的过驱动方式的液晶面板驱动装置的构成示意图。
具体实施方式
对实施本发明的最佳方式进行说明。参照图1，本发明的一个实施方式所涉及的显示用控制驱动装置(控制驱动器)具有：显示用存储器(101)；存储器控制电路(104)，进行以下控制：接收由图像描绘装置(20)提供的输入图像数据，从显示用存储器(101)读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据提供到显示用存储器(101)；图像数据控制电路(108)，从存储器控制电路(104)接收输入图像数据并暂时保存，在存储器控制电路(104)的控制下，将从显示用存储器(101)读出的前一帧的读出图像数据暂时保存，判断上述输入图像数据和上述前一帧的读出图像数据是否一致；变换电路(109)，输出根据上述输入图像数据和上述前一帧的读出图像数据而确定的变换后的图像数据；传送数据控制电路(110)，当上述输入图像数据和上述前一帧读出图像数据一致时输出上述输入图像数据，当不一致时输出上述变换后的图像数据；锁存多个像素(例如1个线的像素)的图像数据的锁存电路组(102)；移位寄存器电路(107)，生成并输出锁存信号，以使从传送数据控制电路(110)输出、并经由开关(111)被传送的图像数据在锁存电路组(102)中以对应的锁存电路锁存，其中上述开关(111)由传送启动信号被接通；以及数据线驱动电路组(103)，接收锁存电路组各锁存电路的输出，并驱动对应的数据线。
图像数据控制电路(108)从图像描绘装置(20)输入动画静止图像识别信号，当动画静止图像识别信号表示静止图像时，进行控制，使上述输入图像数据作为写入数据提供到显示用存储器(101)。并且，从显示用存储器(101)输出的多个(例如1个线)的图像数据被提供到锁存电路组(102)，在上述锁存电路组中，根据静止图像用的锁存信号，将从显示用存储器(101)输出的一个线的图像数据进行采样，并输出到数据线驱动电路组(103)。
另一方面，当动画静止图像识别信号表示动画图像时，在存储器控制电路(104)的控制下，输入图像数据的前一帧的图像数据从显示用存储器(101)被读出，临时保存在图像数据控制电路(108)中的该输入图像数据被提供到显示用存储器(101)，并写入到对应的地址中。并且，在图像数据控制电路(108)中，判断输入图像数据和前一帧的读出图像数据是否一致，根据判断结果，从传送数据控制电路(110)输出输入图像数据或者变换后图像数据，经由设定为接通状态的开关(111)被提供到锁存电路组(102)。并且，响应于从移位寄存器电路(107)输出的锁存信号，通过锁存电路组(102)中对应的锁存电路，图像数据被采样，并被提供到对应的数据线驱动电路(103)。
根据本发明的一个实施方式，在动画图像显示时进行过驱动的情况下，由于从显示用存储器(101)读出前一帧的图像数据和向显示用存储器(101)写入现在的图像数据是以多个像素单位进行的，因此对显示用存储器(101)的访问次数较少，可以抑制动画图像模糊。
并且，根据本发明的一个实施方式，在变换电路(109)将变换为过驱动用的图像数据传送到锁存电路102时，由于使用了从显示用存储器(101)到锁存电路(102)的配线(数据总线)112，因此可以在不增加配线数的情况下实现过驱动。
进一步，根据本发明的一个实施方式，在静止图像显示时，与上述现有技术一样，将存储在显示用存储器(101)中的图像数据以一个水平线(水平像素数)的单位读出，并经由锁存电路(102)显示，在动画图像显示时，进行如上所述的过驱动。这样一来，在动画图像显示时和静止图像显示时，通过变更控制驱动器的控制形态，可以选择在静止图像显示时、动画图像显示时最适合的驱动方法。并且，静止图像显示时、动画图像显示时的控制驱动器的控制形态的切换，通过从图像描绘装置(CPU)(20)输入到控制驱动装置(控制驱动器)的识别信号来进行。以下参照具体的实施例进行说明。
(实施例)
图1是本发明第一实施例的构成的示意图。参照图1，在本实施例中，控制驱动器10配置在图像描绘装置20和显示单元30之间，具有显示用存储器101、锁存电路102、数据线驱动电路103、存储器控制单元104、时序控制电路105、灰度级电压发生电路106、移位寄存器107、图像数据控制电路108、查找表109、传送数据控制电路110、开关111、以及数据传送用的配线112。其中，图像描绘装置20由CPU等构成，显示单元30例如由LCD(Liquid Crystal Display)或者EL(Electro Luminescence)显示器等构成。
在控制驱动器10中，显示用存储器101存储一个帧(H×V个像素)的像素数据(k比特)。
存储器控制电路104从CPU等图像描绘装置20输入输入图像数据(每一像素k比特)，从图像描绘装置20输入存储器控制信号，生成显示用存储器控制信号提供到显示用存储器101。存储器控制电路104和图15所示的构成一样，从时序控制电路105接收时序控制信号。时序控制电路105向栅极线驱动电路31提供栅极启动脉冲信号，向数据线驱动电路103提供选通信号STB。
图像数据控制电路108输入从图像描绘装置20输出的用于识别动画、静止图像的动画静止图像识别信号，从存储器控制电路104输入输入图像数据并保存在输入数据寄存器中(未图示)。当从图像描绘装置20提供到控制驱动器10的输入图像数据为动画图像时，动画静止图像识别信号被设定为表示动画图像的值，当输入图像数据为静止图像时，动画静止图像识别信号被设定为表示静止图像的值。来自图像描绘装置20的输入图像数据例如经由k比特宽度的数据总线、按每一像素依次提供到控制驱动器10。并且，在图1等中，为了便于说明，像素的图像数据(每一像素k比特)只以亮度信号的灰度级表示。一个像素的数据具有RGB数据时，每一像素的图像数据例如为3×k比特。
以下对来自图像描绘装置20的动画静止图像识别信号为动画图像的情况下，就本实施例中的图像数据控制电路108、查找表109、传送数据控制电路110、移位寄存器107、存储器控制电路104、时序控制电路105、锁存电路102、及数据线控制电路103相关的数据流程及控制进行概要说明。
即，动画静止图像识别信号为动画时，图像数据控制电路108将已经写入到显示用存储器101的前一帧的图像数据以二个像素并列读出，并将该读出的二个像素的图像数据保存在读出数据寄存器(未图示)中。并且，二个像素的输入图像数据从图像数据控制电路108作为二个像素的存储器写入图像数据(k比特×2)被输出，在存储器控制电路104的控制下，写入到显示用存储器101中。写入到显示用存储器101的二个像素的存储器写入图像数据在存储器控制电路104的控制下，和该二个像素的存储器读出图像数据的读出时间错开，写入到读出前一帧的二个像素的存储器读出图像数据的地址中。
并且，图像数据控制电路108判断从存储器控制电路104接收的输入图像数据(k比特)和该输入图像数据的前一帧的存储器读出图像数据(k比特)是否一致，将判断结果作为不一致信号提供到传送数据控制电路110。
进一步，图像数据控制电路108将从存储器控制电路104接收的输入图像数据(k比特)提供到传送数据控制电路110，将输入图像数据和前一帧的存储器读出图像数据提供到查找表109。
在查找表109中，输入由图像数据控制电路108提供的输入图像数据(k比特)和该输入图像数据的前一帧的图像数据(k比特)，将输入的各个图像数据作为地址读出的图像数据(用于进行过驱动或者减速驱动的数据，称作“变换后图像数据”)输出到传送数据控制电路110。变换后图像数据根据相对于输入图像数据及前一帧的存储，读出图像数据的变化方向的程度，被设定为使显示元件的亮度响应上升、下降在必要的充分的范围内加速的信号值。
传送数据控制电路110接收由图像数据控制电路108输出的不一致信号和输入图像数据，接收从查找表109输出的变换后图像数据，当不一致信号表示不一致时，选择并输出变换后图像数据，当不一致信号表示不一致时，输出输入图像数据。
在本实施例中，传送数据控制电路110并列输出二个像素的图像数据(k比特×2)。例如具有存储偶数位数据为高位k比特、奇数位数据为低位k比特的寄存器，从该寄存器将二个像素(k比特×2)的图像数据经由被设定为接通状态的开关111提供到锁存电路102(H个锁存电路)。
开关111在来自存储器控制电路104的传送启动信号为激活状态的期间内，被设定为接通状态。
在本实施例中，移位寄存器107由H/2级级联连接的触发器构成，通过由时序控制电路105提供的锁存/移位信号中的移位信号被移位驱动，对应于从传送数据控制电路110输出的二个像素的图像数据，将H/2个锁存信号依次激活并输出。即，移位寄存器107在动画静止图像识别信号为动画图像时，通过H/2级的触发器分别输出，在激活的时间分别输出和时序控制电路105提供的移位信号的周期错开的H/2个锁存信号。此外，在静止图像情况下的移位寄存器107的动作后述。
锁存电路102由对应于一个水平线的H个像素的H个锁存电路并列配置而成，H个锁存电路分别将一个像素k比特的图像数据进行锁存并输出。在H个锁存电路中，二个锁存电路共享从移位寄存107输出的锁存信号。即，和从传送数据控制电路110输出的二个像素的图像数据(k比特×2)分别对应的二个锁存电路响应于从移位寄存器107输出的公共的锁存信号，分别锁存该二个像素的图像数据，并将锁存的二个像素的图像数据分别提供到对应的二个数据线驱动电路的输入端。
数据线驱动电路103由输入端分别连接到H个锁存电路的输出端、输出端分别连接到H个数据线的H个数据线驱动电路并列配置而成。H个数据线电路分别输入从对应的锁存电路输出的k比特的图像数据，输入来自灰度级电压发生电路106的灰度级电压，响应于来自时序控制电路105的选通信号STB的激活，通过和输入的图像数据对应的信号电压驱动显示单元30的数据线。并且，通过接收来自时序控制电路105的栅极启动脉冲信号的栅极线驱动电路31而被选择、激活的栅极线所连接的像素开关(未图示)被接通，来自与该像素开关连接的数据线的灰度级电压信号被施加到像素的显示元件，由此进行一个水平线的像素显示。以下同样，针对下一个线的图像数据，从传送数据控制电路110依次输出的二个像素单位的图像数据通过从移位寄存器107依次输出的H/2个锁存信号，在对应的二个锁存电路依次被锁存，和图像数据对应的灰度级电压信号从数据线驱动电路103输出到H个数据线，依次进行通过栅极线驱动电路31选择的线的显示，并进行构成一个帧的V个线的显示。
接着对在图1所示的本实施例中来自图像描绘装置20的输入图像数据为静止图像时的动作进行说明。图像数据控制电路108将来自存储器控制电路104的输入图像数据作为二个像素并列的存储器写入数据而写入到显示用存储器101。从显示用存储器101读出的图像数据以一个线并列地提供到锁存电路102。
当动画静止图像识别信号为静止图像时，移位寄存器107根据来自时序控制电路105的锁存/移位信号中的锁存信号，将H/2个锁存信号以公共的时序激活并输出。以H个锁存电路锁存的一个线的图像数据并列地被提供到数据线驱动电路103，在和图像数据对应的灰度级电压下，第一至第H个数据线被驱动。通过接收来自时序控制电路105的栅极启动脉冲信号的栅极线驱动电路31而被选择、激活的栅极线所连接的像素开关(未图示)被接通，来自与该像素开关连接的数据线的灰度级电压信号被施加到像素(显示元件)，由此进行一个线的像素显示。以下同样，从显示用存储器101以每一个线(H个)依次输出的H个图像数据被H个锁存电路锁存，和来自锁存电路的图像数据对应的灰度级电压信号从数据线驱动电路103输出到H个数据线，依次进行通过栅极线驱动电路31所选择的线的显示，并进行构成一个帧的V个线的显示。
在本实施例中，在向显示用存储器101以每二个像素进行的写入图像数据的传送、从显示用存储器101以每二个像素进行的读出图像数据的传送、及向锁存电路的每二个像素进行的传送中，使用来自图像描绘装置20的输入图像的传送时钟的二分频时钟进行图像数据的传送。因此，可以无需增加传送时钟的频率而实现过驱动。
并且，在本实施例中，当动画静止图像识别信号为动画图像时，作为将从传送数据控制电路110输出的图像数据传送到锁存电路102的数据传送路径，使用动画静止图像识别信号为静止图像时作为数据传送路径所使用的、从显示用存储器101到锁存电路102的配线(数据总线)。根据这种构成的本实施例，在实现过驱动功能的情况下，也可以不增加连接到锁存电路102的配线，从而可以抑制芯片面积增加。即，在本实施例中，当动画静止图像识别信号为动画图像时，将传送数据控制电路110的输出通过传送启动信号在激活状态期间为接通状态的开关111而连接到数据传送用的配线112，将从传送数据控制电路110输出的图像数据从配线112传送到锁存电路102。并且，当动画静止图像识别信号为静止图像时，开关111总是保持断开状态，传送数据控制电路110的输出和配线112切断。如上所述，可以进行切换，使得在同一形态下，当为静止图像时保持和现有技术一样的电力，只在动画图像显示时进行过驱动。
并且，在图1中，数据线驱动电路103的构成是电压驱动数据线，当显示单元30的像素由电流驱动型的显示元件构成时其构成为：灰度级电压发生电路106被置换为电流发生电路，数据线驱动电路103的H个数据线驱动电路分别根据对应的锁存电路输出的图像数据，通过驱动电流而驱动对应的数据线。
图2是用于说明图1所示的本发明的第一实施例中，当动画静止图像识别信号为动画图像时的动作的时序图。在图2中，CLK是驱动时钟信号。地址是一个线的输入图像数据的显示用存储器的存储地址。在图2中，一个线的输入图像数据为y地址为0、x地址为0-n的地址，k比特的输入图像数据为D0-Dn。此外在图1中，显示用存储器101的一个线为H像素，H和图2的地址(0，n)中的n的关系是H＝n+1。以下参照图1和图2对本发明的第一实施例的动作进行说明。
存储器控制电路104将显示用存储器读(READ)和显示用存储器写按照各个时钟周期交互输出作为显示用存储器控制信号。向显示用存储器101的存储器写入图像数据的传送按照每二个像素(k比特×2)并行进行，从显示用存储器101读出的存储器读出图像数据也以每二个像素(k比特×2)并行进行，传送速率是从图像描绘装置20传送输入图像数据的一半。
移位寄存器107根据时序控制电路105提供的移位信号(时钟信号CLK的二个时钟周期)，依次输出二个时钟周期相位互相错开的锁存信号0、锁存信号1、...、锁存信号(n-2)/2、锁存信号(n-2)/2＝H/2。
时序控制电路105在锁存信号(n-1)/2(脉冲信号)从移位寄存器107输出、一个线(H个)的像素的图像数据由锁存电路102锁存后，生成并输出选通信号STB(脉冲信号)，将该选通信号STB提供到数据线驱动电路103。
图像数据控制电路108具有：输入数据寄存器(图1中未图示，图3的1081)，输入来自存储器控制电路104的一个像素单位(k比特)的输入图像数据，并输出二个像素的图像数据(2×k比特宽度)；及输入并存储来自显示用存储器101的存储器读出图像数据(2×k比特宽度)的读出数据寄存器(图1中未图示，图3中的1082)。图2表示输入数据寄存器的高位k比特[k×2-1:k]和低位k比特[k-1:0]的内容推移，及存储从显示用存储器101读出的前一帧的存储器读出图像数据的读出数据寄存器的高位k比特[k×2-1:k]和低位k比特[k-1:0]的内容推移。
图像数据控制电路108的输入数据寄存器[k×2-1:k]和输入数据寄存器[k-1:0]中，按照时钟信号CLK的每二个周期存储偶奇的输入图像数据。即，输入数据寄存器[k×2-1:k]中，以每二个周期存储从存储器控制电路104提供到图像数据控制电路108的输入图像数据D0、D2、D4、...、Dn-3、Dn-1。并且输入数据寄存器[k-1:0]内，以每二个周期存储从存储器控制电路104提供到图像数据控制电路108的输入图像数据D1、D3、D5、...、Dn-2、Dn。
图像数据控制电路108的输入数据寄存器的高位k比特[k×2-1:k]和低位k比特[k-1:0]的二个像素的图像数据，根据以每二个时钟周期被激活的显示用存储器控制信号写(高电平下为激活状态)，写入到显示用存储器101。
即，从图像数据控制电路108的输入数据寄存器[k×2-1:k]和输入数据寄存器[k-1:0]，作为k比特×2的存储器写入图像数据，传送D0和D1，响应于激活状态的显示用存储器控制信号写，D0和D1被写入到显示用存储器101的对应地址(0，0)、(0，1)。接着，从图像数据控制电路108的输入数据寄存器[k×2-1:k]和输入数据寄存器[k-1.0]，作为k比特×2的存储器写入图像数据，传送D2和D3，响应于激活状态的显示用存储器控制信号写，D2和D3被写入到显示用存储器101的对应地址(0，2)、(0，3)。同样，二个像素的图像数据Dn-1和Dn从输入数据寄存器被传送到显示用存储器101，响应于激活状态的显示用存储器控制信号写，被写入到显示用存储器101的对应的地址(0，n-1)、(0，n)。
图像数据控制电路108的读出数据寄存器的高位k比特[k×2-1:k]、低位k比特[k-1:0]中，按照时钟信号CLK的每二个周期被激活的显示用存储器控制信号读(高电平下为激活状态)，从显示用存储器101读出的二个像素的存储器读出图像数据被同时存储。即，读出数据寄存器[k×2-1:k]和读出数据寄存器[k-1:0]中，依次存储二个像素的存储器读出图像数据D0’和D1’、D2’和D3’、...、Dn-3’和Dn-2’、Dn-1’和Dn’。
在本实施例中，显示用存储器控制信号读的激活时序和显示用存储器控制信号写的激活时序互相以时钟信号CLK的一个周期错开。即，响应于激活状态的显示用存储器控制信号读，二个像素的存储器读出图像数据D0'和D1’从显示用存储器101的地址(0，0)、(0，1)被读出后，响应于激活状态的显示用存储器控制信号写，二个像素的存储器写入图像数据D0和D1从图像数据控制电路108的输入数据寄存器写入到地址(0，0)、(0，1)。二个像素的存储器读出图像数据D0’和D1’分别是二个像素的存储器写入图像数据D0和D1的前一帧的图像数据。同样，二个像素的存储器读出图像数据D2’和D3’从显示用存储器101的地址(0，2)、(0，3)被读出后，二个像素的存储器写入图像数据D2和D3被写入到地址(0，2)、(0，3)，二个像素的存储器读出图像数据Dn-1’和Dh’从显示用存储器101的地址(0，n-1)、(0，n)被读出后，被读出后，二个像素的存储器写入图像数据Dn-1和Dn被写入到地址(0，n-1)、(0，n)。
图像数据控制电路108具有判断输入图像数据和输入图像数据的前一帧的图像数据是否一致的检测电路(未图示)，并将判断结果作为不一致信号输出。当不一致时，不一致信号为高电平，当一致时则为低电平。
而在图2所示的时序图中表示了如下所示的例子：图像数据控制108的输入数据寄存器中保存的输入图像数据D2和读出数据寄存器中保存的前一帧的图像数据D2’是一致的，输入图像数据D7和前一帧的图像数据D7’是一致的，输入图像数据Dn-2和前一帧的图像数据Dn-2’是一致的，输入图像数据Dn-1和前一帧的图像数据D-1’是一致的(不一致信号为低电平)。查找表(LUT)109从输入图像数据和前一帧的图像数据中输出变换后图像数据。对于输入图像数据和前一帧的图像数据对(D0-D0’)、(D1-D1’)、(D2-D2’)、...、(Dn-1-Dn-1’)、(Dn-Dn’)，输出变换后图像数据D0_O、D1_O、...、Dn-1_O、Dn_O。查找表109以一个时钟周期进行动作。
传送数据控制电路110具有k比特×2的传送数据寄存器(未图示)，当不一致信号表示不一致时(高电平时)，将从查找表109输出  的变换后图像数据存储到传送数据寄存器中，当不一致信号表示一致时(低电平时)，将输入图像数据存储到传送数据寄存器中。并且，传送数据控制电路110内的传送数据寄存器的二个像素的k比特×2的图像数据，在来自存储器控制电路104的传送启动信号被激活时，通过被设定为接通状态的开关111而传送到锁存电路102。
在图2所示的例子中，传送数据控制电路110内的传送数据寄存器的高位比特[k×2-1:k]、低位比特[k-1:0]中，存储偶奇的图像数据D0_O、D1_O，从存储器控制电路104输出的传送启动信号为激活状态时，开关111接通，D0_O、D1_O被提供到锁存电路102。接着，传送数据寄存器的高位比特[k×2-1:k]、低位比特[k-1:0]中，存储偶奇的图像数据D2(输入图像数据)、D3_O(变换后的图像数据)，从存储器控制电路104输出的传送启动信号为激活状态时，开关111接通，D2、D3_O被提供到锁存电路102，同样，传送数据寄存器的高位比特[k×2-1:k]、低位比特[k-1:0]中，存储偶奇的图像数据Dn-1、Dn_O，从存储器控制电路104输出的传送启动信号为激活状态时，开关111接通，Dn-1、Dn_O被提供到锁存电路102。经由从存储器控制电路104提供到显示用存储器101的显示用存储器控制信号(显示用存储器读信号、显示用存储器写信号)不是激活状态时(即，在未进行对显示用存储器101的读出、写入的期间内)而被接通的开关111，来自传送数据控制电路110的两个像素的图像数据经由配线(数据总线)被传送到锁存电路102。在存储器控制电路104的控制下，在进行对显示用存储器101的读出或者写入时，开关111被设定为断开状态，传送数据控制电路110的输出和配线112切断。即，根据本实施例，利用查找表109进行的像素数据的变换动作与显示用存储器101的二个像素的图像数据的读出、写入动作是同时进行的，在不访问显示用存储器101的空隙，将变换像素数据传送到锁存电路102，并通过对应的锁存电路进行锁存。
图3是用于说明图1所示的图像数据控制电路108及传送数据控制电路110的构成的图。
参照图3，图像数据控制电路108具有输入数据寄存器1081、读出数据寄存器1082、由不一致的时候输出逻辑1的排他逻辑和构成的不一致检测电路1083、和开关1084。
输入数据寄存器1081将由存储器控制电路104提供的输入图像数据(k比特)以二个像素并列存储，作为存储器写入数据输出。并且，输入数据寄存器1081输出图像数据(k比特)。
读出数据寄存器1082输入从显示用存储器101读出的二个像素的存储器读出图像数据(存储在输入数据寄存器1081中的图像数据的前一帧的数据)，并依次输出图像数据(k比特)。开关1084在动画静止图像识别信号表示动画图像时导通。
不一致检测电路1083对来自开关1084的输入图像数据和、来自读出数据寄存器1082的读出图像数据(输入图像数据的前一帧的图像数据)进行比较，当一致时输出低电平，当不一致时输出高电平。
来自输入数据寄存器1081的输入图像数据(开关1084的输出)和、来自读出数据寄存器1082的读出图像数据(输入图像数据的前一帧的读出图像数据)被提供到查找表109。
当动画静止图像识别信号表示动画图像时，开关1084设置为接通，当表示静止图像时开关1084被断开。
传送数据控制电路110具有：选择器1101，将从查找表109输出的变换后图像数据(k比特)和来自输入数据寄存器1081的输入图像数据(k比特)(开关1084的输出)作为输入信号，将不一致信号作为选择控制信号输入；和传送数据寄存器1102，接收选择器1101的输出，保持二个像素的图像数据。
从传送数据寄存器1102输出的二个像素的图像数据(k比特×2)经由开关111从配线112提供到锁存电路102，该开关111在从存储器控制电路104输出的传送启动信号激活的期间为接通状态。
图4是以图1所示的本发明第一实施例的移位寄存器107的构成为中心的示意图。
参照图4，移位寄存器107具有：带复位功能的D型触发器FF0～FFm-1，其将来自时序控制电路105的移位信号共同输入到时钟输入端子，以纵态连接；双输入或电路OR0～ORm-1，与D型触发器FF0～FFm-1对应地设置，一个输入端子分别和D型触发器FF0～FFm-1的数据输出端子D连接，另一个输入端子将来自时序控制电路105的静止图像用锁存信号作为共同的输入信号。第一级的D型触发器FF0的数据输入端子D，输入来自时序控制电路105的动画用锁存信号(动画图像时为高电平)，例如，在移位信号上升沿，被D型触发器FF0采样并从其数据输出端子Q输出(触发器FF0的数据输出端子Q从低电平向高电平移动)，之后，在移位信号的上升沿，依次转送D型触发器FF1～FFm，D型触发器FF1～FFm-1的数据输出端子Q依次从低电平转换到高电平。
或电路OR0～ORm-1在静止图像用锁存信号为低电平(动画)时，分别将触发器FF0～FFm-1的输出传送到锁存电路102。
另一方面，当是静止图像的情况下，响应于从时序控制电路105输出的静止图像用锁存信号的从低电平向高电平的转换，锁存电路102锁存来自显示用存储器的一个线的图像数据。静止图像用锁存信号为高电平时，或电路OR0～ORm-1屏蔽D型触发器FF0～FFm-1。并且，在为静止图像时，来自时序控制电路105的动画用锁存信号为低电平。来自时序控制电路105的复位信号在动画时，在开始扫描一个线之前进行。
在存储器控制电路104的控制下，从显示用存储器101读出的二个像素的存储器读出图像数据(k比特×2)并列地被提供到图像数据控制电路108的读出数据寄存器1082(参照图3)。并且，在存储器控制电路104的控制下，从图像数据控制电路108的输入数据寄存器1081(参照图3)并列地被提供到显示用存储器101的二个像素的存储器写入图像数据(k比特×2)被写入到显示用存储器101的对应的地址。这种情况下，存储器写入图像数据写入到和之前读出的前一帧的图像数据相同的地址。向显示用存储器101进行读出、写入时，开关111被设置为断开状态。并且在图4所示的构成下，例如在显示用存储器101的锁存电路102一侧的附近设置输出端口，在和开关111相对的一侧附近设置输入端口，输出端口和输入端口连接到对应的配线(数据总线)112。
显示的帧图像为静止图像时，从显示用存储器101的输出端口，对应的线的一个线的图像数据并列地从配线112提供到锁存电路102，锁存电路102如上所述，在静止图像用锁存信号的上升沿，将从显示用存储器101的输出端口输出到H(＝2m)个配线112的图像数据信号(k比特)并列地进行锁存。
当为动画图像时，从传送数据控制电路110输出的二个像素的图像数据(k比特×2)通过以激活的传送启动信号被设定为接通状态的H个开关111并经由H个配线112共同地提供到锁存电路102(H个锁存电路)的输入端，在或电路的OR0的输出信号(锁存信号0)的上升沿，被和第一、第二数据线对应的二个锁存电路锁存。
接着，从传送数据控制电路110输出的二个像素的图像数据(k比特×2)通过以激活的传送启动信号被设定为接通状态的H个开关、并经由H个配线112共同地提供到锁存电路102(H个锁存电路)的输入端，在或电路的OR1的输出信号(锁存信号1)的上升沿，被和第三、第四数据线对应的二个锁存电路锁存。同样，通过和第H-1、第H个数据线对应的二个锁存电路，在或电路ORm-1的输出信号(锁存信号H/2)的上升沿，二个像素的图像数据被锁存。如上所述，在本实施例中，在动画图像显示(过驱动处理等)情况下，显示用存储器101的读出/写入动作也可以用多个像素(在本实施例中为二个像素)单位进行，像素的变换动作和向显示用存储器101的读出/写入动作同时进行，由于在不访问显示用存储器101时，将图像数据传送到锁存电路102，因此可以不用提高时钟速度而进行过驱动处理。
并且，在本发明的第一实施例中，显示的图像为动画图像时，对于最初的帧的图像，不存储前一帧的图像数据，因此其构成也可以是存储到显示用存储器101中，从显示用存储器101提供到锁存电路102。在本实施例中，将从传送数据控制电路110输出的图像数据提供到锁存电路102时，通过来自存储器控制电路104的传送启动信号，H个开关111全部同时为接通状态，但也可以不是H个全部接通，而只是作为传送对象(锁存到锁存电路的图像数据)的开关设置为接通状态(即，对传送启动信号进行移位)的构成。
对本发明的第一实施例的作用效果进行说明。根据本发明的第一实施例，向现在的图像数据的显示用存储器101的写入是在多个像素单位下进行的，因此可以对抑制显示用存储器101的访问次数的增加，同时可以抑制动画模糊。
并且，根据本发明的第一实施例，变换为过驱动用的图像数据传送到锁存电路102时，利用配线(数据总线)112，该配线用于将来自显示用存储器101的图像数据传送到锁存电路102，因此可以不增加配线数便实现过驱动。
进一步，根据本发明的第一实施例，根据从图像描绘装置(CPU)20输入到控制驱动器10的动画/静止图像识别信号，在静止图像显示时和动画图像显示时，通过对控制驱动器10的控制方式进行可变控制，可以在静止图像显示时及动画图像显示时选择最佳的驱动。
接着对本发明的第二实施例进行说明。图5是表示本发明的第二实施例的构成的示意图。此外在图5中，对于和图1相同或者同等的构成要素赋予相同的参照符号。以下对本发明的第二实施例和图1所示的上述第一实施例的不同点进行说明。
参照图5，本发明的第二实施例具有接收来自传送数据控制电路110A的输出并移位的数据移位电路114，图1的移位寄存器107被删除，在数据移位电路114的输出和数据传送用的配线112之间***开关111。本发明的第二实施例的构成是：传送数据控制电路110A输出k比特的图像数据(一个像素的数据)并提供到数据移位电路114，数据移位电路114接收来自存储器控制电路104A的移位信号，依次对输入的图像数据进行移位，在存储了一个线的阶段，存储器控制电路104A激活传送启动信号，将开关111设置为接通，从数据移位电路114并列输出的一个线(H个)的图像数据被提供到锁存电路102，构成锁存电路102的H个锁存电路通过来自时序控制电路105A的共同的锁存信号进行锁存，并被提供到数据线驱动电路103。即，在上述第一实施例中，当为动画图像时，锁存电路102提供的锁存信号在移位寄存器移位并输出，而在本实施例中，其构成是共同的锁存信号被提供到锁存电路102的H个锁存电路。
图6是用于说明图5所示的本发明的第二实施例的动作的时序图。CLK、地址、输入图像数据和图2中的一样。
存储器控制电路104A和上述第一实施例一样，作为显示用存储器控制信号将读和写以二个时钟周期输出。在本实施例中，存储器控制电路104A输出移位信号、传送启动信号。时序控制电路105A对H个锁存电路输出共同的锁存信号。
图像数据控制电路108、查找表109和图2进行同样的动作。
传送数据控制电路110将k比特的传送数据提供到数据移位电路114，数据移位电路114将输入的传送数据(图像数据)根据从存储器控制电路104A提供的移位信号依次移位，存储一个线的图像数据。
并且在图6所示的例子中，由于输入图像数据D2和前一帧的存储器读出图像数据D2’是相同的，因此不一致信号为低电平，从传送数据控制电路110A输出输入图像数据D2。
图7是本发明的第二实施例的图像数据控制电路108、传送数据控制电路110A的构成的示意图。如图7所示，图像数据控制电路108和图3所示的上述第一实施例为相同的构成。
另一方面，传送数据控制电路110A和图3所示的上述第一实施例不同，只具有选择器1101。即，选择器1101将来自图像数据控制电路108的不一致信号作为选择控制信号接收，当不一致信号表示不一致时，选择查找表109的输出(变换后图像数据)并提供到数据移位电路114，当不一致信号表示不一致时，选择来自开关1084的图像数据并提供到数据移位电路114。
图8是以本发明的第二实施例的数据移位电路114的构成为中心的具体构成图。参照图8，数据移位电路114由H级级联连接的触发器DF1～DFH构成，通过移位信号，来自传送数据控制电路110A的图像数据从初级触发器DF1开始依次传送。应提供到第一数据线的锁存电路的图像数据通过从触发器DF1输入的H个移位信号，到达触发器DFH。此时，触发器DF1中，应提供到第H数据线的锁存电路的图像数据被采样。
在本发明的第二实施例中，也和上述第一实施例一样具有相同的效果。
接着对本发明的第三实施例进行说明。图9是本发明的第三实施例的构成的示意图。参照图9，本发明的第三实施例具有存储一个线的图像数据的线存储器115，以此取代上述第二实施例中的数据移位电路。除此之外的构成和上述第二实施例大致相同，但不同点是：存储器控制单元104B生成并输出线存储器115的访问地址(线存储器地址)；以及，向传送数据控制电路110B提供传送数据切换信号。传送数据控制电路110B接收来自存储器控制单元104B的传送数据切换信号并进行动作。在本发明的第三实施例中，通过和来自图像描绘装置20的输入图像数据同时被传送的地址数据，存储器控制电路104B生成传送数据切换信号。即，在从图像描绘装置20传送的输入图像数据之外(传送数据切换信号表示非激活状态时)，进行以下控制：通过前一帧的图像数据，置换并输出该输入图像数据。
图10是本发明的第三实施例的动作的时序图。CLK是驱动用时钟。地址是存储一个线的输入图像数据的地址。在图10所示的示例中，在时钟周期t0、t1、t4、t5、tn-1下，来自图像描绘装置20的输入图像数据D0、D1、D4、D7、Dn-1被提供到控制驱动器10B，在时钟周期t2、t3、t5、t6、t8、t9、tn下，不提供输入图像数据，传送数据切换信号为低电平。并且，在传送数据切换信号为高电平时传送的输入图像数据D0、D1、D4、D7、Dn-1是应该写入到显示用存储器101的地址(0，0)、(0，1)、(0，4)、(0，7)、(0，n-1)的数据。
存储器控制电路104B，作为显示用存储器控制信号，将2时钟周期的读、写信号以二个时钟周期相位错开输出。并且，存储器控制电路104B将传送切换信号提供到传送数据控制电路110B。
传送数据切换信号为高电平时，传送数据控制电路110B将来自查找表109的变换后图像数据或者来自图像数据控制电路108的输入图像数据根据不一致信号进行选择，以一个像素的图像数据单位输出到线存储器115。当传送数据切换信号为低电平时，传送数据控制电路110B将由图像数据控制电路108提供的存储器读出图像数据输出到线存储器115。
存储器控制电路104B将线存储器写信号、线存储器地址提供到线存储器，并将传送启动信号提供到开关111，并控制从线存储器115输出的图像数据向锁存电路102的传送。
作为对应来自存储器控制电路104B的激活的显示用存储器的读信号的读出地址，以二个像素的图像数据依次输出地址[(0，0)、(0，1)]、[(0，2)、(0，3)]、[(0，4)、(0，5)]、[(0，6)、(0，7)]、[(0，8)、(0，9)]、...、[(0，n-3)、(0，n-2)]、[(0，n-1)、(0，n)]。当传送数据切换信号为高电平时，向进行了二个像素的图像数据的读出的地址，写入从图像数据控制电路108传送的二个像素的存储器写入图像数据。另一方面，当传送数据切换信号为低电平时，由于来自图像描绘装置20的输入图像数据不提供到控制驱动器10B，因此显示用存储器写信号不输出。并且，当传送数据切换信号为高电平时，存储器控制电路104B输出和输入图像数据对应的显示用存储器地址(0，4)、(0，7)、(0，n-1)，输入图像数据D4、D7、Dn-1分别按各个像素写入到对应的地址。
在图像数据控制电路108中，读出数据寄存器[2k-1:k]、[k-1:0]中，以每二个时钟周期依次存储D0’、D1’、D2’、D3’的读出图像数据。当传送数据切换信号为高电平时，对保存在输入数据寄存器[2k-1:k]中的输入图像数据D0、和保存在读出数据寄存器[2k-1:k]中的前一帧的读出图像数据D0’进行比较，此时由于是一致的(不一致信号为低电平)，输入图像数据D0从传送数据控制电路110B作为k比特的传送数据被提供到线存储器115，并写入到线存储器115的地址(0，0)。
在下一个时钟周期，比较保存在输入数据寄存器[k-1:0]的输入图像数据D1及保存在读出数据寄存器[k-1:0]前一帧的读出数据D1’，此时由于是不一致的，因此从传送数据控制电路110B选择变换后图像数据D10，作为k比特的传送数据提供到线存储器115，并写入到线存储器115的地址(0，1)。
接着，在周期t2，传送数据切换信号变为低电平，传送数据控制电路110B将读出数据寄存器[2×k-1:k]、[k-1:0]的读出数据D2’、D3’依次作为k比特的传送数据传送到线存储器115，并分别写入到线存储器115的地址(0，2)，(0，3)(周期t2，t3)。此时，输入数据寄存器[2×k-1:k]、[k-1:0]分别保存前一值D0、D1。
接着，在周期t4，传送数据切换信号再次变为高电平。来自图像描绘装置20的输入图像数据D4存储在图像数据控制电路108的输入数据寄存器[2×k-1:k]中，比较输入图像数据D4和保存在读出数据寄存器[2×k-1:k]中的前一帧的读出数据D4’，此时，由于不一致信号为低电平(输入图像数据和前一帧的图像数据一致)，因此传送数据控制电路110B将输入图像数据D4作为传送数据输出，写入到线存储器115的地址(0，4)。
接着，在周期t5，由于传送数据切换信号变为低电平，输入图像数据不由图像描绘装置20提供，在图像数据控制电路108的输入数据寄存器[2×k-1:k]、[k-1:0]中，前一数据D4、D1分别原样保存，传送数据控制电路110B将图像数据控制电路108的读出数据寄存器[k-1:0]的读出图像数据D5’作为传送数据输出，写入到线存储器115的地址(0，5)。之后的地址也一样，当传送数据切换信号为低电平时，将保存在图像数据控制电路108的读出数据寄存器的前一帧的读出图像数据提供到线存储器115，当传送数据切换信号为高电平时，将变换后图像数据或者输入图像数据提供到线存储器115。
图11是本发明的第三实施例中的图像数据控制电路108、查找表109、传送数据控制电路110B的构成示意图。
参照图11，图像数据控制电路108和图7所示的构成是相同的。传送数据控制电路110B具有：第一选择器1101，输入查找表109的输出、及来自开关1084的输入图像数据，将不一致信号作为选择控制信号输入；第二选择器1103，输入第一选择器1101的输出、及来自读出数据寄存器1082的读出图像数据，将传送数据切换信号作为选择控制信号输入。当传送数据切换信号为逻辑0(低电平)时，第二选择器1103选择输出来自读出数据寄存器1082的读出图像数据。
图12是本发明第三实施例的线存储器的***构成示意图。从传送数据控制电路110B输出的k比特的图像数据被写入到和一个线的线存储器115对应的地址，在写入一个线的阶段，开关111通过来自存储器控制电路104B的被激活的传送启动信号而接通，来自线存储器115的一个线的图像数据在配线112上传送，分别被提供到锁存电路102(H个锁存电路)的输入端子。时序控制电路105A将共同的锁存信号提供到锁存电路102(H个锁存电路)，通过数据线驱动电路103，数据线以和数据信号对应的灰度级电压被驱动，通过选通信号STB，显示选择栅极线的线。
接着对本发明的第四实施例进行说明。图13是本发明的第四实施例的构成示意图。参照图13，本实施例在进行读出图像数据k比特和输入图像数据k比特的一致性检测时，通过不一致检测电路1083A对k比特中的高位n比特之间是否一致进行判断。
查找表109A输入读出图像数据的高位n比特和输入图像数据的高位n比特，并根据这些高位n比特，输出n比特的变换后图像数据。
并且，在连接处理电路1104中，进行从查找表109A输出的n比特的变换后图像数据和输入图像数据的低位k-n比特的连接处理，生成k比特的变换后图像数据，提供到选择器1101。
在选择器1101中，当来自不一致检测电路1083A的不一致信号表示不一致时，选择输出来自连接处理电路1104的变换后图像数据，当表示一致时，选择输出输入图像数据。
在本实施例中，不一致检测电路1083A检测n比特的一致/不一致，查找表109A输入各n比特的二个像素的信号，输出n比特的信号。
根据本实施例，对过驱动的有无不是通过图像数据的全部比特，是通过高位比特的变化进行判断。根据上述构成的本实施例，通过减少比较比特的数量，可以大幅减小查找表的电路规模。
接着对本发明的第五实施例进行说明。图14是本发明的第五实施例的构成示意图。在图14中，对于和图13所示的构成相同或者同等的要素标以相同的参照符号。以下仅对和上述第四实施例的不同点进行说明。如图14所示，查找表109B的构成也可以是：输入读出图像数据的高位n比特和输入图像数据的高位n比特，并根据这些高位n比特，输出k比特的变换后图像数据。此时，不需要图13中的连接处理电路1104。
在上述各实施例中，对过驱动进行了说明，上述构成也可以适用于γ校正等。对这种情况下的动作参照图1进行简要说明。从显示用存储器101并列地读出多个像素，通过查找表109进行γ校正后，通过作为显示用存储器101用的数据传送路径的数据总线112，将图像数据传送到锁存电路102，从数据线驱动电路103驱动显示单元30的数据线并显示。图像数据传送到锁存电路102的方法除了上述第一实施例外，可以应用第二到第三实施例中的任意一个。原来的图像数据留在显示用存储器101中。并且，在图1、图5、图9所示的构成中，控制驱动器10的构成也可以是含有栅极线驱动电路31的构成。
在上述各实施例中，如图1等所示，在图像数据控制电路108内，判断输入图像数据和前一帧的图像数据是否不一致，将作为判断结果的不一致信号提供到传送数据控制电路110，在传送数据控制电路110中，根据该不一致信号，选择输出输入图像数据和来自查找表109的变换后图像数据中的其中一个，但作为变形例也可以是如下构成：在查找表109中提前设定输入图像数据和前一帧的图像数据一致时的图像数据，从而无需不一致检测电路(图3中的1083)和选择器(图3中的1101)。这种情况下，例如在图3中，从查找表109输出的变换后图像数据(k比特)被提供到传送数据寄存器1102，从传送数据寄存器1102通过接通状态的开关111传送到配线(数据总线)112，并提供到锁存电路102(参照图1)。并且，例如在图7所示的构成中，无需不一致检测电路1083及选择器1101，从查找表109输出的变换后图像数据(k比特)被输入到数据移位电路114。此外，在图11所示的构成中，不需要不一致检测电路1083及选择器1101，从查找表109输出的变换后图像数据(k比特)被输入到选择器1103。并且在图13所示的构成中，无需不一致检测电路1083A及选择器1101，从查找表109A输出的变换后图像数据(k比特)通过连接处理电路1104输入到数据移位电路114。同样，在图14所示的构成中，无需不一致检测电路1083A及选择器1101，从查找表109B输出的变换后图像数据(k比特)被输入到数据移位电路114。
以上通过上述实施例对本发明进行了说明，但本发明并不仅限于上述构成，本领域技术人员在本发明的范围内可获得的各种变形、修改也属于本发明的范围之内。

Claims (27)

1.一种控制驱动器，其特征在于，具有：
显示用存储器，至少存储一个帧的图像数据；
存储器控制电路，进行以下控制：接收由图像描绘装置提供的输入图像数据，从上述显示用存储器读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；
变换电路，输入上述输入图像数据和上述前一帧的读出图像数据，输出根据上述输入图像数据和上述前一帧的读出图像数据所确定的变换后图像数据；
比较电路，比较上述输入图像数据和上述前一帧的读出图像数据；
传送数据控制电路，根据上述输入图像数据和上述前一帧的读出图像数据的比较结果，判断输出上述变换电路的上述变换后图像数据或者上述输入图像数据中的哪一个，并输出上述变换后图像数据或者上述输入图像中的一方的图像数据；
多个锁存电路，将从上述传送数据控制电路输出的图像数据直接、或者通过预定的电路间接接收，并响应于输入的锁存信号进行锁存；以及
多个驱动电路，将从上述多个锁存电路分别输出的图像数据作为输入而接收，分别输出和上述图像数据对应的输出信号。
2.根据权利要求1所述的控制驱动器，其特征在于：
具有：第一寄存器，从上述存储器控制电路接收上述输入图像数据并保存；
第二寄存器，保存从上述显示用存储器读出的、上述输入图像数据的前一帧的读出图像数据；
其中，保存在上述第一寄存器中的上述输入图像数据，在上述存储器控制电路的控制下，作为写入到上述显示用存储器的写入图像数据而提供到上述显示用存储器中，
并具有：判断电路，将保存在上述第一寄存器中的上述输入图像数据和保存在上述第二寄存器中的上述前一帧读出图像数据作为输入而接收，并判断其是否互相一致；
上述变换电路，将上述第一寄存器的上述输入图像数据和上述第二寄存器的上述前一帧读出图像数据作为输入而接收，输出根据上述输入图像数据和上述前一帧读出图像数据所确定的变换后图像数据；
上述传送数据控制电路，将从上述变换电路输出的上述变换后图像数据和上述第一寄存器的上述输入图像数据作为输入而接收，并将上述判断电路的判断结果作为输入，当上述判断结果表示一致时，输出上述输入图像数据，当上述判断结果表示不一致时，输出来自上述变换电路的变换后图像数据；
上述多个锁存电路，将从上述传送数据控制电路输出的图像数据直接、或者通过预定的电路间接接收，并响应于输入的锁存信号进行锁存；
上述多个驱动电路，是接收从上述多个锁存电路输出的图像数据并分别驱动显示单元的数据线的多个数据线驱动电路。
3.根据权利要求1所述的控制驱动器，其特征在于：
从上述传送数据控制电路输出的上述变换后图像数据或者上述输入图像数据中的一方的图像数据通过数据传送线提供到上述多个锁存电路，
并具有移位电路，生成锁存信号，以便通过上述多个锁存电路中和上述图像数据对应的锁存电路来锁存上述图像数据，并将上述生成的锁存信号提供到对应的锁存电路。
4.根据权利要求1所述的控制驱动器，其特征在于：
具有移位寄存器，在上述传送数据控制电路和上述多个锁存电路之间，接收从上述传送数据控制电路输出的上述变换后图像数据或者上述输入图像数据中的一方的图像数据，并依次移位，且存储一个线的像素的图像数据，
从上述移位寄存器并行输出的一个线的图像数据通过数据传送线由上述多个锁存电路锁存。
5.根据权利要求1所述的控制驱动器，其特征在于：
具有线存储器，在上述传送数据控制电路和上述多个锁存电路之间，接收从上述传送数据控制电路输出的上述变换后图像数据或者上述输入图像数据中的一方的图像数据，并写入到对应的地址，且存储一个线的图像的图像数据。
6.根据权利要求3所述的控制驱动器，其特征在于：作为传送上述变换后图像数据或者上述输入图像数据中的一方的图像数据的上述数据传送线，使用用于将来自上述显示用存储器的图像数据传送到上述锁存电路的显示用存储器用的数据总线。
7.根据权利要求3所述的控制驱动器，其特征在于：上述存储器控制电路在除了向上述显示用存储器进行读出和写入的期间外，以规定的时序进行切换控制，使来自上述显示用存储器的图像数据传送到上述多个锁存电路的显示用存储器用的数据总线，用作用于传送上述变换后图像数据或者上述输入图像数据中的一方的图像数据的上述数据传送用总线。
8.根据权利要求2所述的控制驱动器，其特征在于：
输入从上述图像描绘装置提供的控制信号，当上述控制信号表示第一值时，上述传送数据控制电路和上述多个锁存电路间的连接保持为断开状态，上述输入图像数据从上述第一寄存器写入到上述显示用存储器中，从上述显示用存储器输出的多个像素的图像数据通过数据传送线从上述显示用存储器提供到上述多个锁存电路，接收从上述多个锁存电路分别输出的图像数据的上述多个数据线驱动电路驱动数据线，
当上述控制信号表示第二值时，从上述图像描绘装置提供的输入图像数据保存在上述第一寄存器中，从上述显示用存储器读出上述输入图像数据的前一帧的图像数据，上述前一帧的读出图像数据被保存在上述第二寄存器中，
并进行以下控制：保存在上述第一寄存器中的上述输入图像数据作为写入到上述显示用存储器的图像数据，和上述前一帧的读出图像数据的读出时序在时间上错开，写入到和从上述显示用存储器读出的上述前一帧的读出图像数据相同的地址中，
根据上述判断电路中的一致或不一致的判断，从上述传送数据控制电路输出上述输入图像数据或者上述变换后图像数据，
上述传送数据控制电路的输出和上述多个锁存电路间的连接被控制接通、断开，从上述传送数据控制电路输出的图像数据通过上述数据传送线被传送到多个锁存电路，接收从上述锁存电路输出的图像数据的上述数据线驱动电路驱动数据线。
9.根据权利要求2所述的控制驱动器，其特征在于：
上述第一寄存器保存从上述图像描绘装置提供的多个像素的输入图像数据，
在上述存储器控制电路的控制下，对于上述显示用存储器，从上述第一寄存器中多个像素的输入图像数据被并行地传送，作为多个像素的写入图像数据写入到上述显示用存储器，
在上述存储器控制电路的控制下，从上述显示用存储器读出的多个像素的读出图像数据并行地传送并存储到上述第二寄存器中，
从上述显示用存储器读出上述多个像素的读出图像数据的读出时序和、写入到上述显示用存储器的上述多个像素的写入图像数据的写入时序，至少在时间上互相错开上述输入图像数据的一个周期。
10.根据权利要求2所述的控制驱动器，其特征在于：
上述判断电路判断上述输入图像数据的预定的高位比特和上述第二寄存器的上述前一帧的读出图像数据的预定的高位比特是否互相一致，
上述变换电路将上述输入图像数据的预定的高位比特和上述前一帧的读出图像数据的预定的高位比特作为输入而接收，输出根据上述输入图像数据的预定的高位比特和上述前一帧的读出图像数据的预定的高位比特所确定的变换后图像数据的预定的高位比特或者全部比特。
11.一种控制驱动器，具有至少存储一个帧的图像数据的显示用存储器，并设置在图像描绘装置和显示单元之间，其特征在于，具有：
存储器控制电路，进行以下控制：接收由上述图像描绘装置提供的输入图像数据，从上述显示用存储器中读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；
图像数据控制电路，输入上述输入图像数据和从上述显示用存储器读出的上述前一帧的读出图像数据，判断上述输入图像数据和上述读出图像数据是否一致；
变换电路，根据上述输入图像数据和上述前一帧的读出图像数据，输出变换后图像数据；
传送数据控制电路，根据上述图像数据控制电路的判断结果，当上述输入图像数据和上述前一帧的读出图像数据一致时，输出上述输入图像数据，当不一致时，输出上述变换后图像数据；
多个锁存电路，通过开关与上述传送数据控制电路的输出端连接；
移位电路，对上述多个锁存电路分别生成锁存信号并提供；以及
多个数据线驱动电路，接收来自上述多个锁存电路的输出，分别驱动对应的数据线。
12.一种控制驱动器，具有至少存储一个帧的图像数据的显示用存储器，并设置在图像描绘装置和显示单元之间，其特征在于，具有：
存储器控制电路，进行以下控制：接收由上述图像描绘装置提供的输入图像数据，从上述显示用存储器中读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；
图像数据控制电路，输入上述输入图像数据和从上述显示用存储器读出的上述前一帧的读出图像数据，判断上述输入图像数据和上述读出图像数据是否一致；
变换电路，根据上述输入图像数据和上述前一帧的读出图像数据，输出变换后图像数据；
传送数据控制电路，根据上述图像数据控制电路的判断结果，当上述输入图像数据和上述前一帧的读出图像数据一致时，输出上述输入图像数据，当不一致时，输出上述变换后图像数据；
数据移位电路，将从上述传送数据控制电路输出的图像数据依次移位，最多保存一个线的多个像素的图像数据；
多个锁存电路，通过开关与上述数据移位电路的输出端连接，当上述开关为接通时，分别接收来自上述数据移位电路的多个像素的图像数据，并响应于共同的锁存信号进行锁存；以及
多个数据线驱动电路，接收来自上述多个锁存电路的输出，分别驱动对应的数据线。
13.一种控制驱动器，具有至少存储一个帧的图像数据的显示用存储器，并设置在图像描绘装置和显示单元之间，其特征在于，具有：
存储器控制电路，进行以下控制：接收由上述图像描绘装置提供的输入图像数据，从上述显示用存储器中读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；
图像数据控制电路，输入上述输入图像数据和从上述显示用存储器读出的上述前一帧的读出图像数据，判断上述输入图像数据和上述读出图像数据是否一致；
变换电路，根据上述输入图像数据和上述前一帧的读出图像数据，输出变换后图像数据；
传送数据控制电路，根据上述图像数据控制电路的判断结果，当上述输入图像数据和上述前一帧的读出图像数据一致时，输出上述输入图像数据，当不一致时，输出上述变换后图像数据；
存储器电路，将从上述传送数据控制电路输出的图像数据存储到对应的地址中，最多存储一个线的多个像素的数据；
多个锁存电路，通过开关与上述存储器电路的输出端连接，当上述开关为接通时，分别接收来自上述存储器电路的多个像素的图像数据，并响应于共同的锁存信号进行锁存；以及
数据线驱动电路，接收来自上述多个锁存电路的输出，分别驱动对应的数据线。
14.根据权利要求11所述的控制驱动器，其特征在于：
从上述图像描绘装置输入动画静止图像识别信号，当上述动画静止图像识别信号表示静止图像时，上述开关被设为断开状态，将上述输入图像数据作为写入数据写入到上述显示用存储器，接收从上述显示用存储器输出的一个线的图像数据的上述多个锁存电路响应于共同的锁存信号进行锁存，并提供到上述多个数据线驱动电路，
另一方面，当上述动画静止图像识别信号表示动画图像时，在上述图像数据控制电路中，判断上述输入图像数据和上述输入图像数据的前一帧的读出图像数据是否一致，从上述传送数据控制电路输出的变换后图像数据或者输入图像数据通过被设定为接通状态的上述开关，提供到对应的上述锁存电路的输入，上述锁存电路的输出提供到对应的上述数据线驱动电路。
15.根据权利要求11所述的控制驱动器，其特征在于，
上述图像数据控制电路具有：输入数据寄存器，至少存储一个由上述图像描绘装置提供的上述输入图像数据，并作为写入图像数据提供到上述显示用存储器；
读出数据寄存器，至少存储一个从上述显示用存储器读出的读出图像数据；
控制开关，输入端连接到上述输入数据寄存器的输出端，当由上述图像描绘装置提供的动画静止图像识别信号表示动画图像时，被设定为接通状态；和
判断电路，一个输入端连接到上述控制开关的输出端，其他输入端连接到上述读出数据寄存器，判断上述输入图像数据和上述输入图像数据的前一帧的读出图像数据是否互相一致，并输出判断结果信号，
其中，上述变换电路输入从上述控制开关的输出端输出的上述输入图像数据和来自上述读出数据寄存器的上述前一帧的读出图像数据，并输出上述变换后图像数据，
上述传送数据控制电路具有：选择器，将从上述变换电路输出的上述变换后图像数据和来自上述控制开关的输出端的输入图像数据作为输入，当上述判断结果信号表示不一致时，选择上述变换后图像数据输出，当上述判断结果信号表示一致时，输出上述输入图像数据；和
传送数据寄存器，接收上述选择器的输出，输出并保存传送到上述锁存电路的图像数据。
16.根据权利要求12所述的控制驱动器，其特征在于，
上述图像数据控制电路具有：输入数据寄存器，至少存储一个由上述图像描绘装置提供的上述输入图像数据，并作为写入图像数据提供到上述显示用存储器；
读出数据寄存器，至少存储一个从上述显示用存储器读出的读出图像数据；
控制开关，输入端连接到上述输入数据寄存器的输出端，当由上述图像描绘装置提供的动画静止图像识别信号表示动画图像时，被设定为接通状态；和
判断电路，一个输入端连接到上述控制开关的输出端，其他输入端连接到上述读出数据寄存器，判断上述输入图像数据和上述输入图像数据的前一帧的读出图像数据是否互相一致，并输出判断结果信号，
其中，上述变换电路输入从上述控制开关的输出端输出的上述输入图像数据和来自上述读出数据寄存器的上述前一帧的读出图像数据，并输出上述变换后图像数据，
上述传送数据控制电路具有：选择器，将从上述变换电路输出的上述变换后图像数据和来自上述控制开关的输出端的输入图像数据作为输入，当上述判断结果信号表示不一致时，选择上述变换后图像数据输出，当上述判断结果信号表示一致时，输出上述输入图像数据，
其中，上述选择器的输出提供到上述数据移位电路。
17.根据权利要求13所述的控制驱动器，其特征在于，
上述图像数据控制电路具有：输入数据寄存器，至少存储一个由上述图像描绘装置提供的上述输入图像数据，并作为写入图像数据提供到上述显示用存储器；
读出数据寄存器，至少存储一个从上述显示用存储器读出的读出图像数据；
控制开关，输入端连接到上述输入数据寄存器的输出端，当由上述图像描绘装置提供的动画静止图像识别信号表示动画图像时，被设定为接通状态；
判断电路，一个输入端连接到上述控制开关的输出端，其他输入端连接到上述读出数据寄存器，判断上述输入图像数据和上述输入图像数据的前一帧的读出图像数据是否一致，并输出判断结果信号，
其中，上述变换电路输入从上述控制开关的输出端输出的上述输入图像数据和来自上述读出数据寄存器的上述前一帧的读出图像数据，并输出上述变换后图像数据，
上述传送数据控制电路具有：第一选择器，将从上述变换电路输出的上述变换后图像数据和来自上述控制开关的输出端的输入图像数据作为输入，当上述判断结果信号表示不一致时，选择上述变换后图像数据输出，当上述判断结果信号表示一致时，输出上述输入图像数据；和
第二选择器，接收上述第一选择器的输出和来自上述读出数据寄存器的读出图像数据，根据与来自上述图像描绘装置的上述输入图像数据同时被传送的地址数据，当上述存储器控制电路生成的传送数据切换信号为激活状态时，选择上述第一选择器的输出，当上述传送数据切换信号为非激活状态时，选择并输出来自上述读出数据寄存器的读出图像数据，
其中，上述第二选择器的输出提供到上述存储器电路。
18.根据权利要求11所述的控制驱动器，其特征在于：
上述图像数据控制电路具有：输入数据寄存器，至少存储一个由上述图像描绘装置提供的上述输入图像数据，并作为写入图像数据提供到上述显示用存储器；
读出数据寄存器，至少存储一个从上述显示用存储器读出的读出图像数据；
控制开关，输入端连接到上述输入数据寄存器的输出端，当由上述图像描绘装置提供的动画静止图像识别信号表示动画图像时，被设定为接通状态；和
判断电路，一个输入端连接到上述控制开关的输出端，其他输入端连接到上述读出数据寄存器，判断输入图像数据(k比特)的高位n比特(n是比k小的预定的正整数)和读出图像数据的高位n比特是否一致，并输出判断结果信号，
其中，上述变换电路输入从上述控制开关的输出端输出的输入图像的高位n比特和来自上述读出数据寄存器的读出图像数据的高位n比特，并输出对应的上述变换后图像数据的高位n比特，
上述传送数据控制电路具有：连接电路，连接从上述变换电路输出的上述变换后图像数据的高位n比特和上述输入图像数据的低位(k-n)比特，生成k比特的变换后图像数据；和
选择器，输入从上述连接电路输出的图像数据和从上述控制开关输出的上述输入图像数据，当上述判断结果信号表示不一致时，选择并输出从上述连接电路输出的变换后图像数据，当上述判断结果信号表示一致时，输出上述输入图像数据。
19.根据权利要求11所述的控制驱动器，其特征在于：
上述图像数据控制电路具有：输入数据寄存器，至少存储一个由上述图像描绘装置提供的上述输入图像数据，并作为写入图像数据提供到上述显示用存储器；
读出数据寄存器，至少存储一个从上述显示用存储器读出的读出图像数据；
控制开关，输入端连接到上述输入数据寄存器的输出端，当由上述图像描绘装置提供的动画静止图像识别信号表示动画图像时，被设定为接通状态；和
判断电路，一个输入端连接到上述控制开关的输出端，其他输入端连接到上述读出数据寄存器，判断输入图像数据(k比特)的高位n比特(n是比k小的预定的正整数)和读出图像数据的高位n比特是否一致，并输出判断结果信号，
其中，上述变换电路输入从上述控制开关的输出端输出的输入图像的高位n比特和来自上述读出数据寄存器的读出图像数据的高位n比特，并输出k比特的上述变换后图像数据，
并具有选择器，输入上述变换后图像数据和从上述控制开关输出的上述输入图像数据，当上述判断结果信号表示不一致时，选择并输出上述变换后图像数据，当上述判断结果信号表示一致时，输出上述输入图像数据。
20.根据权利要求11所述的控制驱动器，其特征在于：
具有时序控制电路，
上述移位电路具有：移位寄存器，由触发器级联连接而成，将从上述时序控制电路输出的动画图像用锁存信号接收到第一级，根据从上述时序控制电路输入的移位信号，依次传送上述动画图像用锁存信号；和
多个逻辑门，其分别接收上述各级触发器的输出和来自上述时序控制电路的静止图像用锁存信号，当上述静止图像用锁存信号为非激活状态时，输出上述触发器，当上述静止图像用锁存信号为激活状态时，输出上述静止图像用锁存信号，
其中，从上述多个逻辑门的输出，锁存信号被提供到上述多个锁存电路。
21.根据权利要求11所述的控制驱动器，其特征在于：
多个写入图像数据以将一个像素的图像数据的传送单位的时钟的频率分频的频率被传送到上述显示用存储器，
当为动画图像时，多个像素的图像数据的读出和多个像素的图像数据的写入错开时间交互进行，在上述显示用存储器中，一个像素的写入图像数据被写入到和上述一个像素的写入图像数据的前一帧像素的读出图像数据相同的地址中。
22.一种控制驱动器，其特征在于，具有：
显示用存储器，至少存储一个帧的图像数据；
存储器控制电路，进行以下控制：接收由图像描绘装置提供的输入图像数据，从上述显示用存储器读出上述输入图像数据的前一帧的图像数据，并且将上述输入图像数据作为写入图像数据写入到上述显示用存储器；
变换电路，输入上述输入图像数据和上述前一帧的读出图像数据，输出根据上述输入图像数据和上述前一帧读出图像数据所确定的变换后图像数据；
多个锁存电路，将从上述变换电路输出的变换后图像数据直接、或者通过预定的电路间接接收，并响应于输入的锁存信号进行锁存；以及
多个驱动电路，将从上述多个锁存电路分别输出的图像数据作为输入而接收，分别输出和上述图像数据对应的输出信号。
23.根据权利要求1所述的控制驱动器，其特征在于：作为上述变换后图像数据，上述变换电路输出用于过驱动的图像数据。
24.根据权利要求1所述的控制驱动器，其特征在于：作为上述变换后图像数据，上述变换电路输出灰度校正用的图像数据。
25.一种半导体装置，在半导体基板上具有权利要求1所述的上述控制驱动器。
26.一种显示装置，具有权利要求1所述的上述控制驱动器和上述显示单元。
27.一种控制驱动器，利用帧存储器和查找表进行响应时间的补偿，其特征在于：
包括控制电路、锁存电路和数据线驱动电路，
上述控制电路，当处于响应时间补偿模式时，将输入数据和来自上述帧存储器的前一帧的数据输入到上述查找表，根据上述输入数据和上述前一帧的数据的比较结果，当需要对上述输入数据进行响应时间的补偿时，输出来自上述查找表的数据，来自上述控制电路的输出数据被对应的上述锁存电路锁存，接收从上述锁存电路输出的数据的上述数据线驱动电路输出和上述数据对应的信号，
当不处于上述响应时间补偿模式时，上述控制电路的输出从上述锁存电路切断，从上述帧存储器输出的数据被对应的上述锁存电路锁存，接收从上述锁存电路输出的数据的上述数据线驱动电路输出和上述数据对应的信号，通过具有一个帧存储器可进行响应时间的补偿。
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