CN117859170A - 像素驱动方法、像素驱动电路和显示装置 - Google Patents

像素驱动方法、像素驱动电路和显示装置 Download PDF

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Abstract

本公开提供了一种像素驱动方法及电路、显示装置。像素驱动方法包括：接收图像数据；基于图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号；响应于第一使能信号有效，以第一显示模式驱动目标像素，在第一显示模式中，以第一频率更新数据电压信号，并为目标像素提供数据电压信号，使得目标像素的驱动电压被确定为数据电压信号和公共电压信号之间的电压差；响应于第二使能信号有效，以第二显示模式驱动目标像素，在第二显示模式中，以第二频率更新所述数据电压信号，根据用于目标像素的像素数据调整数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压或最小驱动电压，第二频率低于所述第一频率。

Description

像素驱动方法、像素驱动电路和显示装置 技术领域
本公开涉及显示技术领域，具体地，涉及一种像素驱动方法、像素驱动电路和显示装置。
背景技术
对于一些使用电池供电的计算设备而言，例如可穿戴设备、移动电话、平板电脑等，一般需要通过充电或更换电池来维持续航，因此，针对这类设备，通常存在降低功耗、延长续航时间的需求。特别地，针对诸如智能手表等可穿戴设备，由于设备体积较小，难以承载大容量电池，因此，这些设备在功耗控制方面往往存在更为迫切的需求。
发明内容
有鉴于此，本公开提供了一种像素驱动方法、像素驱动电路、显示装置和计算设备，可以缓解、减轻或甚至消除上述问题。
根据本公开的一方面，提供了一种像素驱动方法，包括：接收图像数据，图像数据包括用于至少一个像素的像素数据；基于图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号；响应于第一使能信号有效，以第一显示模式驱动目标像素，在第一显示模式中，以第一频率更新数据电压信号，并为目标像素提供数据电压信号，使得目标像素的驱动电压被确定为数据电压信号和公共电压信号之间的电压差，其中，公共电压信号为所有像素共用的基准电压信号；响应于第二使能信号有效，以第二显示模式驱动目标像素，在第二显示模式中，以第二频率更新数据电压信号，根据用于目标像素的像素数据调整数据电压信号，并为目标像素提供调整后的数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压或最小驱动电压，其中，第二频率低于第一频率。
在一些实施例中，用于目标像素的像素数据包括至少一个有效数据位，并且其中，根据用于目标像素的像素数据调整数据电压信号，并为目标像素提供调整后的数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压或最小驱动电压包括：响应于至少一个有效数 据位中的最高有效数据位为第一值，调整数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压；响应于至少一个有效数据位中的最高有效数据位为第二值，调整数据电压信号，使得目标像素的驱动电压被确定为最小驱动电压。
在一些实施例中，调整数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压包括：在初始化时段内，将数据电压信号确定为第一电压信号，并依次为各像素提供有效的初始化控制信号；在显示时段内，将数据电压信号确定为与公共电压信号相反，并为目标像素提供持续有效的显示控制信号，使得目标像素的驱动电压被确定为数据电压信号与公共电压信号的电压差。
在一些实施例中，调整数据电压信号，使得目标像素的驱动电压被确定为最小驱动电压包括：在初始化时段内，将数据电压信号确定为第二电压信号，并依次为各像素提供有效的初始化控制信号；在显示时段内，为目标像素提供无差电压信号，无差电压信号与公共电压信号相同，并为目标像素提供持续有效的显示控制信号，使得目标像素的驱动电压被确定为无差电压信号和公共电压信号之间的电压差。
在一些实施例中，基于图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号包括：缓存图像数据中的用于预设数目个像素的像素数据；根据预设数模转换规则，将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
在一些实施例中，缓存图像数据包括：响应于用于预设数目个像素的像素数据中的有效数据位的数量大于第一阈值，根据预设压缩规则对用于预设数目个像素的像素数据进行压缩，使得压缩后的像素数据中的有效数据位的数量不大于所述第一阈值。
在一些实施例中，将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号包括：对压缩后的像素数据进行解压缩；将解压缩后的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
在一实施例中，缓存图像数据包括：响应于用于预设数目个像素的像素数据中的有效数据位的数量小于第一阈值，根据第一预设补位规则对用于预设数目个像素的像素数据进行补位，使得补位后的图像数据中的有效数据位的数量等于第一阈值。
在一些实施例中，将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号包括：响应于用于目标像素电极的像素数据中的有效数据位的数量小于第二阈值，根据第二预设补位规则对用于目标像素电极的图像数据进行补位，使得补位后的像素数据中的有效数据位的数量等于所述第二阈值。
在一些实施例中，将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号还包括：响应于每时钟周期接收到用于至少两个像素的像素数据，将至少两个像素的像素数据重新分配为用于不同像素的至少两组像素数据。
在一些实施例中，该图像处理方法还包括：在第一显示模式中，响应于接收到切换至第二显示模式的指令，向模式寄存器写入针对第二显示模式的使能数据，在第一预设时间间隔后，基于模式寄存器中的使能数据，令第二使能信号有效。
在一些实施例中，该图像处理方法还包括：在第二显示模式中，响应于接收到新的图像数据，开启数据电压缓存器；将基于新的图像数据确定的数据电压信号写入所述数据电压缓存器；在第二预设时间间隔后，关闭数据电压存储器。
在一些实施例中，该图像处理方法还包括：在第二显示模式中，响应于接收到切换至第一显示模式的指令，向模式寄存器写入针对第一显示模式的使能数据，并开启数据电压缓存器；将数据电压信号写入数据电压缓存器；在第三预设时间间隔后，关闭数据电压缓存器；基于模式寄存器中的使能数据，令第一使能信号有效。
在一些实施例中，该图像处理方法还包括：在第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第一预设条件时，响应于接收到针对低质显示模式的使能信号，使用低质显示模式，其中，在低质显示模式中，响应于用于目标像素的像素数据中的最高有效数据位为第一值，将用于目标像素的像素数据置位为最大值，以及，响应于用于目标像素的像素数据中的最高有效数据位为第二值，将用于目标像素的像素数据置位为最小值。
在一些实施例中，该图像处理方法还包括：在第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第二预设条件时，在亮屏前使第二使能信号变为有效。
在一些实施例中，该图像处理方法还包括：在第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第三预设条件时，根据预设绑点电压调整用于目标像素的数据电压信号，其中，预设绑点电压用于指定至少一个灰阶对应的数据电压信号。
在一些实施例中，接收图像数据包括：在设备上电并初始化之后，并且在亮屏之前，接收初始化图像数据，并基于初始化图像数据确定用于各个像素的初始化电压信号。
在一些实施例中，接收图像数据包括：根据预设接口规则，基于显示模式和/或像素数据中的有效数据位的数量选择第一接口或第二接口来接收图像数据，其中，第一接口和第二接口具有不同的数据传输速率。
根据本公开的另一方面，提供了一种像素驱动电路，包括：数据接口，被配置为：接收图像数据，图像数据包括用于至少一个像素的像素数据；数据处理电路，被配置为：基于图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号；像素电极驱动电路，包括第一充电电路和第二充电电路，其中，所述第一充电电路被配置为：响应于第一使能信号有效，以第一显示模式驱动目标像素，在第一显示模式中，以第一频率更新数据电压信号，并为目标像素提供数据电压信号，使得目标像素的驱动电压被确定为数据电压信号和公共电压信号之间的电压差，其中，公共电压信号为所有像素共用的基准电压信号，以及其中，所述第二充电电路被配置为：响应于第二使能信号有效，以第二显示模式驱动目标像素，在第二显示模式中，以第二频率更新数据电压信号，根据用于目标像素的像素数据调整数据电压信号，并为目标像素提供调整后的数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压或最小驱动电压，其中，第二频率低于第一频率。
在一些实施例中，用于目标像素的像素数据包括至少一个有效数据位，并且其中，第二充电电路包括：锁存器，被配置为锁存至少一个有效数据位中的最高有效数据位；模式选择电路，被配置为：响应于至少一个有效数据位中的最高有效数据位为第一值，调整数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压，以及响应于至少一个有效数据位中的最高有效数据位为第二值，调整数据电压信 号，使得目标像素的驱动电压被确定为最小驱动电压。
在一些实施例中，数据处理电路包括：缓存电路，被配置为缓存图像数据中的用于预设数目个像素的像素数据；数模转换电路，被配置为将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
在一些实施例中，像素驱动电路还包括：数据电压缓存器，被配置为在第二显示模式中缓存数据电压信号。
根据本公开的又一方面，提供了一种显示装置，包括根据前述方面所描述的像素驱动电路；液晶面板，包括多个像素，并被配置为接收来自像素驱动电路的数据电压信号；背光板，被配置为为液晶面板提供背光。
根据在下文中所描述的实施例，本公开的这些和其它方面将是清楚明白的，并且将参考在下文中所描述的实施例而被阐明。
附图说明
在下面结合附图对于示例性实施例的描述中，本公开的更多细节、特征和优点被公开，在附图中：
图1示意性示出了根据本公开的一些实施例的像素驱动方法的示例流程图；
图2示意性示出了根据本公开的一些实施例的像素电路的示例电路图；
图3A和3B示意性示出了根据本公开的一些实施例的像素电路在第一显示模式下的工作状态；
图4A、4B、4C和4D示意性示出了根据本公开的一些实施例的像素电路在第二显示模式下的工作状态；
图5A和5B示意性示出了根据本公开的一些实施例的用于驱动像素电路的示例驱动时序；
图6示意性示出了根据本公开的一些实施例的用于为像素电路充电的像素充电电路的示例电路图；
图7A、7B、7C、7D和7E示意性示出了根据本公开的一些实施例的图像数据的示例数据格式的传输协议；
图8A、8B、8C和8D示意性示出了根据本公开的一些实施例的针 对各数据格式的示例处理流程；
图9A、9B和9C示意性示出了根据本公开的一些实施例的模式切换或图像数据更新的示例流程图；
图10示意性示出了根据本公开的一些实施例的像素驱动电路的示例性的内部模式切换图；
图11示意性示出了根据本公开的一些实施例的配合Idle模式的示例性的数据处理流程；
图12示意性示出了根据本公开的一些实施例的显示流程的示例流程图；
图13示意性示出了根据本公开的一些实施例的显示流程的示例流程图；
图14示意性示出了根据本公开的一些实施例的配合接口的示例性的内部模式切换图；
图15示意性示出了根据本公开的一些实施例的推荐接口配置的示例表格；
图16示意性示出了根据本公开的一些实施例的像素驱动电路的示例框图；
图17A示意性示出了根据本公开的一些实施例的显示装置的示例性框图；
图17B示例性示出了根据本公开的一些实施例的显示装置的示意图；
图18示意性示出了根据本公开的一些实施例的计算设备的示例框图。
具体实施方式
下面将结合本公开实施例中的附图，对本公开实施例中的技术方案进行清楚、完整地描述。应理解，所描述的实施例仅仅是本公开的一部分实施例，而不是全部的实施例。基于本公开所描述的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本公开保护的范围。本领域技术人员将会理解，下文描述的实施例旨在用于解释本公开，而不应视为对本公开的限制。除非特别说明，在下文实施例中没有明确描述具体技术或条件的，本领 域技术人员可以按照本领域内的常用的技术或条件或者按照产品说明书进行理解。
在本说明书的描述中，参考术语“一个实施例”、“另一个实施例”等的描述意指结合该实施例描述的具体特征、结构、材料或者特点包含于本公开的至少一个实施例中。在本说明书中，对上述术语的示意性表述不必须针对的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任一个或多个实施例或示例中以合适的方式结合。此外，在不相互矛盾的情况下，本领域的技术人员可以将本说明书中描述的不同实施例或示例以及不同实施例或示例的特征进行结合和组合。另外，需要说明的是，本说明书中，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。
如本领域技术人员将理解的，尽管在附图中以特定顺序描述了本公开中方法的各个步骤，但是这并非要求或者暗示必须按照该特定顺序来执行这些步骤，除非上下文另有明确说明。附加的或可替换的，可以将多个步骤合并为一个步骤执行，以及/或者将一个步骤分解为多个步骤执行。此外，在步骤之间可以***其他方法步骤。***的步骤可以表示诸如本文所描述的方法的改进，或者可以与该方法无关。此外，在下一步骤开始之前，给定步骤可能尚未完全完成。
图1示意性示出了根据本公开的一些实施例的像素驱动方法100的示例流程图。如图1所示，像素驱动方法100可以包括步骤110至步骤140。示例性地，像素驱动方法100可以由包括显示屏的计算设备执行，例如由计算设备中的用于驱动显示屏的驱动装置执行，驱动装置可以体现为独立或与其他装置集成的电路结构，并且可以具有或不具有单独的封装结构。例如，驱动装置可以被实施为驱动IC(Integrated Circuit，集成电路)等结构。一般地，驱动装置可以用于接收来自***端的图像数据，并基于图像数据为显示屏中的部分或全部像素提供驱动信号，以显示相应的图像。***端可以指诸如中央控制单元(CPU)、微控制器(MCU)或专门的图形处理单元(GPU)等装置，这些装置可以基于所存储的图像、所接收的图像或所生成的图像，根据预设数据格式和相应传输协议向驱动装置传输图像数据。下面参照图1详细介绍步骤110至140。
在步骤110，接收图像数据，图像数据可以包括用于至少一个像素的像素数据。示例性地，图像数据可以由计算设备中的控制器、中央处理器或图形处理器提供，例如经由数据总线或其他类型的传输线路提供至像素驱动装置。图像数据可以是符合预设数据协议格式的数据，其可以包括用于显示屏中各个像素或部分像素的像素数据。示例性地，可以根据预设频率接收多组图像数据，其中，每组图像数据可以表示视频中的一帧。
在步骤120，可以基于图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号。用于一个像素的像素数据可以包括该像素的像素值，例如，针对单色图像，像素数据可以反映该像素的灰度，针对彩色图像，像素数据可以反映该像素的R(红色)、G(绿色)、B(蓝色)分别对应的亮度等。示例性地，可以预先设定像素数据和数据电压信号之间的转换关系，例如可以通过查找表、曲线、函数表达式等各种方式来表达这种转换关系，使得可以根据该转换关系来基于像素数据确定对应的数据电压信号。可选地，在根据预设转换关系确定数据电压信号前，可以根据需求对像素数据进行处理，以便满足数据传输、数据存储、数据处理以及显示效果的不同需求，这类实施例将在下文中予以详细描述。
在步骤130，响应于第一使能信号有效，可以以第一显示模式驱动目标像素。在第一显示模式中，可以以第一频率更新数据电压信号，并为目标像素提供数据电压信号，使得目标像素的驱动电压被确定为数据电压信号和公共电压信号之间的电压差，其中，公共电压信号为所有像素共用的基准电压信号。一般而言，每个像素的像素电路可以包括存储电容，该存储电容一端可以连接至公共电压信号，另一端可以连接至数据电压信号，两者之间的电压差可以为存储电容充电，从而使像素显示相应的亮度。在此，“连接”应理解为涵盖直接连接或间接连接，即，存储电容可以直接连接至公共电压信号及数据电压信号，也可以通过其他中间电路元件连接至这些信号中的一个或两个。在本公开的其他表述中，若无相反指示，“连接”一词也应做类似理解。
此外，示例性地，数据电压信号的更新频率可以由像素驱动电路控制，或者也可以取决于像素驱动电路所接收的图像数据的频率。
在步骤140，响应于第二使能信号有效，可以以第二显示模式驱动目标像素。在第二显示模式中，可以以第二频率更新数据电压信号，根据用于目标像素的像素数据调整数据电压信号，并为目标像素提供调整后的数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压或最小驱动电压，其中，第二频率低于第一频率。示例性地，可以根据用于目标像素的像素数据中的部分或全部有效位来调整数据电压信号，使得调整后的数据电压信号与公共电压信号之间的差值为最大值或最小值，从而，在通过调整后数据电压信号与公共电压信号为像素中的存储电容充电时，可以得到最大驱动电压或最小驱动电压；或者，可以根据用于目标像素的像素数据中的部分或全部有效位来调整数据电压信号，使得调整后的数据电压信号与公共电压信号(以及无差电压信号)之间的差值为最大值，从而，在通过调整后数据电压信号与公共电压信号为像素中的存储电容充电时，可以得到最大驱动电压，而在通过无差电压信号与公共电压信号为像素中的存储电容充电时，可以得到最小驱动电压；等等。示例性地，该最小驱动电压可以为零。由此，在第二显示模式下，像素亮度可以为最高或最低。可选地，根据像素的控制模式不同，当以零电压驱动像素时，像素亮度可以为最高或最低。例如，在常黑模式下，当以零电压驱动像素时，像素亮度可以为最低；在常白模式下，当以零电压驱动像素时，像素亮度可以为最高。这可以根据具体应用需求来设计。
示例性地，第一频率和第二频率可以是预先设置的，其中，第一频率可以为显示设备常规使用的频率，例如60Hz或其他近似频率，比如60Hz至85Hz中的任一频率，其可以满足常规动态画面的显示需求；第二频率可以为低频显示模式的频率，例如1Hz或其他近似频率，比如2Hz、0.5Hz等，其可以用于静态画面的显示，并且相比于第一频率可以显著降低功耗。
此外，示例性地，可以由像素驱动电路响应于使用第一显示模式或第二显示模式的指令而相应地将第一使能信号或第二使能信号置为有效，或者，可以由像素驱动电路根据具体显示需求而将第一使能信号或第二使能信号置为有效。进一步示例性地，使用第一显示模式或第二显示模式的指令可以由像素驱动电路内部生成，或者也可以从外部电路接收。例如，用户可以通过计算设备上的实体或虚拟按钮等来 选择使用第一显示模式或第二显示模式，随后，计算设备可以根据用户的选择来生成相应的指令，并提供至像素驱动电路；或者，计算设备可以根据当前需求而自动判断使用第一显示模式或第二显示模式，生成相应指令，并提供至像素驱动电路；或者，像素驱动电路可以根据所要显示的图像数据而自行判断使用第一显示模式或第二显示模式，并生成相应指令；等等。
在相关技术中，往往仅支持一种频率下的显示模式，例如上文描述的第一显示频率，或者，虽然相关电路支持多种频率下的显示模式，但在使用过程中仅可选择其中一种频率。然而，通过像素驱动方法100，可以支持不同频率下的显示模式(例如，60Hz模式和1Hz模式，或者其他第一频率和第二频率的组合)，并且在两种模式下通过不同方式为像素充电。具体地，可以通过不同使能信号来在不同显示模式下使用不同充电方式，在第一显示模式下，可以为像素提供数据电压信号，使得可以通过数据电压信号和公共电压信号之间的电压差来为像素充电；而在第二显示模式下，可以根据像素数据调整所确定的数据电压信号，并为像素提供调整后的数据电压信号，使得可以通过最大驱动电压或最小驱动电压来为像素充电。如此，可以允许例如通过手动切换或在满足某些条件时自动切换来提供针对不同显示模式的使能信号，并在不同显示模式下以不同频率更新数据电压，和以不同方式为像素充电。通过这种方式，可以无需一直保持高频率显示状态，从而有助于降低整机功耗。具体而言，高频率的第一显示模式可以满足常规显示需求，而低频率的第二显示模式可以满足低功耗显示的需求。此外，在低频率的第二显示模式中，各像素的驱动电压被确定为最大或最小驱动电压，即各像素仅存在white/black(白/黑)两种显示状态，这可以实现更简单的处理逻辑，有助于进一步降低功耗。
如前文所提及的，对于诸如智能手表等的可穿戴设备而言，降低功耗、延长续航时间的需求往往更为强烈，因此，本公开提供的像素驱动方法可以应用于此类设备。根据实验，通过使用本公开提供的技术方案，诸如智能手表等的可穿戴设备的功耗降幅明显，通常可以降低1至2个数量级。
在一些实施例中，图1所示的像素驱动方法100可以配合图2所示的像素电路200来使用，即，像素驱动方法100可以用于驱动像素 电路200。但是，应理解，像素电路200仅仅是示例性的，实际上也可以使用其他类似像素电路。
如图2所示，像素电路200可以包括第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第二晶体管M5以及两个首尾相接的反相器。首尾相接的两个反相器可以构成静态随机存取存储器(Static Random Access Memory，SRAM)，可以用于存储电压信号，该电压信号可以控制M3和M4的通断。M1和M2的开关可以由GateA信号决定，当GateA为高时，M1导通，M2关断，Source信号可以经由M1输入至节点1，即输入至SRAM，当GateA信号为低时，M1关断，M2导通，SRAM与Source信号隔离，Source信号的变化不会影响SRAM中的电压信号。在GateB信号为高时，当SRAM中的电压信号使得M3关断、M4导通时，像素电路200中的存储电容P可以经由M5连接至Source；当SRAM中的电压信号使得M3打开、M4关断时，存储电容P可以经由M5连接至FRP。图2中的Source信号可以视为前文所提到的由驱动装置提供至像素电路的数据电压信号，FRP可以视为无差电压信号，在此电路中可以为长黑电压信号，VCOM可以视为公共电压信号。此外，GateA和GateB为控制信号，其中，GateA可以视为初始化控制信号，可以用于逐行的初始化；GateB可以视为显示控制信号，可以用于逐行的显示。
下面，结合图3A和3B描述根据本公开的一些实施例的像素电路200在第一显示模式下的工作状态。如前文所提到的，第一显示模式可以为常规频率下的显示模式，例如60Hz模式或其他近似频率模式。
图3A示出了第一显示模式的初始化阶段。如图所示，GateA为高电平，此时，M1导通，M2关断，通过Source信号写入L电平(低电平)，此时L电平经过节点1和节点2之间的反相器第一次反向为H电平(高电平)，该H电平使得M4导通，同时经过节点3和节点4之间的反相器第二次反向为L电平，但两个反相器并不导通。GateB为低电平，此时，M5关断，因此无数据写入存储电容P，像素无显示。
图3B示出了第一显示模式的显示阶段。如图所示，GateA为低电平，此时，M2导通，M1关断，两个反相器导通，保持电平的循环，使得M4持续导通。GateB为高电平，此时，M5导通，因此，可以通过Source信号持续写入数据并经由M4、M5将数据写入到存储电容P， 存储电容P两端的Source信号与VCOM信号形成压差，像素正常显示。
示例性地，在第一显示模式下，可以通过图5A所示的驱动时序500A来驱动像素电路200。图5A示出了列起始信号STV、数据电压信号Source、公共电压信号VCOM、长黑电压信号FRP、像素1至像素n的初始化控制信号GateA1至GateAn、像素1至像素n的显示控制信号GateB1至GateBn，其中n≥1。如图所示，在第一显示模式下，第1帧可以用于初始化，从第2帧开始可以用于正常显示，仅当重新上电或帧频发生变化时，才需重复从初始化至正常显示的过程。具体地，在第一显示模式的初始化阶段，Source为低电平，GateA1至GateAn依次被置为高电平，即依次初始化各个像素电路；在第一显示模式的显示阶段，通过Source向各个像素的像素电路的写入图像数据，GateB1至GateBn依次被置为高电平，即依次向各个像素电路写入相应的图像数据，以便显示帧图像。示例性地，以60Hz模式为例，每帧持续时间可以为约16.7ms。
下面，结合图4A、4B、4C和4D描述根据本公开的一些实施例的像素电路200在第二显示模式下的工作状态。为便于描述，在关于图4A-4D描述的实施例中，假设像素电路200为处于常黑模式下的像素电路，针对常白模式，可以类似地驱动，其中驱动电压与像素灰阶(或像素亮度)的对应关系需进行调整。如前文所提到的，第二显示模式可以为低频显示模式，例如1Hz模式或其他近似频率模式。在一些实施例中，第二显示模式可以进一步划分为White(白色)模式和Black(黑色)模式，在White模式中，像素驱动电压被确定为最大驱动电压，并显示最高亮度，在Black模式中，像素驱动电压被确定为最小驱动电压(例如零电压)，并显示最低亮度(例如全黑)。
图4A示出了第二显示模式中White模式的初始化阶段。该阶段类似于第一显示模式的初始化阶段。如图所示，GateA为高电平，此时，M1导通，M2关断，通过Source信号写入L电平(低电平)，此时L电平经过节点1和节点2之间的反相器第一次反向为H电平(高电平)，该H电平使得M4导通，同时经过节点3和节点4之间的反相器第二次反向为L电平，但两个反相器并不导通。GateB为低电平，此时，M5关断，因此无数据写入存储电容P，像素无显示。
图4B示出了第二显示模式中White模式的显示阶段。如图所示， GateA为低电平，此时，M2导通，M1关断，两个反相器导通，保持电平的循环，使得M4持续导通。GateB为高电平，此时，M5导通，因此，可以通过Source信号持续写入数据并经由M4、M5将数据写入到存储电容P，存储电容P两端的Source信号与VCOM信号形成压差，像素正常显示。在一些实施例中，当显示静态画面时，***端不持续写入图像数据，对于像素电路，可以通过M4、M5将上一帧的Source数据写入存储电容P，该Source数据可以存储在缓存装置中，这将在下文中予以介绍。
图4A示出了第二显示模式中Black模式的初始化阶段。如图所示，GateA为高电平，此时，M1导通，M2关断，通过Source信号写入H电平，该H电平使得M3导通，并且该H电平经过节点1和节点2之间的反相器第一次反向为L电平，又经过节点3和节点4之间的反相器第二次反向为H电平，但两个反相器并不导通。GateB为低电平，此时，M5关断，因此无数据写入存储电容P，像素无显示。
图4B示出了第二显示模式中Black模式的显示阶段。如图所示，GateA为低电平，此时，M2导通，M1关断，两个反相器导通，保持电平的循环，使得M3持续导通。GateB为高电平，此时，M5导通，因此，可以经由M3、M5将FRP信号写入到存储电容P，存储电容P两端的FRP信号与VCOM信号间的电压差为零，像素显示黑色。在一些实施例中，当显示静态画面时，***端不持续写入图像数据，对于像素电路，在下一帧中，可以继续通过Source信号的高电平初始化为Black模式，并通过M3、M5将FRP信号写入存储电容P，当有画面更新时，***端再写入新的图像数据。
示例性地，在第二显示模式下，可以通过图5B所示的驱动时序500B来驱动像素电路200。图5B示出了列起始信号STV、Black模式下的数据电压信号Source(Black)、White模式下的数据电压信号Source(White)、公共电压信号VCOM、长黑电压信号FRP、像素1至像素n的初始化控制信号GateA1至GateAn、像素1至像素n的显示控制信号GateB1至GateBn，其中n≥1。如图所示，在第二显示模式下，每帧中的部分时间可以用于初始化，剩余时间可以用于正常显示。以1Hz模式为例，每帧时间为1s，其中前16.7ms可以用于初始化，剩余时间可以用于正常显示。应理解，初始化阶段的时间长度可以根据需求设 定，其可以与第一显示模式的一帧时长相等或不等。具体地，在第二显示模式的Black模式的初始化阶段，Source为高电平，GateA1至GateAn依次被置为高电平，即依次初始化各个像素电路；在第二显示模式的Black模式的显示阶段，通过FRP和VCOM为像素充电，GateB1至GateBn保持高电平，即持续为像素电路提供FRP信号，以便令相关像素持续显示黑色。在第二显示模式的White模式的初始化阶段，Source为低电平，GateA1至GateAn依次被置为高电平，即依次初始化各个像素电路；在第二显示模式的White模式的显示阶段，通过Source向各个像素的像素电路的写入图像数据，GateB1至GateBn保持高电平，即持续向各个像素电路写入相应的Source信号，以便显示帧图像。由于在第二显示模式中，涉及针对像素的Black或White模式的选择，在每一帧开始时均需重复从初始化至正常显示的过程。
应理解，上文描述均针对控制电平高有效的晶体管，事实上，也可以使用控制电平低有效的晶体管，在这种情况下，相关驱动信号可以被置为与上文描述相反。
在一些实施例中，用于目标像素的像素数据可以包括至少一个有效数据位。关于图像数据的数据格式，下文将举例详细介绍，在此不再赘述。在这种实施例中，步骤140可以包括：响应于至少一个有效数据位中的最高有效数据位为第一值，调整数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压；响应于至少一个有效数据位中的最高有效数据位为第二值，调整数据电压信号，使得目标像素的驱动电压被确定为最小驱动电压。示例性地，当像素数据中的最高有效数据位为1时，可以调整数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压，例如，可以调整数据电压信号，使得目标像素以前文所描述的White模式显示；当像素数据中的最高有效数据位为0时，可以调整属实电压信号，使得目标像素的驱动电压被确定为最小驱动电压(比如零)，例如，可以调整数据电压信号，使得目标像素以前文所描述的Black模式显示。由此，可以仅根据像素数据的最高有效位的取值确定目标像素显示为最高亮度或最低亮度，这有助于降低数据处理量，简化处理逻辑，从而有助于进一步降低功耗。
在一些实施例中，可以通过如下方式将目标像素的驱动电压确定为最大驱动电压或最小驱动电压。具体而言，为使得目标像素的驱动 电压被确定为最大驱动电压，在初始化时段内，可以将数据电压信号确定为第一电压信号，并依次为各像素提供有效的初始化控制信号，随后，在显示时段内，可以将数据电压信号确定为与公共电压信号相反，并为目标像素提供持续有效的显示控制信号，使得目标像素的驱动电压被确定为数据电压信号与公共电压信号的电压差；为使得目标像素的驱动电压被确定为最小驱动电压，在初始化时段内，可以将数据电压信号确定为第二电压信号，并依次为各像素提供有效的初始化控制信号，随后，在显示时段内，可以为目标像素提供无差电压信号，无差电压信号与公共电压信号相同，并为目标像素提供持续有效的显示控制信号，使得目标像素的驱动电压被确定为无差电压信号和公共电压信号之间的电压差。
依旧以参考图4A-4D描述的像素电路为例，目标像素的驱动电压被确定为最大驱动电压的情况可以为前文所提到的White模式。在White模式下，在初始化时段内，可以将数据电压信号确定为低电平，在显示时段内，可以将数据电压信号确定为与公共电压信号相反，例如，如图5B所示的Source(White)信号那样。目标像素的驱动电压被确定为最小驱动电压的情况可以为前文所提到的Black模式。在Black模式下，在初始化时段内，可以将数据电压信号确定为高电平，例如，如图5B所示的Source(Black)信号那样，在显示时段内，可以提供与公共电压信号相同的长黑电压信号，例如，如图5B所示的与VCOM相同的FRP信号那样。此外，示例性地，可以如图5B所示的GateA1至GateAn那样，在初始化时段内依次为各像素提供有效的初始化控制信号，并且，可以如GateB1至GateBn那样，在显示时段内为各像素提供持续有效的显示控制信号。
在上述实施例中，可以调整数据电压信号，并通过调整后的数据电压信号在初始化时段内将像素设置为以最大亮度或最低亮度显示的模式，并可以通过在显示时段内使显示控制信号持续有效，使得各像素持续显示最大亮度或最小亮度。由此，可以便捷地控制各周期内各个像素的显示情况(即，显示最大亮度或是最小亮度)。
在一些实施例中，可以借助图6所示的像素充电电路600来为像素充电。如图6所示，像素充电电路600包括两条充电路径610和620，充电路径610可以用于在第一显示模式下为像素电路充电，充电路径 620可以用于在第二显示模式下为像素电路充电。
如图6所示，像素充电电路600可以接收数据电压信号Source’，该数据电压信号Source’可以是在前文所述的步骤120中基于像素数据生成的。当第一使能信号EN_1有效、第二使能信号EN_2无效时，可以以第一显示模式驱动像素电路。此时，Source’信号经由晶体管T1传输至第一充电路径610中，进而作为Source信号被提供至相应像素电路，写入像素电路的存储电容，使得Source信号和VCOM信号在存储电容两端形成压差，使得像素显示相应亮度。在一些实施例中，压差与像素亮度可以成正比。示例性地，图6还示意性示出了用于第一充电路径610的示例驱动时序611。如图所示，VCOM可以在4.5V和0V之间变化，Source信号可以根据图像数据被确定为一系列电压信号，例如图中所示的3V、4.5V、0V、4.5V、1.5V，由此，存储电容的充电电压可以被确定为两者的差值ΔV。
当第一使能信号EN_1无效、第二使能信号EN_2有效时，可以第二显示模式驱动像素电路。此时，Source’信号经由晶体管T2传输至第二充电路径620中。为判断第二显示模式下像素驱动电压应被确定为最大值还是最小值，可以将像素数据的最高有效位的数值锁存(Latch)至各像素。可选地，最高有效位的数值可以取自Source’信号、图像数据中的相应像素数据、经处理的图像数据中的相应像素数据等。示例性地，当最高有效位为1时，T3导通，以White模式驱动像素电路(在此仍以常黑模式为例)，其中，Source’信号被调整为Source信号，使得Source信号与VCOM信号之间存在最大压差。示例性地，图6还示意性示出了用于第二充电路径620的White模式下的示例驱动时序621。如图所示，Source’可以被调整为Source，以便以最大压差4.5V为像素电路的存储电容充电，使得像素显示最高亮度。当最高有效位为0时，T4导通，以Black模式驱动像素电路，其中，Source’信号被调整为Source信号，使得可以通过长黑电压信号FRP和VCOM的压差为像素电路的存储电容充电。示例性地，图6还示意性示出了用于第二充电路径620的Black模式下的示例驱动时序622。如图所示，VCOM与FRP相同，使得存储电容两端电压为零，从而使得像素显示黑色。
为简洁起见，在图6中，像素电路未被完整示出，仅示意性示出 其Source端、VCOM端、Gate端等。应理解，在此，像素电路可以具有与前文实施例描述的相同或相似的结构，并可以如前文实施例中描述的那样被驱动。
在一些实施例中，参考图1描述的步骤120可以包括：缓存图像数据中的用于预设数目个像素的像素数据；根据预设数模转换规则，将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。由于接口数据传输速率与驱动装置内部的数据处理速率可能存在差异，例如，数据传输速率可能高于数据处理速率，因此，可以对所接收的图像数据进行缓存，以待后续处理和使用。可选地，预设数模转换规则可以是预设数模转换函数、预设查找表等。数模转换过程可以根据像素数据中的有效数据位完成数字信号至模拟信号(即数据电压信号)的转换，转换后的模拟信号可以被输入至显示屏，并决定显示屏的灰阶颜色。
在一些实施例中，在缓存图像数据的过程中，响应于用于预设数目个像素的像素数据中的有效数据位的数量大于第一阈值，可以根据预设压缩规则对用于预设数目个像素的像素数据进行压缩，使得压缩后的像素数据中的有效数据位的数量不大于所述第一阈值。为节省存储空间，并减少驱动装置内部数据传输速率的压力，可以以预设数目个像素为单位对像素数据进行压缩，其中，预设数目例如可以为2、3、4等预设值，第一阈值可以为36bit或其他值。可以理解，预设数目和第一阈值可以根据具体应用需求来设定，例如，针对图像数据的不同数据格式，可以设定不同的预设数目，第一阈值可以根据驱动电路内部的处理能力来设定。
在上述实施例中，在将所缓存的像素数据转换为数据电压信号的过程中，可以对压缩后的像素数据进行解压缩，并将解压缩后的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
在一些实施例中，在缓存图像数据的过程中，响应于用于预设数目个像素的像素数据中的有效数据位的数量小于第一阈值，可以根据第一预设补位规则对用于预设数目个像素的像素数据进行补位，使得补位后的图像数据中的有效数据位的数量等于第一阈值。为保证像素数据在驱动装置内部存储、传输和处理过程中具有相同或相似格式， 以便于以统一方式进行管理，当预设数目个像素的像素数据中的有效数据位数量小于第一阈值时，可以将其补位至第一阈值。第一预设补位规则可以被设定为补0，或者也可以根据具体应用需求而被设定为其他补位方式。
在上述实施例中，在将所缓存的像素数据转换为数据电压信号的过程中，响应于用于目标像素电极的像素数据中的有效数据位的数量小于第二阈值，可以根据第二预设补位规则对用于目标像素电极的图像数据进行补位，使得补位后的像素数据中的有效数据位的数量等于第二阈值。示例性地，第二预设补位规则可以根据应用需求预先设定，例如可以通过相关寄存器进行设定，比如设定为补0、补1、补MSB(最高有效位)、补Green LSB(绿色最低有效位)等。示例性地，可以基于寄存器的设定结果生成补位控制信号EPF，来指定通过何种方式执行补位。
在上述实施例中，在将所缓存的像素数据转换为数据电压信号的过程中，响应于每时钟周期接收到用于至少两个像素的像素数据，可以将至少两个像素的像素数据重新分配为用于不同像素的至少两组像素数据。示例性地，当用于一个像素的像素数据中的有效数据位数量过低时，为了统一接收不同数据格式的图像数据时的时钟信号数量，同时提升传输效率，可以在一个时钟周期内接收用于两个或更多个像素的像素数据，并将其作为整体缓存和处理。在这种示例中，为了保证像素数据可以被提供至正确的像素，在生成数据电压信号前，可以对该两个或更多个像素数据进行重新分配，使其分配为两组或更多组独立的像素数据。
下面，作为示例，参考图7A至7E，简要介绍几种适用于本公开提供的技术方案的数据格式。应理解，附图所示出的数据格式仅仅是示例性地，基于本公开所提供的技术方案，也可以设计并使用其他类型的数据格式。
如图所示，数据格式可以由CMD(控制信息)和DATA(数据信息)组成，其中CMD可以用于指定数据协议类型等信息，DATA可以用于传输图像数据。示例性地，1个byte(字节)可以包括9bit(比特)位，其中，第1个byte可以用于传输CMD，从第2个byte开始可以传输DATA。每个byte中的第1位可以用于校错等功能，而不传输实 际数据。对于不同数据格式，其用于传输数据的有效数据位可以是不同的。
具体地，图7A示意性示出了24bit数据格式的传输协议700A。在24bit数据格式下，每个像素的像素数据可以由8bit红色、8bit绿色、8bit蓝色数据组成，并可以以3byte传输。图7B示意性示出了18bit数据格式的传输协议700B。在18bit数据格式下，每个像素的像素数据可以由6bit红色、6bit绿色、6bit蓝色数据组成，并同样可以以3byte传输，但在每个byte中，存在2bit空闲位。图7C示意性示出了16bit数据格式的传输协议700C。在16bit数据格式下，每个像素的像素数据可以由5bit红色、6bit绿色、5bit蓝色数据组成，并可以以2byte传输。图7D示意性示出了6bit数据格式的传输协议700D。在6bit数据格式下，每个像素的像素数据可以由2bit红色、2bit绿色、2bit蓝色数据组成。针对6bit数据格式，设计了两种不同的协议类型，如图7D上半部分所示，每个像素的像素数据可以连续传输，而不存在空闲位，如此可以提升数据传输效率；如图7D下半部分所示，在一个byte中可以仅传输1个像素的像素数据，另外两个bit位空闲，如此，虽然在一定程度上损失数据传输效率，但有助于降低数据处理的复杂度。可以根据***端的数据传输情况选择这两种协议类型中的一种协议类型。图7E示意性示出了3bit数据格式的传输协议700E。在3bit数据格式下，每个像素的像素数据可以由1bit红色、1bit绿色、1bit蓝色数据组成。针对3bit数据格式，同样设计了两种不同的协议类型，如图7E上半部分所示，在一个byte中，可以仅传输2个像素的像素数据，另外两个bit位空闲；如图7E下半部分所示，每个像素的像素数据可以连续传输，而不存在空闲位。类似于6bit数据格式，两种协议类型分别具有不同的优势，可以根据***端的数据传输情况选择其中一种协议类型。
示例性地，配合前文所述的第一显示模式和第二显示模式的不同需求和特点，在第一显示模式下，可以优先使用类似图7A、图7B、图7C所示的有效数据位较高的数据格式，以便呈现更加丰富的画面细节，提供满足常规需求的显示效果；而在第二显示模式下，可以优先使用类似图7D、图7E所示的有效数据位较低的数据格式，以便降低数据传输量，简化数据处理逻辑，进一步降低整体功耗。然而，根据实际 应用需求，也可以在第一显示模式中使用低有效数据位的数据格式，或者在第二显示模式中使用高有效数据位的数据格式。
针对不同数据格式，可以根据前文实施例所描述的方案进行处理并最终生成相应的数据电压信号。示例性地，图8A至8D示意性示出了参考图7A至7E描述的数据格式的数据处理流程。
示例性地，为便于理解，基于以下假设来描述图8A至图8D所示的数据处理流程。像素驱动装置可以采取驱动IC的形式。***端可以根据前述数据格式中的一种将图像数据写入驱动IC，驱动IC可以接收图像数据并经过多级数据处理，最终将数据通过Source写入相应像素电路。对于驱动IC，数据传输可以以24bit为单位进行，即，每个时钟周期(每CLK)可以接收24bit数据，若每时钟上升沿接收1bit数据，则每个时钟周期应至少包括24个时钟上升沿。在驱动IC内部，数据处理可以由压缩/解压缩(MC/MD)、数据映射、数模转换(D/A)三个模块组成。对于MC/MD模块，允许以至少一个像素的像素数据为单位进行36bit有效数据位的数据处理，即，当至少一个像素的像素数据的有效数据位的数量超过36bit时，需对像素数据进行压缩，当有效数据位的数量不足36bit时，需对像素数据进行补位，补位例如可以通过补0来实施。D/A数据采集和处理可以以24bit为单位进行，由此，数据映射模块可以对不足24bit的像素数据进行补位，如前所述，补位规则可以根据需求设定为补0、补1、补MSB、补Green LSB等。
图8A示意性示出了24bit数据格式的处理流程800A。如图所示，IC接口可以以1像素/CLK接收图像数据，对于24bit数据格式，即，每CLK接收24bit有效数据位，无需补位操作。在MC/MD内，图像数据以2像素/CLK(即48bit有效数据位)存在，需启用3/4压缩，使得像素数据由48bit压缩为36bit，并存储至GRAM，随后在解压缩后恢复至48bit有效数据位。数据映射模块每次接收1像素的像素数据，即接收24bit有效数据位，无需补位，可直接进入D/A模块进行数模转换，生成相应数据电压信号，并提供至显示面板。
图8B示意性示出了18bit数据格式的处理流程800B。如图所示，IC接口可以以1像素/CLK接收图像数据，对于18bit数据格式，即，每CLK接收18bit有效数据位，补0至24bit。在MC/MD内，图像数据以2像素/CLK(即36bit有效数据位)存在，无需启用数据压缩和解 压缩，图像数据可以直接经由该模块输入至数据映射模块。数据映射模块每次接收1像素的像素数据，即接收18bit有效数据位，需补位至24bit，补位后的数据进入D/A模块进行数模转换，生成相应数据电压信号，并提供至显示面板。对于16bit数据格式，处理流程与18bit类似，仅补位位数有所差异，在此不再赘述。
图8C示意性示出了6bit数据格式的处理流程800C。如图所示，IC接口可以以1像素/CLK接收图像数据，对于6bit数据格式，即，每CLK接收6bit有效数据位，补0至24bit。在MC/MD内，图像数据以2像素/CLK(即12有效数据位)存在，无需启用数据压缩和解压缩，可补位至36bit。数据映射模块每次接收1像素的像素数据，即接收18bit数据(包含12bit有效数据位)，需补位至24bit，补位后的数据进入D/A模块进行数模转换，生成相应数据电压信号，并提供至显示面板。对于6bit数据格式，考虑到其主要应用于低频率的第二显示模式，为降低处理复杂度，并且在第二显示模式下仅根据最高有效数据位的取值确定数据电压信号，可以仅通过补0来完成补位操作。
图8D示意性示出了3bit数据格式的处理流程800D。如图所示，对于3bit数据格式，为数据传输效率，IC接口可以以2像素/CLK接收图像数据，即，每CLK接收6bit有效数据位，补0至24bit。在MC/MD内，图像数据以4像素/CLK(即12有效数据位)存在，无需启用数据压缩和解压缩，可补位至36bit。数据映射模块每次接收2像素的像素数据，即接收18bit数据(包含12bit有效数据位)，需补位至24bit。由于此时补位后的24bit数据中实际包含了用于两个像素的像素数据，为确保像素数据可以被提供至对应的像素，需对补位后的数据进行重新分配为两组像素数据。可选地，在重新分配时，可以令每个像素数据的次高位等于最高位取值。重新分配的像素数据可以依次进入D/A模块进行数模转换，生成相应数据电压信号，并提供至显示面板。对于3bit数据格式，类似于6bit数据格式，可以仅通过补0来完成补位操作。
在一些实施例中，可以通过提供模式切换指令来在第一显示模式和第二显示模式之间切换。
示例性地，在第一显示模式中，响应于接收到切换至第二显示模式的指令，可以向模式寄存器写入针对第二显示模式的使能数据，在 第一预设时间间隔后，可以基于模式寄存器中的使能数据，令第二使能信号有效。类似前文实施例所提到的，切换至第二显示模式的指令可以接收自***端，例如用户可以手动选择切换至第二显示模式，或者***端可以在某些情形下自动确定切换至第二显示模式，基于此手动或自动切换操作，可以向像素驱动电路发送切换至第二显示模式的指令。模式寄存器可以响应于接收到相关切换指令而写入对应的使能数据，随后，可以基于模式寄存器中存储的使能数据而向诸如前文实施例描述的像素充电电路提供第一使能信号或第二使能信号。第一预设时间间隔可以根据具体应用需求来设定，其可以作为缓冲时间，有助于避免电路处理错误。
以60Hz模式和1Hz模式为例，图9A示意性示出了从60Hz模式切换至1Hz模式的示例流程900A。如图所示，在60Hz模式下，可选地，可以设置颜色格式，例如，根据前文实施例所描述的，可以基于接收自***端的图像数据中的CMD信息或基于其他相关指令来设置相应数据格式，以便根据该数据格式的特点和需求选择合适的处理流程，这已在前文实施例中予以详细描述，在此不再赘述。在设置颜色格式后，可选地，可以接收图像数据(2C/3C数据)。当接收到切换至1Hz模式的指令，可以向模式寄存器写入针对1Hz模式的使能数据，并在50ms的时间间隔后，切换至1Hz模式，并令第二使能信号有效。
示例性地，在第二显示模式中，响应于接收到新的图像数据，可以开启数据电压缓存器，将基于新的图像数据确定的数据电压信号写入数据电压缓存器，并在第二预设时间间隔后，关闭数据电压存储器。如前文所提及的，第二显示模式可以用于静态画面的显示，因此，在该模式下，***端可能不会持续向像素驱动电路提供图像数据。由此，在第二显示模式下，可以在基于图像数据生成相应数据电压信号后，将所生成的数据电压信号存储至数据电压缓存器，以便可以在每个显示周期内基于数据电压缓存器中的数据提供或更新数据电压信号。这种缓存机制有助于在第二显示模式下降低***端与像素驱动电路之间以及像素驱动电路内部的数据传输压力，并缩减像素驱动电路内的不必要的数据处理操作。
以1Hz模式为例，图9B示意性示出了在1Hz模式下接收到新图像数据时的处理流程900B。如图所示，在1Hz模式下，当接收到新的 图像数据时，可以开启数据电压缓存器(例如用于缓存数据电压信号的GRAM)，在1ms延迟后，可以开始接收新的图像数据。可选地，可以根据CMD信息或额外指令设置颜色格式(例如图像数据的数据格式)。随后，可以基于新的图像数据生成相应的数据电压信号，并写入数据电压缓存器。在未接收到模式切换指令时，可以根据状态寄存器所存储的使能数据而保持1Hz模式。当新的图像数据接收处理完毕后，在50ms的时间间隔后，可以关闭数据电压缓存器。
示例性地，在第二显示模式中，响应于接收到切换至第一显示模式的指令，可以向模式寄存器写入针对第一显示模式的使能数据，并开启数据电压缓存器，随后，可以将数据电压信号写入数据电压缓存器，在第三预设时间间隔后，关闭数据电压缓存器，并基于模式寄存器中的使能数据，令第一使能信号有效。类似前文实施例所提到的，切换至第一显示模式的指令可以接收自***端，***端可以基于手动或自动切换操作而向像素驱动电路发送切换至第一显示模式的指令。像素驱动电路可以基于接收到该指令而向模式寄存器写入针对第一显示模式的使能数据，以便可以准备切换至第一显示模式。为降低处理逻辑的复杂度，在此情况下，可以遵循前文所描述的第二显示模式下的图像数据更新流程，即，可以开启数据电压缓存器，并在数据电压缓存器中存储基于图像数据生成的数据电压信号，此时所存储的数据电压信号可以是基于新的图像数据生成的，也可以是先前图像数据对应的数据电压信号。随后，可以根据模式寄存器中的使能数据而切换至第一显示模式，并令第一使能信号变为有效。
以60Hz模式和1Hz模式为例，图9C示意性示出了从1Hz模式切换至60Hz模式的示例流程900C。如图所示，在1Hz模式下，响应于接收到切换至60Hz的指令，可以向模式寄存器写入针对60Hz模式的使能数据，并开启数据电压缓存器，以便存储基于图像数据生成的数据电压信号。可选地，可以根据前文实施例所描述的那样设置颜色格式。在设置颜色格式后，可选地，可以接收图像数据(2C/3C数据)。随后，可以根据模式寄存器中的使能数据而切换至60Hz模式，并在50ms的时间间隔后，关闭数据电压缓存器。
如前文所提及的，第一显示模式可以用于满足常规显示需求，因此，在一些实施例中，当像素驱动电路上电后，可以直接进入第一显 示模式，并可以在第一显示模式下持续写入和更新图像数据。当需要显示静态画面或存在降低功耗的需求时，可以手动或自动地切换至第二显示模式。在第二显示模式下，可以低频更新图片数据，并在需要时切换回第一显示模式。示例性地，图10示意性示出了像素驱动电路内部的模式切换图1000。如图所示，在断电状态下，响应于通电操作，像素驱动电路可以进入休眠状态。在休眠状态下，响应于断电操作，像素驱动电路可以恢复至断电状态；当休眠时间较长时或者响应于相关状态切换操作，像素驱动电路可以进入深度休眠状态；当接收到来自***端的图像数据或接收到相关指令时，像素驱动电路可以切换至第一显示模式(例如60Hz模式)。在深度休眠状态下，当接收到来自***端的数据信号或指令时，像素驱动电路可以切换回休眠状态。休眠状态下，可以关闭部分电路功能，深度休眠状态下可以关闭更多电路功能，从而减少不必要的功耗。在第一显示模式(例如60Hz模式)下，如前文所描述的，可以接收图像数据并基于图像数据为像素电路提供数据电压信号以及其他驱动信号，也可以响应于相关切换指令切换至第二显示模式(例如1Hz模式)。此外，当不再显示图像数据时或响应于相关指令，像素驱动电路也可以从第一显示模式切换回休眠状态。在第二显示模式(例如1Hz模式)下，如前文所描述的，可以接收图像数据并基于图像数据为像素电路提供数据电压信号以及其他驱动信号，也可以响应于相关切换指令切换至第一显示模式(例如1Hz模式)。此外，当不再显示图像数据时或响应于相关指令，像素驱动电路也可以从第二显示模式切换回休眠状态。
如前文实施例所提及的，在第一显示模式下，为提供更为丰富的画面细节，满足常规显示需求，可以使用有效数据位较多的数据格式，例如前文描述的24bit、18bit、16bit数据格式等；在第二显示模式下，配合其显示特点，为了减少数据量且降低功耗，可以使用有效数据位较少的数据格式，例如前文描述的6bit、3bit数据格式等。然而，在某些实际应用中，受限于主板速率，为避免卡顿，也可能存在在第一显示模式下使用较少有效数据位的数据格式的需求。由于在一般设计中，诸如6bit、3bit等的较少有效数据位的数据格式一般应用于第二显示模式，如前文所描述的，在第二显示模式下，可以根据最高有效数据位的取值将像素驱动电压最终确定为最大驱动电压或最小驱动电压。因 此，为了降低数据处理复杂度，在进行补位操作时，一般默认采取补0操作。然而，在这种情况下，当在第一显示模式中使用这些较少有效数据位的数据格式时，会存在像素亮度不足的问题。
举例而言，假设在像素驱动电路内部，当像素数据中的有效数据位的数量不足24bit时，需补位至24bit。以18bit数据格式为例，在有效数据位为R(111111)G(111111)B(111111)的情况下，若以0进行补位，补位后的数据为R(11111100)G(11111100)B(11111100)，此时通过D/A模块后，对应灰阶为R252G252B252，若以1进行补位后为R(11111111)G(11111111)B(11111111)，此时通过D/A模块后，对应灰阶为R255G255B255。因此，通过不同的补位方式，最终的最大灰阶亮度范围为252～255，基本没有亮度差异。而以6bit数据格式为例，在有效数据位为R(11)G(11)B(11)的情况下，作为有效数据位数量较少的数据格式，仅采取补0方式进行补位，即补位后的数据为R(11000000)G(11000000)B(11000000)，此时通过D/A模块后，对应灰阶为R192G192B192，即，此时能达到的最大灰阶亮度仅为192灰阶，视效亮度严重不足，仅为正常亮度的60％。同理，3bit数据格式存在同样问题。
在一些实施例中，为解决上述亮度不足问题，在第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第一预设条件时，响应于接收到针对低质显示模式的使能信号，可以使用低质显示模式。在低质显示模式中，响应于用于目标像素的像素数据中的最高有效数据位为第一值，将用于目标像素的像素数据置位为最大值，以及，响应于用于目标像素的像素数据中的最高有效数据位为第二值，将用于所述目标像素的像素数据置位为最小值。示例性地，第一预设条件可以指有效数据位的数量低于某预设阈值，或者可以指有效数据位的数量等于某预设值。例如，第一预设条件可以指有效数据位的数量为6，即前文所提到的6bit数据格式，或者，第一预设条件也可以根据需求设置为其他条件。低质显示模式可以为独立设置的显示模式，或者可以直接采用IC的Idle mode来实施。可选地，当需要配合低质显示模式进行图像数据的处理和显示时，可以通过相关使能信号来启用低质显示模式，使能信号可以借助单独指令或者图像数据中CMD信息等方式来传递。在低质显示模式下，可以仅根据像素数据的最高位 数值来将像素数据重新置位为最大值或最小值，即置位为全1或全0，对应灰阶为255或0，从而避免亮度损失。
继续以前文示例为例，对于像素中的R、G或B子像素而言，完成补位后写入的像素数据位为8bit，此时，可以对最高位D7进行判断，若D7为1，即可能的数据范围为10000000～11111111，对应灰阶为128～255，此时IC显示255灰阶；若D7为0，即可能的数据范围为00000000～01111111，对应灰阶为0～127，此时IC显示0灰阶。在这种显示模式下，最多可显示8种颜色。然而，对于6bit数据格式，正常情况下可以显示64种颜色。正常情况下，若要显示8种颜色，一般仅需3bit数据格式即可实现。因此，对于实现相同显示效果，6bit数据格式会增加主板的数据量。为解决该问题，在配合低质显示模式写入6bit数据格式的图像数据时，可以直接令次高有效位数值等于最高有效位数值，例如D6＝D7，从而既满足主板低数据量的需求，又满足不损失显示亮度的需求。
图11示意性示出了配合Idle模式进行数据处理的示例过程1100。如图11所示，在接收6bit数据格式的图像数据时，可以对6bit有效数据位的像素数据进行补位，补位至24bit。此时，示例性地，为降低驱动电路主板数据量，可以直接令D6＝D7。随后，可以根据CMD信息中的指令，通过使能信号进入Idle模式。在Idle模式中，根据D7取值，判断像素显示255灰阶还是0灰阶，即，将像素数据置位为全1或全0。置位后的像素数据可以经过数据映射模块，而后经过D/A转换模块，生成对应的数据电压信号，该数据电压信号随后可以通过图6所示的像素充电电路的分支610被提供至像素电路，使得像素显示最高亮度或最低亮度。
在一些实施例中，为解决上述亮度不足问题，在第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第二预设条件时，可以在亮屏前使第二使能信号变为有效。示例性地，第二预设条件可以指有效数据位的数量低于某预设阈值，或者可以指有效数据位的数量等于某预设值。例如，第二预设条件可以指有效数据位的数量为3，即前文所提到的3bit数据格式，或者，第一预设条件也可以根据需求设置为其他条件。常规情况下，在第一显示模式下接收到图像数据后，将根据前文实施例描述的过程基于图像数据生成相应的数据电 压信号，并使用所生成的数据电压信号驱动对应像素，以显示图像画面。为解决第一显示模式下使用诸如3bit数据格式导致的亮度损失问题，可以在生成数据电压信号后，切换至第二显示模式，即通过第二显示模式的充电路径驱动对应像素，并在第二显示模式下亮屏显示。由于在第二显示模式下，像素驱动电压被确定为最大驱动电压或最小驱动电压，因此像素将呈现最大亮度或最小亮度，而不存在亮度损失。可选地，在当前图像显示完毕后，可以切换回第一显示模式继续接收图像数据。
图12示意性示出了借助第二显示模式避免前述亮度损失问题的示例流程1200。如图所示，继续以60Hz模式和1Hz模式为例，设备通电后，可以对电路进行初始化，随后准备进入60Hz模式。响应于接收到相关显示指令或者接收到诸如3bit数据格式的图像数据，驱动电路可以停止休眠(sleep out)，并开始对图像数据进行处理，并生成相应的数据电压信号。在120ms延迟后(该时段内可以完成相应数据处理操作)，可切换至1Hz模式进行亮屏显示，从而避免60Hz下使用诸如3bit数据格式时产生的亮度损失问题。
在一些实施例中，为解决上述亮度不足问题，在第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第三预设条件时，根据预设绑点电压调整用于目标像素的数据电压信号，预设绑点电压用于指定至少一个灰阶对应的数据电压信号。如前文所分析的，在第一显示模式中使用有效数据位数量较低的数据格式时，由于补位后的像素数据对应灰阶无法达到最大灰阶(例如255)，因此存在亮度损失。由此，可以调节灰阶-亮度曲线(gamma曲线)中部分或全部绑点电压，以便在合理范围内增大整体亮度，来弥补前述亮度损失。可选地，可以调节gamma 255绑点电压来提升亮度。然而，由于绑点电压存在调节范围，不可无限调高，因此该方法虽有利于提高亮度，但提升效果往往是有限的。经实验验证，针对本公开实施例中提到的像素电路及像素驱动电路，亮度可以由60％提升至80％。可选地，当采用该方案时，可以在提供图像数据的同时提供对应的经调节的预设绑点电压，或者该经调节的预设绑点电压可以存储在驱动电路中，根据需要而被启用。
一般而言，在相关技术中，通常在设备上电、完成驱动电路内部 寄存器等的初始化后就进入显示状态。然而，如前文所描述的，在本公开的一些实施例中，像素电路的驱动包含初始化阶段和显示阶段。当***完成驱动电路初始化并对显示屏以随机信号进行驱动初始化时，此时显示屏上的显示画面将呈现为花屏，即出现开机雪花问题。这会减损用户的体验效果。在一些实施例中，为改善这一问题，在设备上电并初始化之后，并且在亮屏之前，可以接收初始化图像数据，并基于初始化图像数据确定用于各个像素的初始化电压信号。可选地，该初始化图像数据可以是单独的初始化图像数据，或者可以是正常接收的图像数据中的第一帧图像数据。
图13示意性示出了未避免开机雪花问题所采取的示例流程1300。如图所示，设备通电后，可以通过初始化代码初始化设备电路，随后准备进入60Hz模式。在停止休眠并接收到图像数据(2C/3C)后，可以在120ms后再进行亮屏显示。在该120ms内，可以基于图像数据生成相应的数据电压信号并提供至相应像素，以做好相应图像的显示准备。
如前文所示，在本公开的一些实施例中，可以支持诸如24bit、28bit、16bit、6bit、3bit等的多种数据格式。针对不同的数据格式，由于对应的bit数量不同，在相同分辨率下，针对一帧图像，数据整体传输量将不同，在传输速率一致的情况下，所需传输时间也将不同。具体而言，数据传输量与分辨率、数据格式成正比，而数据整体的传输速率(即数据的写入速率)又依赖于数据接口的速率，与该接口传输1bit数据需要的时间成反比，因此，图像数据的写入速率F＝1bit传输时间*数据格式bit数量*X*Y(其中，X、Y为分辨率)。由此，对于高bit量的数据格式而言，当数据接口的传输速率过低时，将影响画面刷新的流程度，造成画面卡顿；对于低bit量的数据格式而言，当数据接口的传输速率偏高时，虽不会对画面显示效果产生影响，但会对接口资源和接口功耗造成冗余的消耗，不利于整机功耗控制。
为避免上述问题，在一些实施例中，可以在驱动电路中提供具有不同数据传输速率的第一接口和第二接口，并可以根据预设接口规则，基于显示模式和/或像素数据中的有效数据位的数量选择第一接口或第二接口来接收所述图像数据。示例性地，预设接口规则可以指定在何种情况下使用何种接口。例如，可以在像素数据中有效数据位的数量 高于某阈值时使用传输速率更高的第一接口，并在有效数据位的数量低于该阈值时使用传输速率更低的第二接口；或者，如前文所提及的，第一显示模式通常用于常规显示需求，而第二显示模式通常用于静态图像或低频刷新图像的显示，因此也可以设定在第一显示模式下使用第一接口，而在第二模式下使用第二接口；或者，可以综合考虑两者来选择合适的接口，等等。示例性地，第一接口可以为例如MIPI接口，其速率可达几百Mbps至1Gbps，第二接口可以为例如SPI接口，其速率可以为几十Mbps。或者，也可以根据具体应用需求选择其他接口组合，或者，还可以提供多于两个接口的选择。
图14示意性示出了通过不同接口的示例状态切换流程1400。如图所示，在休眠状态下，可以通过MIPI接口的CMD模式进入60Hz模式。MIPI接口可以支持CMD模式和VIDEO模式，在CMD模式中，***端可以通过CMD+DATA形式向像素驱动电路发送命令、参数和数据，以控制像素驱动电路的行为；在VIDEO模式中，***端可以以实时像素流的形式向像素驱动电路发送数据。在60Hz模式下，可以通过MIPI接口的CMD模式更新图像，可以通过MIPI接口或者通过SPI接口进入1Hz模式。在1Hz模式下，可以通过MIPI接口或SPI接口进入60Hz模式，可以通过MIPI接口或SPI接口更新图像数据。
图15示意性示出了MIPI接口和SPI接口的应用推荐表格1500。如图表所示，对于MIPI接口，可以应用VIDEO或CMD模式，该接口可以用于60Hz及1Hz模式下的各种数据格式；对于SPI接口(此处以SPI4W接口为例)，可以应用CMD模式，其可以用于1Hz模式下的数据格式，对于60Hz模式，其可以用于各种数据格式，但对于普通的3bit、6bit数据格式，由于亮度损失较大，不推荐使用，对于配合Idle模式使用的6bit数据格式，可以在主板支持以2-2-2格式送3bit数据的条件下使用，对于配合Gamma绑点电压调节使用的3bit数据格式，亮度可以提升至80％，并可以在部分条件下使用(例如对亮度要求不高的情况等)。
根据本公开的一些实施例，还提供了一种像素驱动电路。图16示意性示出了像素驱动电路1600的示例框图。如图所示，像素驱动电路1600可以包括数据接口1610、数据处理电路1620和像素充电电路1630。
具体而言，数据接口1610可以被配置为：接收图像数据，图像数 据包括用于至少一个像素的像素数据；数据处理电路1620可以被配置为：基于图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号；像素充电电路1630可以包括第一充电电路和第二充电电路。第一充电电路可以被配置为：响应于第一使能信号有效，以第一显示模式驱动目标像素，在第一显示模式中，以第一频率更新数据电压信号，并为目标像素提供数据电压信号，使得目标像素的驱动电压被确定为数据电压信号和公共电压信号之间的电压差，其中，公共电压信号为所有像素共用的基准电压信号；第二充电电路可以被配置为响应于第二使能信号有效，以第二显示模式驱动目标像素，在第二显示模式中，以第二频率更新数据电压信号，根据用于目标像素的像素数据调整数据电压信号，并为目标像素提供调整后的数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压或最小驱动电压，其中，第二频率低于第一频率。示例性地，第一充电电路和第二充电电路可以分别如图6所示的充电路径610和充电路径620，或者也可以采取其他类似形式。
在一些实施例中，用于目标像素的像素数据可以包括至少一个有效数据位，并且其中，第二充电电路可以包括：锁存器，被配置为锁存至少一个有效数据位中的最高有效数据位；模式选择电路，被配置为：响应于至少一个有效数据位中的最高有效数据位为第一值，调整数据电压信号，使得目标像素的驱动电压被确定为最大驱动电压，以及响应于至少一个有效数据位中的最高有效数据位为第二值，调整数据电压信号，使得目标像素的驱动电压被确定为最小驱动电压。
在一些实施例中，数据处理电路包括：缓存电路，被配置为缓存图像数据中的用于预设数目个像素的像素数据；数模转换电路，被配置为将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
在一些实施例中，像素驱动电路还包括：数据电压缓存器，被配置为在第二显示模式中缓存数据电压信号。示例性地，在第二显示模式中，当接收到新的图像数据时，可以开启数据电压缓存器，并向其中写入基于新的图像数据生成的数据电压信号；当接收到切换至第一显示模式的指令时，可以开启数据电压缓存器，并写入数据电压信号。这已在前文实施例中予以描述，在此不再赘述。
应理解，像素驱动电路1600可以与前文描述的像素驱动方法100具有相同或相似的实施方式和优势，在此不再赘述。
根据本公开的一些实施例，还提供了一种显示装置，其可以包括像素驱动电路1600；液晶面板，包括多个像素，并被配置为接收来自像素驱动电路的数据电压信号；背光板，被配置为为液晶面板提供背光。图17A示意性示出了根据本公开的一些实施例的显示装置1700A的示例性框图。如图17A所示，显示装置1700A可以包括像素驱动电路1600、液晶面板1701和背光板1702。示例性地，液晶面板1701可以包括彩膜基板、阵列基板和两者之间的液晶层等结构。针对每个像素单元，可以通过阵列基板施加电场来控制液晶分子的偏转程度，从而显示相应亮度。可选地，背光板1702可以采用各种类型的直下式或侧入式背光结构，被公开对此不作具体限定。
示例性地，图17B示例性示出了根据本公开的一些实施例的显示装置1700B的示意图。如图所示，显示装置1700B可以包括液晶面板1710和像素驱动电路1720。背光板可以位于液晶面板1710下方，图17B中未示出。可选地，除液晶显示装置外，本公开提供的像素驱动电路也可以应用于其他合适类型的显示装置。像素驱动电路1720可以是前文各种实施例所描述的像素驱动电路，并可以执行前文各种实施例所描述的像素驱动方法，以驱动显示屏1710。像素驱动电路1720可以被实施为例如驱动IC的形式，并可以被固定在电路板1730上。示例性地，电路板1730可以是一般地印刷电路板(PCB)，也可以是柔性电路板(FPC)。驱动IC可以通过COF(Chip On Film，覆晶薄膜)技术等被固定在电路板1730上。
此外，根据本公开的一些实施例，还提供了一种计算设备，其可以包括像素驱动电路1600。
示例性地，图18示意性示出了根据本公开的一些实施例的计算设备1800的示例性框图。如图所示，计算设备1800可以包括显示屏1810、像素驱动装置1820和处理器1830。示例性地，像素驱动装置1820可以通过适当接口从处理器接收与显示相关的各种指令和数据，并基于这些指令和数据向显示屏中的各个像素提供数据电压信号，以便驱动相应像素显示相应亮度。像素驱动装置1820可以是前文各种实施例所描述的像素驱动电路，并可以执行前文各种实施例所描述的像素驱动 方法。显示屏1810例如可以是LCD(Liquid Crystal Display，液晶显示屏)或其他类型的显示屏。处理器1830可以是CPU(central processing unit，中央处理器)、MCU(Microcontroller Unit，微控制单元)或其他形式的处理器。
应理解，上述显示装置及计算设备也可以与前文描述的像素驱动方法100具有相同或相似的实施方式和优势，在此亦不再赘述。
以上所述，仅为本公开的具体实施方式，但本公开的保护范围并不局限于此。任何熟悉本技术领域的技术人员在本公开揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本公开的保护范围之内。因此，本公开的保护范围应以权利要求的保护范围为准。此外，在权利要求书中，词语“包括”不排除其他元件或步骤，并且“一”或“一个”不排除多个。在相互不同的从属权利要求中记载某些措施的纯粹事实并不表明这些措施的组合不能用来获利。

Claims (23)

  1. 一种像素驱动方法，包括：
    接收图像数据，所述图像数据包括用于至少一个像素的像素数据；
    基于所述图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号；
    响应于第一使能信号有效，以第一显示模式驱动所述目标像素，在所述第一显示模式中，以第一频率更新所述数据电压信号，并为所述目标像素提供所述数据电压信号，使得所述目标像素的驱动电压被确定为所述数据电压信号和公共电压信号之间的电压差，其中，所述公共电压信号为所有像素共用的基准电压信号；
    响应于第二使能信号有效，以第二显示模式驱动所述目标像素，在所述第二显示模式中，以第二频率更新所述数据电压信号，根据用于目标像素的像素数据调整所述数据电压信号，并为所述目标像素提供调整后的数据电压信号，使得所述目标像素的驱动电压被确定为最大驱动电压或最小驱动电压，其中，所述第二频率低于所述第一频率。
  2. 根据权利要求1所述的方法，其中，用于目标像素的像素数据包括至少一个有效数据位，并且其中，所述根据用于目标像素的像素数据调整所述数据电压信号，并为所述目标像素提供调整后的数据电压信号，使得所述目标像素的驱动电压被确定为最大驱动电压或最小驱动电压包括：
    响应于所述至少一个有效数据位中的最高有效数据位为第一值，调整所述数据电压信号，使得所述目标像素的驱动电压被确定为最大驱动电压；
    响应于所述至少一个有效数据位中的最高有效数据位为第二值，调整所述数据电压信号，使得所述目标像素的驱动电压被确定为最小驱动电压。
  3. 根据权利要求2所述的方法，其中，所述调整所述数据电压信号，使得所述目标像素的驱动电压被确定为最大驱动电压包括：
    在初始化时段内，将所述数据电压信号确定为第一电压信号，并依次为各像素提供有效的初始化控制信号；
    在显示时段内，将所述数据电压信号确定为与所述公共电压信号 相反，并为所述目标像素提供持续有效的显示控制信号，使得所述目标像素的驱动电压被确定为所述数据电压信号与所述公共电压信号的电压差。
  4. 根据权利要求2所述的方法，其中，所述调整所述数据电压信号，使得所述目标像素的驱动电压被确定为最小驱动电压包括：
    在初始化时段内，将所述数据电压信号确定为第二电压信号，并依次为各像素提供有效的初始化控制信号；
    在显示时段内，为所述目标像素提供无差电压信号，所述无差电压信号与所述公共电压信号相同，并为所述目标像素提供持续有效的显示控制信号，使得所述目标像素的驱动电压被确定为所述无差电压信号和所述公共电压信号之间的电压差。
  5. 根据权利要求1所述的方法，其中，所述基于所述图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号包括：
    缓存所述图像数据中的用于预设数目个像素的像素数据；
    根据预设数模转换规则，将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
  6. 根据权利要求5所述的方法，其中，所述缓存所述图像数据包括：
    响应于用于预设数目个像素的像素数据中的有效数据位的数量大于第一阈值，根据预设压缩规则对用于预设数目个像素的像素数据进行压缩，使得压缩后的像素数据中的有效数据位的数量不大于所述第一阈值。
  7. 根据权利要求6所述的方法，其中，所述将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号包括：
    对压缩后的像素数据进行解压缩；
    将解压缩后的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
  8. 根据权利要求5所述的方法，其中，所述缓存所述图像数据包括：
    响应于用于预设数目个像素的像素数据中的有效数据位的数量小于第一阈值，根据第一预设补位规则对用于预设数目个像素的像素数 据进行补位，使得补位后的图像数据中的有效数据位的数量等于所述第一阈值。
  9. 根据权利要求8所述的方法，其中，所述将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号包括：
    响应于用于目标像素电极的像素数据中的有效数据位的数量小于第二阈值，根据第二预设补位规则对所述用于目标像素电极的图像数据进行补位，使得补位后的像素数据中的有效数据位的数量等于所述第二阈值。
  10. 根据权利要求9所述的方法，其中，所述将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号还包括：
    响应于每时钟周期接收到用于至少两个像素的像素数据，将所述至少两个像素的像素数据重新分配为用于不同像素的至少两组像素数据。
  11. 根据权利要求1所述的方法，还包括：
    在所述第一显示模式中，响应于接收到切换至所述第二显示模式的指令，向模式寄存器写入针对所述第二显示模式的使能数据，在第一预设时间间隔后，基于所述模式寄存器中的使能数据，令所述第二使能信号有效。
  12. 根据权利要求1所述的方法，还包括：
    在所述第二显示模式中，响应于接收到新的图像数据，开启数据电压缓存器；
    将基于新的图像数据确定的数据电压信号写入所述数据电压缓存器；
    在第二预设时间间隔后，关闭所述数据电压存储器。
  13. 根据权利要求1所述的方法，还包括：
    在所述第二显示模式中，响应于接收到切换至所述第一显示模式的指令，向模式寄存器写入针对所述第一显示模式的使能数据，并开启数据电压缓存器；
    将数据电压信号写入所述数据电压缓存器；
    在第三预设时间间隔后，关闭所述数据电压缓存器；
    基于所述模式寄存器中的使能数据，令所述第一使能信号有效。
  14. 根据权利要求1所述的方法，还包括：在所述第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第一预设条件时，响应于接收到针对低质显示模式的使能信号，使用低质显示模式，
    其中，在所述低质显示模式中，响应于用于目标像素的像素数据中的最高有效数据位为第一值，将用于所述目标像素的像素数据置位为最大值，以及，响应于用于目标像素的像素数据中的最高有效数据位为第二值，将用于所述目标像素的像素数据置位为最小值。
  15. 根据权利要求1所述的方法，还包括：在所述第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第二预设条件时，在亮屏前使所述第二使能信号变为有效。
  16. 根据权利要求1所述的方法，还包括：在所述第一显示模式中，当用于目标像素的像素数据中的有效数据位的数量符合第三预设条件时，根据预设绑点电压调整用于目标像素的数据电压信号，其中，所述预设绑点电压用于指定至少一个灰阶对应的数据电压信号。
  17. 根据权利要求1所述的方法，其中，所述接收图像数据包括：
    在设备上电并初始化之后，并且在亮屏之前，接收初始化图像数据，并基于所述初始化图像数据确定用于各个像素的初始化电压信号。
  18. 根据权利要求1所述的方法，其中，所述接收图像数据包括：
    根据预设接口规则，基于显示模式和/或像素数据中的有效数据位的数量选择第一接口或第二接口来接收所述图像数据，其中，所述第一接口和第二接口具有不同的数据传输速率。
  19. 一种像素驱动电路，包括：
    数据接口，被配置为：接收图像数据，所述图像数据包括用于至少一个像素的像素数据；
    数据处理电路，被配置为：基于所述图像数据中的用于目标像素的像素数据，确定用于目标像素的数据电压信号；
    像素电极驱动电路，包括第一充电电路和第二充电电路，
    其中，所述第一充电电路被配置为：响应于第一使能信号有效，以第一显示模式驱动所述目标像素，在所述第一显示模式中，以第一频率更新所述数据电压信号，并为所述目标像素提供所述数据电压信号，使得所述目标像素的驱动电压被确定为所述数据电压信号和公共 电压信号之间的电压差，其中，所述公共电压信号为所有像素共用的基准电压信号，以及
    其中，所述第二充电电路被配置为：响应于第二使能信号有效，以第二显示模式驱动所述目标像素，在所述第二显示模式中，以第二频率更新所述数据电压信号，根据用于目标像素的像素数据调整所述数据电压信号，并为所述目标像素提供调整后的数据电压信号，使得所述目标像素的驱动电压被确定为最大驱动电压或最小驱动电压，其中，所述第二频率低于所述第一频率。
  20. 根据权利要求19所述的像素驱动电路，其中，用于目标像素的像素数据包括至少一个有效数据位，并且其中，所述第二充电电路包括：
    锁存器，被配置为锁存所述至少一个有效数据位中的最高有效数据位；
    模式选择电路，被配置为：响应于所述至少一个有效数据位中的最高有效数据位为第一值，调整所述数据电压信号，使得所述目标像素的驱动电压被确定为最大驱动电压，以及响应于所述至少一个有效数据位中的最高有效数据位为第二值，调整所述数据电压信号，使得所述目标像素的驱动电压被确定为最小驱动电压。
  21. 根据权利要求19所述的像素驱动电路，其中，所述数据处理电路包括：
    缓存电路，被配置为缓存所述图像数据中的用于预设数目个像素的像素数据；
    数模转换电路，被配置为将所缓存的像素数据中的用于目标像素的像素数据转换为用于目标像素的数据电压信号。
  22. 根据权利要求19所述的像素驱动电路，还包括：
    数据电压缓存器，被配置为在所述第二显示模式中缓存所述数据电压信号。
  23. 一种显示装置，包括：
    根据权利要求19所述的像素驱动电路；
    液晶面板，包括多个像素，并被配置为接收来自所述像素驱动电路的数据电压信号；
    背光板，被配置为为所述液晶面板提供背光。
CN202280002588.7A 2022-08-09 2022-08-09 像素驱动方法、像素驱动电路和显示装置 Pending CN117859170A (zh)

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