CN117594020A - 显示装置 - Google Patents

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Abstract

提供了显示装置。显示装置包括：包括用于响应于第一电力和第二电力而产生光的多个像素的像素单元；用于将第一电力供给到第一电力线以及将第二电力供给到第二电力线的电源；以及用于在多个像素处于关闭状态时将第一电力线和第二电力线的电压进行放电并且在预定时间之后使第一电力线和第二电力线处于高阻抗状态的保护电路。

Description

显示装置
相关申请的交叉引用
本申请要求2022年8月11日提交的韩国专利申请第10-2022-0100726号的优先权，该韩国专利申请的公开内容通过引用以其整体并入本文中。
技术领域
本公开涉及显示装置和驱动显示装置的方法。
背景技术
随着信息技术发展，作为用户与信息之间的连接介质的显示装置起主要作用。因此，诸如液晶显示装置和有机发光显示装置的高质量显示装置的使用正在增加。
显示装置包括其中设置有多个像素的像素单元。多个像素中的每个响应于数据信号而产生预定亮度的光，并且因此预定图像显示在像素单元中。多个像素可以从共同连接的多个电力线接收预定电压。在此情况下，当像素单元被关闭时(例如，当所有像素被设置成关闭状态时)，由于多个电力线中残留的电压，可能在像素单元中显示异常屏幕(例如，闪烁现象)。为了防止闪烁现象，使用用于在像素单元被关闭时将多个电力线的电压进行放电的保护电路。
发明内容
本公开的实施方式提供了显示装置和驱动显示装置的方法，其中当多个电力线被放电时，防止外部泄漏电流被供给到多个电力线。
根据本公开的实施方式，提供了显示装置，包括：像素单元，包括用于响应于第一电力和第二电力而产生光的多个像素；电源，用于将第一电力供给到第一电力线以及将第二电力供给到第二电力线；以及保护电路，用于在多个像素处于关闭状态时将第一电力线和第二电力线的电压进行放电并且在预定时间之后使第一电力线和第二电力线处于高阻抗状态。
电源在多个像素处于关闭状态时不将第一电力供给到第一电力线并且不将第二电力供给到第二电力线。
显示装置还包括：时序控制器，被配置为在多个像素处于关闭状态时将使能电平的第一控制信号供给到保护电路并且在多个像素处于打开状态时将禁用电平的第一控制信号供给到保护电路。
保护电路包括：第一保护晶体管，连接在第一电力线与地电位之间，其中第一保护晶体管响应于第一驱动信号而被导通；第二保护晶体管，连接在第二电力线与地电位之间，其中第二保护晶体管响应于第二驱动信号而被导通；控制器，被配置为在禁用电平的第一控制信号被供给时生成使能电平的第二控制信号并且在使能电平的第一控制信号被供给之后的预定时间之后生成禁用电平的第二控制信号；以及驱动器，被配置为在使能电平的第一控制信号和使能电平的第二控制信号被供给时将第一驱动信号供给到第一保护晶体管并且将第二驱动信号供给到第二保护晶体管。
预定时间是10帧或更少的时间。
控制器包括：延迟单元，被配置为在使能电平的第一控制信号被供给之后的预定时间之后生成计数信号；以及信号发生器，被配置为在计数信号从延迟单元被供给时生成禁用电平的第二控制信号并且将禁用电平的第二控制信号供给到驱动器。
延迟单元是计数器。
驱动器包括：第一逻辑电路单元，被配置为在使能电平的第一控制信号和使能电平的第二控制信号被供给时将第一驱动信号供给到第一保护晶体管；以及第二逻辑电路单元，被配置为在使能电平的第一控制信号和使能电平的第二控制信号被供给时将第二驱动信号供给到第二保护晶体管。
第一逻辑电路单元和第二逻辑电路单元中的每个是与门。
保护电路包括：第一电阻器，连接在第一保护晶体管与地电位之间；第一二极管，连接在第一电力线与地电位之间；第一电容器，连接在第一电力线与地电位之间；第二电阻器，连接在第二保护晶体管与地电位之间；第二二极管，连接在第二电力线与地电位之间；以及第二电容器，连接在第二电力线与地电位之间。
根据本公开的实施方式，提供了驱动显示装置的方法，显示装置包括用于使用供给到第一电力线的第一电力和供给到第二电力线的第二电力来显示图像的多个像素，该方法包括：当图像显示在多个像素中时，将第一电力供给到第一电力线以及将第二电力供给到第二电力线；当多个像素被关闭时，停止将第一电力供给到第一电力线以及将第二电力供给到第二电力线；将第一电力线和第二电力线连接到地电位；以及在第一电力线和第二电力线连接到地电位之后，使第一电力线和第二电力线处于高阻抗状态。
预定时间是10帧内的时间。
连接在第一电力线与地电位之间的第一保护晶体管在第一电力被供给到第一电力线时处于关断状态，并且连接在第二电力线与地电位之间的第二保护晶体管在第二电力被供给到第二电力线时处于关断状态。
当将第一电力线和第二电力线连接到地电位时，第一保护晶体管和第二保护晶体管处于导通状态。
在预定时间之后，第一保护晶体管和第二保护晶体管处于关断状态。
根据本公开的实施方式，提供了显示装置，包括：以矩阵形式布置的多个像素，其中多个像素通过第一电力线被提供有第一电力并且通过第二电力线被提供有第二电力；用于供给第一电力和第二电力的电源；以及连接到第一电力线和第二电力线的保护电路，其中保护电路被配置为响应于具有使能电平的第一控制信号而将第一电力线和第二电力线上的电压进行放电。
保护电路还被配置为在第一电力线和第二电力线上的电压被放电之后使第一电力线和第二电力线处于高阻抗状态。
保护电路包括控制器和驱动器，其中控制器和驱动器被配置为各自接收第一控制信号。
保护电路包括连接在驱动器与第一电力线之间的第一晶体管以及连接在驱动器与第二电力线之间的第二晶体管。
第一控制信号在多个像素被关闭时具有使能电平。
按照根据本公开的实施方式的显示装置和驱动显示装置的方法，可以通过在多个电力线被放电之后将多个电力线设置成高阻抗状态来防止外部泄漏电流被供给到多个电力线。
附图说明
通过参考附图进一步详细描述本公开的实施方式，本公开的上述及其它特征将变得更清楚，在附图中：
图1是图示根据本公开的实施方式的显示装置的图；
图2A和图2B是图示当像素单元被关闭时与保护电路的存在或不存在相对应的多个电力线的电压的图；
图3是图示根据本公开的实施方式的像素的图；
图4是图示驱动图3中所示的像素的方法的图；
图5是图示根据本公开的实施方式的保护电路的图；
图6和图7是图示图5中所示的控制器的实施方式的图；
图8是图示图5中所示的驱动器的实施方式的图；
图9A和图9B是图示根据本公开的实施方式的保护电路的操作过程的图；
图10是图示根据本公开的另一实施方式的保护电路的图；并且
图11是图示根据本公开的实施方式的驱动显示装置的方法的图。
具体实施方式
在下文中，将参考附图详细描述本公开的各个实施方式。本公开可以以各种不同的形式来实现，并且不限于本文中描述的实施方式。
为了清楚地描述本公开，省略了对于描述不必要的部分，并且在整个说明书中，相同或相似的元件由相同的参考标记表示。
另外，本描述中的表述“相同”可以意味着“实质上相同”。
图1是图示根据本公开的实施方式的显示装置的图。图2A和图2B是图示当像素单元被关闭时与保护电路的存在或不存在相对应的多个电力线的电压的图。
参考图1，根据本公开的实施方式的显示装置1包括处理器150、时序控制器100、像素单元110、数据驱动器120、扫描(或栅)驱动器130、发射驱动器140、电源160和保护电路170。上述元件中的每个可以被实现为单独的集成电路，并且这些元件中的两个或更多个可以被集成到一个集成电路中。
时序控制器100可以从处理器150接收与帧时段相对应的输入数据和时序信号。这里，处理器150可以与图形处理单元(GPU)、中央处理单元(CPU)和应用处理器(AP)中的至少一个相对应。时序信号可以包括垂直同步信号、水平同步信号、数据使能信号等。
时序控制器100可以通过重排(rearrange)输入数据来生成图像数据，并且可以将图像数据供给到数据驱动器120。
时序控制器100可以使用时序信号来生成用于控制数据驱动器120、扫描驱动器130、发射驱动器140和电源160的控制信号。当像素单元110被关闭时，时序控制器100可以生成第一控制信号CS1的使能(enable)，并且将第一控制信号CS1的使能供给到保护电路170。时序控制器100可以在像素单元110被正常驱动时将第一控制信号CS1的禁用(disable)供给到保护电路170。第一控制信号CS1的使能可以是指其中第一控制信号CS1具有使能电平的情况，并且第一控制信号CS1的禁用可以是指其中第一控制信号CS1具有禁用电平的情况。
这里，其中像素单元110被正常驱动的情况可以意味着其中预定图像被显示在像素单元110中的情况。换句话说，其中像素单元110被正常驱动的情况可以意味着其中多个像素被打开以显示图像的情况。另外，其中像素单元110被关闭的情况可以意味着其中由于多个像素被关闭而不显示图像的情况。
可以使用各种方法作为从时序控制器100供给第一控制信号CS1的方法。例如，当从处理器150供给与像素单元110的关闭相对应的信号时，时序控制器100可以控制数据驱动器120、扫描驱动器130和发射驱动器140以关闭像素单元110。另外，时序控制器100可以在与像素单元110的关闭相对应的信号被供给时将第一控制信号CS1的使能供给到保护电路170，并且可以在其他情况下将第一控制信号CS1的禁用供给到保护电路170。
数据驱动器120从时序控制器100接收图像数据和控制信号。当数据驱动器120接收图像数据和控制信号时，其生成与图像数据的灰度相对应的数据信号。当数据驱动器120生成数据信号时，其可以将数据信号供给到数据线DL1、DL2、DL3、DL4、……和DLn(n为大于0的整数)以与扫描信号同步。
扫描驱动器130从时序控制器100接收控制信号。当扫描驱动器130接收控制信号时，其将扫描信号供给到扫描线SL0、SL1、SL2、……和SLm(m为大于0的整数)。例如，扫描驱动器130可以将扫描信号顺序地供给到扫描线SL0至SLm。这里，扫描信号可以被设置成栅极导通电压，使得供给有扫描信号的晶体管被导通。
发射驱动器140从时序控制器100接收控制信号。当发射驱动器140接收控制信号时，其将发射控制信号供给到发射控制线EL1、EL2、EL3、……和ELo(o为大于0的整数)。例如，发射驱动器140可以将发射控制信号顺序地供给到发射控制线EL1至ELo。这里，发射控制信号可以被设置成栅极关断电压，使得供给有发射控制信号的晶体管被关断。
像素单元110包括多个像素。多个像素可以以矩阵形式布置。每个像素PXij(i和j为大于0的整数)可以连接到对应的数据线、扫描线和发射控制线。当扫描信号被供给到扫描线SL0至SLm时，多个像素以水平线为单位被选择(例如，连接到同一扫描线的多个像素可以被划分成一条水平线(或行线))，并且通过扫描信号选择的多个像素从与其连接的数据线接收数据信号。接收数据信号的多个像素可以响应于数据信号的电压(换句话说，灰度)而产生预定亮度的光。
多个像素可以发射第一颜色、第二颜色和第三颜色中的任一种颜色的光。这里，第一颜色、第二颜色和第三颜色可以是不同的颜色。例如，第一颜色可以是红色，第二颜色可以是绿色，并且第三颜色可以是蓝色。另外，第一颜色可以是品红色，第二颜色可以是青色，并且第三颜色可以是黄色。
电源160可以将(图3中所示的)第一电力VDD的电压供给到第一电力线VDDL，并且将(图3中所示的)第二电力VSS的电压供给到第二电力线VSSL。
电源160可以经由第一电力线VDDL将第一电力VDD的电压供给到包含在像素单元110中的多个像素。多个像素可以共同连接到第一电力线VDDL以接收同一第一电力VDD的电压。
电源160可以经由第二电力线VSSL将第二电力VSS的电压供给到包含在像素单元110中的多个像素。多个像素可以共同连接到第二电力线VSSL以从第二电力VSS接收相同的电压。在像素单元110的显示时段期间，第一电力VDD可以被设置成比第二电力VSS的电压高的电压。
用于生成第一电力VDD和第二电力VSS的电路中的每个可以是电压转换器。例如，用于生成第一电力VDD和第二电力VSS中的每个的电路可以被实现为降压转换器、升压转换器和降压-升压转换器中的至少一个。
另外，当像素单元110被关闭时，电源160不将第一电力VDD供给到第一电力线VDDL，并且不将第二电力VSS供给到第二电力线VSSL。当像素单元110被关闭时，由于多个像素被设置成非发射状态，因此为了降低功耗，电源160可以不将第一电力VDD和第二电力VSS分别供给到第一电力线VDDL和第二电力线VSSL。
保护电路170可以连接到第一电力线VDDL和第二电力线VSSL，并且可以在第一控制信号CS1的使能被供给时将第一电力线VDDL和第二电力线VSSL的电压放电至地电位GND的电压。
更具体地，当像素单元110被关闭时，多个像素被设置成关闭状态。此时，当保护电路170未被驱动时，第一电力线VDDL如图2A中所示从先前供给的第一电力VDD(例如，大约5V)逐渐降低到低电压，并且第二电力线VSSL如图2A中所示从先前供给的第二电力VSS(例如，大约-5V)逐渐增加到高电压。如上所述，当第一电力线VDDL和第二电力线VSSL的电压被逐渐放电时，可能在像素单元110中出现闪烁现象。
为了防止这种情况，时序控制器100可以在像素单元110被关闭时将第一控制信号CS1的使能供给到保护电路170。接收第一控制信号CS1的使能的保护电路170可以如图2B中所示将第一电力线VDDL和第二电力线VSSL的电压(例如，VDD和VSS)快速放电至地电位GND的电压(例如，大约0V)，并且因此可以防止闪烁现象出现在像素单元110中。
另外，保护电路170可以在第一电力线VDDL和第二电力线VSSL被放电之后的预定时间之后将第一电力线VDDL和第二电力线VSSL设置成高阻抗状态。当第一电力线VDDL和第二电力线VSSL被设置成高阻抗状态时，可以防止来自数据线DL1至DLn的泄漏电流被供给到第一电力线VDDL和第二电力线VSSL，并且因此可以防止由于泄漏电流引起的烧毁现象。稍后给出与此有关的详细描述。
图3是图示根据本公开的实施方式的像素的图。在图3中，示出了定位在第i水平线且在第j垂直线上的像素。
参考图3，根据本公开的实施方式的像素PXij包括第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6和第七晶体管T7、存储电容器Cst和发光元件LD。
在图3中，作为示例描述了由P型晶体管配置的电路。然而，本领域的技术人员将能够通过改变施加到栅电极的电压的极性来配置N型晶体管的电路。类似地，本领域的技术人员将能够设计由P型和N型晶体管的组合配置的电路。晶体管可以被配置成各种形式，诸如薄膜晶体管(TFT)、场效应晶体管(FET)和双极结型晶体管(BJT)。
发光元件LD可以连接在对其供给有第一电力VDD的第一电力线VDDL与对其供给有第二电力VSS的第二电力线VSSL之间。例如，发光元件LD的第一电极可以经由第六晶体管T6、第一晶体管T1和第五晶体管T5连接到第一电力线VDDL，并且发光元件LD的第二电极可以连接到对其供给有第二电力VSS的第二电力线VSSL。发光元件LD可以发射具有与从第一晶体管T1供给的电流的量相对应的亮度的光。
发光元件LD可以是有机发光二极管。另外，发光元件LD可以是诸如微型发光二极管(LED)或量子点发光二极管的无机发光二极管。另外，发光元件LD可以是其中有机材料和无机材料结合的元件。尽管像素PXij在图3中被示出为包括单个发光元件LD，但是在另一实施方式中，像素PXij可以包括多个发光元件LD，并且多个发光元件LD可以彼此串联、并联或串并联连接。
第一晶体管T1的第一电极连接到第二节点N2，并且第一晶体管T1的第二电极连接到第三节点N3。另外，第一晶体管T1的栅电极连接到第一节点N1。第一晶体管T1可以响应于第一节点N1的电压来控制从第一电力VDD经由发光元件LD流到第二电力VSS的电流的量。
第二晶体管T2连接在数据线DLj与第二节点N2之间。另外，第二晶体管T2的栅电极连接到第一扫描线SLi1。第二晶体管T2可以在第一扫描信号被供给到第一扫描线SLi1时被导通，以电连接数据线DLj和第二节点N2。
第三晶体管T3连接在第一晶体管T1的第二电极(或第三节点N3)与第一晶体管T1的栅电极(或第一节点N1)之间。另外，第三晶体管T3的栅电极连接到第二扫描线SLi2。第三晶体管T3在第二扫描信号被供给到第二扫描线SLi2时被导通，以电连接第一节点N1和第三节点N3。当第一节点N1和第三节点N3电连接时，第一晶体管T1以二极管形式连接。
第四晶体管T4连接在第一节点N1与初始化电力线INTL之间。另外，第四晶体管T4的栅电极连接到第三扫描线SLi3。第四晶体管T4在第三扫描信号被供给到第三扫描线SLi3时被导通，以电连接第一节点N1和初始化电力线INTL。在此情况下，初始化电力线INTL的初始化电压可以被供给到第一节点N1。这里，初始化电压可以被设置成比数据信号的电压低的电压。
第五晶体管T5连接在第一电力线VDDL与第二节点N2之间。另外，第五晶体管T5的栅电极连接到发射控制线ELi。第五晶体管T5在发射控制信号被供给到发射控制线ELi时被关断，并且在其它情况下被导通。
第六晶体管T6连接在第三节点N3与发光元件LD的第一电极之间。另外，第六晶体管T6的栅电极连接到发射控制线ELi。第六晶体管T6在发射控制信号被供给到发射控制线ELi时被关断，并且在其它情况下被导通。
另外，尽管第五晶体管T5和第六晶体管T6在图3中连接到同一发射控制线ELi，但是本公开不限于此。例如，第五晶体管T5和第六晶体管T6可以连接到不同的发射控制线。
第七晶体管T7连接在发光元件LD的第一电极与初始化电力线INTL之间。另外，第七晶体管T7的栅电极连接到第四扫描线SLi4。第七晶体管T7在第四扫描信号被供给到第四扫描线SLi4时被导通，以将初始化电力线INTL的初始化电压供给到发光元件LD的第一电极。
存储电容器Cst连接在第一电力线VDDL与第一节点N1之间。存储电容器Cst存储施加到第一节点N1的电压。
图4是图示驱动图3中所示的像素的方法的图。
在图3和图4中，为了便于描述，假设其中第一扫描线SLi1、第二扫描线SLi2和第四扫描线SLi4是第i扫描线SLi并且第三扫描线SLi3是第(i-1)扫描线SL(i-1)的情况。然而，第一扫描线SLi1、第二扫描线SLi2、第三扫描线SLi3和第四扫描线SLi4的连接关系可以根据实施方式而变化。
参考图4，首先，发射控制信号被供给到发射控制线ELi，并且与第(i-1)水平线相对应的数据信号DATA(i-1)j被供给到数据线DLj。然后，扫描信号被供给到第(i-1)扫描线SL(i-1)。
当扫描信号被供给到第(i-1)扫描线SL(i-1)时，第四晶体管T4被导通。当第四晶体管T4被导通时，初始化电压从初始化电力线INTL被供给到第一节点N1。在此情况下，由于第二晶体管T2被设置成关断状态，因此数据信号DATA(i-1)j不被供给到第二节点N2。
当发射控制信号被供给到发射控制线ELi时，第五晶体管T5和第六晶体管T6被关断。当第五晶体管T5和第六晶体管T6被关断时，发光元件LD被设置成非发射状态。
其后，与第i水平线相对应的数据信号DATAij被供给到数据线DLj，并且扫描信号被供给到第i扫描线SLi。当扫描信号被供给到第i扫描线SLi时，第二晶体管T2、第三晶体管T3和第七晶体管T7被导通。
当第二晶体管T2被导通时，数据线DLj和第二节点N2电连接。然后，数据信号DATAij从数据线DLj被供给到第二节点N2。
当第三晶体管T3被导通时，第一晶体管T1以二极管形式连接。当第一晶体管T1以二极管形式连接时，第二节点N2和第一节点N1电连接。因此，供给到第二节点N2的数据信号DATAij经由第一晶体管T1和第三晶体管T3被供给到第一节点N1。在此情况下，通过从数据信号DATAij的电压减去第一晶体管T1的阈值电压而获得的补偿电压被施加到第一节点N1，并且存储电容器Cst存储补偿电压。
当第七晶体管T7被导通时，发光元件LD的第一电极和初始化电力线INTL电连接，并且因此发光元件LD的第一电极被初始化为初始化电压。
其后，停止将发射控制信号供给到发射控制线ELi，并且因此第五晶体管T5和第六晶体管T6被导通。当第五晶体管T5被导通时，第一电力线VDDL和第二节点N2电连接。当第六晶体管T6被导通时，第三节点N3和发光元件LD电连接。在此情况下，第一晶体管T1响应于第一节点N1的电压(换句话说，补偿电压)来控制从第一电力VDD经由发光元件LD供给到第二电力VSS的电流的量。
通过存储在存储电容器Cst中的补偿电压来控制供给到发光元件LD的电流的量。发光元件LD发射具有与供给到发光元件LD的电流的量相对应的亮度的光。
当未供给发射控制信号时(例如，当发射控制信号被设置成导通电平时)，接收对应的发射控制信号的像素可以处于显示状态。因此，其中不供给发射控制信号的时段可以被称为发射时段EP。另外，当发射控制信号被供给时(例如，当发射控制信号被设置成关断电平时)，接收对应的发射控制信号的像素被设置成非发射状态。因此，其中供给发射控制信号的时段可以被称为非发射时段NEP。
在图4中，非发射时段NEP用于防止像素PXij在不期望的时段期间发射光。在其中被写入到像素PXij的补偿电压被保持的时段(例如，一个帧时段)期间，可以另外提供一个或多个非发射时段NEP。这可以通过减少像素PXij的发射时段EP来有效地表达低灰度，或者平滑地模糊图像的运动。
图5是图示根据本公开的实施方式的保护电路的图。图6和图7是图示图5中所示的控制器的实施方式的图。
参考图5，根据本公开的实施方式的保护电路170包括控制器500、驱动器502以及保护晶体管。保护晶体管可以包括第一保护晶体管MP1和第二保护晶体管MP2。
控制器500可以在第一控制信号CS1的禁用被供给时将第二控制信号CS2的使能供给到驱动器502。另外，控制器500可以在第一控制信号CS1的使能被供给之后的预定时间之后将第二控制信号CS2的禁用供给到驱动器502。第二控制信号CS2的使能可以是指其中第二控制信号CS2具有使能电平的情况，并且第二控制信号CS2的禁用可以是指其中第二控制信号CS2具有禁用电平的情况。
这里，预定时间可以是指其中在像素单元110被关闭之后第一电力线VDDL和第二电力线VSSL被放电的时间，并且可以考虑面板的尺寸、分辨率等以实验方式来确定。例如，预定时间可以被设置成10帧或更少的时间(例如，2帧的时间)。
时序控制器100可以在像素单元110被关闭时将第一控制信号CS1的使能供给到控制器500和驱动器502。另外，当像素单元110被正常驱动时，时序控制器100可以将第一控制信号CS1的禁用供给到控制器500和驱动器502。例如，时序控制器100可以在像素单元110被打开时将第一控制信号CS1的禁用供给到控制器500和驱动器502。
另外，第一控制信号CS1的使能可以被设置成高电平电压，并且第一控制信号CS1的禁用可以被设置成低电平电压。类似地，第二控制信号CS2的使能可以被设置成高电平电压，并且第二控制信号CS2的禁用可以被设置成低电平电压。然而，在本公开的实施方式中，第一控制信号CS1和第二控制信号CS2的电压电平可以根据需要进行各种改变。
控制器500可以包括如图6中所示的延迟单元600和信号发生器602。
当第一控制信号CS1的使能被供给时，延迟单元600可以在预定时间之后生成计数信号，并且将计数信号供给到信号发生器602。例如，延迟单元600可以在第一控制信号CS1的使能被供给之后的10帧内的时间之后生成计数信号，并且将计数信号供给到信号发生器602。另外，延迟单元600在第一控制信号CS1的禁用被供给时不将计数信号供给到信号发生器602。
为此，延迟单元600可以是如图7中所示的计数器604，但是本公开不限于此。例如，延迟单元600可以具有能够在第一控制信号CS1的使能被供给之后的预定时间之后生成计数信号的各种配置。
当计数信号未被供给时，信号发生器602可以生成第二控制信号CS2的使能，并且将第二控制信号CS2的使能供给到驱动器502。另外，当计数信号被供给时，信号发生器602可以生成第二控制信号CS2的禁用，并且将第二控制信号CS2的禁用供给到驱动器502。
第一保护晶体管MP1连接在第一电力线VDDL与地电位GND之间。第一保护晶体管MP1在驱动器502的控制下被导通或关断。例如，第一保护晶体管MP1在从驱动器502供给第一驱动信号DS1时被导通，并且在其他情况下被关断。当第一保护晶体管MP1被导通时，第一电力线VDDL和地电位GND电连接。
第二保护晶体管MP2连接在第二电力线VSSL与地电位GND之间。第二保护晶体管MP2在驱动器502的控制下被导通或关断。例如，第二保护晶体管MP2在从驱动器502供给第二驱动信号DS2时被导通，并且在其他情况下被关断。当第二保护晶体管MP2被导通时，第二电力线VSSL和地电位GND电连接。
驱动器502从控制器500接收第二控制信号CS2，并且从时序控制器100接收第一控制信号CS1。驱动器502可以在第一控制信号CS1的使能和第二控制信号CS2的使能被供给时将第一驱动信号DS1和第二驱动信号DS2分别供给到第一保护晶体管MP1和第二保护晶体管MP2。
另外，驱动器502在第一控制信号CS1的禁用或第二控制信号CS2的禁用被供给时不将第一驱动信号DS1和第二驱动信号DS2分别供给到第一保护晶体管MP1和第二保护晶体管MP2。
另外，第一电阻器R1可以连接在第一保护晶体管MP1与地电位GND之间，并且第二电阻器R2可以连接在第二保护晶体管MP2与地电位GND之间。
图8是图示图5中所示的驱动器的实施方式的图。
参考图8，驱动器502可以包括第一逻辑电路单元504和第二逻辑电路单元506。
第一逻辑电路单元504可以在第一控制信号CS1的使能和第二控制信号CS2的使能被供给时生成第一驱动信号DS1并且将第一驱动信号DS1供给到第一保护晶体管MP1。当第一驱动信号DS1被供给时，第一保护晶体管MP1可以被导通。第一逻辑电路单元504可以是与门。这里，第一逻辑电路单元504在第一控制信号CS1的禁用或第二控制信号CS2的禁用被供给时不生成第一驱动信号DS1。当未生成第一驱动信号DS1时，第一保护晶体管MP1可以被设置成关断状态。
第二逻辑电路单元506可以在第一控制信号CS1的使能和第二控制信号CS2的使能被供给时生成第二驱动信号DS2并且将第二驱动信号DS2供给到第二保护晶体管MP2。当第二驱动信号DS2被供给时，第二保护晶体管MP2可以被导通。第二逻辑电路单元506可以是与门。这里，第二逻辑电路单元506在第一控制信号CS1的禁用或第二控制信号CS2的禁用被供给时不生成第二驱动信号DS2。当未生成第二驱动信号DS2时，第二保护晶体管MP2可以被设置成关断状态。
图9A和图9B是图示根据本公开的实施方式的保护电路的操作过程的图。
首先，当像素单元110被正常驱动时，第一控制信号CS1的禁用从时序控制器100被供给到保护电路170。第一控制信号CS1的禁用被供给到保护电路170的延迟单元600、第一逻辑电路单元504和第二逻辑电路单元506。
当延迟单元600接收第一控制信号CS1的禁用时，其不将计数信号供给到信号发生器602。当计数信号未被供给时，信号发生器602可以生成第二控制信号CS2的使能，并且将第二控制信号CS2的使能供给到驱动器502。
在此情况下，第一逻辑电路单元504和第二逻辑电路单元506接收第二控制信号CS2的使能(例如，高电平电压)和第一控制信号CS1的禁用(例如，低电平电压)。然后，第一逻辑电路单元504不生成第一驱动信号DS1并且第二逻辑电路单元506不生成第二驱动信号DS2。在此情况下，低电平电压被供给到第一保护晶体管MP1和第二保护晶体管MP2的栅电极，并且因此第一保护晶体管MP1和第二保护晶体管MP2被设置成关断状态。
当第一保护晶体管MP1和第二保护晶体管MP2被设置成关断状态时，第一电力线VDDL和第二电力线VSSL不连接到地电位GND。在此情况下，第一电力线VDDL可以保持第一电力VDD的电压，并且第二电力线VSSL可以保持第二电力VSS的电压。因此，在其中供给第一控制信号CS1的禁用的时段期间，像素单元110的多个像素可以正常产生预定亮度的光。
当像素单元110被关闭时，例如，当多个像素中的全部被设置成非发射状态时，时序控制器100将第一控制信号CS1的使能供给到保护电路170。第一控制信号CS1的使能被供给到保护电路170的延迟单元600、第一逻辑电路单元504和第二逻辑电路单元506。
当延迟单元600接收第一控制信号CS1的使能时，其在预定时间之后生成计数信号，并且将计数信号供给到信号发生器602。当计数信号被供给时，信号发生器602可以生成第二控制信号CS2的禁用，并且将第二控制信号CS2的禁用供给到驱动器502。
然而，在第一控制信号CS1的使能被供给之后的预定时间期间可以不从延迟单元600供给计数信号，并且信号发生器602可以在预定时间期间将第二控制信号CS2的使能供给到驱动器502。
当第一控制信号CS1的使能被供给时，第一逻辑电路单元504接收第二控制信号CS2的使能。在此情况下，第一逻辑电路单元504生成第一驱动信号DS1，并且将第一驱动信号DS1供给到第一保护晶体管MP1。
当第一保护晶体管MP1接收第一驱动信号DS1时，其被设置成导通状态。当第一保护晶体管MP1被导通时，第一电力线VDDL的电压被放电至地电位GND的电压，如图9A中所示。如上所述，当第一电力线VDDL的电压在像素单元110被关闭时被放电至地电位GND的电压时，可以防止像素单元110闪光的闪烁现象。
当第一控制信号CS1的使能被供给时，第二逻辑电路单元506接收第二控制信号CS2的使能。在此情况下，第二逻辑电路单元506生成第二驱动信号DS2，并且将第二驱动信号DS2供给到第二保护晶体管MP2。
当接收第二驱动信号DS2的第二保护晶体管MP2被设置成导通状态时，并且当第二保护晶体管MP2被导通时，第二电力线VSSL的电压增加至地电位GND的电压，如图9A中所示。如上所述，当第二电力线VSSL的电压在像素单元110被关闭时增加至地电位GND的电压时，可以防止像素单元110闪光的闪烁现象。
第一逻辑电路单元504和第二逻辑电路单元506可以在预定时间期间将第一驱动信号DS1和第二驱动信号DS2分别供给到第一保护晶体管MP1和第二保护晶体管MP2，并且因此第一保护晶体管MP1和第二保护晶体管MP2可以在预定时间期间被设置成导通状态。这里，预定时间可以被设置成如上所述的10帧内的时段，并且例如，可以以实验方式被设置成使得第一电力线VDDL和第二电力线VSSL的电压可以被稳定地放电。
第二控制信号CS2的禁用在预定时间之后被供给到第一逻辑电路单元504和第二逻辑电路单元506中的每个。当第二控制信号CS2的禁用被供给时，第一逻辑电路单元504中不生成第一驱动信号DS1并且第二逻辑电路单元506中不生成第二驱动信号DS2，并且因此第一保护晶体管MP1和第二保护晶体管MP2被设置成关断状态。
如图9B中所示，当第一保护晶体管MP1和第二保护晶体管MP2被设置成关断状态时，第一电力线VDDL和第二电力线VSSL被设置成高阻抗状态(当像素单元110被关闭时，第一电力VDD和第二电力VSS不从电源160分别供给到第一电力线VDDL和第二电力线VSSL)。当第一电力线VDDL和第二电力线VSSL被设置成高阻抗状态时，可以防止由于泄漏电流引起的烧毁现象。
更具体地，在其中用户使用显示装置1的过程期间可能发生第一电力线VDDL和第二电力线VSSL与其它布线电接触的情况。在此情况下，当第一保护晶体管MP1和第二保护晶体管MP2被连续地设置成导通状态时，可能发生来自数据线DL1至DLn的泄露电流，并且因此可能发生烧毁现象。
另一方面，如在本公开中，当第一电力线VDDL和第二电力线VSSL在预定时间之后被设置成高阻抗状态时，泄漏电流可以不被供给到第一电力线VDDL和第二电力线VSSL，并且因此可以防止由于泄露电流引起的烧毁现象。
图10是图示根据本公开的另一实施方式的保护电路的图。当描述图10时，相同的附图标记被分配给与图5的配置相同的配置，并且其详细描述被省略。
参考图10，根据本公开的实施方式的保护电路170包括控制器500、驱动器502、第一保护晶体管MP1和第二保护晶体管MP2、第一二极管D1和第二二极管D2以及第一电容器C1和第二电容器C2。
第一二极管D1可以连接在第一电力线VDDL与地电位GND之间。第一二极管D1也可以连接到第一保护晶体管MP1。第一二极管D1可以防止第一电力线VDDL超过预定电压。例如，第一二极管D1可以是触发二极管。
第一电容器C1可以连接在第一电力线VDDL与地电位GND之间。第一电容器C1可以稳定地保持第一电力线VDDL的电压。
第二二极管D2可以连接在第二电力线VSSL与地电位GND之间。第二二极管D2也可以连接到第二保护晶体管MP2。第二二极管D2可以防止第二电力线VSSL超过预定电压。例如，第二二极管D2可以是触发二极管。
第二电容器C2可以连接在第二电力线VSSL与地电位GND之间。第二电容器C2可以稳定地保持第二电力线VSSL的电压。
图11是图示根据本公开的实施方式的驱动显示装置的方法的图。
参考图11，首先，在其中像素单元110被正常驱动的时段期间，电源160将第一电力VDD供给到第一电力线VDDL，并且将第二电力VSS供给到第二电力线VSSL(S1110)。
其后，确定像素单元是否被关闭(S1112)。当像素单元110未被关闭时(对应于图11中所示的“否”)，如在步骤S1110中，第一电力VDD和第二电力VSS分别被正常地供给到第一电力线VDDL和第二电力线VSSL(S1110和S1112)。
然而，当像素单元110被关闭时(对应于图11中所示的“是”)，电源160不将第一电力VDD和第二电力VSS分别供给到第一电力线VDDL和第二电力线VSSL(S1112和S1114)。
另外，当像素单元110被关闭时，保护电路170将第一电力线VDDL和第二电力线VSSL连接到地电位GND(S1116)。当第一电力线VDDL和第二电力线VSSL连接到地电位GND时，第一电力线VDDL和第二电力线VSSL的电压可以被放电至地电位GND的电压。
在预定时间之后，保护电路170将第一电力线VDDL和第二电力线VSSL设置成高阻抗状态(S1118)。当第一电力线VDDL和第二电力线VSSL被设置成高阻抗状态时，可以防止由于泄漏电流引起的烧毁现象。
尽管上面已经参考本公开的实施方式进行了描述，但是本领域的技术人员将理解，可以在不背离如权利要求中描述的本公开的精神和范围的情况下对本公开进行各种改变和修改。

Claims (10)

1.一种显示装置，包括：
像素单元，包括用于响应于第一电力和第二电力而产生光的多个像素；
电源，用于将所述第一电力供给到第一电力线以及将所述第二电力供给到第二电力线；以及
保护电路，用于在所述多个像素处于关闭状态时将所述第一电力线和所述第二电力线的电压进行放电并且在预定时间之后使所述第一电力线和所述第二电力线处于高阻抗状态。
2.根据权利要求1所述的显示装置，其中，所述电源在所述多个像素处于所述关闭状态时不将所述第一电力供给到所述第一电力线并且不将所述第二电力供给到所述第二电力线。
3.根据权利要求1所述的显示装置，还包括：
时序控制器，被配置为在所述多个像素处于所述关闭状态时将使能电平的第一控制信号供给到所述保护电路并且在所述多个像素处于打开状态时将禁用电平的第一控制信号供给到所述保护电路。
4.根据权利要求3所述的显示装置，其中，所述保护电路包括：
第一保护晶体管，连接在所述第一电力线与地电位之间，其中，所述第一保护晶体管响应于第一驱动信号而被导通；
第二保护晶体管，连接在所述第二电力线与所述地电位之间，其中，所述第二保护晶体管响应于第二驱动信号而被导通；
控制器，被配置为在所述禁用电平的所述第一控制信号被供给时生成使能电平的第二控制信号并且在所述使能电平的所述第一控制信号被供给之后的预定时间之后生成禁用电平的第二控制信号；以及
驱动器，被配置为在所述使能电平的所述第一控制信号和所述使能电平的所述第二控制信号被供给时将所述第一驱动信号供给到所述第一保护晶体管并且将所述第二驱动信号供给到所述第二保护晶体管。
5.根据权利要求4所述的显示装置，其中，所述预定时间是10帧或更少的时间。
6.根据权利要求4所述的显示装置，其中，所述控制器包括：
延迟单元，被配置为在所述使能电平的所述第一控制信号被供给之后的所述预定时间之后生成计数信号；以及
信号发生器，被配置为在所述计数信号从所述延迟单元被供给时生成所述禁用电平的所述第二控制信号并且将所述禁用电平的所述第二控制信号供给到所述驱动器。
7.根据权利要求6所述的显示装置，其中，所述延迟单元是计数器。
8.根据权利要求4所述的显示装置，其中，所述驱动器包括：
第一逻辑电路单元，被配置为在所述使能电平的所述第一控制信号和所述使能电平的所述第二控制信号被供给时将所述第一驱动信号供给到所述第一保护晶体管；以及
第二逻辑电路单元，被配置为在所述使能电平的所述第一控制信号和所述使能电平的所述第二控制信号被供给时将所述第二驱动信号供给到所述第二保护晶体管。
9.根据权利要求8所述的显示装置，其中，所述第一逻辑电路单元和所述第二逻辑电路单元中的每个是与门。
10.根据权利要求4所述的显示装置，其中，所述保护电路包括：
第一电阻器，连接在所述第一保护晶体管与所述地电位之间；第一二极管，连接在所述第一电力线与所述地电位之间；
第一电容器，连接在所述第一电力线与所述地电位之间；
第二电阻器，连接在所述第二保护晶体管与所述地电位之间；
第二二极管，连接在所述第二电力线与所述地电位之间；以及
第二电容器，连接在所述第二电力线与所述地电位之间。
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