CN116092415A - 具有像素驱动电路的电致发光显示装置 - Google Patents

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Abstract

公开了具有像素驱动电路的电致发光显示装置。该显示装置包括像素，该像素包括子像素，并被划分为子像素区域和公共区域。每个子像素的发光元件包括阳极电极和阴极电极。阳极电极连接至与第二像素驱动电路连接的第一公共线。每个子像素还包括：驱动元件，其包括分别连至第一、第二、第三节点的源极、栅极和漏极；分别连至第一、第二、第三节点的第四、第二、第五晶体管；连至第二和第三节点的第三晶体管；连至第二节点和与第二像素驱动电路连接的第二公共线的第一电容器；连至第一公共线和第一或第二节点的第二电容器；驱动元件下方的导电层。导电层连至第一节点或驱动元件的栅极。

Description

具有像素驱动电路的电致发光显示装置
相关申请的交叉引用
本申请要求于2021年11月5日向韩国知识产权局提交的韩国专利申请第10-2021-0151341号的优先权，其公开内容通过引用并入本文。
技术领域
本公开内容涉及一种具有像素驱动电路的电致发光显示装置，并且涉及一种改善了亮点和图像质量缺陷的电致发光显示面板。
背景技术
随着信息技术的发展，作为信息和用户之间的连接媒介的显示装置的市场正在增长。除了基于文本的信息的传输之外，用户之间还积极进行各种形式的通信。随着信息类型的变化，用于显示信息的显示装置的性能也在发展。因此，诸如电致发光显示装置、液晶显示装置、以及量子点显示装置的各种显示装置的使用正在增加。其中，电致发光显示装置可以根据发光元件的类型而分为有机发光显示装置和无机发光显示装置。此外，无机发光显示装置包括发光二极管(LED)显示装置。
有机发光显示装置包括能够自行发光的有机发光二极管(OLED)。LED显示装置包括能够自行发光的发光二极管(LED)。在有机发光显示装置或LED显示器中，包括发光元件的像素以特定图案排列，并且像素的亮度根据图像数据的灰度而被调整。每个像素包括驱动元件(或驱动晶体管)，该驱动元件(或驱动晶体管)被配置成根据栅极-源极电压来控制在发光元件中流动的驱动电流。每个像素还包括一个或更多个开关元件(或开关晶体管)，其被配置成对驱动元件的栅极-源极电压进行编程。在每个像素中，通过取决于驱动电流的发光元件的发光量来调整显示灰度(或亮度)。
最近，对使用LED的LED显示装置的兴趣和开发正在增加，LED是包括无机层的发光元件。LED可以输出比OLED亮度更高的灰度，并且对抗热、水分、氧气等具有出色的可靠性。
为了实现像素之间没有亮度和色差的均匀图像质量，所有像素的驱动特性必须相同。然而，由于包括工艺偏差在内的各种原因，像素之间的驱动特性可能存在偏差。此外，取决于显示装置的驱动时间，像素之间的劣化速度可能不同。因此，像素之间的驱动特性可能存在偏差。因此，流向发光元件的驱动电流的量根据像素之间的驱动特性偏差而改变，这导致图像质量不均匀。
为了补偿驱动特性偏差，像素包括内部补偿像素驱动电路或外部补偿像素驱动电路。这些像素驱动电路由上述驱动元件和开关元件以及电容器实现。驱动特性(诸如像素驱动电路的可靠性、驱动电流的偏差)根据像素驱动电路的各元件的连接关系及其驱动方法而不同。
发明内容
上述驱动元件或开关元件可以由薄膜晶体管(以下称为“晶体管”)来实现。晶体管由半导体层、电极层和多个绝缘层组成。然而，绝缘层可能由于在晶体管形成时产生的静电而损坏，这可能导致晶体管中的缺陷。这可能导致电致发光显示装置中的图像质量缺陷，特别是亮点缺陷。特别地，对于LED显示装置，需要高亮度的驱动电流以使LED发光。因此，亮点可能导致图像质量缺陷。为了解决静电产生的问题，可以在工艺设备中采取直接的措施来抑制静电的产生。然而，完全抑制静电产生是不可能的。因此，需要实现即使在其中产生静电也不会将静电识别为缺陷的像素驱动电路。换言之，需要发明一种能够减少亮点产生的像素驱动电路，并将该像素驱动电路应用于显示面板。
本公开内容要实现的目的在于提供一种包括像素驱动电路的电致发光显示装置。该像素驱动电路被实现为当产生由静电引起的缺陷时，显示面板中包括的像素不被看成为亮点。
本公开内容要实现的另一个目的是提供一种通过更简单地配置由多个晶体管组成的像素驱动电路来提高集成密度的电致发光显示装置。
本发明要实现的又一目的在于提供一种包括像素驱动电路的电致发光显示装置。像素驱动电路被实现为当产生由静电引起的缺陷时，包括在显示面板中的像素被看成为暗点。
本公开内容的目的不限于上述目的，本领域技术人员可以通过以下描述清楚地理解上述未提及的其他目的。
根据本公开内容的一个方面，电致发光显示装置包括像素，该像素包括子像素，并且被划分为公共区域和设置有子像素的子像素区域。子像素中的每个子像素包括发光元件，该发光元件包括阳极电极和阴极电极。在子像素区域中，设置有第一像素驱动电路，在公共区域中，设置有第二像素驱动电路。发光元件的阳极电极连接至第一公共线，第一公共线连接至第二像素驱动电路。子像素中的每个子像素还包括驱动元件，该驱动元件包括连接至第一节点的源极、连接至第二节点的栅极和连接至第三节点的漏极。子像素还包括连接至第一节点的第四晶体管、连接至第二节点的第二晶体管和连接至第三节点的第五晶体管。子像素还包括连接至第二节点和第三节点的第三晶体管，以及第一电容器，该第一电容器连接至第二节点和第二公共线，第二公共线连接至第二像素驱动电路。子像素还包括连接至第一公共线和第一节点或第二节点的第二电容器，以及设置在驱动元件下方的导电层。导电层连接至第一节点或驱动元件的栅极。在这种情况下，当电致发光显示装置的子像素由于静电而产生缺陷时，子像素变暗。因此，可以减少图像质量缺陷。
根据本公开内容的另一方面，电致发光显示装置包括发光元件，该发光元件包括阴极电极以及连接至被提供以高电位电压的第一公共线的阳极电极。电致发光显示装置还包括子像素，该子像素包括向发光元件提供驱动电流的像素驱动电路。子像素还包括驱动元件，该驱动元件包括连接至第一节点的源极、连接至第二节点的栅极和连接至第三节点的漏极。子像素还包括连接至阳极电极的第一公共开关电路，以及第一电容器，第一电容器包括连接至第二节点的第一电极以及连接至第四节点的第二电极。子像素还包括连接至第二节点的第二开关电路和连接至第三节点的第三开关电路。子像素还包括连接至第一节点的第一开关电路和连接至第四节点的第二公共开关电路。因此，当电致发光显示装置的子像素由于静电而产生缺陷时，子像素变暗。因此，可以减少图像质量缺陷。
示例性实施方式的其他事项包括在具体实施方式和附图中。
根据本公开内容，在子像素中实现包括连接至驱动元件的栅极的两个电容器的像素驱动电路。因此，可以抑制电致发光显示面板中亮点缺陷的产生。
根据本公开内容，发光元件的阳极电极由多个子像素共享，并且阴极电极被配置成提供来自驱动元件的驱动电流。因此，可以抑制电致发光显示面板中亮点的产生。
根据本公开内容，包括在单位像素中的子像素共享设置在单位像素中的像素驱动电路的一部分。因此，可以减少单位像素中的非发光区域，从而可以提高显示面板的分辨率。
根据本公开内容的效果不限于以上例示的内容，本说明书中包括更多的各种效果。
附图说明
本公开内容的上述和其他方面、特征和其他优点将从以下结合附图的详细描述中得到更清楚的理解，其中：
图1是示出根据本公开内容的实施方式的电致发光显示装置的框图；
图2示出了包括在电致发光显示面板的每个像素中的发光元件的实施方式；
图3示出了包括在电致发光显示面板的单位像素中的子像素的布局；
图4A、图4B和图5示出了根据本公开内容的实施方式的像素驱动电路以及输入至像素驱动电路的信号的波形图；以及
图6示出了根据本公开内容的另一实施方式的像素驱动电路。
具体实施方式
通过参考以下详细描述的实施方式并结合附图，本公开内容的优点和特征以及实现这些优点和特征的方法将变得清楚。然而，本公开内容不限于本文中公开的实施方式，而是将以各种形式实现。实施方式仅作为示例提供，使得本领域技术人员可以充分地理解本公开内容的公开内容和本公开内容的范围。因此，本公开内容将仅由所附权利要求的范围限定。
用于描述本公开内容的实施方式的附图中所示出的形状、尺寸、比例、角度、数目等仅仅是示例，并且本公开内容不限于此。在整个说明书中，相似的附图标记通常表示相似的元件。此外，在本公开内容的以下描述中，可以省略对已知相关技术的详细说明以避免不必要地使本公开内容的主题模糊。本文中使用的诸如“包括”、“具有”和“由……组成”的术语通常旨在允许添加其他部件，除非这些术语与术语“仅”一起使用。除非另有明确说明，否则任何对单数的引用都可以包括复数。
即使没有明确说明，部件也被解释为包括普通的误差范围。
当使用诸如“在……上”、“在……上方”、“在……下方”和“靠近”的术语来描述两个部分之间的位置关系时，除非这些术语与术语“立即”或“直接”一起使用，否则两个部分之间可以放置一个或更多个部分。
当元件或层被设置在另一元件或层“上”时，另一层或另一元件可以被直接***在其他元件上或该元件或该层与其他元件或层之间。
尽管术语“第一”、“第二”等用于描述各种部件，但是这些部件不受这些术语的限制。这些术语仅用于将一个部件与其他部件区分开来。因此，下面要提到的第一部件可以是本公开内容的技术构思中的第二部件。
在整个说明书中，相似的附图标记通常表示相似的元件。
附图中所示出的每个部件的尺寸和厚度是为了便于描述而示出的，并且本公开内容不限于所示出的部件的尺寸和厚度。
本公开内容的各种实施方式的特征可以部分地或全部地彼此结合或组合，并且可以以各种技术方式互锁和操作，以及实施方式可以彼此独立或关联地执行。
根据本公开内容，形成在显示面板的基板上的驱动电路和栅极驱动电路可以由N型或P型晶体管实现。例如，晶体管可以由MOSFET(金属氧化物半导体场效应晶体管)来实现。晶体管是包括栅极、源极和漏极的三电极元件。源极是向晶体管提供载流子的电极。在晶体管中，载流子从源极流向漏极。在n型晶体管中，载流子是电子，因此电子从源极流向漏极，并且源极电压低于漏极电压。由于在N型晶体管中电子从源极流向漏极，因此电流从漏极流向源极。在P型晶体管中，载流子是空穴，因此源极电压高于漏极电压，使得空穴可以从源极流向漏极。由于在P型晶体管中空穴从源极流向漏极，所以电流从源极流向漏极。晶体管的源极和漏极不是固定的，而是可以根据施加至其上的电压而互换。
在以下描述中，栅极导通信号是使晶体管导通的栅极信号。栅极截止信号是关断晶体管的栅极信号。在P型晶体管中，栅极导通信号为逻辑低电压，并且栅极截止信号为逻辑高电压。在N型晶体管中，栅极导通信号为逻辑高电压，栅极截止信号为逻辑低电压。
在下文中，将参照附图描述根据本公开内容的实施方式的像素驱动电路和包括该像素驱动电路的电致发光显示装置。
图1是示出根据本公开内容的实施方式的电致发光显示装置的框图。图2示出了包括在电致发光显示面板的每个像素中的发光元件的实施方式。
参照图1和图2，根据本公开内容的电致发光显示装置包括显示面板100，显示面板100包括像素PXL。此外，电致发光显示装置包括显示面板驱动电路200和300，显示面板驱动电路200和300被配置成向连接至像素PXL的信号线提供信号。此外，电致发光显示装置包括时序控制器400，其被配置成控制显示面板驱动电路200和300。
显示面板驱动电路200和300将输入图像数据DATA提供至显示面板100的像素PXL。显示面板驱动电路200和300包括：源极驱动器200，其被配置成向连接至像素PXL的数据线201提供数据信号；以及栅极驱动器300，其被配置成向连接至像素PXL的栅极线301提供栅极信号。
显示面板100设置有多条数据线201和多条栅极线301。像素PXL中的每个像素响应于由数据线201和栅极线301提供的信号而被驱动。因此，像素PXL中的每个像素的区域可以由数据线201和栅极线301限定。每个像素PXL包括发光元件130，例如图2所示的LED。
发光元件130可以包括发光层EL、第一电极E1和第二电极E2。当在第一电极E1与第二电极E2之间流动的电子和空穴复合时，发光层EL发光。发光层EL可以包括第一半导体层131、有源层133和第二半导体层135。
第一半导体层131向有源层133提供电子。例如，第一半导体层131可以由n-GaN半导体材料制成。n-GaN半导体材料可以是GaN、AlGaN、InGaN、AlInGaN等。作为用于掺杂第一半导体层131的杂质，可以使用Si、Ge、Se、Te、C等。
有源层133设置在第一半导体层131的一侧。有源层133具有多量子阱(MQW)结构，该结构具有阱层以及带隙高于阱层的势垒层。有源层133可以具有诸如InGaN/GaN等的MQW结构。
第二半导体层135设置在有源层133上并向有源层133提供空穴。第二半导体层135可以由p-GaN半导体材料制成。p-GaN半导体材料可以是GaN、AlGaN、InGaN、AlInGaN等。作为用于掺杂第二半导体层135的杂质，可以使用Mg、Zn、Be等。
第一半导体层131、有源层133和第二半导体层135可以顺序地层叠在半导体基板上。半导体基板包括诸如蓝宝石基板或硅(Si)基板的半导体材料。半导体基板可以用作为使第一半导体层131、有源层133和第二半导体层135中的每一个生长的基板，然后可以通过基板分离工艺与第一半导体层131分离。基板分离工艺可以是激光剥离工艺或化学剥离工艺。与半导体基板分离的发光元件130被转移至像素PXL中的每个像素并且连接至像素驱动电路。
第一电极E1设置在第二半导体层135上。第二电极E2可以设置在第一半导体层131的另一侧，以与有源层133和第二半导体层135电断开。例如，第一电极E1和第二电极E2中的每一个可以由透明导电材料制成。透明导电材料可以是铟锡氧化物(ITO)、铟锌氧化物(IZO)等，但不限于此。替选地，第一电极E1和第二电极E2中的每一个可以由诸如Au、W、Pt、Si、Ir、Ag、Cu、Ni、Ti或Cr的金属材料及其合金中的至少一种制成。
从发光元件130发出的光穿过第一电极E1和第二电极E2中的每一个并且被输出至外部，从而显示图像。发光元件130的第一电极E1也可以称为阳极电极，并且第二电极E2也可以称为阴极电极。
图3示出了包括在电致发光显示面板的单位像素中的子像素的布局。
每个像素PXL包括多个子像素SPXL。设置有子像素SPXL的每个区域也可以称为子像素区域。子像素SPXL中的每个子像素可以是红色子像素、绿色子像素、蓝色子像素和白色子像素中的任何一种以实现各种颜色。像素PXL中实现的颜色可以根据红色子像素、绿色子像素、蓝色子像素和白色子像素的发射比来确定。子像素SPXL中的每个子像素包括用于发射相应子像素SPXL的颜色的光的发光元件130以及像素驱动电路。此外，为了减小或最小化像素驱动电路的尺寸，像素驱动电路的一部分可以由子像素SPXL共享。由子像素SPXL共享的像素驱动电路可以设置在公共区域CA中。单位像素PXL包括多个子像素区域和公共区域CA。稍后将详细描述设置在公共区域CA中的像素驱动电路。
再次参照图1，除了数据线201和栅极线301之外，通过电源线分别向子像素SPXL提供电力电压。电源线也可以由多个子像素SPXL共享。电力电压由电源单元提供，并且包括高电位电压VDD、低电位电压VSS和参考电压Vref。通过第一电源线向子像素SPXL提供高电位电压VDD，通过第二电源线向子像素SPXL提供低电位电压VSS，并通过第三电源线向子像素SPXL提供参考电压Vref。例如，高电位电压VDD可以低于参考电压Vref并且高于低电位电压VSS。在这种情况下，高电位电压VDD和参考电压Vref可以是正电压，而低电位电压VSS可以是负电压。连接至子像素SPXL的电源线的结构具有在两个或更多子像素SPXL上延伸的线形状和板形状。
源极驱动器200将从时序控制器400接收的输入图像数据DATA转换成每帧中的数据电压Vdata，然后将数据电压Vdata提供至数据线201。源极驱动器200使用将输入图像数据DATA转换成伽马补偿电压的数模转换器(DAC)来输出数据电压Vdata。例如，数据电压Vdata可以是低电位电压VSS与高电位电压VDD之间的电压。
栅极驱动器300可以通过板内栅极工艺与像素PXL一起直接形成在显示面板100的基板上，但是本公开内容不限于此。栅极驱动器300可以以IC(集成电路)类型来制造，然后通过导电膜接合至显示面板100。
时序控制器400基于从未示出的主机***接收的时序控制信号来产生用于控制源极驱动器200的操作时序的数据时序控制信号DDC。时序控制器400还基于从未示出的主机***接收的时序控制信号来产生用于控制栅极驱动器300的操作时序的栅极时序控制信号GDC。例如，时序控制信号包括垂直同步信号Vsync、水平同步信号Hsync、数据使能信号DE等。
图4A、图4B和图5示出了根据本公开内容的实施方式的像素驱动电路和输入至像素驱动电路的信号的波形图。
参照图4A，根据本公开内容的实施方式的像素驱动电路包括第一像素驱动电路PC1和第二像素驱动电路PC2。第一像素驱动电路PC1设置在子像素SPXL中的每个子像素中，第二像素驱动电路PC2设置在单位像素PXL内部的公共区域CA中。第二像素驱动电路PC2连接至设置在单位像素PXL内的子像素SPXL。第一像素驱动电路PC1包括发光元件130、驱动元件、第一开关电路、第二开关电路、第三开关电路和电容器电路。
图4A和4B示出了包括在第n行的像素PXL中的像素驱动电路。第n行的像素驱动电路被提供有第(n-1)扫描信号S(n-1)、第n扫描信号S(n)和第n发射信号EM(n)。第(n-1)扫描信号S(n-1)被配置成通过第(n-1)扫描线来提供，第n扫描信号S(n)被配置成通过第n扫描线来提供，并且第n发射信号EM(n)被配置成通过第n发射线来提供。第(n-1)扫描线、第n扫描线和第n发射线包括在栅极线301中。
驱动元件产生对应于数据电压Vdata的驱动电流，并将驱动电流提供至发光元件130的阴极电极。发光元件130的阴极电极和驱动元件的源极连接在N1节点处。发光元件130的阳极电极连接至N5节点。N5节点连接至第一公共线101，并且被提供以来自第二像素驱动电路PC2的高电位电压VDD。第一公共线101是在单位像素PXL的子像素SPXL中公共设置的单条线。此外，对于子像素SPXL中的每个子像素单独地设置发光元件130的阴极电极，以便向各个子像素SPXL提供不同的驱动电流。
当发光元件130发光时，发光元件130的阴极电极的电压低于发光元件130的阳极电极的电压。在像素驱动电路中，除了发光元件130之外的驱动元件和开关电路产生驱动电流，使得发光元件130的阴极电极具有低于高电位电压VDD的电压，以使发光元件130发光。
根据本公开内容的实施方式的像素驱动电路可以由P型晶体管、特别是PMOS TFT(P沟道金属氧化物半导体薄膜晶体管)来实现。然而，本公开内容不限于此。根据本公开内容的实施方式的像素驱动电路也可以由N型晶体管实现。在这种情况下，N型晶体管可以是NMOS TFT(N沟道金属氧化物半导体薄膜晶体管)。在本文中，当P型晶体管关断时，栅极电压为逻辑高电压，当N型晶体管关断时，栅极电压为逻辑低电压。
例如，发光元件130的阴极电极可以连接至被提供低电位电压VSS的第二电源线，并且阳极电极可以配置成被提供以从驱动元件产生的驱动电流。在这种情况下，如果驱动元件和开关电路的任何一个或更多个晶体管由于静电的影响而出现缺陷，则关断的晶体管中的栅极电压为逻辑高电压。因此，发光元件130的阳极电极受到影响，并且因此容易产生亮点。具体地，可能存在晶体管的栅极绝缘层由于静电而击穿并且在栅极与有源层之间发生短路的情况。通过短路的栅极和有源层而传递的逻辑高电压被传递至发光元件130的阳极电极，使得发光元件130发光。因此，为了使发光元件130不会不必要地发光并被看成为亮点，第二像素驱动电路PC2和第一公共线101彼此连接。因此，高电位电压VDD被施加至发光元件130的阳极电极。阴极电极电连接至第一像素驱动电路PC1。因此，可以抑制在显示面板中产生亮点。
参照图4A，驱动元件由第一晶体管Tl实现。第一晶体管T1的栅极连接至N2节点，源极连接至N1节点，漏极连接至N3节点。驱动元件可以通过栅极电压导通，以向N1节点提供均匀的驱动电流。驱动元件可以具有栅极设置在有源层上的顶栅结构，以及源极和漏极通过接触孔与有源层接触的共面结构。此外，导电层设置在驱动元件的有源层下方。导电层可以阻挡入射到驱动元件的有源层的光，从而抑制有源层的劣化。导电层不浮置，并且连接至第一晶体管T1的源极。因此，可以提高驱动电流和亮度的均匀性。参照图4B，导电层可以连接至第一晶体管T1的栅极。如果导电层连接至驱动元件的源极，则与导电层连接至驱动元件的栅极的情况相比，驱动元件的驱动电流减小。然而，显示面板的亮度均匀性可以提高。如果导电层连接至驱动元件的栅极，则与导电层连接至驱动元件的源极的情况相比，显示面板的亮度均匀性降低。然而，驱动元件的驱动电流可以增大。
N1开关电路包括第四晶体管T4。第四晶体管T4由第n扫描信号S(n)控制，以为N1节点提供流过数据线201的数据电压Vdata。由于数据电压Vdata配置成被提供至N1节点，驱动元件可以产生对应于数据电压Vdata的驱动电流。
N2开关电路包括第二晶体管T2和第三晶体管T3。第二晶体管T2由第(n-1)扫描信号S(n-1)控制，以向N2节点提供流过第二电源线的低电位电压VSS。由于提供至N2节点的低电位电压VSS，第一晶体管T1的栅极利用低电位电压VSS放电。因此，当补偿驱动元件的阈值电压并产生驱动电流时，可以将电压精确地施加至驱动元件的栅极。
第三晶体管T3由第n扫描信号S(n)控制，以电连接N2节点和N3节点。第三晶体管T3通过电连接驱动元件的栅极和漏极来提取驱动元件的阈值电压。所提取的阈值电压反映在驱动元件的栅极电压中，并最终在驱动元件产生的驱动电流处偏移。因此，驱动元件的阈值电压得到补偿。
N3开关电路包括第五晶体管T5。第五晶体管T5由第n发射信号EM(n)控制，以向N3节点提供低电位电压VSS。由于第五晶体管T5将低电位电压VSS提供至驱动元件的漏极，所以可以产生驱动电流。
电容器电路包括第一电容器Cst1和第二电容器Cst2。第一电容器Cst1包括分别连接至N2节点和N4节点的两个电极。N4节点通过第二公共线102连接至第二像素驱动电路PC2，并通过第二像素驱动电路PC2被施加高电位电压VDD或参考电压Vref。
第一电容器Cstl通过使用电容器元件的耦合效应来调节N2节点的电压，并且固定在发光期间施加至驱动元件的栅极的电压。这导致均匀的驱动电流和发光亮度。
通过使两个电极交叠来实现第一电容器Cstl。电极中的一个电极连接至N2节点，因此连接至驱动元件的栅极。第一电容器Cst1的另一个电极设置在驱动元件的栅极上，以与栅极的一部分交叠。此外，绝缘层设置在第一电容器Cst1的两个电极之间。
例如，在具有伽马结构的像素驱动电路中，电容器可以连接至驱动元件的栅极，在伽马结构中发光元件的阴极电极被多个子像素共享。在这种情况下，覆盖晶体管的绝缘层由于在形成像素驱动电路的过程中产生的静电而击穿，因此，电容器的两个电极可能彼此短接。当电容器的两个电极彼此短接时，对应的子像素SPXL可被看成为亮点。亮点比暗点更容易被看到，因此会降低图像质量。因此，根据本公开内容的实施方式，使用以下像素驱动电路：即，具有反伽马结构的像素驱动电路，在反伽马结构中发光元件的阳极电极被多个子像素共享。因此，可以提高电致发光显示装置的图像质量。
第二电容器Cst2包括两个电极。第二电容器Cst2的一个电极连接至第一晶体管T1的栅极，而另一个电极连接至提供有高电位电压VDD的线。也就是说，与第二电容器Cst2的一个电极连接的第一晶体管T1的栅极的一部分可以设置成与被提供以高电位电压VDD的线的一部分交叠，或者与连接至被提供以高电位电压VDD的线的另一电极交叠。此外，参照图4B，第二电容器Cst2的一个电极可以连接至第一晶体管T1的源极，而另一个电极可以连接至被提供高电位电压VDD的线。即使第二电容器Cst2的两个电极由于静电等而短接，高电位电压VDD也配置成被提供至第二电容器Cst2的另一个电极。因此，高电位电压VDD也被提供至驱动元件的栅极。因此，驱动元件关断并且子像素SPXL变暗。
此外，由于两个电容器连接至驱动元件的栅极，因此驱动元件的栅极电压甚至不会受到由其他开关晶体管产生的寄生电容器引起的耦合效应的影响。
第二像素驱动电路PC2包括第一公共开关电路和第二公共开关电路。
第一公共开关电路包括第一公共晶体管TCl。第一公共开关电路被配置成通过第一公共线101向N5节点施加电压。
第一公共晶体管TC1由第n发射信号EM(n)控制，以将高电位电压VDD施加至N5节点。由于第一公共晶体管TC1向发光元件130的阳极电极提供高电位电压VDD，所以发光元件130发光。
第二公共开关电路包括第二公共晶体管TC2、第三公共晶体管TC3和第四公共晶体管TC4。第二公共开关电路被配置成通过第二公共线102向N4节点提供电压。
第二公共晶体管TC2由第n发射信号EM(n)控制，以将高电位电压VDD施加至N4节点。第二公共晶体管TC2将高电位电压VDD施加至第一电容器Cst1的另一电极，以维持驱动元件的栅极电压。因此，驱动元件可以产生均匀的驱动电流。
第三公共晶体管TC3由第n扫描信号S(n)控制，以将参考电压Vref施加至N4节点。第三公共晶体管TC3将参考电压Vref施加至第一电容器Cst1的另一电极，以对驱动元件的阈值电压进行采样。因此，可以产生驱动电流。
第四公共晶体管TC4由第(n-1)扫描信号S(n-1)控制，以将参考电压Vref施加至N4节点。第四公共晶体管TC4将参考电压Vref施加至第一电容器Cst1的另一电极，以向N4节点提供恒定电压，该N4节点在发光后浮置。因此，在一个采样时段内，电压可以被精确地耦合并施加至驱动元件的栅极。
第二像素驱动电路PC2不直接连接至驱动元件，并且将高电位电压VDD或参考电压Vref的恒定电压提供至N4节点和N5节点。因此，第二像素驱动电路PC2可以被包括在单位像素PXL中的多个子像素SPXL共享。取决于第二像素驱动电路PC2的晶体管的尺寸，第二像素驱动电路PC2也可以由多个像素PXL共享。在这种情况下，晶体管的尺寸可以由第一电容器Cst1的充电时间来确定。
参照图3，第二像素驱动电路PC2可以设置在像素PXL的公共区域CA中并且由子像素SPXL共享。在这种情况下，第一公共线101和第二公共线102由子像素SPXL共享。因此，可以减小子像素SPXL的尺寸，从而可以减小单位像素PXL的尺寸。因此，可以实现高分辨率的显示面板。
参照图4A、图4B和图5，在划分为初始化时段①、采样时段②、保持时段③和发光时段④的时段中驱动像素驱动电路。
第(n-1)扫描信号S(n-1)和第n扫描信号S(n)中的每一个在一个水平时段1H期间包括逻辑低电压的脉冲。第n发射信号EM(n)在至少两个水平时段2H期间包括逻辑高电压的脉冲。第(n-1)扫描信号S(n-1)具有逻辑低电压的一个水平时段1H被称为像素驱动电路的初始化时段①。此外，第n扫描信号S(n)具有逻辑低电压的一个水平时段1H被称为像素驱动电路的采样时段②。尽管图5示出了第n发射信号EM(n)在四个水平时段4H期间具有逻辑高电压，但是本公开内容不限于此。第n发射信号EM(n)至少在像素驱动电路的初始化时段①和采样时段②期间具有逻辑高电压，从而抑制发光元件130的发光。第n发射信号EM(n)在除初始化时段①和采样时段②之外的时段期间或除四个水平时段4H之外的时段期间，可以具有逻辑低电压。第n发射信号EM(n)具有逻辑低电压的时段被称为像素驱动电路的发光时段④。
在初始化时段①中，第一像素驱动电路PC1的第二晶体管T2导通，并且低电位电压VSS被施加至N2节点。此外，第二像素驱动电路PC2的第四公共晶体管TC4导通，并且参考电压Vref被施加至N4节点。因此，第一晶体管T1的栅极利用低电位电压VSS放电，并且第一电容器Cst1和第二电容器Cst2中的每一个的一个电极也利用低电位电压VSS放电。
在采样时段②中，第二像素驱动电路PC2的第三公共晶体管TC3导通，并且参考电压Vref被施加至N4节点。N4节点在采样时段②和初始化时段①期间保持参考电压Vref。
在采样时段②中，第一像素驱动电路PCl的第四晶体管T4导通，并且数据电压Vdata被施加至N1节点。另外，第三晶体管T3导通，并且N2节点与N3节点电连接。因此，驱动元件的栅极和漏极短路。因此，N2节点的电压增加，直到N2节点的电压与N1节点的电压之间的差等于驱动元件的阈值电压Vth。因此，在采样时段②结束时，N2节点的电压变为Vdata+Vth。N2节点的电压升高需要时间。需要足够的采样时间来精确采样驱动元件的阈值电压。将第n扫描信号S(n)完全转换成逻辑高电压也需要时间。因此，可以在采样时段②之后设置保持时段③。
保持时段③被示为一个水平时段1H，但本公开内容不限于此。为了使发光元件130即使在保持时段③期间也不发光，第n发射信号EM(n)保持逻辑高电压。当第n发射信号EM(n)转换成逻辑低电压时，发光元件130开始发光。
在发光时段④中，第二像素驱动电路PC2的第二公共晶体管TC2导通，并且高电位电压VDD被施加至N4节点。随着N4节点的电压从参考电压Vref变为高电位电压VDD，由于第一电容器Cst1的耦合，N2节点的电压变为Vdata+Vth+VDD-Vref。
在发光时段④中，第一像素驱动电路PCl的第五晶体管T5导通，并且低电位电压VSS被施加至N3节点。因此，驱动元件导通，并且驱动电流配置成被提供至发光元件130。此外，第二像素驱动电路PC2的第一公共晶体管TC1导通，并且高电位电压VDD被施加至发光元件130的阳极电极。因此，发光元件130发光。在这种情况下，驱动元件的源极电压变为VDD-VTC1-Vled，并且驱动元件的驱动电流ID由以下等式1表示。
[等式1]
ID＝k(Vdata-Vref+VTC1-Vled)2
在等式1中，k是由驱动元件的特性确定的常数值，Vled是发光元件130的阈值电压，VTC1是第一公共晶体管TC1的阈值电压。参考等式1，驱动元件的阈值电压Vth从驱动电流ID中被去除。因此，驱动电流ID不依赖于驱动元件的阈值电压Vth，并且不受阈值电压Vth的变化的影响。
此外，驱动电流ID不受由于电流的影响而经历电压降的高电位电压VDD的影响。然而，驱动电流ID受到参考电压Vref的影响，参考电压Vref几乎不受由于施加至其的恒定电压所引起的电压降的影响。因此，可以抑制取决于像素PXL在显示面板上的位置的亮度变化。
图6示出了根据本公开内容另一实施方式的像素驱动电路。施加至图6所示的像素驱动电路的信号的波形图与图5所示的波形图相同，因此将参照图5进行描述。
参照图6，根据本公开内容另一实施方式的像素驱动电路包括第一像素驱动电路PCl和第二像素驱动电路PC2。第一像素驱动电路PC1设置在子像素SPXL中的每个子像素中，第二像素驱动电路PC2设置在单位像素PXL内部的公共区域CA中。第二像素驱动电路PC2连接至设置在单位像素PXL内的子像素SPXL。第一像素驱动电路PC1包括发光元件130、驱动元件、第一开关电路、第二开关电路、第三开关电路和电容器电路。
图6示出了包括在第n行的像素PXL中的像素驱动电路。第n行的像素驱动电路被提供有第(n-1)扫描信号S(n-1)、第n扫描信号S(n)和第n发射信号EM(n)。第(n-1)扫描信号S(n-1)被配置成通过第(n-1)扫描线来提供，第n扫描信号S(n)被配置成通过第n扫描线来提供，并且第n发射信号EM(n)被配置成通过第n发射线来提供。第(n-1)扫描线、第n扫描线和第n发射线包括在栅极线301中。
驱动元件产生对应于数据电压Vdata的驱动电流，并将驱动电流提供至发光元件130的阴极电极。发光元件130的阴极电极和驱动元件的源极连接在N1节点。发光元件130的阳极电极连接至N5节点。N5节点连接至第一公共线101，并且被提供以来自第二像素驱动电路PC2的高电位电压VDD。第一公共线101是在单位像素PXL的子像素SPXL中公共设置的单条线。此外，对于子像素SPXL中的每个子像素单独地设置发光元件130的阴极电极，以便向各个子像素SPXL提供不同的驱动电流。
当发光元件130发光时，阴极电极的电压低于阳极电极的电压。在像素驱动电路中，除了发光元件130之外的驱动元件和开关电路产生驱动电流，使得发光元件130的阴极电极具有低于高电位电压VDD的电压，以使发光元件130发光。
根据本公开内容的另一实施方式的像素驱动电路可以由P型晶体管实现，特别是PMOS TFT(P沟道金属氧化物半导体薄膜晶体管)。然而，本公开内容不限于此。根据本公开内容的另一实施方式的像素驱动电路也可以由N型晶体管实现。在这种情况下，N型晶体管可以是NMOS TFT(N沟道金属氧化物半导体薄膜晶体管)。在本文中，当P型晶体管关断时，栅极电压为逻辑高电压，当N型晶体管关断时，栅极电压为逻辑低电压。
如在根据本公开内容的实施方式的像素驱动电路中，为了使发光元件130不会不必要地发光并被看成为亮点，在根据本公开内容的另一实施方式的像素驱动电路中，第二像素驱动电路PC2和第一公共线101彼此连接。因此，高电位电压VDD被施加至发光元件130的阳极电极。阴极电极电连接至像素驱动电路。因此，可以抑制在显示面板中产生亮点。
驱动元件由第一晶体管Tl实现。第一晶体管T1的栅极连接至N2节点，源极连接至N1节点，并且漏极连接至N3节点。驱动元件可以通过栅极电压导通，以向N1节点提供均匀的驱动电流。如上所述，导电层设置在驱动元件的有源层下方。导电层不浮置，并且连接至第一晶体管T1的源极。因此，可以提高驱动电流和亮度的均匀性。虽然图6示出了导电层连接至第一晶体管T1的源极，但本公开内容不限于此。如图4B所示，导电层可以连接至第一晶体管T1的栅极。
N1开关电路包括第四晶体管T4。第四晶体管T4由第n扫描信号S(n)控制，从而向N1节点提供流过数据线201的数据电压Vdata。由于数据电压Vdata配置成被提供至N1节点，因此驱动元件可以产生对应于数据电压Vdata的驱动电流。
N2开关电路包括第二晶体管T2和第三晶体管T3。第二晶体管T2由第(n-1)扫描信号S(n-1)控制，以向N2节点提供流过第二电源线的低电位电压VSS。由于提供至N2节点的低电位电压VSS，第一晶体管T1的栅极利用低电位电压VSS放电。因此，当补偿驱动元件的阈值电压并产生驱动电流时，可以将电压精确地施加至驱动元件的栅极。
第三晶体管T3由第n扫描信号S(n)控制，以电连接N2节点和N3节点。第三晶体管T3通过电连接驱动元件的栅极和漏极来提取驱动元件的阈值电压。所提取的阈值电压反映在驱动元件的栅极电压中，并最终在驱动元件产生的驱动电流处偏移。因此，驱动元件的阈值电压得到补偿。
N3开关电路包括第五晶体管T5。第五晶体管T5由第n发射信号EM(n)控制，以向N3节点提供低电位电压VSS。由于第五晶体管T5将低电位电压VSS提供至驱动元件的漏极，所以可以产生驱动电流。
电容器电路包括第一电容器Cstl和第二电容器Cst2。第一电容器Cst1包括分别连接至N2节点和N4节点的两个电极。N4节点通过第二公共线102连接至第二像素驱动电路PC2，并且通过第二像素驱动电路PC2被施加以高电位电压VDD或参考电压Vref。
第一电容器Cstl通过使用电容器元件的耦合效应来调节N2节点的电压，并且固定在发光期间施加至驱动元件的栅极的电压。这导致均匀的驱动电流和发光亮度。
通过使两个电极交叠来实现第一电容器Cstl。电极中的一个电极连接至N2节点，因此连接至驱动元件的栅极。第一电容器Cst1的另一个电极设置在驱动元件的栅极上，以与栅极的一部分交叠。此外，绝缘层设置在第一电容器Cst1的两个电极之间。
如上所述，在具有伽马结构的像素驱动电路的电容器中，一个电极和另一个电极可能由于工艺期间产生的静电而彼此短接。当电容器的两个电极彼此短接时，对应的子像素SPXL可被看成为亮点。亮点比暗点更容易被看到，因此会降低图像质量。因此，即使当设置在具有反伽马结构的像素驱动电路中的电容器短接时，驱动元件也被关断。因此，可以使对应的子像素SPXL变暗。
第二电容器Cst2包括两个电极。第二电容器Cst2的一个电极连接至第一晶体管T1的栅极，另一个电极连接至N1节点。即，与第二电容器Cst2的一个电极连接的第一晶体管T1的栅极的一部分可以设置成与N1节点的电极或连接至N1节点的另一电极的一部分交叠。即使第二电容器Cst2的两个电极由于静电等而短接，短接的第二电容器Cst2也会在驱动元件的源极与栅极之间产生0V的电压差。因此，驱动元件关断并且子像素SPXL变暗。
此外，由于两个电容器连接至驱动元件的栅极，因此即使由其他开关晶体管产生的寄生电容器引起的耦合效应也不会影响驱动元件的栅极电压。
第二像素驱动电路PC2包括第一公共开关电路、第二公共开关电路和第三公共开关电路。
第一公共开关电路包括第一公共晶体管TC1。第一公共开关电路用于通过第一公共线101向N5节点施加电压。
第一公共晶体管TC1由第n发射信号EM(n)控制，以将高电位电压VDD施加至N5节点。由于第一公共晶体管TC1向发光元件130的阳极电极提供高电位电压VDD，所以发光元件130发光。
第二公共开关电路包括第三公共晶体管TC3和第四公共晶体管TC4。第二公共开关电路被配置成通过第二公共线102向N4节点提供电压。
第三公共晶体管TC3由第n扫描信号S(n)控制，以将参考电压Vref施加至N4节点。第三公共晶体管TC3将参考电压Vref施加至第一电容器Cst1的另一电极，以对驱动元件的阈值电压进行采样。因此，可以产生驱动电流。
第四公共晶体管TC4由第(n-1)扫描信号S(n-1)控制，以将参考电压Vref施加至N4节点。第四公共晶体管TC4将参考电压Vref施加至第一电容器Cst1的另一电极，以向N4节点提供恒定电压，该N4节点在发光后浮置。因此，在采样时段内，电压可以被精确地耦合并施加至驱动元件的栅极。
第三公共开关电路包括第二公共晶体管TC2。第二公共晶体管TC2由第n发射信号EM(n)控制，以电连接N4节点和N5节点。第二公共晶体管TC2使N4节点的电压等于N5节点的电压。因此，N5节点的电压值反映在N4节点中并被施加至第一电容器Cst1的另一个电极。由于第一电容Cst1的耦合，N5节点的电压值反映在驱动元件的栅极电压上，从而驱动元件产生精确的驱动电流。
第二像素驱动电路PC2不直接连接至驱动元件，并且将高电位电压VDD或参考电压Vref的恒定电压提供至N4节点和N5节点。因此，第二像素驱动电路PC2可以被包括在单位像素PXL中的多个子像素SPXL共享。取决于第二像素驱动电路PC2的晶体管的尺寸，第二像素驱动电路PC2也可以由多个像素PXL共享。在这种情况下，晶体管的尺寸可以由第一电容器Cst1的充电时间来确定。
参照图3，第二像素驱动电路PC2可以设置在像素PXL的公共区域CA中，并且由子像素SPXL共享。在这种情况下，第一公共线101和第二公共线102由子像素SPXL共享。因此，可以减小子像素SPXL的尺寸，从而可以减小单位像素PXL的尺寸。因此，可以实现高分辨率的显示面板。
参照图6和图5，在被划分为初始化时段①、采样时段②、保持时段③和发光时段④的时段中驱动像素驱动电路。
第(n-1)扫描信号S(n-1)和第n扫描信号S(n)中的每一个在一个水平时段1H期间包括逻辑低电压的脉冲。第n发射信号EM(n)在至少两个水平时段2H期间包括逻辑高电压脉冲。第(n-1)扫描信号S(n-1)具有逻辑低电压的一个水平时段1H被称为像素驱动电路的初始化时段①。此外，第n扫描信号S(n)具有逻辑低电压的一个水平时段1H称为像素驱动电路的采样时段②。尽管图5示出了第n发射信号EM(n)在四个水平时段4H期间具有逻辑高电压，但是本公开内容不限于此。第n发射信号EM(n)至少在像素驱动电路的初始化时段①和采样时段②期间具有逻辑高电压，从而抑制发光元件130的发光。第n发射信号EM(n)在除初始化时段①和采样时段②之外的时段期间或除四个水平时段4H之外的时段期间，可以具有逻辑低电压。第n发射信号EM(n)具有逻辑低电压的时段被称为像素驱动电路的发光时段④。
在初始化时段①中，第一像素驱动电路PC1的第二晶体管T2被导通，并且低电位电压VSS被施加至N2节点。此外，第二像素驱动电路PC2的第四公共晶体管TC4导通，并且参考电压Vref被施加至N4节点。因此，第一晶体管T1的栅极利用低电位电压VSS放电，并且第一电容器Cst1和第二电容器Cst2中的每一个的一个电极也利用低电位电压VSS放电。
在采样时段②中，第二像素驱动电路PC2的第三公共晶体管TC3导通，并且参考电压Vref被施加至N4节点。N4节点在采样时段②和初始化时段①期间保持参考电压Vref。
在采样时段②中，第一像素驱动电路PC1的第四晶体管T4导通，并且数据电压Vdata被施加至N1节点。另外，第三晶体管T3导通，并且N2节点与N3节点电连接。因此，驱动元件的栅极和漏极短路。因此，N2节点的电压增加，直到N2节点的电压与N1节点的电压之间的差等于驱动元件的阈值电压Vth。因此，在采样时段②结束时，N2节点的电压变为Vdata+Vth。N2节点的电压升高需要时间。需要足够的采样时间来精确地对驱动元件的阈值电压进行采样。将第n扫描信号S(n)完全转换成逻辑高电压也需要时间。因此，可以在采样时段②之后设置保持时段③。
保持时段③被示为一个水平时段1H，但本公开内容不限于此。为了使发光元件130即使在保持时段③期间也不发光，第n发射信号EM(n)保持逻辑高电压。当第n发射信号EM(n)转换成逻辑低电压时，发光元件130开始发光。
在发光时段④中，第二像素驱动电路PC2的第一公共晶体管TC1导通，并且高电位电压VDD被施加至N5节点。此外，第二公共晶体管TC2导通，并且N4节点的电压变得等于N5节点的电压。在这种情况下，实质上施加至N5节点的电压具有以下的值：通过将第一公共晶体管的阈值电压VTC1反映在高电位电压VDD中而获得的值。同样地，N4节点的电压从参考电压Vref变为高电位电压VDD与第一公共晶体管的阈值电压VTC1之间的差值。由于第一电容器Cst1的耦合，N2节点的电压变为Vdata+Vth+VDD-Vref-VTC1。
在发光时段④中，第一像素驱动电路PC1的第五晶体管T5导通，并且低电位电压VSS被施加至N3节点。因此，驱动元件被导通，并且驱动电流配置成被提供至发光元件130。因此，发光元件130发光。在这种情况下，驱动元件的源极电压变为VDD-VTC1-Vled。因此，驱动元件的驱动电流ID由以下等式2表示。
[等式2]
ID＝k(Vdata-Vref-Vled)2
在等式2中，k是由驱动元件的特性确定的常数值，VTC1是第一公共晶体管TC1的阈值电压，并且Vled是发光元件130的阈值电压。参考等式2，从驱动电流ID中去除驱动元件的阈值电压Vth。因此，驱动电流ID不依赖于驱动元件的阈值电压Vth，并且不受阈值电压Vth的变化的影响。此外，与本公开内容的实施方式不同，从驱动电流ID中去除第一公共晶体管的阈值电压VTC1。因此，驱动电流ID不受第一公共晶体管TC1的阈值电压VTC1变化的影响。因此，可以确保驱动电流ID的可靠性并提高显示面板的亮度均匀性。
此外，驱动电流ID不受由于电流的影响而经历电压降的高电位电压VDD的影响。然而，驱动电流ID受到参考电压Vref的影响，参考电压Vref几乎不受由于施加至其的恒定电压引起的电压降的影响。因此，可以抑制取决于像素PXL在显示面板上的位置的亮度变化。
本公开内容的示例性实施方式还可以描述如下：
根据本公开内容的一个方面，电致发光显示装置包括像素，该像素包括子像素，并且被划分为公共区域和设置子像素的子像素区域。子像素中的每个子像素包括发光元件，该发光元件包括阳极电极和阴极电极。在子像素区域中设置有第一像素驱动电路，并且在公共区域中设置有第二像素驱动电路。发光元件的阳极电极连接至第一公共线，第一公共线连接至第二像素驱动电路。子像素中的每个子像素还包括驱动元件，该驱动元件包括连接至第一节点的源极、连接至第二节点的栅极和连接至第三节点的漏极。子像素还包括连接至第一节点的第四晶体管、连接至第二节点的第二晶体管和连接至第三节点的第五晶体管。子像素还包括连接至第二节点和第三节点的第三晶体管，以及第一电容器，该第一电容器连接至第二节点和第二公共线，第二公共线连接至第二像素驱动电路。子像素还包括连接至第一公共线和第一节点或第二节点的第二电容器，以及设置在驱动元件下方的导电层。导电层连接至第一节点或驱动元件的栅极。在这种情况下，当电致发光显示装置的子像素由于静电而产生缺陷时，子像素变暗。因此，可以减少图像质量缺陷。
第二像素驱动电路可以包括被配置成向第一公共线施加电压的第一公共开关电路，以及被配置成向第二公共线施加电压的第二公共开关电路。
子像素可以通过第一公共线和第二公共线彼此连接。
第二公共开关电路可以连接至被配置成提供参考电压的线，并且参考电压可以配置成被提供至驱动元件的栅极，以导通驱动元件。
第二像素驱动电路可以由受到第(n-1)扫描信号、第n扫描信号和第n发射信号控制的晶体管实现。
第四晶体管可以由第n扫描信号控制，以将数据电压提供至第一节点。
第二晶体管可以由第(n-1)扫描信号控制，并且连接至被提供以低电位电压的线，以将低电位电压提供至第二节点。
第五晶体管可以由第n发射信号控制，并且连接至被提供以低电位电压的线，以向第三节点提供低电位电压。
第三晶体管可以由第n扫描信号控制，以电连接第二节点和第三节点。
根据本公开内容的另一方面，电致发光显示装置包括发光元件，该发光元件包括阳极电极和阴极电极，该阳极电极连接至被提供以高电位电压的第一公共线。电致发光显示装置还包括子像素，该子像素包括向发光元件提供驱动电流的像素驱动电路。子像素还包括驱动元件，其包括连接至第一节点的源极、连接至第二节点的栅极和连接至第三节点的漏极。子像素还包括连接至阳极电极的第一公共开关电路，以及第一电容器，该第一电容器包括连接至第二节点的第一电极以及连接至第四节点的第二电极。子像素还包括连接至第二节点的第二开关电路和连接至第三节点的第三开关电路。子像素还包括连接至第一节点的第一开关电路和连接至第四节点的第二公共开关电路。因此，当电致发光显示装置的子像素由于静电而产生缺陷时，子像素变暗。因此，可以减少图像质量缺陷。
第一公共开关电路可以由第n发射信号控制，以将高电位电压提供至第一公共线并且电连接第四节点和第一公共线。
第二开关电路可以由第n扫描信号控制，以电连接第二节点和第三节点，并且第二开关电路可以由第(n-1)扫描信号控制，以向第二节点提供低电位电压。
第三开关电路可以由第n发射信号控制，以向第三节点提供低电位电压。
第一开关电路可以由第n扫描信号控制，以向第一节点提供数据电压。
第二公共开关电路可以由第(n-1)扫描信号和第n扫描信号控制，以向第四节点提供高于高电位电压的电压。
子像素还可以包括设置在驱动元件下方的导电层，并且导电层可以连接至第一节点或第二节点。
子像素还可以包括第二电容器，第二电容器包括连接至第二节点的一个电极和连接至第一节点的另一电极。
尽管已经参照附图详细描述了本公开内容的示例性实施方式，但是本公开内容不限于此，并且可以在不背离本公开内容的技术构思的情况下以许多不同的形式来实施。因此，提供本公开内容的示例性实施方式仅用于说明的目的，而不意图限制本公开内容的技术构思。本公开内容的技术构思的范围不限于此。因此，应当理解，上述示例性实施方式在所有方面都是示例性的，并不限制本公开内容。本公开内容的保护范围应基于所附权利要求理解，其等同范围内的所有技术构思均应理解为落入本公开内容的保护范围之内。

Claims (19)

1.一种电致发光显示装置，包括：
像素，其包括子像素，并且被划分为公共区域和设置所述子像素的子像素区域，
其中，所述子像素中的每个子像素包括发光元件，所述发光元件包括阳极电极和阴极电极，
在所述子像素区域中，设置有第一像素驱动电路，
在所述公共区域中，设置有第二像素驱动电路，
所述发光元件的所述阳极电极连接至第一公共线，所述第一公共线连接至所述第二像素驱动电路，
并且其中，所述子像素中的每个子像素还包括：
驱动元件，其包括连接至第一节点的源极、连接至第二节点的栅极、以及连接至第三节点的漏极；
第四晶体管，其连接至所述第一节点；
第二晶体管，其连接至所述第二节点；
第五晶体管，其连接至所述第三节点；
第三晶体管，其连接至所述第二节点和所述第三节点；
第一电容器，其连接至所述第二节点和第二公共线，所述第二公共线连接至所述第二像素驱动电路；
第二电容器，其连接至所述第一公共线以及所述第一节点或所述第二节点；以及
导电层，其设置在所述驱动元件下方，其中，所述导电层连接至所述第一节点或所述驱动元件的栅极。
2.根据权利要求1所述的电致发光显示装置，
其中，所述第二像素驱动电路包括被配置成向所述第一公共线施加电压的第一公共开关电路，以及被配置成向所述第二公共线施加电压的第二公共开关电路。
3.根据权利要求2所述的电致发光显示装置，
其中，所述子像素通过所述第一公共线和所述第二公共线彼此连接。
4.根据权利要求2所述的电致发光显示装置，
其中，所述第二公共开关电路连接至被配置成提供参考电压的线，并且所述参考电压配置成被提供至所述驱动元件的栅极，以导通所述驱动元件。
5.根据权利要求1所述的电致发光显示装置，
其中，所述第二像素驱动电路由受到第(n-1)扫描信号、第n扫描信号和第n发射信号控制的晶体管实现。
6.根据权利要求1所述的电致发光显示装置，
其中，所述第四晶体管由第n扫描信号控制，以向所述第一节点提供数据电压。
7.根据权利要求1所述的电致发光显示装置，
其中，所述第二晶体管由第(n-1)扫描信号控制，并且连接至被提供以低电位电压的线，以将所述低电位电压提供至所述第二节点。
8.根据权利要求1所述的电致发光显示装置，
其中，所述第五晶体管由第n发射信号控制，并且连接至被提供以低电位电压的线，以向所述第三节点提供所述低电位电压。
9.根据权利要求1所述的电致发光显示装置，
其中，所述第三晶体管由第n扫描信号控制，以电连接所述第二节点和所述第三节点。
10.一种电致发光显示装置，包括：
发光元件，其包括阳极电极和阴极电极，所述阳极电极连接至被提供以高电位电压的第一公共线；以及
子像素，其包括向所述发光元件提供驱动电流的像素驱动电路，
其中，所述子像素还包括：
驱动元件，其包括连接至第一节点的源极、连接至第二节点的栅极、以及连接至第三节点的漏极；
第一公共开关电路，其连接至所述阳极电极；
第一电容器，其包括连接至所述第二节点的第一电极，以及连接至第四节点的第二电极；
第二开关电路，其连接至所述第二节点；
第三开关电路，其连接至所述第三节点；
第一开关电路，其连接至所述第一节点；以及
第二公共开关电路，其连接至所述第四节点。
11.根据权利要求10所述的电致发光显示装置，
其中，所述第一公共开关电路由第n发射信号控制，以向所述第一公共线提供所述高电位电压并且电连接所述第四节点和所述第一公共线。
12.根据权利要求10所述的电致发光显示装置，
其中，所述第二开关电路由第n扫描信号控制，以电连接所述第二节点和所述第三节点，并且所述第二开关电路由第(n-1)扫描信号控制，以向所述第二节点提供低电位电压。
13.根据权利要求10所述的电致发光显示装置，
其中，所述第三开关电路由第n发射信号控制，以向所述第三节点提供低电位电压。
14.根据权利要求10所述的电致发光显示装置，
其中，所述第一开关电路由第n扫描信号控制，以向所述第一节点提供数据电压。
15.根据权利要求10所述的电致发光显示装置，
其中，所述第二公共开关电路由第(n-1)扫描信号和第n扫描信号控制，以向所述第四节点提供高于所述高电位电压的电压。
16.根据权利要求10所述的电致发光显示装置，
其中，所述子像素还包括设置在所述驱动元件下方的导电层，并且
所述导电层连接至所述第一节点或所述第二节点。
17.根据权利要求10所述的电致发光显示装置，
其中，所述子像素还包括第二电容器，所述第二电容器包括连接至所述第二节点的一个电极，以及连接至所述第一节点的另一电极。
18.根据权利要求17所述的电致发光显示装置，其中，当所述第二电容器的两个电极短接时，所述驱动元件的源极和栅极之间的电压差变为0V，并且所述驱动元件关断。
19.一种电致发光显示装置，包括：
像素，其包括子像素，并且被划分为子像素区域和公共区域，所述子像素和第一像素驱动电路设置在所述子像素区域中，第二像素驱动电路设置在所述公共区域中，
其中，所述子像素中的每个子像素包括：
发光元件，其包括阳极电极和阴极电极，其中，所述阳极电极连接至被提供以高电位电压的第一公共线，并且连接至所述第二像素驱动电路；
驱动元件，其包括连接至第一节点的源极、连接至第二节点的栅极、以及连接至第三节点的漏极；
第四晶体管，其连接至所述第一节点；
第二晶体管，其连接至所述第二节点；
第五晶体管，其连接至所述第三节点；
第三晶体管，其连接至所述第二节点和所述第三节点；
第一电容器，其连接至所述第二节点和第二公共线，所述第二公共线连接至所述第二像素驱动电路；以及
第二电容器，其包括连接至所述第二节点的一个电极，以及连接至所述第一公共线的另一电极，
其中，当所述第二电容器的两个电极短接时，所述高电位电压被施加至所述驱动元件的栅极，并且所述驱动元件关断。
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