CN114779542A - 电子设备、显示装置及其像素排列结构 - Google Patents
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Abstract
本申请主要是涉及电子设备、显示装置及其像素排列结构,像素排列结构包括重复排列的基本像素单元,每一基本像素单元包括具有第一颜色的第一像素、具有第二颜色的第二像素和具有第三颜色的第三像素,第一像素、第二像素和第三像素中至少一者包括对应的至少两个子像素,即将原本的像素拆分成多个,使得原本的像素间隙被更多的像素占据,以在较少(甚至不)扩大基本像素单元的情况下减小像素间隙,使得像素排列更加紧凑,有利于改善纱窗效应和颗粒感。此外,同一像素的至少两个子像素依旧对应像素驱动电路中原有的漏极,而无需增加额外的薄膜晶体管,从而较少(甚至不)改变原有的像素驱动电路。
Description
技术领域
本申请涉及电子设备的技术领域,具体是涉及电子设备、显示装置及其像素排列结构。
背景技术
随着电子设备的不断普及,电子设备已经成为人们日常生活中不可或缺的社交、娱乐工具,人们对于电子设备的要求也越来越高。电子设备已不在局限于智能手机,而是更多地拓展至诸如虚拟现实(Virtual Reality,VR)、增强现实(Augmented Reality,AR)、混合现实(Mixed Reality,MR)、介导现实(Mediated Reality,MR)等的智能眼镜。
发明内容
本申请实施例提供了一种像素排列结构,像素排列结构包括重复排列的基本像素单元,每一基本像素单元包括具有第一颜色的第一像素、具有第二颜色的第二像素和具有第三颜色的第三像素,第一像素、第二像素和第三像素中至少一者包括对应的至少两个子像素。
本申请实施例还提供了一种显示装置,显示装置包括像素驱动电路和上述实施例所述的像素排列结构,像素排列结构与像素驱动电路电性连接。
本申请实施例又提供了一种电子设备,电子设备包括上述实施例所述的显示装置。
本申请的有益效果是:本申请提供的像素排列结构中第一像素、第二像素和第三像素中至少一者包括对应的至少两个子像素,也即将原本的像素拆分成多个,使得原本的像素间隙被更多的像素占据,以在较少(甚至不)扩大基本像素单元的情况下减小像素间隙,使得像素排列更加紧凑,这样有利于改善纱窗效应和颗粒感,提高显示的精细度。此外,本申请中同一像素的至少两个子像素依旧对应像素驱动电路中原有的漏极,而无需增加额外的薄膜晶体管及其他诸如扫描线、数据线、储存电容等相关结构,从而较少(甚至不)改变原有的像素驱动电路,进而控制像素驱动电路的制作成本。
附图说明
为了更清楚地说明本申请实施例中的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1是本申请提供的电子设备一实施例的结构示意图;
图2是图1中电子设备沿XZ平面的截面结构示意图;
图3是图2中一光机模组的原理结构示意图;
图4是本申请提供的显示装置中像素排列结构一实施例的结构示意图;
图5是本申请提供的显示装置中像素排列结构一实施例的结构示意图;
图6是本申请提供的电子设备一实施例所呈现的画面;
图7是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图;
图8是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图;
图9是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图;
图10是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图;
图11是本申请提供的显示装置一实施例的电路结构示意图;
图12是本申请提供的显示装置一实施例的层叠结构示意图。
具体实施方式
下面结合附图和实施例,对本申请作进一步的详细描述。特别指出的是,以下实施例仅用于说明本申请,但不对本申请的范围进行限定。同样的,以下实施例仅为本申请的部分实施例而非全部实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本申请保护的范围。
本申请中提及“实施例”意味着,结合实施例描述的特定特征、结构或特性可以包含在本申请的至少一个实施例中。本领域技术人员显式地和隐式地理解的是,本申请所描述的实施例可以与其他实施例相结合。
共同参阅图1至图3,图1是本申请提供的电子设备一实施例的结构示意图,图2是图1中电子设备沿XZ平面的截面结构示意图,图3是图2中一光机模组的原理结构示意图。需要说明的是:图1中示意图出电子设备的X、Y、Z三个方向,主要是为了示意出XY、XZ、YZ三个平面,以便于后文中进行相应的描述。因此,本申请中所有方向性指示(诸如上、下、左、右、前、后……)主要是用于解释在某一特定姿态(如附图1所示)下各部件之间的相对位置关系、运动情况等;如果该特定姿态发生改变时,则该方向性指示也相应地随之改变。
本申请中,电子设备10可以是基于虚拟现实(Virtual Reality,VR)、增强现实(Augmented Reality,AR)、混合现实(Mixed Reality,MR)、介导现实(Mediated Reality,MR)等概念的电子设备。其中,虚拟现实的实现方式一般是基于纯虚拟数字画面(例如由后文中提及的图像源142生成虚拟场景),增强现实、混合现实的实现方式一般是基于虚拟数字画面与裸眼现实(例如由人眼获取现实场景),介导现实的实现方式一般是基于虚拟数字画面与数字现实(例如由设备上额外的摄像头获取现实场景)。进一步地,由于这类电子设备需要为用户提供别样的视觉体验,使得它们在整机结构上可以是头戴式、眼镜式等。基于此,本实施例以电子设备10为AR眼镜为例进行示例性的说明。当然,在其他一些实施例中,电子设备10还可以是智能手机、智能手表等具有显示屏的终端设备。
结合图1及图2,电子设备10可以包括镜架组件11、镜腿组件12、转轴组件13和光机模组14。其中,镜腿组件12的数量可以为两个,两个镜腿组件12的一端可以分别通过转轴组件13与镜架组件11的两端一一对应活动连接。进一步地,光机模组14可以与镜架组件11连接,以便于为用户提供视觉体验,后文有相应的示例性说明。
作为示例性地,镜架组件11可以包括前壳111和后壳112,两者可以通过胶接、卡接、螺纹连接等组装方式中的一种或其组合进行装配连接。此时,后壳112与前壳111可以配合形成一设置光机模组14的收纳腔(图中未标注)。基于增强现实的实现方式,前壳111可以设有第一视窗113,后壳112可以设有第二视窗114,光机模组14则可以介于第一视窗113与第二视窗114之间。如此设置,当用户佩戴电子设备10时,外界环境的光线可以依次通过第一视窗113、光机模组14、第二视窗114而被用户的眼睛接收,以使得用户能够感受到裸眼现实;与此同时,光机模组14发出的光线也可以通过第二视窗114而被用户的眼睛接收,以使得用户能够感受到虚拟数字画面,进而将虚拟场景叠加到现实场景中。此时,第一视窗113和/或第二视窗114处可以设置光学镜片,这样至少可以控制外界环境的光线的透过率,以增加裸眼现实与虚拟数字画面之间的对比度。除此之外,光学镜片还可以保护光机模组14。
作为示例性地,镜腿组件12可以包括内壳121和外壳122,两者可以通过胶接、卡接、螺纹连接等组装方式中的一种或其组合进行装配连接。此时,外壳122与内壳121可以配合形成一设置主板15和/或电池16的收纳腔(图中未示出)。进一步地,结合图1,主板15可以设置在一镜腿组件12(例如对应于用户的右手的)内,以便于用户控制电子设备10;电池16可以设置在另一镜腿组件12(例如对应于用户的左手的)内,以便于增加电池16的容量,进而改善电子设备10的续航能力。除此之外,将光机模组14、主板15、电池16等结构件合理地分布设置在镜架组件11、镜腿组件12等结构件内,可以均衡电子设备10的重量分布,进而改善电子设备10在佩戴方面的可靠性和舒适性。
作为示例性地,光机模组14可以包括基座141和组装在基座141上的图像源142、第一镜片143、第二镜片144。其中,图像源142、第一镜片143和第二镜片144之间的相对位置关系可以呈三角形。作为示例性地,上述三角形可以为等腰直角三角形,第一镜片143位于其斜边。当然,图像源142与第一镜片143之间还可以设一透镜145,以便于图像聚焦。结合图2,在光机模组14与镜架组件11组装时,基座141可以与前壳111和/或后壳112组装连接,第一镜片143靠近第二视窗114,第二镜片144靠近第一视窗113。
进一步地,基于增强现实的实现方式,图像源142可以是LCD(Liquid CrystalDisplay)这类显示屏,也可以是OLED(Organic Light-Emitting Diode)、QLED(QuantumDot Light Emitting Diode)这类显示屏,还可以是Mini-LED、Micro-LED这类显示屏,以提供所需的虚拟数字画面;第一镜片143可以为分光镜,其具有相应的反射值和透射值(R1/T1);第二镜片144可以为凹面镜,其也具有相应的反射值和透射值(R2/T2)。结合图3,对于图像源142生成的虚拟数字画面而言,其光线的传播路径可以为:图像源142发出的光线投射至第一镜片143,光线以R1的百分比被第一镜片143部分反射至第二镜片144;这部分光线再以R2的百分比被第二镜片144部分反射至第一镜片143,并被第二镜片144聚焦;这部分光线以T1的百分比穿过第一镜片143而被用户的眼睛接收。对于外界环境的光线而言,其光线的传播路径可以为:光线以T2的百分比穿过第二镜片144,并进一步传播至第一镜片143;这部分光线以T1的百分比穿过第一镜片143而被用户的眼睛接收。
共同参阅图4至图6,图4是本申请提供的显示装置中像素排列结构一实施例的结构示意图,图5是本申请提供的显示装置中像素排列结构一实施例的结构示意图,图6是本申请提供的电子设备一实施例所呈现的画面。需要说明的是:图4和图5中虚线所框的像素可以构成像素排列结构中的最小重复单元(也即基本像素单元),例如图4中基本像素单元为RGBG,再例如图5中基本像素单元为RGB。换言之,像素排列结构包括重复排列的基本像素单元,基本像素单元定义为像素排列结构中所有像素重复排列的最小重复单元。
一般地,结合图12,显示装置可以包括层叠设置的基体(Substance,简写为Sub)、像素驱动电路(Pixel Drive Circuit,PDC)和像素排列结构,像素驱动电路和与像素驱动电路电性连接的像素排列结构,像素排列结构在像素驱动电路的控制下发光,或者像素排列结构在像素驱动电路控制液晶分子偏转的情况下呈现相应的颜色,进而使得显示装置显示画面。对于OLED这类显示屏,显示装置可以包括与像素驱动电路电性连接的阳极和阴极,以及介于阳极和阴极之间并在载流子作用下发出具有某一颜色的可见光的发光材料;例如分别发出红(R)、绿(G)和蓝(B)光的三种发光材料按照一定的规律分布,相邻两像素所对应的发光材料被像素定义层(Pixel Define Layer,PDL)隔开,以使得显示装置基于发光材料的分布规律划分出相应的像素排列结构。对于LCD这类显示屏,显示装置可以包括与像素驱动电路电性连接的液晶,以及位于液晶一侧的彩色滤光片;液晶分子在电场作用下偏转,彩色滤光片上具有按照一定的规律分布的分别具有红(R)、绿(G)和蓝(B)颜色的色块,相邻两像素所对应的色块被黑色矩阵(Black Matrix,BM)隔开,以使得显示装置基于色块的分布规律划分出相应的像素排列结构。其中,沿显示装置的出光方向观察,像素定义层和黑色矩阵一般呈网格,以形成多个彼此间隔的像素;像素排列结构中不同像素与像素驱动电路中不同的漏极一一对应,以使得每一像素均能够被像素驱动电路单独地控制。需要说明的是:关于像素驱动电路、像素排列结构及其他结构,为本领域的技术人员所熟知,在此不再一一赘述。
一般地,结合图11,对于一个典型的7T1C像素驱动电路,像素控制电路可以包括七个晶体管(例如T1、T2、……及T7)和一个存储电容Cst。其中,第一晶体管T1为驱动晶体管;第二晶体管T2、第三晶体管T3和第七晶体管T7的栅极接入本级的扫描信号(例如Scan2和Scan3),第四晶体管T4的栅极接入上一级的扫描信号Scan1,第四晶体管T4的源极连接第三晶体管T3的源极,第四晶体管T4的漏极分别连接第七晶体管T7的源极和参考电压Vref。进一步地,7T1C像素控制电路的作用可分为复位阶段S1、补偿阶段S2及发光阶段S3。
在复位阶段S1中,上一级的扫描信号Scan1为低电平,本级的扫描信号(例如Scan2和Scan3)与发光信号EM为高电平,因此第四晶体管T4导通,使得第一晶体管T1的栅极复位为参考电平Vref。
在电压补偿阶段S2中,发光信号EM一样为高电平,而上一级的扫描信号Scan1变为高电平,本级的扫描信号(例如Scan2和Scan3)变为低电平,因此第二晶体管T2导通,使得第一晶体管T1的源极接入数据信号Data。此时,由于第一晶体管T1的栅极和漏极短接,使得第一晶体管T1形成二极管结构,基于此,在第一晶体管T1的源极接入数据信号Data后,第一晶体管T1的栅极会充电至第一电位(Vdata-Vth)。其中,Vdata为数据信号Data的电平,Vth为第一晶体管T1的阈值电压。换言之,第一晶体管T1的栅极的电平会等于数据信号Data的电平与第一晶体管T1的阈值电压之间的差值。同时,第三晶体管T3与第七晶体管T7也接入低电平的本级的扫描信号(例如Scan2和Scan3),因此第七晶体管T7导通,使得有机发光二极管的阳极复位至参考电平Vref。
在发光阶段S3中,发光信号EM为低电平,上一级的扫描信号Scan1与本级的扫描信号(例如Scan2和Scan3)皆为高电平,因此第二晶体管T2、第三晶体管T3、第四晶体管T4与第七晶体管T7皆不导通,电压源ELVDD通过第一晶体管T1、第五晶体管T5及第六晶体管T6传输至有机发光二极管的阳极,进而与公共接地端ELVSS形成回路,使得有机发光二极管发光。
本申请的发明人在长期的研发工作中发现:对于OLED这类显示屏,例如图4,像素间隙一般在10~20μm级别;对于LCD这类显示屏,例如图5,像素间隙一般在5~10μm级别。其中,像素间隙可以定义为R、G、B像素中任意两者之间的最小间距。显然,像素间隙越大,显示屏的纱窗效应和颗粒感越严重。由于应用场景存在较大差别,这种级别的像素间隙对于诸如智能手机、智能手表的终端设备也许是能够容忍的,但对于诸如VR眼镜、AR眼镜的终端设备却是难以容忍的,例如图6所示的画面存在明显的纱窗效应和颗粒感。具体而言,不论图像源142是OLED这类显示屏,还是LCD这类显示屏,图像源142发出的光线在第一镜片143、第二镜片144及透镜145的作用下,光路发生改变,用户的看到的画面可能具有更为严重的纱窗效应和颗粒感,可以简单地视作像素间隙一定程度上被放大了。为此,本申请的一个发明初衷在于:如何减小显示屏的像素间隙,以改善纱窗效应和颗粒感,从而提高显示的精细度。然而,本领域的技术人员容易想到的技术方案是:增大像素排列结构的像素密度(也即单位面积上像素的数量),以使得像素更加紧凑,从而改善纱窗效应和颗粒感;但是这样也会导致像素驱动电路中扫描线、数据线、薄膜晶体管、储存电容等结构的数量成倍增加,使得像素驱动电路的制作成本急剧上升。
共同参阅图7至图10,图7是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图,图8是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图,图9是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图,图10是本申请提供的像素排列结构中基本像素单元一实施例的结构示意图。
结合图7至图10,每一基本像素单元100可以包括具有第一颜色的第一像素101、具有第二颜色的第二像素102和具有第三颜色的第三像素103,第一像素101、第二像素102和第三像素103中至少两者的数量相等。其中,第一颜色、第二颜色和第三颜色可以分别为红(R)、绿(G)和蓝(B)中的任意一种,且两两不相同。当然,每一基本像素单元100还可以包括具有第四颜色的第四像素,例如第四颜色为白色。为了便于描述,本实施例以第一像素101具有红色、第二像素102具有绿色及第三像素103具有蓝色为例进行示例性的说明。进一步地,第一像素101、第二像素102和第三像素103中至少一者可以包括对应的至少两个子像素,也即将原本的像素拆分成多个,使得原本的像素间隙被更多的像素占据,以在较少(甚至不)扩大基本像素单元的情况下减小像素间隙,使得像素排列更加紧凑,这样有利于改善纱窗效应和颗粒感,提高显示的精细度。此外,相较于增大像素排列结构的像素密度,本申请中同一像素的至少两个子像素依旧对应像素驱动电路中原有的漏极,而无需增加额外的薄膜晶体管及其他诸如扫描线、数据线、储存电容等相关结构,从而较少(甚至不)改变原有的像素驱动电路,进而控制像素驱动电路的制作成本。其中,第一像素101、第二像素102和第三像素103可以呈矩形、菱形等形状,相应的子像素也可以呈矩形、菱形等形状。
在一些实施例中,例如图7至图9,第一像素101和第三像素103的数量可以相等,并可以与第二像素102的数量不相等,例如第二像素102的数量等于第一像素101的数量与第三像素103的数量之和。其中,对于OLED这类显示屏,由于分别发出红(R)、绿(G)和蓝(B)光的三种发光材料的寿命存在一定的差异,使得三种发光材料的面积随之存在一定的差异。例如:RGB像素中B像素(也即对应发出蓝光的发光材料)的寿命相对最短,B像素(例如第三像素103)的面积也随之相对最大,这样有利于增加显示装置的可靠性。
在其他一些实施例中,例如图10,第一像素101、第二像素102和第三像素103的数量可以相等。其中,对于LCD这类显示屏,由于不依赖发光材料,使得分别具有红(R)、绿(G)和蓝(B)颜色的色块的面积可以相等,也即RGB像素的面积可以相等。
进一步地,结合图7,每一基本像素单元100中,第一像素101、第二像素102和第三像素103中一者可以包括对应的至少两个子像素,例如第二像素102包括至少两个第二子像素1021;或者,结合图8,第一像素101、第二像素102和第三像素103中两者可以分别包括对应的至少两个子像素,例如第一像素101包括至少两个第一子像素1011,第二像素102包括至少两个第二子像素1021;或者,结合图9或者图10,第一像素101、第二像素102和第三像素103中三者可以分别包括对应的至少两个子像素。
作为示例性地,结合图9或者图10,每一基本像素单元100中,第一像素101可以包括至少两个第一子像素1011,第二像素102可以包括至少两个第二子像素1021,第三像素103可以包括至少两个第三子像素1031,以使得更多的像素间隙被像素占据,以在较少(甚至不)扩大基本像素单元的情况下尽可能地减小像素间隙,使得像素排列更加紧凑,这样有利于改善纱窗效应和颗粒感,提高显示的精细度。其中,第一像素101、第二像素102和第三像素103中同一像素分隔前后的几何中心保持不变。进一步地,子像素可以绕其所在像素的几何中心均匀分布,例如至少两个第一子像素1011绕第一像素101的几何中心(例如端点C)均匀分布,再例如至少两个第三子像素1031绕第三像素103的几何中心(例如端点E)均匀分布,这样有利于增加像素排列结构的均匀性,并降低制作难度。结合图9及图4,以第一像素101为例,第一像素101分隔前的几何中心可以为端点C;随后,第一像素101可以拆分为四个第一子像素1011,四个第一子像素1011的几何中心的连线可以为四边形,前述四边形的几何中心也可以为端点C,此时四个第一子像素1011可以绕端点C均匀分布。
进一步地,每个第一像素101中的第一子像素1011、每个第二像素102中的第二子像素1021和每个第三像素103中的第三子像素1031中至少两者的数量可以相等,以在像素排列紧凑的情况下使得像素排列更加均匀,并兼顾显示装置的制作成本。例如:第一子像素1011的数量等于第三子像素1031的数量,并大于第二子像素1021的数量,这样有利于简化像素排列结构,进而降低显示装置的制作成本。
在一些实施例中,例如图9,第一子像素1011、第二子像素1021和第三子像素1031中第二子像素1021的面积最小,第二子像素1021的数量等于第一子像素1011的数量与第三子像素1031的数量之和。如此,针对图4所示的像素排列结构,图9所示的像素排列结构将原本的像素每一个都拆分成多个,使得原本的像素间隙被更多的像素占据,以在较少(甚至不)扩大基本像素单元的情况下尽可能地减小像素间隙,使得像素排列更加紧凑,这样有利于改善纱窗效应和颗粒感,提高显示的精细度。其中,第一子像素1011、第二子像素1021和第三子像素1031的数量可以分别为两个,或者三个,亦或者四个,等等;所有的第一子像素1011对应像素驱动电路的一个漏极,所有的第二子像素1021对应像素驱动电路的另一个漏极,所有的第三子像素1031对应像素驱动电路的又一个漏极。如此,同一像素的至少两个子像素依旧对应像素驱动电路中原有的漏极,而无需增加额外的薄膜晶体管及其他诸如扫描线、数据线、储存电容等相关结构,从而较少(甚至不)改变原有的像素驱动电路,进而控制像素驱动电路的制作成本。
进一步地,每一基本像素单元100中,第一像素101和第三像素103的数量可以分别为一个,第二像素102的数量可以为两个,也即每一基本像素单元中第二像素102的数量分别是第一像素101和第三像素103的两倍,这样有利于保证第一像素101、第二像素102和第三像素103的均匀分布,并同时保证第二像素102的像素面积最大,以延长其寿命。基于此,第一像素101的几何中心、第三像素103的几何中心与一个第二像素102的几何中心连线形成第一等腰直角三角形(例如△CDE),第三像素103的几何中心与两个第二像素102的几何中心连线形成第二等腰直角三角形(例如△DEF),第二等腰直角三角形与第一等腰直角三角形公用一直角边(例如线段DE),第二等腰直角三角形的斜边(例如线段DF)与第一等腰直角三角形的斜边(例如线段CE)平行。其中,结合图9,第一像素101、第二像素102和第三像素103中任意一者的几何中心可以定义为对应的至少两个子像素的几何中心的连线所围成的图形的几何中心,例如第一像素101的几何中心为四个第一子像素1011的几何中心的连线所围成的四边形的几何中心(例如端点C),再例如第三像素103的几何中心为四个第三子像素1031的几何中心的连线所围成的四边形的几何中心(例如端点E)。如此,第一像素101和第三像素103的几何中心可以位于同一水平线上,两组第二像素102的几何中心也可以位于同一水平线上;相邻第一像素101和第二像素102的几何中心的连线相对于水平线倾斜45°或者135°,相邻第三像素103和第二像素102的几何中心的连线相对于水平线倾斜45°或者135°,这样有利于增加像素排列结构的均匀性,并降低显示装置的制作难度。
类似地,第一子像素1011、第二子像素1021和第三子像素1031中第三子像素1031的面积最大,以延长第三子像素1031的寿命,这样有利于增加显示装置的可靠性。
进一步地,结合图11及图12,对于OLED这类显示屏,第一像素101、第二像素102和第三像素103中同一像素的子像素可以分别通过相应的过孔结构连接至像素驱动电路,例如同一像素的子像素所对应的阳极分别通过相应的过孔结构连接至像素驱动电路的同一漏极,也即同一像素的子像素(例如第一像素101的四个第一子像素1011)以并联的方式接入像素驱动电路(例如7T1C像素驱动电路中公共接地端ELVSS与第六晶体管T6的漏极之间)。换言之,每一像素通电(或者断电)时,该像素的子像素随之全部通电(或者断电),进而全部发光(或者不发光)。结合图4,相邻两发光材料被像素定义层隔开,也即相邻像素由像素定义层隔开。类似地,图7至图9中,同一像素中相邻子像素所对应的发光材料可以被像素定义层隔开,也即同一像素的子像素可以由像素定义层隔开。除此之外,图7至图9中,同一像素中相邻子像素所对应的发光材料还可以被阳极隔开,也即同一像素的子像素可以由阳极隔开。简而言之,第一像素101、第二像素102和第三像素103中同一像素的子像素由中间体104隔开,中间体104可以为显示装置的阳极或者像素定义层。值得注意的是,相较于像素定义层(一般为绝缘体),同一像素的子像素由阳极隔开有利于减小同一像素中每一子像素相对于像素驱动电路中与该像素电性连接的漏极的电势差,也即降低阻抗的差异性,从而增加同一像素的子像素发光的一致性,进而增加显示装置出光的均匀性。
在其他一些实施例中,例如图10,第一子像素1011、第二子像素1021和第三子像素1031的面积可以相等,第一子像素1011、第二子像素1021和第三子像素1031的数量也可以相等。如此,有利于增加像素排列结构的均匀性,并降低制作难度。此外,针对图5所示的像素排列结构,图10所示的像素排列结构将原本的像素每一个都拆分成多个,使得原本的像素间隙被更多的像素占据,以在较少(甚至不)扩大基本像素单元的情况下尽可能地减小像素间隙,使得像素排列更加紧凑,这样有利于改善纱窗效应和颗粒感,提高显示的精细度。
与OLED这类显示屏不同的是:对于LCD这类显示屏,同一像素中相邻子像素所对应的色块可以被黑矩阵隔开,也即同一像素的子像素可以由黑矩阵隔开。因此,同一像素的至少两个子像素依旧对应像素驱动电路中原有的漏极,而无需增加额外的薄膜晶体管及其他诸如扫描线、数据线、储存电容等相关结构,从而较少(甚至不)改变原有的像素驱动电路,进而控制像素驱动电路的制作成本。
以上所述仅为本申请的部分实施例,并非因此限制本申请的保护范围,凡是利用本申请说明书及附图内容所作的等效装置或等效流程变换,或直接或间接运用在其他相关的技术领域,均同理包括在本申请的专利保护范围内。
Claims (11)
1.一种像素排列结构,其特征在于,所述像素排列结构包括重复排列的基本像素单元,每一所述基本像素单元包括具有第一颜色的第一像素、具有第二颜色的第二像素和具有第三颜色的第三像素,所述第一像素、所述第二像素和所述第三像素中至少一者包括对应的至少两个子像素。
2.根据权利要求1所述的像素排列结构,其特征在于,每一所述基本像素单元中,所述第一像素包括至少两个第一子像素,所述第二像素包括至少两个第二子像素,所述第三像素包括至少两个第三子像素。
3.根据权利要求2所述的像素排列结构,其特征在于,每个所述第一像素中的第一子像素、每个所述第二像素中的第二子像素和每个所述第三像素中的第三子像素中至少两者的数量相等。
4.根据权利要求3所述的像素排列结构,其特征在于,所述第一子像素、所述第二子像素和所述第三子像素中所述第二子像素的面积最小,所述第二子像素的数量等于所述第一子像素的数量与所述第三子像素的数量之和。
5.根据权利要求4所述的像素排列结构,其特征在于,所述第一像素和所述第三像素的数量分别为一个,所述第二像素的数量为两个,所述第一像素的几何中心、所述第三像素的几何中心与一个所述第二像素的几何中心连线形成第一等腰直角三角形,所述第三像素的几何中心与两个所述第二像素的几何中心连线形成第二等腰直角三角形,所述第二等腰直角三角形与所述第一等腰直角三角形公用一直角边,所述第二等腰直角三角形的斜边与所述第一等腰直角三角形的斜边平行。
6.根据权利要求3所述的像素排列结构,其特征在于,所述第一子像素、所述第二子像素和所述第三子像素的面积相等,所述第一子像素、所述第二子像素和所述第三子像素的数量相等。
7.根据权利要求2所述的像素排列结构,其特征在于,所述第一像素、所述第二像素和所述第三像素中同一像素分隔前后的几何中心保持不变。
8.一种显示装置,其特征在于,所述显示装置包括像素驱动电路和权利要求1-7任一项所述的像素排列结构,所述像素排列结构与所述像素驱动电路电性连接。
9.根据权利要求8所述的显示装置,其特征在于,所述第一像素、所述第二像素和所述第三像素中同一像素的子像素由所述显示装置的阳极或者像素定义层隔开。
10.根据权利要求8所述的显示装置,其特征在于,所述第一像素、所述第二像素和所述第三像素中同一像素的子像素以并联的方式接入所述像素驱动电路。
11.一种电子设备,其特征在于,所述电子设备包括权利要求8-10任一项所述的显示装置。
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