CN113689817A - 驱动电路及显示装置 - Google Patents

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Abstract

本申请公开了一种驱动电路及显示装置。驱动电路包括第一端子；多个第二端子；第一电路模块，其与第一端子以及多个第二端子电性连接，第一电路模块用于降低第一端子接入的驱动信号传送至多个第二端子时产生的交流功率；以及多个第二电路模块，多个第二电路模块与多个第二端子一一对应电性连接，第二电路模块用于基于所述驱动信号输出数据信号。本申请提供的驱动电路及显示装置，通过在芯片内部设置第一电路模块，并将第一电路模块与第一端子以及多个第二端子电性连接，可以降低驱动信号在传送时产生的交流功率，从而降低电磁场的辐射强度。

Description

驱动电路及显示装置
技术领域
本申请涉及显示技术领域，具体涉及一种驱动电路及显示装置。
背景技术
随着显示行业高解析度以及高刷新率的发展，需要更高速率的传输协议，而高速率的驱动信号在传送时会产生较大交流功率，在驱动芯片内衍生严重的电磁干扰的问题。
发明内容
本申请提供一种驱动电路及显示装置，可以降低驱动信号在传送时产生的交流功率，从而降低电磁场的辐射强度。
第一方面，本申请提供一种驱动电路，其包括：
第一端子；
多个第二端子；
第一电路模块，其与所述第一端子以及多个所述第二端子电性连接，所述第一电路模块用于降低所述第一端子接入的驱动信号传送至多个所述第二端子时产生的交流功率；以及
多个第二电路模块，多个所述第二电路模块与多个所述第二端子一一对应电性连接，所述第二电路模块用于基于所述驱动信号输出数据信号。
在本申请提供的驱动电路中，所述第一电路模块包括多个电路单元，所述电路单元用于提升驱动电流，以增强所述驱动信号的驱动能力，多个所述电路单元串联设置形成一串联支路；其中，
所述串联支路具有一第一端以及多个第二端，所述第一端以及多个所述第二端依次设置，所述第一端与所述第一端子电性连接，多个所述第二端与多个所述第二端子一一对应电性连接。
在本申请提供的驱动电路中，所述电路单元包括运算放大器，所述运算放大器具有一正极性端、一负极性端以及一输出端，所述正极性端为所述电路单元的输入端，所述负极性端与所述输出端电性连接。
在本申请提供的驱动电路中，在所述串联支路上，相邻两个所述第二端之间设置的所述电路单元的数量相等。
在本申请提供的驱动电路中，在所述串联支路上，相邻两个所述第二端之间均设置一所述电路单元。
在本申请提供的驱动电路中，在所述串联支路上，相邻两个所述第二端之间设置的所述电路单元的数量沿着所述第一端至多个所述第二端的方向递增。
在本申请提供的驱动电路中，在所述串联支路上，所述第一端与所述第一端子之间还设置所述电路单元。
在本申请提供的驱动电路中，所述第一端子接入的驱动信号传送至第n个所述第二端子时产生的功率Pn，Pn＝fn*Cn*V2，其中，Cn为第n个所述第二端子对应的寄生电容，fn为第1个所述第二端子对应的寄生电容至第n个所述第二端子对应的寄生电容的充放电频率；V为所述驱动信号的电压值。
在本申请提供的驱动电路中，所述驱动信号为时钟信号、输出使能控制信号或者数据电压信号。
第二方面，本申请还提供一种显示装置，其包括显示面板以及与所述显示面板电性连接的驱动芯片，所述驱动芯片包括以上所述的驱动电路。
本申请提供的驱动电路及显示装置，通过在芯片内部设置第一电路模块，并将第一电路模块与第一端子以及多个第二端子电性连接，可以降低驱动信号在传送时产生的交流功率，从而降低电磁场的辐射强度。
附图说明
为了更清楚地说明本申请实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本申请实施例提供的驱动电路的结构示意图；
图2为本申请实施例提供的驱动电路的另一结构示意图；
图3为图2所示的驱动电路中的第一电路模块的结构示意图；
图4为图3所示的第一电路模块中的电路单元的结构示意图；
图5为图2所示的驱动电路中的第一电路模块的另一结构示意图；
图6为图2所示的驱动电路中的第一电路模块的再一结构示意图；
图7为本申请实施例提供的显示装置的结构示意图；
图8为本申请实施例提供的驱动芯片的结构示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请的一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。应当理解的是，此处所描述的具体实施方式仅用于说明和解释本申请，并不用于限制本申请。本申请的权利要求书以及说明书中的术语“第一”、“第二”等是用于区别不同对象，而不是用于描述特定顺序。
请参阅图1，图1为本申请实施例提供的驱动电路的结构示意图。如图1所示，图1所示的驱动电路10包括第一端子A1、多个第二端子B1以及多个第二电路模块101。多个第二电路模块101与多个第二端子B1一一对应电性连接。多个第二端子B1通过一信号线102与第一端子A1电性连接。第二电路模块101用于基于第一端子A1接入的驱动信号输出数据信号。数据信号提供给显示面板，使显示面板显示图像。
其中，信号线102具有一第一信号端D1以及多个第二信号端C1。第一信号端D1与第一端子A1电性连接。多个第二信号端C1与多个第二端子B1一一对应电性连接。也即，驱动信号从第一端子A1接入后，依次经过第一信号端D1以及多个第二信号端C1。
可以理解的，第一端子A1接入的驱动信号经第一信号端D1、多个第二信号端C1以及多个第二端子B1输出至多个第二电路模块101。由于信号线102上存在寄生电容，第一端子A1接入的驱动信号流经寄生电容时会产生电场，而时变的电场会产生时变的磁场，驱动信号在传送时会产生较大交流功率，从而使得驱动芯片内衍生严重的电磁干扰。
基于此，本申请还提供另一种驱动电路。本申请实施例提供的驱动电路可以降低驱动信号在传送时产生的交流功率，从而降低电磁场的辐射强度。其中，驱动电路可以集成在驱动芯片内。驱动芯片可以为显示装置的源极驱动芯片。
请参阅图2，图2为本申请实施例提供的驱动电路的另一结构示意图。图2所示的驱动电路20与图1所示的驱动电路10的区别在于：图2所示的驱动电路20设置有第一电路模块202。其中，图2所示的驱动电路202包括第一端子A2、多个第二端子B2、第一电路模块202以及多个第二电路模块201。其中，第一电路模块202与第一端子A2以及多个第二端子B2电性连接。多个第二电路模块201与多个第二端子B2一一对应电性连接。第二电路模块201用于基于驱动信号输出数据信号。第一电路模块202用于降低第一端子A2接入的驱动信号传送至多个第二端子B2时产生的交流功率。
其中，驱动信号可以为驱动芯片内其他模块输出的信号。比如，在数据驱动芯片内，驱动信号可以为时钟信号、输出使能控制信号或者数据电压信号。
具体的，请参阅图3，图3为图2所示的驱动电路中的第一电路模块的结构示意图。结合图2、图3所示，在本申请实施例提供的驱动电路20中，第一电路模块202包括多个电路单元2021。电路单元2021用于提升驱动电流，以增强驱动信号的驱动能力。多个电路单元2021串联设置形成一串联支路。串联支路具有一第一端D2以及多个第二端C2。第一端D2以及第二端C2依次设置。第一端D2与第一端子A2电性连接。多个第二端C2与多个第二端子B2一一对应电性连接。也即，驱动信号从第一端子A2接入后，依次经过第一端D2以及多个第二端C2。
其中，在串联支路上，相邻两个第二端C2之间设置的电路单元2021的数量相等。在本申请实施例中，在串联支路上，相邻两个第二端C2之间均设置一个电路单元2021。需要说明的是，在串联支路上，相邻两个第二端C2之间还可以均设置多个电路单元2021。也即，在串联支路上，相邻两个第二端C2之间可以设置两个电路单元2021、三个电路单元2021或者四个电路单元2021。在串联支路上，相邻两个第二端C2之间设置的电路单元2021的数量可以根据实际情况设置。
其中，请参阅图4，图4为图3所示的第一电路模块中的电路单元的结构示意图。结合图3、图4所示，在本申请实施例提供的驱动电路中，电路单元2021包括运算放大器20211。运算放大器2021具有一正极性端V+、一负极性端V-以及一输出端Vout。正极性端V+为电路单元的输入端。负极性端V-与输出端Vout电性连接。
比如，第一个电路单元至第m个电路单元依次设置。第一个电路单元为靠近第一端子的一电路单元，第m个电路单元为远离第一端子的一电路单元。其中，第一个电路单元包括第一运算放大器。第一运算放大器具有一第一正极性端、一第一负极性端以及一第一输出端。第二个电路单元包括第二算放大器。第二运算放大器具有一第二正极性端、一第二负极性端以及一第二输出端。第三个电路单元包括第三算放大器。第三运算放大器具有一第三正极性端、一第三负极性端以及一第三输出端。以此类推，第m个电路单元包括第二算放大器。第m运算放大器具有一第m正极性端、一第m负极性端以及一第m输出端。第一负极性端与第一输出端电性连接，第二负极性端与第二输出端电性连接，第三负极性端与第三输出端电性连接。以此类推，第m负极性端与第m输出端电性连接。第一正极性端与第一端电性连接。第一输出端与第二正极性端电性连接，第二输出端与第三正极性端电性连接。以此类推，第m-1输出端与第m正极性端电性连接。
其中，如图2、图3、图4所示，第一端子A2接入的驱动信号传送至第n个第二端子B2时产生的功率Pn，Pn＝fn*Cn*V2，其中，Cn为第n个第二端子B2对应的寄生电容，fn为第1个第二端子B2对应的寄生电容至第n个第二端子B2对应的寄生电容的充放电频率；V为驱动信号的电压值。也即，在图2、图3、图4所示的驱动电路中，第一端子A2接入的驱动信号传送至多个第二端子B2时产生的总功率P总，P11＝f1*C1*V2+f1*C2*V2+……+fn*Cn*V2。
其中，在图1所示的驱动电路中，第一端子A1接入的驱动信号传送至第n个第二端子B1时产生的功率Qn，Qn＝f*Cn*V2，其中，Cn为第n个第二端子B1对应的寄生电容，f为第1个第二端子B1对应的寄生电容至第n个第二端子B1对应的寄生电容的充放电频率；V为驱动信号的电压值。也即，在图1所示的驱动电路中，第一端子A1接入的驱动信号传送至多个第二端子时B1产生的总功率Q总，Q总＝f*C1*V2+f*C1*V2+……+f*Cn*V2，其中，f为第1个第二端子B1对应的寄生电容至第n个第二端子B1对应的寄生电容的充放电频率。
也即，图2、图3、图4所示的驱动电路20中第一端子A2接入的驱动信号传送至第一个第二端子B2时产生的功率P1小于图1所示的驱动电路10中第一端子A1接入的驱动信号传送至第一个第二端子B1时产生的功率Q1；图2、图3、图4所示的驱动电路20中第一端子A2接入的驱动信号传送至第二个第二端子B2时产生的功率P2小于图1所示的驱动电路10中第一端子A1接入的驱动信号传送至第二个第二端子B1时产生的功率Q2；以此类推，图2、图3、图4所示的驱动电路20中第一端子A2接入的驱动信号传送至第n-1个第二端子B2时产生的功率Pn-1小于图1所示的驱动电路10中第一端子A1接入的驱动信号传送至第n-1个第二端子B1时产生的功率Qn-1。图2、图3、图4所示的驱动电路20中第一端子A2接入的驱动信号传送至第n个第二端子B2时产生的功率Pn等于图1所示的驱动电路10中第一端子A1接入的驱动信号传送至第n个第二端子B1时产生的功率Qn。从而，图2、图3、图4所示的驱动电路20中第一端子A2接入的驱动信号传送至多个第二端子B2时产生的总功率P总小于图1所示的驱动电路10中第一端子A1接入的驱动信号传送至多个第二端子B1时产生的总功率Q总。
可以理解的，图2、图3、图4所示的驱动电路20相较于图1所示的驱动电路10，通过在芯片内部设置第一电路模块202，并将第一电路模块202与第一端子A2以及多个第二端子B2电性连接，可以降低驱动信号在传送时产生的交流功率，从而降低电磁场的辐射强度。
请参阅图5，图5为图2所示的驱动电路中的第一电路模块的另一结构示意图。其中，图5所示的第一电路模块302与图3所示的第一电路模块202的区别在于：图5所示的第一电路模块302，在串联支路上，相邻两个第二端C2之间设置的电路单元2021的数量沿着第一端D2至多个第二端C2的方向递增。
结合图2、图5所示，在本申请实施例提供的驱动电路20中，第一电路模块302包括多个电路单元2021。电路单元2021用于提升驱动电流，以增强驱动信号的驱动能力。多个电路单元2021串联设置形成一串联支路。串联支路2021具有一第一端D2以及多个第二端D2。第一端D2以及第二端C2依次设置。第一端D2与第一端子A2电性连接。多个第二端C2与多个第二端子B2一一对应电性连接。也即，驱动信号从第一端子A2接入后，依次经过第一端D2以及多个第二端C2。
其中，在串联支路上，相邻两个第二端C2之间设置的电路单元2021的数量沿着第一端D2至多个第二端C2的方向递增。在本申请实施例中，第一个相邻两个第二端C2之间设置一个电路单元2021，第二个相邻两个第二端C2之间设置两个电路单元2021，以此类推，第s个相邻两个第二端C2之间设置s个电路单元2021。需要说明的是，第一个相邻两个第二端C2之间设置的电路单元2021的数量与第二个相邻两个第二端C2之间设置的电路单元2021的数量可以递增1个电路单元2021、两个电路单元2021、三个电路单元2021或者四个电路单元2021。其中，递增的电路单元2021的数量可以根据实际情况设置。
请参阅图6，图6为图2所示的驱动电路中的第一电路模块的再一结构示意图。其中，图6所示的第一电路模块402与图3所示的第一电路模块202的区别在于：图6所示的第一电路模块402，在串联支路上，第一端A2与第一端子D2之间还设置电路单元2021。
请参阅图7，图7为本申请实施例提供的显示装置的结构示意图。如图7所示，本申请实施例提供的显示装置1000包括显示面板100以及与显示面板100电性连接的驱动芯片200。其中，驱动芯片200包括以上所述的驱动电路20。
具体的，请参照图8，图8为本申请实施例提供的驱动芯片的结构示意图。如图7所示，驱动芯片200包括数据接收模块210、逻辑控制模块220、移位寄存器模块230、数据寄存器模块240、数模转换模块250、第一驱动电路260以及第二驱动电路270。
其中，数据接收模块210与逻辑控制模块220、第一驱动电路260以及第二驱动电路270电性连接，逻辑控制模块220与移位寄存器模块230、第一驱动电路260以及第二驱动电路270电性连接，移位寄存器模块230与数据寄存器模块240电性连接，数据寄存器模块240与数模转换模块250电性连接，数模转换模块250与第一驱动电路260以及第二驱动电路270电性连接。数据接收模块210负责接收前端输入的差分信号，解码得到数据信息以及时钟信号，并传送时钟信号至第一驱动电路260以及第二驱动电路270。逻辑控制模块220起到整个芯片功能逻辑控制的作用，是否开启某个功能，控制何时输出信号等，并传送输出使能控制信号至第一驱动电路260以及第二驱动电路270。移位寄存器模块230将串行数据转为并行数据输出到数据寄存器模块240中。数模转换模块250将数字电压转换为模拟电压，并传送数据电压信号至第一驱动电路260以及第二驱动电路270。
其中，第一驱动电路260以及第二驱动电路270为以上所示的驱动电路20，具体可参照以上所述，在此不做赘述。
本申请提供的显示装置，通过在芯片内部设置第一电路模块，并将第一电路模块与第一端子以及多个第二端子电性连接，可以降低驱动信号在传送时产生的交流功率，从而降低电磁场的辐射强度。
以上对本申请实施例所提供的驱动电路及显示装置进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的方法及其核心思想；同时，对于本领域的技术人员，依据本申请的思想，在具体实施方式及应用范围上均会有改变之处，综上所述，本说明书内容不应理解为对本申请的限制。

Claims (10)

1.一种驱动电路，其特征在于，包括：
第一端子；
多个第二端子；
第一电路模块，其与所述第一端子以及多个所述第二端子电性连接，所述第一电路模块用于降低所述第一端子接入的驱动信号传送至多个所述第二端子时产生的交流功率；以及
多个第二电路模块，多个所述第二电路模块与多个所述第二端子一一对应电性连接，所述第二电路模块用于基于所述驱动信号输出数据信号。
2.根据权利要求1所述的驱动电路，其特征在于，所述第一电路模块包括多个电路单元，所述电路单元用于提升驱动电流，以增强所述驱动信号的驱动能力，多个所述电路单元串联设置形成一串联支路；其中，
所述串联支路具有一第一端以及多个第二端，所述第一端以及多个所述第二端依次设置，所述第一端与所述第一端子电性连接，多个所述第二端与多个所述第二端子一一对应电性连接。
3.根据权利要求2所述的驱动电路，其特征在于，所述电路单元包括运算放大器，所述运算放大器具有一正极性端、一负极性端以及一输出端，所述正极性端为所述电路单元的输入端，所述负极性端与所述输出端电性连接。
4.根据权利要求2所述的驱动电路，其特征在于，在所述串联支路上，相邻两个所述第二端之间设置的所述电路单元的数量相等。
5.根据权利要求4所述的驱动电路，其特征在于，在所述串联支路上，相邻两个所述第二端之间均设置一所述电路单元。
6.根据权利要求2所述的驱动电路，其特征在于，在所述串联支路上，相邻两个所述第二端之间设置的所述电路单元的数量沿着所述第一端至多个所述第二端的方向递增。
7.根据权利要求2所述的驱动电路，其特征在于，在所述串联支路上，所述第一端与所述第一端子之间还设置所述电路单元。
8.根据权利要求1所述的驱动电路，其特征在于，所述第一端子接入的驱动信号传送至第n个所述第二端子时产生的功率Pn，Pn＝fn*Cn*V2，其中，Cn为第n个所述第二端子对应的寄生电容，fn为第1个所述第二端子对应的寄生电容至第n个所述第二端子对应的寄生电容的充放电频率；V为所述驱动信号的电压值。
9.根据权利要求1所述的驱动电路，其特征在于，所述驱动信号为时钟信号、输出使能控制信号或者数据电压信号。
10.一种显示装置，其特征在于，包括显示面板以及与所述显示面板电性连接的驱动芯片，所述驱动芯片包括权利要求1-9任一项所述的驱动电路。
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