CN112908258A - 像素驱动电路、驱动方法、显示面板与显示装置 - Google Patents

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Abstract

本申请实施例的像素驱动电路、驱动方法、显示面板与显示装置，像素驱动电路包括：驱动模块，所述驱动模块的控制端与第一节点电连接，所述驱动模块的第一端与第二节点电连接，用于驱动发光元件发光；数据写入模块，所述数据写入模块的控制端与第一扫描信号线电连接，所述数据写入模块的第一端与数据信号端电连接，用于写入数据信号；耦合模块，所述耦合模块的第一端与所述数据写入模块的第二端电连接，所述耦合模块的第二端与所述第二节点电连接，用于将所述数据信号耦合至所述驱动模块的第一端。本申请实施例提供了一种新的数据信号写入方式，至少能够解决发光元件的亮度与预期正常亮度不一致、显示不良的技术问题。

Description

像素驱动电路、驱动方法、显示面板与显示装置
技术领域
本申请属于显示技术领域，尤其涉及一种像素驱动电路、驱动方法、显示面板与显示装置。
背景技术
有机发光二极管(Organic Light-Emitting Diode，OLED)显示面板具有高可视度、高亮度以及更轻薄的优点，因此，OLED显示面板的应用也越来越广泛。
OLED显示面板一般包含有若干个像素，每个像素包括与像素驱动电路电连接的发光元件。像素驱动电路中的晶体管可以产生驱动电流，发光元件响应像素驱动电路输出的驱动电流而发光。然而，经本申请的发明人研究发现，相关的像素驱动电路驱动发光元件发光时，发光元件的亮度往往与预期正常亮度不一致，存在显示不良的问题。
发明内容
本申请实施例提供一种像素驱动电路、驱动方法、显示面板与显示装置，能够解决发光元件的亮度与预期正常亮度不一致、显示不良的技术问题。
第一方面，本申请实施例提供一种像素驱动电路，该像素驱动电路包括：
驱动模块，驱动模块的控制端与第一节点电连接，驱动模块的第一端与第二节点电连接，用于驱动发光元件发光；
数据写入模块，数据写入模块的控制端与第一扫描信号线电连接，数据写入模块的第一端与数据信号端电连接，用于写入数据信号；
耦合模块，耦合模块的第一端与数据写入模块的第二端电连接，耦合模块的第二端与第二节点电连接，用于将数据信号耦合至驱动模块的第一端。
第二方面，基于同一发明构思，本申请实施例提供了一种驱动方法，该驱动方法应用于第一方面提供的像素驱动电路，该驱动方法包括：
数据写入阶段，数据写入模块在第一扫描信号线输出的第一扫描信号的控制下导通，将数据信号端输出的数据信号经由耦合模块耦合至驱动模块的第一端。
第三方面，基于同一发明构思，本申请实施例提供了一种显示面板，该显示面板包括第一方面提供的像素驱动电路。
第四方面，基于同一发明构思，本申请实施例提供了一种显示装置，该显示装置包括第一方面提供的像素驱动电路或者第三方面提供的显示面板。
经本申请的发明人研究发现，相关的像素驱动电路在驱动发光元件发光时会因为数据写入模块漏电流，使得数据信号对驱动模块的控制端的电位的影响，例如会拉低驱动模块的控制端的电位，进而使得发光元件的亮度低于预期正常亮度，出现屏幕亮度偏暗、显示不良的问题。有鉴于此，本申请实施例的像素驱动电路、驱动方法、显示面板与显示装置，提供了一种新的数据信号写入方式，数据写入模块不再与驱动模块的控制端连接，而是与驱动模块的第一端连接，并且在数据写入模块与驱动模块之间还设置有耦合模块，在数据写入阶段通过耦合模块将数据写入模块写入的数据信号耦合至驱动模块的第一端，在发光阶段耦合模块进行分压，减轻因漏电流输入的数据信号对驱动模块的控制端的电位的影响，进而使得驱动模块的控制端的电位维持在预设阈值范围内，保证发光元件能够正常发光，解决了发光元件的亮度与预期正常亮度不一致、显示不良的技术问题。
附图说明
为了更清楚地说明本申请实施例的技术方案，下面将对本申请实施例中所需要使用的附图作简单的介绍，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本申请实施例提供的一种像素驱动电路的电路示意图；
图2为本申请实施例提供的另一种像素驱动电路的电路示意图；
图3为本申请实施例提供的又一种像素驱动电路的电路示意图；
图4为本申请实施例提供的又一种像素驱动电路的电路示意图；
图5为本申请实施例提供的又一种像素驱动电路的电路示意图；
图6为本申请实施例提供的又一种像素驱动电路的电路示意图；
图7为本申请实施例提供的又一种像素驱动电路的电路示意图；
图8为本申请实施例提供的又一种像素驱动电路的电路示意图；
图9为本申请实施例提供的又一种像素驱动电路的电路示意图；
图10为本申请实施例提供的又一种像素驱动电路的电路示意图；
图11为本申请实施例提供的又一种像素驱动电路的电路示意图；
图12为本申请实施例提供的又一种像素驱动电路的电路示意图；
图13为本申请实施例提供的又一种像素驱动电路的电路示意图；
图14为本申请实施例提供的又一种像素驱动电路的电路示意图；
图15为本申请实施例提供的又一种像素驱动电路的电路示意图；
图16为本申请实施例提供的又一种像素驱动电路的电路示意图；
图17为本申请实施例提供的又一种像素驱动电路的电路示意图；
图18为本申请实施例提供的又一种像素驱动电路的电路示意图；
图19为本申请实施例提供的又一种像素驱动电路的电路示意图；
图20为本申请实施例提供的又一种像素驱动电路的电路示意图；
图21为本申请实施例提供的又一种像素驱动电路的电路示意图；
图22为本申请实施例提供的又一种像素驱动电路的电路示意图；
图23为本申请实施例提供的又一种像素驱动电路的电路示意图；
图24为本申请实施例提供的又一种像素驱动电路的电路示意图；
图25为本申请实施例提供的又一种像素驱动电路的电路示意图；
图26为本申请实施例提供的又一种像素驱动电路的电路示意图；
图27为图25所示的像素驱动电路的时序图；
图28为图26所示的像素驱动电路的时序图；
图29为本申请实施例提供的一种驱动方法的流程示意图；
图30为本申请实施例提供的另一种驱动方法的流程示意图；
图31为本申请实施例提供的又一种驱动方法的流程示意图；
图32为本申请实施例提供的又一种驱动方法的流程示意图；
图33为本申请实施例提供的又一种驱动方法的流程示意图；
图34为本申请实施例提供的又一种驱动方法的流程示意图；
图35为本申请实施例提供的又一种驱动方法的流程示意图；
图36为本申请实施例提供的又一种驱动方法的流程示意图；
图37为本申请实施例提供的又一种驱动方法的流程示意图；
图38为本申请实施例提供的又一种驱动方法的流程示意图；
图39为本申请实施例提供的又一种驱动方法的流程示意图；
图40为本申请实施例提供的一种显示面板的结构示意图；
图41为本申请实施例提供的一种显示装置的结构示意图。
具体实施方式
下面将详细描述本申请的各个方面的特征和示例性实施例，为了使本申请的目的、技术方案及优点更加清楚明白，以下结合附图及具体实施例，对本申请进行进一步详细描述。应理解，此处所描述的具体实施例仅意在解释本申请，而不是限定本申请。对于本领域技术人员来说，本申请可以在不需要这些具体细节中的一些细节的情况下实施。下面对实施例的描述仅仅是为了通过示出本申请的示例来提供对本申请更好的理解。
需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
需要说明的是，本申请实施例中的晶体管以P型晶体管为例进行说明，但不限于P型晶体管，也可以替换为N型晶体管。对于P型晶体管来说，导通电平为低电平，截止电平为高电平。即，P型晶体管的控制极为低电平时，其第一极和第二极之间导通，P型晶体管的控制端为高电平时，其第一极和第二极之间关断。在具体实施时，上述各晶体管的栅极作为其控制极，并且，根据各晶体管的栅极的信号以及其类型，可以将其第一极作为源极，第二极作为漏极，或者将其第一极作为漏极，第二极作为源极，在此不做区分，另外本发明实施例中的导通电平和截止电平均为泛指，导通电平是指任何能够使晶体管导通的电平，截止电平是指任何能够使晶体管截止/关断的电平。
在本申请实施例中，术语“电连接”可以是指两个组件直接电连接，也可以是指两个组件之间经由一个或多个其它组件电连接。
在本申请实施例中，第一节点和第二节点只是为了便于描述电路结构而定义的，第一节点和第二节点并不是一个实际的电路单元。
在不脱离本申请的精神或范围的情况下，在本申请中能进行各种修改和变化，这对于本领域技术人员来说是显而易见的。因而，本申请意在覆盖落入所对应权利要求(要求保护的技术方案)及其等同物范围内的本申请的修改和变化。需要说明的是，本申请实施例所提供的实施方式，在不矛盾的情况下可以相互组合。
在阐述本申请实施例所提供的技术方案之前，为了便于对本申请实施例理解，本申请首先对相关技术中存在的问题进行具体说明：
如前所述，OLED显示面板一般包含有若干个像素，每个像素包括与像素驱动电路电连接的发光元件。相关的像素驱动电路中的数据写入模块通常与驱动模块的控制端连接，在驱动发光元件发光时会因为数据写入模块漏电流，使得漏入的数据信号对驱动模块的控制端的电位的影响，例如会拉低驱动模块的控制端的电位，进而使得发光元件的亮度低于预期正常亮度，出现屏幕亮度偏暗、显示不良的问题。
为了解决相关技术问题，本申请实施例提供了一种像素驱动电路、驱动方法、显示面板与显示装置。
下面首先对本申请实施例所提供的像素驱动电路进行介绍。
图1为本申请实施例提供的一种像素驱动电路的电路示意图。如图1所示，该像素驱动电路包括：
驱动模块11，驱动模块11的控制端与第一节点N1电连接，驱动模块11的第一端与第二节点N2电连接，用于驱动发光元件D1发光；
数据写入模块12，数据写入模块12的控制端与第一扫描信号线S1电连接，数据写入模块12的第一端与数据信号端Data电连接，用于写入数据信号；
耦合模块13，耦合模块13的第一端与数据写入模块12的第二端电连接，耦合模块13的第二端与第二节点N2电连接，用于将数据信号耦合至驱动模块11的第一端。
本申请实施例的像素驱动电路，提供了一种新的数据信号写入方式，数据写入模块12与驱动模块11的第一端连接，并且在数据写入模块12与驱动模块11之间还设置有耦合模块13，在数据写入阶段通过耦合模块13将数据写入模块12写入的数据信号耦合至驱动模块11的第一端，在发光阶段耦合模块13进行分压，减轻因漏电流输入的数据信号对驱动模块11的控制端的电位的影响，进而使得驱动模块11的控制端的电位维持在预设阈值范围内，保证发光元件能够正常发光，解决了发光元件的亮度与预期正常亮度不一致、显示不良的技术问题。
图2为本申请实施例提供的另一种像素驱动电路的电路示意图。如图2所示，驱动模块11可以包括第一晶体管T1，数据写入模块12可以包括第二晶体管T2，耦合模块13可以包括耦合电容C1。第一晶体管T1的控制极与第一节点N1电连接，第一晶体管T1的第一极与第二节点N2电连接。
第二晶体管T2的控制极与第一扫描信号线S1电连接，第二晶体管T2的第一极与数据信号端Data电连接，第二晶体管T2的第二极与耦合电容C1的第一极板电连接。耦合电容C1的第二极板与第二节点N2电连接。
在数据写入阶段t2，第二晶体管T2在第一扫描信号线S1输出的第一扫描信号的控制下导通，通过耦合电容C1可以将第二晶体管T2写入的数据信号耦合至第一晶体管T1的第一极。在发光阶段t3，耦合电容C1可以对第二晶体管T2漏入的数据信号进行分压，减轻因漏电流输入的数据信号对第一晶体管T1的控制极的电位的影响，进而使得第一晶体管T1的控制极的电位维持在预设阈值范围内，保证发光元件能够正常发光，解决了发光元件的亮度与预期正常亮度不一致、显示不良的技术问题。
进一步地，经本申请的发明人发现，由于工艺偏差，OLED显示面板上的薄膜晶体管(Thin Film Transistor，TFT)的阈值电压Vth会发生偏移，导致不同的像素的电流出现不均匀的现象，进而会使得面板显示不均匀。
如图3所示，为了弥补TFT不均匀性所导致阈值电压偏移(Vth Shift)，保证不同的像素的电流的均匀性，像素驱动电路还可以包括：
阈值补偿模块14，阈值补偿模块14的控制端与第二扫描信号线S2电连接，阈值补偿模块14的第一端与第一节点N1电连接，阈值补偿模块14的第二端与驱动模块11的第二端电连接；
存储模块15，存储模块15的第一端与第一节点N1电连接，存储模块15的第二端与第一电源电压信号端PVDD电连接，用于维持第一节点N1的电位。
具体地，在数据写入阶段t2(又称“阈值补偿阶段”)，数据写入模块12在第一扫描信号线S1输出的第一扫描信号的控制下导通，阈值补偿模块14在第二扫描信号线S2输出的第二扫描信号的控制下导通，驱动模块11在第一节点N1的控制下导通。数据写入模块12写入的数据信号通过耦合模块13耦合至驱动模块11的第一端，阈值补偿模块14导通驱动模块11的控制端与驱动模块11的第二端，存储模块15维持驱动模块11的控制端的电位。在数据信号的作用下，驱动模块11的控制端的电位调整至目标电压值，其中，目标电压值可以为驱动模块11的第一端的电压值与驱动模块11的阈值电压Vth的差值。即，数据写入阶段的驱动模块11的控制端的电位VN1＝VN2-Vth。其中，VN2表示驱动模块11的第一端(即第二节点N2)的电压值。由此，本申请实施例通过耦合模块将数据写入模块写入的数据信号耦合至驱动模块的第一端，再利用驱动模块的第一端输入的数据信号进行阈值补偿，实现了对驱动TFT的阈值电压Vth进行补偿，消除了阈值电压Vth对像素的驱动电流的影响，保证了面板显示的均匀性，提高了显示效果。
图4为本申请实施例提供的又一种像素驱动电路的电路示意图。如图4所示，阈值补偿模块14可以包括第三晶体管T3，存储模块15可以包括存储电容C2。第三晶体管T3的控制极与第二扫描信号线S2电连接，第三晶体管T3的第一极与第一节点N1电连接，第三晶体管T3的第二极与第一晶体管T1的第二极电连接。存储电容C2的第一极板与第一节点N1电连接，存储电容C2的第二极板与第一电源电压信号端PVDD电连接。
在数据写入阶段t2，第三晶体管T3在第二扫描信号线S2输出的第二扫描信号的控制下导通，第三晶体管T3导通第一晶体管T1的控制极(第一节点N1)和第一晶体管T1的第二极；第一晶体管T1在第一节点N1的控制下导通，第一晶体管T1、第三晶体管T3和存储电容C2形成一回路；第二晶体管T2在第一扫描信号线S1输出的第一扫描信号的控制下导通，通过耦合电容C1将数据信号耦合至第一晶体管T1的第一极，第一晶体管T1抓取阈值，第一晶体管T1的控制极的电位调整至VN1＝VN2-Vth。由此，实现了对第一晶体管T1的阈值电压Vth进行补偿，消除了阈值电压Vth对像素的驱动电流的影响，保证了面板显示的均匀性，提高了显示效果。
需要说明的是，第一扫描信号线S1和第二扫描信号线S2可以是不同的扫描信号线，但在一些实施方式中，第一扫描信号线S1也可以与第二扫描信号线S2复用，即第一扫描信号线S1和第二扫描信号线S2可以是同一扫描信号线，第二晶体管T2的控制极和第三晶体管T3的控制极可以连接同一扫描信号线，具体示例会在下文中描述。
图5为本申请实施例提供的又一种像素驱动电路的电路示意图。如图5所示，为了使得第一节点N1每次可以成功的写入预期电压值，像素驱动电路还可以包括：
第一复位模块16，第一复位模块16的控制端与第三扫描信号线S3电连接，第一复位模块16的第一端与第一参考电压信号端Vref1电连接，第一复位模块16的第二端与第一节点N1电连接，用于对第一节点N1进行复位。具体地，在初始化阶段t1，第一复位模块16在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号端Vref1输出的第一参考电压信号对第一节点N1进行复位。通过对第一节点N1进行复位，可使得第一节点N1被拉低到较低电位，从而保证第一节点N1后续写入预期电压值时能够成功写入。
图6为本申请实施例提供的又一种像素驱动电路的电路示意图。如图6所示，第一复位模块16可以包括第四晶体管T4，第四晶体管T4的控制极与第三扫描信号线S3电连接，第四晶体管T4的第一极与第一参考电压信号端Vref1电连接，第四晶体管T4的第二极与第一节点N1电连接。具体地，在初始化阶段t1，第四晶体管T4在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号端Vref1输出的第一参考电压信号对第一节点N1进行复位。通过对第一节点N1进行复位，可使得第一节点N1被拉低到较低电位，从而保证第一节点N1后续写入预期电压值时能够成功写入。
图7为本申请实施例提供的又一种像素驱动电路的电路示意图。如图7所示，为了保证数据信号能够成功的耦合到驱动模块11的第一端，避免出现拖影现象，像素驱动电路还可以包括：
第二复位模块17，第二复位模块17的控制端与第三扫描信号线S3电连接，第二复位模块17的第一端与第二参考电压信号端Vref2电连接，第二复位模块17的第二端与耦合模块13的第一端电连接，用于对耦合模块13的第一端进行复位。具体地，在初始化阶段t1，第二复位模块17在第三扫描信号线S3输出的第三扫描信号的控制下导通，第二参考电压信号端Vref2输出的第二参考电压信号对耦合模块13的第一端进行复位。通过对耦合模块13的第一端进行复位，可使得耦合模块13的第一端被拉低到较低电位，从而保证后续数据信号能够通过耦合模块13成功的耦合到驱动模块11的第一端，避免出现拖影现象。
这里，需要说明的是，第二参考电压信号端Vref2可以与第一参考电压信号端Vref1复用。即，第二复位模块17的第一端可以与第一参考电压信号端Vref1连接，并利用第一参考电压信号端Vref1输出的第一参考电压信号对耦合模块13的第一端进行复位。
图8为本申请实施例提供的又一种像素驱动电路的电路示意图。如图8所示，第二复位模块17可以包括第五晶体管T5，第五晶体管T5的控制极与第三扫描信号线S3电连接，第五晶体管T5的第一极与第二参考电压信号端Vref2电连接，第五晶体管T5的第二极与耦合模块13的第一端电连接，例如第五晶体管T5的第二极可以与耦合电容C1的第一极板电连接。具体地，在初始化阶段t1，第五晶体管T5在第三扫描信号线S3输出的第三扫描信号的控制下导通，第二参考电压信号端Vref2输出的第二参考电压信号对耦合电容C1的第一极板进行复位。通过对耦合电容C1的第一极板进行复位，可使得耦合电容C1的第一极板被拉低到较低电位，从而保证后续数据信号能够通过耦合电容C1成功的耦合到第一晶体管T1的第一极，避免出现拖影现象。
图9为本申请实施例提供的又一种像素驱动电路的电路示意图。与图7不同的是，图9所示的第二复位模块17的第一端与第一复位模块16的第二端电连接，第一参考电压信号端Vref1输出的第一参考电压信号依次通过第一复位模块16和第二复位模块17，以对耦合模块13的第一端进行复位。如图9所示，第二复位模块17的控制端与第三扫描信号线S3电连接，第二复位模块17的第一端与第一复位模块16的第二端电连接，第二复位模块17的第二端与耦合模块13的第一端电连接，用于对耦合模块13的第一端进行复位。具体地，在初始化阶段t1，第一复位模块16在第三扫描信号线S3输出的第三扫描信号的控制下导通，第二复位模块17在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号依次通过第一复位模块16和第二复位模块17对耦合模块13的第一端进行复位。通过对耦合模块13的第一端进行复位，可使得耦合模块13的第一端被拉低到较低电位，从而保证后续数据信号能够通过耦合模块13成功的耦合到驱动模块11的第一端，避免出现拖影现象。
图10为本申请实施例提供的又一种像素驱动电路的电路示意图。如图10所示，对应图9所示的第二复位模块17，第二复位模块17可以包括第五晶体管T5，第五晶体管T5的控制极与第三扫描信号线S3电连接，第五晶体管T5的第一极与第一复位模块16的第二端电连接，第五晶体管T5的第二极与耦合模块13的第一端电连接。具体地，例如第五晶体管T5的控制极与第三扫描信号线S3电连接，第五晶体管T5的第一极与第四晶体管T4的第二极电连接，第五晶体管T5的第二极与耦合电容C1的第一极板电连接。在初始化阶段t1，第四晶体管T4在第三扫描信号线S3输出的第三扫描信号的控制下导通，第五晶体管T5在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号依次通过第四晶体管T4和第五晶体管T5对耦合电容C1的第一极板进行复位。通过对耦合电容C1的第一极板进行复位，可使得耦合电容C1的第一极板被拉低到较低电位，从而保证后续数据信号能够通过耦合电容C1成功的耦合到第一晶体管T1的第一极，避免出现拖影现象。
图11为本申请实施例提供的又一种像素驱动电路的电路示意图。与图7不同的是，图11所示的第二复位模块17的第一端与阈值补偿模块14的第二端电连接，第一参考电压信号端Vref1输出的第一参考电压信号可以依次通过第一复位模块16、阈值补偿模块14和第二复位模块17，以对耦合模块13的第一端进行复位。如图11所示，第二复位模块17的控制端与第三扫描信号线S3电连接，第二复位模块17的第一端与阈值补偿模块14的第二端电连接，第二复位模块17的第二端与耦合模块12的第一端电连接，用于对耦合模块12的第一端进行复位。具体地，在初始化阶段t1，第一复位模块16在第三扫描信号线S3输出的第三扫描信号的控制下导通，阈值补偿模块14在第二扫描信号线S2输出的第二扫描信号的控制下导通，第二复位模块17在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号可以依次通过第一复位模块16、阈值补偿模块14和第二复位模块17对耦合模块13的第一端进行复位。通过对耦合模块13的第一端进行复位，可使得耦合模块13的第一端被拉低到较低电位，从而保证后续数据信号能够通过耦合模块13成功的耦合到驱动模块11的第一端，避免出现拖影现象。
图12为本申请实施例提供的又一种像素驱动电路的电路示意图。如图12所示，对应图11所示的第二复位模块17，第二复位模块17可以包括第五晶体管T5，第五晶体管T5的控制极与第三扫描信号线S3电连接，第五晶体管T5的第一极与阈值补偿模块14的第二端电连接，第五晶体管T5的第二极与耦合模块13的第一端电连接。例如，第五晶体管T5的控制极与第三扫描信号线S3电连接，第五晶体管T5的第一极与第三晶体管T3的第二极电连接，第五晶体管T5的第二极与耦合电容C1的第一极板电连接。在初始化阶段t1，第四晶体管T4在第三扫描信号线S3输出的第三扫描信号的控制下导通，第三晶体管T3在第二扫描信号线S2输出的第二扫描信号的控制下导通，第五晶体管T5在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号依次通过第四晶体管T4、第三晶体管T3和第五晶体管T5对耦合电容C1的第一极板进行复位。通过对耦合电容C1的第一极板进行复位，可使得耦合电容C1的第一极板被拉低到较低电位，从而保证后续数据信号能够通过耦合电容C1成功的耦合到第一晶体管T1的第一极，避免出现拖影现象。
图13为本申请实施例提供的又一种像素驱动电路的电路示意图。如图13所示，为了使得第二节点N2每次可以成功的写入预期电压值，像素驱动电路还可以包括：
第三复位模块18，第三复位模块18的控制端与第三扫描信号线S3电连接，第三复位模块18的第一端与第三参考电压信号端Vref3电连接，第三复位模块18的第二端与第二节点N2电连接，用于对第二节点N2进行复位。具体地，在初始化阶段t1，第三复位模块18在第三扫描信号线S3输出的第三扫描信号的控制下导通，第三参考电压信号端Vref3输出的第三参考电压信号对第二节点N2进行复位。通过对第二节点N2进行复位，可使得第二节点N2被拉低到较低电位，从而保证第二节点N2后续写入预期电压值时能够成功写入。
需要说明的是，第三参考电压信号端Vref3可以与第一参考电压信号端Vref1或第二参考电压信号端Vref2复用。即，第三复位模块18的第一端可以与第一参考电压信号端Vref1或第二参考电压信号端Vref2连接，并利用第一参考电压信号端Vref1或第二参考电压信号端Vref2输出的参考电压信号对第二节点N2进行复位。
图14为本申请实施例提供的又一种像素驱动电路的电路示意图。如图14所示，第三复位模块18可以包括第六晶体管T6，第六晶体管T6的控制极与第三扫描信号线S3电连接，第六晶体管T6的第一极与第三参考电压信号端Vref3电连接，第六晶体管T6的第二极与第二节点N2电连接。具体地，在初始化阶段t1，第六晶体管T6在第三扫描信号线S3输出的第三扫描信号的控制下导通，第三参考电压信号端Vref3输出的第三参考电压信号对第二节点N2进行复位。通过对第二节点N2进行复位，可使得第二节点N2被拉低到较低电位，从而保证第二节点N2后续写入预期电压值时能够成功写入。
图15为本申请实施例提供的又一种像素驱动电路的电路示意图。与图13不同的是，图15所示的第三复位模块18的第一端与第一复位模块16的第二端电连接，第一参考电压信号端Vref1输出的第一参考电压信号依次通过第一复位模块16和第三复位模块18，以对第二节点N2进行复位。如图15所示，第三复位模块18的控制端与第三扫描信号线S3电连接，第三复位模块18的第一端与第一复位模块16的第二端电连接，第三复位模块18的第二端与第二节点N2电连接，用于对第二节点N2进行复位。具体地，在初始化阶段t1，第一复位模块16在第三扫描信号线S3输出的第三扫描信号的控制下导通，第三复位模块18在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号依次通过第一复位模块16和第三复位模块18对第二节点N2进行复位。通过对第二节点N2进行复位，可使得第二节点N2被拉低到较低电位，从而保证第二节点N2后续写入预期电压值时能够成功写入。
图16为本申请实施例提供的又一种像素驱动电路的电路示意图。如图16所示，对应如15所示的第三复位模块18，第三复位模块18可以包括第六晶体管T6，第六晶体管T6的控制极与第三扫描信号线S3电连接，第六晶体管T6的第一极与第一复位模块16的第二端电连接，第六晶体管T6的第二极与第二节点N2电连接。例如，第六晶体管T6的控制极与第三扫描信号线S3电连接，第六晶体管T6的第一极与第四晶体管T4的第二极电连接，第六晶体管T6的第二极与第二节点N2电连接。具体地，在初始化阶段t1，第四晶体管T4在第三扫描信号线S3输出的第三扫描信号的控制下导通，第六晶体管T6在第三扫描信号线S3输出的第三扫描信号的控制下导通，第一参考电压信号依次通过第四晶体管T4和第六晶体管T6对第二节点N2进行复位。通过对第二节点N2进行复位，可使得第二节点N2被拉低到较低电位，从而保证第二节点N2后续写入预期电压值时能够成功写入。
图17为本申请实施例提供的又一种像素驱动电路的电路示意图。如图17所示，与图13不同的是，第三复位模块18的控制端与第一发光控制信号线Emit1电连接，第三复位模块18的第一端与第一电源电压信号端PVDD电连接，第三复位模块18的第二端与第二节点N2电连接，用于利用第一电源电压信号端PVDD输入的第一电源电压信号对第二节点N2进行复位。具体地，在初始化阶段t1，第三复位模块18在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，第一电源电压信号对第二节点N2进行复位。通过对第二节点N2进行复位，可使得第二节点N2被拉低到较低电位，从而保证第二节点N2后续写入预期电压值时能够成功写入。
图18为本申请实施例提供的又一种像素驱动电路的电路示意图。如图1所示，对应图17所示的电路，第三复位模块18可以包括第六晶体管T6，第六晶体管T6的控制极与第一发光控制信号线Emit1电连接，第六晶体管T6的第一极与第一电源电压信号端PVDD电连接，第六晶体管T6的第二极与第二节点N2电连接。第六晶体管T6可以利用第一电源电压信号端PVDD输入的第一电源电压信号对第二节点N2进行复位。具体地，在初始化阶段t1，第六晶体管T6在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，第一电源电压信号对第二节点N2进行复位。通过对第二节点N2进行复位，可使得第二节点N2被拉低到较低电位，从而保证第二节点N2后续写入预期电压值时能够成功写入。
图19为本申请实施例提供的又一种像素驱动电路的电路示意图。如图19所示，为了保证在数据信号写入时驱动模块11不受第一电源电压信号的影响以及避免在数据信号写入时驱动模块11的电流流入发光元件，在图13或图15所示的电路的基础上，像素驱动电路还可以包括第一发光控制模块19和第二发光控制模块20，其中：
第一发光控制模块19，第一发光控制模块19的控制端与第一发光控制信号线Emit1电连接，第一发光控制模块19的第一端与第一电源电压信号端PVDD电连接，第一发光控制模块19的第二端与第二节点N2电连接。第二发光控制模块20，第二发光控制模块20的控制端与第一发光控制信号线Emit1电连接，第二发光控制模块20的第一端与驱动模块11的第二端电连接，第二发光控制模块20的第二端与发光元件D1的第一极电连接。具体地，在发光阶段t3，第一发光控制模块19在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，第二发光控制模块20在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，驱动模块11在第一节点N1的控制下导通，驱动模块11向发光元件D1提供驱动电流，发光元件D1在该驱动电流的驱动下发光。
图20为本申请实施例提供的又一种像素驱动电路的电路示意图。如图20所示，对应图19所示的电路，第一发光控制模块19可以包括第七晶体管T7，第二发光控制模块20可以包括第八晶体管T8，其中：第七晶体管T7的控制极与第一发光控制信号线Emit1电连接，第七晶体管T7的第一极与第一电源电压信号端PVDD电连接，第七晶体管T7的第二极与第二节点N2电连接。第八晶体管T8的控制极与第一发光控制信号线Emit1电连接，第八晶体管T8的第一极与驱动模块11的第二端电连接，例如第八晶体管T8的第一极可以与第一晶体管T1的第二极电连接，第八晶体管T8的第二极与发光元件D1的第一极电连接。具体地，在发光阶段t3，第七晶体管T7在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，第八晶体管T8在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，第一晶体管T1在第一节点N1的控制下导通，第一晶体管T1向发光元件D1提供驱动电流，发光元件D1在该驱动电流的驱动下发光。
图21为本申请实施例提供的又一种像素驱动电路的电路示意图。与图19不同的是，图21所示的第三复位模块18和第一发光控制模块19复用，并且第三复位模块18和第二发光控制模块20分别由第一发光控制信号线Emit1和第二发光控制信号线Emit2控制。如图21所示，在图17所示的电路的基础上，像素驱动电路还可以包括：第二发光控制模块20，第二发光控制模块20的控制端与第二发光控制信号线Emit2电连接，第二发光控制模块20的第一端与驱动模块11的第二端电连接，第二发光控制模块20的第二端与发光元件D1的第一极电连接。具体地，在发光阶段t3，第三复位模块18在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，第二发光控制模块20在第二发光控制信号线Emit2输出的第二发光控制信号的控制下导通，驱动模块11在第一节点N1的控制下导通，驱动模块11向发光元件D1提供驱动电流，发光元件D1在该驱动电流的驱动下发光。
图22为本申请实施例提供的又一种像素驱动电路的电路示意图。如图22所示，对应图21所示的电路，第二发光控制模块20可以包括第八晶体管T8，第八晶体管T8的控制极与第二发光控制信号线Emit2电连接，第八晶体管T8的第一极与驱动模块11的第二端电连接，例如第八晶体管T8的第一极可以与第一晶体管T1的第二极电连接，第八晶体管T8的第二极与发光元件D1的第一极电连接。具体地，在发光阶段t3，第六晶体管T6在第一发光控制信号线Emit1输出的第一发光控制信号的控制下导通，第八晶体管T8在第二发光控制信号线Emit2输出的第二发光控制信号的控制下导通，第一晶体管T1在第一节点N1的控制下导通，第一晶体管T1向发光元件D1提供驱动电流，发光元件D1在该驱动电流的驱动下发光。
图23为本申请实施例提供的又一种像素驱动电路的电路示意图。如图23所示，像素驱动电路还可以包括第四复位模块21，第四复位模块21的控制端与第四扫描信号线S4电连接，第四复位模块21的第一端与第四参考电压信号端Vref4电连接，第四复位模块21的第二端与发光元件D1的第一极电连接，用于对发光元件D1的第一极进行复位。具体地，在初始化阶段t1，第四复位模块21在第四扫描信号线S4输出的第四扫描信号的控制下导通，第四参考电压信号端Vref4输出的第四参考电压信号对发光元件D1的第一极进行复位。其中，发光元件D1的第一极可以为发光元件D1的阳极。
需要说明的是，第四扫描信号线S4可以与第三扫描信号线S3复用，第四参考电压信号端Vref4可以与上文中的第一参考电压信号端Vref1、第二参考电压信号端Vref2和第三参考电压信号端Vref3中的任意一个复用。换言之，第一参考电压信号端Vref1、第二参考电压信号端Vref2、第三参考电压信号端Vref3和第四参考电压信号端Vref4中的各个参考电压信号端之间可以彼此复用。此外，第四复位模块21的第一端还可以与第一复位模块16的第二端连接，第一参考电压信号端Vref1输出的第一参考电压信号依次通过第一复位模块16和第四复位模块21，以对发光元件D1的第一极进行复位。或者，第四复位模块21的第一端还可以与阈值补偿模块14的第二端连接，第一参考电压信号依次通过第一复位模块16、阈值补偿模块14和第四复位模块21，以对发光元件D1的第一极进行复位。
图24为本申请实施例提供的又一种像素驱动电路的电路示意图。如图24所示，对应图23所示的电路，第四复位模块21可以包括第九晶体管T9，第九晶体管T9的控制极与第四扫描信号线S4电连接，第九晶体管T9的第一极与第四参考电压信号端Vref4电连接，第九晶体管T9的第二极与发光元件D1的第一极电连接，用于对发光元件D1的第一极进行复位。具体地，在初始化阶段t1，第九晶体管T9在第四扫描信号线S4输出的第四扫描信号的控制下导通，第四参考电压信号端Vref4输出的第四参考电压信号对发光元件D1的第一极进行复位。
下面结合图25和图26所示的像素驱动电路的两个具体示例，对像素驱动电路进行详细说明。
在对图25和图26所示的像素驱动电路进行具体说明之前，需要说明的是，在图25和图26所示的像素驱动电路中，各个晶体管均以P型晶体管为例进行说明。对于P型晶体管来说，导通电平为低电平，截止电平为高电平。即，P型晶体管的控制极为低电平时，其第一极和第二极之间导通，P型晶体管的控制端为高电平时，其第一极和第二极之间关断。在具体实施时，也可以将图25和图26所示的像素驱动电路中的一个晶体管或多个晶体管替换为N型晶体管。对于N型晶体管来说，导通电平为高电平，截止电平为低电平。即，N型晶体管的控制极为高电平时，其第一极和第二极之间导通，N型晶体管的控制端为低电平时，其第一极和第二极之间关断。例如，以图25所示的第二晶体管T2为例，如图25所示，当第二晶体管T2由P型晶体管替换为N型晶体管时，只需将控制第二晶体管T2的第一扫描信号线S1的时序由t1-t3阶段的“高电平-低电平-高电平”更改为“低电平-高电平-低电平”，其他晶体管类似，在此不再赘述。
图27为图25所示的像素驱动电路的时序图。如图25和图27所示，共分为三个阶段：
在初始化阶段t1，第二扫描信号线S2输出导通电平，第三扫描信号线S3输出导通电平，第四晶体管T4在第三扫描信号线S3的控制下导通，第一参考电压信号对第一节点N1进行复位。第六晶体管T6在第三扫描信号线S3的控制下导通，第一参考电压信号对第二节点N2进行复位。第三晶体管在第二扫描信号线S2的控制下导通，第五晶体管T5在第三扫描信号线S3的控制下导通，第一参考电压信号依次通过第四晶体管T4、第三晶体管T3和第五晶体管T5对耦合电容C1的第一极板进行复位。
在数据写入阶段t2，第一扫描信号线S1输出导通电平，第二扫描信号线S2输出导通电平，第三扫描信号线S3输出截止电平。第三晶体管T3在第二扫描信号线S2的控制下导通，第三晶体管T3导通第一晶体管T1的控制极和第一晶体管T1的第二极；第一晶体管T1在第一节点N1的控制下导通，第一晶体管T1、第三晶体管T3和存储电容C2形成一回路；第二晶体管T2在第一扫描信号线S1控制下导通，通过耦合电容C1将数据信号耦合至第一晶体管T1的第一极，第一晶体管T1抓取阈值，第一晶体管T1的控制极的电位调整至VN1＝VN2-Vth，从而实现对第一晶体管T1的阈值电压Vth进行补偿。在发光阶段t3，第一发光控制信号线Emit1输出导通电平，第七晶体管T7在第一发光控制信号线Emit1的控制下导通，第八晶体管T8在第一发光控制信号线Emit1的控制下导通，第一晶体管T1在第一节点N1的控制下导通，第一晶体管T1向发光元件D1提供驱动电流，发光元件D1在该驱动电流的驱动下发光。其中，驱动电流的大小为I＝1/2coxμW/L(VPVDD-c2/(c1+c2)*Vdata)2。其中，cox表示第一晶体管T1的栅介质电容值；μ表示第一晶体管T1的迁移率；W/L表示第一晶体管T1的宽长比；VPVDD表示第一电源电压信号的电压值；Vdata表示数据信号的电压值；c1表示耦合电容C1的电容值；c2表示存储电容C2的电容值。
图28为图26所示的像素驱动电路的时序图。如图26和图28所示，共分为三个阶段：
在初始化阶段t1，第一发光控制信号线Emit1输出导通电平，第三扫描信号线输出导通电平。第六晶体管T6在第一发光控制信号线Emit1的控制下导通，第一电源电压信号端PVDD输出的第一电源电压信号对第二节点N2进行复位，此时，第二节点N2的电位为VPVDD。第四晶体管T4在第三扫描信号线S3的控制下导通，第一参考电压信号端Vref1输出的第一参考电压信号对第一节点N1进行复位。第五晶体管T5在第三扫描信号线S3的控制下导通，第一参考电压信号对耦合电容C1的第一极板进行复位，此时，耦合电容C1的第一极板处的电位为Vref’，Vref’表示第一参考电压信号的电压值。
在数据写入阶段t2，第一发光控制信号线Emit1输出截止电平，第一扫描信号线S1输出导通电平，第二扫描信号线S2输出导通电平，第三扫描信号线S3输出截止电平。第三晶体管T3在第二扫描信号线S2的控制下导通，第三晶体管T3导通第一晶体管T1的控制极和第一晶体管T1的第二极；第一晶体管T1在第一节点N1的控制下导通，第一晶体管T1、第三晶体管T3和存储电容C2形成一回路；第二晶体管T2在第一扫描信号线S1控制下导通，通过耦合电容C1将数据信号耦合至第一晶体管T1的第一极，第一晶体管T1抓取阈值，第一晶体管T1的控制极的电位调整至VN1＝VN2-Vth＝VPVDD+Vdata-Vref’-Vth，从而实现对第一晶体管T1的阈值电压Vth进行补偿。
需要说明的是，当第二晶体管T2和第三晶体管T3的控制时序相同时，例如当第二晶体管T2和第三晶体管T3均只在数据写入阶段t2导通时，控制第二晶体管T2导通/截止的第一扫描信号线S1与控制第三晶体管T3导通/截止的第二扫描信号线S2可以复用，即第一扫描信号线S1和第二扫描信号线S2可以是同一扫描信号线，第二晶体管T2的控制极和第三晶体管T3的控制极可以连接同一扫描信号线，本申请对此不作限定。
在发光阶段t3，第一发光控制信号线Emit1输出导通电平，第二发光控制信号线Emit2输出导通电平，第六晶体管T6在第一发光控制信号线Emit1的控制下导通，第八晶体管T8在第二发光控制信号线Emit2的控制下导通，第一晶体管T1在第一节点N1的控制下导通，第一晶体管T1向发光元件D1提供驱动电流，发光元件D1在该驱动电流的驱动下发光。其中，驱动电流的大小为I＝1/2coxμW/L(Vref’-Vdata)2。
基于上述实施例提供的像素驱动电路，相应地，本申请还提供了一种驱动方法。请参见以下实施例。
参见图29，本申请实施例提供的驱动方法可以包括：
S101、数据写入阶段，数据写入模块在第一扫描信号线输出的第一扫描信号的控制下导通，将数据信号端输出的数据信号经由耦合模块耦合至驱动模块的第一端。
本申请实施例的驱动方法，在数据写入阶段通过耦合模块13将数据写入模块12写入的数据信号耦合至驱动模块11的第一端，在发光阶段耦合模块13进行分压，减轻因漏电流输入的数据信号对驱动模块11的控制端的电位的影响，进而使得驱动模块11的控制端的电位维持在预设阈值范围内，保证发光元件能够正常发光，解决了发光元件的亮度与预期正常亮度不一致、显示不良的技术问题。
如图30所示，在一些实施方式中，S101还可以包括：在数据写入阶段，阈值补偿模块在第二扫描信号线输出的第二扫描信号的控制下导通，驱动模块在第一节点的控制下导通，在数据信号的作用下，存储模块将第一节点的电位维持在目标电压值。作为一个示例，目标电压值可以为驱动模块的第一端的电压值与驱动模块的阈值电压的差值。
如图31所示，在一些实施方式中，在S101之前，本申请实施例提供的驱动方法还可以包括：
S100、初始化阶段，第一复位模块在第三扫描信号线输出的第三扫描信号的控制下导通，第一参考电压信号端输出的参考电压信号对第一节点进行复位。
如图32所示，在一些实施方式中，S100还可以包括：初始化阶段，第二复位模块在第三扫描信号的控制下导通，第二参考电压信号端输出的参考电压信号对耦合模块的第一端进行复位。
如图33所示，在一些实施方式中，S100还可以包括：初始化阶段，第二复位模块在第三扫描信号的控制下导通，第一复位模块的第二端输出的参考电压信号对耦合模块的第一端进行复位。
如图34所示，在一些实施方式中，S100还可以包括：初始化阶段，第二复位模块在第三扫描信号的控制下导通，阈值补偿模块在第二扫描信号的控制下导通，阈值补偿模块的第二端输出的参考电压信号对耦合模块的第一端进行复位。
如图35所示，在一些实施方式中，S100还可以包括：初始化阶段，第三复位模块在第三扫描信号的控制下导通，第三参考电压信号端输出的参考电压信号对第二节点进行复位。
如图36所示，在一些实施方式中，S100还可以包括：初始化阶段，第三复位模块在第三扫描信号的控制下导通，第一复位模块的第二端输出的参考电压信号对第二节点进行复位。
如图37所示，在一些实施方式中，S100还可以包括：初始化阶段，第三复位模块在第一发光控制信号线输出的第一发光控制信号的控制下导通，第一电源电压信号端输出的第一电源电压信号对第二节点进行复位。
如图38所示，在一些实施方式中，在S101之后，本申请实施例提供的驱动方法还可以包括：
S102、发光阶段，第一发光控制模块和第二发光控制模块在第一发光控制信号线输出第一发光控制信号的控制下导通，驱动模块驱动发光元件发光。
如图39所示，在一些实施方式中，在S101之后，本申请实施例提供的驱动方法还可以包括：
S102、发光阶段，第三复位模块在第一发光控制信号线输出的第一发光控制信号的控制下导通，第二发光控制模块在第二发光控制信号线输出的第二发光控制信号的控制下导通，驱动模块驱动发光元件发光。
本申请实施例提供的驱动方法中的S100、S101和S102在介绍本申请实施例的像素驱动电路时详细说明，请参见上文，为了描述简洁，在此不再赘述。
本申请还提供了一种显示面板，如图40所示，该显示面板100可包括上述实施例中的像素驱动电路10。该显示面板100具体可以为AM-OLED显示面板，在此并不限定。
本申请还提供了一种显示装置，如图41所示，该显示装置1000可包括设备本体101以及上述实施例中的显示面板100，该显示面板100覆盖在设备本体101上。设备本体101中可设置有各类器件，如传感器件、处理器件等，在此并不限定。显示装置1000具体可以为手机、计算机、平板电脑、数码相机、电视机、电子纸等具有显示功能的装置，在此并不限定。
需要明确的是，本说明书中的各个实施例均采用递进的方式描述，各个实施例之间相同或相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。对于显示面板实施例和显示装置实施例而言，相关之处可以参见像素驱动电路实施例和阵列基板实施例的说明部分。本申请并不局限于上文所描述并在图中示出的特定结构。本领域的技术人员可以在领会本申请的精神之后，作出各种改变、修改和添加。并且，为了简明起见，这里省略对已知技术的详细描述。
本领域技术人员应能理解，上述实施例均是示例性而非限制性的。在不同实施例中出现的不同技术特征可以进行组合，以取得有益效果。本领域技术人员在研究附图、说明书及权利要求书的基础上，应能理解并实现所揭示的实施例的其他变化的实施例。在权利要求书中，术语“包括”并不排除其他结构；数量涉及“一个”但不排除多个；术语“第一”、“第二”用于标示名称而非用于表示任何特定的顺序。权利要求中的任何附图标记均不应被理解为对保护范围的限制。某些技术特征出现在不同的从属权利要求中并不意味着不能将这些技术特征进行组合以取得有益效果。

Claims (36)

1.一种像素驱动电路，其特征在于，包括：
驱动模块，所述驱动模块的控制端与第一节点电连接，所述驱动模块的第一端与第二节点电连接，用于驱动发光元件发光；
数据写入模块，所述数据写入模块的控制端与第一扫描信号线电连接，所述数据写入模块的第一端与数据信号端电连接，用于写入数据信号；
耦合模块，所述耦合模块的第一端与所述数据写入模块的第二端电连接，所述耦合模块的第二端与所述第二节点电连接，用于将所述数据信号耦合至所述驱动模块的第一端。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述驱动模块包括第一晶体管，所述数据写入模块包括第二晶体管，所述耦合模块包括耦合电容，其中：
所述第一晶体管的控制极与所述第一节点电连接，所述第一晶体管的第一极与所述第二节点电连接；
所述第二晶体管的控制极与所述第一扫描信号线电连接，所述第二晶体管的第一极与所述数据信号端电连接，所述第二晶体管的第二极与所述耦合电容的第一极板电连接；
所述耦合电容的第二极板与所述第二节点电连接。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
阈值补偿模块，所述阈值补偿模块的控制端与第二扫描信号线电连接，所述阈值补偿模块的第一端与所述第一节点电连接，所述阈值补偿模块的第二端与所述驱动模块的第二端电连接；
存储模块，所述存储模块的第一端与所述第一节点电连接，所述存储模块的第二端与第一电源电压信号端电连接，用于维持所述第一节点的电位。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述阈值补偿模块包括第三晶体管，所述存储模块包括存储电容，其中：
所述第三晶体管的控制极与所述第二扫描信号线电连接，所述第三晶体管的第一极与所述第一节点电连接，所述第三晶体管的第二极与第一晶体管的第二极电连接；
所述存储电容的第一极板与所述第一节点电连接，所述存储电容的第二极板与所述第一电源电压信号端电连接。
5.根据权利要求3所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第一复位模块，所述第一复位模块的控制端与第三扫描信号线电连接，所述第一复位模块的第一端与第一参考电压信号端电连接，所述第一复位模块的第二端与所述第一节点电连接，用于对所述第一节点进行复位。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述第一复位模块包括第四晶体管，其中：
所述第四晶体管的控制极与所述第三扫描信号线电连接，所述第四晶体管的第一极与所述第一参考电压信号端电连接，所述第四晶体管的第二极与所述第一节点电连接。
7.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二复位模块，所述第二复位模块的控制端与第三扫描信号线电连接，所述第二复位模块的第一端与第二参考电压信号端电连接，所述第二复位模块的第二端与所述耦合模块的第一端电连接，用于对所述耦合模块的第一端进行复位。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述第二复位模块包括第五晶体管，其中：
所述第五晶体管的控制极与所述第三扫描信号线电连接，所述第五晶体管的第一极与所述第二参考电压信号端电连接，所述第五晶体管的第二极与所述耦合模块的第一端电连接。
9.根据权利要求5所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二复位模块，所述第二复位模块的控制端与所述第三扫描信号线电连接，所述第二复位模块的第一端与所述第一复位模块的第二端电连接，所述第二复位模块的第二端与所述耦合模块的第一端电连接，用于对所述耦合模块的第一端进行复位。
10.根据权利要求9所述的像素驱动电路，其特征在于，所述第二复位模块包括第五晶体管，其中：
所述第五晶体管的控制极与所述第三扫描信号线电连接，所述第五晶体管的第一极与所述第一复位模块的第二端电连接，所述第五晶体管的第二极与所述耦合模块的第一端电连接。
11.根据权利要求3所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二复位模块，所述第二复位模块的控制端与所述第三扫描信号线电连接，所述第二复位模块的第一端与所述阈值补偿模块的第二端电连接，所述第二复位模块的第二端与所述耦合模块的第一端电连接，用于对所述耦合模块的第一端进行复位。
12.根据权利要求11所述的像素驱动电路，其特征在于，所述第二复位模块包括第五晶体管，其中：
所述第五晶体管的控制极与所述第三扫描信号线电连接，所述第五晶体管的第一极与所述阈值补偿模块的第二端电连接，所述第五晶体管的第二极与所述耦合模块的第一端电连接。
13.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第三复位模块，所述第三复位模块的控制端与第三扫描信号线电连接，所述第三复位模块的第一端与第三参考电压信号端电连接，所述第三复位模块的第二端与所述第二节点电连接，用于对所述第二节点进行复位。
14.根据权利要求13所述的像素驱动电路，其特征在于，所述第三复位模块包括第六晶体管，其中：
所述第六晶体管的控制极与所述第三扫描信号线电连接，所述第六晶体管的第一极与所述第三参考电压信号端电连接，所述第六晶体管的第二极与所述第二节点电连接。
15.根据权利要求5所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第三复位模块，所述第三复位模块的控制端与所述第三扫描信号线电连接，所述第三复位模块的第一端与所述第一复位模块的第二端电连接，所述第三复位模块的第二端与所述第二节点电连接，用于对所述第二节点进行复位。
16.根据权利要求15所述的像素驱动电路，其特征在于，所述第三复位模块包括第六晶体管，其中：
所述第六晶体管的控制极与所述第三扫描信号线电连接，所述第六晶体管的第一极与所述第一复位模块的第二端电连接，所述第六晶体管的第二极与所述第二节点电连接。
17.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第三复位模块，所述第三复位模块的控制端与第一发光控制信号线电连接，所述第三复位模块的第一端与第一电源电压信号端电连接，所述第三复位模块的第二端与所述第二节点电连接，可用于利用所述第一电源电压信号端输入的第一电源电压信号对所述第二节点进行复位。
18.根据权利要求17所述的像素驱动电路，其特征在于，所述第三复位模块包括第六晶体管，其中：
所述第六晶体管的控制极与所述第一发光控制信号线电连接，所述第六晶体管的第一极与所述第一电源电压信号端电连接，所述第六晶体管的第二极与所述第二节点电连接。
19.根据权利要求13或15所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第一发光控制模块，所述第一发光控制模块的控制端与第一发光控制信号线电连接，所述第一发光控制模块的第一端与第一电源电压信号端电连接，所述第一发光控制模块的第二端与所述第二节点电连接；
第二发光控制模块，所述第二发光控制模块的控制端与所述第一发光控制信号线电连接，所述第二发光控制模块的第一端与所述驱动模块的第二端电连接，所述第二发光控制模块的第二端与所述发光元件的第一极电连接。
20.根据权利要求19所述的像素驱动电路，其特征在于，所述第一发光控制模块包括第七晶体管，所述第二发光控制模块包括第八晶体管，其中：
所述第七晶体管的控制极与所述第一发光控制信号线电连接，所述第七晶体管的第一极与所述第一电源电压信号端电连接，所述第七晶体管的第二极与所述第二节点电连接；
所述第八晶体管的控制极与所述第一发光控制信号线电连接，所述第八晶体管的第一极与所述驱动模块的第二端电连接，所述第八晶体管的第二极与所述发光元件的第一极电连接。
21.根据权利要求17所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二发光控制模块，所述第二发光控制模块的控制端与第二发光控制信号线电连接，所述第二发光控制模块的第一端与所述驱动模块的第二端电连接，所述第二发光控制模块的第二端与所述发光元件的第一极电连接。
22.根据权利要求21所述的像素驱动电路，其特征在于，所述第二发光控制模块包括第八晶体管，其中：
所述第八晶体管的控制极与所述第二发光控制信号线电连接，所述第八晶体管的第一极与所述驱动模块的第二端电连接，所述第八晶体管的第二极与所述发光元件的第一极电连接。
23.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第四复位模块，所述第四复位模块的控制端与第四扫描信号线电连接，所述第四复位模块的第一端与第四参考电压信号端电连接，所述第四复位模块的第二端与所述发光元件的第一极电连接，用于对所述发光元件的第一极进行复位。
24.一种驱动方法，其特征在于，应用于如权利要求1至23中任一项所述的像素驱动电路，包括：
数据写入阶段，所述数据写入模块在所述第一扫描信号线输出的第一扫描信号的控制下导通，将所述数据信号端输出的数据信号经由所述耦合模块耦合至所述驱动模块的第一端。
25.根据权利要求24所述的驱动方法，其特征在于，所述像素驱动电路还包括阈值补偿模块和存储模块，所述驱动方法还包括：
在所述数据写入阶段，所述阈值补偿模块在所述第二扫描信号线输出的第二扫描信号的控制下导通，所述驱动模块在所述第一节点的控制下导通，在所述数据信号的作用下，所述存储模块将所述第一节点的电位维持在目标电压值。
26.根据权利要求24所述的驱动方法，其特征在于，所述像素驱动电路还包括第一复位模块，在所述数据写入阶段之前，所述驱动方法还包括：
初始化阶段，所述第一复位模块在所述第三扫描信号线输出的第三扫描信号的控制下导通，所述第一参考电压信号端输出的参考电压信号对所述第一节点进行复位。
27.根据权利要求24所述的驱动方法，其特征在于，所述像素驱动电路还包括第二复位模块，所述驱动方法还包括：
初始化阶段，所述第二复位模块在所述第三扫描信号的控制下导通，所述第二参考电压信号端输出的参考电压信号对所述耦合模块的第一端进行复位。
28.根据权利要求26所述的驱动方法，其特征在于，所述像素驱动电路还包括第二复位模块，所述第二复位模块的第一端与所述第一复位模块的第二端电连接，所述驱动方法还包括：
在所述初始化阶段，所述第二复位模块在所述第三扫描信号的控制下导通，所述第一复位模块的第二端输出的参考电压信号对所述耦合模块的第一端进行复位。
29.根据权利要求25所述的驱动方法，其特征在于，所述像素驱动电路还包括第二复位模块，所述第二复位模块的第一端与所述阈值补偿模块的第二端电连接，所述驱动方法还包括：
初始化阶段，所述第二复位模块在所述第三扫描信号的控制下导通，所述阈值补偿模块在所述第二扫描信号的控制下导通，所述阈值补偿模块的第二端输出的参考电压信号对所述耦合模块的第一端进行复位。
30.根据权利要求24所述的驱动方法，其特征在于，所述像素驱动电路还包括第三复位模块，所述驱动方法还包括：
初始化阶段，所述第三复位模块在所述第三扫描信号的控制下导通，所述第三参考电压信号端输出的参考电压信号对所述第二节点进行复位。
31.根据权利要求26所述的驱动方法，其特征在于，所述像素驱动电路还包括第三复位模块，所述第三复位模块的第一端与所述第一复位模块的第二端电连接，所述驱动方法还包括：
在所述初始化阶段，所述第三复位模块在所述第三扫描信号的控制下导通，所述第一复位模块的第二端输出的参考电压信号对所述第二节点进行复位。
32.根据权利要求24所述的驱动方法，其特征在于，所述像素驱动电路还包括第三复位模块，所述第三复位模块的控制端与第一发光控制信号线电连接，所述第三复位模块的第一端与第一电源电压信号端电连接，所述驱动方法还包括：
初始化阶段，所述第三复位模块在所述第一发光控制信号线输出的第一发光控制信号的控制下导通，所述第一电源电压信号端输出的第一电源电压信号对所述第二节点进行复位。
33.根据权利要求30或31所述的驱动方法，其特征在于，所述像素驱动电路还包括第一发光控制模块和第二发光控制模块，在所述数据写入阶段之后，所述驱动方法还包括：
发光阶段，所述第一发光控制模块和所述第二发光控制模块在所述第一发光控制信号线输出第一发光控制信号的控制下导通，所述驱动模块驱动所述发光元件发光。
34.根据权利要求32所述的驱动方法，其特征在于，所述像素驱动电路还包括第二发光控制模块，在所述数据写入阶段之后，所述驱动方法还包括：
发光阶段，所述第三复位模块在所述第一发光控制信号线输出的第一发光控制信号的控制下导通，所述第二发光控制模块在所述第二发光控制信号线输出的第二发光控制信号的控制下导通，所述驱动模块驱动所述发光元件发光。
35.一种显示面板，其特征在于，包括如权利要求1至23中任意一项所述的像素驱动电路。
36.一种显示装置，其特征在于，包括如权利要求35所述的显示面板。
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