CN112017612A - 时序控制器及其控制方法、具有该时序控制器的显示装置 - Google Patents

时序控制器及其控制方法、具有该时序控制器的显示装置 Download PDF

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Abstract

本申请提供一种时序控制器及其控制方法、具有该时序控制器的显示装置，该时序控制器包括互相连接的存储控制模块和帧缓冲模块，以及与前端***芯片连接的自刷新接口，当该时序控制器利用自刷新接口侦测到前端***芯片输出静态画面时，存储控制模块将从前端***芯片接收到的静态画面写入帧缓冲模块存储后，按照正常时序从帧缓冲模块输出该静态画面。本申请提供的时序控制器在前端***芯片显示静态画面时，可以仅保持其内部必要的模块如存储控制模块和帧缓冲模块工作，而使得其他模块暂停工作，从而减少了时序控制器的功耗，提高了具有该时序控制器的显示装置的续航时间。

Description

时序控制器及其控制方法、具有该时序控制器的显示装置
技术领域
本申请涉及显示技术领域，尤其涉及一种时序控制器及其控制方法、具有该时序控制器的显示装置。
背景技术
目前，液晶显示屏在显示电子书或者浏览静态网页等屏幕静止的环境下时，控制液晶显示屏的时序控制器仍然保持工作，这样严重浪费电能，使得时序控制器的功耗较大，从而导致液晶显示屏的功耗也较大。
发明内容
为了降低液晶显示屏显示静态画面时时序控制器的功耗，，本申请提供一种时序控制器及其控制方法、具有该时序控制器的显示装置。
第一方面，本申请提供一种时序控制器，该时序控制器包括互相连接的存储控制模块和帧缓冲模块，以及与前端***芯片连接的自刷新接口，所述自刷新接口用于侦测所述前端***芯片是否输出静态画面；当所述自刷新接口侦测到所述静态画面时，所述存储控制模块写入所述静态画面至所述帧缓冲模块，且控制所述帧缓冲模块输出所述静态画面。
在一些实施例中，所述时序控制器还包括与所述存储控制模块连接的行缓冲模块；所述帧缓冲模块写入所述静态画面后，所述存储控制模块将所述静态画面每帧的像素数据由所述帧缓冲模块经过所述行缓冲模块后按照至少一行像素数据依次输出。
在一些实施例中，所述时序控制器还包括与所述存储控制模块连接的数据接收模块和与所述行缓冲模块连接的数据输出模块；其中，所述数据接收模块，用于接收所述前端***芯片输出的所述静态画面并向所述帧缓冲模块输出所述静态画面每帧的像素数据；所述数据输出模块，用于接收所述行缓冲模块输出的至少一行像素数据并输出。
在一些实施例中，所述时序控制器还包括与所述行缓冲模块连接的栅源极时序控制信号模块；所述栅源极时序控制信号模块，用于产生栅极时序控制信号和源极时序控制信号。
在一些实施例中，所述时序控制器还包括微处理模块，所述前端***芯片和所述存储控制模块分别与所述微处理模块连接；所述微处理模块，用于控制所述存储控制模块接收所述前端***芯片发送的数据和指令。
在一些实施例中，所述时序控制器还包括锁相环模块；所述锁相环模块，用于分别产生所述存储控制模块、所述数据输出模块和所述微处理模块的时钟频率。
在一些实施例中，所述存储控制模块包括侦测单元和控制单元：其中，所述侦测单元，用于侦测所述静态画面的有效数据选通信号；所述控制单元，用于在侦测到所述有效数据选通信号的一个周期时，控制所述帧缓冲模块将所述静态画面的像素数据由所述帧缓冲模块传输至所述行缓冲模块。
第二方面，本申请还提供一种时序控制器的控制方法，其中，该时序控制器包括互相连接的存储控制模块和帧缓冲模块，以及与前端***芯片连接的自刷新接口，该控制方法包括：
所述自刷新接口侦测到所述前端***芯片输出任一所述静态画面。
所述存储控制模块将从所述静态画面写入所述帧缓冲模块。
所述存储控制模块将所述静态画面由所述帧缓冲模块输出。
在一些实施例中，所述时序控制器还包括与所述存储控制模块连接的行缓冲模块，所述控制方法中的所述存储控制模块将所述静态画面由所述帧缓冲模块输出，具体包括：
所述存储控制模块将所述静态画面每帧的像素数据由所述帧缓冲模块经过所述行缓冲模块后按照至少一行像素数据依次输出。
第三方面，本申请还提供一种显示装置，该显示装置包括：显示面板，用于向所述显示面板提供扫描信号的栅极驱动器，用于向所述显示面板提供数据信号的源极驱动器，以及如上所述的时序控制器，所述时序控制器用于向所述栅极驱动器提供栅极时序控制信号，并向所述源极驱动器提供源极时序控制信号和静态画面的像素数据。
本申请提供的时序控制器及其控制方法、具有该时序控制器的显示装置中，该时序控制器包括互相连接的存储控制模块和帧缓冲模块，以及与前端***芯片连接的自刷新接口，当该时序控制器利用自刷新接口侦测到前端***芯片输出静态画面时，存储控制模块将从前端***芯片接收到的静态画面写入帧缓冲模块存储后，按照正常时序从帧缓冲模块输出该静态画面。本申请提供的时序控制器在前端***芯片显示静态画面时，可以仅保持其内部必要的模块如存储控制模块和帧缓冲模块工作，而使得其他模块暂停工作，从而减少了时序控制器的功耗，提高了具有该时序控制器的显示装置的续航时间。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1为本申请实施例提供的时序控制器的基本结构示意图。
图2为本申请实施例提供的时序控制器的具体结构示意图。
图3为本申请实施例提供的时序控制器的存储控制模块的结构示意图。
图4本申请实施例提供的显示装置的结构示意图。
图5为本申请实施例提供的时序控制器的控制方法的流程示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
图1为本申请实施例提供的时序控制器的基本结构示意图，如图1所示，该时序控制器包括互相连接的存储控制模块1和帧缓冲模块2，以及与前端***芯片(图中未示出)连接的自刷新接口3，自刷新接口3用于侦测前端***芯片是否输出静态画面；当自刷新接口3侦测到前端***芯片输出任一静态画面时，存储控制模块1将从前端***芯片接收到的该静态画面写入帧缓冲模块2后，将该静态画面由帧缓冲模块2输出。
具体地，自刷新接口3通过前端***芯片传送的电平准位来判断前端***芯片是否输出静态画面，例如，当前端***芯片正常输出画面给时序控制器时，就向自刷新接口3传送低电平；当前端***芯片输出静态画面给时序控制器时，就向自刷新接口3传送高电平，即，自刷新接口3确认前端***芯片输出静态画面的有效电平为高电平。需要说明的是，高低电平的切换在垂直消隐时间间隔(Vblank)进行，其中，垂直消隐时间间隔是指有效显示区(AA区)的最后一行像素写入前一帧画面的数据至第一行像素写入下一帧画面的数据之间的间隔。
本申请提供的时序控制器在前端***芯片显示静态画面时，可以仅保持其内部必要的模块如存储控制模块1和帧缓冲模块2工作，而使得其他模块暂停工作，从而减少了时序控制器的功耗。
图2为本申请实施例提供的时序控制器的具体结构示意图，如图2所示，该时序控制器还包括与存储控制模块1连接的行缓冲模块4；帧缓冲模块2写入静态画面后，存储控制模块1将静态画面每帧的像素数据由帧缓冲模块2经过行缓冲模块4按照至少一行像素数据依次输出，行缓冲模块4可以存储和输出一行或多行像素数据。
进一步地，如图2所示，该时序控制器还包括与存储控制模块1连接的数据接收模块5和与行缓冲模块4连接的数据输出模块6；其中，数据接收模块5，用于接收前端***芯片输出的静态画面并向帧缓冲模块2输出静态画面每帧的像素数据；数据输出模块6，用于接收行缓冲模块4输出的至少一行像素数据并输出。
进一步地，如图2所示，该时序控制器还包括与行缓冲模块4连接的栅源极时序控制信号模块7，栅源极时序控制信号模块7用于产生栅极时序控制信号和源极时序控制信号。
进一步地，如图2所示，时序控制器还包括微处理模块8，前端***芯片和存储控制模块1分别与微处理模块8连接，微处理模块8用于控制存储控制模块1接收前端***芯片发送的数据和指令。
进一步地，如图2所示，时序控制器还包括锁相环模块9，锁相环模块9用于分别产生存储控制模块1、数据输出模块6和微处理模块8的时钟频率。需要说明的是，锁相环模块9可以包括多个锁相环，分别用于产生存储控制模块1、数据输出模块6和微处理模块8的工作频率。
基于上述实施例，在自刷新接口3侦测到前端***芯片输出静态画面时，该时序控制器中与存储控制模块1和帧缓冲模块2同时工作的还有行缓冲模块4、数据输出模块6、数据接收模块5、栅源极时序控制信号模块7、微处理模块8和锁相环模块9。该时序控制器的工作过程为：在存储控制模块1的控制下，由数据接收模块5接收前端***芯片输入的静态画面并存储在帧缓冲模块2中，然后将静态画面由帧缓冲模块2依据时序按照一行或者多行像素数据传输至行缓冲模块4存储，最后由行缓冲模块4将一行或者多行像素数据经数据输出模块6依次输出，由此输出整帧静态画面的像素数据。
具体地，图3为本申请实施例提供的时序控制器的存储控制模块1的结构示意图，如图3所示，存储控制模块1包括侦测单元11和控制单元12：其中，侦测单元11用于侦测静态画面的有效数据选通信号；控制单元12用于在侦测到有效数据选通信号的一个周期时，控制帧缓冲模块2将静态画面的像素数据由帧缓冲模块2传输至行缓冲模块4。
图4为本申请实施例提供的显示装置的结构示意图，如图4所示，该显示装置100包括：显示面板200，用于向显示面板200提供扫描信号的栅极驱动器201，用于向显示面板200提供数据信号的源极驱动器202，以及如上所述的时序控制器300；时序控制器300用于向栅极驱动器201提供栅极时序控制信号，以及向源极驱动器202提供源极时序控制信号和静态画面的像素数据。
具体地，该时序控制器300从栅源极时序控制信号模块7输出栅极时序控制信号到栅极驱动器201，并输出源极时序控制信号到源极驱动器202，从而进行栅极时序控制和源极时序控制；并且，该时序控制控制器从数据输出模块6向源极驱动器202传输静态画面的像素数据。
需要说明的是，该显示装置的栅极驱动器201和源极驱动器202不一定设置于显示面板200的内部，图4中栅极驱动器201和源极驱动器202与显示面板200之间的位置关系仅为示例。
图5为本申请实施例提供的时序控制器的控制方法的流程示意图，结合图1和图5所示，本申请还提供一种时序控制器的控制方法，其中，该时序控制器包括互相连接的存储控制模块1和帧缓冲模块2，以及与前端***芯片连接的自刷新接口3，该控制方法包括以下步骤：
S501、自刷新接口3侦测到前端***芯片输出任一静态画面。
S502、存储控制模块1将静态画面写入帧缓冲模块2。
S503、存储控制模块1将静态画面由帧缓冲模块2输出。
本申请提供的时序控制器的控制方法，在前端***芯片显示静态画面时，可以仅保持时序控制器内部必要的模块如存储控制模块1和帧缓冲模块2工作，而使得其他模块暂停工作，从而减少了时序控制器的功耗。
进一步地，如图2所示，时序控制器还包括与存储控制模块1连接的行缓冲模块4，该控制方法中的步骤S503、存储控制模块1将静态画面由帧缓冲模块2输出，具体包括：
当帧缓冲模块2写入静态画面后，存储控制模块1将静态画面每帧的像素数据由帧缓冲模块2经过行缓冲模块4按照至少一行像素数据依次输出。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述的部分，可以参见其他实施例的相关描述。
本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想；本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。

Claims (10)

1.一种时序控制器，包括互相连接的存储控制模块和帧缓冲模块，其特征在于，所述时序控制器还包括与前端***芯片连接的自刷新接口，所述自刷新接口用于侦测所述前端***芯片是否输出静态画面；
当所述自刷新接口侦测到所述静态画面时，所述存储控制模块写入所述静态画面至所述帧缓冲模块，且控制所述帧缓冲模块输出所述静态画面。
2.如权利要求1所述的时序控制器，其特征在于，所述时序控制器还包括与所述存储控制模块连接的行缓冲模块；
所述帧缓冲模块写入所述静态画面后，所述存储控制模块将所述静态画面每帧的像素数据由所述帧缓冲模块经过所述行缓冲模块后按照至少一行像素数据依次输出。
3.如权利要求2所述的时序控制器，其特征在于，所述时序控制器还包括与所述存储控制模块连接的数据接收模块和与所述行缓冲模块连接的数据输出模块；其中，
所述数据接收模块，用于接收所述前端***芯片输出的所述静态画面并向所述帧缓冲模块输出所述静态画面每帧的像素数据；
所述数据输出模块，用于接收所述行缓冲模块输出的至少一行像素数据并输出。
4.如权利要求2所述的时序控制器，其特征在于，所述时序控制器还包括与所述行缓冲模块连接的栅源极时序控制信号模块；
所述栅源极时序控制信号模块，用于产生栅极时序控制信号和源极时序控制信号。
5.如权利要求3所述的时序控制器，其特征在于，所述时序控制器还包括微处理模块，所述前端***芯片和所述存储控制模块分别与所述微处理模块连接；
所述微处理模块，用于控制所述存储控制模块接收所述前端***芯片发送的数据和指令。
6.如权利要求5所述的时序控制器，其特征在于，所述时序控制器还包括锁相环模块；
所述锁相环模块，用于分别产生所述存储控制模块、所述数据输出模块和所述微处理模块的时钟频率。
7.如权利要求2所述的时序控制器，其特征在于，所述存储控制模块包括侦测单元和控制单元：其中，
所述侦测单元，用于侦测所述静态画面的有效数据选通信号；
所述控制单元，用于在侦测到所述有效数据选通信号的一个周期时，控制所述帧缓冲模块将所述静态画面的像素数据由所述帧缓冲模块传输至所述行缓冲模块。
8.一种时序控制器的控制方法，所述时序控制器包括互相连接的存储控制模块和帧缓冲模块，其特征在于，所述时序控制器还包括与前端***芯片连接的自刷新接口，所述控制方法包括：
所述自刷新接口侦测到所述前端***芯片输出任一静态画面；
所述存储控制模块将所述静态画面写入所述帧缓冲模块；
所述存储控制模块将所述静态画面由所述帧缓冲模块输出。
9.如权利要求8所述的控制方法，其特征在于，所述时序控制器还包括与所述存储控制模块连接的行缓冲模块，所述控制方法中的所述存储控制模块将所述静态画面由所述帧缓冲模块输出，具体包括：
所述存储控制模块将所述静态画面每帧的像素数据由所述帧缓冲模块经过所述行缓冲模块后按照至少一行像素数据依次输出。
10.一种显示装置，其特征在于，包括：显示面板，用于向所述显示面板提供扫描信号的栅极驱动器，用于向所述显示面板提供数据信号的源极驱动器，以及如权利要求1～7任一项所述的时序控制器；
所述时序控制器用于向所述栅极驱动器提供栅极时序控制信号，以及向所述源极驱动器提供源极时序控制信号和静态画面的像素数据。
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