CN111402815A - 一种像素电路以及显示装置 - Google Patents

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Abstract

本发明提供了一种像素电路以及显示装置，包括驱动发光模块、发光器件以及初始化模块，在驱动发光模块和发光器件的初始化阶段，初始化模块分别对驱动发光模块和发光器件进行初始化，即初始化模块利用不同的电源电压分别对驱动发光模块和发光器件进行初始化操作，从而避免发光器件的初始化电压对驱动发光模块的限制，可以适当提高驱动发光模块的初始化电压，以减小驱动发光模块的初始化电压与其导通电压之间的差值，从而缩短驱动发光模块的导通时间和充电率。

Description

一种像素电路以及显示装置
技术领域
本发明涉及显示技术领域，具体涉及一种像素电路以及显示装置。
背景技术
目前电子产品对于显示屏幕视觉体验的要求越来越高，这也就需要显示屏幕的刷新频率更高，然而更高的刷新频率也会造成行周期变短，从而导致充电时间缩短、充电率不足，最终产生显示不良的问题。
发明内容
有鉴于此，本发明实施例致力于提供一种像素电路以及显示装置，解决了现有技术中高刷新频率的显示屏幕充电率不足的问题。
根据本发明的一方面，本发明一实施例提供的一种像素电路，包括：驱动发光模块，所述驱动发光模块的一端接收电源电压；发光器件，与所述驱动发光模块电连接，所述发光器件在所述驱动发光模块的驱动下发光；以及初始化模块，所述初始化模块用于分别初始化所述驱动发光模块和所述发光器件。
在一实施例中，所述初始化模块接收第一扫描信号，所述初始化模块根据所述第一扫描信号控制所述发光器件的阳极是否与第一初始化电源的输出端连接，所述初始化模块根据所述第一扫描信号控制所述驱动发光模块是否与第二初始化电源的输出端连接；其中，所述第一初始化电源的电压小于或等于所述第二初始化电源的电压。
在一实施例中，所述第二初始化电源包括上一周期发光控制信号电压。
在一实施例中，所述像素电路进一步包括：数据存储模块，用于存储数据信号电压；以及数据存储控制模块，用于接收第二扫描信号，所述数据存储控制模块根据所述第二扫描信号控制所述数据信号电压是否存入所述数据存储模块。
在一实施例中，所述数据存储控制模块包括至少一个薄膜晶体管。
在一实施例中，所述像素电路进一步包括：串联在电源输出端与所述发光器件的阳极之间的发光控制模块，所述发光控制模块接收发光控制信号，所述发光控制模块根据所述发光控制信号控制所述电源输出端是否与所述发光器件的阳极连接。
在一实施例中，所述驱动发光模块包括驱动晶体管，所述驱动晶体管的源极与所述电源的输出端连接，所述驱动晶体管的漏极与所述发光器件的阳极连接。
在一实施例中，所述像素电路进一步包括：数据存储模块、数据存储控制模块以及发光控制模块，其中：所述数据存储模块包括存储电容，所述存储电容的一端与电源的输出端连接，所述存储电容的另一端与所述驱动晶体管的栅极连接；所述初始化模块包括第一薄膜晶体管与第二薄膜晶体管、第三薄膜晶体管，其中所述第一薄膜晶体管与所述第二薄膜晶体管、所述第三薄膜晶体管的栅极均接收所述第一扫描信号，所述第一薄膜晶体管的源极与所述第一初始化电源连接，所述第一薄膜晶体管的漏极与所述发光器件的阳极连接，所述第二薄膜晶体管的漏极与所述第二初始化电源连接，所述第二薄膜晶体管的源极与所述第三薄膜晶体管的漏极连接，所述第三薄膜晶体管的源极与所述存储电容连接；所述数据存储控制模块包括第四薄膜晶体管和第五薄膜晶体管、第六薄膜晶体管，其中所述第四薄膜晶体管的栅极与所述第五薄膜晶体管、所述第六薄膜晶体管的栅极接收第二扫描信号，所述第四薄膜晶体管的源极接收数据信号电压，所述第四薄膜晶体管的漏极与所述驱动晶体管的源极连接，所述第五薄膜晶体管的源极与所述第三薄膜晶体管的源极连接，所述第五薄膜晶体管的漏极连接所述第六薄膜晶体管的源极，所述第六薄膜晶体管的漏极与所述驱动晶体管的漏极连接；所述发光控制模块包括第七薄膜晶体管和第八薄膜晶体管，其中，所述第七薄膜晶体管的栅极以及所述第八薄膜晶体管的栅极均接收发光控制信号，所述第七薄膜晶体管的漏极接收电源电压，所述第七薄膜晶体管的源极与所述驱动晶体管的源极连接，所述第八薄膜晶体管的漏极与所述驱动晶体管的漏极连接，所述第八薄膜晶体管的源极与所述发光器件的阳极连接；所述存储电容的一端与所述电源的输出端连接，所述存储电容的另一端与所述第二初始化电源输出端连接。
在一实施例中，至少一个所述薄膜晶体管为P型薄膜晶体管。
根据本发明的另一方面，本发明一实施例提供的一种显示装置，包括：多个像素；以及，分别与所述多个像素对应的多个如上任一项所述的像素电路，其中，每个所述像素电路驱动对应的所述像素工作。
本发明提供的一种像素电路以及显示装置，包括驱动发光模块、发光器件以及初始化模块，在驱动发光模块和发光器件的初始化阶段，初始化模块分别对驱动发光模块和发光器件进行初始化，即初始化模块利用不同的电源电压分别对驱动发光模块和发光器件进行初始化操作，从而避免发光器件的初始化电压对驱动发光模块的限制，可以适当提高驱动发光模块的初始化电压，以减小驱动发光模块的初始化电压与其导通电压之间的差值，从而缩短驱动发光模块的导通时间和充电率。
附图说明
图1所示为本申请一实施例提供的一种像素电路的电路图。
图2所示为本申请另一实施例提供的一种像素电路的电路图。
图3所示为本申请另一实施例提供的一种像素电路的电路图。
图4所示为本申请另一实施例提供的一种像素电路的电路图。
图5所示为图4提供的像素电路的驱动信号时序图。
图6是本发明另一实施例提供的一种像素电路的电路图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
此外，在示例性实施例中，因为相同的参考标记表示具有相同结构的相同部件或相同方法的相同步骤，如果示例性地描述了一实施例，则在其他示例性实施例中仅描述与已描述实施例不同的结构或方法。
在整个说明书及权利要求书中，当一个部件描述为“连接”到另一部件，该一个部件可以“直接连接”到另一部件，或者通过第三部件“电连接”到另一部件。此外，除非明确地进行相反的描述，术语“包括”及其相应术语应仅理解为包括所述部件，而不应该理解为排除任何其他部件。
图1所示为本申请一实施例提供的一种像素电路的电路图。如图1所示，该像素电路包括：驱动发光模块，驱动发光模块的一端接收电源电压；发光器件OLED，与驱动发光模块电连接，发光器件OLED在驱动发光模块的驱动下发光；以及初始化模块，初始化模块与驱动发光模块、发光器件OLED电连接，用于分别初始化驱动发光模块和发光器件。发光器件OLED在开启之后，其阳极电压和阴极电压之间会形成一个压差，而在发光器件OLED发光结束后，该压差不会快速自我下降，从而需要对发光器件OLED进行初始化，以快速将发光器件OLED的阳极电压和阴极电压之间的压差降至零，从而避免发光器件OLED在发光结束后还存在一定的亮度，即黑态不够黑，以提高发光器件OLED在发光时和发光结束时的对比度。驱动发光模块通常为薄膜晶体管，而薄膜晶体管的源极和漏极之间的导通是需要栅极电压达到一定阈值电压(例如达到3.5V)，而通过电源将薄膜晶体管的栅极电压充至该阈值是需要一定的时间，因此，通常情况下，会通过初始化操作将薄膜晶体管的栅极电压初始化至一个初始化电压，然后由电源将薄膜晶体管的栅极电压充至该阈值电压，以导通薄膜晶体管的源极和漏极，实现发光器件OLED的发光。然而通常驱动发光模块与发光器件OLED的初始化都是由同一个初始化电源同时完成，为了保证发光器件OLED的对比度，初始化电源的电压不能太高，从而导致驱动发光模块的初始化电压较低，继而导致驱动发光模块的充电时间较长、充电率较低。因此，为了解决该问题，本申请实施例提供的像素电路中将驱动发光模块和发光器件OLED的初始化分开，由初始化模块中的不同部分分别进行，从而可以适当提高驱动发光模块的初始化电源的电压，从而提高驱动发光模块的初始化电压，缩短其充电时间，提高其充电率；并且可以适当降低发光器件OLED的发光电流，从而实现发光器件OLED在黑态时更黑，有利于提高发光器件OLED的对比度。
应当理解，发光器件指的是能够向外发出可见光的器件，可以是如上述所述的有机发光二极管(简称：OLED)，也可以是发光二极管(简称：LED)等，本发明实施例对发光器件的具体种类不作限定。
本发明提供的一种像素电路，包括驱动发光模块、发光器件以及初始化模块，在驱动发光模块和发光器件的初始化阶段，初始化模块分别对驱动发光模块和发光器件进行初始化，即初始化模块利用不同的电源电压分别对驱动发光模块和发光器件进行初始化操作，从而避免发光器件的初始化电压对驱动发光模块的限制，可以适当提高驱动发光模块的初始化电压，以减小驱动发光模块的初始化电压与其导通电压之间的差值，从而缩短驱动发光模块的导通时间和充电率。
初始化模块对驱动发光模块和发光器件OLED的初始化方法可以如图1所示，即初始化模块接收第一扫描信号，初始化模块根据第一扫描信号控制发光器件OLED的阳极是否与第一初始化电源(电压为VSS)的输出端连接，初始化模块根据第一扫描信号控制驱动发光模块是否与第二初始化电源(电压为Vint)的输出端连接，并且第一初始化电源的电压小于或等于第二初始化电源的电压。初始化模块通过接收第一扫描信号的控制信号而确定是否连接发光器件OLED的阳极与第一初始化电源、驱动发光模块与第二初始化电源，即初始化模块接收第一扫描信号的初始化信号连通发光器件OLED的阳极与第一初始化电源、驱动发光模块与第二初始化电源，实现第一初始化电源对发光器件OLED的初始化、第二初始化电源对驱动发光模块的初始化。通过第一初始化电源和第二初始化电源分别对发光器件OLED和驱动发光模块进行初始化，将发光器件OLED和驱动发光模块的初始化相对独立的实现，并且设置第二初始化电源的电压大于或等于第一初始化电源的电压，从而可以适当提高第二初始化电源的电压，以提高驱动发光模块的初始化电压，缩短其充电时间，提高其充电率，还可以适当降低发光器件OLED的发光电流，从而实现发光器件OLED在黑态时更黑，有利于提高发光器件OLED的对比度。
在一实施例中，驱动发光模块包括至少一个驱动晶体管，在一更优选实施例中，驱动发光模块包括一个驱动晶体管，驱动晶体管的源极与电源的输出端连接，驱动晶体管的漏极与发光器件的阳极连接。
图2所示为本申请另一实施例提供的一种像素电路的电路图。如图2所示，本申请提供的像素电路还可以包括：数据存储模块，用于存储数据信号电压，以及数据存储控制模块，用于接收第二扫描信号，数据存储控制模块根据第二扫描信号控制数据信号电压是否存入数据存储模块。在进一步的实施例中，数据存储模块包括至少一个存储电容。在另一进一步的实施例中，数据存储控制模块包括至少一个薄膜晶体管。
在一进一步的实施例中，如图2所示，初始化模块还与数据存储模块连接，用于对数据存储模块进行初始化，初始化模块在第一扫描信号Scan1的作用下导通时，第二初始化电源的电压Vint被传输至数据存储模块的一端，以实现对数据存储模块的电压的重置，即对数据存储模块进行初始化；同时实现第二初始化电源的电压Vint被传输至驱动发光模块，以实现对驱动发光模块的重置，即对驱动发光模块的初始化；并且初始化模块的导通使得第一初始化电压VSS被传输至发光器件OLED的阳极，以实现发光器件OLED的阳极电压的重置，即对发光器件OLED的阳极的初始化。
图3所示为本申请另一实施例提供的一种像素电路的电路图。如图3所示，本申请提供的像素电路还可以包括：串联在电源输出端与发光器件的阳极之间的发光控制模块，发光控制模块接收发光控制信号EM，发光控制模块根据发光控制信号EM控制电源输出端是否与发光器件的阳极连接。即发光控制模块在发光控制信号EM的作用下导通时，电源输出端的电压VDD被传输至发光器件OLED的阳极，以实现点亮发光器件OLED。在一实施例中，发光控制模块包括至少一个薄膜晶体管。
为了使得更好的理解上述像素电路，下面结合更为具体的实施例对上述所述像素电路的工作过程进行详细的说明。
图4所示为本申请另一实施例提供的一种像素电路的电路图，图5所示为对应的驱动信号时序图，如图4所示，一种像素电路包括：数据存储模块、初始化模块、数据存储控制模块以及发光控制模块，其中：数据存储模块包括存储电容C1，存储电容C1的一端与电源的输出端连接，存储电容C1的另一端与驱动晶体管M9的栅极连接；初始化模块包括第一薄膜晶体管M1与第二薄膜晶体管M2、第三薄膜晶体管M3，其中第一薄膜晶体管M1与第二薄膜晶体管M2、第三薄膜晶体管M3的栅极均接收第一扫描信号Scan1，第一薄膜晶体管M1的源极与第一初始化电源VSS连接，第一薄膜晶体管M1的漏极与发光器件OLED的阳极连接，第二薄膜晶体管M2的漏极与第二初始化电源Vint连接，第二薄膜晶体管M2的源极与第三薄膜晶体管M3的漏极连接，第三薄膜晶体管M3的源极与存储电容C1连接；数据存储控制模块包括第四薄膜晶体管M4和第五薄膜晶体管M5、第六薄膜晶体管M6，其中第四薄膜晶体管M4的栅极与第五薄膜晶体管M5、第六薄膜晶体管M6的栅极接收第二扫描信号Scan2，第四薄膜晶体管M4的源极接收数据信号电压Vdata，第四薄膜晶体管M4的漏极与驱动晶体管M9的源极连接，第五薄膜晶体管M5的源极与第三薄膜晶体管M3的源极连接，第五薄膜晶体管M5的漏极连接第六薄膜晶体管M6的源极，第六薄膜晶体管M6的漏极与驱动晶体管M9的漏极连接；发光控制模块包括第七薄膜晶体管M7和第八薄膜晶体管M8，其中第七薄膜晶体管M7的栅极以及第八薄膜晶体管M8的栅极均接收发光控制信号EM，第七薄膜晶体管M7的漏极接收电源电压VDD，第七薄膜晶体管M7的源极与驱动晶体管M9的源极连接，第八薄膜晶体管M8的漏极与驱动晶体管M9的漏极连接，第八薄膜晶体管M8的源极与发光器件OLED的阳极连接；存储电容C1的一端与电源VDD的输出端连接，存储电容C1的另一端与第二初始化电源Vint输出端连接。
结合图5所示，图4所述的像素电路的工作过程如下：
(1)初始化阶段T1：
施加具有第一电压幅值的第一扫描信号Scan1至第一薄膜晶体管M1的栅极、第二薄膜晶体管M2的栅极以及第三薄膜晶体管M3的栅极，具有第一电压幅值的第一扫描信号Scan1使得第一薄膜晶体管M1、第二薄膜晶体管M2以及第三薄膜晶体管M3导通；施加具有第二电压幅值的第二扫描信号Scan2至第四薄膜晶体管M4的栅极、第五薄膜晶体管M5的栅极以及第六薄膜晶体管M6的栅极，具有第二电压幅值的第二扫描信号Scan2使得第第四薄膜晶体管M4、第五薄膜晶体管M5以及第六薄膜晶体管M6截止；施加具有第三电压幅值的发光控制信号EM至第七薄膜晶体管M7的栅极以及第八薄膜晶体管M8的栅极，具有第三电压幅值的发光控制信号EM使得第七薄膜晶体管M7以及第八薄膜晶体管M8截止。
由于第一薄膜晶体管M1导通，发光器件OLED的阳极电压为VSS，将发光器件OLED的阳极电位初始化，保证发光器件OLED反转形成黑态；第二薄膜晶体管M2以及第三薄膜晶体管M3导通使得存储电容C1的Q1端的电压为Vint，清除存储电容C1的Q1端存储的电位；驱动晶体管M9的栅极电压为Vint。
通过第一初始化电源和第二初始化电源分别对发光器件OLED和驱动发光模块进行初始化，将发光器件OLED和驱动发光模块的初始化相对独立的实现，并且设置第二初始化电源的电压Vint大于或等于第一初始化电源的电压VSS，从而可以适当提高第二初始化电源的电压Vint，以提高驱动发光模块的初始化电压，缩短其充电时间，提高其充电率，还可以适当降低发光器件OLED的发光电流，从而实现发光器件OLED在黑态时更黑，有利于提高发光器件OLED的对比度。
(2)数据写入阶段T2：
施加具有第四电压幅值的第二扫描信号Scan2至第四薄膜晶体管M4的栅极、第五薄膜晶体管M5的栅极以及第六薄膜晶体管M6的栅极，具有第四电压幅值的第二扫描信号Scan2使得第四薄膜晶体管M4、第五薄膜晶体管M5以及第六薄膜晶体管M6导通；施加具有第五电压幅值的第一扫描信号Scan1至第一薄膜晶体管M1的栅极、第二薄膜晶体管M2的栅极以及第三薄膜晶体管M3的栅极，具有第五电压幅值的第一扫描信号Scan1使得第一薄膜晶体管M1、第二薄膜晶体管M2以及第三薄膜晶体管M3截止；施加具有第三电压幅值的发光控制信号EM至第七薄膜晶体管M7的栅极以及第八薄膜晶体管M8的栅极，具有第三电压幅值的发光控制信号EM使得第七薄膜晶体管M7以及第八薄膜晶体管M8截止。
由于第四薄膜晶体管M4的导通，像素电路中连接点1的电压等于Vdata；由于驱动晶体管M9的栅极电压为第四电压幅值，即驱动晶体管M9也是导通的，因此，像素电路中连接点2的电压也等于Vdata；由于第五薄膜晶体管M5以及第六薄膜晶体管M6的导通且像素电路中连接点2的电压等于Vdata，存储电容C1的Q1端的电压也等于Vdata。
(3)显示器件发光阶段T3：
施加具有第六电压幅值的发光控制信号EM至第七薄膜晶体管M7的栅极以及第八薄膜晶体管M8的栅极，具有第六电压幅值的发光控制信号EM使得第七薄膜晶体管M7以及第八薄膜晶体管M8导通；施加具有第二电压幅值的第二扫描信号Scan2至第四薄膜晶体管M4的栅极、第五薄膜晶体管M5的栅极以及第六薄膜晶体管M6的栅极，具有第二电压幅值的第二扫描信号Scan2使得第第四薄膜晶体管M4、第五薄膜晶体管M5以及第六薄膜晶体管M6截止；施加具有第五电压幅值的第一扫描信号Scan1至第一薄膜晶体管M1的栅极、第二薄膜晶体管M2的栅极以及第三薄膜晶体管M3的栅极，具有第五电压幅值的第一扫描信号Scan1使得第一薄膜晶体管M1、第二薄膜晶体管M2以及第三薄膜晶体管M3截止；
由于第七薄膜晶体管M7的导通，使得驱动晶体管M9的源极电压等于电源电压VDD，驱动晶体管M9的栅极电压与源极电压的压差等于VDD-Vdata，从而产生驱动电流；由于第八薄膜晶体管M8的导通，使得驱动晶体管M9产生的电流能够传输至发光器件OLED的阳极。
当第八薄膜晶体管M8导通时，驱动晶体管M9产生的驱动电流传输至OLED的阳极，当OLED的阳极电压还没有达到OLED的开启电压时，OLED不发光，当OLED的阳极电压正好达到OLED的开启电压，OLED开始发光。
应当理解，本发明上述实施例提供的薄膜晶体管，例如驱动晶体管M9、第一薄膜晶体管M1、第二薄膜晶体管M2、第三薄膜晶体管M3、第四薄膜晶体管M4、第五薄膜晶体管M5、第六薄膜晶体管M6、第七薄膜晶体管M7以及第八薄膜晶体管M8均可以为PMOS管，第一电压幅值为低电平的电压值、第四电压幅值、第六电压幅值，第二电压幅值、第三电压幅值、第五电压幅值为高电平的电压值。同理，本领域技术人员还可以将像素电路中的多个晶体管部分为PMOS管，部分为NMOS管，施加在相应晶体管上的电压幅值随着晶体光的种类而改变，例如在同一个像素电路中，若第一薄膜晶体管M1、第二薄膜晶体管M2以及第三薄膜晶体管M3均为PMOS管，则施加在第一薄膜晶体管M1的栅极、第二薄膜晶体管M2的栅极以及第三薄膜晶体管M3的栅极的第二扫描信号Scan1的第一电压幅值则为低电平的电压值；若第四薄膜晶体管M4、第五薄膜晶体管M5以及第六薄膜晶体管M6均为NMOS管，则施加在第四薄膜晶体管M4的栅极、第五薄膜晶体管M5的栅极以及第六薄膜晶体管M6的栅极的第二扫描信号Scan2的第二电压幅值则为低电平的电压值。因此本发明对上述像素驱动电路中的晶体管的种类以及施加在相应晶体管上的信号电压幅值不做限定。
图6是本发明另一实施例提供的一种像素电路的电路图。如图6所示，第二初始化电源可以为上一周期发光控制信号EM_N-1的电压。由于发光控制信号EM从高电压降至低电压时会呈现阶梯式下降方式，因此，可以利用下降过程中的台阶电压来对驱动发光模块进行初始化，可以在提高驱动发光模块的初始化电压的同时，加快发光控制信号的降压过程，有助于提高发光器件OLED的对比度。
本发明实施例还提供了一种显示装置，包括多个像素以及与多个像素对应的多个像素电路，每个像素驱动电路对应驱动一个像素工作，其中像素电路的结构如前述所述。本发明实施例提供的显示装置，包括驱动发光模块、发光器件以及初始化模块，在驱动发光模块和发光器件的初始化阶段，初始化模块分别对驱动发光模块和发光器件进行初始化，即初始化模块利用不同的电源电压分别对驱动发光模块和发光器件进行初始化操作，从而避免发光器件的初始化电压对驱动发光模块的限制，可以适当提高驱动发光模块的初始化电压，以减小驱动发光模块的初始化电压与其导通电压之间的差值，从而缩短驱动发光模块的导通时间和充电率。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内，所作的任何修改、等同替换等，均应包含在本发明的保护范围之内。

Claims (10)

1.一种像素电路，其特征在于，包括：
驱动发光模块，所述驱动发光模块的一端接收电源电压；
发光器件，与所述驱动发光模块电连接，所述发光器件在所述驱动发光模块的驱动下发光；以及
初始化模块，所述初始化模块用于分别初始化所述驱动发光模块和所述发光器件。
2.根据权利要求1所述的像素电路，其特征在于，所述初始化模块接收第一扫描信号，所述初始化模块根据所述第一扫描信号控制所述发光器件的阳极是否与第一初始化电源的输出端连接，所述初始化模块根据所述第一扫描信号控制所述驱动发光模块是否与第二初始化电源的输出端连接；
其中，所述第一初始化电源的电压小于或等于所述第二初始化电源的电压。
3.根据权利要求2所述的像素电路，其特征在于，所述第二初始化电源包括上一周期发光控制信号电压。
4.根据权利要求1所述的像素电路，其特征在于，进一步包括：数据存储模块，用于存储数据信号电压；以及
数据存储控制模块，用于接收第二扫描信号，所述数据存储控制模块根据所述第二扫描信号控制所述数据信号电压是否存入所述数据存储模块。
5.根据权利要求4所述的像素电路，其特征在于，所述数据存储控制模块包括至少一个薄膜晶体管。
6.根据权利要求1所述的像素电路，其特征在于，进一步包括：
串联在电源输出端与所述发光器件的阳极之间的发光控制模块，所述发光控制模块接收发光控制信号，所述发光控制模块根据所述发光控制信号控制所述电源输出端是否与所述发光器件的阳极连接。
7.根据权利要求2所述的像素电路，其特征在于，所述驱动发光模块包括驱动晶体管，所述驱动晶体管的源极与所述电源的输出端连接，所述驱动晶体管的漏极与所述发光器件的阳极连接。
8.根据权利要求7所述的像素电路，其特征在于，进一步包括：
数据存储模块、数据存储控制模块以及发光控制模块，其中：
所述数据存储模块包括存储电容，所述存储电容的一端与电源的输出端连接，所述存储电容的另一端与所述驱动晶体管的栅极连接；
所述初始化模块包括第一薄膜晶体管与第二薄膜晶体管、第三薄膜晶体管，其中所述第一薄膜晶体管与所述第二薄膜晶体管、所述第三薄膜晶体管的栅极均接收所述第一扫描信号，所述第一薄膜晶体管的源极与所述第一初始化电源连接，所述第一薄膜晶体管的漏极与所述发光器件的阳极连接，所述第二薄膜晶体管的漏极与所述第二初始化电源连接，所述第二薄膜晶体管的源极与所述第三薄膜晶体管的漏极连接，所述第三薄膜晶体管的源极与所述存储电容连接；
所述数据存储控制模块包括第四薄膜晶体管和第五薄膜晶体管、第六薄膜晶体管，其中所述第四薄膜晶体管的栅极与所述第五薄膜晶体管、所述第六薄膜晶体管的栅极接收第二扫描信号，所述第四薄膜晶体管的源极接收数据信号电压，所述第四薄膜晶体管的漏极与所述驱动晶体管的源极连接，所述第五薄膜晶体管的源极与所述第三薄膜晶体管的源极连接，所述第五薄膜晶体管的漏极连接所述第六薄膜晶体管的源极，所述第六薄膜晶体管的漏极与所述驱动晶体管的漏极连接；
所述发光控制模块包括第七薄膜晶体管和第八薄膜晶体管，其中，所述第七薄膜晶体管的栅极以及所述第八薄膜晶体管的栅极均接收发光控制信号，所述第七薄膜晶体管的漏极接收电源电压，所述第七薄膜晶体管的源极与所述驱动晶体管的源极连接，所述第八薄膜晶体管的漏极与所述驱动晶体管的漏极连接，所述第八薄膜晶体管的源极与所述发光器件的阳极连接；
所述存储电容的一端与所述电源的输出端连接，所述存储电容的另一端与所述第二初始化电源输出端连接。
9.根据权利要求8所述的像素电路，其特征在于，至少一个所述薄膜晶体管为P型薄膜晶体管。
10.一种显示装置，其特征在于，包括：
多个像素；以及，
分别与所述多个像素对应的多个如权利要求1-9任一项所述的像素电路，其中，每个所述像素电路驱动对应的所述像素工作。
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