CN111383586A - 显示面板、与其相关之显示***及方法 - Google Patents

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Abstract

揭示一种显示面板。所述显示面板包含排置于一像素阵列中的复数个像素、一第一选择电路以及一控制电路。所述像素阵列包含复数个列。第一选择电路耦接至显示面板，且包含复数个第一开关群。每一第一开关耦接至一列，且所述这些第一开关群经排置可供依序地并重复地开启，其中所述列的数目大于一群中第一开关的数目。所述控制电路耦接至第一选择电路，且经排置以透过开启中的第一开关群而依序地提供一脉冲信号至显示面板。

Description

显示面板、与其相关之显示***及方法
技术领域
本揭示内容系关于显示面板、与其相关之显示***及方法。
背景技术
随着对于大型显示面板的需求日渐提升，状设于面板中的栅极线 与源极线数目也随之增加。因此，需要更多电路来控制栅极线与源极 线，这占据了许多空间。
发明内容
因此，本揭示内容的一目的是提供一种显示面板、运用所述显示 面板的相关显示***以及一相关方法，以解决上述问题。
根据本揭示内容的实施例，揭示一种显示面板。所述显示面板包 含排置于一像素阵列中的复数个像素、一第一选择电路以及一控制电 路。所述像素阵列包含复数个列。第一选择电路耦接至显示面板，且 包含复数个第一开关群。每一第一开关耦接至一列，且所述这些第一 开关群经排置可供依序地并重复地开启，其中所述列的数目大于一群 中第一开关的数目。所述控制电路耦接至第一选择电路，且经排置以 透过开启中的第一开关群而依序地提供一脉冲信号至显示面板。
根据本揭示内容的实施例，揭示一种显示面板。所述显示面板包 含排置于一像素阵列中的复数个像素、一第一选择电路、至少一信号 产生电路及一处理电路。所述像素阵列包含复数个列。第一选择电路 包含复数个第一开关群，其中每一第一开关耦接至像素阵列中的一 列。每一至少一信号产生电路透过第一开关耦接至像素阵列中的至少 一列，且每一至少一信号产生电路经排置以提供一脉冲信号至显示面 板，其中像素阵列中列的数目大于至少一信号产生电路的数目。所述 处理电路经排置以提供一控制信号至选择电路以开启所述这些开关 的一部分并关闭所述这些开关的另一部分。
根据本揭示内容的实施例，揭示一种显示***。所述显示***包 含一显示面板及一驱动器积体电路(integrated circuit，IC)。显示面板 包含排置于一像素阵列中的复数个像素、一第一选择电路及一控制电 路。所述像素阵列包含复数个列。第一选择电路耦接至显示面板，且 包含复数个第一开关群。每一第一开关耦接至一列，且所述这些第一 开关群经排置可供依序地并重复地开启，其中所述列的数目大于一群 中第一开关的数目。所述控制电路耦接至第一选择电路，且经排置以 透过开启中的第一开关群而依序地提供一脉冲信号至显示面板。驱动 器IC耦接至显示面板，且经排置以提供一影像资料至像素阵列中的 所述这些行。
根据本揭示内容的实施例，揭示显示面板的方法。所述方法包含 将显示阵列的复数个像素排置于一像素阵列中，其中所述像素阵列包 含复数个列；耦接复数个第一开关群的每一者至像素阵列中的一列； 依序地并重复地开启所述这些第一开关群；以及依序地透过开启中的 一第一开关群提供一脉冲信号至该显示面板；其中该列的数目大于一 群中第一开关的数目。
附图说明
在阅读了下文实施方式以及附随图式时，能够最佳地理解本揭露 的多种态样。应注意到，根据本领域的标准作业习惯，图中的各种特 征并未依比例绘制。事实上，为了能够清楚地进行描述，可能会刻意 地放大或缩小某些特征的尺寸。
图1绘示根据本揭示内容一实施例的显示面板。
图2绘示根据本揭示内容一实施例，一像素中的电路。
图3绘示根据本揭示内容一实施例的控制电路及选择电路。
图4A绘示根据本揭示内容一实施例，图3所示之控制电路及选 择电路的操作。
图4B绘示根据本揭示内容一实施例，图3所示之控制电路及选 择电路的后续操作。
图5绘示根据本揭示内容一实施例，信号产生电路产生之信号的 一信号波形。
图6绘示根据本揭示内容另一实施例，图3所示之控制电路及选 择电路的操作。
图7绘示根据本揭示内容另一实施例的显示面板。
图8绘示根据本揭示内容另一实施例，一像素中的电路。
图9绘示根据本揭示内容一实施例的选择电路及控制电路。
图10A绘示根据本揭示内容一实施例，图9所示之控制电路及 选择电路的作业。
图10B绘示根据本揭示内容一实施例，图9所示之控制电路及 选择电路的后续作业。
图11绘示根据本揭示内容一实施例的显示面板之结构。
图12为根据本揭示内容一实施例的显示面板之方法的流程图。
具体实施方式
以下揭示内容提供许多不同的实施例或范例，用于实施本申请案 之不同特征。元件与配置的特定范例之描述如下，以简化本申请案之 揭示内容。当然，这些仅为范例，并非用于限制本申请案。例如，以 下描述在第二特征上或上方形成第一特征可包含形成直接接触的第 一与第二特征之实施例，亦可包含在该第一与第二特征之间形成其他 特征的实施例，因而该第一与第二特征并非直接接触。此外，本申请 案可在不同范例中重复元件符号与/或字母。此重复系为了简化与清 楚之目的，而非支配不同实施例与/或所讨论架构之间的关系。
再者，本申请案可使用空间对应语词，例如「之下」、「低于」、 「较低」、「高于」、「较高」等类似语词之简单说明，以描述图式中一 元件或特征与另一元件或特征的关系。空间对应语词系用以包括除了 图式中描述的位向之外，装置于使用或操作中之不同位向。装置或可 被定位(旋转90度或是其他位向)，并且可相应解释本申请案使用的 空间对应描述。
尽管本揭露之广泛范围揭露的数值范围与参数为近似值，但在具 体实施例中阐述的数值尽可能地精确。然而，任何数值固有地包含须 由个别测试测量中得到的标准偏差所导致的某些误差。再者，如本文 所述，「约」通常是指给定值或范围之10％、5％、1％、或0.5％以内。 或者，用语「约」是指该技艺中具有通常技术者考量的平均值之可接 受的标准误差之内。除了在操作/工作范例中，或是除非特别指明， 否则本文所揭露例如材料的量、时间期间、温度、操作条件、量的比 例、以及类似者之所有的数值范围、量、值与比例皆应被理解为在所 有情况下都被用语「约」修饰。因此，除非有相反的说明，否则本揭 露与申请专利范围所述之数值参数皆为可视需要而变化的近似值。至 少应根据报告的有效数字的数量且应用普通舍入技术来解释每个数 值参数。在本文中，范围可表示为自一端点至另一端点，或是在两个 端点之间。除非特别说明，否则本文所揭露的所有范围包含端点。
图1绘示根据本揭示内容一实施例的显示面板100。如图1所示， 显示面板100包含排置于一像素阵列110中的复数个像素、控制电路 120及选择电路130。像素阵列110包含M列及N行，其中M及N 皆为自然数。位于第一行及第一列中的像素标记为像素PIX11，且位 于第二行及第一列中的像素标记为像素PIX12，以此类推。选择电路 130透过导线L1至LM耦接至像素阵列110，如图1所示，且每一导 线耦接至位于相同列中的像素。控制电路120经排置以提供信号SIG1 至SIGx以及控制信号CTRL给选择电路130，其中x为小于M的自 然数。控制电路120更经排置以选择性地透过导线L1至LM而提供 直流(direct current，DC)电压DCV给像素阵列110。
为求清楚与简洁，图1中针对控制电路120与导线L1至LM间 的DC电压DCV仅绘示了一条信号线。在某些实施方式中，每一信 号SIG1至SIGx为一脉冲信号。然而，本揭示内容并不限定信号SIG 的模式。本发明所属技术领域中具有通常知识者应可理解，位于相同 行中的像素亦可共同耦接于一导线。图1为求简明省略了耦接位于相 同行中之像素的导线。
图2绘示根据本揭示内容一实施例，每一像素中的电路。以像素 阵列110之像素PIX11为例，像素PIX11包含晶体管T1与T2以及 电容器C。如图2所示，晶体管T1的栅极端耦接至导线L1。导线 L1将位于像素阵列110之第一列中的像素(如像素PIX11、PIX12等 等)之晶体管T1的栅极端耦接到一起。本发明所属技术领域中具有通 常知识者可轻易理解，导线L1可作为一栅极线，其中在显示面板100 的操作阶段中，导线L1上携带的信号决定了晶体管T1的开关状态。 举例来说，当显示面板在显示阶段中运作时，导线L1上携带的信号 扫描位于带有高电压特性的第一列中的像素(如，像素PIX11、PIX12 等等)。
晶体管T1的源极端耦接至导线DL，其中导线DL将位于像素阵 列110第一行中的像素之晶体管T1的源极端耦接在一起。本发明所 属技术领域中具有通常知识者可轻易理解，导线DL可作为一资料 线，其中在显示阶段中，当导线L1开启晶体管T1时，导线DL传送 影像资料至像素PIX11。此外，导线DL上携带的影像资料可由耦接 至显示面板100的驱动器积体电路(IC)产生。本发明所属技术领域中 具有通常知识者应可理解，所述驱动器IC及显示面板100可构成一 显示***。
电容器C的一终端耦接至晶体管T1的漏极端以及晶体管T2的 栅极端，而电容器C的另一终端耦接至一供应电压VDD。当晶体管 T1被开启时，导线DL上携带的信号被传送到晶体管T1的漏极端， 以开启晶体管T2。如此一来，发射电流会通过晶体管T2的漏极端及 源极端。在晶体管T1被关闭后，电容器C可将晶体管T2之栅极端 上的电压保持在一定位准，以维持发射电流。本发明所述技术领域中 具有通常知识者当可轻易理解，一等效二极体会形成于晶体管T2的 源极端。于本实施例中，显示面板100运用有机发光二极体(OLED) 技术，故二极体标记为OLED。当发射电流通过晶体管T2的漏极端 及源极端到达二极体OLED时，像素PIX11会相应地发光。
当注意到，图2所示电路仅为例示，而非本揭示内容的限制。本 发明所属技术领域中具有通常知识者可轻易理解，一像素中所包含的 电路可具有不同的的布局。举例来说，像素中可包含一补偿电路以补 偿OLED的衰变。此外，在图2的实施例中，晶体管T1及T2绘示成N-型晶体管。然而，晶体管T1及T2亦可实作为P-型晶体管，且 其不应作为本揭示内容的限制。
图3绘示根据本揭示内容一实施例的控制电路120及选择电路 130。如图3所示，控制电路120包含一处理电路210、信号产生电 路221至22x以及电压产生电路230，其中x为小于图1所述之M 的自然数。选择电路130包含开关SW1至SWM。处理电路210经排 置以提供控制信号CTRL，以选择性地开启/关闭选择电路130的开 关SW1至SWM。每一信号产生电路221至22x经排置以提供相应的 信号SIG。换句话说，信号产生电路221提供信号SIG1，且信号产生电路222提供信号SIG2，依此类推。
如图1之实施例中所述，信号SIG1至SIGx可以是一脉冲信号。 每一开关SW1至SWM对应于像素阵列100之一列。换句话说，开 关SW1透过导线L1耦接至像素阵列110的第一列，且开关SW2透 过导线L2耦接至像素阵列110的第二列，依此类推。电压产生电路 230经排置以透过导线L1至LM选择性地提供DC电压DCV至像素 阵列110。信号产生电路221至22x及电压产生电路230的操作受到 处理电路210的控制。下文将说明信号产生电路221至22x及开关 SW1至SWx间的连接。
图4A绘示根据本揭示内容一实施例，图3所示之控制电路120 及选择电路130的作业。为求清楚与简洁，自然数M为8，且自然 数x为M的一半(即，x＝4)。信号产生电路221分别透过开关SW1(经 由导线L1)及开关SW5(经由导线L5)而耦接至像素阵列110的第一 列及第五列。信号产生电路222分别透过开关SW2(经由导线L2)及 开关SW6(经由导线L6)而耦接至像素阵列110的第二列及第六列。 信号产生电路223分别透过开关SW3(经由导线L3)及开关SW7(经 由导线L7)而耦接至像素阵列110的第三列及第七列。信号产生电路224分别透过开关SW4(经由导线L4)及开关SW8(经由导线L8)而耦 接至像素阵列110的第四列及第八列。于本实施例中，由于x是M 的一半(即，x＝4)，将开关SW1至SW4分类为第一开关群，而开关 SW5至SW8分类为第二开关群。
具体来说，处理电路210提供控制信号CTRL以开启第一开关群 (即，开关SW1至SW4)并关闭第二开关群(即，开关SW5至SW8)。 如图1及图3之实施例所述，每一信号SIG1至SIG4为一脉冲信号。 因此，透过被开启的开关SW1，当触发信号SIG1时，位于像素阵列 110的第一列上的晶体管T1被开启。相似地，透过被开启的开关SW2， 当触发信号SIG2时，位于像素阵列110的第二列上的像素的晶体管 T1被开启，依此类推。
同时，处理电路210控制电压产生电路230以提供DC电压DCV 至第二开关群(即，开关SW5至SW8)。于本实施例中，DC电压DCV 可关闭位于像素阵列110中第五列至第八列上之像素的晶体管T1。 藉由此种配置，位于像素阵列110的第一列至第四列上之像素的晶体 管T1会被开启，且图2所示之资料线DL上携带的显示资料可被传 输到像素阵列110的第一列至第四列。
接着，在图4A的实施例之后，图4B绘示根据本揭示内容一实 施例，图3所示之控制电路120及选择电路130的后续作业。处理电 路210提供控制信号CTRL以开启第二开关群(即，开关SW5至SW8) 并关闭第一开关群(即，开关SW1至SW4)。因此，透过被开启的开 关SW5，当触发信号SIG5时，位于像素阵列110第五列上的晶体管 T1被开启。相似地，透过被开启的开关SW6，当触发信号SIG6时， 位于像素阵列110第六列上之像素的晶体管T1被开启，依此类推。
同时，处理电路210控制电压产生电路230以提供DC电压DCV 至第一开关群(即，开关SW1至SW4)。于本实施例中，DC电压DCV 可关闭位于像素阵列110第一列至第四列上之像素的被开启的晶体 管T1。藉由此种配置，位于像素阵列110第五列至第八列上之像素 的晶体管T1被开启，且图2所示之资料线DL上携带的显示资料可 被传输到像素阵列110的第五列至第八列。接着，重复图4A之实施 例的控制电路120及选择电路130之作业。
图5绘示根据本揭示内容一实施例，信号产生电路221至224 产生之信号SIG1至SIG4的信号波形。如图5所示，依序地将信号 SIG1至SIG4触发为高电压。因此，当第一开关群(即，开关SW1至 SW4)被开启时，位于第一列至第四列的像素110上的像素的晶体管 T1分别被信号SIG1至SIG4依序地开启。另一方面，当第二开关群 (即，开关SW5至SW8)被开启时，位于第五列至第八列的像素110 上的像素的晶体管T1分别被SIG1至SIG4依序地开启。本发明所属 技术领域中具有通常知识者可轻易理解，可基于像素阵列中所用之晶 体管T1的类型而采用不同的信号SIG1至SIG4模式。此处为求简洁 省略其详细说明。
藉由使用选择电路130的开关SW1至SW8并进一步依序地开启 第一开关群及第二开关群，可以大幅减少信号产生电路221至22x， 特别是当像素阵列110包含上千列时。藉由此种配置，可大幅减少信 号产生电路221至22x所占据的面积，而所节省的面积就可运用于其 他用途。譬如可以提高像素阵列110的尺寸。
在图4A及图4B的实施例中，将x设计为M的一半，然而，本 发明所属技术领域中具有通常知识者可轻易理解，图4A及图4B的 实施例中所示之控制电路120及选择电路130的作业亦可轻易适用于 不同数目的M与x。
为了节省信号产生电路221至22x所占据的面积，可运用较少的 信号产生电路而不会牺牲显示面板100的解析度。图6绘示根据本揭 示内容另一实施例，图3所示之控制电路及选择电路的作业。于本实 施例中，自然数M为8，且自然数x是M的四分之一(即，x＝2)。信 号产生电路221分别透过开关SW1(经由导线L1)、开关SW3(经由 导线L3)、开关SW5(经由导线L5)及开关SW7(经由导线L7)而耦接 至像素阵列110的第一列、第三列、第五列及第七列。信号产生电路 222分别透过开关SW2(经由导线L2)、开关SW4(经由导线L4)、开 关SW6(经由导线L6)及开关SW8(经由导线L8)而耦接至像素阵列 110的第二列、第四列、第六列及第八列。于本实施例中，由于x是 M的四分之一(即，x＝2)，将开关SW1及SW2划分为第一开关群， 开关SW3及SW4划分为第二开关群，将开关SW5及SW6划分为第 三开关群，并将开关SW7至SW8划分为第四开关群。
具体来说，处理电路210提供控制信号CTRL以开启第一开关群 (即，开关SW1及SW2)并关闭其他开关群(即，开关SW3至SW8)。 如图1及图3之实施例中所述，每一信号SIG1至SIG4为一脉冲信 号。因此，透过被开启的开关SW1，当触发信号SIG1时，位于像素 阵列110的第一列上的晶体管T1被开启。相似地，透过被开启的开 关SW2，当触发信号SIG2时，位于像素阵列110的第二列上的晶体 管T1被开启。同时，处理电路210控制电压产生电路230以提供 DC电压DCV至其他开关群(即，开关SW3至SW8)。于本实施例中， DC电压DCV可关闭位于像素阵列110第三列至第八列上的像素的 晶体管T1。藉由此种配置，位于像素阵列110第一列及第二列上之 像素的晶体管T1被开启，且图2所示之资料线DL上携带的显示资 料可被传输到像素阵列110的第一列及第二列。
接着，第二开关群(即，开关SW3及SW4)被开启。本发明所属 技术领域中具有通常知识者可轻易理解后续作业，此处为求简洁省略 其详细说明。藉由使用选择电路130的开关SW1至SW8并进一步依 序地开启四个开关群，可使用较少的信号产生电路221至22x。藉由此种配置，可大幅减少信号产生电路221至22x所占据的面积。运用 较快的切换速度，显示面板100可仅使用一个信号产生电路，而不会 为了完成显示阶段而牺牲解析度。
图7绘示根据本揭示内容另一实施例的显示面板700。显示面板 700与图1所示之显示面板100类似，不同之处在于显示面板700还 包含一选择电路740。因此，此处为求简洁，省略显示面板100及显 示面板700间的相似部分。选择电路730透过导线L1’至LM’耦接至 像素阵列710，如图7所示，且每一导线耦接至位于相同列中的像素。 控制电路720提供控制信号CTRL至选择电路730及选择电路740， 并进一步提供信号SIG1至SIGx至选择电路730以及提供信号SIG'1 至SIG'x至选择电路740。如图1之实施例中所述，每一信号SIG1 至SIGx可以是一脉冲信号。每一信号SIG'1至SIG'x可以是一开关 控制信号，下文将进一步说明。
图8绘示根据本揭示内容另一实施例，每一像素中的电路。以像 素阵列710的像素PIX’11为例，像素PIX’11与图2所示之像素阵列 210的像素PIX11类似，不同之处在于像素PIX’11包含一补偿电路 810。补偿电路耦接于晶体管T2的源极端与二极体OLED的阳极之间，用以基于二极体OLED的衰变来控制发射电流。补偿电路810 的实作为本领域所熟知，因此，图8中仅绘示与本揭示内容相关的部 分。于本实施例中，补偿电路810包含一开关811，其系由导线L1’ 上携带的信号(如，信号SIG'1)所控制。以下段落中将进一步描述导 线L1’的详细作业。
图9绘示根据本揭示内容一实施例的控制电路720及选择电路 730与740。于本实施例中，控制电路720及选择电路730与图3之 实施例所述的控制电路120及选择电路130类似，不同之处在于控制 电路720还包含信号产生电路941至94x，其中x为小于M的自然 数。每一信号产生电路941至94x产生相应的信号SIG'。换句话说， 信号产生电路941提供信号SIG'1，且信号产生电路942提供信号 SIG'2，依此类推。如图7的实施例中所述，每一信号SIG'1至SIG’x 可以是一开关控制信号，其系用以控制图8所示的开关811。选择电 路740包含开关SW'1至SW'M，且SW'1至SW'M的开关状态对应 于开关SW1至SWM的开关状态。换句话说，透过控制处理电路910 产生的信号CTRL，当开关SW1被开启时，开关SW'1会被开启。或者是，当开关SW1被关闭时，开关SW'1会被关闭。当开关SW2被 开启时，开关SW'2会被开启，依此类推。此处为求简洁省略了图3 及图9相似的部分。
图10A绘示根据本揭示内容一实施例，图9所示之控制电路720 及选择电路730与740的作业。为求清楚与简洁，自然数M为8且 自然数x为M的一半(即，x＝4)。如图10A所示，信号产生电路921 至924及开关SW1至SW8间的连接与图4A所示者相同，且此处为 求简洁省略其详细说明。信号产生电路941分别透过开关SW'1(经 由导线L1')及开关SW'5(经由导线L5')而耦接至像素阵列710的第一 列及第五列。信号产生电路942分别透过开关SW'2(经由导线L2') 及开关SW'6(经由导线L6')而耦接至像素阵列710的第二列及第六 列。信号产生电路943分别透过开关SW'3(经由导线L3')及开关SW'7 (经由导线L7')而耦接至像素阵列710的第三列及第七列。信号产生 电路944分别透过开关SW'4(经由导线L4')及开关SW'8(经由导线 L8')而耦接至像素阵列710的第四列及第八列。于本实施例中，由于 x是M的二分之一(即，x＝4)，将开关SW1至SW4划分为第一开关 群，并将开关SW5至SW8划分为第二开关群。相应地，将开关SW'1 至SW'4划分为第一相应开关群，并将开关SW'5至SW'8划分为第二 相应开关群。
具体来说，处理电路910提供控制信号CTRL以开启第一开关群 (即，开关SW1至SW4)及第一相应开关群(即，开关SW'1至SW'4)， 并关闭第二开关群(即，开关SW5至SW8)及第二相应开关群(即，开 关SW'5至SW'8)。如图7的实施例中所述，每一信号SIG1至SIG4 为一脉冲信号，且每一信号SIG'1至SIG'4为一开关控制信号。因此， 透过被开启的开关SW1，当触发信号SIG1时，位于像素阵列710第 一列上之像素的晶体管T1被开启。透过被开启的开关SW2，当触发 信号SIG2时，位于像素阵列710第二列上之像素的晶体管T1被开 启，依此类推。同时，透过被开启的开关SW'1，当触发信号SIG'1 时，位于像素阵列710第一列上之像素的开关811被开启。相似地， 透过被开启的开关SW'2，当触发信号SIG'2时，位于像素阵列710 第二列上之像素的开关811被开启，依此类推。
处理电路910控制电压产生电路930，以提供DC电压DCV至 第二开关群(即，开关SW5至SW8)。于本实施例中，DC电压DCV 可关闭位于像素阵列110第五列至第八列上之像素的晶体管T1。藉 由此种配置，位于像素阵列110的第一列至第四列上之像素的晶体管 T1被开启，且图2所示之资料线DL上携带的显示资料可被传输到 像素阵列110的第一列至第四列。
接着，在图10A的实施例之后，图1-B绘示根据本揭示内容一 实施例，图9所示之控制电路720及选择电路730与740的后续作业。 处理电路910提供控制信号CTRL以开启第二开关群(即，开关SW5 至SW8)及第二相应开关群(即，开关SW'5至SW'8)，并关闭第一开 关群(即，开关SW1至SW4)及第一相应开关群(即，开关SW'1至 SW'4)。因此，透过被开启的开关SW5，当触发信号SIG5时，位于 像素阵列710第五列上的晶体管T1被开启。相似地，透过被开启的 开关SW6，当触发信号SIG6时，位于像素阵列910第六列上之像素 的晶体管T1被开启，依此类推。相应地，透过被开启的开关SW'5， 当触发信号SIG’5时，位于像素阵列710第五列上的像素的开关811 被开启。相似地，透过被开启的开关SW’6，当触发信号SIG’6时， 位于像素阵列710第六列上之像素的开关811被开启，依此类推。
同时，处理电路910控制电压产生电路930，以提供DC电压 DCV至第一开关群(即，开关SW1至SW4)。于本实施例中，DC电 压DCV可关闭位于像素阵列710第一列至第四列上之像素的晶体 管。藉由此种配置，位于像素阵列110第五列至第八列上之像素的晶 体管T1被开启，且图2所示之资料线DL上携带的显示资料可被传 输到像素阵列110的第五列至第八列。接着，重复图9之实施例的控 制电路720及选择电路730与740之作业。
当图3及图9之开关SW1至SWM的一部分被关闭时，举例来 说，当第二开关群(即，开关SW5至SW8)被关闭时，相应列(即，第 五列至第八列)可用于感应触控。举例来说，当显示面板100及700 的使用者触碰第五列至第八列时，可将第五列至第八列感测到的检测 信号传输至控制电路120及720。
图11绘示根据本揭示内容一实施例之显示面板100的结构。如 图1所示，显示面板100包含一基板300、一电路层310、一发光层320及一位于电路层310及发光层320间的电极层264。于本实施例 中，像素阵列110、控制电路120及选择电路130形成于基板300上 的电路层310中。虽然图11仅绘示了像素PIX11，本发明所属技术 领域中具有通常知识者可轻易理解，可由图11所示之结构衍生至整 个像素阵列。此外，像素PIX11、控制电路120及选择电路130的尺 寸与位置仅为例示。
电路层310还包含一平坦化层311，设于像素阵列110、控制电 路120及选择电路130上方。发光层320设于平坦化层311上方的电 极层330上，如图11所示。发光层320包含一载子注入层321，设 于电极层330的露出表面上方。载子注入层321连续地衬接于露出表面。于本实施例中，所用发光单元运用一共用载子注入层。在某些实 施方式中，载子注入层321系用于电洞注入。在某些实施方式中，载 子注入层321系用于电子注入。在某些实施方式中，载子注入层321 为有机层。
一载子传输层322设于电极264的露出表面上方。载子注入层 321设于载子传输层322下方。载子传输层322连续地衬接载子注入 层276。于本实施例中，所有发光单元运用一共用的载子传输层322。 在某些实施方式中，载子传输层322系用于电洞传输。在某些实施方 式中，载子传输层322系用于电子传输。视需要地，载子传输层322 和载子注入层321接触。在某些实施方式中，载子传输层277为有机 层。
当形成于电路层310中的电路需要连接到发光层320时，接触通 孔340将电路连接到电极层。举例来说，在图2的实施例中，晶体管 T2的源极端连接到二极体OLED的阳极，其中二极体OLED的阳极 可以是载子注入层321。因此，晶体管T2的源极端透过接触通孔340及电极层330连接到载子注入层321。
本发明所属技术领域中具有通常知识者应可轻易理解图11所示 的显示面板100结构亦可用于显示面板700。此处为求简洁省略其详 细说明。
图12的流程图绘示根据本揭示内容一实施例的显示面板之驱动 方法1200。由于其结果实质上是相同的，图12所示的步骤不需依所 描述的顺序执行，且可采行其他顺序。方法1200摘要整理如下。
步骤1201：将显示阵列的复数个像素排置于一像素阵列中，其 中像素阵列包含复数个列
步骤1202：将复数个第一开关群的每一者耦接至像素阵列中的 一列
步骤1203：依序地并重复地开启这些第一开关群。
步骤1204：透过开启中的一第一开关依序地将一脉冲信号提供 给显示面板
本发明所属技术领域中具有通常知识者在阅读了上文段落后，应 可轻易理解驱动方法1200。此处为求简洁，省略其详细说明。
符号说明
100、700、900 显示面板
110、710 像素阵列
120、720 控制电路
130、730、740 选择电路
210 处理电路
221～22x、921～924、941～94x 信号产生电路
230、930 电压产生电路
810 补偿电路
811、SW1～SWM、SW'1～SW'M 开关
264、330 电极层
276、321 载子注入层
277、322 载子传输层
311 平坦化层
340 接触通孔
1200 驱动方法
1201～1204 步骤
C 电容器
CTRL 控制信号
DCV DC电压
DL、L1～LM、L1’～LM’ 导线
M 列
N 行
PIX11、PIX12、PIX’11 像素
SIG1～SIGx、SIG'1～SIG'x 信号
T1、T2 晶体管
VDD 供应电压

Claims (20)

1.一种显示面板，包括：
复数个像素，排置于一像素阵列中，其中该像素阵列包含复数个列；
一第一选择电路，耦接至该显示面板，其中该第一选择电路包含复数个第一开关群，每一第一开关耦接至一列，且所述这些第一开关群经排置可供依序地并重复地开启；以及
一控制电路，耦接至该第一选择电路，其中该控制电路经排置以依序地透过开启中的一第一开关群提供一脉冲信号至该显示面板；
其中该列的数目大于一群中第一开关的数目。
2.如权利要求1所述的显示面板，其中该控制电路更经排置以提供一直流电压至耦接至关闭中的一第一开关群之该列。
3.如权利要求2所述的显示面板，其中该控制电路更经排置以接收来自对应于关闭中的该第一开关群之每一列的一检测信号，其中该检测信号指出对应于关闭中之该第一开关群的所述每一列是否被使用者触碰。
4.如权利要求1所述的显示面板，其中该控制电路经排置以提供一控制信号以开启/关闭所述这些第一开关群。
5.如权利要求1所述的显示面板，其中该控制电路包括：
一信号产生电路，分别透过两个不同第一开关群耦接至该像素阵列中的两个不同列，其中该信号产生电路经排置以透过开启中的该第一开关群提供该脉冲信号至该显示面板。
6.如权利要求1所述的显示面板，其中每一像素包含一晶体管，且每一第一开关耦接至一列中的所述这些晶体管，且当该脉冲信号被提供至所述这些晶体管的栅极端以供产生一发射电流。
7.如权利要求6所述的显示面板，还包括：
一第二选择电路，耦接至该显示面板，其中该第二选择电路包含复数个第二开关群，每一第二开关耦接至一列，及所述这些第二开关群可供依序地并重复地开启；
其中该列的数目大于一群中第二开关的数目；
其中一第一开关群及一第二开关群耦接至该像素阵列中的相同列，且系同时开启/关闭。
8.如权利要求7所述的显示面板，其中该控制电路更经排置依序地透过开启中的一第二开关群提供一开关控制信号至该显示面板。
9.如权利要求8所述的显示面板，其中每一像素还包含一开关，且当该开关被该开关控制信号开启时，该开关经排置以发送该发射电流。
10.如权利要求7所述的显示面板，其中该控制电路更经排置以提供一控制信号以选择性地开启/关闭所述这些第一开关群及所述这些第二开关群。
11.如权利要求1所述的显示面板，还包括：
一电路层包含一平坦化层，其中该第一选择电路及该控制电路形成于该电路层中；以及
一发光层，设于该电路层的该平坦化层上方，且包含由一发光材料制成的发光像素之一阵列，其中每一所述这些像素透过一导电通路耦接至一相应的发光像素。
12.一显示面板，包括：
复数个像素，排置于一像素阵列中，其中该像素阵列包含复数个列；
一第一选择电路，包含复数个第一开关，其中每一第一开关耦接至该像素阵列中的一列；
至少一信号产生电路，其中每一该至少一信号产生电路透过所述这些第一开关耦接至该像素阵列中的至少一列，且每一该至少一信号产生电路经排置以提供一脉冲信号至该显示面板；以及
一处理电路，经排置以提供一控制信号至该选择电路以开启所述这些开关的一部分并关闭所述这些开关的另一部分；
其中该像素阵列中该列的数目大于该至少一信号产生电路的数目。
13.如权利要求12所述的显示面板，还包括：
一电压产生电路，经排置以提供一直流电压至耦接至被该处理电路关闭的开关之所述这些列。
14.一显示***，包括：
一显示面板，包含：
复数个像素，排置于一像素阵列中，其中该像素阵列包含复数个列及复数个行；
一第一选择电路，耦接至该显示面板，其中该第一选择电路包含复数个第一开关群，每一第一开关耦接至一列，且所述这些第一开关群经排置可供依序地并重复地开启；以及
一控制电路，耦接至该第一选择电路，其中该控制电路经排置以透过开启中的一第一开关群依序地提供一脉冲信号至该显示面板；
其中该列的数目大于一群中第一开关的数目；以及
一驱动器积体电路(integrated circuit，IC)，耦接至该显示面板，其中该驱动器IC经排置以提供一影像资料至该像素阵列中的所述这些行。
15.一种显示面板的驱动方法，包括：
于一像素阵列中排置该显示阵列的复数个像素，其中该像素阵列包含复数个列；
耦接复数个第一开关群的每一者至该像素阵列中的一列；
依序地并重复地开启所述这些第一开关群；以及
依序地透过开启中的一第一开关群提供一脉冲信号至该显示面板；
其中该列的数目大于一群中第一开关的数目。
16.如权利要求15所述的方法，还包括：
提供一直流电压至关闭中的一第一开关群。
17.如权利要求16所述的方法，还包括：
接收来自对应于关闭中之该第一开关群的每一列之一检测信号，其中该检测信号指出对应于关闭中之该第一开关群的所述每一列是否被使用者触碰。
18.如权利要求16所述的方法，其中每一像素包含一晶体管，且每一第一开关耦接至一列中的所述这些晶体管，且当该脉冲信号被提供至所述这些晶体管的栅极端以供产生一发射电流，该方法还包括：
耦接每一所述这些第二开关群至一列；以及
依序地并重复地开启所述这些第二开关群；以及
耦接一第一开关群及一第二开关群至该像素阵列中的相同列；以及
同时开启/关闭耦接至该像素阵列中的相同列的该第一开关群及该第二开关；
其中该列的数目大于一群中第二开关的数目。
19.如权利要求18所述的方法，还包括：
透过开启中的一第二开关群依序地提供一发射信号至该显示面板。
20.如权利要求19所述的方法，其中每一像素还包含一开关，该方法还包括：
当该开关被该发射信号开启时，透过该开关发送该发射电流。
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