CN111367392B - 一种动态电源管理*** - Google Patents
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Abstract
本发明实施例公开了一种动态电源管理***,包括两个或多个PSU,所述***还包括:中背板、CMC板和节点Node,所述CMC板有两个,所述节点Node有一个或多个,所述PSU设置于中背板上,所述PSU并联对外输出,所述每个CMC板通过CMC连接器和中背板上的所有PSU连接,所述每个节点Node通过节点连接器和中背板连接;所述CMC板为冗余设计,所述CMC板用于对PSU进行在位检测和功耗侦测,所述CMC板用于控制Power capping触发机制,所述每个节点Node用于对节点进行功耗限定,所述中背板用于给***供电。本发明使用BMC和CPLD共同实现逻辑控制,以解决现有技术中无法对不同规格电源冗余情况进行管理,无法对电源告警实现快速响应的问题,使得控制方式更加灵活。
Description
技术领域
本发明涉及电源管理技术领域,具体涉及一种动态电源管理***。
背景技术
随着科技的发展,服务器的应用越来越广泛。高密度服务器具有占用空间小、***更集中等优点。高密度服务器在同一个机箱里由多台服务器节点共享电源和风扇,在更小的物理空间内集成更多的处理器和I/O扩展能力,因此对电源供电提出更高的要求,必须使用多块电源进行供电。
为提高服务器的可靠性,在高密度服务器中电源通常采用冗余方案设计。例如在4个电源配置供电时,支持3+1电源冗余,可以允许1个电源故障时,其余3个电源仍然可以满足整个***的供电要求。由于高密度服务器配置方案的灵活性,使得冗余方案设计更加复杂。
如图1所示,为目前基于BMC的服务器电源冷冗余控制方案,BMC控制CPU节流保护Pin触发CPU降频实现快速降低整机***功耗,避免因冗余电源输出异常造成***功耗过载;并且通过控制CPU或***节点管理控制器限定整机***功耗不超过预设功耗值,从而实现服务器电源冷冗余的控制,满足了高配置服务器应用中客户对电源冷冗余的规格需求,降低了电源设计的复杂度和电源成本。
现有技术中,仅通过BMC实现服务器电源冗余控制的方法,无法满足高密度服务器中针对不同规格电源冗余情况进行管理,无法对电源告警实现快速响应,控制方式不够灵活。
发明内容
本发明实施例中提供了一种动态电源管理***,BMC和CPLD共同实现逻辑控制,以解决现有技术中无法对不同规格电源冗余情况进行管理,无法对电源告警实现快速响应的问题,使得控制方式更加灵活。
本发明实施例公开了如下技术方案:
本发明提供了一种动态电源管理***,包括两个或多个PSU,所述***还包括:中背板、CMC板和节点Node,所述CMC板有两个,所述节点Node有一个或多个,所述PSU设置于中背板上,所述PSU并联对外输出,所述每个CMC板通过CMC连接器和中背板上的所有PSU连接,所述每个节点Node通过节点连接器和中背板连接;
所述CMC板为冗余设计,所述CMC板用于对PSU进行在位检测和功耗侦测,所述CMC板用于控制Power capping触发机制,所述每个节点Node用于对节点进行功耗限定,所述中背板用于给***供电。
进一步地,所述两个CMC板的硬件结构和对外连接结构相同,***预设其中一个CMC板作为主CMC板,则另一个CMC板作为从CMC板,所述从CMC板为冗余板;
***上电时,所述主CMC板用于对PSU进行在位检测和功耗侦测,所述从CMC板用于对PSU进行在位检测和功耗侦测,如果有异常的PSU,则所述主CMC板用于控制Powercapping触发机制。
进一步地,若所述主CMC板发生故障时,***将所述从CMC板升级为主CMC板。
进一步地,所述每个CMC板包括第一BMC和第一CPLD,所述第一BMC连接所有PSU和所有的节点Node,所述第一CPLD连接所有PSU和所有的节点Node,所述第一CPLD连接第一BMC;所述第一BMC用于对PSU进行在位检测和功耗侦测,所述第一CPLD用于控制Powercapping触发机制。
进一步地,所述第一BMC的GPIO模块连接每个PSU的在位信号PSU_PRESENT,所述第一BMC的I2C模块连接每个PSU的PMBUS信号,所述第一BMC的GPIO_OVERRIDE信号连接第一CPLD,所述第一BMC的CMC_I2C信号连接每个节点Node;
***上电时,所述第一BMC通过在位信号PSU_PRESENT判断每个PSU是否在位,如果PSU在位,则PSU的告警信号PSU_Alert为低电平,如果有异常的PSU,异常PSU的告警信号PSU_Alert为高电平;
所述第一BMC通过PMBUS信号读取在位PSU的功耗,所述第一BMC判断在位PSU的功耗之和是否大于BMC预设的***功耗阈值,如果是,则所述第一BMC输出的GPIO_OVERRIDE信号为低电平,不触发Power capping机制,如果否,则所述第一BMC输出的GPIO_OVERRIDE信号为高电平,触发Power capping机制。
进一步地,所述第一CPLD的GPIO模块连接第一BMC的GPIO_OVERRIDE信号,所述第一CPLD的GPIO模块连接每个PSU的告警信号PSU_Alert,所有的告警信号PSU_Alert经过CPLD内部与非门1的输入端,与非门1的输出端和GPIO_OVERRIDE信号经过CPLD内部与非门2的输入端,与非门2的输出端作为第一CPLD的CMC_CAPPING_N信号连接每个节点Node;
当有异常的PSU,并且所述第一BMC判断在位PSU的功耗之和大于BMC预设的***功耗阈值,则所述第一BMC输出的GPIO_OVERRIDE信号为低电平,所述第一CPLD的CMC_CAPPING_N信号输出为高电平,不触发Power capping机制,否则所述第一CPLD的CMC_CAPPING_N信号输出为低电平,触发Power capping机制。
进一步地,所述每个节点Node包括第二BMC、第二CPLD、CPU和PCH,所述第二CPLD的GPIO模块连接第一CPLD的CMC_CAPPING_N信号,所述第二CPLD的PROC_Hot_Throttle信号和MEM_Hot_Throttle信号连接CPU,所述第二CPLD的BMC_GPIO_Throttle信号连接所述第二BMC,所述第二BMC的I2C模块连接CMC_I2C信号,所述第二BMC的BMC_PCH_ME信号连接PCH,PCH的PCH_ME_N信号连接CPU;
当触发Power capping机制后,所述第二CPLD接收第一CPLD的CMC_CAPPING_N信号低电平,则所述第二CPLD将PROC_Hot_Throttle信号和MEM_Hot_Throttle信号发送给CPU,所述第二CPLD将BMC_GPIO_Throttle信号发送给所述第二BMC,CPU接收到PROC_Hot_Throttle信号和MEM_Hot_Throttle信号后,CPU进入硬件低功耗模式;
所述第二BMC接收到BMC_GPIO_Throttle信号后,所述第二BMC通过CMC_I2C信号获取在位PSU的功耗之和小于BMC预设的***功耗阈值,所述第二BMC通过BMC_PCH_ME信号通知PCH在位PSU功耗低,PCH的ME模块通过PCH_ME_N信号通知CPU限定功耗。
进一步地,所述***中每个PSU的功耗规格为800W、1300W、1600W或2000W中的任一种,所述***中至少有一个PSU为冗余电源。
发明内容中提供的效果仅仅是实施例的效果,而不是发明所有的全部效果,上述技术方案中的一个技术方案具有如下优点或有益效果:
1)本发明提供的动态电源管理***,使用BMC和CPLD共同实现逻辑控制,***上电时,CMC板上第一BMC通过在位信号PSU_PRESENT判断每个PSU是否在位,如果PSU在位,第一BMC通过PMBUS信号读取在位PSU的功耗,并判断在位PSU的功耗之和是否大于BMC预设的***功耗阈值,如果是,不触发Power capping机制,如果否,触发Power capping机制;触发Power capping机制后,所述节点Node上的第二CPLD接收第一CPLD的CMC_CAPPING_N信号低电平,CPU进入硬件低功耗模式,同时节点Node上的第二BMC通过CMC_I2C信号获取在位PSU的功耗之和小于BMC预设的***功耗阈值,第二BMC和PCH协商降功耗,并通知CPU限定功耗。本发明实现了对不同规格电源冗余情况进行管理,对电源告警实现快速响应,控制方式更加灵活。
2)本发明提供的动态电源管理***,使用两个CMC板的冗余设计,两个CMC板的硬件结构和对外连接结构相同,***预设其中一个CMC板作为主CMC板,则另一个CMC板作为从CMC板,从CMC板为冗余板。本发明CMC板的冗余设计提高了***的可靠性和稳定性。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,对于本领域普通技术人员而言,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本发明所述现有技术基于BMC的服务器电源冷冗余控制方案结构框图;
图2为本发明所述***结构框图;
图3为本发明实施例所述CMC板连接的一种结构框图;
图4为本发明实施例所述CMC板连接的另一种结构框图;
图5为本发明实施例所述节点Node连接的一种结构框图;
图6为本发明实施例所述节点Node连接的另一种结构框图。
具体实施方式
为了能清楚说明本方案的技术特点,下面通过具体实施方式,并结合其附图,对本发明进行详细阐述。下文的公开提供了许多不同的实施例或例子用来实现本发明的不同结构。为了简化本发明的公开,下文中对特定例子的部件和设置进行描述。此外,本发明可以在不同例子中重复参考数字和/或字母。这种重复是为了简化和清楚的目的,其本身不指示所讨论各种实施例和/或设置之间的关系。应当注意,在附图中所图示的部件不一定按比例绘制。本发明省略了对公知组件和处理技术及工艺的描述以避免不必要地限制本发明。
如图2所示,为本发明所述***结构框图,***包括两个或多个PSU(PSU,PowerSupply unit,电源供应单元),***还包括:中背板、CMC板和节点Node,CMC板有两个,节点Node有一个或多个,PSU设置于中背板上,PSU并联对外输出,每个CMC板通过CMC连接器和中背板上的所有PSU连接,每个节点Node通过节点连接器和中背板连接。
CMC板为冗余设计,CMC板用于对PSU进行在位检测和功耗侦测,CMC板用于控制Power capping触发机制,每个节点Node用于对节点进行功耗限定,中背板用于给***供电。
两个CMC板的硬件结构和对外连接结构相同,***预设其中一个CMC板作为主CMC板,则另一个CMC板作为从CMC板,从CMC板为冗余板;
***上电时,主CMC板用于对PSU进行在位检测和功耗侦测,从CMC板用于对PSU进行在位检测和功耗侦测,如果有异常的PSU,则主CMC板用于控制Power capping触发机制。
若主CMC板发生故障时,***将从CMC板升级为主CMC板。
如图3所示,为本发明实施例所述CMC板连接的一种结构框图,每个CMC板包括第一BMC(BMC,Baseboard Management Controller,基板管理控制器,本实施例中型号为AST2500A2-GP)和第一CPLD(CPLD,Complex Programmable Logic Device,复杂可编程逻辑器件,本实施例中型号为LCMXO2-2000HC-4FTG256I),第一BMC的GPIO(GPIO,General-purpose input/output,通用型输入输出)模块连接每个PSU的在位信号PSU_PRESENT,第一BMC的I2C(I2C,Inter-Integrated Circuit,两线式串行总线)模块连接每个PSU的PMBUS信号,第一BMC的GPIO_OVERRIDE信号连接第一CPLD的GPIO模块,第一BMC的CMC_I2C信号连接每个节点Node,第一CPLD的GPIO模块连接每个PSU的告警信号PSU_Alert,所有的告警信号PSU_Alert经过与非门1的输入端,与非门1的输出端和GPIO_OVERRIDE信号经过与非门2的输入端,与非门2的输出端作为第一CPLD的CMC_CAPPING_N信号连接每个节点Node。
CMC板的工作原理是:
***上电时,CMC板上的第一BMC通过在位信号PSU_PRESENT判断每个PSU是否在位,如果所有的PSU都在位,则PSU的告警信号PSU_Alert为低电平,第一BMC通过PMBUS信号读取每个PSU的功耗;
当有异常的PSU时,异常PSU的告警信号PSU_Alert为高电平,第一BMC判断***中PSU的功耗之和是否大于BMC预设的***功耗阈值,如果是,则第一BMC输出的GPIO_OVERRIDE信号为低电平,第一CPLD的CMC_CAPPING_N信号输出为高电平,不触发Powercapping机制,如果否,则第一BMC输出的GPIO_OVERRIDE信号为高电平,第一CPLD的CMC_CAPPING_N信号输出为低电平,触发Power capping机制。
如图4所示,为本发明实施例所述CMC板连接的另一种结构框图,本结构中有8个节点Node,8个节点Node在***中为并联形式,8个节点的管理控制信息及反馈通过各节点中CMC_I2C_N*信号与CMC板进行交互。
如图5所示,为本发明实施例所述节点Node连接的一种结构框图,每个节点Node包括第二BMC、第二CPLD、CPU(CPU,central processing unit,中央处理器)和PCH(PCH,Platform Controller Hub,intel公司的集成南桥,本实施例中型号为EY82C627),第二CPLD的GPIO模块连接第一CPLD的CMC_CAPPING_N信号,第二CPLD的PROC_Hot_Throttle信号和MEM_Hot_Throttle信号连接CPU,第二CPLD的BMC_GPIO_Throttle信号连接第二BMC,第二BMC的I2C模块连接CMC_I2C信号,第二BMC的BMC_PCH_ME信号连接PCH,PCH的PCH_ME_N信号连接CPU。
节点Node的工作原理是:
当触发Power capping机制后,第二CPLD接收第一CPLD的CMC_CAPPING_N信号低电平,则第二CPLD将PROC_Hot_Throttle信号和MEM_Hot_Throttle信号发送给CPU,第二CPLD将BMC_GPIO_Throttle信号发送给第二BMC,CPU接收到PROC_Hot_Throttle信号和MEM_Hot_Throttle信号后,CPU进入硬件低功耗模式;
第二BMC接收到BMC_GPIO_Throttle信号后,第二BMC通过CMC_I2C信号获取***中PSU的功耗之和小于BMC预设的***功耗阈值,第二BMC通过BMC_PCH_ME信号通知PCH PSU功耗低,PCH的ME模块通过PCH_ME_N信号通知CPU限定功耗。
如图6所示,为本发明实施例所述节点Node连接的另一种结构框图,本结构中2个CMC板在***中和节点Node的连接完全相同,2个CMC板为冗余结构。
***中至少有一个PSU为冗余电源,每个PSU的功耗规格为800W、1300W、1600W或2000W中的任一种。
本发明中还包括风扇板,风扇板插到中背板,风扇板实现对风扇及网络的控制。以上所述只是本发明的优选实施方式,对于本技术领域的普通技术人员来说,在不脱离本发明原理的前提下,还可以做出若干改进和润饰,这些改进和润饰也被视为本发明的保护范围。
Claims (4)
1.一种动态电源管理***,其特征在于,所述***包括两个或多个PSU,所述***还包括中背板、CMC板和节点Node,所述CMC板有两个,所述节点Node有一个或多个,所述PSU设置于中背板上,所述PSU并联对外输出,所述每个CMC板通过CMC连接器和中背板上的所有PSU连接,所述每个节点Node通过节点连接器和中背板连接,
所述CMC板为冗余设计,所述CMC板用于对PSU进行在位检测和功耗侦测,所述CMC板用于控制Power capping触发机制,所述每个节点Node用于对节点进行功耗限定,所述中背板用于给***供电;
所述两个CMC板的硬件结构和对外连接结构相同,***预设其中一个CMC板作为主CMC板,则另一个CMC板作为从CMC板,所述从CMC板为冗余板,
***上电时,所述主CMC板用于对PSU进行在位检测和功耗侦测,所述从CMC板用于对PSU进行在位检测和功耗侦测,如果有异常的PSU,则所述主CMC板用于控制Power capping触发机制;
所述每个CMC板包括第一BMC和第一CPLD,所述第一BMC连接所有PSU和所有的节点Node,所述第一CPLD连接所有PSU和所有的节点Node,所述第一CPLD连接第一BMC;所述第一BMC用于对PSU进行在位检测和功耗侦测,所述第一CPLD用于控制Power capping触发机制;
所述每个节点Node包括第二BMC、第二CPLD、CPU和PCH,所述第二CPLD的GPIO模块连接第一CPLD的CMC_CAPPING_N信号,所述第二CPLD的PROC_Hot_Throttle信号和MEM_Hot_Throttle信号连接CPU,所述第二CPLD的BMC_GPIO_Throttle信号连接所述第二BMC,所述第二BMC的I2C模块连接CMC_I2C信号,所述第二BMC的BMC_PCH_ME信号连接PCH,PCH的PCH_ME_N信号连接CPU,
当触发Power capping机制后,所述第二CPLD接收第一CPLD的CMC_CAPPING_N信号低电平,则所述第二CPLD将PROC_Hot_Throttle信号和MEM_Hot_Throttle信号发送给CPU,所述第二CPLD将BMC_GPIO_Throttle信号发送给所述第二BMC,CPU接收到PROC_Hot_Throttle信号和MEM_Hot_Throttle信号后,CPU进入硬件低功耗模式,
所述第二BMC接收到BMC_GPIO_Throttle信号后,所述第二BMC通过CMC_I2C信号获取在位PSU的功耗之和小于BMC预设的***功耗阈值,所述第二BMC通过BMC_PCH_ME信号通知PCH在位PSU功耗低,PCH的ME模块通过PCH_ME_N信号通知CPU限定功耗;
所述***中每个PSU的功耗规格为800W、1300W、1600W或2000W中的任一种,所述***中至少有一个PSU为冗余电源。
2.根据权利要求1所述的一种动态电源管理***,其特征在于,若所述主CMC板发生故障时,***将所述从CMC板升级为主CMC板。
3.根据权利要求1所述的一种动态电源管理***,其特征在于,所述第一BMC的GPIO模块连接每个PSU的在位信号PSU_PRESENT,所述第一BMC的I2C模块连接每个PSU的PMBUS信号,所述第一BMC的GPIO_OVERRIDE信号连接第一CPLD,所述第一BMC的CMC_I2C信号连接每个节点Node;
***上电时,所述第一BMC通过在位信号PSU_PRESENT判断每个PSU是否在位,如果PSU在位,则PSU的告警信号PSU_Alert为低电平,如果有异常的PSU,异常PSU的告警信号PSU_Alert为高电平;
所述第一BMC通过PMBUS信号读取在位PSU的功耗,所述第一BMC判断在位PSU的功耗之和是否大于BMC预设的***功耗阈值,如果是,则所述第一BMC输出的GPIO_OVERRIDE信号为低电平,不触发Power capping机制,如果否,则所述第一BMC输出的GPIO_OVERRIDE信号为高电平,触发Power capping机制。
4.根据权利要求3所述的一种动态电源管理***,其特征在于,所述第一CPLD的GPIO模块连接第一BMC的GPIO_OVERRIDE信号,所述第一CPLD的GPIO模块连接每个PSU的告警信号PSU_Alert,所有的告警信号PSU_Alert经过CPLD内部与非门1的输入端,与非门1的输出端和GPIO_OVERRIDE信号经过CPLD内部与非门2的输入端,与非门2的输出端作为第一CPLD的CMC_CAPPING_N信号连接每个节点Node;
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