CN111343379A - 基于fpga的数据高速采集装置及方法 - Google Patents
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Abstract
本发明公开了一种基于FPGA的数据高速采集装置及方法,包括双目相机、IMU、FPGA平台以及网口模块,双目相机和IMU通过FPGA平台连接至网口模块,其中,双目相机的两个图像传感器的trigger信号由FPGA平台同步触发,并且向FPGA平台同步输出采集的实时图像;IMU与两个图像传感器通过FPGA平台达到硬件同步;FPGA平台包括FIFO和双目IMU传输IP核,FIFO连接IMU和两个图像传感器,并且同时存储实时双目图像和IMU数据,FIFO连接双目IMU传输IP核,并通过双目IMU传输IP核向网口模块传输同步的双目图像和IMU数据。本发明可以同步低延时传输双目图像和IMU数据,适用于视觉导航定位、工业检测及识别领域。
Description
技术领域
本发明涉及机器视觉技术领域,特别涉及一种基于FPGA的数据高速采集装置及方法。
背景技术
双目图像数据广泛应用于视觉导航定位领域,比如:无人机视觉惯导定位***、自动驾驶导航避障***、AR、VR、室内机器人和仓库AGV定位导航***等等;双目图像数据也广泛应用于识别领域,比如:3D人脸识别、物体感知追踪。同时双目图像数据也应用于测量领域,比如,深度测量、ADAS和工业筛检。
目前双目图像采集方案有的使用STM32作为主控,难以同时处理两部摄像头采集到的数据,发热比较严重;有的双目图像数据和IMU数据之间同步误差达到几十毫秒,在高速场景下基本不能使用。有的双目图像数据传输延迟达到100毫秒以上,不能实时传输,在无人机,自动驾驶领域基本没法使用。有的双目图像数据传输带宽不够,在高帧率模式下丢包严重,达不到高帧率实时检测,基本无法应用于工业检测领域。
发明内容
本发明的第一目的在于克服现有技术的缺点与不足,提供一种基于FPGA的数据高速采集装置,该装置可以及时有效地获取和传输实时数据,实现IMU数据和双目数据之间硬件级同步,可以应用于高速运动场景。
本发明的第二目的在于提供一种基于FPGA的数据高速采集方法,该方法能够同步低延时传输双目图像和IMU数据,数据缓存时间短、传输稳定,有利于提高数据传输的质量。
本发明的第一目的通过下述技术方案实现:一种基于FPGA的数据高速采集装置,包括:双目相机、IMU、FPGA平台以及网口模块,双目相机和IMU通过FPGA平台连接至网口模块,其中,
双目相机具有两个图像传感器,两个图像传感器的trigger信号由FPGA平台同步触发,并且向FPGA平台同步输出采集的实时图像;
IMU与两个图像传感器通过FPGA平台达到硬件同步;
FPGA平台包括FIFO和双目IMU传输IP核,FIFO连接IMU和两个图像传感器,并且同时缓存实时的双目图像和IMU数据,FIFO连接双目IMU传输IP核,并通过双目IMU传输IP核向网口模块传输同步的双目图像和IMU数据。
优选的,FIFO包括FIFO1、FIFO2和FIFO3,其中,FIFO1和FIFO2分别连接对应的图像传感器并存储实时图像,FIFO3连接IMU并存储IMU数据;三个FIFO均连接双目IMU传输IP核。
优选的,双目相机为全局曝光相机,图像传感器工作在外触发模式,双目曝光时间同步精度在1ms内;
两个图像传感器和IMU之间通过FPGA平台的双目IMU时间同步***实现硬件同步,同步时间1ms内。
优选的,网口模块为以太网模块,数据高速采集装置通过以太网模块连接上位机,双目图像和IMU数据根据图像传输协议通过以太网传输至上位机。
优选的,FPGA平台采用FPGA EP4CE6E22C8N,FIFO采用小容量8Kbyte;图像传感器采用安森美AR0134传感器;IMU采用BMI160六轴传感器;网口模块采用RTL8211芯片。
本发明的第二目的通过下述技术方案实现:一种基于FPGA的数据高速采集方法,包括如下步骤:
S1、FPGA平台配置双目相机中两个图像传感器的寄存器,使两个图像传感器均工作在外触发模式,然后同步触发两个图像传感器的trigger信号,使两个图像传感器采集的实时图像同步输出;
FPGA平台将两个图像传感器和IMU硬件同步,并且双目图像和IMU数据同时缓存至FPGA平台的FIFO中;
S2、FPGA平台的双目IMU传输IP核将同步的双目图像和IMU数据通过图像传输协议传输给上位机;
S3、上位机获取到数据后,根据图像传输协议解析出双目图像和IMU数据。
优选的,图像传输协议为UDP协议,UDP协议采用verilog语言,并定义有MAC层、IP层、UDP层、数据层和CRC校验层,其中,数据层根据FPGA平台中各个FIFO的缓存情况选择对应的FIFO的数据作为待发送数据。
优选的,图像传输协议根据双目图像的分辨率N*M,规定一个数据包的长度为N+3个字节,并且数据包的第一个字节表示相机型号,第二个字节表示一行图像中的行数低8位,第三个字节表示该行图像中的行数高8位,后N个字节表示该行图像的数据信息,其中,IMU的数据包规定为600个字节,数据包的前两个字节分别为0X55、0X50,剩余的字节为当前帧与上一帧之间的IMU数据。
更进一步的,上位机根据图像协议解析出双目图像和IMU数据,具体为:上位机通过数据包中的行数和相机型号解析出双目图像,并根据行数判定是否丢包,在丢包情况下再进行丢包处理。
优选的,FPGA平台通过双目IMU时间同步***将两个图像传感器和IMU硬件同步,具体是:FPGA平台先采集相机的FLASH信号,然后配置相机的FLASH信号至IMU中的寄存器,在图像开始曝光时,图像传感器所产生的FLASH信号同时触发IMU采集IMU数据,如果采集到偶数个IMU数据,则取中间两个IMU数据时间戳的中值作为图像的时间戳;如果采集到奇数个IMU数据,则取中间的IMU数据时间戳作为图像的时间戳。
本发明相对于现有技术具有如下的优点及效果:
(1)本发明基于FPGA的数据高速采集装置,包括双目相机、IMU、FPGA平台以及网口模块,双目相机和IMU通过FPGA平台连接至网口模块,其中,双目相机具有两个图像传感器,两个图像传感器的trigger信号由FPGA平台同步触发,并且向FPGA平台同步输出采集的实时图像;IMU与两个图像传感器通过FPGA平台达到硬件同步;FPGA平台包括FIFO和双目IMU传输IP核,FIFO连接IMU和两个图像传感器,并且同时缓存实时的双目图像和IMU数据,FIFO连接双目IMU传输IP核,并通过双目IMU传输IP核向网口模块传输同步的双目图像和IMU数据。本发明装置基于FPGA,发热少,传输时延小,并且通过FPGA平台使两个图像传感器同步触发,可以提供一个精准的原始图像;通过FPGA平台将IMU和双目相机硬件同步,可以有效避免装置在高速移动或者轻微震动时位姿估计不准确的问题,提高感知周围物体和自身状态的准确率,有利于及时有效地获取和传输实时数据,因此非常适用于视觉导航定位、工业检测及识别领域。
(2)本发明装置通过设置以太网模块,使得双目图像和IMU数据能够通过以太网及时传输至上位机,便于显示和做进一步分析处理。
(3)本发明基于FPGA的数据高速采集方法将实时双目图像和IMU数据的时间戳同步,并且设计了快速安全的图像传输协议,能够将双目图像和IMU数据同步低延时地传输到上位机,并且上位机能够根据该协议对数据进行丢包检测,有利于提高数据传输的质量。
附图说明
图1是本发明基于FPGA的数据高速采集装置的示意图。
具体实施方式
下面结合实施例及附图对本发明作进一步详细的描述,但本发明的实施方式不限于此。
实施例
本实施例公开了一种基于FPGA的数据高速采集装置,如图1所示,包括:双目相机、IMU、FPGA平台以及网口模块,双目相机和IMU通过FPGA平台连接至网口模块。
其中,双目相机1具有两个图像传感器Camera1、Camera2,两个图像传感器的trigger信号由FPGA平台同步触发,并且向FPGA平台同步输出采集的实时图像。
在本实施例中,双目相机选用全局曝光相机,全局曝光相机受环境光干扰比较小,可以提高图像质量。
两个图像传感器同步触发,也就是使两个成像单元同时曝光,如此能够避免图像出现果冻现象,当应用在高速运动中时,可以有效避免图像变形、模糊等现象,提供一个精准的原始图像。图像传感器工作在外触发模式,可以方便人为控制相机工作状态。双目曝光时间同步精度在1ms内。图像传感器可采用安森美AR0134传感器。
IMU 2包括有陀螺仪和加速度计,可用于采集双目相机的角速度和加速度。IMU与两个图像传感器通过FPGA平台实现硬件同步,可以有效避免装置在高速移动或者轻微震动时位姿估计不准确的问题,提高感知周围物体和自身状态的准确率,适用于高速运动场景。本实施例的IMU可采用BMI160六轴传感器。
在本实施例中,两个图像传感器和IMU之间具体是通过FPGA平台设计的双目IMU时间同步***实现硬件同步,并且同步时间1ms内。数据高速采集装置的时间***以IMU的时间***为基准。
FPGA平台3包括FIFO和双目IMU传输IP核,FIFO连接IMU和两个图像传感器,并且同时缓存实时双目图像和IMU数据,FIFO连接双目IMU传输IP核,并通过双目IMU传输IP核向网口模块传输同步的双目图像和IMU数据。
在本实施例中,FPGA平台的Init通过I2C接口配置图像传感器中寄存器,使图像传感器工作在外触发模式,通过DVP接口获取实时图像。FPGA平台的Init通过I2C接口配置IMU中寄存器,使寄存器一直触发,通过UART接口获取IMU数据。FPGA平台可采用FPGAEP4CE6E22C8N。
FIFO包括FIFO1、FIFO2和FIFO3,其中,FIFO1和FIFO2分别连接对应的图像传感器并存储实时图像,FIFO3连接IMU并存储IMU数据;FIFO1、FIFO2和FIFO3均连接双目IMU传输IP核。FIFO可采用小容量8Kbyte,便于将图像和IMU数据实时传至双目IMU传输IP核,不用经过长时间缓存,可以降低传输延时。
网口模块4为以太网模块,数据高速采集装置通过以太网模块连接上位机5,双目图像和IMU数据根据图像传输协议通过以太网传输至上位机,上位机可以对数据进行显示和做进一步处理。网口模块可采用RTL8211芯片。上位机可以是平板、电脑、工控机或其他具有数据显示和处理功能的设备。
本实施例还公开了一种基于FPGA的数据高速采集方法,包括:
S1、FPGA平台配置双目相机中两个图像传感器的寄存器,使两个图像传感器均工作在外触发模式,然后同步触发两个图像传感器的trigger信号,使两个图像传感器采集的实时图像同步输出。
S2、FPGA平台将两个图像传感器和IMU硬件同步,并且双目图像和IMU数据同时缓存至FPGA平台的FIFO中。
其中,FPGA平台通过双目IMU时间同步***将两个图像传感器和IMU硬件同步,具体是:FPGA平台先采集相机的FLASH信号,然后配置相机的FLASH信号至IMU中的寄存器,在图像开始曝光也即FLASH信号拉高的时候,同时触发IMU采集IMU数据,如果采集到偶数个IMU数据,则取中间两个IMU数据时间戳的中值作为图像的时间戳;如果采集到奇数个IMU数据,则取中间的IMU数据时间戳作为图像的时间戳。
S2、FPGA平台的双目IMU传输IP核将同步的双目图像和IMU数据通过图像传输协议传输给上位机。
其中,图像传输协议为UDP协议,UDP协议采用verilog语言,并定义有MAC层、IP层、UDP层、数据层和CRC校验层,其中,数据层根据FPGA平台中各个FIFO的缓存情况选择对应的FIFO的数据作为待发送数据。
S3、上位机获取到数据后,并根据图像传输协议解析出双目图像和IMU数据。
其中,图像传输协议根据双目图像的分辨率为N*M,规定一个数据包的长度为N+3个字节,并且数据包的第一个字节表示相机型号,第二个字节表示一行图像中的行数低8位,第三个字节表示该行图像中的行数高8位,后N个字节表示该行图像的数据信息,其中,IMU的数据包规定为600个字节,数据包的前两个字节是0X55、0X50,剩余的字节为当前帧与上一帧之间的IMU数据。本实施例的图像分辨率为1280*720,每帧图像具有720行,数据包的长度为1283。根据该图像传输协议,双目图像和IMU数据可以同步低延时传输到上位机。
上位机可以通过数据包中的行数和相机型号解析出双目图像,并根据行数判定是否丢包,在丢包情况下再进行丢包处理。本实施例的上位机可以是平板、电脑、工控机或其他具有数据显示和处理功能的设备。
如上方法可应用在本实施例所述的高速采集装置中,并且,上位机还可以根据图像传输协议设计有linux和windows驱动,传输数据稳定在800Mb/s,满足双目图像1280*720@50fps的高速稳定传输。
上述实施例为本发明较佳的实施方式,但本发明的实施方式并不受上述实施例的限制,其他的任何未背离本发明的精神实质与原理下所作的改变、修饰、替代、组合、简化,均应为等效的置换方式,都包含在本发明的保护范围之内。
Claims (10)
1.一种基于FPGA的数据高速采集装置,其特征在于,包括:双目相机、IMU、FPGA平台以及网口模块,双目相机和IMU通过FPGA平台连接至网口模块,其中,
双目相机具有两个图像传感器,两个图像传感器的trigger信号由FPGA平台同步触发,并且向FPGA平台同步输出采集的实时图像;
IMU与两个图像传感器通过FPGA平台达到硬件同步;
FPGA平台包括FIFO和双目IMU传输IP核,FIFO连接IMU和两个图像传感器,并且同时缓存实时的双目图像和IMU数据,FIFO连接双目IMU传输IP核,并通过双目IMU传输IP核向网口模块传输同步的双目图像和IMU数据。
2.根据权利要求1所述的基于FPGA的数据高速采集装置,其特征在于,FIFO包括FIFO1、FIFO2和FIFO3,其中,FIFO1和FIFO2分别连接对应的图像传感器并存储实时图像,FIFO3连接IMU并存储IMU数据;三个FIFO均连接双目IMU传输IP核。
3.根据权利要求1所述的基于FPGA的数据高速采集装置,其特征在于,双目相机为全局曝光相机,图像传感器工作在外触发模式,双目曝光时间同步精度在1ms内;
两个图像传感器和IMU之间通过FPGA平台的双目IMU时间同步***实现硬件同步,同步时间1ms内。
4.根据权利要求1所述的基于FPGA的数据高速采集装置,其特征在于,网口模块为以太网模块,数据高速采集装置通过以太网模块连接上位机,双目图像和IMU数据根据图像传输协议通过以太网传输至上位机。
5.根据权利要求1所述的基于FPGA的数据高速采集装置,其特征在于,FPGA平台采用FPGA EP4CE6E22C8N,FIFO采用小容量8Kbyte;图像传感器采用安森美AR0134传感器;IMU采用BMI160六轴传感器;网口模块采用RTL8211芯片。
6.一种基于FPGA的数据高速采集方法,其特征在于,包括如下步骤:
S1、FPGA平台配置双目相机中两个图像传感器的寄存器,使两个图像传感器均工作在外触发模式,然后同步触发两个图像传感器的trigger信号,使两个图像传感器采集的实时图像同步输出;
FPGA平台将两个图像传感器和IMU硬件同步,并且双目图像和IMU数据同时缓存至FPGA平台的FIFO中;
S2、FPGA平台的双目IMU传输IP核将同步的双目图像和IMU数据通过图像传输协议传输给上位机;
S3、上位机获取到数据后,根据图像传输协议解析出双目图像和IMU数据。
7.根据权利要求6所述的基于FPGA的数据高速采集方法,其特征在于,图像传输协议为UDP协议,UDP协议采用verilog语言,并定义有MAC层、IP层、UDP层、数据层和CRC校验层,其中,数据层根据FPGA平台中各个FIFO的缓存情况选择对应的FIFO的数据作为待发送数据。
8.根据权利要求6所述的基于FPGA的数据高速采集方法,其特征在于,图像传输协议根据双目图像的分辨率N*M,规定一个数据包的长度为N+3个字节,并且数据包的第一个字节表示相机型号,第二个字节表示一行图像中的行数低8位,第三个字节表示该行图像中的行数高8位,后N个字节表示该行图像的数据信息,其中,IMU的数据包规定为600个字节,数据包的前两个字节分别为0X55、0X50,剩余的字节为当前帧与上一帧之间的IMU数据。
9.根据权利要求8所述的基于FPGA的数据高速采集方法,其特征在于,上位机根据图像协议解析出双目图像和IMU数据,具体为:上位机通过数据包中的行数和相机型号解析出双目图像,并根据行数判定是否丢包,在丢包情况下再进行丢包处理。
10.根据权利要求6所述的基于FPGA的数据高速采集方法,其特征在于,FPGA平台通过双目IMU时间同步***将两个图像传感器和IMU硬件同步,具体是:
FPGA平台先采集相机的FLASH信号,然后配置相机的FLASH信号至IMU中的寄存器,在图像开始曝光时,图像传感器所产生的FLASH信号同时触发IMU采集IMU数据,如果采集到偶数个IMU数据,则取中间两个IMU数据时间戳的中值作为图像的时间戳;如果采集到奇数个IMU数据,则取中间的IMU数据时间戳作为图像的时间戳。
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