CN109872697A - 一种阵列基板、显示面板、显示装置 - Google Patents

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Abstract

本发明提供一种阵列基板、显示面板、显示装置，属于显示技术领域，其可解决现有的8K的AMOLED工艺难度较大以及像素排布空间有限的问题。本发明的阵列基板中每相邻两个像素单元为一个像素组，一个像素组中包括六个子像素，六个子像素用三条数据线，即该像素组中每两个子像素共用其中一条数据线，相当于数据线减半，节省了排布空间。该阵列基板适用于各种显示装置，尤其适用于8K的AMOLED。

Description

一种阵列基板、显示面板、显示装置
技术领域
本发明属于显示技术领域，具体涉及一种阵列基板、显示面板、显示装置。
背景技术
AMOLED屏幕是指以AMOLED材料为主的屏幕，AMOLED(Active Matrix/OrganicLight Emitting Diode)是有源矩阵有机发光二极体面板。相比传统的液晶面板，AMOLED具有反应速度较快、对比度更高、视角较广等特点。
发明人发现现有技术中至少存在如下问题：目前显示领域AMOLED高分辨率8K产品相对稀少，尤其8K AMOLED显示装置没有投产面世，主要原因工艺难度较大以及像素排布空间有限以及制作成本过高。
发明内容
本发明针对现有的8K的AMOLED工艺难度较大以及像素排布空间有限的问题，提供一种阵列基板、显示面板、显示装置。
解决本发明技术问题所采用的技术方案是：
一种阵列基板，包括多个阵列排布的像素单元，一行所述像素单元中的每相邻两个像素单元为一个像素组，该像素组中的两个像素单元分别为第一像素单元，第二像素单元；每个所述像素单元均包括三个子像素，分别为第一子像素、第二子像素、第三子像素；每个所述子像素均包括含有开关晶体管、驱动晶体管、感应晶体管、存储电容及发光器件的像素电路；
所述每一行所述像素单元中的各个所述子像素由四行扫描线控制，所述四行扫描线分别记作第一扫描线、第二扫描线、第三扫描线、第四扫描线；所述第一像素单元的第一子像素和第二子像素的开关晶体管的控制极，以及第二像素单元的第二子像素的开关晶体管的控制极均连接第一扫描线；所述第一像素单元的第一子像素和第二子像素的感应晶体管的控制极，以及第二像素单元的第二子像素的感应晶体管的控制极均连接第二扫描线；所述第一像素单元的第三子像素的开关晶体管的控制极，以及第二像素单元的第一子像素和第三子像素的开关晶体管的控制极均连接第三扫描线；所述第一像素单元的第三子像素的感应晶体管的控制极，以及第二像素单元的第一子像素和第三子像素的感应晶体管的控制极均连接第四扫描线；
其中，一个像素组中包括三条数据线，该像素组中每两个子像素共用其中一条数据线，并且连接该数据线的其中一个子像素与第一扫描线、第二扫描线连接，另一个子像素与第三扫描线、第四扫描线连接。
可选的是，所述四行扫描线分别设于该行像素单元所在行的两侧，其中第一扫描线和第二扫描线位于该行像素单元的同侧，第三扫描线和第四扫描线位于该行像素单元的同侧。
可选的是，所述一个像素组中的三条数据线分别为第一数据线，第二数据线，第三数据线；该像素组中的每个像素单元中包括两列，所述第一子像素位于一列，所述第二子像素、第三子像素位于同一列；其中，第一数据线设于第一像素单元的第一子像素所在列与第二子像素、第三子像素所在列之间；第二数据线设于该像素组中的两个像素单元之间；第三数据线设于第二像素单元的第一子像素所在列与第二子像素、第三子像素所在列之间。
可选的是，所述第一像素单元的第一子像素和第三子像素的开关晶体管的第一极连接第一数据线；所述第一像素单元的第二子像素和第二像素单元的第一子像素的开关晶体管的第一极连接第二数据线；所述第二像素单元的第二子像素和第三子像素的开关晶体管的第一极连接第三数据线。
可选的是，所述第一像素单元背离第二像素单元的一侧设有第一电源线，所述第一像素单元的三个子像素的驱动晶体管的第一极连接至第一电源线；所述第二像素单元背离第一像素单元的一侧设有第二电源线，所述第二像素单元的三个子像素的驱动晶体管的第一极连接至第二电源线。
可选的是，所述第一像素单元与所述第二像素单元之间设有第一感应线，所述第一像素单元的三个子像素的感应晶体管的第一级连接至所述第一感应线；所述第二像素单元背离第一像素单元的一侧设有第二感应线，所述第二像素单元的三个子像素的感应晶体管的第一级连接至所述第二感应线。
可选的是，每个所述像素单元中开关晶体管的第二极连接驱动晶体管的控制极，以及存储电容的第一极；每个所述像素单元中驱动晶体管的第二极连接发光器件的第一极，存储电容的第二极以及感应晶体管的第二极；每个所述像素单元中所述发光器件的第二极连接第二电源端。
可选的是，每个所述像素单元中的第一子像素、第二子像素、第三子像素分别为：蓝色子像素、绿色子像素、红色子像素。
可选的是，所述发光器件包括有机电致发光器件。
本发明还提供一种显示面板，包括上述的阵列基板。
本发明还提供一种显示装置，包括上述的显示面板。
本发明还提供一种上述阵列基板的驱动方法，该方法包括：向连接同一数据线且不同扫描线的两子像素同时提供数据信号；向连接不同数据线相同扫描线的两子像素同时提供数据信号；向连接不同数据线且不同扫描线的子像素分时段提供数据信号。
附图说明
图1为本发明的实施例1的阵列基板的像素结构示意图；
图2为本发明的实施例1的阵列基板的电路结构示意图；
图3为本发明的实施例2的阵列基板的数据线排布示意图；
图4为本发明的实施例2的阵列基板的电源线排布示意图；
图5为本发明的实施例2的阵列基板的感应线排布示意图；
图6为本发明的实施例2的阵列基板的电路结构示意图；
图7为本发明的实施例2的子像素的一种电路结构示意图；
图8为本发明的实施例2的子像素的另一种电路结构示意图；
图9为本发明的实施例2的阵列基板的子像素的设计示意图；
图10为本发明的实施例2的图9中纯色显示驱动时序图；
图11为本发明的实施例2的图9中混色显示驱动时序图；
图12为本发明的实施例2的阵列基板中感应晶体管时序图；
其中，附图标记为：10、像素单元；11、第一子像素；12、第二子像素；13、第三子像素；3、数据线；31、第一数据线；32、第二数据线；33、第三数据线；41、第一电源线；42、第二电源线；51、第一感应线；52、第二感应线。
具体实施方式
为使本领域技术人员更好地理解本发明的技术方案，下面结合附图和具体实施方式对本发明作进一步详细描述。
本发明实施例中的所采用的晶体管可以为薄膜晶体管或场效应管或其他特性的相同器件，由于采用的晶体管的源极和漏极在一定条件下是可以互换的，所以其源极、漏极从连接关系的描述上是没有区别的。在本发明实施例中，为区分晶体管的源极和漏极，将其中一极称为第一极，另一极称为第二极，栅极称为控制极。
在本发明实施例中发光器件可以是有机电致发光器件，其中发光器件的第一极和第二极中的一者为阳极，另一者为阴极，在本实施例中是以发光器件的第一极为阳极，第二极为阴极为例进行说明的。
除非另外定义，本发明实施例公开使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本发明实施例中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语一直出该词前面的元件或误检涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述的对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
对本实施例的阵列基板中的每个像素单元的结构进行说明。每个像素单元均包括三个子像素，分别为第一子像素、第二子像素、第三子像素；每个子像素均包括由开关晶体管、驱动晶体管、感应晶体管、存储电容及发光器件构成的像素电路；其中，对于每个像素电路，开关晶体管的栅极连接扫描线扫，源极连接数据线，漏极连接驱动晶体管的栅极和存储电容的第一端；驱动晶体管的源极连接第一电源电压端，漏极连接存储电容的第二端和发光器件的阳极；感应晶体管的源极连接感应线，漏极连接存储电容的第二端和发光器件的阳极；发光器件的阴极连接第二电源电压端。
实施例1：
本实施例提供一种阵列基板，如图1、图2所示，包括多个阵列排布的像素单元10，一行所述像素单元10中的每相邻两个像素单元10为一个像素组，该像素组中的两个像素单元10分别为第一像素单元，第二像素单元；每个所述像素单元10均包括三个子像素，分别为第一子像素11、第二子像素12、第三子像素13；每个所述子像素均包括含有开关晶体管、驱动晶体管、感应晶体管、存储电容及发光器件的像素电路；
所述每一行所述像素单元10中的各个所述子像素由四行扫描线控制，所述四行扫描线分别记作第一扫描线G11、第二扫描线G12、第三扫描线G21、第四扫描线G22；所述第一像素单元的第一子像素和第二子像素的开关晶体管的控制极，以及第二像素单元的第二子像素的开关晶体管的控制极均连接G11；所述第一像素单元的第一子像素和第二子像素的感应晶体管的控制极，以及第二像素单元的第二子像素的感应晶体管的控制极均连接G12；所述第一像素单元的第三子像素的开关晶体管的控制极，以及第二像素单元的第一子像素和第三子像素的开关晶体管的控制极均连接G21；所述第一像素单元的第三子像素的感应晶体管的控制极，以及第二像素单元的第一子像素和第三子像素的感应晶体管的控制极均连接G22；
其中，一个像素组中包括三条数据线3，该像素组中每两个子像素共用其中一条数据线3，并且连接该数据线3的其中一个子像素与G11、G12连接，另一个子像素与G21、G22连接。
本实施例的阵列基板中每相邻两个像素单元10为一个像素组，一个像素组中包括六个子像素，六个子像素用三条数据线，即该像素组中每两个子像素共用其中一条数据线，相当于数据线减半，节省了排布空间。该阵列基板适用于各种显示装置，尤其适用于8K的AMOLED。
实施例2：
本实施例提供一种阵列基板，如图1-8所示，该阵列基板包括多个阵列排布的像素单元10，一行所述像素单元10中的每相邻两个像素单元10为一个像素组，该像素组中的两个像素单元10分别为第一像素单元，第二像素单元；图3中左侧的虚线框内为第一像素单元，右侧的虚线框内为第二像素单元；每个所述像素单元10均包括三个子像素，分别为第一子像素、第二子像素、第三子像素；本实施例中以第一子像素、第二子像素、第三子像素分别为：蓝色子像素B、红色子像素R、绿色子像素G为例进行说明，三种颜色互换的情况也是类似的。每个所述子像素均包括含有开关晶体管T2、驱动晶体管T1、感应晶体管T3、存储电容Cst及发光器件的像素电路；
所述每一行所述像素单元10中的各个所述子像素由四行扫G11、G12、G21、G22控制；所述G11、G12与G21、G22分别设于该行像素单元的两侧；
左侧第一像素单元中的第一子像素B、第二子像素R以及右侧第二像素单元的第二子像素R的各自的连接关系如图7、图8所示，左侧第一像素单元中的第一子像素B和第二子像素R以及右侧第二像素单元的第二子像素R的开关晶体管T2的控制极均连接G11；左侧第一像素单元的第一子像素B和第二子像素R的感应晶体管T3的控制极，以及右侧第二像素单元的第二子像素G的感应晶体管T3的控制极均连接G12；左侧第一像素单元的第三子像素G的开关晶体管T2的控制极，以及右侧第二像素单元的第一子像素B和第三子像素G的开关晶体管T2的控制极均连接G21；左侧第一像素单元的第三子像素G的感应晶体管T3的控制极，以及第二像素单元的第一子像素B和第三子像素G的感应晶体管T3的控制极均连接G22；
其中，如图3所示，该像素组中包括三条数据线3，分别为第一数据线31，第二数据线32，第三数据线33；该像素组中的每个像素单元中的第二子像素R、第三子像素G位于同一列，第一子像素B与第二子像素R、第三子像素G位于同一行；其中，第一数据线31设于第一像素单元的第一子像素B与第二子像素R、第三子像素G之间；第二数据线32设于该像素组中的两个像素单元10之间；第三数据线33设于第二像素单元的第一子像素B与第二子像素R、第三子像素G之间。
在一个实施例中，左侧第一像素单元的第一子像素B和第三子像素G的开关晶体管T2的第一极连接第一数据线31；左侧第一像素单元的第二子像素R和第二像素单元的的第一子像素B的开关晶体管T2的第一极连接第二数据线32；右侧第二像素单元的第二子像素R和第三子像素G的开关晶体管T2的第一极连接第三数据线33。
在一个实施例中，如图4所示，左侧第一像素单元背离第二像素单元的一侧设有第一电源线41(VDD)，左侧第一像素单元的三个子像素B、R、G的驱动晶体管T1的第一极连接至第一电源线41；右侧第二像素单元背离第一像素单元的一侧设有第二电源线42，右侧第二像素单元的三个子像素B、R、G的驱动晶体管T1的第一极连接至第二电源线42(VDD)。
在一个实施例中，如图5所示，左侧第一像素单元与右侧第二像素单元之间设有第一感应线51，左侧第一像素单元的三个子像素B、R、G的感应晶体管T3的第一级连接至所述第一感应线51；右侧第二像素单元背离第一像素单元的一侧设有第二感应线52，右侧第二像素单元的三个子像素B、R、G的感应晶体管T3的第一级连接至所述第二感应线52。
在一个实施例中，每个所述像素单元中开关晶体管T2的第二极连接驱动晶体管T1的控制极，以及存储电容Cst的第一极；每个所述像素单元中驱动晶体管T2的第二极连接发光器件的第一极，存储电容Cst的第二极以及感应晶体管T3的第二极；每个所述像素单元中所述发光器件的第二极连接第二电源端VSS。
本实施例中两组R、G、B构成一个像素组，即一个像素组中含有6个子像素，两个不同颜色子像素共用1条数据线，一个像素组中感应线与子像素的比例为1:3。传统设计方案6个子像素需要6条数据线，直接造成使用Source IC数量的增加，使制作成本大幅增加，本案节省了数据线的数量，采用本案的方案，只需要3条数据线即可满足，直接使Source IC数量减少一半。本实施例中采用双栅设计是为了在有限布线空间内实现AMOLED电学和光学补偿功能，提高显示质量。需要说明的是，VDD线、Sense线排列走向可以在此基础上做各种变化，本案不一一列出。
本实施例还提供上述阵列基板的驱动方法，该方法包括：向连接同一数据线且不同扫描线的两子像素同时提供数据信号；向连接不同数据线相同扫描线的两子像素同时提供数据信号；向连接不同数据线且不同扫描线的子像素分时段提供数据信号。
本实施例以附图9的情况为例进行时说明。
具体的，本发明纯色显示方案如下：当显示蓝色灰阶时，如图10所示，第一时段：G11和G12打开，第一数据线31写入第一像素单元的第一子像素B1灰阶电压值。第二时段：G21和G22打开，第二数据线32写入第二像素单元的第一子像素B2灰阶电压值，其中，两个第一子像素B1、B2的灰阶电压值相同。红色、绿色的纯色方案与之类似，当显示红色灰阶时：第一时段：G11和G12打开，第一数据线31写入R1。第二时段：G21和G22打开，第三数据线33写入R2。当显示绿色灰阶时：第一时段：G21和G22打开，第一数据线31写入G1。第二时段：G11和G12打开，第三数据线33写入G2。
图11是两色混合画面显示时序，当R、B混色显示时：首先第一时段：G11和G12打开，第一数据线31写入第一像素单元的第一子像素B1灰阶电压值，同时，第二数据线32写入第一像素单元的第二子像素R1灰阶电压值。第二时段：G21和G22打开，第二数据线32写入第二像素单元的第一子像素B2灰阶电压值，同时第三数据线33写入第二像素单元的第二子像素R2灰阶电压值。R1、R2灰阶电压值相同，B1、B2灰阶电压值相同。当G、B混色显示时：第一时段：G11和G12打开，第一数据线31写入B1，同时，第三数据线33写入G2。第二时段：G21和G22打开，第一数据线31写入G1，同时，第二数据线32写入B2。当R、G混色显示时：第一时段：G11和G12打开，第二数据线32写入R1，同时，第三数据线33写入G2。第二时段：G21和G22打开，第一数据线31写入G1，同时，第三数据线33写入R2。
需要说明的是：本发明完整显示频率为X Hz，由于两个子像素共用数据线，为了避免灰阶电压值误写入，G11、G12、G21、G22工作频率需要小于2XHz，以确保正常显示。
图12是本发明提供感应晶体管T3特性时序，以蓝色子像素驱动为例，一个像素组要分两次感应实现。T1阶段是左侧第一像素单元获取阶段，T2阶段是右侧第二像素单元获取阶段。
实施例3：
本实施例提供一种显示面板，包括上述的阵列基板。
该显示面板可以是8K的AMOLED产品，也可以是其他分辨率产品。
实施例4：
本实施例提供了一种显示装置，其包括上述任意一种显示装置，包括上述的显示面板。所述显示装置可以为：电子纸、OLED面板、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (12)

1.一种阵列基板，其特征在于，包括多个阵列排布的像素单元，一行所述像素单元中的每相邻两个像素单元为一个像素组，该像素组中的两个像素单元分别为第一像素单元，第二像素单元；每个所述像素单元均包括三个不同颜色的子像素，分别为第一子像素、第二子像素、第三子像素；每个所述子像素均包括含有开关晶体管、驱动晶体管、感应晶体管、存储电容及发光器件的像素电路；
每一行所述像素单元中的各个所述子像素由四行扫描线控制，所述四行扫描线分别记作第一扫描线、第二扫描线、第三扫描线、第四扫描线；所述第一像素单元的第一子像素和第二子像素的开关晶体管的控制极，以及第二像素单元的第二子像素的开关晶体管的控制极均连接第一扫描线；所述第一像素单元的第一子像素和第二子像素的感应晶体管的控制极，以及第二像素单元的第二子像素的感应晶体管的控制极均连接第二扫描线；所述第一像素单元的第三子像素的开关晶体管的控制极，以及第二像素单元的第一子像素和第三子像素的开关晶体管的控制极均连接第三扫描线；所述第一像素单元的第三子像素的感应晶体管的控制极，以及第二像素单元的第一子像素和第三子像素的感应晶体管的控制极均连接第四扫描线；
其中，一个像素组中包括三条数据线，该像素组中每两个子像素共用其中一条数据线，并且连接该数据线的其中一个子像素与第一扫描线、第二扫描线连接，另一个子像素与第三扫描线、第四扫描线连接。
2.根据权利要求1所述的阵列基板，其特征在于，所述四行扫描线分别设于该行像素单元所在行的两侧，其中第一扫描线和第二扫描线位于该行像素单元的同侧，第三扫描线和第四扫描线位于该行像素单元的同侧。
3.根据权利要求1所述的阵列基板，其特征在于，所述一个像素组中的三条数据线分别为第一数据线，第二数据线，第三数据线；该像素组中的每个像素单元中包括两列，所述第一子像素位于一列，所述第二子像素、第三子像素位于同一列；其中，第一数据线设于第一像素单元的第一子像素所在列与第二子像素、第三子像素所在列之间；第二数据线设于该像素组中的两个像素单元之间；第三数据线设于第二像素单元的第一子像素所在列与第二子像素、第三子像素所在列之间。
4.根据权利要求3所述的阵列基板，其特征在于，所述第一像素单元的第一子像素和第三子像素的开关晶体管的第一极连接第一数据线；所述第一像素单元的第二子像素和第二像素单元的第一子像素的开关晶体管的第一极连接第二数据线；所述第二像素单元的第二子像素和第三子像素的开关晶体管的第一极连接第三数据线。
5.根据权利要求1所述的阵列基板，其特征在于，所述第一像素单元背离第二像素单元的一侧设有第一电源线，所述第一像素单元的三个子像素的驱动晶体管的第一极连接至第一电源线；所述第二像素单元背离第一像素单元的一侧设有第二电源线，所述第二像素单元的三个子像素的驱动晶体管的第一极连接至第二电源线。
6.根据权利要求1所述的阵列基板，其特征在于，所述第一像素单元与所述第二像素单元之间设有第一感应线，所述第一像素单元的三个子像素的感应晶体管的第一级连接至所述第一感应线；所述第二像素单元背离第一像素单元的一侧设有第二感应线，所述第二像素单元的三个子像素的感应晶体管的第一级连接至所述第二感应线。
7.根据权利要求1所述的阵列基板，其特征在于，每个所述像素单元中开关晶体管的第二极连接驱动晶体管的控制极，以及存储电容的第一极；每个所述像素单元中驱动晶体管的第二极连接发光器件的第一极，存储电容的第二极以及感应晶体管的第二极；每个所述像素单元中所述发光器件的第二极连接第二电源端。
8.根据权利要求1所述的阵列基板，其特征在于，每个所述像素单元中的第一子像素、第二子像素、第三子像素分别为：蓝色子像素、绿色子像素、红色子像素。
9.根据权利要求1所述的阵列基板，其特征在于，所述发光器件包括有机电致发光器件。
10.一种显示面板，其特征在于，包括权利要求1-9中任一项所述的阵列基板。
11.一种显示装置，其特征在于，包括权利要求10所述的显示面板。
12.一种权利要求1-9中任一项所述的阵列基板的驱动方法，其特征在于，包括：
向连接同一数据线且不同扫描线的两子像素同时提供数据信号；向连接不同数据线相同扫描线的两子像素同时提供数据信号；向连接不同数据线且不同扫描线的子像素分时段提供数据信号。
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