CN108665850A - 驱动基板和显示面板 - Google Patents

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CN108665850A CN201810451384.7A CN201810451384A CN108665850A CN 108665850 A CN108665850 A CN 108665850A CN 201810451384 A CN201810451384 A CN 201810451384A CN 108665850 A CN108665850 A CN 108665850A
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Abstract

本申请提供一种驱动基板和显示面板,驱动基板包括基底、检测电路层、第一绝缘层和至少一条信号线。检测电路层设置于非显示区,并围绕显示区设置。第一绝缘层位于异形非显示区和异形显示区,并设置于基底和检测电路层之间。信号线用以驱动设置于异形显示区中的多个第一像素驱动单元。至少一条信号线设置于基底和第一绝缘层之间,至少一条信号线由异形非显示区向异形显示区延伸,以使检测电路层与至少一条信号线形成至少一个补偿电容。补偿电容可以增加信号线的负载,进而使得屏体的显示区域趋于一致。

Description

驱动基板和显示面板
技术领域
本发明涉及显示领域,特别是涉及一种驱动基板和显示面板。
背景技术
随着手机产业的不断发展,全面屏手机的屏体具有较大的屏占比、窄边框的优点,大大提高观者的视觉效果,受到人们广泛关注。
在全面屏的制作过程中,在屏体上通常由开槽等异形设计构成异形显示区。开槽处的像素数量少于正常显示区的像素的数量。因此异形显示区像素驱动信号的负载与正常显示区像素驱动信号的电容负载差异很大,从而造成像素扫描等驱动信号的延迟不同。由于屏体的像素扫描等驱动信号的延迟不同,从而造成屏体的异形显示区与正常显示区的亮度不同,影响正常使用。
发明内容
基于此,有必要针对现有手机异形显示区与正常显示区的亮度不同的问题,提供一种解决上述问题的驱动基板和显示面板。
一种驱动基板,包括:
基底,所述基底包括显示区和非显示区,所述非显示区围绕所述显示区设置,所述非显示区包括异形非显示区,所述显示区包括异形显示区,所述异形非显示区和所述异形显示区相邻设置;
检测电路层,设置于所述非显示区,并围绕所述显示区设置;
第一绝缘层,位于所述异形非显示区和所述异形显示区,并设置于所述基底和所述检测电路层之间;
至少一条信号线,用以驱动设置于所述异形显示区中的多个第一像素驱动单元,所述至少一条信号线设置于所述基底和所述第一绝缘层之间,所述至少一条信号线由所述异形非显示区向所述异形显示区延伸,以使所述检测电路层与所述至少一条信号线形成至少一个补偿电容。
在一个实施例中,还包括:
第一走线层,位于所述异形显示区和所述异形非显示区,设置于所述第一绝缘层远离所述基底的表面,在所述异形非显示区,所述检测电路层和所述第一走线层在所述基底的投影至少部分重合;
第二绝缘层,位于所述异形显示区和所述异形非显示区,并设置于所述第一走线层远离所述基底的表面,以及所述检测电路层和所述第一走线层之间。
在一个实施例中,在所述异形非显示区,所述第一走线层与所述检测电路层在所述基底投影重合部分之间的垂直距离小于所述第一走线层与所述检测电路层在所述基底的投影不重合部分之间垂直距离。
在一个实施例中,还包括第二走线层,设置于所述异形显示区,所述第二走线层与所述检测电路层同层设置,并设置于所述第二绝缘层远离所述基底的表面。
在一个实施例中,所述第一像素驱动单元包括薄膜晶体管,所述薄膜晶体管设置于所述第一绝缘层和所述基底之间,所述薄膜晶体管包括栅极层,所述栅极层与所述信号线同层一体成型。
在一个实施例中,所述薄膜晶体管还包括有源层,所述有源层设置于所述基底和所述栅极层之间,所述有源层和所述栅极层之间设置有第三绝缘层。
在一个实施例中,还包括至少一个栅极驱动单元,设置于所述基底,并位于所述异形非显示区,在所述基底所在的平面,所述栅极驱动单元设置于所述检测电路层和所述异形显示区之间,一个所述栅极驱动单元通过一个所述信号线电连接所述像素驱动单元行。
在一个实施例中,还包括至少一个电容电极层,位于所述异形非显示区,在所述异形非显示区所在的平面,所述电容电极层设置于所述栅极驱动单元和所述异形显示区之间,所述电容电极层设置于所述第一绝缘层远离所述基底的一侧,所述电容电极层在所述基底的投影和所述信号线在所述基底的投影至少部分重合。
在一个实施例中,所述电容电极层与所述检测电路层同层设置。
一种显示面板,所述显示区还包括正常显示区,包括:
所述的驱动基板,包括多个第二像素驱动单元,设置于所述基底,位于所述
显示区;
多个第一像素单元,与所述多个第一像素驱动单元一一对应电连接;
多个第二像素单元,与所述多个第二像素驱动单元一一对应电连接。
本实施例提供的驱动基板中,所述第一绝缘层设置于所述基底和所述检测电路层之间。至少一条信号线设置于所述基底和所述第一绝缘层之间。所述信号线、所述第一绝缘层和所述检测电路层依次设置以使所述检测电路层与所述至少一条信号线形成至少一个补偿电容。所述电补偿电容可以增加所述信号线的电容负载。所述信号线的电容负载增加后可以使得异形显示区的每条所述信号线的电容负载和正常显示区的每条信号线的电容负载趋于相同,进而使得屏体表面亮度趋于一致。利用现有的检测电路层与信号线构成电容负载可以节省成本,提高生产效率。
附图说明
图1为本申请实施例提供的驱动基板示意图;
图2为本申请实施例提供的异形非显示区A-A截面图;
图3为本申请实施例提供的异形非显示区B-B截面图;
图4为本申请实施例提供的异形非显示区局部放大图。
附图标记说明:
驱动基板10
显示区100
异形显示区110
正常显示区120
基底130
非显示区200
异形非显示区210
检测电路层310
信号线320
像素驱动单元行330
第一像素驱动单元331
第二像素驱动单元332
薄膜晶体管340
有源层341
栅极层342
第一走线层350
第二走线层360
第一绝缘层410
第二绝缘层420
第三绝缘层430
栅极驱动单元500
电容电极层510
具体实施方式
请参见图1-3,本申请实施例提供一种驱动基板10。所述驱动基板10包括基底130、检测电路层310和至少一条信号线320。所述基底130包括显示区100和非显示区200。所述非显示区200围绕所述显示区100设置。所述非显示区200包括异形非显示区210。所述显示区100包括异形显示区110。所述异形非显示区210和所述异形显示区110相邻设置。
所述第一绝缘层410位于所述异形非显示区210和所述异形显示区110。所述第一绝缘层410设置于所述基底130和所述检测电路层310之间。所述检测电路层310设置于所述非显示区200。所述检测电路层310围绕所述显示区100设置。所述信号线320设置于所述基底130和所述第一绝缘层410之间。即所述第一绝缘层410设置于所述信号线320和所述检测电路层310之间。所述至少一条信号线320由所述异形非显示区210向所述异形显示区110延伸。以使所述检测电路层310与所述至少一条信号线320形成至少一个补偿电容。即在所述异形非显示区210,所述信号线320背离所述基底130的表面和所述检测电路层310朝向所述基底130的表面相对设置构成所述补偿电容。
所述信号线320用以驱动设置于所述异形显示区110中的多个第一像素驱动单元331。所述异形显示区10还包括至少一个像素驱动单元行330。所述像素驱动单元行330包括多个第一像素驱动单元331。所述像素驱动单元行330设置于所述基底130,并位于所述异形显示区110。一条所述信号线320与一个所述像素驱动单元行330中的多个第一像素驱动单元331电连接。
所述信号线320具有一定的宽度,即所述信号线320在所述基底130的投影具有一定面积。所述信号线320背离所述基底130的表面即所述信号线320朝向所述检测电路层310的表面。所述检测电路层310朝向所述基底130的表面与所述信号线320背离所述基底130的表面相对构成所述补偿电容。
所述驱动基板10可以用于OLED显示屏。所述异形非显示区210和所述异形显示区110可以设有开槽或者圆弧等形状。由于所述开槽或者圆弧结构,使得驱动基板10中的所述第一像素驱动单元331的数量与正常显示区120的第二像素驱动单元332的数量不同。在驱动基板10上通常会设置有多条信号线320。每条信号线320驱动多个像素驱动单元。在正常显示区120,通常每条所述信号线320驱动的像素驱动单元的数量相同。由于异形显示区110与正常显示区120的像素驱动单元的数量不同,因此在异形显示区110,每条信号线320驱动的所述第一像素驱动单元331的个数与正常显示区120中每条所述信号线320驱动的第二像素驱动单元332的数量不同。并且通常在异形显示区110中每条信号线320驱动的所述第一像素驱动单元331的数量会少于所述正常显示区120中每条信号线320驱动的像素驱动单元的个数。因此所述异形显示区110中的每条信号线320的电容负载会小于所述正常显示区120中的每条信号线320的电容负载。可以理解,所述信号线320可以为扫描线或者数据线。
所述异形非显示区210可以设置有驱动电路及电源电路等。所述异形非显示区210可以围绕所述异形显示区110设置。所述异形非显示区210可以根据所述异形显示区110的形状设置。当所述异形显示区110与正常显示区120直接相邻时,所述异形非显示区210只包围所述异形显示区110没有与所述正常显示区120邻接的边缘。
所述第一像素驱动单元331的排布可以根据所述异形显示区110的形状确定。所述多个第一像素驱动单元331可以通过至少一条所述信号线320驱动。所述信号线320可以将所述多个第一像素驱动单元331串联构成所述像素驱动单元行330。所述信号线320可以为曲线或者折线结构。所述第一像素驱动单元331的排布形式可以根据依据所述异形显示区110的形状设置。所述检测电路层310可以通过沉积形成于所述基底130的表面。所述检测电路层310可以用于检测屏体的裂缝。可以理解,所述检测电路层310可以同过图形化工艺形成于所述基底130上表面的一层。所述检测电路层310具有一定的面积。
在一个实施例中,所述检测电路层310所在的平面和所述信号线320背离所述基底130的表面相对平行设置。所述检测电路层310朝向所述基底130的表面与所述信号线320背离所述基底130的表面相对设置构成电容结构,具有电容负载。在所述异形显示区110,由于每个所述扫描线连接的所述第一像素驱动单元331的数量不同,因此每个所述扫描线需要补偿的电容负载也不相同。通过改变所述信号线320背离所述基底130的表面面积和所述检测电路层310朝向所述基底130的表面面积,可以改变所述电容结构的大小。
请再参见图3,在一个实施例中,可以有多个平行设置的扫描线。所述扫描线与所述检测电路层310构成多个补偿电容。可以改变每个所述补偿电容负载,可以对不同的所述扫描线进行电容补偿。因此可以理解,所述信号线320可以为沉积在所述基底130表面的金属层通过图形化形成。所述第一绝缘层410可以通过图案化处理得到不同功能的结构。
本申请实施例中,所述第一绝缘层410设置于所述基底130和所述检测电路层310之间。至少一条信号线320设置于所述基底130和所述第一绝缘层410之间。所述信号线320、所述第一绝缘层410和所述检测电路层310依次设置以使所述检测电路层310与所述至少一条信号线320形成至少一个补偿电容。即所述信号线320背离所述基底130的表面和所述检测电路层310朝向所述基底130的表面相对设置,使得所述信号线320、所述第一绝缘层410和所述检测电路层310构成补偿电容。所述补偿电容可以增加所述信号线320的电容负载。所述信号线320的电容负载增加后可以使得异形显示区110的每条所述信号线320的电容负载和正常显示区120的每条信号线320的电容负载趋于相同,进而使得屏体表面亮度趋于一致。利用现有的检测电路层310与信号线320构成电容负载可以节省成本,提高生产效率。
请再参见图2,在一个实施例中,所述第一像素驱动单元331包括薄膜晶体管340。所述述薄膜晶体管340设置于所述第一绝缘层410和所述基底130之间。所述薄膜晶体管340设置于所述基底130的表面。所述薄膜晶体管340包括有源层341和栅极层342。所述有源层341设置于所述基底130和所述栅极层342之间。所述栅极层342可以与所述信号线320同层一体成型。所述栅极层342和所述信号线320可以是对沉积在所述基底130表面的同一个金属层进行图像化处理后形成的。所述栅极层342和所述信号线320可以为连续延伸的结构,进而可以提高生产效率。
在一个实施例中,所述信号线320为扫描线。所述栅极层342可以由金属材料制成。所述有源层341可以形成薄膜晶体管的源极、漏极和沟道。
在一个实施例中,所述驱动基板10还包括第一走线层350和第二绝缘层420。所述第一走线层350位于所述异形显示区110和所述异形非显示区210,并设置于所述第一绝缘层410远离所述基底130的表面。
所述第二绝缘层420位于所述异形显示区110和所述异形非显示区210。所述第二绝缘层420还设置于所述第一走线层350远离所述基底130的表面,以及所述检测电路层310和所述第一走线层350之间。在所述异形非显示区210,所述检测电路层310和所述第一走线层350在所述基底130的投影至少部分重合。因此所述检测电路层310和所述第一走线层350可以构成电容结构。即在所述异形非显示区210,所述第一走线层350背离所述基底130的表面与所述检测电路层310朝向所述基底130的表面相对设置构成所述电容结构。
所述第一走线层350背离所述基底130的表面与所述检测电路层310朝向所述基底130的表面相对设置可以使得所述第一走线层350、所述第二绝缘层420和所述检测电路层310依次构成电容结构。在一个实施例中,所述第一走线层350背离所述基底130的表面与所述检测电路层310朝向所述基底130的表面平行设置。
所述第一走线层350可以由金属材料制成。所述第一走线层350可以与所述栅极层342构成电容结构,以进一步提高所述扫描线的电容负载。
在一个实施例中,所述第一走线层350、所述检测电路层310和所述信号线320所在平面可以为三个间隔设置的平行平面。因此所述第一走线层350、所述检测电路层310和所述扫描线在所述基底130具有公共投影面积。因此所述第一走线层350和所述信号线320也可以具有相对面积。所述第一走线层350和所述信号线320可以构成电容结构,以进一步增加所述信号线320的电容负载。
在一个实施例中,在所述异形非显示区210,所述第一走线层350与所述检测电路层310在所述基底130投影重合部分之间的垂直距离小于所述第一走线层350与所述检测电路层310在所述基底130的投影不重合部分之间垂直距离。即位于所述第一走线层350与所述检测电路层310之间的所述第二绝缘层420的部分的厚度小于所述异形显示区110和所述异形非显示区(210)中的其它所述第二绝缘层420部分的厚度。在制作所述第二绝缘层420的过程中通过掩膜工艺使得所述第二绝缘层420的厚度更薄。所所述第一走线层350与所述检测电路层310在所述基底130投影重合部分之间的垂直距离小于所述第一走线层350与所述检测电路层310在所述基底130的投影不重合部分之间垂直距离可以进一步增加所述检测电路层310与所述第一走线层350构成的电容负载,并且工艺简单,能够提高工作效率。
在一个实施例中,所述驱动基板10还包括第二走线层360。所述第二走线层360设置于所述异形显示区110。所述第二走线层360与所述检测电路层310同层设置。所述第二绝缘层420设置于所述第二走线层360和所述第一走线层350之间。所述第二走线层360与所述检测电路层310绝缘设置。即所述第二走线层360与所述检测电路层310之间没有电性导通,避免所述检测电路层310被干扰。所述第二走线层360可以设置电源信号电路。所述第二绝缘层420设置于所述第二走线层360和所述第一走线层350之间可以避免所述第二走线层360和所述第一走线层350发生短路。
在一个实施例中,所述驱动基板10还包括第三绝缘层430。所述第三绝缘层430设置于所述有源层341和所述栅极层342之间。所述第三绝缘层430可以避免所述有源层341和所述栅极层342发生接触。
请参见图4,在一个实施例中,还包括至少一个栅极驱动单元500。所述栅极驱动单元500设置于所述基底130,并位于所述异形非显示区210。在所述基底130所在的平面,所述栅极驱动单元500设置于所述检测电路层310和所述异形显示区110之间。一个所述栅极驱动单元500通过一个所述信号线320电连接所述像素驱动单元行330。所述栅极驱动单元500可以向所述信号线320输出扫描信号。通过所述扫描信号可以驱动所述薄膜晶体管340开闭。所述栅极驱动单元500可以为多层结构。并且所述栅极驱动单元500的多层结构可以在所述第一像素驱动单元331形成的过程中与所述第一像素驱动单元331中的各个层结构一起形成,并通过图案化处理形成不同的功能结构。
请再参见图2,在一个实施例中,所述驱动基板10还包括至少一个电容电极层510。所述电容电极层510位于所述异形非显示区210。在所述异形非显示区210所在的平面,所述电容电极层510设置于所述栅极驱动单元500和所述异形显示区110之间。所述电容电极层510设置于所述第一绝缘层410远离所述基底130的一侧,所述电容电极层510在所述基底130的投影和所述信号线320在所述基底130的投影至少部分重合。所述电容电极层510在所述基底130的投影和所述信号线320在所述基底130的投影至少部分重合使得所述电容电极层510和所述基底130构成电容结构。
在一个实施例中,所述电容电极层510在所述基底130的投影覆盖所述信号线320的投影。因此所述电容电极层510朝向所述基底130的表面和所述信号线320背离所述基底130的表面相对设置构成电容结构。进而增加所述信号线320的电容负载。
在一个实施例中,所述电容电极层510可以与所述检测电路层310形成于同一层。所述电容电极层510可以通过绝缘绝缘材料与所述检测电路层310隔开,以避免影响所述检测电路层310的正常使用。所述电容电极层510可以与至少一条所述信号线320相对设置。根据每条信号线320需要增加的负载不同,所述电容电极层510与所述信号线320的相对面积可以不同,因而可以自由调节每条所述信号线320的负载,方便灵活。
本申请实施例还提供一种显示面板。所述显示面板包括所述的驱动基板10。所述驱动基板10包括多个第二像素驱动单元332。所述第二像素驱动单元332设置于所述基底130。所述第二像素驱动单元332位于所述显示区100。所述显示面板还包括多个第一像素单元和多个第二像素单元。所述第一像素驱动单元331与所述第一像素单元一一对应电连接。所述第二像素驱动单元332与所述第二像素单元一一对应电连接。所述第一像素驱动单元331的表面可以形成所述第一像素单元。所述第二像素驱动单元332的表面可以形成所述第二像素单元。通过调节所述第一像素驱动单元331的电容负载,可以使得所述异形显示区110的扫描线的电容负载和所述正常显示区120的扫描线的电容负载趋于相同。因此所述显示面板的异形显示区110和正常显示区120的光强趋于一致,可以提高观感。
以上所述实施例的各技术特征可以进行任意的组合,为使描述简洁,未对上述实施例中的各个技术特征所有可能的组合都进行描述,然而,只要这些技术特征的组合不存在矛盾,都应当认为是本说明书记载的范围。
以上所述实施例仅表达了本发明的几种实施方式,其描述较为具体和详细,但并不能因此而理解为对发明专利范围的限制。应当指出的是,对于本领域的普通技术人员来说,在不脱离本发明构思的前提下,还可以做出若干变形和改进,这些都属于本发明的保护范围。因此,本发明专利的保护范围应以所附权利要求为准。

Claims (10)

1.一种驱动基板,其特征在于,包括:
基底(130),所述基底(130)包括显示区(100)和非显示区(200),所述非显示区(200)围绕所述显示区(100)设置,所述非显示区(200)包括异形非显示区(210),所述显示区(100)包括异形显示区(110),所述异形非显示区(210)和所述异形显示区(110)相邻设置;
检测电路层(310),设置于所述非显示区(200),并围绕所述显示区(100)设置;
第一绝缘层(410),位于所述异形非显示区(210)和所述异形显示区(110),并设置于所述基底(130)和所述检测电路层(310)之间;
至少一条信号线(320),用以驱动设置于所述异形显示区(110)中的多个第一像素驱动单元(331),所述至少一条信号线(320)设置于所述基底(130)和所述第一绝缘层(410)之间,所述至少一条信号线(320)由所述异形非显示区(210)向所述异形显示区(110)延伸,以使所述检测电路层(310)与所述至少一条信号线(320)形成至少一个补偿电容。
2.如权利要求1所述的驱动基板,其特征在于,还包括:
第一走线层(350),位于所述异形显示区(110)和所述异形非显示区(210),设置于所述第一绝缘层(410)远离所述基底(130)的表面,在所述异形非显示区(210),所述检测电路层(310)和所述第一走线层(350)在所述基底(130)的投影至少部分重合;
第二绝缘层(420),位于所述异形显示区(110)和所述异形非显示区(210),并设置于所述第一走线层(350)远离所述基底(130)的表面,以及所述检测电路层(310)和所述第一走线层(350)之间。
3.如权利要求2所述的驱动基板,其特征在于,在所述异形非显示区(210),所述第一走线层(350)与所述检测电路层(310)在所述基底(130)投影重合部分之间的垂直距离小于所述第一走线层(350)与所述检测电路层(310)在所述基底(130)的投影不重合部分之间垂直距离。
4.如权利要求2所述的驱动基板,其特征在于,还包括第二走线层(360),设置于所述异形显示区(110),所述第二走线层(360)与所述检测电路层(310)同层设置,并设置于所述第二绝缘层(420)远离所述基底(130)的表面。
5.如权利要求1所述的驱动基板,其特征在于,所述第一像素驱动单元(331)包括薄膜晶体管(340),所述薄膜晶体管(340)设置于所述第一绝缘层(410)和所述基底(130)之间,所述薄膜晶体管(340)包括栅极层(342),所述栅极层(342)与所述信号线(320)同层一体成型。
6.如权利要求5所述的驱动基板,其特征在于,所述薄膜晶体管(340)还包括有源层(341),所述有源层(341)设置于所述基底(130)和所述栅极层(342)之间,所述有源层(341)和所述栅极层(342)之间设置有第三绝缘层(430)。
7.如权利要求1所述的驱动基板,其特征在于,还包括至少一个栅极驱动单元(500),设置于所述基底(130),并位于所述异形非显示区(210),在所述基底(130)所在的平面,所述栅极驱动单元(500)设置于所述检测电路层(310)和所述异形显示区(110)之间,一个所述栅极驱动单元(500)通过一个所述信号线(320)电连接所述像素驱动单元行(330)。
8.如权利要求7所述的驱动基板,其特征在于,还包括至少一个电容电极层(510),位于所述异形非显示区(210),在所述异形非显示区(210)所在的平面,所述电容电极层(510)设置于所述栅极驱动单元(500)和所述异形显示区(110)之间,所述电容电极层(510)设置于所述第一绝缘层(410)远离所述基底(130)的一侧,所述电容电极层(510)在所述基底(130)的投影和所述信号线(320)在所述基底(130)的投影至少部分重合。
9.如权利要求8所述的驱动基板,其特征在于,所述电容电极层(510)与所述检测电路层(310)同层设置。
10.一种显示面板,其特征在于,所述显示区(100)还包括正常显示区(120),包括:
权利要求1-9所述的驱动基板,包括多个第二像素驱动单元(332),设置于所述基底(130),位于所述显示区(100);
多个第一像素单元,与所述多个第一像素驱动单元(331)一一对应电连接;
多个第二像素单元,与所述多个第二像素驱动单元(332)一一对应电连接。
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