CN108572886B - 操作***恢复电路 - Google Patents

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Abstract

一种操作***恢复电路，包括一存储所述操作***的存储装置、一平台控制器芯片以执行所述操作***、一第二只读存储器用以根据所述操作***的状态控制所述平台控制器芯片输出对应的开关控制信号及一开关芯片，用于接收所述平台控制器芯片所输出的开关控制信号，并根据所接收的开关控制信号以决定所述第一只读存储器与所述平台控制器芯片之间是否接通。当所述存储装置中的操作***处于异常状态时，所述平台控制器芯片从所述第一只读存储器中恢复所述操作***。如此，可以在操作***被损坏时及时地对操作***进行恢复，方便使用。

Description

操作***恢复电路
技术领域
本发明涉及一种操作***恢复电路。
背景技术
电脑在运行过程中突然断电会导致操作***被损坏，此时需要***硬盘以恢复***。然而，很多用户并不能很快地找到***硬盘以恢复操作***，如此将会造成不便。
发明内容
鉴于上述内容，有必要提供一种能够快速恢复计算机***的操作***恢复电路。
一种操作***恢复电路，包括：
一存储装置，用于存储所述操作***；
一第一只读存储器，用于存储一备份的操作***；
一平台控制器芯片，用以执行所述操作***；
一第二只读存储器，用以根据所述操作***的状态控制所述平台控制器芯片输出对应的开关控制信号；及
一开关芯片，连接于所述第一只读存储器及所述平台控制器芯片之间，用于接收所述平台控制器芯片所输出的开关控制信号，并根据所接收的开关控制信号以决定所述第一只读存储器与所述平台控制器芯片之间是否接通；
当所述存储装置中的操作***处于异常状态时，所述第二只读存储器控制所述平台控制器芯片输出具有第一状态的开关控制信号至所述开关芯片，所述开关芯片接收所述第一状态的开关控制信号后使得所述第一只读存储器与所述平台控制器芯片接通，所述平台控制器芯片从所述第一只读存储器中恢复所述操作***。
上述操作***恢复电路通过所述第二只读存储器控制所述平台控制器芯片输出开关控制信号至所述开关芯片，以控制所述第一只读存储器与所述平台控制器芯片之间的连通，进而从所述第一只读存储器中恢复所述操作***。如此，可以在操作***被损坏时及时地对操作***进行恢复，方便使用。
附图说明
图1为操作***恢复电路的一较佳实施方式的方框图。
图2为图1中操作***恢复电路的较佳实施方式的电路图。
主要元件符号说明
操作***恢复电路 100
PCH芯片 10
开关芯片 20
第一只读存储器 30
第二只读存储器 40
连接器 50
存储装置 60
电容 C1-C7
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。
为了使本发明的目的、技术方案及优点更加清楚明白，以下将结合附图及实施方式，对本发明中的操作***恢复电路作进一步详细描述及相关说明。
如图1所示，一操作***恢复电路100应用于一电脑***中，所述操作***恢复电路包括一平台控制器(platform controller hub，PCH)芯片10、一开关芯片20、一第一只读存储器30、一第二只读存储器40、一连接器50及一存储装置60。
所述开关芯片20、所述第二只读存储器40及所述连接器50均与所述PCH芯片10连接，所述第一只读存储器30通过所述开关芯片20连接至所述PCH芯片10。
在一实施方式中，所述连接器50为一串行高级技术附件(serial advancedtechnology attachment，SATA)连接器。
所述存储装置60用于存储操作***，所述PCH芯片10通过所述连接器50以执行所述存储装置60中的操作***。在一实施方式中，所述存储装置60为一硬盘。
所述第二只读存储器40用于根据所述操作***的工作状态以控制所述PCH芯片10输出对应的开关控制信号。
所述第一只读存储器30用于存储一备份的操作***。所述开关芯片20用于接收所述PCH芯片10所输出的开关控制信号，并根据所接收的开关控制信号以控制所述第一只读存储器30与所述PCH芯片10之间的连通状态。
当所述存储装置60中的操作***被损坏时，所述第二只读存储器40将控制所述PCH芯片10输出一具有第一状态的开关控制信号至所述开关芯片20，所述开关芯片20接收所述第一状态的开关控制信号后处于导通状态，并使得所述第一只读存储器30与所述PCH芯片10之间实现连接。所述PCH芯片10从所述第一只读存储器30中恢复所述操作***。
当操作***恢复完成后，所述第二只读存储器40将会控制所述PCH芯片10输出一具有第二状态的开关控制信号至所述开关芯片20，以断开所述第一只读存储器30与所述PCH芯片10之间的连接。
如图2所示，所述第二只读存储器40的第一信号输出引脚SPI_CLK、第二输出接收引脚SPI_IO及第三信号输出引脚SPI_CS分别与所述PCH芯片10的第一信号接收引脚SPI_CLK、第二信号接收引脚SPI_IO及第三信号接收引脚SPI_CS对应连接，所述第二只读存储器40的电源引脚VCC连接至一电源+3P3V，所述第二只读存储器40的电源引脚VCC还通过一电容C1接地。
所述连接器50的第一接地引脚至第三接地引脚GND1-GND3均接地，所述连接器50的第一数据引脚A+通过电容C4连接至所述PCH芯片10的第一数据引脚PCH_TX_P，所述连接器50的第二数据引脚A-通过电容C5连接至所述PCH芯片10的第二数据引脚PCH_TX_N，所述连接器50的第三数据引脚B+通过电容C6连接至所述PCH芯片10的第四数据引脚PCH_RX_N，及所述连接器50的第四数据引脚B-通过电容C7连接至所述PCH芯片10的第三数据引脚PCH_RX_P，所述连接器50通过一SATA线缆连接至所述存储装置60。
所述开关芯片20的第一数据引脚B_TX_P、第二数据引脚B_TX_N、第三数据引脚B_RX_P及第四数据引脚B_RX_N分别与所述PCH芯片10的第一数据引脚PCH_TX_P、第二数据引脚PCH_TX_N、第三数据引脚PCH_RX_P及第四数据引脚PCH_RX_N对应连接，所述开关芯片20的第五数据引脚A_TX_P、第六数据引脚A_TX_N、第七数据引脚A_RX_P及第八数据引脚A_RX_N分别与所述第一只读存储器30的第一数据引脚TX_P、第二数据引脚TX_N、第三数据引脚RX_P及第四数据引脚RX_N对应连接，所述开关芯片20的信号接收引脚CTL与所述PCH芯片10的通用输入输出引脚GPIO连接以接收所述PCH芯片10输出的开关控制信号，所述开关芯片20的电源引脚VCC连接至所述电源+3P3V，所述开关芯片20的电源引脚VCC还通过一电容C2接地。
所述第一只读存储器30的电源引脚VCC连接至所述电源+3P3V，所述第一只读存储器30的电源引脚VCC还通过一电容C3接地。
下面将介绍操作***恢复电路100的工作原理：
首先，当存储装置60中的操作***正常运行，所述第二只读存储器40控制所述PCH芯片10的通用输入输出引脚GPIO输出低电平的开关控制信号至所述开关芯片20的信号接收引脚CTL，所述开关芯片20接收所述低电平的开关控制信号后处于截止状态，并断开所述第一只读存储器30与所述PCH芯片10之间的连接。此时，电脑***执行所述操作***得以正常运作。
当所述存储装置60中的操作***被损坏时，所述第二只读存储器40控制所述PCH芯片10的通用输入输出引脚GPIO输出高电平的开关控制信号至所述开关芯片20的信号接收引脚CTL，所述开关芯片20接收所述高电平的开关控制信号后处于导通状态，并使得所述第一只读存储器30与所述PCH芯片10之间接通。此时，所述PCH芯片10将会从所述第二只读存储器40中获取备份的操作***并执行所备份操作***。如此，电脑***将恢复所述操作***以正常运作。
当操作***恢复完成后，所述第二只读存储器40将会控制所述PCH芯片10的通用输入输出引脚GPIO输出低电平的开关控制信号至所述开关芯片20的信号接收引脚CTL，所述开关芯片20接收所述低电平的开关控制信号后处于截止状态，所述第一只读存储器30断开与所述PCH芯片10之间的连接。此时，电脑***将继续正常运作。
上述操作***恢复电路100通过所述第二只读存储器40控制所述PCH芯片10输出开关控制信号至所述开关芯片20，以控制所述第一只读存储器30与所述PCH芯片10之间的连通，进而从所述第一只读存储器30中恢复所述操作***。如此，可以在操作***被损坏时及时地对操作***进行恢复，方便使用。
最后应说明的是，以上实施例仅用以说明本发明的技术方案而非限制，尽管参照较佳实施例对本发明进行了详细说明。本领域的普通技术人员应当理解，可以对本发明的技术方案进行修改或等同替换，而不脱离本发明技术方案的精神和范围。并且，基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都将属于本发明保护的范围。

Claims (6)

1.一种操作***恢复电路，其特征在于：所述操作***恢复电路包括：
一存储装置，用于存储所述操作***；
一第一只读存储器，用于存储一备份的操作***；
一连接器；
一平台控制器芯片，所述平台控制器芯片通过所述连接器连接至所述存储装置以执行所述操作***；
一第二只读存储器，用以根据所述操作***的状态控制所述平台控制器芯片输出对应的开关控制信号；
其中，所述第二只读存储器的第一信号输出引脚、第二输出接收引脚及第三信号输出引脚分别与所述平台控制器芯片的第一信号接收引脚、第二信号接收引脚及第三信号接收引脚对应连接，所述第二只读存储器的电源引脚连接至一电源，所述第二只读存储器的电源引脚还通过一第一电容接地，所述连接器的第一接地引脚至第三接地引脚均接地，所述连接器的第一数据引脚通过电容第二电容连接至所述平台控制器芯片的第一数据引脚，所述连接器的第二数据引脚通过第三电容连接至所述平台控制器芯片的第二数据引脚，所述连接器的第三数据引脚通过第四电容连接至所述平台控制器芯片的第四数据引脚，所述连接器的第四数据引脚通过第五电容连接至所述平台控制器芯片的第三数据引脚；及
一开关芯片，连接于所述第一只读存储器及所述平台控制器芯片之间，用于接收所述平台控制器芯片所输出的开关控制信号，并根据所接收的开关控制信号以决定所述第一只读存储器与所述平台控制器芯片之间是否接通；
当所述存储装置中的操作***处于异常状态时，所述第二只读存储器控制所述平台控制器芯片输出具有第一状态的开关控制信号至所述开关芯片，所述开关芯片接收所述第一状态的开关控制信号后使得所述第一只读存储器与所述平台控制器芯片接通，所述平台控制器芯片从所述第一只读存储器中恢复所述操作***。
2.如权利要求1所述的操作***恢复电路，其特征在于：当所述存储装置中的操作***处于正常状态时，所述第二只读存储器控制所述平台控制器芯片输出具有第二状态的开关控制信号至所述开关芯片，所述开关芯片接收所述第二状态的开关控制信号后使得所述第一只读存储器与所述平台控制器芯片断开。
3.如权利要求1所述的操作***恢复电路，其特征在于：所述连接器为一串行高级技术附件连接器。
4.如权利要求1所述的操作***恢复电路，其特征在于：所述开关芯片的第一数据引脚、第二数据引脚、第三数据引脚及第四数据引脚分别与所述平台控制器芯片的第一数据引脚、第二数据引脚、第三数据引脚及第四数据引脚对应连接，所述开关芯片的第五数据引脚、第六数据引脚、第七数据引脚及第八数据引脚分别与所述第一只读存储器的第一数据引脚、第二数据引脚、第三数据引脚及第四数据引脚对应连接，所述开关芯片的信号接收引脚与所述平台控制器芯片的通用输入输出引脚连接以接收所述平台控制器芯片输出的开关控制信号，所述开关芯片的电源引脚连接至所述电源，所述开关芯片的电源引脚还通过一第六电容接地。
5.如权利要求4所述的操作***恢复电路，其特征在于：所述第一只读存储器的电源引脚连接至所述电源，所述第一只读存储器的电源引脚还通过一第七电容接地。
6.如权利要求1所述的操作***恢复电路，其特征在于：所述存储装置为一硬盘。
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