CN108257545A - 显示装置及其驱动方法 - Google Patents
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Abstract
一种驱动方法包含依序产生多个驱动信号，以及分别输出此些驱动信号至显示装置的多条栅极线。其中，各驱动信号具有多个时段的导通期间。各栅极线的驱动信号的导通期间和相邻的栅极线的驱动信号的导通期间不重叠，且各栅极线的驱动信号的多个时段中的最后一个时段的导通期间和后续相隔至少一条的栅极线的驱动信号的多个时段中之一的导通期间重叠。
Description
技术领域
本发明是关于驱动显示技术，特别是一种显示装置及其驱动方法。
背景技术
显示装置因具有低功率消耗、薄型量轻、色彩饱和度高、寿命长等优点而成为现代显示科技产品的主流之一。
在近年来显示装置的一般架构中，显示装置的栅极驱动电路是经由多条栅极线依序逐列驱动各显示单元，并且经由栅极线输出至每一横列的驱动信号的导通期间会和输出至下一横列的驱动信号的导通期间重叠，使得当前横列的显示单元在进行显示时，其下一横列的显示单元可预先进行充电(pre-charge)，以改善显示装置因充电时间过短所致的显色异常问题。此外，显示装置更藉由多工电路(Multiplexer)的协助，使得源极驱动电路可经由同一输出管脚控制多个显示单元(例如，3个显示单元)的数据信号，以窄化显示装置的边框。
然而，在此种一般架构中，当显示装置中的任一显示单元因工艺缺陷无法发光而形成暗点且此显示单元所耦接的数据线亦为浮接(floating)时，位于此显示单元的下一横列且和其耦接于同一条数据线的显示单元便会受其影响而亦形成暗点。并且，此种上下成对出现的暗点会导致显示装置的品质评比被降阶，甚至致使此显示装置无法出货，并且降低显示装置的生产良率。
发明内容
在一实施例中，一种适用于显示装置的驱动方法包含依序产生多个驱动信号，以及分别输出驱动信号至显示装置的多条栅极线。其中，各驱动信号具有多个时段的导通期间。各栅极线的驱动信号的导通期间与相邻的栅极线的驱动信号的导通期间不重叠，且各栅极线的驱动信号的多个时段中的最后一个时段的导通期间和后续相隔至少一条的栅极线的驱动信号的多个时段中之一的导通期间重叠。
在一实施例中，一种显示装置包含多条栅极线以与门栅极驱动电路。多条栅极线沿第一方向依序排列。栅极驱动电路依序产生多个驱动信号，并且分别输出此些驱动信号至多条栅极线。其中，各驱动信号具有多个时段的导通期间。各栅极线的驱动信号的导通期间与相邻的栅极线的驱动信号的导通期间不重叠，且各栅极线的驱动信号的多个时段中的最后一个时段的导通期间和后续相隔至少一条的栅极线的驱动信号的多个时段中之一的导通期间重叠。
综上所述，本发明实施例的显示装置及其驱动方法，其藉由输出至各栅极线的驱动信号的导通期间可和后续相隔至少一条栅极线的驱动信号的导通期间有部分重叠，以增加各显示单元的充电时间，并且藉由输出至各栅极线的驱动信号的导通期间和相邻的栅极线的驱动信号的导通期间不重叠，而可有效避免上下成对的暗点的产生，进而得以维持显示装置的品质水平并大幅提升显示装置的生产良率。
以下结合附图和具体实施例对本发明进行详细描述，但不作为对本发明的限定。
附图说明
图1为显示装置的一实施例的概要示意图。
图2为显示装置的另一实施例的概要示意图。
图3为驱动方法的一实施例的流程示意图。
图4为多个驱动信号的第一实施例的波形图。
图5为多个驱动信号的第二实施例的波形图。
图6为产生图4多个驱动信号的栅极驱动电路的一实施例的概要示意图。
图7为图6中多个时钟脉冲信号与多个驱动信号的一实施例的波形图。
图8为产生图5多个驱动信号的栅极驱动电路的一实施例的概要示意图。
图9为图8中多个时钟脉冲信号与多个驱动信号的一实施例的波形图。
其中，附图标记：
100 显示装置 110 驱动装置
111 栅极驱动电路 111a-111i 驱动单元
112 源极驱动电路 A1 图像显示区
AND1 与门 Buf1 缓冲器
CK_L1 时钟脉冲信号 CK_L2 时钟脉冲信号
CK_R1 时钟脉冲信号 CK_R2 时钟脉冲信号
D1-Dx 数据信号 d(-4)-d(11) 数据
G1-Gy 驱动信号 L11-L1y 栅极线
L21-L2x 数据线 OE_E 偶数控制信号
OE_O 奇数控制信号 R1 移位寄存器
SR1-SR5 移位信号 t1-t3 时段
td 时间间隔 ts1 时间间隔
ts2 时间间隔 U11-Uxy 显示单元
V1 第一方向 V2 第二方向
XCK_L1 时钟脉冲信号 XCK_L2 时钟脉冲信号
XCK_R1 时钟脉冲信号 XCK_R2 时钟脉冲信号
S10～S40 步骤 113 多工电路
1131-113z 多工模块
具体实施方式
下面结合附图对本发明的结构原理和工作原理作具体的描述：
图1为显示装置的一实施例的概要示意图。请参阅图1，显示装置100包含多条栅极线L11-L1y与栅极驱动电路111。此外，显示装置100更包含多条数据线L21-L2x、多个显示单元U11-Uxy以及源极驱动电路112。其中，x、y为大于1的正整数。
多条栅极线L11-L1y彼此相互平行，且沿第一方向V1依序排列。多条数据线L21-L2x彼此相互平行，且沿正交于第一方向V1的第二方向V2依序排列。多个显示单元U11-Uxy以阵列型式排列，且各显示单元U11-Uxy耦接于多条栅极线L11-L1y中之一以及多条数据线L21-L2x中之一。栅极驱动电路111耦接于多条栅极线L11-L1y，且源极驱动电路112耦接于多条数据线L21-L2x。
图2为显示装置的另一实施例的概要示意图。请参阅图2，在一实施例中，显示装置100可更包含多工电路113，且多工电路113耦接于源极驱动电路112与多条数据线L21-L2x之间。于此，多工电路113可用以减缩源极驱动电路112的输出管脚的所需数量。在一些实施例中，多工电路113可包含多个多工模块1131-113z，其中z为大于1的正整数。此些多工模块1131-113z耦接于源极驱动电路112，且分别耦接于多条数据线L21-L2x，例如三条。举例而言，多工模块1131可耦接于数据线L21-L23，且多工模块1132可耦接于数据线L24-L26，并以此类推至多工模块113z，但本发明并非以此为限。
在一实施例中，栅极驱动电路111、源极驱动电路112与多工电路113可组合成一个驱动装置110，例如，通过集成电路工艺技术整合于驱动芯片中，但本发明并非仅限于此。在另一实施例中，栅极驱动电路111可通过GOA(Gate On Array)直接制作于显示装置100的基板上，而源极驱动电路112与多工电路113则可通过集成电路工艺技术另制而成。
图3为驱动方法的一实施例的流程示意图，图4为多个驱动信号的第一实施例的波形图，且图5为多个驱动信号的第二实施例的波形图。请参阅图1至图5，显示装置100可根据本发明任一实施例的驱动方法驱动多个显示单元U11-Uxy进行每一帧(frame)的画面显示。
在驱动方法的一实施例中，显示装置100可致使栅极驱动电路111于作动时序上依序产生多个驱动信号G1-Gy(步骤S10)。于此，在各驱动信号G1-Gy的每一个扫描周期内可具有多个时段的导通期间。并且，各驱动信号G1-Gy的导通期间的多个时段于时间上具有先后顺序。其中，在各驱动信号G1-Gy的导通期间的多个时段中，于时间上最先出现的时段可称为第一个时段。接续于第一个时段之后出现的时段可称为第二个时段。以此类推，最后一个出现的时段可称为最后一个时段。
显示装置100于致使栅极驱动电路111产生各驱动信号G1-Gy时，栅极驱动电路111可于每一驱动信号G1-Gy的产生后即根据此驱动信号G1-Gy与各栅极线L11-L1y之间的配置关系将此驱动信号G1-Gy输出至对应的栅极线L11-L1y上，以使各栅极线L11-L1y所接收到的驱动信号的导通期间与相邻的栅极线所接收到的驱动信号的导通期间于时间上互不重叠，且各栅极线L11-L1y所接收到的驱动信号G1-Gy的多个时段中的最后一个时段的导通期间可和后续与其相隔至少一条栅极线的另一条栅极线所接收到的驱动信号的多个时段中之一的导通期间重叠(步骤S20)。
于此，各栅极线L11-L1y所接收到的驱动信号的导通期间与相邻的栅极线所接收到的驱动信号的导通期间于时间上互不重叠是指，例如，第二条栅极线L12所接收到的驱动信号的导通期间不会与位于其上方的第一条栅极线L11所接收到的驱动信号的导通期间重叠，且亦不会与位于其下方的第三条栅极线L13所接收到的驱动信号的导通期间重叠。同样地，第四条栅极线L14所接收的驱动信号的导通期间不会与位于其上方的第三条栅极线L13所接收到的驱动信号的导通期间重叠，且亦不会与位于其下方的第五条栅极线L15所接收到的驱动信号的导通期间重叠。依此类推，第y-1条栅极线L1(y-1)所接收的驱动信号的导通期间不会与第y-2条栅极线L1(y-2)所接收到的驱动信号的导通期间重叠，且亦不会与第y条栅极线L1y所接收到的驱动信号的导通期间重叠。
换言之，当耦接于第a条栅极线L1a的各显示单元U1a-Uxa于根据驱动信号进行充电动作时，耦接于第(a-1)条栅极线L1(a-1)的各显示单元U1(a-1)-Ux(a-1)以及耦接于第(a+1)条栅极线L1(a+1)的各显示单元U1(a+1)-Ux(a+1)并不会进行充电动作。其中，a为大于1且小于y的正整数。
此外，各栅极线L11-L1y所接收到的驱动信号G1-Gy的多个时段中的最后一个时段的导通期间可和后续与其相隔至少一条栅极线的另一条栅极线所接收到的驱动信号的多个时段中之一的导通期间重叠是指，例如以相隔一条栅极线为例来进行说明时，如图4所示，第一条栅极线L11的驱动信号G1的最后一个时段的导通期间是和位于其下方的第三条栅极线L13的驱动信号G2的第一个时段的导通期间重叠。而第二条栅极线L12的驱动信号G4的最后一个时段的导通期间是和位于其下方的第四条栅极线L14的驱动信号G6的第一个时段的导通期间重叠。
换言之，当耦接于第a条栅极线L1a的各显示单元U1a-Uxa于驱动信号的最后一个时段的导通期间进行充电动作时，耦接于第b条栅极线L1b的各显示单元U1b-Uxb可因其驱动信号的第一个时段的导通期间重叠于第a条栅极线L1a上的驱动信号的最后一个时段的导通期间而亦开始进行充电动作(此即预先充电(pre-charge))。其中a与b为1至y中任一正整数，b大于a，且a与b之间的差值大于1。
在驱动方法的一实施例中，显示装置100于致使栅极驱动电路111输出驱动信号G1-Gy时，更可致使源极驱动电路112在每一个驱动信号G1-Gy的各时段的导通期间中产生对应于此时段的导通期间的多个数据信号D1-Dx(步骤S30)，并且分别输出数据信号D1-Dx至数据线L21-L2x上(步骤S40)，以致使显示单元U11-Uxy可于对应的驱动信号G1-Gy的各时段的导通期间中经由对应的数据线L21-L2x载入相应的数据信号D1-Dx。
在驱动信号G1-Gy的第一实施例中，各驱动信号G1-Gy的导通期间的多个时段可于时间上相连，如图4所示。以下，以九条栅极线L11-L19分别接收对应的九个驱动信号G1-G9为例来进行说明。其中，各驱动信号G1-G9分别具有三个于时间上依序相连的时段t1-t3的导通期间。
栅极驱动电路111可依序产生驱动信号G1-G9，并且各驱动信号G1-G9的导通期间和后一个驱动信号的至少一个时段的导通期间重叠。例如，如图4所示，驱动信号G1可和驱动信号G2于时间上重叠了一个时段的导通期间(即，驱动信号G1的时段t3的导通时间重叠于驱动信号G2的时段t1的导通时间)。而驱动信号G3则可和驱动信号G4于时间上重叠了两个时段的导通期间(即，驱动信号G3的时段t2-t3的导通时间重叠于驱动信号G4的时段t1-t2的导通时间)。
在第一实施例中，栅极驱动电路111可使得各栅极线L11-L19上的驱动信号的导通期间和相邻的栅极线上的驱动信号的导通期间彼此交错而不重叠，并且使得各栅极线上L11-L19的驱动信号的最后一个时段t3的导通期间是和后续相隔至少一条栅极线的驱动信号的多个时段t1-t3中的任一个时段的导通期间重叠。
以下，是以相隔一条栅极线为例，但此相隔的数量并非用以限定本发明。举例而言，在一实施方式中，如图4所示，于此由上至下所示的驱动信号的顺序是依据对应的栅极线L11-L19的排列顺序进行排序，因此，从栅极驱动电路111的作动时序来看时，栅极驱动电路111可先于栅极线L11上产生并输出驱动信号G1，之后于栅极线L13上产生并输出驱动信号G2，接续再于栅极线L15上产生并输出驱动信号G3。之后，栅极驱动电路111接续于栅极线L12上产生并输出驱动信号G4，再接续于栅极线L17上产生并输出驱动信号G5，并且接续于栅极线L14上产生并输出驱动信号G6。之后，栅极驱动电路111接续于栅极线L19上产生并输出驱动信号G7，再接续于栅极线L16上产生并输出驱动信号G8，并且接续于栅极线L18上产生并输出驱动信号G9。
接续，以栅极驱动电路111于时间上的作动时序来说明显示装置100的运作。首先，耦接于栅极线L11的各显示单元U11-Ux1可最先接收到驱动信号G1。并且，于驱动信号G1的第一个时段t1中，显示单元U11-Ux1可经由对应的数据线L21-L2x接收对应的数据d(-1)，以开始进行预先充电。其中，数据d(-1)是指源极驱动电路112于此时(即驱动信号G1的第一个时段t1)经由多条数据线L21-L2x所输出的多个数据信号。于此，数据d(-1)是用以致使显示单元U11-Ux1预先充电至某一电位的预充数据，而并非为显示单元U11-Ux1于此帧中充电至真正的显示电位所需的最终数据。但须注意的是，此并非用以限定数据d(-1)不可和显示单元U11-Ux1于此帧中进行显示时的最终数据相同。
之后，于驱动信号G1的第二个时段t2中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(-4)。其中，数据d(-4)是指源极驱动电路112于此时(即驱动信号G1的第二个时段t2)经由多条数据线L21-L2x所输出的多个数据信号。因此，于驱动信号G1的第二个时段t2中，显示单元U11-Ux1可分别根据数据d(-4)中对应的数据信号接续进行预先充电。于此，数据d(-4)同样地是用以致使显示单元U11-Ux1预先充电至某一电位的预充数据，而非为显示单元U11-Ux1于此帧中充电至真正的显示电位所需的最终数据。须注意的是，此非用以限定数据d(-4)不可和显示单元U11-Ux1于此帧中所需的最终数据(如后方所述的数据d(1))相同。此外，在一些实施方式中，数据d(-4)可和数据d(-1)相同，但并非以此为限。
接续，在驱动信号G1的最后一个时段t3中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(1)。其中，数据d(1)是指源极驱动电路112于此时(即驱动信号G1的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(1)为显示单元U11-Ux1于此帧中充电至真正的显示电位所需的最终数据。因此，在驱动信号G1的最后一个时段t3中，显示单元U11-Ux1可根据数据d(1)中对应的数据信号充电至真正的显示电位。
于此，由于驱动信号G2的第一个时段t1的导通期间重叠于驱动信号G1的最后一个时段t3的导通期间，故当显示单元U11-Ux1于根据数据d(1)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L13的各显示单元U13-Ux3亦可经由对应的数据线L21-L2x接收到数据d(1)，并且根据数据d(1)中对应的数据信号进行预先充电。因此，数据d(1)除了为显示单元U11-Ux1于此帧中进行显示时的最终数据，亦是用以致使显示单元U13-Ux3预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G2的第一个时段t1的导通期间可和驱动信号G1的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G2的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G1的最后一个时段t3的导通期间。
之后，于驱动信号G2的第二个时段t2中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(-2)。其中，数据d(-2)是指源极驱动电路112于此时(即驱动信号G2的第二个时段t2)经由多条数据线L21-L2x所输出的多个数据信号。因此，于驱动信号G2的第二个时段t2中，显示单元U13-Ux3可分别根据数据d(-2)中对应的数据信号接续进行预先充电。于此，数据d(-2)同样地是用以致使显示单元U13-Ux3预先充电至某一电位的预充数据，而非为显示单元U13-Ux3于此帧中充电至真正的显示电位所需的最终数据(如后方所述的数据d(3))。须注意的是，此非用以限定数据d(-2)不可和显示单元U13-Ux3于此帧中所需的最终数据相同。此外，在一些实施方式中，数据d(-2)可和数据d(1)相同，但并非以此为限。
接续，在驱动信号G2的最后一个时段t3中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(3)。其中，数据d(3)是指源极驱动电路112于此时(即驱动信号G2的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(3)为显示单元U13-Ux3于此帧中充电至真正的显示电位所需的最终数据。因此，在驱动信号G2的最后一个时段t3中，显示单元U13-Ux3可根据数据d(3)中对应的数据信号进行显示。并且，由于驱动信号G3的第一个时段t1的导通期间重叠于驱动信号G2的最后一个时段t3的导通期间，故当显示单元U13-Ux3于根据数据d(3)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L15的各显示单元U15-Ux5亦可经由对应的数据线L21-L2x接收到数据d(3)，并且根据数据d(3)中对应的数据信号开始进行预先充电。因此，数据d(3)除了为显示单元U13-Ux3于此帧中所需的最终数据，亦是用以致使显示单元U15-Ux5预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G3的第一个时段t1的导通期间可和驱动信号G2的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G3的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G2的最后一个时段t3的导通期间。
之后，于驱动信号G3的第二个时段t2中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(0)。其中，数据d(0)是指源极驱动电路112于此时(即驱动信号G3的第二个时段t2)经由多条数据线L21-L2x所输出的多个数据信号。因此，于驱动信号G3的第二个时段t2中，显示单元U15-Ux5可分别根据数据d(0)中对应的数据信号接续进行预先充电。于此，数据d(0)同样地是用以致使显示单元U15-Ux5预先充电至某一电位的预充数据，而非为显示单元U15-Ux5于此帧中充电至真正的显示电位所需的最终数据。须注意的是，此非用以限定数据d(0)不可和显示单元U15-Ux5于此帧中所需的最终数据(如后方所述的数据d(5))相同。此外，在一些实施方式中，数据d(0)可和数据d(3)相同，但并非以此为限。
此外，由于驱动信号G4第一个时段t1的导通期间重叠于驱动信号G3的第二个时段t2的导通期间，故当显示单元U15-Ux5于根据数据d(0)中对应的数据信号预先充电时，耦接于栅极线L12的各显示单元U12-Ux2亦可经由对应的数据线L21-L2x接收到数据d(0)，并且根据数据d(0)中对应的数据信号开始进行预先充电。换言之，数据d(0)除了为用以致使显示单元U15-Ux5预先充电至某一电位的预充数据，亦是用以致使显示单元U12-Ux2预先充电至某一电位的预充数据。在一些实施方式中，驱动信号G4的第一个时段t1的导通期间可和驱动信号G3的第二个时段t2的导通期间完全重叠，但本发明并非以此为限，驱动信号G4的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G3的第二个时段t2的导通期间。
接续，在驱动信号G3的最后一个时段t3中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(5)。其中，数据d(5)是指源极驱动电路112于此时(即驱动信号G3的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(5)为显示单元U15-Ux5于此帧中充电至真正的显示电位所需的最终数据。因此，在驱动信号G3的最后一个时段t3中，显示单元U15-Ux5可根据数据d(5)中对应的数据信号充电至真正的显示电位。
此外，由于驱动信号G4的第二个时段t2的导通期间、驱动信号G5的第一个时段t1的导通期间重叠于驱动信号G3的最后一个时段t3的导通期间，故当显示单元U15-Ux5于根据数据d(5)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L12的各显示单元U12-Ux2亦可经由对应的数据线L21-L2x接收到数据d(5)并根据数据d(5)中对应的数据信号接续进行预先充电，且耦接于栅极线L17的各显示单元U17-Ux7亦可经由对应的数据线L21-L2x接收到数据d(5)并根据数据d(5)中对应的数据信号开始进行预先充电。换言之，数据d(5)除了为显示单元U15-Ux5于此帧中所需的最终数据，亦是用以致使显示单元U12-Ux2以及显示单元U17-Ux7预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G4的第二个时段t2的导通期间、驱动信号G5的第一个时段t1的导通期间可和驱动信号G3的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G4的第二个时段t2的导通期间、驱动信号G5的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G3的最后一个时段t3的导通期间。
接续，于驱动信号G4的最后一个时段t3的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(2)。其中，数据d(2)是指源极驱动电路112于此时(即驱动信号G4的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号。因此，于驱动信号G4的最后一个时段t3中，显示单元U12-Ux2可分别根据数据d(2)中对应的数据信号充电至真正的显示电位。
此外，由于驱动信号G5的第二个时段t2的导通期间、驱动信号G6的第一个时段t1的导通期间重叠于驱动信号G4的最后一个时段t3的导通期间，故当显示单元U12-Ux2于根据数据d(2)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L17的各显示单元U17-Ux7亦可经由对应的数据线L21-L2x接收到数据d(2)并根据数据d(2)中对应的数据信号接续进行预先充电，且耦接于栅极线L14的各显示单元U14-Ux4亦可经由对应的数据线L21-L2x接收到数据d(2)并根据数据d(2)中对应的数据信号开始进行预先充电。换言之，数据d(2)除了为显示单元U12-Ux2于此帧中所需的最终数据，亦是用以致使显示单元U17-Ux7以及显示单元U14-Ux4预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G5的第二个时段t2的导通期间、驱动信号G6的第一个时段t1的导通期间可和驱动信号G4的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G5的第二个时段t2的导通期间、驱动信号G6的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G4的最后一个时段t3的导通期间。
接续，于驱动信号G5的最后一个时段t3的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(7)。其中，数据d(7)是指源极驱动电路112于此时(即驱动信号G5的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(7)为显示单元U17-Ux7于此帧中充电至真正的显示电位所需的最终数据。因此，于驱动信号G5的最后一个时段t3中，显示单元U17-Ux7可分别根据数据d(7)中对应的数据信号充电至真正的显示电位。
此外，由于驱动信号G6的第二个时段t2的导通期间、驱动信号G7的第一个时段t1的导通期间重叠于驱动信号G5的最后一个时段t3的导通期间，故当显示单元U17-Ux7于根据数据d(7)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L14的各显示单元U14-Ux4亦可经由对应的数据线L21-L2x接收到数据d(7)并根据数据d(7)中对应的数据信号接续进行预先充电，且耦接于栅极线L19的各显示单元U19-Ux9亦可经由对应的数据线L21-L2x接收到数据d(7)并根据数据d(7)中对应的数据信号开始进行预先充电。换言之，数据d(7)除了为显示单元U17-Ux7于此帧中进所需的最终数据，亦是用以致使显示单元U14-Ux4以及显示单元U19-Ux9预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G6的第二个时段t2的导通期间、驱动信号G7的第一个时段t1的导通期间可和驱动信号G5的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G6的第二个时段t2的导通期间、驱动信号G7的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G5的最后一个时段t3的导通期间。
接续，于驱动信号G6的最后一个时段t3的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(4)。其中，数据d(4)是指源极驱动电路112于此时(即驱动信号G6的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(4)为显示单元U14-Ux4于此帧中充电至真正的显示电位所需的最终数据。因此，于驱动信号G6的最后一个时段t3中，显示单元U14-Ux4可分别根据数据d(4)中对应的数据信号充电至真正的显示电位。
此外，由于驱动信号G7的第二个时段t2的导通期间、驱动信号G8的第一个时段t1的导通期间重叠于驱动信号G6的最后一个时段t3的导通期间，故当显示单元U14-Ux4于根据数据d(4)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L19的各显示单元U19-Ux9亦可经由对应的数据线L21-L2x接收到数据d(4)并根据数据d(4)中对应的数据信号接续进行预先充电，且耦接于栅极线L16的各显示单元U16-Ux6亦可经由对应的数据线L21-L2x接收到数据d(4)并根据数据d(4)中对应的数据信号开始进行预先充电。换言之，数据d(4)除了为显示单元U14-Ux4于此帧中所需的最终数据，亦是用以致使显示单元U19-Ux9以及显示单元U16-Ux6预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G7的第二个时段t2的导通期间、驱动信号G8的第一个时段t1的导通期间可和驱动信号G6的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G7的第二个时段t2的导通期间、驱动信号G8的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G6的最后一个时段t3的导通期间。
接续，于驱动信号G7的最后一个时段t3的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(9)。其中，数据d(9)是指源极驱动电路112于此时(即驱动信号G7的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(9)为显示单元U19-Ux9于此帧中充电至真正的显示电位所需的最终数据。因此，于驱动信号G7的最后一个时段t3中，显示单元U19-Ux9可分别根据数据d(9)中对应的数据信号充电至真正的显示电位。
此外，由于驱动信号G8的第二个时段t2的导通期间重叠于驱动信号G7的最后一个时段t3的导通期间，故当显示单元U19-Ux9于根据数据d(9)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L16的各显示单元U16-Ux6亦可经由对应的数据线L21-L2x接收到数据d(9)并根据数据d(9)中对应的数据信号接续进行预先充电。换言之，数据d(9)除了为显示单元U19-Ux9于此帧中所需的最终数据，亦是用以致使显示单元U16-Ux6预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G8的第二个时段t2的导通期间可和驱动信号G7的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G8的第二个时段t2的导通期间亦可仅部分重叠于驱动信号G7的最后一个时段t3的导通期间。
接续，于驱动信号G8的最后一个时段t3的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(6)。其中，数据d(6)是指源极驱动电路112于此时(即驱动信号G8的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(6)为显示单元U16-Ux6于此帧中充电至真正的显示电位所需的最终数据。因此，于驱动信号G8的最后一个时段t3中，显示单元U16-Ux6可分别根据数据d(6)中对应的数据信号充电至真正的显示电位。
此外，由于驱动信号G9的第一个时段t1的导通期间重叠于驱动信号G8的最后一个时段t3的导通期间，故当显示单元U16-Ux6于根据数据d(6)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L18的各显示单元U18-Ux8亦可经由对应的数据线L21-L2x接收到数据d(6)并根据数据d(6)中对应的数据信号开始进行预先充电。换言之，数据d(6)除了为显示单元U16-Ux6于此帧中所需的最终数据，亦是用以致使显示单元U18-Ux8预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G9的第一个时段t1的导通期间可和驱动信号G8的最后一个时段t3的导通期间完全重叠，但本发明并非以此为限，驱动信号G9的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G8的最后一个时段t3的导通期间。
接续，于驱动信号G9的第二个时段t2的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(11)。其中，数据d(11)是指源极驱动电路112于此时(即驱动信号G9的第二个时段t2)经由多条数据线L21-L2x所输出的多个数据信号。因此，于驱动信号G9的第二个时段t2中，显示单元U18-Ux8可分别根据数据d(11)中对应的数据信号接续进行预先充电。
最后，于驱动信号G9的最后一个时段t3的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(8)。其中，数据d(8)是指源极驱动电路112于此时(即驱动信号G9的最后一个时段t3)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(8)为显示单元U18-Ux8于此帧中充电至真正的显示电位所需的最终数据。因此，于驱动信号G9的最后一个时段t3中，显示单元U18-Ux8可分别根据数据d(8)中对应的数据信号充电至真正的显示电位。
在一些实施例中，各时段t1、t2、t3的时间长度大于或等于显示装置100的线路时间(line time)。因此，各驱动信号G1-G9的导通期间的时间长度可至少大于或等于三个显示装置100的线路时间。但本发明并非仅限于此，在另一些实施例中，各时段t1、t2、t3的时间长度亦可小于显示装置100的线路时间。
在一些实施例中，各时段t1、t2、t3的时间长度可彼此相同。但本发明并非以此为限，在另一些实施例中，各时段t1、t2、t3的时间长度亦可相互不同。
在本实施例中，源极驱动电路112输出至数据线L21-L2x上的数据于时间上出现的次序如后顺序所示：数据d(-1)、数据d(-4)、数据d(1)、数据d(-2)、数据d(3)、数据d(0)、数据d(5)、数据d(2)、数据d(7)、数据d(4)、数据d(9)、数据d(6)、数据d(11)、数据d(8)。须注意的是，此数据的输出顺序并非用以限定本发明，其数据的输出顺序可配合各栅极线L11-L19上所接收到的驱动信号的导通期间进行调整。
图6为产生图4多个驱动信号的栅极驱动电路的一实施例的概要示意图，且图7为图6中多个时钟脉冲信号与多个驱动信号的一实施例的波形图。请参阅图1至图7，在一实施例中，栅极驱动电路111可包含多个驱动单元。以下，以九个驱动单元111a-111i为例来进行说明，但其数量并用以限定本发明。于此，奇数级的驱动单元111a、111c、111e、111g、111i可设置在显示装置100的图像显示区A1的左侧，且偶数级的驱动单元111b、111d、111f、111h相对地设置在图像显示区A1的右侧，以藉此形成双边驱动的架构，但本发明并非以此为限。
在一实施例中，栅极驱动电路111可根据多个时钟脉冲信号产生驱动信号G1-G8。于此，栅极驱动电路111可包含八个时钟脉冲信号XCK_L1、CK_L1、XCK_L2、CK_L2、XCK_R1、CK_R1、XCK_R2、CK_R2，且每一驱动单元111a-111h用以接收多个时钟脉冲信号XCK_L1、CK_L1、XCK_L2、CK_L2、XCK_R1、CK_R1、XCK_R2、CK_R2中之一，并根据对应的时钟脉冲信号产生驱动信号。
其中，时钟脉冲信号XCK_L1与时钟脉冲信号CK_L1在时序上彼此交错且互不重叠。时钟脉冲信号XCK_L2与时钟脉冲信号CK_L2在时序上彼此交错且互不重叠。时钟脉冲信号XCK_R1与时钟脉冲信号CK_R1在时序上彼此交错且互不重叠。并且，时钟脉冲信号XCK_R2与时钟脉冲信号CK_R2在时序上彼此交错且互不重叠。
在一实施例中，奇数级的驱动单元111a、111c、111e、111g、111i可由时钟脉冲信号XCK_L1、XCK_L2、CK_L1、CK_L2依序交替控制，且偶数级的驱动单元111b、111d、111f、111h则由时钟脉冲信号XCK_R1、XCK_R2、CK_R1、CK_R2依序交替控制。
举例而言，如图6所示，驱动单元111a可根据时钟脉冲信号XCK_L1产生驱动信号G1；驱动单元111b可根据时钟脉冲信号XCK_R1产生驱动信号G4；驱动单元111c可根据时钟脉冲信号XCK_L2产生驱动信号G2；驱动单元111d可根据时钟脉冲信号XCK_R2产生驱动信号G6；驱动单元111e可根据时钟脉冲信号CK_L1以及驱动信号G1产生驱动信号G3；驱动单元111f可根据时钟脉冲信号CK_R1以及驱动信号G4产生驱动信号G8；驱动单元111g可根据时钟脉冲信号CK_L2以及驱动信号G2产生驱动信号G5；驱动单元111h可根据时钟脉冲信号CK_R2以及驱动信号G6产生驱动信号G9；且驱动单元111i可根据时钟脉冲信号XCK_L1以及驱动信号G3产生驱动信号G7。
在驱动信号G1-Gy的第二实施例中，各驱动信号G1-Gy的导通期间的多个时段亦可于时间上不相连，如图5所示。以下，以五条栅极线L11-L15分别接收对应的五个驱动信号G1-G5为例来进行说明。于此，各驱动信号G1-G5分别具有于时间上依序相隔一时间间隔td的两个时段t1-t2的导通期间。
栅极驱动电路111可依序产生驱动信号G1-G5。于此，各驱动信号G1-G5的导通期间和后一个驱动信号的导通期间彼此交错而不重叠。并且，各驱动信号G1-G5的最后一个时段t2的导通期间可和后续相隔至少一个驱动信号的第一个时段t1的导通期间重叠。因此，栅极驱动电路111可将驱动信号G1-G5直接依序输出至栅极线L11-L15，以使得各栅极线L11-L15的驱动信号的导通期间和相邻的栅极线上的驱动信号的导通期间彼此交错而不重叠，并且使得各栅极线L11-L15上的驱动信号的最后一个时段t2的导通期间是和后续相隔至少一条栅极线的驱动信号的第一个时段t1的导通期间重叠。
以下，是以相隔一条栅极线为例，但此相隔的数量并非用以限定本发明。举例而言，如图5所示，于此由上至下所示的驱动信号的顺序是依据对应的栅极线L11-L15的顺序进行排序。栅极线L11的驱动信号G1的最后一个时段t2可与栅极线L13的驱动信号G3的第一个时段t1重叠。栅极线L12的驱动信号G2的最后一个时段t2可与栅极线L14的驱动信号G4的第一个时段t1重叠。并且，栅极线L13的驱动信号G3的最后一个时段t2可与栅极线L15的驱动信号G5的第一个时段t1重叠。
以下，以栅极驱动电路111于时间上的作动时序来说明显示装置100的运作。首先，耦接于栅极线L11的各显示单元U11-Ux1可最先接收到驱动信号G1。并且，于驱动信号G1的第一个时段t1中，显示单元U11-Ux1可经由对应的数据线L21-L2x接收对应的数据d(-1)，以进行预先充电。其中，数据d(-1)是指源极驱动电路112于此时(即驱动信号G1的第一个时段t1)经由多条数据线L21-L2x所输出的多个数据信号。并且，数据d(-1)是用以致使显示单元U11-Ux1预先充电至某一电位的预充数据，而非为显示单元U11-Ux1于此帧中充电至真正的显示电位所需的最终数据(如后方所述的数据d(1))。但须注意的是，此非用以限定数据d(-1)不可和显示单元U11-Ux1于此帧中所需的最终数据相同。
之后，耦接于栅极线L12的各显示单元U12-Ux2可接收到驱动信号G2。并且，于驱动信号G2的第一个时段t1中，显示单元U12-Ux2可经由对应的数据线L21-L2x接收对应的数据d(0)，以开始进行预先充电。其中，数据d(0)是指源极驱动电路112于此时(即驱动信号G2的第一个时段t1)经由多条数据线L21-L2x所输出的多个数据信号。并且，数据d(0)是用以致使显示单元U12-Ux2预先充电至某一电位的预充数据，而并非为显示单元U12-Ux2于此帧中所需的最终数据(如后方所述的数据d(2))。但须注意的是，此非用以限定数据d(0)不可和显示单元U12-Ux2于此帧中所需的最终数据相同。
接续，源极驱动电路112可于驱动信号G1的最后一个时段t2经由对应的数据线L21-L2x输出数据d(1)。其中，数据d(1)是指源极驱动电路112于此时(即驱动信号G1的最后一个时段t2)经由多条数据线L21-L2x所输出的多个数据信号，且数据d(1)为显示单元U11-Ux1于此帧中充电至真正的显示电位所需的最终数据。因此，在驱动信号G1的最后一个时段t2中，显示单元U11-Ux1可根据数据d(1)中对应的数据信号充电至真正的显示电位。
于此，由于驱动信号G3的第一个时段t1的导通期间重叠于驱动信号G1的最后一个时段t2的导通期间，故当显示单元U11-Ux1于根据数据d(1)充电至真正所需的显示电位时，耦接于栅极线L13的各显示单元U13-Ux3亦可根据数据d(1)进行预先充电。换言之，数据d(1)除了为显示单元U11-Ux1于此帧中所需的最终数据，亦是用以致使显示单元U13-Ux3预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G3的第一个时段t1的导通期间可和驱动信号G1的最后一个时段t2的导通期间完全重叠，但本发明并非以此为限，驱动信号G3的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G1的最后一个时段t2的导通期间。
接续，于驱动信号G2的最后一个时段t2的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(2)。其中，数据d(2)是指源极驱动电路112于此时(即驱动信号G2的最后一个时段t2)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(2)为显示单元U12-Ux2于此帧中充电至真正的显示电位所需的最终数据。因此，于驱动信号G2的最后一个时段t2的导通期间中，显示单元U12-Ux2可分别根据数据d(2)中对应的数据信号充电至真正的显示电位。
此外，由于驱动信号G4的第一个时段t1的导通期间重叠于驱动信号G2的最后一个时段t2的导通期间，故当显示单元U12-Ux2于根据数据d(2)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L14的各显示单元U14-Ux4亦可经由对应的数据线L21-L2x接收到数据d(2)并根据数据d(2)中对应的数据信号开始进行预先充电。换言之，数据d(2)除了为显示单元U12-Ux2于此帧中所需的最终数据，亦是用以致使显示单元U14-Ux4预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G4的第一个时段t1的导通期间可和驱动信号G2的最后一个时段t2的导通期间完全重叠，但本发明并非以此为限，驱动信号G4的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G2的最后一个时段t2的导通期间。
接续，于驱动信号G3的最后一个时段t2的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(3)。其中，数据d(3)是指源极驱动电路112于此时(即驱动信号G3的最后一个时段t2)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(3)为显示单元U13-Ux3于此帧中充电至真正的显示电位所需的最终数据。
此外，由于驱动信号G5的第一个时段t1的导通期间重叠于驱动信号G3的最后一个时段t2的导通期间，故当显示单元U13-Ux3于根据数据d(3)中对应的数据信号充电至真正的显示电位时，耦接于栅极线L15的各显示单元U15-Ux5亦可经由对应的数据线L21-L2x接收到数据d(3)，并根据数据d(3)中对应的数据信号开始进行预先充电。换言之，数据d(3)除了为显示单元U13-Ux3于此帧中所需的最终数据，亦是用以致使显示单元U15-Ux5预先充电至某一电位的预充数据。
在一些实施方式中，驱动信号G5的第一个时段t1的导通期间可和驱动信号G3的最后一个时段t2的导通期间完全重叠，但本发明并非以此为限，驱动信号G5的第一个时段t1的导通期间亦可仅部分重叠于驱动信号G3的最后一个时段t2的导通期间。
之后，于驱动信号G4的最后一个时段t2的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(4)。其中，数据d(4)是指源极驱动电路112于此时(即驱动信号G4的最后一个时段t2)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(4)为显示单元U14-Ux4于此帧中充电至真正的显示电位所需的最终数据。
最后，于驱动信号G5的最后一个时段t2的导通期间中，源极驱动电路112可经由多条数据线L21-L2x输出数据d(5)。其中，数据d(5)是指源极驱动电路112于此时(即驱动信号G5的最后一个时段t2)经由多条数据线L21-L2x所输出的多个数据信号，并且数据d(5)为显示单元U15-Ux5于此帧中充电至真正的显示电位所需的最终数据。
在一些实施例中，各时段t1、t2的时间长度大于或等于显示装置100的线路时间。并且，时段t1与时段t2相隔的时间间隔td至少大于显示装置100的线路时间。但本发明并非仅限于此，在另一些实施例中，各时段t1、t2的时间长度亦可小于显示装置100的线路时间。
在一些实施例中，各时段t1、t2、t3的时间长度可彼此相同。但本发明并非以此为限，在另一些实施例中，各时段t1、t2、t3的时间长度亦可相互不同。
图8为产生图5多个驱动信号的栅极驱动电路的一实施例的概要示意图，且图9为图8中多个时钟脉冲信号与多驱动信号的一实施例的波形图。请参阅图1至图9，在一实施例中，栅极驱动电路111可包含多个驱动单元。以下，以五个驱动单元111a-111e为例来进行说明，但其数量并用以限定本发明。于此，奇数级的驱动单元111a、111c、111e可设置在显示装置100的图像显示区A1的左侧，且偶数级的驱动单元111b、111d相对地设置在图像显示区A1的右侧，以藉此形成双边驱动的架构，但本发明并非以此为限。
在一实施例中，各驱动单元111a-111e可包含移位寄存器R1及与门(AND Gate)AND1。在每一个奇数级的驱动单元111a、111c、111e中，与门AND1的第一输入端耦接于移位寄存器R1的输出端，且与门的第二输入端接收奇数控制信号OE_O。而在每一个偶数级的驱动单元111b、111d中，与门AND1的第一输入端耦接于移位寄存器R1的输出端，且与门AND1的第二输入端则接收偶数控制信号OE_E。
于此，每一个奇数级的驱动单元111a、111c、111e的与门AND1是根据移位寄存器R1输出的移位信号SR1、SR3、SR5与奇数控制信号OE_O产生对应的驱动信号G1、G3、G5。并且，每一个偶数级的驱动单元111b、111d的与门AND1是根据移位寄存器R1输出的移位信号SR2、SR4与偶数控制信号OE_E产生对应的驱动信号G2、G4。
在一实施例中，奇数控制信号OE_O具有多个时段的导通期间。其中，奇数控制信号OE_O的多个时段于时间上不相连，且各个时段之间可彼此相隔一时间间隔ts1。同样地，偶数控制信号OE_E具有多个时段的导通期间。其中，偶数控制信号OE_E的多个时段于时间上不相连，且各个时段之间可彼此相隔一时间间隔ts2。于此，奇数控制信号OE_O的导通期间和偶数控制信号OE_E的导通期间彼此交错而不重叠。
在一些实施例中，奇数控制信号OE_O的各个时段的时间长度至少大于或等于显示装置100的线路时间。并且，偶数控制信号OE_E的各个时段的时间长度至少大于或等于显示装置100的线路时间。此外，奇数控制信号OE_O中的各个时段间相隔的时间间隔ts1至少大于或等于显示装置100的线路时间。并且，偶数控制信号OE_E中的各个时段间相隔的时间间隔ts2至少大于或等于显示装置100的线路时间。
在一些实施例中，时间间隔ts1大致上与时间间隔ts2相同。
在一实施例中，各移位信号SR1-SR5的信号上升缘的时间点依序两两之间具有时间差。于此，各移位信号SR1-SR5的导通期间最多可与奇数控制信号OE_O(或偶数控制信号OE_E)的两个时段的导通期间重叠。
在一些实施例中，各驱动单元111a-111e更可包含缓冲器Buf1。各驱动单元111a-111e的缓冲器Buf1耦接于各驱动单元111a-111e的与门AND1的输出端。换言之，各驱动单元111a-111e所输出的驱动信号G1-G5可经由缓冲器Buf1的缓冲后再输出。
综上所述，本发明实施例的显示装置及其驱动方法，其藉由输出至各栅极线的驱动信号的导通期间可和后续相隔至少一条栅极线的驱动信号的导通期间有部分重叠，以增加各显示单元的充电时间，并且藉由输出至各栅极线的驱动信号的导通期间和相邻的栅极线的驱动信号的导通期间不重叠，而可有效避免上下成对的暗点的产生，进而得以维持显示装置的品质水平并大幅提升显示装置的生产良率。
当然，本发明还可有其它多种实施例，在不背离本发明精神及其实质的情况下，熟悉本领域的技术人员当可根据本发明作出各种相应的改变和变形，但这些相应的改变和变形都应属于本发明所附的权利要求的保护范围。
Claims (8)
1.一种驱动方法，适用于一显示装置，其特征在于，该驱动方法包含：
依序产生多个驱动信号，其中各该驱动信号具有多个时段的导通期间；及
分别输出该些驱动信号至该显示装置的多条栅极线，其中各该栅极线的该驱动信号的该导通期间与相邻的该栅极线的该驱动信号的该导通期间不重叠，各该栅极线的该驱动信号的该些时段中的最后一个时段的该导通期间与后续相隔至少一条的该栅极线的该驱动信号的该些时段中之一的该导通期间重叠。
2.如权利要求1所述的驱动方法，其特征在于，其中各该驱动信号的该导通期间的该些时段于时间上相连。
3.如权利要求1所述的驱动方法，其特征在于，其中各该驱动信号的该导通期间的该些时段于时间上不相连。
4.如权利要求1所述的驱动方法，其特征在于，其中该显示装置更包含多条数据线与多个显示单元，各该显示单元耦接于该些栅极线中之一与该些数据线中之一，该驱动方法更包含：
产生多个数据信号；及
分别输出该些数据信号至该些数据线，其中各该显示单元在对应的该栅极线的该驱动信号的该导通期间经由对应的该数据线接收该数据信号。
5.一种显示装置，其特征在于，包含：
多条栅极线，沿一第一方向依序排列；及
一栅极驱动电路，依序产生多个驱动信号，并分别输出该些驱动信号至该些栅极线，其中各该驱动信号具有多个时段的导通期间，各该栅极线的该驱动信号的该导通期间与相邻的该栅极线的该驱动信号不重叠，各该栅极线的该驱动信号的该些时段中的最后一个时段的该导通期间与后续相隔至少一条的该栅极线的该驱动信号的该些时段中之一的该导通期间重叠。
6.如权利要求5所述的显示装置，其特征在于，其中各该驱动信号的该导通期间的该些时段于时间上相连。
7.如权利要求5所述的显示装置，其特征在于，其中各该驱动信号的该导通期间的该些时段于时间上不相连。
8.如权利要求5所述的显示装置，其特征在于，更包含：
多条数据线；
多个显示单元，耦接于该些栅极线中之一与该些数据线中之一；及
一源极驱动电路，产生多个数据信号，并分别输出该些数据信号至该些数据线，其中各该显示单元在对应的该栅极线的该驱动信号的该导通期间经由对应的该数据线接收该数据信号。
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